【手続補正書】
【提出日】平成23年5月19日(2011.5.19)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
アナログ回路からのアナログ出力信号および第１のデジタル回路を受信し、第２のデジタル信号を供給するように構成されたフィードバック回路と、
前記フィードバック回路に結合され、前記第２のデジタル信号を受信し、１次またはより高次のホールドでデジタル／アナログ変換を実行する前記アナログ回路、前記アナログ回路のためのアナログ入力信号を供給するように構成されたゼロ次のホールド（ＺＯＨ）回路と、
を備える装置。
【請求項２】
前記フィードバック回路に結合され、デジタル入力信号を受信し、前記第１のデジタル信号を供給するように構成された逆モデル回路をさらに備え、前記逆モデル回路は、前記ＺＯＨ回路および前記アナログ回路の組み合された伝達回路の逆数に基づいて決定される伝達関数を有する、
請求項１に記載の装置。
【請求項３】
前記フィードバック回路は、前記アナログ出力回路に基づいて低周波数ノイズ・フィルタリングを実行するように構成される、
請求項１に記載の装置。
【請求項４】
前記フィードバック回路は、前記アナログ回路の伝達関数に基づいて決定される伝達関数を有するモデル回路を備える、
請求項１に記載の装置。
【請求項５】
前記モデル回路の前記伝達関数は、前記ＺＯＨ回路の伝達関数にさらに基づいて決定される、
請求項４に記載の装置。
【請求項６】
前記フィードバック回路は、前記アナログ回路の少なくとも１つのパラメータを推定するように構成された適応回路をさらに備え、前記モデル回路の前記伝達関数は、前記少なくとも１つの推定されたパラメータに基づく、
請求項４に記載の装置。
【請求項７】
前記フィードバック回路は、前記アナログ回路のポール周波数および利得を推定するように構成された適応回路をさらに備え、前記モデル回路の前記伝達関数は、前記推定されたポール周波数および利得に基づく、
請求項４に記載の装置。
【請求項８】
前記フィードバック回路は、第１のデジタル信号を受信し、モデル出力信号を供給するように構成されたモデル回路と、
前記モデル出力信号とデジタル化された出力信号との差をとり、エラー信号を供給するように構成された第１の加算器と、
前記エラー信号をフィルタにかけ、フィルタにかけられた信号を供給するように構成されたループ・フィルタと、
前記フィルタにかけられた信号と前記第１のデジタル信号との和を取り、前記第２のデジタル信号を供給するように構成された第２の加算器と、
を備える請求項１に記載の装置。
【請求項９】
前記ループ・フィルタは、前記第１のデジタル信号の帯域幅より小さな帯域幅でノイズ・フィルタリングを実行するように構成される、
請求項８に記載の装置。
【請求項１０】
前記フィードバック回路は、前記アナログ出力信号をデジタル化し、前記デジタル化された出力信号を供給するように構成されたアナログ／デジタル変換器（ＡＤＣ）をさらに備える、
請求項８に記載の装置。
【請求項１１】
前記ＡＤＣは、ノイズ形成変調器を備える、
請求項１０に記載の装置。
【請求項１２】
前記フィードバック回路は、前記第１のデジタル信号のための広域変調パスと前記第１のデジタル信号のための低域変調パスを備える、
請求項１に記載の装置。
【請求項１３】
前記アナログ回路は、少なくとも１つのポールを備える、請求項１に記載の装置。
【請求項１４】
前記アナログ回路は、
【数１８】
2011511604.tif 000001
のｓ−ドメイン伝達関数Ｇ（ｓ）を有し、
ここで、ａは、前記アナログ回路のポール周波数であり、ｂは、前記アナログ回路の利得である、
請求項１に記載の装置。
【請求項１５】
前記ポールの周波数は、前記第１のデジタル信号のサンプリング周波数より少なくとも１０倍小さい、
請求項１４に記載の装置。
【請求項１６】
アナログ回路からのアナログ出力信号および第１のデジタル回路を受信し、第２のデジタル信号を供給するように構成されたフィードバック回路と
前記フィードバック回路に結合され、前記第２のデジタル信号を受信し、１次またはより高次のホールドでデジタル／アナログ変換を実行する前記アナログ回路、前記アナログ回路のためのアナログ入力信号を供給するように構成されたゼロ次のホールド（ＺＯＨ）回路と、
を備える集積回路。
【請求項１７】
前記フィードバック回路に結合され、デジタル入力信号を受信し、前記第１のデジタル信号を供給するように構成された逆モデル回路をさらに備え、前記逆モデル回路は、前記ＺＯＨ回路および前記アナログ回路の組み合された伝達回路の逆数に基づいて決定される伝達関数を有する、
請求項１６に記載の集積回路。
【請求項１８】
前記フィードバック回路は、前記第１のデジタル信号を受信し、モデル出力信号を供給するように構成されたモデル回路と、
前記モデル出力信号とデジタル化された出力信号との差をとり、エラー信号を供給するように構成された第１の加算器と、
前記エラー信号をフィルタにかけ、フィルタにかけられた信号を供給するように構成されたループ・フィルタと、
前記フィルタにかけられた信号と前記第１のデジタル信号との和を取り、前記第２のデジタル信号を供給するように構成された第２の加算器と、
を備える請求項１６に記載の集積回路。
【請求項１９】
１次またはより高次のホールドでデジタル／アナログ変換を実行するための方法であって、前記方法は、
第２のデジタル信号を取得するためにアナログ回路からのアナログ出力信号および第１のデジタル回路を処理することと、
前記アナログ回路のためのアナログ入力信号を取得するためにゼロ次のホールドでデジタルからアナログに前記第２のデジタル信号を変換することと、
前記アナログ出力信号を取得するために前記アナログ回路を前記アナログ入力信号が通過することと、
を備える方法。
【請求項２０】
前記第１のデジタル信号を得るために、前記ゼロ次のホールド及び前記アナログ回路の伝達関数の組み合わせの逆数に基づいて決定された伝達関数でデジタル入力信号を処理すること、
をさらに備える請求項１９に記載の方法。
【請求項２１】
前記フィードバック回路で前記アナログ出力信号と前記第１のデジタル信号を前記処理することは、
モデル出力信号を取得するためにモデル回路で前記第１のデジタル信号を処理することと、
エラー信号を取得するために前記モデル出力信号とデジタル化された出力信号との差をとることと、
フィルタにかけられた信号を取得するためにループ・フィルタで前記エラー信号をフィルタリングすることと、
前記第２のデジタル信号を取得するために前記第１のデジタル信号と前記フィルタにかけられた信号との和をとることと、
を備える請求項１９に記載の方法。
【請求項２２】
アナログ回路の少なくとも１つのパラメータを推定することと、
前記少なくとも１つの推定されたパラメータに基づいて前記モデル回路の伝達関数を実施することと、
をさらに備える請求項２１に記載の方法。
【請求項２３】
前記アナログ回路のポール周波数および利得を推定することと、
前記推定されたポール周波数および利得に基づいてモデル回路の伝達関数をインプリメントすることと、
をさらに備える請求項２１に記載の方法。
【請求項２４】
１次またはより高次のホールドでデジタル／アナログ変換を実行するための装置であって、前記装置は、
第２のデジタル信号を取得するためにアナログ回路からのアナログ出力信号および第１のデジタル回路を処理するための手段と、
前記アナログ回路のためのアナログ入力信号を取得するためにゼロ次のホールドでデジタルからアナログに前記第２のデジタル信号を変換するための手段と、
前記アナログ出力信号を取得するために前記アナログ回路を前記アナログ入力信号が通過するための手段と、
を備える装置。
【請求項２５】
前記第１のデジタル信号を得るために、前記ゼロ次のホールド及び前記アナログ回路の伝達関数の組み合わせの逆数に基づいて決定された伝達関数でデジタル入力信号を処理するための手段、
をさらに備える請求項２４に記載の装置。
【請求項２６】
前記フィードバック回路で前記アナログ出力信号と前記第１のデジタル信号を前記処理するための手段は、
モデル出力信号を取得するためにモデル回路で前記第１のデジタル信号を処理するための手段と、
エラー信号を取得するために前記モデル出力信号とデジタル化された出力信号との差を取るための手段と、
フィルタにかけられた信号を取得するためにループ・フィルタで前記エラー信号をフィルタリングするための手段と、
前記第２のデジタル信号を取得するために前記第１のデジタル信号と前記フィルタにかけられた信号との和をとるための手段と、
備える請求項２４に記載の装置。
【請求項２７】
アナログ回路の少なくとも１つのパラメータを推定するための手段と、
前記少なくとも１つの推定されたパラメータに基づいて前記モデル回路の伝達関数をインプリメントするための手段と、
をさらに備える請求項２６に記載の装置。
【請求項２８】
前記アナログ回路のポール周波数および利得を推定するための手段と、
前記推定されたポール周波数および利得に基づいてモデル回路の伝達関数を実施するための手段と
をさらに備える請求項２６に記載の装置。
【請求項２９】
コンピュータ可読媒体を備えるコンピュータ・プログラム製品であって、
前記コンピュータ可読媒体は、
少なくとも１つのコンピュータに、第２のデジタル信号を取得するために第１のデジタル信号を処理させることをもたらすためのコードと、
少なくとも１つのコンピュータに、エラー信号を取得するために前記モデル出力とデジタル化された出力信号との差をとらせることをもたらすためのコードと、
少なくとも１つのコンピュータに、フィルタにかけられた信号を取得するためにループ・フィルタで前記エラー信号をフィルタにかけさせることをもたらすためのコードと、
少なくとも１つのコンピュータに、ゼロ次ホールドでデジタルからアナログに変換するために適した第２のデジタル信号を取得するために前記フィルタにかけられた信号と前記第１のデジタル信号との和をとらせること、およびアナログ出力回路を取得するためにアナログ回路、をもたらすためのコードと、
を備えるコンピュータ・プログラム製品。
【請求項３０】
前記コンピュータ可読媒体は、
少なくとも１つのコンピュータに、アナログ回路の少なくとも１つのパラメータを推定させることをもたらすためのコードと、
前記少なくとも１つのコンピュータに、前記少なくとも１つの推定されたパラメータに基づいてモデル回路の伝達関数をインプリメントさせるためことをもたらすためのコードと、
をさらに備える請求項２９に記載のコンピュータ・プログラム製品。