(57)【要約】  ノイズ検出回路が、第１の基準電圧をコンパレータ（２）の第１の入力端子（２ａ）に印加する第１の基準電圧印加回路（３）と、第２の基準電圧をコンパレータ（２）の第２の入力端子（２ｂ）に印加する第２の基準電圧印加回路（４）と、一端がコンパレータ（２）の出力端子（２ｃ）と接続され、他端がコンパレータ（２）の第１の入力端子（２ａ）又は第２の入力端子（２ｂ）と接続されているフィードバック回路（１０）とを備えるように構成した。
2019116470.tif 000002
【特許請求の範囲】
【請求項１】
第１の入力端子及び第２の入力端子並びに出力端子を有しており、前記第１の入力端子の電位と前記第２の入力端子の電位とを比較し、前記出力端子から電位の比較結果を出力するコンパレータと、
第１の基準電圧を前記第１の入力端子に印加する第１の基準電圧印加回路と、
第２の基準電圧を前記第２の入力端子に印加する第２の基準電圧印加回路と、
一端が前記出力端子と接続され、他端が前記第１の入力端子又は前記第２の入力端子と接続されているフィードバック回路と
を備えたノイズ検出回路。
【請求項２】
前記コンパレータにおける出力端子の電位が閾値電圧以上であるとき、ノイズを検出した旨を表示する表示回路を備えたことを特徴とする請求項１記載のノイズ検出回路。
【請求項３】
前記第１の基準電圧印加回路は、
一端に第１の電圧が印加され、他端が前記第１の入力端子と接続されている第１の抵抗と、
一端が前記第１の抵抗の他端と接続され、他端がグランドと接続されている第１のコンデンサとを備え、
前記第２の基準電圧印加回路は、
一端に第２の電圧が印加され、他端が前記第２の入力端子と接続されている第２の抵抗と、
一端が前記第２の抵抗の他端と接続され、他端がグランドと接続されている第２のコンデンサとを備えていることを特徴とする請求項１記載のノイズ検出回路。
【請求項４】
前記フィードバック回路の他端が前記第１の入力端子と接続されており、
前記第１の抵抗の抵抗値と、前記第１のコンデンサの容量値との積で決定される時定数が第１の時定数であり、前記第２の抵抗の抵抗値と、前記第２のコンデンサの容量値との積で決定される時定数が第２の時定数であるとき、
前記第１の基準電圧が前記第２の基準電圧よりも低く設定され、かつ、前記第１の時定数が前記第２の時定数よりも大きく設定されることを特徴とする請求項３記載のノイズ検出回路。
【請求項５】
前記フィードバック回路の他端が前記第２の入力端子と接続されており、
前記第１の抵抗の抵抗値と、前記第１のコンデンサの容量値との積で決定される時定数が第１の時定数であり、前記第２の抵抗の抵抗値と、前記第２のコンデンサの容量値との積で決定される時定数が第２の時定数であるとき、
前記第１の基準電圧が前記第２の基準電圧よりも高く設定され、かつ、前記第１の時定数が前記第２の時定数よりも小さく設定されることを特徴とする請求項３記載のノイズ検出回路。
【請求項６】
前記第１の基準電圧印加回路は、
一端が前記第１の抵抗の他端と接続され、他端が前記第１の入力端子と接続されているリセット回路を備え、
前記リセット回路は、前記第１の抵抗と前記第１の入力端子との間の電気的な接続と非接続を切り換える回路であることを特徴とする請求項３記載のノイズ検出回路。
【請求項７】
前記第２の基準電圧印加回路は、
一端が前記第２の抵抗の他端と接続され、他端が前記第２の入力端子と接続されているリセット回路を備え、
前記リセット回路は、前記第２の抵抗と前記第２の入力端子との間の電気的な接続と非接続を切り換える回路であることを特徴とする請求項３記載のノイズ検出回路。
【請求項８】
前記フィードバック回路は、アノードが前記コンパレータの出力端子と電気的に接続され、カソードが前記第１の入力端子又は前記第２の入力端子と電気的に接続されているダイオードを備えていることを特徴とする請求項１記載のノイズ検出回路。
【請求項９】
前記第１の基準電圧印加回路は、
前記コンパレータに駆動用の電力を供給するための駆動用電圧を分圧し、分圧した電圧を、前記第１の電圧として、前記第１の抵抗の一端に印加する第１の分圧回路を備え、
前記第２の基準電圧印加回路は、
前記駆動用電圧を分圧し、分圧した電圧を、前記第２の電圧として、前記第２の抵抗の一端に印加する第２の分圧回路を備えていることを特徴とする請求項３記載のノイズ検出回路。
【請求項１０】
前記フィードバック回路は、アノードが前記コンパレータの出力端子と電気的に接続され、カソードが前記第１の入力端子又は前記第２の入力端子と電気的に接続されているダイオードを備えていることを特徴とする請求項９記載のノイズ検出回路。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、コンパレータを備えるノイズ検出回路に関するものである。
【背景技術】
【０００２】
プリント基板に適用されるＥＭＣ（Ｅｌｅｃｔｒｏ  Ｍａｇｎｅｔｉｃ  Ｃｏｍｐａｔｉｂｉｌｉｔｙ）試験として、静電気放電、雷サージ、電気的ファストトランジェントバーストなどの過渡的な電磁ノイズに対する耐性評価試験がある。
耐性評価試験において、過渡的な電磁ノイズの特性を測定して、プリント基板上のノイズ伝搬経路を特定するために、ＥＭＣ測定用のアンテナが取り付けられたオシロスコープなどの計測器を用いることがある。
しかしながら、オシロスコープなどの計測器は、大型で、持ち運びが困難であるため、持ち運びが容易な小型のノイズ検出回路が求められる。【０００３】
以下の特許文献１には、２つのコンパレータと、ピーク検出器と、リセット回路とを備えるノイズ検出回路が開示されている。
２つのコンパレータは、アンテナにより受信された信号の保持と、アンテナにより受信された信号のリセットとを行うＲＳフリップフロップ回路を構成している。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開平８−１０２７１６号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
従来のノイズ検出回路は、コンパレータを２つ備えている。コンパレータは、能動素子であり、一般的に、抵抗、コンデンサなどの受動素子と比べて大型である。このため、コンパレータを２つ備える従来のノイズ検出回路は、回路規模が大きくなってしまうという課題があった。【０００６】
この発明は上記のような課題を解決するためになされたもので、１つのコンパレータを備えるだけで、ノイズを検出することができるノイズ検出回路を得ることを目的とする。
【課題を解決するための手段】
【０００７】
この発明に係るノイズ検出回路は、第１の入力端子及び第２の入力端子並びに出力端子とを有しており、第１の入力端子の電位と第２の入力端子の電位とを比較し、出力端子から電位の比較結果を出力するコンパレータと、第１の基準電圧を第１の入力端子に印加する第１の基準電圧印加回路と、第２の基準電圧を第２の入力端子に印加する第２の基準電圧印加回路と、一端が出力端子と接続され、他端が第１の入力端子又は第２の入力端子と接続されているフィードバック回路とを備えるようにしたものである。
【発明の効果】
【０００８】
この発明によれば、ノイズ検出回路が、第１の基準電圧をコンパレータの第１の入力端子に印加する第１の基準電圧印加回路と、第２の基準電圧をコンパレータの第２の入力端子に印加する第２の基準電圧印加回路と、一端がコンパレータの出力端子と接続され、他端がコンパレータの第１の入力端子又は第２の入力端子と接続されているフィードバック回路とを備えるように構成した。したがって、１つのコンパレータを備えるだけで、ノイズを検出することができる効果がある。
【図面の簡単な説明】
【０００９】
【図１】実施の形態１によるノイズ検出回路を示す構成図である。
【図２】図１に示すノイズ検出回路のノイズ検出動作を示す説明図である。
【図３】差動入力端子１の端子１ｂから入力されたノイズを検出することが可能なノイズ検出回路のノイズ検出動作を示す説明図である。
【図４】実施の形態３によるノイズ検出回路を示す構成図である。
【図５】実施の形態３による他のノイズ検出回路を示す構成図である。
【図６】実施の形態４によるノイズ検出回路を示す構成図である。
【図７】実施の形態４による他のノイズ検出回路を示す構成図である。
【図８】実施の形態５によるノイズ検出回路を示す構成図である。
【図９】図８に示すノイズ検出回路のノイズ検出動作を示す説明図である。
【図１０】実施の形態５による他のノイズ検出回路を示す構成図である。
【図１１】実施の形態６によるノイズ検出回路を示す構成図である。
【図１２】実施の形態６による他のノイズ検出回路を示す構成図である。
【発明を実施するための形態】
【００１０】
以下、この発明をより詳細に説明するために、この発明を実施するための形態について、添付の図面に従って説明する。
【００１１】
実施の形態１．
図１は、実施の形態１によるノイズ検出回路を示す構成図である。
図１において、差動入力端子１は、端子１ａ及び端子１ｂを備えている。
図１に示すノイズ検出回路は、端子１ａから入力されたノイズを検出する回路である。ノイズの波形としては、例えばパルス波形が考えられる。
コンパレータ２は、第１の入力端子２ａ、第２の入力端子２ｂ及び出力端子２ｃを有している。
コンパレータ２は、第１の入力端子２ａの電位Ｖ１と、第２の入力端子２ｂの電位Ｖ２とを比較し、出力端子２ｃから電位の比較結果を出力する。
【００１２】
第１の基準電圧印加回路３は、第１の電圧源３ａ、第１の抵抗３ｂ、抵抗３ｃ及び第１のコンデンサ３ｄを備えている。
図１では、第１の基準電圧印加回路３が第１の電圧源３ａを備えている例を示しているが、第１の電圧源３ａは、ノイズ検出回路の外部に設けられていてもよい。
第１の基準電圧印加回路３は、第１の基準電圧Ｅ１をコンパレータ２の第１の入力端子２ａに印加する回路である。
第１の電圧源３ａは、第１の電圧を第１の抵抗３ｂの一端に印加する電圧源である。
第１の抵抗３ｂは、一端が第１の電圧源３ａと接続されて、他端が抵抗３ｃの一端と接続されており、抵抗値Ｒ１を有している。
抵抗３ｃは、一端が第１の抵抗３ｂの他端と接続されて、他端がコンパレータ２の第１の入力端子２ａと接続されており、抵抗値Ｒ３を有している。
第１のコンデンサ３ｄは、一端が第１の抵抗３ｂの他端と接続されて、他端がグランドと接続されており、容量値Ｃ１を有している。
図１では、第１の基準電圧印加回路３が、単一のコンデンサである第１のコンデンサ３ｄだけを備えている例を示しているが、これに限るものではなく、複数のコンデンサで第１のコンデンサ３ｄを構成してもよい。なお、複数のコンデンサの容量は、それぞれ同じであってもよいし、異なっていてもよい。
【００１３】
第２の基準電圧印加回路４は、第２の電圧源４ａ、第２の抵抗４ｂ、抵抗４ｃ及び第２のコンデンサ４ｄを備えている。
図１では、第２の基準電圧印加回路４が第２の電圧源４ａを備えている例を示しているが、第２の電圧源４ａは、ノイズ検出回路の外部に設けられていてもよい。
第２の基準電圧印加回路４は、第２の基準電圧Ｅ２をコンパレータ２の第２の入力端子２ｂに印加する回路である。
第２の電圧源４ａは、第２の電圧を第２の抵抗４ｂの一端に印加する電圧源である。
第２の抵抗４ｂは、一端が第２の電圧源４ａと接続されて、他端が抵抗４ｃの一端と接続されており、抵抗値Ｒ２を有している。
抵抗４ｃは、一端が第２の抵抗４ｂの他端と接続されて、他端がコンパレータ２の第２の入力端子２ｂと接続されており、抵抗値Ｒ４を有している。
第２のコンデンサ４ｄは、一端が第２の抵抗４ｂの他端と接続されて、他端がグランドと接続されており、容量値Ｃ２を有している。
図１では、第２の基準電圧印加回路４が、単一のコンデンサである第２のコンデンサ４ｄだけを備えている例を示しているが、これに限るものではなく、複数のコンデンサで第２のコンデンサ４ｄを構成してもよい。なお、複数のコンデンサの容量は、それぞれ同じであってもよいし、異なっていてもよい。
【００１４】
駆動用電源５は、コンパレータ２に駆動用の電力を供給するための電圧Ｅ０を出力する電源である。
図１では、ノイズ検出回路が駆動用電源５を備えている例を示しているが、駆動用電源５は、ノイズ検出回路の外部に設けられている電圧源であってもよい。
コンデンサ６は、一端が差動入力端子１の端子１ａと接続されて、他端が抵抗８の一端と接続されており、容量値Ｃ３を有している。
コンデンサ６は、差動入力端子１の端子１ａから入力される信号に含まれている直流成分を遮断するために設けられている。
コンデンサ７は、一端が差動入力端子１の端子１ｂと接続されて、他端が抵抗９の一端と接続されており、容量値Ｃ４を有している。
コンデンサ７は、差動入力端子１の端子１ｂから入力される信号に含まれている直流成分を遮断するために設けられている。
【００１５】
抵抗８は、一端がコンデンサ６の他端と接続されて、他端がコンパレータ２の第１の入力端子２ａと接続されており、抵抗値Ｒ５を有している。
抵抗９は、一端がコンデンサ７の他端と接続されて、他端がコンパレータ２の第２の入力端子２ｂと接続されており、抵抗値Ｒ６を有している。
フィードバック回路１０は、一端がコンパレータ２の出力端子２ｃと接続されて、他端がコンパレータ２の第１の入力端子２ａと接続されている回路であり、抵抗１１を備えている。
抵抗１１は、一端がコンパレータ２の出力端子２ｃと接続されて、他端がコンパレータ２の第１の入力端子２ａと接続されており、抵抗値Ｒ７を有している。
抵抗１２は、一端がコンパレータ２の出力端子２ｃと接続されて、他端が表示回路１３と接続されており、抵抗値Ｒ８を有している。
抵抗３ｃ，４ｃ，８，９，１１，１２は、ノイズ検出回路のインピーダンスを設定するために設けられている。ただし、抵抗３ｃ，４ｃ，８，９，１１，１２は、ノイズ検出回路において、必須の要素ではない。したがって、第１の抵抗３ｂの他端がコンパレータ２の第１の入力端子２ａと直接接続されていてもよい。また、第２の抵抗４ｂの他端がコンパレータ２の第２の入力端子２ｂと直接接続されていてもよい。
【００１６】
表示回路１３は、例えば、ＬＥＤ（Ｌｉｇｈｔ  Ｅｍｉｔｔｉｎｇ  Ｄｉｏｄｅ）を備えている。
表示回路１３は、コンパレータ２における出力端子２ｃの電位Ｖ３がＬＥＤの閾値電圧以上であるとき、ＬＥＤを発光させることで、ノイズを検出した旨を表示する回路である。
【００１７】
次に、図２を参照しながら、ノイズ検出回路の動作原理について説明する。図２は、図１に示すノイズ検出回路のノイズ検出動作を示す説明図である。
この実施の形態１では、コンパレータ２の差動入力の電位差がΔＶ、コンパレータ２の第１の入力端子２ａにおける電位がＶ１、コンパレータ２の第２の入力端子２ｂにおける電位がＶ２、コンパレータ２の出力端子２ｃにおける電位がＶ３であるとする。
また、コンパレータ２の出力端子２ｃから第１の入力端子２ａに向けて、フィードバック回路１０を流れる電流がＩであるとする。
【００１８】
ここでは、説明の便宜上、駆動用電源５からコンパレータ２に出力される電圧Ｅ０が、３．０（Ｖ）であるとする。
また、第１の基準電圧印加回路３からコンパレータ２の第１の入力端子２ａに出力される第１の基準電圧Ｅ１が１．４８（Ｖ）であり、第２の基準電圧印加回路４からコンパレータ２の第２の入力端子２ｂに出力される第２の基準電圧Ｅ２が１．５０（Ｖ）であるとする。
差動入力端子１の端子１ａからノイズが入力されていない状態では、第１の入力端子２ａにおける電位Ｖ１は、第１の基準電圧Ｅ１と等しい。したがって、差動入力端子１の端子１ａからノイズが入力されていない状態では、第１の入力端子２ａにおける電位Ｖ１は、第２の入力端子２ｂにおける電位Ｖ２（＝Ｅ２）よりも低くなっている。
コンパレータ２は、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２以下である場合、出力端子２ｃにおける電位Ｖ３がＬレベル（０Ｖ）になるように設定されている。
また、コンパレータ２は、電位Ｖ１が上昇して、電位Ｖ１が電位Ｖ２よりも高くなると、電位Ｖ３がＨレベル（０Ｖよりも高い電圧）になるように設定されている。
コンパレータ２は、増幅率がｇのオペアンプに相当し、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、電位Ｖ１が電位Ｖ２よりも高い場合、電位差ΔＶ（＝Ｖ１−Ｖ２）と正比例する電位（＝ΔＶ×ｇ）となる。
この実施の形態１では、コンパレータ２の出力側の電圧降下は、すべて無視するものとする。
【００１９】
まず、第２の基準電圧印加回路４は、第２の基準電圧Ｅ２をコンパレータ２の第２の入力端子２ｂに印加することで、以下の式（１）に示すように、コンパレータ２の第２の入力端子２ｂにおける電位Ｖ２をＥ２に設定する。
Ｖ２＝Ｅ２              （１）
次に、第１の基準電圧印加回路３は、第１の基準電圧Ｅ１をコンパレータ２の第１の入力端子２ａに印加することで、以下の式（２）に示すように、コンパレータ２の第１の入力端子２ａにおける電位Ｖ１をＥ１に設定する。
Ｖ１＝Ｅ１              （２）
第１の入力端子２ａにおける電位Ｖ１をＥ１に設定し、第２の入力端子２ｂにおける電位Ｖ２をＥ２に設定している状態においては、Ｖ１＜Ｖ２であるため、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、Ｌレベルである。
コンパレータ２の出力端子２ｃにおける電位Ｖ３がＬレベルである状態は、ノイズを検出することが可能なノイズ入力待ち状態である。
【００２０】
差動入力端子１の端子１ａからノイズが入力されると、ノイズによる電位ＶＮが第１の入力端子２ａに印加される。
このため、第１の入力端子２ａにおける電位Ｖ１は、以下の式（３）に示すように、ノイズによる電位ＶＮが印加される分だけ上昇する。
Ｖ１＝Ｅ１＋ＶＮ        （３）
ノイズによる電位ＶＮが大きいために、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態（Ｖ１＞Ｖ２）になることがある。
第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態（Ｖ１＞Ｖ２）になると、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、ＬレベルからＨレベルに遷移して、電位差ΔＶ（＝Ｖ１−Ｖ２）と正比例する電位となる。
表示回路１３のＬＥＤは、コンパレータ２の出力端子２ｃにおける電位Ｖ３が上昇して、電位Ｖ３がＬＥＤの閾値電圧よりも高くなると、ＬＥＤに順方向電流が流れるため、発光する。ユーザは、表示回路１３のＬＥＤが発光することで、ノイズが検出されたことを認識できる。
この実施の形態１では、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＬＥＤの閾値電圧よりも高くなると、表示回路１３のＬＥＤが発光する例を示しているが、順方向電流のレベルに応じて、発光する色が変化するようにしてもよい。
【００２１】
ここで、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、第１の入力端子２ａにおける電位Ｖ１以下の状態であれば（Ｖ１≧Ｖ３）、コンパレータ２の出力端子２ｃから第１の入力端子２ａに向けて、電流Ｉが流れることはない。
第１の入力端子２ａにおける電位Ｖ１の上昇に伴って、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、第１の入力端子２ａにおける電位Ｖ１よりも高くなると（Ｖ１＜Ｖ３）、フィードバック回路１０を通じて、コンパレータ２の出力端子２ｃから第１の入力端子２ａに向けて、電流Ｉが流れる。
フィードバック回路１０を通じて、電流Ｉが一旦流れると、第１の入力端子２ａにおける電位Ｖ１は、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続する。
このため、差動入力端子１の端子１ａから入力されたノイズのパルス幅が狭いために、ノイズによる電位ＶＮが第１の入力端子２ａに印加されている状態が直ぐに解消されても、第１の入力端子２ａにおける電位Ｖ１は、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続する。
第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続することで、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、Ｈレベルに保持されるため、表示回路１３におけるＬＥＤの発光が継続される。
【００２２】
この実施の形態１では、差動入力端子１の端子１ａから入力されたノイズを検出するノイズ検出回路を説明している。
ノイズ検出回路が、差動入力端子１の端子１ｂから入力されたノイズを検出することができるようにするには、図３に示すように、一端がコンパレータ２の出力端子２ｃと接続されているフィードバック回路１０の他端が、コンパレータ２の第２の入力端子２ｂと接続されている必要がある。
図３は、差動入力端子１の端子１ｂから入力されたノイズを検出することが可能なノイズ検出回路のノイズ検出動作を示す説明図である。
【００２３】
差動入力端子１の端子１ｂから入力されたノイズを検出する場合には、第１の基準電圧印加回路３により印加される第１の基準電圧Ｅ１は、第２の基準電圧印加回路４により印加される第２の基準電圧Ｅ２よりも高くなるように設定されている。
コンパレータ２は、第２の入力端子２ｂにおける電位Ｖ２が、第１の入力端子２ａにおける電位Ｖ１以下である場合、出力端子２ｃにおける電位Ｖ３がＬレベル（０Ｖ）となるように設定されている。
また、コンパレータ２は、電位Ｖ２が上昇して、電位Ｖ２が電位Ｖ１よりも高くなると、電位Ｖ３がＨレベルになるように設定されている。
コンパレータ２は、増幅率がｇのオペアンプに相当し、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、電位Ｖ２が電位Ｖ１よりも高い場合、電位差ΔＶ（＝Ｖ２−Ｖ１）と正比例する電位（＝ΔＶ×ｇ）となる。
【００２４】
まず、第１の基準電圧印加回路３は、第１の基準電圧Ｅ１をコンパレータ２の第１の入力端子２ａに印加することで、上記の式（２）に示すように、コンパレータ２の第１の入力端子２ａにおける電位Ｖ１をＥ１に設定する。
次に、第２の基準電圧印加回路４は、第２の基準電圧Ｅ２をコンパレータ２の第２の入力端子２ｂに印加することで、上記の式（１）に示すように、コンパレータ２の第２の入力端子２ｂにおける電位Ｖ２をＥ２に設定する。
第１の入力端子２ａにおける電位Ｖ１をＥ１に設定し、第２の入力端子２ｂにおける電位Ｖ２をＥ２に設定している状態においては、Ｖ１＞Ｖ２であるため、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、Ｌレベルである。
差動入力端子１の端子１ｂからノイズが入力されると、ノイズによる電位ＶＮが第２の入力端子２ｂに印加される。
このため、第２の入力端子２ｂにおける電位Ｖ２は、以下の式（４）に示すように、ノイズによる電位ＶＮが印加される分だけ上昇する。
Ｖ２＝Ｅ２＋ＶＮ        （４）
【００２５】
ノイズによる電位ＶＮが大きいために、第２の入力端子２ｂにおける電位Ｖ２が、第１の入力端子２ａにおける電位Ｖ１よりも高い状態（Ｖ１＜Ｖ２）になることがある。
第２の入力端子２ｂにおける電位Ｖ２が、第１の入力端子２ａにおける電位Ｖ１よりも高い状態（Ｖ１＜Ｖ２）になると、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、ＬレベルからＨレベルに遷移して、電位差ΔＶ（＝Ｖ２−Ｖ１）と正比例する電位となる。
表示回路１３のＬＥＤは、コンパレータ２の出力端子２ｃにおける電位Ｖ３が上昇して、電位Ｖ３がＬＥＤの閾値電圧よりも高くなると、ＬＥＤに順方向電流が流れるため、発光する。ユーザは、表示回路１３のＬＥＤが発光することで、ノイズが検出されたことを認識できる。
【００２６】
ここで、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、第２の入力端子２ｂにおける電位Ｖ２以下の状態であれば（Ｖ２≧Ｖ３）、コンパレータ２の出力端子２ｃから第２の入力端子２ｂに向けて、電流Ｉが流れることはない。
第２の入力端子２ｂにおける電位Ｖ２の上昇に伴って、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、第２の入力端子２ｂにおける電位Ｖ２よりも高くなると（Ｖ２＜Ｖ３）、フィードバック回路１０を通じて、コンパレータ２の出力端子２ｃから第２の入力端子２ｂに向けて、電流Ｉが流れる。
フィードバック回路１０を通じて、電流Ｉが一旦流れると、第２の入力端子２ｂにおける電位Ｖ２は、第１の入力端子２ａにおける電位Ｖ１よりも高い状態が継続する。
このため、差動入力端子１の端子１ｂから入力されたノイズのパルス幅が狭いために、ノイズによる電位ＶＮが第２の入力端子２ｂに印加されている状態が直ぐに解消されても、第２の入力端子２ｂにおける電位Ｖ２は、第１の入力端子２ａにおける電位Ｖ１よりも高い状態が継続する。
第２の入力端子２ｂにおける電位Ｖ２が、第１の入力端子２ａにおける電位Ｖ１よりも高い状態が継続することで、コンパレータ２の出力端子２ｃにおける電位Ｖ３は、Ｈレベルに保持されるため、表示回路１３におけるＬＥＤの発光が継続される。
【００２７】
以上の実施の形態１は、ノイズ検出回路が、第１の基準電圧Ｅ１をコンパレータ２の第１の入力端子２ａに印加する第１の基準電圧印加回路３と、第２の基準電圧Ｅ２をコンパレータ２の第２の入力端子２ｂに印加する第２の基準電圧印加回路４と、一端がコンパレータ２の出力端子２ｃと接続され、他端がコンパレータ２の第１の入力端子２ａ又は第２の入力端子２ｂと接続されているフィードバック回路１０とを備えるように構成した。したがって、１つのコンパレータ２を備えるだけで、ノイズを検出することができる。
【００２８】
実施の形態２．
実施の形態１では、差動入力端子１の端子１ａから入力されたノイズを検出する場合、第２の基準電圧印加回路４が、第２の入力端子２ｂにおける電位Ｖ２を第２の基準電圧Ｅ２に設定してから、第１の基準電圧印加回路３が、第１の入力端子２ａにおける電位Ｖ１を第１の基準電圧Ｅ１に設定する例を示している。
第２の入力端子２ｂにおける電位Ｖ２を第２の基準電圧Ｅ２に設定してから、第１の入力端子２ａにおける電位Ｖ１を第１の基準電圧Ｅ１に設定する理由は、以下の通りである。
第２の入力端子２ｂにおける電位Ｖ２が第２の基準電圧Ｅ２に設定されるよりも先に、第１の入力端子２ａにおける電位Ｖ１が第１の基準電圧Ｅ１に設定されてしまうと、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに固定されてしまって、ノイズを検出することができなくなるからである。
【００２９】
この実施の形態２では、第１の電圧源３ａから第１の電圧が出力されるタイミングと、第２の電圧源４ａから第２の電圧が出力されるタイミングとが概ね同時であっても、第２の基準電圧印加回路４が、第２の入力端子２ｂにおける電位Ｖ２を第２の基準電圧Ｅ２に設定してから、第１の基準電圧印加回路３が、第１の入力端子２ａにおける電位Ｖ１を第１の基準電圧Ｅ１に設定するようにしている。
【００３０】
具体的には、以下の通りである。
差動入力端子１の端子１ａから入力されたノイズを検出する場合、図１に示すノイズ検出回路において、実施の形態１と同様に、第１の基準電圧Ｅ１は、第２の基準電圧Ｅ２よりも低い電圧に設定されているものとする。
この実施の形態２では、第１の抵抗３ｂが有する抵抗値Ｒ１と、第１のコンデンサ３ｄが有する容量値Ｃ１との積で決定される時定数は、第１の時定数τ１であるとする。また、第２の抵抗４ｂが有する抵抗値Ｒ２と、第２のコンデンサ４ｄが有する容量値Ｃ２との積で決定される時定数は、第２の時定数τ２であるとする。
このとき、第１の時定数τ１が、第２の時定数τ２よりも大きくなるように、第１の抵抗３ｂが有する抵抗値Ｒ１、第１のコンデンサ３ｄが有する容量値Ｃ１、第２の抵抗４ｂが有する抵抗値Ｒ２及び第２のコンデンサ４ｄが有する容量値Ｃ２のそれぞれが設定されているものとする。
【００３１】
第１の時定数τ１が第２の時定数τ２よりも大きければ、第１の電圧源３ａから第１の電圧が出力されるタイミングと、第２の電圧源４ａから第２の電圧が出力されるタイミングとが同時であっても、第１の基準電圧印加回路３から第１の基準電圧Ｅ１が出力されるタイミングが、第２の基準電圧印加回路４から第２の基準電圧Ｅ２が出力されるタイミングよりも遅くなる。
この結果、第２の基準電圧印加回路４が、第２の入力端子２ｂにおける電位Ｖ２を第２の基準電圧Ｅ２に設定してから、第１の基準電圧印加回路３が、第１の入力端子２ａにおける電位Ｖ１を第１の基準電圧Ｅ１に設定するようになる。
【００３２】
差動入力端子１の端子１ｂから入力されたノイズを検出する場合、図３に示すノイズ検出回路において、実施の形態１と同様に、第１の基準電圧Ｅ１は、第２の基準電圧Ｅ２よりも高い電圧に設定されているものとする。
このとき、第１の時定数τ１が、第２の時定数τ２よりも小さくなるように、第１の抵抗３ｂが有する抵抗値Ｒ１、第１のコンデンサ３ｄが有する容量値Ｃ１、第２の抵抗４ｂが有する抵抗値Ｒ２及び第２のコンデンサ４ｄが有する容量値Ｃ２のそれぞれが設定されているものとする。
【００３３】
第１の時定数τ１が第２の時定数τ２よりも小さければ、第１の電圧源３ａから第１の電圧が出力されるタイミングと、第２の電圧源４ａから第２の電圧が出力されるタイミングとが同時であっても、第２の基準電圧印加回路４から第２の基準電圧Ｅ２が出力されるタイミングが、第１の基準電圧印加回路３から第１の基準電圧Ｅ１が出力されるタイミングよりも遅くなる。
この結果、第１の基準電圧印加回路３が、第１の入力端子２ａにおける電位Ｖ１を第１の基準電圧Ｅ１に設定してから、第２の基準電圧印加回路４が、第２の入力端子２ｂにおける電位Ｖ２を第２の基準電圧Ｅ２に設定するようになる。
【００３４】
以上の実施の形態２は、差動入力端子１の端子１ａから入力されたノイズを検出する場合、第１の基準電圧Ｅ１が第２の基準電圧Ｅ２よりも低く設定され、かつ、第１の時定数τ１が第２の時定数τ２よりも大きく設定されるように構成した。また、差動入力端子１の端子１ｂから入力されたノイズを検出する場合、第１の基準電圧Ｅ１が第２の基準電圧Ｅ２よりも高く設定され、かつ、第１の時定数τ１が第２の時定数τ２よりも小さく設定されるように構成した。したがって、第１の電圧源３ａから第１の電圧が出力されるタイミングと、第２の電圧源４ａから第２の電圧が出力されるタイミングとが同時であっても、第１の基準電圧Ｅ１と第２の基準電圧Ｅ２のうち、電圧が低い方の基準電圧Ｅを先に設定することができる。この結果、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに固定されてしまって、ノイズを検出することができなくなる状況の発生を防ぐことができる。
【００３５】
実施の形態３．
実施の形態１のノイズ検出回路は、フィードバック回路１０を通じて、電流Ｉが流れると、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持される例を示している。
この実施の形態３では、コンパレータ２の出力端子２ｃにおける電位Ｖ３をＨレベルからＬレベルに戻すことができるノイズ検出回路について説明する。
【００３６】
図４は、実施の形態３によるノイズ検出回路を示す構成図である。図４において、図１と同一符号は同一又は相当部分を示すので説明を省略する。
第１の基準電圧印加回路３は、リセット回路２１を備えている。リセット回路２１は、一端が第１の抵抗３ｂの他端と接続され、他端が抵抗３ｃを介して第１の入力端子２ａと接続されている。
リセット回路２１は、第１の抵抗３ｂと第１の入力端子２ａとの間の電気的な接続と非接続を切り換える回路である。
この実施の形態３では、リセット回路２１として、例えば、ディップスイッチ又はタクトスイッチを用いる例を想定しているが、ディップスイッチ又はタクトスイッチに限るものではなく、例えば、リードスイッチ又は磁気抵抗素子などの近接センサを用いるものであってもよい。また、リセット回路２１は、直接操作によって接続と非接続を切り換える回路であってもよいし、遠隔操作によって接続と非接続を切り換える回路であってもよい。
【００３７】
この実施の形態３においても、実施の形態１と同様に、コンパレータ２の出力端子２ｃにおける電位Ｖ３が上昇して、電位Ｖ３がＬＥＤの閾値電圧よりも高くなることがある。表示回路１３のＬＥＤは、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＬＥＤの閾値電圧よりも高くなると、実施の形態１と同様に、順方向電流が流れるため、発光する。ユーザは、表示回路１３のＬＥＤが発光することで、ノイズが検出されたことを認識できる。
実施の形態１では、フィードバック回路１０を通じて、電流Ｉが一旦流れると、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続するため、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持される。
差動入力端子１の端子１ａから入力されたノイズのパルス幅が狭い場合、ノイズによる電位ＶＮが第１の入力端子２ａに印加されている状態が直ぐに解消される。ノイズによる電位ＶＮが第１の入力端子２ａに印加されている状態が直ぐに解消されても、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持されているため、表示回路１３におけるＬＥＤの発光状態が継続される。よって、ユーザが、ノイズが検出されたことを見逃す状況の発生を防ぐことができる。
【００３８】
しかし、実施の形態１における図１に示すノイズ検出回路は、コンパレータ２の出力端子２ｃにおける電位Ｖ３をＨレベルからＬレベルに戻す手段を備えていない。このため、例えば、ノイズ検出回路に対する電源を一旦落とすことで、ノイズ検出回路の全体をリセットしなければ、以降に入力されるノイズを検出することができない。
この実施の形態３では、第１の基準電圧印加回路３がリセット回路２１を備えているので、ノイズ検出回路の全体をリセットすることなく、コンパレータ２の出力端子２ｃにおける電位Ｖ３をＨレベルからＬレベルに戻すことができる。
【００３９】
リセット回路２１は、差動入力端子１の端子１ａから入力されたノイズを検出する場合、第１の抵抗３ｂと抵抗３ｃとの間を接続することで、第１の抵抗３ｂと第１の入力端子２ａとの間を電気的に接続する。
リセット回路２１は、差動入力端子１の端子１ａから入力されたノイズが検出されたのち、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＨレベルからＬレベルに戻される際には、第１の抵抗３ｂと抵抗３ｃとの間を切り離すことで、第１の抵抗３ｂと第１の入力端子２ａとの間を非接続にする。
第１の抵抗３ｂと第１の入力端子２ａとの間を非接続にすることで、第１の入力端子２ａにおける電位Ｖ１は、差動入力端子１の端子１ａにノイズが入力されていなければ、第２の入力端子２ｂにおける電位Ｖ２よりも低くなるため、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＬレベルに戻る。
【００４０】
図４に示すノイズ検出回路は、差動入力端子１の端子１ａから入力されたノイズを検出する例を示しているが、差動入力端子１の端子１ｂから入力されたノイズを検出するノイズ検出回路の場合は、図５に示すように、第２の基準電圧印加回路４がリセット回路２２を備えている。
図５は、実施の形態３による他のノイズ検出回路を示す構成図である。図５において、図３と同一符号は同一又は相当部分を示すので説明を省略する。
【００４１】
第２の基準電圧印加回路４は、リセット回路２２を備えている。リセット回路２２は、一端が第２の抵抗４ｂの他端と接続され、他端が抵抗４ｃを介して第２の入力端子２ｂと接続されている。
リセット回路２２は、第２の抵抗４ｂと第２の入力端子２ｂとの間の電気的な接続と非接続を切り換える回路である。
この実施の形態３では、リセット回路２２として、例えば、ディップスイッチ又はタクトスイッチを用いる例を想定しているが、ディップスイッチ又はタクトスイッチに限るものではなく、例えば、リードスイッチ又は磁気抵抗素子などの近接センサを用いるものであってもよい。また、リセット回路２２は、直接操作によって接続と非接続を切り換える回路であってもよいし、遠隔操作によって接続と非接続を切り換える回路であってもよい。
【００４２】
差動入力端子１の端子１ｂから入力されたノイズを検出する場合でも、フィードバック回路１０を通じて、電流Ｉが一旦流れると、第２の入力端子２ｂにおける電位Ｖ２が、第１の入力端子２ａにおける電位Ｖ１よりも高い状態が継続するため、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持される。
差動入力端子１の端子１ｂから入力されたノイズのパルス幅が狭い場合、ノイズによる電位ＶＮが第２の入力端子２ｂに印加されている状態が直ぐに解消される。ノイズによる電位ＶＮが第２の入力端子２ｂに印加されている状態が直ぐに解消されても、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持されているため、表示回路１３におけるＬＥＤの発光状態が継続される。よって、ユーザが、ノイズが検出されたことを見逃す状況の発生を防ぐことができる。
【００４３】
差動入力端子１の端子１ｂから入力されたノイズを検出する実施の形態１における図３に示すノイズ検出回路は、コンパレータ２の出力端子２ｃにおける電位Ｖ３をＨレベルからＬレベルに戻す手段を備えていない。このため、例えば、ノイズ検出回路に対する電源を一旦落とすことで、ノイズ検出回路の全体をリセットしなければ、以降に入力されるノイズを検出することができない。
この実施の形態３では、第２の基準電圧印加回路４がリセット回路２２を備えているので、ノイズ検出回路の全体をリセットすることなく、コンパレータ２の出力端子２ｃにおける電位Ｖ３をＨレベルからＬレベルに戻すことができる。
【００４４】
リセット回路２２は、差動入力端子１の端子１ｂから入力されたノイズを検出する場合、第２の抵抗４ｂと抵抗４ｃとの間を接続することで、第２の抵抗４ｂと第２の入力端子２ｂとの間を電気的に接続する。
リセット回路２２は、差動入力端子１の端子１ｂから入力されたノイズが検出されたのち、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＨレベルからＬレベルに戻される際には、第２の抵抗４ｂと抵抗４ｃとの間を切り離すことで、第２の抵抗４ｂと第２の入力端子２ｂとの間を非接続にする。
第２の抵抗４ｂと第２の入力端子２ｂとの間を非接続にすることで、第２の入力端子２ｂにおける電位Ｖ２は、差動入力端子１の端子１ｂにノイズが入力されていなければ、第１の入力端子２ａにおける電位Ｖ１よりも低くなるため、コンパレータ２の出力端子２ｃにおける電位Ｖ３がＬレベルに戻る。
【００４５】
実施の形態４．
実施の形態１では、フィードバック回路１０が、抵抗１１を備えている例を示している。
この実施の形態４では、フィードバック回路１０が、抵抗１１のほかに、ダイオード２３を備えている例を説明する。
【００４６】
図６は、実施の形態４によるノイズ検出回路を示す構成図である。図６において、図１と同一符号は同一又は相当部分を示すので説明を省略する。
フィードバック回路１０は、抵抗１１及びダイオード２３を備えている。
ダイオード２３は、アノードがコンパレータ２における出力端子２ｃと接続され、カソードが、抵抗１１を介して、コンパレータ２における第１の入力端子２ａと電気的に接続されている。
ダイオード２３は、コンパレータ２における出力端子２ｃの電位Ｖ３が、コンパレータ２における第１の入力端子２ａの電位Ｖ１よりも高く、かつ、出力端子２ｃの電位Ｖ３と、第１の入力端子２ａの電位Ｖ１との電位差（Ｖ３−Ｖ１）が、ダイオード２３の順方向電圧よりも高いときに、出力端子２ｃから第１の入力端子２ａに向けて順方向電流である電流Ｉを流す素子である。
この実施の形態４では、説明の簡単化のため、抵抗１１における電圧降下を無視している。
図６では、図１に示すノイズ検出回路にダイオード２３を適用している例を示しているが、図４に示すノイズ検出回路にダイオード２３を適用するようにしてもよい。
【００４７】
例えば、図１に示すノイズ検出回路では、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高い場合、フィードバック回路１０を流れる電流Ｉの向きが、第１の入力端子２ａから出力端子２ｃに向かう方向となる。
このため、フィードバック回路１０を流れる電流Ｉは、余分な電流として、表示回路１３に流れてしまう。その結果、例えば、ノイズとして検出する必要がない微弱な信号が入力された場合でも、ＬＥＤが発光してしまう可能性がある。
【００４８】
この実施の形態４では、フィードバック回路１０がダイオード２３を備えており、ダイオード２３は、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉを流さない。
このため、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高い場合でも、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉが、余分な電流として、表示回路１３に流れてしまうことがない。
【００４９】
コンパレータ２における出力端子２ｃの電位Ｖ３は、実施の形態１と同様に、差動入力端子１の端子１ａにノイズが入力されることで上昇する。
ダイオード２３は、出力端子２ｃの電位Ｖ３が上昇して、出力端子２ｃの電位Ｖ３が、第１の入力端子２ａの電位Ｖ１よりも高くなり、かつ、出力端子２ｃの電位Ｖ３と、第１の入力端子２ａの電位Ｖ１との電位差（Ｖ３−Ｖ１）が、ダイオード２３の順方向電圧よりも高くなると、順方向電流である電流Ｉを流すようになる。
順方向電流である電流Ｉがダイオード２３を流れることで、実施の形態１と同様に、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続される。その結果、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持される。
【００５０】
以上の実施の形態４は、フィードバック回路１０が、アノードがコンパレータ２の出力端子２ｃと接続され、カソードが第１の入力端子２ａと電気的に接続されているダイオード２３を備えている。ダイオード２３は、出力端子２ｃの電位Ｖ３が、第１の入力端子２ａの電位Ｖ１よりも高く、かつ、出力端子２ｃの電位Ｖ３と、第１の入力端子２ａの電位Ｖ１との電位差（Ｖ３−Ｖ１）が、ダイオード２３の順方向電圧よりも高いときに、出力端子２ｃから第１の入力端子２ａに向けて順方向電流を流すように構成した。したがって、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高いとき、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉが、余分な電流として、表示回路１３に流れてしまうことを防ぐことができる。
【００５１】
図６では、差動入力端子１の端子１ａから入力されたノイズを検出することが可能なノイズ検出回路を示しているが、差動入力端子１の端子１ｂから入力されたノイズを検出することが可能なノイズ検出回路については、図３又は図５に示すノイズ検出回路にダイオード２３を適用するようにしてもよい。
図７は、実施の形態４による他のノイズ検出回路を示す構成図であり、図７に示すノイズ検出回路は、ダイオード２３が適用されており、差動入力端子１の端子１ｂから入力されたノイズを検出することができる。
【００５２】
実施の形態５．
実施の形態１では、第１の基準電圧印加回路３における第１の抵抗３ｂの一端には、第１の電圧源３ａから出力された第１の電圧が印加され、第２の基準電圧印加回路４における第２の抵抗４ｂの一端には、第２の電圧源４ａから出力された第２の電圧が印加される例を示している。
この実施の形態５では、第１の基準電圧印加回路３１が、駆動用電源５から出力された電圧Ｅ０を分圧する第１の分圧回路３２を備え、第１の抵抗３ｂの一端には、第１の分圧回路３２により分圧された電圧が、第１の電圧として印加される例を説明する。
また、第２の基準電圧印加回路４が、駆動用電源５から出力された電圧Ｅ０を分圧する第２の分圧回路４２を備え、第２の抵抗４ｂの一端には、第２の分圧回路４２により分圧された電圧が、第１の電圧として印加される例を説明する。
【００５３】
図８は、実施の形態５によるノイズ検出回路を示す構成図である。図８において、図１及び図４と同一符号は同一又は相当部分を示すので説明を省略する。
第１の基準電圧印加回路３１は、第１の抵抗３ｂ、抵抗３ｃ、第１のコンデンサ３ｄ及び第１の分圧回路３２を備えている。第１の基準電圧印加回路３１は、第１の基準電圧Ｅ１をコンパレータ２の第１の入力端子２ａに印加する回路である。
第１の分圧回路３２は、分圧抵抗３２ａ，３２ｂを備えている。
第１の分圧回路３２は、駆動用電源５から出力された電圧Ｅ０を分圧し、分圧した電圧を、第１の電圧として、第１の抵抗３ｂの一端に出力する回路である。
分圧抵抗３２ａは、一端が駆動用電源５と接続され、他端が第１の抵抗３ｂの一端及び分圧抵抗３２ｂの一端とそれぞれ接続されており、抵抗値Ｒ１１を有している。
分圧抵抗３２ｂは、一端が第１の抵抗３ｂの一端及び分圧抵抗３２ａの他端とそれぞれ接続され、他端がグランドと接続されており、抵抗値Ｒ１２を有している。
【００５４】
第２の基準電圧印加回路４１は、第２の抵抗４ｂ、抵抗４ｃ、第２のコンデンサ４ｄ及び第２の分圧回路４２を備えている。第２の基準電圧印加回路４１は、第２の基準電圧Ｅ２をコンパレータ２の第２の入力端子２ｂに印加する回路である。
第２の分圧回路４２は、分圧抵抗４２ａ，４２ｂを備えている。
第２の分圧回路４２は、駆動用電源５から出力された電圧Ｅ０を分圧し、分圧した電圧を、第２の電圧として、第２の抵抗４ｂの一端に出力する回路である。
分圧抵抗４２ａは、一端が駆動用電源５と接続され、他端が第２の抵抗４ｂの一端及び分圧抵抗４２ｂの一端とそれぞれ接続されており、抵抗値Ｒ２１を有している。
分圧抵抗４２ｂは、一端が第２の抵抗４ｂの一端及び分圧抵抗４２ａの他端とそれぞれ接続され、他端がグランドと接続されており、抵抗値Ｒ２２を有している。
【００５５】
図８に示すノイズ検出回路は、第１の基準電圧印加回路３１が、リセット回路２１を備えているが、第１の基準電圧印加回路３１が、リセット回路２１を備えていないノイズ検出回路であってもよい。
【００５６】
次に、図９を参照しながら、ノイズ検出回路の動作原理について説明する。図９は、図８に示すノイズ検出回路のノイズ検出動作を示す説明図である。
この実施の形態５では、差動入力端子１の端子１ａに入力されたノイズを検出するものとする。
この実施の形態５では、コンパレータ２の差動入力の電位差がΔＶ、コンパレータ２の第１の入力端子２ａにおける電位がＶ１、コンパレータ２の第２の入力端子２ｂにおける電位がＶ２、コンパレータ２の出力端子２ｃにおける電位がＶ３であるとする。
また、コンパレータ２の出力端子２ｃから第１の入力端子２ａに流れる電流がＩであるとする。
【００５７】
ここでは、説明の便宜上、駆動用電源５からコンパレータ２に出力される電圧Ｅ０が、３．０（Ｖ）であるとする。
また、駆動用電源５の出力電位がＶ５（＝Ｅ０）、分圧抵抗３２ａと分圧抵抗３２ｂとの間の電位がＶ６、分圧抵抗４２ａと分圧抵抗４２ｂとの間の電位がＶ７であるとする。
また、分圧抵抗３２ａが有する抵抗値Ｒ１１が５（ｋΩ）、分圧抵抗３２ｂが有する抵抗値Ｒ１２が４（ｋΩ）、分圧抵抗４２ａが有する抵抗値Ｒ２１が５（ｋΩ）、分圧抵抗４２ｂが有する抵抗値Ｒ２２が５（ｋΩ）であるとする。
【００５８】
抵抗値Ｒ１１が５（ｋΩ）、抵抗値Ｒ１２が４（ｋΩ）、抵抗値Ｒ２１が５（ｋΩ）及び抵抗値Ｒ２２が５（ｋΩ）であれば、分圧抵抗３２ａと分圧抵抗３２ｂとの間の電位Ｖ６は、以下の式（５）のようになり、分圧抵抗４２ａと分圧抵抗４２ｂとの間の電位Ｖ７は、以下の式（６）のようになる。
2019116470.tif 000003
2019116470.tif 000004
【００５９】
第１の抵抗３ｂが有する抵抗値Ｒ１、抵抗３ｃが有する抵抗値Ｒ３、第２の抵抗４ｂが有する抵抗値Ｒ２及び抵抗４ｃが有する抵抗値Ｒ４のそれぞれは、電位Ｖ６及び電位Ｖ７を考慮して、差動入力端子１の端子１ａからノイズが入力されていない状態のときに、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも低い電位になるように設定される。
差動入力端子１の端子１ａからノイズが入力されていない状態のとき、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも低い電位になるように設定されることで、実施の形態１等と同様に動作するノイズ検出回路が得られる。
この実施の形態５では、第１の電圧源３ａ及び第２の電圧源４ａが不要になり、単一の電源として、駆動用電源５だけが、ノイズ検出回路の内部又は外部にあればよい。
【００６０】
図８では、差動入力端子１の端子１ａから入力されたノイズを検出することが可能なノイズ検出回路を示しているが、差動入力端子１の端子１ｂから入力されたノイズを検出することが可能なノイズ検出回路については、例えば、図３又は図５に示すノイズ検出回路に、第１の基準電圧印加回路３１及び第２の基準電圧印加回路４１を適用するようにしてもよい。ただし、第１の基準電圧印加回路３１が備えているリセット回路２１は、不要である。
図１０は、実施の形態５による他のノイズ検出回路を示す構成図であり、図１０に示すノイズ検出回路は、第１の基準電圧印加回路３１及び第２の基準電圧印加回路４１が適用されており、差動入力端子１の端子１ｂから入力されたノイズを検出することができる。
【００６１】
この実施の形態５では、第１の分圧回路３２が、分圧抵抗３２ａ，３２ｂを備え、第２の分圧回路４２が、分圧抵抗４２ａ，４２ｂを備える構成例を示している。
しかし、第１の分圧回路３２及び第２の分圧回路４２のそれぞれは、駆動用電源５から出力された電圧Ｅ０を分圧することができればよく、上記の構成例に限るものではない。
例えば、分圧抵抗３２ａ，３２ｂ，４２ａ，４２ｂの代わりに、それぞれ可変抵抗を用いて、第１の基準電圧印加回路３１から出力される第１の基準電圧Ｅ１及び第２の基準電圧印加回路４１から出力される第２の基準電圧Ｅ２のそれぞれを調整できるようにしてもよい。
【００６２】
実施の形態６．
実施の形態５では、フィードバック回路１０が、抵抗１１を備えている例を示している。
この実施の形態６では、フィードバック回路１０が、抵抗１１のほかに、ダイオード２３を備えている例を説明する。
【００６３】
図１１は、実施の形態６によるノイズ検出回路を示す構成図である。図１１において、図１及び図８と同一符号は同一又は相当部分を示すので説明を省略する。
フィードバック回路１０は、抵抗１１及びダイオード２３を備えている。
例えば、図８に示すノイズ検出回路では、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高い場合、フィードバック回路１０を流れる電流Ｉの向きが、第１の入力端子２ａから出力端子２ｃに向かう方向となる。
このため、フィードバック回路１０を流れる電流Ｉは、余分な電流として、表示回路１３に流れてしまう。その結果、例えば、ノイズとして検出する必要がない微弱な信号が入力された場合でも、ＬＥＤが発光してしまう可能性がある。
【００６４】
この実施の形態６では、フィードバック回路１０がダイオード２３を備えており、ダイオード２３は、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉを流さない。
このため、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高い場合でも、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉが、余分な電流として、表示回路１３に流れてしまうことがない。
【００６５】
コンパレータ２における出力端子２ｃの電位Ｖ３は、実施の形態５と同様に、差動入力端子１の端子１ａにノイズが入力されることで上昇する。
ダイオード２３は、出力端子２ｃの電位Ｖ３が上昇して、出力端子２ｃの電位Ｖ３が、第１の入力端子２ａの電位Ｖ１よりも高くなり、かつ、出力端子２ｃの電位Ｖ３と、第１の入力端子２ａの電位Ｖ１との電位差（Ｖ３−Ｖ１）が、ダイオード２３の順方向電圧よりも高くなると、順方向電流である電流Ｉを流すようになる。
順方向電流である電流Ｉがダイオード２３を流れることで、実施の形態５と同様に、第１の入力端子２ａにおける電位Ｖ１が、第２の入力端子２ｂにおける電位Ｖ２よりも高い状態が継続される。その結果、コンパレータ２の出力端子２ｃにおける電位Ｖ３が、Ｈレベルに保持される。
【００６６】
以上の実施の形態６は、フィードバック回路１０が、アノードがコンパレータ２の出力端子２ｃと接続され、カソードが第１の入力端子２ａと電気的に接続されているダイオード２３を備えている。ダイオード２３は、出力端子２ｃの電位Ｖ３が、第１の入力端子２ａの電位Ｖ１よりも高く、かつ、出力端子２ｃの電位Ｖ３と、第１の入力端子２ａの電位Ｖ１との電位差（Ｖ３−Ｖ１）が、ダイオード２３の順方向電圧よりも高いときに、出力端子２ｃから第１の入力端子２ａに向けて順方向電流を流すように構成した。したがって、コンパレータ２における第１の入力端子２ａの電位Ｖ１が、コンパレータ２における出力端子２ｃの電位Ｖ３よりも高いときに、第１の入力端子２ａから出力端子２ｃに向かう電流Ｉが、余分な電流として、表示回路１３に流れてしまうことを防ぐことができる。
【００６７】
図１１では、差動入力端子１の端子１ａから入力されたノイズを検出することが可能なノイズ検出回路を示しているが、差動入力端子１の端子１ｂから入力されたノイズを検出することが可能なノイズ検出回路については、図１０に示すノイズ検出回路にダイオード２３を適用するようにしてもよい。
図１２は、実施の形態６による他のノイズ検出回路を示す構成図であり、図１２に示すノイズ検出回路は、ダイオード２３が適用されており、差動入力端子１の端子１ｂから入力されたノイズを検出することができる。
【００６８】
なお、本願発明はその発明の範囲内において、各実施の形態の自由な組み合わせ、あるいは各実施の形態の任意の構成要素の変形、もしくは各実施の形態において任意の構成要素の省略が可能である。
【産業上の利用可能性】
【００６９】
この発明は、コンパレータを備えるノイズ検出回路に適している。
【符号の説明】
【００７０】
１  差動入力端子、１ａ，１ｂ  端子、２  コンパレータ、２ａ  第１の入力端子、２ｂ  第２の入力端子、２ｃ  出力端子、３  第１の基準電圧印加回路、３ａ  第１の電圧源、３ｂ  第１の抵抗、３ｃ  抵抗、３ｄ  第１のコンデンサ、４  第２の基準電圧印加回路、４ａ  第２の電圧源、４ｂ  第２の抵抗、４ｃ  抵抗、４ｄ  第２のコンデンサ、５  駆動用電源、６，７  コンデンサ、８，９  抵抗、１０  フィードバック回路、１１，１２  抵抗、１３  表示回路、２１，２２  リセット回路、２３  ダイオード、３１  第１の基準電圧印加回路、３２  第１の分圧回路、３２ａ，３２ｂ  分圧抵抗、４１  第２の基準電圧印加回路、４２  第２の分圧回路、４２ａ，４２ｂ  分圧抵抗。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【手続補正書】
【提出日】令和1年12月25日(2019.12.25)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００７
【補正方法】変更
【補正の内容】
【０００７】
この発明に係るノイズ検出回路は、第１の入力端子及び第２の入力端子並びに出力端子とを有しており、第１の入力端子の電位と第２の入力端子の電位とを比較し、出力端子から電位の比較結果を出力するコンパレータと、第１の基準電圧を第１の入力端子に印加する第１の基準電圧印加回路と、第２の基準電圧を第２の入力端子に印加する第２の基準電圧印加回路と、一端が出力端子と接続され、他端が第１の入力端子又は第２の入力端子と接続されているフィードバック回路とを備えるようにしたものである。
この構成における第１の基準電圧印加回路は、一端に第１の電圧が印加され、他端が第１の入力端子と接続されている第１の抵抗と、一端が第１の抵抗の他端と接続され、他端がグランドと接続されている第１のコンデンサとを備えている。
この構成における第２の基準電圧印加回路は、一端に第２の電圧が印加され、他端が第２の入力端子と接続されている第２の抵抗と、一端が第２の抵抗の他端と接続され、他端がグランドと接続されている第２のコンデンサとを備えている。
【手続補正２】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
第１の入力端子及び第２の入力端子並びに出力端子を有しており、前記第１の入力端子の電位と前記第２の入力端子の電位とを比較し、前記出力端子から電位の比較結果を出力するコンパレータと、
第１の基準電圧を前記第１の入力端子に印加する第１の基準電圧印加回路と、
第２の基準電圧を前記第２の入力端子に印加する第２の基準電圧印加回路と、
一端が前記出力端子と接続され、他端が前記第１の入力端子又は前記第２の入力端子と接続されているフィードバック回路と
を備え、
前記第１の基準電圧印加回路は、
一端に第１の電圧が印加され、他端が前記第１の入力端子と接続されている第１の抵抗と、
一端が前記第１の抵抗の他端と接続され、他端がグランドと接続されている第１のコンデンサとを備え、
前記第２の基準電圧印加回路は、
一端に第２の電圧が印加され、他端が前記第２の入力端子と接続されている第２の抵抗と、
一端が前記第２の抵抗の他端と接続され、他端がグランドと接続されている第２のコンデンサとを備えていることを特徴とするノイズ検出回路。
【請求項２】
前記コンパレータにおける出力端子の電位が閾値電圧以上であるとき、ノイズを検出した旨を表示する表示回路を備えたことを特徴とする請求項１記載のノイズ検出回路。
【請求項３】
前記フィードバック回路の他端が前記第１の入力端子と接続されており、
前記第１の抵抗の抵抗値と、前記第１のコンデンサの容量値との積で決定される時定数が第１の時定数であり、前記第２の抵抗の抵抗値と、前記第２のコンデンサの容量値との積で決定される時定数が第２の時定数であるとき、
前記第１の基準電圧が前記第２の基準電圧よりも低く設定され、かつ、前記第１の時定数が前記第２の時定数よりも大きく設定されることを特徴とする請求項１記載のノイズ検出回路。
【請求項４】
前記フィードバック回路の他端が前記第２の入力端子と接続されており、
前記第１の抵抗の抵抗値と、前記第１のコンデンサの容量値との積で決定される時定数が第１の時定数であり、前記第２の抵抗の抵抗値と、前記第２のコンデンサの容量値との積で決定される時定数が第２の時定数であるとき、
前記第１の基準電圧が前記第２の基準電圧よりも高く設定され、かつ、前記第１の時定数が前記第２の時定数よりも小さく設定されることを特徴とする請求項１記載のノイズ検出回路。
【請求項５】
前記第１の基準電圧印加回路は、
一端が前記第１の抵抗の他端と接続され、他端が前記第１の入力端子と接続されているリセット回路を備え、
前記リセット回路は、前記第１の抵抗と前記第１の入力端子との間の電気的な接続と非接続を切り換える回路であることを特徴とする請求項１記載のノイズ検出回路。
【請求項６】
前記第２の基準電圧印加回路は、
一端が前記第２の抵抗の他端と接続され、他端が前記第２の入力端子と接続されているリセット回路を備え、
前記リセット回路は、前記第２の抵抗と前記第２の入力端子との間の電気的な接続と非接続を切り換える回路であることを特徴とする請求項１記載のノイズ検出回路。
【請求項７】
前記第１の基準電圧印加回路は、
前記コンパレータに駆動用の電力を供給するための駆動用電圧を分圧し、分圧した電圧を、前記第１の電圧として、前記第１の抵抗の一端に印加する第１の分圧回路を備え、
前記第２の基準電圧印加回路は、
前記駆動用電圧を分圧し、分圧した電圧を、前記第２の電圧として、前記第２の抵抗の一端に印加する第２の分圧回路を備えていることを特徴とする請求項１記載のノイズ検出回路。
【請求項８】
前記フィードバック回路は、アノードが前記コンパレータの出力端子と電気的に接続され、カソードが前記第１の入力端子又は前記第２の入力端子と電気的に接続されているダイオードを備えていることを特徴とする請求項７記載のノイズ検出回路。
【国際調査報告】
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2019116470.tif 000019
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