(57)【要約】  インターフェース回路の校正回路（１０１）において、制御回路（１４０）は校正を実行する場合に、電圧（Ｖ１，ＶＲＥＦ）または電圧（Ｖ１，Ｖ２）が比較器（１３０）に与えられるように、セレクタ（１２０）を制御する。２つの電圧の比較器（１２０）への入力先は、正負入れ替えられる。そしてそれぞれの状態で、制御回路（１４０）は、比較器（１２０）の出力変化時における可変抵抗制御信号（ＵＰＣＯＤＥ，ＤＮＣＯＤＥ）の信号値を求め、求めた信号値の平均値を用いて、終端抵抗の抵抗値を制御するための校正データを求める。
2010137088.tif 000002
【特許請求の範囲】
【請求項１】
終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号とを出力する制御回路とを備え、
前記制御回路は、
校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記比較器の出力変化時における前記第１または第２の可変抵抗制御信号の信号値を、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧の前記比較器への入力先を正負入れ替えたそれぞれの状態で求め、求めた信号値の平均値を用いて、前記校正データを求める
ことを特徴とするインターフェース回路。
【請求項２】
請求項１記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第１または第２の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項３】
終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器のオフセット補正用のＤＡコンバータと、
前記ＤＡコンバータの出力を、前記比較器の正入力または負入力に加算する加算器と、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号と、前記ＤＡコンバータに与えるオフセット補正信号とを出力する制御回路とを備え、
前記制御回路は、
校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記校正データを求める前に、前記参照電圧が前記比較器の正負入力の両方に与えられるように前記セレクタ制御信号によって前記セレクタを制御した状態で、前記オフセット補正信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記オフセット補正信号の信号値を基にして、オフセット補正データを求め、
校正を実行する場合において、前記オフセット補正データを前記ＤＡコンバータに与えるものである
ことを特徴とするインターフェース回路。
【請求項４】
請求項３記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第１または第２の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項５】
請求項４記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、オフセット補正データを再度求めた後に、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項６】
請求項２または４記載のインターフェース回路において、
温度電圧変換素子と、
前記温度電圧変換素子の出力と、少なくとも２つ以上の異なる温度検出用基準電圧とを比較する温度検出用比較部と、
校正データの温度補正量が、前記温度検出用比較部の出力と関連付けて格納されている温度補正テーブルとを備え、
前記制御回路は、
再校正を行う場合において、前記温度検出用比較部の出力を受け、この出力を用いて前記温度補正テーブルを参照することによって、校正データの温度補正量を求める
ことを特徴とするインターフェース回路。
【請求項７】
請求項２または４記載のインターフェース回路において、
前記制御回路は、再校正を行う場合に、処理を時間的に分割して実行する
ことを特徴とするインターフェース回路。
【請求項８】
請求項２または４記載のインターフェース回路において、
前記制御回路は、再校正を、繰り返し実行する
ことを特徴とするインターフェース回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、メモリインターフェース等のインターフェース回路に関し、特に、バス終端のための終端抵抗の抵抗値を校正する技術に関する。
【背景技術】
【０００２】
一般に、インターフェース回路では、バスの終端のために、ＳＳＴＬ(stub busterminated logic)と能動終端(active termination)とが用いられる。能動終端はオンチップ終端(on-chip termination)ともいい、チップ内部の能動終端抵抗（以下、「終端抵抗」という）を用いてバスの終端を行う。能動終端はＳＳＴＬよりも信号伝達特性が良く、データレートが高い。【０００３】
能動終端において、終端抵抗の抵抗値ずれは信号伝達特性の低下を招く。そしてデータ伝送の高速化に伴い、終端抵抗の抵抗値ずれが信号伝達特性に与える影響は、より顕著に現れる。よって、信号伝達特性の低下を防ぐために、終端抵抗を正確に所望の抵抗値に校正することが求められる。【０００４】
例えば、特許文献１には、２つの比較器と第１及び第２の可変抵抗、第１の可変抵抗と同一のダミー可変抵抗、第１制御コード発生回路、第２制御コード発生回路とを備え、工程、電圧、または温度に関係なく終端抵抗の抵抗値を校正できる校正回路が開示されている。一方の比較器が第１可変抵抗と外部抵抗が接続される第１のノードと基準電圧ＶＲＥＦを比較し、他方の比較器が第１のノードと、ダミー可変抵抗と第２可変抵抗が接続される第２のノードを比較する。２つの比較器の出力結果に基づいて、第１制御コード発生回路及び第２制御コード発生回路が制御コードを発生する。【０００５】
また、例えば、特許文献２には、周辺温度の変化等による終端抵抗の抵抗値の変動を補正するインターフェース回路が開示されている。データの送受信が停止しているときに、２つの比較器を用いて複数の抵抗素子が共通接続されているｎｏｄｅ１と、所望の終端抵抗の抵抗値の範囲から算出した上限基準電圧及び下限基準電圧との比較を行い、範囲を超えた場合に範囲内に収まるように補正を行う。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開２００３−２６０７７９号公報
【特許文献２】特許第３６０９３６３号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
しかしながら、従来の回路構成では、終端抵抗の校正のために、アナログ素子からなる比較器が用いられている。比較器は通常、オフセットを持ち、このオフセットはアナログ素子ばらつきの影響により、それぞれの比較器によってばらばらの値となる。このため、比較器による電圧比較の精度が保証されず、したがって、終端抵抗の抵抗値を必ずしも所望の抵抗値に校正できず、信号伝達特性が低下してしまうという問題があった。【０００８】
本発明は、上記の点に鑑み、インターフェース回路において、アナログ素子ばらつきの影響を受けることなく、終端抵抗の抵抗値を精度良く校正可能にすることを目的とする。
【課題を解決するための手段】
【０００９】
本発明の第１態様は、終端抵抗の抵抗値を校正する機能を有するインターフェース回路として、終端抵抗として機能する可変抵抗部と、参照抵抗が外付けされるパッドと、前記パッドに接続されており、前記可変抵抗部に抵抗値を制御するための校正データを出力する校正回路とを備え、前記校正回路は、第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、正入力および負入力を有する比較器と、前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号とを出力する制御回路とを備え、前記制御回路は、校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、前記比較器の出力変化時における前記第１または第２の可変抵抗制御信号の信号値を、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧の前記比較器への入力先を正負入れ替えたそれぞれの状態で求め、求めた信号値の平均値を用いて、前記校正データを求めるものである。【００１０】
この態様によると、比較器によって、第１ノードの電圧と参照電圧、または第１ノードの電圧と第２ノードの電圧を比較する際に、比較器への入力先が正負入れ替えられる。そしてそれぞれの状態で、比較器の出力変化時における第１または第２の可変抵抗制御信号の信号値が求められ、求めた信号値の平均値を用いて、終端抵抗の抵抗値を制御するための校正データが求められる。このような動作により、比較器のオフセットの影響を受けることなく、精度の高い校正データを求めることができ、したがって、アナログ素子ばらつきの影響を受けることなく終端抵抗を所望の抵抗値に校正することができるので、良好な信号伝達特性を確保することが可能となる。【００１１】
本発明の第２態様は、終端抵抗の抵抗値を校正する機能を有するインターフェース回路として、終端抵抗として機能する可変抵抗部と、参照抵抗が外付けされるパッドと、前記パッドに接続されており、前記可変抵抗部に抵抗値を制御するための校正データを出力する校正回路とを備え、前記校正回路は、第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、正入力および負入力を有する比較器と、前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、前記比較器のオフセット補正用のＤＡコンバータと、前記ＤＡコンバータの出力を、前記比較器の正入力または負入力に加算する加算器と、前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号と、前記ＤＡコンバータに与えるオフセット補正信号とを出力する制御回路とを備え、前記制御回路は、校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、前記校正データを求める前に、前記参照電圧が前記比較器の正負入力の両方に与えられるように前記セレクタ制御信号によって前記セレクタを制御した状態で、前記オフセット補正信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記オフセット補正信号の信号値を基にして、オフセット補正データを求め、校正を実行する場合において、前記オフセット補正データを前記ＤＡコンバータに与えるものである。【００１２】
この態様によると、校正データを求める前に、参照電圧が比較器の正負入力の両方に与えられ、また、正負入力の一方に、オフセット補正信号を受けたＤＡコンバータの出力が加算器によって加算される。この状態で、比較器の出力変化時におけるオフセット補正信号の信号値が求められ、これに基づいてオフセット補正データが求められる。そして、このオフセット補正データは、校正を実行する場合において、ＤＡコンバータに与えられる。このような動作により、比較器のオフセットの影響を受けることなく、精度の高い校正データを求めることができ、したがって、アナログ素子ばらつきの影響を受けることなく終端抵抗を所望の抵抗値に校正することができるので、良好な信号伝達特性を確保することが可能となる。
【発明の効果】
【００１３】
本発明によると、比較器のオフセットの影響を受けることなく、精度の高い校正データを求めることができ、したがって、アナログ素子ばらつきの影響を受けることなく終端抵抗を所望の抵抗値に校正することができるので、良好な信号伝達特性を確保することが可能となる。
【図面の簡単な説明】
【００１４】
【図１】実施形態１〜３に係るインターフェース回路の概略構成図である。
【図２】図１のインターフェース回路がメモリインターフェース回路として機能する場合の概略構成を示す図である。
【図３】実施形態１に係る校正回路の構成を示す回路図である。
【図４】可変抵抗の回路構成例である。
【図５】実施形態２に係る校正回路の構成を示す回路図である。
【図６】実施形態３に係る校正回路の構成を示す回路図である。
【発明を実施するための形態】
【００１５】
以下、本発明の実施形態について、図面を参照して説明する。なお、以下の各実施形態において、他の実施形態と同様の機能を有する構成要素については同一の符号を付して説明を省略する。
【００１６】
（実施形態１）
図１は実施形態１に係るインターフェース回路の構成を概略的に示す回路図である。図１に示すインターフェース回路１００は、トランスミッター回路１０２、レシーバ回路１０３、データバスに接続される送信用パッド１０６、および、データバスに接続される受信用パッド１０７を備えている。トランスミッター回路１０２と送信用パッド１０６との間、およびレシーバ回路１０３と受信用パッド１０７との間には、バスの能動終端抵抗として機能する可変抵抗部１０４Ａ，１０４Ｂがそれぞれ設けられている。また、インターフェース回路１００は、能動終端抵抗を校正するための校正回路１０１（２０１，３０１）を備えている。校正回路１０１（２０１，３０１）は、外付けされた参照抵抗Ｒｔｅｒｍとパッド１０５を介して接続されている。そして、校正動作を実行した後、校正データとしての第１および第２の制御コードＵＰＣＯＤＥ，ＤＮＣＯＤＥによって、可変抵抗部１０４Ａ，１０４Ｂの抵抗値を制御する。第１および第２の制御コードＵＰＣＯＤＥ，ＤＮＣＯＤＥは、例えば５ビットで構成される。
【００１７】
また、校正回路１０１（２０１，３０１）には、校正イネーブル信号ＣＡＬＥＮがパッド１０８を介して与えられる。この校正イネーブル信号ＣＡＬＥＮは校正動作区間を示す信号であり、例えば、校正イネーブル信号ＣＡＬＥＮがＬレベルからＨレベルに遷移したとき、校正回路１０１（２０１，３０１）は校正動作を開始する。なお、この校正イネーブル信号ＣＡＬＥＮは、必ずしもインターフェース回路１００の外部から与えられる必要はなく、例えば、インターフェース回路１００の内部で発生させてもよい。
【００１８】
図２は図１のインターフェース回路１００がメモリインターフェース回路として機能する場合の概略構成を示す図である。図２の構成では、インターフェース回路１００は、メモリ回路５００と接続されており、書き込みデータを送信用パッド１０６からデータバスを介して送信し、読み出しデータをデータバスを介して受信用パッド１０７から受信する。また、校正イネーブル信号ＣＡＬＥＮはメモリ回路５００からインターフェース回路１００に与えられる。なお、図１のインターフェース回路１００は、メモリインターフェース以外の用途に用いてもかまわない。
【００１９】
図３は本実施形態に係る校正回路１０１の構成を示す回路図である。図３において、電源電位ＶＤＤを与える第１の電源とパッド１０５との間にダミー可変抵抗１１０が接続されており、また、第１の電源と接地電位ＶＳＳを与える第２の電源との間に、第１および第２の可変抵抗１１１，１１２が直列に接続されている。Ｖ１はダミー可変抵抗１１０とパッド１０５との間の第１ノードであり、Ｖ２は第１の可変抵抗１１１と第２の可変抵抗１１２との間の第２ノードである。ダミー可変抵抗１１０および第１の可変抵抗１１１の抵抗値は、後述する制御回路１４０から出力された第１の可変抵抗制御信号ＵＰＣＯＤＥによって制御され、第２の可変抵抗１１２の抵抗値は、制御回路１４０から出力された第２の可変抵抗制御信号ＤＮＣＯＤＥによって制御される。可変抵抗制御信号と抵抗値との関係は、例えば、信号の全ビットが“０”のときは抵抗値が最大値となり、信号値が大きくなるにつれて抵抗値が小さくなり、信号の全ビットが“１”のときに抵抗値が最小値となる、というように定めればよい。なお、この可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥは、校正動作の終了後、第１および第２の制御コードとして用いられる。
【００２０】
図４は第１および第２の可変抵抗１１１，１１２の回路構成例を示す。図４に示すとおり、第１の可変抵抗１１１と第２の可変抵抗１１２とは第２ノードＶ２を挟んで対称的な構造になっており、その動作および抵抗値の制御方法は同様である。また、ダミー可変抵抗１１０の構成および動作は第１の可変抵抗１１１と同様である。さらに、図１に示した可変抵抗部１０４Ａ，１０４Ｂの構成および動作は、第１および第２の可変抵抗１１１，１１２と同様である。
【００２１】
図３に戻り、比較器１３０は、（＋）入力（正入力）および（−）入力（負入力）を有しており、（＋）入力の電圧が（−）入力の電圧よりも高いときはＨレベルを出力する一方、（＋）入力の電圧が（−）入力の電圧よりも低いときはＬレベルを出力する。セレクタ１２０は、第１ノードＶ１の電圧（以下適宜、電圧Ｖ１と称する）、第２ノードＶ２の電圧（以下適宜、電圧Ｖ２と称する）、および参照電圧ＶＲＥＦを入力とし、これらの電圧の中から、比較器１３０の（＋）入力および（−）入力に与える電圧を、それぞれ選択出力する。セレクタ１２０の選択動作は、制御回路１４０から出力されたセレクタ制御信号ＩＮＳＥＬによって制御される。また、参照電圧ＶＲＥＦは、例えば、第１および第２の可変抵抗１１１，１１２の抵抗値が参照抵抗Ｒｔｅｒｍと同一になるような電圧に設定されている。
【００２２】
制御回路１４０は、比較器１３０の出力を入力とし、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥと、セレクタ制御信号ＩＮＳＥＬとを出力する。また、校正イネーブル信号ＣＡＬＥＮを受け、この校正イネーブル信号ＣＡＬＥＮに従って校正動作を行う。
【００２３】
＜校正動作の説明＞
このように構成された校正回路１０１が実行する校正動作について、説明する。本実施形態では、まず、電圧Ｖ１と参照電圧ＶＲＥＦとを比較して、第１の制御コードを決定する（比較工程Ａ）。その後、電圧Ｖ１と電圧Ｖ２とを比較して、第２の制御コードを決定する（比較工程Ｂ）。また、比較工程Ａ，Ｂにおいてそれぞれ、２つの電圧の比較器１３０への入力先を正負入れ替えて、それぞれの状態で比較動作を行うものとする。
【００２４】
−比較工程Ａ−
制御回路１４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に電圧Ｖ１が入力され、（−）入力に参照電圧ＶＲＥＦが入力されるように、セレクタ１２０を制御する（第１の比較状態）。
【００２５】
この第１の比較状態で、制御回路１４０は、第１の可変抵抗制御信号ＵＰＣＯＤＥを変化させることによってダミー可変抵抗１１０の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、制御コード候補ａとして保持する。例えば、第１の可変抵抗制御信号ＵＰＣＯＤＥを、全ビット“０”の状態からアップカウントしていく。これにより、ダミー可変抵抗１１０の抵抗値が最大値から徐々に小さくなっていき、ダミー可変抵抗１１０と参照抵抗Ｒｔｅｒｍの抵抗比の変化に応じて、ノードＶ１の電圧は上昇する。そして、ノードＶ１の電圧が参照電圧ＶＲＥＦを上回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、制御コード候補ａとして保持する。
【００２６】
次に、制御回路１４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に参照電圧ＶＲＥＦが入力され、（−）入力に電圧Ｖ１が入力されるように、セレクタ１２０を制御する（第２の比較状態）。すなわち、比較器１３０の正負入力が入れ替えられる。
【００２７】
この第２の比較状態で、制御回路１４０は、第１の可変抵抗制御信号ＵＰＣＯＤＥを変化させることによってダミー可変抵抗１１０の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、制御コード候補ｂとして保持する。例えば、第１の可変抵抗制御信号ＵＰＣＯＤＥを、全ビット“１”の状態からダウンカウントしていく。これにより、ダミー可変抵抗１１０の抵抗値が最小値から徐々に大きくなっていき、ダミー可変抵抗１１０と参照抵抗Ｒｔｅｒｍの抵抗比の変化に応じて、ノードＶ１の電圧は下降する。そして、ノードＶ１の電圧が参照電圧ＶＲＥＦを下回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、制御コード候補ｂとして保持する。
【００２８】
そして、制御回路１４０は、保持している制御コード候補ａおよび制御コード候補ｂの平均値を求め、この平均値を、終端抵抗を校正するための第１の制御コードとして定める。次の比較工程Ｂでは、ここで定めた第１の制御コードを第１の可変抵抗制御信号ＵＰＣＯＤＥとして用いて、第１の可変抵抗１１１の抵抗値を設定する。
【００２９】
−比較工程Ｂ−
制御回路１４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に電圧Ｖ１が入力され、（−）入力に電圧Ｖ２が入力されるように、セレクタ１２０を制御する（第３の比較状態）。
【００３０】
この第３の比較状態で、制御回路１４０は、第２の可変抵抗制御信号ＤＮＣＯＤＥを変化させることによって第２の可変抵抗１１２の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、制御コード候補ｃとして保持する。例えば、第２の可変抵抗制御信号ＤＮＣＯＤＥを、全ビット“０”の状態からアップカウントしていく。これにより、第２の可変抵抗１１２の抵抗値が最大値から徐々に小さくなっていき、第１の可変抵抗１１１と第２の可変抵抗１１２の抵抗比の変化に応じて、ノードＶ２の電圧は下降する。そして、ノードＶ２の電圧が電圧Ｖ１を下回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、制御コード候補ｃとして保持する。
【００３１】
次に、制御回路１４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に電圧Ｖ２が入力され、（−）入力に電圧Ｖ１が入力されるように、セレクタ１２０を制御する（第４の比較状態）。すなわち、比較器１３０の正負入力が入れ替えられる。
【００３２】
この第４の比較状態で、制御回路１４０は、第２の可変抵抗制御信号ＤＮＣＯＤＥを変化させることによって第２の可変抵抗１１２の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、制御コード候補ｄとして保持する。例えば、第２の可変抵抗制御信号ＤＮＣＯＤＥを、全ビット“１”の状態からダウンカウントしていく。これにより、第２の可変抵抗１１２の抵抗値が最小値から徐々に大きくなっていき、第１の可変抵抗１１１と第２の可変抵抗１１２の抵抗比の変化に応じて、ノードＶ２の電圧は上昇する。そして、ノードＶ２の電圧が電圧Ｖ１を上回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、制御コード候補ｄとして保持する。
【００３３】
そして、制御回路１４０は、保持している制御コード候補ｃおよび制御コード候補ｄの平均値を求め、この平均値を、終端抵抗を校正するための第２の制御コードとして定める。
【００３４】
以上のような比較工程Ａ，Ｂによって、校正動作が終了する。
【００３５】
本実施形態における校正動作によると、比較工程Ａ，Ｂにおいて、比較器１３０の入力極性を切り替えて比較を２回行い、得られた制御コード候補の平均をとることによって制御コードを求める。これにより、比較器１３０にオフセットがある場合でも、そのオフセットの影響を回避することができ、校正のための制御コードを精度良く求めることができる。したがって、終端抵抗の抵抗値を精度良く校正することが可能になる。
【００３６】
＜再校正動作の説明＞
また、本実施形態では、一旦校正を行った後に、再度校正を行う場合において、上述したものと同様の校正動作を行う。この場合、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥを、現在の校正データすなわち第１および第２の制御コードに基づく所定の範囲内でのみ変化させるのが好ましい。すなわち、比較工程Ａにおいて、第１の可変抵抗制御信号ＵＰＣＯＤＥを、制御コード候補ａ±ＭＡまたは制御コード候補ｂ±ＭＡ（ＭＡは正の整数）の範囲で変化させ、比較工程Ｂにおいて、第２の可変抵抗制御信号ＤＮＣＯＤＥを、制御コード候補ｃ±ＭＢまたは制御コード候補ｄ±ＭＢ（ＭＢは正の整数）の範囲で変化させる。これにより、再校正を短時間で実行することが可能になる。ここでは例えば、ＭＡ，ＭＢをそれぞれ１とし、次のような動作を行うものとする。
【００３７】
−比較工程Ａ−
まず第１の比較状態において、第１の可変抵抗制御信号ＵＰＣＯＤＥを「制御コード候補ａ−１」に設定して比較器１３０の出力を得、その後、第１の可変抵抗制御信号ＵＰＣＯＤＥを「制御コード候補ａ＋１」に設定して比較器１３０の出力を得る。そして、出力がＬレベルとＨレベルの場合は、元の制御コード候補ａを新たな制御コード候補ａとして保持する。出力がともにＬレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより低いので、ダミー可変抵抗１１０の抵抗値を小さくするように、「制御コード候補ａ＋１」を新たな制御コード候補ａとする。出力がともにＨレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより高いので、ダミー可変抵抗１１０の抵抗値を大きくするように、「制御コード候補ａ−１」を新たな制御コード候補ａとする。
【００３８】
次に第２の比較状態において、同様に、第１の可変抵抗制御信号ＵＰＣＯＤＥを「制御コード候補ｂ−１」に設定して比較器１３０の出力を得、その後、第１の可変抵抗制御信号ＵＰＣＯＤＥを「制御コード候補ｂ＋１」に設定して比較器１３０の出力を得る。出力がＬレベルとＨレベルの場合は、元の制御コード候補ｂを新たな制御コード候補ｂとして保持する。出力がともにＬレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより高いので、ダミー可変抵抗１１０の抵抗値を大きくするように、「制御コード候補ｂ−１」を新たな制御コード候補ｂとする。出力がともにＨレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより低いので、ダミー可変抵抗１１０の抵抗値を小さくするように、「制御コード候補ｂ＋１」を新たな制御コード候補ｂとする。
【００３９】
そして、制御回路１４０は、新たな制御コード候補ａおよび新たな制御コード候補ｂの平均値を求め、この平均値を、終端抵抗を校正するための第１の制御コードとして新たに定める。次の比較工程Ｂでは、ここで定めた新たな第１の制御コードを第１の可変抵抗制御信号ＵＰＣＯＤＥとして用いて、第１の可変抵抗１１１の抵抗値を設定する。
【００４０】
−比較工程Ｂ−
まず第３の比較状態において、第２の可変抵抗制御信号ＤＮＣＯＤＥを「制御コード候補ｃ−１」に設定して比較器１３０の出力を得、その後、第２の可変抵抗制御信号ＤＮＣＯＤＥを「制御コード候補ｃ＋１」に設定して比較器１３０の出力を得る。そして、出力がＬレベルとＨレベルの場合は、元の制御コード候補ｃを新たな制御コード候補ｃとして保持する。出力がともにＬレベルの場合は、電圧Ｖ２は電圧Ｖ１より高いので、第２の可変抵抗１１２の抵抗値を小さくするように、「制御コード候補ｃ＋１」を新たな制御コード候補ｃとする。出力がともにＨレベルの場合は、電圧Ｖ２は電圧Ｖ１より低いので、第２の可変抵抗１１２の抵抗値を大きくするように、「制御コード候補ｃ−１」を新たな制御コード候補ｃとする。
【００４１】
次に第４の比較状態において、同様に、第２の可変抵抗制御信号ＤＮＣＯＤＥを「制御コード候補ｄ−１」に設定して比較器１３０の出力を得、その後、第２の可変抵抗制御信号ＤＮＣＯＤＥを「制御コード候補ｄ＋１」に設定して比較器１３０の出力を得る。出力がＬレベルとＨレベルの場合は、元の制御コード候補ｄを新たな制御コード候補ｄとして保持する。出力がともにＬレベルの場合は、電圧Ｖ２は電圧Ｖ１より低いので、第２の可変抵抗１１２の抵抗値を大きくするように、「制御コード候補ｄ−１」を新たな制御コード候補ｄとする。出力がともにＨレベルの場合は、電圧Ｖ２は電圧Ｖ１より高いので、第２の可変抵抗１１２の抵抗値を小さくするように、「制御コード候補ｄ＋１」を新たな制御コード候補ｄとする。
【００４２】
そして、制御回路１４０は、新たな制御コード候補ｃおよび新たな制御コード候補ｄの平均値を求め、この平均値を、終端抵抗を校正するための第２の制御コードとして新たに定める。
【００４３】
このように、再校正を行う場合に、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥを、現在の校正データに基づく所定の範囲内でのみ変化させることによって、再校正を短時間で実行することが可能になる。したがって、例えば、周辺温度の変化等により終端抵抗の抵抗値の変動が生じた場合であっても、短時間で速やかに、再校正することが可能となる。
【００４４】
なお、再校正を行う場合において、例えば再校正動作に必要となる時間がまとまって確保できない等の場合には、処理を時間的に分割して実行するようにしてもよい。これにより、周辺温度の変化等により終端抵抗の抵抗値の変動が生じたような場合において、まとまった時間が確保できなくても、再校正動作を段階的に実行することが可能になり、短時間で速やかに、再校正することが可能となる。
【００４５】
（実施形態２）
実施形態２に係るインターフェース回路の構成は、実施形態１で示した図１と同様であり、ここではその詳細な説明を省略する。
【００４６】
図５は本実施形態に係る校正回路２０１の構成を示す回路図である。図５において、図３と共通の構成要素には図３と同一の符号を付しており、ここではその詳細な説明を省略する。図５において、２６０は比較器１３０のオフセット補正用のＤＡコンバータ、２５０はＤＡコンバータ２６０の出力を比較器１３０の（＋）入力に加算する加算器である。制御回路２４０は、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥと、セレクタ制御信号ＩＮＳＥＬとを出力するのに加えて、ＤＡコンバータ２６０に与えるオフセット補正信号ＯＦＦＣＡＮを出力する。ＤＡコンバータ２６０は、オフセット補正信号ＯＦＦＣＡＮをアナログ値に変換して出力する。加算器２５０は、セレクタ１２０の出力とＤＡコンバータ２５０の出力とを加算し、比較器１３０の（＋）入力に与える。なお、加算器１３０は、比較器１３０の（−）入力の側に設けてもかまわない。
【００４７】
＜校正動作の説明＞
このように構成された校正回路２０１が実行する校正動作について、説明する。本実施形態では、まず、比較器１３０のオフセットを補正するためのオフセット補正データを求める（オフセット検出工程）。そして、オフセットを補正した状態で、電圧Ｖ１と参照電圧ＶＲＥＦとを比較して、第１の制御コードを決定する（比較工程Ａ）。その後、電圧Ｖ１と電圧Ｖ２とを比較して、第２の制御コードを決定する（比較工程Ｂ）。
【００４８】
−オフセット検出工程−
制御回路２４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力と（−）入力の両方に参照電圧ＶＲＥＦが入力されるように、セレクタ１２０を制御する（第１の比較状態）。
【００４９】
この第１の比較状態で、制御回路２４０は、オフセット補正信号ＯＦＦＣＡＮを変化させることによって加算器２５０の出力電圧を参照電圧ＶＲＥＦから増減させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転するときのオフセット補正信号ＯＦＦＣＡＮの値を求め、これをオフセット補正データとして保持する。以降の比較工程Ａ，Ｂでは、このオフセット補正データがＤＡコンバータ２６０に与えられ、ＤＡコンバータ２６０から、オフセット補正データに応じたアナログ値が出力され、比較器１３０の（＋）入力に加算される。これにより、比較器１３０のオフセットの影響がキャンセルされる。
【００５０】
−比較工程Ａ−
制御回路２４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に電圧Ｖ１が入力され、（−）入力に参照電圧ＶＲＥＦが入力されるように、セレクタ１２０を制御する（第２の比較状態）。
【００５１】
この第２の比較状態で、制御回路２４０は、第１の可変抵抗制御信号ＵＰＣＯＤＥを変化させることによってダミー可変抵抗１１０の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、終端抵抗を校正するための第１の制御コードとして定める。例えば、第１の可変抵抗制御信号ＵＰＣＯＤＥを、全ビット“０”の状態からアップカウントしていく。これにより、ダミー可変抵抗１１０の抵抗値が最大値から徐々に小さくなっていき、ダミー可変抵抗１１０と参照抵抗Ｒｔｅｒｍの抵抗比の変化に応じて、ノードＶ１の電圧は上昇する。そして、ノードＶ１の電圧が参照電圧ＶＲＥＦを上回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第１の可変抵抗制御信号ＵＰＣＯＤＥを、第１の制御コードとして保持する。次の比較工程Ｂでは、ここで定めた第１の制御コードを第１の可変抵抗制御信号ＵＰＣＯＤＥとして用いて、第１の可変抵抗１１１の抵抗値を設定する。
【００５２】
−比較工程Ｂ−
制御回路２４０は、セレクタ制御信号ＩＮＳＥＬによって、比較器１３０の（＋）入力に電圧Ｖ１が入力され、（−）入力に電圧Ｖ２が入力されるように、セレクタ１２０を制御する（第３の比較状態）。
【００５３】
この第３の比較状態で、制御回路２４０は、第２の可変抵抗制御信号ＤＮＣＯＤＥを変化させることによって第２の可変抵抗１１２の抵抗値を変化させながら、比較器１３０の出力をモニターする。そして、比較器１３０の出力が反転したときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、終端抵抗を校正するための第２の制御コードとして定める。例えば、第２の可変抵抗制御信号ＤＮＣＯＤＥを、全ビット“０”の状態からアップカウントしていく。これにより、第２の可変抵抗１１２の抵抗値が最大値から徐々に小さくなっていき、第１の可変抵抗１１１と第２の可変抵抗１１２の抵抗比の変化に応じて、ノードＶ２の電圧は下降する。そして、ノードＶ２の電圧が電圧Ｖ１を下回ったとき、比較器１３０の出力はそれまでのＬレベルからＨレベルに変化する。このときの第２の可変抵抗制御信号ＤＮＣＯＤＥを、第２の制御コードとして保持する。
【００５４】
以上のようなオフセット検出工程、および比較工程Ａ，Ｂによって、校正動作が終了する。
【００５５】
本実施形態における校正動作によると、比較工程Ａ，Ｂの前に、オフセット検出工程において、比較器１３０の一方の入力にオフセット補正信号に応じたアナログ値を加算することによって、オフセット補正データを求める。これにより、比較器１３０のオフセットの影響を回避することができ、校正データを精度良く求めることができる。したがって、終端抵抗の抵抗値を精度良く校正することが可能になる。
【００５６】
＜再校正動作の説明＞
また、本実施形態では、一旦校正を行った後に、再度校正を行う場合において、上述したものと同様の校正動作を行う。この場合、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥを、現在の校正データに基づく所定の範囲内でのみ変化させるのが好ましい。すなわち、比較工程Ａにおいて、第１の可変抵抗制御信号ＵＰＣＯＤＥを、第１の制御コード±ＭＡ（ＭＡは正の整数）の範囲で変化させ、比較工程Ｂにおいて、第２の可変抵抗制御信号ＤＮＣＯＤＥを、第２の制御コード±ＭＢ（ＭＢは正の整数）の範囲で変化させる。これにより、再校正を短時間で実行することが可能になる。ここでは例えば、ＭＡ，ＭＢをそれぞれ１とし、次のような動作を行うものとする。
【００５７】
−比較工程Ａ−
第２の比較状態において、第１の可変抵抗制御信号ＵＰＣＯＤＥを「第１の制御コード−１」に設定して比較器１３０の出力を得、その後、第１の可変抵抗制御信号ＵＰＣＯＤＥを「第１の制御コード＋１」に設定して比較器１３０の出力を得る。そして、出力がＬレベルとＨレベルの場合は、元の第１の制御コードを新たな第１の制御コードとして保持する。出力がともにＬレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより低いので、ダミー可変抵抗１１０の抵抗値を小さくするように、「第１の制御コード＋１」を新たな第１の制御コードとする。出力がともにＨレベルの場合は、電圧Ｖ１が参照電圧ＶＲＥＦより高いので、ダミー可変抵抗１１０の抵抗値を大きくするように、「第１の制御コード−１」を新たな第１の制御コードとする。次の比較工程Ｂでは、ここで定めた新たな第１の制御コードを第１の可変抵抗制御信号ＵＰＣＯＤＥとして用いて、第１の可変抵抗１１１の抵抗値を設定する。
【００５８】
−比較工程Ｂ−
第３の比較状態において、第２の可変抵抗制御信号ＤＮＣＯＤＥを「第２の制御コード−１」に設定して比較器１３０の出力を得、その後、第２の可変抵抗制御信号ＤＮＣＯＤＥを「第２の制御コード＋１」に設定して比較器１３０の出力を得る。そして、出力がＬレベルとＨレベルの場合は、元の第２の制御コードを新たな第２の制御コードとして保持する。出力がともにＬレベルの場合は、電圧Ｖ２は電圧Ｖ１より高いので、第２の可変抵抗１１２の抵抗値を小さくするように、「第２の制御コード＋１」を新たな制御コード候補ｃとする。出力がともにＨレベルの場合は、電圧Ｖ２は電圧Ｖ１より低いので、第２の可変抵抗１１２の抵抗値を大きくするように、「第２の制御コード−１」を新たな第２の制御コードとする。
【００５９】
このように、再校正を行う場合に、第１および第２の可変抵抗制御信号ＵＰＣＯＤＥ，ＤＮＣＯＤＥを、現在の校正データに基づく所定の範囲内でのみ変化させることによって、再校正を短時間で実行することが可能になる。したがって、例えば、周辺温度の変化等により終端抵抗の抵抗値の変動が生じた場合であっても、短時間で速やかに、再校正することが可能となる。
【００６０】
なお、再校正を行う場合において、オフセット検出工程を実行してオフセット補正データを再度求めた後に、新たな校正データを求めるようにしてもよい。これにより、周辺温度の変化等が生じた場合であっても、校正データをより精度良く求めることが可能になる。
【００６１】
また、再校正を行う場合において、例えば再校正動作に必要となる時間がまとまって確保できない等の場合には、処理を時間的に分割して実行するようにしてもよい。これにより、周辺温度の変化等により終端抵抗の抵抗値の変動が生じたような場合において、まとまった時間が確保できなくても、再校正動作を段階的に実行することが可能になり、短時間で速やかに、再校正することが可能となる。
【００６２】
（実施形態３）
実施形態３に係るインターフェース回路の構成は、実施形態１で示した図１と同様であり、ここではその詳細な説明を省略する。
【００６３】
図６は本実施形態に係る校正回路３０１の構成を示す回路図である。図６において、図３と共通の構成要素には図３と同一の符号を付しており、ここではその詳細な説明を省略する。図６において、３８０は温度検出部、３７０は温度補正テーブルである。温度検出部３８０は、温度電圧変換素子３８１と、温度電圧変換素子３８１の出力と、互いに異なる温度検出用基準電圧ＶＲＥＦＨ，ＶＲＥＦＬとを比較する比較器３３１，３３２とを備えている。比較器３３１，３３２によって温度検出用比較部が構成されている。基準電圧ＶＲＥＦＨは高温検出のための電圧レベルであり、基準電圧ＶＲＥＦＬは低温検出のための電圧レベルである。比較器３３１，３３２の出力ＴＥＭＰＨ，ＴＥＭＰＬは制御回路３４０に与えられる。また、温度補正テーブル３７０には、校正データの温度補正量が、比較器３３１，３３２の出力ＴＥＭＰＨ，ＴＥＭＰＬと関連付けて格納されている。
【００６４】
このように構成された校正回路３０１の動作について、説明する。本実施形態では、校正動作に関しては、第１の実施形態と同様に実行される。
【００６５】
そして本実施形態では、一旦校正を行った後に、再校正を行う場合において、校正データの温度補正を行う。すなわち、温度電圧変換素子３８１が周辺温度に応じた電圧を出力し、この出力が、比較器３３１，３３２によって基準電圧ＶＲＥＦＨ，ＶＲＥＦＬとそれぞれ比較される。制御回路３４０は、比較器３３１，３３２の出力ＴＥＭＰＨ，ＴＥＭＰＬを受け、この出力ＴＥＭＰＨ，ＴＥＭＰＬを用いて温度補正テーブル３７０を参照することによって、温度補正量ＯＦＳＴＣＯＤＥを求める。そして、この温度補正量ＯＦＳＴＣＯＤＥを、再校正を実行する前の制御コード候補ａ，ｂ，ｃ，ｄに加算する。その後、第１の実施形態と同様に再校正を行う。
【００６６】
このように本実施形態によると、再校正を行う場合において、再校正の前に、校正データの温度補正量ＯＦＴＣＯＤＥを求める。これにより、周辺温度の変化による抵抗値の変動を、より短時間で、補正することが可能になる。
【００６７】
なお、本実施形態では、第１の実施形態と組み合わせて実現するものとして説明を行ったが、これに限られるものではなく、例えば、第２の実施形態と組み合わせてもよい。すなわち、図５に示すインターフェース回路２０１の構成に、図６に示した温度検出部３８０および温度補正テーブル３７０を追加し、本実施形態と同様に、再校正の前に、校正データの温度補正量ＯＦＴＣＯＤＥを求めるようにすればよい。そして、この温度補正量ＯＦＳＴＣＯＤＥを、再校正を実行する前の第１および第２の制御コードに加算すればよい。
【００６８】
なお、本実施形態では、温度検出用比較部は２個の比較器を有するものとしたが、２個以上の比較器を設けてもよい。比較器の個数を増やし、温度検出用電圧レベルの数を増やすことによって、周辺温度の変化による抵抗値の変動に対し、より細かく補正を行うことが可能となる。
【００６９】
また、上述の各実施形態において、一旦校正を行った後に、制御回路１４０，２４０，３４０が、再校正を、繰り返し実行するようにしてもよい。すなわち、再校正が常時行われることによって、周辺温度の変化による抵抗値の変動が常に補正されることになり、良好な信号伝達特性が常に確保される。
【産業上の利用可能性】
【００７０】
本発明では、バスの終端抵抗を所望の抵抗値に確実に校正可能であるので、例えば、良好な信号伝達特性の確保が必要なメモリインターフェース回路に有用できる。
【符号の説明】
【００７１】
１００  インターフェース回路
１０１，２０１，３０１  校正回路
１０４Ａ，１０４Ｂ  可変抵抗部
１０５  パッド
１１０  ダミー可変抵抗
１１１  第１可変抵抗
１１２  第２可変抵抗
１２０  セレクタ
１３０  比較器
１４０，２４０，３４０  制御回路
２５０  加算器
２６０  ＤＡコンバータ
３３１，３３２  比較器（温度検出用比較部）
３７０  温度補正テーブル
３８１  温度電圧変換素子
ＵＰＣＯＤＥ  第１の可変抵抗制御信号
ＤＮＣＯＤＥ  第２の可変抵抗制御信号
ＩＮＳＥＬ  セレクタ制御信号
ＯＦＦＣＡＮ  オフセット補正信号
ＯＦＳＴＣＯＤＥ  温度補正量
Ｒｔｅｒｍ  参照抵抗
Ｖ１  第１ノード
Ｖ２  第２ノード
ＶＲＥＦ  参照電圧
【図１】
2010137088.tif 000003
【図２】
2010137088.tif 000004
【図３】
2010137088.tif 000005
【図４】
2010137088.tif 000006
【図５】
2010137088.tif 000007
【図６】
2010137088.tif 000008
【手続補正書】
【提出日】平成24年8月3日(2012.8.3)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号とを出力する制御回路とを備えた
ことを特徴とするインターフェース回路。
【請求項２】
請求項１記載のインターフェース回路において、
前記制御回路は、
校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させ、前記比較器の出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記比較器の出力変化時における前記第１または第２の可変抵抗制御信号の信号値を、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧の前記比較器への入力先を正負入れ替えたそれぞれの状態で求め、求めた信号値の平均値を用いて、前記校正データを求める
ことを特徴とするインターフェース回路。
【請求項３】
請求項２記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第１または第２の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項４】
終端抵抗の抵抗値を校正する機能を有するインターフェース回路であって、
終端抵抗として機能する可変抵抗部と、
参照抵抗が外付けされるパッドと、
前記パッドに接続されており、前記可変抵抗部に、抵抗値を制御するための校正データを出力する校正回路とを備え、
前記校正回路は、
第１の電源と前記パッドとの間に接続されたダミー可変抵抗と、
前記第１の電源と第２の電源との間に直列に接続された第１および第２の可変抵抗と、
正入力および負入力を有する比較器と、
前記ダミー可変抵抗と前記パッドとの間の第１ノードの電圧、前記第１および第２の可変抵抗の間の第２ノードの電圧、並びに、参照電圧を入力とし、これらの電圧の中から、前記比較器の正入力および負入力に与える電圧を、それぞれ選択出力するセレクタと、
前記比較器のオフセット補正用のＤＡコンバータと、
前記ＤＡコンバータの出力を、前記比較器の正入力または負入力に加算する加算器と、
前記比較器の出力を入力とし、前記ダミー可変抵抗および前記第１の可変抵抗の抵抗値を制御する第１の可変抵抗制御信号と、前記第２の可変抵抗の抵抗値を制御する第２の可変抵抗制御信号と、前記セレクタを制御するセレクタ制御信号と、前記ＤＡコンバータに与えるオフセット補正信号とを出力する制御回路とを備えた
ことを特徴とするインターフェース回路。
【請求項５】
請求項４記載のインターフェース回路において、
前記制御回路は、
校正を実行する場合において、前記第１ノードの電圧と前記参照電圧、または前記第１ノードの電圧と前記第２ノードの電圧が前記比較器に与えられるように、前記セレクタを前記セレクタ制御信号によって制御した状態で、前記第１または第２の可変抵抗制御信号を変化させ、前記比較器の出力変化時における前記第１または第２の可変抵抗制御信号の信号値を基にして、前記校正データを求めるものであり、かつ、
前記校正データを求める前に、前記参照電圧が前記比較器の正負入力の両方に与えられるように前記セレクタ制御信号によって前記セレクタを制御した状態で、前記オフセット補正信号を変化させつつ前記比較器の出力をモニターし、出力変化時における前記オフセット補正信号の信号値を基にして、オフセット補正データを求め、
校正を実行する場合において、前記オフセット補正データを前記ＤＡコンバータに与えるものである
ことを特徴とするインターフェース回路。
【請求項６】
請求項５記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、前記第１または第２の可変抵抗制御信号を、現在の校正データに基づく所定の範囲内でのみ変化させて、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項７】
請求項６記載のインターフェース回路において、
前記制御回路は、
再校正を行う場合において、オフセット補正データを再度求めた後に、新たな校正データを求める
ことを特徴とするインターフェース回路。
【請求項８】
請求項３または６記載のインターフェース回路において、
温度電圧変換素子と、
前記温度電圧変換素子の出力と、少なくとも２つ以上の異なる温度検出用基準電圧とを比較する温度検出用比較部と、
校正データの温度補正量が、前記温度検出用比較部の出力と関連付けて格納されている温度補正テーブルとを備え、
前記制御回路は、
再校正を行う場合において、前記温度検出用比較部の出力を受け、この出力を用いて前記温度補正テーブルを参照することによって、校正データの温度補正量を求める
ことを特徴とするインターフェース回路。
【請求項９】
請求項３または６記載のインターフェース回路において、
前記制御回路は、再校正を行う場合に、処理を時間的に分割して実行する
ことを特徴とするインターフェース回路。
【請求項１０】
請求項３または６記載のインターフェース回路において、
前記制御回路は、再校正を、繰り返し実行する
ことを特徴とするインターフェース回路。
【国際調査報告】
2010137088.tif 000009
2010137088.tif 000010