(57)【要約】  ソースドライバは、階調基準電圧生成回路で生成された階調基準電圧ＶＨ２５５〜ＶＬ２５５に基づき複数の階調電圧を生成し、生成した階調電圧を用いてデータ線を駆動する。制御部は、ソースドライバの電源を切断する前に待機期間Ｔｗを設定し、待機期間Ｔｗにおいて階調基準電圧ＶＨ２５５〜ＶＬ２５５がすべて同じ電圧ＶＱになるように階調基準電圧生成回路を制御する。これにより、画素回路に同じ電圧を書き込み、画素回路に残留する電荷を放電して、電源切断時の残留電荷に起因する残像、焼き付きおよびフリッカを防止する。
2014050719.tif 000002
【特許請求の範囲】
【請求項１】
アクティブマトリクス型の液晶表示装置であって、
複数の走査線と複数のデータ線と複数の画素回路とを含む液晶パネルと、
前記走査線を駆動する走査線駆動回路と、
複数の階調基準電圧を生成する階調基準電圧生成回路と、
前記複数の階調基準電圧に基づき複数の階調電圧を生成し、生成した階調電圧を用いて前記データ線を駆動するデータ線駆動回路と、
電源切断指示を受けたときに、前記データ線駆動回路の電源を切断する前に待機期間を設定し、前記待機期間において前記複数の階調基準電圧がすべて同じ第１電圧になるように前記階調基準電圧生成回路を制御する制御部とを備えた、液晶表示装置。
【請求項２】
前記制御部は、前記データ線駆動回路の電源を切断する前で、かつ、前記走査線駆動回路の電源を切断する前に前記待機期間を設定することを特徴とする、請求項１に記載の液晶表示装置。
【請求項３】
前記第１電圧は、前記液晶パネルの対向電極に印加される電圧に、前記画素回路に対する書き込み時に発生する引き込み電圧を加算した電圧であることを特徴とする、請求項１に記載の液晶表示装置。
【請求項４】
前記第１電圧は、正極性の最低階調基準電圧と負極性の最低階調基準電圧の平均電圧であることを特徴とする、請求項１に記載の液晶表示装置。
【請求項５】
前記待機期間の長さは１秒以上であることを特徴とする、請求項１に記載の液晶表示装置。
【請求項６】
前記階調基準電圧生成回路は、それぞれが与えられたデジタル値を１個の階調基準電圧に変換する複数のＤ／Ａ変換器を含み、
前記制御部は、前記待機期間において、前記第１電圧に対応したデジタル値を前記階調基準電圧生成回路に含まれるすべてのＤ／Ａ変換器に与えることを特徴とする、請求項１に記載の液晶表示装置。
【請求項７】
前記階調基準電圧生成回路は、それぞれが１個の階調基準電圧を出力する複数のオペアンプと、それぞれが前記オペアンプから出力された階調基準電圧および前記第１電圧のいずれかを出力する複数の切替回路とを含み、
前記制御部は、前記待機期間において、前記第１電圧を出力するようにすべての前記切替回路を制御することを特徴とする、請求項１に記載の液晶表示装置。
【請求項８】
前記走査線に対応した複数のトランジスタをさらに備え、
前記トランジスタの一方の導通端子は対応する走査線に接続され、すべての前記トランジスタの他方の導通端子は第１制御線に共通して接続され、すべての前記トランジスタの制御端子は第２制御線に共通して接続され、
前記制御部は、前記データ線駆動回路の電源を切断する前で、かつ、前記走査線駆動回路の電源を切断した後に前記待機期間を設定し、前記待機期間において、前記第１制御線に前記走査線を選択するための電圧を印加し、前記第２制御線に前記トランジスタを導通させる電圧を印加する制御を行うことを特徴とする、請求項１に記載の液晶表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、表示装置に関し、特に、アクティブマトリクス型の液晶表示装置に関する。
【背景技術】
【０００２】
アクティブマトリクス型の液晶表示装置は、液晶容量と書き込み制御ＴＦＴ（Thin Film Transistor：薄膜トランジスタ）を含む画素回路を２次元状に配置した構造を有する。従来の液晶表示装置では、ＴＦＴは、例えばアモルファスシリコンを用いて形成される。近年、ＩＧＺＯ（Indium Gallium Zinc Oxide ：インジウムガリウム亜鉛酸化物）などの酸化物半導体を用いてＴＦＴを形成する技術が開発されている。酸化物半導体を用いて形成されたＴＦＴは、従来のＴＦＴよりもオフ時のリーク電流が小さいという特徴を有する。したがって、酸化物半導体を用いてＴＦＴを形成した液晶表示装置によれば、従来の液晶表示装置よりも表示品位を高くすることができる。【０００３】
液晶表示装置には、表示画面に残像、焼き付き、および、フリッカが発生するという問題がある。液晶層に直流電圧が印加されると、液晶層内でイオン電導による電荷の移動が誘導され、移動した電荷は電極に塗布されている配向膜に蓄積される。電極に塗布されている配向膜に蓄積された電荷による電圧が電極間（液晶層）に加わると、残像や焼付きが発生する。従来、この残像と焼き付きを防止するために、液晶表示装置は、画素電極に書き込む電圧の極性を所定の周期で切り替える交流駆動（極性反転駆動）を行う。交流駆動では、正極性のときと負極性のときとで同じ大きさの電圧（絶対値が同じ電圧）を印加する。ところが、正極性のときと負極性のときとで同じ大きさの電圧を印加しても、ＴＦＴ特性やパネル配線などの負荷などの影響により、電極間の電位差（絶対値）は若干異なる。このため、極性反転の周期に対応した差が表示輝度に現れ、フリッカと呼ばれる表示品位の低下が発生する。従来、このフリッカを防止するために、液晶表示装置は、画素電極に書き込む電圧のレベルを極性別に調整する機能を有する。【０００４】
また、液晶表示装置には、電源切断時に画素電極に不要な電荷が残留し、残像や焼き付きが発生するという問題もある。特許文献１には、液晶表示装置における残像を防止する方法として、電源切断時にすべてのゲート線の電圧を一時的に書き込み制御ＴＦＴがオン状態になるレベルに制御する方法が記載されている。具体的には、図１０に示すようにゲート線９１に対応してトランジスタＴｒ１を設け、電源電圧と制御線ＶＨ１、ＶＨ２の電圧を図１１に示すように変化させる。これにより、電源切断時にトランジスタＴｒ１をオン状態に制御し、ゲート線９１の電圧をハイレベルにし、画素回路内の書き込み制御ＴＦＴ９２をオン状態にして、画素電極９３に残留した電荷をソース線９４を介して放電することができる。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】日本国特開２００２−２０７４５５号公報
【発明の概要】
【発明が解決しようとする課題】
【０００６】
しかしながら、特許文献１に記載された液晶表示装置では、電源切断後に画素電極に電荷がわずかに残留し、画素電極に残留する電荷の量は画素回路ごとに異なる。このため、特許文献１に記載された液晶表示装置では、残像、焼き付き、および、フリッカを十分に防止することができない。特に、酸化物半導体を用いてＴＦＴを形成した液晶表示装置では、書き込み制御ＴＦＴのオフ時のリーク電流が小さいので、電源切断時に画素電極に残留した電荷は長時間に亘って（例えば、数日間も）残留し続ける。このため、残像などを十分に防止できないという問題は、酸化物半導体を用いてＴＦＴを形成した液晶表示装置では顕著になる。【０００７】
それ故に、本発明は、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止できる液晶表示装置を提供することを目的とする。
【課題を解決するための手段】
【０００８】
本発明の第１の局面は、アクティブマトリクス型の液晶表示装置であって、
複数の走査線と複数のデータ線と複数の画素回路とを含む液晶パネルと、
前記走査線を駆動する走査線駆動回路と、
複数の階調基準電圧を生成する階調基準電圧生成回路と、
前記複数の階調基準電圧に基づき複数の階調電圧を生成し、生成した階調電圧を用いて前記データ線を駆動するデータ線駆動回路と、
電源切断指示を受けたときに、前記データ線駆動回路の電源を切断する前に待機期間を設定し、前記待機期間において前記複数の階調基準電圧がすべて同じ第１電圧になるように前記階調基準電圧生成回路を制御する制御部とを備える。【０００９】
本発明の第２の局面は、本発明の第１の局面において、
前記制御部は、前記データ線駆動回路の電源を切断する前で、かつ、前記走査線駆動回路の電源を切断する前に前記待機期間を設定することを特徴とする。【００１０】
本発明の第３の局面は、本発明の第１の局面において、
前記第１電圧は、前記液晶パネルの対向電極に印加される電圧に、前記画素回路に対する書き込み時に発生する引き込み電圧を加算した電圧であることを特徴とする。【００１１】
本発明の第４の局面は、本発明の第１の局面において、
前記第１電圧は、正極性の最低階調基準電圧と負極性の最低階調基準電圧の平均電圧であることを特徴とする。【００１２】
本発明の第５の局面は、本発明の第１の局面において、
前記待機期間の長さは１秒以上であることを特徴とする。【００１３】
本発明の第６の局面は、本発明の第１の局面において、
前記階調基準電圧生成回路は、それぞれが与えられたデジタル値を１個の階調基準電圧に変換する複数のＤ／Ａ変換器を含み、
前記制御部は、前記待機期間において、前記第１電圧に対応したデジタル値を前記階調基準電圧生成回路に含まれるすべてのＤ／Ａ変換器に与えることを特徴とする。【００１４】
本発明の第７の局面は、本発明の第１の局面において、
前記階調基準電圧生成回路は、それぞれが１個の階調基準電圧を出力する複数のオペアンプと、それぞれが前記オペアンプから出力された階調基準電圧および前記第１電圧のいずれかを出力する複数の切替回路とを含み、
前記制御部は、前記待機期間において、前記第１電圧を出力するようにすべての前記切替回路を制御することを特徴とする。【００１５】
本発明の第８の局面は、本発明の第１の局面において、
前記走査線に対応した複数のトランジスタをさらに備え、
前記トランジスタの一方の導通端子は対応する走査線に接続され、すべての前記トランジスタの他方の導通端子は第１制御線に共通して接続され、すべての前記トランジスタの制御端子は第２制御線に共通して接続され、
前記制御部は、前記データ線駆動回路の電源を切断する前で、かつ、前記走査線駆動回路の電源を切断した後に前記待機期間を設定し、前記待機期間において、前記第１制御線に前記走査線を選択するための電圧を印加し、前記第２制御線に前記トランジスタを導通させる電圧を印加する制御を行うことを特徴とする。
【発明の効果】
【００１６】
本発明の第１の局面によれば、データ線駆動回路の電源を切断する前に、階調電圧の基準となる階調基準電圧をすべて同じ電圧にすることにより、液晶パネルの画素回路に同じ電圧を書き込み、画素回路に残留する電荷を放電することができる。また、画素回路に電荷がわずかに残留する場合でも、残留する電荷の量を画素回路間で等しくすることができる。したがって、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００１７】
本発明の第２の局面によれば、待機期間では、階調基準電圧をすべて同じ電圧にした状態で、走査線駆動回路とデータ線駆動回路が動作する。したがって、待機期間において、画素回路に同じ電圧を順に書き込み、画素回路に残留する電荷を放電して、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００１８】
本発明の第３または第４の局面によれば、待機期間において、液晶パネルの液晶層にほぼ０Ｖの電圧を印加し、画素回路に残留する電荷を減らして、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００１９】
本発明の第５の局面によれば、データ線駆動回路の電源を切断する前に１秒以上、階調基準電圧をすべて同じ電圧にすることにより、画素回路に同じ電圧を複数回書き込み、画素回路に残留する電荷を確実に放電することができる。したがって、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００２０】
本発明の第６の局面によれば、Ｄ／Ａ変換器を用いて階調基準電圧を生成する液晶表示装置について、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００２１】
本発明の第７の局面によれば、オペアンプを用いて階調基準電圧を生成する液晶表示装置について、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。【００２２】
本発明の第８の局面によれば、待機期間では、階調基準電圧をすべて同じ電圧にした状態で、すべての走査線が選択される。したがって、待機期間において、画素回路に同じ電圧を同時に書き込み、画素回路に残留する電荷を放電して、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。
【図面の簡単な説明】
【００２３】
【図１】本発明の第１の実施形態に係る液晶表示装置の構成を示すブロック図である。
【図２】図１に示す液晶表示装置に含まれる階調電圧生成回路の例を示す図である。
【図３】図１に示す液晶表示装置の電源切断時の電源シーケンスを示す図である。
【図４】液晶パネルの断面図である。
【図５】比較例に係る液晶表示装置の電源切断時の電源シーケンスを示す図である。
【図６】本発明の第２の実施形態に係る液晶表示装置の構成を示すブロック図である。
【図７】本発明の第３の実施形態に係る液晶表示装置の構成を示すブロック図である。
【図８】本発明の第４の実施形態に係る液晶表示装置の構成を示すブロック図である。
【図９】図８に示す液晶表示装置の電源切断時の電源シーケンスを示す図である。
【図１０】従来の液晶表示装置の構成を示すブロック図である。
【図１１】図１０に示す液晶表示装置の電源切断時の信号波形図である。
【発明を実施するための形態】
【００２４】
（第１の実施形態）
図１は、本発明の第１の実施形態に係る液晶表示装置の構成を示すブロック図である。図１に示す液晶表示装置１０は、液晶パネル１１、ゲートドライバ１２、ソースドライバ１３、階調基準電圧生成回路１４、および、制御部１５を備えている。以下、ｍおよびｎは２以上の整数、ｉは１以上ｍ以下の整数、ｊは１以上ｎ以下の整数であるとする。
【００２５】
液晶パネル１１は、ｍ本のゲート線Ｇ１〜Ｇｍ、ｎ本のソース線Ｓ１〜Ｓｎ、および、（ｍ×ｎ）個の画素回路１を含んでいる。（ｍ×ｎ）個の画素回路１は、行方向（図１では横方向）にｎ個ずつ、列方向（図１では縦方向）にｍ個ずつ並べて配置される。ゲート線Ｇ１〜Ｇｍは、行方向に伸延し、互いに平行に配置される。ソース線Ｓ１〜Ｓｎは、列方向に伸延し、ゲート線Ｇ１〜Ｇｍと直交するように互いに平行に配置される。ゲート線Ｇｉはｉ行目に配置されたｎ個の画素回路１に共通して接続され、ソース線Ｓｊはｊ列目に配置されたｍ個の画素回路１に共通して接続される。
【００２６】
画素回路１は、ＴＦＴ２、液晶容量３、および、補助容量４を含んでいる。ＴＦＴ２は、Ｎチャネル型ＴＦＴであり、書き込み制御ＴＦＴとして機能する。ｉ行目かつｊ列目に配置された画素回路１では、ＴＦＴ２のゲート端子はゲート線Ｇｉに接続され、ＴＦＴ２のソース端子はソース線Ｓｊに接続される。ＴＦＴ２のドレイン端子は、液晶容量３の一方の電極（以下、画素電極５という）と補助容量４の一方の電極に接続される。液晶容量３の他方の電極は、すべての画素回路１に共通した対向電極（図示せず）である。補助容量４の他方の電極は、補助容量線に接続される。対向電極には対向電極電圧Ｖｃｏｍが印加され、補助容量線には補助容量対向電圧ＣＳが印加される。
【００２７】
ゲートドライバ１２は、ゲート線Ｇ１〜Ｇｍを駆動する。より詳細には、ゲートドライバ１２には電源回路（図示せず）から、ロジック電源電圧ＶＣＣ、ゲートハイ電圧ＶＧＨ、および、ゲートロー電圧ＶＧＬが供給される。また、ゲートドライバ１２にはタイミング制御回路（図示せず）から、ゲートスタートパルスやゲートクロックなどを含むロジック信号が供給される。ゲートドライバ１２は、供給されたロジック信号に基づきゲート線Ｇ１〜Ｇｍの中から１本のゲート線を昇順に（または降順に）選択し、選択したゲート線にゲートハイ電圧ＶＧＨを印加し、残りのゲート線にゲートロー電圧ＶＧＬを印加する。
【００２８】
階調基準電圧生成回路１４は、ソースドライバ１３から出力される階調電圧の基準となる複数の階調基準電圧を生成する。階調基準電圧生成回路１４で生成される複数の階調基準電圧には、複数の正極性階調基準電圧と複数の負極性階調基準電圧とが含まれる。階調基準電圧生成回路１４で生成された複数の階調基準電圧は、ソースドライバ１３に供給される。以下、階調基準電圧生成回路１４は、複数の階調基準電圧ＶＨ２５５〜ＶＬ２５５を生成するものとする。
【００２９】
ソースドライバ１３は、階調電圧生成回路１６を含んでいる。階調電圧生成回路１６は、階調基準電圧生成回路１４で生成された階調基準電圧ＶＨ２５５〜ＶＬ２５５に基づき複数の階調電圧を生成する。また、ソースドライバ１３には電源回路から、ロジック電源電圧ＶＣＣとソース出力電源電圧ＶＬＳが供給される。さらに、ソースドライバ１３にはタイミング制御回路から、ソーススタートパルスやソースクロックなどを含むロジック信号、および、表示データに対応したデータ信号が供給される。ソースドライバ１３は、供給されたロジック信号およびデータ信号に基づき、階調電圧生成回路１６で生成された複数の階調電圧の中からソース線ごとに１個の階調電圧を選択し、ソース線Ｓ１〜Ｓｎに対して全部でｎ個の階調電圧を印加する。このようにソースドライバ１３は、階調基準電圧生成回路１４で生成された階調基準電圧ＶＨ２５５〜ＶＬ２５５に基づき複数の階調電圧を生成し、生成した複数の階調電圧を用いてデータ線Ｓ１〜Ｓｎを駆動する。
【００３０】
ゲート線Ｇｉの選択期間（ゲート線Ｇｉにゲートハイ電圧ＶＧＨが印加されている期間）では、ｉ行目に配置されたｎ個の画素回路１に含まれるＴＦＴ２はオン状態になる。この期間では、ソースドライバ１３は、ソース線Ｓ１〜Ｓｎに対して、ｉ行目に配置されたｎ個の画素回路１に含まれる画素電極５に書き込むべきｎ個の階調電圧を印加する。これにより、ｉ行目に配置されたｎ個の画素電極５にそれぞれの階調電圧が書き込まれる。この処理を１フレーム期間内にｍ回行うことにより、（ｍ×ｎ）個の画素回路１に含まれる画素電極５にそれぞれの階調電圧を書き込み、液晶パネル１１に所望の画像を表示することができる。
【００３１】
ソースドライバ１３は、残像と焼き付きを防止するために交流駆動を行う。より詳細には、ソースドライバ１３は、ソース線Ｓ１〜Ｓｎを駆動するときに、画素電極５に書き込む階調電圧の極性を所定時間ごとに（例えば、１フレーム期間ごとに）反転させる（正極性と負極性に切り替える）。ソースドライバ１３は、交流駆動として、フレーム反転駆動を行ってもよく、ライン反転駆動を行ってもよく、ドット反転駆動を行ってもよい。
【００３２】
制御部１５は、液晶表示装置１０の動作を制御する。制御部１５は、ゲートドライバ１２とソースドライバ１３に対して、電源電圧、ロジック信号、および、データ信号を供給する。また、制御部１５は、電源切断指示を受けたときに、ゲートドライバ１２とソースドライバ１３の電源を切断する前に待機期間を設定し、待機期間において階調基準電圧ＶＨ２５５〜ＶＬ２５５がすべて同じ電圧になるように階調基準電圧生成回路１４を制御する（詳細は後述）。
【００３３】
なお、図１では、ゲートドライバ１２とソースドライバ１３は液晶パネル１１の外部に設けられているが、ゲートドライバ１２とソースドライバ１３の全部または一部を液晶パネル１１と一体に形成してもよい。また、ゲート線、ソース線、ゲートドライバ、および、ソースドライバは、それぞれ、走査線、データ線、走査線駆動回路、および、データ線駆動回路とも呼ばれる。
【００３４】
図２は、ソースドライバ１３に含まれる階調電圧生成回路１６の例を示す図である。ここでは、データ信号の幅が８ビットで、階調電圧生成回路１６には１０個の正極性階調基準電圧と１０個の負極性階調基準電圧とが供給されるものとする。図２に示す階調電圧生成回路１６には、正極性階調基準電圧としてＶＨ０、ＶＨ１６、ＶＨ３２、ＶＨ６４、ＶＨ１２８、ＶＨ１６０、ＶＨ１９２、ＶＨ２３２、ＶＨ２４８、ＶＨ２５５が供給され、負極性階調基準電圧としてＶＬ０、ＶＬ１６、ＶＬ３２、ＶＬ６４、ＶＬ１２８、ＶＬ１６０、ＶＬ１９２、ＶＬ２３２、ＶＬ２４８、ＶＬ２５５が供給される。階調電圧生成回路１６は、１８個の抵抗分割回路Ｒ１〜Ｒ１８を含んでいる。抵抗分割回路Ｒ１は、２個の電圧ＶＨ２５５、ＶＨ２４８に基づき８個の階調電圧を生成する。抵抗分割回路Ｒ２は、２個の電圧ＶＨ２４８、ＶＨ２３２に基づき１６個の階調電圧を生成する。同様に、抵抗分割回路Ｒ３〜Ｒ１８は、２個の電圧に基づき複数の階調電圧を生成する。このように図２に示す階調電圧生成回路１６は、抵抗分割回路Ｒ１〜Ｒ１８を用いて、２５６個の正極性階調電圧と２５６個の負極性階調電圧を生成する。
【００３５】
以下、本実施形態に係る液晶表示装置１０の特徴である、電源切断時の動作について説明する。図３は、液晶表示装置１０の電源切断時の電源シーケンスを示す図である。図３には、ロジック電源電圧ＶＣＣ（ゲートドライバ１２とソースドライバ１３に供給される電源電圧）、ゲートハイ電圧ＶＧＨ、ゲートロー電圧ＶＧＬ、ソース出力電源電圧ＶＬＳ、階調基準電圧ＶＨ２５５〜ＶＬ２５５、対向電極電圧Ｖｃｏｍ、補助容量対向電圧ＣＳ、および、ロジック信号（ゲートドライバ１２とソースドライバ１３に供給されるロジック信号）の電圧について、電源切断時の変化が記載されている。なお、図３において、対向電極電圧Ｖｃｏｍと補助容量対向電圧ＣＳは同じ電圧である。
【００３６】
図３に示す電源シーケンスでは、時刻ｔ１において、すべての階調基準電圧ＶＨ２５５〜ＶＬ２５５が電圧ＶＱに変化する。次に時刻ｔ２において、ゲートハイ電圧ＶＧＨが０Ｖ（グランドレベル）に向けて変化し始める。次に、対向電極電圧Ｖｃｏｍ、補助容量対向電圧ＣＳ、および、すべての階調基準電圧ＶＨ２５５〜ＶＬ２５５が０Ｖに変化する。その後、ソース出力電源電圧ＶＬＳ、ゲートロー電圧ＶＧＬ、ロジック信号の電圧、および、ロジック電源電圧ＶＣＣが、順に０Ｖに変化する。図３に示す電源シーケンスは、制御部１５によって実現される。
【００３７】
制御部１５によって設定された時刻ｔ１から時刻ｔ２までの期間を待機期間Ｔｗという。待機期間Ｔｗの長さは、例えば１秒以上に設定される（理由は後述）。本実施形態では、制御部１５は、ソースドライバ１３の電源を切断する前で、かつ、ゲートドライバ１２の電源を切断する前に、待機期間Ｔｗを設定する。待機期間Ｔｗではゲートドライバ１２とソースドライバ１３には引き続き電源電圧が供給されるので、ゲートドライバ１２とソースドライバ１３は待機期間Ｔｗにおいて従前と同じ動作を行う。具体的には、待機期間Ｔｗにおいて、ゲートドライバ１２はゲート線Ｇ１〜Ｇｍを駆動し、ソースドライバ１３はソース線Ｓ１〜Ｓｎを駆動する。
【００３８】
待機期間Ｔｗでは、階調基準電圧生成回路１４で生成される階調基準電圧ＶＨ２５５〜ＶＬ２５５は、すべて電圧ＶＱに等しい。このため、待機期間Ｔｗにおいて階調電圧生成回路１６で生成される階調電圧も、すべて電圧ＶＱに等しくなる。したがって、待機期間Ｔｗでは、ソースドライバ１３は、データ信号にかかわらず、すべてのソース線Ｓ１〜Ｓｎに常に同じ電圧ＶＱを印加する。待機期間Ｔｗの長さは１秒以上であるので、待機期間Ｔｗにおいて（ｍ×ｎ）個の画素回路１に含まれる画素電極５に電圧ＶＱが複数回ずつ書き込まれる。このとき、画素電極５に残留する電荷は、ソース線Ｓ１〜Ｓｎを介して放電される。
【００３９】
ここで、液晶表示装置で発生する残像、焼き付き、および、フリッカについて説明する。図４は、液晶パネルの断面図である。図４に示すように、液晶パネル５０は、２枚のガラス基板５２、５３の間に液晶層５１を挟み込んだ構造を有する。一方のガラス基板５２には画素電極５４と配向膜５６が設けられ、他方のガラス基板５３には対向電極５５と配向膜５７が設けられる。
【００４０】
液晶表示装置の画素回路では、書き込み制御ＴＦＴのゲート端子に接続されたゲート線の電圧がハイレベルになったときに、ソース線の電圧が画素電極５４に印加される。ところが、液晶層５１は完全な絶縁体ではない。このため、液晶層５１に直流電圧を印加すると、イオン電導が発生し、液晶層５１と配向膜５６、５７との界面（以下、配向膜界面という）に電荷が溜まる。したがって、液晶層５１に印加される電圧は、ソースドライバを用いて画素回路の外部から印加しようとした電圧には完全には一致しない。液晶層５１の透過率は液晶層５１に印加される電圧に応じて変化するので、液晶層５１に印加される電圧が正しいレベルから変化すると、残像や焼き付きが発生する。
【００４１】
また、交流駆動を行うことにより、画素電極５４と対向電極５５の間に、絶対値が等しい正極性階調電圧と負極性階調電圧が所定の時間ごとに（例えば、１フレーム期間ごとに）切り替えて書き込まれる。しかしながら、配向膜界面に電荷が溜まると、正極性階調電圧を書き込んだときと負極性階調電圧を書き込んだときとで、液晶層５１に印加される電圧の絶対値に差が生じる。このため、画素の輝度が１フレームごとに変化し、画素の輝度の変化がフリッカとして認識される。
【００４２】
なお、以上の説明では、画素電極と対向電極が異なるガラス基板に設けられた液晶パネルについて説明したが、画素電極と対向電極が同じガラス基板に設けられた液晶パネルでも、同様の理由により残像、焼き付き、および、フリッカが発生する。
【００４３】
以下、本実施形態に係る液晶表示装置１０の効果を説明する。一般に、液晶表示装置の動作中に発生する焼き付きは、交流駆動によって防止することができる。ところが、電源切断時に特段の工夫を行わない従来の液晶表示装置（例えば、電源切断時に図５に示す電源シーケンスを用いる液晶表示装置）では、電源切断時に画素電極に電荷が残留し、電源切断後に液晶層に直流電圧が印加され、配向膜界面に電荷が溜まる。このため、従来の液晶表示装置では、電源切断後に残像や焼き付きが発生し、次に電源を入れたときにフリッカが発生することが問題となる。
【００４４】
特許文献１に記載された液晶表示装置では、電源切断後に画素電極に電荷がわずかに残留し、画素電極に残留する電荷の量は画素回路ごとに異なる。このため、特許文献１に記載された液晶表示装置では、残像、焼き付き、および、フリッカを十分に防止することができない。この問題は、ＩＧＺＯなどの酸化物半導体を用いてＴＦＴを形成した液晶表示装置では顕著になる。
【００４５】
本実施形態に係る液晶表示装置１０では、制御部１５は、電源切断指示を受けたときに、ソースドライバ１３の電源を切断する前で、かつ、ゲートドライバ１２の電源を切断する前に待機期間Ｔｗを設定し、待機期間Ｔｗにおいて階調基準電圧ＶＨ２５５〜ＶＬ２５５がすべて同じ電圧ＶＱになるように階調基準電圧生成回路１４を制御する。液晶表示装置１０では、ゲートドライバ１２とソースドライバ１３の電源を切断する前に、階調基準電圧ＶＨ２５５〜ＶＬ２５５を同じ電圧ＶＱに制御した状態で、ゲートドライバ１２とソースドライバ１３が１秒以上動作する。したがって、液晶パネル１１に含まれるすべての画素回路１に（すべての画素電極５に）電圧ＶＱを複数回書き込み、画素電極５に残留する電荷をソース線Ｓ１〜Ｓｎを介して確実に放電することができる。また、画素電極５に電荷がわずかに残留する場合でも、残留する電荷の量を画素回路１間で等しくすることができる。したがって、本実施形態に係る液晶表示装置１０によれば、電源切断時の残留電荷に起因する残像、焼付き、および、フリッカを効果的に防止することができる。
【００４６】
電圧ＶＱは、以下の方法で決定される。画素回路１への書き込み時に発生する引き込み電圧（ゲート線Ｇｉと画素電極５との容量結合による電圧の引き込み分）を考慮すると、待機期間Ｔｗでは、画素電極５の電圧が対向電極電圧Ｖｃｏｍよりも、画素回路１への書き込み時に発生する引き込み電圧だけ高いことが好ましい。具体的には、画素電極５の電圧は、対向電極電圧Ｖｃｏｍよりも次式（１）に示すΔＶｇｈだけ高いことが好ましい。そこで、電圧ＶＱとして、対向電極電圧ＶｃｏｍよりもΔＶｇｈだけ高い電圧（Ｖｃｏｍ＋ΔＶｇｈ）を使用することが好ましい。
ΔＶｇｈ＝Ｃｇｄ／ΣＣ×（ＶＧＨ−ＶＧＬ）  …（１）
ただし、式（１）において、Ｃｇｄは画素電極５とゲート線Ｇｉとの結合容量を表し、ΣＣは画素電極５に結合するすべての容量を表し、ＶＧＨはゲートハイ電圧を表し、ＶＧＬはゲートロー電圧を表す。
【００４７】
実際の液晶パネルでは、ゲートハイ電圧ＶＧＨとゲートロー電圧ＶＧＬはパネルの配線負荷によって変化するので、電圧ＶＱの好ましいレベルは上記の計算値とは少し異なる。このため、電圧ＶＱは、実際の液晶パネルにおいて引き込み分を調整した電圧に基づき決定することが好ましい。以上のことから、電圧ＶＱとして、液晶パネルごとに調整された正極性の最低階調基準電圧ＶＨ０と負極性の最低階調基準電圧ＶＬ０の平均電圧（ＶＨ０＋ＶＬ０）／２を使用することが好ましい。
【００４８】
また、液晶表示装置１０では、液晶パネル１１の液晶層に印加される電圧が変化してから液晶層の誘電率が変化するまでに１フレーム期間（１６ミリ秒）程度かかることがある。この場合、画素電極５に電圧を１回書き込んだだけでは、画素電極５の電圧は書き込んだ電圧に到達しない。このため、待機期間Ｔｗの長さは、３フレーム期間以上（５０ミリ秒以上）にする必要がある。また、表示画像によっては、液晶パネル１１の特定の画素回路１で配向膜界面に電荷が残留する場合がある。このような場合を考慮すると、待機期間Ｔｗの長さは１秒以上にすることが好ましい。
【００４９】
以上に示すように、本実施形態に係る液晶表示装置１０は、複数の走査線（ゲート線Ｇ１〜Ｇｍ）と複数のデータ線（ソース線Ｓ１〜Ｓｎ）と複数の画素回路１とを含む液晶パネル１１と、走査線を駆動する走査線駆動回路（ゲートドライバ１２）と、複数の階調基準電圧ＶＨ２５５〜ＶＬ２５５を生成する階調基準電圧生成回路１４と、複数の階調基準電圧ＶＨ２５５〜ＶＬ２５５に基づき複数の階調電圧を生成し、生成した階調電圧を用いてデータ線を駆動するデータ線駆動回路（ソースドライバ１３）と、電源切断指示を受けたときに、データ線駆動回路の電源を切断する前で、かつ、走査線駆動回路の電源を切断する前に待機期間Ｔｗを設定し、待機期間Ｔｗにおいて複数の階調基準電圧ＶＨ２５５〜ＶＬ２５５がすべて同じ電圧ＶＱになるように階調基準電圧生成回路１４を制御する制御部１５とを備えている。
【００５０】
本実施形態に係る液晶表示装置１０によれば、待機期間Ｔｗでは、階調電圧の基準となる階調基準電圧ＶＨ２５５〜ＶＬ２５５をすべて同じ電圧ＶＱにした状態で、走査線駆動回路とデータ線駆動回路が動作する。したがって、待機期間Ｔｗにおいて、液晶パネル１１の画素回路１に同じ電圧ＶＱを順に書き込み、画素回路１に残留する電荷を放電することができる。また、画素回路１に電荷がわずかに残留する場合でも、残留する電荷の量を画素回路１間で等しくすることができる。よって、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。
【００５１】
また、電圧ＶＱとして、対向電極電圧に画素回路１に対する書き込み時に発生する引き込み電圧を加算した電圧（Ｖｃｏｍ＋ΔＶｇｈ）、あるいは、正極性の最低階調基準電圧と負極性の最低階調基準電圧の平均電圧（ＶＨ０＋ＶＬ０）／２を用いることにより、待機期間において、液晶パネル１１の液晶層にほぼ０Ｖの電圧を印加し、画素回路１に残留する電荷を減らすことができる。また、待機期間Ｔｗの長さを１秒以上にすることにより、画素回路１に同じ電圧を複数回書き込み、画素回路１に残留する電荷を確実に放電することができる。
【００５２】
（第２の実施形態）
第２および第３の実施形態では、第１の実施形態に係る液晶表示装置の具体例を説明する。図６は、本発明の第２の実施形態に係る液晶表示装置の構成を示すブロック図である。図６に示す液晶表示装置２０は、液晶パネル１１、ゲートドライバ１２、ソースドライバ１３、および、制御基板２１を備えている。以下に示す実施形態では、各実施形態の構成要素のうち、先に述べた実施形態の構成要素と同一のものについては、同一の参照符号を付して説明を省略する。
【００５３】
制御基板２１には、マイクロコンピュータ２２、電源回路２３、タイミング制御ＩＣ２４、および、ＤＡＣ  ＩＣ２５が搭載されている。マイクロコンピュータ２２とタイミング制御ＩＣ２４は図１に示す制御部１５として機能し、ＤＡＣ  ＩＣ２５は図１に示す階調基準電圧生成回路１４として機能する。
【００５４】
タイミング制御ＩＣ２４には、液晶表示装置２０の外部から表示データが入力される。タイミング制御ＩＣ２４は、ゲートドライバ１２に対してロジック信号（同期信号と制御信号）を出力し、ソースドライバ１３に対してロジック信号と表示データに応じたデータ信号とを出力する。また、タイミング制御ＩＣ２４は、ＤＡＣ  ＩＣ２５に対して、デジタル値を示す制御信号Ｃ１を出力する。
【００５５】
ＤＡＣ  ＩＣ２５は、複数のＤ／Ａ変換器（図示せず）を含んでいる。例えば２０個の階調基準電圧を生成する場合、ＤＡＣ  ＩＣ２５は少なくとも２０個のＤ／Ａ変換器を含んでいる。タイミング制御ＩＣ２４は、制御信号Ｃ１を出力することにより、ＤＡＣ  ＩＣ２５に含まれる２０個のＤ／Ａ変換器に対して、２０個の階調基準電圧に対応した２０個のデジタル値をそれぞれ与える。各Ｄ／Ａ変換器は、タイミング制御ＩＣ２４から与えられたデジタル値を１個の階調基準電圧に変換する。このように複数のＤ／Ａ変換器を含むＤＡＣ  ＩＣ２５を用いて、階調基準電圧ＶＨ２５５〜ＶＬ２５５を生成することができる。
【００５６】
マイクロコンピュータ２２は、電源回路２３とタイミング制御ＩＣ２４を制御する。電源回路２３は、マイクロコンピュータ２２からの制御に従い、ゲートドライバ１２とソースドライバ１３に供給される電源電圧を生成する。
【００５７】
マイクロコンピュータ２２は、液晶表示装置３０の外部から電源切断を指示する制御信号Ｐ１を受け取ると、タイミング制御ＩＣ２４に対して電源切断を指示する制御信号Ｐ２を出力する。タイミング制御ＩＣ２４は、制御信号Ｐ２を受け取ると、電圧ＶＱに対応したデジタル値をＤＡＣ  ＩＣ２５に含まれるすべてのＤ／Ａ変換器に与える。ＤＡＣ  ＩＣ２５に含まれるすべてのＤ／Ａ変換器は、電圧ＶＱに対応したデジタル値を電圧ＶＱに変換する。したがって、待機期間Ｔｗでは、ＤＡＣ  ＩＣ２５から出力される階調基準電圧ＶＨ２５５〜ＶＬ２５５は、すべて電圧ＶＱになる。
【００５８】
タイミング制御ＩＣ２４は、電圧ＶＱに対応したデジタル値をＤＡＣ  ＩＣ２５に含まれるすべてのＤ／Ａ変換器に与えた後に、マイクロコンピュータ２２に対して電源切断準備完了を示す制御信号Ｐ３を出力する。マイクロコンピュータ２２は、制御信号Ｐ３を受け取ると、図３に示す電源シーケンスに従い、ゲートドライバ１２とソースドライバ１３の電源を切断する。
【００５９】
以上に示すように、本実施形態に係る液晶表示装置２０では、階調基準電圧生成回路は、それぞれが与えられたデジタル値を１個の階調基準電圧に変換する複数のＤ／Ａ変換器を含んでいる。制御部（マイクロコンピュータ２２とタイミング制御ＩＣ２４）は、待機期間Ｔｗにおいて、電圧ＶＱに対応したデジタル値を階調基準電圧生成回路に含まれるすべてのＤ／Ａ変換器に与える。したがって、本実施形態に係る液晶表示装置２０によれば、Ｄ／Ａ変換器を用いて階調基準電圧を生成する液晶表示装置について、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。
【００６０】
（第３の実施形態）
図７は、本発明の第３の実施形態に係る液晶表示装置の構成を示すブロック図である。図７に示す液晶表示装置３０は、液晶パネル１１、ゲートドライバ１２、ソースドライバ１３、および、制御基板３１を備えている。
【００６１】
制御基板３１には、マイクロコンピュータ２２、電源回路２３、タイミング制御ＩＣ２４、複数のオペアンプ３２、および、複数の切替回路３３が搭載されている。マイクロコンピュータ２２とタイミング制御ＩＣ２４は図１に示す制御部１５として機能し、複数のオペアンプ３２と複数の切替回路３３は図１に示す階調基準電圧生成回路１４として機能する。
【００６２】
オペアンプ３２は、１個の階調基準電圧を出力する。切替回路３３は、タイミング制御ＩＣ２４から出力された制御信号Ｃ２に従い、オペアンプ３２から出力された階調基準電圧および電圧ＶＱのいずれかを出力する。液晶表示装置３０の動作中、切替回路３３は、オペアンプ３２から出力された階調基準電圧を出力するように制御される。
【００６３】
マイクロコンピュータ２２は、電源切断を指示する制御信号Ｐ１を受け取ると、タイミング制御ＩＣ２４に対して電源切断を指示する制御信号Ｐ２を出力する。タイミング制御ＩＣ２４は、制御信号Ｐ２を受け取ると、切替回路３３が電圧ＶＱを出力するように制御信号Ｃ２の値を切り替える。したがって、複数の切替回路３３から階調基準電圧ＶＨ２５５〜ＶＬ２５５は、すべて電圧ＶＱになる。
【００６４】
タイミング制御ＩＣ２４は、制御信号Ｃ２の値を切り替えた後に、マイクロコンピュータ２２に対して電源切断準備完了を示す制御信号Ｐ３を出力する。マイクロコンピュータ２２は、制御信号Ｐ３を受け取ると、図３に示す電源シーケンスに従い、ゲートドライバ１２とソースドライバ１３の電源を切断する。
【００６５】
以上に示すように、本実施形態に係る液晶表示装置３０では、階調基準電圧生成回路は、それぞれが１個の階調基準電圧を出力する複数のオペアンプ３２と、それぞれがオペアンプ３２から出力された階調基準電圧および電圧ＶＱのいずれかを出力する複数の切替回路３３とを含んでいる。制御部（マイクロコンピュータ２２とタイミング制御ＩＣ２４）は、待機期間Ｔｗにおいて、電圧ＶＱを出力するようにすべての切替回路３３を制御する。したがって、本実施形態に係る液晶表示装置３０によれば、オペアンプを用いて階調基準電圧を生成する液晶表示装置について、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。
【００６６】
（第４の実施形態）
図８は、本発明の第４の実施形態に係る液晶表示装置の構成を示すブロック図である。図８に示す液晶表示装置４０は、第１の実施形態に係る液晶表示装置１０（図１）に対して、Ｖｆ線、ＶＧＨ２線、および、ｍ個のＴＦＴ４１を追加し、ゲートドライバ１２をゲートドライバ４２に置換する変更を施したものである。
【００６７】
図８に示すように、ｍ個のＴＦＴ４１は、ゲート線Ｇ１〜Ｇｍに対応して設けられる。ＴＦＴ４１のソース端子は対応するゲート線に接続され、ＴＦＴ４１のドレイン端子はＶＧＨ２線に共通して接続され、ＴＦＴ４１のゲート端子はＶｆ線に共通して接続される。
【００６８】
ゲートドライバ４２は、第１の実施形態に係るゲートドライバ１２に、Ｖｆ線の電圧がハイレベルのときには出力をハイインピーダンス状態にする機能を追加したものである。Ｖｆ線の電圧がローレベルのときには、ゲートドライバ４２はゲートドライバ１２と同様に動作する。Ｖｆ線の電圧がハイレベルのときには、ゲートドライバ４２の出力はハイインピーダンス状態になる。
【００６９】
図９は、液晶表示装置４０の電源切断時の電源シーケンスを示す図である。図９には、図３に示した電圧、Ｖｆ線の電圧、および、ＶＧＨ２線の電圧について、電源切断時の変化が記載されている。なお、図９でも、対向電極電圧Ｖｃｏｍと補助容量対向電圧ＣＳは同じ電圧である。
【００７０】
図９に示す電源シーケンスでは、待機期間Ｔｗより前に、ゲートハイ電圧ＶＧＨが０Ｖに変化し、Ｖｆ線の電圧とＶＧＨ２線の電圧がハイレベルに変化し、ゲートロー電圧ＶＧＬが０Ｖに変化する。次に時刻ｔ１において、すべての階調基準電圧ＶＨ２５５〜ＶＬ２５５が電圧ＶＱに変化する。次に時刻ｔ２においてＶＧＨ２線の電圧が０Ｖに向けて変化し始め、時刻ｔ２の後にＶｆ線の電圧が０Ｖが向けて変化し始める。次に、対向電極電圧Ｖｃｏｍ、補助容量対向電圧ＣＳ、および、すべての階調基準電圧ＶＨ２５５〜ＶＬ２５５が０Ｖに変化する。その後、ソース出力電源電圧ＶＬＳ、ロジック信号の電圧、および、ロジック電源電圧ＶＣＣが、順に０Ｖに変化する。このように本実施形態では、制御部１５は、ソースドライバ１３の電源を切断する前で、かつ、ゲートドライバ４２の電源を切断した後に、待機期間Ｔｗを設定する。
【００７１】
待機期間Ｔｗでは、ゲートドライバ４２は動作を停止しているが、ソースドライバ１３は従前と同様に動作する。また、待機期間Ｔｗでは、すべてのＴＦＴ４１がオン状態になり、すべてのゲート線Ｇ１〜Ｇｍが選択され、（ｍ×ｎ）個の画素回路１に含まれるＴＦＴ２がすべてオン状態になり、（ｍ×ｎ）個の画素回路１に含まれる画素電極５には同じ電圧ＶＱが同時に書き込まれる。
【００７２】
以上に示すように、本実施形態に係る液晶表示装置４０は、走査線（ゲート線Ｇ１〜Ｇｍ）に対応した複数のトランジスタ（ＴＦＴ４１）を備えている。トランジスタの一方の導通端子（ソース端子）は対応する走査線に接続され、すべてのトランジスタの他方の導通端子（ドレイン端子）は第１制御線（ＶＧＨ２線）に共通して接続され、すべてのトランジスタの制御端子（ゲート端子）は第２制御線（Ｖｆ線）に共通して接続される。制御部１５は、データ線駆動回路（ソースドライバ１３）の電源を切断する前で、かつ、走査線駆動回路（ゲートドライバ４２）の電源を切断した後に待機期間Ｔｗを設定し、待機期間Ｔｗにおいて、第１制御線に走査線（ゲート線Ｇ１〜Ｇｍ）を選択するための電圧（ハイレベル電圧）を印加し、第２制御線にトランジスタを導通させる電圧（ハイレベル電圧）を印加する制御を行う。
【００７３】
本実施形態に係る液晶表示装置４０によれば、待機期間Ｔｗでは、階調電圧の基準となる階調基準電圧ＶＨ２５５〜ＶＬ２５５をすべて同じ電圧ＶＱにした状態で、すべての走査線が選択される。したがって、待機期間Ｔｗにおいて、液晶パネル１１の画素回路１に同じ電圧ＶＱを同時に書き込み、画素回路１に残留する電荷を放電して、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。なお、本実施形態に係る液晶表示装置４０についても、階調基準電圧生成回路１４と制御部１５は、第２および第３の実施形態で述べた方法で構成することができる。
【００７４】
以上に示すように、本発明の液晶表示装置によれば、データ線駆動回路の電源を切断する前に、階調電圧の基準となる階調基準電圧をすべて同じ電圧にすることにより、液晶パネルの画素回路に同じ電圧を書き込み、画素回路に残留する電荷を放電して、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。この効果は、ＩＧＺＯなどの酸化物半導体を用いてＴＦＴを形成した液晶表示装置において顕著になる。
【産業上の利用可能性】
【００７５】
本発明の液晶表示装置は、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止できるという特徴を有するので、各種の電子機器の表示部などに利用することができる。
【符号の説明】
【００７６】
１…画素回路
２、４１…ＴＦＴ
３…液晶容量
４…補助容量
５…画素電極
１０、２０、３０、４０…液晶表示装置
１１…液晶パネル
１２、４２…ゲートドライバ（走査線駆動回路）
１３…ソースドライバ（データ線駆動回路）
１４…階調基準電圧生成回路
１５…制御部
１６…階調電圧生成回路
２１、３１…制御基板
２２…マイクロコンピュータ
２３…電源回路
２４…タイミング制御ＩＣ
２５…ＤＡＣ  ＩＣ
３２…オペアンプ
３３…切替回路
【図１】
2014050719.tif 000003
【図２】
2014050719.tif 000004
【図３】
2014050719.tif 000005
【図４】
2014050719.tif 000006
【図５】
2014050719.tif 000007
【図６】
2014050719.tif 000008
【図７】
2014050719.tif 000009
【図８】
2014050719.tif 000010
【図９】
2014050719.tif 000011
【図１０】
2014050719.tif 000012
【図１１】
2014050719.tif 000013
【手続補正書】
【提出日】平成27年2月10日(2015.2.10)
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】０００８
【補正方法】変更
【補正の内容】
【０００８】
本発明の第１の局面は、アクティブマトリクス型の液晶表示装置であって、
複数の走査線と複数のデータ線と複数の画素回路とを含む液晶パネルと、
前記走査線を駆動する走査線駆動回路と、
複数の階調基準電圧を生成する階調基準電圧生成回路と、
前記複数の階調基準電圧に基づき複数の階調電圧を生成し、生成した階調電圧を用いて前記データ線を駆動するデータ線駆動回路と、
電源切断指示を受けたときに、前記データ線駆動回路の電源を切断する前に、前記液晶パネルに含まれるすべての画素回路に対して複数回書き込みを行える長さを有する待機期間を設定し、前記待機期間において前記複数の階調基準電圧がすべて同じ第１電圧になるように前記階調基準電圧生成回路を制御する制御部とを備える。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００１６
【補正方法】変更
【補正の内容】
【００１６】
本発明の第１の局面によれば、データ線駆動回路の電源を切断する前に、階調電圧の基準となる階調基準電圧をすべて同じ電圧にすることにより、液晶パネルの画素回路に同じ電圧を書き込み、画素回路に残留する電荷を放電することができる。特に、待機期間において液晶パネルに含まれるすべての画素回路に同じ電圧を複数回書き込むことにより、画素回路に電圧を１回書き込んだだけでは画素回路内の画素電極の電圧が書き込んだ電圧に到達しない場合でも、画素回路に残留する電荷を確実に放電することができる。また、画素回路に電荷がわずかに残留する場合でも、残留する電荷の量を画素回路間で等しくすることができる。したがって、電源切断時の残留電荷に起因する残像、焼き付き、および、フリッカを効果的に防止することができる。
【手続補正３】
【補正対象書類名】特許請求の範囲
【補正対象項目名】請求項１
【補正方法】変更
【補正の内容】
【請求項１】
アクティブマトリクス型の液晶表示装置であって、
複数の走査線と複数のデータ線と複数の画素回路とを含む液晶パネルと、
前記走査線を駆動する走査線駆動回路と、
複数の階調基準電圧を生成する階調基準電圧生成回路と、
前記複数の階調基準電圧に基づき複数の階調電圧を生成し、生成した階調電圧を用いて前記データ線を駆動するデータ線駆動回路と、
電源切断指示を受けたときに、前記データ線駆動回路の電源を切断する前に、前記液晶パネルに含まれるすべての画素回路に対して複数回書き込みを行える長さを有する待機期間を設定し、前記待機期間において前記複数の階調基準電圧がすべて同じ第１電圧になるように前記階調基準電圧生成回路を制御する制御部とを備えた、液晶表示装置。
【国際調査報告】
2014050719.tif 000014
2014050719.tif 000015
2014050719.tif 000016
2014050719.tif 000017