(57)【特許請求の範囲】
【請求項１】
露光時間の異なる複数の画像信号を加算してダイナミックレンジが拡大された画像を得る撮像装置であって、
光像を光電変換し画像信号を出力する、画素が配置されたＸ−Ｙアドレス方式の固体撮像素子と、
前記固体撮像素子の画素列を第１と第２の２つの群に夫々半分ずつに分離して第１の前記群の走査と第２の前記群の走査を行う走査手段と、
前記各走査の１水平走査時間毎に、第１の前記群に係る第１の画像信号と第２の前記群に係る第２の画像信号を並列して前記各群から読み出す読出し手段と、
第１の前記群と第２の前記群の走査における露光時間として、露光時間の長さが個々に設定可能な第１の露光時間と第２の露光時間とを設定するとともに、前記走査手段に対して、前記各群全体を夫々走査させた後、前記各群に対する前記各露光時間を交互に入れ替えて前記各群全体を夫々走査させる制御手段と、
同一の前記画素列の同一の前記画素に係る、前記第１の画像信号と前記第２の画像信号とが出力されるタイミングを調節する手段と、
を具備することを特徴とする撮像装置。
【請求項２】
読み出された前記露光時間毎の前記各画像信号を足し合わせて対数特性に増幅する対数増幅器を更に具備することを特徴とする請求項１に記載の撮像装置。
【請求項３】
前記走査手段は、前記画素列を偶数ラインと奇数ラインとの前記各群に分離することを特徴とする請求項１に記載の撮像装置。
【請求項４】
前記走査手段は、前記画素列を垂直方向上下の前記各群に分離することを特徴とする請求項１に記載の撮像装置。
【請求項５】
前記走査手段は、前記画素列を水平方向左右の前記各群に分離することを特徴とする請求項１に記載の撮像装置。
【請求項６】
前記対数増幅器は、足し合わされた前記画像信号を所定レベルに戻して出力することを特徴とする請求項２に記載の撮像装置。
【請求項７】
前記各画像信号の各色の成分を分離する色分離回路を更に具備し、
前記対数増幅器は、前記色分離回路からの前記各画像信号を夫々同じ色の成分毎に夫々増幅して足し合わせることを特徴とする請求項２に記載の撮像装置。
【請求項８】
前記対数増幅器で夫々増幅して足し合わされた同じ色の成分毎の前記各画像信号を用いて、輝度信号を出力するマトリクスを更に具備したことを特徴とする請求項７に記載の撮像装置。
【請求項９】
同一の前記画素列に係る前記画像信号が加算されることにより、前記対数増幅器から出力される前記画像信号は、インターレース信号となることを特徴とする請求項２に記載の撮像装置。
【発明の詳細な説明】
【０００１】
【産業上の利用分野】
本発明は、ダイナミックレンジの拡大可能な撮像装置に関する。
【０００２】
【従来の技術】
従来、固体撮像素子のダイナミックレンジを拡大するための種々の手法が考えられている。
【０００３】
例えば、本出願人が出願した特願昭６３−２０１４０６号には、非破壊読み出し型撮像素子から露光時間が異なる複数の画像を読出し、外設された複数のメモリに記憶した後、記憶された各画像を加算することによって、ダイナミックレンジの拡大を図る撮像素子が記載されている。
【０００４】
【発明が解決しようとする課題】
しかし前述した特願昭６３−２０１４０６号に記載される撮像装置によれば、１枚の広ダイナミックレンジの画像を得るために、数フレーム分の処理時間が必要である。
【０００５】
例えば、異なる露光時間を２回変えて撮像すると、１枚の広ダイナミックレンジの画像を得るのに２フレーム分の処理時間が必要となり、１枚の画像を得るのに時間がかかるという欠点がある。
【０００６】
そこで本発明は、広ダイナミックレンジの１画像をＴＶレートでリアルタイムで得られ、画像全体の露光量の制御が容易で、ダイナミックレンジも容易に制御可能な撮像装置を提供することを目的とする。
【０００７】
【課題を解決するための手段】
本発明は上記目的を達成するために、露光時間の異なる複数の画像信号を加算してダイナミックレンジが拡大された画像を得る撮像装置であって、光像を光電変換し画像信号を出力する、画素が配置されたＸ−Ｙアドレス方式の固体撮像素子と、前記固体撮像素子の画素列を第１と第２の２つの群に夫々半分ずつに分離して第１の前記群の走査と第２の前記群の走査を行う走査手段と、前記各走査の１水平走査時間毎に、第１の前記群に係る第１の画像信号と第２の前記群に係る第２の画像信号を並列して前記各群から読み出す読出し手段と、前記第１の前記群と第２の前記群の走査における露光時間として、露光時間の長さが個々に設定可能な第１の露光時間と第２の露光時間とを設定するとともに、前記走査手段に対して、前記各群全体を夫々走査させた後、前記各群に対する前記各露光時間を交互に入れ替えて前記各群全体を夫々走査させる制御手段と、同一の前記画素列の同一の前記画素に係る、前記第１の画像信号と前記第２の画像信号とが出力されるタイミングを調節する手段とを備える撮像装置を提供する。
【０００８】
【作用】
以上のように構成された撮像装置は、Ｘ−Ｙアドレス方式の固体撮像素子を第１と第２の２つの群に夫々半分ずつに分離して、第１の前記群の走査と第２の前記群に対する各走査の１水平走査時間毎に、第１の前記群に係る第１の画像信号と第２の前記群に係る第２の画像信号を並列して前記各群から読み出す。そして前記第１の前記群と第２の前記群の走査における第１の露光時間と第２の露光時間とをそれぞれに露光時間を設定するとともに、前記各群全体を夫々走査させた後、前記各群に対する前記各露光時間を交互に入れ替えて前記各群全体を夫々走査させて、同一の前記画素列の同一の前記画素に係る、前記第１の画像信号と前記第２の画像信号とが出力されるタイミングを調節する。
【０００９】
【実施例】
以下、図面を参照して本発明の実施例を詳細に説明する。
図１は本発明による第１実施例としての撮像装置の構成を示し、説明する。
【００１０】
まず、電子シャッタ機能を有する撮像素子ＣＭＤ（Ｃｈａｇｅ  Ｍｏｄｕｌａｔｉｏｎ  Ｄｅｖｉｃｅ；電荷変調素子）１は、ＳＩＧａとＳＩＧｂの２信号が同時に出力される。ここで、前記ＣＭＤの具体的な構成を図２に示し、説明する。
【００１１】
前記ＣＭＤにおいて、クロック発生回路２１から垂直走査及び水平走査に必要なパルス列を発生し、垂直走査回路２２ａ，２２ｂ及び水平走査回路２３に出力する。前記垂直走査回路２２ａ，２２ｂは読出すべきラインを指定すると共に、後述する露光時間の制御を行なう。このＣＭＤでは、前記垂直走査回路２２ａ，２２ｂを独立して設け、マトリクスに配置される受光素子列の上半分と下半分を分離して走査できるように構成されている。以下、前記垂直走査回路２２ａにより走査される受光素子（画素）列２５ａをＡ群、前記垂直走査回路２２ｂにて走査される受光素子列２５ｂをＢ群と称する。
【００１２】
前記各垂直走査回路２２ａ，２２ｂにより走査されたラインの出力を個々に読出すように、Ａ群の読出し線２７とＢ群の読出し線２８の２出力線を設ける。前記垂直走査回路２２ａ，２２ｂには、図３に示すようなパルスａ１，…、ｂ１，…が加えられ、図３に示す高レベルのパルス（Ｖ２  ）がＣＭＤの各画素の電荷をリセットするリセットパルスであり、低レベルのパルス（Ｖ１  ）は画像信号読出しパルスである。また、各垂直走査回路の出力は、入力に加えられた信号をパルスａ１，ａ２，…のように、所定の水平走査時間（以下Ｈで表す）ずつ遅らせて出力する。つまり、最初に垂直走査回路２２ａからは、Ａ群の１ライン目に図３に示すパルスａ１が、垂直走査回路２２ｂからは、Ｂ群の１ライン目にパルスｂ１が、それぞれの２ライン目には各パルスａ２，ｂ２が印加される。
【００１３】
従って、Ａ群の読出し線（ＳＩＧａ）２７からは露光時間３０ｎ×Ｈ（ｎは整数）、Ｂ群の読出し線（ＳＩＧｂ）２８からは露光時間ｎ×Ｈの信号が出力される。前記ＣＭＤの受光素子列（受光面）を上下１／２に分けているため、この垂直走査は通常の１フレーム時間の１／２で終了する。
残りの１／２フレーム時間ではＡ群，Ｂ群の走査パルスを入れ替えて、信号線２７から露光時間ｎ×Ｈ、信号線２８からは３０ｎ×Ｈの信号が出力される。
【００１４】
次に、図１に戻り説明する。コントローラ２は前記ＣＭＤ１に露光時間の信号を出力し、切換回路３には、１／２フレーム毎に切換えるように切換え信号を出力する。
【００１５】
前記切換回路３は、１／２フレーム毎の切換え信号により、前記ＣＭＤ１のＡ群，Ｂ群の出力を、遅延回路（  ｄｅｌａｙ）４を介する第１出力線と、介さない第２出力線に切換える。これにより前記遅延回路４は、常に露光時間３０ｎ×Ｈの画像信号が入力され、１／２フレーム時間だけ入力された信号を遅延させる。
【００１６】
つまり、露光時間３０ｎ×Ｈとｎ×Ｈの比が３０：１とすれば、前者の画像信号を０ｄＢとすると、後者の画像信号は、約−３０ｄＢになる。以下、Ａ群からの露光時間３０ｎ×Ｈの信号をＳＩＧａ（０ｄＢ）、ｎ×Ｈの信号をＳＩＧａ（−３０ｄＢ）、同様にＢ群からの信号をＳＩＧｂ（０ｄＢ）、ＳＩＧｂ（−３０ｄＢ）と称する。図４に、これらのＣＭＤ１の出力ＳＩＧａ，ＳＩＧｂと、前記遅延回路４の出力（ｄｅｌａｙ  出力）、及び前記切換回路３の出力で遅延されていない出力（ｔｈｒｏｕｇｈ  出力）の関係を示す。
【００１７】
この図４に示した１／２フレーム時間早く走査された０ｄＢの画像は、図１に示す前記遅延回路４により、１／２フレーム遅延させられ、同じ画素の−３０ｄＢの信号と同時に、次段の色分離回路５ａ，５ｂに出力される。
【００１８】
前記画像は、これらの色分離回路５ａ，５ｂにより、ｒ成分，ｇ成分，ｂ成分に分離された後、それぞれ対数増幅器６ｒ，６ｇ，６ｂで対数特性に変換される。ここで、前記対数増幅器６ｒ，６ｇ，６ｂの具体的な構成を図５に示し説明する。
【００１９】
前記対数増幅器６ｒ，６ｇ，６ｂには、−３０ｄＢの信号と０ｄＢの信号が入力される。前記０ｄＢの画像信号は、最初にダイナミッククランプ回路３１を介して、リミッタ回路３２で、所定のレベルに制限され、０ｄＢの信号として、加算器５６に送られる。
【００２０】
また前記０ｄＢの画像信号は、前記ダイナミッククランプ回路３１を介して、次段の増幅器３３に出力され、１０ｄＢ増幅されて、ダイナミッククランプ回路３４を介して、リミッタ回路３５で所定レベルに制限され、１０ｄＢの信号として加算器５６に入力される。
以下、同様に処理された２０ｄＢ，３０ｄＢ，４０ｄＢ，５０ｄＢの信号が加算器５６に入力される。
一方、−３０ｄＢの信号については、増幅器５０，５３が２段設けられ、−３０ｄＢ，−２０ｄＢ，−１０ｄＢの信号を加算器５６に出力される。
【００２１】
前記加算器５６では、図６に示すように、−３０ｄＢ，−２０ｄＢ，…，０ｄＢ，…，５０ｄＢの各出力信号を足し合わせる。足し合わされた出力信号は図６の破線ｃに示すように、対数特性を有する。前記出力信号は、最大値が所定レベルの９倍となるため、図５に示す乗算器５７で１／９倍し、所定レベルに戻し、ダイナミッククランプ回路６１を介して出力される。
【００２２】
また、減算器５８、増幅器６０は、入力のダイナミックレンジが小さい場合に用いられる部分である。前記減算器５８では、入力のダイナミックレンジに応じて所定レベルを信号から減じ、該減算器５８で減じた分を補償するように、前記増幅器６０で増幅させてから、前記ダイナミッククランプ回路６１を介して出力する。
これらの対数増幅器６ｒ，６ｇ，６ｂによれば、入力のダイナミックレンジの大小にかかわらず最適な対数変換が行われる。
【００２３】
次に前記対数増幅器６ｒ，６ｇ，６ｂで対数変換された信号は、Ａ／Ｄ変換器７ｒ，７ｇ，７ｂで、対数特性のままデジタル値にそれぞれ変換される。前記Ａ／Ｄ変換器７ｒ，７ｇ，７ｂの出力は、対数特性のまま加算器１４ｒ，１４ｇ，１４ｂと、逆対数変換器（  ｌｏｇ−１）８ｒ，８ｇ，８ｂに送られる。
前記逆対数変換器８ｒ，８ｇ，８ｂはＲＯＭで構成され、入力した対数特性の値に対して元の信号の値を出力する。
以上のような構成により、ダイナミックレンジ９０ｄＢのＲＧＢ信号が得られる。これをマトリクス回路９に入力して、輝度信号“Ｙ”を得る。
【００２４】
前記輝度信号“Ｙ”は、対数回路１０で対数に変換され、“ｌｏｇ  Ｙ”が得られる。前記“ｌｏｇ  Ｙ”は、照明ムラ抑制回路１１により照明ムラ成分が抑制され、“ｌｏｇ  Ｙ′”となり、輝度圧縮回路１２で、係数α，βにより、“αｌｏｇ  βＹ′”という形に圧縮される。
【００２５】
そして減算器１３で、圧縮された“αｌｏｇ  βＹ′”から“ｌｏｇ  Ｙ”を減算し、圧縮係数“ｌｏｇ［｛（βＹ′）×α乗｝／Ｙ］”を得る。これを加算器１４ｒ，１４ｇ，１４ｂにて、対数特性の信号“ｌｏｇ  Ｒ”，“ｌｏｇ  Ｇ”，“ｌｏｇ  Ｂ”に加えられ、圧縮係数
ｌｏｇ［｛（βＹ′）×α乗｝／Ｙ］＝ｌｏｇ  ｋ
【００２６】
とおくと、それぞれ“ｌｏｇ  ｋＲ”，“ｌｏｇ  ｋＧ”，“ｌｏｇ  ｋＢ”となり、逆対数変換回路１５ｒ，１５ｇ，１５ｂにおいて、“ｋＲ”，“ｋＧ”，“ｋＢ”が得られる。
前記照明ムラ抑制回路１１及び前記輝度圧縮回路１２の構成等については、特願平０４−０４１４５１号に詳しく記述されており、ここでは省略する。
【００２７】
よって、本第１実施例によれば、９０ｄＢの画像信号を、リアルタイムで撮像して表示ができる。また、１個の撮像素子で、動画にも対応できる広ダイナミックレンジのカメラ等の撮像装置を構成することができる。さらに、“ｎ”を変化させることにより、露光時間を制御することができる。
【００２８】
なお、この第１実施例において、異なる２つの露光時間の比を３０：１としたが、この比を変化させることにより、容易に入力のダイナミックレンジを制御することができる。また、露光時間を２段階としたが、これを多段階としても良い。
【００２９】
次に図７には、前述した撮像素子ＣＭＤの構成が異なる第２実施例の撮像装置の構成を示し説明する。ここで第２実施例の構成部材で図２に示す部材と同等のものには同じ参照符号を付してその説明を省略する。
【００３０】
この第２の実施例のＣＭＤは、クロック発生回路７１、水平走査回路２３、信号読出し回路２４、垂直走査回路２２ａ，２２ｂ及び、２次元マトリックス状に並べられた受光素子で構成され、２次元マトリクスの奇数ライン２５ａが垂直走査回路２２ａに、偶数ライン２５ｂが垂直走査回路２２ｂによって走査されるように接続されている。
【００３１】
前記信号読出し回路２４の、読出し線を前記垂直走査回路２２ａによって走査される奇数ラインの信号ＳＩＧａを読出すための読出し線２７、前記垂直走査回路２２ｂによって走査される偶数ラインの信号ＳＩＧｂを読出すための読出し線２８を設け、奇数ラインと偶数ラインを個々に走査、読出し可能な構成とする。前記ＣＭＤを図１のシステムに適用する。また、与える駆動パルスも、第１実施例と同様に図３に示すものを用いる。
この構成の撮像装置の各出力信号を図８に示し説明する。
【００３２】
図８に示すように、１／２フレーム時間に奇数ラインが、次の１／２フレーム時間に偶数ラインが、それぞれ０ｄＢの画像と−３０ｄＢの画像を同時に読出され、インターレース走査が可能となる。
次に本発明による第３実施例の撮像装置について説明する。この第３実施例は、第１実施例に対して、ＣＭＤ及び、遅延回路の構成が異なる。
【００３３】
本第３実施例に用いるＣＭＤは、図９に示すように構成され、クロック発生回路７２、水平走査回路２３、信号読出し回路２４、垂直走査回路２２、受光素子とからなり、２次元マトリクス状に並べられた受光素子の各ラインは垂直走査回路２２によって順次走査される。
一方、読出し回路２４への結線は、第２実施例と同様に、奇数ラインの信号ＳＩＧａと、偶数ラインの信号ＳＩＧｂを個々に読出せるようになされている。
【００３４】
前記クロック発生回路７２は、外部から露光時間の信号を受け取ると、図１０に示すようなパルスを垂直走査回路２２へ出力する。前記垂直走査回路２２は、これを順次、１Ｈずつ遅延させて、１ライン目、２ライン目、…と各ラインに出力する。
【００３５】
この遅延されたパルスは、リセットパルスが印加された後、３０ｎ×Ｈ（ｎは整数）経過の後に、１Ｈ期間で読出し、その直後に再びリセットし、ｎ×Ｈ後に再び読出すためのものである。２回の読出しの露光時間の比が、３０：１であるため、先の読出しにより０ｄＢ、後の読み出しにより−３０ｄＢの各画像信号が得られる。
【００３６】
前記０ｄＢの画像が得られてから、ｎ×Ｈ後に、前記−３０ｄＢの画像信号の読出しが開始される。そして読出しにかかる時間が１Ｈなので、０ｄＢの画像と−３０ｄＢの画像の読み出し開始の時間差は（ｎ＋１）×Ｈである。この時間に、走査回路では、ｎ＋１ライン先まで走査する。
従って、図１１に示すように、ｋライン目の−３０ｄＢの画像と、ｋ＋（ｎ＋１）ライン目の０ｄＢの画像の読出しタイミングが一致する。
ここで、“ｎ”は偶数になるようにする。“ｋ”が奇数の時、“ｋ＋（ｎ＋１）”は偶数になり、“ｋ”が偶数の時、“ｋ＋（ｎ＋１）”が奇数となる。
【００３７】
前述の通り、奇数ラインと偶数ラインは、同時に独立に読み出せるので、ｋライン目の−３０ｄＢの画像とｋ＋（ｎ＋１）ライン目の０ｄＢの画像は、２本の読出し線により、個々に読出すことができる。
【００３８】
“ｎ”＝２，４，８，６，…と変化させることにより、露光時間を変化させることができる。ただし、“ｎ”は、ＣＭＤのライン数（垂直方向の画素数）を“Ｎ”とすると、
３０ｎ＋ｎ＋１＋１＝３１ｎ＋２≦Ｎ
を満たさねばならない。
このＣＭＤを、図１のシステムに適用させるためのＣＭＤ周辺の構成を図１２に示す。
【００３９】
ＣＭＤ７３からの２つの出力信号ＳＩＧａ，ＳＩＧｂは、切換器３に入力される切換器３では、コントローラ７４からの１Ｈ周期の信号により、ＣＭＤ７３からの出力信号を、遅延回路７５を介する信号と、介さない信号に切換える。この際、前記遅延回路７５に送られる信号は、常に０ｄＢの信号であり、遅延回路７５を介さない信号は、常に−３０ｄＢの信号が出力される。
また、コントローラ７４からは露光時間を決定する信号であるｎの値が、ＣＭＤ７３およびセレクタ７６に送られる。
遅延回路７５では初段のみ３Ｈ、後段は２Ｈ遅延毎に、タップを出して、セレクタ７６に入力する。
【００４０】
前記セレクタ７６では、コントローラ７４から送られてくる“ｎ”の値に応じて、前記遅延回路７５のタップから、出力すべき信号を選択する。すなわち、“ｎ”の値に対して（ｎ＋１）Ｈ遅延の出力を選択する。
【００４１】
このようにして、同じラインの０ｄＢと−３０ｄＢの画像を、同時に得ることができる。また、“ｎ”を変化させることによって露光量の調整も容易である。本実施例では２回の異なる露光時間の比を３０：１としたが、この比は限定されるものではなく、可変にしてもよい。この比の可変により、ダイナミックレンジの制御が可能となる。また、露光時間を２段階としたが、これを多段階としても良い。
【００４２】
通常のＣＭＤのチップ上の受光素子（画素）であるフォトトランジスタ配置は上から見ると、図１３に示すように構成されている。この構成で、フォトトランジスタ上に環状にゲート８１が形成され、受光部にあたる。
【００４３】
前記環状ゲート８１の内側に、フォトトランジスタのソース部が形成され（図示せず）、そのソース部に接続された電極８２が形成される。この電極８２は、縦方向に配置されたフォトトランジスタにおいて共通であり、図示しない読出し回路へ接続されている。前記環状ゲート８１の外側が、フォトトランジスタのドレイン部になり、全フォトトランジスタにおいて共通である。
【００４４】
このような構造のＣＭＤにおいて、図９に示すような偶数ラインと奇数ラインの読出し線を別に設ける構成を実現すると、ＣＭＤのチップ上の画素が図１４のように配置される。このような配置にすると、画素間に２本の配線が通るので、素子間隔を狭くすることができず、解像度は低下する。
【００４５】
そこで、本実施例に用いるＣＭＤは、図１５に示すような奇数ラインの画素と、偶数ラインの画素を、水平方向に画素ピッチの１／２だけずらす配置とする。このような配置によれば、読出し線配線は、従来通り、画素の中央を通り抜けるようまっすぐに施すことが可能となり、画素間の配線も１本となり画素間隔を狭くすることができるので、解像度の低下を防ぐことができる。
【００４６】
次に図１６乃至図１９を参照して、本発明による第４実施例として、−３０ｄＢと０ｄＢの画像信号を得る撮像装置について説明する。ここで、第４実施例の説明は特徴部分のみとし、以外の構成，部材は第１実施例と同等であるものとする。
図１７に本第４実施例に用いるＣＭＤの構成図を示す。
【００４７】
このＣＭＤにおいて、Ｎ×Ｎの２次元マトリクス状に配置されたフォトトランジスタのゲート部は、横１ライン毎に、垂直走査回路２２に接続され、ソース部は縦１列毎に読出し回路７８ａ，７８ｂに接続されている。読出し回路７８ａは水平方向の１〜Ｎ／２画素までを、読出し回路７８ｂは水平方向のＮ／２＋１−Ｎ画素を読み出すよう各列のソースに接続されている。
【００４８】
前記読出し回路７８ａ，７８ｂは、水平走査回路２３により同時に走査され、読出し線７９，８０から、水平方向にＮ／２画素分離れた、２つの画素の信号が同時に読出される。
【００４９】
クロック発生回路７７から垂直走査回路２２ａは、図１８に示すようなパルスが送られる。図１８の中の“ｎ”は、露光時間を決める正の整数で図示しない外部のコントローラよりＣＭＤのクロック発生回路に入力される。
【００５０】
図１８に示すリセットパルス（Ｖ２  ）で、ＣＭＤの該当ラインの蓄積電荷をリセット後、露光時間３０ｎ×Ｈ後に読出しパルス（Ｖ１  ）により読出した直後に再びリセットし、次にｎ×Ｈ後に再び読出すためのパルス列であり、１ライン毎に１Ｈづつ遅延された前記パルス列が加えられる。なお、１ラインは前後半分に分けられているので、読出しにかかる時間は、１／２Ｈである。
【００５１】
図１９には、ｋラインとｋ＋ｎラインに加えられるパルス列を示す。図示するように、１ライン毎に１Ｈづつ遅延されるため、ｋラインとｋ＋ｎラインではｎ×Ｈだけの時間差がある。前記ｋ＋ｎラインの１回目の読出し（０ｄＢ）と、ｋラインの２回目の読出し（−３０ｄＢ）が、１Ｈの時間内に連続して行われる。
図１６は、第４実施例の撮像装置を図１のシステムに適用させるためのＣＭＤ周辺の構成を示すブロック図である。
コントローラ７４は露光時間を決定する信号“ｎ”をＣＭＤ８３とセレクタ８７に送出し、切替器８５には切替信号を送る。
【００５２】
前記ＣＭＤ８３の出力信号ＳＩＧ２は、遅延回路８４にて１／２Ｈ遅延された後、前記切替器８５に入力される。一方、前記ＣＭＤ８３の出力信号ＳＩＧ１は、直接的に切替器８５に入力される。
【００５３】
前記切替器８５では、始めは信号ＳＩＧ１を、１／２Ｈ遅延させた出力信号ａを、すでに１／２Ｈ遅延された信号ＳＩＧ２を直接、出力信号ｂとして、それぞれ出力する。そして、１／２Ｈ経過した後、前記コントローラ７４からの制御信号により、切替器８５のスイッチが切り替わり、信号ＳＩＧ１を直接的に出力信号ｂとして、既に１／２Ｈ遅延された信号ＳＩＧ２をさらに１／２遅延した出力信号ａをそれぞれ出力する。以下、１／２Ｈ毎に同じ動作を繰り返す。
【００５４】
前記切換器８５の出力信号ａは、１Ｈ遅延毎にタップを持つ遅延回路８６に接続される。前記遅延回路８６の各タップは、セレクタ８７に入力される。前記セレクタ８７では、前記コントローラ７４からの信号“ｎ”に応じて、ｎ×Ｈ遅延した信号を選択して出力する。
図２０には、前記ＣＭＤ８３の出力信号ＳＩＧ１，ＳＩＧ２、前記切替器８５の出力信号ａ，ｂ、セレクタ８７の出力信号の関係を示す。
【００５５】
以上のようにして、０ｄＢと−３０ｄＢの画像を１フレーム時間内に撮像することができる。本実施例は、０ｄＢと−３０ｄＢの画像の時間差がほとんどないため、動きのある被写体の撮影に好適する。
【００５６】
この第４実施例では、２回の異なる露光時間の比を３０：１としたが、この比は限定されず、可変にしてもよい。この比を可変すれば、ダイナミックレンジの制御も可能となる。また、露光時間を２段階としたが、これを多段階としても良い。
【００５７】
以上説明したように本発明の実施例によれば、１つのＣＭＤ等の撮像素子を用いて、１フレーム時間内に露光時間の異なる２画像を得られ、１枚の広ダイナミックレンジの画像がＴＶレートでリアルタイムで得ることができる。
さらに全体の露光量の制御も容易であり、さらに、ダイナミックレンジも容易に制御可能である。
また本発明は、前述した実施例に限定されるものではなく、他にも発明の要旨を逸脱しない範囲で種々の変形や応用が可能であることは勿論である。
【００５８】
【発明の効果】
以上詳述したように、本発明によれば、広ダイナミックレンジの１画像をＴＶレートでリアルタイムで得られ、画像全体の露光量の制御が容易で、ダイナミックレンジも容易に制御可能な撮像装置を提供できる。
【図面の簡単な説明】
【図１】図１は本発明による第１実施例としての撮像装置の構成を示すブロック図である。
【図２】図２は、図１に示したＣＭＤの具体的な構成を示す図である。
【図３】図３は、図１に示した垂直走査回路に印加するパルス波形を示し図である。
【図４】図４は、ＣＭＤ１の出力信号と、遅延回路の出力信号、切換回路の出力で遅延されていない出力との関係を示す図である。
【図５】図５は、図１に示した対数増幅器の具体的な構成を示す図である。
【図６】図６は、加算器からの各出力信号を足し合わせた特性を示す図である。
【図７】図７は、本発明による第２実施例としての撮像装置に用いるＣＭＤの構成を示す図である。
【図８】図８は、第２実施例の撮像装置の各出力信号を示す図である。
【図９】図９は、第３実施例の撮像装置に用いるＣＭＤの構成を示す図である。
【図１０】図１０は、クロック発生回路から垂直走査回路へ出力するパルス波形を示す図である。
【図１１】図１１は、ｋライン目の−３０ｄＢの画像と、ｋ＋（ｎ＋１）ライン目の０ｄＢの画像との読出しのタイミングを示すタイムチャート。
【図１２】図１２は、第３実施例の撮像装置を図１のシステムに適用させるためのＣＭＤ周辺の構成を示す図である。
【図１３】図１３は、従来のＣＭＤのチップ上のフォトトランジスタと配線の配置を示す図である。
【図１４】図１４は、従来のＣＭＤのチップ上の画素に偶数，奇数ラインの読出し線を別に設けたフォトトランジスタと配線の配置を示す図である。
【図１５】図１５は、本発明のＣＭＤのチップ上のフォトトランジスタと配線の配置を示す図である。
【図１６】図１６は、第４実施例の撮像装置を図１のシステムに適用させるためのＣＭＤ周辺の構成を示す図である。
【図１７】図１７は、第４実施例の撮像装置に用いるＣＭＤの構成図を示す図である。
【図１８】図１８は、クロック発生回路から垂直走査回路に出力されるパルス波形を示した図である。
【図１９】図１９は、所定ラインに加えられるパルス列を示す図である。
【図２０】図２０は、第４実施例に用いるＣＭＤの出力信号、切替器の出力信号、セレクタの出力信号の関係を示す図である。
【符号の説明】
１，７３，８３…ＣＭＤ、２…コントローラ、３…切換回路、４，７５…遅延回路（  ｄｅａｌｙ  ）  、５ａ，５ｂ…色分離回路、６ｒ，６ｇ，６ｂ…対数増幅器、７ｒ，７ｇ，７ｂ…Ａ／Ｄ変換器、８ｒ，８ｇ，８ｂ…逆対数変換器（  ｌｏｇ−１）、９…マトリクス回路、１０…対数回路、１１…照明ムラ抑制回路、１２…輝度圧縮回路、１３，５８…減算器、１４ｒ，１４ｇ，１４ｂ…加算器、２１，７１，７２，７７…クロック発生回路、２２ａ，２２ｂ…垂直走査回路、２３…水平走査回路、２４，７８ａ，７８ｂ…信号読出し回路、２５ａ，２５ｂ…受光素子（画素）列、２７，２８，７９，８０…読出し線、３１，６１…ダイナミッククランプ回路、３２，３５…リミッタ回路、５０，５３，６０…増幅器、５６…加算器、５７…乗算器、７４…ＣＭＤコントローラ、７６，８７…セレクタ、８５…切替器。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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