(57)【特許請求の範囲】
【請求項１】
設定電圧を一方の入力に受け他方の入力に出力側の電圧が帰還されて前記一方の入力電圧と前記他方の入力電圧との差に応じた電圧出力を発生する比較増幅器と、この比較増幅器の出力電圧を受け前記比較増幅器の前記他方の入力に出力を帰還させるバッファアンプと、第１の端子にこのバッファアンプからの出力電圧を受け、第２の端子が被検査デバイスに接続されたダイオードブリッジからなるダイオードスイッチ回路と、このダイオードスイッチ回路の前記第１の端子と前記バッファアンプの出力端子との間に設けられた第１のスイッチ回路とを備え、前記比較増幅器と前記バッファアンプと前記ダイオードスイッチ回路とが１つのＩＣに集積化され、前記第２の端子における入力インピーダンスを高抵抗に設定するときに前記第１のスイッチ回路をＯＦＦにしかつ前記ダイオードスイッチ回路をＯＦＦ状態に設定する電子デバイスへの負荷電流出力回路。
【請求項２】
さらに、前記ＩＣに前記比較増幅器と前記バッファアンプと前記ダイオードスイッチ回路と同時に集積化された第１、第２の定電流源を有し、前記バッファアンプは、プッシュプル動作のボルテージフォロアであり、前記ダイオードスイッチ回路は、前記ダイオードブリッジの第３の端子に前記第１の定電流源からの電流を第２のスイッチ回路を介して受け、このダイオードブリッジの第４の端子から流出する電流を第３のスイッチを介して前記第２の定電流源に流すものであり、前記被検査デバイスが出力信号を発生しないときあるいはテストのために出力信号の状態を判定するタイミングにないときに前記高抵抗に設定するときとされて前記第２のスイッチ回路と前記第３のスイッチ回路とが前記第１のスイッチ回路とともにＯＦＦにされ、これにより前記ダイオードスイッチ回路が前記バッファアンプと前記第１および第２の定電流源とから切り離される請求項１記載の電子デバイスへの負荷電流出力回路。
【請求項３】
さらに、前記ダイオードブリッジを構成するダイオードはショットキー・ダイオードであり、前記バッファアンプと等価の動作をするダミー回路が設けられ前記比較増幅器の出力をこのダミー回路で受けてこのダミー回路の出力を前記他方入力に送出し、前記ダミー回路も前記ＩＣに前記第１、第２の定電流源と同時に集積化され、前記高抵抗に設定する制御信号を受けて前記第１、第２および第３のスイッチ回路がＯＦＦにされる請求項２記載の電子デバイスへの負荷電流出力回路。
【請求項４】
前記第２および第３のスイッチ回路はトランジスタの電流切換回路で構成され、前記ダミー回路と前記他方の入力との間に第４のスイッチ回路が設けられ、前記第１および前記第４のスイッチ回路は、ＣＭＯＳトランスミッションゲートで構成された請求項３記載の電子デバイスへの負荷電流出力回路。
【請求項５】
設定電圧を一方の入力に受け他方の入力に出力側の電圧が帰還されて前記一方の入力電圧と前記他方の入力電圧との差に応じた電圧出力を発生する比較増幅器と、この比較増幅器の出力電圧を受け前記比較増幅器の前記他方の入力に出力を帰還させるバッファアンプと、第１の端子にこのバッファアンプからの出力電圧を受け、第２の端子が被検査デバイスに接続されたダイオードブリッジからなるダイオードスイッチ回路と、このダイオードスイッチ回路の前記第１の端子と前記バッファアンプの出力端子との間に設けられた第１のスイッチ回路とを備え、前記比較増幅器と前記バッファアンプと前記ダイオードスイッチ回路とが１つのＩＣに集積化され、前記第２の端子における入力インピーダンスを高抵抗に設定するときに前記第１のスイッチ回路をＯＦＦにしかつ前記ダイオードスイッチ回路をＯＦＦ状態に設定する負荷電流出力回路を有するＩＣテスタ。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
この発明は、電子デバイスへの負荷電流出力回路およびＩＣテスタに関し、詳しくは、被検査デバイス（以下ＤＵＴ）に負荷電流を供給して出力波形状態の判定をするとき以外には、接続された端子に対して高抵抗（高い入力インピーダンス）を保持してＤＵＴの消費電力を低減でき、精度の高いテストをすることが可能な電子デバイスへの負荷電流出力回路およびＩＣテスタに関する。
【０００２】
【従来の技術】
ＩＣテスタでは、所定の端子をあらかじめ設定された電圧で駆動して、所定の時間後にＤＵＴの出力端子（あるいは入出力端子，以下同じ）から出力された信号の波形について、ＨＩＧＨレベル（以下“Ｈ”）か、ＬＯＷレベル（以下“Ｌ”）かを、所定のタイミングで発生するストローブ信号に応じて判定回路で判定し（以下判定モード）、期待値と比較することでＤＵＴの動作試験あるいは性能試験等を行う。
この場合に、特定の出力端子には、“Ｈ”、“Ｌ”の出力波形に応じてあらかじめ決められた電流値、例えば、数ｍＡから数十ｍＡの程度の負荷電流を供給して判定が行われる。そのためにＩＣテスタには、判定モード時にＤＵＴの出力端子に負荷電流を供給する負荷電流供給回路が設けられている。この負荷電流供給回路は、通常、内部のダイオードスイッチ回路を介して出力端子に接続状態にされている。
【０００３】
ダイオードスイッチ回路は、一般的に、ダイオードブリッジで構成され、出力端子の“Ｈ”、“Ｌ”の出力に応じて、これのダイオードをＯＮ／ＯＦＦさせて負荷電流の供給を制御する。この関係で、判定モード以外ではダイオードスイッチ回路をＯＦＦ状態にさせておく必要がある。しかし、負荷電流を供給していない状態でのＤＵＴの出力端子から負荷電流供給回路へリークするリーク電流がこの場合に問題になる。このリーク電流は、例えば、ＣＭＯＳＩＣ（半導体集積回路）等の低消費電力デバイスの電源電流測定などに影響を及ぼさない程度のリーク電流として通常は数１００ｎＡ以下であることが好ましい。そのため、ＩＣテスタにおける負荷電流供給回路のダイオードスイッチ回路部分は、ディスクリートな回路として設けざるを得ないのが現状である。
【０００４】
図５は、ＩＣテスタの負荷電流供給回路を含む全体的な構成を示す。
図５において、ＩＣテスタ７０は、装置の制御を行うコンピュータ７１と、時間基準となるクロック信号を発生する基準信号発生器５４、クロック信号をもとに試験タイミング信号を発生するタイミング発生器５３、試験タイミング信号からテストパターンを発生するパターン発生器５５、試験タイミング信号およびテストパターン信号からテスト信号を発生する波形フォーマッタ５１、ＤＵＴ７３に印加する試験波形の“Ｈ”，“Ｌ”の電圧レベルを生成するリファレンス電圧発生器５６、そのリファレンス電圧と波形フォーマッタの出力パターン波形とを受けて、試験波形を持つテスト信号をＤＵＴ７３に印加するドライバ４２、ドライバ４２から出力された試験波形をＤＵＴ７３に与える伝送線路７２、ＤＵＴ７３からの応答信号（出力信号）とリファレンス電圧の比較を行うコンパレータ４３、コンパレータ４３からの比較信号と期待値信号の比較を行う比較レジスタ５２、そしてＤＵＴ７３からの出力信号を得るときに、その端子に所定の負荷電流を供給し、あるいは負荷電流としてシンク電流を受ける負荷電流出力回路４１等とで構成されている。
【０００５】
なお、ＩＣテスタ７０において、ＤＵＴ７３は、パフォーマンスボードに搭載され、負荷電流出力回路４１とドライバ４２、コンパレータ４３は、パフォーマンスボードの手前に配置された基板に搭載されている。通常、この部分は、ピンエレクトロニクス（ピンエレクトロニクス４）と呼ばれている。
近年、ＩＣテスタでは、波形フォーマッタ５１と、比較レジスタ５２と、タイミング発生器５３と、基準信号発生器５４と、パターン発生器５５と、リファレンス電圧発生器５６と、ピンエレクトロニクス４とをＤＵＴ７３のピン対応に設けたパーピン方式が採用されている。その結果、このような回路基板がそれぞれＩ／Ｏピン数×測定デバイス数だけ用意され、複数のＤＵＴ７３に対してそれぞれの応答信号（出力端子からの出力信号）を同時に試験している。
【０００６】
【発明が解決しようとする課題】
負荷電流出力回路４１は、ＩＣ化されたものではなく、図６に示すように４つのダイオードＤからなるダイオードブリッジのスイッチ回路１０と、２つの定電流源２１１，２２１およびスイッチ回路２１２，２２２と、バッファアンプ３２と、差動増幅器３９とで構成されている。スイッチ回路２１２，２２２は、制御端子９５に加えられるインヒビット信号ＩＮＨによりＯＮ／ＯＦＦされて、切換られれる。ダイオードブリッジのスイッチ回路１０と定電流源２１１，２２１の電流経路を切断したときには電流バッファ３２と入出力端子（Ｉ／Ｏ端子）９２は、ダイオードにより電気的に切り離れた高抵抗モード（ＤＵＴの出力端子からみた入力インピーダンスが高い抵抗値になっている状態）になる。
ここで、負荷電流出力回路４１は、ＩＣテスタ７０においてＤＵＴ７３の電流負荷をする回路として使用されるので、負荷電流出力回路４１を測定系（出力波形判定系）から電気的に切り離す必要があるときには前記の高抵抗モードになる。高抵抗モード時の負荷電流出力回路４１からのリーク電流は、他のテスト動作に影響を及ぼさないような値でなければならない。
このリーク電流の条件を満たすため、従来の負荷電流出力回路では、ダイオードブリッジのスイッチ回路１０を構成するダイオードにリーク電流が少ない特性の素子を使用している。
【０００７】
したがって、従来のＩＣテスタにあっては、負荷電流出力回路のダイオードスイッチ回路部分をディスクリートな回路として設けざるを得ない。しかも、多数のピンエレクトロニクス回路を使用する関係でディスクリートな回路を設けることでＩＣテスタが大型化する問題がある。また、ダイオードスイッチ回路部分をディスクリートな回路で構成すると、ダイオードスイッチ回路（ダイオードブリッジ）とバッファアンプ間の経路の配線長が長くなる。さらに、経路中に集積回路のパッケージピンによるインダクタが存在するために、負荷電流出力回路の出力端子電圧が高速に変化しても、経路の電流追従が難しくなる問題がある。そのために、出力信号の周波数が高くなると高速な応答ができなくなり、精度の高い測定ができない。
【０００８】
一方、ＩＣ化する場合には、低リーク電流のダイオードとトランジスタ素子の両者を、両者の性能を落とさず同一基板上に形成することが困難である。また、両者を同一基板上に生成するためには高価な金属材料と特殊な製造プロセスが必要になる。ＩＣ化するためのダイオードをトランジスタで形成することもできるが、動作が遅く、耐圧は低い。耐圧があり、動作が速いダイオードとして、例えば、ショットキー・ダイオードを集積化することもできるが、タングステン等の一般に使用される金属材料を用いるものはリークが大きい。このようなダイオードを同一基板上に集積化するとダイオードスイッチ回路と負荷電流供給回路との接続パスは短くできる反面、ダイオードスイッチ回路から他の回路へのリーク電流が大きくなり、ＤＵＴの出力端子から流出する電流リークによりＤＵＴ側での消費電力が増加して測定精度が落ちる。そのため、従来の負荷電流出力回路では、ダイオードブリッジのスイッチ回路は、集積回路の外部に個別部品の低リークダイオードを設ける構成となっている。
この発明の目的は、このような従来技術の問題点を解決するものであって、ダイオードスイッチ回路を含めて負荷電流出力回路をＩＣ化してもリーク電流を低減することができ、高速応答ができる電子デバイスへの負荷電流出力回路およびＩＣテスタを提供することにある。
【０００９】
【課題を解決するための手段】
このような目的を達成するための発明の電子デバイスへの負荷電流出力回路およびＩＣテスタの特徴は、設定電圧を一方の入力に受け他方の入力に出力側の電圧が帰還されて一方の入力電圧と他方の入力電圧との差に応じた電圧出力を発生する比較増幅器と、この比較増幅器の出力電圧を受け比較増幅器の前記他方の入力に出力を帰還させるバッファアンプと、第１の端子にこのバッファアンプからの出力電圧を受け、第２の端子が被検査デバイスに接続されたダイオードブリッジからなるダイオードスイッチ回路と、このダイオードスイッチ回路の第１の端子とバッファアンプの出力端子との間に設けられた第１のスイッチ回路とを備えていて、比較増幅器とバッファアンプとダイオードスイッチ回路とが１つのＩＣに集積化され、第２の端子における入力インピーダンスを高抵抗に設定するときに第１のスイッチ回路をＯＦＦにしかつダイオードスイッチ回路をＯＦＦ状態に設定するものである。
【００１０】
さらに、この発明の具体的な構成としては、このＩＣに比較増幅器とバッファアンプとダイオードスイッチ回路と同時に集積化された第１、第２の定電流源を有していて、バッファアンプがプッシュプル動作のボルテージフォロアであり、ダイオードスイッチ回路が、ダイオードブリッジの第３の端子に第１の定電流源からの電流を第２のスイッチ回路を介して受け、このダイオードブリッジの第４の端子から流出する電流を第３のスイッチを介して第２の定電流源に流すものであり、被検査デバイスが出力信号を発生しないときあるいはテストのために出力信号の状態を判定するタイミングにないときに高抵抗に設定するときとされて第２のスイッチ回路と第３のスイッチ回路とが第１のスイッチ回路とともにＯＦＦにされ、これによりダイオードスイッチ回路がバッファアンプと第１および第２の定電流源とから切り離されるものである。
【００１１】
【発明の実施の形態】
このように、負荷電流出力回路のバッファアンプとダイオードブリッジ間にスイッチ回路を設けて、１つのＩＣとして集積化し、高抵抗モード時に、スイッチ回路をＯＦＦにして、かつ、例えば、逆バイアス等によりブリッジのダイオードをＯＦＦにすることでダイオードスイッチ回路をＯＦＦ状態に設定する。このようにすれば、ダイオードスイッチ回路の入力端子と出力端子とを切り離すことができるので、ＩＣ化されていてもリーク電流を低減することができる。
これにより、負荷電流を供給して出力信号の状態を測定するとき以外の高抵抗モード時においては、リーク電流が低減してＤＵＴからみた消費電流を低減することができる。しかも、バッファアンプとともにダイオードスイッチ回路がＩＣ化されているので、これらの間のパスが短くなり、経路上のインダクタ値を少なくできる。
その結果、高速に応答する負荷電流出力回路を実現でき、ＤＵＴの出力信号が高い周波数のものになっても負荷電流出力回路がそれに追従することができる。
【００１２】
さらに、ダイオードスイッチ回路を含めてＩＣ化できることにより小形、かつ低価格な負荷電流出力回路になり、多数のピンエレクトロニクス回路を使用するＩＣテスタの小形化、および低価格化を実現できる。
【００１３】
【実施例】
図１は、この発明によるＩＣテスタにおける負荷電流出力回路を中心とするブロック図である。
９２は、負荷電流出力回路４１０が接続された入出力端子（Ｉ／Ｏ端子）であり、ドライバ４２により所定の波形信号が入力された後にＩ／Ｏ切換スイッチ４２ａがＯＦＦにされて入出力切換が行われ、ドライバ部４２がＩ／Ｏ端子９２から切り離される。そして、Ｉ／Ｏ端子９２の出力のタイミングに合わせてその手前でダイオードブリッジからなるダイオードスイッチ回路１に電流が流されてＯＮ状態にされる。このとき、ダイオードスイッチ回路１の入力端子Ａの電圧は、“Ｈ”と“Ｌ”の中間電圧に設定される。その出力端子Ｂは、ＤＵＴ７３に接続されている。なお、負荷電流出力回路４１０は、１つのＩＣの中に集積化された回路である。
【００１４】
そこで、ＤＵＴ７３のＩ／Ｏ端子９２の出力が“Ｈ”のときには、ダイオードブリッジの入力端子Ａが出力端子Ｂよりも低くなる。そのため、Ｉ／Ｏ端子９２から流出する電流がダイオードブリッジの導通したダイオードＤ４を通してシンクされる。その電流値（シンク電流値）は、通常、数ｍＡから数十ｍＡの範囲のある値を採る。同様に、Ｉ／Ｏ端子９２の出力が“Ｌ”のときには、ダイオードブリッジの導通したダイオードＤ２を通してＩ／Ｏ端子９２に電流が流出する。その電流値（ソース電流値）も数ｍＡから数１０ｍＡの範囲のある値を採る。ソース電流，シンク電流の値は、ダイオードスイッチ回路１のダイオードブリッジによるアナログスイッチをＯＮ／ＯＦＦ制御する側の端子のうちの上流に位置するソース電流流入端子と下流に位置するシンク電流流出端子の２つの端子にそれぞれ接続された定電流部２１，２２において流れる電流値で決定され、通常、プログラマブルに設定可能である。
なお、ここでのダイオードブリッジは、通常、アナログスイッチとして使用されるダイオードブリッジの入力側から出力側への信号伝達以上の電圧差を入出力端子間に与えてソース電流流入端子の電流を出力端子に流出し、あるいは、出力端子の電流をシンク電流流出端子へとシンクさせる電流切換動作をさせるものである。
【００１５】
定電流部２１は、定電流源２１１とスイッチ回路２１２からなる。定電流源２１１は、Ｉ／Ｏ端子９２へソース電流を流す電流源であり、電源電圧ラインＶccに接続されている。定電流部２２は、定電流源２２１とスイッチ回路２２２からなる。定電流源２２１は、Ｉ／Ｏ端子９２からのシンク電流を受ける電流源であり、グランドＧＮＤより低い負電源の電圧ラインＶEEに接続されている。ここで、Ｉ1は、定電流源２１１の電流値であり、Ｉ2は、定電流源２２１の電流値である。
ＤＵＴ７３の出力信号が“Ｌ”から“Ｈ”へと変化するときには、負荷電流出力回路４１は、出力信号“Ｌ”，“Ｈ”に応じて、図２に示すように、Ｉ1からＩ2に変化するような電流出力になる。逆の場合には、Ｉ2からＩ1に変化するような電流出力になる。なお、図中、ＶTは、設定電圧入力端子９１に設定される電圧である。
【００１６】
Ｉ／Ｏ端子９２にこのような負荷電流が加えられた状態において、出力波形の判定がコンパレータ部４３１と４３２でそれぞれ行われる。コンパレータ部４３１は、“Ｈ”側の判定を行うものであって、“Ｈ”に対応するハイレベルの基準電圧信号ＶＨが比較基準側の端子に加えられている。コンパレータ部４３２は、“Ｌ”側の判定を行うものであり、“Ｌ”に対応するローレベルの基準電圧信号ＶＬが比較基準側の端子に加えられている。なお、各コンパレータに与えられる判定タイミングを決定するストローブ信号は省略してある。
【００１７】
次に、このような負荷電流を発生する負荷電流出力回路４１０の構成について詳細に説明する。
負荷電流出力回路４１は、ショットキー・ダイオードＤ１，Ｄ２，Ｄ３，Ｄ４のブリッジで構成されるダイオードスイッチ回路１と、定電流部２１および２２と、バッファ部３とからなる。この回路は、通常、Ｉ／Ｏ端子９２にＤＵＴ７３を接続して使用される。
バッファ部３は、設定電圧入力端子９１の電圧ＶＴをダイオードスイッチ回路１の入力端子Ａに伝送して設定する回路である。バッファ部３は、バッファアンプ３１と疑似バッファ部３６と差動増幅器３９で構成される。
【００１８】
バッファアンプ３１は、ボルテージフォロア３２とこのボルテージフォロア３２の出力端子とダイオードスイッチ回路１の入力端子Ａとの間に接続されたスイッチ回路３３で構成される。ボルテージフォロア３２は、電圧利得が１倍の電流バッファであり、ダイオードスイッチ回路１の入力端子に設定電圧入力端子９１の電圧信号ＶＴと同じ電圧信号を発生し、これに応じて決定される電流を入力端子Ａへ流出し、あるいは入力端子Ａから電流をシンクさせる。いわゆる、入力端子Ａの電圧をＶＴに維持するためにプッシュプル動作をするバッファアンプである。スイッチ回路３３は、制御端子９５に入力されるインヒビット信号ＩＮＨによりＯＦＦにされ、ボルテージフォロア３２とダイオードスイッチ回路１の電流経路の接続および切断を行う。
【００１９】
さて、Ｉ／Ｏ端子９２の端子電圧、すなわち、ＤＵＴ７３の端子電圧が設定電圧入力端子９１の設定電圧ＶＴより低いときには、言い換えれば、Ｉ／Ｏ端子９２に“Ｌ”の出力信号が発生したときには、ダイオードスイッチ回路１の入力端子Ａが出力端子Ｂよりも高いので、ダイオードＤ１とＤ４がＯＦＦになり、ダイオードＤ２とＤ３がＯＮになる。その結果、定電流部２１から電流値Ｉ１がダイオードＤ２を介してＩ／Ｏ端子９２を経由してＤＵＴ７３へ至る経路でソース電流が流れる。また、バッファ部３（ボルテージフォロア３２）の出力電流がダイオードＤ３を通して定電流部２２へと流れる。
【００２０】
Ｉ／Ｏ端子９２の端子電圧が設定電圧入力端子９１の設定電圧ＶＴより高いとき、言い換えれば、Ｉ／Ｏ端子９２に“Ｈ”の出力信号が発生したときには、ダイオードスイッチ回路１の入力端子Ａが出力端子Ｂよりも低くなるので、ダイオードＤ１とＤ４がＯＮになり、ダイオードＤ２とＤ３とがＯＦＦになる。その結果、ＤＵＴ７３からＩ／Ｏ端子９２を経由して電流値Ｉ２がダイオードＤ４を介して定電流部２２へと流れる。また、定電流部２１の電流Ｉ１は、ダイオードＤ１を通してバッファ部３（ボルテージフォロア３２）へと流れる。
先に説明したように、前者がソース電流であり、後者がシンク電流である。なお、設定電圧入力端子９１の電圧信号ＶＴは、図５のリファレンス電圧発生器５６から送出されて設定される。この電圧信号ＶＴは、例えば、“Ｈ”が３Ｖで“Ｌ”が０Ｖのときには、１．５Ｖである。
【００２１】
ＩＣテスタ７０が判定動作モードにないときには、あるいは、“Ｈ”，“Ｌ”の出力タイミングにないときは、インヒビット信号ＩＮＨが発生する。このインヒビット信号ＩＮＨは、例えば、図５のタイミング発生器５３、波形フォマッタ５１あるいはパターン発生器９５から発生させることができる。なお、このとき、このインヒビット信号ＩＮＨは、“Ｌ”有意の信号とすることができる。
インヒビット信号ＩＮＨ（例えば、ＩＮＨが“Ｌ”になっているとき）は、スイッチ回路２１２およびスイッチ回路２２２をＯＦＦにし、さらに、スイッチ回路３３をＯＦＦにする。これにより負荷電流出力回路４１０は、周囲の回路から切り離されて高抵抗モードに切換えられる。その結果、ＤＵＴ７３のＩ／Ｏ端子９２は、バッファ部３の信号経路から電気的に切り離される。なお、インヒビット信号ＩＮＨを受けていないとき（例えば、ＩＮＨが“Ｈ”になっているとき）には、スイッチ回路２１２，スイッチ回路２２２，スイッチ回路３３がＯＮになり、前記した負荷電流出力回路４１０の動作により所定の負荷電流がＩ／Ｏ端子９２に出力される。
【００２２】
ダイオードスイッチ回路１は、前記したように、４つショットキー・ダイオードＤ１，Ｄ２，Ｄ３，Ｄ４のブリッジで構成され、ソース電流とシンク電流との切換えを行い負荷電流を発生させる。これらをショットキー・ダイオードで構成すると耐圧もあり高速な応答をする切換えスイッチ回路にすることができる。
また、定電流源２１１、２２１は、通常は、プログラマブル定電流源とするが、図ではこの関係を図示していない。これは、例えば、この各定電流源２１１，２２１の電流値を、図５のコンピュータ７１からシステムバス６を介して設定することで調整できる。あるいは図５のパターン発生器５５からデータ設定することによりＤ／Ａ変換回路を介してリアルタイムで電流値を変更することも可能である。なお、このプログラマブル定電流源の構成例としては、電流源に基準抵抗および差動増幅器を設ける方法などがある。
【００２３】
次に、バッファ部３の疑似バッファ部３６について説明する。
疑似バッファ部３６は、バッファアンプ３１とほぼ同一の回路特性を持たせたボルテージフォロアである。これの出力電圧を差動増幅器３９の（−）入力端子にスイッチ回路３８を介して帰還させる。差動増幅器３９は、ここでは、比較増幅器を構成していて（＋）入力端子が設定電圧入力端子９１に接続されている。これにより、差動増幅器３９は（−）入力端子の電圧が（＋）入力端子に一致するまで動作してボルテージフォロアのバッファアンプ３７の出力電圧が設定電圧入力端子９１の電圧値ＶＴに一致するようにバッファアンプ３２及びバッファアンプ３７を制御する。疑似バッファ部３６はバッファアンプ３１とほぼ同一の回路特性を持つので、バッファアンプ３２とバッファアンプ３７の出力電圧は同一であり、従ってダイオードスイッチ回路１の入力端子Ａの電圧が設定電圧入力端子９１の電圧ＶＴになる。
【００２４】
このような疑似バッファ部３６のダミー回路を設ける理由は、バッファアンプ３１とほぼ同一の回路特性を持った疑似バッファ部３６を設けることによって、スイッチ回路３３のＯＮ／ＯＦＦ動作に無関係に、あらかじめ図１中のダイオードブリッジの入力端子Ａに発生させる電圧を疑似バッファ部３６の出力端子であるＣ点の電圧として確保することができる点にある。したがって、疑似バッファ部３６中のスイッチ回路３８を常時接続することで帰還ループが常時動作して差分増幅器３９は正常動作を常時することができる。そこで、判定モードに入る手前あるいはＤＵＴ７３が信号を出力する手前のタイミングにおいて正しい電圧をあらかじめ差動増幅器３９の出力として設定できる。これにより出力信号の高速切換えに対応できる。なお、スイッチ回路３８は、スイッチ回路３３と同一特性を持たせたもので、その目的はバッファアンプ３２の出力端子からＡ点までの信号特性とバッファアンプ３７からＣ点までの信号特性をほぼ同一にすることにある。
【００２５】
また、疑似バッファ部３６を設けることには次のような利点もある。最近では、“Ｈ”のレベルがＤＵＴ（ＩＣ）の低消費電力化にともない３Ｖより低い電圧になる傾向にある。“Ｈ”のレベルが低くなると、図２において、“Ｌ”から“Ｈ”へと切換わる領域が原点Ｏ側に移るので、“Ｌ”レベルでの負荷電流値が不安定になり易い。これを防止する効果がある。
なお、疑似バッファ部３６に同一の回路特性を持たせる方法の一例としては、両回路の素子配置を相似にし、また回路を近接して素子特性をほぼ同一にする方法がある。
【００２６】
さて、図１の負荷電流出力回路４１の特徴としては、ダイオードスイッチ回路１が、スイッチ回路２１２，スイッチ回路２２２、およびスイッチ回路３３により、定電流部２１１および２２１とバッファ部３から電気的に切り離せることにある。これら３つのスイッチ回路を切断した高抵抗モード時にはＩ／Ｏ端子９２へ至る電流経路は全て高抵抗になり、ＩＣ化した状態であっても、ディスクリートでスイッチ回路を構成した場合と同様にＩ／Ｏ端子９２からの漏れ電流が少なくなる。
なお、ダイオードブリッジのスイッチ回路は、通常、アナログスイッチとして上流側を低い電圧に、下流側を高い電圧にすれば、４つのブリッジのダイオードが逆バイアスになってＯＦＦになるが、この場合、バッファ部３とダイオードスイッチ回路１の入力端子とが接続されていると完全な逆バイアスを設定し難い。しかし、前記のようにバッファ部３とダイオードスイッチ回路１の入力端子との間にスイッチ回路３３を設けて、これらの間を切り離した状態で逆バイアスにすると、その分、確実にダイオードブリッジがＯＦＦ状態になり、これの入出力の切り離しが確実にできる。しかし、この場合には、逆バイアスに設定する電力が必要になる関係から、また、そのような回路を集積化しなければならないことから、前記よりも消費電力が多くなる欠点がある。この点、前記のように３つのスイッチ回路を設ける回路では、ダイオードブリッジ部分を他の回路から孤立させることで消費電力の低減とともにリーク電流をいっそう低減できる利点がある。
【００２７】
ところで、負荷電流出力回路４１０は、同一チップ上に形成している。そのためバッファ部３からダイオードスイッチ回路の入力端子Ａまでおよび出力端子Ｂまでのインダクタンス成分が低減される。このインダクタンス成分が大きくなると、インダクタンスに蓄えられたエネルギにより電流変化が阻害され、電流応答速度が遅くなる。図１の負荷電流出力回路４１０は、ダイオードスイッチ回路１と近接して、定電流部２１、定電流部２２、バッファ部３を同一チップに配置し、かつ、出力端子に近いところに配置することにより配線およびボンディングワイヤのインダクタンスを減らし、出力端子Ｂ点までのパスを短くすることができるので、電流応答速度を改善することができる。
【００２８】
さて、前記の回路では、スイッチ回路２１２、２２２がインヒビット信号ＩＮＨによりＯＦＦされたときには定電流源２１１からの電流がダイオードブリッジに流れなくなる。また、定電流源２２１はシンク動作をしなくなる。このスイッチ回路２１２，２２２は、電流経路を切り替えるカレント切換スイッチ回路で構成することができる。これについて次に説明する。
図３は、スイッチ回路２１２およびスイッチ回路２２２をカレント切換スイッチ回路で構成した負荷電流出力回路４１１の他の実施例である。スイッチ回路２１２は、共通エミッタ側に定電流源２１１を有するトランジスタＱ１，Ｑ２からなる電流切換回路で構成され、スイッチ回路２２２は、共通エミッタ側に定電流源２２１を有するトランジスタＱ３，Ｑ４からなる電流切換回路で構成されている。トランジスタＱ１とトランジスタＱ３のコレクタは接地され、トランジスタＱ２とトランジスタＱ４のコレクタの間にダイオードスイッチ回路１が挿入されている。トランジスタＱ２とトランジスタＱ３のベースにはインヒビット信号ＩＮＨが入力され、トランジスタＱ１とトランジスタＱ４のベースには、インヒビット信号ＩＮＨの反転信号がインバータを介して入力されている。これによりインヒビット信号ＩＮＨが“Ｌ”のときにトランジスタＱ２とトランジスタＱ４がＯＮになり、Ｉ／Ｏ端子９２に負荷電流が送出される。
【００２９】
図４は、本発明による負荷電流出力回路の、さらに他の実施例を示すブロック図である。
図４の負荷電流出力回路４１ｂは、図１におけるスイッチ回路３３をＭＯＳトランジスタＱ５およびＱ６からなるトランスファゲートで形成した例である。その他の構成は図１と同様である。
スイッチ回路３３は、ｎＭＯＳトランジスタＱ５およびｐＭＯＳトランジスタＱ６から構成されている。トランジスタＱ５のゲート端子にはインヒビット信号ＩＮＨを、トランジスタＱ６のゲート端子にはインバータを通してインヒビット信号ＩＮＨを反転して入力する。このことで、トランジスタＱ５およびＱ６はインヒビット信号ＩＮＨが“Ｈ”のとき導通し、また“Ｌ”のとき遮断し、スイッチ回路の機能を果たす。この回路は、スイッチ回路をＣＭＯＳで構成したことにより電力消費が少なくて済む。
なお、ダミー回路である疑似バッファ部３６のスイッチ回路３８は、前記スイッチ回路３３と同じトランスファゲートで構成される。
【００３０】
以上説明してきたが、実施例では、ダイオードスイッチ回路のダイオードブリッジに対して上流側の定電流源と下流側の定電流源との間にスイッチ回路を設けてダイオードブリッジ回路を切り離しているが、これは、ダイオードブリッジ回路をＯＦＦ状態にするものであってもよい。なお、ダイオードブリッジのダイオードは高速動作が要求されないときには、トランジスタにより形成されるダイオードであってもよいことはもちろんである。そうでないときには、ＰＮ接合からなる本来のダイオードを形成してＩＣ化することが好ましい。
また、実施例のバッファアンプは、ボルテージフォロアに限定されない。さらに、ダイオードブリッジ回路のダイオードは、ショットキー・ダイオードに限定されるものではない。
【００３１】
【発明の効果】
以上説明してきたが、この発明にあっては、負荷電流出力回路のバッファアンプとダイオードブリッジ間にスイッチ回路を設けて、１つのＩＣとして集積化し、高抵抗モード時に、スイッチ回路をＯＦＦにして、かつ、ダイオードスイッチ回路をＯＦＦ状態に設定することにより、ダイオードスイッチ回路の入力端子と出力端子とを切り離すことができるので、ＩＣ化されていてもリーク電流の低減を図ることができる。
これにより、負荷電流を供給して出力信号の状態を測定するとき以外の高抵抗モード時においては、リーク電流が低減してＤＵＴからみた消費電流を低減することができる。しかも、バッファアンプとともにダイオードスイッチ回路がＩＣ化されているので、これらの間のパスが短くなり、経路上のインダクタ値を少なくできる。
その結果、高速に応答する負荷電流出力回路を実現でき、ＤＵＴの出力信号が高い周波数のものになっても、負荷電流出力回路がそれに追従することができる。
【図面の簡単な説明】
【図１】図１は、この発明によるＩＣテスタにおける負荷電流出力回路を中心とするブロック図である。
【図２】図２は、負荷電流出力回路のＩ／Ｏ端子へ送出する負荷電流の電流−電圧特性の説明図である。
【図３】図３は、カレント切換スイッチを有する負荷電流出力回路の一実施例の回路図である。
【図４】図４は、負荷電流出力回路の他の一実施例の回路図である。
【図５】図５は、負荷電流出力回路を備えたＩＣテスタの全体的な構成の説明図である。
【図６】図６は、従来の負荷電流出力回路の回路図である。
【符号の説明】
１…ダイオードブリッジ、２１…定電流部、
２２…定電流部、３…バッファ部、
３１…バッファアンプ、３２…ボルテージフォロア、
３６…疑似バッファ部、３３，３８…スイッチ回路、
３２，３７…ボルテージフォロア、
３９…差動増幅器、４…ピンエレクトロニクス、
４１０，４１１，４１２…負荷電流出力回路、４２…ドライバ、
４３…コンパレータ、４３１…コンパレータ部、
４３２…コンパレータ部、９１…設定電圧入力端子、
９２…Ｉ／Ｏ端子、ＩＮＨ…インヒビット信号。
【図１】
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【図２】
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【図３】
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【図４】
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【図６】
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【図５】
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