【手続補正書】
【提出日】平成29年6月5日(2017.6.5)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
選択的な電力または性能の最適化を伴うメモリチャネルインターリービング方法であって、
少なくとも第1のメモリデバイスおよび第2のメモリデバイスについてメモリアドレスマップを構成するステップであって、前記第1のメモリデバイスが第1のメモリコントローラおよび第1のメモリチャネルに関連付けられ、前記第2のメモリデバイスが第2のメモリコントローラおよび第2のメモリチャネルに関連付けられ、前記第1のメモリデバイスおよび前記第2のメモリデバイスの各々がインターリーブ領域の一部分と線形領域の一部分とを備え、前記インターリーブ領域が比較的高い性能のユースケースのためのインターリーブされたアドレス空間を備え、前記線形領域が比較的低い電力のユースケースのための線形アドレス空間を備える、ステップと、
メモリチャネルインターリーバにおいて、1つまたは複数のクライアントからメモリ要求を受信するステップであって、前記メモリ要求が電力節約または性能に対する選好を備える、ステップと、
前記メモリチャネルインターリーバによって、電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当て、かつ性能に対する選好を備える前記メモリ要求を前記インターリーブ領域に割り当てるステップであって、電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当てるステップが、前記第1のメモリコントローラに、前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する第1のアドレス範囲に書き込むように命令し、かつ前記第2のメモリコントローラに、前記第2のメモリデバイスを電力節約モードに遷移させるように命令するステップを備える、ステップと
を備える、方法。
【請求項２】
前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する前記第1のアドレス範囲における最終メモリアドレスに達したときに、
前記第1のメモリデバイスを前記電力節約モードに置くステップと、
前記第2のメモリデバイスをアクティブ化するステップと、
電力節約に対する選好を備える次の受信されたメモリ要求を、前記第2のメモリデバイス内の前記線形領域の前記一部分に対応する第2のアドレス範囲に書き込むステップと
をさらに備える、請求項1に記載の方法。
【請求項３】
電力節約または性能に対する前記選好がオペレーティングシステムへのシステムコールを介して指定される、請求項1に記載の方法。
【請求項４】
電力節約または性能に対する前記選好がメモリヒープのタイプを指定するパラメータを備える、請求項1に記載の方法。
【請求項５】
前記メモリデバイスがダイナミックランダムアクセスメモリ(DRAM)デバイスを備える、請求項1に記載の方法。
【請求項６】
前記メモリチャネルインターリーバがシステムオンチップ(SOC)バスを介して前記メモリ要求を受信する、請求項1に記載の方法。
【請求項７】
前記メモリチャネルインターリーバにおいて、メモリ帯域幅の履歴ログを備えるデータベースに対して、性能に対する前記選好を有するメモリ要求を有効にするステップと、
有効にされない場合、前記メモリチャネルインターリーバにおいて、性能に対する前記選好を無効にし、かつ前記有効にされなかったメモリ要求を前記線形領域に割り当てるステップと
をさらに備える、請求項1に記載の方法。
【請求項８】
前記メモリ要求を前記線形領域または前記インターリーブ領域に割り当てるステップが、動的なメモリ割振りまたは所定の静的なメモリ割振りを備える、請求項1に記載の方法。
【請求項９】
前記メモリチャネルインターリーバがアドレスマッピングモジュールを備える、請求項1に記載の方法。
【請求項１０】
前記メモリチャネルインターリーバがデータセレクタをさらに備え、前記データセレクタが前記アドレスマッピングモジュールに結合され、かつ通信する、請求項9に記載の方法。
【請求項１１】
選択的な電力または性能の最適化を伴うメモリチャネルインターリービングを提供するためのシステムであって、
少なくとも第1のメモリデバイスおよび第2のメモリデバイスについてメモリアドレスマップを構成するための手段であって、前記第1のメモリデバイスが第1のメモリコントローラおよび第1のメモリチャネルに関連付けられ、前記第2のメモリデバイスが第2のメモリコントローラおよび第2のメモリチャネルに関連付けられ、前記第1のメモリデバイスおよび前記第2のメモリデバイスの各々がインターリーブ領域の一部分と線形領域の一部分とを備え、前記インターリーブ領域が比較的高い性能のユースケースのためのインターリーブされたアドレス空間を備え、前記線形領域が比較的低い電力のユースケースのための線形アドレス空間を備える、手段と、
1つまたは複数のクライアントからメモリ要求を受信するための手段であって、前記メモリ要求が電力節約または性能に対する選好を備える、手段と、
電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当て、かつ性能に対する選好を備える前記メモリ要求を前記インターリーブ領域に割り当てるための手段であって、前記電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当てるための手段が、前記第1のメモリコントローラに、前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する第1のアドレス範囲に書き込むように命令するための手段と、前記第2のメモリコントローラに、前記第2のメモリデバイスを電力節約モードに遷移させるように命令するための手段とを備える、手段と
を備える、システム。
【請求項１２】
前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する前記第1のアドレス範囲における最終メモリアドレスに達したときに、
前記第1のメモリデバイスを前記電力節約モードに置くための手段と、
前記第2のメモリデバイスをアクティブ化するための手段と、
電力節約に対する選好を備える次の受信されたメモリ要求を、前記第2のメモリデバイス内の前記線形領域の前記一部分に対応する第2のアドレス範囲に書き込むための手段と
をさらに備える、請求項11に記載のシステム。
【請求項１３】
電力節約または性能に対する前記選好がオペレーティングシステムへのシステムコールを介して指定される、請求項11に記載のシステム。
【請求項１４】
電力節約または性能に対する前記選好がメモリヒープのタイプを指定するパラメータを備える、請求項11に記載のシステム。
【請求項１５】
前記メモリデバイスがダイナミックランダムアクセスメモリ(DRAM)デバイスを備える、請求項11に記載のシステム。
【請求項１６】
前記メモリ要求を前記受信するための手段が、システムオンチップ(SOC)バスと通信している、請求項11に記載のシステム。
【請求項１７】
メモリ帯域幅の履歴ログを備えるデータベースに対して、性能に対する前記選好を有するメモリ要求を有効にするための手段と、
有効にされなかったメモリ要求についての性能に対する前記選好を無効にし、かつ前記有効にされなかったメモリ要求を前記線形領域に割り当てるための手段と
をさらに備える、請求項11に記載のシステム。
【請求項１８】
前記メモリ要求を前記線形領域または前記インターリーブ領域に前記割り当てるための手段が、動的なメモリ割振り手段または所定の静的なメモリ割振り手段を備える、請求項12に記載のシステム。
【請求項１９】
前記メモリ要求を前記線形領域に割り当てるための手段が、アドレスマッピングモジュールを有するメモリチャネルインターリーバを備える、請求項11に記載のシステム。
【請求項２０】
前記メモリチャネルインターリーバがデータセレクタをさらに備え、前記データセレクタが前記アドレスマッピングモジュールに結合され、かつ通信する、請求項19に記載のシステム。
【請求項２１】
コンピュータプログラムであって、選択的な電力または性能の最適化を伴うメモリチャネルインターリービングのための方法を実施するために実行されるように適合され、前記方法が、
少なくとも第1のメモリデバイスおよび第2のメモリデバイスについてメモリアドレスマップを構成するステップであって、前記第1のメモリデバイスが第1のメモリコントローラおよび第1のメモリチャネルに関連付けられ、前記第2のメモリデバイスが第2のメモリコントローラおよび第2のメモリチャネルに関連付けられ、前記第1のメモリデバイスおよび前記第2のメモリデバイスの各々がインターリーブ領域の一部分と線形領域の一部分とを備え、前記インターリーブ領域が比較的高い性能のユースケースのためのインターリーブされたアドレス空間を備え、前記線形領域が比較的低い電力のユースケースのための線形アドレス空間を備える、ステップと、
1つまたは複数のクライアントからメモリ要求を受信するステップであって、前記メモリ要求が電力節約または性能に対する選好を備える、ステップと、
電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当て、かつ性能に対する選好を備える前記メモリ要求を前記インターリーブ領域に割り当てるステップであって、電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当てるステップが、前記第1のメモリコントローラに、前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する第1のアドレス範囲に書き込むように命令し、かつ前記第2のメモリコントローラに、前記第2のメモリデバイスを電力節約モードに遷移させるように命令するステップを備える、ステップと
を備える、コンピュータプログラム。
【請求項２２】
前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する前記第1のアドレス範囲における最終メモリアドレスに達したときに、前記方法が、
前記第1のメモリデバイスを前記電力節約モードに置くステップと、
前記第2のメモリデバイスをアクティブ化するステップと、
電力節約に対する選好を備える次の受信されたメモリ要求を、前記第2のメモリデバイス内の前記線形領域の前記一部分に対応する第2のアドレス範囲に書き込むステップと
をさらに備える、請求項21に記載のコンピュータプログラム。
【請求項２３】
電力節約または性能に対する前記選好がオペレーティングシステムへのシステムコールを介して指定される、請求項21に記載のコンピュータプログラム。
【請求項２４】
電力節約または性能に対する前記選好がメモリヒープのタイプを指定するパラメータを備える、請求項21に記載のコンピュータプログラム。
【請求項２５】
前記メモリデバイスがダイナミックランダムアクセスメモリ(DRAM)デバイスを備える、請求項21に記載のコンピュータプログラム。
【請求項２６】
チャネルインターリーバがシステムオンチップ(SOC)バスを介して前記メモリ要求を受信する、請求項21に記載のコンピュータプログラム。
【請求項２７】
前記方法が、
メモリ帯域幅の履歴ログを備えるデータベースに対して、性能に対する前記選好を有するメモリ要求を有効にするステップと、
有効にされない場合、性能に対する前記選好を無効にし、かつ前記有効にされなかったメモリ要求を前記線形領域に割り当てるステップと
をさらに備える、請求項21に記載のコンピュータプログラム。
【請求項２８】
前記メモリ要求を前記線形領域または前記インターリーブ領域に割り当てるステップが、動的なメモリ割振りまたは所定の静的なメモリ割振りを備える、請求項21に記載のコンピュータプログラム。
【請求項２９】
前記メモリ要求を割り当てるステップが、メモリチャネルインターリーバによって実施される、請求項21に記載のコンピュータプログラム。
【請求項３０】
前記メモリチャネルインターリーバがアドレスマッピングモジュールとデータセレクタとを備え、前記データセレクタが前記アドレスマッピングモジュールに結合され、かつ通信する、請求項29に記載のコンピュータプログラム。
【請求項３１】
選択的な電力または性能の最適化を伴うメモリチャネルインターリービングを提供するためのシステムであって、
システムオンチップ(SoC)に接続される少なくとも第1のメモリデバイスおよび第2のメモリデバイスにアクセスするためのメモリ要求を生成するための1つまたは複数の処理ユニットを備えるSOCであって、前記第1のメモリデバイスが第1のメモリコントローラおよび第1のメモリチャネルに関連付けられ、前記第2のメモリデバイスが第2のメモリコントローラおよび第2のメモリチャネルに関連付けられ、
前記第1のメモリデバイスおよび前記第2のメモリデバイスの各々が、メモリアドレスマップによって定義されたインターリーブ領域の一部分と線形領域の一部分とを備え、前記インターリーブ領域が比較的高い性能のユースケースのためのインターリーブされたアドレス空間を備え、前記線形領域が比較的低い電力のユースケースのための線形アドレス空間を備える、システムオンチップ(SOC)と、
前記SoC上にあるメモリチャネルインターリーバであって、
前記1つまたは複数の処理ユニットからのメモリ要求を受信することであって、前記メモリ要求が電力節約または性能に対する選好を備える、受信することと、
電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当て、かつ性能に対する選好を備える前記メモリ要求を前記インターリーブ領域に割り当てることであって、電力節約に対する選好を備える前記メモリ要求を前記線形領域に割り当てることが、前記第1のメモリコントローラに、前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する第1のアドレス範囲に書き込むように命令し、かつ前記第2のメモリコントローラに、前記第2のメモリデバイスを電力節約モードに遷移させるように命令することを備える、割り当てることと
を行うように構成されるメモリチャネルインターリーバと
を備える、システム。
【請求項３２】
前記第1のメモリデバイス内の前記線形領域の前記一部分に対応する前記第1のアドレス範囲における最終メモリアドレスに達したときに、
前記第1のメモリデバイスが前記電力節約モードに置かれ、
前記第2のメモリデバイスがアクティブ化され、
電力節約に対する選好を備える次の受信されたメモリ要求が、前記第2のメモリデバイス内の前記線形領域の前記一部分に対応する第2のアドレス範囲に書き込まれる、
請求項31に記載のシステム。
【請求項３３】
電力節約または性能に対する前記選好がオペレーティングシステムへのシステムコールを介して指定される、請求項31に記載のシステム。
【請求項３４】
電力節約または性能に対する前記選好がメモリヒープのタイプを指定するパラメータを備える、請求項31に記載のシステム。
【請求項３５】
前記メモリデバイスがダイナミックランダムアクセスメモリ(DRAM)デバイスを備える、請求項31に記載のシステム。
【請求項３６】
前記SOCがポータブル通信デバイス上にある、請求項31に記載のシステム。
【請求項３７】
前記メモリチャネルインターリーバが、
メモリ帯域幅の履歴ログを備えるデータベースに対して、性能に対する前記選好を有するメモリ要求を有効にし、
有効にされない場合、性能に対する前記選好を無効にし、かつ前記有効にされなかったメモリ要求を前記線形領域に割り当てる
ようにさらに構成される、請求項31に記載のシステム。
【請求項３８】
前記メモリチャネルインターリーバが、動的なメモリ割振りまたは所定の静的なメモリ割振りを使用して、前記メモリ要求を前記線形領域または前記インターリーブ領域に割り当てるようにさらに構成される、請求項31に記載のシステム。
【請求項３９】
前記メモリチャネルインターリーバがアドレスマッピングモジュールを備える、請求項31に記載のシステム。
【請求項４０】
前記メモリチャネルインターリーバがデータセレクタをさらに備え、前記データセレクタが前記アドレスマッピングモジュールに結合され、かつ通信する、請求項39に記載のシステム。