【手続補正書】
【提出日】平成29年4月26日(2017.4.26)
【手続補正１】
【補正対象書類名】特許請求の範囲
【補正対象項目名】全文
【補正方法】変更
【補正の内容】
【特許請求の範囲】
【請求項１】
バッテリ充電器のための回路であって、
制御入力と、クロック入力と、誘導エレメントに接続するように構成されるスイッチング出力とを有するスイッチング回路と、
バッテリ端子に接続されたバッテリを充電するように電力を提供するために前記バッテリ端子に前記誘導エレメントを電気的に接続するように構成される充電端子と、
制御端子と、
クロック端子と、
前記スイッチング回路の前記制御入力および前記制御端子に内部で生成された制御信号を供給する第１の構成で動作することと、前記スイッチング回路の前記制御入力に前記制御端子上で受信された外部で生成された制御信号を供給する第２の構成で動作することとを行うように構成される制御セレクタと、
前記スイッチング回路の前記クロック入力および前記クロック端子に内部で生成されたクロック信号を供給する第１の構成で動作することと、前記スイッチング回路の前記クロック入力に前記クロック端子上で受信された外部で生成されたクロック信号を供給する第２の構成で動作することとを行うように構成されたクロックセレクタと
を備える、回路。
【請求項２】
前記スイッチング回路の前記スイッチング出力に接続された第１のＦＥＴと第２のＦＥＴとをさらに備え、前記第１のＦＥＴは、前記第２のＦＥＴに接続され、前記第１のＦＥＴと前記第２のＦＥＴとは、前記制御入力上で受信した制御信号と前記クロック入力上で受信したクロック信号とにしたがう前記スイッチング回路によってＯＮとＯＦＦが切り替えられる、
請求項１に記載の回路。
【請求項３】
前記クロック入力に前記クロック端子上で受信した外部で生成されたクロック信号を供給するために、前記クロック入力と前記クロック端子との間の前記クロックセレクタによって選択的に接続されることができる遅延エレメントをさらに備える、
請求項１に記載の回路。
【請求項４】
前記遅延エレメントは、前記外部で生成されたクロック信号の選択可能な位相シフトを提供するように構成される、
請求項３に記載の回路。
【請求項５】
前記内部で生成されたクロック信号を生成するクロック信号生成器と、遅延エレメントと
をさらに備え、
前記クロックセレクタは、前記第１の構成で動作するとき、前記スイッチング回路の前記クロック入力および前記クロック端子に前記クロック信号生成器を接続し、
前記クロックセレクタは、前記第２の構成で動作するとき、前記クロック入力に前記クロック端子上で受信した外部で生成されたクロック信号を供給するために、前記クロック端子と前記クロック入力との間に前記遅延エレメントを接続する、
請求項１に記載の回路。
【請求項６】
前記遅延エレメントは、前記外部で生成されたクロック信号の位相シフトを生成するように構成される、
請求項５に記載の回路。
【請求項７】
前記内部で生成された制御信号を生成する制御信号生成器をさらに備え、
前記制御セレクタは、前記第１の構成で動作するとき、前記スイッチング回路の前記制御入力および前記制御端子に、前記制御信号生成器を接続し、
前記制御セレクタは、前記第２の構成で動作するとき、前記制御入力に前記制御端子上で受信した外部で生成された制御信号を提供するために前記制御入力に前記制御端子を接続する、
請求項１に記載の回路。
【請求項８】
外部選択インジケータに接続するように構成されるセレクタ入力をさらに備え、前記制御セレクタと前記クロックセレクタは、前記選択インジケータに依存する前記第１または第２の構成において動作する、
請求項１に記載の回路。
【請求項９】
前記遅延エレメントは、前記選択インジケータに依存する前記外部で生成されたクロック信号の位相シフトを生成するように構成される、
請求項８に記載の回路。
【請求項１０】
前記外部選択インジケータは、デジタル信号である、
請求項８に記載の回路。
【請求項１１】
前記外部選択インジケータは、アナログ信号である、
請求項８に記載の回路。
【請求項１２】
前記外部選択インジケータは、１つまたは複数の抵抗エレメントを備える、
請求項８に記載の回路。
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００５３
【補正方法】変更
【補正の内容】
【００５３】
[0063]特許請求の範囲は以下の通りである。
以下に、本願出願の当初の特許請求の範囲に記載された発明を付記する。
［Ｃ１］
バッテリ充電器のための回路であって、
制御入力と、クロック入力と、誘導エレメントに接続するように構成されるスイッチング出力とを有するスイッチング回路と、
バッテリ端子に接続されたバッテリを充電するように電力を提供するために前記バッテリ端子に前記誘導エレメントを電気的に接続するように構成される充電端子と、
制御端子と、
クロック端子と、
前記スイッチング回路の前記制御入力および前記制御端子に内部で生成された制御信号を供給する第１の構成で動作することと、前記スイッチング回路の前記制御入力に前記制御端子上で受信された外部で生成された制御信号を供給する第２の構成で動作することとを行うように構成される制御セレクタと、
前記スイッチング回路の前記クロック入力および前記クロック端子に内部で生成されたクロック信号を供給する第１の構成で動作することと、前記スイッチング回路の前記クロック入力に前記クロック端子上で受信された外部で生成されたクロック信号を供給する第２の構成で動作することとを行うように構成されたクロックセレクタと
を備える、回路。
［Ｃ２］
前記スイッチング回路の前記スイッチング出力に接続された第１のＦＥＴと第２のＦＥＴとをさらに備え、前記第１のＦＥＴは、前記第２のＦＥＴに接続され、前記第１のＦＥＴと前記第２のＦＥＴとは、前記制御入力上で受信した制御信号と前記クロック入力上で受信したクロック信号とにしたがう前記スイッチング回路によってＯＮとＯＦＦが切り替えられる、
［Ｃ１］に記載の回路。
［Ｃ３］
前記クロック入力に前記クロック端子上で受信した外部で生成されたクロック信号を供給するために、前記クロック入力と前記クロック端子との間の前記クロックセレクタによって選択的に接続されることができる遅延エレメントをさらに備える、
［Ｃ１］に記載の回路。
［Ｃ４］
前記遅延エレメントは、前記外部で生成されたクロック信号の選択可能な位相シフトを提供するように構成される、
［Ｃ３］に記載の回路。
［Ｃ５］
前記内部で生成されたクロック信号を生成するクロック信号生成器と、遅延エレメントと
をさらに備え、
前記クロックセレクタは、前記第１の構成で動作するとき、前記スイッチング回路の前記クロック入力および前記クロック端子に前記クロック信号生成器を接続し、
前記クロックセレクタは、前記第２の構成で動作するとき、前記クロック入力に前記クロック端子上で受信した外部で生成されたクロック信号を供給するために、前記クロック端子と前記クロック入力との間に前記遅延エレメントを接続する、
［Ｃ１］に記載の回路。
［Ｃ６］
前記遅延エレメントは、前記外部で生成されたクロック信号の位相シフトを生成するように構成される、
［Ｃ５］に記載の回路。
［Ｃ７］
前記内部で生成された制御信号を生成する制御信号生成器をさらに備え、
前記制御セレクタは、前記第１の構成で動作するとき、前記スイッチング回路の前記制御入力および前記制御端子に、前記制御信号生成器を接続し、
前記制御セレクタは、前記第２の構成で動作するとき、前記制御入力に前記制御端子上で受信した外部で生成された制御信号を提供するために前記制御入力に前記制御端子を接続する、
［Ｃ１］に記載の回路。
［Ｃ８］
外部選択インジケータに接続するように構成されるセレクタ入力をさらに備え、前記制御セレクタと前記クロックセレクタは、前記選択インジケータに依存する前記第１または第２の構成において動作する、
［Ｃ１］に記載の回路。
［Ｃ９］
前記遅延エレメントは、前記選択インジケータに依存する前記外部で生成されたクロック信号の位相シフトを生成するように構成される、
［Ｃ８］に記載の回路。
［Ｃ１０］
前記外部選択インジケータは、デジタル信号である、
［Ｃ８］に記載の回路。
［Ｃ１１］
前記外部選択インジケータは、アナログ信号である、
［Ｃ８］に記載の回路。
［Ｃ１２］
前記外部選択インジケータは、１つまたは複数の抵抗エレメントを備える、
［Ｃ８］に記載の回路。
［Ｃ１３］
制御端子と、
クロック端子と、
ハイサイドＦＥＴおよびローサイドＦＥＴと、
前記ハイサイドＦＥＴおよび前記ローサイドＦＥＴを駆動するためのＰＷＭドライバと、
複数の制御ループを備えるフィードバック回路、前記フィードバック回路は、制御信号を生成する、と、
クロック生成器と遅延エレメントとを備えるクロックモジュール、前記クロックモジュールは、前記ＰＷＭドライバに提供されるクロック信号を生成する、と、
第１の構成または第２の構成における前記充電回路を構成する選択モジュールと
を備え、前記第１の構成において、前記制御信号は、前記ＰＷＭドライバに、そして前記制御端子に供給され、前記クロック信号は、前記クロック生成器から生成され、
前記第２の構成において、前記制御端子上で受信した外部で生成された制御信号は、前記ＰＷＭドライバに供給され、前記クロック端子上で受信した外部で生成されたクロック信号は、前記遅延エレメントに供給され、前記クロック信号は、前記遅延エレメントの出力である、
充電回路。
［Ｃ１４］
前記遅延エレメントは、選択可能な位相シフトを提供する、
［Ｃ１３］に記載の充電回路。
［Ｃ１５］
前記第１の構成において、前記クロック信号は、前記遅延エレメントから生成されず、前記第２の構成において、前記クロック信号は、前記クロック生成器から生成されない、
［Ｃ１３］に記載の充電回路。
［Ｃ１６］
前記第１の構成において、前記フィードバック回路によって生成され、前記制御端子上で供給される前記制御信号は、外部で生成された制御信号としての役割を果たす、
［Ｃ１３］に記載の充電回路。
［Ｃ１７］
前記第１の構成において、前記クロックモジュールによって生成され、前記クロック端子上で供給される前記クロック信号は、外部で生成されたクロック信号としての役割を果たす、
［Ｃ１３］に記載の充電回路。
［Ｃ１８］
ハイサイドＦＥＴとローサイドＦＥＴとを駆動するためのＰＷＭドライバと、
遅延エレメントと、
第１の入力ピン上で受信した外部で供給される制御信号を前記ＰＷＭドライバに提供する、前記ＰＷＭドライバに接続された前記第１の入力ピンと、
第２の入力ピン上で受信した外部で供給されるクロック信号を前記遅延エレメントに提供するために、前記遅延エレメントに接続された前記第２の入力ピンと
を備え、前記遅延エレメントは、前記ＰＷＭドライバに提供される遅延クロック信号を供給するために前記クロック信号を遅延する、
充電回路。
［Ｃ１９］
前記ＰＷＭドライバへの前記制御信号は、前記外部で供給された制御信号によってのみ供給される、
［Ｃ１８］に記載の充電回路。
［Ｃ２０］
前記ＰＥＭドライバへの前記クロック信号は、前記外部で供給されたクロック信号からのみ生じる、
［Ｃ１８］に記載の充電回路。