(57)【特許請求の範囲】
【請求項１】
ＬＤＤ構造を有するＭＯＳトランジスタにおいて、
半導体基板のチャンネル領域上にゲート絶縁膜を介してゲートを形成し、該ゲートエッジ部のゲート絶縁膜両端部にゲート絶縁膜よりも厚い絶縁膜を形成し、該厚い絶縁膜は２〜３ｎｍの厚さに形成することにより、前記チャンネル領域側にＬＤＤ領域を越えない範囲で形成されることを特徴とするＭＯＳトランジスタ。
【請求項２】
前記厚い絶縁膜は、前記ゲート絶縁膜と類似な性質を有することを特徴とする請求項１記載のＭＯＳトランジスタ。
【請求項３】
ＬＤＤ構造を有するＭＯＳトランジスタにおいて、
半導体基板のチャンネル領域上にゲート絶縁膜を介してゲートを形成し、該ゲートエッジ部のゲート絶縁膜両端部にゲート絶縁膜よりも厚い絶縁膜を形成し、該厚い絶縁膜は２〜３ｎｍの厚さに形成することにより、ＬＤＤ領域が終わる地点からチャンネル領域側に１０ｎｍ以内に位置することを特徴とするＭＯＳトランジスタ。
【請求項４】
前記厚い絶縁膜は、前記ゲート絶縁膜と類似な性質を有することを特徴とする請求項３記載のＭＯＳトランジスタ。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明はＭＯＳトランジスタに係り、特にゲート領域構造に関するものである。
【０００２】
【従来の技術】
既存のＭＯＳトランジスタにおいては、ドレインエッジでの高電界によるホットキャリヤ効果に起因する信頼性低下を改善するために、一般にＬＤＤ領域を形成した。しかし、素子の高速特性を追求してＬＤＤ領域のドーピング濃度が増加することに伴い、ゲートエッジで再度電界が増加した。そこで、ゲートエッジ付近を部分的に酸化（ＧＰＯＸ：ｇａｔｅ  ｐｏｌｙ  ｏｘｉｄａｔｉｏｎ  ）させて、ゲートエッジ部のゲート絶縁膜両端部のゲート絶縁膜を厚くすることにより、この部分の電界を最小化させてホットキャリヤ効果を抑制させることが行われており、これをＧＰＯＸ構造と呼ぶ。
【０００３】
図３は、ＧＰＯＸ構造を採用した従来のＭＯＳトランジスタを示す。この図において、１はｐ型シリコン基板であり、このシリコン基板１のチャンネル領域上にゲート絶縁膜２を介してポリシリコンゲート３が形成される。このポリシリコンゲート３エッジのゲート絶縁膜２両端部およびその外側の基板１表面部には厚い絶縁膜４が形成される。この絶縁膜４の下において、シリコン基板１内には、ソースおよびドレインを構成するｎ−  領域５とｎ＋  領域６が形成される。ポリシリコンゲート３の側面には側壁７が形成される。
【０００４】
このようなＭＯＳトランジスタは、次のような工程により製造される。まず、ｐ型シリコン基板１上にゲート絶縁膜２を形成した後、ポリシリコンをその上に堆積し、所定のゲートパターンマスク（図示せず）を用いて前記ポリシリコン層をパターニングしてポリシリコンゲート３を形成する。次いで、ゲートポリ酸化工程を施して７〜１７ｎｍほどの厚い酸化膜４を形成する。次いで、ＬＤＤイオン注入工程を実施してｎ−  領域５を形成した後、ポリシリコンゲート３の側面に側壁７を形成し、しかる後、再びイオン注入工程を施してｎ＋  領域６を形成することによりＬＤＤ構造のソースおよびドレインを完成させる。
【０００５】
【発明が解決しようとする課題】
上記のような従来の構造および方法において、厚い絶縁膜４は、ゲート絶縁膜２よりも相当に厚く形成されるため、この絶縁膜４を形成するためのＧＰＯＸ工程は、長時間の熱酸化工程となる。しかるに、熱酸化工程時間が長くなると、酸化時の酸化源のＨ２  ／Ｏ２  がポリシリコンゲートとゲート絶縁膜の界面、およびゲート絶縁膜とシリコン基板の界面に沿ってポリシリコンゲート３のエッジからポリシリコンゲート３の中央部側に拡散するため、図３に示すように、厚い絶縁膜４にバーズビークＢＢが発生し、厚い絶縁膜４がポリシリコンゲート３のエッジから内側に深く入り込むようになる。この従来例のように厚い絶縁膜４を７〜１７ｎｍ厚に形成した場合、厚い絶縁膜４は、ポリシリコンゲート３のエッジから５０ｎｍも深く入り込み、ｎ−  領域５（ＬＤＤ領域）を越えてその内側のチャンネル領域まで入り込む。したがって、従来のＭＯＳトランジスタでは、ＧＰＯＸ構造によりホットキャリヤ効果は改善されるが、厚い絶縁膜４がポリシリコンゲート３の内側に深く形成される結果、動作速度を代弁するドレイン飽和電流（Ｉｄｓａｔ）  特性が劣化し、高速回路を実現する上で障害が発生する問題点があった。
【０００６】
本発明は上記の点に鑑みなされたもので、ホットキャリヤ効果を防止しながら、ドレイン飽和電流特性も良好となるＭＯＳトランジスタを提供することを目的とする。
【０００７】
【課題を解決するための手段】
本発明は上述の課題を解決するために、ＬＤＤ構造を有するＭＯＳトランジスタにおいて、半導体基板のチャンネル領域上にゲート絶縁膜を介してゲートを形成し、該ゲートエッジ部のゲート絶縁膜両端部にゲート絶縁膜よりも厚い絶縁膜を形成し、該厚い絶縁膜は前記チャンネル領域側にＬＤＤ領域を越えない範囲で形成されることを特徴とするＭＯＳトランジスタとする。
【０００８】
また、本発明は、ＬＤＤ構造を有するＭＯＳトランジスタにおいて、半導体基板のチャンネル領域上にゲート絶縁膜を介してゲートを形成し、該ゲートエッジ部のゲート絶縁膜両端部にゲート絶縁膜よりも厚い絶縁膜を形成し、該厚い絶縁膜は、ＬＤＤ領域が終わる地点からチャンネル領域側に１０ｎｍ以内に位置することを特徴とするＭＯＳトランジスタとする。
【０００９】
【発明の実施の形態】
次に添付図面を参照して本発明のＭＯＳトランジスタの実施の形態を詳細に説明する。図１は本発明の第１の実施の形態を示す断面図である。この図において、１１はｐ型シリコン基板であり、このシリコン基板１１のチャンネル領域上にゲート絶縁膜１２を介してポリシリコンゲート１３が形成される。このポリシリコンゲート１３エッジのゲート絶縁膜１２両端部およびその外側の基板１１表面部には厚い絶縁膜１４が形成される。この絶縁膜１４は、ゲート絶縁膜１２と類似の性質の絶縁膜であり、例えばシリコン酸化膜である。前記ポリシリコンゲート１３のエッジ部分の下においてシリコン基板１１の表面部内には、ＬＤＤ領域であるｎ−  領域１５が形成される。さらに、このｎ−  領域１５に接続して、その外側の基板１１表面部内にはｎ＋  領域１６が形成される。このｎ−  領域１５とｎ＋  領域１６とによりソースおよびドレイン領域が形成される。ポリシリコンゲート１３の側面には側壁１７が形成される。
【００１０】
以上のような構造において、厚い絶縁膜１４は、ポリシリコンゲート１３のエッジからポリシリコンゲート１３の中央部（内側）に入り込んで形成されるが、図１の第１の実施の形態では、厚い絶縁膜１４は、ＬＤＤ領域であるｎ−  領域１５を越えない範囲で形成される。例えばポリシリコンゲート１３のエッジからｎ−  領域１５の縁までを２５ｎｍとすると、厚い絶縁膜１４は、ポリシリコンゲート１３のエッジからチャンネル方向に２０ｎｍ未満の位置まで形成される。すなわち、厚い絶縁膜１４は、ｎ−  領域１５の内側のチャンネル領域には形成されないようにする。その結果、図１の第１の実施の形態では、ホットキャリヤ効果を防止できる上に、チャンネル領域でのゲート絶縁膜１２の厚さを元来の厚さのままとすることによりドレイン飽和電流特性を向上させることができ、高速回路を実現できる。なお、厚い絶縁膜１４を２〜３ｎｍの厚さに形成することにより、上記のような入り込み状態で厚い絶縁膜１４を形成できる。
【００１１】
図２は本発明の第２の実施の形態を示す。この第２の実施の形態において、図１と同一部分は図１と同一符号を付してその説明を省略する。この第２の実施の形態では、ポリシリコンゲート１３のエッジからポリシリコンゲート１３の中央部方向へのｎ−  領域１５の入り込みが少ないため、厚い絶縁膜１４がｎ−  領域１５を越えてチャンネル領域側まで入り込んでいるが、このように入り込んでも、ｎ−  領域１５が終わった地点からチャンネル領域側に１０ｎｍ以内に入り込み部が留まるように厚い絶縁膜１４が形成される。したがって、この第２の実施の形態においても、ホットキャリヤ効果を防止でき、かつ、ドレイン飽和電流特性を向上させることができる。
【００１２】
シミュレーションで、厚い絶縁膜１４の厚さを２〜３ｎｍにして、図１および図２の厚い絶縁膜１４の形成状態でＭＯＳトランジスタを製造したところ、厚い絶縁膜の厚さを７〜１７ｎｍにして図３の状態で厚い絶縁膜を形成した従来のＭＯＳトランジスタに比較して、ドレイン飽和電流が約１５％以上向上することを確認した。従来の構造ではＮ−ＭＯＳＦＥＴで  Ｉｄｓａｔ＝５８０μＡ／μｍ  であり、本発明の構造ではＩｄｓａｔ＝６５０μＡ／μｍ  の結果が得られた。また、実際製造した場合は、従来の構造がＮ−ＭＯＳＦＥＴで  Ｉｄｓａｔ＝６００μＡ／μｍ  、本発明の構造がＩｄｓａｔ＝７１０μＡ／μｍ  であり、実際製造時は前記のシミュレーションの結果よりも一層良好な結果を本発明は得た。このような本発明での性能向上はポリシリコンゲートの大きさが８０％スケールダウンされる効果と同様な効果を生み出すものであって、本発明の構造によればスケールダウンに伴う特性劣化を防止し得る。
【００１３】
また、本発明によるＭＯＳトランジスタ特性の改善効果はショ−トチャンネル構造になればなるほど一層大きくなる。これはゲート長さが１／２サブミクロンになるに従い、ゲート長さに対する絶縁膜のバーズビーク長さが占める比重が大きくなり、バーズビークがＭＯＳトランジスタ特性に与える影響が大きくなるためである。ゲート長さが短くなればなるほどバーズビーク長さに伴うドレイン飽和電流の変化は一層大きくなる。したがって、本発明の構造は、ゲート長さが１／２サブミクロンの素子になるに従い一層重要な要素として作用する。
【００１４】
なお、本発明は、上述の実施の形態に限定されるものではなく、本発明の技術的思想を外れない限り多様な置換、変形および変更が可能であることは本発明の属する技術分野で通常の知識を有する者においては明白である。
【００１５】
【発明の効果】
以上詳述したように本発明のＭＯＳトランジスタによれば、ホットキャリヤ効果を防止しながら、ドレイン飽和電流特性も良好となり、高速回路を実現できる。
【図面の簡単な説明】
【図１】本発明のＭＯＳトランジスタの第１の実施の形態を示す断面図。
【図２】本発明のＭＯＳトランジスタの第２の実施の形態を示す断面図。
【図３】従来のＭＯＳトランジスタを示す断面図。
【符号の説明】
１１  ｐ型シリコン基板
１２  ゲート絶縁膜
１３  ポリシリコンゲート
１４  絶縁膜
１５  ｎ−  領域
１６  ｎ＋  領域
【図１】
0003602963.tif 000002
【図２】
0003602963.tif 000003
【図３】
0003602963.tif 000004