(57)【要約】【課題】画素用ホールの径大化を抑制することが可能な液晶表示装置及びその製造方法を提供する。【解決手段】本発明の液晶表示装置の製造方法では、ゲート絶縁膜３にゲート配線５２の一部を露出させる第１の端子用ホール３ｂを形成し、下層絶縁膜４及び上層絶縁膜８に、ドレイン電極５７の一部を露出させる画素用ホール８ａと、平面視において第１の端子用ホール３ｂと重複し、ゲート配線５２の一部を露出させる第２の端子用ホール８ｂと、を形成し、画素用ホール８ａを通じてドレイン電極５７に接続される画素電極９と、第２の端子用ホール８ｂを通じてゲート配線５２に接続される端子９２と、を形成する。【選択図】図１
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【特許請求の範囲】
【請求項１】
透明基板上にゲート電極及びゲート配線を形成し、
前記ゲート電極及び前記ゲート配線を覆うゲート絶縁膜を形成し、
前記ゲート絶縁膜に前記ゲート配線の一部を露出させる第１の端子用ホールを形成し、
前記ゲート絶縁膜上に半導体層、ソース電極及びドレイン電極を形成し、
前記半導体層、前記ソース電極、前記ドレイン電極及び前記ゲート配線を覆う保護絶縁膜を形成し、
前記保護絶縁膜に、前記ソース電極又は前記ドレイン電極の一部を露出させる画素用ホールと、平面視において前記第１の端子用ホールと重複し、前記ゲート配線の一部を露出させる第２の端子用ホールと、を形成し、
前記画素用ホールを通じて前記ソース電極又は前記ドレイン電極に接続される画素電極と、前記第２の端子用ホールを通じて前記ゲート配線に接続される端子と、を形成する、
ことを特徴とする液晶表示装置の製造方法。
【請求項２】
前記第２の端子用ホールは、前記第１の端子用ホールよりも小さく、前記第１の端子用ホールの内側に形成される、
請求項１に記載の液晶表示装置の製造方法。
【請求項３】
前記保護絶縁膜は下層絶縁膜と上層絶縁膜とを含み、前記下層絶縁膜と前記上層絶縁膜との間に共通電極が形成される、
請求項１に記載の液晶表示装置の製造方法。
【請求項４】
前記ゲート絶縁膜は前記保護絶縁膜よりも硬い、
請求項２に記載の液晶表示装置の製造方法。
【請求項５】
透明基板と、
前記透明基板上に配置されるゲート電極及びゲート配線と、
前記ゲート電極及び前記ゲート配線を覆うゲート絶縁膜と、
前記ゲート絶縁膜上に配置される半導体層、ソース電極及びドレイン電極と、
前記半導体層、前記ソース電極及び前記ドレイン電極を覆う保護絶縁膜と、
前記保護絶縁膜に形成された画素用ホールを通じて前記ソース電極又は前記ドレイン電極に接続される画素電極と、
前記保護絶縁膜に形成された端子用ホールを通じて前記ゲート配線に接続される端子と、
を備え
前記ゲート配線のうち前記端子と接続される部分では、前記保護絶縁膜が前記ゲート配線と直接接している、
ことを特徴とする液晶表示装置。
【請求項６】
前記端子は、前記ゲート絶縁膜と接触しない、
請求項５に記載の液晶表示装置。
【請求項７】
前記保護絶縁膜は下層絶縁膜と上層絶縁膜とを含み、前記下層絶縁膜と前記上層絶縁膜との間に共通電極が形成される、
請求項５に記載の液晶表示装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、液晶表示装置及びその製造方法に関し、特には絶縁膜におけるホールの形成に関する。
【背景技術】
【０００２】
特許文献１に開示された液晶表示装置は、薄膜トランジスタＴｒを覆う絶縁膜１３と、絶縁膜１３上に配置される共通電極１５と、共通電極１５を覆う絶縁膜１７と、絶縁膜１７上に配置される画素電極１９と、を備えている。これら２層の絶縁膜１３，１７には、薄膜トランジスタＴｒのソース／ドレイン電極１１ｓｄの一部を露出させる画素用ホール１７ａが形成されており、画素電極１９は、画素用ホール１７ａを通じてソース／ドレイン電極１１ｓｄに接続されている。
【先行技術文献】
【特許文献】
【０００３】
【特許文献１】特開２００９−０４７８１７号公報
【発明の概要】
【発明が解決しようとする課題】
【０００４】
ところで、上記のような液晶表示装置の周縁領域には、ゲート配線（走査線）の一部を露出させる端子用ホールが形成され、この端子用ホールを通じて端子がゲート配線に接続される。この端子用ホールは、画素用ホールが形成される２層の絶縁膜とその下のゲート絶縁膜とを含む合計３層の絶縁膜を貫通するように形成される。
【０００５】
しかしながら、端子用ホールと画素用ホールをエッチングにより同時に形成する場合、３層の絶縁膜を貫通する端子用ホールの形成が完了するまで、２層の絶縁膜を貫通する画素用ホールがエッチングされ続けるため、画素用ホールが径大化してしまうという問題がある。
【０００６】
本発明は、上記実情に鑑みて為されたものであり、画素用ホールの径大化を抑制することが可能な液晶表示装置及びその製造方法を提供することを主な目的とする。
【課題を解決するための手段】
【０００７】
上記課題を解決するため、本発明の液晶表示装置の製造方法は、透明基板上にゲート電極及びゲート配線を形成し、前記ゲート電極及び前記ゲート配線を覆うゲート絶縁膜を形成し、前記ゲート絶縁膜に前記ゲート配線の一部を露出させる第１の端子用ホールを形成し、前記ゲート絶縁膜上に半導体層、ソース電極及びドレイン電極を形成し、前記半導体層、前記ソース電極、前記ドレイン電極及び前記ゲート配線を覆う保護絶縁膜を形成し、前記保護絶縁膜に、前記ソース電極又は前記ドレイン電極の一部を露出させる画素用ホールと、平面視において前記第１の端子用ホールと重複し、前記ゲート配線の一部を露出させる第２の端子用ホールと、を形成し、前記画素用ホールを通じて前記ソース電極又は前記ドレイン電極に接続される画素電極と、前記第２の端子用ホールを通じて前記ゲート配線に接続される端子と、を形成することを特徴とする。
【０００８】
また、本発明の一態様では、前記第２の端子用ホールは、前記第１の端子用ホールよりも小さく、前記第１の端子用ホールの内側に形成される。
【０００９】
また、本発明の一態様では、前記保護絶縁膜は下層絶縁膜と上層絶縁膜とを含み、前記下層絶縁膜と前記上層絶縁膜との間に共通電極が形成される。
【００１０】
また、本発明の一態様では、前記ゲート絶縁膜は前記保護絶縁膜よりも硬い。
【００１１】
また、本発明の液晶表示装置は、透明基板と、前記透明基板上に配置されるゲート電極及びゲート配線と、前記ゲート電極及び前記ゲート配線を覆うゲート絶縁膜と、前記ゲート絶縁膜上に配置される半導体層、ソース電極及びドレイン電極と、前記半導体層、前記ソース電極及び前記ドレイン電極を覆う保護絶縁膜と、前記保護絶縁膜に形成された画素用ホールを通じて前記ソース電極又は前記ドレイン電極に接続される画素電極と、前記保護絶縁膜に形成された端子用ホールを通じて前記ゲート配線に接続される端子と、を備え前記ゲート配線のうち前記端子と接続される部分では、前記保護絶縁膜が前記ゲート配線と直接接していることを特徴とする。
【００１２】
また、本発明の一態様では、前記端子は、前記ゲート絶縁膜と接触しない。
【００１３】
また、本発明の一態様では、前記保護絶縁膜は下層絶縁膜と上層絶縁膜とを含み、前記下層絶縁膜と前記上層絶縁膜との間に共通電極が形成される。
【発明の効果】
【００１４】
本発明によると、第１の端子用ホールをゲート絶縁膜に形成し、その後、第１の端子用ホールと平面視において重複する第２の端子用ホールを保護絶縁膜に形成することから、ゲート配線の一部を露出させるまでの時間を短縮することが可能であり、この結果、画素用ホールの径大化を抑制して、開口率を向上させることが可能である。
【図面の簡単な説明】
【００１５】
【図１】本発明の液晶表示装置の一実施形態を模式的に表す断面図である。
【図２Ａ】本発明の液晶表示装置の製造方法の一実施形態を表す図である。
【図２Ｂ】本発明の液晶表示装置の製造方法の一実施形態を表す図である。
【図３Ａ】図２Ａ及び図２Ｂに続く図である。
【図３Ｂ】図２Ａ及び図２Ｂに続く図である。
【図４Ａ】図３Ａ及び図３Ｂに続く図である。
【図４Ｂ】図３Ａ及び図３Ｂに続く図である。
【図５Ａ】図４Ａ及び図４Ｂに続く図である。
【図５Ｂ】図４Ａ及び図４Ｂに続く図である。
【図６Ａ】図５Ａ及び図５Ｂに続く図である。
【図６Ｂ】図５Ａ及び図５Ｂに続く図である。
【図７Ａ】図６Ａ及び図６Ｂに続く図である。
【図７Ｂ】図６Ａ及び図６Ｂに続く図である。
【図８Ａ】図７Ａ及び図７Ｂに続く図である。
【図８Ｂ】図７Ａ及び図７Ｂに続く図である。
【図９】第１及び第２の端子用ホールの構成例を表す図である。
【図１０】第１及び第２の端子用ホールの構成例を表す図である。
【図１１】本発明の液晶表示装置の別の実施形態を概略的に表す断面図である。
【発明を実施するための形態】
【００１６】
本発明の液晶表示装置及びその製造方法の実施形態を、図面を参照しながら説明する。図１は、本発明の液晶表示装置の一実施形態を模式的に表す断面図である。同図の左側には、ＴＦＴ基板１の表示領域に設けられた薄膜トランジスタ（ＴＦＴ）５の近傍が示され、同図の右側には、ＴＦＴ基板１の周縁領域に設けられた端子９２の近傍が示されている。
【００１７】
ＴＦＴ基板１の表示領域では、透明基板２上にＴＦＴ５が配置されている。ＴＦＴ５は、ゲート電極５１と、半導体層５３と、ソース電極５５と、ドレイン電極５７と、を備えている。ゲート電極５１上には半導体層５３が配置されており、ゲート電極５１と半導体層５３の間にはゲート絶縁膜３が配置されている。半導体層５３上には、ソース電極５５及びドレイン電極５７が配置されている。
【００１８】
ＴＦＴ５及びゲート絶縁膜３は、保護絶縁膜としての下層絶縁膜４によって覆われており、下層絶縁膜４は有機絶縁膜６によって覆われている。有機絶縁膜６は、比較的厚めに形成されており、その表面が平坦になった平坦化膜である。有機絶縁膜６上には共通電極７が配置されており、共通電極７には共通線７２が接続されている。共通電極７及び有機絶縁膜６は、保護絶縁膜としての上層絶縁膜８によって覆われており、上層絶縁膜８上には画素電極９が配置されている。なお、有機絶縁膜６は必須ではない。
【００１９】
有機絶縁膜６のうちドレイン電極５７の上方には、底に下層絶縁膜４が露出するホール６ａが形成されており、上層絶縁膜８は、ホール６ａを充填して下層絶縁膜４と接触している。下層絶縁膜４及び上層絶縁膜８には、有機絶縁膜６のホール６ａの内側を通って、底にドレイン電極５７が露出する画素用ホール８ａが形成されており、画素電極９は、画素用ホール８ａを通ってドレイン電極５７に接続されている。
【００２０】
ＴＦＴ基板１の周縁領域には、ゲート電極５１と接続されたゲート配線５２が延在しており、ゲート配線５２の端部には端子９２が接続されている。ゲート配線５２の端部の上方には、ゲート絶縁膜３、下層絶縁膜４及び上層絶縁膜８が積層されており、有機絶縁膜６は配置されていない。ゲート絶縁膜３には第１の端子用ホール３ｂが形成されており、下層絶縁膜４及び上層絶縁膜８には第２の端子用ホール８ｂが形成されている。第１の端子用ホール３ｂと第２の端子用ホール８ｂは、平面視で互いに重複するように形成されている。第２の端子用ホール８ｂの底にはゲート配線５２の端部が露出しており、端子９２は、第２の端子用ホール８ｂを通ってゲート配線５２の端部に接続されている。
【００２１】
透明基板２は無アルカリガラス等からなる。ＴＦＴ５のゲート電極５１、ゲート配線５２、ソース電極５５及びドレイン電極５７はＣｕやＡｌ等の金属からなる。半導体層５３は非晶質Ｓｉなどの半導体からなる。ゲート絶縁膜３、下層絶縁膜４及び上層絶縁膜８はＳｉＮ等の透明な無機絶縁材料からなる。有機絶縁膜６を構成する有機材料については後述する。共通電極７、画素電極９及び端子９２は、スズ添加酸化インジウム（ＩＴＯ）等の酸化物からなる透明導電膜である。
【００２２】
ＴＦＴ基板１では、さらに、上層絶縁膜８及び画素電極９の上方に不図示の配向膜が配置され、透明基板２の下方に不図示の偏光板が配置される。こうしたＴＦＴ基板１と、不図示のカラーフィルタ（ＣＦ）基板とが液晶層を挟持することによって液晶パネルが構成され、さらに、こうした液晶パネルに駆動回路が組み付けられることによって液晶表示装置が構成される。
【００２３】
図２Ａ〜図８Ｂは、本発明の液晶表示装置の製造方法の実施形態を表す図である。これらの図のＡの断面図は、フォトリソグラフィー工程及びエッチングによる薄膜加工が終了し、フォトレジストが除去された状態を示している。Ｂのフローチャートは、当該状態に至るまでの主な工程を示している。
【００２４】
ここで、フォトリソグラフィー工程とは、フォトレジストの塗布から、フォトマスクを使用した選択的な露光を経て、現像を行うまでの、レジストパターンを形成する一連の処理を含む工程であり、以下では詳細な説明を省略する。
【００２５】
図２Ａ及び図２Ｂに示される工程では、ゲート電極５１及びゲート配線５２が形成される。具体的には、始めに、透明基板２上にスパッタリングによりＣｕやＡｌ等の金属からなる金属膜が形成される（Ｓ１１）。次いで、金属膜上にレジストパターンが形成され（Ｓ１２）、金属膜が選択的にエッチングされる（Ｓ１３）。その後、フォトレジストが剥離される（Ｓ１４）。これにより、透明基板２上にゲート電極５１及びゲート配線５２が形成される。
【００２６】
図３Ａ及び図３Ｂに示される工程では、ゲート絶縁膜３、半導体層５３、ソース電極５５及びドレイン電極５７が形成される。また、ゲート絶縁膜３には、第１の端子用ホール３ｂが形成される。具体的には、ＣＶＤ装置の反応室内にアンモニアガス、シランガス及び窒素ガスを導入することでＳｉＮｘからなるゲート絶縁膜３が形成され、続いて、シランガス及び水素ガスを導入することで非晶質Ｓｉからなる半導体層が形成され、続いて、スパッタリングによりＣｕやＡｌ等の金属からなる金属膜が形成される（Ｓ２１）。
【００２７】
次いで、金属膜上にハーフトーンマスクを利用したレジストパターンが形成される（Ｓ２２）。ここでは、ソース電極５５及びドレイン電極５７が形成される領域にフォトレジストが第１の厚さで形成され、ソース電極５５とドレイン電極５７の間の領域にフォトレジストが上記第１の厚さよりも薄い第２の厚さで形成される。また、半導体層５３が形成されない領域にフォトレジストが上記第２の厚さよりも薄い第３の厚さで形成され、第１の端子用ホール３ｂが形成される領域にはフォトレジストが形成されない。次いで、金属膜、半導体層及びゲート絶縁膜３が選択的にエッチングされ（Ｓ２３）、これにより、ゲート絶縁膜３には、底にゲート配線５２の端部が露出する第１の端子用ホール３ｂが形成される。次いで、フォトレジストの第３の厚さで形成された部分がハーフアッシングにより除去され（Ｓ２４）、これにより露出した領域の金属膜及び半導体層が選択的にエッチングされる（Ｓ２５）。次いで、フォトレジストの第２の厚さで形成された部分がハーフアッシングにより除去され（Ｓ２６）、これにより露出した領域の金属膜がエッチングされる（Ｓ２７）。その後、フォトレジストが剥離される（Ｓ２６）。これにより、半導体層５３、ソース電極５５及びドレイン電極５７が形成され、ＴＦＴ５が完成する。
【００２８】
図４Ａ及び図４Ｂに示される工程では、下層絶縁膜４が形成される。具体的には、ＣＶＤ装置の反応室内にアンモニアガス、シランガス及び窒素ガスを導入することで、ＴＦＴ５及びゲート絶縁膜３上にＳｉＮｘからなる下層絶縁膜４が形成される（Ｓ３１）。このとき、下層絶縁膜４は、ゲート絶縁膜３に形成された第１の端子用ホール３ｂを充填するため、第１の端子用ホール３ｂの上方にはその形状に倣った窪み４ｃが形成される。
【００２９】
図５Ａ及び図５Ｂに示される工程では、有機絶縁膜６が形成される。具体的には、下層絶縁膜４上に液状の有機材料を塗布し、硬化させることで有機絶縁膜６が形成される（Ｓ４１）。有機絶縁膜６を構成する有機材料としては、例えばアクリル樹脂が挙げられる。これに限られず、シリコーン樹脂、エポキシ樹脂、ポリイミド樹脂などであってもよい。また、有機絶縁膜６はシリカ等の無機充填材を含んでいてもよい。有機絶縁膜６は、下層絶縁膜４及び上層絶縁膜８よりも厚く、その表面が平坦になった平坦化膜である。次いで、有機絶縁膜６上にはレジストパターンが形成され（Ｓ４２）、有機絶縁膜６が選択的にエッチングされ（Ｓ４３）、その後、フォトレジストが剥離される（Ｓ４４）。これにより、有機絶縁膜６のうちドレイン電極５７の上方には、底に下層絶縁膜４が露出するホール６ａが形成される。なお、有機絶縁膜６は、ゲート配線５２の端部の上方には形成されない。
【００３０】
図６Ａ及び図６Ｂに示される工程では、共通電極７及び共通線７２が形成される。具体的には、有機絶縁膜６上にスパッタリングによりＩＴＯ等の酸化物からなる透明導電膜が形成され、さらにスパッタリングによりＣｕやＡｌ等の金属からなる金属膜が形成される（Ｓ５１）。次いで、金属膜上にハーフトーンマスクを利用したレジストパターンが形成される（Ｓ５２）。ここでは、共通線７２が形成される領域にフォトレジストが比較的厚く形成され、共通電極７のみが形成される領域にフォトレジストが比較的薄く形成され、共通電極７が形成されない領域にはフォトレジストが形成されない。次いで、金属膜及び透明導電膜が選択的にエッチングされる（Ｓ５３）。次いで、フォトレジストの薄く形成された部分がハーフアッシングにより除去され（Ｓ５４）、これにより露出した領域の金属膜がエッチングされる（Ｓ５５）。その後、フォトレジストが剥離される（Ｓ５６）。これにより、共通電極７及び共通線７２が形成される。
【００３１】
図７Ａ及び図７Ｂに示される工程では、上層絶縁膜８が形成される。具体的には、ＣＶＤ装置の反応室内にアンモニアガス、シランガス及び窒素ガスを導入することで、有機絶縁膜６上にＳｉＮｘからなる上層絶縁膜８が形成される（Ｓ６１）。このとき、上層絶縁膜８は、有機絶縁膜６に形成されたホール６ａを充填し、ホール６ａの底に露出する下層絶縁膜４と接触する。また、ゲート配線５２の端部の上方でも、上層絶縁膜８は、下層絶縁膜４と接触する。次いで、上層絶縁膜８上にレジストパターンが形成され（Ｓ６２）、上層絶縁膜８が選択的にエッチングされ（Ｓ６３）、その後、フォトレジストが剥離される（Ｓ６４）。
【００３２】
これにより、ＴＦＴ基板１の表示領域では、下層絶縁膜４及び上層絶縁膜８の２層に亘って、有機絶縁膜６のホール６ａの内側を通り、底にドレイン電極５７が露出する画素用ホール８ａが形成される。一方、ＴＦＴ基板１の周縁領域でも、下層絶縁膜４及び上層絶縁膜８の２層に亘って、平面視において第１の端子用ホール３ｂと重複し、底にゲート配線５２の端部が露出する第２の端子用ホール８ｂが形成される。すなわち、本実施形態では、ゲート絶縁膜３に第１の端子用ホール３ｂを形成しているため、第２の端子用ホール８ｂを形成すべき絶縁膜の数が、下層絶縁膜４及び上層絶縁膜８の２層となって、画素用ホール８ａを形成すべき絶縁膜の数と同じになる。これによると、画素用ホール８ａ及び第２の端子用ホール８ｂを同時に形成する際に、ドレイン電極５７が露出するまでの時間とゲート配線５２が露出するまでの時間とが実質的に同じになるか、若しくは両者の差が十分に小さくなるので、この結果、画素用ホール８ａの径大化の抑制を図ることが可能である。
【００３３】
図９は、第１の端子用ホール３ｂ及び第２の端子用ホール４ｂの具体的な構成例を表す図である。本構成例では、第２の端子用ホール８ｂは、第１の端子用ホール３ｂよりも小さく、第１の端子用ホール３ｂの内側に形成されている。このため、ゲート配線５２のうち端子９２が接続される部分では、ゲート絶縁膜３ではなく、下層絶縁膜４がゲート配線５２を覆っている。詳しくは、ゲート配線５２のうち、第２の端子用ホール８ｂによって露出する露出部分の周囲領域は、下層絶縁膜４によって覆われている。このように下層絶縁膜４及び上層絶縁膜８に第２の端子用ホール８ｂが形成されることによって、第２の端子用ホール８ｂ内に形成される端子９２（図１を参照）は、ゲート絶縁膜３とは接触しない。
【００３４】
ところで、ゲート絶縁膜３は半導体層５３と共に形成されることから（図３Ａ及び図３Ｂを参照）、ゲート絶縁膜３の成膜温度は、下層絶縁膜４及び上層絶縁膜８の成膜温度よりも高い。例えば、ゲート絶縁膜３の成膜温度は約３５０℃であるのに対し、下層絶縁膜４及び上層絶縁膜８の成膜温度は約２９０℃である。この違いから、ゲート絶縁膜３は、下層絶縁膜４及び上層絶縁膜８よりも硬くなり、被加工性に劣る。しかしながら、図９の構成例では、第２の端子用ホール８ｂが、加工性が比較的悪いゲート絶縁膜３ではなく、加工性が比較的良い下層絶縁膜４及び上層絶縁膜８に形成されるため、第２の端子用ホール８ｂを所望のテーパー形状に成形することが容易であり、端子９２の信頼性を向上させることが可能である。
【００３５】
なお、ゲート絶縁膜３、下層絶縁膜４及び上層絶縁膜８は同じ材料からなるため、互いの境界が判別し難いことが考えられる。しかし、第２の端子用ホール８ｂが第１の端子用ホール３ｂよりも小さく、第１の端子用ホール３ｂの内側に形成されているか否かは、上層絶縁膜８の上面にゲート絶縁膜３に対応する盛り上がり部８１が形成されているか否かによって判断することが可能である。
【００３６】
また、上記態様に限られず、図１０に示されるように、第２の端子用ホール８ｂが第１の端子用ホール３ｂよりも大きく、第１の端子用ホール３ｂの外側に形成されてもよい。この場合、第１の端子用ホール３ｂと第２の端子用ホール８ｂが連続し、その内側壁は段形状となる。すなわち、ゲート絶縁膜３には、下層絶縁膜４及び上層絶縁膜８よりも内側に張り出した張り出し部３２が形成される。
【００３７】
製造工程の説明に戻り、図８Ａ及び図８Ｂに示される工程では、画素電極９及び端子９２が形成される。具体的には、上層絶縁膜８上にスパッタリングによりＩＴＯ等の酸化物からなる透明導電膜が形成される（Ｓ７１）。次いで、透明導電膜上にレジストパターンが形成され（Ｓ７２）、透明導電膜が選択的にエッチングされる（Ｓ７３）。その後、フォトレジストが剥離される（Ｓ７４）。これにより、上層絶縁膜８上に画素電極９が形成されると共に、画素電極９は、画素用ホール８ａを通って、その底に露出したドレイン電極５７に接続される。また、端子９２は、第２の端子用ホール８ｂを通って、その底に露出したゲート配線５２の端部に接続される。
【００３８】
その後、上層絶縁膜８及び画素電極９の上方に不図示の配向膜が配置され、透明基板２の下方に不図示の偏光板が配置されることで、ＴＦＴ基板１が完成する。さらに、ＴＦＴ基板１と不図示のＣＦ基板との間に液晶層が保持されることで液晶パネルが完成し、こうした液晶パネルに駆動回路などが組み付けられることで液晶表示装置が完成する。
【００３９】
以上、本発明の実施形態について説明したが、本発明は上記実施形態に限定されるものではなく、種々の変形実施が当業者にとって可能であるのはもちろんである。
【００４０】
本発明は、図１１に示されるようなＴＦＴ基板１０に適用されてもよい。ＴＦＴ基板１０では、保護絶縁膜４上に画素電極９が形成されており、ゲート絶縁膜３下に共通電極７が形成されている。ＴＦＴ基板１０の表示領域では、保護絶縁膜４に、底にドレイン電極５７が露出する画素用ホール８ａが形成されている。ＴＦＴ基板１０の周縁領域では、保護絶縁膜４に、平面視において第１の端子用ホール３ｂと重複し、底にゲート配線５２の端部が露出する第２の端子用ホール４ｂが形成されている。すなわち、本変形例においても、ゲート絶縁膜３に第１の端子用ホール３ｂを形成しているため、第２の端子用ホール４ｂを形成すべき絶縁膜の数が、保護絶縁膜４のみの１層となって、画素用ホール４ａを形成すべき絶縁膜の数と同じになる。
【符号の説明】
【００４１】
１  ＴＦＴ基板、２  透明基板、３  ゲート絶縁膜、３２  張り出し部、３ｂ  第１の端子用ホール、４  下層絶縁膜（保護絶縁膜）、４ａ  画素用ホール、４ｂ  第２の端子用ホール、４ｃ  窪み、５  薄膜トランジスタ（ＴＦＴ）、５１  ゲート電極、５２  ゲート配線、５３  半導体層、５５  ソース電極、５７  ドレイン電極、６  有機絶縁膜、６ａ  ホール、７  共通電極、７２  共通線、８  上層絶縁膜（保護絶縁膜）、８１  盛り上がり部、８ａ  画素用ホール、８ｂ  第２の端子用ホール、９  画素電極、９２  端子。
【図１】
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【図２Ａ】
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【図２Ｂ】
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【図３Ａ】
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【図３Ｂ】
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【図４Ａ】
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【図４Ｂ】
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【図５Ａ】
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【図５Ｂ】
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【図６Ａ】
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【図６Ｂ】
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【図７Ａ】
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【図７Ｂ】
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【図８Ａ】
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【図８Ｂ】
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【図９】
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【図１０】
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【図１１】
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