(57)【要約】【課題】櫛形のＮ型ＭＯＳトランジスタをＥＳＤ保護素子として用いた半導体装置において、前記櫛型のＮ型ＭＯＳトランジスタを全体で均一に動作させることのできる半導体装置を提供する。【解決手段】外周ガードリングに配置された基板電位固定用コンタクトからの距離に応じて、ＥＳＤ保護素子に用いられているＮ型ＭＯＳトランジスタのゲート電極のＬ長を調整することで、ゲート電極を構成しているそれぞれの櫛が一様にスナップバック動作に入り、局所的な電流集中を回避させ、所望のＥＳＤ耐量を得ることを可能とする。【選択図】図１
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【特許請求の範囲】
【請求項１】
交互に配置された複数のドレイン領域と複数のソース領域と、
前記複数のドレイン領域と複数のソース領域の間に配置されたゲート電極と、
前記複数のドレイン領域と複数のソース領域、および前記ゲート電極の周囲に配置された、グランド電位に固定するためのメタル配線が接続された基板コンタクトと、
を有する複数のトランジスタが一体となった構造を有するＮ型ＭＯＳトランジスタをＥＳＤ保護用素子として用いた半導体装置であって、
前記ゲート電極のチャネル方向の長さであるＬ長が、前記基板コンタクトの近くに配置されたゲート電極においては、前記基板コンタクトから離れた位置に配置されたゲート電極におけるよりも短いことを特徴とする半導体装置。
【請求項２】
前記ゲート電極のチャネル幅方向と平行な方向の基板コンタクトからの距離が近いほど前記ゲート電極のＬ長を短くしたことを特徴とする請求項１記載の半導体装置。
【請求項３】
前記基板コンタクトが前記ゲート電極のチャネル幅方向と平行な二辺にのみ配置されていることを特徴とする請求項２記載の半導体装置。
【請求項４】
前記ゲート電極のチャネル長方向と平行な方向の基板コンタクトからの距離が近いほど前記ゲート電極のＬ長を短くしたことを特徴とする請求項１記載の半導体装置。
【請求項５】
前記基板コンタクトが前記ゲート電極のＬ長方向と平行な二辺にのみ配置されていることを特徴とする請求項４記載の半導体装置。
【請求項６】
複数のドレイン領域と複数のソース領域が交互に配置され、前記ドレイン領域と前記ソース領域の間にゲート電極が配置された、複数のトランジスタが一体となった構造を有するＮ型ＭＯＳトランジスタをＥＳＤ保護素子として用いた半導体装置おいて、前記Ｎ型ＭＯＳトランジスタの周囲に配置された、グランド電位に固定するためのメタル配線が接続された基板コンタクトからの距離が近いほど前記ゲート電極のＬ長を短くしたことを特徴とする半導体装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置に関する。特にＮ型ＭＯＳトランジスタをＥＳＤ保護素子として使用した半導体装置に関する。
【背景技術】
【０００２】
ＭＯＳ型トランジスタを有する半導体装置では、外部接続用(ＶＤＤ)ＰＡＤからの静電気による内部回路の破壊を防止するために、Ｎ型ＭＯＳトランジスタのゲート電位をグランド（Ｖｓｓ）に固定してオフ状態として設置するオフトランジスタをＥＳＤ保護素子として使用することが多い。
【０００３】
オフトランジスタは、短時間・多量の静電気による電流を流しきる必要があるため、通常の内部ＭＯＳトランジスタ構造よりも大きな幅(Ｗ)を有する必要がある。このためオフトランジスタは、複数のドレイン領域、ソース領域、ゲート領域を櫛状に組み合わせたマルチフィンガータイプをとることで総Ｗ面積を大きくした構造をとることが多い。
【０００４】
しかしながら、複数のトランジスタを組み合わせた構造をとることにより、ＥＳＤ保護用のＭＯＳトランジスタ全体で均一な動作をさせることは難しく、最初に寄生バイポーラ動作に入った櫛のみがＥＳＤサージを受けきれずに局所的に破壊に至ってしまう問題がある。オフトランジスタの周りに配置されたガードリングにはオフトランジスタのゲート電位をグランド電位に固定するための基板コンタクトが配置してある。一般にガードリングはＥＳＤ素子の外周を取り囲むように配置されるので、櫛型ＥＳＤ素子の周囲に設置されているグラウンド電位から各単位櫛ＥＳＤ素子、すなわち寄生バイポーラトランジスタのベースまでの距離が異なる。つまり、ベース抵抗が各々の櫛によって差があるため、アバランシェブレークダウン後のソース領域とチャネル領域との間で形成される寄生バイポーラトランジスタがＯＮするトリガーとなる局所的な電圧差が異なる。このため寄生バイポーラトランジスタが動作するタイミングが各単位ＥＳＤ素子で異なるため、最も早く寄生バイポーラトランジスタがＯＮした単位ＥＳＤ素子に電流が集中し、局所破壊を生じる。
【０００５】
この改善策としてドレイン領域のコンタクトとゲート電極との距離を、外部接続素子が遠いほど小さくし、トランジスタの動作を速める工夫することで全櫛が一様にバイポーラ動作の開始であるスナップバック状態に入るようなレイアウト方法も提案されている。（例えば、特許文献１参照）
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開平７−４５８２９号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
しかしながら上記方法では、ドレイン領域の幅の縮小化に伴って所望のコンタクト位置を確保できないこと、近年の高融点金属を含む配線による配線の低抵抗化で、サージの伝播スピードがさらに速くなり、コンタクトとゲート電極までの距離だけでは調整しきれない場合が生じるという課題を有していた。
【課題を解決するための手段】
【０００８】
上記課題を解決するため、本発明は半導体装置を以下のように構成した。
複数のドレイン領域と複数のソース領域が交互に配置され、前記ドレイン領域と前記ソース領域の間にゲート電極が配置され、外周ガードリングには前記ゲート電極の電位をグランド電位に固定するための基板コンタクトが配置された複数のトランジスタが一体化した構造を有するＥＳＤ保護用のＮ型ＭＯＳトランジスタにおいて、ドレイン領域は外部接続端子と電気的に接続され、ソース領域はグランド電位供給ラインと電気的に接続されており、ゲート電極の櫛単体Ｌ長を外周に配置されたグランド電位固定用基板コンタクトからの距離が近くなるほど短くし、遠くなるほど長くした。
【発明の効果】
【０００９】
本発明によれば、グランド電位固定用基板コンタクトから最も遠い内側のゲート電極ほどＬ長を長くすることで、ゲート電極を構成しているそれぞれの櫛が一様にスナップバック動作に入り、局所的な電流集中を回避させ、所望のＥＳＤ耐量を得ることが出来る。
【図面の簡単な説明】
【００１０】
【図１】本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第１の実施例を示す模式的平面図である。
【図２】本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第２の実施例を示す模式的平面図である。
【図３】本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第３の実施例を示す模式的平面図である。
【図４】本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第４の実施例を示す模式的平面図である。
【発明を実施するための形態】
【００１１】
以下では発明を実施するための形態についていくつかの実施例を挙げ、図面を用いて詳細に説明する。また、以下の説明においては、メタル配線によりグランド電位に接続されているもののみを基板コンタクトと称する。
【実施例１】
【００１２】
図１は、本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第１の実施例を示す模式的平面図である。
Ｎ型の高濃度不純物領域からなる第１のソース領域１０１と第１のドレイン領域３０１が形成されており、第１のソース領域１０１と第１のドレイン領域３０１の間には、シリコン酸化膜などからなるゲート絶縁膜が設けられ、その上面にポリシリコンなどからなるゲート電極２０１が形成されている。第１のドレイン領域３０１からゲート電極２０１を介して第２のソース領域１０２、さらにゲート電極２０１を介して第２のドレイン領域３０２、前記同様の繰り返しパターンで電極２０１を介して第３のソース領域１０３、第３のドレイン領域３０３、第４のソース領域１０４が形成されている。第１の実施例においては、ソース領域を４つ、ドレイン領域を３つ、ゲート電極を６つ配置した形の例を示した。ここで、ドレイン領域３０１、３０２、３０３は第１のメタル配線６０１を介して外部接続端子７０１に接続されている。各々のゲート電極は櫛の歯に相当して、６本集合して櫛型の形状になっており、櫛の歯の間にソース領域とドレイン領域が交互に配置されて、ＭＯＳトランジスタが６つ組み合わさった形のマルチフィンガータイプとなっている。
【００１３】
第１のソース領域１０１、第２のソース領域１０２、および第３のソース領域１０３には、高融点金属を含むメタル材料などで形成されたグランド電位供給ライン４０１に接続された高融点金属を含む材料などで形成された上層のメタル配線によりグランド電位が供給される。ＥＳＤ保護用のＮ型ＭＯＳトランジスタの外周ガードリングには、チャネル幅と水平な方向の基板コンタクト５０１およびチャンネル長と水平な方向の基板コンタクト５０２が一定間隔で配置されている。
【００１４】
ここで、ゲート電極２０１はチャネル幅と平行な方向（図１では左右の方向）に配置された基板コンタクト５０１から近いゲート電極ほどＬ長が短くレイアウトされており、基板コンタクト５０１から最も遠い位置にある内側のゲート電極のＬ長が最も長くなるようにレイアウトがされている。すなわち、図１ではデート電極の６本の櫛の歯のうち最上段と最下段のゲート電極のＬ長が最も短く、中央の２本のゲート電極のＬ長が最も長くなるように設定されている。これは、チャネルが形成される基板領域の電位が近隣の基板のコンタクトにより接地電位にしっかりと固定されているほど、バイポーラ動作が起こりにくいからである。ゲート電極２０１の各櫛の歯のＬ長を上記のように設定することにより、基板コンタクトまでの距離が異なることで生じる基板の電位の差によって発生する、各ゲート電極２０１の下のチャネルで起こるバイポーラ動作の開始タイミングの差を解消し、等しくすることで、ＥＳＤ保護用のＮ型ＭＯＳトランジスタ全体で均一に動作させることが可能となる。図１に示した実施例では、ＥＳＤ保護用のＮ型ＭＯＳトランジスタのチャネル幅と水平な方向の基板コンタクト５０１からゲート電極２０１間の距離差によるバイポーラ動作の開始タイミングの違いを解消するために、ゲート電極２０１のＬ長を調整した。櫛の歯の１本に当たる単位ゲート電極は幅が一定であり、基本的に長方形の形状を有している。
【実施例２】
【００１５】
図２は、本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第２の実施例を示す模式的平面図である。図１と対応する部分には同じ番号が付してある。図１に示した第１の実施例と異なる点は、単位ゲート電極２０１のＬ長が一定ではないことである。図２における基板コンタクトは、図では左右方向となるチャネル幅方向と平行な方向の基板コンタクト５０１だけではなく、図では上下方向となるチャネル長方向と平行な方向の基板コンタクト５０２も設けられているため、これを考慮して基板コンタクト５０２との距離が近い各ゲート電極２０１の先端および根元付近のＬ長を中心付近のＬ長よりも短くした。
【００１６】
このような構成とすることで、ＥＳＤ保護用のＮ型ＭＯＳトランジスタのチャネル幅方向と水平な方向の基板コンタクト５０１からのゲート電極２０１間の距離差及び、チャネル長方向と水平な方向の基板コンタクト５０２からのゲート電極２０１間の距離差から生じるバイポーラ動作開始タイミングの違いを解消することができる。
【実施例３】
【００１７】
図３は、本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第３の実施例を示す模式的平面図である。図１と対応する部分には同じ番号が付してある。図１に示した第１の実施例と異なる点は、ＥＳＤ保護用のＮ型ＭＯＳトランジスタのチャネル長方向と水平な方向に配置された基板コンタクトを有さないことでチャネル長方向と平行な方向の基板ポテンシャルの差の影響を無くし、外周ガードリングにはチャネル幅方向と平行な方向の基板コンタクト５０１だけを配置した構成とした点である。この場合のゲート電極２０１は、実施例１同様、チャネル幅と水平な方向の基板コンタクト５０１から近いゲート電極ほどＬ長が短くレイアウトし、基板コンタクト５０１から最も遠い位置にある内側のゲート電極のＬ長が最も長くなるようにレイアウトしている。従って、単位ゲート電極２０１は長方形の形状を有している。
【実施例４】
【００１８】
図４は、本発明による半導体装置の、ＥＳＤ保護用のＮ型ＭＯＳトランジスタの第４の実施例を示す模式的平面図である。図１と対応する部分には同じ番号が付してある。
本実施例では、外周ガードリングにチャネル長と平行な方向の基板コンタクト５０２のみを配置しており、これを考慮したゲート電極形状となっている。すなわち、基板コンタクト５０２との距離が近い各ゲート電極２０１の先端および根元付近のＬ長を中心付近のＬ長よりも短くし、６本のゲート電極２０１は同じ形状とした。
【００１９】
図１に示した第１の実施例と異なる点は、単位ゲート電極２０１のＬ長が一定ではないことである。図２に示した第２の実施例と異なる点は、各単位ゲート電極２０１間のＬ長が等しいことである。
【００２０】
このような構成とすることで、チャネル長方向と水平な方向の基板コンタクト５０２からのゲート電極２０１間の距離差から生じるバイポーラ動作開始タイミングの違いを解消することができる。
【符号の説明】
【００２１】
１０１  第１のソース領域
１０２  第２のソース領域
１０３  第３のソース領域
１０４  第４のソース領域
２０１  ゲート電極
３０１  第１のドレイン領域
３０２  第２のドレイン領域
３０３  第３のドレイン領域
４０１  グランド(ＶＳＳ)電位供給ライン
５０１  チャネル幅と水平な方向の基板コンタクト
５０２  チャネル長と水平な方向の基板コンタクト
６０１  第１のメタル配線
７０１  外部接続端子
【図１】
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【図２】
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【図３】
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【図４】
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