(57)【特許請求の範囲】
【請求項１】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線の寄生容量に、前記データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、前記寄生容量に蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給することを特徴とする電源供給方法。
【請求項２】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、前記データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、前記キャパシタに蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給することを特徴とする電源供給方法。
【請求項３】
複数の走査線と、
各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、
各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいてスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線の寄生容量に、前記データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、前記寄生容量に蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給することを特徴とする電源供給方法。
【請求項４】
複数の走査線と、
各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、
各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいてスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、前記データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、前記キャパシタに蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給することを特徴とする電源供給方法。
【請求項５】
請求項１乃至４のいずれかにおいて、
前記所与の期間は、
前記データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む期間であることを特徴とする電源供給方法。
【請求項６】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、負電圧を出力するレギュレータの低電位側の電源線の寄生容量に、データ線から放電される電荷に対応する電荷を蓄積し、
前記所与の期間後に、低電位側の駆動電源電圧として前記寄生容量に蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力することを特徴とする電源供給方法。
【請求項７】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、負電圧を出力するレギュレータの低電位側の電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、低電位側の駆動電源電圧として前記キャパシタに蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力することを特徴とする電源供給方法。
【請求項８】
複数の走査線と、
各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、
各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいてスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、負電圧を出力するレギュレータの低電位側の電源線の寄生容量に、データ線から放電される電荷に対応する電荷を蓄積し、
前記所与の期間後に、低電位側の駆動電源電圧として前記寄生容量に蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力することを特徴とする電源供給方法。
【請求項９】
複数の走査線と、
各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、
各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいてスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、
所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、負電圧を出力するレギュレータの低電位側の電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、データ線から放電された電荷に対応する電荷を蓄積し、
前記所与の期間後に、低電位側の駆動電源電圧として前記キャパシタに蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力することを特徴とする電源供給方法。
【請求項１０】
請求項６乃至９のいずれかにおいて、
前記所与の期間において、前記駆動回路の入力信号を受け付けないことを特徴とする電源供給方法。
【請求項１１】
請求項１０において、
前記入力信号が入力される入力バッファの出力を、前記駆動回路の低電位側の駆動電源電圧に固定することを特徴とする電源供給方法。
【請求項１２】
請求項６乃至９のいずれかにおいて、
前記所与の期間において、前記駆動回路を制御するコントローラが出力する前記駆動回路に対する制御信号の出力を停止することを特徴とする電源供給方法。
【請求項１３】
請求項１２において、
前記制御信号の出力を、前記コントローラの低電位側の電源電圧に固定することを特徴とする電源供給方法。
【請求項１４】
請求項６乃至１３のいずれかにおいて、
前記所与の期間は、
前記データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む期間であることを特徴とする電源供給方法。
【請求項１５】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源回路であって、
その電源線に供給された第１の電圧を電源電圧として動作し、該第１の電圧又は該第１の電圧を分圧した分割電圧を入力電圧として該入力電圧に基づく調整電圧を出力するレギュレータと、
一端が前記駆動回路の駆動電源電圧が出力される出力ノードに接続され、他端が前記レギュレータの出力に接続される第１のスイッチ回路と、
一端が前記出力ノードに接続され、他端が前記電源線に接続される第２のスイッチ回路とを含み、
前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、
前記第１のスイッチ回路がオフ、前記第２のスイッチ回路がオンとなり、前記データ線から放電された電荷に対応する電荷が前記電源線の寄生容量に蓄積され、
前記所与の期間後において、
前記第１のスイッチ回路がオン、前記第２のスイッチ回路がオフとなり、前記寄生容量に蓄積された電荷により発生した電圧が電源電圧として供給された前記レギュレータにより、前記調整電圧が前記出力ノードに出力されることを特徴とする電源回路。
【請求項１６】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源回路であって、
第１の電圧又は該第１の電圧を分圧した分割電圧を入力電圧として該入力電圧に基づく調整電圧を出力するレギュレータと、
一端が前記駆動回路の駆動電源電圧が出力される出力ノードに接続され、他端が前記レギュレータの出力に接続される第１のスイッチ回路と、
一端が前記出力ノードに接続される第２のスイッチ回路と、
一端が前記第２のスイッチ回路の他端に接続され、他端がシステム電源線に接続されるキャパシタと、
前記第２のスイッチ回路の他端と、前記レギュレータの電源電圧が供給される電源線との間に接続され、前記システム電源線から前記レギュレータの電源線への方向が順方向となるように接続されるダイオード素子とを含み、
前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、
前記第１のスイッチ回路がオフ、前記第２のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記キャパシタに蓄積され、
前記所与の期間後において、
前記第１のスイッチ回路がオン、前記第２のスイッチ回路がオフとなり、前記キャパシタに蓄積された電荷により発生した電圧が電源電圧として供給された前記レギュレータにより、前記調整電圧が出力されることを特徴とする電源回路。
【請求項１７】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧を供給する低電位側電源線からの電荷を利用して負電圧を出力する電源回路であって、
入力された負電圧に基づく調整電圧を出力するレギュレータと、
一端が前記駆動回路の低電位側の駆動電源電圧を出力する出力ノードに接続され、他端が前記電源回路の接地側電源電圧が供給されるシステム接地電源線に接続された第４のスイッチ回路と、
一端が前記出力ノードに接続され、他端が直接又は所定の素子を介して前記レギュレータの低電位側の電源線に接続された第５のスイッチ回路とを含み、
前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、
前記第４のスイッチ回路がオフ、前記第５のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記レギュレータの低電位側の電源線の寄生容量に蓄積され、
前記所与の期間後において、
前記第４のスイッチ回路がオン、前記第５のスイッチ回路がオフとなり、前記寄生容量に蓄積された電荷により発生した電圧が前記出力ノードに出力されることを特徴とする電源回路。
【請求項１８】
複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧を供給する低電位側電源線からの電荷を利用して負電圧を出力する電源回路であって、
入力された負電圧に基づく調整電圧を出力するレギュレータと、
一端が前記駆動回路の低電位側の駆動電源電圧を出力する出力ノードに接続され、他端が前記電源回路の接地側電源電圧が供給されるシステム接地電源線に接続された第４のスイッチ回路と、
一端が前記出力ノードの接続された第５のスイッチ回路と、
一端が前記第５のスイッチ回路の他端に接続され、他端が接地されるキャパシタと、
前記レギュレータの低電位側の電源線と前記第５のスイッチ回路の他端との間に、前記レギュレータの低電位側の電源線から前記第５のスイッチ回路への方向が順方向となるように接続されたダイオード素子とを含み、
前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、
前記第４のスイッチ回路がオフ、前記第５のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記キャパシタに蓄積され、
前記所与の期間後において、
前記第４のスイッチ回路がオン、前記第５のスイッチ回路がオフとなり、前記キャパシタに蓄積された電荷により発生した電圧が前記出力ノードに出力されることを特徴とする電源回路。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、電源供給方法及び電源回路に関係する。
【０００２】
【従来の技術】
従来より、携帯電話機などの電子機器に用いられる液晶パネル（広義には、表示パネル）として、単純マトリクス方式の液晶パネルと、薄膜トランジスタ（Thin Film Transistor：以下、ＴＦＴと略す）などのスイッチ素子を用いたアクティブマトリクス方式の液晶パネルとが知られている。
【０００３】
単純マトリクス方式は、アクティブマトリクス方式に比べて低消費電力化が容易である反面、多色化や動画表示が困難である。一方、アクティブマトリクス方式は、多色化や動画表示に適している反面、低消費電力化が困難である。
【０００４】
近年、携帯電話機などの携帯型電子機器では、高品質な画像の提供のために、多色化、動画表示への要望が強まっている。このため、これまで用いられてきた単純マトリクス方式の液晶パネルに代えて、アクティブマトリクス方式の液晶パネルが用いられるようになってきた。
【０００５】
ところで、単純マトリクス方式の液晶パネルやアクティブマトリクス方式の液晶パネルでは、画素を構成する液晶への印加電圧が交流となるように駆動される。このような交流駆動の手法として、ライン反転駆動やフレーム反転駆動が知られている。ライン反転駆動では、１又は複数ラインごとに、液晶の印加電圧の極性が反転するように駆動される。フレーム反転駆動では、フレームごとに液晶の印加電圧の極性が反転するように駆動される。
【０００６】
【特許文献１】
特開２００２−２３７０９号公報
【０００７】
【発明が解決しようとする課題】
液晶の印加電圧の極性を反転させる極性反転駆動では、液晶パネルのデータ線への電荷の充電と、データ線からの電荷の放電とが交互に繰り返される。その結果として、データ線から放電された電荷が、該データ線を駆動する駆動回路に戻される。
【０００８】
駆動回路は、例えばボルテージフォロワ接続された演算増幅器によりデータ線を駆動する。駆動回路に戻された電荷は、この演算増幅器において、駆動回路の接地側電源線に戻される。その結果、該レギュレータにより再びデータ線を充電する必要が生じ、消費電力の増大を招く。
【０００９】
本発明は、以上のような技術的課題に鑑みてなされたものであり、その目的とするところは、極性反転駆動によりデータ線から放電される電荷を利用して低消費電力化を図る電源供給方法及び電源回路を提供することにある。
【００１０】
【課題を解決するための手段】
上記課題を解決するために本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線の寄生容量に、前記データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、前記寄生容量に蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給する電源供給方法に関係する。
【００１１】
ここで、データ線から放電された電荷とは、例えば極性反転駆動が行われたときに表示パネルのデータ線から流れる電荷である。
【００１２】
本発明において、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、駆動回路の高電位側の駆動電源電圧を出力するレギュレータにより本来例えばシステム接地電源線に捨てられるデータ線から放電された電荷を、該レギュレータの電源線の寄生容量に蓄積するようにした。そして、寄生容量への電荷の蓄積後に、該寄生容量に蓄積された電荷により発生した電圧をレギュレータの電源線に出力し、駆動回路に対して高電位側の駆動電源電圧を供給する。
【００１３】
したがって、本来捨てられるべき電荷を再利用して、駆動回路の高電位側の駆動電源電圧を供給することができるので、低消費電力化を図ることができる。
【００１４】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、前記データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、前記キャパシタに蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給する電源供給方法に関係する。
【００１５】
ここで所定の素子とは、例えばダイオード素子やスイッチ素子などがある。
【００１６】
本発明において、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、駆動回路の高電位側の駆動電源電圧を出力するレギュレータにより本来例えばシステム接地電源線に捨てられるデータ線から放電された電荷を、レギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに蓄積するようにした。したがって、キャパシタは、その他端に、データ線から放電される電荷を蓄積することができる。そして、キャパシタへの電荷の蓄積後に、キャパシタに蓄積された電荷により発生した電圧（キャパシタの両端部に発生した電圧）をレギュレータの電源線に出力し、駆動回路に対して高電位側の駆動電源電圧を供給する。
【００１７】
したがって、本来捨てられるべき電荷を再利用して、駆動回路の高電位側の駆動電源電圧を供給することができるので、低消費電力化を図ることができる。
【００１８】
また本発明は、複数の走査線と、各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線の寄生容量に、前記データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、前記寄生容量に蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給する電源供給方法に関係する。
【００１９】
ここで第ｆ（１≦ｆ≦３、ｆは整数）のデマルチプレクス用スイッチ素子をオンに設定するとは、第ｆのデマルチプレクス用スイッチ素子を閉じることを意味する。すなわち、第ｆのデマルチプレクス用スイッチ素子の両端の第ｊの色成分用の画素と、データ線とが電気的に接続されることを意味する。
【００２０】
本発明は、例えば低温ポリシリコン（Low Temperature Poly-Silicon：ＬＴＰＳ）プロセスにより形成された表示パネルを駆動する駆動回路への電源供給に適用することができる。
【００２１】
本発明においては、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、駆動回路の高電位側の駆動電源電圧を出力するレギュレータにより本来例えばシステム接地電源線に捨てられるデータ線から放電された電荷を、該レギュレータの電源線の寄生容量に蓄積するようにした。このとき、表示パネルの各デマルチプレクサに含まれる第１〜第３のデマルチプレクス用スイッチ素子を全てオンにして、第１〜第３の色成分用画素に接続されるデータ線から放電される電荷を放電させるようにしている。
【００２２】
そして、寄生容量への電荷の蓄積後に、該寄生容量に蓄積された電荷により発生した電圧をレギュレータの電源線に出力し、駆動回路に対して高電位側の駆動電源電圧を供給する。
【００２３】
したがって、ＬＴＰＳプロセスにより形成された表示パネルに対しても、本来捨てられるべき電荷を再利用して、駆動回路の高電位側の駆動電源電圧を供給することができるので、低消費電力化を図ることができる。
【００２４】
また本発明は、複数の走査線と、各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、該駆動回路に供給される駆動電源電圧を出力するレギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、前記データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、前記キャパシタに蓄積された電荷により発生した電圧を前記電源線に出力し、前記駆動回路の高電位側の駆動電源電圧として前記レギュレータにより生成された電圧を前記駆動回路に供給する電源供給方法に関係する。
【００２５】
本発明は、例えばＬＴＰＳプロセスにより形成された表示パネルを駆動する駆動回路への電源供給に適用することができる。
【００２６】
本発明において、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、駆動回路の高電位側の駆動電源電圧を出力するレギュレータにより本来例えばシステム接地電源線に捨てられるデータ線から放電された電荷を、レギュレータの電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに蓄積するようにした。したがって、キャパシタは、その他端に、データ線から放電される電荷を蓄積することができる。このとき、表示パネルの各デマルチプレクサに含まれる第１〜第３のデマルチプレクス用スイッチ素子を全てオンにして、第１〜第３の色成分用画素に接続されるデータ線から放電される電荷を放電させるようにしている。
【００２７】
そして、キャパシタへの電荷の蓄積後に、キャパシタに蓄積された電荷により発生した電圧（キャパシタの両端部に発生した電圧）をレギュレータの電源線に出力し、駆動回路に対して高電位側の駆動電源電圧を供給する。
【００２８】
したがって、ＬＴＰＳプロセスにより形成された表示パネルに対しても、本来捨てられるべき電荷を再利用して、駆動回路の高電位側の駆動電源電圧を供給することができるので、低消費電力化を図ることができる。
【００２９】
また本発明に係る電源供給方法では、前記所与の期間は、前記データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む期間であってもよい。
【００３０】
本発明によれば、極性反転駆動に伴って捨てられる電荷を再利用することができるので、極性反転駆動による表示品位の向上と共に低消費電力化を図ることができる。
【００３１】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、負電圧を出力するレギュレータの低電位側の電源線の寄生容量に、データ線から放電される電荷に対応する電荷を蓄積し、前記所与の期間後に、低電位側の駆動電源電圧として前記寄生容量に蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力する電源供給方法に関係する。
【００３２】
ここで、負電圧は、例えば複数の走査線を駆動する駆動回路に対して供給することができる。
【００３３】
本発明において、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、データ線駆動回路の低電位側電源線に捨てられるべきであるデータ線から放電された電荷を、負電圧を出力するレギュレータの低電位側の電源線の寄生容量に蓄積するようにしている。そして、寄生容量への電荷の蓄積後に、該寄生容量に蓄積された電荷により発生した電圧をレギュレータの低電位側の電源線に供給し、負電圧を出力するようにしている。
【００３４】
したがって、本来捨てられるべき電荷を再利用して、負電圧の生成に利用することができるので、低消費電力化を図ることができる。
【００３５】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、負電圧を出力するレギュレータの低電位側の電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、低電位側の駆動電源電圧として前記キャパシタに蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力する電源供給方法に関係する。
【００３６】
本発明において、駆動回路によるデータ線への出力をハイインピーダンス状態に設定し、データ線駆動回路の低電位側電源線に捨てられるべきであるデータ線から放電された電荷を、負電圧を出力するレギュレータの低電位側の電源線にその一端が直接又は所定の素子を介して接続されるキャパシタの他端に蓄積するようにしている。
【００３７】
そして、キャパシタへの電荷の蓄積後に、該キャパシタに蓄積された電荷により発生した電圧をレギュレータの低電位側の電源線に供給し、負電圧を出力するようにしている。
【００３８】
したがって、本来捨てられるべき電荷を再利用して、負電圧の生成に利用することができるので、低消費電力化を図ることができる。
【００３９】
また本発明は、複数の走査線と、各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、負電圧を出力するレギュレータの低電位側の電源線の寄生容量に、データ線から放電される電荷に対応する電荷を蓄積し、前記所与の期間後に、低電位側の駆動電源電圧として前記寄生容量に蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力する電源供給方法に関係する。
【００４０】
また本発明は、複数の走査線と、各データ線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数のデータ線と、各画素が前記走査線のいずれか１つと前記データ線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各データ線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧が供給される低電位側電源線からの電荷を利用して負電圧を供給するための電源供給方法であって、所与の期間において、前記駆動回路によるデータ線への出力をハイインピーダンス状態に設定すると共に、前記第１〜第３のデマルチプレクス制御信号により第１〜第３のデマルチプレクス用スイッチ素子をオンに設定し、負電圧を出力するレギュレータの低電位側の電源線にその一端が直接又は所定の素子を介して接続されるキャパシタに、データ線から放電された電荷に対応する電荷を蓄積し、前記所与の期間後に、低電位側の駆動電源電圧として前記キャパシタに蓄積された電荷により発生した電圧に基づいて前記レギュレータにより生成された負電圧を出力する電源供給方法に関係する。
【００４１】
本発明によれば、ＬＴＰＳプロセスにより形成された表示パネルに対しても、本来捨てられるべき電荷を再利用して、負電圧を出力することができるので、低消費電力化を図ることができる。
【００４２】
また本発明に係る電源供給方法では、前記所与の期間において、前記駆動回路の入力信号を受け付けないようにすることができる。
【００４３】
本発明によれば、駆動回路の低電位側の駆動電源電圧が下がるため、上述の期間においてデータ線からの電荷の放電により、駆動回路への入力信号の論理レベルを誤って認識される事態を回避することができる。
【００４４】
また本発明に係る電源供給方法では、前記入力信号が入力される入力バッファの出力を、前記駆動回路の低電位側の駆動電源電圧に固定することができる。
【００４５】
本発明においては、低電位側の駆動電源電圧に固定することにより、駆動回路への入力信号が固定されることによるリークを抑えることができると共に、駆動回路を高耐圧プロセスを用いて形成する必要がなくなる。
【００４６】
また本発明に係る電源供給方法では、前記所与の期間において、前記駆動回路を制御するコントローラが出力する前記駆動回路に対する制御信号の出力を停止することができる。
【００４７】
本発明においては、コントローラが上述の所与の期間を認識している場合には、駆動回路において入力信号の受け付けを行わないようにする構成を不要とすることができる。
【００４８】
また本発明に係る電源供給方法では、前記制御信号の出力を、前記コントローラの低電位側の電源電圧に固定することができる。
【００４９】
本発明においては、上述と同様に、コントローラが停止した制御信号のリークを抑えることができると共に、コントローラを高耐圧プロセスを用いて形成する必要がなくなる。
【００５０】
また本発明に係る電源供給方法では、前記所与の期間は、前記データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む期間であってもよい。
【００５１】
本発明によれば、極性反転駆動に伴って捨てられる電荷を再利用することができるので、極性反転駆動による表示品位の向上と共に低消費電力化を図ることができる。
【００５２】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源回路であって、その電源線に供給された第１の電圧を電源電圧として動作し、該第１の電圧又は該第１の電圧を分圧した分割電圧を入力電圧として該入力電圧に基づく調整電圧を出力するレギュレータと、一端が前記駆動回路の駆動電源電圧が出力される出力ノードに接続され、他端が前記レギュレータの出力に接続される第１のスイッチ回路と、一端が前記出力ノードに接続され、他端が前記電源線に接続される第２のスイッチ回路とを含み、前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、前記第１のスイッチ回路がオフ、前記第２のスイッチ回路がオンとなり、前記データ線から放電された電荷に対応する電荷が前記電源線の寄生容量に蓄積され、前記所与の期間後において、前記第１のスイッチ回路がオン、前記第２のスイッチ回路がオフとなり、前記寄生容量に蓄積された電荷により発生した電圧が電源電圧として供給された前記レギュレータにより、前記調整電圧が前記出力ノードに出力される電源回路に関係する。
【００５３】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち高電位側の駆動電源電圧を供給するための電源回路であって、第１の電圧又は該第１の電圧を分圧した分割電圧を入力電圧として該入力電圧に基づく調整電圧を出力するレギュレータと、一端が前記駆動回路の駆動電源電圧が出力される出力ノードに接続され、他端が前記レギュレータの出力に接続される第１のスイッチ回路と、一端が前記出力ノードに接続される第２のスイッチ回路と、一端が前記第２のスイッチ回路の他端に接続され、他端がシステム電源線に接続されるキャパシタと、前記第２のスイッチ回路の他端と、前記レギュレータの電源電圧が供給される電源線との間に接続され、前記システム電源線から前記レギュレータの電源線への方向が順方向となるように接続されるダイオード素子とを含み、前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、前記第１のスイッチ回路がオフ、前記第２のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記キャパシタに蓄積され、前記所与の期間後において、前記第１のスイッチ回路がオン、前記第２のスイッチ回路がオフとなり、前記キャパシタに蓄積された電荷により発生した電圧が電源電圧として供給された前記レギュレータにより、前記調整電圧が出力される電源回路に関係する。
【００５４】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧を供給する低電位側電源線からの電荷を利用して負電圧を出力する電源回路であって、入力された負電圧に基づく調整電圧を出力するレギュレータと、一端が前記駆動回路の低電位側の駆動電源電圧を出力する出力ノードに接続され、他端が前記電源回路の接地側電源電圧が供給されるシステム接地電源線に接続された第４のスイッチ回路と、一端が前記出力ノードに接続され、他端が直接又は所定の素子を介して前記レギュレータの低電位側の電源線に接続された第５のスイッチ回路と、前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、前記第４のスイッチ回路がオフ、前記第５のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記レギュレータの低電位側の電源線の寄生容量に蓄積され、前記所与の期間後において、前記第４のスイッチ回路がオン、前記第５のスイッチ回路がオフとなり、前記寄生容量に蓄積された電荷により発生した電圧が前記出力ノードに出力される電源回路に関係する。
【００５５】
また本発明は、複数の画素と、複数の走査線と、複数のデータ線とを有する表示パネルの前記複数のデータ線を駆動する駆動回路の高電位側及び低電位側の駆動電源電圧のうち低電位側の駆動電源電圧を供給する低電位側電源線からの電荷を利用して負電圧を出力する電源回路であって、入力された負電圧に基づく調整電圧を出力するレギュレータと、一端が前記駆動回路の低電位側の駆動電源電圧を出力する出力ノードに接続され、他端が前記電源回路の接地側電源電圧が供給されるシステム接地電源線に接続された第４のスイッチ回路と、一端が前記出力ノードの接続された第５のスイッチ回路と、一端が前記第５のスイッチ回路の他端に接続され、他端が接地されるキャパシタと、前記レギュレータの低電位側の電源線と前記第５のスイッチ回路の他端との間に、前記レギュレータの低電位側の電源線から前記第５のスイッチ回路への方向が順方向となるように接続されたダイオード素子とを含み、前記駆動回路による前記データ線への出力がハイインピーダンス状態に設定され、該データ線に接続される画素が有する画素電極と電気光学物質を介して対向する対向電極との電圧の極性を反転させるタイミングを含む所与の期間において、前記第４のスイッチ回路がオフ、前記第５のスイッチ回路がオンとなり、前記データ線から放電される電荷に対応する電荷が前記キャパシタに蓄積され、前記所与の期間後において、前記第４のスイッチ回路がオン、前記第５のスイッチ回路がオフとなり、前記キャパシタに蓄積された電荷により発生した電圧が前記出力ノードに出力される電源回路に関係する。
【００５６】
【発明の実施の形態】
以下、本発明の好適な実施の形態について図面を用いて詳細に説明する。なお、以下に説明する実施の形態は、特許請求の範囲に記載された本発明の内容を不当に限定するものではない。また以下で説明される構成の全てが本発明の必須構成要件であるとは限らない。以下の実施形態では、アクティブマトリクス方式の液晶パネルであるＴＦＴパネルを例に説明するが、本発明はこれに限定されるものではない。
【００５７】
１．  液晶装置（電気光学装置）
図１に、液晶装置の構成の概要を示す。液晶装置は、携帯電話、携帯型情報機器（ＰＤＡ等）、デジタルカメラ、プロジェクタ、携帯型オーディオプレーヤ、マスストレージデバイス、ビデオカメラ、電子手帳、又はＧＰＳ（Global Positioning System）などの種々の電子機器に組み込むことができる。
【００５８】
図１において、液晶装置１０は、液晶パネル２０、データ線駆動回路（狭義にはソースドライバ）３０、走査線駆動回路（狭義にはゲートドライバ）４０、コントローラ５０、電源回路６０を含む。なお、液晶装置１０にこれら全ての回路ブロックを含める必要はなく、その一部の回路ブロックを省略する構成にしてもよい。
【００５９】
液晶パネル２０は、複数の走査線（ゲート線）と、複数のデータ線（ソース線）と、各画素が複数の走査線のいずれかの走査線及び複数のデータ線のいずれかのデータ線により特定される複数の画素とを含む。各画素は、ＴＦＴと画素電極とを含む。データ線にはＴＦＴが接続され、該ＴＦＴに画素電極が接続される。
【００６０】
より具体的には、液晶パネル２０は例えばガラス基板からなるパネル基板上に形成される。パネル基板には、図１のＹ方向に複数配列されそれぞれＸ方向に伸びる走査線ＧＬ１〜ＧＬＭ（Ｍは２以上の整数）と、Ｘ方向に複数配列されそれぞれＹ方向に伸びるデータ線ＤＬ１〜ＤＬＮ（Ｎは２以上の整数）とが配置されている。走査線ＧＬｍ（１≦ｍ≦Ｍ、ｍは整数）とデータ線ＤＬｎ（１≦ｎ≦Ｎ、ｎは整数）との交差点に対応する位置に画素ＰＥｍｎが設けられている。画素ＰＥｍｎは、ＴＦＴｍｎと画素電極とを含む。
【００６１】
ＴＦＴｍｎのゲート電極は走査線Ｇｍに接続される。ＴＦＴｍｎのソース電極はデータ線ＤＬｎに接続される。ＴＦＴｍｎのドレイン電極は画素電極に接続される。画素電極と、該画素電極と液晶素子（広義には電気光学物質）を介して対向する対向電極ＣＯＭ（コモン電極）との間には、液晶容量ＣＬｍｎ及び補助容量ＣＳｍｎが形成されている。画素電極と対向電極ＣＯＭとの間の電圧に応じて、液晶素子の透過率が変化するようになっている。対向電極ＣＯＭに供給される電圧ＶＣＯＭは、電源回路６０により生成される。
【００６２】
データ線駆動回路３０は、表示データに基づいて液晶パネル２０のデータ線ＤＬ１〜ＤＬＮを駆動する。走査線駆動回路４０は、液晶パネル２０の走査線ＧＬ１〜ＧＬＭを走査する。
【００６３】
コントローラ５０は、図示しない中央処理装置（Central Processing Unit：以下、ＣＰＵと略す）等のホストにより設定された内容に従って、データ線駆動回路３０、走査線駆動回路４０及び電源回路６０に対して制御信号を出力する。より具体的には、コントローラ５０は、データ線駆動回路３０及び走査線駆動回路４０に対しては、例えば動作モードの設定や内部で生成した水平同期信号や垂直同期信号を供給する。またコントローラ５０は、電源回路６０に対しては、対向電極ＣＯＭの電圧ＶＣＯＭの極性反転タイミングの制御を行う。
【００６４】
電源回路６０は、外部から供給される基準電圧に基づいて、液晶パネル２０の各種電圧や、対向電極ＣＯＭの電圧ＶＣＯＭを生成する。より具体的には、電源回路６０は、チャージポンプ回路を含み、接地側電源電圧を基準とした正方向及び負方向の複数の電源電圧と、対向電極ＣＯＭの電圧ＶＣＯＭとを生成することができる。接地側電源電圧を基準として負方向の電源電圧は、例えば走査線駆動回路４０に対して出力される。
【００６５】
電源回路６０では、生成した複数の電源電圧と電圧ＶＣＯＭとが、それぞれレギュレータ（電圧調整回路）により電圧調整される。そして、調整後の電圧が出力される。このようなレギュレータは、例えばボルテージフォロワ接続された演算増幅器により構成される。
【００６６】
なお図１では、液晶装置１０がコントローラ５０を含む構成になっているが、コントローラ５０を液晶装置１０の外部に設けてもよい。或いは、コントローラ５０と共にホスト（図示せず）を液晶装置１０に含めるように構成してもよい。
【００６７】
また走査線駆動回路４０、コントローラ５０及び電源回路６０のうち少なくとも１つをデータ線駆動回路３０に内蔵させてもよい。またデータ線駆動回路３０、走査線駆動回路４０、コントローラ５０及び電源回路６０の一部又は全部を液晶パネル２０上に形成してもよい。
【００６８】
ところで、液晶素子には、直流電圧を長時間印加すると劣化するという性質を有する。そこで、液晶素子に印加する電圧の極性を交互に反転させる駆動方式が必要になる。このような駆動方式としては、フレーム反転駆動、走査（ゲート）ライン反転駆動、データ（ソース）ライン反転駆動、ドット反転駆動などがある。
【００６９】
図２に、走査ライン反転駆動の説明図を示す。例えば走査ライン反転駆動では、液晶素子に印加される電圧が走査期間毎（１又は複数の走査線ごと）に極性反転される。
【００７０】
例えば、第ｋ（１≦ｋ≦Ｍ、ｋは整数）の走査期間（走査線ＧＬｋの選択期間）では正極性の電圧が液晶素子に印加され、第（ｋ＋１）の走査期間では負極性の電圧が印加され、第（ｋ＋２）の走査期間では正極性の電圧が印加される。一方、次のフレームにおいては、今度は、第ｋの走査期間では負極性の電圧が液晶素子に印加され、第（ｋ＋１）の走査期間では正極性の電圧が印加され、第（ｋ＋２）の走査期間では負極性の電圧が印加されるようになる。
【００７１】
そして、この走査ライン反転駆動では、対向電極ＣＯＭの電圧（コモン電圧）ＶＣＯＭが走査期間ごとに極性反転される。
【００７２】
より具体的には、正極の期間Ｔ１（第１の期間）ではコモン電圧ＶＣＯＭはＶＣ１（第１のコモン電圧）になり、負極の期間Ｔ２（第２の期間）ではＶＣ２（第２のコモン電圧）になる。
【００７３】
ここで、正極の期間Ｔ１は、データ線（画素電極）の電圧ＶＳがコモン電圧ＶＣＯＭよりも高くなる期間である。この期間Ｔ１では液晶素子に正極性の電圧が印加されることになる。一方、負極の期間Ｔ２は、データ線の電圧ＶＳがコモン電圧ＶＣＯＭよりも低くなる期間である。この期間Ｔ２では液晶素子に負極性の電圧が印加されることになる。また、電圧ＶＣ２は、所与の電圧を基準として電圧ＶＣ１を極性反転した電圧である。
【００７４】
このようにコモン電圧ＶＣＯＭを極性反転することで、液晶パネルの駆動に必要な電圧を低くすることができる。これにより、駆動回路の耐圧を低くでき、駆動回路の製造プロセスの簡素化、低コスト化を図ることができる。
【００７５】
１．１  第１の実施形態
ところで、上述のような極性反転駆動では、データ線の充電と、データ線の放電とが交互に繰り返される。その結果として、データ線から放電された電荷は、データ線駆動回路３０の電源線に戻される。したがって、データ線に対して再度電荷を供給する必要が生じ、消費電力の増大を招く。
【００７６】
以下では、この点について説明する。
【００７７】
まず、データ線駆動回路３０の構成について説明する。
【００７８】
図３に、データ線駆動回路３０の構成例を示す。データ線駆動回路３０には、高電位側の駆動電源電圧ＶＤＤＳが供給される高電位側電源線と、低電位側の駆動電源電圧ＶＳＳＳが供給される低電位側（接地側）電源線とが接続される。高電位側及び低電位側の駆動電源電圧ＶＤＤＳ、ＶＳＳＳは、電源回路６０により生成される。
【００７９】
データ線駆動回路３０は、データラッチ３１、レベルシフタ（Level Shifter：Ｌ／Ｓ）３２、基準電圧発生回路３３、電圧選択回路（Digital-to-Analog Converter：ＤＡＣ）３４、出力回路３５を含む。
【００８０】
データラッチ３１は、表示データをラッチする。表示データは、データ線単位に区分される複数の階調データを含んで構成される。Ｌ／Ｓ３２は、データラッチ３１の出力の電圧レベルをシフトする。
【００８１】
基準電圧発生回路３３は、高電位側の駆動電源電圧ＶＤＤＳと低電位側の駆動電源電圧ＶＳＳＳとの間の電圧を分割した複数の基準電圧を発生する。基準電圧発生回路３３は、例えば両端に高電位側の駆動電源電圧ＶＤＤＳと低電位側の駆動電源電圧ＶＳＳＳとが接続されたラダー抵抗を含んで構成される。この場合、ラダー抵抗の複数の電圧分割端子から基準電圧が発生される。各基準電圧は、階調データに対応した階調電圧になる。
【００８２】
ＤＡＣ３４は、基準電圧発生回路３３により生成された複数の基準電圧を用いて、Ｌ／Ｓ３２からの出力をアナログ階調電圧に変換する。より具体的には、ＤＡＣ３４は、階調データをデコードし、デコード結果に基づいて複数の基準電圧のいずれかを選択する。ＤＡＣ３４において選択された基準電圧は、アナログ階調電圧として出力回路３５に出力される。
【００８３】
出力回路３５は、ＤＡＣ３４からのアナログ階調電圧に基づいてデータ線ＤＬ１〜ＤＬＮを駆動する。このような出力回路３５では、インピーダンス変換回路としてのボルテージフォロワ接続された演算増幅器がデータ線単位に設けられる。
【００８４】
図４に、データ線駆動回路３０の構成要部を示す。図４においては、データ線ＤＬｎを駆動するデータ線駆動回路３０の要部を示している。
【００８５】
データ線ＤＬｎに対応する階調データは、ＤＡＣ３４ｎによりアナログ階調電圧に変換される。アナログ階調電圧は、出力回路３５ｎに入力される。出力回路３５ｎは、ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎを含む。出力回路３５ｎは、ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎによりデータ線ＤＬｎを駆動する。
【００８６】
出力回路３５ｎは、イネーブル信号ＥＮにより、イネーブル状態又はディセーブル状態に設定される。出力回路３５ｎは、イネーブル信号ＥＮによりディセーブル状態に設定されているとき、その出力をハイインピーダンス状態に設定する。またイネーブル状態に設定された出力回路３５ｎにより駆動されたデータ線ＤＬｎには、階調データに対応した電圧が印加される。
【００８７】
しかしながら、上述の極性反転駆動によりコモン電極ＣＯＭの電圧ＶＣＯＭが交互に電圧ＶＣ１、ＶＣ２となることにより、液晶素子に印加される電圧の極性が反転される。その結果、極性反転タイミングに合わせてデータ線ＤＬｎに蓄積された電荷が放電されることになる。
【００８８】
より具体的には、ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎが、高電位側の駆動電源電圧ＶＤＤＳと低電位側の駆動電源電圧ＶＳＳＳとの間の電圧を動作電圧として動作するものとすると、極性反転タイミングに合わせて、高電位側の駆動電源電圧ＶＤＤＳが供給される高電位側電源線又は低電位側の駆動電源電圧ＶＳＳＳが供給される低電位側電源線に、データ線ＤＬｎに蓄積された電荷が戻されることになる。
【００８９】
図５に、データ線から放電される場合について説明する図を示す。まず、コモン電極の電圧ＶＣＯＭは、電圧ＶＣ１であるものとする。図４に示すようにデータ線ＤＬｎは、データ線駆動回路３０の出力回路３５ｎにより駆動される。
【００９０】
そして、データ線ＤＬｎが充電され（ｔ１）、例えばデータ線ＤＬｎの電圧が５Ｖになる。そして、走査線ＧＬｍが選択されてＴＦＴｍｎがオンになり、ＴＦＴｍｎに接続された画素電極にデータ線ＤＬｎの電圧が書き込まれた後、ＴＦＴｍｎがオフとなる（ｔ２）。
【００９１】
極性反転タイミングｔ３において、コモン電極の電圧ＶＣＯＭが電圧ＶＣ１（「Ｌ」レベル）から電圧ＶＣ２（「Ｈ」レベル）に変化すると、データ線ＤＬｎの電圧が相対的に電圧（ＶＣ２−ＶＣ１）だけ上がる（ｔ４）。例えば期間ｔ１においてデータ線ＤＬｎの電圧が５Ｖになり、電圧ＶＣ１が０Ｖ、電圧ＶＣ２が５Ｖとすると、極性反転タイミングｔ３以降の期間ｔ４において、データ線ＤＬｎの電圧は１０Ｖとなる。
【００９２】
ところがデータ線ＤＬｎを駆動するデータ線駆動回路３０の出力回路３５ｎは、基準電圧より高い電圧が印加された信号線の電荷を低電位側の電源線に抜くように構成されている。図４に示すように、データ線ＤＬｎがボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎにより駆動される場合、データ線ＤＬｎの電圧が入力される信号の電圧より高くなると、データ線ＤＬｎと、低電位側の駆動電源電圧ＶＳＳＳが供給される低電位側電源線とが電気的に接続される。したがって、データ線ＤＬｎから放電された電荷は、低電位側電源線に抜ける。
【００９３】
図６に、ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎの構成例を示す。ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎの入力電圧Ｖｉｎとして、アナログ階調電圧が入力される。またボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎの出力電圧Ｖｏｕｔは、データ線ＤＬｎに出力される。ボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎは、差動増幅部４１ｎと、出力部４２ｎとを含む。
【００９４】
出力電圧Ｖｏｕｔが入力電圧Ｖｉｎより高い場合には、出力部４２ｎのｐ型トランジスタ４４がオフとなる。したがって、イネーブル信号ＥＮによりオン状態となるｎ型トランジスタ４６により構成される定電流源を介して、出力電圧Ｖｏｕｔが印加される出力信号線が、低電位側電源線と電気的に接続される。
【００９５】
このようにデータ線ＤＬｎがボルテージフォロワ接続された演算増幅器ＯＰＡＭＰｎにより駆動される場合、図５に示すように出力電圧であるデータ線ＤＬｎの電圧が入力される信号の電圧より高くなると、低電位側の駆動電源電圧ＶＳＳＳが供給される低電位側電源線に電荷が抜け、データ線ＤＬｎの電圧を高電位側電源線に供給される高電位側の駆動電源電圧ＶＤＤＳに戻してしまう（ｔ５）。そのため、図５において斜線部７０のデータ線ＤＬｎから放電される電荷に対応した電力が無駄に消費されてしまい、消費電力の増大を招く。
【００９６】
そこで第１の実施形態では、電源回路６０を以下のように構成することで、データ線ＤＬｎから放電される電荷の再利用を図り、消費電力の削減を実現する。
【００９７】
すなわち、第１の実施形態では、極性反転タイミングを含む所与の期間において、出力回路３５ｎの出力がハイインピーダンス状態に設定される。すると、データ線ＤＬｎから放電された電荷は、出力信号線に蓄積される。そのため、該出力信号線の電圧が上がる。
【００９８】
ところが、データ線駆動回路３０の出力端子には、出力保護回路４８ｎが接続されている。出力保護回路４８ｎは、ダイオード素子又はトランジスタによって構成されている。そのため、出力信号線に蓄積された電荷が、高電位側電源線に抜ける。その結果、データ線駆動回路３０の高電位側の駆動電源電圧が上がる。
【００９９】
データ線駆動回路３０の高電位側の駆動電源電圧は、電源回路６０からの高電位側電源線を介して供給される。電源回路６０は、高電位側電源線に対し、レギュレータにより高電位側の駆動電源電圧を供給する。このレギュレータは、例えば上述のボルテージフォロワ接続された演算増幅器により構成される場合、上述のように電圧が上がった高電位側の駆動電源電圧をそのまま該演算増幅器の出力に戻してしまうと、やはり電源回路６０の接地側電源線に電荷を戻してしまい、消費電力の増大を招く。
【０１００】
そのため、第１の実施形態における電源回路６０では、スイッチ回路を設けて、高電位側電源線の電荷を蓄積し、蓄積した電荷を利用して、該高電位側電源線を駆動するレギュレータに対して電源電圧を供給する。こうすることで、図５に示す斜線部７０に相当する電力の消費を抑えることができる。
【０１０１】
図７に、第１の実施形態における電源回路６０の構成の概要を示す。電源回路６０は、電圧発生回路６２と、電圧調整回路としてのレギュレータ６４と、第１及び第２のスイッチ回路ＳＷ１、ＳＷ２とを含む。
【０１０２】
電圧発生回路６２は、例えばシステム電源電圧ＶＤＤとしての第１の電圧が供給された電源線と、例えばシステム接地電源電圧ＶＳＳが供給された接地電源線との間に接続されたラダー抵抗を含む。ラダー抵抗の電圧分割端子からは、各種電源電圧が取り出される。図７においては、１つの電圧分割端子から取り出された電源電圧がレギュレータ６４の入力となるように接続されているが、レギュレータ６４の入力を第１の電圧とするように構成してもよい。
【０１０３】
レギュレータ６４は、図６に示した差動増幅部及び出力部を有するボルテージフォロワ接続された演算増幅器により構成される。レギュレータ６４は、データ線駆動回路３０の高電位側電源線を駆動する。
【０１０４】
高電位側電源線に接続される電源回路６０の出力ノードＮＤには、第１及び第２のスイッチ回路ＳＷ１、ＳＷ２が接続される。第１のスイッチ回路ＳＷ１の他端は、レギュレータ６４の出力に接続される。第２のスイッチ回路ＳＷ２の他端は、第１の電圧が供給される電源線に接続される。第１のスイッチ回路ＳＷ１は、ＳＷ１制御信号によりオン・オフ制御される。第２のスイッチ回路ＳＷ２は、ＳＷ２制御信号によりオン・オフ制御される。
【０１０５】
第１の実施形態における電源回路６０では、出力ノードＮＤをレギュレータ６４の電源電圧が供給される信号線（電源線）に接続し、高電位側電源線に蓄積された電荷を該電源線の寄生容量Ｃ０に蓄積することができる。ここで、寄生容量Ｃ０は、電源線と、所定の信号線又は基板との間に形成される容量ということもできる。
【０１０６】
図８に、第１及び第２のスイッチ回路ＳＷ１、ＳＷ２の制御タイミングの一例を示す。極性反転タイミングを含む期間ＴＭ１（所与の期間）では、データ線駆動回路３０の出力回路３５ｎの出力がハイインピーダンス状態にされる。より具体的には、極性反転タイミングのうち、対向電極ＣＯＭの電圧ＶＣＯＭが「Ｌ」レベルから「Ｈ」レベルに変化するタイミングを含む期間ＴＭ１では、データ線駆動回路３０の出力回路３５ｎの出力がハイインピーダンス状態にされる。これにより、データ線の放電が行われ、データ線駆動回路３０の高電位側電源線の電圧が上がる。
【０１０７】
そこで、該期間ＴＭ１において、ＳＷ１制御信号により第１のスイッチ回路ＳＷ１をオフに設定し、かつＳＷ２制御信号により第２のスイッチ回路ＳＷ２をオンに設定する。これにより、出力ノードＮＤとレギュレータ６４の電源線とが電気的に接続される。したがって、高電位側電源線の電荷が、電源線の寄生容量Ｃ０に蓄積される。
【０１０８】
そして、該期間ＴＭ１以降において、ＳＷ１制御信号により第１のスイッチ回路ＳＷ１をオンに設定し、かつＳＷ２制御信号により第２のスイッチ回路ＳＷ２をオフに設定する。これにより、出力ノードＮＤとレギュレータ６４の電源線とが電気的に遮断されると共に、出力ノードＮＤとレギュレータ６４の出力とが電気的に接続される。レギュレータ６４は、電源線の寄生容量Ｃ０により発生した電圧により、電圧発生回路６２の分割電圧に基づいて高電位側電源線を駆動する。
【０１０９】
なお所与の期間は、極性タイミングの前の所定の期間と、極性タイミングの後の所定の期間のうち、少なくとも一方を含むことができる。
【０１１０】
こうすることで、極性反転駆動により本来接地側に捨てられる電荷を再利用して、消費電力を削減することができる。
【０１１１】
１．２  変形例
図７においては、高電位電源線の電荷を、レギュレータ６４の電源電圧が供給される信号線（電源線）の寄生容量に蓄積させるようにしていたが、これに限定されるものではない。本変形例における電源回路では、第２のスイッチ回路ＳＷ２の他端と、システム電源電圧ＶＤＤが供給されるシステム電源線との間にキャパシタＣを設け、該キャパシタＣに高電位電源線の電荷を蓄積させるように構成される。
【０１１２】
図９に、本変形例における電源回路の構成例を示す。ただし、図７に示す電源回路６０と同一部分には同一符号を付し、適宜説明を省略する。本変形例における電源回路１００が図７に示す電源回路６０と異なる点は、第３のスイッチ回路ＳＷ３、キャパシタＣ及びダイオード素子（所定の素子）１０２を含む点である。
【０１１３】
第３のスイッチ回路ＳＷ３は、第２のスイッチ回路ＳＷ２の他端とレギュレータ６４の電源線との間に接続される。第３のスイッチ回路ＳＷ３は、ＳＷ３制御信号によりオン・オフ制御される。
【０１１４】
キャパシタＣは、第２のスイッチ回路ＳＷ２の他端とシステム電源線との間に接続される。システム電源線は、システム電源ＶＤＤが供給される電源線である。システム電源線は、またレギュレータの電源電圧を供給するための信号線ということもできる。
【０１１５】
ダイオード素子１０２は、システム電源線とレギュレータ６４の電源線との間に接続される。より具体的には、ダイオード素子１０２は、システム電源線からレギュレータ６４の電源線の方向が順方向となるように接続される。
【０１１６】
図１０に、第１〜第３のスイッチ回路ＳＷ１〜ＳＷ３の制御タイミングの一例を示す。第１及び第２のスイッチ回路ＳＷ１、ＳＷ２の制御タイミングは、図８と同様である。ＳＷ３制御信号は、ＳＷ１制御信号と同じタイミングで変化する。
【０１１７】
すなわち、期間ＴＭ１において、ＳＷ１制御信号により第１及び第３のスイッチ回路ＳＷ１、ＳＷ３をオフに設定し、かつＳＷ２制御信号により第２のスイッチ回路ＳＷ２をオンに設定する。これにより、電圧が上がった出力ノードＮＤの電荷が、キャパシタＣに蓄積される。
【０１１８】
そして、該期間ＴＭ１以降において、ＳＷ１制御信号及びＳＷ３制御信号により第１及び第３のスイッチ回路ＳＷ１、ＳＷ３をオンに設定し、かつＳＷ２制御信号により第２のスイッチ回路ＳＷ２をオフに設定する。これにより、キャパシタＣにより発生した電圧が、レギュレータ６４の電源線に供給される。レギュレータ６４は、キャパシタＣにより発生した電圧により、電圧発生回路６２の分割電圧に基づいて高電位側電源線を駆動する。こうすることで、極性反転駆動により本来接地側に捨てられる電荷を再利用して、消費電力を削減することができる。
【０１１９】
なお、図１１に示すように第３のスイッチ回路ＳＷ３を省略する構成にすることも可能である。この場合、ダイオード素子１０２を介してキャパシタＣの両端が接続される。したがって、キャパシタＣに高電位側電源線の電荷を蓄積することが可能となる。
【０１２０】
１．３  第２の実施形態
第２の実施形態では、以下に述べる構成を第１の実施形態の構成に代える又は加えることにより、本来捨てられる電荷を利用して、例えば走査線駆動回路４０に供給される負電圧を生成する。
【０１２１】
第１の実施形態では、コモン電極ＣＯＭの電圧ＶＣＯＭが「Ｌ」レベルから「Ｈ」レベルに変化するときにデータ線駆動回路の高電位側電源線に放電されるデータ線の電荷が蓄積される。これに対して第２の実施形態における以下の構成では、コモン電極の電圧ＶＣＯＭが「Ｈ」レベルから「Ｌ」レベルに変化するときにデータ線駆動回路の低電位側電源線に放電されるデータ線の電荷が蓄積される。そして、低電位側電源線に放電されるデータ線の電荷を、負電圧の生成に再利用する。
【０１２２】
図１２に、第２の実施形態における電源回路及びデータ線駆動回路の構成の要部を示す。ただし、図１に示す液晶パネル２０及び走査線駆動回路４０と同一部分には同一符号を付し、適宜説明を省略する。またデータ線駆動回路２５０は、図３に示すデータ線駆動回路３０の各部を含む。
【０１２３】
第２の実施形態における電源回路２００は、走査線駆動回路４０に対して接地電源電位に対して負側の電圧（負電圧）を出力することができる。そのため電源回路２００は、チャージポンプ２１０と、レギュレータ２２０とを含む。
【０１２４】
チャージポンプ２１０は、接地電源電位を基準として正側の所与の基準電圧ＶＮ０を、図示しない昇圧クロックに基づいて負方向に昇圧して負電圧ＶＮを生成する。
【０１２５】
レギュレータ２２０は、高電位側及び低電位側の電源線の電位差を動作電源電圧とする。レギュレータ２２０の高電位側の電源線は、システム接地電源線である。レギュレータ２２０の低電位側の電源線は、チャージポンプ２１０の出力電圧である負電圧ＶＮが供給される信号線である。レギュレータ２２０は、高電位側及び低電位側の電源線の電圧を抵抗分割した所与の分割電圧を入力とし、その調整電圧を走査線駆動回路４０に対して出力する。
【０１２６】
電源回路２００は、第４及び第５のスイッチ回路ＳＷ４、ＳＷ５を含む。第４のスイッチ回路ＳＷ４は、データ線駆動回路２５０及び走査線駆動回路４０の低電位側の駆動電源電圧ＶＳＳＳが供給される低電位側電源線と、システム接地電源電圧ＶＳＳが供給された接地電源線との間に挿入される。第５のスイッチ回路ＳＷ５は、データ線駆動回路２５０及び走査線駆動回路４０に接続される低電位側電源線と、ダイオード素子（所定の素子）２２２の一端との間に挿入される。ダイオード素子２２２の他端は、レギュレータ２２０の低電位側の電源線（チャージポンプ２１０の出力）に接続される。ダイオード素子２２２は、レギュレータ２２０の低電位側の電源線から第５のスイッチ回路ＳＷ５への方向が順方向となるように接続される。これにより、キャパシタＣ１の一端には、ほぼレギュレータ２２０の低電位側の電源線の電圧が供給される。
【０１２７】
第４のスイッチ回路ＳＷ４は、ＳＷ４制御信号によりオン・オフ制御される。第５のスイッチ回路ＳＷ５は、ＳＷ５制御信号によりオン・オフ制御される。
【０１２８】
第２の実施形態においても第１の実施形態と同様に、極性反転タイミングを含む所与の期間において、データ線駆動回路２５０の出力回路の出力がハイインピーダンス状態に設定される。すると、コモン電極ＣＯＭの電圧ＶＣＯＭが「Ｈ」レベルから「Ｌ」レベルに変化し、データ線ＤＬｎから放電され、出力信号線の電圧が下がる。
【０１２９】
ところが、データ線駆動回路２５０の出力端子に接続される出力保護回路によって、出力信号線に蓄積された電荷が、低電位側電源線に抜ける。その結果、データ線駆動回路の低電位側の駆動電源電圧が下がる。
【０１３０】
データ線駆動回路２５０の低電位側の駆動電源電圧は、電源回路２００からの低電位側電源線を介して供給される。そのため、第２の実施形態における電源回路２００では、スイッチ回路を設けて低電位側電源線に放電される電荷を蓄積し、蓄積した電荷を、負電圧を出力するレギュレータ２２０の低電位側の電源に利用する。
【０１３１】
図１３に、第４及び第５のスイッチ回路ＳＷ４、ＳＷ５の制御タイミングの一例を示す。極性反転タイミングを含む期間ＴＭ２（所与の期間）では、データ線駆動回路２５０の出力回路の出力がハイインピーダンス状態にされる。より具体的には、極性反転タイミングのうち、対向電極ＣＯＭの電圧ＶＣＯＭが「Ｈ」レベルから「Ｌ」レベルに変化するタイミングを含む期間ＴＭ２では、データ線駆動回路２５０の出力回路の出力がハイインピーダンス状態にされる。これにより、データ線駆動回路２５０の低電位側電源線の電圧が下がる。
【０１３２】
そこで、該期間ＴＭ２において、ＳＷ４制御信号により第４のスイッチ回路ＳＷ４をオフに設定し、かつＳＷ５制御信号により第５のスイッチ回路ＳＷ５をオンに設定する。これにより、低電位側電源線とキャパシタＣ１とが電気的に接続される。したがって、低電位側電源線の電荷が、キャパシタＣ１に蓄積される。
【０１３３】
そして、該期間ＴＭ２以降において、ＳＷ４制御信号により第４のスイッチ回路ＳＷ４をオンに設定し、かつＳＷ５制御信号により第５のスイッチ回路ＳＷ５をオフに設定する。これにより、キャパシタＣ１により発生した電圧がレギュレータ２２０の低電位側の電源線に印加される。
【０１３４】
なお所与の期間は、極性タイミングの前の所定の期間と、極性タイミングの後の所定の期間のうち、少なくとも一方を含むことができる。
【０１３５】
こうすることで、極性反転駆動により本来接地側に捨てられる電荷を再利用して、消費電力を削減することができる。
【０１３６】
なおキャパシタＣ１、ダイオード素子２２２を省略して、第５のスイッチ回路ＳＷ５が、走査線駆動回路４０及びデータ線駆動回路２５０に接続される低電位側電源線とレギュレータ２２０の低電位側の電源線との間に接続される構成にしてもよい。この場合、レギュレータ２２０の低電位側の電源線の寄生容量に、低電位側電源線に放電された電荷が蓄積される。
【０１３７】
なおデータ線駆動回路２５０が、いわゆるトリプルウェル構造で形成される場合には、接地電源電位よりも負側の電圧を生成することができる。したがって、上述の構成で電荷の再利用を図ることができる。
【０１３８】
しかしながら、データ線駆動回路２５０が、いわゆるツインウェル構造で形成される場合には、接地電源電位よりも負側の電圧を生成することができない。そのため、データ線駆動回路２５０に外部から入力される信号の論理レベルが「Ｌ」の場合、データ線駆動回路２５０の内部で認識される論理レベルが変わってしまう場合がある。そこで、データ線駆動回路２５０では、入力制御回路２５２を含む。
【０１３９】
図１４に、入力制御回路２５２の構成例を示す。
【０１４０】
入力制御回路２５２は、バッファ回路２５４と、ラッチ回路２５６とを含む。バッファ回路２５４は、マイナスプリチャージ信号ｍｐによりイネーブル制御される。ラッチ回路２５６は、マイナスプリチャージ信号ｍｐの反転信号によりイネーブル制御される。マイナスプリチャージ信号ｍｐは、図１３に示すＳＷ４制御信号と同様のタイミングで変化する信号である。こうすることで、電圧ＶＣＯＭの変化する期間ＴＭ２では、入力信号が入力されるバッファ回路２５４がディセーブル状態に設定されるため、入力信号を受け付けない。そのため、入力信号の誤った論理レベルを認識してしまうことがなくなる。
【０１４１】
なお、マイナスプリチャージ信号ｍｐによりラッチ回路２５６でラッチされた信号が出力される信号は、データ線駆動回路の接地電源電圧に固定されることが望ましい。データ線駆動回路の高電位側の電源電圧に固定されると、耐圧の問題が生じてしまうからである。
【０１４２】
またコントローラ５０では、極性反転タイミングが予め認識されていることから、コントローラ５０がデータ線駆動回路３０、走査線駆動回路４０及び電源回路６０に対する制御信号の出力を停止し、かつその出力をシステム接地電源電圧（コントローラの低電位側の電源電圧）に固定することが望ましい。
【０１４３】
また、このような入力制御回路２５２を設けることなく、差動で動作する入力信号を設けるようにすることも可能である。
【０１４４】
２．  その他
近年、情報機器の小型軽量化や高画質化の要求により、表示パネルの小型化、画素の微細化が望まれている。その１つの解決策として、低温ポリシリコン（Low Temperature Poly-Silicon：以下ＬＴＰＳと略す。）プロセスにより、表示パネルを形成することが検討されている。
【０１４５】
ＬＴＰＳプロセスによれば、スイッチ素子（例えば、薄膜トランジスタ（Thin Film Transistor：ＴＦＴ））等を含む画素が形成されるパネル基板（例えばガラス基板）上に、駆動回路等を直接形成することができる。そのため、部品数を削減し、表示パネルの小型軽量化が可能となる。またＬＴＰＳでは、これまでのシリコンプロセスの技術を応用して、開口率を維持したまま画素の微細化を図ることができる。更にまたＬＴＰＳは、アモルファスシリコン（amorphous silicon：ａ−Ｓｉ）に比べて電荷の移動度が大きく、かつ寄生容量が小さい。したがって、画面サイズの拡大により１画素当たりの画素選択期間が短くなった場合でも、当該基板上に形成された画素の充電期間を確保し、画質の向上を図ることが可能となる。
【０１４６】
このようなＬＴＰＳプロセスにより形成された表示パネル（液晶パネル）に対しても、上述した実施形態を適用することができる。
【０１４７】
図１５に、ＬＴＰＳプロセスにより形成された液晶パネルの構成の概要を示す。ＬＴＰＳプロセスにより形成された液晶パネル５００は、複数の走査線と、複数のデータ線と、複数の画素とを含む。複数の走査線と複数のデータ線とは、互いに交差するように配置される。画素は、走査線とデータ線とにより特定される。
【０１４８】
液晶パネル５００では、各走査線（ＧＬ）及び各データ線（ＤＬ）により３画素単位で選択される。選択された各画素には、データ線に対応する３本の色成分用データ線（Ｒ、Ｇ、Ｂ）のいずれかを伝送する各色成分用信号が書き込まれる。各画素は、ＴＦＴと画素電極とを含む。
【０１４９】
液晶パネル５００では、例えばガラス基板等のパネル基板上に走査線及びデータ線が形成される。より具体的には、図１５に示すパネル基板上に、Ｙ方向に複数配列されそれぞれＸ方向に伸びる走査線ＧＬ１〜ＧＬＭと、Ｘ方向に複数配列されそれぞれＹ方向に伸びるデータ線ＤＬ１〜ＤＬＮとが形成されている。更に該パネル基板上には、Ｘ方向に第１〜第３の色成分用データ線を１組として複数組配列されそれぞれＹ方向に伸びる色成分用データ線（Ｒ１、Ｇ１、Ｂ１）〜（ＲＮ、ＧＮ、ＢＮ）が形成されている。
【０１５０】
走査線ＧＬ１〜ＧＬＭと、第１の色成分用データ線Ｒ１〜ＲＮとの交差位置に、Ｒ用画素（第１の色成分用画素）ＰＲ（ＰＲ１１〜ＰＲＭＮ）が設けられている。走査線ＧＬ１〜ＧＬＭと、第２の色成分用データ線Ｇ１〜ＧＮとの交差位置に、Ｇ用画素（第２の色成分用画素）ＰＧ（ＰＧ１１〜ＰＧＭＮ）が設けられている。走査線ＧＬ１〜ＧＬＭと、第３の色成分用データ線Ｂ１〜ＢＮとの交差位置に、Ｂ用画素（第３の色成分用画素）ＰＢ（ＰＢ１１〜ＰＢＭＮ）が設けられている。
【０１５１】
Ｒ用画素ＰＲ、Ｇ用画素ＰＧ及びＢ用画素ＰＢは、それぞれ図１に示した画素ＰＥｍｎと同様の構成であるため説明を省略する。
【０１５２】
また図１５において、パネル基板上には、各データ線に対応して設けられたデマルチプレクサ（demultiplexer）ＤＭＵＸ１〜ＤＭＵＸＮとが設けられている。デマルチプレクサＤＭＵＸ１〜ＤＭＵＸＮには、デマルチプレクス制御信号が入力される。デマルチプレクス制御信号は、各デマルチプレクサのスイッチ制御を行うための信号である。
【０１５３】
ゲート信号ＧＡＴＥ１〜ＧＡＴＥＭは、それぞれ走査線ＧＬ１〜ＧＬＭに出力される。ゲート信号ＧＡＴＥ１〜ＧＡＴＥＭは、スタートパルス信号により開始される１フレームの垂直走査期間においていずれか１つがアクティブとなるパルス信号である。
【０１５４】
デマルチプレクス制御信号は、例えば上述の実施形態におけるデータ線駆動回路から供給される。またデータ線ＤＬ１〜ＤＬＮは、上述の実施形態におけるデータ線駆動回路により駆動される。データ線駆動回路は、色成分用画素ごとに時分割され各色成分の階調データに対応した電圧（データ信号）を、各色成分用データ線に出力する。そしてデータ線駆動回路は、時分割のタイミングに合わせて、各色成分の階調データに対応した電圧を各色成分用データ線に選択出力するためのデマルチプレクス制御信号を生成し、液晶パネル５００に対して出力する。
【０１５５】
図１６に、データ線駆動回路によりデータ線に出力されるデータ信号とデマルチプレクス制御信号との関係を模式的に示す。ここでは、データ線ＤＬｎに出力されたデータ信号ＤＡＴＡｎを示す。
【０１５６】
データ線駆動回路は、データ線ごとに、各色成分用の階調データ（表示データ）に対応した電圧が時分割により多重化されたデータ信号を出力する。図１６では、データ線駆動回路は、Ｒ用画素への書込信号、Ｇ用画素への書込信号及びＢ用画素への書込信号を多重化してデータ線ＤＬｎに出力する。ここで、Ｒ用画素への書込信号は、データ線ＤＬｎに対応するＲ用画素ＰＲ１ｎ〜ＰＲＭｎのうち、例えば走査線ＧＬｍにより選択されるＲ用画素ＰＲｍｎへの書込信号である。Ｇ用画素への書込信号は、データ線ＤＬｎに対応するＧ用画素ＰＧ１ｎ〜ＰＧＭｎのうち、例えば走査線ＧＬｍにより選択されるＧ用画素ＰＧｍｎへの書込信号である。Ｂ用画素への書込信号は、データ線ＤＬｎに対応するＢ用画素ＰＢ１ｎ〜ＰＢＭｎのうち、例えば走査線ＧＬｍにより選択されるＢ用画素ＰＢｍｎへの書込信号である。
【０１５７】
またデータ線駆動回路は、データ信号ＤＡＴＡｎにおいて多重化される各色成分用書込信号の時分割タイミングに合わせて、デマルチプレクス制御信号を生成する。デマルチプレクス制御信号は、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）からなる。
【０１５８】
またパネル基板上には、データ線ＤＬｎに対応するデマルチプレクサＤＭＵＸｎが設けられている。デマルチプレクサＤＭＵＸｎは、第１〜第３のデマルチプレクス用スイッチ素子ＤＳＷ１〜ＤＳＷ３を含む。
【０１５９】
デマルチプレクサＤＭＵＸｎの出力側には、第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）が接続される。また、入力側には、データ線ＤＬｎが接続される。デマルチプレクサＤＭＵＸｎは、デマルチプレクス制御信号に応じて、データ線ＤＬｎと、第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）のいずれかとを、電気的に接続する。デマルチプレクサＤＭＵＸ１〜ＤＭＵＸＮには、それぞれ共通にデマルチプレクス制御信号が入力される。
【０１６０】
第１のデマルチプレクス用スイッチ素子ＤＳＷ１は、第１のデマルチプレクス制御信号Ｒｓｅｌによりオン・オフ制御される。第２のデマルチプレクス用スイッチ素子ＤＳＷ２は、第２のデマルチプレクス制御信号Ｇｓｅｌによりオン・オフ制御される。第３のデマルチプレクス用スイッチ素子ＤＳＷ３は、第３のデマルチプレクス制御信号Ｂｓｅｌによりオン・オフ制御される。第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）は周期的に順次アクティブとなる。そのため、デマルチプレクサＤＭＵＸｎは、周期的に、データ線ＤＬｎと第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）とを順次電気的に接続する。
【０１６１】
このような構成の液晶パネル５００において、時分割された第１〜第３の色成分用の階調データに対応した電圧が、データ線ＤＬｎに出力される。デマルチプレクサＤＭＵＸｎでは、時分割タイミングに合せて生成された第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）により、各色成分の階調データに対応した電圧が、第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）に印加される。このとき、走査線ＧＬｍにより選択された第１〜第３の色成分用画素（ＰＲｍｎ、ＰＧｍｎ、ＰＢｍｎ）のいずれかにおいて、色成分用データ線と画素電極とが電気的に接続される。
【０１６２】
以上のような構成の液晶パネル５００に対しても、第１又は第２の実施形態における電源回路を適用することができる。
【０１６３】
図１７に、液晶パネル５００に第１及び第２の実施形態における電源回路を適用した場合の制御タイミングの一例を示す。ここでは、図７又は図１１に示すように高電位側電源線に放電された電荷を蓄積すると共に、図１２に示すように低電位側電源線に放電された電荷を蓄積する場合について示す。
【０１６４】
このように極性反転タイミングを含む所与の期間ＴＭ１、ＴＭ２において、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が同時にオンとなる。より具体的には、コモン電極ＣＯＭの電圧ＶＣＯＭが「Ｌ」レベルから「Ｈ」レベルに変化するタイミングを含む期間ＴＭ１と、電圧ＶＣＯＭが「Ｈ」レベルから「Ｌ」レベルに変化するタイミングを含む期間ＴＭ２において、第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）とデータ線ＤＬｎとが電気的に接続される。したがって、期間ＴＭ１、ＴＭ２において、第１〜第３の色成分用データ線（Ｒｎ、Ｇｎ、Ｂｎ）とデータ線ＤＬｎとに蓄積された電荷の放電が行われることになる。
【０１６５】
なおデマルチプレクサＤＭＵＸ１〜ＤＭＵＸＮのすべてを第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）により、各デマルチプレクサの第１〜第３のデマルチプレクス用スイッチ素子ＤＳＷ１〜ＤＳＷ３を同時にオンにするようにしてもよいし、データ線がハイインピーダンス状態に設定されたデマルチプレクサのみの第１〜第３のデマルチプレクス用スイッチ素子ＤＳＷ１〜ＤＳＷ３を同時にオンにするようにしてもよい。
【０１６６】
なお、本発明は上述した実施の形態に限定されるものではなく、本発明の要旨の範囲内で種々の変形実施が可能である。
【０１６７】
また、本発明のうち従属請求項に係る発明においては、従属先の請求項の構成要件の一部を省略する構成とすることもできる。また、本発明の１の独立請求項に係る発明の要部を、他の独立請求項に従属させることもできる。
【図面の簡単な説明】
【図１】  液晶装置の構成の概要を示す構成図。
【図２】  走査ライン反転駆動の説明図。
【図３】  データ線駆動回路の構成例を示すブロック図。
【図４】  データ線駆動回路の構成要部を示す構成図。
【図５】  データ線から放電される場合について説明する図。
【図６】  ボルテージフォロワ接続された演算増幅器の構成例を示す回路図。
【図７】  第１の実施形態における電源回路の構成の概要を示す構成図。
【図８】  第１及び第２のスイッチ回路の制御タイミングの一例を示すタイミング図。
【図９】  本変形例における電源回路の構成例を示す構成図。
【図１０】  第１〜第３のスイッチ回路の制御タイミングの一例を示すタイミング図。
【図１１】  図９の構成から第３のスイッチ回路を省略した場合の電源回路の構成例を示す構成図。
【図１２】  第２の実施形態における電源回路及びデータ線駆動回路の構成の要部を示す構成図。
【図１３】  第４及び第５のスイッチ回路の制御タイミングの一例を示すタイミング図。
【図１４】  入力制御回路の構成例を示す回路図。
【図１５】  ＬＴＰＳプロセスにより形成された液晶パネルの構成の概要を示す構成図。
【図１６】  データ線駆動回路によりデータ線に出力されるデータ信号とデマルチプレクス制御信号との関係を示す模式図。
【図１７】  ＬＴＰＳプロセスにより形成された液晶パネルに第１及び第２の実施形態における電源回路を適用した場合の制御タイミングの一例を示すタイミング図。
【符号の説明】
１０  液晶装置、２０、５００  液晶パネル、３０、２５０  データ線駆動回路（ソースドライバ）、３１  データラッチ、３２  Ｌ／Ｓ、３３  基準電圧発生回路、３４  ＤＡＣ、３５、３５ｎ  出力回路、４０  走査線駆動回路、４１ｎ差動増幅部、４２ｎ  出力部、４８ｎ  出力保護回路、５０  コントローラ、６０、１００、２００  電源回路、６２  電圧発生回路、６４、２２０  レギュレータ（電圧調整回路）、１０２、２２２  ダイオード素子、２５２  入力制御回路、２５４  バッファ回路、２５６  ラッチ回路
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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