(57)【特許請求の範囲】
【請求項１】
サーボ同期検出器によりシステムクロックに同期させて出力されるＥＲＤ(Encoded Read Data)からサーボアドレスマークを検出するサーボアドレスマーク検出器と、サーボアドレスマーク検出時点に同期してサーボ情報及びデータ情報を検出するための初期値を貯蔵出力する制御手段とを備えたディスク駆動記録装置のサーボアドレスマーク自動検出及びタイミング補償回路であって、
前記制御手段からロードされるウインドウ値に従うサーボアドレスマークウィンドウ内でサーボアドレスマークが検出されない場合にサーボアドレスマーク検出ミス信号とカウント調整信号を出力するサーボアドレスマーク検出ウィンドウ生成器、
前記サーボアドレスマーク検出器によるサーボアドレスマーク検出出力に従ってリセットされ、前記サーボアドレスマーク検出ミス信号をカウントした値が前記制御手段によってロードされた値と一致する場合にサーボアドレスマークサーチ信号及び擬似サーボアドレスマークを出力するサーボアドレスマーク検出ミス信号カウンタ、
前記制御手段による選択信号に応じて前記サーボアドレスマークサーチ信号及び前記擬似サーボアドレスマークを選択するサーボアドレスマークサーチモード制御器、
前記サーボアドレスマーク検出出力に応じてサーボタイミング生成のための基準パルスを出力する基準パルス生成器と、前記基準パルスが出力されると前記システムクロックをカウントし、その際に前記カウント調整信号が出力されているときには前記制御手段からロードされた値から前記システムクロックをカウントするメインカウンタと、該メインカウンタのカウント値が前記制御手段によってロードされた値と一致する場合にサーボアドレスマークウィンドウ信号をエネーブルさせるためのデータセクタ終了パルスを出力するデータセクタ終了パルス生成器と、から構成され、サーボタイミングの遅延を補償するタイミング補償回路、
を有してなることを特徴とするサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項２】
サーボアドレスマーク検出ミス信号がサーボアドレスマークウィンドウ終了時にエネーブルされる請求項１記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項３】
カウント調整信号がサーボアドレスマーク検出ミス信号の反転信号である請求項２記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項４】
サーボアドレスマーク検出器は、サーボアドレスマークサーチ信号によってエネーブルされる請求項３記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項５】
基準パルス生成器は、サーボアドレスマーク検出器によるサーボアドレスマーク検出出力の立ち上がりエッジで電源電圧をクロッキングしてサーボアドレスマーク検出信号を出力する第１フリップフロップと、該第１フリップフロップの出力とサーボアドレスマーク検出ミス信号を論理和する第１ＯＲゲートと、該第１ＯＲゲートの出力の立ち上がりエッジで電源電圧をクロッキングして基準パルスを出力する第２フリップフロップと、から構成される請求項４記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項６】
メインカウンタは、基準パルス生成器から出力される基準パルスをシステムクロックと論理積する第１ＡＮＤゲートと、該第１ＡＮＤゲートの出力をカウントし、その際にカウント調整信号が出力されているときには制御手段からロードされた値から前記第１ＡＮＤゲートの出力をカウントするカウンタと、から構成される請求項５記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項７】
データセクタ終了パルス生成器は、メインカウンタから出力されるカウント値が制御手段によってロードされた値と一致する場合にデータセクタ終了パルスを出力する第１比較器と、基準パルスとシステムクロックの論理積信号の立ち上がりエッジで前記データセクタ終了パルスをラッチして出力する第３フリップフロップと、から構成される請求項６記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項８】
サーボアドレスマーク検出ウィンドウ生成器は、サーボアドレスマーク検出出力によってリセットされ、データセクタ終了パルス生成器によるデータセクタ終了パルスの立ち上がりエッジで電源電圧をラッチして出力する第４フリップフロップと、該第４フリップフロップの出力とシステムクロックを論理積する第２ＡＮＤゲートと、前記サーボアドレスマーク検出出力によってリセットされ、前記第２ＡＮＤゲートの出力をカウントする第２カウンタと、該第２カウンタから出力されるカウント値と制御手段からロードされた値が一致する場合にサーボアドレスマーク検出ミス信号を出力する第２比較器と、前記第２ＡＮＤゲートの反転出力の立ち上がりエッジで前記サーボアドレスマーク検出ミス信号をラッチして出力する第５フリップフロップと、から構成される請求項７記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項９】
サーボアドレスマークサーチモード制御器は、サーボアドレスマーク検出ミス信号の立ち上がりエッジでサーボアドレスマーク検出ミス信号カウンタから出力されるサーボアドレスマークサーチ信号をラッチして出力する第６フリップフロップと、前記サーボアドレスマーク検出ミス信号の立ち上がりエッジで前記サーボアドレスマーク検出ミス信号カウンタから出力される擬似サーボアドレスマークをラッチして出力する第７フリップフロップと、から構成される請求項８記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項１０】
第６フリップフロップは、サーボアドレスマーク検出信号によってリセットされる請求項９記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【請求項１１】
第７フリップフロップは、データセクタ終了パルスによってリセットされる請求項１０記載のサーボアドレスマーク自動検出及びタイミング補償回路。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、フレキシブルディスクドライブやハードディスクドライブなどディスク状記録担体を駆動するディスク駆動記録装置のヘッド制御に関する。
【０００２】
【従来の技術】
ハードディスクなどのディスクは、ディスクの中心から同心円状にトラック分割され、各トラックは更にサーボセクタとデータセクタに分割される。サーボセクタはヘッド位置制御のためのサーボ情報が所定のサーボ記録パターンに応じて記録される領域で、データセクタはホストコンピュータの利用するデータが記録される領域である。
【０００３】
サーボセクタの開始点には、サーボ情報検出の同期を提供するサーボアドレスマーク（Servo Address Mark: ＳＡＭ）が記録される。このＳＡＭ領域には通常、サーボセクタ及びデータセクタで他には使用されない専用パターンが記録される。ディスク駆動記録装置は、ＳＡＭの検出時点から同期してインデックス、アドレス、バーストなどのサーボ情報及びデータを検出するためのサンプリング区間を定めるウィンドウ信号を生成して出力する。
【０００４】
図１を参照して、このようなＳＡＭ検出過程につきハードディスクドライブを例にして説明する。図１に示すのは、ハードディスクドライブの概略構成を説明したブロック図である。
【０００５】
ＨＤＡ(Head Disk Assembly)１０は、データ書込／読出のための磁気ヘッドと、スピンドルモータにより定速回転する磁気ディスクと、を備えた主要部分である。このＨＤＡ１０のヘッドによる読出信号は前置増幅器１２で増幅されてから読出／書込チャンネル回路１４へ送られ、ＥＲＤ(Encoded Read Data) にデコードされてゲートアレイ２６へ提供される。また読出／書込チャンネル回路１４は、ＣＰＵ２２の制御で、書込データを受けてコード化しヘッドへ出力する。
【０００６】
ゲートアレイ２６は、読出／書込チャンネル回路１４から入力されるＥＲＤからサーボパターンを検出し、データ入出力、デコーディング、エンコーディングのためのウィンドウ信号、タイミングクロックを生成して出力する。なお図１では、ハードディスクドライブにおけるゲートアレイのうち、ＳＡＭ検出過程に関するＳＡＭ検出器１６、サーボタイミングカウンタ１８、及びデータセクタ終了パルス生成器２０のみが示されている。
【０００７】
制御手段であるＣＰＵ２２はハードディスクドライブの全般的な制御を実行し、パワーオン時にＳＡＭスタート信号をＳＡＭ検出器１６へ出力してＳＡＭの検出を開始させる。ＳＡＭ検出器１６は、ＣＰＵ２２から入力されるＳＡＭスタート信号によってエネーブルされ、エネーブル期間にＥＲＤからＳＡＭが検出されると、同期信号ＳＹＮＣをサーボタイミングカウンタ１８へ出力する。サーボタイミングカウンタ１８は、ＳＡＭ検出器１６から入力される同期信号によりリセットされてカウント動作を行い、そのカウント値をデータセクタ終了パルス生成器２０へ出力する。データセクタ終了パルス生成器２０は、サーボタイミングカウンタ１８から入力されるカウント値がＣＰＵ２２によってロードされたロード値に一致すると、データセクタの終了を知らせるＥＮＤＳ(End of Sector) 信号をＳＡＭ検出器１６へ出力する。このデータセクタ終了パルス生成器２０からＥＮＤＳ信号が入力されるとＳＡＭ検出器１６は再びエネーブルされ、次のＳＡＭを検出する。
【０００８】
【発明が解決しようとする課題】
上記従来のディスク駆動記録装置においてＣＰＵ２２は、ＳＡＭ検出器１６からサーボセクタごとに検出フラグ(Detect Flag) ＤＦを確認し、ＳＡＭ検出器１６をソフトウェア的に制御する。従って、ディスクの所定トラックにＮ個のサーボセクタが構成されているとすれば、ＣＰＵ２２は、Ｎ個のサーボセクタにつきＮ回のインタラプト（割り込み）を受けてサーボ状態をチェックしなければならない。このときに検出フラグにエラーが発生すると、ＣＰＵ２２は全てのサーボ関連タイミングの生成を止めてＳＡＭ検出を再試行するためのスタート信号をＳＡＭ検出器１６へ出力しなければならなくなる。即ち、従来のハードディスクドライブにおいては、ＳＡＭ検出ミス時にＳＡＭ検出を再試行するＣＰＵ２２がオーバーロードになるという問題があった。
【０００９】
このような課題に着目して本発明の目的は、ＳＡＭ検出ミスがあると自動的にＳＡＭを検出すると共に、ＳＡＭ検出ミスによるサーボタイミング遅延を補償し得るＳＡＭ自動検出及びタイミング補償のための回路つまりハードウェアを提供することにある。
【００１０】
【課題を解決するための手段】
この目的のために本発明は、サーボ同期検出器によりシステムクロックに同期させて出力されるＥＲＤ(Encoded Read Data)からサーボアドレスマークを検出するサーボアドレスマーク検出器と、サーボアドレスマーク検出時点に同期してサーボ情報及びデータ情報を検出するための初期値を貯蔵出力する制御手段とを備えたディスク駆動記録装置において、前記制御手段からロードされるウインドウ値に従うサーボアドレスマークウィンドウ内でサーボアドレスマークが検出されない場合にサーボアドレスマーク検出ミス信号とカウント調整信号を出力するサーボアドレスマーク検出ウィンドウ生成器と、前記サーボアドレスマーク検出器によるサーボアドレスマーク検出出力に従ってリセットされ、前記サーボアドレスマーク検出ミス信号をカウントした値が前記制御手段によってロードされた値と一致する場合にサーボアドレスマークサーチ信号及び擬似サーボアドレスマークを出力するサーボアドレスマーク検出ミス信号カウンタと、前記制御手段による選択信号に応じて前記サーボアドレスマークサーチ信号及び前記擬似サーボアドレスマークを選択するサーボアドレスマークサーチモード制御器と、前記カウント調整信号が出力されたときに、前記制御手段からロードされた値からシステムクロックをカウントし、サーボタイミングの遅延を補償するタイミング補償回路と、を有してなるサーボアドレスマーク自動検出及びタイミング補償回路を備えることを特徴とする。
【００１１】
タイミング補償回路は、サーボアドレスマーク検出器によるサーボアドレスマーク検出出力に応じてサーボタイミング生成のための基準パルスを出力する基準パルス生成器と、前記基準パルスが出力されるとシステムクロッ−をカウントし、その際にカウント調整信号が出力されているときには制御手段からロードされた値から前記システムクロックをカウントするメインカウンタと、該メインカウンタのカウント値が前記制御手段によってロードされた値と一致する場合にサーボアドレスマークウィンドウ信号をエネーブルさせるためのデータセクタ終了パルスを出力するデータセクタ終了パルス生成器と、から構成可能である。サーボアドレスマーク検出ミス信号はサーボアドレスマークウィンドウ終了時にエネーブルされるものとし、カウント調整信号はサーボアドレスマーク検出ミス信号の反転信号とすることができる。またサーボアドレスマーク検出器は、サーボアドレスマークサーチ信号によってエネーブルされるようにしておく。
【００１２】
基準パルス生成器は、サーボアドレスマーク検出器によるサーボアドレスマーク検出出力の立ち上がりエッジで電源電圧をクロッキングして出力する第１フリップフロップと、該第１フリップフロップの出力とサーボアドレスマーク検出ミス信号を論理和する第１ＯＲゲートと、該第１ＯＲゲートの出力の立ち上がりエッジで電源電圧をクロッキングして基準パルスを出力する第２フリップフロップと、から構成可能である。また、メインカウンタは、基準パルス生成器から出力される基準パルスをシステムクロックと論理積する第１ＡＮＤゲートと、該第１ＡＮＤゲートの出力をカウントし、その際にカウント調整信号が出力されているときには制御手段からロードされた値から前記第１ＡＮＤゲートの出力をカウントするカウンタと、から構成可能である。そしてデータセクタ終了パルス生成器は、メインカウンタから出力されるカウント値が制御手段によってロードされた値と一致する場合にデータセクタ終了パルスを出力する第１比較器と、基準パルスとシステムクロックの論理積信号の立ち上がりエッジで前記データセクタ終了パルスをラッチして出力する第３フリップフロップと、から構成可能である。
【００１３】
サーボアドレスマーク検出ウィンドウ生成器は、サーボアドレスマーク検出出力によってリセットされ、データセクタ終了パルス生成器によるデータセクタ終了パルスの立ち上がりエッジで電源電圧をラッチして出力する第４フリップフロップと、該第４フリップフロップの出力とシステムクロックを論理積する第２ＡＮＤゲートと、前記サーボアドレスマーク検出出力によってリセットされ、前記第２ＡＮＤゲートの出力をカウントする第２カウンタと、該第２カウンタから出力されるカウント値と制御手段からロードされた値が一致する場合にサーボアドレスマーク検出ミス信号を出力する第２比較器と、前記第２ＡＮＤゲートの反転出力の立ち上がりエッジで前記サーボアドレスマーク検出ミス信号をラッチして出力する第５フリップフロップと、から構成可能である。
【００１４】
サーボアドレスマークサーチモード制御器は、サーボアドレスマーク検出ミス信号の立ち上がりエッジでサーボアドレスマーク検出ミス信号カウンタから出力されるサーボアドレスマークサーチ信号をラッチして出力する第６フリップフロップと、前記サーボアドレスマーク検出ミス信号の立ち上がりエッジで前記サーボアドレスマーク検出ミス信号カウンタから出力される擬似サーボアドレスマークをラッチして出力する第７フリップフロップと、から構成可能で、その第６フリップフロップは、サーボアドレスマーク検出信号によってリセットされ、第７フリップフロップは、データセクタ終了パルスによってリセットされる構成しておく。
【００１５】
【発明の実施の形態】
以下、本発明の実施形態につき添付図面を参照して詳細に説明する。
【００１６】
図２は、本発明のＳＡＭ自動検出及びタイミング補償手段を設けたハードディスクドライブの概略構成を示したブロック図である。ＨＤＡ１０、前置増幅器１２、読出／書込チャンネル回路１４については従来同様である。
【００１７】
サーボ同期検出器３０は、読出／書込チャンネル回路１４によるＥＲＤからサーボ同期信号を検出して、これをシステムクロックに同期させて出力する。ＳＡＭ検出器１６は、そのシステムクロックに同期したＥＲＤからＳＡＭを検出してタイミング補償回路３１へ出力する。このＳＡＭ検出器１６から出力されるＳＡＭ検出出力ＳＤＯ(SAM Detect Output) を受けるタイミング補償回路３１は、基準パルス生成器３２、メインカウンタ３４、及びデータセクタ終了パルス生成器２０で構成され、ＳＡＭ検出ミス時にサーボサンプリングタイミングを補償する機能をもつ。
【００１８】
基準パルス生成器３２は、ＳＡＭ検出出力ＳＤＯの入力に応じてサーボタイミング生成のための基準パルスを発生し、そしてメインカウンタ３４が、その基準パルスに応じてシステムクロックＳＣＬＫをカウントする。また、メインカウンタ３４は、ＳＡＭ検出ウィンドウ生成回路３６からカウント値調整信号Ｂが入力されると、ＣＰＵ２２によってロードされた値からカウントを始めてＳＡＭ検出ミス時のタイミング遅延を補償する。データセクタ終了パルス生成器２０は、読出し中のサーボセクタの後位に位置するサーボセクタのサーボ同期以前にメインカウンタ３４から入力されるカウント値がＣＰＵ２２によってロードされた値に一致すれば、ＥＮＤＳパルスを生成する。そのＥＮＤＳパルスはＳＡＭ検出ウィンドウ生成回路３６へ入力される。
【００１９】
サーボインタラプト生成器４２は、サーボゲート（Servo Gate: ＳＧ）以後にメインカウンタ３４から入力されるカウント値がＣＰＵ２２によってロードされた値に一致すれば、サーボインタラプト（Servo Interrupt:ＳＩ）を出力する。ＣＰＵ２２がこのサーボインタラプトＳＩを受けると、サーボセクタ検出に関する各種の状態信号を確認し、ＤＤＣ(Disk Data Controller)４８における読出／書込機能遂行を制御する。サーボゲート生成器４４は、メインカウンタ３４から入力されるカウント値がＣＰＵ２２によってロードされた値に一致すれば、サーボセクタ領域を保護するためのサーボゲートＳＧを出力する。セクタパルス生成器４６は、サーボゲートＳＧの入力に応答してデータセクタ内のＩＤ領域を読出すためのセクタパルスＳＰを出力する。このセクタパルスＳＰに応答して、ＤＤＣ４８が読出ゲートＲＧ／書込ゲートＷＧをエネーブルさせる。
【００２０】
ＳＡＭ検出ウィンドウ生成回路３６は、データセクタ終了パルス生成器２０から入力されるＥＮＤＳパルスによってエネーブルされ、ＣＰＵ２２からロードされたウィンドウ値ＳＡＭＷ［７：０］内でＳＡＭ検出をミスすると、ＳＡＭ検出ミス信号Ａを生成して、基準パルス生成器３２及びＳＡＭ検出ミス信号カウンタ３８へ出力する。また、ＳＡＭ検出ウィンドウ生成回路３６は、ＳＡＭ検出ミス信号Ａを一定時間遅延させてＳＡＭ検出ミス時のタイミング遅延を補償するためのカウント値調整信号Ｂをメインカウンタ３４へ出力する。以後、メインカウンタ３４はＳＡＭサーチモード制御器４０から入力されるＰＳＡＭ（疑似ＳＡＭ）によってカウント動作を再び行う。
【００２１】
ＳＡＭ検出ミス信号カウンタ３８は、ＳＡＭ検出ウィンドウ生成回路３６から入力されるＳＡＭ検出ミス信号Ａをカウントする。このＳＡＭ検出ミス信号カウンタ３８により、連続的なＳＡＭ検出によるタイミング遅延を補償することができる。ＳＡＭサーチモード制御器４０は、ＣＰＵ２２から入力される選択信号ＳＥＬ（ＳＥＬ０，ＳＥＬ１）に応じて、ＳＡＭ検出ミス信号カウンタ３８から出力されるＰＳＡＭ及びＳＡＭサーチ信号ＳＣＨをメインカウンタ３４とＳＡＭ検出器１６へ出力する。ＳＡＭサーチ信号ＳＣＨはＳＡＭ検出器１６とサーボゲート生成器４４に入力され、ＳＡＭを検出するまでサーボゲートＳＧを論理“ハイ”エネーブルさせることにより、読出／書込チャンネル回路１４でサーボセクタのＥＲＤが生成されるようにする。
【００２２】
ＣＰＵ２２はハードディスクドライブの全般的な制御動作を行い、ＳＡＭサーチモード制御器４０へ選択信号ＳＥＬを出力してＳＡＭ検出ミス信号カウンタ３８からのＰＳＡＭ及びＳＡＭサーチ信号を選択制御する。またＣＰＵ２２は、ＳＡＭ検出器１６から入力されるＦＳＡＭによりＳＡＭ検出有無を確認し、ＤＤＣ４８の読出ゲートＲＧ及び書込ゲートＷＧの生成タイミングを制御する。
【００２３】
図３〜図５には、タイミング補償回路３１、ＳＡＭ検出ミス信号カウンタ３８、ＳＡＭサーチモード制御器４０の詳細構成を示してある。
【００２４】
図３Ａ及び図３Ｂは、タイミング補償回路３１の詳細構成である。まず、基準パルス生成器３２は、図３Ｂに示すＤフリップフロップ５８と図３Ａに示すＤフリップフロップ５０で構成される。Ｄフリップフロップ５８は、ＳＡＭ検出出力ＳＤＯの立ち上がりエッジで電源電圧ＶＤＤをクロッキングしてＳＡＭ検出信号ＳＡＭＯ(SAM OUTPUT)を出力する。このＳＡＭＯは、データセクタ終了パルス生成器２０から出力されるＥＮＤＳの立ち上がりエッジでディスエーブルされる。出力されたＳＡＭＯは、ＳＡＭ検出ウィンドウ生成回路３６から入力されるＳＡＭ検出ミス信号Ａと論理和された後にＤフリップフロップ５０のクロック端子へ入力される。このＤフリップフロップ５０は、ＯＲゲートＯ１の出力信号の立ち上がりエッジで電源電圧ＶＤＤをクロッキングして出力する。そして、Ｄフリップフロップ５０の出力信号はＡＮＤゲートＡ２でシステムクロックＳＣＬＫと論理積された後、メインカウンタ３４のクロック端ＣＫへ入力される。
【００２５】
メインカウンタ３４は、クロック端ＣＫへ入力されるＡＮＤゲートＡ２の出力信号をカウントする。このメインカウンタ３４は、端子ＬＤからＣＰＵ２２によるサーボタイミング補償のためのカウント値を入力し、また端子ＬＤＢからＳＡＭ検出ウィンドウ生成回路３６によるカウント値補償信号Ｂを入力する。
【００２６】
メインカウンタ３４及びＤフリップフロップ５０はＡＮＤゲートＡ１の論理“ロウ”出力によってリセットされるようにしてある。ＡＮＤゲートＡ１は、ＰＯＲＢ（Power On Reset Bar:Bar= 反転）、ＳＡＭサーチ信号ＳＣＨＢ(Search Bar)、及びインバータＩＮＶ２により反転したＥＮＤＳを演算する。
【００２７】
そして、データセクタ終了パルス生成器２０は比較器５４及びＤフリップフロップ５６で構成される。比較器５４は、Ｘ端子からメインカウンタ３４のカウント値を入力してＣＰＵ２２からＹ端子へロードされるＥＮＤＳデータと比較し、一致すると論理“ハイ”のＥＮＤＳを出力する。Ｄフリップフロップ５６は、インバータＩＮＶ１によって反転したＡＮＤゲートＡ２の出力信号の立ち上がりエッジでＥＮＤＳをラッチして出力する。
【００２８】
図４はＳＡＭ検出ウィンドウ生成回路３６の詳細構成で、図示のようにＤフリップフロップ６０，６６，６８、カウンタ６２、及び比較器６４で構成される。Ｄフリップフロップ６０は、データセクタ終了パルス生成器２０から入力されるＥＮＤＳの立ち上がりエッジで電源電圧ＶＤＤをクロッキングして出力し、ＡＮＤゲートＡ４がその出力信号をシステムクロックＳＣＬＫと論理積する。カウンタ６２は、クロック端ＣＫに受けるＡＮＤゲートＡ４の出力信号をカウントして８ビットのカウント値を出力する。比較器６４は、ＣＰＵ２２からロードされた８ビットのＳＡＭウィンドウデータＳＡＭＷとカウンタ６２のカウント出力値を比較し、一致するときに論理“ハイ”のＳＡＭ検出ミス信号Ａを出力する。Ｄフリップフロップ６６，６８は、インバータＩＮＶ４で反転したＡＮＤゲートＡ４の出力信号の立ち上がりエッジでＳＡＭ検出ミス信号Ａを順次ラッチして出力する。Ｄフリップフロップ６８から出力されるＳＡＭ検出ミス信号ＡがＳＡＭ検出ミスを示すことになる。
【００２９】
ＡＮＤゲートＡ６は、ＰＯＲＢ、インバータＩＮＶ５により反転したＳＤＯ、Ｄフリップフロップ６８の反転出力端子バーＱから出力される反転信号バーＡを論理積することにより、Ｄフリップフロップ６０とカウンタ６２をリセットさせる。一方、Ｄフリップフロップ６６，６８はＰＯＲＢによってリセットされる。即ち、ＳＡＭ検出ウィンドウ生成回路３６では、ＳＡＭ検出時のＳＡＭ検出出力ＳＤＯがインバータＩＮＶ５を介してＡＮＤゲートＡ６に印加されることにより、Ｄフリップフロップ６０とカウンタ６２をリセットさせる。従って、Ｄフリップフロップ６８からＳＡＭ検出ミス信号Ａが生成されないことにより、正常なＳＡＭ検出が行われている。ところがＳＡＭ検出ミスが発生すると、ＳＤＯが出ないためにＤフリップフロップ６８の出力端子からＳＡＭ検出ミス信号Ａが出力される。これによりＳＡＭ検出ウィンドウ生成回路３６は、指定された期間内でＳＡＭが検出されないと、ＳＡＭ検出ミス信号Ａを発生し、また遅延器ＤＥＬＡＹから、サーボカウント値を補償するためのカウント値調整信号Ｂがメインカウンタ３４のロード端子ＬＤＢへ出力される。このときにメインカウンタ３４は、ＣＰＵ２２によって初期にロードされた８ビット値からカウントを開始し、サーボサンプリングパルスのタイミングを補償してＳＡＭミスによるタイミングシフト(Timing Shift)を改善する。
【００３０】
図５は、ＳＡＭ検出ミス信号カウンタ３８の詳細構成を示し、Ｄフリップフロップ７０，７２，７４，７６、インバータＩＮＶ６、及びＡＮＤゲートＡ７で構成される。まず、基準パルス生成器３２のＤフリップフロップ５８から出力されるＳＡＭＯがインバータＩＮＶ６を介してＡＮＤゲートＡ７へ入力され、ＰＯＲＢと論理積される。このＡＮＤゲートＡ７の出力信号は、Ｄフリップフロップ７０，７２，７４，７６のリセット信号として用いられる。
【００３１】
Ｄフリップフロップ７０は、ＳＡＭ検出ウィンドウ生成回路３６から入力されるＳＡＭ検出ミス信号Ａの立ち上がりエッジで反転出力端子バーＱの信号をクロッキングして出力する。そして、Ｄフリップフロップ７０の出力端子ＱからＳＡＭサーチ信号ＳＣＨ２が出力されてＳＡＭサーチモード制御器４０へ入力され、また反転出力端子バーＱの信号ＰＳＡＭ２もＳＡＭサーチモード制御器４０へ入力される。Ｄフリップフロップ７２は、Ｄフリップフロップ７０の反転出力端子バーＱから入力される信号ＰＳＡＭ２の立ち上がりエッジで反転出力端子バーＱの信号をクロッキングして出力し、出力端子Ｑ及び反転出力端子バーＱから出力されるＳＡＭサーチ信号ＳＣＨ３とＰＳＡＭ３がＳＡＭサーチモード制御器４０へ入力される。Ｄフリップフロップ７４は、Ｄフリップフロップ７２の反転出力端子バーＱから入力される信号ＰＳＡＭ３の立ち上がりエッジで反転出力端子バーＱの信号をクロッキングして出力し、出力端子Ｑ及び反転出力端子バーＱから出力されるＳＡＭサーチ信号ＳＣＨ５とＰＳＡＭ５がＳＡＭサーチモード制御器４０へ入力される。Ｄフリップフロップ７６は、Ｄフリップフロップ７０の出力端子Ｑから出力される信号ＳＣＨ２の立ち上がりエッジでＤフリップフロップ７２の出力端子Ｑの信号ＳＨ３をクロッキングし、ＳＡＭサーチ信号ＳＣＨ４として出力する。このＤフリップフロップ７６の反転出力端子バーＱからはＰＳＡＭ４が出力されてＳＡＭサーチモード制御器４０へ入力される。
【００３２】
図６は、ＳＡＭサーチモード制御器４０の詳細構成を示す。このＳＡＭサーチモード制御器４０は、ＣＰＵ２２から入力される選択信号ＳＥＬ０，ＳＥＬ１に応じて、ＳＡＭ検出ミス信号カウンタ３８から入力されるＰＳＡＭとＳＡＭサーチ信号ＳＣＨをそれぞれ選択して出力するマルチプレクサ（ＭＵＸ  Ａ）７８及びマルチプレクサ（ＭＵＸ  Ｂ）８０と、ＳＡＭ検出ウィンドウ生成回路３６から出力されるＳＡＭ検出ミス信号Ａの立ち上がりエッジでマルチプレクサ７８，８０の出力端子Ｙから入力される信号をそれぞれクロッキングしてラッチ出力するＤフリップフロップ８２，８４と、データセクタ終了パルス生成器２０から入力されるＥＮＤＳを反転出力するインバータＩＮＶ７と、このインバータＩＮＶ７の出力信号とＰＯＲＢを論理積してＤフリップフロップ８２をリセットさせる信号を出力するＡＮＤゲートＡ８と、から構成される。Ｄフリップフロップ８４は基準パルス生成器３２の出力ＳＡＭＯによってリセットされる。
【００３３】
図７は、サーボ同期、ＳＡＭ、グレーコード、バーストＡ，Ｂ，Ｃ，Ｄで構成される一般のサーボセクタから検出される正常なＳＡＭ検出関連タイミング図である。図中の（ａ）はヘッドを通じてサーボセクタから読出されたアナログ読出信号を示し、（ｂ）はそのアナログ読出信号を波形整形したディジタル信号を示す。ＥＮＤＳは、図中のサーボセクタの前に位置するデータセクタの終了時にデータセクタ終了パルス生成器２０から生成出力され、ＳＡＭは、ＥＮＤＳと同時にエネーブルされてＳＡＭ検出ウィンドウ区間内でＳＡＭが検出された場合にディスエーブルされる信号である。そして、ＳＡＭ検出器１６から生成出力されるＳＤＯは、図７に示すようにＳＡＭが検出される時点で発生してメインカウンタ３４をスタートさせる。
【００３４】
これに対しＳＡＭ検出ミス信号Ａは、ＳＡＭ検出ミス時に常に一定間隔、即ちＳＡＭ検出ウィンドウＳＡＭＷが終了する時点で発生する。このとき、ＳＡＭ検出ウィンドウ生成回路３６はＳＤＯとＳＡＭ検出ミス信号Ａとの間のタイミング差Ｄを補償するためのカウント値調整信号Ｂをメインカウンタ３４へロードしてＳＡＭ検出ミス時のサーボタイミングを補償する。即ち、ＳＡＭ検出ミス信号Ａが発生してもサーボサンプリングパルスは常に一定の位置で生成可能である。
【００３５】
図８Ａは、正常にＳＡＭが検出される場合のサーボ関連タイミング図で、４つのサーボセクタに対して正常にＳＡＭが検出された場合を示している。ＳＧはサーボゲート生成器４４から生成出力されるサーボゲートで、ＳＩはサーボインタラプト生成器４２から生成出力されるサーボインタラプトである。ＳＡＭ検出器１６から生成出力されてＣＰＵ２２へ入力されるＳＡＭは、ＥＮＤＳによってエネーブルされ、正常にＳＡＭが検出された場合にディスエーブルされる。ＧＲＡＹもＥＮＤＳによってエネーブルされ、各サーボセクタに位置するグレーコード区間終了時点でディスエーブルされる。ＥＳＡＭ(Error SAM) は、ＳＡＭ検出ミス時にエネーブルされ且つＳＡＭ検出時にディスエーブルされるエラー信号である。
【００３６】
図８Ｂは、ＳＡＭ検出ミスがあった場合のサーボ関連タイミング図で、２番目及び３番目のＳＡＭ検出ミスを例示してある。この場合でも、各サーボセクタに対してサーボゲートＳＧ及びサーボインタラプトＳＩが生成される。この例のように２番目及び３番目のサーボセクタでＳＡＭ検出をミスすると、ＳＡＭ検出器１６から出力されるＳＡＭのフラグは２番目及び３番目のサーボセクタに対して引き続き論理“ハイ”状態を保持する。ＥＳＡＭは、ＳＡＭ検出器１６が３番目のサーボセクタのＳＡＭ検出をミスする場合に論理“ハイ”状態のフラグを保持してから、４番目のサーボセクタからＳＡＭが検出される場合にディスエーブルされる。
【００３７】
以下、図３〜図８を参照して本例のサーボアドレスマーク自動検出及びサーボタイミング補償過程を説明する。
【００３８】
まず、ＳＡＭ検出器１６によって検出されたＳＡＭ検出出力ＳＤＯが、図３Ｂに示したＤフリップフロップ５８のクロック端子に入力されることにより、論理“ハイ”レベルのＳＡＭＯが生成される。この論理“ハイ”レベルのＳＡＭＯは、ＳＡＭ検出ミス信号カウンタ３８、ＳＡＭサーチモード制御器４０に入力されると共に図３Ａに示したＯＲゲートＯ１に入力される。従って、基準パルス生成器３２のＤフリップフロップ５０がＯＲゲートＯ１の出力信号の立ち上がりエッジで電源電圧ＶＤＤをラッチして出力することにより、論理“ハイ”の信号がＡＮＤゲートＡ２に入力される。ＡＮＤゲートＡ２では、Ｄフリップフロップ５０の出力信号とシステムクロックＳＣＬＫを論理積してメインカウンタ３４のクロック端ＣＫへ出力する。
【００３９】
メインカウンタ３４は、クロック端ＣＫへ入力されるＡＮＤゲートＡ２の出力信号をカウントし、比較器５４は、ＣＰＵ２２から次のサーボセクタ前までの長さをロードした値のＥＮＤＳとカウント値が一致する場合に論理“ハイ”の信号を出力する。これによりＥＮＤＳがＤフリップフロップ５６のＱ端子から出力され、図４のＤフリップフロップ６０のクロック端ＣＫへ入力される。このとき、図３Ａ及び図３Ｂに示した基準パルス生成器３２を構成するＤフリップフロップ５８，５０とメインカウンタ３４は、ＥＮＤＳによってリセットされる。
【００４０】
ＳＡＭ検出ウィンドウ生成回路３６のＤフリップフロップ６０は、クロック端ＣＫへ入力されるＥＮＤＳの立ち上がりエッジで電源電圧ＶＤＤをクロッキングして出力し、ＡＮＤゲートＡ４がシステムクロックＳＣＬＫとＤフリップフロップ６０の出力信号を論理積して出力する。これによりカウンタ６２はシステムクロックをカウントして出力する。このカウント値をＸ端子を通じて受ける比較器６４は、カウント値がＣＰＵ２２の指定したウィンドウの長さ値であるＳＡＭＷに一致する場合、論理“ハイ”レベルの信号を出力する。
【００４１】
比較器６４から出力される信号はＤフリップフロップ６６，６８によってラッチされ、ＳＡＭ検出ミス信号Ａとして出力される。このときにＤフリップフロップ６８の反転出力端子バーＱから遅延出力される信号Ｂは、メインカウンタ３４のＬＤＢ端子に印加される。ＳＡＭが検出されない場合には、このようにしてＳＡＭ検出ミス信号Ａが生成出力されるが、ＳＡＭ検出器１６で正常にＳＡＭが検出される場合には、ＳＤＯがインバータＩＮＶ５を介してＡＮＤゲートＡ６に入力されることにより、Ｄフリップフロップ６０とカウンタ６２をリセットさせる。従って、ＳＡＭが正常に検出される場合にはＤフリップフロップ６８からＳＡＭ検出ミス信号Ａは生成されない。また、ＳＡＭ検出ウィンドウ生成回路３６は、指定された区間内でＳＡＭ検出をミスする場合、ＣＰＵ２２が初期にロードしたＬＤ値からカウントを開始するように、カウント値調整信号Ｂを生成してメインカウンタ３４のＬＤＢ端子へ出力する。その結果、サーボサンプリングパルスのタイミングを補償してＳＡＭ検出ミスによるタイミングのシフトを改善することができる。
【００４２】
ＳＡＭ検出ウィンドウ生成回路３６から出力されるＳＡＭ検出ミス信号Ａは、ＳＡＭ検出ミス信号カウンタ３８のＤフリップフロップ７０のクロック端ＣＫに入力され、同時に、ＳＡＭサーチモード制御器４０のＤフリップフロップ８２，８４のクロック端ＣＫにも入力される。ＳＡＭ検出ミス信号Ａが入る度に、Ｄフリップフロップ７０，７２，７４，７６で順番にＰＳＡＭ２，３，４，５とサーチ信号ＳＣＨ２，３，４，５がラッチ出力され、ＳＡＭサーチモード制御器４０のマルチプレクサ７８，８０に印加される。
【００４３】
ＣＰＵ２２は選択信号ＳＥＬ０，１により、連続２回から５回までの範囲でミスサーボセクタ数を指定可能になっている。マルチプレクサ７８，８０は、その選択信号ＳＥＬ０，１による指定でＰＳＡＭ２，３，４，５とサーチ信号ＳＣＨ２，３，４，５のいずれかを選択してＰＳＡＭ及びサーチ信号ＳＣＨとして出力し、Ｄフリップフロップ８２，８４は、ＳＡＭ検出ミス信号Ａの立ち上がりエッジでマルチプレクサ７８，８０から出力される信号をラッチして出力する。このＤフリップフロップ８４から出力されるサーチ信号ＳＣＨＢはカウント動作中のメインカウンタ３４を停止させ、サーチ信号ＳＣＨはＳＡＭ検出器１６をエネーブルさせてＳＡＭ検出が開始される。
【００４４】
【発明の効果】
本発明によれば、ＳＡＭ検出をミスした場合にサーボサンプリング関連タイミングを自動補償し、初期に制御手段で決定される回数だけのＳＡＭ検出を連続してミスしても自動的にＳＡＭをサーチして検出する回路を設けられるので、ＣＰＵの負担を軽減させることができる。
【図面の簡単な説明】
【図１】従来のＳＡＭ検出過程を実行するハードディスクドライブのブロック図。
【図２】本発明によるＳＡＭ自動検出及びタイミング補償手段を設けたハードディスクドライブのブロック図。
【図３】図２中のタイミング補償回路の詳細回路図。
【図４】図２中のＳＡＭ検出ウィンドウ生成回路の詳細回路図。
【図５】図２中のＳＡＭ検出ミス信号カウンタの詳細回路図。
【図６】図２中のＳＡＭサーチモード制御器の詳細回路図。
【図７】正常なＳＡＭ検出時のサーボ関連タイミング図。
【図８】４つのサーボセクタのＳＡＭ検出について説明するタイミング図。
【符号の説明】
１６  ＳＡＭ検出器
２０  データセクタ終了パルス生成器
３１  タイミング補償回路
３２  基準パルス生成器
３４  メインカウンタ
３６  ＳＡＭ検出ウィンドウ生成器
３８  ＳＡＭ検出ミス信号カウンタ
４０  ＳＡＭサーチモード制御器
４２  サーボインタラプト生成器
４４  サーボゲート生成器
４６  セクタパルス生成器
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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