(57)【特許請求の範囲】
【請求項１】
一定数の入力データを積算してシンボルを生成する復調器におけるシンボルタイミング再生回路であって、前記一定数の入力データの相加平均値と前記入力データを掛け合わせた値を用いて、プリアンブル部に含まれる一定数のデータのうち１つのデータの極性がその他のデータの極性と異なるプリアンブルパタンを検出することでシンボルタイミングを再生することを特徴とするシンボルタイミング再生回路。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明はシンボルタイミング再生回路に関し、特に一定数のデータを積算して生成したシンボルのタイミングを再生する回路に関する。
【０００２】
【従来の技術】
デジタルデータを送受信する変復調装置(MODEM)において、送信側では伝送したいシンボルをもとに一定数のデータを繰り返し送信し、受信側ではそのデータを一定数積算することでシンボルを生成する通信方法を考える。
【０００３】
送信側でのデータ伝送速度をx[bps](bit per second)とし、受信側ではこのx[bps]のデータ受信クロックは再生されているものとする。この通信系を用いて、x[bps]で送信されるデータをn[bit]づつ積算して1つの受信データとし、1秒間にz個のデジタルデータを送信する。ここで、変数x,n,zは自然数であり、積算によって生成されるデータの最小単位が1シンボルとなる。送信側では送信したいシンボルをもとに、同じデータをn[bit]ずつ繰り返して送信する。この通信方法では、x[bps]の通信系を用いてz[sps] (symbol per second)の通信ができることになる。
【０００４】
伝送速度 ２０[bps]、積算個数 ４[bit]の場合の積算によるシンボル生成例を図１に示す。送信シンボル列{0,0,1,0,1,1,0,1,0,0}をもとに同じビットを４bitずつ繰り返し、２０[bps]でのビット列
{0000000011110000111111110000111100000000}
を送信する。
【０００５】
受信側では２０[bps]のビット列を４[bit]ずつ積算し、積算結果をシンボル列{0,0,1,0,1,1,0,1,0,0}に変換することでシンボルを生成している。この例での受信シンボル速度は５[sps]となる。
【０００６】
本発明は、このような通信方式におけるシンボルタイミングの再生回路に関する。
【０００７】
【発明が解決しようとする課題】
このような通信系の受信側においてｎ[bit]の積算を行う場合、どこから積算を開始してシンボルを生成するかという、データ列上での積算開始位置を正確に知る必要がある。この位置は１つのシンボルの先頭であり、この位置を求める処理がシンボルタイミング再生である。シンボルタイミングが狂うと正しい積算ができなくなり、結果的に正しいシンボルが生成できなくなる。
【０００８】
例えば、１つのシンボルを生成するデータ列の中心付近から積算が開始された場合、隣り合った２シンボル分のデータ列をまたいで積算することになる。こうなると積算結果に誤りが生じ、送信したいシンボルと受信側で生成されるシンボルが一致しなくなってしまう可能性が生じる。
【０００９】
したがって、本発明の目的は、一定数のデータを積算してシンボルを生成する復調器におけるシンボルタイミング再生回路を提供することである。
【００１０】
【課題を解決するための手段】
本発明によるシンボルタイミング再生回路においては、プリアンブル部に含まれる特定のプリアンブルパタンを用いてシンボルタイミングを再生することを特徴とする。
【００１１】
また、本発明によれば、一定数の入力データの相加平均値を入力データと掛け合わせた値を用いることにより、同期検波方式のみではなく遅延検波方式を用いた通信系に対しても有効である。
【００１２】
【発明の実施の形態】
図２のフレーム構成図に示すように、シンボルタイミング再生は、実際に送信したいデータ部の前に設けられたプリアンブル部に含まれるシンボルタイミング再生処理専用区間において行われ、この区間をプリアンブルパタンと呼ぶ。このため、送信データはシンボルタイミング再生用のプリアンブルパタンを含むプリアンブル部とデータ部を有するフレーム構成となる。
【００１３】
図３は、本発明の第一の実施の形態における送信側の構成を示すブロック図である。送信側はベースバンド波形発生回路１と、シングルパルス発生回路２と、論理回路３とで構成されている。
【００１４】
ベースバンド波形発生回路１は、任意のベースバンド波形を発生する。シングルパルス発生回路２は、伝送速度に応じた時間単位幅のシングルパルスを発生する。論理回路３は、２入力の排他的論理和を取る回路である。
【００１５】
図４は、本発明の第一の実施の形態における受信側の構成を示すブロック図である。受信側は、遅延回路４と、セレクタ５と、振り分け回路６と、積算回路７と、比較回路８とで構成されている。積算回路７はシンボルの生成に必要な積算回数分だけ用意する。
【００１６】
遅延回路４は、データ伝送速度に応じた時間単位で入力信号を遅延させる。セレクタ５は、条件によって信号出力を２系統に切り替える。振り分け回路６は、入力されるデータを規則に従って振り分ける。積算回路７は、入力された値を積算して結果を記憶しておく。比較回路８は、入力された値を条件に従って比較し、シンボルタイミング再生の可否判定とシンボルタイミング再生のための遅延情報を出力する。
【００１７】
データ伝送速度を５０００[bps]、1シンボルを生成するための連続データ積算個数を２５個とすると、この条件下では１秒間に２００個のシンボルを送信できる。このような通信系を例にとって、本実施例の動作を説明する。復調は同期検波方式を用いるものとし、ベースバンド波形はデジタルデータ(シンボル)"0"に"-1"、"1"に"+1"を対応させる。また、シンボルタイミング再生用のプリアンブルパターン長は２秒間(10000[bit])とする。プリアンブルパタンは多くの組み合わせが考えられるが、以下に示すパタンが望ましい。
【００１８】
図３の送信側ブロックの動作について説明する。プリアンブル部でのシンボルは一定とする。ここでは、"0"一定としたシンボルをもとにベースバンド波形を決めて、ベースバンド発生回路１から"-1"を出力する。シングルパルス発生回路２は1/200[sec]周期で繰り返される1/5000[sec]幅のシングルパルスを、１シンボル分のデータ列の先頭と一致するタイミングで発生する。シングルパルス発生回路２の出力波形を図５に示す。
【００１９】
この２つの信号を論理回路３に入力し、排他的論理和を取る。論理回路３の出力波形と出力データ列を図６に示す。出力データ列は２５個のデータで1つのパタンを構成し、先頭の1個が"+1"、残りの24個が"-1"の値を取る。こうして合成された信号は変調器に入力される。
【００２０】
図４の受信側ブロックの動作について説明する。シンボルタイミング再生処理中は遅延回路４でデータに遅延がかかることはなく、入力データは直接セレクタに伝達される。当然のことであるが、データ列のどの位置から積算が開始されているかは一切不明である。
【００２１】
セレクタ５では、振り分け回路６への出力が選択されている。
【００２２】
入力されたデータは振り分け回路６によって２５個の積算回路７に、順番に振り分けられる。１番目から２５番目までひと通りデータが振り分けられると、振り分け回路６は再び１番から順にデータの振り分けを行う。振り分け回路６は、この作業を指定された回数だけ繰り返す。この回数は積算回路７で何回積算するかを示す値であり、この例では400回とする。
【００２３】
積算回路7は、周期的に入力されるデータを順に積算して結果を記憶する。400回の積算が終了した時点では、400回分の積算結果が２５個あるそれぞれの積算回路７に記憶されている。
【００２４】
受信側に入力されるデータ列を{x1, x2, x3, ...}、1シンボルを生成するために積算する回数をn、積算回路７で積算する回数をr、記憶される積算結果をSとすると、n個ある積算結果のi番目は次式で与えられる。
【００２５】
【数式１】
0003667539.tif 000002
図７を用いて、ある例における積算過程を示す。図７のデータ列において、シンボルの先頭位置で"+1"の値を取るものを黒、現在の積算開始位置で"-1"の値を取るものを灰、それ以外で"-1"の値を取るものを白で示す。矢印の流れに従ってそれぞれの値が振り分け回路6で振り分けられ、積分回路７−１から積分回路７−２５は４００個分の積算を繰り返す。
【００２６】
積分回路７−２５が４００回目の積算を終了した時点で全積算処理が完了し、比較回路８が動作を開始する。比較回路８の動作について説明する。
【００２７】
はじめに、２５個の積算回路７に記憶された値の正負を比較する。正しく積算が行われていれば、シンボル先頭位置に対応する積算回路７における積算結果は正、それ以外の積算結果は負になっているはずである。正の値が記憶された積算回路７が２つ以上ある場合、もしくは正の値が記憶された積算回路７がひとつも存在しない場合には、シンボルタイミングの再生が不成功に終わったとする。
【００２８】
正の値が記憶された積算回路７が１つだけ存在する場合、その積算回路７の位置がシンボルの積算開始位置すなわちシンボルの先頭位置と推定できる。続いて比較回路８は、実際に積算を開始した位置から上記の処理で求まったシンボルの先頭位置までの差を求め、その差分を遅延情報として遅延回路４に送信する。
【００２９】
遅延情報が入力されると、遅延回路４はその情報によって与えられた量だけ入力データに遅延をかける。
【００３０】
図７の例では、１０番目の積算回路７−１０の積算結果が正の値、それ以外の積算回路７の積算結果が負の値となる。シンボルタイミングが正しく再生されれば、積算結果が正の値となるのは１番目の積算回路７−１であるはずが、この例では１０番目が正の値となっていることから、現在の先頭位置は真のシンボルの先頭からデータ９個分遅れていることになる。従って、遅延回路４でデータ９個分の遅延をかければ、現在の先頭位置が真のシンボル先頭位置に一致し、シンボルタイミングが再生できる。
【００３１】
このようにして、最もシンボルの先頭らしい位置を推定する。なお、より確実にシンボルタイミング再生を行いたい場合は、正負の判定を行う処理に正のしきい値を設けて、シンボルタイミング再生の成否判定を厳しくすればよい。
【００３２】
遅延情報で指示された時間分の遅延をかけた後に、セレクタ５を復調側へ切り替える。これにて、シンボルタイミングの再生処理は終了である。
【００３３】
次に、本発明の第1の実施の形態の効果について説明する。本発明の回路を用いることにより、一定数のデータを積算してシンボルを再生する復調装置において、シンボルタイミングを再生することができる。
【００３４】
【発明の他の実施の形態】
シンボルタイミング再生処理内での積算回数、すなわち積算回路７での積算回数は必要に応じて設定値を変更できる。例えば、入力信号レベルが小さい場合は回数を多くして信号対雑音比を向上させられ、逆に入力信号レベルが大きい場合は積算回数を少なくできる。なお、積算回数はシンボルタイミング再生処理がプリアンブル区間内で終了するような値に設定する必要がある。
【００３５】
１回の再生処理でシンボルタイミングが再生できなかった場合においても、プリアンブル部の長さを調整することで引き続き再生処理を繰り返すことが可能である。
【００３６】
今回はプリアンブル区間のベースバンド波形レベルを"-1"基準としたが、この極性を反転させて"+1"を基準としても、同様にシンボルタイミングを再生できる。
【００３７】
またこの事例では、デジタルデータ"0, 1"を"-1, +1"に対応させているが、この対応を行わず、"0, +1"で判定を行うこともできる。ただしこの場合には、判定のしきい値を必ずしも0にはできず、最適な値を推定する必要がある。これは、積算されるデータ"0"がノイズ等の影響で微少に変動することにより、データ"0"の積算結果が必ず0になるとは限らず、正負に微小変動する可能性があるためである。
【００３８】
当然のことであるが、データ伝送速度やシンボルを生成するための積算回数は上記例のみにとどまらず、動作条件を満たす値であればどんな数値でもよい。
【００３９】
また、プリアンブルパタンは実施例で示したパタンに限定されない。
【００４０】
さらに、遅延検波方式を用いる通信系に本発明を適用する方法について説明する。
【００４１】
遅延検波方式で通信を行う場合、基準シンボルを一定にしても受信するプリアンブル区間のベースバンド波形レベルはその時々によって"-1"と"+1"とに変化する。そのため、一定周期で挿入される先頭パルスの極性もその時々で変化することになる。このとき、図４で示したブロック図でシンボルタイミングを再生しようとすると、ベースバンド波形レベルが"-1"か"+1"かによって、比較回路８でのシンボル先頭位置を検出する処理を変更する必要が生じる。これは、正値だけをシンボル先頭位置として認識する処理だと、ベースバンド波形レベルが"+1"の場合にはシンボル先頭位置が負値になり、シンボルタイミングが再生できなくなってしまうからである。
【００４２】
この対策のひとつとして、プリアンブル区間のベースバンド波形レベルが正負のどちらなのかを判定してからシンボルタイミング再生を行うという方法も考えられるが、より確実かつ有効なシンボルタイミング再生方法を以下に説明する。なお、この方法は同期検波方式にも適用できるが、追加される処理は冗長なものとなる。
【００４３】
図８は、遅延検波に対応するために追加するブロック図である。追加ブロックは相加平均回路９と乗算器１０で構成されている。相加平均回路９は入力データを一定数相加平均する。乗算器１０は２入力を乗算して出力する。このブロックを、図４に示したブロック図の遅延回路４の直前に追加する。
【００４４】
前述の例をもとに、図８の追加回路の動作を説明する。積算回路７での積算を開始する前に、５０個分の相加平均を求める。この積算が終了するまでは、相加平均回路９の出力を０に固定するなどして遅延回路４以降にデータを送らない。５０個の積算が終了した後に、シンボルタイミングの再生処理が開始される。
【００４５】
入力データはすでに計算された相加平均値と乗算器１１によって乗算された後にセレクタ５を通過し、振り分け回路６によって振り分けられる。相加平均回路９は引き続き５０個のデータが入力される毎に相加平均を求めて、乗算器１０で乗算される相加平均値を更新する。なお、更新されるまでは常に同じ平均値が繰り返し出力される。
【００４６】
図８で示した処理の追加により、シンボルタイミング推定処理においてシンボル先頭位置はプリアンブル部のベースバンド極性に関係なく負の値を、それ以外は正の値を取るようになるため、プリアンブル部の極性が反転した場合でも比較回路8において常に一定の判定処理が可能となる。他のブロックの処理および動作フローに関しては、同期検波方式に則して説明したとおりである。また、遅延検波方式への適用に際しても、発明の他の実施の形態は適用できる。
【００４７】
【発明の効果】
第1の効果は、一定数のデータを積算してシンボルを生成する復調器において、そのシンボルタイミングが再生できるということである。その理由は、送信したいデータ部の前に設けたプリアンブル部に含まれるプリアンブルパタンを用いた再生処理を行うためである。
【００４８】
第2の効果は、同期検波・遅延検波の両方に適用が可能ということである。
【００４９】
その理由は、遅延検波のための追加回路を提案したことである。
【図面の簡単な説明】
【図１】積算によるシンボル生成の例である。
【図２】本発明の第一の実施の形態におけるフレームの構成を示す図である。
【図３】本発明の第一の実施の形態における送信側の構成を示すブロック図である。
【図４】本発明の第一の実施の形態における受信側の構成を示すブロック図である。
【図５】シングルパルス発生回路２の出力波形である。
【図６】論理回路3の出力波形と出力データ列である。
【図７】シンボルタイミング再生のある例における積算過程である。
【図８】遅延検波に対応するため受信側に追加するブロック図である。
【符号の説明】
１    ベースバンド波形発生回路
２    シングルパルス発生回路
３    論理回路
４    遅延回路
５    セレクタ
６    振り分け回路
７    積算回路
８    比較回路
９    相加平均回路
１０  乗算器
【図１】
0003667539.tif 000003
【図２】
0003667539.tif 000004
【図３】
0003667539.tif 000005
【図４】
0003667539.tif 000006
【図５】
0003667539.tif 000007
【図６】
0003667539.tif 000008
【図７】
0003667539.tif 000009
【図８】
0003667539.tif 000010