(57)【特許請求の範囲】
【請求項１】
第１フィールドにおいては，クロック・パルスの１周期ごとにデータが変化する第１フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データとが与えられ，第２フィールドにおいてはクロック・パルスの１周期ごとにデータが変化する第２フィールドの輝度データが与えられる４：２：０のコンポーネント符号化されたデータが与えられ，第１フィールドにおいては，時間的に連続する２つの輝度データが同期し，２つの輝度データのうち一方の輝度データとＲ−Ｙの色差データとが交互に現れるように，かつ２つの輝度データのうち他方の輝度データとＢ−Ｙの色差データとが交互に現れるようにデータ配列を変換し，第２フィールドにおいては，時間的に連続する２つの輝度データが同期し，かつ輝度データと空きデータとが交互に現れるようにデータ配列を変換するデータ配列変換手段，および
奇数行メモリと偶数行メモリとが規定されているメモリ手段にデータを書き込むものであって，アドレス３ｍ（ｍは０以上の整数）の奇数行メモリおよび偶数行メモリに上記データ配列変換手段によってデータ配列が変換された第１フィールドの輝度データを，アドレス３ｍ＋１の奇数行メモリおよび偶数行メモリにＲ−Ｙの色差データおよびＢ−Ｙの色差データを，アドレス３ｍ＋２の奇数行メモリおよび偶数行メモリに第２フィールドの輝度データを書き込むデータ書き込み手段，
を備えたディジタル画像データの書込み装置。
【請求項２】
奇数行メモリと偶数行メモリとが規定されており，アドレス３ｍ（ｍは０以上の整数）の奇数行メモリおよび偶数行メモリに，時間的に連続した２つの第１フィールドの輝度データが書き込まれており，アドレス３ｍ＋１の奇数行メモリおよび偶数行メモリにＲ−Ｙの色差データおよびＢ−Ｙの色差データが書き込まれており，アドレス３ｍ＋２の奇数行メモリおよび偶数行メモリに時間的に連続した２つの輝度データが書き込まれているデータを，与えられるアドレス信号にもとづいて出力するメモリ手段，
第１フィールドのデータの読み取りを行うときには，アドレス３ｍおよび３ｍ＋１のアドレス信号を発生し，第２フィールドのデータの読み取りを行うときには，アドレス３ｍ＋１および３ｍ＋２のアドレス信号を発生し，発生したアドレス信号を上記メモリ手段に与えるアドレス信号発生手段，ならびに
第１フィールドにおいては，クロック・パルスの１周期ごとにデータが変化する第１フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データとが得られるように上記メモリ手段から出力されたデータの配列を変換し，第２フィールドにおいてはクロック・パルスの１周期ごとにデータが変化する第２フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データが得られるように上記メモリ手段から出力されたデータ配列を変換し，４：２：２擬似コンポーネント符号化データを出力するデータ配列変換手段，
を備えたディジタル画像データの読出し装置。
【請求項３】
第１フィールドにおいては，クロック・パルスの１周期ごとにデータが変化する第１フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データとが与えられ，第２フィールドにおいてはクロック・パルスの１周期ごとにデータが変化する第２フィールドの輝度データが与えられる４：２：０のコンポーネント符号化されたデータが与えられ，第１フィールドにおいては，時間的に連続する２つの輝度データが同期し，２つの輝度データのうち一方の輝度データとＲ−Ｙの色差データとが交互に現れるように，かつ２つの輝度データのうち他方の輝度データとＢ−Ｙの色差データとが交互に現れるようにデータ配列を変換し，第２フィールドにおいては，時間的に連続する２つの輝度データが同期し，かつ輝度データと空きデータとが交互に現れるようにデータ配列を変換し，
奇数行メモリと偶数行メモリとが規定されているメモリにデータを書き込むものであって，３ｍ（ｍは０以上の整数）の奇数行メモリおよび偶数行メモリに上記データ配列変換手段によってデータ配列が変換された第１フィールドの輝度データを，アドレス３ｍ＋１の奇数行メモリおよび偶数行メモリにＲ−Ｙの色差データおよびＢ−Ｙの色差データを，アドレス３ｍ＋２の奇数行メモリおよび偶数行メモリに第２フィールドの輝度データを書き込む，
ディジタル画像データの書込み方法。
【請求項４】
奇数行メモリと偶数行メモリとが規定されており，アドレス３ｍ（ｍは０以上の整数）の奇数行メモリおよび偶数行メモリに，時間的に連続した２つの第１フィールドの輝度データが書き込まれており，アドレス３ｍ＋１の奇数行メモリおよび偶数行メモリにＲ−Ｙの色差データおよびＢ−Ｙの色差データが書き込まれており，アドレス３ｍ＋２の奇数行メモリおよび偶数行メモリに時間的に連続した２つの輝度データが書き込まれているデータを，与えられるアドレス信号にもとづいて出力するメモリ手段からデータを読み出す方法であって，
第１フィールドのデータの読み取りを行うときには，アドレス３ｍおよび３ｍ＋１のアドレス信号を発生し，第２フィールドのデータの読み取りを行うときには，アドレス３ｍ＋１および３ｍ＋２のアドレス信号を発生し，発生したアドレス信号を上記メモリ手段に与え，
第１フィールドにおいては，クロック・パルスの１周期ごとにデータが変化する第１フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データとが得られるように上記メモリ手段から出力されたデータの配列を変換し，第２フィールドにおいてはクロック・パルスの１周期ごとにデータが変化する第２フィールドの輝度データとクロック・パルスの２周期ごとにデータがそれぞれ変化するＲ−Ｙの色差データとＢ−Ｙの色差データが得られるように上記メモリ手段から出力されたデータ配列を変換し，４：２：２擬似コンポーネント符号化データを得る，
ディジタル画像データの読出し方法。
【発明の詳細な説明】
【０００１】
【技術分野】
この発明は，メモリ装置にディジタル画像データを書込む装置および方法，ディジタル画像データが書込まれたメモリ装置からディジタル画像データを読出す装置および方法ならびにディジタル画像データを記憶するメモリ装置に関する。
【０００２】
【発明の背景】
被写体を撮影することにより得られるディジタル画像データは，ディジタル輝度データとＲ−ＹおよびＢ−Ｙのディジタル色差データとから構成される。これらのディジタル輝度データおよびディジタル色差データによって表わされる画像を例えば静止画として表示する場合，１画像分のディジタル輝度データおよびディジタル色差データをメモリに記憶する必要がある。データの記憶を行なう場合，輝度用のメモリおよび色差用のメモリを設け，輝度用メモリにディジタル輝度データが記憶され，色差用のメモリにディジタル色差データが記憶される。
【０００３】
ディジタル・ビデオ・テープ・レコーダにおいては，ディジタル輝度データおよびディジタル色差データはたとえば４：２：２コンポーネント符号化または４：２：０コンポーネント符号化される。４：２：２コンポーネント符号化は，図８（Ａ）  に示すように例えば偶数列の画素については輝度データおよび色差データを用いて表わされ，奇数列の画素については輝度データのみを用いて表わされる。４：２：０コンポーネント符号化は図８（Ｂ）  に示すように奇数行および奇数列の画素については輝度データのみを用いて表わされ，そのほかの画素については輝度データおよび色差データを用いて表わされる。
【０００４】
このように４：２：２コンポーネント符号化と４：２：０コンポーネント符号化の場合とでは，色差データのデータ量が異なるので，４：２：２コンポーネント符号化の場合と４：２：０コンポーネント符号化の場合に同じ輝度用メモリを用いてデータを記憶させると，４：２：０コンポーネント符号化のときには輝度用メモリの記憶領域が余ってしまいメモリの有効利用を図ることができない。
【０００５】
またメモリの有効利用を図るために，同一のメモリに単に輝度データと色差データとを順に書込んでいくと，データの読出しが困難であり，リアル・タイムの読出しもできない。
【０００６】
【発明の開示】
この発明は，４：２：０コンポーネント符号化されたディジタル輝度データおよびディジタル色差データをメモリに記憶する際にメモリの有効利用を図ることができ，かつリアルタイムにデータの読出しをすることができるようにすることを目的とする。
【０００７】
第１の発明のディジタル画像データの書込み装置は，与えられるアドレス信号によって指定されるアドレスの記憶領域に，入力データを書込むメモリ手段，第１フィールドにおいては偶数列の画素および奇数列の画素のうち一方の画素が第１の輝度データならびにＲ−ＹおよびＢ−Ｙの色差データによって表わされ，偶数列の画素および奇数列の画素のうち他方の画素が第２の輝度データによって表わされ，第２フィールドにおいてはすべての画素が第３の輝度データによって表わされる４：２：０コンポーネント符号化されたデータが第１フィールドおよび第２フィールドごとに与えられ，第１フィールドにおいては上記第１の輝度データとＲ−ＹおよびＢ−Ｙの上記色差データのうち一方の色差データとが交互に現われ，かつ上記第２の輝度データとＲ−ＹおよびＢ−Ｙの上記色差データのうち他方の色差データとが交互に現われるように，第２フィールドにおいては上記第３の輝度データと空データとが交互に現われるようにデータ配列を変換するデータ配列変換手段，ならびに上記第１の輝度データおよび上記第２の輝度データと上記色差データとを連続するアドレスの記憶領域に記憶し，上記第１の輝度データおよび上記第２の輝度データまたは上記色差データが記憶される領域のアドレスに連続するアドレスの記憶領域に上記色差データを表わす画素に対応する画素の上記第３の輝度データを記憶するように上記メモリ手段のアドレス信号を発生し，上記メモリ手段に与えるアドレス発生手段を備えていることを特徴とする。
【０００８】
第１の発明のディジタル画像データの書込み方法は，第１フィールドにおいては偶数列の画素および奇数列の画素のうち一方の画素が第１の輝度データならびにＲ−ＹおよびＢ−Ｙの色差データによって表わされ，偶数列の画素および奇数列の画素のうち他方の画素が第２の輝度データによって表わされ，第２フィールドにおいてはすべての画素が第３の輝度データによって表わされる４：２：０コンポーネント符号化されたデータが第１フィールドおよび第２フィールドごとに与えられ，第１フィールドにおいては上記第１の輝度データとＲ−ＹおよびＢ−Ｙの上記色差データのうち一方の色差データとが交互に現われ，かつ上記第２の輝度データとＲ−ＹおよびＢ−Ｙの上記色差データのうち他方の色差データとが交互に現われるように，第２フィールドにおいては上記第３の輝度データと空データとが交互に現われるようにデータ配列を変換し，上記第１の輝度データおよび上記第２の輝度データと上記色差データとを連続するアドレスの記憶領域に記憶し，上記第１の輝度データおよび上記第２の輝度データまたは上記色差データが記憶される領域のアドレスに連続するアドレスの記憶領域に上記色差データを表わす画素に対応する画素の上記第３の輝度データを記憶するようにメモリ手段のアドレス信号を発生し，メモリ手段に与え，メモリ手段に与えられるアドレス信号によって指定されるアドレスの記憶領域に上記第１の輝度データ，上記第２の輝度データ，上記第３の輝度データおよび上記色差データを書込むことを特徴とする。
【０００９】
第１の発明によると，第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データとは連続するアドレスの記憶領域に記憶され，かつ第２フィールドの画素を表わす上記第３の輝度データと色差データも連続するアドレスの記憶領域に記憶される。第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データ，第２フィールドの画素を表わす上記第３の輝度データおよび色差データはアドレスの順に順次メモリに記憶されていく。１つのメモリに第１フィールドの画素を表わす輝度データ，第２フィールドの画素を表わす輝度データおよび色差データのすべてを記憶できるので，輝度用データを記憶するメモリと色差用データを記憶するメモリとを設ける必要がなく，メモリの有効利用を図ることができる。
【００１０】
第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データおよび第２フィールドの画素を表わす上記第３の輝度データと色差データは連続するアドレスの記憶領域，すなわち隣接する記憶領域に記憶されている。したがって第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データおよび第２フィールドの画素を表わす上記第３の輝度データと色差データをほぼ同時に読み出すことができる。メモリ装置からディジタル画像データをリアル・タイムに読出すことができることとなる。
【００１１】
第２の発明のディジタル画像データの読出し装置は，第１フィールドにおいては偶数列の画素および奇数列の画素のうち一方の画素が第１の輝度データならびにＲ−ＹおよびＢ−Ｙの色差データによって表わされ，偶数列の画素および奇数列の画素のうち他方の画素が第２の輝度データによって表わされ，第２フィールドにおいてはすべての画素が第３の輝度データによって表わされる４：２：０コンポーネント符号化されたデータが記憶されているものであり，上記第１の輝度データおよび上記第２の輝度データと上記色差データとが連続するアドレスの記憶領域に記憶され，上記第１の輝度データおよび上記第２の輝度データまたは上記色差データが記憶される領域のアドレスに連続するアドレスの記憶領域に，上記色差データを表わす画素に対応する画素の上記第３の輝度データが記憶され，与えられるアドレス信号によって指定されるアドレスに記憶されているデータを出力するメモリ手段，ならびに第１フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第１の輝度データ，上記第２の輝度データおよび上記色差データのアドレス信号を発生し，第２フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第３の輝度データと上記色差データとのアドレス信号を発生し，発生したアドレス信号を上記メモリ手段に与えるアドレス信号発生手段を備えていることを特徴とする。
【００１２】
第２の発明の画像データの読出し方法は，第１フィールドにおいては偶数列の画素および奇数列の画素のうち一方の画素が第１の輝度データならびにＲ−ＹおよびＢ−Ｙの色差データによって表わされ，偶数列の画素および奇数列の画素のうち他方の画素が第２の輝度データによって表わされ，第２フィールドにおいてはすべての画素が第３の輝度データによって表わされる４：２：０コンポーネント符号化されたデータが記憶されているものであり，上記第１の輝度データおよび上記第２の輝度データと上記色差データとが連続するアドレスの記憶領域に記憶され，上記第１の輝度データおよび上記第２の輝度データまたは上記色差データが記憶される領域のアドレスに連続するアドレスの記憶領域に，上記色差データを表わす画素に対応する画素の上記第３の輝度データが記憶されているメモリ手段からのデータの読出しであり，第１フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第１の輝度データ，上記第２の輝度データおよび上記色差データのアドレス信号を発生し，第２フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第３の輝度データと上記色差データとのアドレス信号を発生し，発生したアドレス信号を上記メモリ手段に与え，メモリ手段からデータを読出すことを特徴とする。
【００１３】
第２の発明によると，第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データとは連続するアドレスの記憶領域に記憶され，かつ第２フィールドの画素を表わす上記第３の輝度データと色差データも連続するアドレスの記憶領域に記憶されている。第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データ，第２フィールドの画素を表わす上記第３の輝度データおよび色差データはアドレスの順にメモリに記憶されていく。
【００１４】
第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データおよび第２フィールドの画素を表わす上記第３の輝度データと色差データは連続するアドレスの記憶領域，すなわち隣接する記憶領域に記憶されており，第１フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第１フィールドの上記第１の輝度データおよび上記第２の輝度データと上記色差データとのアドレス信号が発生し，第２フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第２フィールドの上記第３の輝度データと上記色差データとのアドレス信号が発生する。発生したアドレス信号は上記メモリ手段に与えられる。
【００１５】
したがって第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データおよび第２フィールドの画素を表わす上記第３の輝度データと色差データをほぼ同時に読み出すことができる。メモリ装置からディジタル画像データをリアル・タイムに読出すことができることとなる。
【００１６】
第３の発明のメモリ装置は，第１フィールドにおいては偶数列の画素および奇数列の画素のうち一方の画素が第１の輝度データならびにＲ−ＹおよびＢ−Ｙの色差データによって表わされ，偶数列の画素および奇数列の画素のうち他方の画素が第２の輝度データによって表わされ，第２フィールドにおいてはすべての画素が第３の輝度データによって表わされる４：２：０コンポーネント符号化されたデータが記憶されているものであり，上記第１の輝度データおよび上記第２の輝度データと上記色差データとが連続するアドレスの記憶領域に記憶され，上記第１の輝度データおよび上記第２の輝度データまたは上記色差データが記憶される領域のアドレスに連続するアドレスの記憶領域に，上記色差データを表わす画素に対応する画素の上記第３の輝度データが記憶され，与えられるアドレス信号によって指定されるアドレスに記憶されているデータを出力することを特徴とする。
【００１７】
第３の発明においては，第１フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第１フィールドの上記第１の輝度データおよび上記第２の輝度データと上記色差データとのアドレス信号が上記メモリ装置に与えられ，第２フィールドの画素を表わすデータの読取りを行なうときには，上記連続するアドレスの記憶領域に記憶されている上記第２フィールドの上記第３の輝度データと上記色差データとのアドレス信号が上記メモリ装置に与えられる。
【００１８】
したがって第１フィールドの画素を表わす上記第１の輝度データおよび上記第２の輝度データと色差データおよび第２フィールドの画素を表わす上記第３の輝度データと色差データをほぼ同時に読み出すことができる。メモリ装置からディジタル画像データをリアル・タイムに読出すことができることとなる。
【００１９】
【実施例の説明】
図１はこの発明の実施例を示すもので，ビデオ・テープ・レコーダの電気的構成の一部を示している。
【００２０】
図１に示すビデオ・テープ・レコーダは４：２：０コンポーネント符号化された映像データを入力し，静止画表示を行なう場合に入力した映像データを一旦メモリ１７に記憶するものであり，メモリ１７周辺の回路ブロック部分が詳細に示されている。
【００２１】
図１に示すビデオ・テープ・レコーダは，図８（Ｂ）  に示すように奇数列および奇数行の画素については輝度データのみによって表わし，そのほかの画素については輝度データおよび色差データによって表わす４：２：０コンポーネント符号化された映像データを入力し，図８（Ａ）  に示すように奇数列の画素については輝度データのみによって表わし，偶数列の画素については輝度データおよび色差データによって表わす４：２：２コンポーネント符号化された映像データに擬似的なデータを出力するものである。図１に示すビデオ・テープ・レコーダは輝度データ用のメモリと色差データ用のメモリとを別個に持たず１つのメモリを用いて輝度データと色差データを記憶し，４：２：２コンポーネント符号化されたデータの擬似的なデータを出力する。
【００２２】
図１を参照して，ビデオ・カメラから出力される映像信号は輝度色差変換および同期信号分離回路１２に与えられる。映像信号は輝度色差変換および同期信号分離回路１２において，輝度信号，色差信号および同期信号が抽出され，アナログ／ディジタル（Ａ／Ｄ）コンバータ１３，Ａ／Ｄコンバータ１４およびＰＬＬ回路１１にそれぞれ与えられる。ＰＬＬ回路１１に同期信号が与えられることにより，ＰＬＬ回路１１から基準クロック・パルスが出力され各回路に与えられる。またＰＬＬ回路１１からは水平ブランキング・パルス（ＨＤ）が出力されタイミング発生回路１０に与えられる。
【００２３】
輝度信号および色差信号はＡ／Ｄコンバータ１３および１４にそれぞれ与えられ，ディジタル輝度データおよびディジタル色差データに変換される。これらのディジタル輝度データおよびディジタル色差データは配列変換回路１５に与えられる。
【００２４】
メモリ１７は，便宜的に図４に示すように奇数行メモリと偶数行メモリとに分けられている。もちろんこれら奇数行メモリと偶数行メモリとは図面に表わす便宜上のものであって実際のメモリ形態が必らず図４に示すものでなければならないというわけではない。
【００２５】
図１に示すビデオ・テープ・レコーダにおいてはディジタル輝度データおよびディジタル色差データのうち，図４に示すように奇数行メモリのｐ＋３ｍ（ｐ，ｍは０以上の整数）のアドレスに奇数フィールド（ｎ＋２ｑ）番めの画素（ｎ，ｑは０以上の整数）のディジタル輝度データＹｏ（ｎ＋２ｑ）が記憶され，奇数行メモリのｐ＋（３ｍ＋１）のアドレスに奇数フィールドの（ｎ＋２ｑ）番めの画素のＲ−Ｙのディジタル色差データＣｏ（ｎ＋２ｑ）が記憶され，奇数行メモリのｐ＋（３ｍ＋２）のアドレスに偶数フィールドの（ｎ＋２ｑ）番めの画素のディジタル輝度データＹｅ（ｎ＋２ｑ）が記憶される。また偶数行メモリのｐ＋３ｍ（ｐ，ｍは０以上の整数）のアドレスに奇数フィールド（ｎ＋２ｑ＋１）番めの画素（ｎ，ｑは０以上の整数）のディジタル輝度データＹｏ（ｎ＋２ｑ＋１）が記憶され，奇数行メモリのｐ＋（３ｍ＋１）のアドレスに奇数フィールドの（ｎ＋２ｑ＋１）番めの画素のＢ−Ｙのディジタル色差データＣｏ（ｎ＋２ｑ＋１）が記憶され，奇数行メモリのｐ＋（３ｍ＋２）のアドレスに偶数フィールドの（ｎ＋２ｑ＋１）番めの画素のディジタル輝度データＹｅ（ｎ＋２ｑ＋１）が記憶される。
【００２６】
配列変換回路１５は，このようにディジタル輝度データおよびディジタル色差データをメモリ１７に記録することができるように入力するデータの配列を変換するものである。配列変換回路１５から出力されるディジタル輝度データおよびディジタル色差データは，タイミング発生回路１０から与えられる第１の制御信号（ＤＩＲ）によってそのデータの出力方向性が制御される双方向バッファ１６を介してメモリ１７に与えられる。
【００２７】
ビデオ・テープ・レコーダにはタイミング信号発生回路１０が含まれており，このタイミング信号発生回路１０においてクロック・パルスＣＬＫおよび水平ブランキング・パルスＨＢにもとづいてメモリ・ライト信号ＷＥおよびメモリ・リード信号ＯＥが生成されメモリ１７に与えられる。またタイミング信号発生回路１０において，メモリ１７のアドレス・データ生成のための各種タイミング信号Ｓ０，Ｓ１，Ｓ２およびＬＤが生成されアドレス発生器３０に与えられる。アドレス発生器３０において入力する各種信号にもとづいてアドレス・データが生成されメモリ１７に与えられる。これによりメモリ１７に図４に示すようにディジタル輝度データおよびディジタル色差データが書込まれ，またメモリ１７に記憶されたディジタル輝度データおよびディジタル色差データが読出される。メモリ１７へのデータの書込みおよびデータの読出しについて詳しくは後述する。
【００２８】
メモリ１７からデータが読出されるときは，メモリ１７から出力されるディジタル輝度データおよびディジタル色差データは双方向バッファ１６を介して配列変換回路１８に与えられる。配列変換回路１８において入力するデータのうちディジタル輝度データとディジタル色差データとがそれぞれ抽出される。ディジタル輝度データおよびディジタル色差データはそれぞれディジタル／アナログ（Ｄ／Ａ）コンバータ１９およびＤ／Ａコンバータ２０に与えられ，アナログ輝度信号およびアナログ色差信号に変換される。Ｄ／Ａコンバータ１９および２０から出力されるアナログ輝度信号およびアナログ色差信号に加えて輝度色差変換および同期信号分離回路１２から出力される同期信号がＮＴＳＣ変換および同期信号合成回路２１に与えられる。これにより，回路２１からＮＴＳＣ映像信号が出力される。このＮＴＳＣ映像信号が表示装置に与えられることにより静止画像が表示される。
【００２９】
図２（Ａ）  ，（Ｂ）  はメモリにディジタル輝度データおよびディジタル色差データを書込むときのタイム・チャートを示すものであり，図２（Ａ）  は奇数フィールドにおいて得られたときのデータをメモリに書込むときのタイム・チャートであり，図２（Ｂ）  は偶数フィールドにおいて得られたときのデータをメモリに書込むときのタイム・チャートである。
【００３０】
図３（Ａ）  ，（Ｂ）  はメモリからディジタル輝度データおよびディジタル色差データを読出すときのタイム・チャートを示すものであり，図３（Ａ）  は奇数フィールドにおけるデータをメモリから読出すときのタイム・チャートであり，図３（Ｂ）  は偶数フィールドにおけるデータをメモリから読出すときのタイム・チャートである。
【００３１】
図４（Ａ）  ，（Ｂ）  はメモリにデータを書込むときの，書込まれるデータとメモリのアドレスとの関係を示している。
【００３２】
まず，メモリ１７にデータが書込まれる場合について説明する。
【００３３】
図２（Ａ）  を参照して，奇数フィールドのデータが与えられるときにはクロック・パルスＣＬＫの１周期でデータが変化するディジタル輝度データＹｏとクロック・パルスＣＬＫの２周期でデータが変化するディジタル色差データＣｏｒおよびＣｏｂとが配列変換回路１５に与えられる。この配列変換回路１５において，メモリ１７の奇数行メモリにはディジタル輝度データＹｏとＣｏｒのディジタル色差データとが交互に記録されるように，メモリ１７の偶数行メモリにはディジタル輝度データＹｏとＣｏｂのディジタル色差データとが交互に記録されるようにデータ配列の変換が行なわれる。
【００３４】
またアドレス発生器３０において，図４（Ａ）  に示すようにディジタル輝度データＹｏの次にディジタル色差データＣｏｒおよびＣｏｂが連続してメモリ１７に記憶され，ディジタル色差データＣｏｒおよびＣｏｂが記憶された記憶領域のアドレスの次のアドレスの記憶領域は空領域となるように，メモリ書込み用アドレスが生成される。
【００３５】
メモリ１７に，奇数フィールドのディジタル輝度データＹｏおよびディジタル色差データＣｏｒおよびＣｏｂが与えられ，かつアドレス発生器３０から書込み用アドレスが与えられることにより，図４（Ａ）  に示すようにメモリ１７の奇数行メモリには２つおきのアドレスごとにディジタル輝度データＹｏおよびＣｏｒのディジタル色差データが記憶され，かつ輝度データの記憶領域のアドレスの次のアドレスの記憶領域にＣｏｒの色差データが記憶される。したがって２つおきのアドレスごとに空領域ができる。
【００３６】
また図４（Ａ）  に示すようにメモリ１７の偶数行メモリには２つおきのアドレスごとにディジタル輝度データＹｏおよびＣｏｂのディジタル色差データが記憶され，かつ輝度データの記憶領域のアドレスの次のアドレスの記憶領域にＣｏｂの色差データが記憶される。したがって２つおきのアドレスごとに奇数行メモリの空領域に対応して偶数行メモリにも空領域ができる。
【００３７】
図２（Ｂ）  を参照して，偶数フィールドにおいてはクロック・パルスの１周期ごとにデータが変化する輝度データＹｅのみが配列変換回路１５に与えられる。偶数フィールドにおいては色差データは含まれていない。図２（Ｂ）  においては色差データが存在しない様子がハッチングで示されている。
【００３８】
配列変換回路１５に入力す輝度データは，配列変換回路１５において，クロック・パルスＣＬＫの１周期おきに奇数行メモリに記憶される輝度データＹｅと偶数行メモリに記憶される輝度データＹｅとが同期してメモリ１７に与えられるように画素配列の変換が行なわれる。これにより配列変換回路１５から出力されるデータは輝度データのみであってクロック・パルスＣＬＫの１周期ごとにデータが存在しないこととなる。
【００３９】
メモリ１７に，偶数フィールドのディジタル輝度データＹｅが与えられ，かつアドレス発生器３０から書込み用アドレスが与えられると図４（Ａ）  に色差データと輝度データとの間に空欄で示すように空領域に，偶数フィールドの輝度データＹｅが記憶される。
【００４０】
以上のようにして図４（Ｂ）  に示すように，奇数フィールドを表わす画素であり，かつ偶数列の画素および奇数列の画素のうちの一方の画素を表わす輝度データと奇数フィールドの色差データとを連続するアドレスの記憶領域に記憶し，奇数フィールドを表わす画素であり，かつ偶数列の画素および奇数列の画素のうちの他方の画素を表わす輝度データと奇数フィールドの色差データとを連続するアドレスの記憶領域に記憶し，これらの輝度データまたは色差データに連続するアドレスの記憶領域に奇数フィールドの色差データまたは奇数フィールドを表わす画素の輝度データに対応する偶数フィールドを表わす画素の輝度データがメモリ１７に記憶される。
【００４１】
次にメモリ１７からデータが読出される場合について説明する。
【００４２】
図３（Ａ）  および図４（Ｂ）  を参照して，奇数フィールドのデータの読出しにおいては連続するアドレスに記憶されているデータであって奇数フィールドの輝度データＹｏと色差データＣｏｒおよびＣｏｂとが対で読出されるようにアドレス・データがアドレス発生器３０で発生し，メモリ１７に与えられる。これによりメモリ１７から輝度データおよび色差データが読出され配列変換回路１８に与えられる。配列変換回路１８において，奇数フィールドの輝度データＹｏはクロック・パルス１周期ごとにデータが変化し，奇数フィールドの色差データＣｏｒおよびＣｏｂはクロック・パルス２周期ごとにデータが変化し，対応する画素についてのデータがパラレルに出力するようにデータ配列が変換される。
【００４３】
図３（Ｂ）  および図４（Ｂ）  を参照して，奇数フィールドのデータの読出しにおいては連続するアドレスに記憶されているデータであって偶数フィールドの輝度データＹｅと奇数フィールドＣｏｒおよびＣｏｂの色差データとが対で読出されるようにアドレス・データがアドレス発生器３０で発生し，メモリ１７に与えられる。これによりメモリ１７から輝度データおよび色差データが読出され配列変換回路１８に与えられる。配列変換回路１８において，偶数フィールドの輝度データＹｅはクロック・パルス１周期ごとにデータが変化し，奇数フィールドの色差データＣｏｒおよびＣｏｂはクロック・パルス２周期ごとにデータが変化し，対応する画素についてのデータがパラレルに出力するようにデータ配列が変換される。
【００４４】
偶数フィールドに色差データＣｏｒおよびＣｏｂが存在しない４：２：０コンポーネント符号化されたデータであっても，読出し時には輝度データＹｅとともに色差データＣｏｒおよびＣｏｂが出力され，擬似的に４：２：２コンポーネント符号化されたデータと同じデータが得られる。
【００４５】
図５はアドレス発生器３０の電気的構成を示すブロック図である。
【００４６】
アドレス発生器３０には，ＰＬＬ回路１１からクロック・パルスＣＬＫが与えられ，タイミング信号発生回路１０からアドレス発生器３０に含まれるマルチプレクサの切換えを制御する切換制御信号Ｓ０，Ｓ１，Ｓ２およびＬＤが与えられる。
【００４７】
奇数フィールドのデータをメモリに書込む場合，またはメモリから読出す場合のアドレス発生器３０におけるアドレス・データの生成の仕方について説明する。データをメモリに書込む場合は，タイミング信号発生回路１０からメモリ１７にメモリ・ライト信号ＷＥが与えられこの信号ＷＥの立上りのタイミングでデータがメモリ１７に書込まれる。メモリからデータを読出す場合は，タイミング信号発生回路１０からメモリ１７にメモリ・リード信号ＯＥが与えられこの信号ＯＥの立上りのタイミングでデータがメモリ１７から読取られる。
【００４８】
図５において，第１のマルチプレクサ３１には「０」，「１」および「２」の３種類のデータが与えられている。第１のマルチプレクサ３１にはこれら３種類のデータのうちいずれか１つのデータを選択するための切換信号Ｓ０，Ｓ１およびＳ２が与えられている。切換信号Ｓ０がＬレベルのときは第１のマルチプレクサ３１からデータ「０」が出力され，切換信号Ｓ１がＬレベルのときは第１のマルチプレクサ３１からデータ「１」が出力され，切換信号Ｓ２がＬレベルのときは第１のマルチプレクサ３１からデータ「２」が出力される。
【００４９】
第１のマルチプレクサ３１の出力データは加算器３２に与えられる。加算器３２にはアドレス・レジスタ３４の出力データも与えられており，第１のマルチプレクサ３１の出力データと加算して出力される。加算器３２の出力データは第２のマルチプレクサ３３に与えられる。
【００５０】
第２のマルチプレクサ３３には初期データ「ｍ」も与えられている。この初期データ「ｍ」はユーザの所望のデータに設定される。第２のマルチプレクサ３３にはタイミング信号発生回路１０から出力されるアドレス・ロード信号ＬＤも与えられている。第２のマルチプレクサ３３はアドレス・ロード信号ＬＤがＬレベルのときには初期データ「ｍ」を選択して出力し，アドレス・ロード信号ＬＤがＨレベルのときには加算器３２の出力データを選択して出力する。
【００５１】
第２のマルチプレクサ３３の出力データはアドレス・レジスタ３４に与えられる。アドレス・レジスタ３４にはクロック・パルスＣＬＫも与えられており，与えられるクロック・パルスＣＬＫに同期して，アドレス・データＡＤＲとして出力される。このアドレス・データＡＤＲはメモリ１７に与えられるとともに加算器３３に与えられる。
【００５２】
これにより奇数フィールドのときには図４（Ａ）  に示すようにメモリ１７の奇数行メモリには同一画素についての輝度データＹｏとＣｏｒの色差データとを連続するアドレスの記憶領域に記憶でき，メモリ１７の偶数行メモリには同一画素についての輝度データＹｏとＣｏｂの色差データとを連続するアドレスの記憶領域に記憶でき，しかも偶数フィールドの輝度データＹｅを記憶するための空領域も設けることができる。またデータの読取りを行なうときには，奇数フィールドの輝度データＹｏならびに色差データＣｏｒおよびＣｏｂを読出すことができる。
【００５３】
図７を参照して，偶数フィールドのデータをメモリ１７に書込む場合またはメモリ１７に書込まれたデータを読出す場合にも奇数フィールドの場合と同様にしてアドレス・データＡＤＲが生成される。但し，偶数フィールドにおいては，奇数フィールドの場合と異なり第１のマルチプレクサ３１に与えられるデータ「０」は不要となる。
【００５４】
偶数フィールドにおけるアドレス・データの生成は奇数フィールドにおけるデータの生成と同様なのでこれ以上の重複説明は避ける。
【図面の簡単な説明】
【図１】ディジタル・ビデオ・テープ・レコーダの電気的構成の一部を示している。
【図２】（Ａ）  は奇数フィールドのデータをメモリに書込むときのタイム・チャートであり，（Ｂ）  は偶数フィールドのデータをメモリに書込むときのタイム・チャートである。
【図３】（Ａ）  は奇数フィールドのデータをメモリから読出すときのタイム・チャートであり，（Ｂ）  は偶数フィールドのデータをメモリから読出すときのタイム・チャートである。
【図４】（Ａ）  は奇数フィールドのデータをメモリに書込んだときの状態を示し，（Ｂ）  は奇数フィールドおよび偶数フィールドのデータをメモリに書込んだときの状態を示している。
【図５】アドレス発生器の電気的構成を示している。
【図６】奇数フィールドのデータをメモリに書込む場合および奇数フィールドのデータがメモリから読出される場合にアドレス・データを生成するときのタイム・チャートを示している。
【図７】偶数フィールドのデータをメモリに書込む場合および奇数フィールドのデータがメモリから読出される場合にアドレス・データを生成するときのタイム・チャートを示している。
【図８】（Ａ）  は４：２：２コンポーネント符号化されたデータによって表わされる画素の模式図，（Ｂ）  は４：２：０コンポーネント符号化されたデータによって表わされる画素の模式図である。
【符号の説明】
１０  タイミング信号発生回路
１５，１８  配列変換回路
１７  メモリ
３０  アドレス発生器
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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