(57)【特許請求の範囲】
【請求項１】
パケットを複数の固定長セルに分解し、各セルにはシーケンス番号を付加して前記パケットの送受信を行うシステムにおいて，
セルのシーケンス番号からセルの欠落数を検出する手段と,
該セルの欠落の状態からセル落ちのモードを判断し，該セル落ちのモードから対応するセルの補正数及び，補正位置を含む補正情報を出力する補正制御手段と，
該補正情報に基づき，セル欠落部にダミーデータを挿入してセル欠落前のデータ長を復元するパケット組立部を有し，
前記補正制御手段において判断されるセル落ちのモードは，パケットを構成するセルの内，パケットの先頭を構成するパケットの先頭セルが落ちたか， パケットの最後を構成するパケットの先頭セルが落ちたか，或いはパケットの中間を構成するセルが落ちたかの状態を有することを特徴とするデータ長補正システム。
【請求項２】
請求項１において，
受信パケットを一時記憶するデータバッファメモリと，
前記補正情報を一時記憶する制御バッファとメモリと，
該受信パケットと，前記補正制御手段からの補正情報をそれぞれ該データバッファメモリ及び制御バッファメモリに書き込む，書込制御手段を有し，
該データバッファメモリのパケットに，該制御バッファメモリに記憶された補正情報に基づき，前記ダミーデータを挿入することを特徴とするデータ長補正システム。
【請求項３】
請求項２において，
前記データバッファメモリ及び制御バッファメモリは，ＦＩＦＯ(ファーストイン・ファーストアウト)メモリで構成されることを特徴とするデータ長補正システム。
【請求項４】
請求項２において，
前記制御バッファメモリに記憶される補正情報は，パケットの開始(ＢＯＰ)，パケットの終了（ＥＯＰ）及びダミーデータ長であることを特徴とするデータ長補正システム。
【請求項５】
請求項１において，
さらに，受信パケットを一時記憶するデータバッファメモリを有し，
各パケットの先頭セルは，ＢＡｓｉｚｅ(バーストサイズ)情報を含むＣＳヘッダを有し，且つ連続するセル毎のシーケンス番号を有し，
前記補正制御手段は，パケット毎の前記データバッファメモリに書き込んだバイト数を計数するとともに，該セルのシーケンス番号を監視し，セル落ちが検出された時に，前記データバッファメモリに書き込んだバイト数とＢＡｓｉｚｅ(バーストサイズ)を比較して，受信中のパケットの未受信の残りのセル数を求め，次に受信されるセルのシーケンス番号から欠落セル数が，前記残りセル数よりも多いと判定される場合は，前記次に受信されるセルを次のパケットのセルとするように構成されたことを特徴とするデータ長補正システム。
【発明の詳細な説明】
【０００１】
【産業上の利用分野】
本発明は、複数のセルによって構成されるデータにおける、かかるセルが欠落する場合のデータ長を補正するシステムに関する。特に、パケット毎に複数のセルを有して構成されるＡＴＭデータのＡＴＭセルが欠落する場合の問題を解決するためのデータ長補正システムに関する。
【０００２】
【従来の技術】
広帯域ＩＳＤＮ（Ｂ−ＩＳＤＮ）の転送モードとしてＡＴＭ（Ａｓｙｎｃｈｒｏｎｏｕｓ  Ｔｒａｎｓｆｅｒ  Ｍｏｄｅ：非同期転送モード））が使用される。ここで転送モードとは、広帯域から狭帯域に至るまでの、画像、音声あるいはデータ等の情報信号を多重化・伝送・交換する方法である。
【０００３】
更にＡＴＭでは、全てのディジタル情報はセルと呼ぶ、固定長のブロックに分割される。即ち、図１２に示すように、ディジタルのユーザ情報がセル化されて伝送される。
【０００４】
即ち、図１２において、１２０はディジタルのユーザ情報、１２１はヘッダ、１２２は固定長で区切られた情報部、１２３はセルである。図から理解できるように、バースト状に発生するユーザ情報１２０を固定長の情報部１２２に区切り、これにヘッダ１２１を付けたものをセル１２３として構成している。
【０００５】
更に、一のセルの長さは、情報部１２２を４８バイト、ヘッダ１２１を５バイト計５３バイトで構成する。５バイトのヘッダ１２１には宛て先情報等が含まれ、ネットワーク内はセル１２３を単位として転送される。
【０００６】
図１３は、かかるＡＴＭセル１２３の、ＡＴＭ網から受信側端末への一般的な流れを説明する図である。図１３において、１３０はＡＴＭ網、１３１がＡＴＭ受信側端末である。ＡＴＭ受信側端末１３１において、インタフェース回路１３２、ＣＲＣ演算部１３３、ＶＰＩ／ＶＣＩ処理部１３４、データ長処理部１３５及び端末個別の処理部１３６が備えられる。
【０００７】
ここで、インタフェース回路１３２は、ＡＴＭ網１３０からのＡＴＭの受信セルを受信側端末１３１に受入れるためのインタフェース機能を有する。ＣＲＣ演算部１３３は、誤り訂正符号を演算し、符号誤り訂正を行う。
【０００８】
更に、ＶＰＩ／ＶＣＩ処理部１３４は、バーチャル・パス（仮想パス）識別子ＶＰＩ及びバーチャル・チャネル（仮想回線）識別子ＶＣＩに基づき、情報の送信先を識別する。
【０００９】
データ長処理部１３５は、後で説明するようにＡＴＭセルが伝送途中に欠落した場合、これを検出してダミーデータを挿入してデータ長を補正する回路である。個別処理回路１３６は、データ長を補正されたＡＴＭセルを入力して端末個別の処理を行う。
【００１０】
図１４は、上記図１３に示す受信側端末１３１のデータ長処理部１３５における欠落セルの補正を説明する図である。即ち、図１４において、（１）は、送信状態のＡＴＭセル列であり、バースト的にＡＴＭセルが現れている。各ＡＴＭセルは、上記図１２において説明したように、ヘッダ１２１と情報部１２２で構成される。
【００１１】
ＳＮ＝１〜７は、セルのシーケンス番号である。このシーケンス番号ＳＮは、情報部１２２の中に用意されるフィールドに載せられる。このシーケンス番号ＳＮにより、送信されるＡＴＭセルの順序が識別される。図１４の（１）においては、ＳＮ＝４、５の２個のＡＴＭセルが欠落している状態を示している。
【００１２】
いま、このＡＴＭセルが欠落している状態で受信側端末１３１において、そのまま復号すると、欠落したＡＴＭセルに載っていたデータの分だけデータは、短くなってしまう。もしこのデータが画像データのような同期信号を含むものであれば、セルの欠落により、受信側端末１３１で復元した時に同期外れが生じる。
【００１３】
したがって、かかる不都合を防ぐために上記のように情報部１２２にシーケンス番号ＳＮフィールドを設け、このフィールドに連続するシーケンス番号ＳＮを載せている。受信側端末１３１では、この受信したＡＴＭセルのシーケンス番号ＳＮが連続しない場合は、欠落したセルの数を知ることができる。
【００１４】
したがって、受信側端末１３１のデータ長処理部１３５において、欠落したセルのデータと同じ長さのダミーデータ（例えば、オール“０”）を欠落した場所に挿入して、図１４の（２）のように元のデータ長を復元する。同期信号を含む情報部１２２の欠落に対しも同期外れを防止することが出来る。
【００１５】
かかるダミーデータの挿入に対し、実際的にはセルの欠落を検知し、ダミーデータを挿入する間、同時に、後ろに続く幾つかのデータセルを受信するために、これを一時保存するためにバッファが必要となる。したがって、本件発明者は、先にかかるバッファの容量を小さくする技術を提案している（特開平４−３６２８２５号公報）。
【００１６】
かかる先の提案においては、図１５に示すように、受信されたセルを蓄積しておくための受信バッファ（Ａ）と、セルの欠落を検出してセル欠落数を書き込むセル欠落数書込バッファ（Ｂ）を備える。更に、セルを受信する度に、受信セルを受信バッファを書き込むとともに、一つ前に受信したセルとの間に欠落したセル数をセル欠落数書込バッファに書き込むようにしている。
【００１７】
そして、受信バッファからセル読みだしに際して、セル欠落数書込バッファに書き込まれたセル欠落数に基づきダミーデータを挿入するようにしている（Ｃ）。
【００１８】
【発明が解決しようとする課題】
一方、データをパケット単位に構成し、これをＡＴＭ網で送信しようとする場合がある。かかる場合、特にパケットの境界即ち、２つのパケットにまたがって、欠落すると、先に説明した従来技術及び本発明者が先に提案した技術によっても、元のパケットの長さに対する情報を有していないので、正しいパケット長を復元することが出来なくなる。
【００１９】
したがって、本発明の目的は、パケット形態のデータをＡＴＭセル化した場合等において、セルの欠落に対し、元のパケット長を再現することを可能とするデータ長補正システムを提供することにある。
【００２０】
【課題を解決するための手段及び作用】
本発明にしたがうデータ長補正システムは、データを複数の固定長セルに分解し、各セルには、シーケンス番号を付加してデータの送受信を行うシステムにおいて、セルのシーケンス番号からセルの欠落数を検出する手段と、セルの欠落の状態からセル落ちのモードを判断し、該セル落ちのモードから対応するセルの補正数及び、補正位置を含む補正情報を出力する補正制御手段と、前記補正情報に基づき、セル欠落部にダミーデータを挿入してセル欠落前のデータ長を復元するパケット組立部を有して構成される。
【００２１】
更に、具体的態様として、前記補正制御手段において判断されるセル落ちのモードは、パケットの先頭のセルか、パケット中のセルか、パケットの最後までのセルか、或いは２つのパケットにまたがるセルかのセル欠落状態を有する。
【００２２】
更に具体的には、受信データを一時記憶するデータバッファメモリと、補正情報を一時記憶する制御バッファメモリと、受信されたＡＴＭデータと、補正制御手段からの補正情報をそれぞれ該データメモリ及び制御メモリに書き込む、書込制御手段を有し、前記データバッファメモリのデータに、前記制御バッファメモリに記憶された補正情報に基づき、前記ダミーデータを挿入する。
【００２３】
また別の態様として、前記データバッファメモリ及び制御バッファメモリは、ＦＩＦＯ（ファーストイン・ファーストアウト）メモリで構成される。
【００２４】
更に、具体的には、前記制御バッファメモリに記憶される補正情報は、パケットの開始（ＢＯＰ）、パケットの終了（ＥＯＰ）及びダミーデータ長である。
【００２５】
本発明は、上記手段のように、受信側端末において、受信セルからパケットデータである受信データを取り出し、ＦＩＦＯ等のデータバッファメモリに書き込む。
【００２６】
この時、パケット毎のバッファメモリに書き込んだバイト数を計数する。パケットのセルを受信すると、その先頭のセルをＣＳヘッダ中のＢＡｓｉｚｅ（バーストサイズ）を取り出し、その値を保持する。
【００２７】
シーケンス番号を監視し、セル落ちが検出された時に、前記バイト数の計数とＢＡｓｉｚｅ（バーストサイズ）を比較して、受信中のパケットの未受信セル数を認識することが出来る。欠落セル数が、この残りのセルよりも多い場合は、それが次のパケットのセルであると知ることが出来る。
【００２８】
これにより、このパケットの最後に付加されるダミーのデータ長と、次のパケットの先頭に付加するダミーデータ長が計算でき、それぞれ元のパケット長を復元することが出来る。
【００２９】
【実施例】
以下本発明の実施例を図にしたがい説明する。尚、本発明について、同一または類似のものには、同一の参照数字及び記号を付して説明する。
【００３０】
図１は、先に図１３において説明したＡＴＭ受信側端末１３１のデータ長処理部１３５に対応して実施される、本発明のデータ長処理部の構成例ブロック図である。
【００３１】
一方、図２は、本発明の特徴として  送信側でパケットの形態のデータをセル化する時に使用される、タイプ４  ＡＡＬ  ＣＳ（ＡＴＭ  Ａｄａｐｔｉｖｅ  Ｌａｙｅｒ  Ｃｏｎｖｅｒｇｅｎｃｅ  Ｓｕｂｌａｙｅｒ）のフォーマットとタイプ４  ＡＡＬ  ＳＡＲ（ＡＴＭ  Ａｄａｐｔｉｖｅ  Ｌａｙｅｒ  Ｓｅｇｍｅｎｔ  Ａｎｄ  Ｒｅａｓｓｅｍｂｌｙ）サブレイヤのフォーマットを示す図である。
【００３２】
図２において、（１）は、（ＡＡＬ  ＣＳ）フォーマットであり、ＲＥＳ２０は、予備用の領域で１バイトで全“０”にセットされる。ＢＥｔａｇ２１は、開始、終了タグであり、１バイトを有し、この領域は、使用されずに全“０”に  セットされる。
【００３３】
更に、ＢＡｓｉｚｅ，Ｌｅｎｇｔｈ２２は、２バイトで構成されバーストの長さを示す、Ｉｎｆｏｒｍａｔｉｏｎ  Ｆｉｅｌｄ２３は、バイト長の値がセットされる情報領域である。このＩｎｆｏｒｍａｔｉｏｎ  Ｆｉｅｌｄ２３は、１１５７バイトを越えない大きさを有し、パケットデータが収容される。
【００３４】
上記（１）のＲＥＳ２０、ＢＥｔａｇ２１及びＢＡｓｉｚｅ，Ｌｅｎｇｔｈ２２により、ＣＳ（Ｃｏｎｖｅｒｇｅｎｃｅ  Ｓｕｂｌａｙｅｒ）ヘッダ２４となる。更に後部に設けられるＲＥＳ２０、ＢＥｔａｇ２１及びＢＡｓｉｚｅ，Ｌｅｎｇｔｈ２２により、ＣＳトレーラ２５となる。
【００３５】
図２の（２）は、ＣＳヘッダと情報領域により構成されるＡＡＬ  ＳＡＲフォーマットを示し、更に図２の（３）のＡＴＭセルとの関係を示している。図２の（３）は、図１２に示したＡＴＭセルの４８バイトで構成される情報部１２２を示し、先頭に図示されない５バイトのＡＴＭヘッダ１２１が付加されて、一のＡＴＭセル１２３を構成する。
【００３６】
図２の（３）に示すＡＴＭセル１２３の情報部１２２において、ＳＴ２６は、そのセルのセグメントタイプを示し、その内容は、２ビットで次の通りに表される。
【００３７】
ＢＯＭ（メッセージの開始）            ：“１、０”
ＣＯＭ（メッセージの継続）            ：“０、０”
ＥＯＭ（メッセージの終了）            ：“０、１”
ＳＳＭ（単一セグメイントのメッセージ）：“１、１”
更に、ＳＮ２７は、シーケンス番号であり、同じＶＣＩのセル全てに対して、０〜１５の順序番号が付けられる。ＭＩＤ２８は、データセルと制御セルの識別をするメッセージ識別子である。データセルでは、そのセルがどのバーストに属するかを識別する。ＭＩＤ２８は、次の関係で表される。
【００３８】
制御セル  ：  ０
データセル：  １〜２５５の昇番
２９は、ＳＡＲペイロードであり、４４バイトを有し、図２の（２）のＡＡＬＳＡＲフォーマットの内容を（２）と（３）の間を点線で結ぶように４４バイト分ずつに分割して収容する。
【００３９】
また、ＬＩ３０は、ＳＡＲペイロード２９の正確な長さを示す。ＣＲＣ３１は、パリテイ領域であり、このＣＲＣ３１を除くＡＴＭセルの内容から計算され、図１３において説明したＣＲＣ演算部１３３において、誤り訂正に用いる生成多項式  ｘ１０＋ｘ９  ＋ｘ５  ＋ｘ４  ＋ｘ＋１の値がセットされる。
【００４０】
次に、上記のようなパケットをＡＴＭセル化した信号がＡＴＭ網１３０を通して受信される時の、本発明にしたがうデータ処理部１３５の構成及び動作を、各受信データの内容を例示しながら以下に説明する。
【００４１】
図３は、セル欠落がない時の受信セルの状態を示す一例であり、パケット長が１００バイトの第１のパケットと５０バイトの第２のパケットがセル化して送られてきた時の受信データを例としている。
【００４２】
図１において、受信データが図１３のＶＰＩ／ＶＣＩ処理部１３４から書込制御部１０、補正制御部１３及びセル落ち検出部１４に入力する。補正制御部１３において、第１パケットの先頭セルを受信し、図２で説明したＣＳヘッダ２４中のＢＡ（バースト）サイズ２２から１００バイトのパケットを意味する、ＢＡｓｉｚｅ＝１００を検出する。
【００４３】
一方、セル落ち検出部１４では、図２で説明したようにように受信データのＳＮ領域２７からＳＮ番号の不連続からセル落ちしているセル数をカウントする。そしてカウントされたセル落ちのセル数を補正制御部１３に送る。
【００４４】
ここで、補正制御部１３は、ＢＡ（バースト）サイズ２２のラッチ回路及びその出力をバースト長に変換するＲＯＭを有する。
【００４５】
図３の場合は、セル落ちがない場合である。したがって、補正制御部１３から書込制御部１０に送られる補正情報は０である。書込制御部１０は、更に受信データに基づき、データをデータバッファメモリ１１に書き込む。更に、パケットの先頭のデータを書き込むのと同時に、制御バッファメモリ１２にＢＯＰ（パケットの開始フラグ）＝１を書き込む。
【００４６】
ここで、データバッファメモリ１１、制御バッファメモリ１２は、一例としてＦＩＦＯ（ファーストイン・ファーストアウト）で構成される。
【００４７】
そして、書込制御部１０は、補正制御部１３のバースト長に変換するＲＯＭの出力と、データバッファメモリ１１に書き込んだバイト数“４０”をカウントして得られる欠落セル数の値から、図３の第１のパケットの残りバイト数が１００−４０＝６０であることが認識できる。
【００４８】
次のＳＮ＝２のセルを受信すると、そのデータ部分（４１〜８４バイト目）を同様にデータバッファメモリ１１に書き込む。この時の書込制御部１０内のカウンタの値は、８４になる。
【００４９】
更に次のＳＮ＝３のセル（第１のパケットの最終セル）を受信すると、そのデータ部分（８５〜１００バイト目）をデータバッファメモリ１１に書き込む。これと同時に制御バッファメモリ１２にＥＯＰ（パケットの終了フラグ）＝１を書き込む。最終バイトまで書き込まれると、書込制御部１０はカウンタをクリアリセットする。
【００５０】
ついで、５０バイトからなる第２のパケットに対しても上記と同様に処理される。ここで図４は、図３の受信セルの状態に対応する制御バッファメモリ１２と、データバッファメモリ１１の状態を示す図である。
【００５１】
即ち、図４の（１）は、制御バッファメモリ１２の内容であり、ＢＯＰの欄のパケットの開始位置に開始フラグ１が、ＥＯＰの欄のパケットの終了位置に終了フラグ１が、たてられる。補正数は、欠落セルが無いので全て０である。
【００５２】
更に、図４の（２）は、データバッファメモリ１１の内容であり、その上段の数字ｎは、第ｎパケットを示し、下段の数字ｍは、ｍバイト目のデータを示している。図１において、データバッファメモリ１１からのデータ及び制御バッファメモリ１２からのパケットの開始及び終了位置フラグＢＯＰ、ＥＯＰがパケット組立部１６に入力される。
【００５３】
一方、制御バッファメモリ１２からの補正数は、ダミーデータ発生部１５に入力される。この補正数に対応して、“０”の値がパケット組立部１６に送られ、本来のデータ位置に挿入され、データ長がセル欠落前の長さに復元される。
【００５４】
なお、図３の受信データの場合は、セルの欠落が無いのでダミーデータ発生部１５からは、“０”の値がパケット組立部１６に送られることはない。
【００５５】
ここで、更にセル欠落がある場合の受信データの例に基づき説明する前に、上記の図３の受信データの状態例に基づき説明した図１のデータ長処理部１３５の動作を一般化して、図５の動作フローに基づき先に説明する。
【００５６】
受信セルを入力すると、セル落ち検出部１４がセル欠落数Ｎを検出する（ステップＳ１）。セル欠落数Ｎは、補正制御部１３に通知される。更に、補正制御部１３は、このセル欠落がパケットの先頭であるか否かを判断する（ステップＳ２）。
【００５７】
セル欠落がパケットの先頭である場合は、補正制御部１３は、書込制御部１０に対し、書き込み要求として、補正情報、即ちセル欠落位置、この場合ＢＯＰ＝１及び、セル欠落数Ｎに対する補正数〔＝４０＋４４（Ｎ−１）〕を送る（ステップＳ２０）。この補正情報を基に、書込制御部１０は、データバッファメモリ１１、制御バッファメモリ１２に対し書込を行う。
【００５８】
セル欠落がパケットの先頭でない場合は、補正制御部１３は、残セル数が欠落セル数より大きいか否かを判別し、残セル数が欠落セル数より大きい時は、パケット中のセルが欠落していると判断する（ステップＳ３）。
【００５９】
そして、書込制御部１０に対し、書き込み要求として、補正情報、即ちセル欠落位置、この場合セル欠落数Ｎに対する補正数（＝４４×Ｎ）を送る（ステップＳ３０）。この補正情報を基に、書込制御部１０は、データバッファメモリ１１、制御バッファメモリ１２に対し書込を行う。
【００６０】
次に、補正制御部１３が、残セル数＝欠落セル数と判別する（ステップＳ４）場合は、更にパケットの最後のセルまでセル欠落である場合は、書込制御部１０に対し、書き込み要求として、補正情報、即ちセル欠落位置、この場合セル欠落数Ｎに対する補正数（＝残バイト数）を送る（ステップＳ４０）。この補正情報を基に、書込制御部１０は、データバッファメモリ１１、制御バッファメモリ１２に対し書込を行う。
【００６１】
上記ステップＳ４において、残セル数≠欠落セル数であり、残セル数＞欠落セル数である場合は、補正制御部１３が、２パケットにまたがるセル落ちと判断する。この時、書込制御部１０に対し、書き込み要求として、補正情報である補正数（＝残バイト数）、ＥＯＰ＝１を送る。これにより、書込制御部１０は、第１のパケットの最終セルの、制御バッファメモリ１１の対応位置に補正数を書き込む（ステップＳ５）。
【００６２】
更に、補正制御部１３は、Ｍ＝（欠落セル数−残セル数）を計算して、補正情報として補正数＝４０＋４４（Ｍ−１）、ＢＯＰ＝１を、書込制御部１０に送る。書込制御部１０は、これら補正情報を、第２のパケットに対する補正数及び補正位置として、データバッファメモリ１１及び、制御バッファメモリ１２への書込を行う。
【００６３】
上記の処理において、具体的には、受信側端末において、受信セルからパケットデータである受信データを取り出し、ＦＩＦＯ等のデータバッファメモリ１１に書き込む。
【００６４】
この時、パケット毎のバッファメモリ１１に書き込んだバイト数を計数する。パケットのセルを受信すると、その先頭のセルをＣＳヘッダ中のＢＡｓｉｚｅ（バーストサイズ）を取り出し、その値を保持する。
【００６５】
シーケンス番号を監視し、セル落ちが検出された時に、前記書き込んだバイト数を補正制御部１３が計数する。同時に、補正制御部１３は、ＢＡｓｉｚｅ（バーストサイズ）と比較して、受信中のパケットの未受信の残りセル数（＝バーストサイズ−書き込んだバイト数）を求める。
【００６６】
次いで欠落セル数が、この残りセル数よりも多い場合は、それが次のパケットのセルであると知ることが出来る。これにより、このパケットの最後に付加されるダミーのデータ長と、次のパケットの先頭に付加するダミーデータ長が計算でき、それぞれ元のパケット長を復元することが出来る。
【００６７】
次に図６の受信データは、パケットの途中にセル欠落がある場合の受信データの状態を示す図である。即ち、図６の例は、図４に示すデータ例に対応し、但し、第１パケットの二番目のセル（ＳＮ＝２）が欠落している。
【００６８】
この場合は、先ず、第１のパケットの先頭セルを受信し、ＢＡｓｉｚｅ＝１００を抜き出し、第１パケットが１００バイトから構成されることを補正制御部１３が認識する。
【００６９】
書込制御部１０は、データ部分（１〜４０バイト目）をデータバッファメモリ１１に書き込む。またデータバッファメモリ１１に書き込んだバイト数である“４０”を書込制御部１０内のカウンタが計数する。これにより、第１パケットの残りバイト数が６０バイトであることを検出する。
【００７０】
次に、第１パケットの第三番目ＳＮ＝３のセルを受信すると、セル落ち検出部１４が１セル落ちを検出し、補正制御部１３にセル欠落数を通知する。補正制御部１３では、１セル落ちにより失われる最大バイト数４４（パケットの残りバイト数が６０であるので、第三番目ＳＮ＝３のセルのデータと、前のデータ（ＳＮ＝１の最終バイトのデータ）との間に４４バイト分のダミーデータを挿入すればよいと判断する。
【００７１】
したがって、補正制御部１３は、補正数４４の情報を書込制御部１０に送り、書込制御部１０は、制御バッファメモリ１２に補正数４４を書き込む。その後にデータ（８５〜１００バイト目）を書き込む。パケットの最終データ（１００バイト目）をデータバッファメモリ１１に書き込むと、同時に制御バッファメモリ１２にＥＯＰ（パケット終了フラグ）＝１を書き込む。以降のセルに対しては、図４及び図５において説明したと同様に処理される。
【００７２】
図７は、上記図６の受信セルの状態に対応するバッファの状態を示す図である。即ち、図７の（１）の制御バッファメモリ１２の状態において、補正数４４は、図７の（２）のデータバッファメモリ１１の状態の第１のパケットの４０バイトと８５バイトとの間のセル欠落に対応して設定されている。
【００７３】
かかるバッファの状態に対し、パケット組立部１６において、第１のパケットの４０バイトと８５バイトとの間のセル欠落位置に補正数４４、即ち４４バイトに相当するダミーデータが挿入され、データ長がセル欠落前と同じに復元される。
【００７４】
図８は、パケットの最終セルを含んだセルの欠落がある場合の受信データの状態を示す図である。即ち、図８の例は、図４に示すデータ例に対応し、但し、第１パケットの三番目のセル（ＳＮ＝３）及び第２パケットの一番目のセル（ＳＮ＝４）が欠落している場合である。
【００７５】
この場合は、先ず、第１のパケットの先頭セルを受信し、ＢＡｓｉｚｅ＝１００を抜き出し、第１パケットが１００バイトから構成されることを補正制御部１３が認識する。
【００７６】
書込制御部１０は、データ部分（１〜４０バイト目）をデータバッファメモリ１１に書き込む。またデータバッファメモリ１１に書き込んだバイト数である“４０”を書込制御部１０内のカウンタが計数する。これにより、第１パケットの残りバイト数が６０バイトであることを検出する。
【００７７】
次のセル（ＳＮ＝２）を受信すると、そのデータ部分（４１〜８４バイト目）をデータバッファメモリ１１に同様にして書き込む。この時、書込制御部１０内のカウンタの値は、８４になる。これにより、第１パケットの残りバイト数が１６バイトであることを検出する。
【００７８】
次に、第１パケットの第三番目ＳＮ＝３のセル及び第２パケットの第一番目ＳＮ＝４のセルが欠落しているので、第２パケットの第二番目ＳＮ＝５のセルを受信する。この時、セル落ち検出部１４が２セル落ちを検出し、補正制御部１３にセル欠落数２を通知する。
【００７９】
補正制御部１３では、２セル落ちにより失われる最大バイト数８８でパケットの残りバイト数が１６であるので、パケットの最終セルを含んだセル落ちであると判断できる。更に、残りバイト数１６を運ぶのに必要なセル数“１”を例えばテーブルＲＯＭを使用して得る。
【００８０】
更に、セル落ちが“２”なので、もう一つのセルは、次のパケットの先頭セルであることが分かる。これにより、先ずＥＯＰ＝１と補正数１６、次にＢＯＰ＝１と補正数４０を制御バッファメモリ１２に書き込む。その後にセルのデータ（第２パケットの４０〜５０バイト）をデータバッファメモリ１１に書き込む。
【００８１】
図９は、図８の受信セルの状態に対応するバッファの状態を示す図である。図９の（１）に示すように、制御バッファメモリ１１に補正数として、ＥＯＰ＝１のフラグに対応するセル位置に１６バイト、ＢＯＰ＝１のフラグに対応する位置に４０バイトが記録される。
【００８２】
この結果、図９の右に示されるように、第１のパケットの最終のセル位置及び、第２のパケットの最初のセル位置にダミーデータが挿入されて、元のセル欠落前のデータ長が復元される。
【００８３】
図１０は、パケットの先頭からセルの欠落がある場合の受信データの状態を示す図である。即ち、図１０の例は、図４に示すデータ例に対応し、但し、第２パケットの一番目のセル（ＳＮ＝４）が欠落している場合である。
【００８４】
この場合は、第１のパケットについては、セル落ちが無いので図４、図５において説明したと同様に、通常の処理が行われる。第２パケットの二番目のセルであるＳＮ＝５のセルを受信すると、セル落ち検出部１４が、１セルの欠落を検知し、補正制御部１３に通知する。
【００８５】
補正制御部１３では、先頭１セルの欠落なので、デーブルＲＯＭにより、補正数４０を読み出し、書込制御部１０に補正情報を送り、補正数４０とＢＯＰ＝１を制御バッファメモリ１２に書き込む。その後に第２パケットの二番目のセルのデータ４０〜５０バイト分をデータバッファメモリ１１に書き込む。
【００８６】
図１１は、図１０の受信セルの状態に対応するバッファの状態である。図１１の（１）の制御バッファメモリ１２には、ＢＯＰ＝１に対応して、第２のパケットの先頭セルに対応する位置のデータが欠落し、４０バイトの補正数が記されている。そして、図１１の右部に示されるように、第２のパケットの先頭にダミーデータが付され、元のデータ長が再現されている。
【００８７】
【発明の効果】
以上実施例にしたがい説明したように本発明は、ＡＴＭ網を使って、パケット形態のデータを送信する場合、セル落ちが生じても、受信側でダミーデータを挿入して元のパケット長を復元することができる。特に、本発明は、２つのパケットにまたがりセルが欠落する場合であっても、ダミーデータ長を正しく計算して挿入することが可能であり、欠落前のデータ長を復元することができる。
【００８８】
また、上記の実施例は、本発明の理解のために例示されたものであり、本発明は、かかる実施例においてのみ実現されるものではない。上記本発明の技術思想と同じくするものは、請求の範囲に記載されたものと均等の範囲にあるものは、全て本発明の保護の範囲に含まれるものである。
【図面の簡単な説明】
【図１】本発明にしたがうデータ長処理部の構成例ブロック図である。
【図２】タイプ４  ＡＡＬ  ＣＳ  ＳＡＲフォーマットの構成例を示す図である。
【図３】セル欠落がない時の受信セルの状態例を示す図である。
【図４】図３の受信セルの状態に対応するバッファメモリの状態を示す図である。
【図５】本発明にしたがう補正制御ブロック図の処理の流れを示すフローである。
【図６】パケット中のセル欠落の受信セルの状態例を示す図である。
【図７】図６の受信セルの状態に対応するバッファメモリの状態を示す図である。
【図８】パケットの最終セルを含んだセル欠落の受信セルの状態例を示す図である。
【図９】図８の受信セルの状態に対応するバッファメモリの状態を示す図である。
【図１０】パケットの先頭からセル欠落の受信セルの状態例を示す図である。
【図１１】図１０の受信セルの状態に対応するバッファメモリの状態を示す図である。
【図１２】ＡＴＭの情報伝達方式を示す図である。
【図１３】受信側端末でのＡＴＭセルの流れを示す図である。
【図１４】従来のデータ長補正例を示す図である。
【図１５】先に提案された方式によるデータ長補正例を示す図である。
【符号の説明】
１２０  ユーザ情報
１２１  ヘッダ
１２２  情報部
１２３  セル
１３０  ＡＴＭ網
１３１  受信側端末
１３２  インタフェース回路
１３３  ＣＲＣ演算部
１３４  ＶＰＩ／ＶＣＩ処理部
１３５  データ長処理部
１０  書込制御部
１１  データバッファメモリ
１２  制御バッファメモリ
１３  補正制御部
１４  セル落ち検出部
１５  ダミーデータ発生部
１６  パケット組立部
１３６  端末個別の処理部
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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