(57)【特許請求の範囲】
【請求項１】
複数の走査線と、
各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、
各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する電気光学装置を駆動するための駆動回路であって、
スタートパルス信号をシフトしたシフト出力に対応するゲート信号を各走査線に出力するゲート信号生成回路を含み、
前記ゲート信号生成回路は、
前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成するスタートパルス信号生成回路を含むことを特徴とする駆動回路。
【請求項２】
請求項１において、
前記スタートパルス信号生成回路は、
第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする駆動回路。
【請求項３】
請求項１又は２において、
第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、
前記スタートパルス信号生成回路は、
前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする駆動回路。
【請求項４】
複数の走査線と、
各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、
各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
スタートパルス信号をシフトしたシフト出力に対応するゲート信号を各走査線に出力するゲート信号生成回路と、
を含み、
前記ゲート信号生成回路は、
前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成するスタートパルス信号生成回路を含むことを特徴とする電気光学装置。
【請求項５】
請求項４において、
前記スタートパルス信号生成回路は、
第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする電気光学装置。
【請求項６】
請求項４又は５において、
第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、
前記スタートパルス信号生成回路は、
前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする電気光学装置。
【請求項７】
複数の走査線と、
各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、
各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、
各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、
を有する電気光学装置を駆動するための駆動方法であって、
前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件にスタートパルス信号を生成し、
前記スタートパルス信号をシフトしたシフト出力に対応するゲート信号を、各走査線に出力することを特徴とする駆動方法。
【請求項８】
請求項７において、
第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする駆動方法。
【請求項９】
請求項７又は８において、
第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、
前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することを特徴とする駆動方法。
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】
本発明は、駆動回路、電気光学装置及び駆動方法に関する。
【０００２】
【従来の技術】
液晶（Liquid Crystal Display：ＬＣＤ）パネルに代表される表示パネル（広義には電気光学装置）は、各種情報機器の表示部に用いられている。情報機器の小型軽量化や高画質化の要求により、表示パネルの小型化、画素の微細化が望まれている。その１つの解決策として、低温ポリシリコン（Low Temperature Poly-Silicon：以下ＬＴＰＳと略す。）プロセスにより、表示パネルを形成することが検討されている。
【０００３】
ＬＴＰＳプロセスによれば、スイッチ素子（例えば、薄膜トランジスタ（Thin Film Transistor：ＴＦＴ））等を含む画素が形成されるパネル基板（例えばガラス基板）上に、駆動回路等を直接形成することができる。そのため、部品数を削減し、表示パネルの小型軽量化が可能となる。またＬＴＰＳでは、これまでのシリコンプロセスの技術を応用して、開口率を維持したまま画素の微細化を図ることができる。更にまたＬＴＰＳは、アモルファスシリコン（amorphous silicon：ａ−Ｓｉ）に比べて電荷の移動度が大きく、かつ寄生容量が小さい。したがって、画面サイズの拡大により１画素当たりの画素選択期間が短くなった場合でも、当該基板上に形成された画素の充電期間を確保し、画質の向上を図ることが可能となる。
【０００４】
【特許文献１】
特開２００２−２３７０９号公報
【０００５】
【発明が解決しようとする課題】
例えばＬＴＰＳによりＴＦＴが形成される表示パネルでは、該表示パネルを駆動するドライバ（駆動回路）の全部をパネル上に形成することができる。しかしながら、シリコン基板上でＩＣ化された場合に比べると、微細化や速度の点で問題があり、ドライバの機能の一部を表示パネル上に形成することが検討されている。
【０００６】
そこで、１本の信号線を、Ｒ、Ｇ、Ｂ用（第１〜第３の色成分用）の画素電極に接続可能なＲ、Ｇ、Ｂ用信号線のいずれかに接続するデマルチプレクサを設ける表示パネルが考えられる。この場合、ＬＴＰＳの電荷の移動度が大きいことを利用して、信号線上に、Ｒ、Ｇ、Ｂ用の表示データが、時分割されて伝送される。そして、当該Ｒ、Ｇ、Ｂ用画素の選択期間に、各色成分用の表示データが、デマルチプレクサにより順次Ｒ、Ｇ、Ｂ用信号線に切り替えて出力され、各色成分ごとに設けられた画素電極に書き込まれる。このような構成によれば、ドライバから信号線に表示データを出力するための端子の数を削減することができる。そのため、端子間のピッチに制限されることなく、画素の微細化による信号線数の増加にも対応することができる。
【０００７】
しかしながら、ドライバ及び表示パネルを含めた装置全体の低消費電力化をより追求する場合には、表示パネルの端子数を減らすことが望ましい。その際、表示パネルの画質を劣化させることなく、表示パネルとドライバとの間で伝達される信号の数を削減する必要がある。
【０００８】
本発明は、以上のような技術的課題に鑑みてなされたものであり、その目的とするところは、電気光学装置と駆動回路とが同一基板上に形成された場合に、画質を劣化させることなく端子数を削減することができる電気光学装置の駆動回路、電気光学装置及びその駆動方法を提供することにある。
【０００９】
【課題を解決するための手段】
上記課題を解決するために本発明は、複数の走査線と、各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する電気光学装置を駆動するための駆動回路であって、スタートパルス信号をシフトしたシフト出力に対応するゲート信号を各走査線に出力するゲート信号生成回路を含み、前記ゲート信号生成回路は、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成するスタートパルス信号生成回路を含む駆動回路に関係する。
【００１０】
本発明において、電気光学装置では、複数の走査線と、各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、各画素が走査線と信号線とにより特定される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊの色成分用の各画素に接続され第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを含む。したがって、各走査線による選択期間において、信号線に時分割されて出力された第１〜第３の色成分用のデータ信号が第１〜第３のデマルチプレクス制御信号により切り替え出力されて、各色成分用の各画素への書き込みが行われる。すなわち、画素への書き込み期間においては、第１〜第３のデマルチプレクス制御信号が、排他的にアクティブとなる。
【００１１】
そこで本発明では、スタートパルス信号生成回路が、第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件にスタートパルス信号を生成する。そして、該スタートパルス信号をシフトしたシフト出力に対応するゲート信号を各走査線に出力する。
【００１２】
こうすることで、非常に簡素な構成で、スタートパルス信号を入力するための端子を削減することができる。特に電気光学装置と当該駆動回路とを同一基板上に形成する場合には、電気光学装置の端子数を削減できるため、より低消費電力化を図ることができる。
【００１３】
また本発明に係る駆動回路では、前記スタートパルス信号生成回路は、第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００１４】
本発明においては、表示品位への影響がない帰線期間において、本来重複してアクティブとすべきでない第１〜第３のデマルチプレクス制御信号の少なくとも２つを重複してアクティブにしてスタートパルス信号を内部で生成するようにした。そして、本来の画素への書き込み期間において、本来のデータ信号が改めて各画素に書き込まれる。したがって、画質を劣化させることなく、スタートパルス信号を内部で生成することができ、かつその入力端子を削減することができる。
【００１５】
また本発明に係る駆動回路では、第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、前記スタートパルス信号生成回路は、前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００１６】
第１〜第３の色成分用の各画素が一括して選択される期間内において第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合において、スタートパルス信号を生成するために第１のデマルチプレクス制御信号を用いる場合を考える。この場合、第１のデマルチプレクス制御信号をアクティブにしてスタートパルス信号を生成した後、該スタートパルス信号により１フレームの垂直走査期間の最初の選択期間の開始直後に、改めて第１のデマルチプレクス制御信号をアクティブにする必要がある。したがって、第１のデマルチプレクス制御信号の生成タイミングが、他の第２及び第３のデマルチプレクス制御信号に比べて余裕がない。この傾向は、画素数の増大により画素の選択期間の短縮化が進むに伴い、より顕著となる。
【００１７】
したがって本発明においては、第１のデマルチプレクス制御信号を除いて第２及び第３のデマルチプレクス制御信号を用いてスタートパルス信号を生成するようにしたので、画素の選択期間の短縮化が進んだ場合にも、端子数を削減可能な駆動回路を提供することができる。
【００１８】
また本発明は、複数の走査線と、各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサと、スタートパルス信号をシフトしたシフト出力に対応するゲート信号を各走査線に出力するゲート信号生成回路とを含み、前記ゲート信号生成回路は、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成するスタートパルス信号生成回路を含む電気光学装置に関係する。
【００１９】
また本発明に係る電気光学装置では、前記スタートパルス信号生成回路は、第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００２０】
また本発明に係る電気光学装置では、第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、前記スタートパルス信号生成回路は、前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００２１】
また本発明は、複数の走査線と、各信号線が第１〜第３の色成分用のデータ信号を多重化して伝送される複数の信号線と、各画素が前記走査線のいずれか１つと前記信号線のいずれか１つとに接続される複数の画素と、各デマルチプレクス用スイッチ素子が一端が各信号線に接続され他端が第ｊ（１≦ｊ≦３、ｊは整数）の色成分用の各画素に接続され、第１〜第３のデマルチプレクス制御信号に基づいて排他的にスイッチ制御される第１〜第３のデマルチプレクス用スイッチ素子を含む複数のデマルチプレクサとを有する電気光学装置を駆動するための駆動方法であって、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件にスタートパルス信号を生成し、前記スタートパルス信号をシフトしたシフト出力に対応するゲート信号を、各走査線に出力する駆動方法に関係する。
【００２２】
また本発明に係る駆動方法では、第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、前記第１のフレームの垂直走査期間と前記第２のフレームの垂直走査期間との間に設けられた帰線期間において、前記第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００２３】
また本発明に係る駆動方法では、第１〜第３の色成分用の各画素が一括して選択される期間内において前記第１、第２、第３のデマルチプレクス制御信号の順にアクティブになる場合に、前記第２及び第３のデマルチプレクス制御信号が重複してアクティブになることを条件に前記スタートパルス信号を生成することができる。
【００２４】
【発明の実施の形態】
以下、本発明の好適な実施の形態について図面を用いて詳細に説明する。なお、以下に説明する実施の形態は、特許請求の範囲に記載された本発明の内容を不当に限定するものではない。また以下で説明される構成の全てが本発明の必須構成要件であるとは限らない。
【００２５】
また以下では、電気光学装置として、ＬＴＰＳによりスイッチ素子としてＴＦＴが形成された表示パネル（液晶パネル）を例に説明するが、本発明はこれに限定されるものではない。
【００２６】
図１に、本実施形態における表示パネルの構成の概要を示す。本実施形態における表示パネル（広義には電気光学装置）１０は、複数の走査線（ゲート線）と、複数の信号線（データ線）と、複数の画素とを含む。複数の走査線と複数の信号線とは、互いに交差するように配置される。画素は、走査線と信号線とにより特定される。
【００２７】
表示パネル１０では、各走査線（ＧＬ）及び各信号線（ＳＬ）により３画素単位で選択される。選択された各画素には、信号線に対応する３本の色成分用信号線（Ｒ、Ｇ、Ｂ）のいずれかを伝送する各色成分用信号が書き込まれる。各画素は、ＴＦＴと画素電極とを含む。
【００２８】
表示パネル１０では、例えばガラス基板等のパネル基板上に走査線及び信号線が形成される。より具体的には、図１に示すパネル基板上に、Ｙ方向に複数配列されそれぞれＸ方向に伸びる走査線ＧＬ１〜ＧＬＭ（Ｍは２以上の整数）と、Ｘ方向に複数配列されそれぞれＹ方向に伸びる信号線ＳＬ１〜ＳＬＮ（Ｎは２以上の整数）とが形成されている。更に該パネル基板上には、Ｘ方向に第１〜第３の色成分用信号線を１組として複数組配列されそれぞれＹ方向に伸びる色成分用信号線（Ｒ１、Ｇ１、Ｂ１）〜（ＲＮ、ＧＮ、ＢＮ）が形成されている。
【００２９】
走査線ＧＬ１〜ＧＬＭと、第１の色成分用信号線Ｒ１〜ＲＮとの交差位置に、Ｒ用画素（第１の色成分用画素）ＰＲ（ＰＲ１１〜ＰＲＭＮ）が設けられている。走査線ＧＬ１〜ＧＬＭと、第２の色成分用信号線Ｇ１〜ＧＮとの交差位置に、Ｇ用画素（第２の色成分用画素）ＰＧ（ＰＧ１１〜ＰＧＭＮ）が設けられている。走査線ＧＬ１〜ＧＬＭと、第３の色成分用信号線Ｂ１〜ＢＮとの交差位置に、Ｂ用画素（第３の色成分用画素）ＰＢ（ＰＢ１１〜ＰＢＭＮ）が設けられている。
【００３０】
図２（Ａ）、（Ｂ）に、色成分用画素の構成例を示す。ここでは、Ｒ用画素ＰＲｍｎ（１≦ｍ≦Ｍ、１≦ｎ≦Ｎ、ｍ、ｎは整数）の構成例を示すが、他の色成分用画素の構成も同様である。
【００３１】
図２（Ａ）において、第１のスイッチ素子ＳＷ１としてのＴＦＴｍｎはｎ型トランジスタである。ＴＦＴｍｎのゲート電極は、走査線ＧＬｍに接続される。ＴＦＴｍｎのソース電極は、第１の色成分用信号線Ｒｎに接続される。ＴＦＴｍｎのドレイン電極は、画素電極ＰＥｍｎに接続される。画素電極ＰＥｍｎに対向して、対向電極ＣＥｍｎが設けられている。対向電極ＣＥｍｎには、コモン電圧ＶＣＯＭが印加される。画素電極ＰＥｍｎと対向電極ＣＥｍｎとの間には、液晶材が挟持されて液晶層ＬＣｍｎが形成される。画素電極ＰＥｍｎと対向電極ＣＥｍｎとの間の電圧に応じて、液晶層ＬＣｍｎの透過率が変化する。また、画素電極ＰＥｍｎの電荷のリークを補うため、画素電極ＰＥｍｎと対向電極ＣＥｍｎと並列に補助容量ＣＳｍｎが形成される。補助容量ＣＳｍｎの一端は、画素電極ＰＥｍｎと同電位にされる。補助容量ＣＳｍｎの他端は、対向電極ＣＥｍｎと同電位にされる。
【００３２】
また図２（Ｂ）に示すように、第１のスイッチ素子ＳＷ１としてトランスファゲートを用いることも可能である。トランスファゲートは、ｎ型トランジスタであるＴＦＴｍｎと、ｐ型トランジスタであるｐＴＦＴｍｎとにより構成される。ｐＴＦＴｍｎのゲート電極は、走査線ＧＬｍと互いに論理レベルが反転する走査線ＸＧＬｍに接続される必要がある。図２（Ｂ）では、書き込むべき電圧に応じたオフセット電圧を不要とする構成をとることができる。
【００３３】
また図１において、パネル基板上には、ゲート信号生成回路２０と、各信号線に対応して設けられたデマルチプレクサ（demultiplexer）ＤＭＵＸ１〜ＤＭＵＸＮとが設けられている。
【００３４】
ゲート信号生成回路２０には、走査線ＧＬ１〜ＧＬＭが接続される。またゲート信号生成回路２０には、デマルチプレクス制御信号と、シフトクロックＣＰＶとが入力される。デマルチプレクス制御信号は、各デマルチプレクサのスイッチ制御を行うための信号である。シフトクロックＣＰＶは、走査線ＧＬ１〜ＧＬＭを順次選択するタイミングを規定するクロックである。
【００３５】
ゲート信号生成回路２０は、シフトクロックＣＰＶを用いてゲート信号（選択信号）ＧＡＴＥ１〜ＧＡＴＥＭを生成する。ゲート信号ＧＡＴＥ１〜ＧＡＴＥＭは、それぞれ走査線ＧＬ１〜ＧＬＭに出力される。ゲート信号ＧＡＴＥ１〜ＧＡＴＥＭは、スタートパルス信号により開始される１フレームの垂直走査期間においていずれか１つがアクティブとなるパルス信号である。
【００３６】
図１において、第１〜第３のスイッチ素子ＳＷ１〜ＳＷ３は、走査線ＧＬｍに供給されたゲート信号ＧＡＴＥｍによりスイッチ制御（オン・オフ制御）される。各スイッチ素子がオン状態のとき、各色成分用信号線と各画素電極とが電気的に接続される。
【００３７】
このようなゲート信号ＧＡＴＥ１〜ＧＡＴＥＭは、例えばスタートパルス信号をシフトレジスタによりシフトしたシフト出力に対応する信号である。シフトレジスタは、複数のフリップフロップ（flip-flop）を有し、各フリップフロップに共通に入力されたシフトクロックに基づいてシフト動作を行う。スタートパルス信号は、ゲート信号生成回路２０において、デマルチプレクス制御信号に基づいて生成される。
【００３８】
デマルチプレクス制御信号は、例えば表示パネル１０の外部に設けられたソースドライバ（信号線駆動回路）から供給される。また信号線ＳＬ１〜ＳＬＮは、例えば表示パネル１０の外部に設けられたソースドライバ（信号線駆動回路）により駆動される。ソースドライバは、各色成分用の画素に、階調データに対応したデータ信号を出力する。この際、ソースドライバは、色成分用画素ごとに時分割され各色成分の階調データに対応した電圧（データ信号）を、各色成分用信号線に出力する。そしてソースドライバは、時分割のタイミングに合わせて、各色成分の階調データに対応した電圧を各色成分用信号線に選択出力するためのデマルチプレクス制御信号を生成し、表示パネル１０に対して出力する。
【００３９】
図３に、ソースドライバにより信号線に出力されるデータ信号とデマルチプレクス制御信号との関係を模式的に示す。ここでは、信号線ＳＬｎに出力されたデータ信号ＤＡＴＡｎを示す。
【００４０】
ソースドライバは、信号線ごとに、各色成分用の階調データ（表示データ）に対応した電圧が時分割により多重化されたデータ信号を出力する。図３では、ソースドライバは、Ｒ用画素への書込信号、Ｇ用画素への書込信号及びＢ用画素への書込信号を多重化して信号線ＳＬｎに出力する。ここで、Ｒ用画素への書込信号は、信号線ＳＬｎに対応するＲ用画素ＰＲ１ｎ〜ＰＲＭｎのうち、例えば走査線ＧＬｍにより選択されるＲ用画素ＰＲｍｎへの書込信号である。Ｇ用画素への書込信号は、信号線ＳＬｎに対応するＧ用画素ＰＧ１ｎ〜ＰＧＭｎのうち、例えば走査線ＧＬｍにより選択されるＧ用画素ＰＧｍｎへの書込信号である。Ｂ用画素への書込信号は、信号線ＳＬｎに対応するＢ用画素ＰＢ１ｎ〜ＰＢＭｎのうち、例えば走査線ＧＬｍにより選択されるＢ用画素ＰＢｍｎへの書込信号である。
【００４１】
またソースドライバは、データ信号ＤＡＴＡｎにおいて多重化される各色成分用書込信号の時分割タイミングに合わせて、デマルチプレクス制御信号を生成する。デマルチプレクス制御信号は、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）からなる。
【００４２】
またパネル基板上には、信号線ＳＬｎに対応するデマルチプレクサＤＭＵＸｎが設けられている。デマルチプレクサＤＭＵＸｎは、第１〜第３（ｉ＝３）のデマルチプレクス用スイッチ素子ＤＳＷ１〜ＤＳＷ３を含む。
【００４３】
デマルチプレクサＤＭＵＸｎの出力側には、第１〜第３の色成分用信号線（Ｒｎ、Ｇｎ、Ｂｎ）が接続される。また、入力側には、信号線ＳＬｎが接続される。デマルチプレクサＤＭＵＸｎは、デマルチプレクス制御信号に応じて、信号線ＳＬｎと、第１〜第３の色成分用信号線（Ｒｎ、Ｇｎ、Ｂｎ）のいずれかとを、電気的に接続する。デマルチプレクサＤＭＵＸ１〜ＤＭＵＸＮには、それぞれ共通にデマルチプレクス制御信号が入力される。
【００４４】
第１のデマルチプレクス用スイッチ素子ＤＳＷ１は、第１のデマルチプレクス制御信号Ｒｓｅｌによりオン・オフ制御される。第２のデマルチプレクス用スイッチ素子ＤＳＷ２は、第２のデマルチプレクス制御信号Ｇｓｅｌによりオン・オフ制御される。第３のデマルチプレクス用スイッチ素子ＤＳＷ３は、第３のデマルチプレクス制御信号Ｂｓｅｌによりオン・オフ制御される。第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）は周期的に順次アクティブとなる。そのため、デマルチプレクサＤＭＵＸｎは、周期的に、信号線ＳＬｎと第１〜第３の色成分用信号線（Ｒｎ、Ｇｎ、Ｂｎ）とを順次電気的に接続する。
【００４５】
このような構成の表示パネル１０において、時分割された第１〜第３の色成分用の階調データに対応した電圧が、信号線ＳＬｎに出力される。デマルチプレクサＤＭＵＸｎでは、時分割タイミングに合せて生成された第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）により、各色成分の階調データに対応した電圧が、第１〜第３の色成分用信号線（Ｒｎ、Ｇｎ、Ｂｎ）に印加される。このとき、走査線ＧＬｍにより選択された第１〜第３の色成分用画素（ＰＲｍｎ、ＰＧｍｎ、ＰＢｍｎ）のいずれかにおいて、色成分用信号線と画素電極とが電気的に接続される。
【００４６】
なお図１において、シフトクロックを生成する回路の機能の一部又は全部、或いは上述のソースドライバの一部又は全部の機能を有する回路を、表示パネル１０のパネル基板上に形成するようにしてもよい。
【００４７】
表示パネル１０の駆動回路の機能は、ゲート信号生成回路２０、デマルチプレクサＤＭＵＸ１〜ＤＭＵＸＮ及び上述の機能を有するソースドライバにより構成される回路の一部又は全部により実現される。
【００４８】
ゲート信号生成回路２０は、以下のようにゲート信号を生成する。
【００４９】
図４に、ゲート信号生成回路２０の構成例を示す。ゲート信号生成回路２０は、シフトレジスタ３０と、スタートパルス信号生成回路４０とを含む。
【００５０】
シフトレジスタ３０は、複数のフリップフロップＦＦ１〜ＦＦＭを含む。フリップフロップＦＦｐ（１≦ｐ≦Ｍ−１、ｐは整数）の出力は、次の段のフリップフロップＦＦｐ＋１の入力に接続される。フリップフロップＦＦｐの出力は、走査線ＧＬｐに接続される。
【００５１】
各フリップフロップは、入力端子Ｄと、クロック入力端子Ｃと、出力端子Ｑと、リセット端子Ｒとを有する。フリップフロップは、クロック入力端子Ｃへの入力信号の立ち上がりで、入力端子Ｄへの入力信号をラッチする。そしてフリップフロップは、ラッチした信号を、出力端子Ｑから出力する。またフリップフロップは、リセット端子Ｒへの入力信号の論理レベルが「Ｈ」となったとき、ラッチした内容を初期化し、出力端子Ｑからの出力信号を論理レベル「Ｌ」にする。
【００５２】
フリップフロップＦＦ１の入力端子Ｄには、スタートパルス信号ＩＳＴＶが入力される。フリップフロップＦＦ１〜ＦＦＭの各リセット端子Ｒには、所与のリセット信号ＲＳＴが共通に入力される。またフリップフロップＦＦ１〜ＦＦＭの各クロック入力端子Ｃには、シフトクロックＣＰＶが入力される。
【００５３】
スタートパルス信号生成回路４０は、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）に基づいてスタートパルス信号ＩＳＴＶを生成する。第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）は、同時にオン状態とならないように第１〜第３のデマルチプレクス用スイッチング素子ＤＳＷ１〜ＤＳＷ３のスイッチ制御を行う。したがって、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）は、本来同時にアクティブとならない。
【００５４】
そこで、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）のうち少なくとも２つが同時にアクティブのとき、スタートパルス信号生成回路４０は、スタートパルス信号ＩＳＴＶを生成するようにしている。こうすることで、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が本来行うべき排他的なスイッチ制御という機能を維持しながら、１フレームの垂直走査期間を開始すべきタイミングを指示することができる。したがって、スタートパルス信号を外部で生成する必要がなく、ゲート信号生成回路２０（表示パネル１０）に入力するための信号を不要とすることができる。
【００５５】
図５に、スタートパルス信号生成回路４０の構成例を示す。スタートパルス信号生成回路４０は、２入力１出力ＡＮＤゲート４２を含む。ＡＮＤゲート４２には、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）が入力される。ＡＮＤゲート４２の出力端子からは、スタートパルス信号ＩＳＴＶが出力される。ＡＮＤゲート４２は、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）の論理積演算結果をその出力端子から出力する。
【００５６】
このような構成のシフトレジスタ３０では、まずリセット信号ＲＳＴにより各フリップフロップの出力がリセットされる。そして、フリップフロップＦＦ１に入力されたスタートパルス信号ＩＳＴＶは、シフトクロックＣＰＶの立ち上がりで取り込まれ、それ以降シフトクロックＣＰＶに同期してシフトされる。各フリップフロップからのシフト出力又はこれに対応した信号は、走査線ＧＬ１〜ＧＬＭに出力される。これにより、走査線ＧＬ１〜ＧＬＭに、各走査線が排他的に選択されるゲート信号ＧＡＴＥ１〜ＧＡＴＥＭを出力することができる。
【００５７】
図６に、スタートパルス信号生成回路４０の動作例のタイミングチャートを示す。ここでは、帰線期間において、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）が重複してアクティブとなることによりスタートパルス信号ＩＳＴＶが生成される。
【００５８】
ここで帰線期間とは、第１のフレームに続いて第２のフレームで各画素にデータ信号が書き込まれる場合に、第１のフレームの垂直走査期間と第２のフレームの垂直走査期間との間に設けられる期間である。垂直走査期間は、複数の水平走査期間を含む。各水平走査期間では、いずれか１つの走査線が選択される。
【００５９】
図６において、例えば第１の走査線を走査線ＧＬＭ、第２の走査線を走査線ＧＬ１とすると、走査線ＧＬＭが選択されたフレームの垂直走査期間と、走査線ＧＬ１が選択されたフレームの垂直走査期間との間に帰線期間が設けられる。
【００６０】
ここで、第１のフレームで走査線ＧＬ１〜ＧＬＭが順次選択され、該第１のフレームに続く第２のフレームで走査線ＧＬ１〜ＧＬＭが順次選択されるものとする。走査線ＧＬＭによる選択期間は、第１のフレームの最後の水平走査期間ということができる。また、走査線ＧＬ１による選択期間は、第２のフレームの最初の水平走査期間ということができる。
【００６１】
より具体的には、走査線ＧＬＭに接続されるＲ用画素（ＰＲＭ１〜ＰＲＭＮ）、Ｇ用画素（ＰＧＭ１〜ＰＧＭＮ）、Ｂ用画素（ＰＢＭ１〜ＰＢＭＮ）（第１の画素群）への各色成分用信号の書き込み期間と、走査線ＧＬ１に接続されるＲ用画素（ＰＲ１１〜ＰＲ１Ｎ）、Ｇ用画素（ＰＧ１１〜ＰＧ１Ｎ）、Ｂ用画素（ＰＢ１１〜ＰＢ１Ｎ）（第２の画素群）への各色成分用信号の書き込み期間との間に、帰線期間が設けられる。
【００６２】
このように、帰線期間において第２及び第３のデマルチプレクス制御信号が重複してアクティブとなることを条件にスタートパルス信号ＩＳＴＶを生成することとしたのは、当該期間への画素の書き込みは直接的には表示品位に関係しないためである。すなわち、一時的に重複してアクティブとなったデマルチプレクス制御信号により複数の画素に不要な書き込み動作が行われるが、本来の選択期間において各色成分用画素ごとに改めてデータ信号が書き込まれる。したがって、画質（表示品位）を劣化させることがない。
【００６３】
このような表示パネルでは、走査線ごとに選択された期間において、第１〜第３のデマルチプレクス制御信号により各色成分用画素に各色成分用のデータ信号が書き込まれる。そして、走査線ＧＬＭによる選択期間の後には帰線期間となる。この帰線期間において、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）が重複してアクティブとなると、これらの論理積演算結果がスタートパルス信号ＩＳＴＶとして生成される。
【００６４】
シフトクロックＣＰＶの立ち上がりでスタートパルス信号ＩＳＴＶの論理レベルが「Ｈ」のとき、シフトレジスタ３０においてシフトクロックＣＰＶが取り込まれる。その後、シフトレジスタ３０におけるシフトクロックＣＰＶに同期したシフト動作により、各走査線にゲート信号が出力されていく。
【００６５】
次に、比較例における表示パネルとの対比において、上述の実施形態の効果を説明する。
【００６６】
図７に、比較例における表示パネルの構成の概要を示す。ただし、図１に示す表示パネル１０と同一部分には同一符号を付し、適宜説明を省略する。
【００６７】
比較例における表示パネル１００が図１に示す表示パネル１０と異なる点は、ゲート信号生成回路２０を有しない点である。したがって、比較例における表示パネル１００では、走査線ＧＬ１〜ＧＬＭに、図示しない外部のゲートドライバによりゲート信号ＧＡＴＥ１〜ＧＡＴＥＭが供給される。
【００６８】
なお比較例における表示パネル１００の動作タイミングは、スタートパルス信号ＩＳＴＶ、ゲート信号ＧＡＴＥ１〜ＧＡＴＥＭ、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）及びデータ信号に関して表示パネル１０の動作タイミングと共通である（図６参照）。
【００６９】
しかしながら、表示パネル１０と表示パネル１００との端子の数を比較すると、表示パネル１００では、ゲート信号及びデマルチプレクス制御信号を入力するための端子の数「Ｍ＋３」が必要とされる。
【００７０】
そこで、表示パネル１００を構成するパネル基板上に、ゲート信号を生成する回路を形成し、端子数を削減する手法が考えられる。この場合、データ信号の出力タイミングと同期をとる必要があるため、少なくともスタートパルス信号及びシフトクロックは表示パネル１００の外部から供給される。したがって、表示パネル１００では、スタートパルス信号、シフトクロック及びデマルチプレクス制御信号を入力するための端子の数が「５」に削減される。ＬＴＰＳプロセスにより回路の形成が可能なパネル基板上には、歩留まり、回路規模、速度又はコスト等を考慮すると、ソースドライバのような複雑な回路を形成することが困難である。
【００７１】
これに対して、表示パネル１０では、パネル基板上にゲート信号生成回路２０が設けられる。したがって、表示パネル１０ではゲート信号生成回路２０においてスタートパルス信号が生成されるため、シフトクロック及びデマルチプレクス制御信号を入力するための端子の数を「４」に削減することができる。このため、より低消費電力を図ることができる。
【００７２】
ＬＴＰＳによりＴＦＴが形成される表示パネル上に形成されるゲート信号生成回路２０のスタートパルス信号生成回路４０は、図５に示したものに限定されるものではない。
【００７３】
なお図６において、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）によりスタートパルス信号ＩＳＴＶを生成しているが、これに限定されるものではない。スタートパルス信号生成回路は、第１〜第３のデマルチプレクス制御信号のうち少なくとも２つが重複してアクティブになることを条件にスタートパルス信号ＩＳＴＶを生成するものであればよい。
【００７４】
図８（Ａ）〜（Ｃ）に、スタートパルス信号生成回路４０の他の構成例を示す。図８（Ａ）におけるスタートパルス信号生成回路４０は、３入力１出力ＡＮＤゲート４４を含む。ＡＮＤゲート４４には、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が入力される。ＡＮＤゲート４４は、その出力端子から第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）の論理積演算結果を出力する。したがって、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が全て同時にアクティブとなったとき、スタートパルス信号ＩＳＴＶがアクティブとなる。
【００７５】
図８（Ｂ）におけるスタートパルス信号生成回路４０は、２入力１出力ＡＮＤゲート４６を含む。ＡＮＤゲート４６には、第１及び第２のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ）が入力される。ＡＮＤゲート４６は、その出力端子から第１及び第２のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ）の論理積演算結果を出力する。したがって、第１及び第２のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ）が同時にアクティブとなったとき、スタートパルス信号ＩＳＴＶがアクティブとなる。
【００７６】
図８（Ｃ）におけるスタートパルス信号生成回路４０は、２入力１出力ＡＮＤゲート４８を含む。ＡＮＤゲート４８には、第１及び第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｂｓｅｌ）が入力される。ＡＮＤゲート４８は、その出力端子から第１及び第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｂｓｅｌ）の論理積演算結果を出力する。したがって、第１及び第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｂｓｅｌ）が同時にアクティブとなったとき、スタートパルス信号ＩＳＴＶがアクティブとなる。
【００７７】
ところで、上述のように第１、第２、第３のデマルチプレク制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）の順に周期的にアクティブとなる。そのため、スタートパルス信号ＩＳＴＶを生成するために第１のデマルチプレクス制御信号Ｒｓｅｌをアクティブにした後、スタートパルス信号ＩＳＴＶにより１フレームの垂直走査期間の最初の選択期間（図６の第２のフレームの垂直走査期間において、ゲート信号ＧＡＴＥ１による選択期間）の開始直後に、改めて第１のデマルチプレクス制御信号Ｒｓｅｌをアクティブにする必要がある。
【００７８】
したがって、第１のデマルチプレクス制御信号Ｒｓｅｌの生成タイミングが、他の第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）に比べて余裕がない。この傾向は、画素数の増大により画素の選択期間の短縮化が進むに伴い、より顕著となる。以上のことから、画素の選択期間の短縮化が進むと、第１、第２、第３のデマルチプレク制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）の順にアクティブとなる場合に、図５に示すように、第１のデマルチプレクス制御信号Ｒｓｅｌを除く他のデマルチプレクス制御信号を用いてスタートパルス信号ＳＴＶを生成することが望ましい。
【００７９】
（変形例）
図９に、本変形例における表示パネルの構成の概要を示す。ただし、図１に示す表示パネル１０と同一部分には同一符号を付し、適宜説明を省略する。本変形例における表示パネル２００が図１に示す表示パネル１０と異なる点は、ゲート信号生成回路２０に代えてゲート信号生成回路２１０を含む点である。
【００８０】
ゲート信号生成回路２１０は、デマルチプレクス制御信号に基づいて、シフトクロックを生成することができる点で、ゲート信号生成回路２０と異なる。
【００８１】
このような構成により、本変形例における表示パネル２００は、外部からシフトクロックが入力される必要がないため、更に端子数を削減し低消費電力化を図ることが可能となる。
【００８２】
図１０に、ゲート信号生成回路２１０の構成例を示す。ただし、図４に示すゲート信号生成回路２０と同一部分には同一符号を付し、適宜説明を省略する。ゲート信号生成回路２１０がゲート信号生成回路２０と異なる点は、シフトクロック生成回路２２０を含む点である。したがって、シフトレジスタ３０を構成する各フリップフロップのクロック入力端子Ｃには共通して、シフトクロック生成回路２２０により生成されたシフトクロックＩＣＰＶが入力される。
【００８３】
シフトクロック生成回路２２０は、デマルチプレクス制御信号に基づいてシフトクロックＩＣＰＶを生成する。
【００８４】
図１１に、シフトクロック生成回路２２０の構成例を示す。ここでは、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）のうち、第１及び第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｂｓｅｌ）を用いてシフトクロックを生成する回路の構成例を示す。
【００８５】
シフトクロック生成回路２２０は、Ｔフリップフロップ（T flip-flop：ＴＦＦ）２２２と、立ち下がりエッジ検出回路２２４とを含む。ＴＦＦ２２２は、そのクロック入力端子Ｃへの入力信号の立ち上がりで、その出力端子Ｑから出力されるシフトクロックＩＣＰＶの論理レベルを反転させる。またＴＦＦ２２２は、そのリセット入力端子Ｒへの入力信号により、出力端子Ｑからの出力信号の論理レベルを「Ｌ」にする。
【００８６】
立ち下がりエッジ検出回路２２４は、第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりエッジを検出する。より具体的には、立ち下がりエッジ検出回路２２４は、第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりエッジがその立ち上がりとなるパルス信号を出力する。該パルス信号のパルス幅は、遅延素子２２６の遅延時間によって決められる。
【００８７】
ＴＦＦ２２２の入力端子Ｃには、第１のデマルチプレクス制御信号Ｒｓｅｌと、立ち下がりエッジ検出回路２２４の出力との論理和演算結果が入力される。
【００８８】
このような構成のシフトクロック生成回路２２０は、第１のデマルチプレクス制御信号Ｒｓｅｌの立ち上がりでその論理レベルが変化するシフトクロックＩＣＰＶを生成する。またシフトクロック生成回路２２０は、第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりでその論理レベルが変化するシフトクロックＩＣＰＶを生成する。
【００８９】
図１２に、本変形例におけるゲート信号生成回路２１０の動作例のタイミングチャートを示す。まず、シフトクロック生成回路２２０のＴＦＦ２２２では、リセット信号ＲＳＴによりその出力端子Ｑから出力されるシフトクロックＩＣＰＶがリセットされた状態とする。その後、スタートパルス信号生成回路４０において、第２及び第３のデマルチプレクス制御信号（Ｇｓｅｌ、Ｂｓｅｌ）が同時にアクティブとなり、スタートパルス信号ＩＳＴＶの論理レベルが「Ｈ」となる（ｔ１）。
【００９０】
次に、第１のデマルチプレクス制御信号Ｒｓｅｌの立ち上がりで、ＴＦＦ２２２の出力信号の論理レベルが反転され、シフトクロックＩＣＰＶの論理レベルが「Ｈ」となる（ｔ２）。これにより、シフトレジスタ３０のフリップフロップＦＦ１では、シフトクロックＩＣＰＶの立ち上がりでスタートパルス信号ＩＳＴＶが取り込まれ、走査線ＧＬ１の選択期間を示すゲート信号ＧＡＴＥ１が出力される。
【００９１】
続いて、第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりで、ＴＦＦ２２２の出力信号の論理レベルが反転され、シフトクロックＩＣＰＶの論理レベルが「Ｌ」となる（ｔ３）。
【００９２】
以降、ＴＦＦ２２２では、第１のデマルチプレクス制御信号Ｒｓｅｌの立ち上がり、又は第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりで、その出力信号の論理レベルの反転動作が繰り返される。
【００９３】
その結果、第１、第２、第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が順にアクティブとなる期間Ｔ０を１周期とするシフトクロックＩＣＰＶが生成される。そして、シフトレジスタ３０により、シフトクロックＩＣＰＶの立ち上がりでシフト動作が行われ、走査線ＧＬ２〜ＧＬＭに順次ゲート信号ＧＡＴＥ２〜ＧＡＴＥＭが出力される。
【００９４】
なお本変形例においては、立ち下がりエッジ検出回路２２４で第３のデマルチプレクス制御信号Ｂｓｅｌの立ち下がりを検出していたが、これに限定されるものではない。立ち下がりエッジ検出回路２２４は、第２のデマルチプレクス制御信号Ｇｓｅｌの立ち下がりを検出するようにしても同様の効果を得ることができる。
【００９５】
更にまたシフトクロック生成回路２２０では、図１１に示した構成に限定されるものではない。ＲＳフリップフロップにおいて第１のデマルチプレクス制御信号Ｒｓｅｌでセットされ、第２のデマルチプレクス制御信号Ｇｓｅｌ又は第２のデマルチプレクス制御信号ＢｓｅｌによりリセットされるシフトクロックＩＣＰＶを生成するようにしてもよい。この場合でも、周期Ｔ０のシフトクロックを生成することが可能である。
【００９６】
なお、本発明は上述した実施の形態に限定されるものではなく、本発明の要旨の範囲内で種々の変形実施が可能である。
【００９７】
また、上述した実施形態では、Ｒ、Ｇ、Ｂの各色成分に対応する３画素単位で選択されるものとして説明したが、これに限定されるものではない。例えば１、２又は４以上の画素数単位で選択される場合についても同様に適用することが可能である。
【００９８】
また、第１〜第３のデマルチプレクス制御信号（Ｒｓｅｌ、Ｇｓｅｌ、Ｂｓｅｌ）が周期的にアクティブとなる順序は、上述の実施形態に限定されるものではない。
【００９９】
また、本発明のうち従属請求項に係る発明においては、従属先の請求項の構成要件の一部を省略する構成とすることもできる。また、本発明の１の独立請求項に係る発明の要部を、他の独立請求項に従属させることもできる。
【図面の簡単な説明】
【図１】  本実施形態における表示パネルの構成の概要を示す構成図。
【図２】  図２（Ａ）、（Ｂ）は、色成分用画素の構成例を示す構成図。
【図３】  信号線に出力されるデータ信号とデマルチプレクス制御信号との関係を示す模式図。
【図４】  ゲート信号生成回路の構成例を示す回路構成図。
【図５】  スタートパルス信号生成回路の構成例を示す回路図。
【図６】  スタートパルス信号生成回路の動作例のタイミングチャート。
【図７】  比較例における表示パネルの構成の概要を示す構成図。
【図８】  図８（Ａ）〜（Ｃ）はスタートパルス信号生成回路の他の構成例を示す回路図。
【図９】  本変形例における表示パネルの構成の概要を示す構成図。
【図１０】  本変形例のゲート信号生成回路の構成例を示す回路構成図。
【図１１】  シフトクロック生成回路の構成例を示す回路図。
【図１２】  本変形例におけるシフトクロック生成回路の動作例のタイミングチャート。
【符号の説明】
１０、１００、２００  表示パネル、  ２０、２１０  ゲート信号生成回路、３０  シフトレジスタ、  ４０  スタートパルス信号生成回路、  ４２、４６、４８  ２入力１出力ＡＮＤゲート、  ４４  ３入力１出力ＡＮＤゲート、    ２２０  シフトクロック生成回路、  ２２２  Ｔフリップフロップ（ＴＦＦ）、２２４  エッジ検出回路、  ２２６  遅延素子、  Ｂ１〜ＢＮ  第３の色成分用信号線、  Ｂｓｅｌ  第３のデマルチプレクス制御信号、  ＣＰＶ  シフトクロック、  ＤＭＵＸ１〜ＤＭＵＸＮ、ＤＭＵＸｎ  デマルチプレクサ、  ＤＳＷ１〜ＤＳＷ３  第１〜第３のデマルチプレクス用スイッチ素子、  Ｇ１〜ＧＮ  第２の色成分用信号線、  ＧＡＴＥ１〜ＧＡＴＥＭ、ＧＡＴＥｍ  ゲート信号、ＧＬ１〜ＧＬＭ、ＧＬｍ  走査線、  Ｇｓｅｌ  第２のデマルチプレクス制御信号、  ＩＣＰＶ  シフトクロック、  ＩＳＴＶ  スタートパルス信号、  Ｒ１〜ＲＮ  第１の色成分用信号線、  Ｒｓｅｌ  第１のデマルチプレクス制御信号、ＳＬ１〜ＳＬＮ  信号線、  ＳＷ１〜ＳＷ３  第１〜第３のスイッチ素子
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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