(57)【特許請求の範囲】
【請求項１】
ポーラス状の最上層を有するシリコン基板を含む基板と、
上記最上層の上に配置された、ＳｉＧｅからなる第２層と、
上記第２層上に配置された、ＡｌＮからなる第３層と、
上記第３層上に配置された、ＧａＮからなる別の層と、を有する装置。
【請求項２】
上記第２層のＧｅが、濃度勾配を有することを特徴とする請求項１に記載の装置。
【請求項３】
上記第２層の材料中のＧｅ濃度が、上記基板から離れる方向に増加していることを特徴とする請求項１または２に記載の装置。
【請求項４】
上記第２層が、上記ポーラス状の最上層と直接接触していることを特徴とする請求項１〜３のいずれかに記載の装置。
【請求項５】
上記ポーラス状の最上層が、少なくとも一部に、閉口したポアを有することを特徴とする請求項１〜４のいずれかに記載の装置。
【請求項６】
上記ポーラス状の最上層が、１０〜９０％の空隙率を有することを特徴とする請求項１〜５のいずれかに記載の装置。
【請求項７】
上記ポーラス状の最上層が、１０ｎｍ〜３μｍの膜厚を有することを特徴とする請求項１〜６のいずれかに記載の装置。
【請求項８】
上記第２層が、１ｎｍ〜１０００ｎｍの膜厚を有することを特徴とする請求項１〜７のいずれかに記載の装置。
【請求項９】
上記第２層が、１ｎｍ〜２０ｎｍの膜厚を有することを特徴とする請求項１〜８のいずれかに記載の装置。
【請求項１０】
請求項１〜９のいずれかに記載の装置を含むことを特徴とするＦＥＴ、ＬＥＤ、レーザダイオード、ＨＥＭＴ若しくはヘテロ接合バイポーラトランジスタ。
【請求項１１】
シリコンの上にＧａＮを含む装置を作製する方法であって、
ポーラス状の最上層を含むシリコン基板を準備する工程と、
上記ポーラス状の最上層を有するシリコン基板にＧｅ含有物質を接触させ、それにより上記最上層上にＳｉＧｅからなる第２層を形成する工程と、
ＡｌＮからなり中間層である第３層を上記第２層上に形成する工程と、
上記ＡｌＮからなる第３層を有するシリコン基板にＧａ含有物質及びＮ含有物質を接触させ、それにより上記第３層上にＧａＮからなる別の層を形成する工程と、を有することを特徴とする方法。
【請求項１２】
上記第３層を形成する工程の前に、上記ＳｉＧｅからなる第２層を熱的にアニールする工程を含むことを特徴とする請求項１１記載の方法。
【請求項１３】
上記熱的アニール工程が、５００℃〜１３００℃の温度で実行されることを特徴とする請求項１２記載の方法。
【請求項１４】
上記第３層を有するシリコン基板にＧａ含有物質及びＮ含有物質を接触させる工程が、有機金属化学気相成長プロセスにより実行されることを特徴とする請求項１１〜１３のいずれかに記載の方法。
【請求項１５】
上記第３層を有するシリコン基板にＧａ含有物質及びＮ含有物質を接触させる工程を５００℃〜１３００℃の温度で実行することを特徴とする請求項１４記載の方法。
【請求項１６】
上記ＧａＮからなる別の層を形成する工程が、５００℃〜１３００℃の間の２つの異なる温度で実行されることを特徴とする請求項１１〜１５のいずれかに記載の方法。
【請求項１７】
上記ＧａＮからなる別の層を形成する工程の第１工程を４００℃〜８００℃の温度で実行し、続いて８００℃〜１２００℃の温度で実行することを特徴とする請求項１６記載の方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、シリコン基板上にIII族窒化物材料を成長させる方法及びその方法により得られる装置に関する。また、本発明は品質が改善されたエピタキシャル層を有する装置に関する。
【背景技術】
【０００２】
市販のＧａＮ基板が不足しているため、今日ＧａＮヘテロ構造を主にサファイア若しくはＳｉＣ上に成長させている。Ｓｉは非常に魅力的な基板であるため、ますます大きな興味が示されている。その主な利点は、熱伝導率が許容範囲にあること（ＳｉＣの熱伝導率の半分である。）及び大きな体積及び大きなウエハサイズで入手することができることである。サファイア及びＳｉＣ基板と比較した場合、Ｓｉの最も重要な利点は、非常にコストが低いということである。
【０００３】
Kuykendall（ナノレター2003,Vol.3,No.8,1063-10）は、例えば、ＭＯＣＶＤによりシリコン及びサファイア基板上にＧａＮナノワイヤを形成することを開示している。
【０００４】
しかし、Ｓｉ上に直接高品質のエピタキシャルＧａＮ層を成長させることに関して直接的に記載されていない。
【０００５】
Ｓｉ及びＧａＮ間の格子不整合が大きいことにより、ＧａＮ層の転位密度が高くなる。サファイア上でＧａＮを成長させるために開発された適切な成長方法を適用することにより、この高い転位密度を劇的に減少させることができる。
【０００６】
ＧａＮとＳｉとの間の熱膨張係数の大きな相違により、成長温度から室温まで冷却する間に、ＧａＮフィルム内に大きな引張応力が誘発され、それによりＧａＮ層にクラックが発生する。クラック現象は、１μｍ以上の膜厚を有する層にとって問題となり、これにより、光電子装置の性能に対して弊害をもたらす。
【０００７】
Ｓｉ基板上に直接ＧａＮを成長させることに対する他の問題点は、Ｇａ及びＳｉのいわゆるメルトバックエッチングプロセスである。高温において、Ｇａ及びＳｉは、合金を形成する。この合金は、激しくて速いエッチング反応を起こし、このエッチング反応によりこの基板及びＧａＮ層を破壊する。これにより非常に荒い表面となる。
【０００８】
また、別の問題点は、Ｓｉ基板上に酸化物が形成され、特別の注意、例えば、基板上にＧａＮを成長させるため、反応炉内にサンプルを導入する直前に注意深く洗浄すること等が必要となることである。
【０００９】
Ｓｉ上にＧａＮを成長させることに対する他の問題点は、基板が湾曲することである。ＧａＮの層がＳｉ上に形成された時、ＧａＮ層に発生した応力は、続いてＳｉ基板にも応力を発生させる。このため、Ｓｉ基板の変形若しくはいわゆる'湾曲'が発生することになる。
【００１０】
特許出願ＷＯ０３／０５４９３９号明細書において、Aixtronは、シリコン基板等の非III-V基板上にIII-V基板を成長させる方法を開示している。III-Vバッファ層若しくはIII-Vジャーミネーション層（III-V germination layer）をＭＯＣＶＤにより基板上に成長させる。
【００１１】
活性ＧａＮ層の成長のため、Boufaden等は薄いＡｌＮ層を使用して、ＧａＮ及びポーラスＳｉ／Ｓｉ基板間において濡れ特性（wetting）を改良することを提案している（マイクロエレクトロニックジャーナル34（2003）843-848）。ＡｌＮ層は、ＧａＮとＳｉとの間の格子不整合を２．５％まで減少させる。また、Orita等は、ポーラスＳｉ層（ＰＳ）及びＧａＮエピタキシャル層との間のＡｌＮバッファ層をＵＳ−Ａ−６３４４３７５において提案している。
【００１２】
クラック及び貫通転移(threading dislocation)を減少させる様々な方法を「Ｓｉ層上のＧａＮベース装置(A.Krost,A.Dadgar,Phys.Stat.Sol.(a),Vol.194,Issue2,2002,pp.361
-375)」において参照できる。
【００１３】
上述の問題を解決するために提案された様々な手段を２つのカテゴリーに分類することができる。完全にin-situな成長方法を使用したもの、およびex-situなプロセス工程が必要なものである。このex-situなプロセスは、次の成長工程に続く。前者のグループは、応力工学に基づき、クラックを防止し、そして活性ＧａＮ層に存在する貫通転位密度をできるだけ多く減少させる。前者のグループは、適切なシード層、スーパー層、若しくは中間層を使用する。後者のグループは、熱クラック及び貫通転移欠陥の幾何分布を制御することを目的とする。ＥＬＯＧ、ペンデオ(Pendeo)、カンチレバーエピタキシ(Cantilever
Epitaxy)の全てにより高品質の領域とすることができ、一方他の方法は、応力を発生させる全ての貫通転移及び／又はクラックを一カ所に集中させる。
【特許文献１】ＷＯ０３／０５４９３９
【特許文献２】ＵＳ−Ａ−６３４４３７５
【非特許文献１】ナノレター2003,Vol.3,No.8,1063-10
【非特許文献２】マイクロエレクトロニックジャーナル34（2003）843-848
【非特許文献３】Phys.Stat.Sol.(a),Vol.194,Issue2,2002,pp.361-375)
【発明の開示】
【発明が解決しようとする課題】
【００１４】
本発明は、従来の解決手段の問題点を克服するための、シリコン基板上にIII族窒化物材料を成長させる新規な方法を提供することを目的とする。
【００１５】
また、本発明は、高品質のIII族窒化物エピタキシャル層を備える装置を提供することを目的とする。
【００１６】
さらに、本発明は、上記高品質のIII族窒化物エピタキシャル層の成長のための、適切な中間テンプレートデバイスを提供することを目的とする。
【課題を解決するための手段】
【００１７】
第１発明では、
ポーラス最上層を有するシリコン基板を備える基板と、
上記最上層上に配置された、Ｇｅ材料からなる第２層と、
上記第２層の上のIII族窒化物材料からなる別の層とを備える装置を開示している。
【００１８】
本明細書の「ポーラス状の最上層」という用語により、他の最上層の中で、基本的にポーラスシリコン（ＰＳ）からなる最上層だけでなく、サブマイクロオーダでパターニングされた２次元的若しくは溝付きの（castellated）最上層などの人為的に作製されたポーラス材料からなる最上層をも意味する。
【００１９】
そのような「ポーラス状の最上層」により、荒くて、ザラザラした（textured）、非平面的な、好ましくは３Ｄ構造の表面、さらにしなやかな骨格が与えられる。そのようなポーラス状の最上層の下にボイド、バブル、若しくは封入物（inclusion）が存在してもよい。ポーラス状の最上層の表面でポアを閉じ込めることにより、ボイド、バブル、封入物若しくはマイクロポア等を形成することができる。
【００２０】
「ポーラス状の最上層」は、ポアの少なくとも一部（できれば略全部）が、上記最上層の表面において開口しているが、上記表面において上記ポアの少なくとも一部が閉じていてもよい。別の実施の形態では、全てのポアが閉じられ、ボイド、バブル、封入物若しくはマイクロポアが基板内に形成されていてもよい。
【００２１】
第１発明のある実施の形態では、これ以前の実施の形態に記載された装置であって、上記ポーラス状最上層が、ボイド、封入物、バブル若しくはマイクロポア等の、少なくとも一部が閉じられたポアを有することを特徴とする装置を開示している。
【００２２】
本発明の好ましい実施の形態に係るポーラス最上層に、空隙率の勾配が存在してもよい。ポアのサイズ及び／又はポアの量は、上記最上層の表面から離れる方向に増加することが好ましい。
【００２３】
少なくとも２つの空隙率を有する最上層が好ましい。これは、本明細書において、異なる空隙率を有する少なくとも２つのサブ基板が上記最上層に存在することを意味する。この差異は、ポアのサイズ及び／又は量にある。
【００２４】
高い空隙率と低い空隙率を有する積層体を有してもよい。高い空隙率を有する層と低い空隙率を有する層とを入れ替えてもよい。小さなサイズのポアが存在すること、及び／又は少量のポアが存在すること（低空隙率）と比較して、高い空隙率は、大きなポアが存在すること、及び／又は大量のポアが存在することを意味する。高い空隙率及び低い空隙率の層を作製する方法は、この技術分野において知られている。
【００２５】
例えば、水素雰囲気における高温のアニールにより、高い空隙率のサブ基板の下に、シリコン基板に接触するように、分離した層を作製することが好ましい。この分離した層は、高い空隙率を有する層であり、機械的に非常に脆弱である。この層は、小さな機械的力により、即ち超音波処理若しくは引張り処理（pulling）により容易に破壊され得る（例えばＥＰ１１３２９５２を参照のこと）。
【００２６】
本発明に係るポーラス状最上層は、一般的に１０％〜９０％の空隙率を有する。このポーラス状最上層は、一般的に１０ｎｍ〜１０μｍ、１０ｎｍ〜３μｍの間の膜厚を有する。
【００２７】
本発明に係る「ポーラス状最上層」を、成長の後再び緩和させてもよい。さらに、応力解放によりエピタキシャル層をサブ基板から分離してもよい。
【００２８】
「Ｇｅ材料からなる層」は、少なくともＧｅを含有する材料からなる層を意味する。
【００２９】
第１発明の好ましい実施の形態では、それ以前の実施の形態に記載した装置であって、上記第２層が、ＳｉＧｅ材料（少なくともＳｉＧｅを含む材料）からなることを特徴とする装置を開示している。この第２層はＳｉＧｅ層であってもよい。Ｇｅ材料、好ましくはＳｉＧｅ材料からなる層の組成は任意ではあるが濃度勾配が付けられている。上記（濃度勾配の付いた）第２層の材料中のＧｅ濃度は、基板から離れる方向に増加することが好ましい。
【００３０】
第１発明の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載した装置であって、III族窒化物材料に少なくともＧａＮが含まれることを特徴とする装置を開示している。第１発明の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された装置であって、III族窒化物材料がＧａＮであることを特徴とする装置を開示している。
【００３１】
別の実施の形態では、上記III族窒化物材料は、少なくともＡｌＮを含んでいても良いし、若しくはＡｌＮであってもよい。他に、例えば少なくともＡｌＧａＮを含有するIII族窒化物エピタキシャル層を成長させることも可能である。
【００３２】
好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された装置であって、上記第２層が上記最上層と直接接触している装置を開示している。好ましい実施の形態では、それ以前の実施の形態に記載された装置であって、例えばＧａＮ層等のIII族窒化物層が、上記第２層と直接接触している装置を開示している。
【００３３】
第１発明のある実施の形態では、これ以前の実施の形態のいずれかに記載された装置であって、第２層（この第２層はＳｉＧｅ等のＧｅ材料からなる。）は、１ｎｍ〜１０００ｎｍ若しくは２０００ｎｍの間の膜厚を、好ましくは１ｎｍ〜５００ｎｍの間の膜厚を、さらに好ましくは１ｎｍ〜３００ｎｍの間の膜厚を、さらに好ましくは１０ｎｍ〜２００ｎｍの膜厚を有する装置を開示している。
【００３４】
Ｇｅ材料層の膜厚は、１ｎｍ〜１００ｎｍ、１ｎｍ〜５０ｎｍ、１ｎｍ〜２０ｎｍ、１ｎｍ〜１５ｎｍ、１ｎｍ〜１０ｎｍであることが好ましい。Ｇｅ材料を含有する層の膜厚は、好ましくは１ｎｍ〜２０ｎｍ、より好ましくは５ｎｍ〜１５ｎｍ、最も好ましくは６ｎｍ〜１２ｎｍである。
【００３５】
本発明に係る好ましい実施の形態では、本発明に係る装置であって、上記最上層が、本発明に係るポーラス状最上層であり、上記第２層がＳｉＧｅ材料（例えばＳｉＧｅ層）からなり、さらに別の層がＧａＮ層であることを特徴とする装置を開示している。ＳｉＧｅ材料からなる層（例えばＳｉＧｅ層）は、上記最上層と直接接触していることが好ましい。また、上記ＧａＮ層は、この第２層と直接接触していることが好ましい。ここに記載された実施の形態の第２層の膜厚は、１ｎｍ〜２μｍ、１ｎｍ〜１０００ｎｍ、１ｎｍ〜５００ｎｍ、１ｎｍ〜３００ｎｍ、１０ｎｍ〜２００ｎｍの間にあることが好ましい。
【００３６】
上記最上層内のポアは、開口したポアであっても良いし、若しくは閉口したポア及び開口したポアを組み合わせたものが存在してもよい。本発明に係る他の特定の好ましい実施の形態では、本発明に係るポーラス状最上層は、少なくとも一部に閉じたポアを含み、上記第２層がＳｉＧｅ材料（例えばＳｉＧｅ層）からなり、上記別の層はＧａＮ層であることを特徴とする装置である。実質的に全てのポア（ポアの７０％、８０％、９０％若しくは９５％以上）は、閉口したポアであってもよい。
【００３７】
閉口したポアの具体例として、バブル、封入物、ボイド若しくはマイクロポアが含まれるが、これらに限定されるものではない。ポーラス状のＳｉ基板における初期のポアの直径と比較して、マイクロポアは、サイズが減少する小さな直径を有する。これは、例えば、III族窒化物層の成長の前のアニール工程のためである。アニール工程の温度は、III族窒化物材料を成長させる工程の温度より高い。ＧａＮの成長温度は、５００〜１３００℃、約１１００℃、約１０５０℃である。一方、アニールのための温度は、１０５０℃以上、１１００℃以上、好ましくは１１００℃〜１２００℃である。
【００３８】
本発明の好ましい実施の形態では、本発明に係る装置であって、第２層がＧｅからなる層であるか、若しくは濃度勾配の付いたＳｉＧｅ層からなる層であり、さらに別の層がＧａＮ層であることを特徴とする装置を開示している。濃度勾配の付いたＳｉＧｅにおけるＧｅ濃度は、上記基板から離れる方向に増加することが好ましい。
【００３９】
以前の実施の形態のいずれかに記載された装置は、さらに中間層（第３層）を備えることが好ましい。この中間層は、第２層（Ｇｅ材料からなる層、例えばＳｉＧｅ材料等）とIII族窒化物層（別の層）との間に存在する。この中間層は、III族窒化物層の成長のためのベースとして、若しくはIII族窒化物層の成長が開始する層として機能するように配置されていることが好ましい。この中間層は、核形成層の一種であることが好ましい。中間層は、１ｎｍ〜２００ｎｍ、１ｎｍ〜１００ｎｍ、１ｎｍ〜５０ｎｍの間の範囲の膜厚を有する層であってもよい。この中間層は、平坦な連続する層であっても良いし、若しくは例えばアイランドを有する不連続層であってもよい。この中間層はＡｌＮ層であってもよい。
【００４０】
本発明に係る他の実施の形態では、本発明に係る装置であって、上記第２層がＧｅからなる層であるか、若しくは濃度勾配の付いたＳｉＧｅからなる層であり、上記中間層はＡｌＮからなる層であり、さらに上記別の層はＧａＮ層であることを特徴とする装置を開示している。濃度勾配の付いたＳｉＧｅにおけるＧｅ濃度は、上記基板から離れる方向に増加することが好ましい。本発明の他の実施の形態では、上記第２層がＳｉＧｅからなる層であり、上記別の層がＡｌＮであることを特徴とする装置を開示している。
【００４１】
本発明は、これ以前の実施の形態のいずれかに記載された発明に係る装置を含む、ＦＥＴ、ＬＥＤ、レーザダイオード、ＨＥＭＴ（高電子移動度トランジスタ）若しくはヘテロ接合パイポーラトランジスタに関連する。
【００４２】
第１発明の特定の実施の形態では、以前の実施の形態のいずれかに記載された装置であって、電子回路が上記シリコン基板上に集積された装置を開示している。上記装置には、III族窒化物層に形成された光学電子装置若しくはＦＥＴが含まれていても良い。
【００４３】
第２発明は、シリコン上にIII族窒化物材料を含む装置を作製する方法であって、
（定義されたような）ポーラス状の最上層を含むシリコン基板を準備する工程と、
上記ポーラス状の最上層を有する上記シリコン基板にＧｅ含有物質を接触させ、それにより上記最上層上にＧｅ材料層（第２層）を形成する工程と、
Ｇｅ材料層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させ、それにより上記第２層上にIII族窒化物材料からなる別の層を形成する工程とを含む方法に関する（図１参照）。
【００４４】
第２発明の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された方法であって、上記方法が、Ｇｅ材料層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程より前に、Ｇｅ材料からなる層を熱的にアニールする工程（図１の任意の工程）を含むことを特徴とする方法を開示している。熱的にアニールする工程は、５００〜１３００℃の間の温度で行うことが好ましく、５００℃〜１１００℃の間の温度で行うことがさらに好ましい。
【００４５】
ポーラス状の最上層を有するシリコン基板にＧｅ含有物質を接触させる工程を、プラズマ気相成長法（ＰＥＣＶＤ）、熱蒸着、閉空間蒸気伝達法（close space vapour transport）、若しくは分子ビームエピタキシ法により実行することが好ましい。
【００４６】
上記第２層の成長の後、予め決定された期間（即ち数時間、数週間、数ヶ月、数年）に亘って、この中間装置を保管してもよい。これは、保護雰囲気（Ｎ２雰囲気等）の下この装置を保管する必要はない。これ以前の実施の形態のいずれかに記載された方法であって、上記最上層に第２層を形成する工程の後、中間装置が保管されることを特徴とする方法を開示している。
【００４７】
Ｇｅ材料の層を含むシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程を有機金属化学気相成長法（ＭＯＣＶＤ）プロセスにより実行することが好ましい。この工程は、一般的に５００℃〜１３００℃の間の温度、１０００℃〜１１００℃の間の温度で実行し、１０５０℃で実行することが好ましい。別の実施の形態では、Ｇｅ材料層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程を、分子ビームエピタキシ（ＭＢＥ）若しくはハイドライド気相エピタキシー法（ＨＶＰＥ）により実行する。
【００４８】
別の実施の形態では、Ｇｅ材料層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程に先行してアニール工程を行ってもよい。アニール工程により、安定な層を形成することができる。例えば、ポーラス状最上層及び第２層の構造体をアニール工程の間変化させてもよい。その結果として、Ｇｅ材料の層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程の間、下地層は、構造的な変化（これに限定されるわけではないが、例えばポア構造の変化）に対して影響を受けにくい。また、アニール工程の後、第２層はＳｉＧｅからなる層となるであろう。
【００４９】
第２発明の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された方法であって、III族元素がＧａであることを特徴とする方法を開示している。最も好ましくは、III族窒化物はＧａＮである。III族窒化物材料はＡｌＮ若しくはＡｌＧａＮであってもよい。
【００５０】
第２発明の他の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された方法であって、III族元素がＡｌであり、III族窒化物がＡｌＮであることを特徴とする方法を開示している。
【００５１】
第２発明の好ましい実施の形態では、これ以前の実施の形態のいずれかに記載された方法であって、上記方法が、上記のポーラス状最上層を有するシリコン基板にＧｅ含有物質を接触させる工程と、上記のＧｅ材料層を有するシリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程との間に、中間層を形成する工程を備えることを特徴とする方法を開示している。ここでは中間層ＡｌＮ層を形成することが好ましい。
【００５２】
ＭＯＣＶＤにより、ＭＯＣＶＤ反応炉内において、９００℃〜１２００℃の間等の高温においてＡｌＮ層を成長させてもよい。別の実施の形態では、ＡｌＮ層を、４００℃〜９００℃の間、５００℃〜８００℃の間等の低温で成長させ、その後、熱的アニール工程を行っても良い。
【００５３】
第２発明の好ましい実施の形態では、ＧａＮ層等のIII族窒化物層の成長を５００℃〜１３００℃の間の異なる２つの温度で実行することを特徴とする方法を開示している。上記成長工程の第１工程は、より低温（例えば、４００℃〜８００℃の間の温度、４００℃〜７００℃の間の温度、４００℃〜６００℃の間の温度）で実行し、続いて、より高温（例えば、８００℃〜１２００℃の間の温度、８００℃〜１１００℃の間の温度、８００℃〜１０００℃の間の温度）で実行することが好ましい。
【００５４】
第３発明は、上記の方法のいずれかにより得られる装置に関する。本発明に係る上述の方法のいずれかにより得られる上記装置の具体例を、第１発明に係る部分で挙げている。
【００５５】
第４発明は、III族窒化物材料の成長のための中間テンプレートデバイスを作製するための方法であって、
ポーラス状の最上層を含むシリコン基板を準備する工程と、
ポーラス状の最上層を含む上記シリコン基板にＧｅ含有物質を接触させ、それにより上記最上層上に、Ｇｅ含有材料からなる第２層を形成する工程と、
続いてＧｅ含有の材料からなる上記第２層を熱的にアニールする工程とを有することを特徴とする方法に関する。
【００５６】
異なる層を形成する方法、それらの組成及び膜厚に関する好ましい実施の形態を、本発明の第１から第３発明に係る部分に記載している。
【００５７】
この方法により、III族窒化物材料の成長に最適のテンプレートデバイスとすることができる。上記テンプレートデバイスは、ポーラス状最上層、及び上記最上層上に第２層を有するシリコン基板を備え、上記第２層はＧｅ含有材料からなることを特徴とする。上記最上層を、III族窒化物材料が上記第２層上に成長するように配置する。好ましい実施の形態では、最上層のポアの少なくとも一部が、閉口したポアであってもよい。さらに別の発明は、本発明に係るテンプレートデバイスを形成する方法により得られるテンプレートデバイスに関連する。
【００５８】
本発明の別の発明は、III族窒化物材料の成長のための中間テンプレートデバイスの用途に関する。上記テンプレートデバイスは、ポーラス状の最上層を含むシリコン基板、及び上記最上層上に形成された第２層を有し、上記第２層はＧｅ含有材料からなる。III族窒化物材料が上記第２層上で成長するように上記最上層を配置することが好ましい。上記最上層のポアの少なくとも一部が、閉口したポアであっても良いし、若しくは直径が減少したポアであってもよい。可能性として考えられる膜厚及び／又は層の組成等は、第１発明及び第２発明の関連する部分に示した通りである。
【発明を実施するための最良の形態】
【００５９】
本発明を以下に詳細に説明している。しかし、当業者であれば、本発明を実行するためのいくつかの他の同様な実施の形態若しくは他の方法に想到することができることは明らかである。
【００６０】
この発明では、ある層が他の層若しくは基板の「上に」あるというときにはその層が直接当該他の層若しくは基板上にあることを意味し、ある層が他の層若しくは基板の「上方に」あるというときには中間層が存在することを意味する。ある層が他の層若しくは基板と「直接接触している」というときは、２つの層の間、若しくはその層と基板との間に中間層がないことを意味する。
【００６１】
この発明では、III族窒化物材料は、元素の周期表のIII族元素の窒化物を含む材料である。III族窒化物材料はＧａＮであっても良い。ここで、ＧａＮは、ＡｌＮ、ＡｌＧａＮ、ＩｎＧａＮ、ＡｌＩｎＧａＮ、ＧａＡｓＰＮ、及び同様のもの（これらに限定されるものではない）等の少なくともＧａＮを含む材料であると理解されるべきである。この発明に記載された装置は、III族材料の代わりに、ダイアモンド層を含んでいてもよい。
【００６２】
シリコン基板は、シリコンを含有する基板である。特定の実施の形態では、上記シリコン基板はシリコンウエハである。このシリコン基板は、本発明に係るポーラス状最上層（上述のように定義している。）を含んでいてもよい。
【００６３】
「溝付きの（castellated）」という用語により、主面における基板の断面が、急峻な丘部及び谷部により特徴付けられ、上記丘部の上面は平坦な台形表面部分を規定し、当該台形表面部分は谷部により形成されたギャップにより互いに離間されている。これらの台形部分のそれぞれは、台形の上面に沿った距離が、１μｍ以下、より好ましくは２００Å以下、最も好ましくは１００Å以下の最小横幅を有する。隣接する台形部は、少なくとも３０Å、より好ましくは６０Åの幅のギャップにより互いに離間されている。
【００６４】
「２次元的にサブミクロンでパターニングされた」という用語により、表面が任意の形状の平坦な台形により特徴付けられ、それぞれの台形部分は、台形上面に沿った方向の最小横幅が１ミクロン以下の横幅を有し、溝部により形成されたギャップが台形部分の間に位置する。これは、Douglas等により記載されたナノメートルリソグラフィー（アプライドフィジックレター(1986),vol 48（10）676-678）等により得られる。
【００６５】
本明細書における「ポア」という用語は、上述のように、「ギャップ」、「谷部」若しくは「溝部」まで拡張される。本発明に係るポーラス状最上層における「ポア」は、開口ポア、閉口ポアであっても良く、開口ポア及び閉口ポアを組み合わせたものが存在してもよい。このポアは、バブル、封入物、ボイド若しくはマクロポア等である。
【００６６】
第１発明では、ポーラス状の最上層を有するシリコン基板を備える基板と、
Ｇｅ材料からなる第２層と、
上記第２層上にIII族窒化物材料からなる別の層とを備える装置を開示している。
【００６７】
上記第２層はＳｉＧｅを含んでいることが好ましい。III族窒化物材料は少なくともＧａＮを含むことが好ましい。III族窒化物材料はＧａＮであることが好ましい。別の実施の形態では、III族窒化物材料は少なくともＡｌＮを含んでいてもよいし、ＡｌＮであってもよい。
【００６８】
ＳｉとIII族窒化物材料との間の格子不整合は非常に大きい。ＧｅをＳｉに添加し、そしてアニール工程を実行することにより、より一層格子不整合の大きいＳｉＧｅ層を形成する。
【００６９】
また、２つの材料（ＳｉとIII族窒化物材料）の間の熱膨張係数の相違は非常に大きく、そのためＧａＮ成長後の冷却工程の間ＧａＮ層等のIII族窒化物層内における応力が過剰に大きくなる。
【００７０】
Ｓｉ及びIII族窒化物材料好ましくはＧａＮの間の熱応力の相違は、ＳｉＧｅ層がＳｉとIII族窒化物材料との間に形成された時減少するであろう。結果的に、III族窒化物材料内のクラックの発生が減少する。
【００７１】
上述のように、Ｇｅ材料層は熱応力を劇的に減少させ、また格子不整合を発生させない。実際この熱応力は、Ｓｉ上にＧａＮ等のIII族窒化物材料を成長させることに対する主な障害である。
【００７２】
ＧａＮ層等のIII族窒化物材料内においてなお転移が起こるかもしれない。この問題は、本発明に係る非常に柔軟性を有するポーラス状Ｓｉ層を使用することにより解決することができる。本発明に係るポーラス状Ｓｉ層により、この基板を、シリコンとIII族窒化物層との間の大きな格子不整合に適応させることができ、それにより後者の層における転移密度を減少させることができる。さらに、本発明に係る基板を使用することにより、装置の冷却の間、III族窒化物層のクラックを防止することができる。さらに別の利点は、基板の「湾曲」を防止することである。
【００７３】
基板の選択（本発明に係るポーラス層を有するシリコン）に関しては直接事項ではない。ポーラス状のＳｉは熱的に不安定であり（それは高温において変形する可能性がある）、外気から湿気を吸収する可能性があるからである。
【００７４】
Ｇｅ材料層を、３００℃〜８００℃の温度で、好ましくは５００℃の温度で成長させる。これは、この技術分野において標準的に使用されるＡｌＮ及びＧａＮの成長温度が高いのと対照的である。
【００７５】
他方、Ｇｅ層は、主に本発明に係るポーラス状Ｓｉの酸化を防止するための保護層として機能する。その結果、ポーラス状Ｓｉ層の構造的な変形を防止する。本発明に係るシリコン基板上に直接成長させたＧａＮ層若しくはＡｌＮ層は、ポーラス状Ｓｉ基板の酸化を防止することができない。
【００７６】
さらに、Ｇｅの還元温度は、ポーラス状のＳｉを、ボイドを有するバルク状Ｓｉに再結晶化させる臨界温度より非常に低い。一方、Ｓｉの還元温度は、この遷移温度をかなり上回る。ここでボイドは、ポーラス状のＳｉにおけるマイクロポアと見なすことができる。
【００７７】
Ｇｅ中間層によりＳｉ基板の窒化が防止され、この界面においてアモルファスＳｉＮｘ材料が全く形成されないか、若しくは少量しか形成されない。アモルファス状の薄いＳｉＮｘ材料の形成は、装置の更なるエピタキシャル成長に対して最悪の欠点である。またＧｅ中間層はＧａ及びＳｉの混合を減少させ、それによりメルトバックエッチングを防止する。
【００７８】
本発明に係るＧｅ材料からなる第２層の有利な効果は、Ｇｅ含有の非常に薄い層を、本発明に係る最上層を有するＳｉ基板上に塗布する時に得られる。例えば、この最上層は、１ｎｍ〜２０ｎｍ、５ｎｍ〜１５ｎｍ、６ｎｍ〜１２ｎｍの間の膜厚を有する層である。
【００７９】
本発明に係る方法により得られる装置は、高品質の装置である。
【００８０】
本発明に係る最上層を有するＳｉ基板上のＧｅ含有材料層により、高品質のワイドなバンドギャップを有するIII族窒化物半導体材料、特にＧａＮをエピタキシャル成長させるのに非常に適した表面を提供することができることが分かった。Ｇｅ層のないポーラス状でないＳｉ基板上に成長させるのと比較して、結晶性が良好で、クラックが非常に少なく、湾曲部分が非常に減少した等の高品質のエピタキシャル層を得ることができた。
【００８１】
本発明に係る好ましい装置を以下に記載している。
【００８２】
その第１装置は、
ポーラス状の最上層を有するシリコン基板を備える基板と、
上記ポーラス状最上層上の、ＳｉＧｅ含有の材料からなる第２層と、
この第２層上のＧａＮ層とを備える。
【００８３】
上記ポーラス状層内のポアは、開口したポアであっても良いし、閉口したポアと開口したポアとを組み合わせたものであってもよい。
【００８４】
本発明のある実施の形態では、ＳｉＧｅ材料層（少なくともＳｉＧｅを含有する材料）は、上記最上層と直接接触している。特定の実施の形態では、ＧａＮ層は、ＳｉＧｅ材料の層と直接接触している。上記第２層はＳｉＧｅ層であることが好ましい。
【００８５】
ここに記載した実施の形態におけるＳｉＧｅ材料の層の膜厚は、１ｎｍ〜２μｍ、１ｎｍ〜１０００ｎｍ、１ｎｍ〜５００ｎｍ、１ｎｍ〜３００ｎｍ、１０ｎｍ〜２００ｎｍの間にある。
【００８６】
他の好ましい装置は、
少なくとも一部に閉口したポアを備えるポーラス状最上層を有するシリコン基板を備える基板と、
上記ポーラス状最上層上の、ＳｉＧｅ含有の材料からなる第２層と、
この第２層上の、別のＧａＮとを備える。第２層はＳｉＧｅ層であることが好ましい。
【００８７】
少なくとも一部に閉口したポア、例えばボイドを有する最上層を備えるシリコン基板を持つ基板を、例えばＧａＮ層の成長と冷却の後に形成する。ＧａＮの成長プロセスにおける第１工程（これはアニール工程である）の間、ポーラス状シリコン層を、ボイドを含むバルク状Ｓｉに変換する。
【００８８】
本発明は、III族窒化物材料層及び基板を含む装置を開示している。ある実施の形態では、この装置は、
ポーラス状の最上層を有するシリコン基板を備える基板と、
上記ポーラス状最上層上の、Ｇｅ層及び濃度勾配の付いたＳｉＧｅ層からなる第２層と、
この第２層上のＧａＮ層とを備える。
【００８９】
Ｇｅ材料からなる第２層、例えばＧｅ層若しくは濃度勾配の付いたＳｉＧｅからなる層等は、上記最上層に直接接触することが好ましい。上記濃度勾配の付いたＳｉＧｅ内のＧｅ濃度は、上記基板から離れる方向に増加することが好ましい。ＧａＮ層は、上記第２層と直接接触していることが好ましい。
【００９０】
ポーラス状Ｓｉ層及びＧｅ層は拡がっており、その結果少なくともその層のより低い部分、即ちＳｉ基板近くの部分に、ＳｉＧｅ層、可能性としては濃度勾配の付いたＳｉＧｅ層が形成されることとなる。
【００９１】
ここに記載された実施の形態におけるＧｅ層若しくは濃度勾配の付いたＳｉＧｅ層の膜厚は、１ｎｍ〜１０００ｎｍ、１ｎｍ〜５００ｎｍ、１ｎｍ〜３００ｎｍ、１０ｎｍ〜２００ｎｍの間にある。Ｇｅ層及び濃度勾配の付いたＳｉＧｅ層の膜厚は、１ｎｍ〜１００ｎｍ、１ｎｍ〜５０ｎｍ、１ｎｍ〜２０ｎｍ、１ｎｍ〜１５ｎｍ、１ｎｍ〜１０ｎｍの間にあることがさらに好ましい。
【００９２】
本発明に係る基板の、上記実施の形態のいずれかに記載された基板は、高品質のワイドなバンドギャップを有するIII族窒化物半導体材料、特にＧａＮのエピタキシャル成長にとって非常に有益である。特に、アニール工程、及び／又は２つの工程（第１工程において低温で行われ、続いてより高温で成長させる。）においてIII族窒化物を成長させる工程を含む方法にしたがって準備された基板及び／又はＧｅ層を含む基板は、これらの目的に対して非常に適当である。
【００９３】
上述の装置の全ては、少なくともデバイス領域の一部であってもよい。この装置は、ＦＥＴ、ＬＥＤ、レーザダイオード、ＨＥＭＴ若しくはヘテロ接合バイポーラトランジスタの一部であってもよい。
【００９４】
本発明の他の発明では、III族窒化物材料の成長のための例えばＳｉ／ｐＳｉ／ＳｉＧｅ基板の用途を開示している。ここで、ｐＳｉは本発明に係るポーラスＳｉを示す。テンプレートデバイスと呼ばれるＳｉ／ｐＳｉ／ＳｉＧｅ基板は、ポーラス状最上層と、上記最上層上のＳｉＧｅ材料層（第２層）とを備えるシリコン基板を含む。「Ｓｉ／ｐＳｉ／ＳｉＧｅ基板」は、実際本発明において開示された全てのテンプレートデバイス、即ちＧｅ材料（好ましくはＳｉＧｅ層）からなる層を第２層として有するデバイスに関係する。
【００９５】
本発明に係るＳｉ／ｐＳｉ／ＳｉＧｅ基板を、III族窒化物材料の成長のために使用することにより、従来の課題に対する問題点を解決することができる。しかし、III族窒化物材料が成長するまで、好ましくはポアの少なくとも一部が閉じた、本発明のＳｉ／ｐＳｉ／ＳｉＧｅ基板を形成し保管してもよい。この保管は、数時間、数日、一ヶ月若しくはそれ以上の間であってもよい。
【００９６】
さらに別の発明では、上述のテンプレートデバイスを作製するための方法を開示している。この方法は、
ポーラス状の最上層を備えるシリコン基板を準備する工程と、
上記ポーラス状最上層を有する上記シリコン基板を、Ｇｅ含有の物質に接触させ、それにより上記最上層上に、Ｇｅ含有の材料からなる第２層を形成する工程と、
続いて、Ｇｅ含有の材料からなる上記層を熱的にアニールする工程とを含む。
【００９７】
シリコン基板を準備する工程、及び上記シリコン基板にＧｅ含有物質を接触させる工程を実行し、さらに結果として得られる基板を保管してもよい。上記Ｇｅ材料層を有する上記基板にIII族元素含有物質及びＮ含有物質を接触させる工程を、上記装置がさらに処理される必要があるとき実行してもよい。
【００９８】
上記アニール工程を、Ｇｅ材料の層を有する上記シリコン基板にIII族元素含有物質及びＮ含有物質を接触させる工程の前に実行することが好ましい。ある好ましい実施の形態ではIII族元素はＧａである。別の実施の形態ではIII族元素はＡｌであってもよい。
【００９９】
Ｇｅ材料層にIII族元素（例えばＧａ）含有物質を接触させる工程の前の、Ｇｅ材料層を熱的にアニールする工程により、Ｇｅ層上に形成された酸化物を取り除くことができ、そしてポーラス状Ｓｉ最上層上にＳｉＧｅ材料層、可能性としては濃度勾配の付いたＳｉＧｅ材料を形成することができる。熱的アニール工程は、５００℃〜１３００℃、好ましくは５００℃〜１１００℃の間の温度で実行することが好ましい。
【０１００】
ポーラス状最上層を有するシリコン基板にＧｅ含有物質を接触させる工程により、上記ポーラス状最上層上にＳｉＯ２が形成されることを防止することができる。従来技術（「室温におけるポーラスシリコンの雰囲気内投入」Canham等、J.Appl.Phys.70(1),1991年7月,pp422-431）により、新たにエッチングされたシリコン基板の、汚染されていない、フッ素処理された水素化物表面が、長い時間外気に曝されている間、汚染された自然酸化物に変換され、その結果構造特性が連続的に変更されるということが知られている。
【０１０１】
本発明に係る方法は、さらにＧｅ層を有する上記シリコン基板にIII族元素含有物質及びＮ含有物質を接触させ、それにより上記第２層上にIII族窒化物層を形成する工程を含んでいてもよい。
【０１０２】
本発明は、さらに上記Ｇｅ材料の第２層と、III族窒化物層（別の層）との間に中間（第３）層を形成する工程を含んでいてもよい。III族窒化物層の成長のためのベースとして、若しくはIII族窒化物層の成長が開始される層として機能するように中間層が配置されていることが好ましい。この中間層は、１ｎｍ〜２００ｎｍ、１ｎｍ〜１００ｎｍ、１ｎｍ〜５０ｎｍの間の膜厚を有する層であってもよい。この中間層は、平坦な連続層若しくはアイランドを有する不連続な層であってもよい。この中間層は、ＡｌＮ層であってもよい。
【０１０３】
中間層ＡｌＮは、ＡｌＮ上に成長されたＧａＮ層内に適度な圧縮応力を誘発する可能性がある。これは、ヘテロ構造体の冷却の間、熱的な不整合による大きな熱的引張り応力を相殺し、さらにクラックを防止する。
【０１０４】
ＡｌＮ層の膜厚は、１ｎｍ〜２μｍ、１０ｎｍ〜１０００ｎｍ、１０ｎｍ〜５００ｎｍの間にある。ＡｌＮ層は、５００℃〜９００℃若しくは９００℃〜１１００℃の間の温度で成長する。
【０１０５】
プラズマ気相成長法（ＰＥＣＶＤ）、熱蒸着、閉空間蒸気伝達法若しくは分子ビームエピタキシにより、ポーラス状の最上層を有するシリコン基板にＧｅ含有物質を接触させる工程を実行してもよい。
【０１０６】
Ｇｅ層の成長は一般的に数分かかる。ポーラス状シリコン基板を準備する工程の後、本発明に係るポーラス状最上層を有するこの基板を数秒、数分、数時間（２時間まで）、保護雰囲気（Ｎ２雰囲気等）の下保管してもよく、それ以降Ｇｅ材料層が成長する。
【０１０７】
上記Ｇｅ層にIII族含有物質及びＮ含有物質を接触させ、それによりIII族窒化物層を成長させる工程のために、このウエハを有機金属化学気相成長（ＭＯＣＶＤ）炉内に投入することが好ましい。また、このウエハをＭＢＥ炉若しくはＨＶＰＲＥ炉内に投入してもよい。成長の前に、例えばＨ２雰囲気中で基板をアニールし、それにより酸化物を取り除く。このアニール工程の間、安定なエピタキシャルＧｅケイ化物層を形成する。
【０１０８】
III族含有物質はＴＭＧａ（トリメチルガリウム）であっても良く、一方Ｎ含有物質はＮＨ３であっても良い。ある実施の形態では、上記Ｇｅ材料層にＧ含有物質及びＮ含有物質を接触させる工程を、５００℃〜１３００℃、好ましくは１０００℃〜１１００℃の間の温度で実行しても良い。
【０１０９】
別の実施の形態では、上記Ｇｅ材料層にIII族含有物質及びＮ含有物質を接触させる工程を、５００℃〜１３００℃の間の異なる２つの温度で実行しても良い。この工程の第１工程を、より低い温度（例えば、４００℃〜８００℃の間の温度）で実行し、続いてより高い温度（例えば８００℃〜１２００℃の間の温度）で実行しても良い。
【０１１０】
上記Ｇｅ材料層にIII族含有物質及びＮ含有物質を接触させる工程により、III族窒化物材料層を形成することができる。好ましい実施の形態では、III族窒化物材料層は、少なくともＧａＮを含む材料である。別の実施の形態では、III族窒化物材料層は、少なくともＡｌＮを含む材料であってもよい。
【０１１１】
ある実施の形態では、Ｓｉウエハから出発して、当業者により知られた方法によりポーラス状に形成された基板を作製しても良い。
【０１１２】
ある実施の形態では、この最上層を、例えば濃縮フッ酸（ＨＦ）を用いて陽極酸化反応することによりポーラス状に形成しても良い。
【実施例１】
【０１１３】
２つの電極の装置（図２参照）を使用して、ＨＦベース溶液中で陽極酸化を行うことによりポーラス状のＳｉ（ｐＳｉ）を得る。この２つの電極は、シリコン作用電極（２４）及びプラチナ対極（２３）を有する。界面活性剤として酢酸を添加し、それによりｐＳｉ形成の間に発生した水素バブルを効果的に取り除き、より均質のｐＳｉ層とすることができる。Ｓｉ（１１１）基板（２１）の陽極酸化の間、Ｓｉ元素の電気化学的な溶解は、すでに形成されたｐＳｉとＳｉ基板との間の界面近傍で起こる。そのためｐＳｉ層の膜厚をエッチング時間で制御する。ポア形成のための適切なパラメータは、電流密度、基板のドーピングのタイプ、基板のドーピングレベル、電解液の濃度、見込まれるウエハの照度である。電極表面における正孔は、シリコンの溶解に必要とされるので、ｐ型シリコンは暗闇の中でも容易にエッチングすることができ、一方、ｎ型材料では照度を必要とする。１０％〜９０％の範囲にある空隙率を有し、１０ｎｍ〜数μｍの範囲で変化するポーラス層を容易に得ることができる。このプロセスにより、大きなウエハ領域上に均質なポーラス層を形成することができる。図２は、ｐＳｉ形成のための設備を示している。２１はシリコン基板を、２２はテフロンビーカを、２３はプラチナ電極を、２４はシリコンアノードを、２５はバック接点を示す。ある特定のプロセス条件は、
膜厚：２８０ｍｍ
抵抗率：０．０１Ｗｃｍ
化学溶液：２フッ酸／３酢酸
電流密度：７５ｍＡ／ｃｍ２
である。このプロセスにより、３０％以下の空隙率を有する１．７ｍｍポーラスＳｉ層となる。図４は、上述の方法により得られるポーラス状シリコン〔００１〕に関連する。図５は、シリコン基板（５３）、低空隙率層（５１）、及び高空隙率層（５２）を備えるポーラス状シリコン〔００１〕基板を示している。図６ａ−ｆは、例えばＥＰ１１３２６５２に記載されたＨＦベース溶液における陽極酸化反応によりシリコン〔００１〕基板上にポーラス状最上層を形成する様々な工程を示している。数字６１はシリコン基板を、６２はポアを、６３は反応のポイントを、６４は水素分子を、６５はその分子により作用を受けた流体力（hydrodynamic force）の方向を示している。
【０１１４】
ｐＳｉ形成の後、電解液の痕跡が残らなくなるまで、ウエハをＤＩウォータ内で徹底的にリンスする。この基板をその後Ｎ２で乾燥させ、直ぐに真空システム内に投入し、Ｇｅ層を成長させる。これは、ポーラス状のＳｉの酸化を起こさないことを意味する。Ｇｅを約５００℃の適当な温度でプラズマＣＶＤシステム内で成長させる。Ｇｅは１０〜１００ｎｍの範囲の膜厚を有することとなる。ＰＥＣＶＤ  Ｇｅ層のＸＲＤ分析から推測されるように、ＰＥＣＶＤにより、Ｓｉ基板の上面にエピタキシャルＧｅ層が形成されている。図３は、反射率及びＸＲＤ測定を示している。このＸＲＤ測定は、ｐＳｉ（１１１）の上面にＧａＮのエピタキシャル層が成長していることを示している。
【０１１５】
この工程に続いて１１２５℃で脱気及びアニール工程を行い、その結果ＳｉＧｅ層を形成する。
【０１１６】
次の工程において、基板を、ＭＯＣＶＤ炉内でＴＭＡｌ及びＮＨ３に接触させ、そしてＡｌＮの中間層を１１００℃で形成する（率：７．５ｎｍ／ｍｉｎ、膜厚２００ｎｍ）。
【０１１７】
Ｇｅ層を成長させた後、この基板をＭＯＣＶＤ炉内に投入する。この基板を、１０２０℃でＴＭＧａ及びＮＨ３と接触させる（率１０ｎｍ／ｍｉｎ、膜厚１μｍ）。結果として得られる反射率（図３ａ）及びＸＲＤ測定（図３ｂ）は、滑らかなＧａＮエピタキシャル層がポーラス状Ｓｉ（１１１）の上面に形成されていることを示している。
【図面の簡単な説明】
【０１１８】
【図１】図１は、本発明の（必須及び任意の）工程を示したフローチャートを示している。任意の工程は点線で示している。
【図２】図２は、ｐＳｉ形成の構成を示している。
【図３】図３ａは、時間を関数とした反射率を示している。図３ｂはＸＲＤ測定を示している。
【図４】図４は、低い空隙率から高い空隙率に勾配しているポーラス状シリコン基板を示している。
【図５】図５は、シリコン基板（５３）、低空隙率を有する層（５１）及び高空隙率を有する層（５２）を備えるポーラス状シリコン基板を示している。
【図６】図６ａ−ｆは、例えばＥＰ１１３２９５２に記載されたようなＨＦベースの溶液内で陽極酸化することにより、シリコン〔００１〕基板上にポーラス最上層を形成する場合における様々な工程を示している。数字６１はシリコン基板を、６２はポアを、６３は反応ポイントを、６４は水素分子を、６５はその分子により作用する流体力の方向を示している。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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