(57)【特許請求の範囲】
【請求項１】
絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置であって、
前記下地絶縁層に不純物として含まれるアルミニウムの濃度が、絶縁性基板表面上で１×１０２２原子／ｃｍ３以下に設定され、かつ、前記絶縁性基板表面から１００ｎｍ以上離れた領域では１×１０１９原子／ｃｍ３以下に設定されて、前記絶縁性基板表面から前記半導体層に向かって漸次減少する態様で分布していることを特徴とする半導体装置。
【請求項２】
前記下地絶縁層において、前記絶縁性基板表面から１００ｎｍ離れた領域での前記アルミニウムの濃度が、前記絶縁性基板表面上の前記アルミニウムの濃度の１／１０００００倍以下に設定されていることを特徴とする請求項１に記載の半導体装置。
【請求項３】
前記濃度が前記のように減少している前記下地絶縁層の領域が、少なくともゲート電極の下に位置するように形成されていることを特徴とする請求項１又は２記載の半導体装置。
【請求項４】
絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置の製造方法であって、
前記下地絶縁層を形成する際、前記下地絶縁層に不純物として含ませるアルミニウムの濃度が、絶縁性基板表面上で１×１０２２原子／ｃｍ３以下に設定され、かつ、前記絶縁性基板表面から１００ｎｍ以上離れた領域で１×１０１９原子／ｃｍ３以下に設定されて、前記絶縁性基板表面から前記半導体層に向かって漸次減少する態様で、当該濃度を分布させることを特徴とする半導体装置の製造方法。
【請求項５】
前記下地絶縁層において、前記絶縁性基板表面から１００ｎｍ離れた領域での前記アルミニウムの濃度を、前記絶縁性基板表面上の前記アルミニウムの濃度の１／１０００００倍以下に設定することを特徴とする請求項４記載の半導体装置の製造方法。
【請求項６】
前記濃度が前記のように減少している前記下地絶縁層の領域を、少なくともゲート電極の下に位置するように形成することを特徴とする請求項４又は５記載の半導体装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、半導体装置及びその製造方法に係り、詳しくは、絶縁性基板上に下地絶縁層を介して半導体層を形成した半導体装置及びその製造方法に関する。
【背景技術】
【０００２】
例えば、表示装置の代表として知られている液晶表示装置（Liquid Crystal Device：ＬＣＤ）においては、液晶素子の駆動用デバイスとして薄膜トランジスタ（Thin Film Transistor：ＴＦＴ）を形成したアクティブマトリクス基板が用いられている。ＴＦＴは、絶縁性基板上に形成されたアモルファスシリコン膜やポリシリコン膜等の半導体層を活性層として、ソース領域及びドレイン領域等の活性領域が形成されている。近年、ＬＣＤにおける用途の多様化により、ＴＦＴの多機能化及び微細化が求められ、さらに高い信頼性、あるいは高い耐久性を備えたＴＦＴが要望されている。
【０００３】
ここで、ＴＦＴに用いられる絶縁性基板としては製造コストの点で有利なガラス基板が用いられるが、このガラス基板には製造、加工を容易にするために、製造段階である種の不純物の混入が避けられない。そして、これらの不純物は、ＴＦＴの活性領域となる半導体層に作用して、ＴＦＴの特性上重要なしきい値を変動させる等の影響を及ぼすので、ＴＦＴの信頼性を低下させる。そのような不純物として、特にボロンあるいはアルミニウムが含まれている場合は、微量であっても影響が大きい。このために、ガラス基板上に半導体層を形成するに先立って、ガラス基板に洗浄処理が施されるが、そのような不純物を完全に除去することは困難である。
【０００４】
そのようにガラス基板上に含まれている不純物の影響から半導体層を保護するようにしたＴＦＴが、特許文献１あるいは特許文献２に開示されている。図９は、例えば、特許文献１に開示された従来のＴＦＴの構成を示す断面図である。同ＴＦＴ１００は、絶縁性基板１０１と、この絶縁性基板１０１上に形成された下地絶縁層１０２と、この下地絶縁層１０２上に形成された半導体層１０３と、この半導体層１０３の両端領域にそれぞれ形成されたソース領域１０４及びドレイン領域１０５と、半導体層１０３上に形成されたゲート絶縁膜１０６と、このゲート絶縁膜１０６上に形成されたゲート電極１０７と、ゲート電極１０７を含む全面に形成された層間絶縁膜１０８と、この層間絶縁膜１０８にそれぞれ開孔されたコンタクトホール１０９、１１０を通じて両領域１０４，１０５にコンタクトするように形成されたソース電極１１１及びドレイン電極１１２とを備えている。
【０００５】
上述したような構成の従来のＴＦＴ１００によれば、絶縁性基板１０１上には下地絶縁層１０２を介して半導体層１０３が形成されているので、絶縁性基板１００に含まれている不純物は、下地絶縁層３により遮蔽されて半導体層１０３に作用するのが抑制されるようになる。したがって、ＴＦＴのしきい値が変動するのを防止することが可能となる。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開平０５−２０３９８２号公報
【特許文献２】特開２００５−３４０２８０号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
ところで、特許文献1に記載されているような従来のＴＦＴでは、絶縁性基板と半導体層との間に下地絶縁層が介在されていても、ＴＦＴの製造段階で各種の熱処理が施されると、この熱処理によって絶縁性基板に含まれている不純物が下地絶縁層内に拡散して半導体層に作用する、という問題がある。
すなわち、ＴＦＴの製造段階では、例えばソース領域及びドレイン領域を形成するために半導体層にリン（N型不純物）やボロン（P型不純物）等の不純物が導入されるが、この後にそれらの不純物を活性化させるための活性化工程のように、３００℃以上の比較的高い温度での熱処理を伴う工程が繰り返される。この結果、このような熱処理が長時間にわたって、下地絶縁層を介して半導体層が形成された絶縁性基板が晒されると、絶縁性基板に含まれている前記したようなボロンあるいはアルミニウムが、絶縁性基板から下地絶縁層に拡散するようになる。
【０００８】
そして、ボロンあるいはアルミニウムが下地絶縁層に拡散して半導体層の付近に至るとＴＦＴ特性が変動する。この現象はボロンあるいはアルミニウムが下地絶縁層中の固定電荷として作用していることに起因している可能性がある。また、下地絶縁層を通過して半導体層まで到達するようになると、ボロンあるいはアルミニウムはアクセプタとして作用するので、ＴＦＴのしきい値を変動させるように働く。このような現象は不純物が特にゲート電極直下の半導体層付近もしくは半導体層まで、あるいは低濃度ドレイン（Lightly Doped Drain:ＬＤＤ）領域の半導体層付近もしくは半導体層まで到達した場合に著しくなる。
【０００９】
このため、上述したような活性化工程等の熱処理を伴う工程の熱処理温度を下げることによって、絶縁性基板から下地絶縁層へのボロンあるいはアルミニウムの拡散を抑制させることが考えられる。しかしながら、このように活性化工程等の熱処理温度を下げることは、熱処理の本来の目的が達成できないようになるので、活性化率の低下やゲート絶縁膜等の絶縁耐圧の低下等のマイナス要因をかえって招いてしまうことになる。したがって、特許文献１や特許文献２に開示されたＴＦＴのように絶縁性基板上に下地絶縁層を設けたとしても、ＴＦＴの信頼性の低下を避けることは困難である。
【００１０】
この発明は、上述の事情に鑑みてなされたもので、絶縁性基板上に下地絶縁層を介して半導体層が形成された半導体装置において、絶縁性基板に含まれている不純物が半導体層に作用するのを防止して、半導体装置の信頼性を向上させることができるようにした半導体装置及びその製造方法を提供することを目的としている。
【課題を解決するための手段】
【００１１】
上記課題を解決するために、この発明の第１の構成は、絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置に係り、前記下地絶縁層に不純物として含まれるアルミニウムの濃度が、絶縁性基板表面で１×１０２２原子／ｃｍ３以下に設定され、かつ、前記絶縁性基板表面から１００ｎｍ以上離れた領域で１×１０１９原子／ｃｍ３以下に設定されて、前記絶縁性基板表面から前記半導体層に向かって漸次減少する態様で分布していることを特徴としている。
【００１２】
また、この発明の第２の構成は、絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置の製造方法に係り、前記下地絶縁層を形成する際、前記下地絶縁層に不純物として含ませるアルミニウムの濃度が、絶縁性基板表面で１×１０２２原子／ｃｍ３以下に設定され、かつ、前記絶縁性基板表面から１００ｎｍ以上離れた領域で１×１０１９原子／ｃｍ３以下に設定されて、前記絶縁性基板表面から前記半導体層に向かって漸次減少する態様で、当該濃度を分布させることを特徴としている。
【発明の効果】
【００１３】
この発明の半導体装置によれば、下地絶縁層にこの上の半導体層に対して影響を及ぼさない程度の不純物濃度でアルミニウムが含まれているので、絶縁性基板に含まれているアルミニウムが半導体層に作用するのを防止でき、半導体装置の信頼性を向上させることができる。
【図面の簡単な説明】
【００１４】
【図１】この発明の第１の実施形態である半導体装置の構成を概略的に示す断面図である。
【図２】同半導体装置の製造方法を工程順に示す工程図である。
【図３】同半導体装置の製造方法を工程順に示す工程図である。
【図４】同半導体装置の製造方法を工程順に示す工程図である。
【図５】この発明の第２の実施形態である半導体装置の構成を概略的に示す断面図である。
【図６】この発明の原理を示すもので、Ｖｔｈ(しきい値)変化率（縦軸）とボロン濃度の平均的な減少の割合（／ｎｍ）（横軸）との関係を示す図である。
【図７】この発明の原理を示すもので、Ｖｔｈ変化率（縦軸）とアルミニウム濃度の平均的な減少の割合（／ｎｍ）（横軸）との関係を示す図である。
【図８】この発明の原理において二次イオン質量分析法において検出した不純物濃度分布を示し、不純物濃度（縦軸）と深さ（縦軸）との関係を示す図である。
【図９】従来の半導体装置の構成を示す断面図である。
【発明を実施するための形態】
【００１５】
絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置において、絶縁性基板表面から１００ｎｍ以内の領域に、絶縁性基板表面から半導体層に向かってアルミニウム濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにアルミニウムが含まれている。
また、参考例として、絶縁性基板上に下地絶縁層を介して半導体層を形成する半導体装置において、絶縁性基板表面から１００ｎｍ以内の領域に、絶縁性基板表面から半導体層に向かってボロン濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロンが含まれている。
【００１６】
この発明の発明者らは鋭意研究を重ねた結果、絶縁性基板上に形成された下地絶縁層中にボロンあるいはアルミニウムを含ませ、これらの不純物をその濃度が絶縁性基板から半導体層に向かって特定の平均的な割合で減少するように制御すると、ボロンあるいはアルミニウムが下地絶縁層に含まれていてもＴＦＴのしきい値に影響を及ぼさないことを見い出した。
【００１７】
図６は、絶縁性基板上に形成した、チャネル長及びチャネル幅がともに５μｍ、ＬＤＤ長が１．２μｍのＰチャネル型のＴＦＴを用いて、温度が６０℃、湿度が９０％の高温高湿の雰囲気に晒した状態で、ゲート・ソース間電圧Vｇｓ＝−１８Vを印加することにより負ゲートストレスを加えた条件で得られた、Ｖｔｈ(しきい値)変化率（縦軸）とボロン濃度の平均的な減少の割合（横軸）との関係を示している。すなわち、横軸（ｎｍ）は下地絶縁層に含ませたボロンの濃度の絶縁性基板表面から半導体層に向かっての厚さ１ｎｍあたりの平均的な減少の割合（無次元）を示し、この平均的な減少の割合が1ｎｍあたり１／１００倍より多く減少させると、Ｖｔｈ変化率がどのように変化するかを示している。
【００１８】
ここで、上記の割合とは、下地絶縁層のある位置でのボロンあるいはアルミニウム（後述する）の濃度をボロンあるいはアルミニウムのガラス基板（絶縁性基板）表面の濃度で割った値を示している。また、平均的な減少の割合とはボロンあるいはアルミニウムの濃度の減少した割合を膜厚あたりに換算したもので、２つ以上の異なる絶縁膜から下地絶縁層が構成されている場合には、１層の絶縁層とみなして換算する。例えば、１００ｎｍの下地絶縁層を介して１／１０００００倍の濃度となっている場合、平均的な減少の割合は、１ｎｍあたりで１／１０００倍である。
【００１９】
一方、図７は、絶縁性基板上に形成した、上記と同一規格のＴＦＴを用いて、上記と同一条件で得られた、Ｖｔｈ変化率（縦軸）とアルミニウム濃度の厚さ１ｎｍあたりの平均的な減少の割合（横軸）との関係を示し、この平均的な減少の割合を1ｎｍあたり１／１００倍より多く減少させると、Ｖｔｈ変化率がどのように変化するかを示している。
【００２０】
ボロン濃度あるいはアルミニウム濃度の算出は、図８に示したような、二次イオン質量分析法において検出した不純物濃度分布を用いて算出すると容易である。同図は、不純物濃度（縦軸）と深さ（縦軸）との関係を示している。図６におけるボロン濃度は、二次イオン質量分析法で一次イオンとして酸素プラスイオンを用い、一次イオンの加速電圧を５ｋｅＶとして検出した。検出されるイオン濃度は下地絶縁層中のボロン単体、あるいはボロンを含む物質（化合物等）に由来している。同様にして、図７におけるアルミニウム濃度は、二次イオン質量分析法で一次イオンとして酸素プラスイオンを用い、一次イオンの加速電圧を５ｋｅＶとして検出した。検出されるイオン濃度は下地絶縁層中のアルミニウム単体、あるいはアルミニウムを含む物質（化合物等）に由来している。
【００２１】
図６から明らかなように、Ｖｔｈ変化率（縦軸）とボロン濃度の平均的な減少の割合（／nm）（横軸）との関係は、下地絶縁層におけるボロン濃度の平均的な減少の割合が１ｎｍあたり１／１０００倍の領域で、Ｖｔｈ変化率は急激に減少し、さらにボロン濃度の平均的な減少の割合が１ｎｍあたり１／１００００倍に達するまでそのＶｔｈ変化率は十分に小さく維持されている。ただし、下地絶縁層の形成時に多量のボロンが混入して、下地絶縁層の絶縁性基板表面から１００ｎｍ以上離れた領域で、ボロン濃度が１×１０１９／ｃｍ３より大きくなった場合には、半導体層付近においてボロンの影響を受けるので、下地絶縁層の絶縁性基板表面から１００ｎｍ以上離れたその領域のボロン濃度は１×１０１９（原子／ｃｍ３）以下であることが望ましい。もちろん、このボロン濃度は少なければ少ないほど良い。このように、下地絶縁層の絶縁性基板表面から１００ｎｍ以内の領域に、絶縁性基板表面から半導体層に向かってボロン濃度が平均的に１ｎｍあたり１／１０００倍以下の割合で減少するように設定することにより、ＴＦＴのしきい値の変動を抑えることができることを示している。とくに1ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロン濃度を設定することが望ましい。すなわち、下地絶縁層にこの上の半導体層に対して影響を及ぼさない程度の不純物濃度でボロンを含ませることで、絶縁性基板に含まれているボロンが半導体層に作用するのを防止でき、半導体装置の信頼性を向上させることができる。
【００２２】
同様にして、図７から明らかなように、Ｖｔｈ変化率（縦軸）とアルミニウム濃度の平均的な減少の割合（／nm）（横軸）との関係は、アルミニウム濃度の平均的な減少の割合が１ｎｍあたり１／１０００倍の領域で、Ｖｔｈ変化率は急激に減少し、さらにアルミニウム濃度の平均的な減少の割合が１ｎｍあたり１／１００００倍に達するまでそのＶｔｈ変化率は十分に小さく維持されている。ただし、図６の場合と同様に、下地絶縁層の形成時に多量のアルミニウムが混入して、下地絶縁層の絶縁性基板表面から１００ｎｍ以上離れた領域で、アルミニウム濃度が１×１０１９（原子／ｃｍ３）より大きくなった場合には、半導体層付近においてアルミニウムの影響を受けるので、下地絶縁層の絶縁性基板表面から１００ｎｍ以上離れた領域のアルミニウム濃度は１×１０１９（原子／ｃｍ３）以下であることが望ましい。もちろん、このアルミニウム濃度は少なければ少ないほど良い。このように、下地絶縁層の絶縁性基板表面から１００ｎｍ以内の領域に、絶縁性基板表面から半導体層に向かってアルミニウム濃度が平均的に１ｎｍあたり１／１０００倍以下の割合で減少するように設定することにより、ＴＦＴのしきい値の変動を抑えることができることを示している。とくに1ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにアルミニウム濃度を設定することが望ましい。
【実施形態１】
【００２３】
以下、上述の原理を基に、図面を参照して、この発明の第１の実施形態について説明する。
図１は、この発明の第１の実施形態である半導体装置の構成を概略的に示す断面図、図２（ａ）〜図４（ｊ）は同半導体装置の製造方法を工程順に示す工程図である。以下、図１を参照して同半導体装置の構成を説明する。なお、この例では半導体装置としてはＴＦＴに適用した例で説明する。
この例のＴＦＴ（半導体装置）１０は、図１に示すように、ガラスから成る絶縁性基板１と、この絶縁性基板1上に形成された膜厚が１００〜１０００ｎｍのシリコン酸化膜から成る下地絶縁層２と、この下地絶縁層２上に形成された膜厚が３０〜１００ｎｍのアモルファスシリコン層、あるいはポリシリコン層から成る半導体層３と、この半導体層３の両端領域にそれぞれ形成されたソース領域4及びドレイン領域５と、半導体層３上に形成された膜厚が５０〜３００ｎｍのシリコン酸化膜から成るゲート絶縁膜６と、このゲート絶縁膜６上に形成された膜厚が５０〜１０００ｎｍのクロム膜から成るゲート電極７とを備えている。この例では、後述するように、ソース領域４はＰ型高濃度領域４Ａ及びＰ型低濃度領域４Ｂから成り、一方ドレイン領域５はＰ型高濃度領域５Ａ及びＰ型低濃度領域５Ｂから成り、ともにLDD構造を有している。
【００２４】
さらに、このＴＦＴ１０は、図１に示すように、ゲート電極７を含む全面に形成された膜厚が１０〜５００ｎｍのシリコン酸化膜から成る層間絶縁膜８と、この層間絶縁膜８にそれぞれ開孔されたコンタクトホール９、１１を通じてソース領域４及びドレイン領域５にコンタクトするように形成された膜厚が３０〜５００ｎｍのアルミニウム膜から成るソース電極１２及びドレイン電極１３とを備えている。
【００２５】
ここで、下地絶縁層２には、上述の発明の原理に基づいて、絶縁性基板１表面から１００ｎｍ以内の領域に、絶縁性基板１表面から半導体層に向かってボロン濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロンが含まれている。また、絶縁性基板１表面に存在しているボロンの濃度は、１×１０２２（原子／ｃｍ３）以下であることが望ましい。
【００２６】
上述したようにこの例のＴＦＴ１０によれば、下地絶縁層２には、前述の発明の原理に基づいて、絶縁性基板１表面から１００ｎｍ以内の領域に、絶縁性基板１表面から半導体層３に向かってボロン濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロンが含まれているので、下地絶縁層２におけるボロン濃度の平均的な減少の割合が１ｎｍあたり１／１０００倍の領域で、Ｖｔｈ変化率は急激に減少し、さらにボロン濃度の平均的な減少の割合が１ｎｍあたり１／１００００倍に達するまでそのＶｔｈ変化率は十分に小さく維持されている。
したがって、ＴＦＴ１０のしきい値の変動を抑えることができるので、ＴＦＴの信頼性を向上させることができる。
【００２７】
次に、図２（ａ）乃至図４（ｊ）を参照して、この例のＴＦＴ１０の製造方法（第１の製造方法）を工程順に説明する。
まず、図２（ａ）に示すように、ガラス等の絶縁性基板１を用意して、この絶縁性基板１上に、プラズマＣＶＤ（Chemical Vapor Deposition：化学的気相成長）法により、ＴＥＯＳ（テトラエトキシシラン）もしくはＳｉＨ４（モノシラン）を原料ガスとして、膜厚が１００〜１０００ｎｍのシリコン酸化膜から成る下地絶縁層２を形成する。この下地絶縁層２上には、後述のように半導体層３が形成される。このとき、下地絶縁層２の絶縁性基板１表面から１００ｎｍ以内の領域に、絶縁性基板1表面から半導体層３に向かってボロン濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロンを含ませる。これは、上述のプラズマＣＶＤ法により下地絶縁層２となるシリコン酸化膜を形成する際に、原料ガスの流量、ガス圧力、高周波印加電力量、電極と基板との距離、成膜温度等を適宜制御することにより可能となる。また、これらの制御要素はプラズマＣＶＤ装置によって異なるが、生産コストを考慮してできるだけ形成時間が少なくなるように設定する。
【００２８】
次に、図２（ｂ）に示すように、プラズマＣＶＤ法によりＳｉＨ４ガスを原料ガスとして、下地絶縁層２上に膜厚が３０〜１００ｎｍのアモルファスシリコン膜から成る半導体層３を形成する。このとき、アモルファスシリコン膜の成膜と同時にしきい値の制御を目的に、微量のボロン、リン等の不純物を半導体層３にドーピングさせる。あるいはこれらの不純物のドーピングはアモルファスシリコン膜の成膜後に行ってもよい。次に、必要に応じて、アモルファスシリコン膜にエキシマレーザ等を照射してポリシリコン膜に変えて、ポリシリコン膜から成る半導体層３を形成するようにしてもよい。ポリシリコン膜はアモルファスシリコン膜よりも移動度が大きいので、動作速度の高いＴＦＴを得ることができる。
【００２９】
次に、図２（ｃ）に示すように、フォトリソグラフィ法及びフォトエッチング法により、半導体層３を選択的にエッチングして所望の形状にパターニングした後、プラズマＣＶＤ法により半導体層３上に膜厚が５０〜３００ｎｍのシリコン酸化膜から成るゲート絶縁膜６を形成する。このゲート絶縁膜６は、シリコン酸化膜に代えてシリコン窒化膜を用いてもよく、あるいはシリコン酸化膜とシリコン窒化膜との積層膜を用いてもよい。また、プラズマＣＶＤ法に限らず、ＰＶＤ（Physical Vapor Deposition:物理的気相成長）法、プラズマ酸化法、高圧下での水蒸気による酸化法、あるいはこれらを組み合わせた方法等を用いることができるが、加熱時の絶縁性基板１の変形を防止するために６００℃以下で実施することが望ましい。
【００３０】
次に、図２（ｄ）に示すように、スパッタリング法により、ゲート絶縁膜６上に膜厚が５０〜１０００ｎｍのクロム膜から成るゲート電極膜を形成する。このゲート電極膜は、クロム膜に代えてＣＶＤ法により形成したボロン、リン等の不純物をドーピングしたシリコン膜を用いてもよく、あるいはクロム膜とシリコン膜との積層膜を用いてもよい。次に、フォトリソグラフィ法及びフォトエッチング法により、ゲート電極膜を選択的にエッチングして所望の形状にパターニングすることによりゲート電極７を形成する。
【００３１】
次に、ゲート電極７上にレジストパターンを形成した後、図３（ｅ）に示すように、このレジストパターンをマスクとしてＰ型不純物をゲート絶縁膜７を通じて半導体層３に導入してＰ型高濃度領域４Ａ、５Ａを形成する。このＰ型高濃度領域４Ａ、５Ａの形成はゲート電極７を形成する前に実施してもよいが、不純物の導入によるゲート絶縁膜６の劣化を抑制するためにゲート絶縁膜６の形成前に実施することが望ましい。次に、ゲート電極７上に改めてレジストパターンを形成した後、このレジストパターンをマスクとしてＰ型不純物をゲート絶縁膜７を通じて半導体層３に導入してＰ型低濃度領域４Ｂ、５Ｂを形成する。以上により、Ｐ型高濃度領域４Ａ及びＰ型低濃度領域４Ｂから成るＰ型ソース領域４、Ｐ型高濃度領域５Ａ及びＰ型低濃度領域５Ｂから成るＰ型ドレイン領域５を形成する。
【００３２】
次に、図３（ｆ）に示すように、プラズマＣＶＤ法により、ＴＥＯＳ及びＯ２ガスを原料ガスとして、全面に膜厚が１０〜５００ｎｍのシリコン酸化膜、あるいはシリコン窒化膜、もしくはシリコン酸化膜とシリコン窒化膜との積層膜から成る層間絶縁膜１１を形成する。この層間絶縁膜１１は、この後の段階でLDD構造のソース領域４及びドレイン領域５内の不純物を活性化するために比較的高い温度である３００〜７００℃で熱処理を施す際に、ゲート電極５として用いている材料（この例では前記したようにクロム）が熱によって剥離してしまうのを抑制し、さらにゲート電極５とこの後の段階で形成されるソース電極及びドレイン電極とゲート電極５との絶縁性を確保するためのものである。
【００３３】
次に、図３（ｇ）に示すように、熱処理炉内で３００〜７００℃で熱処理を施して、ソース領域４及びドレイン領域５内の不純物を活性化する。この熱処理は、熱処理炉に代えてエキシマレーザ等を照射して活性化するようにしてもよい。
【００３４】
次に、図４（ｈ）に示すように、半導体層３及び半導体層３とゲート絶縁膜６との界面のダングリングボンドを終端させるために、水素プラズマ中で熱処理を行って水素終端処理を施す。これは、上記のダングリングボンドが終端されていない場合に生ずるＴＦＴの電気的特性の劣化を防止するために行う。
【００３５】
次に、図４（i）に示すように、フォトリソグラフィ法及びフォトエッチング法、あるいはウエットかつエッチング法、もしくは両エッチング法により、層間絶縁膜１１及びゲート絶縁膜７を選択的にエッチングしてそれぞれソース領域４及びドレイン領域５を露出させるコンタクトホール９、１１を開孔する。
【００３６】
次に、図４（ｊ）に示すように、スパッタリング法によりアルミニウム薄膜を全面に形成した後、フォトリソグラフィ法及びフォトエッチング法、あるいはウエットつエッチング法、もしくは両エッチング法により、アルミニウムをエッチングしてソース領域４及びドレイン領域５に接触するようにソース電極１２及びドレイン電極１３を形成する。次に、そのレジストマスクを除去することにより、図１に示したようなＴＦＴ１０を完成させる。この後は、必要に応じて、別の電極膜、パッシベーション膜、層間絶縁膜、平坦化膜、容量絶縁膜等を適宜形成する。
このようなＴＦＴ１０の製造方法によれば、周知の製造プロセスを組み合わせることにより、特別な製造プロセスを用いることなく、この例のＴＦＴ１０を製造することができるので、製造コストをアップすることなくＴＦＴ１０を得ることができる。
【実施形態２】
【００３７】
図５は、この発明の第２の実施形態であるＴＦＴの構成を示す断面図である。この例のＴＦＴの構成が、上述した第１の実施形態の構成と大きく異なるところは、下地絶縁層として積層構造を採用するようにした点である。
この例のＴＦＴ２０は、図５に示すように、下地絶縁層２が、膜厚が５０〜１００ｎｍのシリコン窒化膜から成る下層膜２Ａと、膜厚が５０〜１０００ｎｍのシリコン酸化膜から成る上層膜２Ｂとの積層層から構成されている。ここで、シリコン窒化膜は不純物イオンのブロッキング効果が高いというメリットを有する一方、内部応力が大きいというデメリットを有している。このため、シリコン窒化膜上に直接に半導体層３を形成すると半導体層３に歪みを与えてしきい値に影響するので、シリコン窒化膜上にはシリコン酸化膜を形成して積層構造にしている。この下地絶縁層２の膜厚は、絶縁性基板１と下地絶縁層２との界面に存在する電荷が半導体層３に及ぼす影響を抑制するために１００ｎｍ以上に選ぶことが望ましい。
【００３８】
この例のＴＦＴ２０において、下地絶縁層２にボロンを含ませた場合には、図６に示したような関係と略同様な結果が得られ、またアルミニウムを含ませた場合には、図７に示したような関係と略同様な結果が得られる。
これ以外は、上述した第１の実施形態の構成と略同じであるので、図５において、図１の構成部分と対応する各部には、同一の番号を付してその説明を省略する。
【００３９】
このようにこの例のＴＦＴ２０によれば、下地絶縁層２が積層構造から構成された点が第１の実施形態と異なるだけで、第１の実施形態と略同様な効果を得ることができる。
【００４０】
次に、第２の実施形態によるＴＦＴ２０の製造方法（第２の製造方法）について説明する。
この第２の製造方法では、前述した第１の製造方法における図２（ａ）の工程において、プラズマＣＶＤ法により、ＳｉＨ４、ＮＨ３（アンモニア）及びＮ２を原料ガスとして、膜厚が５０〜１００ｎｍのシリコン窒化膜から成る下層膜２Ａを形成する。次に、プラズマＣＶＤ法により、ＴＥＯＳもしくはＳｉＨ４を原料ガスとして、下層膜２Ａ上に膜厚が５０〜１０００ｎｍのシリコン酸化膜から成る上層膜２Ｂを形成する。
【００４１】
このとき、下地絶縁層２の絶縁性基板１表面から１００ｎｍ以内の領域に、絶縁性基板1表面から半導体層３に向かってボロン濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにボロンを含ませる。あるいは、下地絶縁層２の絶縁性基板１表面から１００ｎｍ以内の領域に、絶縁性基板1表面から半導体層３に向かってアルミニウム濃度が平均的に１ｎｍあたり１／１００００〜１／１０００倍の割合で減少するようにアルミニウムを含ませる。これは、上述のプラズマＣＶＤ法により下地絶縁層２となるシリコン窒化膜及びシリコン酸化膜を形成する際に、原料ガスの流量、ガス圧力、高周波印加電力量、電極と基板との距離、成膜温度等を適宜制御することにより可能となる。また、これらの制御要素はプラズマＣＶＤ装置によって異なるが、生産コストを考慮してできるだけ形成時間が少なくなるように設定する。
これ以外は、上述した第１の製造方法の構成と略同じであるので、その説明を省略する。
【００４２】
このようなＴＦＴ２０の製造方法によれば、ＴＦＴ１０の製造方法と同様に周知の製造プロセスを組み合わせることにより、特別な製造プロセスを用いることなく、この例のＴＦＴ２０を製造することができるので、同様な効果を得ることができる。
【００４３】
以上、この発明の実施形態を図面により詳述してきたが、具体的な構成は上述の実施形態に限られるものではなく、この発明の要旨を逸脱しない範囲の設計の変更等があってもこの発明に含まれる。例えば、上述の実施形態では、ＴＦＴのソース領域及びドレイン領域がＬＤＤ構造を有する例で説明したが、これに限ることはない。またソース領域及びドレイン領域をＮ型導電型、ゲート絶縁膜はシリコン酸化膜を用いて構成した例で説明したが、これに限らずシリコン酸化膜とシリコン窒化膜との積層膜により構成することもできる。また、ゲート電極としてはクロム薄膜を用いる例で説明したが、クロムに代えてアルミニウム、モリブデン、タングステン、ニオブ、あるいはこれらの合金等の他の金属を使用することもできる。
【産業上の利用可能性】
【００４４】
この発明は、不純物を含む絶縁性基板上に下地絶縁層を介して半導体層が形成される構成の半導体装置に広く適用できる。
【符号の説明】
【００４５】
１    絶縁性基板
２    下地絶縁層
２Ａ  下層膜
２Ｂ  上層膜
３    半導体層
４    ソース領域
５    ドレイン領域
４Ａ、５Ａ    Ｐ型高濃度領域
４Ｂ、５Ｂ    Ｐ型低濃度領域
６    ゲート絶縁膜
７    ゲート電極
８    層間絶縁膜
９，１１    コンタクトホール
１０、２０  ＴＦＴ（半導体装置）
１２  ソース電極
１３  ドレイン電極
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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