(57)【特許請求の範囲】
【請求項１】
第１の電極と、
前記第１の電極の上方に形成された第１の化合物半導体層と、
前記第１の化合物半導体層上に形成された第２の化合物半導体層と、
前記第２の化合物半導体層上に形成された第３の化合物半導体層と、
前記第３の化合物半導体層の上方に形成された第２の電極と、
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の積層体に形成された開口部内に形成され、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の側面に接する第４の化合物半導体層と、
前記第２の化合物半導体層と前記第４の化合物半導体層との界面の電位を制御するゲート電極と、
前記第１の化合物半導体層から絶縁され、前記第１の電極及び前記第２の化合物半導体層に接する第３の電極と、
を有し、
前記第２の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第４の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第２の化合物半導体層の伝導帯のエネルギは、前記第３の化合物半導体層の伝導帯のエネルギよりも高いことを特徴とする化合物半導体装置。
【請求項２】
前記第３の電極は、前記第１の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生した２次元電子ガス及び前記第３の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生した２次元電子ガスから離間して形成されていることを特徴とする請求項１に記載の化合物半導体装置。
【請求項３】
前記第２の化合物半導体層の格子定数は、前記第４の化合物半導体層の格子定数以下であることを特徴とする請求項１に記載の化合物半導体装置。
【請求項４】
前記ゲート電極と前記第４の化合物半導体層とを絶縁するゲート絶縁膜を有することを特徴とする請求項１に記載の化合物半導体装置。
【請求項５】
前記ゲート絶縁膜よりも厚く、前記ゲート電極と前記第１の電極とを絶縁する絶縁膜を有することを特徴とする請求項４に記載の化合物半導体装置。
【請求項６】
前記第１の電極及び前記第３の電極は、一体的に形成されていることを特徴とする請求項１に記載の化合物半導体装置。
【請求項７】
第１の化合物半導体層、第２の化合物半導体層、及び第３の化合物半導体層がこの順で積層された積層体を形成する工程と、
前記積層体に開口部を形成する工程と、
前記開口部内に、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の側面に接する第４の化合物半導体層を形成する工程と、
前記第２の化合物半導体層と前記第４の化合物半導体層との界面の電位を制御するゲート電極を形成する工程と、
前記第３の化合物半導体層の上方に第２の電極を形成する工程と、
前記第１の化合物半導体層の下方に第１の電極を形成し、更に、前記第１の化合物半導体層から絶縁され、前記第１の電極及び前記第２の化合物半導体層に接する第３の電極を形成する工程と、
を有し、
前記第２の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第４の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第２の化合物半導体層の伝導帯のエネルギは、前記第３の化合物半導体層の伝導帯のエネルギよりも高いことを特徴とする化合物半導体装置の製造方法。
【請求項８】
前記第３の電極を、前記第１の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生する２次元電子ガス及び前記第３の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生する２次元電子ガスから離間して形成することを特徴とする請求項７に記載の化合物半導体装置の製造方法。
【請求項９】
前記第２の化合物半導体層の格子定数は、前記第４の化合物半導体層の格子定数以下であることを特徴とする請求項７に記載の化合物半導体装置の製造方法。
【請求項１０】
前記ゲート電極と前記第４の化合物半導体層とを絶縁するゲート絶縁膜を形成する工程を有することを特徴とする請求項７に記載の化合物半導体装置の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、化合物半導体装置及びその製造方法に関する。
【背景技術】
【０００２】
従来、基板の上方に結晶成長によりＡｌＧａＮ層及びＧａＮ層が形成され、ＧａＮ層が電子走行層として機能する高電子移動度トランジスタ（ＨＥＭＴ：high electron mobility transistor）についての研究が行われている。ＧａＮのバンドギャップは３．４ｅＶであり、Ｓｉのバンドギャップ（１．１ｅＶ）及びＧａＡｓのバンドギャップ（１．４ｅＶ）よりも大きい。このため、ＧａＮ系のＨＥＭＴの耐圧は高く、自動車用等の高耐圧電力デバイスとして有望である。【０００３】
その一方で、Ｓｉ系の電界効果トランジスタには必然的にボディダイオードが存在する。ボディダイオードは逆並列となるようにトランジスタに接続されており、大電力電源に用いられるフルブリッジ回路方式において、還流ダイオードとして機能する。しかし、ＧａＮ系のＨＥＭＴには、このようなボディダイオードが必然的には存在しない。そこで、基板の厚さ方向にｐ型層及びｎ型層が積層されたｐｎ接合ダイオードが、ＧａＮ系のＨＥＭＴに接続された構造が提案されている。【０００４】
しかしながら、これまで提案された構造では、ダイオードの動作に遅延が生じやすい。そして、遅延に伴って、ダイオードが還流ダイオードとして動作する前にＨＥＭＴに逆電流が流れ、消費電力が増大してしまう。また、遅延のために、ＨＥＭＴのソース及びドレイン間に過電圧が印加された場合には、ダイオードが保護回路として動作しない。【０００５】
また、高耐圧電力デバイスの構造には、ソース及びドレインが基板の表面に平行に配置された横型構造と、ソース及びドレインが基板の表面に垂直に配置された縦型構造とがある。縦型構造では、電流の経路が３次元的になるため、１チップ当たりの電流量が横型構造よりも大きい。また、縦型構造では、ソース電極及びドレイン電極が基板の表面及び裏面に形成されているため、これらが基板の表面のみに形成されている横型構造と比較して、ソース電極及びドレイン電極のために必要な面積が小さい。更に、縦型構造では、１チップ当たりの電極の割合が横型構造よりも大きいため、放熱性が高い。このため、縦型構造の高耐圧電力デバイスの実用化が期待される。【０００６】
しかしながら、縦型構造のＧａＮ系のＨＥＭＴに、上記のｐｎ接合ダイオードを接続することは困難である。また、接続できたとしても、上記の問題点は解消されない。
【先行技術文献】
【特許文献】
【０００７】
【特許文献１】特開２００９−１６４１５８号公報
【特許文献２】特開２００９−４３９８号公報
【非特許文献】
【０００８】
【非特許文献１】Applied Physics Express 1(2008) 011105
【非特許文献２】Applied Physics Express 1(2008) 021104
【発明の概要】
【発明が解決しようとする課題】
【０００９】
本発明は、縦型構造のＨＥＭＴと接続されるダイオードを適切に動作させることができる化合物半導体装置及びその製造方法を提供することを目的とする。
【課題を解決するための手段】
【００１０】
化合物半導体装置の一態様には、第１の電極と、前記第１の電極の上方に形成された第１の化合物半導体層と、前記第１の化合物半導体層上に形成された第２の化合物半導体層と、前記第２の化合物半導体層上に形成された第３の化合物半導体層と、前記第３の化合物半導体層の上方に形成された第２の電極と、が設けられている。更に、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の積層体に形成された開口部内に形成され、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の側面に接する第４の化合物半導体層と、前記第２の化合物半導体層と前記第４の化合物半導体層との界面の電位を制御するゲート電極と、前記第１の化合物半導体層から絶縁され、前記第１の電極及び前記第２の化合物半導体層に接する第３の電極と、が設けられている。そして、前記第２の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、前記第４の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さい。また、前記第２の化合物半導体層の伝導帯のエネルギは、前記第３の化合物半導体層の伝導帯のエネルギよりも高い。
【発明の効果】
【００１１】
上記の化合物半導体装置等によれば、縦型構造の高電子移動度トランジスタと接続されるダイオードを適切に動作させることができる。
【図面の簡単な説明】
【００１２】
【図１Ａ】図１Ａは、第１の実施形態に係る化合物半導体装置の構造を示す断面図である。
【図１Ｂ】図１Ｂは、第１の実施形態における伝導帯のエネルギを示す図である。
【図１Ｃ】図１Ｃは、第１の実施形態の変形例の構造を示す断面図である。
【図２Ａ】図２Ａは、第２の実施形態に係る化合物半導体装置の電極同士の位置関係を示す図である。
【図２Ｂ】図２Ｂは、図２Ａ中のＩ−Ｉ線に沿った断面を示す図である。
【図２Ｃ】図２Ｃは、図２Ａ中のＩＩ−ＩＩ線に沿った断面を示す図である。
【図３Ａ】図３Ａは、電子密度の基板の表面からの距離との関係を示す図である。
【図３Ｂ】図３Ｂは、伝導帯のエネルギの基板の表面からの距離との関係を示す図である。
【図３Ｃ】図３Ｃは、ダイオード特性を示す図である。
【図３Ｄ】図３Ｄは、ドレイン電流のゲート電圧との関係を示す図である。
【図３Ｅ】図３Ｅは、ドレイン電流Ｉｄのソース−ドレイン間電圧との関係を示す図である。
【図４Ａ】図４Ａは、第２の実施形態に係る化合物半導体装置を製造する方法を示す図である。
【図４Ｂ】図４Ｂは、図４Ａに引き続き、化合物半導体装置を製造する方法を示す図である。
【図４Ｃ】図４Ｃは、図４Ｂに引き続き、化合物半導体装置を製造する方法を示す図である。
【図４Ｄ】図４Ｄは、図４Ｃに引き続き、化合物半導体装置を製造する方法を示す図である。
【図５Ａ】図５Ａは、第２の実施形態に係る化合物半導体装置を製造する方法を示す断面図である。
【図５Ｂ】図５Ｂは、図５Ａに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｃ】図５Ｃは、図５Ｂに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｄ】図５Ｄは、図５Ｃに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｅ】図５Ｅは、図５Ｄに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｆ】図５Ｆは、図５Ｅに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｇ】図５Ｇは、図５Ｆに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｈ】図５Ｈは、図５Ｇに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｉ】図５Ｉは、図５Ｈに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｊ】図５Ｊは、図５Ｉに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｋ】図５Ｋは、図５Ｊに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図５Ｌ】図５Ｌは、図５Ｋに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図６】図６は、ＭＯＣＶＤ装置の構成を示す図である。
【図７Ａ】図７Ａは、図５Ａ〜図５Ｌに示す方法の変形例を示す断面図である。
【図７Ｂ】図７Ｂは、図７Ａに引き続き、変形例を示す断面図である。
【図７Ｃ】図７Ｃは、図７Ｂに引き続き、変形例を示す断面図である。
【図７Ｄ】図７Ｄは、図７Ｃに引き続き、変形例を示す断面図である。
【図７Ｅ】図７Ｅは、図７Ｄに引き続き、変形例を示す断面図である。
【図７Ｆ】図７Ｆは、図７Ｅに引き続き、変形例を示す断面図である。
【図７Ｇ】図７Ｇは、図７Ｆに引き続き、変形例を示す断面図である。
【図８】図８は、第２の実施形態の変形例を示す図である。
【図９Ａ】図９Ａは、第３の実施形態に係る化合物半導体装置を製造する方法を示す断面図である。
【図９Ｂ】図９Ｂは、図９Ａに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図９Ｃ】図９Ｃは、図９Ｂに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図９Ｄ】図９Ｄは、図９Ｃに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図９Ｅ】図９Ｅは、図９Ｄに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図９Ｆ】図９Ｆは、図９Ｅに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図１０Ａ】図１０Ａは、第４の実施形態に係る化合物半導体装置を製造する方法を示す断面図である。
【図１０Ｂ】図１０Ｂは、図１０Ａに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図１０Ｃ】図１０Ｃは、図１０Ｂに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図１０Ｄ】図１０Ｄは、図１０Ｃに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図１０Ｅ】図１０Ｅは、図１０Ｄに引き続き、化合物半導体装置を製造する方法を示す断面図である。
【図１１】図１１は、第５の実施形態に係る電源装置の構成を示す図である。
【図１２】図１２は、第６の実施形態に係る高周波増幅器の構成を示す図である。
【発明を実施するための形態】
【００１３】
以下、実施形態について、添付の図面を参照して具体的に説明する。
【００１４】
（第１の実施形態）
先ず、第１の実施形態について説明する。図１Ａは、第１の実施形態に係る化合物半導体装置の構造を示す断面図であり、図１Ｂは、第１の実施形態における伝導帯のエネルギを示す図である。
【００１５】
第１の実施形態では、ドレイン電極１０１上に、化合物半導体層１０２、化合物半導体層１０３、及び化合物半導体層１０４がこの順で形成されている。化合物半導体層１０２〜１０４から積層体１０５が構成されており、積層体１０５に、開口部１０５ａが形成されている。そして、開口部１０５ａ内に、化合物半導体層１０２〜１０４の側面と接する化合物半導体層１０７が形成されている。開口部１０５ａ内には、ゲート電極１０８も形成されている。ゲート電極１０８は絶縁膜１１１により包囲されている。従って、ゲート電極１０８は、ドレイン電極１０１及び化合物半導体層１０７等から絶縁されている。更に、化合物半導体層１０４上に、ソース電極１０６が形成されている。ソース電極１０６は絶縁膜１１１によりゲート電極１０８から絶縁されている。
【００１６】
また、本実施形態では、化合物半導体層１０２内に、絶縁膜１１２を介して化合物半導体層１０２から絶縁された電極１０９が形成されている。電極１０９は、ドレイン電極１０１及び化合物半導体層１０３と接している。
【００１７】
なお、化合物半導体層１０３の格子定数は、化合物半導体層１０２の格子定数及び化合物半導体層１０４の格子定数よりも小さい。また、化合物半導体層１０７の格子定数は、化合物半導体層１０２の格子定数及び化合物半導体層１０４の格子定数よりも小さい。従って、化合物半導体層１０２と化合物半導体層１０７との間の格子定数の差に起因する歪が化合物半導体層１０７に生じる。同様に、化合物半導体層１０４と化合物半導体層１０７との間の格子定数の差に起因する歪みが化合物半導体層１０７に生じる。そして、これらの歪みによりピエゾ分極及び自発分極が生じ、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に２次元電子ガス（２ＤＥＧ）が発生する。２ＤＥＧは、高電子密度且つ高電子移動度の電子ガスである。従って、化合物半導体層１０３と化合物半導体層１０７との間の界面の電位に応じて、ソース電極１０６とドレイン電極１０１との間を流れる電流が変化する。ゲート電極１０８は、この界面の電位を制御する。
【００１８】
このように、第１の実施形態には、縦型構造のＨＥＭＴが含まれている。なお、電極１０９は、上記の２ＤＥＧから離間して形成されている。
【００１９】
なお、上記の格子定数の関係から、化合物半導体層１０３の化合物半導体層１０７との界面近傍には、２ＤＥＧは殆ど発生しない。従って、縦型構造のＨＥＭＴはノーマリオフ動作する。この界面近傍での２ＤＥＧの発生をより確実に抑制するためには、化合物半導体層１０３の格子定数が、化合物半導体層１０７の格子定数以下であることが好ましい。
【００２０】
また、第１の実施形態では、図１Ｂに示すように、化合物半導体層１０３の伝導帯のエネルギは、化合物半導体層１０４の伝導帯のエネルギよりも高い。そして、化合物半導体層１０３には、電極１０９を介してドレイン電極１０１が接続されており、化合物半導体層１０４には、ソース電極１０６が接続されている。
【００２１】
従って、ドレイン電極１０１に負の電圧が印加されると、化合物半導体層１０３及び１０４を介して、ドレイン電極１０１からソース電極１０６に電子が移動し、ソース電極１０６からドレイン電極１０１に向けて電流が流れる。即ち、還流ダイオードの機能が得られる。また、電極１０９がドレイン電極１０１及び化合物半導体層１０３と接し、ソース電極１０６が化合物半導体層１０４と接しているため、この還流ダイオードはＨＥＭＴに大電流が流れる前に動作する。従って、消費電力の上昇を抑制することができる。また、ドレイン電極１０１に正の大きな電圧が印加されると、化合物半導体層１０４及び１０３を介して、ソース電極１０６からドレイン電極１０１に電子が移動し、ドレイン電極１０１からソース電極１０６に向けて電流が流れる。即ち、保護ダイオードの機能が得られる。従って、ＨＥＭＴの故障を防止することができる。
【００２２】
次に、化合物半導体層１０２〜１０４及び１０７の材料の例について説明する。
【００２３】
「ＧａＮ及びＡｌＧａＮの組み合わせ」
ＧａＮとＡｌＧａＮとの間では、ＡｌＧａＮの格子定数がＧａＮの格子定数よりも小さく、ＡｌＧａＮの伝導帯のエネルギがＧａＮの伝導帯のエネルギよりも高い。従って、化合物半導体層１０２及び１０４としてＧａＮ層が用いられ、化合物半導体層１０３及び１０７としてＡｌＧａＮ層が用いられる。なお、化合物半導体層１０４の表層部に、ソース電極１０６との間の接触抵抗を低減するために、ｎ型不純物を高濃度で含むｎ＋ＧａＮ層が含まれていてもよい。
【００２４】
このような組み合わせでは、ＧａＮとＡｌＧａＮとの間の格子定数の相違に起因して、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に、高電子密度且つ高電子移動度の２ＤＥＧが発生する。また、化合物半導体層１０３と化合物半導体層１０７との間で、Ａｌ及びＧａの総量に対するＡｌの割合（Ａｌの組成比率）が同一であれば、これらの格子定数も同一となり、これらの界面近傍には２ＤＥＧが発生しない。
【００２５】
更に、ＧａＮとＡｌＧａＮとの間の伝導帯のエネルギの相違に起因して、化合物半導体層１０３及び１０４が還流ダイオード及び保護ダイオードとして機能することができる。
【００２６】
「ＩｎＡｌＮ及びＡｌＮの組み合わせ」
ＩｎＡｌＮとＡｌＮとの間では、ＡｌＮの格子定数がＩｎＡｌＮの格子定数よりも小さく、ＡｌＮの伝導帯のエネルギがＩｎＡｌＮの伝導帯のエネルギよりも高い。従って、化合物半導体層１０２及び１０４としてＩｎＡｌＮ層が用いられ、化合物半導体層１０３及び１０７としてＡｌＮ層が用いられる。なお、化合物半導体層１０４の表層部に、ソース電極１０６との間の接触抵抗を低減するために、ｎ型不純物を高濃度で含むｎ＋ＩｎＡｌＮ層が含まれていてもよい。
【００２７】
このような組み合わせでは、ＩｎＡｌＮとＡｌＮとの間の格子定数の相違に起因して、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に、高電子密度且つ高電子移動度の２ＤＥＧが発生する。また、化合物半導体層１０３と化合物半導体層１０７との間では、これらの格子定数が同一となり、これらの界面近傍には２ＤＥＧが発生しない。
【００２８】
更に、ＩｎＡｌＮとＡｌＮとの間の伝導帯のエネルギの相違に起因して、化合物半導体層１０３及び１０４が還流ダイオード及び保護ダイオードとして機能することができる。
【００２９】
「ＩｎＡｌＧａＮ及びＡｌＮの組み合わせ」
ＩｎＡｌＧａＮとＡｌＮとの間は、ＡｌＮの格子定数がＩｎＡｌＧａＮの格子定数よりも小さく、ＡｌＮの伝導帯のエネルギがＩｎＡｌＧａＮの伝導帯のエネルギよりも高い。従って、化合物半導体層１０２及び１０４としてＩｎＡｌＧａＮ層が用いられ、化合物半導体層１０３及び１０７としてＡｌＮ層が用いられる。なお、化合物半導体層１０４の表層部に、ソース電極１０６との間の接触抵抗を低減するために、ｎ型不純物を高濃度で含むｎ＋ＩｎＡｌＧａＮ層が含まれていてもよい。
【００３０】
このような組み合わせでは、ＩｎＡｌＧａＮとＡｌＮとの間の格子定数の相違に起因して、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に、高電子密度且つ高電子移動度の２ＤＥＧが発生する。また、化合物半導体層１０３と化合物半導体層１０７との間では、これらの格子定数が同一となり、これらの界面近傍には２ＤＥＧが発生しない。
【００３１】
更に、ＩｎＡｌＧａＮとＡｌＮとの間の伝導帯のエネルギの相違に起因して、化合物半導体層１０３及び１０４が還流ダイオード及び保護ダイオードとして機能することができる。
【００３２】
「ＩｎＡｌＮ及びＩｎＡｌＧａＮの組み合わせ」
ＩｎＡｌＮとＩｎＡｌＧａＮとの間では、これらに含まれるＩｎ、Ａｌ、及びＧａの総量に対する各元素の割合（各元素の組成比率が）に応じて、格子定数及び伝導帯のエネルギの大小関係が変わる。つまり、組成比率の調節により、ＩｎＡｌＮの格子定数をＩｎＡｌＧａＮのそれよりも小さくし、ＩｎＡｌＮの伝導帯のエネルギをＩｎＡｌＧａＮのそれよりも高くすることができる。逆に、組成比率の調節により、ＩｎＡｌＧａＮの格子定数をＩｎＡｌＮの格子定数よりも小さくし、ＩｎＡｌＧａＮの伝導帯のエネルギをＩｎＡｌＮのそれよりも高くすることもできる。組成比率の調節により、ＩｎＡｌＧａＮの格子定数をＩｎＡｌＮのそれよりも小さくし、ＩｎＡｌＧａＮの伝導帯のエネルギをＩｎＡｌＮのそれよりも高くする場合、化合物半導体層１０２及び１０４としてＩｎＡｌＮ層が用いられ、化合物半導体層１０３及び１０７としてＩｎＡｌＧａＮ層が用いられる。なお、化合物半導体層１０４の表層部に、ソース電極１０６との間の接触抵抗を低減するために、ｎ型不純物を高濃度で含むｎ＋ＩｎＡｌＮ層が含まれていてもよい。
【００３３】
このような組み合わせでは、ＩｎＡｌＮとＩｎＡｌＧａＮとの間の格子定数の相違に起因して、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に、高電子密度且つ高電子移動度の２ＤＥＧが発生する。また、化合物半導体層１０３と化合物半導体層１０７との間で、Ｉｎ、Ａｌ、及びＧａの各組成比率が同一であれば、これらの格子定数も同一となり、これらの界面近傍には２ＤＥＧが発生しない。
【００３４】
更に、ＩｎＡｌＮとＩｎＡｌＧａＮとの間の伝導帯のエネルギの相違に起因して、化合物半導体層１０３及び１０４が還流ダイオード及び保護ダイオードとして機能することができる。
【００３５】
「Ａｌ組成比率が相違する２種類のＡｌＧａＮの組み合わせ」
元素の種類が同一であっても、その組成比率が相違していれば、格子定数及び伝導帯のエネルギも相違し得る。例えば、ＡｌＧａＮでは、Ａｌの組成比率が高いほど、格子定数が小さくなり、伝導帯のエネルギが高くなる。このため、格子定数及び伝導帯のエネルギが相違する化合物半導体の組み合わせとして、Ａｌ０．３Ｇａ０．７Ｎ及びＡｌ０．５Ｇａ０．５Ｎの組み合わせを採用することができる。この場合、化合物半導体層１０２及び１０４として、Ａｌの組成比率が低いＡｌ０．３Ｇａ０．７Ｎ層が用いられ、化合物半導体層１０３及び１０７として、Ａｌの組成比率が高いＡｌ０．５Ｇａ０．５Ｎ層が用いられる。なお、化合物半導体層１０４の表層部に、ソース電極１０６との間の接触抵抗を低減するために、ｎ型不純物を高濃度で含むｎ＋Ａｌ０．３Ｇａ０．７Ｎ層が含まれていてもよい。
【００３６】
このような組み合わせでは、Ａｌ０．３Ｇａ０．７ＮとＡｌ０．５Ｇａ０．５Ｎとの間の格子定数の相違に起因して、化合物半導体層１０２及び１０４の化合物半導体層１０７との界面近傍に、高電子密度且つ高電子移動度の２ＤＥＧが発生する。また、化合物半導体層１０３と化合物半導体層１０７との間では、これらの格子定数が同一となり、これらの界面近傍には２ＤＥＧが発生しない。
【００３７】
更に、Ａｌ０．３Ｇａ０．７ＮとＡｌ０．５Ｇａ０．５Ｎとの間の伝導帯のエネルギの相違に起因して、化合物半導体層１０３及び１０４が還流ダイオード及び保護ダイオードとして機能することができる。
【００３８】
なお、上記の２種類のＡｌＧａＮに代えて、Ｉｎ及びＡｌの組成比率が相違する２種類のＩｎＡｌＮを用いてもよく、Ｉｎ、Ａｌ、及びＧａの組成比率が相違する２種類のＩｎＡｌＧａＮを用いてもよい。
【００３９】
「複数種類の化合物半導体を含む化合物半導体層１０３」
図１Ｃに示すように、化合物半導体層１０３が、例えば３つの化合物半導体層１０３ａ、１０３ｂ、及び１０３ｃを含んでいてもよい。この例では、化合物半導体層１０３ａ及び１０３ｃはＡｌＧａＮ層であり、化合物半導体層１０３ｂはＡｌＮ層である。また、化合物半導体層１０２及び１０４の材料としては、ＡｌＧａＮ及びＡｌＮよりも格子定数が大きく、伝導帯のエネルギが低い材料、例えばＧａＮが用いられる。また、化合物半導体層１０７としては、ＡｌＧａＮ層が用いられる。化合物半導体層１０３ｂを構成するＡｌＮと化合物半導体層１０２及び１０４を構成するＡｌＧａＮとの間の格子定数の相違が大きいため、化合物半導体層１０３ａ及び１０３ｃは緩衝層としても機能する。なお、例えば、化合物半導体層１０３ａ、１０３ｂ、及び１０３ｃの厚さは、夫々、１００ｎｍ程度、１０ｎｍ程度、１００ｎｍ程度である。
【００４０】
この例でも、「ＧａＮ及びＡｌＧａＮの組み合わせ」の場合と同様の作用が得られる。また、ＡｌＮの化合物半導体層１０３ｂを含む化合物半導体層１０３とＡｌＧａＮの化合物半導体層１０７との間では、化合物半導体層１０３の格子定数が実質的に化合物半導体層１０７のそれよりも小さくなる。従って、「ＧａＮ及びＡｌＧａＮの組み合わせ」の場合よりも確実に２ＤＥＧの発生を抑制することができる。更に、化合物半導体層１０３にＡｌＮの化合物半導体層１０３ｂが含まれているため、リーク電流が著しく低減される。
【００４１】
（第２の実施形態）
次に、第２の実施形態について説明する。図２Ａは、第２の実施形態に係る化合物半導体装置の電極同士の位置関係を示す図であり、図２Ｂは、図２Ａ中のＩ−Ｉ線に沿った断面を示す図であり、図２Ｃは、図２Ａ中のＩＩ−ＩＩ線に沿った断面を示す図である。
【００４２】
第２の実施形態では、導電性の基板２２１上に、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂがこの順で形成されている。
【００４３】
基板２２１としては、例えば導電性ＧａＮ単結晶基板、導電性サファイア基板、導電性ＳｉＣ基板、導電性Ｓｉ基板等を用いることができる。なお、基板２２１の厚さ方向の抵抗成分を抑制するために、基板２２１の抵抗は低いことが好ましい。導電性ＧａＮ単結晶基板としては、ｎ型不純物としてＳｉが導入されたＧａＮ単結晶基板が挙げられる。
【００４４】
また、ＧａＮ層２０２には、Ｓｉが１×１０１３ｃｍ−３〜１×１０２０ｃｍ−３程度ドーピングされており、その厚さは１００ｎｍ〜１０μｍ程度である。ＡｌＧａＮ層２０３にもｎ型不純物がドーピングされており、その厚さは１ｎｍ〜１０μｍ程度である。また、ＡｌＧａＮ層２０３におけるＡｌの組成比率は０．３である。なお、ＡｌＧａＮ層２０３の厚さが１ｎｍ未満であると、ノーマリオフ動作が困難になることがある。一方、ＡｌＧａＮ層２０３の厚さが１０μｍを超えていると、オン時に十分に高い電子濃度を得ることが困難になることがある。このため、ＡｌＧａＮ層２０３の厚さは、１ｎｍ〜１０μｍ程度であることが好ましい。
【００４５】
ＧａＮ層２０４ａには、Ｓｉが１×１０１３ｃｍ−３〜１×１０２０ｃｍ−３程度ドーピングされており、その厚さは１ｎｍ〜１０μｍ程度である。また、ｎ＋ＧａＮ層２０４ｂには、Ｓｉが１×１０１６ｃｍ−３〜１×１０２２ｃｍ−３程度ドーピングされており、その厚さは１ｎｍ〜１０μｍ程度である。ｎ＋ＧａＮ層２０４ｂにおけるｎ型不純物の濃度は、ＧａＮ層２０４ａにおけるそれよりも高い。このため、ｎ＋ＧａＮ層２０４ｂの抵抗は、ＧａＮ層２０４ａの抵抗よりも低い。なお、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂの総厚さが５ｎｍ未満であると、十分な耐圧を得られないことがある。一方、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂの総厚さが１０μｍを超えていると、オン抵抗の増加に伴ってオン時の電流密度が低下する。このため、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂの総厚さは、５ｎｍ〜１０μｍ程度であることが好ましい。
【００４６】
ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂから積層体２０５が構成されており、積層体２０５に、開口部２０５ａが形成されている。そして、開口部２０５ａ内に、下面及び側面が絶縁膜２１１ａで覆われたゲート電極２０８が形成されている。ゲート電極２０８としては、Ｎｉ膜と、その上に位置するＡｕ膜との積層体が形成されている。ゲート電極２０８は、図２Ａに示すように、櫛歯状（フィンガー状）に複数形成されており、各ゲート電極２０８の一端がゲートバスライン２０８ａに接続されている。絶縁膜２１１ａはＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂの側面と接していない。平面視でゲート電極２０８が延びる方向（ゲート幅方向）に直交する方向の一方側では、絶縁膜２１１ａと、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂとの間にＡｌＧａＮ層２０７が形成されている。そして、ＡｌＧａＮ層２０７がＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂの側面に接している。このように、ゲート電極２０８は、基板２２１及びＡｌＧａＮ層２０７等から絶縁されている。また、他方側では、絶縁膜２１１ａと、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂとの間にシリコン酸化膜２５２が形成されている。なお、ＡｌＧａＮ層２０７にもｎ型不純物がドーピングされており、その厚さは１ｎｍ〜１μｍ程度である。また、ＡｌＧａＮ層２０７におけるＡｌの組成比率は０．３である。ＡｌＧａＮ層２０７の厚さが１ｎｍ未満であると、十分な濃度の２ＤＥＧを発生させることが困難になることがある。一方、ＡｌＧａＮ層２０７の厚さが１μｍを超えていると、ＡｌＧａＮ層２０３及び２０７の界面にゲート電極２０８から電界を印加することが困難になることがある。このため、ＡｌＧａＮ層２０７の厚さは、１ｎｍ〜１μｍ程度であることが好ましい。
【００４７】
更に、ゲート電極２０８及び絶縁膜２１１ａを覆う絶縁膜２１１ｂが形成されている。そして、ｎ＋ＧａＮ層２０４ｂ及び絶縁膜２１１ｂ等の上に、ソース電極２０６が形成されている。ソース電極２０６は絶縁膜２１１ｂによりゲート電極２０８から絶縁されている。また、ソース電極２０６としては、Ｔａ膜と、その上に位置するＡｌ膜との積層体が形成されている。
【００４８】
また、本実施形態では、シリコン酸化膜２５２の近傍において、基板２２１及びＧａＮ層２０２に開口部２２２が形成されており、開口部２２２内に、絶縁膜２１２を介してＧａＮ層２０２から絶縁された電極２０９が形成されている。更に、基板２２１の裏面に基板２２１及び電極２０９と接するドレイン電極２０１が形成されている。なお、ドレイン電極２０１及び電極２０９が一体的に形成されていてもよい。この場合、これらは、例えば、Ｔａ膜と、その上に位置するＡｌ膜との積層体を含んでいる。また、導電性の基板２２１及びドレイン電極２０１を一つの電極とみなすこともできる。
【００４９】
なお、絶縁膜２１１ａのゲート電極２０８とＡｌＧａＮ層２０７との間の部分２２５はＨＥＭＴのゲート絶縁膜として機能する。このため、部分２２５の厚さは、１ｎｍ〜１００ｎｍ程度であることが好ましい。また、絶縁膜２１１ａのゲート電極２０８と基板２２１との間の部分２２４の厚さは、部分２２５の厚さ以上であることが好ましい。これは、部分２２４の厚さが部分２２５の厚さ未満であると、ゲート電極２０８と基板２２１及びドレイン電極２０１との距離が短く、十分な耐圧を得にくくなるためである。その一方で、部分２２４の厚さは、ＧａＮ層２０２の厚さ以下であることが好ましい。これは、部分２２４の厚さがＧａＮ層２０２の厚さを超えていると、ゲート電極２０８の底面がＡｌＧａＮ層２０３の底面よりも上方に位置し、ＡｌＧａＮ層２０３とＡｌＧａＮ層２０７との界面の電位をゲート電極２０８が制御しにくくなるためである。
【００５０】
このように構成された第２の実施形態では、ＧａＮ層２０２とＡｌＧａＮ層２０７との間の格子定数の差に起因する歪がＡｌＧａＮ層２０７に生じる。同様に、ＧａＮ層２０４ａ及びｎ＋ＧａＮ層２０４ｂとＡｌＧａＮ層２０７との間の格子定数の差に起因する歪みがＡｌＧａＮ層２０７に生じる。そして、これらの歪みによりピエゾ分極及び自発分極が生じ、ＧａＮ層２０２、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂのＡｌＧａＮ層２０７との界面近傍に２次元電子ガス（２ＤＥＧ）が発生する。従って、ＡｌＧａＮ層２０３とＡｌＧａＮ層２０７との間の界面の電位に応じて、ソース電極２０６とドレイン電極２０１との間を流れる電流が変化する。また、ゲート電極２０８により、この界面の電位を制御することができる。
【００５１】
また、第２の実施形態では、ドレイン電極２０１に負の電圧が印加されると、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂを介して、ドレイン電極２０１からソース電極２０６に電子が移動し、ソース電極２０６からドレイン電極２０１に向けて電流が流れる。即ち、還流ダイオードの機能が得られる。また、電極２０９がドレイン電極２０１及びＡｌＧａＮ層２０３と接し、ソース電極２０６がｎ＋ＧａＮ層２０４ｂと接しているため、この還流ダイオードはＨＥＭＴに大電流が流れる前に動作する。従って、消費電力の上昇を抑制することができる。また、ドレイン電極２０１に正の大きな電圧が印加されると、ｎ＋ＧａＮ層２０４ｂ、ＧａＮ層２０４ａ、及びＡｌＧａＮ層２０３を介して、ソース電極２０６からドレイン電極２０１に電子が移動し、ドレイン電極２０１からソース電極２０６に向けて電流が流れる。即ち、保護ダイオードの機能が得られる。従って、ＨＥＭＴの故障を防止することができる。
【００５２】
ここで、本願発明者が行った第２の実施形態に関するシミュレーションについて説明する。
【００５３】
（第１のシミュレーション）
第１のシミュレーションでは、電子密度（ｃｍ−３）の基板２２１の表面からの距離との関係、及び伝導帯のエネルギ（ｅＶ）の基板２２１の表面からの距離との関係について調べた。このシミュレーションでは、ＧａＮ層２０２の厚さを１０００ｎｍとし、ＡｌＧａＮ層２０３の厚さを２００ｎｍとし、ＧａＮ層２０４ａの厚さを３００ｎｍとし、ｎ＋ＧａＮ層２０４ｂの厚さを２００ｎｍとした。この結果を図３Ａ及び図３Ｂに示す。なお、図３Ａ中では、ゲート電圧Ｖｇｓが０Ｖであって電源がオフになっているときの関係を一点鎖線で示し、ゲート電圧Ｖｇｓが１０Ｖであって電源がオンになっているときの関係を実線で示している。ゲート電圧Ｖｇｓは、ソース−ドレイン間電圧Ｖｄｓに等しい。
【００５４】
図３Ａに示すように、電源がオフになっている場合には、ＡｌＧａＮ層２０３におけるＡｌＧａＮ／ＧａＮヘテロ接合面で、電子密度が不連続に減少する。このため、ソース電極２０６とドレイン電極２０１との間に電流が流れない。一方、電源がオンになっている場合には、ゲート電極２０８により印加された電界に電子が引き寄せられるため、ＡｌＧａＮ層２０３の電子密度がオフ時と比較して著しく高くなる。このため、ソース電極２０６とドレイン電極２０１との間に確実に電流が流れる。従って、ゲート電極２０８に印加する電圧の切り替えにより、ＨＥＭＴのオン及びオフが確実に切り替えられることが判る。
【００５５】
また、図３Ｂに示すように、電源がオフになっている場合には、電源がオンになっている場合と比較して、ＡｌＧａＮ層２０３の伝導帯のエネルギが高い。これは、電源がオフになっている場合には、電源がオンになっている場合と比較して、ＡｌＧａＮ層２０３に存在する電子が著しく少ないことを意味する。従って、ＨＥＭＴがノーマリオフ動作することが判る。
【００５６】
（第２のシミュレーション）
第２のシミュレーションでは、ダイオード特性について調べた。この結果を図３Ｃに示す。
【００５７】
図３Ｃに示すように、適切なダイオード特性が確認された。従って、還流ダイオード及び保護ダイオードの機能が得られることが判る。
【００５８】
（第３のシミュレーション）
第３のシミュレーションでは、ドレイン電流Ｉｄ（Ａ／ｍ）のゲート電圧Ｖｇｓ（Ｖ）との関係について調べた。このシミュレーションでは、ソース−ドレイン間電圧Ｖｄｓを１０Ｖとした。この結果を図３Ｄに示す。
【００５９】
図３Ｄに示すように、ゲート電圧Ｖｇｓが０Ｖのときのドレイン電流Ｉｄは０Ａ／ｍとなった。このことは、良好なノーマリオフ動作が実現されることを意味している。また、ゲート電圧Ｖｇｓの上昇に伴ってドレイン電流Ｉｄが適切に上昇することが確認された。従って、ＨＥＭＴがノーマリオフ動作し、また、ＨＥＭＴの特性が良好であることが判る。
【００６０】
（第４のシミュレーション）
第４のシミュレーションでは、ドレイン電流Ｉｄ（Ａ／ｍ）のソース−ドレイン間電圧Ｖｄｓ（Ｖ）との関係について調べた。このシミュレーションでは、ゲート電圧Ｖｇｓを０Ｖ、２Ｖ、４Ｖ、６Ｖ、８Ｖ、又は１０Ｖとした。この結果を図３Ｅに示す。
【００６１】
図３Ｅに示すように、ソース−ドレイン間電圧Ｖｄｓに拘わらず、ゲート電圧Ｖｇｓが０Ｖのときのドレイン電流Ｉｄは０Ａ／ｍとなった。このことは、良好なノーマリオフ動作が実現されることを意味している。また、ソース−ドレイン間電圧Ｖｄｓの上昇に伴ってドレイン電流Ｉｄが適切に上昇することが確認された。従って、ＨＥＭＴがノーマリオフ動作し、また、ＨＥＭＴの特性が良好であることが判る。
【００６２】
次に、第２の実施形態に係る化合物半導体装置を製造する方法について説明する。図４Ａ〜図４Ｄは、第２の実施形態に係る化合物半導体装置を製造する方法を工程順に示す図であって、図２Ａと同様に、主として電極同士の位置関係を示している。また、図５Ａ〜図５Ｌは、第２の実施形態に係る化合物半導体装置を製造する方法を工程順に示す断面図である。
【００６３】
先ず、図４Ａ及び図５Ａに示すように、基板２２１上に選択成長用のマスク２５１を形成する。マスク２５１の形成に際しては、例えばシリコン酸化膜を化学気相成長（ＣＶＤ：chemical vapor deposition）法等により基板２２１の全面に形成し、その後に、積層体２０５を形成する予定の領域からリソグラフィー及びドライエッチングによりシリコン酸化膜を除去する。マスク２５１の平面形状は、図４Ａに示すように、概ね、ゲート電極２０８の平面形状と同様の櫛歯状（フィンガー状）になる。
【００６４】
次いで、図４Ｂ及び図５Ｂに示すように、基板２２１上に、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂをこの順で、例えば有機化学気相堆積（ＭＯＣＶＤ：metal organic chemical vapor deposition）法により形成する。ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂを分子線エピタキシー（ＭＢＥ：molecular beam epitaxy）法により形成してもよい。
【００６５】
ここで、ＭＯＣＶＤ装置について説明する。図６は、ＭＯＣＶＤ装置の構成を示す図である。石英製反応管４０の周囲に高周波コイル４１が配置され、反応管４０の内側に基板１を載置するためのカーボンサセプタ４２が配置されている。反応管４０の上流端（図６中の左側の端部）に、２本のガス導入管４４及び４５が接続され、化合物のソースガスが供給される。例えば、ガス導入管４４からＮソースガスとしてＮＨ３ガスが導入され、ガス導入管４５からＩＩＩ族元素のソースガスとしてトリメチルアルミニウム（ＴＭＡ）、トリメチルガリウム（ＴＭＧ）等の有機ＩＩＩ族化合物原料が導入される。基板１上で結晶成長が行われ、余剰のガスはガス排出管４６から除害塔へ排出される。なお、ＭＯＣＶＤ法による結晶成長を減圧雰囲気で行う場合は、ガス排出管４６は真空ポンプへ接続され、真空ポンプの排出口が除害塔に接続される。
【００６６】
ＭＯＣＶＤ法では、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ+ＧａＮ層２０４ｂは、基板２２１のマスク２５１から露出している部分に選択的に成長する。これらの形成の際には、形成しようとする化合物半導体層に応じて、Ａｌ源であるＴＭＡガス及びＧａ源であるＴＭＧガスの供給の有無及び流量を適宜設定する。また、Ｎ源であるアンモニアガスの流量は、１０ｓｌｍ〜５０ｓｌｍ程度とする。また、成長圧力は５０Ｔｏｒｒ〜３００Ｔｏｒｒ程度とし、成長温度は８００℃〜１３００℃程度とする。更に、ｎ型不純物を含有させる場合には、例えばＳｉを含むガス、例えばＳｉＨ4ガスを所定の流量で原料ガスに添加し、上記の各濃度範囲内の所定値となるようにＳｉをドーピングする。
【００６７】
例えば、ＡｌＧａＮ層２０３を形成する場合の条件は、例えば、以下のように設定する。
トリメチルガリウム（ＴＭＧ）の流量：０〜５０ｓｃｃｍ
トリメチルアルミニウム（ＴＭＡ）の流量：０〜５０ｓｃｃｍ
アンモニア（ＮＨ３）の流量：２０ｓｌｍ
圧力：１００Ｔｏｒｒ
温度：１１００℃
【００６８】
ｎ＋ＧａＮ層２０４ｂの形成後、図５Ｃに示すように、マスク２５１をウェットエッチング等により除去する。マスク２５１の除去により、開口部２０５ａを備えた積層体２０５が得られる。なお、基板２２１が、その表面が非極性面となっているｎ型ＧａＮ単結晶基板である場合、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂの各表面は、ａ軸方向を向く。つまり、各化合物半導体層において、表面がａ軸方向を向く。また、ＧａＮ層２０２、ＡｌＧａＮ層２０３、ＧａＮ層２０４ａ、及びｎ＋ＧａＮ層２０４ｂの開口部２０５ａに面する側面の面方位は、（０００１）となる。つまり、各化合物半導体層において、側面のミラー指数が（０００１）となる。
【００６９】
なお、このような選択成長法を用いる代わりに、各化合物半導体層を基板２２１の全面に形成した後に、リソグラフィー及びドライエッチングにより各化合物半導体層を加工して積層体２０５を形成してもよい。
【００７０】
マスク２５１の除去後、同じく図５Ｃに示すように、積層体２０５の一部を覆う選択成長用のマスクとしてシリコン酸化膜２５２を形成する。シリコン酸化膜２５２は、積層体２０５のＡｌＧａＮ層２０７を成長させる領域を露出し、他の部分を覆うように形成する。シリコン酸化膜２５２の形成に際しては、例えばシリコン酸化膜をＣＶＤ法等により基板２２１の全面に形成し、その後に、ＡｌＧａＮ層２０７を形成する予定の領域内の部分をリソグラフィー及びドライエッチングにより除去すればよい。
【００７１】
次いで、図５Ｄに示すように、積層体２０５のシリコン酸化膜２５２から露出している部分上に、ＡｌＧａＮ層２０７を、例えばＭＯＣＶＤ法により形成する。この際にも、例えば図６に示すＭＯＣＶＤ装置を用いる。ＭＯＣＶＤ法では、ＡｌＧａＮ層２０７は、積層体２０５のシリコン酸化膜２５２から露出している部分に選択的に横方向成長する。この結果、積層体２０５の側面の一部が最下部から最上部にわたってＡｌＧａＮ層２０７により覆われる。ＡｌＧａＮ層２０７の成長条件としては、例えばＡｌＧａＮ層２０３の成長条件と同様のものを採用する。
【００７２】
ＡｌＧａＮ層２０７の形成後、図５Ｅに示すように、絶縁膜２１１ａを全面に形成し、その表面を例えば化学機械的研磨（ＣＭＰ：chemical mechanical polishing）法により平坦化する。絶縁膜２１１ａとしては、例えばプラズマｃｖｄ法、原子層成長 (ＡＬＤ：atomic layer deposition)法等により、厚さが５０ｎｍ程度のシリコン窒化膜を形成する。また、シリコン窒化膜に代えて、ハフニウム酸化膜、タンタル酸化膜、又はアルミニウム酸化膜を形成してもよい。更に、これら４種のうちの２種以上を積層して用いてもよい。
【００７３】
次いで、図５Ｆに示すように、ゲート電極２０８を形成する部分に開口部２５３ａが形成されたレジストパターン２５３を絶縁膜２１１ａ上に形成する。その後、レジストパターン２５３をマスクとして絶縁膜２１１ａを加工することにより、絶縁膜２１１ａに電極溝２２６を形成する。電極溝２２６の形成では、例えばＳＦ６ガスを用いたドライエッチングを行う。
【００７４】
続いて、図４Ｃ及び図５Ｇに示すように、ゲート電極２０８を電極溝２２６内に形成する。ゲート電極２０８は、例えばリフトオフ法により形成することができる。レジストパターン２５３はゲート電極２０８の形成時にも用い、ゲート電極２０８の形成後に除去する。
【００７５】
次いで、図５Ｈに示すように、ゲート電極２０８を覆う絶縁膜２１１ｂを絶縁膜２１１ａ上に形成する。絶縁膜２１１ｂとしては、例えばプラズマＣＶＤ法等により、厚さが１０００ｎｍ程度のシリコン窒化膜を形成する。
【００７６】
その後、図５Ｉに示すように、絶縁膜２１１ｂ、絶縁膜２１１ａ、及びシリコン酸化膜２５２を加工することにより、少なくともｎ＋ＧａＮ層２０４ｂ及びＡｌＧａＮ層２０７を露出させる。
【００７７】
続いて、図４Ｄ及び図５Ｊに示すように、ｎ＋ＧａＮ層２０４ｂ及びＡｌＧａＮ層２０７と接するソース電極２０６を形成する。ソース電極２０６は、例えばリフトオフ法により、ゲートバスライン２０８ａと接しないように形成する。次いで、基板２２１の表面側を表面保護層で覆い、基板２２１の裏面を研磨して基板２２１の厚さを調節する。
【００７８】
次いで、図５Ｋに示すように、基板２２１及びＧａＮ層２０２に、ＡｌＧａＮ層２０３まで達する開口部２２２を形成する。
【００７９】
その後、図５Ｌに示すように、開口部２２２の側面に絶縁膜２１２を形成する。絶縁膜２１２としては、例えばシリコン窒化膜を形成する。そして、開口部２２２内に電極２０９を形成し、更に、基板２２１の裏面にドレイン電極２０１を形成する。電極２０９及びドレイン電極２０１は一体的に形成することができ、この場合、例えば蒸着法によりＴａ膜及びＡｌ膜を順次形成すればよい。
【００８０】
このようにして第２の実施形態に係る化合物半導体装置を完成させることができる。
【００８１】
なお、図７Ａに示すように、ＡｌＧａＮ層２０７の形成後にシリコン酸化膜２５２を除去してもよい。この場合、シリコン酸化膜２５２の除去後に、図７Ｂに示すように、絶縁膜２１１ａを形成する。次いで、図７Ｃに示すように、レジストパターン２５３をマスクとして絶縁膜２１１ａを加工することにより、絶縁膜２１１ａに電極溝２２６を形成する。その後、図７Ｄに示すように、ゲート電極２０８を形成する。続いて、図７Ｅに示すように、絶縁膜２１１ｂを形成する。そして、図７Ｆに示すように、絶縁膜２１１ｂ及び絶縁膜２１１ａを加工することにより、少なくともｎ＋ＧａＮ層２０４ｂ及びＡｌＧａＮ層２０７を露出させる。その後は、図７Ｇに示すように、上述の方法と同様の処理を行う。このような方法で形成された化合物半導体装置では、シリコン酸化膜２５２が存在しない分だけ微細化が可能である。
【００８２】
なお、第２の実施形態において、図８に示すように、一部のゲート電極２０８のゲートバスライン２０８ａと接続された端部とは逆側の端部に接続されたゲートバスライン２０８ｂが設けられていてもよい。この場合、ゲートバスライン２０８ａ及び２０８ｂに接続されたゲート電極２０８では、一端がゲートバスライン２０８ｂに接続されていないゲート電極２０８と比較すると、信号が高速で伝達される。このため、前者のゲート電極２０８を迅速な信号伝達を要する電極とし、後者のゲート電極２０８をさほど迅速な信号伝達を要しない電極とし、目的に応じて使い分けることができる。
【００８３】
（第３の実施形態）
次に、第３の実施形態について説明する。第３の実施形態では、ソース電極２０６をゲート電極２０８より先に形成する。図９Ａ〜図９Ｆは、第３の実施形態に係る化合物半導体装置を製造する方法を工程順に示す断面図である。
【００８４】
先ず、第２の実施形態と同様にして、ＡｌＧａＮ層２０７の形成までの処理を行い（図５Ａ〜図５Ｄ）、更に、シリコン酸化膜２５２を除去する（図７Ａ）。次いで、図９Ａに示すように、ｎ+ＧａＮ層２０４ｂ及びＡｌＧａＮ層２０７上にソース電極２０６を形成する。ソース電極２０６は、例えばリフトオフ法により形成することができる。
【００８５】
その後、図９Ｂに示すように、ソース電極２０６上に絶縁膜２１１ａを形成し、その表面の平坦化を行う。更に、レジストパターン２５３をマスクとして絶縁膜２１１ａを加工することにより、絶縁膜２１１ａに電極溝２２６を形成する。絶縁膜２１１ａの形成及び加工等は第２の実施形態と同様にして行うことができる。
【００８６】
続いて、図９Ｃに示すように、ゲート電極２０８を電極溝２２６内に形成する。ゲート電極２０８は、例えばリフトオフ法により形成することができる。レジストパターン２５３はゲート電極２０８の形成時にも用い、ゲート電極２０８の形成後に除去する。
【００８７】
次いで、図９Ｄに示すように、ゲート電極２０８を覆う絶縁膜２１１ｂを絶縁膜２１１ａ上に形成する。絶縁膜２１１ｂの形成は第２の実施形態と同様にして行うことができる。
【００８８】
その後、基板２２１の表面側を表面保護層で覆い、図９Ｅに示すように、基板２２１の裏面を研磨して基板２２１の厚さを調節する。続いて、基板２２１及びＧａＮ層２０２に、ＡｌＧａＮ層２０３まで達する開口部２２２を形成する。
【００８９】
次いで、図９Ｆに示すように、開口部２２２の側面に絶縁膜２１２を形成する。そして、開口部２２２内に電極２０９を形成し、更に、基板２２１の裏面にドレイン電極２０１を形成する。絶縁膜２１２の形成、電極２０９の形成、及びドレイン電極２０１の形成は第２の実施形態と同様にして行うことができる。
【００９０】
このようにして第３の実施形態に係る化合物半導体装置を完成させることができる。
【００９１】
（第４の実施形態）
次に、第４の実施形態について説明する。第４の実施形態では、ゲート電極２０８と基板２２１との間に２層構造の絶縁膜を形成する。図１０Ａ〜図１０Ｅは、第４の実施形態に係る化合物半導体装置を製造する方法を工程順に示す断面図である。
【００９２】
先ず、第２の実施形態と同様にして、ＡｌＧａＮ層２０７の形成までの処理を行い（図５Ａ〜図５Ｄ）、更に、シリコン酸化膜２５２を除去する（図７Ａ）。次いで、図１０Ａに示すように、絶縁膜３０１を全面に形成する。絶縁膜３０１としては、例えばプラズマＣＶＤ法、ＡＬＤ法等によりシリコン窒化膜を形成する。プラズマＣＶＤ法又はＡＬＤ法によれば特に等方的に絶縁膜３０１を形成することができる。絶縁膜３０１の厚さは、ゲート絶縁膜に適した厚さとし、例えば１ｎｍ〜１００ｎｍ程度とする。また、シリコン窒化膜に代えて、ハフニウム酸化膜、タンタル酸化膜、又はアルミニウム酸化膜を形成してもよい。更に、これら４種のうちの２種以上を積層して用いてもよい。
【００９３】
その後、図１０Ｂに示すように、ゲート電極２０８を形成する部分に開口部２５３ａが形成されたレジストパターン２５３を絶縁膜３０１上に形成する。
【００９４】
続いて、図１０Ｃに示すように、絶縁膜３０１上及びレジストパターン２５３上に絶縁膜３０２を形成する。絶縁膜３０２としては、例えばスパッタリング法等によりシリコン窒化膜を形成する。スパッタリング法によれば特に異方的に絶縁膜３０２を形成することができる。また、シリコン窒化膜に代えて、ハフニウム酸化膜、タンタル酸化膜、又はアルミニウム酸化膜を形成してもよい。更に、これら４種のうちの２種以上を積層して用いてもよい。
【００９５】
続いて、図１０Ｄに示すように、ゲート電極２０８を開口部２０５ａ内の絶縁膜３０２上に形成する。ゲート電極２０８は、例えばリフトオフ法により形成することができる。レジストパターン２５３はゲート電極２０８の形成時にも用い、ゲート電極２０８の形成後に除去する。
【００９６】
その後、図１０Ｅに示すように、絶縁膜２１１ｂの形成、ソース電極２０６の形成、電極２０９の形成、及びドレイン電極２０１の形成等を、第２の実施形態と同様にして行う。
【００９７】
このようにして第４の実施形態に係る化合物半導体装置を完成させることができる。
【００９８】
なお、絶縁膜３０２の厚さは、ゲート電極２０８と基板２２１との絶縁分離に適した厚さとし、ゲート電極２０８と基板２２１との間に位置する絶縁膜３０１及び３０２の総厚さは、第２の実施形態における絶縁膜２１１ａの部分２２４と同様にすることが好ましい。
【００９９】
第１〜第４の化合物半導体装置は、例えば、スイッチング半導体素子に用いることができる。また、このようなスイッチング素子は、スイッチング電源又は電子機器に用いることができる。更に、これらの化合物半導体装置を、サーバの電源回路等のフルブリッジ電源回路用の部品として用いることも可能である。
【０１００】
また、上述のように導電性の基板の材料は特に限定されないが、ドレイン電極の材料は基板の材料に応じて選択することが好ましい。例えば、導電性ＳｉＣ基板が用いられる場合、ドレイン電極の材料としては、Ｎｉを用いることが好ましく、ＮｉＳｉ、ＴａＳｉ、又はＷＳｉ等を用いてもよい。また、導電性Ｓｉ基板が用いられる場合、ドレイン電極の材料としては、Ａｌ、ＴｉＳｉ、ＣｏＳｉ等を用いることができる。
【０１０１】
（第５の実施形態）
次に、第５の実施形態について説明する。第５の実施形態に係る電源装置には、第１〜第４の実施形態のいずれかの化合物半導体装置が含まれている。図１１は、第５の実施形態に係る電源装置の構成を示す図である。
【０１０２】
第５の実施形態には、図１１に示すように、高圧の一次側回路４０１及び低圧の二次側回路４０２が設けられており、更に、一次側回路４０１と二次側回路４０２との間にトランス４０３が設けられている。
【０１０３】
一次側回路４０１には、交流電源４０４、いわゆるブリッジ整流回路４０５、並びに複数（ここでは４つ）のスイッチング素子４０６ａ、４０６ｂ、４０６ｃ、及び４０６ｄが設けられている。また、ブリッジ整流回路４０５には、スイッチング素子４０６ｅが設けられている。二次側回路４０２には、複数（ここでは３つ）のスイッチング素子４０７ａ、４０７ｂ、及び４０７ｃが設けられている。
【０１０４】
そして、スイッチング素子４０６ａ、４０６ｂ、４０６ｃ、４０６ｄ、及び４０６ｅに、第１〜第４の実施形態のいずれかが用いられている。一方、スイッチング素子４０７ａ、４０７ｂ、及び４０７ｃには、シリコンを用いたＭＩＳ（metal-insulator-semiconductor）ＦＥＴが用いられている。
【０１０５】
このような電源回路によれば、高い信頼性を得ることができ、この電源回路は、例えば大電力の用途に用いることができる。
【０１０６】
（第６の実施形態）
次に、第６の実施形態について説明する。第６の実施形態に係る高周波増幅器には、第１〜第４の実施形態のいずれかの化合物半導体装置が含まれている。図１２は、第６の実施形態に係る高周波増幅器の構成を示す図である。
【０１０７】
第６の実施形態には、図１２に示すように、ディジタルプレディストーション回路５０１、ミキサ５０２ａ及び５０２ｂ、並びにパワーアンプ５０３が設けられている。
【０１０８】
ディジタルプレディストーション回路５０１は、入力信号の非線形歪みを補償する回路である。ミキサ５０２ａは、非線形歪みが補償された入力信号と交流信号とをミキシングする。パワーアンプ５０３に第１〜第４の実施形態のいずれかが用いられており、パワーアンプ５０３は、交流信号とミキシングされた入力信号を増幅する。なお、本実施形態では、例えばスイッチの切り替えにより、出力側の信号をミキサ５０２ｂで交流信号とミキシングし、交流信号とミキシングされた出力側の信号をディジタルプレディストーション回路５０１に送出することも可能である。
【０１０９】
このような高周波増幅回路によれば、高い信頼性を得ることができ、この高周波増幅回路は、例えば携帯電話又は無線通信の基地局に用いることができる。
以下、本発明の諸態様を付記としてまとめて記載する。
（付記１）
第１の電極と、
前記第１の電極の上方に形成された第１の化合物半導体層と、
前記第１の化合物半導体層上に形成された第２の化合物半導体層と、
前記第２の化合物半導体層上に形成された第３の化合物半導体層と、
前記第３の化合物半導体層の上方に形成された第２の電極と、
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の積層体に形成された開口部内に形成され、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の側面に接する第４の化合物半導体層と、
前記第２の化合物半導体層と前記第４の化合物半導体層との界面の電位を制御するゲート電極と、
前記第１の化合物半導体層から絶縁され、前記第１の電極及び前記第２の化合物半導体層に接する第３の電極と、
を有し、
前記第２の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第４の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第２の化合物半導体層の伝導帯のエネルギは、前記第３の化合物半導体層の伝導帯のエネルギよりも高いことを特徴とする化合物半導体装置。
（付記２）
前記第３の電極は、前記第１の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生した２次元電子ガス及び前記第３の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生した２次元電子ガスから離間して形成されていることを特徴とする付記１に記載の化合物半導体装置。
（付記３）
前記第２の化合物半導体層の格子定数は、前記第４の化合物半導体層の格子定数以下であることを特徴とする付記１に記載の化合物半導体装置。
（付記４）
前記ゲート電極と前記第４の化合物半導体層とを絶縁するゲート絶縁膜を有することを特徴とする付記１に記載の化合物半導体装置。
（付記５）
前記ゲート絶縁膜よりも厚く、前記ゲート電極と前記第１の電極とを絶縁する絶縁膜を有することを特徴とする付記４に記載の化合物半導体装置。
（付記６）
前記第１の電極及び前記第３の電極は、一体的に形成されていることを特徴とする付記１に記載の化合物半導体装置。
（付記７）
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層は、Ｇａ及びＮを含有し、
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の各表面は、ａ軸方向を向いていることを特徴とする付記１に記載の化合物半導体装置。
（付記８）
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層は、Ｇａ及びＮを含有し、
前記側面の面方位は、（０００１）であることを特徴とする付記１に記載の化合物半導体装置。
（付記９）
前記第３の化合物半導体層の抵抗は、前記第２の化合物半導体層側よりも前記第２の電極側において低くなっていることを特徴とする付記１に記載の化合物半導体装置。
（付記１０）
前記第１の化合物半導体層及び前記第３の化合物半導体層は、ＧａＮ層又はＡｌＧａＮ層であり、
前記第２の化合物半導体層及び前記第４の化合物半導体層は、前記第１の化合物半導体層及び前記第３の化合物半導体層より高い割合でＡｌを含有するＡｌＧａＮ層であることを特徴とする付記１に記載の化合物半導体装置。
（付記１１）
前記ゲート絶縁膜は、シリコン窒化膜、ハフニウム酸化膜、タンタル酸化膜、及びアルミニウム酸化膜からなる群から選択された少なくとも１種を含有することを特徴とする付記４に記載の化合物半導体装置。
（付記１２）
前記絶縁膜は、シリコン窒化膜、ハフニウム酸化膜、タンタル酸化膜、及びアルミニウム酸化膜からなる群から選択された少なくとも１種を含有することを特徴とする付記５に記載の化合物半導体装置。
（付記１３）
第１の化合物半導体層、第２の化合物半導体層、及び第３の化合物半導体層がこの順で積層された積層体を形成する工程と、
前記積層体に開口部を形成する工程と、
前記開口部内に、前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の側面に接する第４の化合物半導体層を形成する工程と、
前記第２の化合物半導体層と前記第４の化合物半導体層との界面の電位を制御するゲート電極を形成する工程と、
前記第３の化合物半導体層の上方に第２の電極を形成する工程と、
前記第１の化合物半導体層の下方に第１の電極を形成し、更に、前記第１の化合物半導体層から絶縁され、前記第１の電極及び前記第２の化合物半導体層に接する第３の電極を形成する工程と、
を有し、
前記第２の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第４の化合物半導体層の格子定数は、前記第１の化合物半導体層及び前記第３の化合物半導体層の格子定数よりも小さく、
前記第２の化合物半導体層の伝導帯のエネルギは、前記第３の化合物半導体層の伝導帯のエネルギよりも高いことを特徴とする化合物半導体装置の製造方法。
（付記１４）
前記第３の電極を、前記第１の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生する２次元電子ガス及び前記第３の化合物半導体層と前記第４の化合物半導体層との間の格子定数の差に起因して発生する２次元電子ガスから離間して形成することを特徴とする付記１３に記載の化合物半導体装置の製造方法。
（付記１５）
前記第２の化合物半導体層の格子定数は、前記第４の化合物半導体層の格子定数以下であることを特徴とする付記１３に記載の化合物半導体装置の製造方法。
（付記１６）
前記ゲート電極と前記第４の化合物半導体層とを絶縁するゲート絶縁膜を形成する工程を有することを特徴とする付記１３に記載の化合物半導体装置の製造方法。
（付記１７）
前記ゲート絶縁膜を形成する工程は、前記ゲート絶縁膜よりも厚く、前記ゲート電極と前記第１の電極とを絶縁する絶縁膜を形成する工程を有することを特徴とする付記１６に記載の化合物半導体装置の製造方法。
（付記１８）
前記第１の電極及び前記第３の電極を、一体的に形成することを特徴とする付記１３に記載の化合物半導体装置の製造方法。
（付記１９）
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層は、Ｇａ及びＮを含有し、
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層の各表面は、ａ軸方向を向いていることを特徴とする付記１３に記載の化合物半導体装置の製造方法。
（付記２０）
前記第１の化合物半導体層、前記第２の化合物半導体層、及び前記第３の化合物半導体層は、Ｇａ及びＮを含有し、
前記側面の面方位は、（０００１）であることを特徴とする付記１３に記載の化合物半導体装置の製造方法。
【産業上の利用可能性】
【０１１０】
これらの化合物半導体装置等によれば、縦型構造の高電子移動度トランジスタと接続されるダイオードを適切に動作させることができる。
【図１Ａ】
0005510544.tif 000002
【図１Ｂ】
0005510544.tif 000003
【図１Ｃ】
0005510544.tif 000004
【図２Ａ】
0005510544.tif 000005
【図２Ｂ】
0005510544.tif 000006
【図２Ｃ】
0005510544.tif 000007
【図３Ａ】
0005510544.tif 000008
【図３Ｂ】
0005510544.tif 000009
【図３Ｃ】
0005510544.tif 000010
【図３Ｄ】
0005510544.tif 000011
【図３Ｅ】
0005510544.tif 000012
【図４Ａ】
0005510544.tif 000013
【図４Ｂ】
0005510544.tif 000014
【図４Ｃ】
0005510544.tif 000015
【図４Ｄ】
0005510544.tif 000016
【図５Ａ】
0005510544.tif 000017
【図５Ｂ】
0005510544.tif 000018
【図５Ｃ】
0005510544.tif 000019
【図５Ｄ】
0005510544.tif 000020
【図５Ｅ】
0005510544.tif 000021
【図５Ｆ】
0005510544.tif 000022
【図５Ｇ】
0005510544.tif 000023
【図５Ｈ】
0005510544.tif 000024
【図５Ｉ】
0005510544.tif 000025
【図５Ｊ】
0005510544.tif 000026
【図５Ｋ】
0005510544.tif 000027
【図５Ｌ】
0005510544.tif 000028
【図６】
0005510544.tif 000029
【図７Ａ】
0005510544.tif 000030
【図７Ｂ】
0005510544.tif 000031
【図７Ｃ】
0005510544.tif 000032
【図７Ｄ】
0005510544.tif 000033
【図７Ｅ】
0005510544.tif 000034
【図７Ｆ】
0005510544.tif 000035
【図７Ｇ】
0005510544.tif 000036
【図８】
0005510544.tif 000037
【図９Ａ】
0005510544.tif 000038
【図９Ｂ】
0005510544.tif 000039
【図９Ｃ】
0005510544.tif 000040
【図９Ｄ】
0005510544.tif 000041
【図９Ｅ】
0005510544.tif 000042
【図９Ｆ】
0005510544.tif 000043
【図１０Ａ】
0005510544.tif 000044
【図１０Ｂ】
0005510544.tif 000045
【図１０Ｃ】
0005510544.tif 000046
【図１０Ｄ】
0005510544.tif 000047
【図１０Ｅ】
0005510544.tif 000048
【図１１】
0005510544.tif 000049
【図１２】
0005510544.tif 000050