(57)【特許請求の範囲】
【請求項１】
基板上に窒化膜を形成する工程と、
前記基板上に形成された窒化膜を窒化水素ラジカルＮＨ*に曝し、膜質を改変する工程と、を含み、
前記膜質を改変する工程は、ＫｒあるいはＡｒガスと窒素および水素を含むガスの混合ガス中にプラズマを、５０〜１００ｍＴｏｒｒのガス圧においてマイクロ波により励起する工程と、前記窒化膜を前記プラズマに曝す工程とよりなることを特徴とする窒化膜の形成方法。
【請求項２】
前記膜質を改変する工程は、５５０°Ｃ以下の基板温度において実行されることを特徴とする請求項１記載の窒化膜の形成方法。
【請求項３】
処理室内に、ＫｒあるいはＡｒよりなる不活性ガスと窒素および水素を含むガスとを導入し、マイクロ波により励起することによりプラズマを形成する工程と、
前記処理室中に処理ガスを導入し、前記処理ガスの前記プラズマによる活性化により、前記処理室中において基板上に窒化膜を堆積する工程とよりなる窒化膜の形成方法であって、
前記窒化膜は、堆積と同時に、５０〜１００ｍＴｏｒｒのガス圧において前記プラズマ中に生成する窒化水素ラジカルＮＨ*により処理されることを特徴とする窒化膜の形成方法。
【請求項４】
処理室内に、ＫｒあるいはＡｒよりなる不活性ガスと、酸素ガスと、窒素および水素を含むガスとを導入し、マイクロ波により励起することによりプラズマを形成する工程と、
前記処理室中に処理ガスを導入し、前記処理ガスの前記プラズマによる活性化により、前記処理室中において基板上に酸窒化膜を堆積する工程とよりなる酸窒化膜の形成方法であって、
前記酸窒化膜は、堆積と同時に、５０〜１００ｍＴｏｒｒのガス圧において前記プラズマ中に生成する原子状酸素および窒化水素ラジカルにより処理されることを特徴とする酸窒化膜の形成方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は一般に半導体装置およびその製造方法に係り、特に絶縁膜の形成方法、およびフラッシュメモリ素子を含む電気的に情報の書き換えが可能な不揮発性半導体メモリ素子およびその製造方法に関する。
【０００２】
半導体メモリ装置には、揮発性メモリ装置であるＤＲＡＭやＳＲＡＭ、不揮発性メモリであるマスクＲＯＭやＰＲＯＭ、ＥＰＲＯＭ、ＥＥＰＲＯＭ等が含まれるが、メモリセル１個当り１個のトランジスタを有するＥＥＰＲＯＭであるいわゆるフラッシュメモリは小型・大容量・低消費電力を特徴とし、その改良に向けて多大の努力がなされている。特にフラッシュメモリを低電圧で長期間にわたり、安定して駆動するには、均一で優れた膜質の誘電体膜が必要不可欠である。
【０００３】
また、均一でリーク電流の少ない優れた膜質の絶縁膜は、フラッシュメモリのみならず、キャパシタを有する他の様々な半導体装置、例えば強誘電体半導体メモリ素子において強誘電体キャパシタを構成する強誘電体膜においても重要である。さらに均一でリーク電流の少ない優れた膜質の高誘電体膜は、ゲート長が０．１μｍ以下の高速半導体装置においてゲート絶縁膜としても重要である。
【背景技術】
【０００４】
まず、従来のフラッシュメモリ素子を、一般的な積層型ゲート（stacked-gate）構造を有するフラッシュメモリ素子の概念を示す図１を参照しながら説明する。
【０００５】
図１を参照するに、フラッシュメモリ素子はシリコン基板１７００上に構成されており、前記シリコン基板１７００中に形成されたソース領域１７０１およびドレイン領域１７０２と、前記シリコン基板１７００上において前記ソース領域１７０１とドレイン領域１７０２との間に形成されたトンネルゲート酸化膜１７０３と、前記トンネルゲート酸化膜１７０３上に形成されたフローティングゲート１７０４とを含み、前記フローティングゲート１７０４上にはシリコン酸化膜１７０５とシリコン窒化膜１７０６とシリコン酸化膜１７０７とが順次積層され、さらに前記シリコン酸化膜１７０７上にはコントロールゲート１７０８が形成されている。すなわち、かかる積層構造のフラッシュメモリセルでは、図１に示されるように、フローティングゲート１７０４とコントロールゲート１７０８が絶縁膜１７０５、１７０６および１７０７よりなる絶縁構造を間に挟むように積層されている。
【０００６】
前記フローティングゲート１７０４とコントロールゲート１７０５間に設けられる前記絶縁構造は、フローティングゲート１７０４とコントロールゲート１７０５との間のリーク電流を抑えるため、このように窒化物膜１７０６を酸化物膜１７０５および１７０７で挟持した、いわゆるＯＮＯ構造を有するのが一般的である。通常のフラッシュメモリ素子では、トンネルゲート酸化膜１７０３およびシリコン酸化膜１７０５は熱酸化法で、また、シリコン窒化膜１７０６、シリコン酸化膜１７０７はＣＶＤ法で形成される。シリコン酸化膜１７０５はＣＶＤで形成される場合もある。トンネルゲート酸化膜１７０３の膜厚は８ｎｍ程度および絶縁膜１７０５、１７０６、１７０７の膜厚の総和は酸化膜厚換算で１５ｎｍ程度である。また、このメモリセルの他に、３〜７ｎｍ程度の厚さのゲート酸化膜を有する低電圧用トランジスタと１５〜３０ｎｍ厚さのゲート酸化膜を有する高電圧用トランジスタが同一シリコン上に形成される。
【発明の概要】
【発明が解決しようとする課題】
【０００７】
このように構成された積層構造のフラッシュメモリセルでは、情報の書き込み時にドレイン１７０２に約５〜７Ｖを印加し、さらにコントロールゲート１７０８に１２Ｖ程度以上の高電圧を印加することにより、ドレイン領域１７０２付近に発生するチャネルホット電子をトンネル絶縁膜１７０３を通してフローティングゲートに蓄積する。また、このようにして蓄積された電子を消去するときには、ドレイン領域１７０２をフローティングにし、コントロールゲート１７０８を接地し、ソース領域１７０１に１２Ｖ程度以上の高電圧を印加することで、前記フローティングゲート１７０４に蓄積された電子を前記ソース領域１７０１に引き抜く。
【０００８】
しかし、かかる従来のフラッシュメモリ素子は、情報の書き込み及び消去動作時に高電圧を必要とし、かかる高電圧の印加によって多量の基板電流が発生して、トンネル絶縁膜が劣化し、素子の特性の低下を招くという問題点があった。また、高電圧印加が原因となって、書き換え回数の制限や過消去等の問題を内包していた。
【０００９】
従来のフラッシュメモリ素子において高電圧を印加しなければならない原因は、絶縁膜１７０５、１７０６および１７０７からなるＯＮＯ膜の膜厚が厚いことにある。
【００１０】
従来の成膜技術では、フローティングゲート１７０４上に前記絶縁膜１７０５として酸化膜を形成する際に熱酸化等の高温処理を使うとポリシリコンゲート１７０４と前記酸化膜との界面がサーマルバジェット等の影響で粗悪になってしまう問題が生じていた。一方、この問題を回避するためにＣＶＤ等の低温処理でかかる酸化膜を形成しようとした場合、高品質で薄膜の酸化膜を形成することが困難であった。このような理由で、従来のフラッシュメモリ素子では絶縁膜１７０５、１７０６、１７０７の膜厚を厚くすることで絶縁膜のリーク電流を抑制せざるを得なかった。
【００１１】
しかし絶縁膜１７０５、１７０６、１７０７の膜厚を厚くしなければならないことから、かかる従来のフラッシュメモリ素子では書き込みおよび消去電圧が必然的に高くなってしまい、その結果、前記トンネルゲート絶縁膜１７０３も、高電圧に耐えるよう厚くする必要があった。
【００１２】
膜厚が小さくてもリーク電流の少ない優れた膜質の絶縁膜は、フラッシュメモリのみならず、他の様々な半導体装置においても望まれるものである。
【００１３】
そこで、本発明は上記の課題を解決した新規で有用な誘電体膜の形成方法を提供することを概括的課題とする。
【課題を解決するための手段】
【００１４】
一の側面によれば本発明は、
基板上に窒化膜を形成する工程と、
前記基板上に形成された窒化膜を窒化水素ラジカルＮＨ*に曝し、膜質を改変する工程と、を含み、
前記膜質を改変する工程は、ＫｒあるいはＡｒガスと窒素および水素を含むガスの混合ガス中にプラズマをマイクロ波により励起する工程と、前記窒化膜を前記プラズマに曝す工程とよりなることを特徴とする窒化膜の形成方法を提供する。
【００１５】
本発明によれば、窒化水素ラジカルＮＨ*は前記基板上に形成された窒化膜中に容易に侵入し、前記窒化膜中の欠陥を補償する。その結果、かかる処理を施されたシリコン窒化膜はＳｉ3Ｎ4の化学量論組成に近い組成を有し、界面準位が少なく、リーク電流が少ない特徴を有する。さらにかかる処理を施したシリコン窒化膜では、膜中に蓄積される歪が減少する。前記窒化水素ラジカルＮＨ*は、Ｋｒと酸素の混合ガスをマイクロ波励起することにより、効率的に生成することができる。
【００１６】
他の側面によれば本発明は、
処理室内に、ＫｒあるいはＡｒよりなる不活性ガスと窒素および水素を含むガスとを導入し、マイクロ波により励起することによりプラズマを形成する工程と、
前記処理室中に処理ガスを導入し、前記処理ガスの前記プラズマによる活性化により、前記処理室中において基板上に窒化膜を堆積する工程とよりなる窒化膜の形成方法であって、
前記窒化膜は、堆積と同時に、前記プラズマ中に生成する窒化水素ラジカルＮＨ*により処理されることを特徴とする窒化膜の形成方法を提供する。
【００１７】
他の側面によれば本発明は、
処理室内に、ＫｒあるいはＡｒよりなる不活性ガスと、酸素ガスと、窒素および水素を含むガスとを導入し、マイクロ波により励起することによりプラズマを形成する工程と、
前記処理室中に処理ガスを導入し、前記処理ガスの前記プラズマによる活性化により、前記処理室中において基板上に酸窒化膜を堆積する工程とよりなる酸窒化膜の形成方法であって、
前記酸窒化膜は、堆積と同時に、前記プラズマ中に生成する原子状酸素および窒化水素ラジカルにより処理されることを特徴とする酸窒化膜の形成方法を提供する。
【００１８】
さらに他の側面によれば本発明は、
処理室中において、基板上にターゲットのスパッタリングにより、窒化膜を堆積する工程と、
前記処理室中において、ＫｒあるいはＡｒよりなる不活性ガスと窒素および水素を含むガスとをマイクロ波励起することにより、プラズマを形成する工程と、
前記プラズマ中に生成された窒化水素ラジカルＮＨ*により、前記窒化膜を処理する工程とよりなることを特徴とする酸化膜のスパッタリング方法を提供する。
【００１９】
更に他の側面によれば本発明は、
基板上へのゲート絶縁膜の形成方法であって、
基板表面に窒化膜を形成する工程と、
前記窒化膜を、窒化水素ラジカルＮＨ*により処理する工程と、
前記前記処理された窒化膜上に、高誘電体膜を堆積する工程と
前記高誘電体膜の表面を、窒化水素ラジカルＮＨ*により処理し、窒化膜を形成する工程とよりなることを特徴とするゲート絶縁膜の形成方法を提供する。
【発明の効果】
【００２０】
本発明によれば、ＫｒあるいはＡｒを不活性ガスとしたプラズマに伴い生成した原子状酸素Ｏ*あるいは窒化水素ラジカルＮＨ*により、前記基板上に形成された酸化膜あるいは窒化膜あるいは酸窒化膜を処理することにより、前記膜中のダングリングボンドあるいはウィークボンドが終端され、その結果、ＣＶＤ法等により形成された膜質の劣る絶縁膜であっても、膜質を向上させることが可能になる。
【図面の簡単な説明】
【００２１】
【図１】従来のフラッシュメモリ素子の断面構造の概略断面構造を示す図である。
【図２】ラジアルラインスロットアンテナを用いたプラズマ装置の概念を示す図である。
【図３】本発明の第１実施例により形成された酸化膜について、得られた酸化膜厚と処理室内のガス圧力との関係を示す図である。
【図４】本発明の第１実施例により形成された酸化膜について、得られた酸化膜厚の酸化時間依存性を示す図である。
【図５】本発明の第１実施例によるシリコン酸化膜中のＫｒ密度の深さ方向分布を示す図である。
【図６】本発明の第１実施例によるシリコン酸化膜の界面準位密度を示す図である。
【図７】本発明の第１実施例によるシリコン酸化膜中の界面準位密度と絶縁耐圧との関係を示す図である。
【図８Ａ】本発明の第１実施例において得られたシリコン酸化膜中の界面準位密度および絶縁耐圧と、処理室内の全圧との関係を示す図（その１）である。
【図８Ｂ】本発明の第１実施例において得られたシリコン酸化膜中の界面準位密度および絶縁耐圧と、処理室内の全圧との関係を示す図（その２）である。
【図９】本発明の第２実施例により形成された窒化膜について、窒化膜厚の処理室内ガス圧力依存性を示す図である。
【図１０】本発明の第２実施例によるシリコン窒化膜の電流電圧特性を示す図である。
【図１１Ａ】本発明の第３実施例によるポリシリコン膜の酸化処理、窒化処理および酸窒化処理を示す図（その１）である。
【図１１Ｂ】本発明の第３実施例によるポリシリコン膜の酸化処理、窒化処理および酸窒化処理を示す図（その２）である。
【図１２Ａ】本発明の第４実施例によるＣＶＤ酸化膜の改変処理を示す図（その１）である。
【図１２Ｂ】本発明の第４実施例によるＣＶＤ酸化膜の改変処理を示す図（その２）である。
【図１３】ＣＶＤ酸化膜の改変処理の効果を示す図である。
【図１４Ａ】本発明の第５実施例による高誘電体膜の改変処理を示す図（その１）である。
【図１４Ｂ】本発明の第５実施例による高誘電体膜の改変処理を示す図（その２）である。
【図１５Ａ】本発明の第６実施例による強誘電体膜の改変処理を示す図（その１）である。
【図１５Ｂ】本発明の第６実施例による強誘電体膜の改変処理を示す図（その２）である。
【図１６Ａ】本発明の第７実施例による低誘電率絶縁膜の改変処理を示す図（その１）である。
【図１６Ｂ】本発明の第７実施例による低誘電率絶縁膜の改変処理を示す図（その２）である。
【図１７Ａ】本発明の第８実施例による窒化膜の改変処理を示す図（その１）である。
【図１７Ｂ】本発明の第８実施例による窒化膜の改変処理を示す図（その２）である。
【図１７Ｃ】本発明の第８実施例による窒化膜の改変処理を示す図（その３）である。
【図１７Ｄ】本発明の第８実施例による窒化膜の改変処理を示す図（その４）である。
【図１７Ｅ】本発明の第８実施例による窒化膜の改変処理を示す図（その５）である。
【図１８】本発明の第９実施例による、改変処理を行いつつ実行される酸化膜の成膜処理を示す図である。
【図１９】本発明の第１０実施例による、改変処理を行いつつ実行される高誘電体膜のスパッタリング処理を示す図である。
【図２０】本発明の第１１実施例によるフラッシュメモリ素子の断面構造を示す図である。
【図２１】本発明の第１２実施例によるフラッシュメモリ素子の製造工程を示す図（その１）である。
【図２２】本発明の第１２実施例によるフラッシュメモリ素子の製造工程を示す図（その２）である。
【図２３】本発明の第１２実施例によるフラッシュメモリ素子の製造工程を示す図（その３）である。
【図２４】本発明の第１２実施例によるフラッシュメモリ素子の製造工程を示す図（その４）である。
【図２５】本発明の第１３実施例によるフラッシュメモリ素子の断面構造を示す図である。
【図２６】本発明の第１４実施例によるフラッシュメモリ素子の断面構造を示す図である。
【発明を実施するための形態】
【００２２】
以下に、本発明を実施例をあげて詳細に説明する。
【００２３】
［第１実施例］
まずは、プラズマを用いた低温の酸化膜形成について述べる。
【００２４】
図２は、本発明の酸化方法を実現するための、ラジアルラインスロットアンテナを用いたマイクロ波プラズマ処理装置の一例を示す断面図である（ＷＯ９８／３３３６２号公報参照）。本実施例においては、酸化膜形成時のためにＫｒをプラズマ励起ガスとして使用していることに新規な特徴がある。
【００２５】
図２を参照するに、前記マイクロ波プラズマ処理装置は被処理基板１０３を保持する試料台１０４を備えた真空容器（処理室）１０１を有し、前記処理室１０１内を真空にし、前記処理室１０１の壁面の一部に形成したシャワープレート１０２からＫｒガスおよびＯ2ガスを導入することで処理室内の圧力を１Ｔｏｒｒ程度に設定する。さらにシリコンウェハ等の円形状の基板を前記被処理基板１０３として加熱機構を持つ試料台１０４に置き、試料の温度を４００℃程度に設定する。この温度設定は２００−５５０℃の範囲であるのが好ましく、この範囲内であれは以下に述べる結果はほとんど同様のものとなる。
【００２６】
次に外部のマイクロ波源に接続された同軸導波管１０５から、ラジアルラインスロットアンテナ１０６および誘電体板１０７を通して、処理室１０１内に２．４５ＧＨｚのマイクロ波を供給し、処理室１０１内に高密度のプラズマを生成する。供給するマイクロ波の周波数が９００ＭＨｚ以上１０ＧＨｚ以下の範囲にあれば、以下に述べる結果はほとんど同様のものとなる。シャワープレート１０２と基板１０３の間隔は、本実施例では６ｃｍにしてある。この間隔は狭いほうがより高速な成膜が可能となる。
【００２７】
図２のマイクロ波プラズマ処理装置では、前記被処理基板１０３の表面において１×１０12ｃｍ-3を超えるプラズマ密度を実現することができる。また形成される高密度プラズマはマイクロ波により励起されるため電子温度が低く、被処理基板１０３の表面におけるプラズマ電位は１０Ｖ以下となる。このため被処理基板１０３表面がプラズマにより損傷することがなく、また処理室１０１のプラズマスパッタリングが生じないため、被処理基板１０３が汚染されることもない。またプラズマ処理がシャワープレート１０２と被処理基板１０３との間の狭い空間においてなされるため、反応生成物は前記空間を速やかに側方へと流れ、試料保持台１０４の周囲に形成された大容積の空間から排気されるため、非常に均一な処理が可能である。
【００２８】
このようにして形成されたＫｒガスとＯ2ガスが混合された高密度励起プラズマ中では、中間励起状態にあるＫｒ*とＯ2分子が衝突し、原子状酸素Ｏ*が効率よく発生し、この原子状酸素により基板表面が酸化される。従来のシリコン表面の酸化はＨ2Ｏ分子あるいはＯ2分子により行われ、処理温度は８００℃以上と極めて高いものであったが、本発明の原子状酸素による酸化は、５５０℃以下と十分に低い温度で可能である。
【００２９】
また、本発明の酸化膜の改質方法は、５５０℃以下の低温でできるので、酸化膜中のダングリングボンドを終端している水素を脱離させることなく、酸素欠損を回復させることができる。これは、後で説明する窒化膜あるいは酸窒化膜の形成においても同じである。
【００３０】
Ｋｒ*とＯ2の衝突機会を大きくするには、処理室１０１内の圧力が高い方が望ましいが、あまり高くすると、発生したＯ*同志が衝突し、Ｏ2分子に戻ってしまう。このため当然ながら、最適ガス圧力が存在する。
【００３１】
図３に、前記処理室１０１内でのＫｒと酸素の圧力比をＫｒ９７％，酸素３％に維持しながら処理室１０１の全圧を変えたときの、得られる酸化膜の厚さを示す。ただし図３の実験では、シリコン基板温度を４００°Ｃに設定し、酸化処理を１０分間行っている。
【００３２】
図３を参照するに、前記処理室１０１内のガス圧が１Ｔｏｒｒ（約１３３Ｐａ）の時に得られる酸化膜の膜厚は最大になり、この圧力ないしはその近傍の酸化条件が最適であることがわかる。しかも、この最適圧力は基板シリコンの面方位が１００面でも１１１面でも変わらない。
【００３３】
図４は、前記Ｋｒ／Ｏ2高密度プラズマを用いたシリコン基板表面の酸化処理の際に得られる酸化膜の膜厚と酸化時間との関係を示す。ただし図４中には、シリコン基板の面配向が（１００）面と（１１１）面の場合の両方の結果を示している。また図４には、従来の９００℃のドライ熱酸化による酸化時間依存性をも示している。
【００３４】
図４を参照するに、基板温度４００°Ｃ、処理室内圧力１Ｔｏｒｒ（約１３３Ｐａ）でのＫｒ／Ｏ2高密度プラズマ酸化処理による酸化速度は、基板温度９００°Ｃでの大気圧ドライＯ2酸化の際の酸化速度よりも速いことがわかる。
【００３５】
また、従来の９００℃ドライ熱酸化では（１１１）面方位シリコンの方が（１００）面方位シリコンよりも酸化膜の成長速度が速いが、Ｋｒ／Ｏ2高密度プラズマ酸化では、逆に（１１１）面方位シリコンの方が（１００）面方位シリコンよりも成長速度が遅くなっているのがわかる。本来Ｓｉ基板では（１１１）面方位の方が（１００）面よりもシリコンの面原子密度が多いので、酸素ラジカルの供給量が同じであれば酸化速度は（１１１）面の方が（１００）面よりも遅くなるはずである。Ｋｒ／Ｏ2高密度プラズマを用いたシリコン基板表面酸化では、この予測通りになっており、（１１１）面上にも（１００）面と同様に、緻密な酸化膜が形成されていると考えられる。これに対し従来の熱酸化処理では、（１１１）面の酸化速度の方が（１００）面の酸化速度よりも大きくなっているが、このことは形成されている（１１１）面の酸化膜が（１００）面上に形成された酸化膜に比べ疎であることを示している。
【００３６】
図５は、上記の手順で形成されるシリコン酸化膜中のＫｒ密度の深さ方向分布を、全反射蛍光Ｘ線分光装置を用いて調べたものである。ただし図５の実験では、シリコン酸化膜の形成は、Ｋｒ中の酸素分圧を３％、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）とし、基板温度を４００°Ｃに設定して行っている。
【００３７】
図５を参照するに、Ｋｒの面密度はシリコン／シリコン酸化膜界面に近接するにつれて減少するが、シリコン酸化膜表面では２×１０11ｃｍ-2程度の密度で含まれる。すなわち図５は、Ｋｒ／Ｏ2高密度プラズマを用いたシリコン基板表面酸化で形成されるシリコン酸化膜は、膜厚が４ｎｍ以上の場合にはＫｒ濃度が実質的に一定で、シリコン／シリコン酸化膜の界面に向かってＫｒ濃度が減少する膜となることを示している。本発明のシリコン酸化膜形成方法によれば、１０10ｃｍ-2以上の面密度のＫｒがシリコン酸化膜中に含有される。図５の結果は、シリコンの（１００）面上においてもまた（１１１）面上においても同様に得られる。
【００３８】
図６は、酸化膜の界面準位密度を、低周波Ｃ−Ｖ測定から求めた結果である。シリコン酸化膜の形成は図２に示した装置を用いて、基板温度４００度で成膜した。希ガス中の酸素の分圧は３％、処理室内の圧力は１Ｔｏｒｒ（約１３３Ｐａに固定した。比較のために、９００度酸素１００％の雰囲気で成膜した熱酸化膜の界面準位密度も同時に示す。
【００３９】
図６を参照するに、Ｋｒガスを用いて成膜した酸化膜の界面準位密度は（１００）面、（１１１）面とも低く、９００℃のドライ酸化雰囲気で成膜した（１００）面に形成した熱酸化膜の界面準位密度と同等であることがわかる。これに対し、（１１１）面に形成した熱酸化膜の界面準位密度はこれらに比べ１桁以上大きい。
【００４０】
これは次のような機構によると考えられる。
【００４１】
シリコン結晶を酸化膜側からみると、（１００）面ではシリコン原子の結合手が２本、（１１１）面ではシリコンの結合手が１本と３本交互に現れる。そこで従来の（１１１）面の熱酸化処理では、（１１１）面においてあるシリコン原子の３本の結合手に酸素原子が結合してしまうと、そのシリコン原子の後ろ側の結合手が伸びてウィークボンドになったり、切れてダングリングボンドになったりして界面準位が増加してしまう。
【００４２】
これに対し、ＫｒとＯ2の混合ガスの高密度励起プラズマ酸化を行うと、中間励起状態にあるＫｒ*とＯ2分子が衝突し原子状酸素Ｏ*が効率よく発生し、この原子状酸素がウィークボンドやダングリングボンドのところに効率よく達してシリコン−酸素の新たな結合をつくることで、（１１１）面においても界面準位を低減すると考えられる。
【００４３】
シリコン酸化膜成膜雰囲気におけるＫｒ中での酸素の分圧と、シリコン酸化膜の絶縁耐圧、および、成膜されたシリコン酸化膜中の界面順位密度の関係を、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）で成膜して測定すると、（１００）面、（１１１）面とも同様の結果が得られ、Ｋｒ中の酸素分圧が３％のとき、界面順位密度は最小となり、熱酸化膜中での界面順位密度と同等の値が得られる。また、シリコン酸化膜の絶縁耐圧も、酸素分圧３％付近で最大となる。このことから、Ｋｒ／Ｏ2混合ガスを用いて酸化を行うときの、酸素分圧は２−４％が好適である。
【００４４】
図７は、シリコン酸化膜成膜時の圧力と、シリコン酸化膜の絶縁耐圧、界面順位密度の関係である。このとき酸素の分圧は３％としている。
【００４５】
図７を参照するに、成膜時の圧力が１Ｔｏｒｒ（約１３３Ｐａ）付近でシリコン酸化膜の絶縁耐圧は最大となり、界面順位密度は最小となることがわかる。図７の結果から、Ｋｒ／Ｏ2混合ガスを用いて酸化膜を形成する場合の圧力は、８００−１２００ｍＴｏｒｒ（約１０７〜約１６０Ｐａ）が最適であることがわかる。図７の結果は、シリコンの（１００）面上においても（１１１）面上においても、同様に得られる。
【００４６】
この他、酸化膜の耐圧特性、リーク特性、ホットキャリア耐性、ストレス電流を流したときのシリコン酸化膜が破壊に至るまでの電荷量ＱＢＤ（Ｃｈａｒｇｅ−ｔｏ−Ｂｒｅａｋｄｏｗｎ）などの電気的特性、信頼性敵特性に関して、Ｋｒ／Ｏ2高密度プラズマを用いたシリコン基板表面酸化による酸化膜は、９００℃の熱酸化と同様の良好な特性が得られた。
【００４７】
図８Ａ，８Ｂは、得られたシリコン酸化膜のストレス電流誘起リーク電流特性を、従来の熱酸化膜の場合と比較して示す。ただし図８Ａ，８Ｂにおいて酸化膜の膜厚は３．２ｎｍとしている。
【００４８】
図８Ａ，８Ｂを参照するに、従来の熱酸化膜では電荷を注入するとリーク電流が増加するのに対して、本発明のＫｒ／Ｏ2によるプラズマ酸化では１００Ｃ／ｃｍ2の電荷を注入しても電流特性に変化がないことがわかる。すなわち、本発明のシリコン酸化膜ではトンネル電流を流しても酸化膜が劣化に至るまでの寿命が極めて長く、フラッシュメモリ素子のトンネル酸化膜として用いるのに最適である。
【００４９】
上述したように、Ｋｒ／Ｏ2高密度プラズマにより成長した酸化膜は、４００℃という低温で酸化しているにもかかわらず、（１００）面、（１１１）面とも、従来の（１００）面の高温熱酸化膜と同等ないしはより優れた特性を示している。こうした効果が得られるのは、酸化膜中にＫｒが含有されることにも起因している。酸化膜中にＫｒが含有されることにより、膜中やＳｉ／ＳｉＯ2界面でのストレスが緩和され、膜中電荷や界面準位密度が低減され、シリコン酸化膜の電気的特性が大幅に改善されるためと考えられる。特に、図５に示されるように、密度において１０10ｃｍ-2以上のＫｒを含むことがシリコン酸化膜の電気的特性、信頼性的特性の改善に寄与していると考えられる。
【００５０】
［第２実施例］
次に、高密度マイクロ波プラズマを用いた低温での窒化膜形成について述べる。
【００５１】
窒化膜形成に使われる装置は図２の装置と同じであり、窒化膜形成時のためにＡｒまたはＫｒをプラズマ励起ガスとして使用する。
【００５２】
すなわち前記真空容器（処理室）１０１内を高真空状態に排気し、シャワープレート１０２から一例としてＡｒガスおよびＮＨ3ガスを導入することにより処理室１０１内の圧力を１００ｍＴｏｒｒ（約１３Ｐａ）程度に設定する。さらにシリコンウェハ等の円形状の基板１０３を前記試料台１０４上に置き、基板温度を約５００°Ｃに設定する。ただし基板温度が４００−５５０℃の範囲内であれば、ほとんど同様の結果が得られる。
【００５３】
次に前記同軸導波管１０５から、ラジアルラインスロットアンテナ１０６および誘電体板１０７を通して処理室内に２．４５ＧＨｚのマイクロ波を供給し、処理室内に高密度プラズマを生成する。供給するマイクロ波の周波数が９００ＭＨｚ以上１０ＧＨｚ以下の範囲にあれば、ほとんど同様の結果が得られる。またシャワープレート１０２と基板１０３の間隔は、本実施例では６ｃｍに設定してある。この間隔は狭いほうがより高速な成膜が可能となる。本実施例では、ラジアルラインスロットアンテナを用いたプラズマ装置を用いて成膜した例を示すが、他の方法を用いてマイクロ波を処理室内に導入してもよい。
【００５４】
本実施例では、プラズマ励起ガスにＡｒを使用しているが、Ｋｒを用いても同様の結果を得ることができる。また、本実施例では、プラズマプロセスガスにＮＨ3を用いているが、Ｎ2とＨ2などの混合ガスを用いても良い。
【００５５】
ＡｒまたはＫｒとＮＨ3（またはＮ2とＨ2）の混合ガスに励起された高密度プラズマ中では、中間励起状態にあるＡｒ*またはＫｒ*により、ＮＨ*ラジカルが効率よく発生し、このＮＨ*ラジカルにより基板表面が窒化される。従来よりシリコン表面の直接窒化についての報告はなく、窒化膜はプラズマＣＶＤ法などにより形成されているが、かかる方法ではトランジスタのゲート膜に使える高品質な窒化膜は得られていなかった。これに対し、本実施例のシリコン窒化によれば、シリコンの面方位を選ばず、（１００）面でも（１１１）面でも、低温で高品質な窒化膜を形成することが可能となる。
【００５６】
ところで、本発明のシリコン窒化膜形成においては、水素が存在することがひとつの重要な要件である。プラズマ中に水素が存在することにより、シリコン窒化膜中および界面のダングリングボンドがＳｉ−Ｈ、Ｎ−Ｈ結合を形成して終端され、その結果シリコン窒化膜および界面の電子トラップが無くなる。Ｓｉ−Ｈ結合、Ｎ−Ｈ結合が本発明の窒化膜に存在することはそれぞれ赤外吸収スペクトル、Ｘ線光電子分光スペクトルを測定することで確認されている。水素が存在することで、ＣＶ特性のヒステリシスも無くなり、シリコン／シリコン窒化膜界面密度も、基板温度を５００℃程度以上にすれば３×１０10ｃｍ-2と低く抑えることが可能である。希ガス（ＡｒまたはＫｒ）とＮ2／Ｈ2の混合ガスを使用してシリコン窒化膜を形成する場合には水素ガスの分圧を０．５％以上とすることで、膜中の電子や正孔のトラップが急激に減少する。
【００５７】
また、本発明の窒化膜の改質方法は、５５０°Ｃ以下の低温で出来るので、窒化膜中のダングリングボンドを終端している水素を脱離させることがない。
【００５８】
図９は、上述の手順で作成したシリコン窒化膜厚の圧力依存性を示す。ただしＡｒ：ＮＨ3の分圧比は９８：２、成膜時間は３０分とした。
【００５９】
図９を参照するに、窒化膜の成長速度は処理室１０１内の圧力を下げて希ガス（ＡｒまたはＫｒ）がＮＨ3（またはＮ2／Ｈ2）に与えるエネルギーを増した方が速くなることがわかる。窒化の効率化の観点からは、ガス圧力は５０〜１００ｍＴｏｒｒ（約６〜１３Ｐａ）が好ましい。また、希ガス中のＮＨ3（またはＮ2／Ｈ2）の分圧は１〜１０％の範囲が良く、さらに好ましくは２〜６％が良い。
【００６０】
本実施例のシリコン窒化膜の誘電率は７．９であり、シリコン酸化膜の約２倍のものが得られた。
【００６１】
図１０は、本実施例のシリコン窒化膜の電流電圧特性を示す。ただし図１０に示す結果は、Ａｒ／Ｎ2／Ｈ2ガスを用い、Ａｒ：Ｎ2：Ｈ2の分圧比を９３：５：２に設定し、厚さが４．２ｎｍのシリコン窒化膜（誘電率換算酸化膜２．１ｎｍに相当）を成膜したときのものであり、この結果を図１０では厚さが２．１ｎｍの熱酸化膜と比較して示している。
【００６２】
図１０を参照するに、１Ｖの電圧印加時にシリコン酸化膜より４桁以上も低いリーク電流特性が得られるのがわかる。これは、得られたシリコン窒化膜が、フラッシュメモリ素子においてフローティングゲート電極とコントロールゲート電極間のリーク電流を抑制するのに適した絶縁膜であることを示している。
【００６３】
上述した成膜条件、物性的・電気的特性はシリコンの面方位によらず、（１００）面でも（１１１）面でも同様であり、本実施例によれば、いずれの面方位においても優れた膜質のシリコン窒化膜を得ることができる。本発明の効果は、酸化膜中にＳｉ−Ｈ結合、Ｎ−Ｈ結合だけでなくＡｒまたはＫｒが含有されることにも関係しており、窒化膜中やシリコン／窒化膜界面でのストレスが緩和され、シリコン窒化膜中の固定電荷や界面準位密度が低減されて、電気的特性、信頼性的特性が大幅に改善されるものと考えられる。特に、図５に示されたシリコン酸化膜の場合と同様に、密度において１０10ｃｍ-2以上のＡｒまたはＫｒを含むことがシリコン窒化膜の電気的特性、信頼性的特性の改善に寄与していると考えられる。
【００６４】
［第３実施例］
以上説明した酸化膜および窒化膜形成方法は、ポリシリコンの酸化・窒化に対しても同様に適用され、良質な酸化膜、窒化膜をポリシリコン上に形成することが可能である。
【００６５】
以下、本発明の第３実施例による、ポリシリコン膜上への誘電体膜の形成方法を、図１１（Ａ），（Ｂ）を参照しながら説明する。
【００６６】
図１１（Ａ）を参照するに、絶縁膜２０２で覆われたシリコン基板２０１上にはポリシリコン膜２０３が堆積される。そこで、かかるポリシリコン膜２０３を図１１（Ｂ）の工程で、図２で説明したマイクロ波プラズマ処理装置の処理容器１０１内においてＫｒあるいはＡｒと酸素の高密度混合ガスプラズマに曝すことにより、ポリシリコン膜２０３の表面に、膜質の優れた、すなわち界面準位密度が小さくリーク電流の少ないシリコン酸化膜２０４を得ることができる。
【００６７】
また図１１（Ｂ）の工程で、前記ポリシリコン膜２０３をＫｒあるいはＡｒとＮＨ3あるいはＮ2とＨ2の高密度混合ガスプラズマに曝すことにより、前記ポリシリコン膜２０３の表面に同様な、膜質の優れた窒化膜２０５を得ることができる。
【００６８】
また、図１１（Ｂ）の工程で、前記ポリシリコン膜２０３をＫｒあるいはＡｒと酸素およびＮＨ3、あるいはＮ2とＨ2の高密度混合ガスプラズマに曝すことにより、前記ポリシリコン膜２０３の表面に膜質の優れた酸窒化膜２０６を得ることができる。
【００６９】
絶縁膜上に形成されるポリシリコンは、（１１１）面方位が絶縁膜に対して垂直方向になった状態が安定であり、かつ緻密で結晶性が良く高品質なものとなるが、実際には他の面方位を持った結晶粒もポリシリコン内に存在する。本実施例による酸化膜、窒化膜あるいは酸窒化膜の形成方法によれば、上に説明したように、シリコンの面方位によらず高品質な酸化膜、窒化膜あるいは酸窒化膜を形成することができる。また、絶縁膜上に形成されるポリシリコンがＰ型やＮ型の不純物がドープされているか否かにかかわらず、本実施例による酸化膜あるいは窒化膜の形成方法によれば、成長速度がほぼ同等の成膜が可能である。このため、図１１（Ａ），（Ｂ）のプロセスは、フラッシュメモリのフローティング電極である第１ポリシリコンゲート電極等のポリシリコン膜上に薄い高品質な酸化膜、窒化膜および酸窒化膜を低温で形成するのに最適である。また、本発明の酸化膜、窒化膜および酸窒化膜は５５０℃以下の低温で形成できるので粒成長が抑制され、ポリシリコン表面が荒れることがない。
【００７０】
また、本発明の酸窒化膜の改質方法は、５５０°Ｃ以下の低温で出来るので、酸窒化膜中のダングリングボンドを終端している水素を脱離させることがない。
【００７１】
［第４実施例］
図１２Ａ，１２Ｂは、本発明の第４実施例によるＣＶＤ酸化膜の改質（ポストアニール）処理を示す。
【００７２】
図１２Ａを参照するに、Ｓｉ基板３０１上にはＣＶＤ法によりＳｉＯ2膜３０２が堆積されるが、このようにして堆積されたＳｉＯ2膜３０２を、図１２Ｂの工程においてＫｒあるいはＡｒと酸素の混合ガスよりなるプラズマに曝すことにより、プラズマ中に中間励起状態のＫｒ*あるいはＡｒ*とＯ2との反応により形成された原子状酸素Ｏ*が前記ＳｉＯ2膜３０２中に侵入し、前記ＳｉＯ2膜３０２の膜質を変化させる。
【００７３】
より具体的には、前記原子上酸素Ｏ*は前記ＣＶＤ−ＳｉＯ2膜３０２中においてダングリングボンドを終端し、ＣＶＤ−ＳｉＯ2膜３０２は図１２Ｂのポストアニール処理後には、熱酸化膜に近い密度と構造、特に理想的な化学量論組成を有するように変化する。
【００７４】
図１３は、このようにして形成されたＣＶＤ−ＳｉＯ2膜（ＮＳＧ膜）に対して、先の第１実施例の場合と同様なＫｒ／Ｏ2プラズマ処理を施して、膜表面の改質を行った場合のエッチング速度とエッチング量との関係を示す。
【００７５】
図１３を参照するに、ＣＶＤ−ＳｉＯ2膜は堆積しただけの状態では熱酸化膜に対して非常に大きなエッチング速度を示すが、前記Ｋｒ／Ｏ2プラズマ処理を施した場合、約２０ｎｍの深さに相当する最初の１０分間程度までのエッチングではエッチング速度が減少し、熱酸化膜に匹敵する小さなエッチング速度が得られることがわかる。これは、ＣＶＤ−ＳｉＯ2膜中に、前記Ｋｒ／Ｏ2プラズマ処理で生成した原子状酸素Ｏ*が侵入し、前記ＣＶＤ−ＳｉＯ2膜が緻密化していることを示している。かかる緻密なＳｉＯ2膜は界面準位等の欠陥が少なく、リーク電流が低減される好ましい特徴を有する。
【００７６】
本実施例においてＣＶＤ−ＳｉＯ2膜の改質プラズマ処理は、原子状酸素Ｏ*の生成効率が高い前記Ｋｒ／Ｏ2プラズマ処理が最も好ましいが、Ａｒ／Ｏ2プラズマ処理においても可能である。
【００７７】
［第５実施例］
図１４Ａ，１４Ｂは、本発明の第５実施例による高誘電体膜のポストアニール処理を示す。
【００７８】
図１４Ａを参照するに、Ｓｉ基板４０１表面にはＳｉＯ2層間絶縁膜４０２がＫｒ／Ｏ2プラズマによる直接酸化などにより形成されており、前記ＳｉＯ2層間絶縁膜４０２上には図示を省略したＴｉ等の密着層を介してＰｔ電極層４０３が形成されている。さらに前記Ｐｔ電極層４０３上にはＴａ2Ｏ5よりなる高誘電体膜４０４が、ＴａＣｌ5あるいはＴａ（ＯＣ2Ｈ5）5を原料に使ったＣＶＤ法により、堆積される。前記Ｔａ2Ｏ5膜４０４は堆積直後においては多量の酸素欠損を含んでおり、その結果、図１４Ａの工程では前記Ｔａ2Ｏ5膜４０４においてはリーク電流が大きく、また本来の高い比誘電率は得られていない。
【００７９】
このようにして形成された図１４Ａの構造は、次に図１４Ｂの工程において前記図２の高密度プラズマ処理装置中において、先の第１実施例と同様な条件下で、Ｋｒ／Ｏ2プラズマに曝される。
【００８０】
図１４Ｂの工程においては、かかるプラズマ処理工程によりプラズマ中に原子状酸素Ｏ*が効率的に生成し、生成した原子状酸素Ｏ*が前記Ｔａ2Ｏ5膜４０４中に効果的に侵入し、酸素欠損を補償する。その際、前記Ｔａ2Ｏ5膜４０４の厚さはせいぜい数十ナノメートル程度であり、前記原子状酸素Ｏ*は前記強誘電体膜４０４の厚さ方向全体にわたって導入される。
【００８１】
本実施例においては酸素欠陥補償工程が、図１４Ｂのプラズマ処理工程を使うことにより５５０°Ｃ以下の低温で可能となり、従来のように酸素雰囲気中での高温急速熱処理（ＲＴＡ）処理を行う必要がなくなる。これに伴い、先にＳｉ基板４０１中に形成されていた活性素子において拡散領域の不純物分布プロファイルが変化する問題が生じることもなくなる。
【００８２】
このようにしてプラズマ処理されたＴａ2Ｏ5膜は、高誘電体材料に固有の大きな比誘電率を示す。なお、本実施例において、前記高融電率膜４０４はＴａ2Ｏ5膜に限定されるものではなく、ＺｒＯ2膜はＨｆＯ2膜であってもよい。
【００８３】
図１４Ｂの工程に引き続いて前記Ｔａ2Ｏ5膜４０４上にＰｔやＳｒＲｕＯ3等の導電性酸化物よりなる電極層を形成することにより、高誘電体キャパシタを形成することができる。
【００８４】
なお本実施例において、Ｋｒ／Ｏ2プラズマの代わりにＡｒ／Ｏ2プラズマを使っても、原子状酸素Ｏ*を効率的に生成することが可能である。
【００８５】
［第６実施例］
図１５Ａ，１５Ｂは、本発明の第６実施例による強誘電体膜のポストアニール処理を示す。
【００８６】
図１５Ａを参照するに、Ｓｉ基板５０１表面にはＳｉＯ2層間絶縁膜５０２がＫｒ／Ｏ2プラズマによる直接酸化などにより形成されており、前記ＳｉＯ2層間絶縁膜５０２上には図示を省略したＴｉ等の密着層を介してＰｔ電極層５０３が形成されている。さらに前記Ｐｔ電極層５０３上にはＢＳＴ（ＢａＳｒＴｉＯ3）あるいはＳＢＴ（ＳｒＢｉ2（Ｔａ）2Ｏ9）よりなる強誘電体５０４がゾルゲル法あるいはスパッタリングにより堆積される。前記強誘電体膜５０４は堆積直後においてはアモルファスであり、図１５Ａの工程では前記強誘電体膜５０４においては強誘電体膜に特有の大きなスイッチング電荷ＱSWは得られていない。
【００８７】
このようにして形成された図１５Ａの構造は、次に図１５Ｂの工程において前記図２の高密度プラズマ処理装置中において、先の第１実施例と同様な条件下で、Ｋｒ／Ｏ2プラズマに曝される。
【００８８】
図１５Ｂの工程においては、かかるプラズマ処理工程によりプラズマ中に原子状酸素Ｏ*が効率的に生成し、生成した原子状酸素Ｏ*が前記強誘電体膜５０４中に効果的に侵入し、これを結晶化すると同時に酸素欠損を補償する。その際、前記強誘電体膜５０４の厚さはせいぜい数十ナノメートル程度であり、前記原子状酸素Ｏ*は前記強誘電体膜５０４の厚さ方向全体にわたって導入される。
【００８９】
本実施例においては結晶化および酸素欠陥補償工程が、図１５Ｂのプラズマ処理工程を使うことにより５５０°Ｃ以下の低温で可能となり、従来のように酸素雰囲気中での高温急速熱処理（ＲＴＡ）処理を行う必要がなくなる。これに伴い、先にＳｉ基板５０１中に形成されていた活性素子において拡散領域の不純物分布プロファイルが変化する問題が生じることもなくなる。
【００９０】
このようにしてプラズマ処理された強誘電体膜５０４は強誘電体材料に固有な大きなスイッチング電荷量ＱSWを有する。なお、本実施例において、前記高融電率膜５０４はＢＳＴあるいはＳＢＴ膜に限定されるものではなく、ＰＺＴ膜やＰＬＺＴ膜であってもよい。
【００９１】
図１５Ｂの工程に引き続いて前記強誘電体膜５０４上にＰｔやＳｒＲｕＯ3等の導電性酸化物よりなる電極層を形成することにより、強誘電体キャパシタを形成することができる。
【００９２】
［第７実施例］
図１６Ａ，１６Ｂは、本発明の第７実施例による低誘電率絶縁膜のポストアニール処理を示す。
【００９３】
図１６Ａを参照するに、Ｓｉ基板６０１上にはＦドープＳｉＯ2（ＳｉＯＦ）膜６０２がＣＶＤ法により、低誘電率層間絶縁膜として形成されており、図１６Ｂに工程において前記図２のマイクロ波プラズマ処理装置中において前記ＳｉＯＦ膜６０２に対して前記第１実施例と同様な条件においてＫｒ／Ｏ2プラズマ処理を行い、その表面および膜内を改質する。
【００９４】
かかる表面改質の結果、前記ＳｉＯＦ膜６０２上に導体パターンを形成した場合、かかる導体パターンと前記ＳｉＯＦ膜６０２との間の密着性が向上するだけでなく、配線間のリーク電流の減少、耐圧の改善が行える。
【００９５】
［第８実施例］
図１７Ａ〜１７Ｅは、本発明の第８実施例による高融電率ゲート絶縁膜の形成方法を示す。
【００９６】
図１７Ａを参照するに、Ｓｉ基板７０１上にはＣＶＤ法等により厚さが１ナノメートル以下のＳｉＮ７０２が形成され、図１７Ｂの工程において前記ＳｉＮ膜７０２を、前記図２のマイクロ波プラズマ処理装置中において、前記第２実施例と同様な条件下でＫｒ／ＮＨ3プラズマに曝露する。
【００９７】
図１７Ｂの工程では、前記Ｋｒ／ＮＨ3プラズマに伴い生成される窒化水素ラジカルＮＨ*が前記ＳｉＮ膜７０２中に侵入し、ダングリングボンド等の欠陥を終端する。その結果、前記ＳｉＮ膜７０２は界面準位密度が減少し、また化学量論組成Ｓｉ3Ｎ4に近い組成を有するリーク電流特性の優れたシリコン窒化膜に変化する。
【００９８】
次に図１７Ｃの工程において、前記Ｋｒ／ＮＨ3プラズマによりポストアニール処理をされたシリコン窒化膜７０２上に、例えばＺｒＣｌ4およびＨ2Ｏを原料としたＣＶＤ法あるいはＡＬＤ（atomic  layer  deposition）法等により、ＺｒＯ2よりなる高誘電体膜７０３を数ナノメートルの厚さに堆積する。
【００９９】
次に図１７Ｄの工程において図１７Ｃの構造を前記図２のマイクロ波プラズマ処理装置中に導入し、前記高誘電体膜７０３の表面をＫｒ／ＮＨ3プラズマに曝露する。かかるポストアニール処理の結果、前記高誘電体膜７０３の表面が窒化され、前記高誘電体膜７０３の表面には窒化膜７０３Ａが形成される。
【０１００】
次に図１７Ｅの工程において、図１７Ｄの構造上に、ポリシリコンゲート電極７０４を形成する。
【０１０１】
本実施例において、前記Ｓｉ基板７０１上に形成される窒化膜７０２はシリコン窒化膜に限定されるものではなく、アルミニウム窒化膜であってもより。また前記高誘電体膜７０３はＺｒＯ2膜に限定されるものではなく、ＨｆＯ2膜やＴａ2Ｏ5膜であってもよい。
【０１０２】
本実施例によれば、図１７Ｂの工程において前記Ｓｉ基板７０１上に比誘電率が７．９の緻密で欠陥の少ないＳｉＮ膜７０２が形成されるため、その上に図１７Ｃの工程において金属酸化膜よりなる高誘電体膜７０３を形成した場合にも、前記高誘電体膜７０３から前記Ｓｉ基板７０１への酸素の侵入が効果的に阻止され、ゲート絶縁膜全体の実効膜厚が増加してしまう問題が回避される。
【０１０３】
また図１７Ｄの工程において前記高誘電体膜７０３の表面に窒化膜を形成しておくことにより、後の工程において還元雰囲気中における処理がなされた場合にも、前記高誘電体膜７０３が還元される問題が回避される。
【０１０４】
［第９実施例］
図１８は、本発明の第９実施例による基板上への酸化膜の形成方法を示す。
【０１０５】
図１８を参照するに、本実施例ではポンプ１２１Ｂにより排気される排気ポート１２１Ａを備え、さらにマイクロ波窓１２２Ａ，１２２Ｂとこれに協働するマイクロ波アンテナ１２３Ａ，１２３Ｂを備えたＣＶＤ装置１２０が使われる。
【０１０６】
前記処理室１２１中にはヒータ１２４Ａを有するステージ１２４が設けられ、前記ステージ１２４上に被処理基板１２５が保持される。また前記処理室１２１中には前記被処理基板１２５に対向するようにシャワープレート１２６が設けられ、ライン１２６Ａから供給される処理ガスが、前記シャワープレート１２６を介して前記処理室１２０中に導入される。また前記処理室１２１中には前記マイクロ波窓１２２Ａ，１２２Ｂに隣接して、ライン１２７Ａから供給されるＫｒ／Ｏ2プラズマガスを前記処理室１２１中に導入するガス導入ポート１２７が形成されている。前記マイクロ波アンテナ１２３Ａ，１２３Ｂは、図２の装置で使われたラジアルラインスロットアンテナであってもよい。また前記マイクロ波アンテナ１２３Ａ，１２３Ｂはホーンアンテナであってもよい。
【０１０７】
かかる構成のＣＶＤ装置１２０では、前記アンテナ１２３Ａ，１２３Ｂからマイクロ波を供給することにより前記処理室１２１中において低エネルギで高密度なプラズマが形成され、Ｋｒ*と原子状酸素Ｏ*とが効率よく生成される。
【０１０８】
本実施例ではさらに前記シャワープレート１２６より、例えばＴａ（ＯＣ2Ｈ5）5とＯ2などの原料ガスを供給することにより、前記被処理基板１２５の表面近傍においてＴａ2Ｏ5膜が堆積する。
【０１０９】
その際、かかるＴａ2Ｏ5膜は堆積と同時に、先に図１２Ａ，１２Ｂの実施例で説明した原子状酸素Ｏ*によるアニール処理を受け、その結果、形成されるＴａ2Ｏ5膜の膜質が、特に界面準位密度およびリーク電流特性について、さらに改善される。しかも、本実施例によればＴａ2Ｏ5膜の堆積とアニール処理とが同時に行われるため、工程が短縮される。
【０１１０】
本実施例においては前記ＣＶＤ膜１２５はＴａ2Ｏ5に限定されるものではなく、ＳｉＯ2膜やＢＳＧ膜、ＢＰＳＧ膜等の酸化膜、あるいは窒化膜、さらには酸窒化膜に対しても適用が可能である。
【０１１１】
本実施例において、前記被処理基板１２５上に窒化膜を堆積する場合には、前記ガス導入ポート１２７からＫｒとＮＨ3の混合ガス、あるいはＫｒとＮ2とＨ2の混合ガスを供給すればよい。この場合にも、シリコン窒化膜を堆積すると同時に窒化水素ラジカルＮＨ*によりアニール処理がなされるため、得られる窒化膜は界面準位密度が低く、リーク電流が少ない、半導体装置のゲート絶縁膜としても使える好ましい特性を有する。
【０１１２】
本実施例において、前記被処理基板１２５上に酸窒化膜を堆積する場合には、前記ガス導入ポート１２７からＫｒとＯ2、およびＮＨ3あるいはＮ2とＨ2を含む混合ガスを供給することにより、前記被処理基板１２５上に界面準位密度が低く、リーク電流が少ない酸窒化膜を堆積することも可能である。
【０１１３】
［第１０実施例］
次に、本発明の第１０実施例による、Ｋｒ／Ｏ2プラズマにより励起された原子状酸素Ｏ*あるいはＫｒ／ＮＨ3プラズマにより励起された窒化水素ラジカルＮＨ*を使ったスパッタリング処理について、図１９を参照しながら説明する。ただし図１９中、先に説明した部分には同一の参照符号を付し、説明を省略する。
【０１１４】
本実施例では前記ＣＶＤ装置１２０の代わりに、図１９に示すスパッタ装置１３０を使う。
【０１１５】
図１９を参照するに、前記スパッタ装置１３０では前記被処理基板１２５に対面するように、高周波電源１３１Ａにより高周波を供給されるＢＳＴ等のターゲット１３１が配置され、また前記ターゲット１３１の近傍にはマグネット１３２が設けられる。また図１９のスパッタ装置１３０では、前記シャワープレート１２６の代わりにガス導入ポート１３３が設けられる。
【０１１６】
さらに図１９の構成では、前記マイクロ波窓１２２Ａに対応して、通常のホーンアンテナ１２３Ｃがマイクロ波アンテナとして設けられている。
【０１１７】
かかる構成のスパッタ装置１３０では、前記ターゲット１３１のスパッタリングにより前記被処理基板１２５上にＢＳＴ膜等の酸化膜形成がなされが、その際に、前記ガス導入ポート１２７からＫｒガスあるいはＫｒ／Ｏ2ガスを前記処理室１２１中に導入し、さらに前記マイクロ波アンテナ１２３Ｃからマイクロ波を導入することにより、前記処理装置中に原子状酸素Ｏ*を効率良く生成され、その結果、前記被処理基板１２５上に形成されるＢＳＴ膜は、堆積と同時に原子状酸素Ｏ*によりポストアニール処理を受ける。また、前記ガス導入ポート１３３より別に雰囲気ガスを導入することも可能である。
【０１１８】
さらに図１９のスパッタ装置１３０において前記ターゲット１３１として窒化物を使い、前記ガス導入ポートからＡｒガスあるいはＫｒガスとＮＨ3ガスとの混合ガス、あるいはＡｒガスまたはＫｒガスと、Ｎ2ガスおよびＨ2ガスとの混合ガスを供給することにより、前記被処理基板１２５上に窒化膜を堆積させることが可能になる。その際、堆積された窒化膜はプラズマ中に生成した窒化水素ラジカルＮＨ*によりポストアニール処理を受ける。
【０１１９】
さらに図１９のスパッタ装置１３０において前記ターゲット１３１として酸窒化ケイ素を使い、前記ガス導入ポートからＡｒガスあるいはＫｒガスと酸素ガスおよびＮＨ3ガスとの混合ガス、あるいはＡｒガスまたはＫｒガスと、Ｎ2ガスおよびＨ2ガスと酸素ガスとの混合ガスを供給することにより、前記被処理基板１２５上に酸窒化膜を堆積させることが可能になる。その際、堆積された酸窒化膜はプラズマ中に生成した原子状酸素Ｏ*および窒化水素ラジカルＮＨ*によりポストアニール処理を受ける。
【０１２０】
［第１１実施例］
次に、上述したマイクロ波プラズマを用いた低温の酸化膜と窒化膜の形成技術を使用した、ポリシリコン／シリサイド積層構造のゲート電極を有する高電圧用トランジスタと低電圧用トランジスタを包含する、本発明の第１１実施例によるフラッシュメモリ素子の製造工程を説明する。
【０１２１】
図２０は、本実施例によるフラッシュメモリ素子１０００の概略断面構造を示す。
【０１２２】
図２０を参照するに、フラッシュメモリ素子１０００はシリコン基板１００１上に構成されており、前記シリコン基板１００１に形成されたトンネル酸化膜１００２と、前記トンネル酸化膜１００２上に形成されフローティングゲート電極となる第１のポリシリコンゲート電極１００３とを含み、前記ポリシリコンゲート電極１００３上にはシリコン窒化膜１００４と、シリコン酸化膜１００５と、シリコン窒化膜１００６と、シリコン酸化膜１００７とが順次形成され、さらに前記シリコン窒化膜１００７上にはコントロールゲート電極となる第２のポリシリコンゲート電極１００８が形成されている。図２０中、ソース領域、ドレイン領域、コンタクトホール、配線パターンなどの図示は省略して記載している。
【０１２３】
本実施例のフラッシュメモリでは、前記シリコン酸化膜１００２、１００５、１００７が先に説明したシリコン酸化膜形成方法により、また、シリコン窒化膜１００４、１００６が先に説明したシリコン窒化膜形成方法により形成されるので、これらの膜の膜厚を従来の酸化膜、窒化膜の約半分にまで減少させても、良好な電気的特性が保証される。
【０１２４】
次に、本実施例のフラッシュメモリ素子を含む半導体集積回路の製造方法を、図２１〜図２４を参照しながら説明する。
【０１２５】
図２１を参照するに、シリコン基板１１０１上にはフィールド酸化膜１１０２によりフラッシュメモリセル領域Ａと、高電圧用トランジスタ領域Ｂと、低電圧用トランジスタ領域Ｃとが画成されており、各々の領域Ａ〜Ｃにはシリコン酸化膜１１０３が形成されている。前記フィールド酸化膜１１０２は、選択酸化法（ＬＯＣＯＳ法）やシャロートレンチアイソレーション法などで形成することができる。
【０１２６】
本実施例においては、酸化膜および窒化膜形成のためにＫｒをプラズマ励起ガスとして使用する。酸化膜および窒化膜の形成には、図２のマイクロ波プラズマ処理装置を使用する。
【０１２７】
次に図２２の工程において、前記メモリセル領域Ａにおいてシリコン酸化膜１１０３を除去し、さらに前記メモリセル領域Ａにトンネル酸化膜１１０４を約５ｎｍの厚さに形成する。前記トンネル酸化膜１１０４を形成する際には、真空容器（処理室）１０１内を真空にし、シャワープレート１０２からＫｒガスおよびＯ2ガスを導入し、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度、シリコンウエハの温度を４５０°Ｃに設定し、同軸導波管１０５から供給される周波数が２．５６ＧＨｚのマイクロ波を、ラジアルラインスロットアンテナ１０６および誘電体板１０７を通して処理室内に供給し、高密度のプラズマを生成する。
【０１２８】
図２２の工程では、前記トンネル酸化膜１１０４の形成の後、さらに第１のポリシリコン層１１０５を、前記トンネル酸化膜１１０４を覆うように堆積し、さらに水素ラジカル処理により、堆積したポリシリコン層１１０５の表面を平坦化する。次に、前記高電圧用トランジスタ領域Ｂおよび低電圧用トランジスタ領域Ｃから前記第１ポリシリコン層１１０５をパターニングにより除去し、前記メモリセル領域Ａのトンネル酸化膜１１０４上にのみ、前記第１ポリシリコン１１０５を残す。
【０１２９】
次に図２３の工程において前記図２２の構造上に、下部窒化膜１１０６Ａと下部酸化膜１１０６Ｂと上部窒化膜１１０６Ｃと上部酸化膜１１０６Ｄとを順次形成し、ＮＯＮＯ構造を有する絶縁膜１１０６を、図２のマイクロ波プラズマ処理装置を使って形成する。
【０１３０】
より詳細に説明すると、図２のマイクロ波プラズマ処理装置において真空容器（処理室）１０１内を高真空状態に排気し、さらにシャワープレート１０２からＫｒガス、Ｎ2ガス、Ｈ2ガスを導入し、処理室内の圧力を１００ｍＴｏｒｒ（約１３Ｐａ）程度に、またシリコンウェハの温度を５００℃に設定する。そして、この状態で前記同軸導波管１０５からの周波数が２．４５ＧＨｚのマイクロ波をラジアルラインスロットアンテナ１０６および誘電体板１０７を通して処理室内に供給し、処理室内に高密度のプラズマを生成する。その結果、前記ポリシリコン表面には、約２ｎｍの厚さのシリコン窒化膜が、前記下部窒化膜１１０６Ａとして形成される。
【０１３１】
次に、マイクロ波の供給を一時停止した後、Ｋｒガス、Ｎ2ガス、Ｈ2ガスの導入を止め、真空容器（処理室）１０１内を排気する。次いで前記シャワープレート１０２からＫｒガスおよびＯ2ガスを導入し、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定した状態で、再び２．４５ＧＨｚのマイクロ波を供給することにより、前記処理室１０１内に高密度のプラズマを生成して、厚さが約２ｎｍのシリコン酸化膜を、前記下部酸化膜１１０６Ｂとして形成する。
【０１３２】
次に、再びマイクロ波の供給を一時停止した後、Ｋｒガス、Ｏ2ガスの導入を止め、真空容器（処理室）１０１内を排気する。さらに前記シャワープレート１０２からＫｒガス、Ｎ2ガスおよびＨ2ガスを導入し、処理室内の圧力を１００ｍＴｏｒｒ程度に設定し、この状態で２．４５ＧＨｚのマイクロ波を供給することにより、前記処理室１０１内に高密度のプラズマを生成する。かかる高密度プラズマ処理により、さらに３ｎｍの厚さのシリコン窒化膜が形成される。
【０１３３】
最後にマイクロ波の供給を一時停止した後、Ｋｒガス、Ｎ2ガス、Ｈ2ガスの導入を止め、真空容器（処理室）１０１内を排気し、シャワープレート１０２からＫｒガス、Ｏ2ガスを導入して、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定する。この状態で再び２．４５ＧＨｚのマイクロ波を供給することにより、前記処理室１０１内に高密度のプラズマを生成して、厚さが２ｎｍのシリコン酸化膜を前記上部酸化膜１１０６Ｄとして形成する。
【０１３４】
すなわち、このような工程により、ＮＯＮＯ構造を有する絶縁膜１１０６を９ｎｍの厚さに形成することができる。このようにして形成されたＮＯＮＯ膜１１０６では、ポリシリコンの面方位依存も見られず、各々の酸化膜および窒化膜の膜厚および膜質は極めて均一である。
【０１３５】
図２３の工程では、さらにこのようにして形成された絶縁膜１１０６をパターニングし、高電圧用トランジスタ領域Ｂおよび低電圧用トランジスタ領域Ｃにおいて選択的に除去する。
【０１３６】
次に図２４の工程において高電圧用トランジスタ領域Ｂおよび低電圧用トランジスタ領域Ｃ上に閾値電圧制御用のイオン注入を行い、さらに前記領域ＢおよびＣ上の酸化膜１１０３を除去する。さらに前記高電圧用トランジスタ領域Ｂにはゲート酸化膜１１０７を７ｎｍの厚さに形成し、次いで低電圧用トランジスタ領域Ｃにゲート酸化膜１１０８を３．５ｎｍの厚さに形成する。
【０１３７】
図２４の工程では、その後前記フィールド酸化膜１１０２を包含する構造全体上に第２のポリシリコン層１１０９及びシリサイド層１１１０を順次形成し、さらにこれらをパターニングすることにより、前記高電圧用及び低電圧用トランジスタ領域Ｂ、Ｃにゲート電極１１１１Ｂ、１１１１Ｃをそれぞれ形成する。次に、メモリセル領域において前記ポリシリコン層１１０９およびシリサイド層１１１０をパターニングしてゲート電極１１１１Ａを形成する。
【０１３８】
最後に、標準的な半導体工程に準拠して、ソース・ドレイン形成、絶縁膜形成、コンタクト形成、配線形成などを行って素子を完成させる。
【０１３９】
このようにして形成されたＮＯＮＯ膜１１０６中のシリコン酸化膜およびシリコン窒化膜は非常に薄膜化されているが、にもかかわらず良好な電気的特性を有し、緻密でまた高品質であることを特徴とする。かかるシリコン酸化膜およびシリコン窒化膜は低温で形成されているためゲートポリシリコンと酸化膜との界面でサーマルバジェット等が発生することはなく、良好な界面特性が得られる。
【０１４０】
本発明のフラッシュメモリ素子を２次元に複数配置して作成したフラッシュメモリ集積回路装置は、情報の書き込み及び消去動作が低電圧で行え、基板電流の発生を抑制することができ、トンネル絶縁膜の劣化が抑えられ、素子の特性が安定する。本発明のフラッシュメモリ素子は優れた低リーク特性をもち、書き込み消去が７Ｖ程度の電圧で動作可能であり、メモリ保持時間を従来より１桁以上、書き換え可能回数を約１桁以上増すことができる。
【０１４１】
［第１２実施例］
次に、前記高密度マイクロ波プラズマを用いた低温での酸化膜と窒化膜の形成技術を使用した、ポリシリコン／シリサイド積層構造のゲート電極を有する、本発明の第５実施例によるフラッシュメモリ素子について説明する。
【０１４２】
図２５は、本実施例によるフラッシュメモリ素子１５００の概略断面構造を示す。
【０１４３】
図２５を参照するに、フラッシュメモリ素子１５００はシリコン基板１５０１上に形成されており、前記シリコン基板１５０１に形成されたトンネル窒化膜１５０２と、前記トンネル窒化膜１５０２上に形成されフローティングゲート電極となる第１のポリシリコンゲート電極１５０３とを含み、前記第１のポリシリコンゲート電極１５０３上にはシリコン酸化膜１５０４と、シリコン窒化膜１５０５、とシリコン酸化膜１５０６とが順次形成されている。さらに、前記シリコン酸化膜１５０６上にはコントロールゲート電極となる第２ポリシリコン電極１５０７が形成されている。図２５中、ソース領域、ドレイン領域、コンタクトホール、配線パターンなどの図示は省略して記載している。
【０１４４】
図２５のフラッシュメモリ素子１５００では、前記シリコン酸化膜１５０２、１５０４および１５０６は先に説明した高密度マイクロ波プラズマを使ったシリコン酸化膜形成方法により、また、シリコン窒化膜１５０５は先に説明した高密度マイクロ波プラズマを使ったシリコン窒化膜形成方法により形成される。
【０１４５】
次に本実施例のフラッシュメモリ集積回路の作成方法を説明する。
【０１４６】
本実施例においても、前記第１のポリシリコン層１５０３をパターンニングするまでの工程は先の図２１および図２２の工程と同様である。ただし、本実施例では、前記トンネル窒化膜１５０２は、真空容器（処理室）１０１内を排気してから、シャワープレート１０２からＡｒガス、Ｎ2ガス、Ｈ2ガスを導入し、処理室内の圧力を１００ｍＴｏｒｒ（約１３Ｐａ）程度に設定し、２．４５ＧＨｚのマイクロ波を供給し、処理室内に高密度のプラズマを生成することにより形成されており、約４ｎｍの厚さを有する。
【０１４７】
このようにして前記第１のポリシリコン層１５０３が形成された後、前記領域Ａにおいて前記第１のポリシリコン層上に、下部シリコン酸化膜１５０４とシリコン窒化膜１５０５と上部シリコン酸化膜１５０６とが順次形成され、ＯＮＯ構造を有する絶縁体膜が形成される。
【０１４８】
より詳細に説明すると、先に図１で説明したマイクロ波プラズマ処理装置の真空容器（処理室）１０１内を高真空状態に排気し、シャワープレート１０２からＫｒガス、Ｏ2ガスを導入し、処理室１０１内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定する。この状態で２．４５ＧＨｚのマイクロ波を前記処理室１０１内に供給し、高密度のプラズマを生成することにより、前記第１のポリシリコン層１５０３の表面に約２ｎｍの厚さのシリコン酸化膜が形成される。
【０１４９】
次に、前記シリコン酸化膜上にＣＶＤ法によりシリコン窒化膜を３ｎｍ形成した後、真空容器（処理室）１０１内を排気し、さらにシャワープレート１０２からＡｒガス、Ｎ2ガス、Ｈ2ガスを導入し、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定する。この状態で再び２．４５ＧＨｚのマイクロ波を供給することにより前記処理室１０１内に高密度プラズマを生成し、前記シリコン窒化膜を高密度プラズマに伴う窒化水素ラジカルＮＨ*に曝すことにより、緻密なシリコン窒化膜へと変換する。
【０１５０】
次に、前記緻密なシリコン窒化膜上にＣＶＤ法により、シリコン酸化膜を約２ｎｍの厚さに形成し、再び、マイクロ波プラズマ装置により、シャワープレート１０２からＫｒガス、Ｏ2ガスを導入し、処理室１０１内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定する。この状態で再び２．４５ＧＨｚのマイクロ波を前記処理室１０１中に供給することにより、前記処理室１０１中に高密度のプラズマを生成する。前記ＣＶＤ法で形成した酸化膜を、前記高密度プラズマに伴う原子状酸素Ｏ*に曝すことにより、前記ＣＶＤシリコン酸化膜は緻密なシリコン酸化膜に変換される。
【０１５１】
このようにして前記ポリシリコン膜１５０３上にはＯＮＯ膜が約７ｎｍの厚さに形成されるが、形成されたＯＮＯ膜にはポリシリコンの面方位依存も見られず、ＯＮＯ膜は極めて均一な膜厚を有する。かかるＯＮＯ膜には、その後、高電圧用及び低電圧用トランジスタ領域Ｂ、Ｃに対応する部分を除去するパターニング工程を行い、引き続き、先の第１１実施例と同様の工程を行うことにより、素子を完成させる。
【０１５２】
このフラッシュメモリ素子は優れた低リーク特性をもっており、書き込み消去電圧は６Ｖ程度で動作可能で、先の実施例のフラッシュメモリ１０００と同様に、メモリ保持時間を従来より１桁以上、書き換え可能回数を約１桁以上増すことができる。
【０１５３】
［第１３実施例］
次に、前記マイクロ波高密度プラズマを用いた低温酸化膜と窒化膜の形成技術を使用した、ポリシリコン／シリサイド積層構造のゲート電極を有する本発明の第１３実施例によるフラッシュメモリ素子１６００について説明する。
【０１５４】
図２６は、前記フラッシュメモリ素子１６００の概略的断面構造を示す。
【０１５５】
図２６を参照するに、本実施例のフラッシュメモリ素子１６００はシリコン基板１６０１上に形成されており、前記シリコン基板１６０１上に形成されたトンネル酸化膜１６０２と、前記トンネル酸化膜１６０２上に形成されフローティングゲート電極を構成する第１のポリシリコンゲート電極１６０３とを含み、前記第１のポリシリコンゲート電極１６０３上にはシリコン窒化膜１６０４と、シリコン酸化膜１６０５とが順次形成されている。さらに、前記シリコン酸化膜１６０５上にはコントロールゲート電極となる第２ポリシリコンゲート電極１６０６が形成されている。
【０１５６】
図２６中、ソ一ス領域、ドレイン領域、コンタクトホール、配線パターンなどの図示は省略して記載している。
【０１５７】
図２６のフラッシュメモリ１６００において、前記シリコン酸化膜１６０２、１６０５は上に説明したシリコン酸化膜形成方法により、また、シリコン窒化膜１６０４は上に説明したシリコン窒化膜形成方法により形成される。
【０１５８】
次に本実施例によるフラッシュメモリ集積回路の製造方法を説明する。
【０１５９】
本実施例においても前記第１のポリシリコン層１６０３をパターニングするまでは、実施例１と同様で、前記第１のポリシリコン層１６０３を領域Ａに形成した後、前記第１のポリシリコン層１６０３上にシリコン窒化膜及びシリコン酸化膜を順次形成してＮＯ構造を有する絶縁体膜を形成する。
【０１６０】
より詳細に説明すると、前記ＮＯ膜は、図２のマイクロ波プラズマ処理装置を使って次のようにして形成される。
【０１６１】
真空容器（処理室）１０１内を真空にし、シャワープレート１０２からＫｒガス、Ｎ2ガス、Ｈ2ガスを導入し、処理室内の圧力を１００ｍＴｏｒｒ（約１３Ｐａ）程度に設定する。この状態で２．４５ＧＨｚのマイクロ波を供給し、処理室内に高密度のプラズマを生成して、前記ポリシリコン層１６０３の窒化反応により約３ｎｍの厚さのシリコン窒化膜を形成する。
【０１６２】
次に、ＣＶＤ法によりシリコン酸化膜を約２ｎｍの厚さに形成し、再び前記マイクロ波プラズマ処理装置において前記シャワープレート１０２からＫｒガスおよびＯ2ガスを導入し、処理室内の圧力を１Ｔｏｒｒ（約１３３Ｐａ）程度に設定する。この状態で周波数が２．４５ＧＨｚのマイクロ波を供給することにより、処理室内に高密度のプラズマを生成し、ＣＶＤ法で形成した酸化膜を、前記高密度プラズマに伴う原子状酸素Ｏ*に曝す。その結果、前記ＣＶＤ酸化膜は緻密なシリコン酸化膜に変換される。
【０１６３】
このようにして形成されたＮＯ膜は約５ｎｍの厚さを有するが、ポリシリコンの面方位依存も見られず、極めて均一な膜厚であった。前記ＮＯ膜は、このようにして形成された後、パターニングされ、高電圧用及び低電圧用トランジスタ領域Ｂ、Ｃに形成された部分が選択的に除去される。
【０１６４】
さらに引き続き、図２４の工程と同様の工程を行い、素子を完成させた。
【０１６５】
このようにして形成されたフラッシュメモリ素子は優れた低リーク特性をもっており、書き込み消去を５Ｖ程度の低電圧で行うことが可能で、先の実施例のフラッシュメモリ素子と同様に、メモリ保持時間を従来より１桁以上、書き換え可能回数を約１桁以上増すことが出来る。
【０１６６】
以上の実施例に示したメモリセル、高電圧用トランジスタ、低電圧用トランジスタの形成方法はあくまで一例であり、本発明はこれらに限定されるものではない。本発明の窒化膜形成にはＫｒの代わりにＡｒを用いてもよく、また前記第１および第２のポリシリコン層の代わりに、ポリシリコン／シリサイド、ポリシリコン／高融点金属／アモルファスシリコンまたはポリシリコンなどの積層構造を有する膜を使うことも可能である。
【０１６７】
また、本発明の酸化膜・窒化膜を実現するためには、図２のマイクロ波プラズマ処理装置の他に、プラズマを用いた低温の酸化膜形成を可能とする別のプラズマプロセス用装置を使用してもかまわない。本発明の実施例ではラジアルラインスロットアンテナを用いたプラズマ装置を用いて成膜した例を示したが、他の方法を用いてマイクロ波を処理室内に導入してもよい。
【０１６８】
また、図２のマイクロ波プラズマ処理装置の代わりに、ＫｒガスあるいはＡｒガス等のプラズマガスを第１のシャワープレートより放出し、処理ガスを前記第１のガス放出部とは異なる第２のシャワープレートから放出する２段シャワープレート型プラズマプロセス装置を使うことも可能である。この場合は、例えば酸素ガスを前記第２のシャワープレートより放出するようにしてもよい。また、前記第１のポリシリコン電極によりフラッシュメモリ素子のフローティングゲート電極を形成すると同時に、同じ第１のポリシリコン電極により、高電圧用トランジスタのゲート電極が形成されるようにプロセスを設計することも可能である。
【０１６９】
以上、本発明を好ましい実施例について説明したが、本発明はかかる特定の実施例に限定されるものではなく、本発明の要旨内において様々な変形・変更が可能である。
【０１７０】
以上、本発明を好ましい実施形態について説明したが、本発明はかかる特定の実施形態に限定されるものではなく、特許請求の範囲に記載した要旨内において様々な変形・変更が可能である。
【符号の説明】
【０１７１】
１０１  処理室
１０２  シャワープレート
１０３  被処理基板
１０４  加熱機構を持つ試料台
１０５  同軸導波管
１０６  ラジアルラインスロットアンテナ
１０７  マイクロ波導入窓
１２０  ＣＶＤ装置
１２１  処理室１２１
１２１Ａ  排気ポート
１２１Ｂ  ポンプ
１２２Ａ，１２２Ｂ  マイクロ波窓
１２３Ａ，１２３Ｂ  マイクロ波アンテナ
１２３Ｃ  ホーンアンテナ
１２４  ステージ
１２４Ａ  ヒータ
１２５  被処理基板
１２６  シャワープレート
１２６Ａ，１２７Ａ  ライン
１２７  ガス導入ポート
１３０  スパッタ装置
１３１  ターゲット
１３１Ａ  高周波電源
１３２  マグネット
１３３  ガス導入ポート
２０１，３０１，４０１，５０１，６０１，７０１，１００１  シリコン基板
２０２  絶縁膜
２０３  ポリシリコン膜
２０４，３０２，４０２，５０２，１００２  シリコン酸化膜
２０５，７０２，１００４  シリコン窒化膜
２０６  酸窒化膜
４０３，５０３  Ｐｔ電極層
４０４，７０３  高誘電体膜
５０４  強誘電体膜
６０２  低誘電率膜
７０３Ａ  窒化膜
７０４  フローティングゲート
１０００  フラッシュメモリ素子
１００３  ポリシリコン電極
１００５  シリコン酸化膜
１００６  シリコン窒化膜
１００７  シリコン酸化膜
１００８  ポリシリコン電極
１１０１  シリコン基板
１１０２  フィールド酸化膜
１１０３  シリコン酸化膜
１１０４  シリコン酸化膜
１１０５  ポリシリコン電極
１１０６  ＮＯＮＯ膜
１１０７  シリコン酸化膜
１１０８  シリコン酸化膜
１１０９  ポリシリコン電極
１１１０  シリサイド電極
１１１１Ａ  フラッシュメモリセル
１１１１Ｂ  高電圧用トランジスタ電極
１１１１Ｃ  低電圧用トランジスタ電極
１５０１  シリコン基板
１５０２  トンネル酸化膜
１５０３  ポリシリコンゲート電極
１５０４  シリコン酸化膜
１５０５  シリコン窒化膜
１５０６  シリコン酸化膜
１５０７  第２ポリシリコンゲート電極
１６０１  シリコン基板
１６０２  トンネル酸化膜
１６０３  ポリシリコンゲート電極
１６０４  シリコン窒化膜
１６０５  シリコン酸化膜
１６０６  第２ポリシリコンゲート電極
【図３】
0005386515.tif 000002
【図４】
0005386515.tif 000003
【図５】
0005386515.tif 000004
【図６】
0005386515.tif 000005
【図７】
0005386515.tif 000006
【図８Ａ】
0005386515.tif 000007
【図８Ｂ】
0005386515.tif 000008
【図９】
0005386515.tif 000009
【図１０】
0005386515.tif 000010
【図１１Ａ】
0005386515.tif 000011
【図１１Ｂ】
0005386515.tif 000012
【図１２Ａ】
0005386515.tif 000013
【図１２Ｂ】
0005386515.tif 000014
【図１３】
0005386515.tif 000015
【図１４Ａ】
0005386515.tif 000016
【図１４Ｂ】
0005386515.tif 000017
【図１５Ａ】
0005386515.tif 000018
【図１５Ｂ】
0005386515.tif 000019
【図１６Ａ】
0005386515.tif 000020
【図１６Ｂ】
0005386515.tif 000021
【図１７Ａ】
0005386515.tif 000022
【図１７Ｂ】
0005386515.tif 000023
【図１７Ｃ】
0005386515.tif 000024
【図１７Ｄ】
0005386515.tif 000025
【図１７Ｅ】
0005386515.tif 000026
【図１８】
0005386515.tif 000027
【図１９】
0005386515.tif 000028
【図２１】
0005386515.tif 000029
【図２２】
0005386515.tif 000030
【図２３】
0005386515.tif 000031
【図２４】
0005386515.tif 000032
【図１】
0005386515.tif 000033
【図２】
0005386515.tif 000034
【図２０】
0005386515.tif 000035
【図２５】
0005386515.tif 000036
【図２６】
0005386515.tif 000037