(57)【特許請求の範囲】
【請求項１】
第１の半導体ウエハーに、前記第１の半導体ウエハーの一つの面から一導電型を付与する不純物元素を添加して不純物領域を形成し、
前記不純物元素を添加した前記第１の半導体ウエハーの一つの面からハロゲンイオンを照射し、その後Ｈ＋、Ｈ２＋及びＨ３＋イオンを含むとともに前記Ｈ３＋イオンが５０％以上と最も多く含む水素イオンを照射して、前記第１の半導体ウエハーの一つの面から前記不純物領域より下方に脆化層を形成し、
前記第１の半導体ウエハーの一つの面上、又は第２の半導体ウエハー上の少なくともどちらか一方に絶縁層を形成し、
前記第１の半導体ウエハーと前記第２の半導体ウエハーを、前記絶縁層を挟んで重ね合わせた状態で、前記脆化層に亀裂を生じさせ、前記第１の半導体ウエハーを前記脆化層で分離する熱処理を行って前記不純物領域を含む単結晶半導体層を前記第２の半導体ウエハー上に形成し、
前記単結晶半導体層の前記不純物領域をチャネル形成領域に用いて電界効果トランジスタを形成することを特徴とする半導体装置の作製方法。
【請求項２】
請求項１において、
前記第１の半導体ウエハーの一つの面上に保護層を形成し、前記第１の半導体ウエハーに、前記第１の半導体ウエハーの一つの面上に形成された前記保護層から一導電型を付与する不純物元素を添加して不純物領域を形成することを特徴とする半導体装置の作製方法。
【請求項３】
第１の半導体ウエハーに、前記第１の半導体ウエハーの一つの面からハロゲンイオンを照射し、その後Ｈ＋、Ｈ２＋及びＨ３＋イオンを含むとともに前記Ｈ３＋イオンが５０％以上と最も多く含む水素イオンを照射して、前記第１の半導体ウエハーの一つの面から一定の深さに脆化層を形成し、
前記第１の半導体ウエハーの一つの面から一導電型を付与する不純物元素を添加して、前記第１の半導体ウエハーの一つの面と前記脆化層との間に不純物領域を形成し、
前記第１の半導体ウエハーの一つの面上、又は第２の半導体ウエハー上の少なくともどちらか一方に絶縁層を形成し、
前記第１の半導体ウエハーと前記第２の半導体ウエハーを、前記絶縁層を挟んで重ね合わせた状態で、前記脆化層に亀裂を生じさせ、前記第１の半導体ウエハーを前記脆化層で分離する熱処理を行って前記不純物領域を含む単結晶半導体層を前記第２の半導体ウエハー上に形成し、
前記単結晶半導体層の前記不純物領域をチャネル形成領域に用いて電界効果トランジスタを形成することを特徴とする半導体装置の作製方法。
【請求項４】
請求項３において、
前記第１の半導体ウエハーの一つの面上に保護層を形成し、前記第１の半導体ウエハーに、前記第１の半導体ウエハーの一つの面上に形成された前記保護層からイオンを照射して、前記第１の半導体ウエハーの一つの面から一定の深さに脆化層を形成することを特徴とする半導体装置の作製方法。
【請求項５】
請求項２又は請求項４において、
前記保護層は、窒化シリコン層、酸化シリコン層、窒化酸化シリコン層、又は酸化窒化シリコン層から選ばれた一層又は複数の層による積層構造とすることを特徴とする半導体装置の作製方法。
【請求項６】
請求項１乃至５のいずれか一項において、
前記一導電型を付与する不純物元素を、前記第１の半導体ウエハーにマスクを用いて選択的に添加することを特徴とする半導体装置の作製方法。
【請求項７】
請求項１乃至６のいずれか一項において、
前記不純物領域として異なる不純物濃度を有する複数の不純物領域を形成することを特徴とする半導体装置の作製方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は絶縁層上に単結晶半導体層が設けられた所謂ＳＯＩ（Ｓｉｌｉｃｏｎ  ｏｎ  Ｉｎｓｕｌａｔｏｒ）構造を有する半導体装置の作製方法に関する。
【背景技術】
【０００２】
単結晶半導体のインゴットを薄くスライスして作製されるシリコンウエハーに代わり、絶縁層上に薄い単結晶半導体層を設けたシリコン・オン・インシュレータ（以下、「ＳＯＩ」ともいう）と呼ばれる技術を使った集積回路が開発されている。ＳＯＩ構造は、単結晶半導体基板中に酸化シリコン層が埋め込まれ、その上に単結晶半導体層が存在する構造である。このＳＯＩ構造を有する基板をＳＯＩ基板とも呼ぶ。ＳＯＩ基板を使った集積回路は、トランジスタと基板間における寄生容量を低減し、半導体集積回路の性能を向上させるものとして注目を集めている。
【０００３】
トランジスタは、ある特定の電圧（しきい値またはしきい値電圧と呼ばれる）がゲート電極に印加されるとオン状態となり、それ未満の電圧ではオフ状態となるスイッチング素子である。従って、しきい値電圧の精密な制御は回路の正確な動作を行う上で非常に重要である。
【０００４】
ところが汚染による可動イオンの影響、トランジスタのゲート周辺の仕事関数差や界面電荷における影響などの不特定な要因によってトランジスタのしきい値電圧がマイナス側或いはプラス側へ移動（シフト）することがある。
【０００５】
その様な時の解決手段として提案された技術にチャネルドープ法がある。チャネルドープ法とはトランジスタの少なくともチャネル形成領域に対して一導電性を付与する不純物元素（典型的にはＰ、Ａｓ、Ｂなど）を添加し、しきい値電圧を意図的にシフトさせて制御する技術である（例えば、特許文献１参照。）。
【特許文献１】特開２００３−２５７９９２号公報
【発明の開示】
【発明が解決しようとする課題】
【０００６】
しかし、半導体装置に作製されるトランジスタには、ｎチャネル型トランジスタやｐチャネル型トランジスタといった導電型が異なるものがあり、用いられる用途によって要求される電気的特性や機能が様々に異なっている。よって、それぞれの必要とされる機能に応じたトランジスタの電気特性の制御をする必要がある。
【０００７】
本発明は、必要とされる機能に応じてトランジスタの電気特性を制御し、半導体装置の高性能化、低消費電力化を図ることを目的の一とする。また、そのような半導体装置を、作製工程を複雑化することなく、高い歩留まりで生産性よく作製することを目的の一とする。
【課題を解決するための手段】
【０００８】
ＳＯＩ構造を有する半導体装置の作製において、半導体装置に含まれるトランジスタのしきい値電圧を制御するための不純物元素の添加を、第１の半導体ウエハーよりトランジスタの半導体層を分離し、第２の半導体ウエハー上に転載する前に、第１の半導体ウエハーへ行う。本発明においてトランジスタとは、電界効果型トランジスタである。なお、本明細書では、トランジスタのしきい値電圧を制御するための一導電型の不純物元素の添加をチャネルドープ工程ともいい、チャネルドープ工程によってチャネル形成領域に形成される不純物領域をチャネルドープ領域ともいう。
【０００９】
第１の半導体ウエハーより単結晶半導体層を分離するためには、第１の半導体ウエハーにイオンを照射して第１の半導体ウエハー表面より一定の深さに脆化層を形成する。単結晶半導体層として第１の半導体ウエハーより分離されるのは、イオンを照射した第１の半導体ウエハー表面より脆化層までの領域であるので、該領域に少なくともチャネルドープ工程を行う。チャネルドープ工程は第１の半導体ウエハーより単結晶半導体層が分離される前であればよいので、脆化層の形成前でも形成後でもよい。
【００１０】
しきい値電圧を制御するための不純物元素の添加工程（チャネルドープ工程）は、イオンドーピング法やイオン注入法を用いて行えばよい。
【００１１】
第１の半導体ウエハーより、単結晶半導体層が第２の半導体ウエハーへ分離及び接合により転載される工程における加熱処理によって、一導電型の不純物元素が添加された不純物領域の活性化も同時に行うことができる。そのため、チャネルドープ工程で添加された不純物元素の活性化のための加熱工程を増加する必要がない。
【００１２】
第１の半導体ウエハーより単結晶半導体層を分離し、第２の半導体ウエハーに転載された単結晶半導体層において単結晶半導体層はチャネルドープ工程により不純物元素を添加された面を第２の半導体ウエハー側にして、第１の半導体ウエハーより分離し、第２の半導体ウエハーに転載される。従って、第２の半導体ウエハー上に転載された単結晶半導体層表面（不純物元素を添加した面とは逆の面）はチャネルドープ工程におけるダメージ（表面あれや汚染物の混入など）を回避することができる。
【００１３】
本明細書において、第１の半導体ウエハーより単結晶半導体層を分離させ、第２の半導体ウエハーに接合して設けることを、単結晶半導体層を第１の半導体ウエハーより第２の半導体ウエハーに転載（転置ともいう）するという。従って、本発明において、トランジスタは第２の半導体ウエハー上に第１の半導体ウエハーより転載された単結晶半導体層を含む。なお、転載された単結晶半導体層は、第２の半導体ウエハーに転載される前に第１の半導体ウエハーにおいてチャネルドープ工程を行った、不純物領域を有する単結晶半導体層である。
【００１４】
チャネルドープ工程において、添加する一導電性を付与する不純物元素としては、ｎ型を付与する不純物元素（代表的にはリン（Ｐ）、ヒ素（Ａｓ）など）、ｐ型を付与する不純物元素（代表的にはボロン（Ｂ）、アルミニウム（Ａｌ）、ガリウム（Ｇａ）など）を用いることができる。１種類の不純物元素を用いてもよいし、導電型の異なる複数種の不純物元素を用いてもよい。添加工程は、一回でおこなってもよいし、複数回行ってもよい。また、マスクを用いて第１の半導体ウエハーに選択的に不純物元素の添加を行い、不純物濃度の異なる不純物領域を形成してもよい。作製するトランジスタの導電型に合わせて、異なる導電型を付与する不純物元素を選択的に添加し、第１の半導体ウエハーに異なる導電型の不純物領域を形成してもよい。
【００１５】
例えば、界面電荷における影響を考慮する場合、しきい値電圧はキャリアが電子であるｎチャネル型トランジスタではマイナス側へ、キャリアが正孔であるｐチャネルトランジスタではプラス側へシフトしやすい。このような場合はトランジスタのしきい値電圧の制御を目的としてチャネル形成領域に添加される一導電型を付与する不純物元素は、そのトランジスタのソース領域及びドレイン領域と逆導電型を用いればよい。例えば、しきい値電圧がマイナスシフトしたｎチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｐ型を付与する不純物元素を用いることができる。またしきい値電圧がプラスシフトしたｐチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｎ型を付与する不純物元素を用いることができる。
【００１６】
第１の半導体ウエハーにおいてしきい値電圧制御のための不純物元素の添加工程を行うと、不純物領域における濃度プロファイルを選択性広く自由に設定することができる。例えば、添加する第１の半導体ウエハー表面近くに濃度のピークがくるように不純物元素を添加し、第１の半導体ウエハーより下地膜となる絶縁膜が設けられた第２の半導体ウエハーへ転載した場合、絶縁膜との界面近くに高濃度に不純物元素が添加された単結晶半導体層を形成することができる。
【００１７】
第１の半導体ウエハーでのチャネルドープ領域（一導電型を付与する不純物元素の添加領域）は、第１の半導体ウエハーより単結晶半導体層が第２の半導体ウエハーに転載され、トランジスタを形成する際そのトランジスタのチャネル形成領域が含まれればよい。よって、チャネルドープ領域は不純物元素を添加する第１の半導体ウエハー表面より脆化層の間の領域を含む。第１の半導体ウエハー表面より脆化層の間の膜厚方向全体に添加してもよいし、一部に添加してもよい。また、第１の半導体ウエハーにおいて、チャネルドープ領域の一部が、脆化層より下方の領域まで形成されてもよい。
【００１８】
本発明の半導体装置の作製方法の一形態は、第１の半導体ウエハーに、第１の半導体ウエハーの一つの面から一導電型を付与する不純物元素を添加して不純物領域を形成する。不純物元素を添加した第１の半導体ウエハーの一つの面からイオンを照射して、第１の半導体ウエハーの一つの面から不純物領域より下方に脆化層を形成する。第１の半導体ウエハーの一つの面上、又は第２の半導体ウエハー上のどちらか一方に絶縁層を形成する。第１の半導体ウエハーと第２の半導体ウエハーを、絶縁層を挟んで重ね合わせた状態で、脆化層に亀裂を生じさせ、第１の半導体ウエハーを脆化層で分離する熱処理を行い、第１の半導体ウエハーより不純物領域を含んで単結晶半導体層を第２の半導体ウエハー上に形成する。単結晶半導体層の不純物領域をチャネル形成領域に用いて電界効果トランジスタを形成する。
【００１９】
本発明の半導体装置の作製方法の一形態は、第１の半導体ウエハーに、第１の半導体ウエハーの一つの面からイオンを照射して、第１の半導体ウエハーの一つの面から一定の深さに脆化層を形成する。第１の半導体ウエハーの一つの面から一導電型を付与する不純物元素を添加して、第１の半導体ウエハーの一つの面と脆化層との間に不純物領域を形成する。第１の半導体ウエハーの一つの面上、又は第２の半導体ウエハー上のどちらか一方に絶縁層を形成する。第１の半導体ウエハーと第２の半導体ウエハーを、絶縁層を挟んで重ね合わせた状態で、脆化層に亀裂を生じさせ、第１の半導体ウエハーを脆化層で分離する熱処理を行い、第１の半導体ウエハーより不純物領域を含んで単結晶半導体層を第２の半導体ウエハー上に形成する。単結晶半導体層の不純物領域をチャネル形成領域に用いて電界効果トランジスタを形成する。
【００２０】
第１の半導体ウエハーより第２の半導体ウエハーへ転載された単結晶半導体層に対して、エッチング処理や研磨処理などを行ってもよいが、作製するトランジスタのチャネル形成領域に用いる領域がチャネルドープ領域となるように行う。
【００２１】
また、第１の半導体ウエハーと接合面を有する絶縁層との間に、保護層を形成してもよい。保護層は、窒化シリコン層、酸化シリコン層、窒化酸化シリコン層、又は酸化窒化シリコン層から選ばれた一層又は複数の層による積層構造により形成することができる。これらの層は、第１の半導体ウエハーに脆化層及び不純物領域が形成される前に第１の半導体ウエハー上に形成することができる。また、第１の半導体ウエハーに脆化層及び不純物領域を形成した後に第１の半導体ウエハー上に形成してもよい。
【発明の効果】
【００２２】
本発明は、第１の半導体ウエハーにおけるチャネルドープ工程により、第２の半導体ウエハー上に必要とされる機能に応じてトランジスタの電気特性を制御し、半導体装置の高性能化、低消費電力化を図ることができる。また、そのような半導体装置を、作製工程を複雑化することなく、高い歩留まりで生産性よく作製することができる。
【発明を実施するための最良の形態】
【００２３】
本発明の実施の形態について、図面を用いて詳細に説明する。但し、本発明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する本発明の構成において、同一部分又は同様な機能を有する部分には同一の符号を異なる図面間で共通して用い、その繰り返しの説明は省略する。
【００２４】
（実施の形態１）
本発明の半導体装置の製造方法について、図１乃至図４を参照して説明する。
【００２５】
本実施の形態では、半導体装置に含まれるトランジスタのしきい値電圧を制御するための不純物元素の添加を、第１の半導体ウエハーよりトランジスタのための単結晶半導体層を分離し、第２の半導体ウエハー上に転載する前に、第１の半導体ウエハーへ行う。第１の半導体ウエハーとしてシリコンウエハーを適用し、第２の半導体ウエハー上に第１の半導体ウエハーから分離、接合される単結晶半導体層として単結晶シリコン層を形成するのが好ましい。
【００２６】
まず、第２の半導体ウエハー上に、第１の半導体ウエハー（半導体基板ともいう）より単結晶半導体層を設ける方法を図１乃至図４を用いて説明する。
【００２７】
図１（Ａ）に清浄化された第１の半導体ウエハー１０８を示す。第１の半導体ウエハー１０８として、シリコンウエハーやゲルマニウムウエハーなどの半導体ウエハー、ガリウムヒ素やインジウムリンなどの化合物半導体ウエハーを適用する。第１の半導体ウエハー１０８は単結晶半導体ウエハーを適用するのが好ましいが、多結晶半導体ウエハーを適用してもよい。結晶格子に歪みを有するシリコン、シリコンに対しゲルマニウムが添加されたシリコンゲルマニウムなどの半導体ウエハーを用いていても良い。歪みを有するシリコンは、シリコンよりも格子定数の大きいシリコンゲルマニウムまたは窒化珪素上における成膜により、形成することができる。第２の半導体ウエハー上に得られる単結晶半導体層は母体となる半導体ウエハーを選択することによって決定することができる。
【００２８】
また、第１の半導体ウエハー１０８は、作製する半導体素子（本実施の形態においては電界効果トランジスタ）によって、結晶面方位を選択すればよい。例えば、結晶面方位として｛１００｝面、｛１１０｝面など有する半導体ウエハーを用いることができる。
【００２９】
第１の半導体ウエハー１０８の表面から電界で加速されたイオン１４２を所定の深さに照射し、脆化層１１０を形成する（図１（Ｂ）参照。）。イオン１４２の照射は第２の半導体ウエハーに転置する単結晶半導体層の厚さを考慮して行われる。イオン１４２を照射する際の加速電圧はこのような厚さを考慮して、第１の半導体ウエハー１０８に照射されるようにする。
【００３０】
本実施の形態は、第１の半導体ウエハーの所定の深さに水素、ヘリウム、又はフッ素をイオン照射し、その後熱処理を行って表層の単結晶半導体層を剥離するイオン照射剥離法で形成するが、ポーラスシリコン上に単結晶シリコンをエピタキシャル成長させた後、ポーラスシリコン層をウオータージェットで劈開して剥離する方法を適用しても良い。
【００３１】
例えば、第１の半導体ウエハー１０８として単結晶シリコン基板を用い、希フッ酸で表面を処理し、自然酸化膜の除去と表面に付着するゴミ等の汚染物も除去して第１の半導体ウエハー１０８表面を清浄化する。
【００３２】
脆化層１１０は、イオンをイオンドーピング法（ＩＤ法と略記する）やイオン注入法（ＩＩ法と略記する）によって照射すればよい。脆化層１１０は水素、ヘリウム若しくはフッ素に代表されるハロゲンのイオンを照射することで形成される。ハロゲン元素としてフッ素イオンを照射する場合にはソースガスとしてＢＦ３を用いれば良い。なお、イオン注入法とはイオン化したガスを質量分離して半導体に照射する方式をいう。
【００３３】
例えば、イオン注入法を用いて、イオン化した水素ガスを質量分離し、Ｈ＋のみを選択的に加速して照射すると、他の質量のイオンを照射するのと比べて同エネルギーで深く第１の半導体ウエハー中に添加され、ブロードな濃度プロファイルを有する。
【００３４】
イオンドープ法は、イオン化したガスを質量分離せずに、プラズマ中で複数種のイオン種を作り、それらを加速して第１の半導体ウエハーにドープする。例えば、Ｈ＋、Ｈ２＋、Ｈ３＋イオンを含む水素では、ドープされるイオンは、代表的にＨ３＋イオンが５０％以上、例えばＨ３＋イオンが８０％、他のイオン（Ｈ＋、Ｈ２＋イオン）が２０％、が一般的である。Ｈ３＋イオンのイオン種のみとして添加することもここではイオンドープとする。すなわち質量が大きいため同じ加速エネルギーで浅く多量にＨ３＋イオンを第１の半導体ウエハー中に添加することができ、急峻な濃度プロファイルを有する。
【００３５】
単結晶シリコン基板にフッ素イオンのようなハロゲンイオンをイオン照射法で照射した場合、添加されたフッ素が、シリコン結晶格子内のシリコン原子をノックアウトする（追い出す）ことによって空白部分を効果的に作り出し、脆化層に微小な空洞を作る。この場合、比較的低温の熱処理によって脆化層に形成された微小な空洞の体積変化が起こり、脆化層に沿って劈開することにより薄い単結晶半導体層を形成することができる。フッ素イオンを照射した後に、水素イオンを照射して空洞内に水素を含ませるようにしても良い。第１の半導体ウエハーから薄い単結晶半導体層を剥離するために形成する脆化層は、脆化層に形成された微小な空洞の体積変化を利用して劈開をするので、このようにフッ素イオンや水素イオンの作用を有効利用することが好ましい。
【００３６】
また、一又は複数の同一の原子から成る質量の異なるイオンを照射してもよい。例えば、水素イオンを照射する場合には、Ｈ＋、Ｈ２＋、Ｈ３＋イオンを含ませると共に、Ｈ３＋イオンの割合を高めておくことが好ましい。水素イオンを照射する場合には、Ｈ＋、Ｈ２＋、Ｈ３＋イオンを含ませると共に、Ｈ３＋イオンの割合を高めておくと添加効率を高めることができ、照射時間を短縮することができる。このような構成とすることで、剥離を容易に行うことができる。
【００３７】
次に第１の半導体ウエハー１０８へ、分離する単結晶半導体層を用いて形成するトランジスタのしきい値電圧の制御をするためにチャネルドープ工程を行う。チャネルドープ工程は、イオンドーピング法やイオン注入法を用いて行えばよい。単結晶半導体層として第１の半導体ウエハー１０８より分離されるのは、イオンを照射した第１の半導体ウエハー１０８表面より脆化層１１０までの領域であるので、該領域に少なくともチャネルドープ工程を行う。第１の半導体ウエハー１０８に一導電型を付与する不純物元素１４１を添加し、不純物領域（チャネルドープ領域）１４０を形成する（図１（Ｃ）参照。）。
【００３８】
チャネルドープ工程は第１の半導体ウエハーより単結晶半導体層が分離される前であればよいので、脆化層の形成前でも形成後でもよい。脆化層１１０の形成前にチャネルドープ工程を行う例を図２に示す。
【００３９】
図２（Ａ）に清浄化された第１の半導体ウエハー１０８を示す。第１の半導体ウエハー１０８へ一導電型を付与する不純物元素１４１を添加し、第１の半導体ウエハー１０８表面近くに不純物領域（チャネルドープ領域）１４０を形成する（図２（Ｂ）参照。）。その後、不純物領域１４０の形成された第１の半導体ウエハー１０８にイオン１４２を照射し、脆化層１１０を形成する（図２（Ｃ）参照。）。
【００４０】
チャネルドープ工程において、添加する一導電性を付与する不純物元素としては、ｎ型を付与する不純物元素（代表的にはリン（Ｐ）、ヒ素（Ａｓ）など）、ｐ型を付与する不純物元素（代表的にはボロン（Ｂ）、アルミニウム（Ａｌ）、ガリウム（Ｇａ）など）を用いることができる。１種類の不純物元素を用いてもよいし、導電型の異なる複数種の不純物元素を用いてもよい。添加工程は、一回でおこなってもよいし、複数回行ってもよい。また、マスクを用いて第１の半導体ウエハーに選択的に不純物元素の添加を行い、不純物濃度の異なる不純物領域を形成してもよい。作製するトランジスタの導電型に合わせて、異なる導電型を付与する不純物元素を選択的に添加し、第１の半導体ウエハーに異なる導電型の不純物領域を形成してもよい。
【００４１】
例えば、界面電荷における影響を考慮する場合、しきい値電圧はキャリアが電子であるｎチャネル型トランジスタではマイナス側へ、キャリアが正孔であるｐチャネルトランジスタではプラス側へシフトしやすい。このような場合はトランジスタのしきい値電圧の制御を目的としてチャネル形成領域に添加される一導電型を付与する不純物元素は、そのトランジスタのソース領域及びドレイン領域と逆導電型を用いればよい。例えば、しきい値電圧がマイナスシフトしたｎチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｐ型を付与する不純物元素を用いることができる。またしきい値電圧がプラスシフトしたｐチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｎ型を付与する不純物元素を用いることができる。
【００４２】
第１の半導体ウエハーにおいてしきい値電圧制御のための不純物元素の添加工程を行うと、不純物領域における濃度プロファイルを選択性広く自由に設定することができる。例えば、添加する第１の半導体ウエハー表面近くに濃度のピークがくるように不純物元素を添加し、第１の半導体ウエハーより下地膜となる絶縁膜が設けられた第２の半導体ウエハーへ転載した場合、絶縁膜との界面近くに高濃度に不純物元素が添加された単結晶半導体層を形成することができる。
【００４３】
第１の半導体ウエハーへのチャネルドープ領域（一導電型を付与する不純物元素の添加領域）は、第１の半導体ウエハーより単結晶半導体層が第２の半導体ウエハーに転載され、トランジスタを形成する際そのトランジスタのチャネル形成領域が含まれればよい。よって、チャネルドープ領域は不純物元素を添加する第１の半導体ウエハー表面より脆化層の間の領域を含む。第１の半導体ウエハー表面より脆化層の間の膜厚方向全体に添加してもよいし、一部に添加してもよい。また、第１の半導体ウエハーにおいて、チャネルドープ領域の一部が、脆化層より下方の領域まで形成されてもよい。
【００４４】
本明細書において酸化窒化シリコン膜とは、その組成として、窒素よりも酸素の含有量が多いものであって、ラザフォード後方散乱法（ＲＢＳ：Ｒｕｔｈｅｒｆｏｒｄ  Ｂａｃｋｓｃａｔｔｅｒｉｎｇ  Ｓｐｅｃｔｒｏｍｅｔｒｙ）及び水素前方散乱法（ＨＦＳ：Ｈｙｄｒｏｇｅｎ  Ｆｏｒｗａｒｄ  Ｓｃａｔｔｅｒｉｎｇ）を用いて測定した場合に、濃度範囲として酸素が５０〜７０原子％、窒素が０．５〜１５原子％、Ｓｉが２５〜３５原子％、水素が０．１〜１０原子％の範囲で含まれるものをいう。また、窒化酸化シリコン膜とは、その組成として、酸素よりも窒素の含有量が多いものであって、ＲＢＳ及びＨＦＳを用いて測定した場合に、濃度範囲として酸素が５〜３０原子％、窒素が２０〜５５原子％、Ｓｉが２５〜３５原子％、水素が１０〜３０原子％の範囲で含まれるものをいう。但し、酸化窒化シリコンまたは窒化酸化シリコンを構成する原子の合計を１００原子％としたとき、窒素、酸素、Ｓｉ及び水素の含有比率が上記の範囲内に含まれるものとする。
【００４５】
また、第１の半導体ウエハーと上記単結晶半導体層と接合する絶縁層との間に、保護層を形成してもよい。保護層は、窒化シリコン層、酸化シリコン層、窒化酸化シリコン層、又は酸化窒化シリコン層から選ばれた一層又は複数の層による積層構造により形成することができる。これらの層は、第１の半導体ウエハーに脆化層及びチャネルドープ工程による不純物領域が形成される前に第１の半導体ウエハー上に形成することができる。また、第１の半導体ウエハーに脆化層及びチャネルドープ工程による不純物領域を形成した後に第１の半導体ウエハー上に形成してもよい。
【００４６】
脆化層の形成に当たってはイオンを高ドーズ条件で照射する必要があり、第１の半導体ウエハー１０８の表面が粗くなってしまう場合がある。そのためイオンが照射される表面に窒化シリコン膜、窒化酸化シリコン膜、若しくは酸化シリコン膜などによりイオン照射に対する保護層を５０ｎｍ乃至２００ｎｍの厚さで設けておいても良い。
【００４７】
例えば、第１の半導体ウエハー１０８上に保護層としてプラズマＣＶＤ法により酸化窒化シリコン膜（膜厚５ｎｍ〜３００ｎｍ、望ましくは３０ｎｍ〜１５０ｎｍ（例えば５０ｎｍ））と窒化酸化シリコン膜（膜厚５ｎｍ〜１５０ｎｍ、望ましくは１０ｎｍ〜１００ｎｍ（例えば５０ｎｍ））の積層を形成する。一例としては、第１の半導体ウエハー１０８上に酸化窒化シリコン膜を膜厚５０ｎｍ形成し、該酸化窒化シリコン膜上に窒化酸化シリコン膜を膜厚５０ｎｍ形成し、積層する。酸化窒化シリコン膜は有機シランガスを用いて化学気相成長法により作製される酸化シリコン膜でもよい。
【００４８】
また、第１の半導体ウエハー１０８を脱脂洗浄し、表面の酸化膜を除去して熱酸化を行ってもよい。熱酸化としては通常のドライ酸化でも良いが、酸化雰囲気中にハロゲンを添加した酸化を行うことが好ましい。例えば、酸素に対しＨＣｌを０．５〜１０体積％（好ましくは３体積％）の割合で含む雰囲気中で、７００℃以上の温度で熱処理を行う。好適には９５０℃〜１１００℃の温度で熱酸化を行うと良い。処理時間は０．１〜６時間、好ましくは０．５〜３．５時間とすれば良い。形成される酸化膜の膜厚としては、１０ｎｍ〜１０００ｎｍ（好ましくは５０ｎｍ〜２００ｎｍ）、例えば１００ｎｍの厚さとする。
【００４９】
ハロゲンを含むものとしてはＨＣｌの他に、ＨＦ、ＮＦ３、ＨＢｒ、Ｃｌ２、ＣｌＦ３、ＢＣｌ３、Ｆ２、Ｂｒ２などから選ばれた一種又は複数種を適用することができる。
【００５０】
このような温度範囲で熱処理を行うことで、ハロゲン元素によるゲッタリング効果を得ることができる。ゲッタリングとしては、特に金属不純物を除去する効果がある。すなわち、塩素の作用により、金属などの不純物が揮発性の塩化物となって気相中へ離脱して除去される。第１の半導体ウエハー１０８の表面を化学的機械研磨（ＣＭＰ）処理をしたものに対しては有効である。また、水素は第１の半導体ウエハー１０８と形成される酸化膜の界面の欠陥を補償して界面の局在準位密度を低減する作用を奏し、第１の半導体ウエハー１０８と酸化膜との界面が不活性化されて電気的特性が安定化する。
【００５１】
この熱処理により形成される酸化膜中にハロゲンを含ませることができる。ハロゲン元素は１×１０１７／ｃｍ３〜５×１０２０／ｃｍ３の濃度で含まれることにより金属などの不純物を捕獲して第１の半導体ウエハー１０８の汚染を防止する保護層としての機能を発現させることができる。
【００５２】
脆化層１１０を形成する際、加速電圧と全イオン数は、第１の半導体ウエハー上に堆積した膜の厚さと、目的とする第１の半導体ウエハーより分離して第２の半導体ウエハー上に転置される単結晶半導体層の膜厚と、照射するイオン種によって調整することができる。イオン種は、プラズマの生成方法、圧力、原料ガス供給量、加速電圧によっても変化する。
【００５３】
脆化層形成の例としては、第１の半導体ウエハー上に酸化窒化シリコン膜（膜厚５０ｎｍ）、窒化酸化シリコン膜（膜厚５０ｎｍ）、及び酸化シリコン膜（膜厚５０ｎｍ）を保護層として積層し、水素を加速電圧４０ｋＶ、ドーズ量２×１０１６ｉｏｎｓ／ｃｍ２で照射し第１の半導体ウエハーに脆化層を形成する。その後保護層の最上層である該酸化シリコン膜上に絶縁層として酸化シリコン膜（膜厚５０ｎｍ）を形成する。脆化層形成の他の例としては、第１の半導体ウエハー上に酸化シリコン膜（膜厚１００ｎｍ）、及び窒化酸化シリコン膜（膜厚５０ｎｍ）を保護層として積層し、水素を加速電圧４０ｋＶ、ドーズ量２×１０１６ｉｏｎｓ／ｃｍ２で照射し第１の半導体ウエハーに脆化層を形成する。その後保護層の最上層である該窒化酸化シリコン膜上に絶縁層として酸化シリコン膜（膜厚５０ｎｍ）を形成する。なお、上記酸化窒化シリコン膜及び窒化酸化シリコン膜はプラズマＣＶＤ法により形成すればよく、上記酸化シリコン膜は有機シランガスを用いてＣＶＤ法により形成すればよい。
【００５４】
窒化酸化シリコン膜は金属不純物が第１の半導体ウエハー側に拡散するのを防止する効果がある。なお、窒化酸化シリコン膜の代わりに、窒化シリコン膜を形成してもよい。第１の半導体ウエハーと窒化酸化シリコン膜との間に酸化窒化シリコン膜や酸化シリコン膜などの応力緩和層を設けるとよい。窒化酸化シリコン膜と酸化窒化シリコン膜の積層構造を設けることで、第１の半導体ウエハーへの不純物拡散を防止しつつ、応力歪みを緩和する構成とすることもできる。
【００５５】
第２の半導体ウエハーには、不純物元素の拡散を防止する窒化シリコン膜又は窒化酸化シリコン膜をブロッキング層（バリア層ともいう）として設けてもよい。さらに応力を緩和する作用のある絶縁膜として酸化窒化シリコン膜を組み合わせても良い。
【００５６】
次に、図３（Ａ）で示すように第２の半導体ウエハーと接合を形成する面に絶縁層１０４として酸化シリコン膜を形成する。酸化シリコン膜としては有機シランガスを用いて化学気相成長法により作製される酸化シリコン膜が好ましい。その他に、シランガスを用いて化学気相成長法により作製される酸化シリコン膜を適用することもできる。化学気相成長法による成膜では、単結晶半導体基板に形成した脆化層１１０から脱ガスが起こらない温度として、例えば３５０℃以下（具体的な例としては３００℃）の成膜温度が適用される。また、単結晶若しくは多結晶半導体ウエハーから半導体層を剥離する熱処理は、成膜温度よりも高い熱処理温度が適用される。
【００５７】
絶縁層１０４は平滑面を有し親水性表面を形成する。この絶縁層１０４として酸化シリコン膜が適している。特に有機シランガスを用いて化学気相成長法により作製される酸化シリコン膜が好ましい。有機シランガスとしては、珪酸エチル（ＴＥＯＳ：化学式Ｓｉ（ＯＣ２Ｈ５）４）、トリメチルシラン（ＴＭＳ：（ＣＨ３）３ＳｉＨ）、テトラメチルシラン（化学式Ｓｉ（ＣＨ３）４）、テトラメチルシクロテトラシロキサン（ＴＭＣＴＳ）、オクタメチルシクロテトラシロキサン（ＯＭＣＴＳ）、ヘキサメチルジシラザン（ＨＭＤＳ）、トリエトキシシラン（ＳｉＨ（ＯＣ２Ｈ５）３）、トリスジメチルアミノシラン（ＳｉＨ（Ｎ（ＣＨ３）２）３）等のシリコン含有化合物を用いることができる。なお、原料ガスに有機シランを用いて化学気相成長法により酸化シリコン層を形成する場合、酸素を付与するガスを混合させることが好ましい。酸素を付与するガスとしては、酸素、亜酸化窒素、二酸化窒素等を用いることができる。さらに、アルゴン、ヘリウム、窒素又は水素等の不活性ガスを混合させてもよい。
【００５８】
また、絶縁層１０４として、モノシラン、ジシラン、又はトリシラン等のシランを原料ガスに用いて化学気相成長法により形成される酸化シリコン膜を適用することもできる。この場合も、酸素を付与するガスや不活性ガス等を混合させることが好ましい。また、単結晶半導体層と接合する絶縁層となる酸化シリコン膜は、塩素を含んでいてもよい。化学気相成長法による成膜では、第１の半導体ウエハー１０８に形成した脆化層１１０から脱ガスが起こらない温度として、例えば３５０℃以下の成膜温度が適用される。また、単結晶若しくは多結晶の第１の半導体ウエハーから半導体層を剥離する熱処理は、成膜温度よりも高い熱処理温度が適用される。なお、本明細書において、化学気相成長（ＣＶＤ；Ｃｈｅｍｉｃａｌ  Ｖａｐｏｒ  Ｄｅｐｏｓｉｔｉｏｎ）法は、プラズマＣＶＤ法、熱ＣＶＤ法、光ＣＶＤ法を範疇に含む。
【００５９】
その他、絶縁層１０４として、酸化性雰囲気下において熱処理することにより形成される酸化シリコン、酸素ラジカルの反応により成長する酸化シリコン、酸化性の薬液により形成されるケミカルオキサイドなどを適用することもできる。絶縁層１０４として、シロキサン（Ｓｉ−Ｏ−Ｓｉ）結合を含む絶縁層を適用してもよい。また、前記有機シランガスと、酸素ラジカル又は窒素ラジカルとを反応させて絶縁層１０４を形成してもよい。
【００６０】
上記平滑面を有し親水性表面を形成する絶縁層１０４は５ｎｍ〜５００ｎｍ、望ましくは１０ｎｍ〜２００ｎｍの厚さで設けられる。この厚さであれば、被成膜表面の表面荒れを平滑化すると共に、当該膜の成長表面の平滑性を確保することが可能である。また、接合する第２の半導体ウエハーとの歪みを緩和することができる。
【００６１】
第２の半導体ウエハー１０１にも絶縁層１０４と同様の酸化シリコン膜を設けておいても良い。すなわち、第２の半導体ウエハー１０１に単結晶半導体層１０２を接合するに際し、接合を形成する面の一方若しくは双方に、好ましくは有機シランを原材料として成膜した酸化シリコン膜でなる絶縁層１０４を設けることで強固な接合を形成することができる。
【００６２】
図３（Ｂ）は第２の半導体ウエハー１０１と第１の半導体ウエハー１０８の絶縁層１０４が形成された面とを密接させ、この両者を接合させる態様を示す。接合を形成する面は、十分に清浄化しておく。第２の半導体ウエハー１０１と第１の半導体ウエハー１０８の絶縁層１０４が形成された面は、メガソニック洗浄などによって清浄化すればよい。また、メガソニック洗浄後にオゾン水で洗浄し、有機物の除去と表面の親水性向上を行ってもよい。
【００６３】
第２の半導体ウエハー１０１と絶縁層１０４を対向させて、一箇所を外部から押しつけると、局所的に接合面同士の距離が縮まる事によるファン・デル・ワールス力の強まりや水素結合の寄与によって、お互いに引きつけ合う。更に、隣接した領域でも対向する第２の半導体ウエハー１０１上と絶縁層１０４間の距離が縮まるので、ファン・デル・ワールス力が強く作用する領域や水素結合が関与する領域が広がる事によって、接合（ボンディングともいう）が進行し接合面全域に接合が広がる。例えば、押しつける圧力は、１００ｋＰａ〜５０００ｋＰａ程度とすればよい。また、第１の半導体ウエハーと第２の半導体ウエハーとを重ねるように配置し、重ねる基板の重みでも接合を広げることもできる。
【００６４】
良好な接合を形成するために、表面を活性化しておいても良い。例えば、接合を形成する面に原子ビーム若しくはイオンビームを照射する。原子ビーム若しくはイオンビームを利用する場合には、アルゴン等の不活性ガス中性原子ビーム若しくは不活性ガスイオンビームを用いることができる。その他に、プラズマ照射若しくはラジカル処理を行う。このような表面処理により低い温度であっても異種材料間の接合を形成することが容易となる。
【００６５】
また、第２の半導体ウエハーと絶縁層との接合界面の接合強度を向上させるために、加熱処理を行うと好ましい。例えば、オーブンや炉などで７０℃〜３５０℃（例えば２００℃で２時間）の温度条件で熱処理を行う。
【００６６】
図３（Ｃ）において、第２の半導体ウエハー１０１と第１の半導体ウエハー１０８を貼り合わせた後、加熱処理を行い脆化層１１０を劈開面として第１の半導体ウエハー１０８を第２の半導体ウエハー１０１から剥離する。例えば、４００℃〜７００℃の熱処理を行うことにより、脆化層１１０に形成された微小な空洞の体積変化が起こり、脆化層１１０に沿って劈開することが可能となる。絶縁層１０４は第２の半導体ウエハー１０１と接合しているので、第２の半導体ウエハー１０１上には第１の半導体ウエハー１０８と同じ結晶性の単結晶半導体層１０２が残存することとなる。熱処理の温度は接合面を有する絶縁層の成膜温度以上、半導体ウエハーの耐熱温度以下で行うことが好ましい。
【００６７】
第１の半導体ウエハーより、単結晶半導体層が第２の半導体ウエハーへ分離及び接合により転載される工程における加熱処理によって、一導電型の不純物元素が添加された不純物領域の活性化も同時に行うことができる。そのため、チャネルドープ工程で添加された不純物元素の活性化のための加熱工程を増加する必要がない。
【００６８】
本実施の形態は、第１の半導体ウエハー１０８及び第２の半導体ウエハー１０１に耐熱温度が高いシリコンウエハーを用いるので、１０００℃以上の（代表的には１００℃〜１３００℃）加熱処理を行うことができる。脆化層を形成するために行うイオン照射工程において、第１の半導体ウエハー１０８の単結晶半導体層は照射されるイオンによりダメージを受けてしまう。上記第１の半導体ウエハー１０８及び第２の半導体ウエハー１０１との接合強度を高める熱処理において、イオン照射工程による単結晶半導体層へのダメージの回復も行っている。さらに、第２の半導体ウエハー１０１上の単結晶半導体層に高温の加熱処理を行うことで表面の結晶性や平坦性の向上を行うことができる。
【００６９】
絶縁層として、プラズマＣＶＤ法により成膜した酸化シリコン膜を用いることにより、７００℃以下の温度で第１の半導体ウエハーと第２の半導体ウエハーとの接合を形成することができる。４００℃〜７００℃の温度域での熱処理は、前述の接合強度を向上させるための熱処理と同じ装置で連続して行ってもよいし、別の装置で行ってもよい。
【００７０】
熱処理を行った後は第２の半導体ウエハーと第１の半導体ウエハーは、一方が他方に載っている状態であり、大きな力を加えずに第２の半導体ウエハーと第１の半導体ウエハーを離すことができる。例えば、上方に載っている基板を真空チャックで持ち上げることにより簡単に離すことができる。この際、下側の基板の真空チャックやメカニカルチャックで固定しておくと水平方向のずれがなく第２の半導体ウエハー及び第１の半導体ウエハーの両基板を離すことができる。
【００７１】
なお、図３、図４においては、第１の半導体ウエハー１０８と第２の半導体ウエハー１０１とが同じサイズの例を示すが、本発明はそれに限定されず、第１の半導体ウエハー１０８が第２の半導体ウエハー１０１より小さいサイズであっても、第１の半導体ウエハー１０８が第２の半導体ウエハー１０１より大きいサイズであってもよい。
【００７２】
チャネルドープ工程における不純物元素の添加は、第１の半導体ウエハーに直接行ってもよいし、第１の半導体ウエハー上に保護層や接合に用いる絶縁層などを形成し、該絶縁層を介して添加してもよい。
【００７３】
図４は第２の半導体ウエハー側に単結晶半導体層と接合する絶縁層を設けて、不純物元素を含む単結晶半導体層を形成する工程を示す。図４（Ａ）は保護層１２１として酸化シリコン膜が形成された第１の半導体ウエハー１０８に、チャネルドープ工程として、一導電型を付与する不純物元素１４１を添加し、不純物領域１４０を形成する例である。さらに、不純物領域１４０を有する第１の半導体ウエハー１０８に、電界で加速されたイオン１４２を所定の深さに照射し、脆化層１１０を形成する工程を示している（図４（Ｂ）参照。）。不純物元素１４１及びイオン１４２の照射は図１の場合と同様である。第１の半導体ウエハー１０８の表面に保護層１２１を形成しておくことで不純物元素及びイオン照射によって表面がダメージを受け、平坦性が損なわれるのを防ぐことができる。また、保護層１２１によって、第１の半導体ウエハー１０８から形成される単結晶半導体層１０２に対する不純物の拡散防止効果を発現する。
【００７４】
図４（Ｃ）は、ブロッキング層１０９及び絶縁層１０４が形成された第２の半導体ウエハー１０１と第１の半導体ウエハー１０８の保護層１２１が形成された面を密着させて接合を形成する工程を示している。第２の半導体ウエハー１０１上の絶縁層１０４と第１の半導体ウエハー１０８の保護層１２１を密着させることにより接合が形成される。
【００７５】
その後、図４（Ｄ）で示すように第１の半導体ウエハー１０８を剥離する。単結晶半導体層を剥離する熱処理は図３（Ｃ）の場合と同様にして行う。このようにして図４（Ｄ）で示すＳＯＩ構造を有する第２の半導体ウエハーを得ることができる。
【００７６】
第２の半導体ウエハー１０１としては、シリコンウエハーやゲルマニウムウエハーなどの半導体ウエハー、ガリウムヒ素やインジウムリンなどの化合物半導体ウエハーを適用する。第２の半導体ウエハー１０１も単結晶半導体ウエハーを適用するのが好ましいが、多結晶半導体ウエハーを適用してもよい。結晶格子に歪みを有するシリコン、シリコンに対しゲルマニウムが添加されたシリコンゲルマニウムなどの半導体ウエハーを用いていても良い。歪みを有するシリコンは、シリコンよりも格子定数の大きいシリコンゲルマニウムまたは窒化珪素上における成膜により、形成することができる。
【００７７】
以上の工程により、図４（Ｄ）に示すように、第２の半導体ウエハー１０１の上に絶縁層１０４が設けられ、第１の半導体ウエハー１０８より分離された単結晶半導体層１０２が絶縁層１０４上に形成される。
【００７８】
第１の半導体ウエハーより単結晶半導体層を分離し、第２の半導体ウエハーに転載された単結晶半導体層において単結晶半導体層はチャネルドープ工程により不純物元素を添加された面を第２の半導体ウエハー側にして、第１の半導体ウエハーより分離し、第２の半導体ウエハーに転載される。従って、第２の半導体ウエハー上に転載された単結晶半導体層表面はチャネルドープ工程におけるダメージ（表面あれや汚染物の混入など）を回避することができる。
【００７９】
また、第１の半導体ウエハーより分離し、第２の半導体ウエハーに転置された単結晶半導体層にレーザ光を照射し、結晶欠陥を低減させてもよい。レーザ光を照射することによって、単結晶半導体層の少なくとも一部の領域を溶融させ、単結晶半導体層中の結晶欠陥を低減させることができる。なお、レーザ光の照射前に単結晶半導体層表面に形成された酸化膜（自然酸化膜、あるいはケミカル酸化膜）を希フッ酸で除去するとよい。
【００８０】
レーザ光の照射は、大気雰囲気のような酸素を含む雰囲気、または窒素雰囲気のような不活性雰囲気で行うことができる。
【００８１】
さらに、単結晶半導体層表面に研磨処理やエッチング処理を行ってもよい。研磨処理やエッチング処理によって、単結晶半導体層を薄膜化し、また単結晶半導体層表面の平坦性を高めることができる。研磨処理やエッチング処理はレーザ光の照射の工程の前後どちらで行ってもよく、両方行ってもよい。
【００８２】
研磨処理としては、化学的機械研磨（Ｃｈｅｍｉｃａｌ  Ｍｅｃｈａｎｉｃａｌ  Ｐｏｌｉｓｈｉｎｇ：ＣＭＰ）法や液体ジェット研磨法を用いることができる。なお、研磨処理前に単結晶半導体層表面を洗浄し、清浄化する。洗浄は、メガソニック洗浄や２流体ジェット洗浄等を用いればよく、洗浄により単結晶半導体層表面のゴミ等を除去する。また、希フッ酸を用いて単結晶半導体層表面上の自然酸化膜等を除去して単結晶半導体層を露出させると好適である。
【００８３】
また、エッチング処理はドライエッチングでもウエットエッチングでもよく、両方行ってもよい。
【００８４】
第１の半導体ウエハーより第２の半導体ウエハーへ転載された単結晶半導体層に対して、エッチング処理や研磨処理などを行ってもよいが、作製するトランジスタの単結晶半導体層のチャネル形成領域に用いる領域がチャネルドープ領域となるように行う。
【００８５】
以上のように本実施の形態において、チャネルドープ工程による不純物領域を有する単結晶半導体層を有するＳＯＩ基板を作製することができる。
【００８６】
ＳＯＩ基板に設けられた単結晶半導体層からトランジスタを作製することで、しきい値電圧を制御されたトランジスタを形成することができる。また、ゲート絶縁層の薄膜化およびゲート絶縁層と局在界面準位密度の低減が可能になる。単結晶半導体層の膜厚を薄くすることで、第２の半導体ウエハー上に、単結晶半導体層で完全空乏型のトランジスタを作製することもできる。
【００８７】
また、本実施の形態において、第１の半導体ウエハー１０８として単結晶シリコン基板を適用した場合は、単結晶半導体層１０２として単結晶シリコン層を得ることが可能である。よって、高速動作が可能で、サブスレッショルド値が低く、電界効果移動度が高く、低消費電圧で駆動可能など高性能、高信頼性のトランジスタを第２の半導体ウエハー上に作製することができる。
【００８８】
なお、本発明において、半導体装置とは、半導体特性を利用することで機能しうる装置を指す。本発明を用いて半導体素子（トランジスタ、メモリ素子やダイオードなど）を含む回路を有する装置や、プロセッサ回路を有するチップなどの半導体装置を作製することができる。
【００８９】
このように、第１の半導体ウエハーにおけるチャネルドープ工程により、第２の半導体ウエハー上に必要とされる機能に応じてトランジスタの電気特性を制御し、半導体装置の高性能化、低消費電力化を図ることができる。また、そのような半導体装置を、作製工程を複雑化することなく、高い歩留まりで生産性よく作製することができる。
【００９０】
（実施の形態２）
本実施の形態では、高性能及び高信頼性な半導体素子を有する半導体装置を、歩留まりよく作製することを目的とした半導体装置の作製方法の一例としてＣＭＯＳ（相補型金属酸化物半導体：Ｃｏｍｐｌｅｍｅｎｔａｒｙ  Ｍｅｔａｌ  Ｏｘｉｄｅ  Ｓｅｍｉｃｏｎｄｕｃｔｏｒ）に関して図５及び図６を用いて説明する。なお、実施の形態１と同一部分又は同様な機能を有する部分の繰り返しの説明は省略する。
【００９１】
本実施の形態では、第１の半導体ウエハーへのチャネルドープ工程において、作製するトランジスタの導電型によって、異なるチャネルドープ条件で不純物領域を形成する例を示す。異なるチャネルドープ条件とは、添加する不純物元素の付与する導電型の種類が異なる場合や、同導電型を付与する不純物元素であっても濃度が異なる場合である。
【００９２】
図５（Ａ）に示すように、第１の半導体ウエハー１０８を用いる。次に、第１の半導体ウエハー１０８を選択的に覆うマスク１４６を形成する。マスク１４６を用いて、一導電型を付与する不純物元素１４３を選択的に添加し、第１の半導体ウエハー１０８に不純物領域１４５を形成する（図５（Ｂ）参照。）。不純物領域１４５はチャネルドープ領域である。
【００９３】
マスク１４６を除去し、第１の半導体ウエハー１０８を選択的に覆うマスク１４８を形成する。マスク１４８を用いて、一導電型を付与する不純物元素１４４を選択的に添加し、第１の半導体ウエハー１０８に不純物領域１４７を形成する（図５（Ｃ）参照。）。不純物領域１４７はチャネルドープ領域である。
【００９４】
このように、チャネルドープ工程を第１の半導体ウエハーに選択的に行うことによって、第１の半導体ウエハー１０８にチャネルドープ条件が異なる不純物領域を形成することができる。
【００９５】
チャネルドープ工程において、添加する一導電性を付与する不純物元素としては、ｎ型を付与する不純物元素（代表的にはリン（Ｐ）、ヒ素（Ａｓ）など）、ｐ型を付与する不純物元素（代表的にはボロン（Ｂ）、アルミニウム（Ａｌ）、ガリウム（Ｇａ）など）を用いることができる。１種類の不純物元素を用いてもよいし、導電型の異なる複数種の不純物元素を用いてもよい。添加工程は、一回でおこなってもよいし、複数回行ってもよい。また、マスクを用いて第１の半導体ウエハーに選択的に不純物元素の添加を行い、不純物濃度の異なる不純物領域を形成してもよい。作製するトランジスタの導電型に合わせて、異なる導電型を付与する不純物元素を選択的に添加し、第１の半導体ウエハーに異なる導電型の不純物領域を形成してもよい。
【００９６】
例えば、界面電荷における影響を考慮する場合、しきい値電圧はキャリアが電子であるｎチャネル型トランジスタではマイナス側へ、キャリアが正孔であるｐチャネルトランジスタではプラス側へシフトしやすい。このような場合はトランジスタのしきい値電圧の制御を目的としてチャネル形成領域に添加される一導電型を付与する不純物元素は、そのトランジスタのソース領域及びドレイン領域と逆導電型を用いればよい。例えば、しきい値電圧がマイナスシフトしたｎチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｐ型を付与する不純物元素を用いることができる。またしきい値電圧がプラスシフトしたｐチャネル型のトランジスタであればチャネル形成領域に設けられる不純物領域に含まれる不純物元素としてｎ型を付与する不純物元素を用いることができる。
【００９７】
不純物領域１４５及び不純物領域１４７を有する第１の半導体ウエハー１０８にイオン１４２を照射し、脆化層１１０を形成する（図５（Ｄ）参照。）。絶縁層１０４が設けられた第２の半導体ウエハー１０１に、絶縁層１０４と第１の半導体ウエハー１０８とが接合するように貼り合わせ、加熱処理によって第２の半導体ウエハー１０１側に単結晶半導体層１３０を転載する（図５（Ｅ）参照。）。以上の工程により、チャネルドープ工程による異なる複数の不純物領域を有する単結晶半導体層１３０を有するＳＯＩ基板を作製することができる。
【００９８】
図６（Ａ）は、第２の半導体ウエハー１０１上に、絶縁層１０４、単結晶半導体層１３０が形成されている。単結晶半導体層１３０、絶縁層１０４は図５（Ｅ）と対応している。単結晶半導体層１３０上には選択的に形成された保護層２０４が形成されている。なお、ここでは図６（Ａ）に示す構成のＳＯＩ基板を適用する例を示すが、本明細書で示すその他の構成のＳＯＩ基板も適用できる。
【００９９】
単結晶半導体層１３０には、ｎチャネル型電界効果トランジスタ及びｐチャネル型電界効果トランジスタの形成領域に合わせて、硼素、アルミニウム、ガリウムなどのｐ型不純物元素、若しくはリン、砒素などのｎ型不純物元素を添加された不純物領域（チャネルドープ領域）を有している。
【０１００】
保護層２０４をマスクとしてエッチングを行い、露呈している単結晶半導体層１３０及びその下方の絶縁層１０４の一部を除去する。次いで、有機シランを用いて酸化シリコン膜を化学気相成長法で堆積する。この酸化シリコン膜は、単結晶半導体層１３０が埋め込まれるように厚く堆積する。次いで、単結晶半導体層１３０上に重なる酸化シリコン膜を研磨により除去した後、保護層２０４を除去して、素子分離絶縁層２０３を残存させる。素子分離絶縁層２０３により単結晶半導体層１３０は、素子領域２０５及び素子領域２０６に分離される（図６（Ｂ）参照。）。
【０１０１】
素子領域２０５は不純物領域１４５より形成され、素子領域２０６は不純物領域１４７より形成される。不純物領域１４５、１４７は、作製するトランジスタの要求される電気特性に応じたチャネルドープ条件によってそれぞれ形成された一導電型を付与する不純物元素を含む領域である。
【０１０２】
次いで、第１の絶縁膜を形成し、第１の絶縁膜上に導電性材料を含むポリシリコン膜を有するゲート電極層２０８ａ、２０８ｂを形成し、ゲート電極層２０８ａ、２０８ｂをマスクとして第１の絶縁膜をエッチングしてゲート絶縁層２０７ａ、２０７ｂを形成する。
【０１０３】
ゲート絶縁層２０７ａ、２０７ｂは酸化シリコン膜、若しくは酸化シリコン膜と窒化シリコン膜の積層構造で形成すればよい。ゲート絶縁層として酸化窒化シリコン膜、窒化酸化シリコン膜なども用いることができる。ゲート絶縁層２０７ａ、２０７ｂは、プラズマＣＶＤ法や減圧ＣＶＤ法により絶縁膜を堆積することで形成しても良いし、プラズマ処理による固相酸化若しくは固相窒化で形成すると良い。半導体層を、プラズマ処理により酸化又は窒化することにより形成するゲート絶縁層は、緻密で絶縁耐圧が高く信頼性に優れているためである。例えば、亜酸化窒素（Ｎ２Ｏ）をＡｒで１〜３倍（流量比）に希釈して、１０〜３０Ｐａの圧力にて３〜５ｋＷのマイクロ波（２．４５ＧＨｚ）電力を印加して単結晶半導体層１３０（素子領域２０５、２０６）の表面を酸化若しくは窒化させる。この処理により１ｎｍ〜１０ｎｍ（好ましくは２ｎｍ〜６ｎｍ）の絶縁膜を形成する。さらに亜酸化窒素（Ｎ２Ｏ）とシラン（ＳｉＨ４）を導入し、１０〜３０Ｐａの圧力にて３〜５ｋＷのマイクロ波（２．４５ＧＨｚ）電力を印加して気相成長法により酸化窒化シリコン膜を形成してゲート絶縁層を形成する。固相反応と気相成長法による反応を組み合わせることにより界面準位密度が低く絶縁耐圧の優れたゲート絶縁層を形成することができる。
【０１０４】
また、ゲート絶縁層２０７ａ、２０７ｂとして、二酸化ジルコニウム、酸化ハフニウム、二酸化チタン、五酸化タンタルなどの高誘電率材料を用いても良い。ゲート絶縁層２０７に高誘電率材料を用いることにより、ゲートリーク電流を低減することができる。
【０１０５】
ゲート電極層２０８ａ、２０８ｂは、スパッタリング法、蒸着法、ＣＶＤ法等の手法により形成することができる。ゲート電極層２０８ａ、２０８ｂはタンタル（Ｔａ）、タングステン（Ｗ）、チタン（Ｔｉ）、モリブデン（Ｍｏ）、アルミニウム（Ａｌ）、銅（Ｃｕ）、クロム（Ｃｒ）、ネオジム（Ｎｄ）から選ばれた元素、又は前記元素を主成分とする合金材料もしくは化合物材料で形成すればよい。また、ゲート電極層２０８ａ、２０８ｂとしてリン等の不純物元素をドーピングした多結晶シリコン膜に代表される半導体膜や、ＡｇＰｄＣｕ合金を用いてもよい。
【０１０６】
次いで、ゲート電極層２０８ａ、２０８ｂを覆う第２の絶縁膜２１０を形成し、さらにサイドウォール構造の側壁絶縁層２１６ａ、２１６ｂ、２１７ａ、２１７ｂを形成する。ｐチャネル型電界効果トランジスタ（ｐＦＥＴ）となる領域の側壁絶縁層２１６ａ、２１６ｂは、ｎチャネル型電界効果トランジスタ（ｎＦＥＴ）となる領域の側壁絶縁層２１７ａ、２１７ｂよりも幅を広くする。次いで、ｎチャネル型電界効果トランジスタとなる領域にヒ素（Ａｓ）などを添加して浅い接合深さの第１の不純物領域２２０ａ、２２０ｂを形成し、ｐチャネル型電界効果トランジスタとなる領域にボロン（Ｂ）などを添加して浅い接合深さの第２の不純物領域２１５ａ、２１５ｂを形成する（図６（Ｃ）参照。）。
【０１０７】
次いで、第２の絶縁膜２１０を部分的にエッチングしてゲート電極層２０８ａ、２０８ｂの上面と、第１の不純物領域２２０ａ、２２０ｂ及び第２の不純物領域２１５ａ、２１５ｂとを露出させる。次いで、ｎチャネル型電界効果トランジスタとなる領域にＡｓなどをドーピングして深い接合深さの第３の不純物領域２１９ａ、２１９ｂを形成し、ｐチャネル型電界効果トランジスタとなる領域にＢなどをドーピングして深い接合深さの第４の不純物領域２２４ａ、２２４ｂを形成する。次いで、活性化のための熱処理（８００℃〜１１００℃）を行う。次いで、シリサイドを形成するための金属膜としてコバルト膜を成膜する。次いでＲＴＡなどの熱処理（５００℃、１分）を行い、コバルト膜に接する部分のシリコンをシリサイド化させ、シリサイド２１３ａ、２１３ｂ、２２２ａ、２２２ｂ、２２３ａ、２２３ｂを形成する。その後、コバルト膜を選択的に除去する。次いで、シリサイド化の熱処理よりも高い温度で熱処理を行い、シリサイド部分の低抵抗化を図る（図６（Ｄ）参照。）。素子領域２０６にはチャネル形成領域２２６が、素子領域２０５にはチャネル形成領域２２１が形成される。
【０１０８】
次いで、層間絶縁層２２７を形成し、レジストからなるマスクを用いて層間絶縁層２２７に深い接合深さの第３の不純物領域２１９ａ、２１９ｂや深い接合深さの第４の不純物領域２２４ａ、２２４ｂにそれぞれ達するコンタクトホール（開口）を形成する。エッチングは、用いる材料の選択比によって、一回で行っても複数回行っても良い。
【０１０９】
エッチング方法及び条件は、コンタクトホールを形成する層間絶縁層２２７の材料によって適宜設定すればよい。ウエットエッチング、ドライエッチング、またはその両方を適宜用いることができる。本実施の形態ではドライエッチングを用いる。エッチング用ガスとしては、Ｃｌ２、ＢＣｌ３、ＳｉＣｌ４もしくはＣＣｌ４などを代表とする塩素系ガス、ＣＦ４、ＳＦ６もしくはＮＦ３などを代表とするフッ素系ガス又はＯ２を適宜用いることができる。また用いるエッチング用ガスに不活性気体を添加してもよい。添加する不活性元素としては、Ｈｅ、Ｎｅ、Ａｒ、Ｋｒ、Ｘｅから選ばれた一種または複数種の元素を用いることができる。ウエットエッチングのエッチャントは、フッ素水素アンモニウム及びフッ化アンモニウムを含む混合溶液のようなフッ酸系の溶液を用いるとよい。
【０１１０】
コンタクトホールを覆うように導電膜を形成し、導電膜をエッチングして各ソース領域又はドレイン領域の一部とそれぞれ電気的に接続するソース電極層又はドレイン電極層としても機能する配線層２４２ａ、２４２ｂ、２４２ｃを形成する。配線層は、ＰＶＤ法、ＣＶＤ法、蒸着法等により導電膜を成膜した後、所望の形状にエッチングして形成することができる。また、液滴吐出法、印刷法、電解メッキ法等により、所定の場所に選択的に導電層を形成することができる。更にはリフロー法、ダマシン法を用いても良い。配線層の材料は、Ａｇ、Ａｕ、Ｃｕ、Ｎｉ、Ｐｔ、Ｐｄ、Ｉｒ、Ｒｈ、Ｗ、Ａｌ、Ｔａ、Ｍｏ、Ｃｄ、Ｚｎ、Ｆｅ、Ｔｉ、Ｚｒ、Ｂａ等の金属、及びＳｉ、Ｇｅ、又はその合金、若しくはその窒化物を用いて形成する。また、これらの積層構造としても良い。
【０１１１】
本実施の形態では、層間絶縁層２２７に形成されたコンタクトホールを埋めるように埋込配線層として配線層２４０ａ、２４０ｂ、２４０ｃ、２４０ｄを形成する。埋込型の配線層２４０ａ、２４０ｂ、２４０ｃ、２４０ｄは、コンタクトホールを埋め込む十分な膜厚の導電膜を形成し、ＣＭＰ法などの研磨処理により、コンタクトホール部だけに導電膜を残し、不要な導電膜部分を除去して形成する。
【０１１２】
埋込型の配線層２４０ａ、２４０ｂ、２４０ｃ、２４０ｄ上に絶縁層２２８及び引き回し配線層として配線層２４１ａ、２４１ｂ、２４１ｃを形成し、配線層２４２ａ、２４２ｂ、２４２ｃを形成する。
【０１１３】
以上の工程で第２の半導体ウエハー１０１に接合された単結晶半導体層１３０の素子領域２０６を用いてｎチャネル型電界効果トランジスタ２３２を、素子領域２０５を用いてｐチャネル型電界効果トランジスタ２３１が作製できる（図６（Ｅ）参照。）。チャネル形成領域２２６は、一導電型を付与する不純物元素１４４が添加された不純物領域１４７を用いて形成され、チャネル形成領域２２１は、一導電型を付与する不純物元素１４３が添加された不純物領域１４５を用いて形成されている。従って、ｐチャネル型電界効果トランジスタ２３１及びｎチャネル型電界効果トランジスタ２３２はチャネルドープ工程によってしきい値電圧を制御された、必要とされる適切な電気特性を有する電界効果トランジスタとすることができる。なお、本実施の形態において、ｎチャネル型電界効果トランジスタ２３２及びｐチャネル型電界効果トランジスタ２３１は配線層２４２ｂによって電気的に接続されている。
【０１１４】
このようにｎチャネル型電界効果トランジスタ２３２とｐチャネル型電界効果トランジスタ２３１を相補的に組み合わせることによってＣＭＯＳ構造を構成する。
【０１１５】
このＣＭＯＳ構造上に、さらに配線や素子などを積層することでマイクロプロセッサなどの半導体装置を作製することができる。なお、マイクロプロセッサは、演算回路（Ａｒｉｔｈｍｅｔｉｃ  ｌｏｇｉｃ  ｕｎｉｔ。ＡＬＵともいう。）、演算回路制御部（ＡＬＵ  Ｃｏｎｔｒｏｌｌｅｒ）、命令解析部（Ｉｎｓｔｒｕｃｔｉｏｎ  Ｄｅｃｏｄｅｒ）、割り込み制御部（Ｉｎｔｅｒｒｕｐｔ  Ｃｏｎｔｒｏｌｌｅｒ）、タイミング制御部（Ｔｉｍｉｎｇ  Ｃｏｎｔｒｏｌｌｅｒ）、レジスタ（Ｒｅｇｉｓｔｅｒ）、レジスタ制御部（Ｒｅｇｉｓｔｅｒ  Ｃｏｎｔｒｏｌｌｅｒ）、バスインターフェース（Ｂｕｓ  Ｉ／Ｆ）、読み出し専用メモリ、及びメモリインターフェース（ＲＯＭ  Ｉ／Ｆ）を有している。
【０１１６】
マイクロプロセッサは、ＣＭＯＳ構造を含む集積回路が形成されているので、処理速度の高速化のみならず低消費電力化を図ることができる。
【０１１７】
本実施の形態に限定されず、薄膜トランジスタはチャネル形成領域が一つ形成されるシングルゲート構造でも、二つ形成されるダブルゲート構造もしくは三つ形成されるトリプルゲート構造であっても良い。
【０１１８】
このように、第１の半導体ウエハーにおけるチャネルドープ工程により、第２の半導体ウエハー上に必要とされる機能に応じてトランジスタの電気特性を制御し、半導体装置の高性能化、低消費電力化を図ることができる。また、そのような半導体装置を、作製工程を複雑化することなく、高い歩留まりで生産性よく作製することができる。
【０１１９】
（実施の形態３）
本実施の形態では、高性能、かつ高い信頼性を付与することを目的とした半導体装置の例について説明する。詳しくは半導体装置の一例として、マイクロプロセッサ及び非接触でデータの送受信を行うことのできる演算機能を備えた半導体装置の一例について説明する。
【０１２０】
図７は半導体装置の一例として、マイクロプロセッサ５００の一例を示す。このマイクロプロセッサ５００は、上記したように本発明に係るＳＯＩ構造を有する半導体ウエハーにより製造されるものである。このマイクロプロセッサ５００は、演算回路５０１（Ａｒｉｔｈｍｅｔｉｃ  ｌｏｇｉｃ  ｕｎｉｔ。ＡＬＵともいう。）、演算回路制御部５０２（ＡＬＵ  Ｃｏｎｔｒｏｌｌｅｒ）、命令解析部５０３（Ｉｎｓｔｒｕｃｔｉｏｎ  Ｄｅｃｏｄｅｒ）、割り込み制御部５０４（Ｉｎｔｅｒｒｕｐｔ  Ｃｏｎｔｒｏｌｌｅｒ）、タイミング制御部５０５（Ｔｉｍｉｎｇ  Ｃｏｎｔｒｏｌｌｅｒ）、レジスタ５０６（Ｒｅｇｉｓｔｅｒ）、レジスタ制御部５０７（Ｒｅｇｉｓｔｅｒ  Ｃｏｎｔｒｏｌｌｅｒ）、バスインターフェース５０８（Ｂｕｓ  Ｉ／Ｆ）、読み出し専用メモリ５０９、及びメモリインターフェース５１０（ＲＯＭ  Ｉ／Ｆ）を有している。
【０１２１】
バスインターフェース５０８を介してマイクロプロセッサ５００に入力された命令は、命令解析部５０３に入力され、デコードされた後、演算回路制御部５０２、割り込み制御部５０４、レジスタ制御部５０７、タイミング制御部５０５に入力される。演算回路制御部５０２、割り込み制御部５０４、レジスタ制御部５０７、タイミング制御部５０５は、デコードされた命令に基づき各種制御を行う。具体的に演算回路制御部５０２は、演算回路５０１の動作を制御するための信号を生成する。また、割り込み制御部５０４は、マイクロプロセッサ５００のプログラム実行中に、外部の入出力装置や周辺回路からの割り込み要求を、その優先度やマスク状態から判断して処理する。レジスタ制御部５０７は、レジスタ５０６のアドレスを生成し、マイクロプロセッサ５００の状態に応じてレジスタ５０６の読み出しや書き込みを行う。タイミング制御部５０５は、演算回路５０１、演算回路制御部５０２、命令解析部５０３、割り込み制御部５０４、レジスタ制御部５０７の動作のタイミングを制御する信号を生成する。例えばタイミング制御部５０５は、基準クロック信号ＣＬＫ１を元に、内部クロック信号ＣＬＫ２を生成する内部クロック生成部を備えており、内部クロック信号ＣＬＫ２を上記各種回路に供給する。なお、図７に示すマイクロプロセッサ５００は、その構成を簡略化して示した一例にすぎず、実際にはその用途によって多種多様な構成を備えることができる。
【０１２２】
このようなマイクロプロセッサ５００は、半導体ウエハー上に接合された結晶方位が一定の単結晶半導体層によって集積回路が形成されているので、処理速度の高速化のみならず低消費電力化を図ることができる。
【０１２３】
次に、非接触でデータの送受信を行うことのできる演算機能を備えた半導体装置の一例について図８を参照して説明する。図８は無線通信により外部装置と信号の送受信を行って動作するコンピュータ（以下、「ＲＦＣＰＵ」という）の一例を示す。ＲＦＣＰＵ５１１は、アナログ回路部５１２とデジタル回路部５１３を有している。アナログ回路部５１２として、共振容量を有する共振回路５１４、整流回路５１５、定電圧回路５１６、リセット回路５１７、発振回路５１８、復調回路５１９と、変調回路５２０を有している。デジタル回路部５１３は、ＲＦインターフェース５２１、制御レジスタ５２２、クロックコントローラ５２３、ＣＰＵインターフェース５２４、中央処理ユニット５２５、ランダムアクセスメモリ５２６、読み出し専用メモリ５２７を有している。
【０１２４】
このような構成のＲＦＣＰＵ５１１の動作は概略以下の通りである。アンテナ５２８が受信した信号は共振回路５１４により誘導起電力を生じる。誘導起電力は、整流回路５１５を経て容量部５２９に充電される。この容量部５２９はセラミックコンデンサーや電気二重層コンデンサーなどのキャパシタで形成されていることが好ましい。容量部５２９はＲＦＣＰＵ５１１と一体形成されている必要はなく、別部品としてＲＦＣＰＵ５１１を構成する基板に取り付けられていれば良い。
【０１２５】
リセット回路５１７は、デジタル回路部５１３をリセットし初期化する信号を生成する。例えば、電源電圧の上昇に遅延して立ち上がる信号をリセット信号として生成する。発振回路５１８は、定電圧回路５１６により生成される制御信号に応じて、クロック信号の周波数とデューティー比を変更する。ローパスフィルタで形成される復調回路５１９は、例えば振幅偏移変調（ＡＳＫ）方式の受信信号の振幅の変動を二値化する。変調回路５２０は、送信データを振幅偏移変調（ＡＳＫ）方式の送信信号の振幅を変動させて送信する。変調回路５２０は、共振回路５１４の共振点を変化させることで通信信号の振幅を変化させている。クロックコントローラ５２３は、電源電圧又は中央処理ユニット５２５における消費電流に応じてクロック信号の周波数とデューティー比を変更するための制御信号を生成している。電源電圧の監視は電源管理回路５３０が行っている。
【０１２６】
アンテナ５２８からＲＦＣＰＵ５１１に入力された信号は復調回路５１９で復調された後、ＲＦインターフェース５２１で制御コマンドやデータなどに分解される。制御コマンドは制御レジスタ５２２に格納される。制御コマンドには、読み出し専用メモリ５２７に記憶されているデータの読み出し、ランダムアクセスメモリ５２６へのデータの書き込み、中央処理ユニット５２５への演算命令などが含まれている。中央処理ユニット５２５は、インターフェース５２４を介して読み出し専用メモリ５２７、ランダムアクセスメモリ５２６、制御レジスタ５２２にアクセスする。ＣＰＵインターフェース５２４は、中央処理ユニット５２５が要求するアドレスより、読み出し専用メモリ５２７、ランダムアクセスメモリ５２６、制御レジスタ５２２のいずれかに対するアクセス信号を生成する機能を有している。
【０１２７】
中央処理ユニット５２５の演算方式は、読み出し専用メモリ５２７にＯＳ（オペレーティングシステム）を記憶させておき、起動とともにプログラムを読み出し実行する方式を採用することができる。また、専用回路で演算回路を構成して、演算処理をハードウェア的に処理する方式を採用することもできる。ハードウェアとソフトウェアを併用する方式では、専用の演算回路で一部の処理を行い、残りの演算をプログラムを使って中央処理ユニット５２５が実行する方式を適用することができる。
【０１２８】
このようなＲＦＣＰＵ５１１は、半導体ウエハー上に接合された結晶方位が一定の単結晶半導体層によって集積回路が形成されているので、処理速度の高速化のみならず低消費電力化を図ることができる。それにより、電力を供給する容量部５２９を小型化しても長時間の動作を保証することができる。
【図面の簡単な説明】
【０１２９】
【図１】本発明の半導体装置の作製方法を説明する図。
【図２】本発明の半導体装置の作製方法を説明する図。
【図３】本発明の半導体装置の作製方法を説明する図。
【図４】本発明の半導体装置の作製方法を説明する図。
【図５】本発明の半導体装置の作製方法を説明する図。
【図６】本発明の半導体装置の作製方法を説明する図。
【図７】本発明の半導体装置の一例であるマイクロプロセッサの構成を示すブロック図。
【図８】本発明の半導体装置の一例であるＲＦＣＰＵの構成を示すブロック図。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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