(57)【特許請求の範囲】
【請求項１】
信号処理のための方法であって、
時間領域波形をクリップされた周波数領域シンボルに変換するステップと、
コンステレーションポイント調整モジュールを用いてアクティブコンステレーション拡張（Active Constellation Extension：ＡＣＥ）手順を実行するステップとを備え、
象限について、前記ＡＣＥ手順の間に移動される前記クリップされた周波数領域シンボルの各シンボルは、前記象限内の交差軸によって規定される領域へ移動され、
前記方法は、
前記象限について、前記交差軸に関連した原点の半径としての誤差ベクトル振幅しきい値の距離における円弧を有する境界の周囲を規定するステップと、
前記象限について、前記円弧とともに前記交差軸によって確立される有界領域の境界を定めるステップと、
前記ＡＣＥ手順の後に、前記領域内であるが前記有界領域の外部のシンボルを識別するステップと、
前記領域内であるが前記有界領域の外部で識別された前記シンボルを前記有界領域へ転送するステップとをさらに備える、方法。
【請求項２】
前記シンボルは、前記転送するステップにおいて、前記有界領域の前記原点の場所に移動される、請求項１に記載の方法。
【請求項３】
前記ＡＣＥ手順を実行する前に、コンステレーションの前記シンボルを前記クリップされた周波数領域シンボルとして取得するステップをさらに備え、
前記ＡＣＥ手順は、前記コンステレーションの前記シンボルについて実行される、請求項１または２に記載の方法。
【請求項４】
前記コンステレーションの他のシンボルの組を取得するステップと、
前記コンステレーションの前記他のシンボルの組について前記ＡＣＥ手順を実行するステップとをさらに備える、請求項３に記載の方法。
【請求項５】
前記コンステレーションは、少なくとも４直交振幅変調（four quadrature amplitude modulation：４−ＱＡＭ）アレイである、請求項３または４に記載の方法。
【請求項６】
前記有界領域は、前記コンステレーションの端部シンボル領域についてのものである、請求項３〜５のいずれか１項に記載の方法。
【請求項７】
前記端部シンボル領域は、前記コンステレーションのコーナーシンボル領域である、請求項６に記載の方法。
【請求項８】
前記シンボルは、前記転送するステップにおいて、前記有界領域の境界に移動される、請求項１〜７のいずれか１項に記載の方法。
【請求項９】
前記シンボルは、前記転送するステップにおいて、前記有界領域の内部または境界上に移動される、請求項１〜７のいずれか１項に記載の方法。
【請求項１０】
送信器であって、
コンステレーションポイント調整モジュールを備え、
前記コンステレーションポイント調整モジュールは、
時間領域波形をクリップされた周波数領域シンボルに変換し、
コンステレーションの第１の組のコンステレーションポイントの前記クリップされた周波数領域シンボルのＡＣＥ転送を実行し、
象限について、前記ＡＣＥ転送の間に移動される各コンステレーションポイントは、前記象限内の交差軸によって規定される領域へ移動され、
前記交差軸に関連した原点の半径としての誤差ベクトル振幅しきい値の距離における円弧を含む境界の周囲を規定し、
前記円弧とともに交差軸によって確立される領域の境界を定めて有界領域を与え、
前記交差軸によって規定される前記領域内であるが前記有界領域の前記円弧の外部に残っている前記コンステレーションの第２の組のコンステレーションポイントを、前記有界領域に転送するように構成される、送信器。
【請求項１１】
前記コンステレーションポイント調整モジュールは、前記コンステレーションの周辺におけるコンステレーションポイントの組のみを調整するように構成される、請求項１０に記載の送信器。
【請求項１２】
前記送信器は、直交周波数分割多重および直交周波数分割多元接続からなるグループから選択される変調のために構成される、請求項１０または１１に記載の送信器。
【請求項１３】
前記しきい値レベルは、３ＧＰＰ−ＬＴＥおよびＩＥＥＥ  ８０２．１６ｅからなるグループから選択された基準についてのものである、請求項１２に記載の送信器
【発明の詳細な説明】
【技術分野】
【０００１】
発明の分野
本発明の実施形態は、集積回路（ＩＣ）装置に関する。より特定的には、本発明の実施形態は、ＩＣについての有界誤差ベクトル振幅を用いてＯＦＤＭおよび／またはＯＦＤＭＡシステムのピーク対平均電力比を低減するための信号処理に関し、最小化の制限のないものも含む。
【背景技術】
【０００２】
発明の背景
プログラマブルロジックデバイス（ＰＬＤ）は、特定の論理関数を実行するようにプログラムすることができる、よく知られた集積回路のタイプである。ＰＬＤの１つのタイプである、フィールドプログラマブルゲートアレイ（ＦＰＧＡ）は、典型的に、プログラマブルタイルを含む。これらのプログラマブルタイルは、たとえば、入出力ブロック（ＩＯＢ）、設定可能ロジックブロック（ＣＬＢ）、内蔵ランダムアクセスメモリブロック（ＢＲＡＭ）、乗算器、デジタル信号処理ブロック（ＤＳＰ）、プロセッサ、クロックマネージャ、遅延ロックループ（ＤＬＬ）などを含み得る。本明細書で用いられるように、「含む」および「含んでいる」は、制限なく含むことを意味する。各プログラマブルタイルは、典型的に、プログラマブル相互接続およびプログラマブルロジックの双方を含む。プログラマブル相互接続は、典型的に、プログラム可能な相互接続点（ＰＩＰ）によって相互接続される可変長さの多くの相互接続ラインを含む。プログラマブルロジックは、たとえば、関数生成器、レジスタ、算術論理などを含み得るプログラマブル素子を用いたユーザ設計のロジックを実行する。
【発明の概要】
【発明が解決しようとする課題】
【０００３】
プログラマブル相互接続およびプログラマブルロジックは、典型的に、どのようにプログラマブル素子が構成されているかを定義する内部設定メモリセルに、一連の設定データをローディングすることによってプログラムされる。設定データは、メモリから（たとえば、外部ＰＲＯＭから）読み出すか、あるいは、外部デバイスによってＦＰＧＡ内に書き込むことができる。そして、個々のメモリセルの集合状態は、ＦＰＧＡの機能を定める。
【０００４】
他のタイプのＰＬＤは、複合プログラマブルロジックデバイス、またはＣＰＬＤである。ＣＰＬＤは、相互接続スイッチマトリックスによって、ともに、かつ入出力（Ｉ／Ｏ）リソースと接続される２つまたはより多くの「機能ブロック」を含む。ＣＰＬＤの各機能ブロックは、プログラマブルロジックアレイ（ＰＬＡ）デバイスおよびプログラマブルアレイロジック（ＰＡＬ）デバイスにおいて用いられるものと同様の、２レベルＡＮＤ／ＯＲ構造を含む。ＣＰＬＤにおいては、設定データは、典型的に、不揮発性メモリのチップ上に記憶される。いくつかのＣＰＬＤにおいては、設定データは不揮発性メモリのチップ上に記憶され、その後、初期設定（プログラミング）シーケンスの一部として、揮発性メモリにダウンロードされる。
【０００５】
これらのプログラマブルロジックデバイス（ＰＬＤ）のすべてについて、デバイスの機能は、その目的のためにデバイスに供給されるデータビットによって制御される。データビットは、揮発性メモリ（たとえば、ＦＰＧＡおよびいくつかのＣＰＬＤにおけるような、スタティックメモリ）、不揮発性メモリ（たとえば、いくつかのＣＰＬＤにおけるような、フラッシュメモリ）、または他のタイプのメモリセルに、記憶され得る。
【０００６】
他のＰＬＤは、たとえば金属層のような、デバイス上のさまざまな素子にプログラム可能に相互接続する処理層を適用することによってプログラムされる。これらのＰＬＤは、マスクプログラマブルデバイスとして公知である。ＰＬＤは、たとえば、ヒューズまたはアンチヒューズ技術のような、他の手法によっても実現することができる。語句「ＰＬＤ」および「プログラマブルロジックデバイス」は、限定されないが、これらの例示的なデバイス、および、部分的にのみプログラム可能である包括的な装置を含む。たとえば、ＰＬＤの１つのタイプは、配線接続トランジスタロジックと、その配線接続トランジスタロジックとプログラム可能に相互接続するプログラマブルスイッチ構造との組み合わせを含む。直交周波数分割多重（Orthogonal Frequency Division Multiplexing：ＯＦＤＭ）および直交周波数分割多元接続（Orthogonal Frequency Division Multiple Access：ＯＦＤＭＡ）は、ブロードバンド通信のための一般的な変調技術である。ＯＦＤＭおよびＯＦＤＭＡは、スペクトル効果を有するとともに、周波数選択チャンネルについて複雑性の低い復調器を含み、それらは電力増幅器効率を低減する、高いピーク対平均電力比（peak-to-average power ratio：ＰＡＰＲ）を有する傾向にある。その他、ＰＡＲＲ低減のためのアクティブコンステレーション拡張（Active Constellation Extension：ＡＣＥ）が提案されている。
【０００７】
ＡＣＥ手順は、シンボル位置を変化する。しかしながら、ＡＣＥは、送信器にコンステレーション誤差を導入し、それは、たとえば、いくつかの基準によって課せられるような、誤差ベクトル振幅（error vector magnitude：ＥＶＭ）制約に違反するかもしれない。これらの基準は、第三世代パートナーシッププロジェクト−ロングタームエボリューション（Third Generation Partnership Project - Long Term Evolution：３ＧＰＰ−ＬＴＥ）および電気電子技術者協会（Institute of Electrical and Electronics Engineers：ＩＥＥＥ）８０２．１６ｅ（携帯ＷｉＭａｘ）を含む。
【課題を解決するための手段】
【０００８】
発明の要約
１つまたはより多くの局面は、概して、集積回路（ＩＣ）装置に関し、より特定的には、ＩＣについての有界誤差ベクトル振幅を用いてＯＦＤＭシステムおよび／またはＯＦＤＭＡシステムのピーク対平均電力比を低減することに関する。１つの局面は、概して、信号処理のための方法に関する。その方法は、ＡＣＥ手順を実行することを含み得る。ＡＣＥ反復法後に有界領域の外部にあるシンボルが識別される。有界領域は、誤差ベクトル振幅目標に応答して決定される。識別されたシンボルは、有界領域へ転送される。本方法において、シンボルは、有界領域の原点の場所に移動される。ＡＣＥ手順を実行する前に、コンステレーションのシンボルが取得され、ＡＣＥ手順は、そのコンステレーションのシンボルについて実行される。方法は、コンステレーションの他のシンボルの組を取得すること、およびそのコンステレーションの他のシンボルの組についてＡＣＥ手順を実行することをさらに含み得る。コンステレーションは、少なくとも４直交振幅変調（four quadrature amplitude modulation：４−ＱＡＭ）アレイであり得る。有界領域は、コンステレーションの端部シンボル領域であり得る。端部シンボル領域は、コンステレーションのコーナーシンボル領域であり得る。シンボルは有界領域の境界に移動され得る。シンボルは、有界領域の内部または有界領域の境界上に移動され得る。
【０００９】
他の局面は、概して、誤差ベクトル振幅の境界を用いるピーク対平均電圧比低減のための方法に関する。コンステレーションの第１のクリップされたシンボルが取得され得る。第１のクリップされたシンボルの第１の組は、アクティブコンステレーション拡張手順を用いて、最初に転送され得る。有界領域は、誤差ベクトル振幅についてのしきい値に応答して設定され得る。有界領域の外部に残っている第１のクリップされたシンボルの第２の組が、有界領域に二番目に転送され得る。第１のクリップされたシンボルは、最初に転送された第１のクリップされたシンボルの第１の組、および二番目に転送された第１のクリップされたシンボルの第２の組を含み、逆高速フーリェ変換処理のために出力され得る。
【００１０】
方法は、コンステレーションの第２のクリップされたシンボルを取得すること、ならびに、第２のクリップされたシンボルの第１の組についての第１の転送、第２のクリップされたシンボルの第２の組についての第２の転送、および第２のクリップされたシンボルの出力を繰り返すことをさらに含み、第２のクリップされたシンボルは、最初に転送された第２のクリップされたシンボルの第１の組、および二番目に転送された第２のクリップされたシンボルの第２の組を含む。第２の組の第１のクリップされたシンボルは、有界領域の原点の場所に移動され得る。コンステレーションは、少なくとも４直交振幅変調（４−ＱＡＭ）アレイであり得る。有界領域は、コンステレーションの端部シンボルについてのものであり得る。端部シンボルは、コンステレーションのコーナーシンボルであり得る。第２の組の第１のクリップされたシンボルは、有界領域の境界に移動され得る。第２の組の第１のクリップされたシンボルは、有界領域の内部または有界領域の境界上に移動され得る。
【００１１】
さらに他の局面は、概して、コンステレーションポイント調整モジュールを含む送信器に関する。コンステレーションポイント調整モジュールは、コンステレーションポイントの第１の組のＡＣＥ転送を実行するとともに、有界領域の外部に残っているコンステレーションポイントの第２の組を有界領域に転送するように構成され得る。
【００１２】
コンステレーションポイント調整モジュールは、コンステレーションの周辺にあるコンステレーションのみを調整するように構成され得る。有界領域は、誤差ベクトル振幅をしきい値レベルに制限するために定義され得る。送信器は、直交周波数分割多重および直交周波数分割多元接続で構成されるグループから選択された変調のために構成され得る。しきい値レベルは、３ＧＰＰ−ＬＴＥおよびＩＥＥＥ  ８０２．１６ｅで構成されるグループから選択される基準についてのものであり得る。
【００１３】
添付図面は、本発明の１つまたはより多くの局面に従う例示的な実施形態を示すが、添付図面は、本発明を示される実施形態に限定するために採用されるべきではなく、説明および理解のためだけのものである。
【図面の簡単な説明】
【００１４】
【図１】本発明の１つまたはより多くの局面が実行され得るコラム型フィールドプログラマブルゲートアレイ（ＦＰＧＡ）の例示的な実施形態を示す単純化されたブロック図である。
【図２】アクティブコンステレーション拡張（ＡＣＥ）調整器を有する先行技術の送信器の例示的な実施形態を示すブロック図である。
【図３Ａ】ピークを有するＯＦＤＭ信号の波形の例示的な実施形態を示す信号図である。
【図３Ｂ】クリップされたピークを有するＯＦＤＭ信号の波形の例示的な実施形態を示す信号図である。
【図４】有界領域シンボルを生成するための修正されたＡＣＥ調整器を有する送信器の例示的な実施形態を示すブロック図である。
【図５Ａ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図５Ｂ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図５Ｃ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図５Ｄ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図５Ｅ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図５Ｆ】４直交振幅変調（４−ＱＡＭ）の実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図６】１６−ＱＡＭの実施形態についてのコンステレーションの例示的な実施形態を示すグラフである。
【図７】信号処理フローの例示的な実施形態を示すフロー図である。
【発明を実施するための形態】
【００１５】
図面の詳細な説明
以下の説明においては、本発明の具体的な実施形態のより詳細な説明を提供するために多くの具体的な詳細が記載される。しかしながら、当業者には、本発明が以下に与えられる特定の詳細のすべてを用いなくとも実現され得ることが理解されるべきである。他の例においては、本発明があいまいにならないように、周知の特徴は詳細について記載されていない。図示を容易にするために、同じ数表示が、異なる図において同じ事項を参照するために用いられるが、代替的な実施形態においては、その事項は異なっていてもよい。
【００１６】
上述のように、最新のＦＰＧＡは、アレイ内にさまざまな異なるタイプのプログラマブルロジックブロックを含み得る。たとえば、図１は、多くの異なるプログラマブルタイルを含むＦＰＧＡ構造１００を示し、プログラマブルタイルは、マルチギガビット送受信器（ＭＧＴ）１０１、設定可能なロジックブロック（ＣＬＢ）１０２、ランダムアクセスメモリブロック（ＢＲＡＭ）１０３、入出力ブロック（ＩＯＢ）１０４、設定およびクロッキングロジック（ＣＯＮＦＩＧ／ＣＬＯＣＫ）１０５、デジタル信号処理ブロック（ＤＳＰ）１０６、専用入出力ブロック（Ｉ／Ｏ）１０７（たとえば、設定ポートおよびクロックポート）、および、デジタルクロックマネージャ、アナログ−デジタル変換器、システム監視ロジックなどのような他のプログラマブルロジック１０８を含む。いくつかのＦＰＧＡは、内蔵プロセッサブロック（ＰＲＯＣ）１１０も含み得る。
【００１７】
いくつかのＦＰＧＡにおいては、各プログラマブルタイルは、各隣接タイルにおける対応する相互接続素子への、および相互接続素子からの標準化された接続を有する、プログラマブル相互接続素子（ＩＮＴ）１１１を含む。したがって、ともに採用されるプログラマブル相互接続素子は、例示されたＦＰＧＡのためのプログラマブル相互接続構成を実現する。プログラマブル相互接続素子１１１は、図１の上部に含まれる例によって示されるように、同じタイル内のプログラマブルロジック素子への、およびプログラマブルロジック素子からの接続も含む。
【００１８】
たとえば、ＣＬＢ１０２は、ユーザロジックに加えて単一のプログラマブル相互接続素子（ＩＮＴ）１１１を実行するようにプログラムされ得る、設定可能なロジック素子（ＣＬＥ）１１２を含み得る。ＢＲＡＭ１０３は、１つまたはより多くのプログラマブル相互接続素子に加えて、ＢＲＡＭロジック素子（ＢＲＬ）１１３を含み得る。典型的に、タイル内に含まれる相互接続素子の数は、タイルの高さに依存する。図示された実施形態においては、ＢＲＡＭタイルは、５つのＣＬＢと同じ高さを有するが、他の数（たとえば、４）も使用することができる。ＤＳＰタイル１０６は、適切な数のプログラマブル相互接続素子に加えて、ＤＳＰロジック素子（ＤＳＰＬ）１１４を含み得る。ＩＯＢ１０４は、たとえば、プログラマブル相互接続素子１１１の１つのインスタンスに加えて、入出力ロジック素子（ＩＯＬ）１１５の２つのインスタンスを含み得る。当業者には明らかであるように、たとえばＩ／Ｏロジック素子１１５に接続される実際のＩ／Ｏパッドは、典型的に、入出力ロジック素子１１５の領域には制限されない。
【００１９】
図示された実施形態において、（図１に示される）ダイの中央部に近いコラム上領域は、設定、クロック、および他の制御ロジックのために用いられる。コラムから伸延する水平領域１０９は、ＦＰＧＡの幅にわたってクロック信号および設定信号を分配するために用いられる。
【００２０】
図１に示される構造を利用するいくつかのＦＰＧＡは、ＦＰＧＡの大部分を作り上げる通常のコラム状構造を分裂させる追加の論理ブロックを含む。追加の論理ブロックは、プログラマブルブロックおよび／または専用ブロックであり得る。たとえば、プロセッサブロック１１０は、ＣＬＢおよびＢＲＡＭのいくつかのコラムにわたる。
【００２１】
図１は、例示的なＦＰＧＡ構造を単に示すことが意図されているに過ぎないことに注意すべきである。たとえば、コラム内の論理ブロックの数、コラムの相対幅、コラムの数および順序、コラムに含まれる論理ブロックのタイプ、論理ブロックの相対サイズ、および図１の上部に含まれる相互接続／論理実行例は、単に例示であるにすぎない。たとえば、実際のＦＰＧＡにおいては、ＣＬＢの１つより多くの隣接コラムは、典型的に、ＣＬＢが現れるどこにでも含まれ、ユーザロジックの効果的な実行を容易にするが、隣接ＣＬＢコラムの数は、ＦＰＧＡの全体サイズとともに変化する。
【００２２】
図２は、先行技術の送信器２００の例示的な実施形態を示すブロック図である。送信器２００は公知であるので、明確化の目的のために、送信器２００の過度に詳細な説明は提供されない。送信器２００は、ＯＦＤＭ／ＯＦＤＭＡ信号のためのものであり、以降は、包括的におよび単一的にＯＦＤＭ信号と称される。
【００２３】
ＯＦＤＭ信号は、図３Ａの波形３００Ａに例示的に示されるように、それらの波形にピークを有する。図３Ａは、ピーク３０１Ａを有する波形３００Ａの例示的な実施形態を示す信号図である。図３Ｂは、ピーク３０１Ａがクリップされた後の波形３００Ａ、すなわちピーク３０１Ｂを有する波形３００Ｂの例示的な実施形態を示す信号図であり、
図２、図３Ａおよび図３Ｂを同時に参照して、送信器２００がさらに説明される。ピークを低減することは、クリッピング以外の他の公知の形式を採用してもよいが、クリッピングは、明確化のために例として用いられており、限定ではないことが想定されるものである。用いられ得るピーク低減の他の例は、「トーンリザベーション（Tone Reservation）」を含む。
【００２４】
単にピークをクリッピングすること、ならびに、送信器２００および受信器（明確化のためにここでは図示されずまたは説明されない）の他のブロックに誤差を取り扱わせることよりもむしろ、ＡＣＥ手順が用いられ得る。波形のクリッピングは、スペクトルマスクを妨害しかつ隣接チャネルに干渉を導入する、スペクトル領域における歪みを導入し得ることが理解されるべきである。いくつかのサブキャリアが、さらなるシンボル、すなわちリザーブトーン（reserve tone）の導入によって、ＰＡＰＲ低減のために専用化され得るが、ＰＡＰＲを低減するために、トーンリザベーションは信号帯域幅を使い果たし、いくつかの基準には準拠しないかもしれない。ＡＣＥ手順は、追加の送信帯域幅を使用せず、本明細書で前に参照したいくつかのような公知の基準を変更することなく実現され得る。
【００２５】
コンステレーション入力２０２は、この例においては４直交振幅変調（４−ＱＡＭ）コンステレーションであり、サブキャリア２０１を介して、時間領域サンプル２０４を生成するための逆高速フーリェ変換ブロック（ＩＦＦＴ）２０３へそれぞれ供給される。時間領域サンプル２０４は、クリッパー２０５へ供給され得る。図３Ａに例示的に示されるもののような時間領域波形は、クリッパー２０５によって、上限しきい値３０８および下限しきい値３０９のような、ユーザにより特定されたしきい値においてクリップされ、図３Ｂに例示的に示されるもののような、クリップされた波形を生成する。
【００２６】
しかしながら、先述のように、クリッピングは歪みを導入し得る。周波数領域においては、このような歪みは、それぞれの原点の場所から移動するコンステレーションのシンボルまたはポイントとして観測可能であり得る。したがって、クリッパー２０５から出力されるクリップされた時間領域サンプル２０７は、クリップされた周波数領域シンボル２０８を提供するために、高速フーリェ変換ブロック（ＦＦＴ）２０６に供給され得る。クリップされた周波数領域シンボル２０８は、それらの原点の場所から移動し、それは、一般的に、コンステレーション入力２０２と比べて、クリップされた周波数領域信号２０８におけるポイントまたはシンボルのより広範な広がりとして示されることが理解されるべきである。
クリップされた周波数領域シンボル２０８は、ＡＣＥ調整器２０９に供給され、相対的に高くかつＥＶＭを増加し得るコンステレーション誤差を低減し得る。ＡＣＥ調整器２０９は、ＡＣＥ反復法を実行するように構成される。ＡＣＥ反復法は、選択的基準に基づいて、シンボルをもとの場所へ戻し、有界領域シンボル２１０を生成する。シンボル距離を最小化するシンボルはそれらの元の場所に戻され、シンボル距離を増加するシンボルは保持され、またはそうでなければ再配置のためには選択されない。マルチプレクサ２１１が、ＩＦＦＴ２０３への入力２０２と２１０との間の選択のために用いられ得る。
【００２７】
ＡＣＥ調整器２０９によるＡＣＥ反復法は、そのような反復について周波数領域内に表わされるＡＣＥ調整器２０９へ入力されるそれらのピークに対して、時間領域において異なるピークを生じさせ得る。したがって、同じＡＣＥ手順が複数回反復され得る。以下の説明から、本明細書で説明されるようなＥＶＭ境界（EVM bounding）が、ＥＶＭを制限するために任意のＡＣＥ反復技術に適用され得る。
【００２８】
図４は、送信器４００の例示的な実施形態を示すブロック図である。図４の送信器４００は、ＡＣＥ調整器２０９が、有界領域シンボル４０８を生成するための「修正されたＡＣＥ」調整器４１０に置き換えられているポイントを除いて、図２の送信器２００と同様である。「修正されたＡＣＥ」調整器４１０の動作は、図４、および図５Ａから図５Ｅのグラフによって示されるそれぞれの例示的な実施形態を同時に参照して説明される。
【００２９】
図５Ａを参照して、クリップされた周波数領域シンボル２０８のコンステレーションのようなコンステレーション５００が、修正されたＡＣＥ調整器４１０に入力される。この例においては、４−ＱＡＭコンステレーションが例示的に示されるが、４よりも大きいＱＡＭサイズが用いられてもよいことが理解されるべきである。公知のように、ＱＡＭシンボルは、複素数についての実数軸５０１および虚数軸５０２によって定義されるコンステレーションマップ内の４つの象限ＩからＩＶのうちの１つに配置される。
【００３０】
修正されたＡＣＥアルゴリズムのＡＣＥ部分について、象限の原点５０４よりも軸５０１および軸５０２の少なくとも１つに近いポイントまたはシンボル５０３が、原点５０４に移動または転送される。原点５０４から広がりそれぞれ軸５０１および軸５０２に平行である基準線５０５および５０６が例示的に示され、ＡＣＥ反復法によって転送されるべきそれらのポイント５０３をより明確に特定する。
【００３１】
図５Ｂを参照して、コンステレーション５１０Ｂの例示的な実施形態を示すグラフであり、それは、修正されたＡＣＥアルゴリズムのＡＣＥ部分または反復後の図５Ａのコンステレーション５００である。ポイント５０７およびポイント５０８、ならびに原点５０４にある任意のシンボルまたはポイントは、修正されたＡＣＥアルゴリズムのＡＣＥ部分によって影響を受けない。ポイント５０７は、各象限ＩからＩＶについての軸５０５および軸５０６によって境界が設けられる領域内にあり、したがって、たとえば、軸５０６と軸５０２との間、または軸５０５と軸５０１との間のような、軸間には存在しない。ポイント５０７およびポイント５０８は、軸５０５または軸５０６上に存在してもよい。コンステレーション５１０Ｂについて、境界の周囲５１１は、各象限ＩからＩＶにおける原点５０４の半径から定義され得る。境界の周囲５１１は、ＥＶＭしきい値レベルに応じて決定されてもよい。しかしながら、修正されたＡＣＥアルゴリズムのＡＣＥ部分の完了後は、軸５０１と基準線５０５との間、または軸５０２と基準線５０６との間、あるいはその組み合わせにおけるポイントまたはシンボルはすでに転送されており、したがって、概して点線によって特定されるような、各境界の周辺５１１の部分は、関心事ではない。したがって、各象限について、基準線５０５および５０６、ならびに境界の周辺５１１のそのような破線部分によって定められる領域または範囲は使用されない。
【００３２】
それどころか、コンステレーションのコーナーシンボルについてのこの例においてはπ／４の円弧長である円弧５１２、すなわち、各象限ＩからＩＶにおいて、基準線５０５から基準線５０６まで進むとともに原点５０４から半径状に伸延する周辺５１１の部分が用いられる。したがって、各象限ＩからＩＶについて、円弧長５１２および基準線５０５，５０６は、有界領域または範囲５２０を定義する。領域５２０は、ＥＶＭをしきい値に制限するための修正されたＡＣＥ調整器４１０によって実行される修正されたＡＣＥ反復法によって、どのポイントが転送されるべきであり、どのポイントが転送されないかを記述するために用いられ得る。そのため、たとえば、領域５２０の外部のポイント５０７は、コンステレーション５１０Ｃおよび５１０Ｄに関連するＥＶＭを低減するために転送されるべきであり、領域５２０の内部のポイント５０８は転送されない。領域５２０の外部のポイントの相対的効果は、しきい値レベルを超えるようにＥＶＭを増加し得ることが理解されるべきである。
【００３３】
図５Ｂの例示的な実施形態においては、ポイント５０７は、矢印を有する波線によって一般的に示されるように、そのようなポイント５０７が配置される象限にそれぞれ関連する原点５０４へすべて転送される。ポイント５０７は、しきい値レベルの範囲内になるようにＥＶＭを低減するために、必ずしもそれぞれの原点５０４へ転送されなくてもよい。たとえば、図５Ｃには、コンステレーション５１０Ｃの例示的な実施形態を示すグラフが例示的に示される。ポイント５０７が、矢印を有する波線によって一般的に示されるように、そのようなポイント５０７が配置される象限にそれぞれ関連した、円弧長５１２のような有界領域５２０の境界上に転送される点を除いて、コンステレーション５１０Ｃは、図５Ｂのコンステレーション５１０Ｂである。
【００３４】
さらに、図５Ｄにおいてコンステレーション５１０Ｄの例示的な実施形態を示すグラフによって概して例示的に示されるように、ポイント５０７は、代替的に、有界領域５２０の周囲の範囲内の場所に転送または移動され得る。図５Ｄにおいて、図５Ｂのコンステレーション５１０Ｂであるコンステレーション５１０Ｄは、矢印を有する波線によって一般的に示されるように、ポイント５０７にそれぞれ関連する、象限ＩからＩＶの範囲内の有界領域の内部に転送されるポイント５０７とともに示されるものとして予期される。
【００３５】
したがって、図５Ｂから図５Ｄを参照して、修正されたＡＣＥアルゴリズムの修正されたＡＣＥ部分の後に有界領域５２０の外側にあるポイントは、有界領域５２０の原点５０４、有界領域５２０の境界または周囲、または、有界領域５２０の内部、あるいはそれらの任煮の組み合わせへと移動され得ることが理解されるべきである。しかしながら、明確化のために、例としてかつ限定ではなく、図５Ｂおよび図５Ｅのコンステレーション図に例示的に示されるように、ポイント５０７は、そのようなポイント５０７に関連するそれぞれの象限の原点５０４に移動されることが想定されるものである。
【００３６】
図５Ｅにおいて、コンステレーション５２５は、有界領域、すなわち有界領域５２０へ転送される、象限ＩからＩＶに関連する全てのポイントまたはシンボルを有するものとして、例示的に示される。したがって、コンステレーション５２５は、ポイント５０７を原ポイント５０４に転送した後の、図５Ｂのコンステレーション５１０Ｂである。この例示的な実施形態について、ポイント５０３およびポイント５０７は、象限対象限基準（quadrant-by-quadrant basis）で、それぞれの原点５０４へ転送される。
【００３７】
図５Ｆにおいて、コンステレーション５３０は、有界領域５２０へ転送される、象限ＩからＩＶに関連する全てのポイントまたはシンボルを有するものとして、例示的に示される。したがって、コンステレーション５３０は、象限対象限基準で、ポイント５０７を、有界領域５２０の範囲内または有界領域５２０の境界上のいずれかのポイントに転送した後の、図５Ｂのコンステレーション５１０Ｂである。
【００３８】
図６は、コンステレーション６００の例示的な実施形態を示すグラフを例示的に示す。明確化のために、例としてかつ限定ではなく、ポイントまたはシンボルの分散は、図６においては例示的に示されていない。
【００３９】
図６は、１６−ＱＡＭの実施形態についての有界領域５２０，６２０を例示的に示す。有界領域５２０は、図５Ａから図５Ｅの４−ＱＡＭの実施形態を参照して先述されたように、コンステレーション６００の周辺においてコーナーシンボル６３１から６３４に関連する。しかしながら、有界領域６２０は、コンステレーション６１０の他の周辺場所、すなわち端部シンボル６４１〜６４４，６５１〜６５４に関連する。
【００４０】
内部シンボル６２１から６２４は、図４の修正されたＡＣＥ調整器４１０によって変化しない。垂直端部シンボル６４１から６４４は、（軸５０２に平行な）基準線５０６と円弧部または円弧長６１２との交点によって定められる有界領域６２０を有する。垂直有界領域６２０についての円弧６１２は、基準線５０６から基準線５０６へ伸延し、原点５０４から半径方向に広がる。垂直端部シンボル６４１から６４４は、したがって、半円、またはπ／２の円弧を有する。象限ＩおよびＩＩＩにおける垂直有界領域６２０の円弧６１２は、基準線５０６から、軸５０１に対して正方向に伸延する。象限ＩＩおよびＩＶにおける垂直有界領域６２０の円弧６１２は、基準線５０６から、軸５０１に対して負方向に伸延する。
【００４１】
水平端部シンボル６５１から６５４は、（軸５０１に平行な）軸５０５と円弧６１２との交点によって定められる有界領域６２０を有する。水平有界領域６２０についての円弧６１２は、基準線５０５から基準線５０５へ伸延し、原点５０４から半径方向に広がる。水平端部シンボル６５１から６５４は、したがって、半円またはπ／２の円弧を有する。象限ＩおよびＩＩにおける水平有界領域６２０の円弧６１２は、基準線５０５から、軸５０２に対して正方向に伸延する。象限ＩＩＩおよびＩＶにおける水平有界領域６２０の円弧６１２は、基準線５０５から、軸５０２に対して負方向に伸延する。
【００４２】
図４を新たに参照して、後続の反復についてのＩＦＦＴ２０３への入力のためのサブキャリア２０１として、有界領域シンボル４０８をフィードバックすることによって、新しいピークが導入され得る。したがって、ＰＡＰＲの目的のためのピークしきい値に合致するとともにＥＶＭしきい値にも合致する出力を有するためのピークを低減するのは、２つ以上の反復サイクルである。図３Ｂの波形３００Ａの正側にのみクリップされたピーク、すなわち図３Ｂの波形３００Ｂが示されているが、クリッピングは、正側振幅および負側振幅のいずれか、または双方に生じ得ることが理解されるべきである。したがって、クリッピングには、正側のしきい値および負側のしきい値の双方が用いられ得る。
【００４３】
図７は、信号処理フロー７００の例示的な実施形態を示すフロー図である。７０１にて、クリップされた周波数領域シンボルが取得される。７０２にて、ＡＣＥ反復法を用いて、７０１で取得されたシンボルの移動され得る任意のシンボルが、７０２において移動または転送される。
【００４４】
７０３にて、７０２において実行されるＡＣＥ反復後の任意のシンボルが、７０３で決定されるような有界領域の外側に残っているか否かを判定するために、ＥＶＭについての、またはＥＶＭに応答する有界領域が適用され得る。そのようなシンボルのいくつかが７０３で決定されるような有界領域の外側にある場合、そのようなシンボルは、本明細書で前述したように、そのような有界領域に移動され得る。
【００４５】
７０４にて、他の反復が実行されるべきか否かが判定される。この判定は、ＰＡＰＲの目的のためにクリップされる必要のある他のピークが生成されたか否か、すなわち、ＡＣＥ反復によって処理されない他のシンボルが有界領域の外側に存在し得るか否かに基づく。しかしながら、他の反復が７０４で実行されるか否かの判定に関して、設定された数の反復が実行されることが理解されるべきであり、そのような数は、反復のそのような設定数の範囲内で、ＰＡＰＲおよびＥＶＭの問題に対処するために公知である。たとえば、いくつかの用途については、１回、２回、または３回の反復で十分であり得る。
【００４６】
すべての反復が完了した後、時間領域サンプルにＩＦＦＴ変換された、最終反復の修正されたＡＣＥで調整された周波数領域シンボルが、７０５において、送信のために解放され得る。出力用の時間領域サンプルを記憶するための記憶アレイは、図２に例示的に示されてはいないけれども、送信用の時間領域サンプルを記憶するための制御回路およびアレイは公知であり、そのため、明確化の目的のために不必要な詳細は本明細書に記載されていないことが理解されるべきである。
【００４７】
上記には、本発明の１つまたはより多くの局面に従う例示的な実施形態が説明されるが、本発明の１つまたはより多くの局面に従う他のおよびさらなる実施形態が、その範囲から逸脱することなく考案され得、それは、以下の特許請求の範囲およびその均等物によって定められる。ステップを列挙する請求項は、ステップのいかなる順序も暗に意味するものではない。商標は、個々の所有者の財産である。
【図１】
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【図２】
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【図３Ａ】
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【図３Ｂ】
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【図４】
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【図５Ａ】
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【図５Ｂ】
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【図５Ｃ】
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【図５Ｄ】
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【図５Ｅ】
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【図５Ｆ】
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【図６】
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【図７】
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