(57)【特許請求の範囲】
【請求項１】
第１導電型ドリフト層と、当該第１導電型ドリフト層の第１主面側に選択的に形成された第２導電型ベース層と、当該第２導電型ベース層の表面に選択的に形成された第１導電型ソース領域と、前記第２導電型ベース層のうち前記第１導電型ドリフト層と前記第１導電型ソース領域とに挟まれる部分に接するゲート絶縁膜と当該ゲート絶縁膜に接するゲート電極とからなるＭＯＳゲート構造と、前記第１導電型ソース領域と前記第２導電型ベース層とに接触するエミッタ電極と、前記第１導電型ドリフト層の第２主面側に形成された第２導電型コレクタ層と、当該第２導電型コレクタ層に接触するコレクタ電極と、を備える半導体装置であって、
前記第１導電型ドリフト層中に当該第１導電型ドリフト層の不純物濃度が極大となる箇所が少なくとも１か所あり、かつ前記第１導電型ドリフト層の不純物濃度が、前記極大となる箇所から前記第２導電型ベース層および前記第２導電型コレクタ層の両方に向かって低くなり、
さらに、前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所に、酸素原子と水素原子が含まれており、
前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所は、該箇所の第１導電型不純物として、前記酸素原子と前記水素原子に起因する複合ドナーを有することを特徴とする半導体装置。
【請求項２】
前記第１導電型ドリフト層と前記第２導電型コレクタ層との間に設けられた第１導電型バッファ層を備えることを特徴とする請求項１に記載の半導体装置。
【請求項３】
前記第１導電型バッファ層は、第１導電型不純物として、前記酸素原子と前記水素原子に起因する複合ドナーを有することを特徴とする請求項２に記載の半導体装置。
【請求項４】
前記第１導電型バッファ層の不純物濃度は、前記第１導電型ドリフト層の平均不純物濃度の５倍よりも大きいことを特徴とする請求項２に記載の半導体装置。
【請求項５】
上記請求項１〜４のいずれか一つに記載の半導体装置を製造するにあたって、
前記第１導電型ドリフト層となる第１導電型の半導体基板中に酸素を導入する工程と、
前記半導体基板の第１主面または第２主面にイオン化した荷電粒子を照射して、同半導体基板中の前記第１導電型ドリフト層に結晶欠陥を導入する工程と、
熱処理を行って、前記第１導電型ドリフト層に導入された結晶欠陥を回復させて前記酸素原子と前記水素原子に起因する複合ドナーを形成することにより、前記第１導電型ドリフト層の一部のネットドーピング濃度を前記半導体基板の当初のネットドーピング濃度よりも高くする工程と、
を含むことを特徴とする半導体装置の製造方法。
【請求項６】
前記イオン化した荷電粒子がプロトンであることを特徴とする請求項５に記載の半導体装置の製造方法。
【請求項７】
前記荷電粒子を照射する前記半導体基板の第１主面または第２主面からの前記荷電粒子の飛程が、前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所の前記照射する主面からの距離に等しいことを特徴とする請求項５または６に記載の半導体装置の製造方法。
【請求項８】
前記熱処理が水素雰囲気で行われることを特徴とする請求項５〜７のいずれか一つに記載の半導体装置の製造方法。
【請求項９】
前記半導体基板の第２主面を研削する工程をさらに含むことを特徴とする請求項５〜８のいずれか一つに記載の半導体装置の製造方法。
【請求項１０】
第１導電型ドリフト層と、当該第１導電型ドリフト層の第１主面側に選択的に形成された第２導電型ベース層と、当該第２導電型ベース層の表面に選択的に形成された第１導電型ソース領域と、前記第２導電型ベース層のうち前記第１導電型ドリフト層と前記第１導電型ソース領域とに挟まれる部分に接するゲート絶縁膜と当該ゲート絶縁膜に接するゲート電極とからなるＭＯＳゲート構造と、前記第１導電型ソース領域と前記第２導電型ベース層とに接触するエミッタ電極と、前記第１導電型ドリフト層の第２主面側に形成された第２導電型コレクタ層と、前記第１導電型ドリフト層と前記第２導電型コレクタ層との間に設けられた第１導電型バッファ層と、前記第２導電型コレクタ層に接触するコレクタ電極と、を備える半導体装置であって、
エピタキシャル成長により形成した前記第２導電型コレクタ層の第１主面側に、エピタキシャル成長により形成した前記第１導電型ドリフト層が設けられ、
前記第１導電型バッファ層の不純物濃度は、前記第１導電型ドリフト層の平均不純物濃度の５倍よりも大きく、前記第２導電型コレクタ層の厚さは、前記第１導電型ドリフト層において当該第１導電型ドリフト層の平均不純物濃度よりも不純物濃度が高い領域の厚さよりも厚く、
前記第１導電型ドリフト層中に当該第１導電型ドリフト層の不純物濃度が極大となる箇所が少なくとも１か所あり、かつ前記第１導電型ドリフト層の不純物濃度が、前記極大となる箇所から前記第２導電型ベース層および前記第２導電型コレクタ層の両方に向かって低くなることを特徴とする半導体装置。
【請求項１１】
前記第１導電型ドリフト層の不純物濃度が極大となる箇所を含む領域の厚さは、前記第１導電型バッファ層の厚さの５倍よりも大きいことを特徴とする請求項１０に記載の半導体装置。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、半導体装置およびその製造方法に関し、特に、高速・低損失であるだけでなく、ソフトなスイッチング特性を兼ね備えたＩＧＢＴ（絶縁ゲート型バイポーラトランジスタ）およびその製造方法に関する。
【背景技術】
【０００２】
電力用半導体装置として、６００Ｖ、１２００Ｖまたは１７００Ｖ等の耐圧クラスのダイオードやＩＧＢＴ等がある。近時、これらのデバイスの特性改善が進んでいる。電力用半導体装置は、高効率で省電力なコンバーター−インバーター等の電力変換装置に用いられており、回転モーターやサーボモーターの制御に不可欠である。
【０００３】
このような電力制御装置には、低損失で省電力であり、また高速、高効率であり、さらに環境に優しい、すなわち周囲に対して悪影響を及ぼさないという特性が要求されている。このような要求に対して、ダイオードにおいては、ブロードバッファ構造が提案されている。ブロードバッファ構造とは、Ｎ-ドリフト層の平均的な濃度分布が、同層のほぼ中間付近にピーク（極大値）を有し、かつエミッタおよびコレクタ方向に向かって、傾きをもって減少するような構造のことである（例えば、下記特許文献１参照。）。
【０００４】
ブロードバッファ構造のダイオードでは、従来のエミッタ注入効率を下げるとともにライフタイム分布の制御を行う技術（例えば、下記特許文献２参照。）では困難であるような高速動作（例えば、キャリア周波数：２０ｋＨｚ以上）でのソフトリカバリー特性および発振抑制効果を実現することができる。このようなブロードバッファ構造のダイオードを作製する方法として、特許文献１には、次の２つの方法が開示されている。
【０００５】
第１の方法は、バルク内の深い領域、すなわち半導体チップの表面から３０〜６０μｍあるいはそれよりも深い領域に、半導体基板の当初のリン濃度よりも高いリン濃度の領域をエピタキシャル成長法により形成する方法である。第２の方法は、ＦＺ（フローティングゾーン）バルクウェハーにプロトンイオン（Ｈ+）を照射し、熱処理を行うことによって、バルク内部の飛程Ｒｐの近傍でプロトンをドナー化させる方法である。エピタキシャルウェハーよりもバルクウェハーの方が安価であるので、第２の方法は、第１の方法よりも安価である。
【０００６】
また、特許文献１の他にも、プロトンの照射と熱処理によるプロトンのドナー化現象を利用して高濃度のＮ+層を形成する方法が種々提案されている（例えば、下記特許文献３、特許文献４参照。）。その他にも、特許文献４には、酸素によるサーマルドナーを用いてＮ+層を形成する方法が開示されている。また、プロトンのドナー化を避ける必要がある場合には、プロトンの代わりにヘリウムを用いる提案がある（例えば、下記特許文献５参照。）。
【０００７】
また、安価にブロードバッファ構造を実現する方法として、アクセプタ元素で半導体基板のドナー（リン）濃度を補償することによって、ネットドーピング濃度としてバルク内部に高濃度領域を得る方法が提案されている（例えば、下記特許文献６参照。）。また、プロトンの照射によりシリコン基板中に欠陥を形成し、熱処理によりその残留欠陥を調整して、局所的にライフタイムを低減する方法が公知である（例えば、下記特許文献５参照。）。
【０００８】
また、低コストで電気的損失の低いＩＧＢＴを作製する方法として、慣用の半導体基板（例えばシリコンウェハー）を研削等により薄くした後に、その研削面側から所定の濃度で元素をイオン注入し、熱処理を行う方法が公知である（例えば、下記特許文献７参照。）。近年、このような低コストな方法による素子の開発および製造が主流になりつつある。
【０００９】
また、低損失特性およびソフトリカバリー特性の両方を向上させたＩＧＢＴとして、上述した特許文献７に開示されているフィールドストップ型ＩＧＢＴの他、下記特許文献８に開示されているソフトパンチスルー型ＩＧＢＴ、下記特許文献９および特許文献１０に開示されている中間高濃度層挿入型ＩＧＢＴが知られている。
【００１０】
【特許文献１】特開２００３−３１８４１２号公報
【特許文献２】特開平８−１４８６９９号公報
【特許文献３】特開平９−２６０６３９号公報
【特許文献４】特開２００１−１５６２９９号公報
【特許文献５】特開２００３−２４９６６２号公報
【特許文献６】特開２００５−６４４２９号公報
【特許文献７】特表２００２−５２０８８５号公報
【特許文献８】特開２０００−１９５８７０号公報
【特許文献９】特開平３−４４９６９号公報
【特許文献１０】特開２００４−１９３２１２号公報
【発明の開示】
【発明が解決しようとする課題】
【００１１】
しかしながら、上述した特許文献１〜７のように、ブロードバッファ構造を有するダイオードに関する技術は開示されているものの、ブロードバッファ構造を有するＩＧＢＴに関する技術はほとんど開示されていない。
【００１２】
また、特許文献８〜１０に開示されているＩＧＢＴでは、デバイス表面のうちＭＯＳゲートが形成されている側のＮ-ドリフト層における比抵抗が最も高い、すなわち、ドナー濃度が低い。このため、素子耐圧は十分に確保されるものの、素子耐圧の半分以上から素子耐圧未満程度の電圧である通常のＤＣバス電圧での動作では、Ｎ-ドリフト層の半分以上まで空乏層が広がる。
【００１３】
そのため、スイッチングの途中で内部の余剰キャリアが枯渇して、素子両端電圧の変化率（ｄＶ／ｄｔ）や素子電流の減少率（−ｄＩ／ｄｔ）が急峻となる。この結果、サージ電圧が素子耐圧を超えてしまい、素子が破壊されたり、数ＭＨｚ以上の振動数で発振したりしてしまうという問題点がある。このような波形発振が発生するメカニズムは、上記特許文献１に開示されているようなダイオードの発振現象と同じメカニズムである。
【００１４】
また、従来構造のＩＧＢＴでは、Ｎ-ドリフト層の厚さを薄くすることによって、高速
かつ低損失なスイッチング特性（ターンオフ・ターンオン損失）や低い導通損失（飽和電圧）の素子を得ることができる。しかし、この場合、内部の余剰キャリアが減少するため、上述した素子の破壊や発振が起こりやすくなってしまうという問題点がある。
【００１５】
ここで、本発明者が行った実験結果について説明する。この実験では、ＦＺ−Ｎ型シリコンウェハーにプロトンを照射し、熱処理を行った後、拡がり抵抗測定法により濃度プロファイルを直接評価した。ウェハーの比抵抗は３３０Ωｃｍであり、リン濃度は１．４×１０13／ｃｍ3であった。また、プロトンの照射エネルギーは７．９ＭｅＶであり、ドー
ズ量は１．０×１０１２／ｃｍ2であった。そして、アルミアブソーバーを用いてプロト
ンの飛程がシリコン表面、すなわちプロトンの照射面から約５０μｍの深さになるように
した。なお、プロトンの照射面には、１００００オングストロームの厚さの熱酸化膜を形成した。
【００１６】
熱処理条件は、３５０℃で６０分とした。また、窒素および水素雰囲気でアニールを行った。このようにした作製した試料を、角度が５°４４′であるマウントに貼り付け、ウェハーの断面が露出するように１／２０ダイヤモンドコンパウンドを用いて研磨した。
【００１７】
また、ｓｏｌｉｄ  ｓｔａｔｅ  ｍｅａｓｕｒｅｍｅｎｔ社製のＳＳＭ２０００を用いて試料の拡がり抵抗を測定した。その測定により得られた抵抗値をキャリア濃度に換算した結果を図２６に示す。図２６において、縦軸はキャリア濃度であり、横軸はウェハー表面（プロトンの照射面）からの距離、すなわち深さである。
【００１８】
図２６より、３５０℃でアニールすると、表面から５０μｍの深さの近傍では、プロトンを照射したウェハー（図２６のプロトン照射後）の平均的な濃度が、プロトンを照射していないウェハー（図２６のプロトン照射前）の濃度よりも一桁低くなっていることがわかる。これは、プロトンの飛程の前後に欠陥が多く存在しており、それによってこの深さの領域で高抵抗になっているからである。従って、特許文献１に開示されているようなブロードバッファ構造になっていないのは明らかである。以上のように、公知のプロトン照射および熱処理の方法では、所望のブロードバッファ構造を形成することは困難である。
【００１９】
また、上述した特許文献１では、ダイオード以外のデバイスに対するブロードバッファ構造の適用例として、ＭＯＳＦＥＴや逆阻止ＩＧＢＴに対するブロードバッファ構造の適用が示されている。しかしながら、パンチスルー型ＩＧＢＴに対するブロードバッファ構造の適用については示されていない。ブロードバッファ構造をパンチスルー型ＩＧＢＴに適用できない理由は、第１に、パンチスルー型ＩＧＢＴには、ＭＯＳＦＥＴの寄生ダイオードや逆阻止ＩＧＢＴの裏面ＰＮ接合によるダイオード動作がないためである。第２に、逆阻止ＩＧＢＴは、空乏層が表面からのみならず裏面からも広がるので、高濃度のＮ+バッファ層を表面にも形成しなければならない。このため、逆阻止ＩＧＢＴをパンチスルー型で形成することは、デバイスの動作上不可能であるためである。
【００２０】
また、従来型のパンチスルー型ＩＧＢＴにおいて、キャリア周波数が１０ｋＨｚ以上（典型的には２０ｋＨｚ）の高速動作タイプのデバイスでは、Ｎ-ドリフト層を薄くするとともに電子線照射などによって輸送効率を低くしている。このため、ターンオフ時に内部キャリアが枯渇して、素子両端電圧の急激な変化（ｄＶ／ｄｔ）や素子電流の急激な減少（−ｄＩ／ｄｔ）が発生する。これにより、ターンオフ時にサージ電圧が素子耐量を超えてデバイスが破損したり、数ＭＨｚ以上の振動数の波形が発振してしまうという問題点がある。
【００２１】
この発明は、上述した従来技術による問題点を解消するため、高速・低損失であり、かつソフトなスイッチング特性を有する半導体装置を提供することを目的とする。また、この発明は、高速・低損失であり、かつソフトなスイッチング特性を有する半導体装置を、ＦＺバルクウェハーを用いて安価に、かつ制御性よく作製することができる半導体装置の製造方法を提供することを目的とする。
【課題を解決するための手段】
【００２２】
上述した課題を解決し、目的を達成するため、この発明にかかる半導体装置は、第１導電型ドリフト層と、当該第１導電型ドリフト層の第１主面側に選択的に形成された第２導電型ベース層と、当該第２導電型ベース層の表面に選択的に形成された第１導電型ソース領域と、前記第２導電型ベース層のうち前記第１導電型ドリフト層と前記第１導電型ソース領域とに挟まれる部分に接するゲート絶縁膜と当該ゲート絶縁膜に接するゲート電極とからなるＭＯＳゲート構造と、前記第１導電型ソース領域と前記第２導電型ベース層とに接触するエミッタ電極と、前記第１導電型ドリフト層の第２主面側に形成された第２導電型コレクタ層と、当該第２導電型コレクタ層に接触するコレクタ電極と、を備える半導体装置であって、前記第１導電型ドリフト層中に当該第１導電型ドリフト層の不純物濃度が極大となる箇所が少なくとも１か所あり、かつ前記第１導電型ドリフト層の不純物濃度が、前記極大となる箇所から前記第２導電型ベース層および前記第２導電型コレクタ層の両方に向かって低くなり、さらに、前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所に、酸素原子と水素原子が含まれており、前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所は、該箇所の第１導電型不純物として、前記酸素原子と前記水素原子に起因する複合ドナーを有することを特徴とする。
【００２３】
上記の発明によれば、第１導電型ドリフト層の不純物濃度が極大となる箇所に、酸素原子と水素原子に起因する複合ドナーが存在することにより、所望のブロードバッファ構造が形成される。
【００２４】
また、この発明にかかる半導体装置は、上記発明において、前記第１導電型ドリフト層と前記第２導電型コレクタ層との間に設けられた第１導電型バッファ層を備えることを特徴とする。
【００２５】
また、この発明にかかる半導体装置は、上記発明において、前記第１導電型バッファ層は、第１導電型不純物として、前記酸素原子と前記水素原子に起因する複合ドナーを有することを特徴とする。
【００２６】
また、この発明にかかる半導体装置は、上記発明において、前記第１導電型バッファ層の不純物濃度は、前記第１導電型ドリフト層の平均不純物濃度の５倍よりも大きいことを特徴とする。
【００２８】
また、この発明にかかる半導体装置の製造方法は、上記に記載の半導体装置を製造するにあたって、前記第１導電型ドリフト層となる第１導電型の半導体基板中に酸素を導入する工程と、前記半導体基板の第１主面または第２主面にイオン化した荷電粒子を照射して、同半導体基板中の前記第１導電型ドリフト層に結晶欠陥を導入する工程と、熱処理を行って、前記第１導電型ドリフト層に導入された結晶欠陥を回復させて前記酸素原子と前記水素原子に起因する複合ドナーを形成することにより、前記第１導電型ドリフト層の一部のネットドーピング濃度を前記半導体基板の当初のネットドーピング濃度よりも高くする工程と、を含むことを特徴とする。
【００２９】
また、この発明にかかる半導体装置の製造方法は、上記発明において、前記イオン化した荷電粒子がプロトンであることを特徴とする。
【００３０】
また、この発明にかかる半導体装置の製造方法は、上記発明において、前記荷電粒子を照射する前記半導体基板の第１主面または第２主面からの前記荷電粒子の飛程が、前記第１導電型ドリフト層中の少なくとも当該第１導電型ドリフト層の不純物濃度が極大となる箇所の前記照射する主面からの距離に等しいことを特徴とする。
【００３１】
また、この発明にかかる半導体装置の製造方法は、上記発明において、前記熱処理が水素雰囲気で行われることを特徴とする。
【００３３】
また、この発明にかかる半導体装置の製造方法は、上記発明において、前記半導体基板の第２主面を研削する工程をさらに含むことを特徴とする。
【００３４】
また、この発明にかかる半導体装置は、第１導電型ドリフト層と、当該第１導電型ドリフト層の第１主面側に選択的に形成された第２導電型ベース層と、当該第２導電型ベース層の表面に選択的に形成された第１導電型ソース領域と、前記第２導電型ベース層のうち前記第１導電型ドリフト層と前記第１導電型ソース領域とに挟まれる部分に接するゲート絶縁膜と当該ゲート絶縁膜に接するゲート電極とからなるＭＯＳゲート構造と、前記第１導電型ソース領域と前記第２導電型ベース層とに接触するエミッタ電極と、前記第１導電型ドリフト層の第２主面側に形成された第２導電型コレクタ層と、前記第１導電型ドリフト層と前記第２導電型コレクタ層との間に設けられた第１導電型バッファ層と、前記第２導電型コレクタ層に接触するコレクタ電極と、を備える半導体装置であって、エピタキシャル成長により形成した前記第２導電型コレクタ層の第１主面側に、エピタキシャル成長により形成した前記第１導電型ドリフト層が設けられ、前記第１導電型バッファ層の不純物濃度は、前記第１導電型ドリフト層の平均不純物濃度の５倍よりも大きく、前記第２導電型コレクタ層の厚さは、前記第１導電型ドリフト層において当該第１導電型ドリフト層の平均不純物濃度よりも不純物濃度が高い領域の厚さよりも厚く、前記第１導電型ドリフト層中に当該第１導電型ドリフト層の不純物濃度が極大となる箇所が少なくとも１か所あり、かつ前記第１導電型ドリフト層の不純物濃度が、前記極大となる箇所から前記第２導電型ベース層および前記第２導電型コレクタ層の両方に向かって低くなることを特徴とする。
【００３５】
また、この発明にかかる半導体装置は、上記発明において、前記第１導電型ドリフト層の不純物濃度が極大となる箇所を含む領域の厚さは、前記第１導電型バッファ層の厚さの５倍よりも大きいことを特徴とする。
【発明の効果】
【００４０】
本発明にかかる半導体装置によれば、高速・低損失であり、かつソフトなスイッチング特性を有する半導体装置が得られる。また、本発明にかかる半導体装置の製造方法によれば、高速・低損失であり、かつソフトなスイッチング特性を有する半導体装置を、ＦＺバルクウェハーを用いて安価に、かつ制御性よく作製することができる。
【発明を実施するための最良の形態】
【００４１】
以下に添付図面を参照して、この発明にかかる半導体装置およびその製造方法の好適な実施の形態を詳細に説明する。本明細書および添付図面においては、ＮまたはＰを冠記した層や領域では、それぞれ電子または正孔が多数キャリアであることを意味する。また、ＮやＰに付す＋および−は、それぞれ相対的に不純物濃度が高いまたは低いことを意味する。なお、以下の実施の形態の説明および添付図面において、同様の構成には同一の符号を付し、重複する説明を省略する。
【００４２】
（実施の形態１）
図１は、実施の形態１にかかる半導体装置の構成、ネットドーピング濃度およびプロトン分布を示す図である。図１において半導体装置の断面図１００に示すように、Ｎ-ドリフト層１の一方の主面側に、Ｐベース層２が形成されている。また、Ｎ-ドリフト層１の他方の主面側には、Ｎ-ドリフト層１より不純物濃度が高いＮ型のコレクタバッファ層３が形成されている。また、コレクタバッファ層３の表面には、Ｐコレクタ層４が形成されている。
【００４３】
また、Ｐベース層２の表面には、エミッタ電極５が形成されている。また、Ｎ-ドリフト層１およびＰベース層２に接するように、ゲート絶縁膜６およびゲート電極７からなるＭＯＳゲート構造が形成されている。さらに、Ｐベース層２のうちエミッタ電極５およびゲート絶縁膜６に接する部分にＮ+ソース領域８が形成されている。また、Ｐコレクタ層４の表面には、コレクタ電極９が形成されている。
【００４４】
図１において、エミッタ電極５からの距離−ネットドーピング濃度（ｌｏｇ）の特性図１１０に示すように、Ｎ-ドリフト層１のネットドーピング濃度は、Ｎ-ドリフト層１のほぼ中間付近にピークを有し、Ｐベース層２およびコレクタバッファ層３に向かって、傾きをもって減少している。すなわち、実施の形態１の半導体装置は、ブロードバッファ構造となっている。Ｐベース層２、コレクタバッファ層３およびＰコレクタ層４のネットドーピング濃度は、ともにＮ-ドリフト層１のネットドーピング濃度よりも高い。
【００４５】
一例として、実施の形態１の半導体装置を、耐圧が１２００Ｖクラスで、定格電流が１５０Ａとなるように、チップサイズを１０ｍｍ×１０ｍｍとして作製した場合の各部のネットドーピング濃度および寸法を例示する。寸法については、Ｐベース層２とエミッタ電極５との界面を基準とし、特に断らない限り、この界面からの距離で表す。
【００４６】
Ｐベース層２とＮ-ドリフト層１との界面までの距離は、３μｍである。Ｐコレクタ層４とコレクタ電極９との界面までの距離は、１４０μｍである。コレクタバッファ層３とＰコレクタ層４との界面から、Ｐコレクタ層４とコレクタ電極９との界面までの距離、すなわちＰコレクタ層４の厚さは、０．５μｍである。
【００４７】
Ｐベース層２のネットドーピング濃度は、エミッタ電極５との界面において５×１０16ａｔｏｍｓ／ｃｍ3であり、Ｎ-ドリフト層１に向かって低くなり、Ｎ-ドリフト層１との界面では、５×１０13ａｔｏｍｓ／ｃｍ3よりも低い。Ｎ-ドリフト層１のネットドーピング濃度は、Ｐベース層２との界面では、５×１０13ａｔｏｍｓ／ｃｍ3よりも低いが、Ｐベース層２との界面近傍で５×１０13ａｔｏｍｓ／ｃｍ3となる。
【００４８】
そして、Ｎ-ドリフト層１のほぼ中間付近でピークとなる箇所のネットドーピング濃度は、１．５×１０14ａｔｏｍｓ／ｃｍ3である。また、Ｎ-ドリフト層１の、コレクタバッファ層３との界面およびその付近におけるネットドーピング濃度は、５×１０13ａｔｏｍｓ／ｃｍ3である。
【００４９】
コレクタバッファ層３のネットドーピング濃度は、Ｎ-ドリフト層１との界面において５×１０13ａｔｏｍｓ／ｃｍ3であり、Ｐコレクタ層４に向かって高くなる。コレクタバッファ層３のネットドーピング濃度は、Ｐコレクタ層４との界面近傍でＮ-ドリフト層１のピークのネットドーピング濃度である１．５×１０14ａｔｏｍｓ／ｃｍ3よりも高くなるが、Ｐコレクタ層４との界面では、５×１０13ａｔｏｍｓ／ｃｍ3よりも低い。
【００５０】
Ｐコレクタ層４のネットドーピング濃度は、コレクタバッファ層３との界面において５×１０13ａｔｏｍｓ／ｃｍ3よりも低いが、コレクタ電極９に向かって高くなり、コレクタ電極９との界面で１×１０18ａｔｏｍｓ／ｃｍ3となる。
【００５１】
図１において、エミッタ電極からの距離−プロトン分布の特性図１２０に示すように、Ｎ-ドリフト層１のネットドーピング濃度がピークとなる箇所までの距離は、６０μｍである。この距離は、製造段階でＰベース層２の表面にプロトンを照射したときのプロトンの飛程Ｒｐに等しい。このプロトンの飛程Ｒｐの前後でプロトンの濃度が高い。Ｎ-ドリフト層１には酸素原子が導入されており、酸素原子とプロトンとからなる複合ドナーによって、所望のブロードバッファ構造が形成されている。
【００５２】
次に、実施の形態１にかかる半導体装置の製造プロセスについて説明する。ここでは、一例として、図１に例示した寸法およびネットドーピング濃度の半導体装置（耐圧：１２００Ｖクラス、定格電流：１５０Ａ）を製造する場合について説明する。図２および図３は、実施の形態１にかかる半導体装置の製造プロセスを示す図である。まず、図２の断面図２００に示すように、半導体基板として、比抵抗が４０〜１２０Ωｃｍ、例えば９０Ωｃｍ（リン濃度５．０×１０13ａｔｏｍｓ／ｃｍ3）のＦＺウェハー１０を用意する。
【００５３】
そして、図２の断面図２１０に示すように、このＦＺウェハー１０の両面にリンガラス１１を塗布し、窒素および酸素雰囲気で例えば１２５０℃、１００時間の熱処理を行って、両面からリン（Ｐ）を拡散させる。この熱処理によって、ＦＺウェハー１０の両面からウェハー内に大量の酸素（Ｏ）が導入され、ＦＺウェハー１０における酸素濃度は、固溶限界濃度（約１×１０18ａｔｏｍｓ／ｃｍ3）となる。
【００５４】
次いで、断面図２１０に一点鎖線で示すように、ＦＺウェハー１０を研削し、ウェハー表面の高濃度のリン拡散層２１１を除去する。それによって、図２の断面図２２０に示すように、高濃度のリン拡散層２１１からなるＮ+層２１４を有する薄ウェハー２１３が得られる。この薄ウェハー２１３の一方の表面をポリッシュして鏡面に仕上げる。このＦＺウェハー１０のミラー仕上げ面には、後のＭＯＳデバイスの形成工程において、Ｐベース層２、エミッタ電極５、ゲート絶縁膜６およびゲート電極７からなるＭＯＳゲート構造、Ｎ+ソース領域８が形成される。ＦＺウェハー１０の厚さは、この研削およびポリッシュ後に例えば５００μｍになるように、予め選定されている。
【００５５】
ＦＺウェハー１０のミラー仕上げ面での比抵抗は、例えば９０Ωｃｍである。ＦＺウェハー１０の他方の表面は、リンガラス１１を除去したままの状態である。この面の表面濃度は、例えば１×１０20ａｔｏｍｓ／ｃｍ3程度であり、高濃度のリンが例えば８０μｍ程度の深さまで拡散している。
【００５６】
次いで、図２の断面図２３０に示すように、標準的なＭＯＳデバイスのプロセス工程によって、Ｐベース層となるＰベース層２、エミッタ電極５、ゲート絶縁膜６およびゲート電極７からなるＭＯＳゲート構造、Ｎ+ソース領域８を形成する。Ｐベース層２の濃度は、例えば５×１０16ａｔｏｍｓ／ｃｍ3であり、その深さは、例えば３μｍである。
【００５７】
次いで、図２の断面図２４０に示すように、エミッタ電極５の側からＦＺウェハー１０に、サイクロトロンにより加速されたプロトンを照射する。その際、サイクロトロンの加速電圧は、例えば７．９ＭｅＶであり、プロトンのドーズ量は、例えば１．０×１０12ａｔｏｍｓ／ｃｍ2である。また、アルミアブソーバーを用い、その厚さを調節して、プロトンの飛程がＦＺウェハー１０の半導体とエミッタ電極５との界面から６０μｍとなるようにする。断面図２４０において、×印は、プロトンの照射によりＦＺウェハー１０内に生じた結晶欠陥１２を表す。
【００５８】
次いで、図３の断面図３００に示すように、例えば３５０℃で１時間の熱処理を水素雰囲気で行い、結晶欠陥１２を回復させる。それによって、ＦＺウェハー１０の半導体とエミッタ電極５との界面から６０μｍの深さのところを中心としてその前後に高濃度領域１３ができる。この高濃度領域１３によって、所望のブロードバッファ構造が形成される。
【００５９】
次いで、図３の断面図３１０に示すように、ＦＺウェハー１０の、リンガラス１１が除去された状態のままの面に対して研削やウエットエッチングを行い、ＦＺウェハー１０を所定の厚さにする。１２００Ｖクラスの場合、この段階でのＦＺウェハー１０の厚さは、典型的には１００〜１６０μｍである。実施の形態１では、この段階でのＦＺウェハー１０の厚さは、例えば１２０μｍである。
【００６０】
次いで、図３の断面図３２０に示すように、ＦＺウェハー１０の、研削やウエットエッチングが行われた面に対してリン等のＮ型不純物をイオン注入する。その際の加速電圧は、例えば２００ｋｅＶであり、ドーズ量は、例えば５×１０12ａｔｏｍｓ／ｃｍ2である。次いで、そのイオン注入面に対して、ＹＡＧ第２高調波レーザ等のレーザ光をダブルパルス法にて照射する。
【００６１】
ここで、ダブルパルス法とは、レーザ光の照射エリアごとに、複数のレーザ照射装置から所定の遅延時間だけ照射タイミングをずらして複数のパルスレーザを連続的に照射する方法である。ダブルパルス法については、特開２００５−２２３３０１号公報に詳述されている。
【００６２】
ダブルパルス法によりレーザ光を照射する際のエネルギー密度は、レーザ光の照射エリアごとに、合計で例えば３Ｊ／ｃｍ2である。また、ダブルパルスの遅延時間は、例えば３００ｎｓｅｃである。このレーザ照射によって、その前にイオン注入されたリン等のＮ型不純物が電気的に活性化して、空乏層を止めるフィールドストップ層となるコレクタバッファ層３ができる。なお、コレクタバッファ層３を形成する際に注入するイオンを、リンよりも拡散係数が大きいＮ型元素（たとえばセレンなど）にして、リンを用いるよりも拡散深さが深いバッファ層を形成してもよい。
【００６３】
つづいて、コレクタバッファ層３を形成した面に対して、ボロンなどのＰ型不純物をイオン注入する。その際の加速電圧は、例えば４５ｋｅＶであり、ドーズ量は、例えば１×１０14ａｔｏｍｓ／ｃｍ2である。次いで、そのイオン注入面に対して例えば３５０℃で１時間の熱処理を行い、Ｐコレクタ層４を形成する。
【００６４】
最後に、Ｐコレクタ層４の表面にアルミニウム、チタン、ニッケルおよび金の順で金属を成膜しコレクタ電極９を形成して、半導体装置（ＩＧＢＴ）が完成する。ＦＺウェハー１０の、Ｐベース層２とコレクタバッファ層３の間の部分は、Ｎ-ドリフト層１となる。図３の特性図３３０は、断面図３２０の半導体装置に対応するネットドーピング濃度のプロファイルである。
【００６５】
なお、ブロードバッファ層部分におけるピークのドーピング濃度ＮｐとＮ-ドリフト層１の平均ドーピング濃度Ｎｄｍの比は、Ｎｐ／Ｎｄｍ＜５とするのが望ましい。その理由は、Ｎｐ／Ｎｄｍ＜５とすれば、素子両端電圧の変化率（ｄＶ／ｄｔ）が小さくなるからである。また、ブロードバッファ層の実効積分濃度は、１ｃｍ2当たり８×１０11／ｃｍ2以下、Ｎ-ドリフト層全体の実効積分濃度は、１ｃｍ2当たり１．２×１０11／ｃｍ2とするのが望ましい。
【００６６】
ここで、本発明者が行った実験結果について説明する。この実験では、図２及び図３の製造プロセスと同じ条件でＦＺ−Ｎ型シリコンウェハーに酸素を導入し、ウェハーの表面に１００００オングストロームの厚さの熱酸化膜を形成し、その表面にプロトンを照射した。ウェハーの比抵抗は３３０Ωｃｍであり、リン濃度は１．４×１０13／ｃｍ3であった。プロトンの照射エネルギーを７．９ＭｅＶとし、ドーズ量を１．０×１０12／ｃｍ2とした。
【００６７】
その後、水素雰囲気で熱処理を行った。熱処理条件を３５０℃で６０分とした。得られた試料を角度が５°４４′であるマウントに貼り付け、ウェハーの断面が露出するように１／２０ダイヤモンドコンパウンドを用いて研磨し、その露出面に対してｓｏｌｉｄ  ｓｔａｔｅ  ｍｅａｓｕｒｅｍｅｎｔ社製のＳＳＭ２０００を用いて拡がり抵抗を測定した。
【００６８】
測定により得られた抵抗値をキャリア濃度に換算した結果を図４（熱処理温度：３５０℃）に示す。図４において、縦軸はキャリア濃度であり、横軸はウェハー表面（プロトンの照射面）からの距離である。
【００６９】
図４より、３５０℃でアニールすると、表面から５０μｍの深さの近傍では、プロトンを照射したウェハー（図４のプロトン照射後）の平均的な濃度が、プロトンを照射していないウェハー（図４のプロトン照射前）の濃度、すなわちウェハーの当初の濃度よりも高くなっており、所望のブロードバッファ構造ができていることがわかる。なお、図４において、ウェハー表面からおよそ１５μｍの深さまでに高濃度領域（低抵抗領域）があるのは、酸化膜からの酸素の拡散によるものである。
【００７０】
以上の説明、並びに図４と図２６との比較から、ブロードバッファ構造を形成するためには、プロトンの照射により基板に水素原子を導入するだけでなく、基板に酸素が含まれていることが極めて重要であるということは、明らかである。また、熱処理によって酸素との相互作用により複合ドナーとなるためには、酸素よりも軽い元素を照射する必要がある。従って、照射する荷電粒子としては、Ｈ、Ｈｅ、Ｌｉ、ＢｅおよびＢの中で、Ｌｉよりも軽いＨやＨｅが好ましく、特にＨ（プロトン）が望ましい。
【００７１】
図５は、実施の形態１にかかる半導体装置および従来型ＩＧＢＴのターンオフ波形を示す図である。図５において、実施の形態１にかかる半導体装置（Ｎ-ドリフト層厚：１２０μｍ）のコレクタ電流Ｉｃおよびコレクタ・エミッタ間の電圧Ｖｃを太実線で示す。また、Ｎ-ドリフト層厚が１２０μｍの従来型ＩＧＢＴのコレクタ電流Ｉｃおよびコレクタ・エミッタ間の電圧Ｖｃを細実線で示す。また、Ｎ-ドリフト層厚が１４０μｍの従来型ＩＧＢＴのコレクタ電流Ｉｃおよびコレクタ・エミッタ間の電圧Ｖｃを一点破線で示す。
【００７２】
図５に示したターンオフ波形は、いずれも図６に示すスナバレス回路６０における波形図である。スナバレス回路６０の主回路の負荷インダクタンスＬｍは１ｍＨ、主回路の回路浮遊インダクタンスＬｓは２００ｎＨである。また、スナバレス回路６０のゲート抵抗は１０Ωであり、ゲート駆動電圧は±１５Ｖである。また、測定時の接合温度はいずれも１２５℃とした。
【００７３】
Ｎ-ドリフト層厚が１２０μｍの従来型ＩＧＢＴの場合、サージ電圧が５０Ｖ増加して発振している。Ｎ-ドリフト層厚が１４０μｍの従来型ＩＧＢＴの場合には、Ｎ-ドリフト層厚が１２０μｍの従来型ＩＧＢＴの場合のような発振は発生していない。このように、従来型ＩＧＢＴで発振を抑えるには、Ｎ-ドリフト層厚を、たとえば１４０μｍ程度まで増加させる必要がある。一方、実施の形態１にかかる半導体装置は、Ｎ-ドリフト層厚が１２０μｍであっても発振は発生せず、スムースなスイッチング波形を示している。
【００７４】
また、実施の形態１にかかる半導体装置では、従来型ＩＧＢＴに比べて損失特性が向上している。Ｎ-ドリフト層厚が１４０μｍの従来型ＩＧＢＴの飽和電圧は１．９Ｖであるのに対して、実施の形態１にかかる半導体装置の飽和電圧は１．７Ｖであり、飽和電圧が０．２Ｖほど低減している。また、Ｎ-ドリフト層厚が１４０μｍの従来型ＩＧＢＴのターンオフ損失は１４．５ｍＪ／ｃｍ2であるのに対して、実施の形態１にかかる半導体装置のターンオフ損失は１３．５ｍＪ／ｃｍ2であり、ターンオフ損失が７％ほど低減している。このように、実施の形態１にかかる半導体装置では、従来型ＩＧＢＴと比べてトレードオフ特性を著しく向上させることができる。
【００７５】
図７は、デバイスシュミレーションによる実施の形態１にかかる半導体装置のターンオフ時の内部状態の変化を示す説明図である。図８は、デバイスシュミレーションによる従来型ＩＧＢＴ（Ｎ-ドリフト層厚：１２０μｍ）のターンオフ時の内部状態の変化を示す説明図である。図７および図８には、エミッタ電極からの距離−不純物濃度（ドナー濃度）の関係、各時刻（μｓ）におけるエミッタ電極からの距離−電界強度の関係および測定開始からの各時刻（μｓ）におけるエミッタ電極からの距離−電子濃度の関係が示されている。
【００７６】
図７に示すように、実施の形態１にかかる半導体装置では、時刻０．３〜０．４μｓまでの間、余剰キャリアの枯渇は見られない。また、実施の形態１にかかる半導体装置では、エミッタ電極から１００μｍ付近で空乏層の広がりが止まっている。一方で、図８に示すように、従来型ＩＧＢＴでは、計測開始から時刻０．３７５μｓ以降で余剰キャリアの枯渇が見られる。また、従来型ＩＧＢＴでは、エミッタ電極から１２０μｍ付近まで空乏層が広がっており、ほぼフィールドストップ層まで空乏層が広がっている。すなわち、従来型ＩＧＢＴでは、空乏層の拡張によってキャリアが掃出され、余剰キャリアの枯渇が生じている。これは、上述した特許文献１に開示されている、いわゆる空間電荷領域のピン止め効果と同様の現象である。
【００７７】
（実施の形態２）
つづいて、実施の形態２にかかる半導体装置の製造プロセスについて説明する。実施の形態２にかかる半導体装置の構成は、実施の形態１にかかる半導体装置の構成と同様であるが、製造プロセスが異なる。具体的には、実施の形態１では、イオン注入およびパルス照射によってコレクタバッファ層３を形成したが、実施の形態２では、プロトンのシャドードナーによってコレクタバッファ層３を形成する。
【００７８】
図９は、実施の形態２にかかる半導体装置の構成、ネットドーピング濃度およびプロトン分布を示す図である。図９において半導体装置の断面図９００およびエミッタ電極５からの距離−ネットドーピング濃度（ｌｏｇ）の特性図９１０に示すように、実施の形態２にかかる半導体装置の構成およびネットドーピング濃度は、図１に示した実施の形態１にかかる半導体装置と同様である。
【００７９】
一方、エミッタ電極５からの距離−プロトン分布の特性図９２０に示すように、Ｎ-ドリフト層１のネットドーピング濃度がピークとなる箇所までの距離は、５０μｍであり、この前後でプロトンの濃度が高い。また、深さが１１０〜１４０μｍの領域において、プロトンの濃度が高い。５０μｍの深さの付近でプロトンの濃度が高いのは、ブロードバッファ構造を形成しているからである。また、１１０〜１４０μｍの深さの領域でプロトンの濃度が高いのは、コレクタバッファ層３を形成しているからである。
【００８０】
なお、Ｐコレクタ層４とコレクタ電極９との界面までの距離が１２０μｍであるにもかかわらず、深さが１１０〜１４０μｍの領域においてプロトンの濃度が高いとしたが、これは、後述するように、１２０μｍよりも厚い研削前のウエハーに、プロトンを、その飛程が１１０〜１４０μｍとなるように照射するからである。
【００８１】
図１０および図１１は、実施の形態２にかかる半導体装置の製造プロセスを示す図である。ここでは、一例として、実施の形態１にかかる半導体装置と同様の寸法およびネットドーピング濃度の半導体装置（耐圧：１２００Ｖクラス、定格電流：１５０Ａ）を製造する場合について説明する。まず、図１０の断面図１０００、断面図１０１０、断面図１０２０および断面図１０３０に示すように、図２で説明したプロセスと同様にして、リン（Ｐ）及び固溶限界濃度まで酸素が導入されたＦＺウエハー１０のミラー仕上げ面に、標準的なＭＯＳデバイスのプロセス工程によって、Ｐベース層２、エミッタ電極５、ゲート絶縁膜６およびゲート電極７からなるＭＯＳゲート構造、Ｎ+ソース領域８を形成する。
【００８２】
次いで、図１０の断面図１０４０に示すように、エミッタ電極５の側からＦＺウエハー１０に図２の説明と同じ条件でプロトンを照射する。ただし、アルミアブソーバーの厚さを調節して、プロトンの飛程がＦＺウエハー１０の半導体とエミッタ電極５との界面から５０μｍとなるようにする（図９、特性図９２０のＲｐ１参照）。断面図１０４０において、Ｐベース層２に近い側の×印は、この飛程Ｒｐ１を５０μｍとしたときのプロトンの照射によりＦＺウエハー１０内に生じた結晶欠陥１２を表す。
【００８３】
続いて、プロトンの飛程がＦＺウエハー１０の半導体とエミッタ電極５との界面から１１０〜１４０μｍとなるようにアルミアブソーバーの厚さを調節して（図９、特性図９２０のＲｐ２参照）、エミッタ電極５の側からＦＺウエハー１０に図２の説明と同じ条件でプロトンを照射する。断面図１０４０において、Ｐベース層２から遠い側の×印は、この飛程Ｒｐ２を１１０〜１４０μｍとしたときのプロトンの照射によりＦＺウエハー１０内に生じた結晶欠陥１４を表す。
【００８４】
なお、２回目のプロトンの照射については、エミッタ電極５の反対側から照射してもよい。エミッタ電極５の反対側とは、エミッタ電極５をＦＺウエハー１０のおもて面に形成するとすれば、ＦＺウエハー１０の裏面側のことである。裏面側から２回目のプロトン照射を行った場合のプロトンの分布を、図９の特性図９２０に破線で示す。
【００８５】
次いで、図１１の断面図１１００に示すように、図３の説明と同じ条件で熱処理を行う。それによって、１回目のプロトン照射でできた結晶欠陥１２の回復による第１の高濃度領域１３と、２回目のプロトン照射でできた結晶欠陥１４の回復による第２の高濃度領域１５ができる。第１の高濃度領域１３によって、所望のブロードバッファ構造が形成される。また、第２の高濃度領域１５によって、コレクタバッファ層３が形成される。
【００８６】
次いで、図１１の断面図１１１０に示すように、図３の説明と同様にして、ＦＺウエハー１０を例えば１２０μｍの厚さにする。そして、図１１の断面図１１２０に示すように、図３の説明と同様にして、Ｐコレクタ層４およびコレクタ電極９を形成し、半導体装置が完成する。ＦＺウエハー１０の、Ｐベース層２とコレクタバッファ層３の間の部分は、Ｎ-ドリフト層１となる。図１１の特性図１１３０は、断面図１１２０の半導体装置に対応するネットドーピング濃度のプロファイルである。
【００８７】
（実施の形態３）
図１２は、実施の形態３にかかる半導体装置の構成およびネットドーピング濃度を示す図である。実施の形態３では、Ｎ-ドリフト層１のブロードバッファ構造をアクセプタの補償によって形成する。図１２において半導体装置の断面図１２００に示すように、実施の形態３の半導体装置は、図１に示す実施の形態１の半導体装置のコレクタバッファ層３を薄くした構成である。その他の構成は実施の形態１と同様であるので、同一の符号を付して説明を省略する。
【００８８】
一例として、実施の形態３の半導体装置の各部のネットドーピング濃度および寸法を例示する。ただし、実施の形態１で例示した値と異なる値のみ説明する。図１２においてエミッタ電極５からの距離−ネットドーピング濃度（ｌｏｇ）の特性図１２１０に示すように、Ｐコレクタ層４とコレクタ電極９との界面までの距離は、１２０μｍである。
【００８９】
また、半導体装置の基板全体のドナー濃度は１．５×１０14ａｔｏｍｓ／ｃｍ3である。エミッタ電極５とＰベース層２との界面からＮ-ドリフト層１のほぼ中央（ネットドーピング濃度がピークになる付近）にかけて、アクセプタとしてアルミニウム（Ａｌ）またはガリウム（Ｇａ）が拡散されている。また、コレクタ電極９とＰコレクタ層４との界面からＮ-ドリフト層１のほぼ中央にかけて、アクセプタとして亜鉛（Ｚｎ）または白金（Ｐｔ）が拡散されている。このアクセプタ濃度は、各位置において基板全体のドナー濃度より低くなっている。
【００９０】
次に、実施の形態３にかかる半導体装置の製造プロセスについて説明する。ここでは、一例として、図１２に例示した寸法およびネットドーピング濃度の半導体装置（耐圧：１２００Ｖクラス）を製造する場合について説明する。図１３および図１４は、実施の形態３にかかる半導体装置の製造プロセスを示す図である。まず、図１３の断面図１３００に示すように、半導体基板として、実施の形態１と同様のＦＺウエハー１０を用意する。
【００９１】
次いで、図１３の断面図１３１０に示すように、ＦＺウエハー１０の一方の表面から、アルミニウム（またはガリウム。以下省略）をイオン注入する。その際の加速電圧は、例えば６０ｋｅＶであり、ドーズ量は、例えば３×１０11ａｔｏｍｓ／ｃｍ2である。そして、例えば１１５０℃、８０分の熱処理を行って、アルミニウムを拡散させ、アルミニウム拡散層１３１１（ガリウムを注入した場合にはガリウム拡散層）を形成する。なお、特許文献１に示すように、アルミニウムには外方拡散する性質があるため、アルミニウムを注入した場合には、窒化膜を用いて外方拡散を防止する。この拡散によって、アルミニウム拡散層１３１１はＦＺウエハー１０の表面から約２０μｍの深さまで達する。
【００９２】
次いで、図１３の断面図１３２０に示すように、標準的なＭＯＳデバイスのプロセス工程によって、Ｐベース層２、ゲート絶縁膜６およびゲート電極７からなるＭＯＳゲート構造、Ｎ+ソース領域８などを形成する。この時、４〜８μｍの浅いＰ層拡散時に、アルミニウムも拡散するため、アルミニウム拡散層１３１１は表面から約４０μｍまで到達する。
【００９３】
次に、図１３の断面図１３３０に示すように、ＦＺウエハー１０を裏面から研削し、厚さを１４０μｍとする。さらに、ＦＺウエハー１０に弗硝酸によるウエットエッチングをおこない、厚さを１２０μｍとする。その後、図１４の断面図１４００に示すように、ＦＺウエハー１０の裏面から亜鉛または白金をイオン注入する。その際の加速電圧は、たとえば３００ｋｅＶ、ドーズ量は、例えば３×１０11／ｃｍ2である。そして、例えば１０００℃、２時間の熱処理を行って、亜鉛または白金をＦＺウエハー１０の裏面から約３０μｍの深さまで拡散させる。
【００９４】
つづけて、図１４の断面図１４１０に示すように、ＦＺウエハー１０の裏面からリン（Ｐ）を、たとえば加速電圧２００ｋｅＶ、ドーズ量１×１０13／ｃｍ2でイオン注入した後、同じくＦＺウエハー１０の裏面からボロン（Ｂ）を、たとえば加速電圧２００ｋｅＶ、ドーズ量１×１０14／ｃｍ2でイオン注入する。または、リンに代えて、リンよりも拡散係数の大きいセレン（Ｓｅ）または硫黄（Ｓ）を、たとえば加速電圧２００ｋｅＶ、ドーズ量１×１０13／ｃｍ2でイオン注入した後、同じくＦＺウエハー１０の裏面からボロン（Ｂ）を、たとえば加速電圧２００ｋｅＶ、ドーズ量１×１０14／ｃｍ2でイオン注入してもよい。
【００９５】
そして、例えば１０００℃、３０分間の熱処理を行って、空乏層を止めるためのコレクタバッファ層３を形成する。さらに、Ａｌ−１％Ｓｉを５μｍスパッタリングにて成膜し、パターニングエッチングしてエミッタ電極５を形成する。
【００９６】
つぎに、図１４の断面図１４２０、１４４０に示すように、Ａｌ―Ｓｉシンタを４００℃で８０分施し、パッシベーション用ポリイミド膜を周辺耐圧構造に形成する。断面図１４２０は、断面図１４１０に示す工程で拡散係数が小さいリンをイオン注入した場合の断面図であり、拡散深さは０．５μｍ程度である。また、断面図１４４０は、断面図１４１０に示す工程で拡散係数が大きいセレンまたは硫黄をイオン注入した場合の断面図であり、拡散深さは３０μｍ程度である。
【００９７】
その後、ＦＺウエハー１０の裏面からボロンをイオン注入する。その際の加速電圧は、たとえば４５ｋｅＶ、ドーズ量は、例えば１×１０14／ｃｍ2である。そして、例えば３８０℃、１時間の熱処理を行って、Ｐコレクタ層４を形成する。最後に、ＦＺウエハー１０の裏面にチタン、ニッケルおよび金を蒸着してコレクタ電極９を形成する。図１４の特性図１４３０は、断面図１４２０の半導体装置に対応するネットドーピング濃度のプロファイルである。図１４の特性図１４５０は、断面図１４４０の半導体装置に対応するネットドーピング濃度のプロファイルである。
【００９８】
なお、上述した実施の形態１〜３の説明では、ＦＺウエハーを用いたＩＧＢＴについてのみ説明したが、本発明はエピタキシャルウエハーを用いたＩＧＢＴにも適用することができる。図１５は、本発明をエピタキシャルウエハーに適用した半導体装置の構成およびネットドーピング濃度を示す図である。図１５においてＩＧＢＴの断面図１５００に示すように、Ｐコレクタ層となる１０μｍ厚のＰ型基板１５０１の一方の主面に、エピタキシャル成長によってＮ+バッファ層（コレクタバッファ層）１５０２が形成されている。
【００９９】
また、Ｎ+バッファ層１５０２の表面には、エピタキシャル成長によってＮ-ドリフト層１５０３が形成されている。さらに、Ｎ-ドリフト層１５０３の表面には、Ｐベース層１５０４、エミッタ電極１５０５、ゲート絶縁膜１５０６、ゲート電極１５０７、Ｎ+ソース領域１５０８などの表面構造が形成されている。また、Ｐ型基板１５０１の他方の主面には、コレクタ電極１５０９が形成されている。
【０１００】
図１５においてエミッタ電極からの距離−ネットドーピング濃度（ｌｏｇ）の特性図１５１０に示すように、Ｎ-ドリフト層１５０３のネットドーピング濃度は、Ｎ-ドリフト層のほぼ中間付近にピークを有し、Ｐベース層１５０４およびＮ+バッファ層１５０２に向かって傾きをもって減少しており、図１５に示すＩＧＢＴはブロードバッファ構造となっている。また、図１５の特性図１５１０は、断面図１５００のＩＧＢＴに対応するネットドーピング濃度のプロファイルである。
【０１０１】
このようなブロードバッファ構造は、上記特許文献１に示されるように、Ｎ-ドリフト層１５０３をエピタキシャル成長させる際に、ドナーとなるガスの流量を調節することによって形成することができる。これにより、エピタキシャルウエハーを用いたパンチスルー型ＩＧＢＴにおいても、特性を向上させることができる。
【０１０２】
また、本発明は、ノンパンチスルー型ＩＧＢＴにも適用することができる。図１６は、本発明を適用したノンパンチスルー型ＩＧＢＴの構成およびネットドーピング濃度を示す図である。図１６において、断面図１６００は、本発明を適用したノンパンチスルー型ＩＧＢＴの構成である。また、特性図１６１０は、断面図１６００のＩＧＢＴに対応するネットドーピング濃度のプロファイルである。
【０１０３】
図１６においてＩＧＢＴの断面図１６００に示すように、Ｎ-ドリフト層１６０１の一方の主面に、Ｐベース層１６０２、エミッタ電極１６０３、ゲート絶縁膜１６０４、ゲート電極１６０５、Ｎ+ソース領域１６０６が形成されている。また、Ｎ-ドリフト層１６０１の他方の主面に、Ｐコレクタ層１６０７、コレクタ電極１６０８が形成されている。
【０１０４】
前述のように、フィールドストップ層を用いることなくブロードバッファ層を形成することが可能であるため、ノンパンチスルー型ＩＧＢＴにも本発明を適用することができる。ノンパンチスルー型ＩＧＢＴは、素子耐圧と等しい電圧が印加されても、裏面のＰコレクタ層まで空乏層が達しないため、フィールドストップ型ＩＧＢＴに見られるような漏れ電流が発生しない。
【０１０５】
また、本発明は、逆阻止ＩＧＢＴや特開２００４−３６３３２８号公報に開示されているような逆導通ＩＧＢＴにも適用することもできる。図１７は、本発明を適用した逆導通型ＩＧＢＴの構成およびネットドーピング濃度を示す図である。図１７において、断面図１７００は本発明を適用した逆導通型ＩＧＢＴの断面図であり、特性図１７１０は、断面図１７００のＩＧＢＴに対応するネットドーピング濃度のプロファイルである。
【０１０６】
本発明を適用したＩＧＢＴでは、低損失で、かつ発振を抑えたターンオフを実現できる。特に、本発明を適用した逆導通ＩＧＢＴは、図１７に示すように、ＩＧＢＴ部１７２０を有するとともに、還流用ダイオード部１７３０をモノリシックに内蔵するので、逆回復特性も同時に改善することができる。
【０１０７】
さらに、本発明にかかるＩＧＢＴの適用例を図１８〜図２０に示す。図１８に示すコンバーター−インバータ回路１８００は、効率良く誘導電動機やサーボモータ等を制御することが可能で、産業や電鉄等で広く用いられる。図１９に示す力率改善回路（ＰＦＣ回路）１９００は、ＡＣ−ＡＣ変換の入力電流を正弦波状に制御して波形改善をはかる回路であり、スイッチング電源用に用いられる。図２０の回路図２０００は、マトリクスコンバーター回路２００１の全体図であり、回路図２０１０は、マトリクスコンバーター回路２００１のスイッチング部２００２の構成を示す図である。
【０１０８】
（実施の形態４）
図２１は、実施の形態４にかかる半導体装置の構成、ネットドーピング濃度を示す図である。図２１において半導体装置の断面図２１００に示すように、Ｎ-ドリフト層２１０１の一方の主面の一部に、Ｐエミッタ層２１０２が形成されている。また、Ｎ-ドリフト層２１０１の他方の主面側には、コレクタバッファ層２１０３が形成されている。また、コレクタバッファ層２１０３の表面には、Ｐ+コレクタ層２１０４が形成されている。また、Ｐ+コレクタ層２１０４の表面にはコレクタ電極２１０９が形成されている。
【０１０９】
また、Ｐエミッタ層２１０２内に、Ｎ+ソース領域２１０８が形成されている。また、Ｎ-ドリフト層２１０１、Ｐエミッタ層２１０２、Ｎ+ソース領域２１０８に接するように、ゲート絶縁膜２１０６およびゲート電極２１０７からなるＭＯＳゲート構造が形成されている。また、Ｐエミッタ層２１０２およびＮ+ソース領域２１０８の一部に接し、かつＭＯＳＦＥＴゲート構造を覆うように、エミッタ電極２１０５が形成されている。
【０１１０】
図２１において、エミッタ電極２１０５からの距離−ネットドーピング濃度（ｌｏｇ）の特性図２１１０に示すように、Ｎ-ドリフト層２１０１のネットドーピング濃度は、Ｎ-ドリフト層２１０１のほぼ中間付近にピークを有し、Ｐエミッタ層２１０２およびコレクタバッファ層２１０３に向かって、傾きをもって減少している。すなわち、実施の形態４の半導体装置は、ブロードバッファ構造となっている。Ｐエミッタ層２１０２、コレクタバッファ層２１０３およびＰ+コレクタ層２１０４のネットドーピング濃度は、ともにＮ-ドリフト層２１０１のネットドーピング濃度よりも高い
【０１１１】
Ｐエミッタ層２１０２のネットドーピング濃度は、エミッタ電極２１０５との界面において５×１０16ａｔｏｍｓ／ｃｍ3であり、Ｎ-ドリフト層２１０１に向かって低くなり、Ｎ-ドリフト層２１０１との界面では、５×１０13ａｔｏｍｓ／ｃｍ3よりも低い。Ｎ-ドリフト層２１０１のネットドーピング濃度は、Ｐエミッタ層２１０２との界面では、５×１０13ａｔｏｍｓ／ｃｍ3よりも低いが、Ｐエミッタ層２１０２との界面近傍で５×１０13ａｔｏｍｓ／ｃｍ3となる。
【０１１２】
Ｎ-ドリフト層２１０１の平均ネットドーピング濃度Ｎdmは、９×１０13ａｔｏｍｓ／ｃｍ3である。また、Ｎ-ドリフト層２１０１の、コレクタバッファ層２１０３との界面およびその付近におけるネットドーピング濃度は、５×１０13ａｔｏｍｓ／ｃｍ3である。また、コレクタバッファ層２１０３のネットドーピング濃度（ピーク濃度）ＮBは、１×１０15ａｔｏｍｓ／ｃｍ3である。また、Ｐ+コレクタ層２１０４のネットドーピング濃度（ピーク濃度）は、１×１０18ａｔｏｍｓ／ｃｍ3である。
【０１１３】
さらに、半導体装置の各層の厚さは、Ｎ-ドリフト層２１０１が１２０μｍ、コレクタバッファ層２１０３が１５μｍ、Ｐ+コレクタ層２１０４が２１５μｍである。
【０１１４】
ここで、各層の厚さおよびネットドーピング濃度は、以下のように決められる。まず、コレクタバッファ層２１０３のネットドーピング濃度ＮBは、Ｎ-ドリフト層２１０１の平均ネットドーピング濃度Ｎdmの５倍以上、すなわち、下記式（１）が成り立つようにする。
５Ｎdm  ＜  Ｎb  ・・・（１）
【０１１５】
これは、以下の理由による。オフ時に電圧をブロッキングする状態では、表面（エミッタ）側から裏面（コレクタ）側に向かって、Ｎ-ドリフト層２１０１に空乏層が広がる。パンチスルー型ＩＧＢＴは、この空乏層をコレクタバッファ層２１０３で止めて（パンチスルーさせて）、Ｐ+コレクタ層２１０４に到達させないようにしている。
【０１１６】
Ｎ-ドリフト層２１０１での空乏層の伸びは、ポアソンの式より、Ｎ-ドリフト層２１０１であるブロードバッファ層の平均ネットドーピング濃度（Ｎ-ドリフト層２１０１のリン濃度をコレクタバッファ層２１０３の直前まで深さ方向に積分し、Ｎ-ドリフト層２１０１の厚さによって割った値）Ｎdmによって定まる。コレクタバッファ層２１０３で空乏層を止めるには、コレクタバッファ層２１０３のネットドーピング濃度ＮBがＮ-ドリフト層２１０１（ブロードバッファ層）の平均ネットドーピング濃度Ｎdmよりも高くなければならない。
【０１１７】
コレクタバッファ層２１０３のネットドーピング濃度ＮBとＮ-ドリフト層２１０１の平均ネットドーピング濃度Ｎdmとが同程度である場合、コレクタバッファ層２１０３で空乏層を止めるためには、コレクタバッファ層２１０３の厚さとＮ-ドリフト層２１０１の厚さとは同程度でなくてはならない。その場合、オン状態でキャリアが蓄積される領域が厚くなり、導通損失やターンオフ損失の増加につながってしまう。また、空乏層はＮ-ドリフト層２１０１の厚さの５分の１程度で止めるのが望ましい。したがって、Ｎ-ドリフト層２１０１の平均ネットドーピング濃度ＮＢは、コレクタバッファ層２１０３のネットドーピング濃度Ｎdmの５倍程度、すなわち、上記式（１）が成り立つようにする。図２１の例では、Ｎdm＝９×１０13ａｔｏｍｓ／ｃｍ3、ＮＢ＝１×１０15ａｔｍｏｓ／ｃｍ3であり、上記式（１）が成立している。
【０１１８】
つぎに、Ｐ+コレクタ層２１０４の厚さはＮ-ドリフト層２１０１の厚さよりも厚いことが望ましい。より詳細には、Ｐ+コレクタ層２１０４の厚さ（ＷA）は、Ｎ-ドリフト層２１０１のうちＮ-ドリフト層２１０１の平均ネットドーピング濃度よりもネットドーピング濃度が高い領域の厚さ（ＷM）よりも厚いことが望ましい。
【０１１９】
これは、以下の理由による。Ｐ+コレクタ層２１０４のネットドーピング濃度を矩形分布であると近似して、Ｐ+コレクタ層２１０４の積分ネットドーピング濃度をＮAＷAとおく。同様に、コレクタバッファ層２１０３の積分ネットドーピング濃度をＮBＷBとおく。ここで、ＮA，ＮBは、それぞれＰ+コレクタ層２１０４、コレクタバッファ層２１０３の濃度である。また、ＷA，ＷBは、それぞれＰ+コレクタ層２１０４、コレクタバッファ層２１０３の厚さである。
【０１２０】
このとき、コレクタバッファ層２１０３に限った輸送効率をαt、Ｐ+コレクタ層２１０４からコレクタバッファ層２１０３への注入効率をγe、両極性キャリアの拡散長をＬaとすると、コレクタバッファ層２１０３のコモンベース増幅率α0は、下記式（２）で表される。
【０１２１】
【数１】
0005396689.tif 000002
【０１２２】
高濃度Ｐ型基板（Ｐ+コレクタ層２１０４）からの注入は高注入である。このため、高濃度Ｐ型基板からの低注入条件として、注入効率γeはおよそ１であることが望ましい。また、ＮA＞ＮBであることから、下記式（３）が成り立つようにする。
ＷA  ＞＞  ＷB  ・・・（３）
【０１２３】
一方、ブロードバッファ層（Ｎ-ドリフト層２１０１）で空乏層の電界強度を減衰させるのは、ネットドーピング濃度が平均ネットドーピング濃度以上となる領域、すなわち、ネットドーピング濃度が平均ネットドーピング濃度となる２点に挟まれた領域Ｍ（厚さＷM）である。図２１の例では、厚さＷM＝８０μｍとなっている。上記式（１）で示すように５Ｎdm＜Ｎbであるため、領域Ｍの厚さＷMはＷBの少なくとも５倍は必要である。すなわち、下記式（４）が成り立つようにする。
ＷM／５  ＞  ＷB  ・・・（４）
【０１２４】
下記式（３），（４）から、ブロードバッファ層における厚さＷMは下記式（５）が成り立つようにしなければならない。また、Ｐ+コレクタ層２１０４からのホールの注入効率を高く維持しなければならないため、Ｐ+コレクタ層２１０４の厚さＷAは、望ましくは下記式（６）が成り立つようにするのがよい。すなわち、Ｐ+コレクタ層２１０４の厚さ（ＷA）は、Ｎ-ドリフト層２１０１のうちＮ-ドリフト層２１０１の平均ネットドーピング濃度よりもネットドーピング濃度が高い領域の厚さ（ＷM）よりも厚いことが望ましい。
ＷA  ＞＞  ＷM／５  ＞  ＷB  ・・・（５）
ＷA  ＞  ＷM  ・・・（６）
【０１２５】
つぎに、実施の形態４にかかる半導体装置の製造プロセスについて説明する。図２２〜２４は、実施の形態４にかかる半導体装置の製造プロセスを示す図である。まず、図２２の断面図２２００に示すように、半導体基板としてＰ+コレクタ層２１０４となる高濃度のＰ型ＣＺウェハーを用意する。
【０１２６】
つぎに、ＣＺウエハー２２０１の表面（鏡面仕上げ面）に、リン濃度１×１０15ａｔｏｍｓ／ｃｍ3、厚さ１５μｍの高濃度のＮ型エピタキシャル層（コレクタバッファ層２１０３）をエピタキシャル成長させる。つづいて、図２３の断面図２３００に示すように、Ｎ型エピタキシャル層２１０３の表面に、全体の厚さが１２０μｍのＮ-ドリフト層２１０１（ブロードバッファ層）をエピタキシャル成長させる。
【０１２７】
Ｎ-ドリフト層２１０１のブロードバッファ構造は、リンを含むホスフィンガスの流量を調整することによって形成する。具体的には、Ｎ-ドリフト層２１０１のうちコレクタバッファ層２１０３に接する部分については、ドーピング濃度が６×１０13ａｔｏｍｓ／ｃｍ3となるようにホスフィンガスの流量を絞る。その後の成長過程においては、連続的にホスフィンガスの流量を増加させ、ドーピング濃度のピークが２×１０14ａｔｏｍｓ／ｃｍ3となるようにする。そして、その後は、連続的にホスフィンガスの流量を減少させ、ドーピング濃度が６×１０13ａｔｍｏｓ／ｃｍ3となるようにする。なお、ドーピング濃度がピークとなる箇所は、Ｎ-ドリフト層２１０１の表面から５０μｍの深さとなるように成長速度やガス流量を制御する。
【０１２８】
つぎに、Ｎ-ドリフト層２１０１の表面に厚さ８０００Åの熱酸化膜を形成する。この熱酸化膜をパターニングして、ウエットエッチングによってエッジターミネーション部を開口する。つぎに、エッジターミネーション部にボロンイオンをドーズ量１×１０15ａｔｍｏｓ／ｃｍ2、加速電圧１００ｋｅＶでイオン注入する。そして、１１５０℃で２００分間熱処理してドライブインさせ、ガードリング構造を形成する。その後、エッジターミネーション部の熱酸化膜を残したままウェットエッチングによって活性部を開口し、厚さ６０５Åのゲート絶縁膜２１０６を成長させる。
【０１２９】
つぎに、厚さ１０μｍのポリシリコン膜を形成してパターニングをおこなう。つづいて、Ａｌ−１％Ｓｉを５μｍスパッタリングにて成膜し、パターニングエッチングしてエミッタ電極２１０５を形成する。つづいて、電子線を加速電圧４．６ＭｅＶ、照射エネルギー３００ｋＧｙで照射した後、３５０℃で１時間熱処理をおこなう。最後に、Ｐ+コレクタ層２１０４の表面にアルミニウム、チタン、ニッケルおよび金の順で金属を成膜しコレクタ電極２１０９を形成して、図２４の断面図２４００に示す半導体装置が完成する。図２４の特性図２４１０は、断面図２４００の半導体装置に対応するネットドーピング濃度のプロファイルである。
【０１３０】
図２５は、実施の形態４にかかる半導体装置および従来型ＩＧＢＴのターンオフ波形を示す図である。図２５において、実施の形態４にかかる半導体装置のコレクタ電流Ｉｃおよびコレクタ・エミッタ間の電圧Ｖｃを実線で示す。また、従来型ＩＧＢＴのコレクタ電流Ｉｃおよびコレクタ・エミッタ間の電圧Ｖｃを一点鎖線で示す。実施の形態４にかかる半導体装置のドリフト層の厚さと従来型ＩＧＢＴのドリフト層の厚さは等しい。実施の形態４にかかる半導体装置は、従来型ＩＧＢＴと比較して発振現象が抑制されている。
【０１３１】
このように、実施の形態４にかかる半導体装置は、Ｎ-ドリフト層が薄いことによって生じやすくなるターンオフ時の発振現象を、従来型ＩＧＢＴと比較して抑制することができる。このため、実施の形態４にかかる半導体装置は、従来型ＩＧＢＴと比較してブロードバッファ層を薄層化することが可能となり、ターンオフ損失や導通損失を低減させることができる。
【０１３２】
以上説明したように、本発明にかかるＩＧＢＴによれば、ブロードバッファ構造により、最も効率的に逆回復損失の低減とソフトリカバリー特性が得られるという効果を奏する。また、ＦＺウエハーを用いる場合には、かつエピタキシャル成長工程がないので、従来よりも著しく安価であるという効果を奏する。さらに、実施の形態１および２では、ウエハーを研削して薄ウエハー化する前に、ブロードバッファ構造を形成するためのプロトンの照射や熱処理を行うので、これらの処理の際にウエハーが割れたりするのを防ぐことができる。
【０１３３】
また、本発明は上述した実施の形態に限らず、種々変更可能である。例えば、実施の形態中に記載した寸法や濃度、電圧値や電流値、温度や時間等の処理条件などの種々の値は一例であり、本発明はそれらの値に限定されるものではない。また、各実施の形態では第１導電型をＮ型とし、第２導電型をＰ型としたが、本発明は第１導電型をＰ型とし、第２導電型をＮ型としても同様に成り立つ。
【０１３４】
また、本発明は、１２００Ｖクラスに限らず、６００Ｖや１７００Ｖ、あるいはそれ以上の耐圧クラスでも同様に適用可能である。例えば、６００Ｖクラスである場合には、ウエハーの比抵抗は２０〜９０Ωｃｍであり、最終厚さが５０〜７０μｍである。１７００Ｖクラスである場合には、ウエハーの比抵抗は８０〜２００Ωｃｍであり、最終厚さが１２０〜２００μｍである。また、本発明は、トレンチゲート構造に限らず、プレーナゲート構造にも同様に適用可能である。
【産業上の利用可能性】
【０１３５】
以上のように、本発明にかかる半導体装置およびその製造方法は、電力用半導体装置に有用であり、特に、電気的損失および放射電磁ノイズの低い、環境問題を考慮したＩＧＢＴモジュールやＩＰＭ（インテリジェントパワーモジュール）に適している。
【図面の簡単な説明】
【０１３６】
【図１】実施の形態１にかかる半導体装置の構成、ネットドーピング濃度およびプロトン分布を示す図である。
【図２】実施の形態１にかかる半導体装置の製造プロセスを示す図である。
【図３】実施の形態１にかかる半導体装置の製造プロセスを示す図である。
【図４】実施の形態１のプロトン照射および３５０℃での熱処理によるウエハーの濃度プロファイルを示す図である。
【図５】実施の形態１にかかる半導体装置および従来型ＩＧＢＴのターンオフ波形を示す図である。
【図６】スナバレス回路の構成を示す図である。
【図７】デバイスシュミレーションによる実施の形態１にかかる半導体装置のターンオフ時の内部状態の変化を示す説明図である。
【図８】デバイスシュミレーションによる従来型ＩＧＢＴのターンオフ時の内部状態の変化を示す説明図である。
【図９】実施の形態２にかかる半導体装置の構成、ネットドーピング濃度およびプロトン分布を示す図である。
【図１０】実施の形態２にかかる半導体装置の製造プロセスを示す図である。
【図１１】実施の形態２にかかる半導体装置の製造プロセスを示す図である。
【図１２】実施の形態３にかかる半導体装置の構成およびネットドーピング濃度を示す図である。
【図１３】実施の形態３にかかる半導体装置の製造プロセスを示す図である。
【図１４】実施の形態３にかかる半導体装置の製造プロセスを示す図である。
【図１５】本発明をエピタキシャルウエハーに適用した半導体装置の構成およびネットドーピング濃度を示す図である。
【図１６】本発明を適用したノンパンチスルー型ＩＧＢＴの構成およびネットドーピング濃度を示す図である。
【図１７】本発明を適用した逆導通型ＩＧＢＴの構成およびネットドーピング濃度を示す図である。
【図１８】本発明にかかるＩＧＢＴの適用例を示す図である。
【図１９】本発明にかかるＩＧＢＴの適用例を示す図である。
【図２０】本発明にかかるＩＧＢＴの適用例を示す図である。
【図２１】実施の形態４にかかる半導体装置の構成、ネットドーピング濃度を示す図である。
【図２２】実施の形態４にかかる半導体装置の製造プロセスを示す図である。
【図２３】実施の形態４にかかる半導体装置の製造プロセスを示す図である。
【図２４】実施の形態４にかかる半導体装置の製造プロセスを示す図である。
【図２５】実施の形態４にかかる半導体装置および従来型ＩＧＢＴのターンオフ波形を示す図である。
【図２６】従来のプロトン照射および３５０℃での熱処理によるウエハーの濃度プロファイルを示す図である。
【符号の説明】
【０１３７】
１  Ｎ-ドリフト層
２  Ｐベース層
３  コレクタバッファ層
４  Ｐコレクタ層
５  エミッタ電極
６  ゲート絶縁膜
７  ゲート電極
８  Ｎ+ソース領域
９  コレクタ電極
【図１】
0005396689.tif 000003
【図２】
0005396689.tif 000004
【図３】
0005396689.tif 000005
【図４】
0005396689.tif 000006
【図５】
0005396689.tif 000007
【図６】
0005396689.tif 000008
【図７】
0005396689.tif 000009
【図８】
0005396689.tif 000010
【図９】
0005396689.tif 000011
【図１０】
0005396689.tif 000012
【図１１】
0005396689.tif 000013
【図１２】
0005396689.tif 000014
【図１３】
0005396689.tif 000015
【図１４】
0005396689.tif 000016
【図１５】
0005396689.tif 000017
【図１６】
0005396689.tif 000018
【図１７】
0005396689.tif 000019
【図１８】
0005396689.tif 000020
【図１９】
0005396689.tif 000021
【図２０】
0005396689.tif 000022
【図２１】
0005396689.tif 000023
【図２２】
0005396689.tif 000024
【図２３】
0005396689.tif 000025
【図２４】
0005396689.tif 000026
【図２５】
0005396689.tif 000027
【図２６】
0005396689.tif 000028