(57)【特許請求の範囲】
【請求項１】
互いに対向する第１面及び第２面を有するキャパシタ用電極を備えたキャパシタであって、
前記第１面は誘電体膜に接し、
前記キャパシタ用電極はＳｒＲｕＯ3膜から構成され、第１面からその厚み方向に所定の距離だけ離れた位置から第２面側の領域中に、１０ａｔｍ％以下の３価の元素を含有することを特徴とするキャパシタ。
【請求項２】
前記３価の元素がＬａであることを特徴とする請求項１に記載のキャパシタ。
【請求項３】
前記所定の距離が０．５〜２ｎｍの範囲であることを特徴とする請求項１又は２に記載のキャパシタ。
【請求項４】
請求項１〜３の何れか１項に記載のキャパシタを備えた半導体装置であって、
前記キャパシタは、
キャパシタ用電極を２つと、
２つの前記キャパシタ用電極間に、各キャパシタ用電極の前記第１面に接するように設けられた誘電体膜と、
を備えたことを特徴とする半導体装置。
【請求項５】
前記誘電体膜の比誘電率が４０以上であることを特徴とする請求項４に記載の半導体装置。
【請求項６】
前記誘電体膜は、ＳｒＴｉＯ3、ＴｉＯ2、Ｌａ2Ｏ3、Ｙ2Ｏ3、ＨｆＯ2、ＺｒＯ2及び（Ｂａ，Ｓｒ）ＴｉＯ3からなる群から選択された少なくとも一種の酸化物を含むことを特徴とする請求項４又は５に記載の半導体装置。
【請求項７】
前記キャパシタに保持されている電荷の状態によってデータの記億を行うことを特徴とする請求項４〜６の何れか１項に記載の半導体装置。
【請求項８】
下記工程（ａ）および（ｂ）によりキャパシタ用電極を形成する工程と、
（ａ）ＡＬＤ法を用いて、１０ａｔｍ％以下の濃度の３価の元素を含有するＳｒＲｕＯ3膜を形成する工程と、
（ｂ）前記３価の元素を含有するＳｒＲｕＯ3膜上に、ＡＬＤ法を用いて３価の元素を含有しないＳｒＲｕＯ3膜を形成する工程と、
前記ＳｒＲｕＯ3膜に接するように、キャパシタ用電極中の３価の元素を含有しない誘電体膜を形成する工程と、
を有することを特徴とするキャパシタの製造方法。
【請求項９】
前記（ａ）工程の３価の元素がＬａであることを特徴とする請求項８に記載のキャパシタの製造方法。
【請求項１０】
前記（ｂ）工程で形成する３価の元素を含有しないＳｒＲｕＯ3膜の膜厚が０．５〜２ｎｍであることを特徴とする請求項８又は９に記載のキャパシタの製造方法。
【請求項１１】
キャパシタの製造方法であって、
下記工程（１）および（２）によりキャパシタ用電極を形成する工程と、
（１）ＡＬＤ法を用いた下記（Ａ）〜（Ｌ）の一連の工程を複数回、繰り返すことにより、１０ａｔｍ％以下の濃度の３価の元素を含有するＳｒＲｕＯ3膜を形成する工程と
（２）前記工程（１）の後に、ＡＬＤ法を用いた下記（Ａ）〜（Ｈ）の一連の工程を複数回、繰り返すことにより、３価の元素を含有しないＳｒＲｕＯ3膜を形成する工程と、
前記ＳｒＲｕＯ3膜に接するように、キャパシタ用電極中の３価の元素を含有しない誘電体膜を形成する工程と、
を有することを特徴とするキャパシタの製造方法。
（Ａ）Ｒｕ原料ガスを供給してＲｕ膜を成膜する工程、
（Ｂ）前記Ｒｕ原料ガスをパージする工程、
（Ｃ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＡを供給して前記Ｒｕ膜の熱酸化処理を行う工程、
（Ｄ）前記ガスＡをパージする工程、
（Ｅ）Ｓｒ原料ガスを供給してＳｒ膜を成膜する工程、
（Ｆ）前記Ｓｒ原料ガスをパージする工程、
（Ｇ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＢを供給して前記Ｓｒ膜の熱酸化処理を行う工程、
（Ｈ）前記ガスＢをパージする工程、
（Ｉ）Ｌａ原料ガスを供給してＬａ膜を成膜する工程、
（Ｊ）前記Ｌａ原料ガスをパージする工程、
（Ｋ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＣを供給して前記Ｌａ膜の熱酸化処理を行う工程、
（Ｌ）前記ガスＣをパージする工程。
【請求項１２】
前記工程（２）で形成する３価の元素を含有しないＳｒＲｕＯ3膜の膜厚が０．５〜２ｎｍであることを特徴とする請求項１１に記載のキャパシタの製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、キャパシタ用電極及びその製造方法、並びにキャパシタを備えた半導体装置に関する。
【背景技術】
【０００２】
近年、半導体デバイスでは微細化が進んでおり、例えば、Ｆ値４０ｎｍ世代（設計ルール４０ｎｍ以降の世代）のＤＲＡＭでは、キャパシタ用の誘電体膜として高誘電率膜が必要となっている。そこで、現在、その有力候補としてＳｒＴｉＯ3等が提案されている。
【０００３】
一方、従来から、キャパシタ用電極としてＴｉＮ／Ｔｉ電極が使用されているが、誘電体膜として上記のような高誘電率膜を使用すると、誘電体の伝導帯と電極のフェルミエネルギー間のバンドオフセットが小さくなる。このため、ショットキー伝導によりリーク電流が増大してしまうという問題があり、ＴｉＮ／Ｔｉ電極を、高誘電率膜を有するキャパシタへ使用することは困難であった。
【０００４】
そこで、高誘電率膜を有するキャパシタ用電極としては仕事関数の高い電極が必要とされ、近年、電極材料の検討が行われている。例えば、仕事関数の最も高い材料としてＰｔを挙げることができる。しかし、Ｐｔは加工性に乏しいためＤＲＡＭ等の半導体デバイスを作製する上で実用性に乏しく、電極材料としては加工性に富んだ材料を用いる必要がある。このため、近年、Ｐｔ以外の他の電極材料の開発が行われている。
【０００５】
非特許文献１には、電極材料としてＲｕ（ルテニウム）を用い、Ｒｕ／ＳｒＴｉＯ3／Ｒｕの、ＭＩＭ構造（Ｍｅｔａｌ−Ｉｎｓｕｌａｔｏｒ−Ｍｅｔａｌ；上下の電極を金属膜で形成したキャパシタ構造）を有するキャパシタが開示されている。この非特許文献１のキャパシタでは、Ｒｕ／ＳｒＴｉＯ3／ＲｕのＭＩＭ構造を作製後、熱処理を行うことにより、誘電体膜（ＳｒＴｉＯ3）の結晶性を向上させてリーク電流値を減少させている。
【０００６】
しかしながら、非特許文献１で使用されている電極材料のＲｕは酸化しやすい材料であり、熱処理により抵抗率及び仕事関数が変動して不安定な（熱耐性が悪い）ものとなっていた。従って、キャパシタ用電極としてＲｕ単膜を用いる限り、リーク電流値の低減には限界があり、仕事関数が高く安定な電極材料が要望されていた。
【０００７】
そこで、他の電極材料として、非特許文献２にはＳｒ（ストロンチウム）とＲｕを含有するＳｒＲｕＯ3膜の電極を用いた例が開示されている。このＳｒＲｕＯ3膜の結晶構造は、高誘電率のＳｒＴｉＯ3などと同じぺロブスカイト構造となっている。このＳｒＲｕＯ3膜を用いることによりエピタキシャル的に高誘電体膜を成長させることができ、結晶性を向上できるという利点を有する。このため、ＳｒＲｕＯ3を用いると他の電極材料と比べて誘電率の高い良質の膜を得ることができると共に、このＳｒＲｕＯ3は仕事関数が高いため、リーク電流値の低減についても有望な材料として注目されている。しかしながら、このＳｒＲｕＯ3は導電性を示す反面、Ｒｕなどの金属の単層膜と比べると抵抗率が高いという欠点があった。
【非特許文献１】Ｃ．Ｍ．Ｃｈｕ，ｅｔ．ａｌ．，Ｓｙｍｐ．Ｏｎ．ＶＬＳＩ  Ｔｅｃｈ，Ｄｉｇ．，２００１，Ｔ４Ｂ−３
【非特許文献２】Ｊｏｏｎ  Ｓｅｏｐ  Ｓｉｍ  ｅｔ．  ａｌ．，  Ｊ．  Ｅｌｅｃｔｒｏｃｈｅｍ．  Ｓｏｃｉ．，  １５３（１１）  Ｃ７７７−Ｃ７８９  （２００６）
【発明の開示】
【発明が解決しようとする課題】
【０００８】
高誘電率膜を用いたキャパシタを備えるＤＲＡＭ等の半導体装置を形成する場合にはリーク電流が小さく、かつ、キャパシタ用電極の電気抵抗値を低くすることが重要である。しかしながら、従来のルテニウムを用いたキャパシタ用電極では、それを両立するのが難しかった。従って、微細化に対応した高性能な半導体装置を形成するのが困難であった。
【０００９】
そこで、本発明者は上記課題を克服すべく、鋭意、検討を行った結果、ルテニウムを用いて、電気抵抗値が低く、リーク電流を抑制することも可能なキャパシタ用電極を得た。すなわち、本発明は、キャパシタ用電極として電気抵抗値が小さく、高誘電率膜をキャパシタ用の絶縁体として使用した場合にリーク電流の増加を抑制することが可能なキャパシタ用電極を提供することを目的とする。
【課題を解決するための手段】
【００１０】
互いに対向する第１面及び第２面を有するキャパシタ用電極であって、
ＳｒＲｕＯ3膜から構成され、
第１面からその厚み方向に所定の距離だけ離れた位置から第２面側の領域中に、１０ａｔｍ％以下の３価の元素を含有することを特徴とするキャパシタ用電極に関する。
【００１１】
本発明の他の実施形態は、
（ａ）ＡＬＤ法を用いて、１０ａｔｍ％以下の濃度の３価の元素を含有するＳｒＲｕＯ3膜を形成する工程と、
（ｂ）前記３価の元素を含有するＳｒＲｕＯ3膜上に、ＡＬＤ法を用いて３価の元素を含有しないＳｒＲｕＯ3膜を形成する工程と、
を有することを特徴とするキャパシタ用電極の製造方法に関する。
【００１２】
また、本発明の他の実施形態は、
キャパシタ用電極の製造方法であって、
（１）ＡＬＤ法を用いた下記（Ａ）〜（Ｌ）の一連の工程を複数回、繰り返すことにより、１０ａｔｍ％以下の濃度の３価の元素を含有するＳｒＲｕＯ3膜を形成する工程と
（２）前記工程（１）の後に、ＡＬＤ法を用いた下記（Ａ）〜（Ｈ）の一連の工程を複数回、繰り返すことにより、３価の元素を含有しないＳｒＲｕＯ3膜を形成する工程と、
を有することを特徴とするキャパシタ用電極の製造方法に関する。
（Ａ）Ｒｕ原料ガスを供給してＲｕ膜を成膜する工程、
（Ｂ）前記Ｒｕ原料ガスをパージする工程、
（Ｃ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＡを供給して前記Ｒｕ膜の熱酸化処理を行う工程、
（Ｄ）前記ガスＡをパージする工程、
（Ｅ）Ｓｒ原料ガスを供給してＳｒ膜を成膜する工程、
（Ｆ）前記Ｓｒ原料ガスをパージする工程、
（Ｇ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＢを供給して前記Ｓｒ膜の熱酸化処理を行う工程、
（Ｈ）前記ガスＢをパージする工程、
（Ｉ）Ｌａ原料ガスを供給してＬａ膜を成膜する工程、
（Ｊ）前記Ｌａ原料ガスをパージする工程、
（Ｋ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＣを供給して前記Ｌａ膜の熱酸化処理を行う工程、
（Ｌ）前記ガスＣをパージする工程。
【発明の効果】
【００１３】
本発明のキャパシタ用電極は仕事関数が高いため、高誘電率膜と組み合わせた場合でもリーク電流値の増加を抑制することができる。また、電気抵抗が低いキャパシタ用電極を形成することができる。更に、本発明のキャパシタ用電極を備えることで、高性能の半導体装置を容易に形成することができる。
【発明を実施するための最良の形態】
【００１４】
１．キャパシタ用電極
本発明のキャパシタ用電極は、キャパシタ用の誘電体膜に接する第１面と、この第１面に対向する反対側の第２面とを有する。また、このキャパシタ用電極は、ＳｒＲｕＯ3（ストロンチウム・ルテニウム・オキサイド）膜から構成されている。そして、第１面からその厚み方向に所定の距離だけ離れた位置から第２面側の領域Ａ中に、１０ａｔｍ％以下の３価の元素を含有する。
【００１５】
本発明のキャパシタ用電極は、このように領域Ａ中に１０ａｔｍ％以下の３価の元素を含有することにより、仕事関数を高く保ったままで、低抵抗なものとすることができる。この結果、リーク電流値が低く、微細化を図った場合にも安定してキャパシタ用電極として動作することが可能となる。また、ＳｒＲｕＯ3膜の結晶構造はぺロブスカイト構造であるため、同じくぺロブスカイト構造の高誘電体膜をキャパシタ用の絶縁膜として使用する場合には、良質の絶縁膜を形成するのが容易である。
【００１６】
図７は、本発明のキャパシタ用電極の一例を模式的に示したものである。このキャパシタ用電極３は、キャパシタの誘電体膜に接する第１面２とこの第１面１に対向する反対側の第２面１とを有する。そして、全体がＳｒＲｕＯ3膜から構成されている。また、この第１面２からその厚み方向（図７中の矢印５の方向）に所定の距離だけ離れた位置から第２面側の領域Ａ（図７中の斜線部分６）中に、１０ａｔｍ％以下の３価の元素を含有する。
【００１７】
なお、本発明のキャパシタ用電極は、複数の層から構成すると共に各層の組成を調節することによって上記のような特性を有するようにしても良い。本発明のキャパシタ用電極は、上記領域Ａを有する単一の層から構成しても良い。また、領域Ａは、第１面からその厚み方向に所定の距離だけ離れた位置から第２面側に所定の膜厚を有するように存在していれば良い。すなわち、領域Ａは、第１面からその厚み方向に所定の距離だけ離れた位置から第２面までの領域の全てを構成しても、一部を構成しても良い。
【００１８】
「ＳｒＲｕＯ3」は、Ｓｒ原子、Ｒｕ原子、Ｏ原子の原子数比が厳密に１：１：３でなくても良く、この組成から若干、Ｓｒ原子、Ｒｕ原子、Ｏ原子の原子数比がずれたものであっても良い。
【００１９】
また、３価の元素は、膜内での領域Ａと領域Ａ以外の界面近傍を除き、領域Ａの厚み方向の全体にわたってなるべく均一に存在していることが抵抗値の上昇を抑制する点から好ましい。また、領域Ａ中に存在する３価の元素の濃度は、最も濃度の濃い部分でも１０ａｔｏｍ％以下となっている必要がある。領域Ａ中の３価の元素の濃度は、ＲＢＳ（Ｒｕｔｈｅｒｆｏｒｄ  Ｂａｃｋｓｃａｔｔｅｒｉｎｇ  Ｓｐｅｃｔｒｏｍｅｔｒｙ：ラザフォード後方散乱法）を用い、Ｈｅイオンを測定試料に照射して、散乱されたイオンを偏向磁場エネルギー分析器によって検出することで測定することができる。
【００２０】
ＳｒＲｕＯ3膜の導電性は、ＳｒＲｕＯ3中の金属元素であるＳｒ（２価）よりも多価数の金属元素を導入し、膜中の電子生成を制御することで改善することができる。本発明では、キャパシタ用電極中にＳｒ（価数２）よりも価数の大きな３価の元素を適切な濃度で含有させることにより、ＳｒＲｕＯ3のＳｒサイトを３価の元素で置換して電子を生成させ、ＳｒＲｕＯ3膜の低抵抗化を図ることが可能となる。また、この電子生成の有無は添加する元素の価数によって決定されるため、３価の元素の種類は特に限定されるわけではない。この３価の元素としては、例えば、Ｂ（ホウ素）、Ａｌ（アルミニウム）、Ｇａ（ガリウム）、Ｉｎ（インジウム）、Ｔｌ（タリウム）及びＬａ（ランタン）からなる群から選択された少なくとも一種の元素を使用できる。なお、３価の元素の中ではＬａはＳｒサイトへの置換性が高く、キャパシタ用電極中に所望の濃度のＬａを含有させることが容易なため、Ｌａを選択することが好ましい。
【００２１】
図１は、３価の元素としてＬａ（ランタン）を使用し、２ｎｍの厚さを有するキャパシタ用電極の、厚み方向のＬａの組成分布の一例を示したものである。図１（ａ）はキャパシタ用電極の断面図、図１（ｂ）はこのキャパシタ用電極の膜厚方向のＬａの濃度分布を表す図である。なお、図１（ｂ）において、膜厚０ｎｍの位置はキャパシタ用電極が誘電体膜と接する第１面、膜厚２ｎｍの位置はキャパシタ用電極の第２面を表す。図１より、このキャパシタ用電極は、膜厚が０〜０．５ｎｍ未満の位置にはＬａが存在せず、膜厚が０．５〜２ｎｍの位置にのみＬａが存在することが分かる。また、膜厚が約０．５〜１ｎｍの領域ではＬａの濃度が徐々に増加し、第２面の近傍ではＬａの濃度が約１０ａｔｏｍ％でほぼ一定となっていることが分かる。
【００２２】
以下に、３価の元素としてＬａを用い、第１面からその厚み方向に所定の距離だけ離れた一例として０．５ｎｍ離れた位置から第２面側の領域Ａ中に１０ａｔｏｍ％の濃度でＬａが存在することによる効果を説明する。
【００２３】
（第１面からその厚み方向に０．５ｎｍ以上、離れた位置に３価の元素が存在することによる効果）
図２は、６００℃で１０分間、熱処理を行った際の、キャパシタ用電極中のＬａ（３価の元素）の、キャパシタを構成する誘電体膜（ＳｒＴｉＯ3）中への拡散の有無を表す図である。図２中の横軸は、熱処理前のキャパシタ用電極の第１面からその厚み方向に向かってＬａが存在し始める位置を表し、０ｎｍの位置は第１面を表す。
【００２４】
また、図２中の縦軸は、熱処理後の誘電体膜内のＬａが拡散した位置を表し、０ｎｍの位置はキャパシタ用電極の第１面と誘電体膜との界面を表す。また、縦軸中のマイナスの位置はキャパシタ用電極内にＬａが存在することを表し、プラスの位置は誘電体膜内にＬａが存在することを表す。
【００２５】
図２より、横軸が０．５ｎｍ未満の場合（熱処理前に、キャパシタ用電極の第１面からその厚み方向にＬａが存在する位置が０．５ｎｍ未満の場合）には、縦軸がプラスの位置となる。すなわち、この場合、熱処理後に、Ｌａが誘電体膜内にまで拡散してしまう。このように熱処理時に、Ｌａ（３価の元素）が誘電体膜中にまで拡散すると、リーク電流が大きい値となる。この理由は、ＬａがＳｒＴｉＯ3のＳｒサイトに置換することにより、誘電体膜の伝導帯より深い準位にＬａの準位ができ、これがトラップ準位として存在してショットキー式から算出されるリーク電流値が大きな値となるためと考えられる。
【００２６】
これに対して、横軸が０．５ｎｍ以上の場合（熱処理前に、キャパシタ用電極の第１面からその厚み方向にＬａが存在する位置が０．５ｎｍ以上の場合）には、縦軸がマイナスの位置となる。すなわち、熱処理を行っても、Ｌａが誘電体膜内にまで拡散することがない。このため、Ｌａを、キャパシタ用電極の第１面からその厚み方向に０．５ｎｍ以上の領域中に存在するようにすれば、熱処理によっても誘電体膜中へＬａが拡散せず、リーク電流値を低減できることが分かる。
【００２７】
なお、図２では第１面から０．５ｎｍ未満のＬａが誘電体膜中に拡散する例を示したが、Ｌａの拡散距離は熱処理条件（温度、時間等）によって影響される。このため、使用する熱処理条件に応じてＬａが誘電体膜中まで拡散しないように、Ｌａの存在する領域Ａをキャパシタ用電極の第１面から離す距離の設定を行えば良い。すなわち、本発明のキャパシタ用電極においては、最終的に誘電体膜と接触する第１面の近傍にＬａが存在しない領域を有するものである。
【００２８】
また、図２では、３価の元素としてＬａを用いた例を示したが、他の３価の元素を用いた場合であっても、熱処理によって誘電体膜中にまで３価の元素が拡散してしまうとリーク電流が増加する原因となる。このため、キャパシタ用電極の第１面から所定の距離だけ離した領域Ａ中にのみ３価の元素を含有することによって、リーク電流を低減することができる。
【００２９】
（第１面からその厚み方向の位置に３価の元素が存在することによる抵抗値への影響）
図３は、同一の膜厚を有するＳｒＲｕＯ3膜について、その抵抗率への、Ｌａ（３価の元素）の位置の影響を表す図である。図３中の横軸はキャパシタ用電極の第１面からその厚み方向にＬａが存在し始める位置を表し、０ｎｍの位置は第１面を表す。また、図３中の縦軸は、キャパシタ用電極膜の抵抗率を表す。抵抗率は公知の手段である４端子法により測定し、縦軸の値は、横軸０ｎｍの位置における抵抗率によって規格化して表示した。
【００３０】
図３より、横軸の値が大きくなるにつれて、すなわち、キャパシタ用電極の第１面からその厚み方向にＬａが存在し始める位置が長くなるにつれて、キャパシタ用電極の抵抗率が大きくなっていることが分かる。この理由は、Ｌａを含有する領域の体積が減少するに従って、ＳｒＲｕＯ3膜全体の導電性が悪くなるためである。図３において、縦軸の破線で示した抵抗率値Ｓは、ＤＲＡＭ等のメモリセルとして使用するキャパシタ用電極に所望される抵抗率を示している。この場合、横軸の値が２ｎｍを超えると、キャパシタ用電極の表面抵抗値が実デバイスとして要求される値を超えるものとなっていることが分かる。これに対して、横軸が２ｎｍ以下の場合には、キャパシタ用電極の表面抵抗値が実デバイスとして要求される範囲に入っていることが分かる。
【００３１】
なお、図３において、特性値Ｓの設定は使用するデバイスに要求される性能に応じて変更可能である。従って、キャパシタ用電極に必要とされる抵抗値に応じて、Ｌａを導入する開始位置を決定することができる。このため、先に説明したリーク電流値の観点と併せて、Ｌａの開始位置として最適となる位置を選定すればよい。
【００３２】
また、図３では、３価の元素としてＬａを用いた例を示したが、他の３価の元素を用いた場合であっても同様に、３価の元素を導入する領域の開始位置がキャパシタ用電極の第１面から遠くなるほど、抵抗値が上昇する。従って、キャパシタ用電極に必要とされる抵抗値に応じて、３価の元素を導入する領域の開始位置を決定すればよい。
【００３３】
（領域Ａ中の３価の元素の濃度が１０ａｔｏｍ％以下であることによる効果）
領域Ａ中に添加する３価の元素濃度が濃くなり過ぎると、ＳｒＲｕＯ3膜の導電性を逆に阻害してしまう。図４は、キャパシタ用電極の抵抗率への、キャパシタ用電極中のＬａ（３価の元素）濃度の影響を表す図である。図４中の横軸はキャパシタ用電極中のＬａの最大濃度を表し、縦軸はキャパシタ用電極の抵抗率を表す。図４より、キャパシタ用電極中のＬａ濃度が約５〜１０ａｔｏｍ％の時に、キャパシタ用電極の抵抗値は低い値を示すことが分かる。一方、Ｌａ濃度が１０％を超えると、抵抗率が上昇してしまう。
【００３４】
また、図４では、３価の元素としてＬａを用いた例を示したが、他の３価の元素を用いた場合であっても同様に、３価の元素の導入量が多くなると抵抗率が上昇してしまう。従って、領域Ａ中に３価の元素を１０ａｔｏｍ％以下の濃度で含有することによりキャパシタ用電極の抵抗率を低くすることができる。添加する３価の元素濃度の下限値については、所望するキャパシタ用電極の抵抗値に応じて決定すればよい。
【００３５】
２．キャパシタ用電極の製造方法
本発明のキャパシタ用電極の製造方法の一例は、以下の工程を有する。
（１）ＡＬＤ（Ａｔｏｍｉｃ  Ｌａｙｅｒ  Ｄｅｐｏｓｉｔｉｏｎ）法を用いた下記（Ａ）〜（Ｌ）の一連の工程を複数回、繰り返すことにより、領域Ａを形成する工程、
（２）工程（１）の後に、ＡＬＤ（Ａｔｏｍｉｃ  Ｌａｙｅｒ  Ｄｅｐｏｓｉｔｉｏｎ）法を用いた下記（Ａ）〜（Ｈ）の一連の工程を複数回、繰り返すことにより、領域Ａ上に３価の元素を含有しないＳｒＲｕＯ3膜を形成する工程。
（Ａ）Ｒｕ原料ガスを供給してＲｕ膜を成膜する工程、
（Ｂ）Ｒｕ原料ガスをパージする工程、
（Ｃ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＡを供給してＲｕ膜の熱酸化処理を行う工程、
（Ｄ）ガスＡをパージする工程、
（Ｅ）Ｓｒ原料ガスを供給してＳｒ膜を成膜する工程、
（Ｆ）Ｓｒ原料ガスをパージする工程、
（Ｇ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＢを供給してＳｒ膜の熱酸化処理を行う工程、
（Ｈ）ガスＢをパージする工程、
（Ｉ）３価の元素を含む原料ガスを供給して３価の元素を含む膜を成膜する工程、
（Ｊ）３価の元素を含む原料ガスをパージする工程、
（Ｋ）Ｏ2ガス及びＯ3ガスのうち少なくとも一方からなるガスＣを供給して、３価の元素を含む膜に熱酸化処理を行う工程、
（Ｌ）ガスＣをパージする工程。
【００３６】
図６は、本発明の製造方法の一例として、３価の元素としてＬａを用いた場合について模式的に示したものである。
本発明の製造方法は、図６（Ａ）に示されるように、（Ａ）〜（Ｄ）の工程を１サイクルとして実施することによりＲｕＯｘ膜が成膜される。図６（Ｂ）に示されるように、（Ｅ）〜（Ｈ）の工程を１サイクルとして実施することによりＳｒＯ膜を成膜すると共に、（Ａ）〜（Ｄ）の工程に引き続いて（Ｅ）〜（Ｈ）の工程を行うことにより、ＲｕＯｘ膜上に形成されたＳｒＯ膜の熱拡散によりＳｒＲｕＯ3膜が成膜される。また、図６（Ｃ）に示されるように、（Ｉ）〜（Ｌ）の工程を１サイクルとして実施することによりＬａＯ膜を成膜すると共に、（Ａ）〜（Ｈ）の工程に引き続いて（Ｉ）〜（Ｌ）の工程を行うことにより、ＳｒＲｕＯ3膜上に形成されたＬａＯ膜の熱拡散によりＬａを含有するＳｒＲｕＯ3膜を成膜する。
【００３７】
従って、上記工程（１）では、ＡＬＤ（Ａｔｏｍｉｃ  Ｌａｙｅｒ  Ｄｅｐｏｓｉｔｉｏｎ）法を用いた（Ａ）〜（Ｌ）の一連の工程を複数回、実施することにより、所望の厚さの、Ｌａを含有するＳｒＲｕＯ3膜を形成することができる。
【００３８】
また、次に、上記工程（２）では、ＡＬＤ（Ａｔｏｍｉｃ  Ｌａｙｅｒ  Ｄｅｐｏｓｉｔｉｏｎ）法を用いた（Ａ）〜（Ｈ）の一連の工程を複数回、実施することにより、Ｌａを含有するＳｒＲｕＯ3膜上に、所望の厚さの、Ｌａを含有しないＳｒＲｕＯ3膜を形成することができる。
【００３９】
Ｌａが存在し始める位置を、ＳｒＲｕＯ3膜の第１面から例えば０．５ｎｍの位置としたい場合には、工程（２）における一連の工程の実施回数を調節し、Ｌａを含有したＳｒＲｕＯ3膜上に０．５ｎｍの厚さのＬａを含有しないＳｒＲｕＯ3膜を堆積すればよい。
【００４０】
なお、「ＡＬＤ（Ａｔｏｍｉｃ  Ｌａｙｅｒ  Ｄｅｐｏｓｉｔｉｏｎ）法」とは、原料ガスの供給・成膜、原料ガスのパージ、反応ガスの供給・反応、反応ガスのパージを１サイクルとして行い、１サイクルごとに１原子又は１分子の層を形成する方法である。
【００４１】
Ｒｕ原料ガスとしては、下記ガスからなる群から選択された少なくとも一種のガスを使用できる。
２，４−（ｄｉｍｅｔｈｙｌｐｅｎｔａｄｉｅｎｙｌ）（ｅｔｈｙｌｃｙｃｌｏｐｅｎｔａｄｉｅｎｙｌ）Ｒｕ
Ｒｕ（Ｃ7Ｈ11）（Ｃ7Ｈ9）
Ｒｕ（Ｃ11Ｈ19Ｏ2）3［Ｒｕ（ｔｈｄ）3］
Ｒｕ（Ｃ5Ｈ5）2［Ｒｕ（Ｃｐ）2］
Ｒｕ（Ｃ2Ｈ5Ｃ5Ｈ4）2［Ｒｕ（ＥｔＣｐ）2］
Ｒｕ3（ＣＯ）12
Ｓｒ原料ガスとしては、下記ガスからなる群から選択された少なくとも一種のガスを使用できる。
Ｓｒ（ＭＥＴＨＤ）2
Ｓｒ（Ｃ5ｉＰｒ3Ｈ2）2
Ｓｒ（ＣＰ＊）2（ＤＥＭ：Ｂｉｓ（ｐｅｎｔａｍｅｔｈｙｌｃｙｃｌｏｐｅｎｔａｄｉｅｎｙｌ）Ｓｔｒｏｎｔｉｕｍ）
１，２−Ｄｉｍｅｔｈｏｘｙｔｈａｎｅ  ａｄｄｕｃｔ。
【００４２】
３価の元素としてＬａを使用する場合、原料ガスとしては、下記ガスからなる群から選択された少なくとも一種のガスを使用できる。
Ｌａ（ＴＨＤ）3  （Ｔｒｉｓ（２，２，６，６−ｔｅｔｒａｍｅｔｈｙｌ−３，５−ｈｅｐｔａｄｉｏｎａｔｏ）−ｌａｎｔｈａｎｕｍ））
Ｌａ（ｉＰｒＣｐ）3  （Ｔｒｉｓ（ｉｓｏ−ｐｒｏｐｙｌｃｙｃｌｏｐｅｎｔａｄｉｅｎｙｌ）−ｌａｎｔｈａｎｕｍ）
Ｌａ（ｓＢｕＣｐ）3  Ｔｒｉｓ（ｓｅｃ−ｂｕｔｙｌｃｙｃｌｏｐｅｎｔａｄｉｅｎｙｌ）−ｌａｎｔｈａｎｕｍ
Ｌａ（ＥＤＭＤＤ）3  Ｔｒｉｓ（６−ｅｔｈｙｌ−２，２−ｄｉｍｅｔｈｙｌ−３，５−ｄｅｃａｎｅｄｉｏｎａｔｏ）−ｌａｎｔｈａｎｕｍ。
【００４３】
（第１実施例）
３価の元素としてＬａを使用する場合の具体的な製造方法について、以下に説明する。
工程（１）：
（Ａ）温度を３００℃に加熱した基板上に、Ｒｕ原料ガスを２０ｍｓ未満から１ｓまでの範囲の時間、供給してＲｕ膜を成膜する。
（Ｂ）Ｒｕ原料ガスをパージする。
（Ｃ）温度を３００℃に保持した状態で、１ｃｃあたり１００ｇのＯ2又はＯ3を含有するガスＡを２秒間供給し、Ｒｕ膜の熱酸化処理を行う。
（Ｄ）ガスＡをパージする。
（Ｅ）温度を３００℃に保持した状態で、Ｓｒ原料ガスを２０ｍｓ未満から１ｓまでの範囲の時間、供給してＳｒ膜を成膜する。
（Ｆ）Ｓｒ原料ガスをパージする。
（Ｇ）温度を３００℃に保持した状態で、１ｃｃあたり１００ｇのＯ2又はＯ3を含有するガスＢを２秒間供給し、Ｓｒ膜の熱酸化処理を行う。
（Ｈ）ガスＢをパージする。
（Ｉ）温度を３００℃に保持した状態で、Ｌａ原料ガスを２０ｍｓ未満から１ｓまでの範囲の時間、供給してＬａ膜を成膜する。
（Ｊ）Ｌａ原料ガスをパージする。
（Ｋ）温度を３００℃に保持した状態で、１ｃｃあたり１００ｇのＯ2又はＯ3を含有するガスＣを２秒間供給し、Ｌａ膜の熱酸化処理を行う。
（Ｌ）ガスＣをパージする。
【００４４】
上記工程（Ａ）〜（Ｄ）、（Ｅ）〜（Ｈ）、（Ｉ）〜（Ｌ）ではそれぞれ、約０．１ｎｍの膜厚の膜が成膜される。上記工程（Ａ）〜（Ｌ）を連続して行うことを繰り返し、約８ｎｍの膜厚を有する、Ｌａを含有したＳｒＲｕＯ3膜（領域Ａ）を形成する。
【００４５】
工程（２）：
（Ａ）温度を３００℃に加熱した基板上に、Ｒｕ原料ガスを２０ｍｓ未満から１ｓまでの範囲の時間、供給してＲｕ膜を成膜する。
（Ｂ）Ｒｕ原料ガスをパージする。
（Ｃ）温度を３００℃に保持した状態で、１ｃｃあたり１００ｇのＯ2又はＯ3を含有するガスＡを２秒間供給し、Ｒｕ膜の熱酸化処理を行う。
（Ｄ）ガスＡをパージする。
（Ｅ）温度を３００℃に保持した状態で、Ｓｒ原料ガスを２０ｍｓ未満から１ｓまでの範囲の時間、供給してＳｒ膜を成膜する。
（Ｆ）Ｓｒ原料ガスをパージする。
（Ｇ）温度を３００℃に保持した状態で、１ｃｃあたり１００ｇのＯ2又はＯ3を含有するガスＢを２秒間供給し、Ｓｒ膜の熱酸化処理を行う。
（Ｈ）ガスＢをパージする。
【００４６】
上記工程（Ａ）〜（Ｄ）、（Ｅ）〜（Ｈ）ではそれぞれ、約０．１ｎｍの膜厚の膜が成膜される。上記工程（Ａ）〜（Ｈ）を連続して行うことを繰り返し、約２ｎｍの膜厚を有する、Ｌａを含有しないＳｒＲｕＯ3膜を、上記工程（１）で形成したＳｒＲｕＯ3膜上に形成する。工程（１）の後に工程（２）を行うことにより、約１０ｎｍの膜厚のＳｒＲｕＯ3膜が得られる。この膜の上面（第１面）から厚み方向に約２ｎｍの距離まではＬａが含有されておらず、上面（第１面）から厚み方向に約２〜１０ｎｍの距離まではＬａが含有された膜となっている。
【００４７】
３．キャパシタ
本発明のキャパシタは、２つのキャパシタ用電極と、この２つのキャパシタ用電極間に、２つのキャパシタ用電極の第１面に接するように設けられた誘電体膜と、を備える。すなわち、第一のキャパシタ用電極、第一のキャパシタ用電極の第１面に接するように設けられた誘電体膜、誘電体膜上に第１面が接するように設けられた第二のキャパシタ用電極、をこの順に備える。
【００４８】
図８は、本発明のキャパシタの一例を模式的に示したものである。このキャパシタは、２つのキャパシタ用電極３と、この２つのキャパシタ用電極３間に誘電体膜４が設けられている。そして、各キャパシタ用電極３は、その第１面２が誘電体膜４に接するように配置されている。
【００４９】
図５は、本発明と比較例のキャパシタのリーク電流を測定した結果を表す図である。横軸は印加電圧で、縦軸は単位面積あたりのリーク電流値を示している。なお、比較例のキャパシタは、キャパシタ用電極がその厚み方向の全体にわたってＬａを含有している。また、誘電体膜としてはＳｒＴｉＯ3膜を使用した。図５より、本発明のキャパシタではリーク電流が１×１０-8Ａ／ｃｍ2以下の低い値に抑えられているのに対して、比較例のキャパシタではリーク電流が１×１０-8Ａ／ｃｍ2を超える大きな値となっていることが分かる。
【００５０】
また、表１に、本発明のキャパシタと、キャパシタ用電極中にＬａを含有しないキャパシタ（比較例１）及びキャパシタ用電極の厚み方向の全体にわたってＬａを含有するキャパシタ（比較例２）について、キャパシタ用電極の仕事関数及び抵抗率、並びにキャパシタのリーク電流値を測定した結果を示す。なお、誘電体膜としてはＳｒＴｉＯ3膜を使用した。本発明のキャパシタ用電極は、Ｌａを含有するＳｒＲｕＯ3膜（領域Ａ）上に、２ｎｍの膜厚のＬａを含有しないＳｒＲｕＯ3膜を有している。また、Ｌａ濃度は１０ａｔｍ％以下となるようにした。
【００５１】
【表１】
0005608317.tif 000002
【００５２】
表１に示されているように、本発明のキャパシタ用電極の仕事関数が５．３ｅＶと大きく、その抵抗率が６×１０-5Ω・ｃｍと低い値となっていることが分かる。また、本発明のキャパシタは１Ｖにおけるリーク電流値が７×１０-9Ａ／ｃｍ2と低い値になっていることが分かる。
【００５３】
これに対して、比較例２のキャパシタ用電極の抵抗率は本発明のキャパシタ用電極とほとんど変わらないものの、リーク電流値は、２×１０-7Ａ／ｃｍ2と大きな値になっていることが分かる。これは、キャパシタ用電極の厚み方向の全体にわたってＬａを含有しているため、誘電体膜（ＳｒＴｉＯ3）に拡散したＬａの影響によるものである。
【００５４】
また、比較例１のキャパシタ用電極の抵抗率は本発明のキャパシタ用電極よりも大きく、５×１０-4Ω・ｃｍとなっている。これはＬａを含有しないために導電性が悪いことを示している。
【００５５】
以上、説明したように、ＳｒＴｉＯ3膜のような比誘電率が４０以上となるような高誘電率膜を用いる場合においても、本発明のキャパシタ用電極と組み合わせることにより、微細化に対応可能な、低抵抗でありながらリーク電流の抑制されたキャパシタを形成することができる。なお、誘電体膜の種類は特に限定されないが、ＳｒＴｉＯ3、ＴｉＯ2、Ｌａ2Ｏ3、Ｙ2Ｏ3、ＨｆＯ2、ＺｒＯ2及び（Ｂａ，Ｓｒ）ＴｉＯ3からなる群から選択された少なくとも一種の酸化物を含むことが好ましい。また、これらの中でも、好ましくはＳｒＴｉＯ3から構成される高誘電率の誘電体膜を用いると、高性能のキャパシタを容易に形成することができる。
【００５６】
また、本発明を用いて形成したキャパシタと、ＭＯＳ型トランジスタを公知の手段で接続することにより、高性能のＤＲＡＭ用メモリセルを容易に形成することが可能となる。
【００５７】
図９及び１０は、本発明のキャパシタを有するＤＲＡＭのメモリセルの一例を説明する図である。図９は、ＤＲＡＭのメモリセルを上面から見た平面図を模式的に表したものであり、簡略化のため、キャパシタより下の部分の構造のみを記載している。また、図１０（ａ）、（ｂ）は、図９のＡ−Ａ線、Ｂ−Ｂ線にそれぞれ沿った断面図である。
【００５８】
図９の楕円で囲まれた部分１１はメモリセル領域に規則的に配置した電界効果型トランジスタのソース／ドレイン領域を表す。また、ビットコンタクトプラグ１４及びキャパシタ用のコンタクトプラグ１７は、それぞれビット線及びキャパシタと電気接続されている。
【００５９】
図１０では、２８はＭＯＳ型トランジスタのゲート電極を表し、ＤＲＡＭのワード線として機能する。ゲート電極（ワード線）２８の両側に位置するソース／ドレイン領域２０は不純物がドープされている。そして、隣接するソース／ドレイン領域の間は、ＳＴＩ（Ｓｈａｌｌｏｗ  Ｔｒｅｎｃｈ  Ｉｓｏｌａｔｉｏｎ）法を用いて形成した素子分離領域２１で絶縁されている。
【００６０】
ゲート電極２８の両側のソース／ドレイン領域２０上には、導電体を埋め込んで形成したキャパシタ用コンタクトプラグ２６、及びビットコンタクトプラグ２９が形成されている。より具体的には、絶縁層２７内をソース／ドレイン領域まで貫通するように、ビットコンタクトプラグ２９が設けられている。このビットコンタクトプラグ２９には、ビット線２５が電気接続されている。また、キャパシタ用コンタクトプラグ２６は絶縁層２７内をソース／ドレイン領域２０まで貫通するように設けられている。このキャパシタ用コンタクトプラグ２６は、キャパシタとソース／ドレイン領域２０とを電気接続している。
【００６１】
そして、このキャパシタは、順に形成された下部電極２４、誘電体膜２２、上部電極２３から構成されている。誘電体膜２２は、下部電極２４の第１面及び上部電極２３の第１面を介して、下部電極２４及び上部電極２３に接するように配置されている。
【００６２】
なお、図１０では、素子分離領域上ではなく半導体領域上に設けられた１つのゲート電極と、このゲート電極を挟んだ両側に設けられたソース／ドレイン領域、ソース／ドレイン領域の一方に電気接続されたビットコンタクトプラグ２９、ソース／ドレイン領域の他方に電気接続されたキャパシタ用コンタクトプラグ２６、キャパシタ等から１つのメモリセルが構成されている。従って、図１０（ｂ）では、２つのメモリセルが示されていることとなり、この２つのメモリセルの間でビットコンタクトプラグ２９は共通化されている。同様にして、図９では、２つのキャパシタ用コンタクトプラグ１７と１つのビットコンタクトプラグ１４と２つのゲート電極等で構成される部分（楕円で囲まれた部分１１及びその上に設けられた構造）が、２つのメモリセルを構成することとなる。
【００６３】
各メモリセルに備えられたキャパシタに保持されている電荷の状態を、ＭＯＳ型トランジスタを介して判定することにより、記憶されているデータの読み出しを行うことができる。また、ＭＯＳ型トランジスタを介して各メモリセルに備えられたキャパシタに電荷を保持させることにより、記憶させたいデータの書き込みを行うことができる。
【００６４】
本発明のキャパシタを用いてＤＲＡＭのメモリセルを形成すると、キャパシタ用電極の電気抵抗値が低くキャパシタのリーク電流が小さいことから、メモリセルにおけるデータの保持特性（リフレッシュ特性）に優れた高性能のＤＲＡＭを容易に形成することができる。また、本発明のキャパシタは、ＤＲＡＭ以外にもキャパシタを使用する半導体デバイスであれば、特に限定されることなく適用することが可能である。
【図面の簡単な説明】
【００６５】
【図１】本発明のキャパシタ用電極の膜厚方向のＬａの分布を表す図である。
【図２】本発明のキャパシタ用電極中の、熱処理前のＬａの存在位置と熱処理後のＬａの拡散位置との関係を表す図である。
【図３】本発明のキャパシタ用電極中のＬａの存在位置と表面抵抗値との関係を表す図である。
【図４】本発明のキャパシタ用電極の低効率とＬａ濃度との関係を表す図である。
【図５】本発明と比較例のキャパシタの電気的特性を表す図である。
【図６】本発明のキャパシタ用電極の製造工程の一例を表す図である。
【図７】本発明のキャパシタ用電極の一例を表す図である。
【図８】本発明のキャパシタの一部を表す図である。
【図９】本発明のキャパシタを有するＤＲＡＭの一部を表す図である。
【図１０】本発明のキャパシタを有するＤＲＡＭの一部を表す図である。
【符号の説明】
【００６６】
１  第２面
２  第１面
３  キャパシタ用電極
４  誘電体膜
５  厚み方向
６  領域Ａ
１２  ワード線（ゲート電極）
１４  ビットコンタクトプラグ
１５  ビット線
１７  キャパシタ用コンタクトプラグ
２０  ソース／ドレイン領域
２１  素子分離領域
２２  誘電体膜
２３  上部電極
２４  下部電極
２５  ビット線
２６  キャパシタ用コンタクトプラグ
２７  層間絶縁膜
２８  ゲート電極
２９  ビットコンタクトプラグ
【図１】
0005608317.tif 000003
【図２】
0005608317.tif 000004
【図３】
0005608317.tif 000005
【図４】
0005608317.tif 000006
【図５】
0005608317.tif 000007
【図６】
0005608317.tif 000008
【図７】
0005608317.tif 000009
【図８】
0005608317.tif 000010
【図９】
0005608317.tif 000011
【図１０】
0005608317.tif 000012