(57)【要約】 【課題】基板が薄型化されるとともに、微細パターンからなる半導体領域が形成された半導体デバイスの製造方法を提供することを目的とする。【解決手段】ＳｉＣ単結晶基板１にＮ型エピタキシャル層２を形成した後、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるＰ型不純物領域３、４及び表面オーミックコンタクト電極５を形成する工程と、表面オーミックコンタクト電極５を覆うように保護膜を形成し、前記保護膜の平坦化を行う工程と、ＳｉＣ単結晶基板１を薄くする基板薄型化工程と、ＳｉＣ単結晶基板１に裏面オーミックコンタクト電極７を形成する工程と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５と接続されたショットキー金属部８を形成し、ショットキー金属部８を覆う表面パッド電極９を形成する工程と、を具備する半導体デバイス１０１の製造方法を用いることにより、上記課題を解決できる。【選択図】図１
2010135392.tif 000002
【特許請求の範囲】
【請求項１】
ＳｉＣ単結晶基板の表面にＮ型エピタキシャル層を形成した後、前記Ｎ型エピタキシャル層の表面に、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるＰ型不純物領域及び表面オーミックコンタクト電極を形成する工程と、
前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極を覆うように保護膜を形成した後、前記保護膜の平坦化を行う工程と、
前記ＳｉＣ単結晶基板の板厚を薄くする基板薄型化工程と、
前記ＳｉＣ単結晶基板の裏面に裏面オーミックコンタクト電極を形成する工程と、
前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極と接続されたショットキー金属部を形成した後、前記ショットキー金属部を覆うように表面パッド電極を形成する工程と、を具備することを特徴とする半導体デバイスの製造方法。
【請求項２】
前記基板薄型化工程が、前記ＳｉＣ単結晶基板の裏面を研磨する工程であることを特徴とする請求項１に記載の半導体デバイスの製造方法。
【請求項３】
前記基板薄型化工程が、前記ＳｉＣ単結晶基板の裏面をドライエッチングする工程であることを特徴とする請求項１に記載の半導体デバイスの製造方法。
【請求項４】
ＳｉＣ単結晶基板と、前記ＳｉＣ単結晶基板の表面に形成されたＮ型エピタキシャル層と、前記Ｎ型エピタキシャル層の表面に形成された微細パターンからなるＰ型不純物領域及び表面オーミックコンタクト電極と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極と接続されたショットキー金属部と、前記ショットキー金属部を覆うように形成された表面パッド電極と、前記ＳｉＣ単結晶基板の裏面に形成された裏面オーミックコンタクト電極と、を有することを特徴とする半導体デバイス。
【請求項５】
前記ＳｉＣ単結晶基板の板厚が１５０〜３５０μｍであることを特徴とする請求項４に記載の半導体デバイス。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体デバイス及び半導体デバイスの製造方法に関するものである。
【背景技術】
【０００２】
従来、ＳｉＣからなる半導体デバイスの作製工程では、ＳｉＣ単結晶基板の表面にエピタキシャル層を形成する際、生成ガスが回りこんで前記ＳｉＣ単結晶基板の裏面にエピタキシャル層が形成される場合があった。そして、裏面に形成されたエピタキシャル層を除去するため、前記ＳｉＣ単結晶基板の裏面を研磨する工程（以下、裏面研磨工程）が実施されていた。なお、この裏面研磨工程は、基板を薄型化して、半導体デバイスのオン抵抗を下げる効果も有していた。
【０００３】
しかしながら、前記裏面研磨工程を行うと、前記ＳｉＣ単結晶基板で局所的な厚さバラツキ（以下、ＬＴＶ：Ｌｏｃａｌ  Ｔｈｉｃｋｎｅｓｓ  Ｖａｒｉａｔｉｏｎ）が大きくなる場合があった。なお、前記ＬＴＶは、前記ＳｉＣ単結晶基板の単位面内の厚さの最大値と最小値の差であって、たとえば、１０ｍｍ角の領域で２〜１０μｍとなるものがある。
前記ＬＴＶの値がステッパーの焦点深度（１μｍ程度）より大きくなった場合には、ステッパーを用いて半導体領域の微細パターンの形成を試みても、所望の微細なパターンを形成することができず、所望の特性の半導体デバイスを作製できないという問題が発生した。
【０００４】
前記半導体デバイスとして、たとえば、ショットキーバリアダイオード（Ｓｃｈｏｔｔｋｙ  ｂａｒｒｉｅｒ  ｄｉｏｄｅ）がある。このショットキーバリアダイオードは、金属と半導体との接合によって生じるショットキー障壁φｂを利用したダイオードであり、ＰＮ接合ダイオードに比べると、順方向の電圧降下が低く、スイッチング速度が速いという特長を有するが、順方向電圧降下をさらに下げるためにショットキー障壁φｂの小さなショットキー金属を使用した場合、逆方向の漏れ電流（以下、リーク電流）が大きく、逆方向の耐電圧が低いという欠点もある。また、ユニポーラデバイスであるため、順方向のサージ電流に対する耐量も低いと欠点もある。微細パターンからなる半導体領域を形成することにより、逆方向の耐電圧性を向上させることができ、また、順方向のサージ電流に対する耐量を向上させることができる。
【０００５】
特に、ＰＮ接合領域とショットキー接合領域とを複合化したショットキーバリアダイオードでは、微細パターンを形成できないために前記ＰＮ接合領域の間隔が広くなる場合には、逆電圧を印加するとショットキー接合領域の電界が大きくなり、前記リーク電流が大きくなり、また小さなショットキー障壁φｂをもつショットキー金属を使用できないため順方向の電圧降下が大きくなる場合があった。さらに、電極全体で前記ショットキー接合領域が占める面積の割合が小さくなり、順方向に電流を流したときの電圧降下が大きくなり、電力損失を大きくする場合があった。
そのため、前記ショットキーバリアダイオードのような半導体デバイスでは、基板を薄型化するとともに、微細パターンからなる半導体領域を形成することが、半導体特性を向上させるために不可欠であった。
【０００６】
特許文献１は、半導体デバイスチップ及び半導体デバイスの製造方法に関するものであり、裏面を加工後に接合端子を形成するウェーハ薄型化加工工程が開示されている。
また、特許文献２は、半導体装置作製用ＳｉＣ単結晶基板とその製造方法に関するものであり、ＳｉＣ単結晶インゴットからＳｉＣ単結晶基板を形成する工程が開示されている。また、特許文献３は、ＳｉＣ単結晶基板の製造方法に関するものであり、ＳｉＣ単結晶基板の加工変質部を、反応ガスを用いたエッチングにより除去する工程が開示されている。さらに、特許文献４は、発光部と表面電極との間に電流ブロック層を設けた発光ダイオードに関するものである。特許文献２〜４では、数μｍ／ｈ程度のエッチング速度でＳｉＣのドライエッチングを行うことが記載されている。
しかし、これらの方法を用いても、上記課題を解決することはできなかった。
【特許文献１】特開２００１−１５６２１号公報
【特許文献２】特開平６−１８８１６３号公報
【特許文献３】特開２００６−２６１５６３号公報
【特許文献４】特開２００６−３２６６５号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
本発明は、上記事情を鑑みてなされたもので、基板が薄型化されるとともに、微細パターンからなる半導体領域が形成された半導体デバイスおよび半導体デバイスの製造方法を提供することを目的とする。
【課題を解決するための手段】
【０００８】
上記の目的を達成するために、本発明は以下の構成を採用した。すなわち、
（１）  ＳｉＣ単結晶基板の表面にＮ型エピタキシャル層を形成した後、前記Ｎ型エピタキシャル層の表面に、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるＰ型不純物領域及び表面オーミックコンタクト電極を形成する工程と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極を覆うように保護膜を形成した後、前記保護膜の平坦化を行う工程と、前記ＳｉＣ単結晶基板の板厚を薄くする基板薄型化工程と、前記ＳｉＣ単結晶基板の裏面に裏面オーミックコンタクト電極を形成する工程と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極と接続されたショットキー金属部を形成した後、前記ショットキー金属部を覆うように表面パッド電極を形成する工程と、を具備することを特徴とする半導体デバイスの製造方法。
（２）  前記基板薄型化工程が、前記ＳｉＣ単結晶基板の裏面を研磨する工程であることを特徴とする（１）に記載の半導体デバイスの製造方法。
（３）  前記基板薄型化工程が、前記ＳｉＣ単結晶基板の裏面をドライエッチングする工程であることを特徴とする（１）に記載の半導体デバイスの製造方法。
（４）  ＳｉＣ単結晶基板と、前記ＳｉＣ単結晶基板の表面に形成されたＮ型エピタキシャル層と、前記Ｎ型エピタキシャル層の表面に形成された微細パターンからなるＰ型不純物領域及び表面オーミックコンタクト電極と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極と接続されたショットキー金属部と、前記ショットキー金属部を覆うように形成された表面パッド電極と、前記ＳｉＣ単結晶基板の裏面に形成された裏面オーミックコンタクト電極と、を有することを特徴とする半導体デバイス。
（５）  前記ＳｉＣ単結晶基板の板厚が１５０〜３５０μｍであることを特徴とする（４）に記載の半導体デバイス。
【発明の効果】
【０００９】
上記の構成によれば、板が薄型化されるとともに、微細パターンからなる半導体領域が形成された半導体デバイスおよび半導体デバイスの製造方法を提供することができる。
【００１０】
本発明の半導体デバイスの製造方法は、ＳｉＣ単結晶基板の表面にＮ型エピタキシャル層を形成した後、前記Ｎ型エピタキシャル層の表面に、ステッパーによるフォトリソグラフィー法を用いて微細パターンからなるＰ型不純物領域及び表面オーミックコンタクト電極を形成する工程と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極を覆うように保護膜を形成した後、前記保護膜の平坦化を行う工程と、前記ＳｉＣ単結晶基板の板厚を薄くする基板薄型化工程と、前記ＳｉＣ単結晶基板の裏面に裏面オーミックコンタクト電極を形成する工程と、前記Ｐ型不純物領域及び前記表面オーミックコンタクト電極と接続されたショットキー金属部を形成した後、前記ショットキー金属部を覆うように表面パッド電極を形成する工程と、を具備する構成なので、基板薄型化工程によりＬＴＶが大きくなる前に、微細加工を行うことにより、微細パターンからなる半導体領域を有するショットキーバリアダイオードまたはＭＯＳＦＥＴなどの半導体デバイスを形成することができる。この基板薄型化により、前記半導体デバイスのオン電圧を小さくすることができ、順方向に電流を流したときの順方向電圧降下を小さくすることができ、電力損失を小さくすることができる。また、この微細パターンからなる半導体領域の形成により、逆電圧が印加された時の逆方向リーク電流を小さくすることができ、半導体デバイスの信頼性を向上させることができる。
【発明を実施するための最良の形態】
【００１１】
以下、本発明を実施するための形態について説明する。
（実施形態１） 
図１は、本発明の実施形態である半導体デバイスの一例を示す断面図であって、ＰＮ接合領域とショットキー接合領域を複合化したショットキーバリアダイオードの一例を示すものである。
図１に示すように、本発明の実施形態である半導体デバイス１０１は、ＳｉＣ単結晶基板１と、ＳｉＣ単結晶基板１の表面１ａに形成されたＮ型エピタキシャル層２と、Ｎ型エピタキシャル層２の表面２ａに形成された微細パターンからなるＰ型不純物領域３、４及び表面オーミックコンタクト電極５と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５と接続されたショットキー金属部８と、ショットキー金属部８を覆うように形成された表面パッド電極９と、ＳｉＣ単結晶基板１の裏面１ｂに形成された裏面オーミックコンタクト電極７と、裏面オーミックコンタクト電極７を覆うように形成された裏面パッド電極１１と、を有して概略構成されている。
【００１２】
ＳｉＣ単結晶基板１は、高濃度にＮ型不純物がドープされたＮ型半導体基板とされている。ＳｉＣ単結晶基板１上にはＮ型エピタキシャル層２が形成されており、Ｎ型エピタキシャル層２には複数のＰ型不純物領域３、４が形成されている。これにより、Ｐ型不純物領域３、４とＮ型エピタキシャル層２との界面にはＰＮ接合領域が形成され、半導体デバイス１０１の整流性が向上される。なお、前記ＰＮ接合領域の間隔を狭くすることにより、リーク電流を小さくすることができる。
なお、後述する半導体デバイスの製造方法において説明するように、Ｐ型不純物領域３、４は、Ｐ型不純物濃度の違いにより、低濃度Ｐ型不純物領域３と、高濃度Ｐ型不純物領域４とされている。
【００１３】
Ｐ型不純物領域４及びＮ型エピタキシャル層２とショットキー金属部８との界面には、金属と半導体との接合によって生じるショットキー障壁が形成され、ショットキー接合領域が形成される。これにより、半導体デバイス１０１の順方向の電圧降下を低くするとともに、スイッチング速度を速くすることができる。
なお、電極全体で前記ショットキー接合領域が占める面積の割合を大きくすることにより、順方向に電流を流したときの電圧降下を小さくして、電力損失を小さくすることができる。
【００１４】
パッシベーション膜１０は、表面パッド電極９の端部９ｃを覆うとともに、Ｎ型エピタキシャル層２の表面２ａ全面を覆って形成されている。表面パッド電極９の露出された部分は端子接合部とされる。
たとえば、半導体デバイス１０１を、配線基板（図示略）に実装する際に、前記配線基板の一の端子部と前記端子接合部とを結ぶように、アルミワイヤーボンディングするとともに、前記配線基板の他の端子部に、裏面パッド電極１１を接合して配置する。これにより、半導体デバイス１０１の裏面パッド電極１１と表面パッド電極９に電圧を印加することができる。
【００１５】
Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５は、微細パターンで形成されることが好ましい。これにより、逆電圧を印加したときのリーク電流を小さくすることができ、半導体デバイス１０１の信頼性を向上させることができる。
【００１６】
ＳｉＣ単結晶基板１の板厚は、１５０〜３５０μｍとすることが好ましい。ＳｉＣ単結晶基板１の板厚を３５０μｍ以下とすることにより、半導体デバイス１０１の、順方向電流が流れ始める電流値であるオン電圧を小さくすることができる。また、順方向に電流を流したときの順方向電圧降下を小さくすることができ、電力損失を小さくすることができる。なお、ＳｉＣ単結晶基板１の板厚が１５０μｍ未満とした場合には、半導体デバイスの強度が不足するので好ましくない。
なお、半導体デバイス１０１は、ショットキーバリアダイオードに限られるものではなく、ＭＯＳＦＥＴなどでもよい。
【００１７】
次に、本発明の実施形態である半導体デバイス１０１の製造方法について説明する。
図２〜図９は、本発明の実施形態である半導体デバイスの製造方法の一例を説明する工程断面図である。なお、図１で示した部材と同じ部材については同じ符号を付して示している。
本発明の実施形態である半導体デバイス１０１の製造方法は、ＳｉＣ単結晶基板１の表面１ａにステッパーによるフォトリソグラフィー法を用いて、微細パターンからなるＰ型不純物領域３、４及び表面オーミックコンタクト電極５を形成する工程（微細パターン形成工程）と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５を覆うように保護膜６を形成した後、保護膜６の平坦化を行う工程（保護膜平坦化工程）と、ＳｉＣ単結晶基板１の板厚を薄くする基板薄型化工程と、ＳｉＣ単結晶基板１の裏面１ｂに裏面オーミックコンタクト電極７を形成する工程（裏面オーミックコンタクト電極形成工程）と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５と接続されたショットキー金属部８を形成した後、ショットキー金属部８を覆うように表面パッド電極９を形成する工程（表面パッド電極形成工程）と、を具備する。
【００１８】
＜微細パターン形成工程＞
まず、図２に示すように、ＳｉＣ単結晶基板（Ｎ型半導体基板）１上にＮ型エピタキシャル層２を形成する。
次に、ＣＶＤ法により、Ｎ型エピタキシャル層２上に酸化膜を形成する。
次に、前記酸化膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成する。ステッパーを用いることにより微細パターンからなるフォトレジストパターンを形成することができる。その後、前記酸化膜をドライエッチングして窓部を形成する。
【００１９】
次に、窓部が形成された前記酸化膜をマスクとして用いて、Ｐ型不純物となるアルミニウムまたはボロンをＮ型エピタキシャル層２にイオン注入する。その後、再び前記酸化膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成、その後、前記酸化膜をドライエッチングして窓部を形成する。次に、窓部が形成された前記酸化膜をマスクとして用いて、Ｐ型不純物となるアルミニウムまたはボロンをＮ型エピタキシャル層２にイオン注入する。前記酸化膜を除去する。
【００２０】
次に、Ｎ型エピタキシャル層２上に、スパッタ法により炭化膜（例えば、カーボン膜）を形成した後、イオン注入を行ったＰ型不純物の活性化を行うため、高温の熱処理（例えば、１７００℃の熱処理）を不活性ガス雰囲気または真空中で行う。その後、前記炭化膜を除去する。これにより、低濃度Ｐ型不純物領域３と高濃度Ｐ型不純物領域４を形成する。
なお、前記炭化膜は、スパッタ法の代わりに、有機物を塗布した後、熱処理をして形成しても良い。
図３は、低濃度Ｐ型不純物領域３と高濃度Ｐ型不純物領域４形成後の時点の状態を示す断面工程図である。
【００２１】
次に、スパッタ法または蒸着法で、Ｐ型不純物領域３、４を形成したＮ型エピタキシャル層２上に、例えば、Ｔｉ／Ａｌからなる２層の金属膜を形成する。
次に、前記金属膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成する。ステッパーを用いることにより微細パターンからなるフォトレジストパターンを形成することができる。その後、前記金属膜をドライエッチングして表面オーミックコンタクト電極５を形成する。表面オーミックコンタクト電極５は、複数の高濃度Ｐ型不純物領域４に接続され、オーミックコンタクトを形成する。
【００２２】
＜保護膜平坦化工程＞
ＣＶＤ法により、オーミックコンタクト電極５を形成したＮ型エピタキシャル層２上に、たとえば、シリコン酸化膜（ＳｉＯ２）からなる保護膜６を形成する。
次に、ＣＭＰ（Ｃｈｅｍｉｃａｌ  Ｍｅｃｈａｎｉｃａｌ  Ｐｏｌｉｓｈｉｎｇ）法により、保護膜６の平坦化を行う。図４は、この時点の状態を示す断面工程図である。
平坦化した保護膜６の平坦面６ａを基準として、次の基板薄型化工程を行うことで、薄型化する基板１の裏面１ｂを平坦化することができる。
【００２３】
＜基板薄型化工程＞
図５に示すように、ＳｉＣ単結晶基板１の裏面１ｂを研磨して、ＳｉＣ単結晶基板１の厚さｔを１５０〜３５０μｍとする。研磨手段は、特に限定されず、公知の方法を用いることができる。
なお、前記ＳｉＣ単結晶基板の裏面をドライエッチングしてＳｉＣ単結晶基板１を薄型化してもよい。効率的に薄型化することができる。
【００２４】
＜裏面オーミックコンタクト電極形成工程＞
スパッタ法または蒸着法で、Ｐ型不純物領域３、４を形成したＳｉＣ単結晶基板１の裏面に、例えば、Ｎｉからなる金属膜を形成する。
次に、熱処理（例えば、９５０℃の熱処理）を不活性ガス雰囲気または真空中で行って、裏面オーミックコンタクト電極７とする。これにより、裏面オーミックコンタクト電極７は、ＳｉＣ単結晶基板１の裏面と良好なオーミックコンタクトを形成する。図６は、この時点の状態を示す断面工程図である。
次に、図７に示すように、保護膜６を除去する。
【００２５】
＜表面ショットキーコンタクト電極形成工程＞
次に、オーミックコンタクト電極５を形成したＮ型エピタキシャル層２上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーをによる露光、その後の現像により、フォトレジストパターンを形成する。焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーを用いることにより、製造工程を低価格化することができる。
次に、スパッタ法または蒸着法で、窓部を形成したレジスト上に、例えば、チタンまたはモリブデンなどからなる金属膜を形成する。
次に、前記レジストを除去（リフトオフ）することにより、窓部に形成された金属膜のみをオーミックコンタクト電極５を覆うように残すことができる。
次に、ショットキー障壁φｂ制御のための熱処理（例えば、６００℃での熱処理）を不活性ガス雰囲気で行い、ショットキー金属部８を形成する。ショットキー金属部８は、ＳｉＣ単結晶基板１に接続され、ショットキーコンタクトを形成している。図８は、この時点の状態を示す断面工程図である。
【００２６】
＜表面パッド電極形成工程＞
次に、ショットキー金属部８を形成したＮ型エピタキシャル層２上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーまたはコンタクトアライナーによる露光、その後の現像により、フォトレジストパターンを形成する。
次に、スパッタ法で、窓部を形成したレジスト上に、例えば、アルミニウムからなる金属膜を形成する。
次に、前記レジストを除去（リフトオフ）することにより、窓部に形成された金属膜のみをショットキー金属部８を覆うように残すことができる。
これにより、ショットキー金属部８に接続された表面パッド電極９を形成する。図９は、この時点の状態を示す断面工程図である。
【００２７】
次に、表面パッド電極９を形成したＮ型エピタキシャル層２上に、パッシベーション膜を塗布する。パッシベーション膜としては、たとえば、感光性ポリイミド膜を用いる。
次に、ミラープロジェクションアライナーまたはコンタクトアライナーによる露光、その後の現像により、パターン化されたパッシベーション膜１０を形成する。図１０は、この時点の状態を示す断面工程図であって、表面パッド電極９の表面の一部が露出され、表面パッド電極９の端部９ｃのみを覆うようにパッシベーション膜１０が形成されている。
最後に、スパッタ法で、裏面オーミックコンタクト電極７上に、裏面パッド電極１１として、例えば、Ｎｉ／Ａｇなどからなる２層の金属膜を形成する。
以上の工程により、図１に示す半導体デバイス１０１を作製する。
【００２８】
本発明の実施形態である半導体デバイス１０１の製造方法は、ＳｉＣ単結晶基板１の表面１ａにステッパーによるフォトリソグラフィー法を用いて、微細パターンからなるＰ型不純物領域３、４及び表面オーミックコンタクト電極５を形成する工程と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５を覆うように保護膜６を形成した後、保護膜６の平坦化を行う工程と、ＳｉＣ単結晶基板１の板厚を薄くする基板薄型化工程と、ＳｉＣ単結晶基板１の裏面１ｂに裏面オーミックコンタクト電極７を形成する工程と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５と接続されたショットキー金属部８を形成した後、ショットキー金属部８を覆うように表面パッド電極９を形成する工程と、を具備する構成なので、基板薄型化工程によりＬＴＶが大きくなる前に、微細加工を行うことにより、微細パターンからなる半導体領域３、４を有するショットキーバリアダイオードまたはＭＯＳＦＥＴなどの半導体デバイス１０１を形成することができる。この基板薄型化により、半導体デバイス１０１のオン電圧を小さくすることができ、順方向に電流を流したときの順方向電圧降下を小さくすることができ、電力損失を小さくすることができる。また、この微細パターンからなる半導体領域３、４の形成により、逆電圧が印加された時の逆方向リーク電流を小さくすることができ、半導体デバイス１０１の信頼性を向上させることができる。
【００２９】
本発明の実施形態である半導体デバイス１０１の製造方法は、前記基板薄型化工程が、ＳｉＣ単結晶基板１の裏面１ｂを研磨する工程である構成なので、基板を効率よく薄型化することができる。
【００３０】
本発明の実施形態である半導体デバイス１０１の製造方法は、前記基板薄型化工程が、ＳｉＣ単結晶基板１の裏面１ｂをドライエッチングする工程である構成なので、基板を効率よく薄型化することができる。
【００３１】
本発明の実施形態である半導体デバイス１０１は、ＳｉＣ単結晶基板１と、ＳｉＣ単結晶基板１の表面１ａに形成されたＮ型エピタキシャル層２と、Ｎ型エピタキシャル層２の表面２ａに形成された微細パターンからなるＰ型不純物領域３、４及び表面オーミックコンタクト電極５と、Ｐ型不純物領域３、４及び表面オーミックコンタクト電極５と接続されたショットキー金属部８と、ショットキー金属部８を覆うように形成された表面パッド電極９と、ＳｉＣ単結晶基板１の裏面１ｂに形成された裏面オーミックコンタクト電極７と、を有する構成なので、記ＰＮ接合領域の間隔を狭くして、逆電圧が印加された時の逆方向リーク電流を小さくすることができる。また、電極全体で前記ショットキー接合領域が占める面積の割合を大きくして、順方向に電流を流したときの電圧降下を小さくして、電力損失を小さくすることができる。これにより、半導体デバイス１０１の信頼性を向上させることができる。
【００３２】
本発明の実施形態である半導体デバイス１０１は、ＳｉＣ単結晶基板１の板厚が１５０〜３５０μｍである構成なので、半導体デバイス１０１のオン電圧を小さくすることができ、順方向に電流を流したときの順方向電圧降下を小さくすることができ、電力損失を小さくすることができる。
【実施例】
【００３３】
以下、本発明を実施例に基づいて具体的に説明する。しかし、本発明はこれらの実施例にのみ限定されるものではない。
（実施例１）
図１に示す半導体デバイスを、次の条件で製造した。
＜微細パターン形成工程＞
まず、ＳｉＣ単結晶基板（Ｎ型半導体基板）上にＮ型エピタキシャル層を形成した。次に、ＣＶＤ法により、Ｎ型エピタキシャル層上に酸化膜を形成した。次に、前記酸化膜上にレジストを塗布した後、ステッパーによる微細パターンからなるフォトレジストパターンを形成した。その後、前記酸化膜をドライエッチングして窓部を形成した。次に、窓部が形成された前記酸化膜をマスクとして用いて、Ｐ型不純物となるアルミニウムをイオン注入した。その後、再び前記酸化膜上にレジストを塗布した後、ステッパーによるフォトレジストパターンを形成、その後、前記酸化膜をドライエッチングして追加の窓部を形成する。次に、窓部が形成された前記酸化膜をマスクとして用いて、Ｐ型不純物となるアルミニウムまたはボロンをＮ型エピタキシャル層２に再度イオン注入した。次に、１７００℃の熱処理を不活性ガス雰囲気で行った。これにより、低濃度Ｐ型不純物領域および高濃度Ｐ型不純物領域を形成した。
【００３４】
次に、スパッタ法で、Ｐ型不純物領域を形成したＮ型エピタキシャル層上に、Ｔｉ／Ａｌからなる２層の金属膜を形成した。次に、前記金属膜上にレジストを塗布した後、ステッパーによる微細パターンからなるフォトレジストパターンを形成した。その後、前記金属膜をドライエッチングして表面オーミックコンタクト電極を形成した。
【００３５】
＜保護膜平坦化工程＞
次に、ＣＶＤ法により、表面オーミックコンタクト電極を形成したＮ型エピタキシャル層上に、シリコン酸化膜（ＳｉＯ２）からなる保護膜を形成した。次に、ＣＭＰにより、前記保護膜の平坦化を行った。
【００３６】
＜基板薄型化工程＞
次に、ＳｉＣ単結晶基板１の裏面を研磨して、ＳｉＣ単結晶基板の厚さを約２５０μｍとした。研磨手段としては、特に限定されず、公知の方法を用いた。
【００３７】
＜裏面オーミックコンタクト電極形成工程＞
次に、スパッタ法で、Ｐ型不純物領域を形成したＳｉＣ単結晶基板の裏面にＮｉからなる金属膜を形成した。次に、９５０℃の熱処理を不活性ガス雰囲気で行って、裏面オーミックコンタクト電極とした。次に前記保護膜を除去した。
【００３８】
次に、前記表面オーミックコンタクト電極を形成したＮ型エピタキシャル層上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーによる露光、その後の現像により、フォトレジストパターンを形成した。次に、スパッタ法で、前記窓部を形成したレジスト上に、チタンからなる金属膜を形成した。前記レジストを除去（リフトオフ）した後、６００℃での熱処理を不活性ガス雰囲気で行い、ショットキー金属部を形成した。
【００３９】
＜表面パッド電極形成工程＞
次に、スパッタ法で、ショットキー金属部を形成したＮ型エピタキシャル層上にレジストを塗布した後、焦点深度の大きいミラープロジェクションアライナーによる露光、その後の現像により、フォトレジストパターンを形成した。次に、スパッタ法で、前記窓部を形成したレジスト上に、アルミニウムからなる金属膜を形成した。前記レジストを除去（リフトオフ）して、表面パッド電極を形成した。
【００４０】
次に、表面パッド電極を形成したＮ型エピタキシャル層上に、感光性ポリイミド膜からなるパッシベーション膜を塗布した。次に、ミラープロジェクションアライナーによる露光、その後の現像により、パターン化されたパッシベーション膜を形成した。
【００４１】
最後に、スパッタ法で、前記裏面オーミックコンタクト電極に、例えば、Ｎｉ／Ａｇからなる２層の金属膜を形成して、裏面パッド電極とした。以上の工程により、図１に示す半導体デバイス（実施例１サンプル）を作製した。
【００４２】
（比較例１）
次に、微細パターン形成工程でステッパーを用いずＰ型不純物領域及び表面オーミックコンタクト電極を形成したことと、保護膜平坦化工程と基板薄型化工程とを行わなかった他は実施例１と同様にして、半導体デバイス（比較例１サンプル）を作製した。
【００４３】
次に、半導体デバイス（実施例１サンプル）と半導体デバイス（比較例１サンプル）の整流特性の違いを調べた。
図１１は、逆方向に電圧を印加したときに、逆方向に流れる電流（以下、逆方向電流）の値を示すグラフである。ここで、逆方向電流は漏れ電流（以下、リーク電流）である。図１１に示すように、逆電圧の値を大きくしたとき、半導体デバイス（実施例１サンプル）の方が、半導体デバイス（比較例１サンプル）よりも、リーク電流の値が小さいという結果が得られた。つまり、リーク電流を小さくして、半導体デバイスの信頼性を向上させることができた。
【００４４】
図１２は、順方向に電圧を印加したときに、順方向に流れる電流（以下、順方向電流）の値を示すグラフである。図１２に示すように、半導体デバイス（実施例１サンプル）の方が、半導体デバイス（比較例１サンプル）よりも、順方向電流が流れ始めるときの電圧の値が低いとともに、Ｉ−Ｖ特性の傾きが大きいという結果が得られた。つまり、半導体デバイス（実施例１サンプル）のオン電圧を小さくすることができ、電力損失を小さくすることができた。
【産業上の利用可能性】
【００４５】
本発明は、半導体デバイス及び半導体デバイスの製造方法に関するものであって、オン電圧を小さくして電力損失を小さくするとともに、リーク電流を小さくして信頼性を向上させた半導体デバイスを製造・利用する産業において利用可能性がある。
【図面の簡単な説明】
【００４６】
【図１】本発明の半導体デバイスを示す断面模式図である。
【図２】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図３】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図４】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図５】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図６】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図７】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図８】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図９】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図１０】本発明の半導体デバイスの製造方法を示す工程断面図である。
【図１１】逆方向電圧と逆方向電流の関係を示すグラフである。
【図１２】順方向電圧と順方向電流の関係を示すグラフである。
【符号の説明】
【００４７】
１…ＳｉＣ単結晶基板（Ｎ型半導体基板）、１ａ…表面、１ｂ…裏面、２…Ｎ型エピタキシャル層、２ａ…表面、３…（低濃度Ｐ型）半導体領域、４…（高濃度Ｐ型）半導体領域、５…（表面）オーミックコンタクト電極、６…保護膜、７…（裏面）オーミックコンタクト電極、８…ショットキー金属部、９…（表面）パッド電極、９ｃ…端部、１０…パッシベーション膜、１１…（裏面）パッド電極、１０１…半導体デバイス。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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