(57)【要約】【課題】２系統以上の給電入力が可能であり、１の給電が停止しても、他の給電に切り替えて、電圧降下の少ない効率的な給電を継続できる回路、および装置を提供する。【解決手段】当該回路は、（Ａ）第１給電入力とシステム内部電源との間に、システム内部電源側が陰極側となるように接続されたダイオードと、（Ｂ）第１給電入力にドレイン、システム内部電源側にソースをつないで接続したＦＥＴであって、そのゲートは第２給電入力に接続され、かつ、抵抗を介して接地された、ＦＥＴと、（Ｃ）第２給電入力とシステム内部電源との間に、システム内部電源側が陰極側となるように接続されたダイオードと、（Ｄ）第２給電入力にドレイン、システム内部電源側にソースをつないで接続したＦＥＴであって、そのゲートは第１給電入力に接続され、かつ、抵抗を介して接地された、ＦＥＴと、を備える。【選択図】図３
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【特許請求の範囲】
【請求項１】
第１給電入力と第２給電入力とから一方を選択してシステム内部電源に給電する回路であって、
前記第１給電入力と前記システム内部電源との間に、前記システム内部電源側が陰極側となるように接続された第１整流素子と、
前記第１整流素子と並列に、前記第１給電入力と前記システム内部電源との間に、スイッチングがオンになったとき前記第１給電入力から前記システム内部電源に電流が流れるように接続された第１スイッチング素子であって、当該第１スイッチング素子のスイッチ制御入力は前記第２給電入力に接続され、かつ、所定の抵抗を介して接地電位に接続された、第１スイッチング素子と、
前記第２給電入力と前記システム内部電源との間に、前記システム内部電源側が陰極側となるように接続された第２整流素子と、
前記第２整流素子と並列に、前記第２給電入力と前記システム内部電源との間に、スイッチングがオンになったとき前記第２給電入力から前記システム内部電源に電流が流れるように接続された第２スイッチング素子であって、当該第２スイッチング素子のスイッチ制御入力は前記第１給電入力に接続され、かつ、所定の抵抗を介して接地電位に接続された、第２スイッチング素子と、
を備える回路。
【請求項２】
前記第１整流素子および前記第２整流素子はダイオードである、請求項１に記載の回路。
【請求項３】
前記第１スイッチング素子および前記第２スイッチング素子はＦＥＴ（電界効果トランジスタ）であり、前記システム内部電源側に前記ＦＥＴのソース端子が接続され、前記スイッチ制御入力は前記ＦＥＴのゲート端子である、請求項１に記載の回路。
【請求項４】
前記第１整流素子の順方向電圧が、前記第２整流素子の順方向電圧より所定の値以上小さいことを特徴とする、請求項１に記載の回路。
【請求項５】
３以上の給電入力のうちから一つを選択してシステム内部電源に給電する回路であって、
前記３以上の給電入力の各々の給電入力について、
当該給電入力と前記システム内部電源との間に、前記システム内部電源側が陰極側となるように接続された整流素子と、
前記整流素子と並列に、当該給電入力と前記システム内部電源との間に、スイッチングがオンになったとき当該給電入力から前記システム内部電源に電流が流れるように接続されたスイッチング素子であって、当該スイッチング素子のスイッチ制御入力は所定の抵抗を介して接地電位に接続された、スイッチング素子と、
当該給電入力の他の全ての給電入力のそれぞれと、前記スイッチ制御入力との間に、前記スイッチ制御入力側が陰極側となるように接続された、それぞれの整流素子と、
を備える回路。
【請求項６】
請求項１乃至５の何れかに記載の回路を備える装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、電源入力回路に関する。より詳細には、２系統以上の外部給電入力同時接続が可能であり、それまで採用していた外部給電が停止しても、他系統の外部給電に切り替えて給電を継続できる電源入力回路に関する。本発明はまた、当該電源入力回路を備える装置に関する。
【背景技術】
【０００２】
産業用プロセスの監視制御等の分野においては、現場に設置される各種産業設備から得られるプロセスデータを処理するために、産業設備毎に制御装置を割り当てて、産業設備と通信可能に接続される。
これらの制御装置は、直流電源で給電して動作させることが多く、ＡＣアダプターを介したＤＣ給電や、ＰｏＥ（Power over Ethernet: パワー・オーバー・イーサーネット）といったネットワーク・ケーブルを介したＤＣ給電が行われている。
【０００３】
従来、これらの制御装置に対する給電は、１系統の給電入力方式がとられるか、または２系統の給電入力を備えているものであっても、一方の系統から給電しているときは他方は給電しない（即ち、給電入力に接続しない）ようにするなどの排他方式がとられる。また、特に無停電のような高信頼性が要求される制御装置の場合には、２系統の給電入力の双方を接続しておき、一方の給電が故障などにより停止しても、他方からの給電に切り替えて、常に制御装置の機能が停止しないようにするものもある。
【０００４】
例えば、特許文献１では、２つの直流電源をダイオードの並列接続によるオア回路を介して制御装置内部に給電することで２系統の給電入力を実現することが記載されている。
しかし、このような方式では、２つの直流電源入力の何れから給電している場合であっても常にダイオードの比較的大きい順方向電圧を経由して制御装置内部に給電することになり、入力端からの電圧降下により効率的な電源供給ができない。すなわち、電圧降下分を見越して、両給電入力とも電圧定格等の範囲を限られたものにしなければならなくなり、設計や仕様の上で大きな制約を受けることになる。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開平８−１６８１７２号公報（図1等）
【発明の概要】
【発明が解決しようとする課題】
【０００６】
本発明の目的は、２系統またはそれ以上の給電入力が可能であり、それまで給電していた１の系統の入力からの給電が停止しても、他のいずれかの系統の電源入力に切り替えて、電圧降下の少ない効率的な給電を継続できる電源入力回路、および当該回路を備えた装置を提供することである。
【課題を解決するための手段】
【０００７】
上記課題を解決するために、本発明では、第１給電入力と第２給電入力とから一方を選択してシステム内部電源に給電する回路を提供する。
この回路は、（Ａ）第１給電入力とシステム内部電源との間に、システム内部電源側が陰極側となるように接続された第１整流素子と、（Ｂ）第１整流素子と並列に、第１給電入力とシステム内部電源との間に、スイッチングがオンになったとき第１給電入力からシステム内部電源に電流が流れるように接続された第１スイッチング素子であって、当該第１スイッチング素子のスイッチ制御入力は第２給電入力に接続され、かつ、所定の抵抗を介して接地電位に接続された、第１スイッチング素子と、（Ｃ）第２給電入力とシステム内部電源との間に、システム内部電源側が陰極側となるように接続された第２整流素子と、（Ｄ）第２整流素子と並列に、第２給電入力とシステム内部電源との間に、スイッチングがオンになったとき第２給電入力からシステム内部電源に電流が流れるように接続された第２スイッチング素子であって、当該第２スイッチング素子のスイッチ制御入力は第１給電入力に接続され、かつ、所定の抵抗を介して接地電位に接続された、第２スイッチング素子と、を備える。
【０００８】
上記回路において、第１および第２整流素子はダイオードであると捉えることができる。また、第１および第２スイッチング素子はＦＥＴ（電界効果トランジスタ）であると捉えることができ、システム内部電源側にこのＦＥＴのソース（Ｓ）端子が接続され、スイッチ制御入力はこのＦＥＴのゲート（Ｇ）端子に相当する。
【０００９】
本発明ではさらに、３以上の給電入力のうちから一つを選択してシステム内部電源に給電する回路を提供する。
この回路は、３以上の給電入力の各々の給電入力について、（Ａ）当該給電入力とシステム内部電源との間に、システム内部電源側が陰極側となるように接続された整流素子と、（Ｂ）この整流素子と並列に、当該給電入力とシステム内部電源との間に、スイッチングがオンになったとき当該給電入力からシステム内部電源に電流が流れるように接続されたスイッチング素子であって、当該スイッチング素子のスイッチ制御入力は所定の抵抗を介して接地電位に接続された、スイッチング素子と、（Ｃ）当該給電入力の他の全ての給電入力のそれぞれと、前記スイッチ制御入力との間に、前記スイッチ制御入力側が陰極側となるように接続された、それぞれの整流素子と、を備える。
【００１０】
以上、本発明の概要を、システム内部電源に給電する回路として説明したが、これらの上記課題を解決するために、本発明はさらに、これら何れかの回路を備える装置としても捉えることができる。
【００１１】
尚、上記発明の概要は、本発明の必要な特徴の全てを列挙したものではなく、これらの構成要素のコンビネーションまたはサブコンビネーションもまた、本発明として提供することができることに留意されたい。
【発明の効果】
【００１２】
本発明に係る電源入力回路によれば、２系統またはそれ以上の給電入力を持つことができる。 また、それまで給電していた１の系統の入力からの給電が停止した場合も、他のいずれかの系統の電源入力に切り替えて、電圧降下の少ない効率的な給電を継続することができる。
【図面の簡単な説明】
【００１３】
【図１】本発明の実施形態に係る給電切替回路を含む装置が用いられるシステム環境の一例を示す。
【図２】本発明に第１の実施形態に係る給電切替回路の、データ蓄積装置内における位置付けを示す。
【図３】本発明の第１の実施形態に係る給電切替回路の例を示す。
【図４】本発明の第２の実施形態に係る給電切替回路の例を示す。
【発明を実施するための形態】
【００１４】
以下、添付図面を参照して、本発明を実施するための形態（以下、実施形態）について詳細に説明する。なお、実施形態の説明の全体を通じて同じ要素には同じ番号を付している。
【００１５】
先ず、本発明の第１の実施形態として、給電入力が２系統の場合について説明する。
初めに、本発明が実施されるシステム環境について説明する。図１は、本発明の実施形態に係る給電切替回路を含む装置が用いられるシステム環境の一例を示す。
産業用プロセスの監視制御等の分野においては、プロセス監視現場に複数の設備（設備１３０、１３２）が設置されている。各設備には、センサーや調節器等のいわゆる現場機器１２０および１２２、１２４および１２６が備えられ、各現場機器が送信するいわゆるプロセスデータは、各設備毎に割り当てられたデータ蓄積装置１１０、１１２に一旦蓄積される。データ蓄積装置１１０、１１２に蓄積されたプロセスデータは、ＬＡＮ等でネットワーク接続された中央監視サーバ１０６やクライアント１０２、１０４によって適宜アクセスされる。
従って、データ蓄積装置は、接続された現場機器からリアルタイムで送信されるプロセスデータを取りこぼすことがない様に、無停電で動作する必要がある。
データ蓄積装置１１０、１１２は、ＡＣアダプターからのＤＣ＋５Ｖ入力と、イーサーネット・ケーブルに重畳させて電源を供給するＰｏＥのＤＣ±４８Ｖの２系統の給電入力を持つ。
【００１６】
図２は、本発明の実施に係る給電切替回路の、データ蓄積装置内における位置付けを示す。
データ蓄積装置には、ＡＣアダプターからのＤＣ＋５Ｖ入力２０２と、ＰｏＥからのＤＣ±４８Ｖ入力２０４の２系統の電源入力がある。ＤＣ＋５Ｖ入力２０２はフューズと電源フィルタ２０６を介して、所定の定格を持ったＤＣ＋５Ｖの第１の給電入力３０８として給電切替回路２００に入力される。ＤＣ±４８Ｖ入力２０４は、ＤＣ−ＤＣコンバータ２０８によって＋５Ｖに変換されて、所定の定格を持ったＤＣ＋５Ｖの第２の給電入力３１８として給電切替回路２００に入力される。
給電切替回路２００は、第１の給電入力３０８と第２の給電入力３１８のうちの何れかを選択して、ＤＣ＋５Ｖの給電出力３２０を内部電源系へ供給する。
【００１７】
ＤＣ＋５Ｖの給電出力３２０は、ＤＣ−ＤＣコンバータ２１０およびスイッチング・レギュレータ２１２を介して、それぞれＲＳ４８５等用のＤＣ＋５ＶおよびＤＣ＋３．３Ｖに変換され、またＤＣ＋３．３Ｖは、シリーズ・レギュレータ２１４および２１６を介して、それぞれＤＣ＋１．９ＶおよびＤＣ＋２．５Ｖに変換され、変換されたこれらの電圧は、データ蓄積装置を稼動させるための内部電源として使用される。
【００１８】
図３は、本発明の第１の実施形態に係る給電切替回路２００の回路構成を示す。 第１の給電入力Ｐ１  ３０８は、ダイオード  Ｄ１  ３０２のアノード（陽極）に接続され、Ｄ１  ３０２のカソード（陰極）は内部電源系への給電出力Ｐ  ３２０に接続される。
第１の給電入力Ｐ１  ３０８はまた、電界効果トランジスタ  ＦＥＴ１  ３０４のドレイン（Ｄ）に接続され、ＦＥＴ１  ３０４のソース（Ｓ）は内部電源系への給電出力Ｐ  ３２０に接続される。ＦＥＴ１  ３０４のゲート（Ｇ）は、第２の給電入力Ｐ２  ３１８に接続され、更に抵抗Ｒ１  ３０６を介してグラウンド（接地電位）にも接続される。
【００１９】
一方、第２の給電入力Ｐ２  ３１８は、ダイオード  Ｄ２  ３１２のアノード（陽極）に接続され、Ｄ２  ３１２のカソード（陰極）は内部電源系への給電出力Ｐ  ３２０に接続される。
第２の給電入力Ｐ２  ３１８はまた、電界効果トランジスタ  ＦＥＴ２  ３１４のドレイン（Ｄ）に接続され、ＦＥＴ２  ３１４のソース（Ｓ）は内部電源系への給電出力Ｐ  ３２０に接続される。ＦＥＴ２  ３１４のゲート（Ｇ）は、第１の給電入力Ｐ１  ３０８に接続され、更に抵抗Ｒ２  ３１６を介してグラウンド（接地電位）にも接続される。
【００２０】
次に、図３に示す第１の実施形態に係る給電切替回路２００の動作について説明する。
第１の給電入力Ｐ１  ３０８から給電がされ、第２の給電入力Ｐ２  ３１８からは給電がされない場合は、ダイオードＤ１  ３０２を通して給電出力Ｐ  ３２０に＋５Ｖ電圧が供給される。そうすると、ＦＥＴ１  ３０４のゲート（Ｇ）には第２の給電入力Ｐ２  ３１８が接続されているため当該ゲート（Ｇ）の電位は０となり、ソース（Ｓ）とゲート（Ｇ）との間に電位差が発生してＦＥＴ１  ３０４がＯｎとなる。ＦＥＴ１がＯｎになった後は、ＦＥＴ１を通して第１の給電入力Ｐ１  ３０８から給電出力Ｐ  ３２０に＋５Ｖ電圧が供給される。この際、給電出力Ｐ  ３２０における＋５Ｖ電圧の電圧降下は、ＦＥＴ１のＯｎ抵抗（約１８ｍΩ）で発生する電圧分のみであり、ダイオードＤ１  ３０２の比較的大きい順方向電圧（例えば、最大０．４Ｖ）による電圧降下と比べてはるかに小さい。
【００２１】
逆に、第２の給電入力Ｐ２  ３１８から給電がされ、第１の給電入力Ｐ１  ３０８からは給電がされない場合は、ダイオードＤ２  ３１２を通して給電出力Ｐ  ３２０に＋５Ｖ電圧が供給される。そうすると、ＦＥＴ２  ３１４のゲート（Ｇ）には第１の給電入力Ｐ１  ３０８が接続されているため当該ゲート（Ｇ）の電位は０となり、ソース（Ｓ）とゲート（Ｇ）との間に電位差が発生してＦＥＴ２  ３１４がＯｎとなる。ＦＥＴ２がＯｎになった後は、ＦＥＴ２を通して第２の給電入力Ｐ２  ３１８から給電出力Ｐ  ３２０に＋５Ｖ電圧が供給される。この際、給電出力Ｐ  ３２０における＋５Ｖ電圧の電圧降下は、ＦＥＴ２のＯｎ抵抗（約１８ｍΩ）で発生する電圧分のみであり、ダイオードＤ２  ３１２の比較的大きい順方向電圧（例えば、最大０．４Ｖ）による電圧降下と比べてはるかに小さい。
【００２２】
第１の給電入力Ｐ１  ３０８と第２の給電入力Ｐ２  ３１８の双方に給電がされる場合は、ＦＥＴ１  ３０４のゲート（Ｇ）およびＦＥＴ２  ３１４のゲート（Ｇ）の双方ともに＋５Ｖ電圧が供給されるので、ＦＥＴ１  ３０４およびＦＥＴ２  ３１４の双方ともＯｆｆになる。
この場合、第１の給電入力Ｐ１  ３０８および第２の給電入力Ｐ２  ３１８から、それぞれ、ダイオードＤ１  ３０２およびダイオードＤ２  ３１２を通して給電出力Ｐ  ３２０に電圧が供給されようとするが、ダイオードによる電圧降下を経た後の電圧が高いほうの給電入力からの給電が選択される。したがって、ダイオードＤ１  ３０２の順方向電圧を、ダイオードＤ２  ３１２の順方向電圧より幾分小さなものにした場合には、結局は、第１の給電入力Ｐ１  ３０８からダイオードＤ１  ３０２を通して給電出力Ｐ  ３２０に給電される。
第１の給電入力Ｐ１  ３０８を主たる給電系統としたい場合は、この方法で、双方の給電入力からの給電が有効な場合に、常に第１の給電入力Ｐ１  ３０８からの給電を選択することができる。
【００２３】
次に、本発明の第２の実施形態として、給電入力が３系統以上である場合について説明する。
図４は、本発明の第２の実施形態に係る給電切替回路４６０の回路構成を示す。 第１の給電入力Ｐ１  ４０８は、ダイオード  Ｄ１  ４０２のアノード（陽極）に接続され、Ｄ１  ４０２のカソード（陰極）は内部電源系への給電出力Ｐ  ４５０に接続される。
第１の給電入力Ｐ１  ４０８はまた、電界効果トランジスタ  ＦＥＴ１  ４０４のドレイン（Ｄ）に接続され、ＦＥＴ１  ４０４のソース（Ｓ）は内部電源系への給電出力Ｐ  ４５０に接続される。
ＦＥＴ１  ４０４のゲート（Ｇ）はさらに、第１の給電入力Ｐ１  ４０８以外の全ての給電入力Ｐ２  ４１８〜Ｐｎ  ４２８から、それぞれダイオードＤ21、・・・、Ｄn1を介して接続され、更に抵抗Ｒ１  ４０６を介してグラウンド（接地電位）にも接続される。
各ダイオードＤ21、・・・、Ｄn1は、カソード（陰極）側がＦＥＴ１  ４０４のゲート（Ｇ）に接続される。
【００２４】
同様に、第２の給電入力Ｐ２  ４１８は、ダイオード  Ｄ２  ４１２のアノード（陽極）に接続され、Ｄ１  ４１２のカソード（陰極）は内部電源系への給電出力Ｐ  ４５０に接続される 
第２の給電入力Ｐ２  ４１８はまた、電界効果トランジスタ  ＦＥＴ２  ４１４のドレイン（Ｄ）に接続され、ＦＥＴ２  ４１４のソース（Ｓ）は内部電源系への給電出力Ｐ  ４５０に接続される。
ＦＥＴ２ ４１４のゲート（Ｇ）はさらに、第２の給電入力Ｐ２  ４１８以外の全ての給電入力Ｐ１  ４０８〜Ｐｎ  ４２８から、それぞれダイオードＤ12、・・・、Ｄn2を介して接続され、更に抵抗Ｒ２  ４１６を介してグラウンド（接地電位）にも接続される。各ダイオードＤ12、・・・、Ｄn2は、カソード（陰極）側がＦＥＴ２  ４１４のゲート（Ｇ）に接続される。
【００２５】
このようにして、各給電入力について同様の回路構成をとっていき、第ｎの給電入力Ｐｎ  ４２８は、ダイオード  Ｄｎ  ４２２のアノード（陽極）に接続され、Ｄｎ  ４２２のカソード（陰極）は内部電源系への給電出力Ｐ  ４５０に接続される。
第ｎの給電入力Ｐｎ  ４２８はまた、電界効果トランジスタ ＦＥＴｎ  ４２４のドレイン（Ｄ）に接続され、ＦＥＴｎ  ４２４のソース（Ｓ）は内部電源系への給電出力Ｐ  ４５０に接続される。
ＦＥＴｎ  ４２４のゲート（Ｇ）はさらに、第ｎの給電入力Ｐｎ  ４２８以外の全ての給電入力Ｐ１  ４０８、Ｐ２  ４１８、・・・から、それぞれダイオードＤ1n、Ｄ2n、・・・を介して接続され、更に抵抗Ｒｎ  ４２６を介してグラウンド（接地電位）にも接続される。各ダイオードＤ1n、Ｄ2n、・・・は、カソード（陰極）側がＦＥＴｎ  ４２４のゲート（Ｇ）に接続される。
【００２６】
次に、図４に示す第２の実施形態に係る給電切替回路４６０の動作について説明する。
第１の給電入力Ｐ１  ４０８に給電がされ、その他の給電入力Ｐ２  ４１８〜Ｐｎ  ４２８には給電がされない場合は、ダイオードＤ１  ４０２を通して給電出力Ｐ  ４５０に＋５Ｖ電圧が供給される。そうすると、ＦＥＴ１  ４０４のゲート（Ｇ）には給電入力Ｐ２  ４１８〜Ｐｎ  ４２８がそれぞれダイオードを経由してＯｒ接続されているため当該ゲート（Ｇ）の電位は０となり、ソース（Ｓ）とゲート（Ｇ）との間に電位差が発生してＦＥＴ１  ４０４がＯｎとなる。ＦＥＴ１がＯｎになった後は、ＦＥＴ１を通して第１の給電入力Ｐ１  ４０８から給電出力Ｐ  ４５０に＋５Ｖ電圧が供給される。この際、給電出力Ｐ  ４５０における＋５Ｖ電圧の電圧降下は、ＦＥＴ１のＯｎ抵抗（約１８ｍΩ）で発生する電圧分のみであり、ダイオードＤ１  ４０２の比較的大きい順方向電圧（例えば、最大０．４Ｖ）による電圧降下と比べてはるかに小さい。
【００２７】
同様に、給電入力Ｐ２  ４１８〜Ｐｎ  ４２８の何れか１つに給電がされ、その他の給電入力には給電がされない場合も、同様の動作原理により、その給電入力に接続されたＦＥＴがＯｎとなる。当該ＦＥＴがＯｎになった後は、Ｏｎ抵抗が小さい（約１８ｍΩ）そのＦＥＴを通して給電出力Ｐ  ４５０に＋５Ｖ電圧が供給されるので、順方向電圧が比較的大きい（例えば、最大０．４Ｖ）ダイオードを通しての給電と比べて電圧降下がはるかに小さい。
【００２８】
第１の給電入力Ｐ１  ４０８へ給電がされ、それに加えて、その他の給電入力Ｐ２  ４１８〜Ｐｎ  ４２８のうちの少なくとも１つ（例えば第ｎの給電入力Ｐｎ  ４２８）に給電がされる場合は、ＦＥＴ１  ４０４のゲート（Ｇ）には、第ｎの給電入力Ｐｎ  ４２８からダイオードＤn1を介して＋５Ｖ電圧が供給されるので、ＦＥＴ１  ４０４はＯｆｆとなる。 また、ＦＥＴ２  ４１４〜ＦＥＴｎ ４２４の各々のゲート（Ｇ）には、第１の給電入力Ｐ１  ４０８からそれぞれ対応するダイオードＤ12、・・・、Ｄ1nを介して＋５Ｖ電圧が供給されるので、ＦＥＴ２  ４１４〜ＦＥＴｎ  ４２４も全てＯｆｆとなる。すなわち、ＦＥＴ１  ４０４〜ＦＥＴｎ  ４２４の全てがＯｆｆとなる。
この場合、第１の給電入力Ｐ１  ４０８および第ｎの給電入力Ｐｎ  ４２８から、それぞれ、ダイオードＤ１  ４０２およびダイオードＤｎ  ４２２を通して給電出力Ｐ  ４５０に電圧が供給されようとするが、ダイオードによる電圧降下を経た後の電圧が高いほうの給電入力からの給電が選択される。
したがって、ダイオードＤ１  ４０２の順方向電圧を、他のダイオードＤ２  ４１２〜Ｄｎ  ４２２の順方向電圧より幾分小さなものにした場合には、結局は、第１の給電入力Ｐ１  ４０８からダイオードＤ１  ４０２を通して給電出力Ｐ  ４５０に給電される。
第１の給電入力Ｐ１  ４０８を主たる給電系統としたい場合は、この方法で、第１の給電入力Ｐ１  ４０８を含む複数の給電入力からの給電が有効な場合に、常に第１の給電入力Ｐ１  ４０８からの給電を選択することができる。
【００２９】
以上、実施形態を用いて本発明を説明したが、本発明の技術的範囲は上記実施形態に記載の範囲には限定されないことは言うまでもない。上記実施形態に、多様な変更または改良を加えることが可能であることが当業者に明らかである。またその様な変更または改良を加えた形態も本発明の技術的範囲に含まれ得ることが、特許請求の範囲の記載から明らかである。
【符号の説明】
【００３０】
１０２．．．クライアント（クライアント・コンピュータ、クライアント・システム）
１０４．．．クライアント（クライアント・コンピュータ、クライアント・システム）
１０６．．．中央監視サーバ（サーバ・コンピュータ、サーバ・システム）
１１０．．．データ蓄積装置
１１２．．．データ蓄積装置
１２０．．．現場機器
１２２．．．現場機器
１２４．．．現場機器
１２６．．．現場機器
１３０．．．設備
１３２．．．設備
１４０．．．プロセス監視現場
２００．．．給電切替回路
２０２．．．ＡＣアダプターからのＤＣ＋５Ｖ入力
２０４．．．ＰｏＥからのＤＣ±４８Ｖ入力
２０６．．．電源フィルタ
２０４．．．ＤＣ−ＤＣコンバータ
２１０．．．ＤＣ−ＤＣコンバータ
２１２．．．スイッチング・レギュレータ
２１４．．．シリーズ・レギュレータ
２１６．．．シリーズ・レギュレータ
３０２．．．ダイオード
３０４．．．ＦＥＴ（電界効果トランジスタ）
３０６．．．抵抗
３０８．．．給電入力
３１２．．．ダイオード
３１４．．．ＦＥＴ（電界効果トランジスタ）
３１６．．．抵抗
３１８．．．給電入力
３２０．．．給電出力
４０２．．．ダイオード
４０４．．．ＦＥＴ（電界効果トランジスタ）
４０６．．．抵抗
４０８．．．給電入力
４１２．．．ダイオード
４１４．．．ＦＥＴ（電界効果トランジスタ）
４１６．．．抵抗
４１８．．．給電入力
４２２．．．ダイオード
４２４．．．ＦＥＴ（電界効果トランジスタ）
４２６．．．抵抗
４２８．．．給電入力
４５０．．．給電出力
４６０．．．給電切替回路
【図１】
2010233424.tif 000003
【図２】
2010233424.tif 000004
【図３】
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【図４】
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