(57)【要約】【課題】基板に電子部品を表面実装する際に、接続部でのインピーダンス不整合による反射を低減し、信号品質を良好に保つことができるようにする。【解決手段】この接続方式で接続された基板１と表面実装部品２の接続部は、図４に示されるように、線路形状のまま引き出される形で構成される。この接続方式の特徴は、表面実装部品２の誘電体端２Ａを斜めに形成することで、その斜面に沿って誘電体上に配線された金属の伝送線路を徐々に基板１に近づけながら、基板１と表面実装部品２を接続することにある。マイクロストリップラインのライン幅は、その電気的特性と幾何学的形状から求まる特性インピーダンスにより調整される。図４の例においては、基板１に近づくほど、ライン幅が狭くなっている。本発明は、基板に電子部品の表面実装する際に適用することができる。【選択図】図４
2010021505.tif 000002
【特許請求の範囲】
【請求項１】
信号が流れる高さの異なる２点間を、各位置の幅がその位置における誘電体の厚さに応じて調整された、誘電体上の線路によって接続する
接続方法。
【請求項２】
高い方の１点は基板に実装される電子部品の線路上の１点であり、低い方の１点は前記基板の線路上の１点である
請求項１に記載の接続方法。
【請求項３】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる面を形成し、前記高さの異なる２点間を、前記面に沿って配設した線路によって接続する
請求項２に記載の接続方法。
【請求項４】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる段を形成し、前記高さの異なる２点間を、前記段に沿って配設した線路によって接続する
請求項２に記載の接続方法。
【請求項５】
信号が流れる高さの異なる２点間が、各位置の幅がその位置における誘電体の厚さに応じて調整された、誘電体上の線路によって接続された
基板。
【請求項６】
高い方の１点は前記基板に実装される電子部品の線路上の１点であり、低い方の１点は前記基板の線路上の１点である
請求項５に記載の基板。
【請求項７】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる面を形成し、前記高さの異なる２点間を、前記面に沿って配設した線路によって接続する
請求項６に記載の基板。
【請求項８】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる段を形成し、前記高さの異なる２点間を、前記段に沿って配設した線路によって接続する
請求項６に記載の基板。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、接続方法、基板に関し、例えば基板に電子部品を実装する際に、接続部でのインピーダンス不整合による反射を低減し、信号品質を良好に保つことができるようにした接続方法、基板に関する。
【背景技術】
【０００２】
部品間や基板間の接続構造は大きく次の２種類に分けられる。同軸ケーブルのような完全遮蔽の構造と、基板上の配線のような、信号線間に誘導容量が存在するオープン構造である。
【０００３】
後者のオープン構造は、クロストークや電磁障害の点で同軸構造に劣るものの、一般のプリント配線基板を見てもわかるように、設計・製造・検査・接続性といった工業的コストに優れた現実的な構造である。
【０００４】
しかし、オープン構造の線路形状では、高速な信号を扱う際に伝送信号の劣化が大きな問題となる。特に、図１に示されるような、基板上に表面実装される電子部品と基板の接続部では、インピーダンス不整合による反射波の影響により、伝送信号が減衰・劣化しやすい。
【０００５】
配線をマイクロストリップ等の線路構造にすることでインピーダンスを調整し、高速信号に対応することは可能である。しかし、高さの異なる層間・基板間・部品間の実装の際には、図２に示されるように部品側から端子部分を足のように出したり、図３に示されるようにはんだボールからビアを通したりして、基板上の配線と接続する必要がある。従って、図１に示されるような、部品と基板の接続部では、インピーダンスの調整が可能な線路構造を保てず、信号品質の劣化が避けられなくなっている。
【０００６】
接続部でのインピーダンスの調整方法として、特許文献１に開示されているような方法がある。
【特許文献１】特開２０００−２１６５１０号公報
【発明の開示】
【発明が解決しようとする課題】
【０００７】
引用文献１に開示されている方法では、基板と接続されるコネクタのインダクタンス要因により伝送信号に発生する波形歪みを低減することができるが、そのために同軸状のスルーホールを接続部周辺に形成する必要があった。
【０００８】
従って、例えば基板端面ではこの方法が使えないといった配置上の問題や、高密度配線時におけるスペースの問題などが発生しやすく、配線の高密度化・部品の小型化といった近年の技術傾向に対応しにくかった。
【０００９】
本発明はこのような状況に鑑みてなされたものであり、例えばRF(Radio Frequency)信号などの高速な信号を扱う基板に電子部品を実装する際に、接続部でのインピーダンス不整合による反射を低減し、信号品質を良好に保つことができるようにするものである。
【課題を解決するための手段】
【００１０】
本発明の一側面の接続方法は、信号が流れる高さの異なる２点間を、各位置の幅がその位置における誘電体の厚さに応じて調整された、誘電体上の線路によって接続するものである。
【００１１】
高い方の１点は基板に実装される電子部品の線路上の１点であり、低い方の１点は前記基板の線路上の１点であるようにすることができる。
【００１２】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる面を形成し、前記高さの異なる２点間を、前記面に沿って配設した線路によって接続することができる。
【００１３】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる段を形成し、前記高さの異なる２点間を、前記段に沿って配設した線路によって接続することができる。
【００１４】
本発明の他の側面の基板は、信号が流れる高さの異なる２点間が、各位置の幅がその位置における誘電体の厚さに応じて調整された、誘電体上の線路によって接続されたものである。
【００１５】
高い方の１点は前記基板に実装される電子部品の線路上の１点であり、低い方の１点は前記基板の線路上の１点であるようにすることができる。
【００１６】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる面を形成し、前記高さの異なる２点間を、前記面に沿って配設した線路によって接続することができる。
【００１７】
誘電体によって構成される前記電子部品の端部に、前記基板の線路との接続部に近づくにつれて誘電体の厚さが薄くなる段を形成し、前記高さの異なる２点間を、前記段に沿って配設した線路によって接続することができる。
【００１８】
本発明においては、信号が流れる高さの異なる２点間が、各位置の幅がその位置における誘電体の厚さに応じて調整された、誘電体上の線路によって接続される。
【発明の効果】
【００１９】
本発明によれば、例えば基板に電子部品を実装する際に、接続部でのインピーダンス不整合による反射を低減し、信号品質を良好に保つことができる。
【発明を実施するための最良の形態】
【００２０】
図４は、本発明の一実施形態に係る接続方式により接続された基板１と表面実装部品２を含む構成の例を示す斜視図である。図５は、図４に示される構成の断面図であり、図６は、図４に示される構成を真上から見た正面図である。
【００２１】
一般的に、プリント配線基板上に部品を実装するためには、デバイスに金属の足をつけて電気的に接続する方法などがとられるが（図１、図２参照）、この接続方式で接続された基板１と表面実装部品２の接続部は、図４において点線で囲んで示すように、表面実装部品２の上面（基板１の面と平行な面）から線路形状のまま引き出された末端と、基板１上に配設された線路１Ａが接続される形で構成される。
【００２２】
この接続方式の特徴は、図５の点線で囲んで示すように、表面実装部品２の誘電体端２Ａを斜めに形成することで、その斜面に沿って誘電体上に配線された金属の伝送線路を徐々に基板１に近づけながら、基板１と表面実装部品２を接続することにある。この例においては、垂直方向の断面が台形になるような形状を表面実装部品２は有している。
【００２３】
このとき、表面実装部品２側のマイクロストリップラインのライン幅は、その電気的特性と幾何学的形状から求まる特性インピーダンスにより調整される。図４、図６に示されるように、この例においては、基板１に近づくほど、すなわち、基板１の高さを基準としたときの高さが低く、表面実装部品２の斜面の誘電体の厚さが薄い位置ほど、ライン幅が狭くなっている。図４、図６の例においては、誘電体端２Ａ上に配設された線路の、基板１上の線路１Ａとの接続部における幅は、線路１Ａの幅と同じ幅になっている。
【００２４】
このように、ライン幅と誘電体厚を徐々に変化させることで、接続部の特性インピーダンスを調整しながら、基板１と表面実装部品２を接続することができ、その接続部での特性インピーダンスの不連続変化を無くし、反射成分を低減することができる。この、接続部での特性インピーダンスの不連続変化を無くし、反射成分を低減することができることのイメージを図７に示す。図７の上段にある特性インピーダンスの不整合のイメージを示す図において、その凹部は、電子部品と基板を接続する図１、図２、図３に示される端子の、電子部品にも基板にも接していない部分（中空に浮いている部分）の特性インピーダンスを表す。
【００２５】
なお、マイクロストリップラインにおける特性インピーダンスは、図１０Ａ、Ｂに示されるように導体材料の幅（ライン幅）をＷ、誘電体厚をｄとすると下式（１Ａ）、（１Ｂ）、（２Ａ）、（２Ｂ）により求まることが一般に知られている。
【数１】
2010021505.tif 000003
【数２】
2010021505.tif 000004
【００２６】
マイクロストリップライン構造を採用した場合の特性インピーダンスの計算結果を図１１に示す。
【００２７】
その他、図１２に示されるような代表的な線路形状についても、線路の電気特性値と断面形状から特性インピーダンスを求めるための一般式が存在する。図１２には、基板と電子部品の接続部を構成する線路として、ストリップライン、マイクロストリップライン、ストリップライン、コープレーナーライン、平行線が示されている。
【００２８】
図８は、基板１と表面実装部品２の接続部を構成する線路としてコープレーナーラインを用いた場合の例を示す図である。このように、接続部を構成する線路としてコープレーナーラインを用いることもできる。図９Ａは、図８において点線で囲む部分の断面図であり、図９Ｂは図８の電子部品の上面の正面図である。図８の例においては、斜面上に配設された線路は、基板の線路との接続部に近づくにつれて幅が広くなるように形成されている。
【００２９】
基板１の構成材料としては、一般の基板材料が使用される。導体部には金属導体、例えば銅などが用いられる。誘電体部には、例えばフェノール・ガラスエポキシ樹脂・アルミナ・テフロン（登録商標）などが用いられる。
【００３０】
以上のような接続方式は、アンテナやLSIなど、基板上に表面実装する電子部品全般を基板上に接続する場合に応用できる。以下、適宜、以上のように、表面実装部品２を構成する誘電体の側面の少なくとも一部を斜面として形成し、その斜面に沿って導体を配線することで電子部品と基板上の配線を接続させる接続方式を単に本接続方式という。
【００３１】
本接続方式により、RF(Radio Frequency)信号などの高速な信号を扱う基板にアンテナやフィルタ回路などの電子部品を表面実装する際に、接続部でのインピーダンスの不整合による反射を低減し、信号品質を良好に保つことが可能になる。なお、ここでの高速な信号とは、伝送信号の最大周波数の波長の1/10を越えるような接続長、もしくは配線長を持つ場合の信号を指す。
【００３２】
変形例
図１２を参照して説明したように、接続線路の構造は、分布定数回路として扱うことができ、インピーダンスの調整ができるものであれば、マイクロストリップライン、ストリップライン、コープレーナーライン、平行線などでも良い。
【００３３】
また、電気的に連続変化するようなものであれば、接続部の線路幅の物理的な形状は非連続なものであってかまわない。接続部の線路幅を決める際、伝送周波数の波長に対する線路長でのインピーダンス変化率が目安となる。
【００３４】
接続部の構成は、図４のように表面実装部品２の側面を構成する誘電体端２Ａ全体を斜めに構成しないでも、図１３に示されるように側面の一部を斜めにするようにして構成し、その斜面上に、幅を調整した線路を配線するようにしても良いし、図１４に示されるようにスルーホールを端面に斜めに空け、その内側に、幅を調整した線路を配線するようにしても良い。
【００３５】
本接続方式により接続できる表面実装部品２としては、アンテナ回路の他、図１５Ａ乃至Ｄに示されるような、フィルタ回路、共振回路、ミキサ回路、スプリッタ回路等のさまざまな部品を用いることができる。
【００３６】
また、本接続方式は、プリント配線基板と表面実装部品の接続だけでなく、部品同士の配線、基板同士の配線、部品内部の配線、多層基板の配線、半導体配線などにも応用が可能である。例えば、多層基板内や部品内の配線、半導体パッケージ内の配線接続にも、効果があると考えられる。
【００３７】
本接続方式を採用することにより、
１．配線間のインピーダンス不整合による信号劣化を改善できる。特にRF回路などの高速な信号を扱う基板と部品の間での接続などに有効である。
２．マイクロストリップラインやコープレーナーラインなどの単純な線路構造で実現でき、余分な回路・コネクタ等を必要としない。
３．フィルタやアンテナなどの表面実装部品だけでなく、信号線間に誘導容量が存在するような部品全般（多層基板内配線、半導体パッケージなど）に応用できる。
【００３８】
補足説明
上記１．を補足するため、伝送信号の劣化を電磁界シミュレーションにより解析した結果について説明する。
【００３９】
単純なマイクロストリップラインモデルを図１６、図１７に示す。図１６は、モデルを三次元的に示す図である。図１７Ａは、図１６のモデルの正面図であり、図１７Ｂは、図１６のモデルの断面図である。
【００４０】
このモデルは信号線路・誘電体基板・GNDで構成される（GND層と誘電体層からなる基板上に信号線路が配設されることによって構成される）。伝送信号の劣化をシミュレーションするため、テスト信号を入力ポートから入力し、伝送された信号を出力ポートで観測する。評価には、S-parameterをdB（デシベル）表記した値が一般に用いられるため、ここでは、次の式（３）で表現されるS-parameterをＳ２１として用いる。
Ｓ２１＝log10（出力信号／入力信号）[dB]      ・・・      （３）
【００４１】
伝送シミュレーション結果を図１８に示す。図１８の横軸は周波数[GHz]、縦軸はＳ２１[dB]を示すが、周波数が上がるにつれＳ２１はわずかに低下する。線路モデルの材料は均質で、かつ断面形状が一定のため、劣化の原因は主に基板内を伝送する信号の誘電損失によると考えられる。よって、インピーダンス整合がされた理想に近い状態であるこのモデルにおいて、伝送劣化はおよそ約−１ｄＢ＠１０ＧＨｚといえる。
【００４２】
次に、一般の接続方式と、本接続方式を用いたシミュレーション結果について説明する。
【００４３】
図１９は、高さの異なる基板間を本接続方式で接続したモデルを示す。図２０、図２１は、それぞれ、高さの異なる基板間をスルーホール、ワイヤボンディングを使って接続したモデルを示す。
【００４４】
図２２、図２３は、図１９、図２０、図２１に示されるモデルの条件を示す図である。
【００４５】
図１９、図２０、図２１に示されるモデルは、図２２において点線で囲んで示す、基板Ａの信号線路Ａ上の位置Ｐ1と、基板Ａ（誘電体Ａ）に重ねて配置された基板Ｂの信号線路Ｂ上の位置Ｐ2の間を、それぞれ、本接続方式、スルーホール、ワイヤボンディングで接続したものである。
【００４６】
GND面Ａに誘電体Ａが積層され、誘電体Ａ上の入力側に信号線路Ａが配設されることによって構成される基板Ａと、GND面Ｂに誘電体Ｂが積層され、誘電体Ｂ上に信号線路Ｂが配設されることによって構成される基板Ｂの諸条件を図２３に示す。
【００４７】
図２３の条件においては、信号線路ＡとＢの線路幅が3.2mm、高さが0.2mmとされ、信号線路ＡとＢの線路長の合計が30mmとされている。誘電体ＡとＢの高さが1.6ｍｍ、誘電率が7.1×10-12［F/m］、10GHzの信号を流したときの誘電損失が0.005とされている。
【００４８】
図２３に示されるような条件下で行った、各接続方式によるシミュレーション結果を図２４に示す。図２４の横軸は周波数[GHz]、縦軸はＳ２１[dB]を示す。また３GHz、６GHz、１０GHzの各周波数におけるＳ２１[dB]の値を図２５に示す。
【００４９】
図２４、図２５に示される結果から、本接続方式の伝送信号の劣化は、３つのモデルの中で最も小さいことが分かる。また、本接続方式を用いたモデルのシミュレーション結果は、図１８に示される理想的なモデルのシミュレーション結果に最も近いものになっている。特に高周波数になるにつれ、本接続方式と他の方式で特性の差が現われていることがわかる。これらの結果から、本接続方式を用いることで、信号劣化改善に効果があると考えられる。
【００５０】
電子部品側の線路と基板側の線路の接続例
次に、基板側の線路との接続部付近の電子部品側の線路の形状について説明する。
【００５１】
図２６Ａは第１の形状を示す正面図であり、図２６Ｂは、図２６Ａに示される構成の断面図である。
【００５２】
図２６Ａ、図２６Ｂに示される第１の形状は、図４乃至図６を参照して説明したものと同じ形状である。すなわち、図２６Ｂに示されるように、電子部品の端部に斜面が形成され、この斜面に沿って、電子部品側の線路の一部である線路２１Ｂが配設されている。線路２１Ｂの各位置における電子部品側の誘電体２２の厚さは、基板側の線路１１との接続部に近づくにつれて直線的に薄くなる。
【００５３】
線路２１Ｂを真上から見たときの形状は、図２６Ａに示されるように、線路２１Ｂの長さ方向の軸を中心として対称に、各位置における誘電体２２の厚さに応じて、幅Ｗ2から幅Ｗ1の間で幅が直線的に変化するような形状とされている。幅Ｗ1は電子部品側の誘電体２２の上面に配設された線路２１Ａの幅であり、幅Ｗ2は基板側の誘電体１２に配設された線路１１Ａの幅である。
【００５４】
図２７Ａは第２の形状を示す正面図であり、図２７Ｂは、図２７Ａに示される構成の断面図である。
【００５５】
この形状の例においては、図２７Ｂに示されるように、電子部品の端部には段が５段形成され、この段に沿って、電子部品側の線路の一部である線路２１Ｂが配設されている。線路２１Ｂの各位置における電子部品側の誘電体２２の厚さは、基板側の線路１１との接続部に近づき、基板からの段数が少なくなるにつれて段階的に薄くなる。
【００５６】
線路２１Ｂを真上から見たときの形状は、図２７Ａに示されるように、線路２１Ｂの長さ方向の軸を中心として対称に、各位置における誘電体２２の厚さに応じて、幅Ｗ2から幅Ｗ1の間で幅が段階的に変化するような形状とされている。
【００５７】
図２８Ａは第３の形状を示す正面図であり、図２８Ｂは、図２８Ａに示される構成の断面図である。
【００５８】
この形状の例においては、図２８Ｂに示されるように、電子部品の端部に断面がほぼ扇形の曲面が形成され、この曲面に沿って、電子部品側の線路の一部である線路２１Ｂが配設されている。線路２１Ｂの各位置における電子部品側の誘電体２２の厚さは、基板側の線路１１との接続部に近づくにつれて薄くなる。
【００５９】
線路２１Ｂを真上から見たときの形状は、図２８Ａに示されるように、線路２１Ｂの長さ方向の軸を中心として対称に、幅Ｗ2から幅Ｗ1の間で幅が所定の割合で変化するような形状とされている。
【００６０】
図２９Ａは第４の形状を示す正面図であり、図２９Ｂは、図２９Ａに示される構成の断面図である。
【００６１】
図２９Ａに示される形状は、図２６Ａを参照して説明した形状と同じ形状である。線路２１Ｂの形状は、線路２１Ｂの長さ方向の軸を中心として対称に、各位置における誘電体２２の厚さに応じて、幅Ｗ2から幅Ｗ1の間で幅が直線的に変化するような形状とされている。
【００６２】
図２９Ｂに示される形状は、図２７Ｂを参照して説明した形状と同じ形状である。電子部品の端部には段が５段形成され、この段に沿って、電子部品側の線路の一部である線路２１Ｂが配設されている。線路２１Ｂの各位置における電子部品側の誘電体２２の厚さは、基板側の線路１１との接続部に近づき、基板からの段数が少なくなるにつれて段階的に薄くなる。
【００６３】
図３０Ａは第５の形状を示す正面図であり、図３０Ｂは、図３０Ａに示される構成の断面図である。
【００６４】
図３０Ａに示される形状は、図２７Ａを参照して説明した形状と同じ形状である。線路２１Ｂの形状は、線路２１Ｂの長さ方向の軸を中心として対称に、各位置における誘電体２２の厚さに応じて、幅Ｗ2から幅Ｗ1の間で幅が段階的に変化するような形状とされている。
【００６５】
図３０Ｂに示される形状は、図２６Ｂを参照して説明した形状と同じ形状である。電子部品の端部には斜面が形成され、この斜面に沿って、電子部品側の線路の一部である線路２１Ｂが配設されている。線路２１Ｂの各位置における電子部品側の誘電体２２の厚さは、基板側の線路１１との接続部に近づくにつれて直線的に薄くなる。
【００６６】
応用例
以上においては、電子部品の誘電体層が１層である場合について説明したが、誘電体層が多層である場合であっても、同様にして電子部品上の線路と基板上の線路とを接続させることが可能である。
【００６７】
図３１は、電子部品の誘電体層が２層である場合の接続の例を示す斜視図である。図２６等に示される構成と同じ構成には同じ符号を付してある。
【００６８】
図３１の例においては、電子部品を構成する誘電体層として誘電体２２Ａ，２２Ｂが重ねて用いられている。上側の層である誘電体２２Ｂの上面に線路２１Ａが配設され、斜面に線路２１Ｂが配設されている。誘電体２２Ａ，２２Ｂの間にはGND面３１が挟まれている。
【００６９】
また、図３１の例においては、誘電体２２Ｂの斜面に配設された線路２１Ｂの幅が一定の幅とされている。GND面３１を設け、線路２１Ｂが配設されている斜面における誘電体２２Ｂの厚さを調整することで、このように、線路２１Ｂの幅を一定にすることが可能になる。
【００７０】
図３２は、図３１に示される構成の断面図である。
【００７１】
図３２に示されるように、誘電体２２Ａの斜面は、基板面に対して誘電体２２Ｂの斜面と同じ角度を有している。誘電体２２Ａの上面と斜面の境界の真上にあたる位置Ｐ11から、誘電体２２Ａの斜面と基板の境界の真上にあたる位置Ｐ12まで、線路２１Ｂの各位置における誘電体２２Ｂの厚さが一定になるようにGND面３１によって調整されている。位置Ｐ12から基板との接続部に向かうにつれて、誘電体層の厚さは徐々に薄くなる。
【００７２】
このように、線路が配設される誘電体層の数を複数とすることも可能である。また、電子部品上の線路と、その電子部品が取り付けられる基板上の線路を接続する場合だけでなく、基板上の線路と他の基板上の線路を接続する場合など、高さの異なる２点間を接続するものであれば様々なケースに本接続方式は適用可能である。
【００７３】
図３３は、本接続方式を半導体パッケージの接続に用いた場合の例を示す斜視図である。
【００７４】
図３３の例においては、基板５１上に半導体パッケージ６１が取り付けられ、その上に、LSI(Large Scale Integration)などのチップ部品６２が実装されている。半導体パッケージ６１とチップ部品６２は、いずれも垂直方向の断面が台形になるような形状を有している。チップ部品６２の上面には複数の電極６２Ａが露出して設けられている。
【００７５】
電極６２Ａからチップ部品６２の上面に配設される線路と、半導体パッケージ６１の上面の線路の間の配線６３、および、半導体パッケージ６１の上面の線路と基板上の線路の間の配線６４にも、上述したような本接続方式による配線を適用することが可能である。
【００７６】
本発明の実施の形態は、上述した実施の形態に限定されるものではなく、本発明の要旨を逸脱しない範囲において種々の変更が可能である。
【図面の簡単な説明】
【００７７】
【図１】電子部品と基板の従来の接続方式を示す図である。
【図２】従来の表面実装部品の構造を示す図である。
【図３】従来の他の表面実装部品の構造を示す図である。
【図４】本発明の一実施形態に係る接続方式により接続された基板と表面実装部品を含む構成の例を示す図である。
【図５】図４に示される構成の断面図である。
【図６】図４に示される構成を真上から見た図である。
【図７】インピーダンスの不連続変化を無くすことのできるイメージを示す図である。
【図８】接続部を構成する線路としてコープレーナーラインを用いた場合の例を示す図である。
【図９】図８の点線部分を示す図である。
【図１０】マイクロストリップラインを示す図である。
【図１１】マイクロストリップライン構造を採用した場合の特性インピーダンスの計算結果を示す図である。
【図１２】基板と電子部品の接続部を構成する線路の例を示す図である。
【図１３】接続部の他の構成例を示す図である。
【図１４】接続部のさらに他の構成例を示す図である。
【図１５】表面実装部品の例を示す図である。
【図１６】マイクロストリップラインモデルを示す図である。
【図１７】図１６のモデルの正面図と断面図である。
【図１８】伝送シミュレーション結果を示す図である。
【図１９】高さの異なる基板間を本接続方式で接続したモデルを示す図である。
【図２０】高さの異なる基板間をスルーホールを使って接続したモデルを示す図である。
【図２１】高さの異なる基板間をワイヤボンディングを使って接続したモデルを示す図である。
【図２２】モデルの条件を示す図である。
【図２３】モデルの条件を示す他の図である。
【図２４】シミュレーション結果を示す図である。
【図２５】３GHz、６GHz、１０GHzの各周波数におけるＳ２１成分を示す図である。
【図２６】電子部品側の線路の形状の例を示す図である。
【図２７】電子部品側の線路の形状の他の例を示す図である。
【図２８】電子部品側の線路の形状のさらに他の例を示す図である。
【図２９】電子部品側の線路の形状の例を示す図である。
【図３０】電子部品側の線路の形状の他の例を示す図である。
【図３１】電子部品の誘電体層が２層である場合の接続の例を示す斜視図である。
【図３２】図３１に示される構成の断面図である。
【図３３】本接続方式を半導体パッケージの接続に用いた場合の例を示す斜視図である。
【符号の説明】
【００７８】
１  基板，  ２  表面実装部品
【図１】
2010021505.tif 000005
【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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【図１５】
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【図１６】
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【図１７】
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【図１８】
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【図１９】
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【図２０】
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【図２１】
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【図２２】
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【図２３】
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【図２４】
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【図２５】
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【図２６】
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【図２７】
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【図２８】
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【図２９】
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【図３０】
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【図３１】
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【図３２】
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【図３３】
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