(57)【要約】【課題】並列データの有効／無効を示す参照用データに基づいて生成されるゲーティッドクロックにより、受信側で並列データが正確に受信されると共に消費電力が低減される同期伝送路を提供する。【解決手段】参照用データ先行伝送手段（たとえば、ＣＧクロックドライバ２１及びフリップフロップ２２1 ，２２2 ，２２3 ，２２4 ）は、フリップフロップ１２に取り込まれる参照用データＶを、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”よりも所定時間先行させて伝送する。この場合、参照用データ先行伝送手段は、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”を、フリップフロップ１２に取り込まれる参照用データＶよりも所定時間遅延させて伝送する。【選択図】図１
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【特許請求の範囲】
【請求項１】
所定ビット数の並列データの有効／無効を示す参照用データをクロックに同期して取り込んで保持する第１のフリップフロップと、
該第１のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第１のゲーティッドクロックとして出力する第１のクロックドライバと、
前記並列データを前記第１のゲーティッドクロックに同期して取り込んで保持する第２のフリップフロップと、
前記第１のフリップフロップに保持されている前記参照用データを前記クロックに同期して取り込んで保持する第３のフリップフロップと、
該第３のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第２のゲーティッドクロックとして出力する第２のクロックドライバと、
前記第２のフリップフロップに保持されている前記並列データを前記第２のゲーティッドクロックに同期して取り込んで保持する第４のフリップフロップとを有し、かつ、
前記第１のフリップフロップに取り込まれる前記参照用データを、前記第２のフリップフロップに取り込まれる前記並列データよりも所定時間先行させて伝送する参照用データ先行伝送手段が設けられていることを特徴とする同期伝送路。
【請求項２】
前記参照用データ先行伝送手段は、
前記第２のフリップフロップに取り込まれる前記並列データを、前記第１のフリップフロップに取り込まれる前記参照用データよりも所定時間遅延させて伝送する構成とされていることを特徴とする請求項１記載の同期伝送路。
【請求項３】
前記参照用データ先行伝送手段は、
前記参照用データが前記並列データの有効を示すとき、前記クロックを第３のゲーティッドクロックとして出力する第３のクロックドライバと、
前記並列データを前記第３のゲーティッドクロックに同期して取り込んで保持する第５のフリップフロップとから構成されていることを特徴とする請求項１又は２記載の同期伝送路。
【請求項４】
前記参照用データ先行伝送手段の前記第３のクロックドライバは、
前記参照用データが前記並列データの有効を示すとき、前記クロックを所定時間遅延させて前記第３のゲーティッドクロックを出力する構成とされていることを特徴とする請求項３記載の同期伝送路。
【請求項５】
前記参照用データ先行伝送手段は、
前記第１のフリップフロップに取り込まれる前記参照用データと、前記第２のフリップフロップに取り込まれる前記並列データとのタイミングが競合するとき、該参照用データを該並列データよりも先行させて伝送する競合調停回路で構成されていることを特徴とする請求項１記載の同期伝送路。
【請求項６】
所定ビット数の並列データの有効／無効を示す参照用データをクロックに同期して取り込んで保持する第１のフリップフロップと、
該第１のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第１のゲーティッドクロックとして出力する第１のクロックドライバと、
前記並列データを前記第１のゲーティッドクロックに同期して取り込んで保持する第２のフリップフロップと、
前記第１のフリップフロップに保持されている前記参照用データを前記クロックに同期して取り込んで保持する第３のフリップフロップと、
該第３のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第２のゲーティッドクロックとして出力する第２のクロックドライバと、
前記第２のフリップフロップに保持されている前記並列データを前記第２のゲーティッドクロックに同期して取り込んで保持する第４のフリップフロップとを有する同期伝送路に用いられるデータ伝送方法であって、
参照用データ先行伝送手段を設けておき、
該参照用データ先行伝送手段が、前記第１のフリップフロップに取り込まれる前記参照用データを、前記第２のフリップフロップに取り込まれる前記並列データよりも所定時間先行させて伝送することを特徴とするデータ伝送方法。
【請求項７】
前記参照用データ先行伝送手段が、前記第２のフリップフロップに取り込まれる前記並列データを、前記第１のフリップフロップに取り込まれる前記参照用データよりも所定時間遅延させて伝送することを特徴とする請求項６記載のデータ伝送方法。
【請求項８】
前記参照用データ先行伝送手段を、第３のクロックドライバと第５のフリップフロップとから構成しておき、
前記参照用データが前記並列データの有効を示すとき、前記第３のクロックドライバが、前記クロックを第３のゲーティッドクロックとして出力し、前記第５のフリップフロップが、前記並列データを前記第３のゲーティッドクロックに同期して取り込んで保持することを特徴とする請求項６又は７記載のデータ伝送方法。
【請求項９】
前記参照用データ先行伝送手段の前記第３のクロックドライバが、前記参照用データが前記並列データの有効を示すとき、前記クロックを所定時間遅延させて前記第３のゲーティッドクロックを出力することを特徴とする請求項８記載のデータ伝送方法。
【請求項１０】
前記参照用データ先行伝送手段を競合調停回路で構成しておき、
前記第１のフリップフロップに取り込まれる前記参照用データと、前記第２のフリップフロップに取り込まれる前記並列データとのタイミングが競合するとき、該競合調停回路が、該参照用データを該並列データよりも先行させて伝送する
ことを特徴とする請求項６記載のデータ伝送方法。
【発明の詳細な説明】
【技術分野】
【０００１】
この発明は、同期伝送路及び該同期伝送路に用いられるデータ伝送方法に係り、特に、所定ビット数の並列データと同並列データの有効／無効を示す参照用データとをクロックに同期して並列に伝送する場合に用いて好適な同期伝送路及び該同期伝送路に用いられるデータ伝送方法に関する。
【背景技術】
【０００２】
複数のビット数の並列データを並列伝送路を介して相手側の端末などに送信する場合、同伝送路を構成する各伝送線の伝搬定数にばらつきがあるため、同伝送路が長くなるにつれて各ビットに進み遅れが発生することがあり、受信側で並列データが正確に受信されないという問題点がある。これを改善する伝送路の構成として、並列伝送路の各伝送線にフリップフロップを設け、並列データをクロックに同期して同各フリップフロップに取り込んで伝送する構成の同期伝送路が考えられる。ところが、この同期伝送路では、各フリップフロップにクロックが常時供給されるので、消費電力が大きいという問題点がある。このため、並列データが正確に伝送され、かつ消費電力が低減される同期伝送路が要求されている。
【０００３】
この種の関連する同期伝送路は、たとえば図２に示すように、クロックドライバ１と、フリップフロップ２と、クロックゲート機能付きクロックドライバ（以下、「ＣＧクロックドライバ」という）３と、フリップフロップ４1 ，４2 ，４3 ，４4 と、クロックドライバ５と、フリップフロップ６と、ＣＧクロックドライバ７と、フリップフロップ８1 ，８2 ，８3 ，８4 とから構成されている。
【０００４】
この同期伝送路では、たとえば４ビットの並列データ“ｄａｔａ”の有効／無効を示す参照用データＶが、クロックドライバ１から供給されるクロックｃｋに同期してフリップフロップ２に取り込まれて保持される。クロックｃｋは、ＣＧクロックドライバ３に入力され、フリップフロップ２に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、同ＣＧクロックドライバ３からゲーティッドクロックｇｃｋ1 として出力される。並列データ“ｄａｔａ”は、ゲーティッドクロックｇｃｋ1 に同期してフリップフロップ４1 ，４2 ，４3 ，４4 に取り込まれて保持される。
【０００５】
フリップフロップ２に保持されている参照用データＶは、クロックドライバ５から供給されるクロックｃｋに同期してフリップフロップ６に取り込まれて保持される。クロックｃｋは、ＣＧクロックドライバ７に入力され、フリップフロップ６に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、ＣＧクロックドライバ７からゲーティッドクロックｇｃｋ2 として出力される。フリップフロップ４1 ，４2 ，４3 ，４4 に保持されている並列データ“ｄａｔａ”は、ゲーティッドクロックｇｃｋ2 に同期してフリップフロップ８1 ，８2 ，８3 ，８4 に取り込まれて保持される。
【０００６】
上記の同期伝送路の他、この種の関連する技術としては、たとえば、特許文献１に記載された半導体論理回路におけるクロック分配回路がある。このクロック分配回路では、クロックイネーブル信号に応じて、クロック生成回路でゲーティッドクロックが生成され、クロック同期回路に供給される。これにより、クロック信号のトグルで消費されていた電力を減少させることができる。
【０００７】
また、特許文献２に記載されたパイプライン処理回路では、パイプラインを停止する各ストール信号は、各フリップフロップによって２クロック分遅延されている。クロック信号は、各ストール信号によってオン／オフされ、各クロック信号が各ステージのフリップフロップに個別に供給され、各ステージのクロック供給／停止が行われて消費電力が低減される。
【０００８】
また、特許文献３に記載された回路設計方法では、ゲートクロック化された論理回路が設計され、同論理回路では、入力されるクロックがイネーブル信号によってゲートされ、クロックによるフリップフロップのオン／オフ動作の回数が減少する。
【先行技術文献】
【特許文献】
【０００９】
【特許文献１】特開２００６−０７２７７７号公報（要約書、図１）
【特許文献２】特開平０７−０４４２６５号公報（要約書、図１）
【特許文献３】特開平１０−２９４３７５号公報（要約書、図２）
【発明の開示】
【発明が解決しようとする課題】
【００１０】
しかしながら、上記各文献を含む上記技術では、次のような問題点があった。
すなわち、図２の同期伝送路では、参照用データＶは、並列データ“ｄａｔａ”と同様に伝送遅延が発生するため、受信側で並列データが正確に受信されないという状態は改善されない。
【００１１】
また、特許文献１に記載されたクロック分配回路では、クロック信号のトグルで消費されていた電力が減少するが、クロックイネーブル信号を同期伝送路で伝送する場合に発生する遅延を解決するものではないので、上記の問題点は、改善されない。
【００１２】
特許文献２に記載されたパイプライン処理回路では、クロック信号は、各ストール信号によってオン／オフされるが、上記特許文献１と同様に、同期伝送路で伝送する場合に発生する遅延を解決するものではないので、上記の問題点は、改善されない。
【００１３】
特許文献３に記載された回路設計方法による論理回路では、クロックによるフリップフロップのオン／オフ動作の回数が減少するが、上記特許文献１と同様に、同期伝送路で伝送する場合に発生する遅延を解決するものではないので、上記の問題点は、改善されない。
【００１４】
この発明は、上述の事情に鑑みてなされたもので、並列データの有効／無効を示す参照用データに基づいて生成されるゲーティッドクロックにより、受信側で並列データが正確に受信されると共に消費電力が低減される同期伝送路及び該同期伝送路に用いられるデータ伝送方法を提供することを目的としている。
【課題を解決するための手段】
【００１５】
上記課題を解決するために、この発明の第１の構成は、同期伝送路に係り、所定ビット数の並列データの有効／無効を示す参照用データをクロックに同期して取り込んで保持する第１のフリップフロップと、該第１のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第１のゲーティッドクロックとして出力する第１のクロックドライバと、前記並列データを前記第１のゲーティッドクロックに同期して取り込んで保持する第２のフリップフロップと、前記第１のフリップフロップに保持されている前記参照用データを前記クロックに同期して取り込んで保持する第３のフリップフロップと、該第３のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第２のゲーティッドクロックとして出力する第２のクロックドライバと、前記第２のフリップフロップに保持されている前記並列データを前記第２のゲーティッドクロックに同期して取り込んで保持する第４のフリップフロップとを有し、かつ、前記第１のフリップフロップに取り込まれる前記参照用データを、前記第２のフリップフロップに取り込まれる前記並列データよりも所定時間先行させて伝送する参照用データ先行伝送手段が設けられていることを特徴としている。
【００１６】
この発明の第２の構成は、所定ビット数の並列データの有効／無効を示す参照用データをクロックに同期して取り込んで保持する第１のフリップフロップと、該第１のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第１のゲーティッドクロックとして出力する第１のクロックドライバと、前記並列データを前記第１のゲーティッドクロックに同期して取り込んで保持する第２のフリップフロップと、前記第１のフリップフロップに保持されている前記参照用データを前記クロックに同期して取り込んで保持する第３のフリップフロップと、該第３のフリップフロップに保持されている前記参照用データが前記並列データの有効を示すとき、前記クロックを第２のゲーティッドクロックとして出力する第２のクロックドライバと、前記第２のフリップフロップに保持されている前記並列データを前記第２のゲーティッドクロックに同期して取り込んで保持する第４のフリップフロップとを有する同期伝送路に用いられるデータ伝送方法に係り、参照用データ先行伝送手段を設けておき、該参照用データ先行伝送手段が、前記第１のフリップフロップに取り込まれる前記参照用データを、前記第２のフリップフロップに取り込まれる前記並列データよりも所定時間先行させて伝送することを特徴としている。
【発明の効果】
【００１７】
この発明の構成によれば、第１及び第２のクロックドライバから並列データの有効／無効に正確に対応して第１及び第２のゲーティッドクロックが出力され、受信側で並列データを正確に受信できると共に各フリップフロップでの消費電力を低減できる。
【図面の簡単な説明】
【００１８】
【図１】この発明の一実施形態である同期伝送路の構成図である。
【図２】関連する同期伝送路の構成図である。
【発明を実施するための形態】
【００１９】
上記参照用データ先行伝送手段は、上記第２のフリップフロップに取り込まれる上記並列データを、上記第１のフリップフロップに取り込まれる上記参照用データよりも所定時間遅延させて伝送する構成とされている同期伝送路を提供する。
【００２０】
また、この発明の好適な形態では、上記参照用データ先行伝送手段は、上記参照用データが上記並列データの有効を示すとき、上記クロックを第３のゲーティッドクロックとして出力する第３のクロックドライバと、上記並列データを上記第３のゲーティッドクロックに同期して取り込んで保持する第５のフリップフロップとから構成されている。
【００２１】
また、この発明の好適な形態では、上記参照用データ先行伝送手段の上記第３のクロックドライバは、上記参照用データが上記並列データの有効を示すとき、上記クロックを所定時間遅延させて上記第３のゲーティッドクロックを出力する構成とされている。
【００２２】
また、この発明の好適な形態では、上記参照用データ先行伝送手段は、上記第１のフリップフロップに取り込まれる上記参照用データと、上記第２のフリップフロップに取り込まれる上記並列データとのタイミングが競合するとき、該参照用データを該並列データよりも先行させて伝送する競合調停回路で構成されている。
【実施形態】
【００２３】
図１は、この発明の一実施形態である同期伝送路の要部の構成を示す図である。
この形態の同期伝送路は、同図に示すように、クロックドライバ１１と、フリップフロップ１２と、クロックゲート機能付きクロックドライバ（ＣＧクロックドライバ）１３と、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 と、クロックドライバ１５と、フリップフロップ１６と、ＣＧクロックドライバ１７と、フリップフロップ１８1 ，１８2 ，１８3 ，１８4 と、ＣＧクロックドライバ２１と、フリップフロップ２２1 ，２２2 ，２２3 ，２２4 とから構成されている。フリップフロップ１２は、たとえば４ビットの並列データ“ｄａｔａ”の有効／無効を示す参照用データＶを、クロックドライバ１１から供給されるクロックｃｋに同期して取り込んで保持する。
【００２４】
ＣＧクロックドライバ１３は、フリップフロップ１２に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、クロックｃｋをゲーティッドクロックｇｃｋ1 として出力する一方、同参照用データＶが並列データ“ｄａｔａ”の無効を示すとき、ゲーティッドクロックｇｃｋ1 を出力しない。フリップフロップ１４1 ，１４2 ，１４3 ，１４4 は、フリップフロップ２２1 ，２２2 ，２２3 ，２２4 に保持されている並列データ“ｄａｔａ”をゲーティッドクロックｇｃｋ1 に同期して取り込んで保持する。フリップフロップ１６は、フリップフロップ１２に保持されている参照用データＶを、クロックドライバ１５から供給されるクロックｃｋに同期して取り込んで保持する。ＣＧクロックドライバ１７は、フリップフロップ１６に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、クロックｃｋをゲーティッドクロックｇｃｋ2 として出力する一方、同参照用データＶが並列データ“ｄａｔａ”の無効を示すとき、ゲーティッドクロックｇｃｋ2 を出力しない。フリップフロップ１８1 ，１８2 ，１８3 ，１８4 は、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に保持されている並列データ“ｄａｔａ”をゲーティッドクロックｇｃｋ2 に同期して取り込んで保持する。
【００２５】
ＣＧクロックドライバ２１は、参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、クロックｃｋをゲーティッドクロックｇｃｋ3 として出力する一方、同参照用データＶが並列データ“ｄａｔａ”の無効を示すとき、ゲーティッドクロックｇｃｋ3 を出力しない。フリップフロップ２２1 ，２２2 ，２２3 ，２２4 は、並列データ“ｄａｔａ”をゲーティッドクロックｇｃｋ3 に同期して取り込んで保持する。これらのＣＧクロックドライバ２１及びフリップフロップ２２1 ，２２2 ，２２3 ，２２4 により、参照用データ先行伝送手段が構成されている。この参照用データ先行伝送手段は、フリップフロップ１２に取り込まれる参照用データＶを、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”よりも所定時間先行させて伝送する。特に、この実施形態では、参照用データ先行伝送手段は、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”を、フリップフロップ１２に取り込まれる参照用データＶよりも所定時間遅延させて伝送する。
【００２６】
次に、この形態の同期伝送路に用いられるデータ伝送方法の処理内容について説明する。
この同期伝送路では、ＣＧクロックドライバ２１及びフリップフロップ２２1 ，２２2 ，２２3 ，２２4 で構成される参照用データ先行伝送手段により、フリップフロップ１２に取り込まれる参照用データＶが、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”よりも所定時間先行して同フリップフロップ１２へ伝送される。
【００２７】
すなわち、参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、クロックドライバ２１からゲーティッドクロックｇｃｋ3 が出力され、並列データ“ｄａｔａ”が同ゲーティッドクロックｇｃｋ3 に同期してフリップフロップ２２1 ，２２2 ，２２3 ，２２4 に取り込まれて保持される。これにより、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”が、フリップフロップ１２に取り込まれる参照用データＶよりも所定時間（たとえば、１クロック時間）遅延されて伝送される。さらに、参照用データＶが、クロックドライバ１１から供給されるクロックｃｋに同期してフリップフロップ１２に取り込まれて保持される。また、クロックｃｋは、ＣＧクロックドライバ１３に入力され、フリップフロップ１２に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、同ＣＧクロックドライバ１３からゲーティッドクロックｇｃｋ1 として出力される。フリップフロップ２２1 ，２２2 ，２２3 ，２２4 に保持されている並列データ“ｄａｔａ”は、ゲーティッドクロックｇｃｋ1 に同期してフリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれて保持される。
【００２８】
フリップフロップ１２に保持されている参照用データＶは、クロックドライバ１５から供給されるクロックｃｋに同期してフリップフロップ１６に取り込まれて保持される。
また、クロックｃｋは、ＣＧクロックドライバ１７に入力され、フリップフロップ１６に保持されている参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、ＣＧクロックドライバ１７からゲーティッドクロックｇｃｋ2 として出力される。フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に保持されている並列データ“ｄａｔａ”は、ゲーティッドクロックｇｃｋ2 に同期してフリップフロップ１８1 ，１８2 ，１８3 ，１８4 に取り込まれて保持される。
【００２９】
以上のように、この実施形態では、フリップフロップ１２に取り込まれる参照用データＶが、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”よりも先行して同フリップフロップ１２へ伝送される。これにより、ＣＧクロックドライバ１３，１７から並列データ“ｄａｔａ”の有効に正確に対応してゲーティッドクロックｇｃｋ1 ，ｇｃｋ2 が出力される一方、並列データ“ｄａｔａ”の無効に正確に対応してゲーティッドクロックｇｃｋ1 ，ｇｃｋ2 が出力されないので、受信側で並列データ“ｄａｔａ”が正確に受信されると共に各フリップフロップでの消費電力が低減される。
【００３０】
以上、この発明の実施形態を図面により詳述してきたが、具体的な構成は同実施形態に限られるものではなく、この発明の要旨を逸脱しない範囲の設計の変更などがあっても、この発明に含まれる。
たとえば、図１中のクロックドライバ２１は、参照用データＶが並列データ“ｄａｔａ”の有効を示すとき、クロックｃｋを所定時間遅延させてゲーティッドクロックｇｃｋ3 を出力する構成としても良い。これにより、伝送路の伝搬状態に対応して、参照用データＶに対する並列データ“ｄａｔａ”の伝送の時間差を調整可能となる（請求項４、９に対応）。
【００３１】
また、参照用データ先行伝送手段として、競合調停回路を設けても良い。同競合調停回路は、フリップフロップ１２に取り込まれる参照用データＶと、フリップフロップ１４1 ，１４2 ，１４3 ，１４4 に取り込まれる並列データ“ｄａｔａ”とのタイミングが競合するとき、同参照用データＶを並列データ“ｄａｔａ”よりも先行させてフリップフロップ１２へ伝送する。これにより、フリップフロップ２２1 ，２２2 ，２２3 ，２２4 による並列データ“ｄａｔａ”の伝送遅延が発生しない（請求項５、１０に対応）。また、クロックドライバ１５、フリップフロップ１６、ＣＧクロックドライバ１７及びフリップフロップ１８1 ，１８2 ，１８3 ，１８4 は、伝送路の長さに応じて、同様のハード構成を後段に追加しても良い。また、並列データ“ｄａｔａ”は、４ビットに限定されない。
【産業上の利用可能性】
【００３２】
この発明は、所定ビット数の並列データと同並列データの有効／無効を示す参照用データとをクロックに同期して並列に伝送する同期伝送路全般に適用できる。
【符号の説明】
【００３３】
１２      フリップフロップ（第１のフリップフロップ）
１３      ＣＧクロックドライバ（クロックゲート機能付きクロックドライバ、第１のクロックドライバ）
１４1 ，１４2 ，１４3 ，１４4       フリップフロップ（第２のフリップフロップ）  １６      フリップフロップ（第３のフリップフロップ）
１７      ＣＧクロックドライバ（第２のクロックドライバ）
１８1 ，１８2 ，１８3 ，１８4       フリップフロップ（第４のフリップフロップ）  ２１      ＣＧクロックドライバ（参照用データ先行伝送手段の一部、第３のクロックドライバ）
２２1 ，２２2 ，２２3 ，２２4       フリップフロップ（参照用データ先行伝送手段の一部、第５のフリップフロップ）
【図１】
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【図２】
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