(57)【要約】【課題】パルス信号を停止した場合に半導体スイッチング素子のオン期間の増大を防止できる半導体スイッチング素子のドライブ回路。【解決手段】ドライブ回路は、直列に接続された第１半導体スイッチング素子Q1と第２半導体スイッチング素子Q2とを交互にオン動作させ、第1，第2半導体スイッチング素子の制御信号となるパルス信号を生成するパルス信号発生回路2の両端に接続され、コンデンサCとトランスT1の一次巻線Pとの直列回路と、一次巻線とは逆方向に巻回され、発生した電圧を第１半導体スイッチング素子の制御端子に印加するトランスの第１の二次巻線S1と、一次巻線と同方向に巻回され、発生した電圧を第２半導体スイッチング素子の制御端子に印加するトランスの第２の二次巻線S2と、パルス信号が停止されたときにオンすることにより第１半導体スイッチング素子のオン期間を短くさせるスイッチング素子Q3とを備える。【選択図】図１
2010288194.tif 000002
【特許請求の範囲】
【請求項１】
直列に接続された第１半導体スイッチング素子と第２半導体スイッチング素子とを交互にオン動作させる半導体スイッチング素子のドライブ回路であって、
前記第１，第２半導体スイッチング素子の制御信号となるパルス信号を生成するパルス信号発生回路の両端に接続され、コンデンサとトランスの一次巻線とが直列に接続された第１直列回路と、
前記トランスの一次巻線とは逆方向に巻回され、発生した電圧を前記第１半導体スイッチング素子の制御端子に印加する前記トランスの第１の二次巻線と、
前記トランスの一次巻線と同方向に巻回され、発生した電圧を前記第２半導体スイッチング素子の制御端子に印加する前記トランスの第２の二次巻線と、
前記パルス信号が停止されたときにオンすることにより前記第１半導体スイッチング素子のオン期間を短くさせるスイッチング素子と、
を備えることを特徴とする半導体スイッチング素子のドライブ回路。
【請求項２】
前記スイッチング素子の第１主端子及び第２主端子間には、前記コンデンサが接続され、前記スイッチング素子の制御端子にドライブ回路を停止させるための停止信号が入力されることを特徴とする請求項１記載の半導体スイッチング素子のドライブ回路。
【請求項３】
前記スイッチング素子の第１主端子及び第２主端子間には、前記トランスの一次巻線又は前記トランスの第１の二次巻線又は前記トランスの第２の二次巻線が接続され、前記スイッチング素子の制御端子にドライブ回路を停止させるための停止信号が入力されることを特徴とする請求項１記載の半導体スイッチング素子のドライブ回路。
【請求項４】
前記スイッチング素子と第１抵抗とが直列に接続された第２直列回路を有し、
前記第１抵抗の値は、前記停止信号が入力されたとき、前記第２直列回路の両端に接続された前記トランスの一次巻線又は前記トランスの第１の二次巻線又は前記トランスの第２の二次巻線に発生する電圧を抑制し、前記トランスの第１の二次巻線に発生する電圧が前記第１半導体スイッチング素子の制御端子の閾値電圧を超えないように設定されることを特徴とする請求項３記載の半導体スイッチング素子のドライブ回路。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、直列に接続された第１半導体スイッチング素子と第２半導体スイッチング素子とを交互にオン動作させる半導体スイッチング素子のドライブ回路に関する。
【背景技術】
【０００２】
図７は従来の半導体スイッチング素子のドライブ回路の一例を示す図である。図７において、Ｎ型ＭＯＳＦＥＴからなるハイサイドの第１半導体スイッチング素子Ｑ１とＮ型ＭＯＳＦＥＴからなるローサイドの第２半導体スイッチング素子Ｑ２との直列回路の両端には、直流電源ＶDCが接続されている。第１半導体スイッチング素子Ｑ１と第２半導体スイッチング素子Ｑ２との接続点には、負荷１が接続されている。
【０００３】
第１，第２半導体スイッチング素子Ｑ１，Ｑ２の制御信号となるパルス信号を生成するパルス信号発生回路２の両端にはコンデンサＣとトランスＴ１の一次巻線Ｐとの直列回路が接続されている。トランスＴ１は、一次巻線Ｐと第１の二次巻線Ｓ１と第２の二次巻線Ｓ２とを有する。第１の二次巻線Ｓ１は一次巻線Ｐとは巻方向が異なり、第２の二次巻線Ｓ２は一次巻線Ｐと巻方向が同一である。
【０００４】
トランスＴ１の第１の二次巻線Ｓ１には第１ドライブ回路３ｃが接続され、第１ドライブ回路３ｃはトランスＴ１の第１の二次巻線Ｓ１の電圧に基づき第１半導体スイッチング素子Ｑ１のゲートに第１ドライブ信号を印加する。トランスＴ１の第２の二次巻線Ｓ２には第２ドライブ回路３ｄが接続され、第２ドライブ回路３ｄはトランスＴ１の第２の二次巻線Ｓ２の電圧に基づき第２半導体スイッチング素子Ｑ２のゲートに第２ドライブ信号を印加する。
【０００５】
次にこのように構成された図７に示す半導体スイッチング素子のドライブ回路の動作を図８に示すドライブ回路を停止した時の動作波形図を参照しながら説明する。
【０００６】
まず、時刻ｔ０において、パルス信号発生回路２により発生したパルス信号ＰＬは、コンデンサＣとトランスＴ１の一次巻線Ｐを介して第１の二次巻線Ｓ１と第２の二次巻線Ｓ２とに送られる。第１の二次巻線Ｓ１と第２の二次巻線Ｓ２とは、巻方向が異なるため、互いに反転したパルス信号が第１ドライブ回路３ｃと第２ドライブ回路３ｄに送られる。
【０００７】
第１ドライブ回路３ｃは、第１ドライブ信号Ｈｇを第１半導体スイッチング素子Ｑ１のゲートに印加し、第２ドライブ回路３ｄは、第２ドライブ信号Ｌｇを第２半導体スイッチング素子Ｑ２のゲートに印加する。図８では、ローサイドの第２の二次巻線Ｓ２が一次巻線Ｐと同方向に巻回されたときの動作波形を示す。
【０００８】
この場合、パルス信号ＰＬがＬレベルのときには、第１ドライブ信号がＨレベルとなり、第１半導体スイッチング素子Ｑ１がオンし、直流電源ＶDCの電力が負荷１に供給される。パルス信号ＰＬがＨレベルのときには、第２ドライブ信号ＬｇがＨレベルとなり、第２半導体スイッチング素子Ｑ２がオンし、負荷１のエネルギーが放電される。
【０００９】
次に、時刻ｔ１０において、パルス信号発生回路２がドライブ回路を停止するためにパルス信号ＰＬを停止した場合、トランスＴ１の一次巻線Ｐと同方向に巻回された第２の二次巻線Ｓ２の出力電圧が負電圧となるので、第２半導体スイッチング素子Ｑ２がオフされる。
【００１０】
これに対して、トランスＴ１の一次巻線Ｐとは逆方向に巻回された第１の二次巻線Ｓ１の出力電圧は正電圧となり、第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈを超えると、第１半導体スイッチング素子Ｑ１がｔON期間中オンされる。その後、トランスＴ１の励磁インダクタンスＬ（図示せず）と、コンデンサＣとのＬＣ共振が起り、共振エネルギーの消費により、コンデンサＣの両端電圧Ｖｃは、緩やかに減少していく。
【００１１】
なお、従来の技術として、例えば特許文献１が知られている。特許文献１に記載されたパワースイッチ素子の駆動方法は、ドライブトランスを介してパワースイッチ素子をパルス駆動するスイッチングレギュレータにおいて、パルスを停止する場合にパルス幅のデューティを徐々に下げるか、もしくはパルス電圧を徐々に下げることにより、ドライブトランスのインダクタンスと入出力に接続されたコンデンサによる電圧の自由振動からパワースイッチ素子の破損を防止するものである。
【先行技術文献】
【特許文献】
【００１２】
【特許文献１】特開２００２−３２０３７６号公報
【発明の概要】
【発明が解決しようとする課題】
【００１３】
しかしながら、上述したＬＣ共振が起る共振期間中、第１の二次巻線Ｓ１の出力電圧は正電圧を出力するため、第１半導体スイッチング素子Ｑ１のオン期間が増大し、過電流が発生する。
【００１４】
本発明の課題は、パルス信号を停止した場合に、半導体スイッチング素子のオン期間の増大を防止できる半導体スイッチング素子のドライブ回路を提供することにある。
【課題を解決するための手段】
【００１５】
上記課題を解決するために、本発明の請求項１は、直列に接続された第１半導体スイッチング素子と第２半導体スイッチング素子とを交互にオン動作させる半導体スイッチング素子のドライブ回路であって、第１，第２半導体スイッチング素子の制御信号となるパルス信号を生成するパルス信号発生回路の両端に接続され、コンデンサとトランスの一次巻線とが直列に接続された第１直列回路と、前記トランスの一次巻線とは逆方向に巻回され、発生した電圧を前記第１半導体スイッチング素子の制御端子に印加する前記トランスの第１の二次巻線と、前記トランスの一次巻線と同方向に巻回され、発生した電圧を前記第２半導体スイッチング素子の制御端子に印加する前記トランスの第２の二次巻線と、前記パルス信号が停止されたときにオンすることにより前記第１半導体スイッチング素子のオン期間を短くさせるスイッチング素子とを備えることを特徴とする。
【発明の効果】
【００１６】
本発明によれば、パルス信号が停止されたとき、スイッチング素子がオンすることにより第１半導体スイッチング素子のオン期間を短くさせるので、半導体スイッチング素子のオン期間の増大を防止できる。
【図面の簡単な説明】
【００１７】
【図１】本発明の実施例１の半導体スイッチング素子のドライブ回路の構成図である。
【図２】本発明の実施例１の半導体スイッチング素子のドライブ回路を停止した時の動作波形図である。
【図３】本発明の実施例２の半導体スイッチング素子のドライブ回路の構成図である。
【図４】本発明の実施例２の半導体スイッチング素子のドライブ回路を停止した時の動作波形図である。
【図５】本発明の実施例３の半導体スイッチング素子のドライブ回路の構成図である。
【図６】本発明の実施例４の半導体スイッチング素子のドライブ回路の構成図である。
【図７】従来の半導体スイッチング素子のドライブ回路の例を示す図である。
【図８】図７に示す従来の半導体スイッチング素子のドライブ回路を停止した時の動作波形図である。
【発明を実施するための形態】
【００１８】
以下、本発明の実施の形態の半導体スイッチング素子のドライブ回路を図面を参照しながら詳細に説明する。
【実施例１】
【００１９】
図１は本発明の実施例１の半導体スイッチング素子のドライブ回路の構成図である。図１に示す実施例１の半導体スイッチング素子のドライブ回路は、第１半導体スイッチング素子Ｑ１のオン期間の増大を防止するために、パルス信号が停止されたときにオンすることにより第１半導体スイッチング素子Ｑ１のオン期間を短くさせるスイッチング素子Ｑ３を設けたことを特徴とする。
【００２０】
スイッチング素子Ｑ３は、ＮＰＮバイポーラトランジスタからなり、コンデンサＣの一端にコレクタ（第１主端子）が接続され、他端にエミッタ（第２主端子）が接続され、ベース（制御端子）にドライブ回路を停止させるための停止信号が入力されるようになっている。
【００２１】
なお、スイッチング素子Ｑ３は、ＭＯＳＦＥＴであっても良く、その他の半導体スイッチング素子でも良い。また、パルス信号発生回路２の両端には、一次巻線Ｐと抵抗Ｒ（図示せず）とコンデンサＣとの直列回路が接続され、スイッチング素子Ｑ３のコレクタ−エミッタ間に抵抗ＲとコンデンサＣとの直列回路が接続されても良い。
【００２２】
また、第１ドライブ回路３ａは、一端がトランスＴ１の第１の二次巻線Ｓ１の一端に接続され他端が第１半導体スイッチング素子Ｑ１のゲートに接続された抵抗Ｄｒ１で構成されている。第２ドライブ回路３ｂは、一端がトランスＴ１の第２の二次巻線Ｓ２の一端に接続され他端が第２半導体スイッチング素子Ｑ２のゲートに接続された抵抗Ｄｒ２で構成されている。
【００２３】
抵抗Ｄｒ１と第１半導体スイッチング素子Ｑ１の入力容量（ゲート−ソース間容量）との時定数で第１デットタイムを生成し、抵抗Ｄｒ２と第２半導体スイッチング素子Ｑ２の入力容量（ゲート−ソース間容量）との時定数で第２デットタイムを生成する。第１，第２デットタイムは、第１スイッチング素子Ｑ１と第２スイッチング素子Ｑ２とが共にオフとなる期間であり、第１スイッチング素子Ｑ１と第２スイッチング素子Ｑ２とを同時にオンとしないように時定数が決められる。
【００２４】
なお、トランスＴ１の一次側回路の時定数の調整により、抵抗Ｄｒ１と抵抗Ｄｒ２とは、省略しても良い。
【００２５】
次にこのように構成された実施例１の半導体スイッチング素子のドライブ回路の動作を図２に示すドライブ回路を停止した時の動作波形図を参照しながら説明する。
【００２６】
まず、時刻ｔ０〜ｔ１までにおいては、停止信号Ｑ３ｇはＬレベルであるので、スイッチング素子Ｑ３はオフである。このため、時刻ｔ０〜ｔ１までの動作は、図８に示す従来のドライブ回路の時刻ｔ０〜ｔ１０までの動作と同様であるので、ここでは、その説明は省略する。
【００２７】
次に、時刻ｔ１において、ドライブ回路が停止したときに停止信号Ｑ３ｇがスイッチング素子Ｑ３のベースに印加されるので、スイッチング素子Ｑ３がオンする。すると、コンデンサＣに蓄えられたエネルギーは、スイッチング素子Ｑ３を介して放電されるため、トランスＴ１の励磁インダクタンスＬ（図示せず）に伝達されるエネルギーが減少する。
【００２８】
この動作により、トランスＴ１の一次巻線Ｐと逆方向に巻回された第１の二次巻線Ｓ１に伝達されるエネルギーが急激に減少する。このため、トランスＴ１の第１の二次巻線Ｓ１の出力電圧（第１ドライブ信号Ｈｇと同じ）は、急激に第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈより下がり、第１半導体スイッチング素子Ｑ１がオフして、時刻ｔ２においてほぼゼロ電圧に達する。また、コンデンサＣの両端電圧Ｖｃも減少していく。このため、パルス信号が停止された場合に、第１半導体スイッチング素子Ｑ１のオン期間の増大を防止できる。
【実施例２】
【００２９】
図３は本発明の実施例２の半導体スイッチング素子のドライブ回路の構成図である。図３に示す実施例２では、オン期間の増大を防止するためのスイッチング素子Ｑ３と抵抗Ｒ１との直列回路をトランスＴ１の第２の二次巻線Ｓ２の両端に接続したことを特徴とする。
【００３０】
また、抵抗Ｒ１の値は、停止信号が入力されたとき、トランスＴ１の第１の二次巻線Ｓ１に発生する電圧が第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈを超えないように設定される。
【００３１】
次にこのように構成された実施例２の半導体スイッチング素子のドライブ回路の動作を図４に示すドライブ回路を停止した時の動作波形図を参照しながら説明する。
【００３２】
時刻ｔ０〜ｔ１までの動作は、図２に示す実施例１のドライブ回路の時刻ｔ０〜ｔ１までの動作と同様であるので、ここでは、その説明は省略する。
【００３３】
次に、時刻ｔ１において、ドライブ回路が停止されたときに停止信号Ｑ３ｇがスイッチング素子Ｑ３のベースに印加されるので、スイッチング素子Ｑ３がオンする。すると、第２の二次巻線Ｓ２に蓄えられたエネルギーは、スイッチング素子Ｑ３と抵抗Ｒ１とを介して放電され、抵抗Ｒ１で消費される。
【００３４】
このため、トランスＴ１の第２の二次巻線Ｓ２の出力電圧（第２ドライブ信号Ｌｇと同じ）は、急激に下がるので、トランスＴ１の第１の二次巻線Ｓ１の出力電圧（第１ドライブ信号Ｈｇと同じ）も急激に第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈより下がる。このため、第１半導体スイッチング素子Ｑ１がオフして、時刻ｔ２においてほぼゼロ電圧に達する。このため、パルス信号が停止された場合に、第１半導体スイッチング素子Ｑ１のオン期間の増大を防止できる。
【実施例３】
【００３５】
図５は本発明の実施例３の半導体スイッチング素子のドライブ回路の構成図である。図５に示す実施例３では、オン期間の増大を防止するためのスイッチング素子Ｑ３と抵抗Ｒ１との直列回路をトランスＴ１の第１の二次巻線Ｓ１の両端に接続したことを特徴とする。
【００３６】
また、抵抗Ｒ１の値は、停止信号が入力されたとき、トランスＴ１の第１の二次巻線Ｓ１に発生する電圧が第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈを超えないように設定される。
【００３７】
このように構成された実施例３の半導体スイッチング素子のドライブ回路によれば、ドライブ回路が停止したときに停止信号Ｑ３ｇがスイッチング素子Ｑ３のベースに印加されるので、スイッチング素子Ｑ３がオンする。すると、トランスＴ１の第１の二次巻線Ｓ１に蓄えられたエネルギーは、スイッチング素子Ｑ３と抵抗Ｒ１とを介して放電され、抵抗Ｒ１で消費される。
【００３８】
このため、トランスＴ１の第１の二次巻線Ｓ１の出力電圧（第１ドライブ信号Ｈｇと同じ）は、急激に第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈより下がるため、第１半導体スイッチング素子Ｑ１がオフする。このため、パルス信号が停止された場合に、第１半導体スイッチング素子Ｑ１のオン期間の増大を防止できる。
【実施例４】
【００３９】
図６は本発明の実施例４の半導体スイッチング素子のドライブ回路の構成図である。図６に示す実施例４では、オン期間の増大を防止するためのスイッチング素子Ｑ３と抵抗Ｒ１との直列回路をトランスＴ１の一次巻線Ｐの両端に接続したことを特徴とする。
【００４０】
また、抵抗Ｒ１の値は、停止信号が入力されたとき、トランスＴ１の第１の二次巻線Ｓ１に発生する電圧が第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈを超えないように設定される。
【００４１】
このように構成された実施例４の半導体スイッチング素子のドライブ回路によれば、ドライブ回路が停止したときに停止信号Ｑ３ｇがスイッチング素子Ｑ３のベースに印加されるので、スイッチング素子Ｑ３がオンする。すると、トランスＴ１の一次巻線Ｐに蓄えられたエネルギーは、スイッチング素子Ｑ３と抵抗Ｒ１とを介して放電され、抵抗Ｒ１で消費される。
【００４２】
このため、トランスＴ１の一次巻線Ｐと逆方向に巻回されたトランスＴ１の第１の二次巻線Ｓ１に伝達されるエネルギーが急激に減少する。従って、トランスＴ１の第１の二次巻線Ｓ１の出力電圧（第１ドライブ信号Ｈｇと同じ）は、急激に第１半導体スイッチング素子Ｑ１のゲートの閾値電圧Ｖｔｈより下がり、第１半導体スイッチング素子Ｑ１がオフするため、パルス信号が停止された場合に、第１半導体スイッチング素子Ｑ１のオン期間の増大を防止できる。
【産業上の利用可能性】
【００４３】
本発明は、共振ハーフブリッジ変換器を有する放電ランプを点灯させる点灯装置に適用可能である。
【符号の説明】
【００４４】
１  負荷
２  パルス信号発生回路
３ａ，３ｃ  第１ドライブ回路
３ｂ，３ｄ  第２ドライブ回路
Ｑ１  第１半導体スイッチング素子
Ｑ２  第２半導体スイッチング素子
Ｑ３  スイッチング素子
Ｔ１  トランス
Ｐ  一次巻線
Ｓ１  第１の二次巻線
Ｓ２  第２の二次巻線
Ｒ１，Ｄｒ１，Ｄｒ２  抵抗
ＶDC  直流電源
【図１】
2010288194.tif 000003
【図２】
2010288194.tif 000004
【図３】
2010288194.tif 000005
【図４】
2010288194.tif 000006
【図５】
2010288194.tif 000007
【図６】
2010288194.tif 000008
【図７】
2010288194.tif 000009
【図８】
2010288194.tif 000010