(57)【要約】【課題】高速転送される画像データに転送エラーが生じても、表示画像の視覚上の画質の劣化を防止することのできるＬＣＤドライバを提供する。【解決手段】エラー検出部１は、シリアルーパラレル変換部１００によりシリアル形式からパラレル形式へ変換された受信画像データの画素ごとのＲ、Ｇ、Ｂデータに付加されているエラーチェックデータＥＣを用いて、その受信画像データの転送エラーを画素単位で検出する。ラッチ２は、１ライン分の受信画像データを画素単位で格納する。ラッチパルス制御部３は、エラー検出部１により転送エラーが検出されたときは、その転送エラーが検出された画素のデータがラッチ2に格納されないよう、その画素に対応するラッチへのラッチパルスの伝送を抑止する。【選択図】図２
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【特許請求の範囲】
【請求項１】
受信画像データの画素ごとに付加されているエラーチェックデータを用いて、前記受信画像データの転送エラーを画素単位で検出するエラー検出手段と、
画素単位のラッチパルスに応じて１ライン分の前記受信画像データを画素単位で格納するラッチと、
前記ラッチに対して画素単位の前記ラッチパルスの伝送を制御する手段であって、
前記エラー検出手段により前記転送エラーが検出されたときは、その転送エラーが検出された画素のデータを前記ラッチが格納しないよう、画素単位で該画素に対応する前記ラッチへのラッチパルスの伝送を抑止するラッチパルス制御手段と
を備えることを特徴とするＬＣＤドライバ。
【請求項２】
前記エラー検出手段が、
前記受信画像データから画素ごとのエラーチェックデータを生成し、
前記受信画像データの画素ごとに付加されているエラーチェックデータと比較して、
その両者が不一致であるときに前記転送エラーを検出したと判定する
ことを特徴とする請求項１に記載のＬＣＤドライバ。
【請求項３】
前記受信画像データの画素ごとに付加されるエラーチェックデータおよび前記エラー検出手段により生成されるエラーチェックデータが、画素データの上位側ビットから生成される
ことを特徴とする請求項２に記載のＬＣＤドライバ。
【請求項４】
前記ラッチパルス制御手段が、
画素データの上位側ビットを格納するラッチに対してのみ前記ラッチパルスの伝送の抑止を行う
ことを特徴とする請求項１乃至３のいずれか１項に記載のＬＣＤドライバ。
【請求項５】
前記ラッチパルス制御手段が、
表示ラインの１ライン目の前記受信画像データを受信したときは、前記ラッチパルスの伝送の抑止を行わない
ことを特徴とする請求項１乃至４のいずれか１項に記載のＬＣＤドライバ。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、ＬＣＤドライバに関する。
【背景技術】
【０００２】
近年、ＴＶなどの表示装置に用いられるＬＣＤ（液晶ディスプレイ）では、画面サイズの大画面化に伴い、映像処理部から転送される画像データの転送速度が高速になっている。しかし、高速データ転送を行う場合、高速動作を行う分、偶発的な信号レベルの変動や伝送タイミングの変動による影響を受けやすく、転送エラーが生じやすくなる。現在のＬＣＤドライバは、受信したデジタルの画像データをアナログデータに変換してＬＣＤに伝達するため、転送エラーが生じた画像データをそのまま表示すると、隣り合った画素との違いが目立ち、画像品質が劣化する、という問題が発生する。
【０００３】
従来、このような画像データの転送エラー問題に対して、画像データのラインごとに誤り検出データを付加し、この誤り検出データを用いて受信した画像データに誤りがあるか否かを検出し、誤りが検出されたときは、そのラインのデータをフレームメモリに書き込まず、送信側にそのラインのデータの再送信を要求する画像表示装置が提案されている（例えば、特許文献１参照。）。
【０００４】
この提案の画像表示装置では、同じ画像データの送信を繰り返すことにより、誤りの検出されない画像データを受信することが可能である。しかし、ＴＶ放送の表示などの場合、高速転送された画像データを、順次、直ちに表示する必要があり、上述の従来のデータ処理方法では、画像の表示が間に合わなくなる、という問題が発生する。
【先行技術文献】
【特許文献】
【０００５】
【特許文献１】特開２００６−１９１１８８号公報  （第１０−１２ページ、図１）
【発明の概要】
【発明が解決しようとする課題】
【０００６】
そこで、本発明の目的は、高速転送される画像データに転送エラーが生じても、表示画像の視覚上の画質の劣化を防止することのできるＬＣＤドライバを提供することにある。
【課題を解決するための手段】
【０００７】
本発明の一態様によれば、受信画像データの画素ごとに付加されているエラーチェックデータを用いて、前記受信画像データの転送エラーを画素単位で検出するエラー検出手段と、画素単位のラッチパルスに応じて１ライン分の前記受信画像データを画素単位で格納するラッチと、前記ラッチに対して画素単位の前記ラッチパルスの伝送を制御する手段であって、前記エラー検出手段により前記転送エラーが検出されたときは、その転送エラーが検出された画素のデータを前記ラッチが格納しないよう、画素単位で該画素に対応する前記ラッチへのラッチパルスの伝送を抑止するラッチパルス制御手段とを備えることを特徴とするＬＣＤドライバが提供される。
【発明の効果】
【０００８】
本発明によれば、高速転送される画像データに転送エラーが生じても、表示画像の視覚上の画質の劣化を防止することができる。
【図面の簡単な説明】
【０００９】
【図１】１画素分の画像データの構成を示す図。
【図２】本発明の実施例１に係るＬＣＤドライバの構成の例を示すブロック図。
【図３】本発明の実施例のエラー検出部の構成の例を示すブロック図。
【図４】本発明の実施例のラッチパルス制御部の構成の例を示すブロック図。
【図５】本発明の実施例のラッチパルス制御部の動作の例を示す波形図。
【図６】エラー検出時のラッチの出力データの例を示す図。
【図７】本発明の実施例２に係るＬＣＤドライバの構成の例を示すブロック図。
【図８】画像データの上位ビットの値とＡＤ変換出力の関係を示す図。
【図９】本発明の実施例３に係るＬＣＤドライバの構成の例を示すブロック図。
【図１０】ｍｉｎｉ−ＬＶＤＳフォーマットによるデータ転送の例を示す図。
【図１１】本発明の実施例４に係るＬＣＤドライバの構成の例を示すブロック図。
【発明を実施するための形態】
【００１０】
ＴＶ放送の表示などの場合、統計的に、隣り合う画素は、画素データの相関が高く、同じ色か、近い色になる確率が高い。そこで、本発明では、受信した画像データの転送エラーの有無を画素ごとに検出し、転送エラーを検出した場合は、１ライン前の同じ画素列の画素データを出力するようにする。
【００１１】
画素ごとの転送エラー検出のために、本発明では、ＬＣＤドライバに送信される画素データにはエラーチェックデータが付加されている。
【００１２】
図１に、本発明のＬＣＤドライバに送信される画素データの構成の例を示す。
【００１３】
本発明のＬＣＤドライバに送信される画素データには、１画素分のＲ、Ｇ、Ｂデータごとに、そのにＲ、Ｇ、Ｂデータ対するエラーチェックデータＥＣが付加されている。エラーチェック方式としては、ＣＲＣやパリティチェックなどが用いられる。
【００１４】
以下、本発明の実施例について図面を参照して説明する。なお、図中、同一または相当部分には同一の符号を付して、その説明は繰り返さない。
【実施例１】
【００１５】
図２は、本発明の実施例１に係るＬＣＤドライバの構成の例を示すブロック図である。
【００１６】
本実施例のＬＣＤドライバは、シリアルーパラレル変換部１００によりシリアル形式からパラレル形式へ変換された受信画像データの画素ごとのＲ、Ｇ、Ｂデータに付加されているエラーチェックデータＥＣを用いて、その受信画像データの転送エラーを画素単位で検出するエラー検出部１と、１ライン分の受信画像データを画素単位で格納するラッチ２と、エラー検出部１により転送エラーが検出されたときは、その転送エラーが検出された画素のデータを格納するラッチへのラッチパルスの伝送を抑止するラッチパルス制御部３と、を備える。
【００１７】
エラー検出部１は、受信画像データから画素ごとのエラーチェックデータＥＣ０を生成し、その受信画像データの画素ごとに付加されているエラーチェックデータＥＣと比較して、その両者が不一致であるときに転送エラーを検出したと判定する。
【００１８】
ラッチ２は、１ライン分の受信画像データを、画素単位のラッチパルスに応じて、画素単位で格納する。すなわち、１ラインにｍ個の画素が含まれるとすると、ラッチ２は、それぞれの画素のＲ、Ｇ、Ｂデータを格納するラッチＬＴ１〜ＬＴｍにより構成される。
【００１９】
このラッチ２出力はＤＡコンバータ（不図示）により、ＬＣＤへ出力する階調電圧に変換される。
【００２０】
ラッチパルス制御部３は、ラッチ２を構成するラッチＬＴ１〜ＬＴｍのそれぞれに対する基本のラッチパルスであるＣＫ１〜ＣＫｍの入力を受けて、ラッチＬＴ１〜ＬＴｍへ供給するラッチパルスＣＰ１〜ＣＰｍの生成を制御する。
【００２１】
そのとき、エラー検出部１により転送エラーが検出されたときは、その転送エラーが検出された画素のデータをラッチが格納しないよう、画素単位で該画素に対応するラッチへのラッチパルスの伝送を抑止する。
【００２２】
ただし、受信画像データが１ライン目の画像データであることを示すＬｉｎｅ１信号が入力されたときは、ラッチパルス伝送の抑止は行わない。
【００２３】
図３に、エラー検出部１の内部構成の例を示す。
【００２４】
図３に示す例では、エラー検出部１は、シリアルーパラレル変換部１００から出力されたＲ、Ｇ、ＢデータからエラーチェックデータＥＣ０を生成するエラーチェックデータ生成部１１と、エラーチェックデータ生成部１１により生成されたエラーチェックデータＥＣ０をシリアルーパラレル変換部１００から出力されたエラーチェックデータＥＣと比較する比較部１２と、から構成される。
【００２５】
比較部１２は、その比較結果をエラー検出信号ＥＲＲとして出力する。ここでは、ＥＣ０≠ＥＣのとき、すなわち、Ｒ、Ｇ、Ｂデータに転送エラーがあった場合に、エラー検出信号ＥＲＲ＝‘０’（転送エラーあり）を出力するものとし、ＥＣ０＝ＥＣのときは、エラー検出信号ＥＲＲ＝‘１’（転送エラーなし）を出力するものとする。
【００２６】
図４に、ラッチパルス制御部３の内部構成の例を示す。なお、ここでは、受信画像データが１ライン目の画像データであるとき、Ｌｉｎｅ１＝‘１’が入力されるものとする。
【００２７】
ラッチパルス制御部３は、エラー検出部１から出力されるエラー検出信号ＥＲＲとＬｉｎｅ１信号が入力されるＯＲゲートＯＲ１と、ラッチ２を構成するラッチＬＴ１〜ＬＴｍのそれぞれに対する基本のラッチパルスＣＫ１〜ＣＫｍとＯＲゲートＯＲ１の出力がそれぞれ入力されるＡＮＤゲートＡＮ１〜ＡＮｍと、から構成される。
【００２８】
ＡＮＤゲートＡＮ１〜ＡＮｍの出力が、ラッチＬＴ１〜ＬＴｍのそれぞれに供給するラッチパルスＣＰ１〜ＣＰｍとなる。
【００２９】
ＯＲゲートＯＲ１は、Ｌｉｎｅ１＝‘１’、すなわち、受信画像データが１ライン目の画像データであるとき、‘１’を出力する。したがって、このとき、ＡＮＤゲートＡＮ１〜ＡＮｍの出力ＣＰ１〜ＣＰｍには、基本のラッチパルスＣＫ１〜ＣＫｍが、そのまま出力される。
【００３０】
一方、Ｌｉｎｅ１＝‘０’、すなわち、受信画像データが２ライン目以降の画像データであるときは、ＯＲゲートＯＲ１の出力は、エラー検出信号ＥＲＲの値によって変化する。
【００３１】
このとき、エラー検出信号ＥＲＲ＝‘１’（転送エラーなし）であるときは、ＯＲゲートＯＲ１の出力＝‘１’となる。したがって、この場合、ＡＮＤゲートＡＮ１〜ＡＮｍの出力ＣＰ１〜ＣＰｍには、基本のラッチパルスＣＫ１〜ＣＫｍが、そのまま出力される。
【００３２】
これに対して、エラー検出信号ＥＲＲ＝‘０’（転送エラーあり）であるときは、ＯＲゲートＯＲ１の出力＝‘０’となる。この場合、ＡＮＤゲートＡＮ１〜ＡＮｍの出力ＣＰ１〜ＣＰｍは‘０’となり、ラッチパルスＣＫ１〜ＣＫｍのラッチＬＴ１〜ＬＴｍへの伝送が抑止される。
【００３３】
ラッチパルスＣＰ１〜ＣＰｍが‘０’のとき、ラッチＬＴ１〜ＬＴｍへにおけるデータの書き替えは発生しない。
【００３４】
図５に、ラッチパルス制御部３の動作の例を波形図で示す。
【００３５】
Ｌｉｎｅ１＝‘１’、すなわち、受信画像データが１ライン目の画像データであるときは、例えば２画素目の画像データにエラーが検出されて、エラー検出信号ＥＲＲに‘０’が出力されても、２画素目のラッチＬＴ２に対するラッチパルスＣＰ２には、基本のラッチパルスＣＫ２が、そのまま出力される。
【００３６】
したがって、この場合、２画素目のラッチＬＴ２には、転送エラーのある画素データが書き込まれことになるが、１ライン目は画面の上端部であり、画像データにエラーがあっても目立たず、視覚的には殆ど問題が生じない。
【００３７】
一方、Ｌｉｎｅ１＝‘０’、すなわち、受信画像データが２ライン目以降の画像データであるときに、例えば２画素目の画像データにエラーが検出されて、エラー検出信号ＥＲＲに‘０’が出力されたとする。この場合、２画素目のラッチＬＴ２に対するラッチパルスＣＰ２は、基本のラッチパルスＣＫ２の伝達が抑止され、‘０’が出力される。
【００３８】
したがって、この場合、２画素目のラッチＬＴ２への、転送エラーのある画素データの書き込みは発生しない。この場合、２画素目のラッチＬＴ２には、以前に書き込まれた画素データが、そのまま保持される。
【００３９】
図６に、上述のような転送エラーが検出されたときのラッチ２の出力の様子を示す。
【００４０】
いま、ラッチ２のラッチＬＴ１〜ＬＴｍにｎライン目の画素データＤ１ｎ〜Ｄｍｎが書き込まれているときに、ｎ＋１ライン目の画像データＤ１ｎ＋１〜Ｄｍｎ＋１を受信し、その２画素目の画素データＤ２ｎ＋１に転送エラーが検出されたとする。
【００４１】
この場合、２画素目のラッチＬＴ２へは、画素データＤ２ｎ＋１の書き込みが行われず、１ライン前の画素データＤ２ｎがそのまま保持される。
【００４２】
すなわち、ｎ＋１ライン目のラッチ２の出力の２画素目には、転送エラーが検出された画素データＤ２ｎ＋１の代わりに、１ライン前の画素データＤ２ｎが出力される。
【００４３】
一般に、上下の画素間の画素データの相関性は高いので、転送エラーが検出された画素データＤ２ｎ＋１を表示するよりも、１ライン前の画素データＤ２ｎを表示した方が、表示画質の劣化を防止することができる。
【００４４】
このような本実施例によれば、受信画像データの画素ごとに転送エラー発生有無の検出を行い、転送エラーの発生を検出したときは、その画素データを格納するラッチへのラッチパルスの伝送を抑止する。その結果、そのラッチには１ライン前の画素データが保持される。これにより、転送エラーの発生した画素データの代わりに、現ラインの画素データとの相関性が高い前ラインの画素データを出力でき、表示画像の視覚上の画質の劣化を防止することができる。
【００４５】
また、転送エラーが発生しても、ラッチパルスの制御を行うのみでよく、画像データの再送などを必要としないため、ＴＶ放送の表示などの高速動作を行うことができる。
【実施例２】
【００４６】
図７は、本発明の実施例２に係るＬＣＤドライバの構成の例を示すブロック図である。
【００４７】
本実施例では、ラッチ２のラッチＬＴ１〜ＬＴｍのそれぞれを、上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵと、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬと、に分割する。
【００４８】
例えば、各画素のＲ、Ｇ、Ｂデータが８ビット（［７：０］）である場合、その上位側の４ビット（［７：４］）を上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵに格納し、下位側の４ビット（［３：０］）を下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬに格納する。
【００４９】
このとき、上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵへ供給するラッチパルスのみを、ラッチパルス制御部３から出力されるＣＰ１〜ＣＰｍとし、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬへ供給するラッチパルスは、基本のラッチパルスであるＣＫ１〜ＣＫｍとする。
【００５０】
したがって、本実施例では、受信画像データに転送エラーが発生した場合、上位ビット側ラッチのＬＴ１Ｕ〜ＬＴｍＵへのデータの書き換えは発生しないが、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬへのデータの書き換えは発生する。
【００５１】
これにより、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬへ誤りデータが書き込まれる可能性はある。しかし、ＤＡ変換後の階調出力電圧は、上位側ビットで表示データの値が概ね決まるので、下位ビットデータの誤りが画質へ与える影響は小さく、視覚的には問題にならない。
【００５２】
図８に、画像データが８ビットである場合の、上位側ビットと階調出力電圧の関係をグラフで示す。
【００５３】
図８に示すように、ＤＡ変換後の階調出力電圧は、上位側ビットで表示データの値が概ね決まるので、上位側ビットにのみ転送エラーに対する対策を施せば、すなわち、前ラインの画素データの保持を行えば、視覚上の画質の劣化を防止することができる。
【００５４】
このような本実施例によれば、ラッチパルス制御部３は、上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵへのみラッチパルスを供給すればよいので、出力負荷が減少し、高速動作への余裕を持つことができる。
【実施例３】
【００５５】
各画素のＲ、Ｇ、Ｂデータのビット数が多い場合、その全ビットからエラーチェックデータＥＣを生成しようとすると、エラーチェックデータＥＣのビット数も増加する。その結果、エラーチェックする回路の規模も大きくなり、転送データの量も多くなる。転送データの量が増加すると、転送速度をさらに上げることが必要となり、消費電流の増加に繋がる。
【００５６】
しかし、図８に示すように、階調電圧の大きさは、上位側ビットで概ね決定される。したがって、Ｒ、Ｇ、Ｂデータの上位側ビットの転送エラーの検出さえ行えば、表示画像の品質を確保することができる。
【００５７】
そこで、本実施例では、受信画像データの画素ごとに付加されるエラーチェックデータＥＣが、画素データの上位側ビットから生成されるものとする。
【００５８】
図９は、本発明の実施例３に係るＬＣＤドライバの構成の例を示すブロック図である。
【００５９】
本実施例では、受信画像データの画素ごとに付加されるエラーチェックデータＥＣが画素データの上位側ビットから生成されるのに対応して、エラー検出部１へ入力されるデータは、画素データの上位側ビットのデータのみとなる。例えば、各画素のＲ、Ｇ、Ｂデータが１０ビット（［９：０］）である場合、その上位側の５ビット（［９：５］）のデータのみが、エラー検出部１へ入力される。
【００６０】
エラー検出部１では、この５ビットのデータからエラーチェックデータＥＣ０を生成し、シリアルーパラレル変換部１００から出力されるエラーチェックデータＥＣと比較することにより、転送エラーの検出を行う。
【００６１】
図１０は、ＬＣＤへの画像データ転送に使用されることが多い、ｍｉｎｉ−ＬＶＤＳフォーマットによるデータ転送の例である。ｍｉｎｉ−ＬＶＤＳでは、クロックおよび画像データが、小振幅の差動信号として伝送される。
【００６２】
このｍｉｎｉ−ＬＶＤＳで各１０ビットのＲ、Ｇ、Ｂデータ、計３０ビットを転送する場合、４つの差動端子、Ｄ０＋／−、Ｄ１＋／−、Ｄ２＋／−、Ｄ３＋／−を用いて、１画素を３２ビットのデータとして取り扱うことが一般的に行われる。そのため、３０ビットのＲ、Ｇ、Ｂデータに対して、２ビットの空きビットが生じる、
通常、この２ビットには、ダミーデータが挿入されるが、本実施例では、この２ビットにエラーチェックデータＥＣ１、ＥＣ２を挿入するようにする。
【００６３】
これにより、転送データのビット数を増加させることなく、エラーチェックデータＥＣを伝送することができる
このような本実施例によれば、画素データの上位側ビットからエラーチェックデータＥＣが生成されるので、エラーチェックデータＥＣのビット数を少なくすることができ、例えば、ｍｉｎｉ−ＬＶＤＳの空きビットを活用して、効率よくデータを転送することができる。
【実施例４】
【００６４】
図１１は、本発明の実施例４に係るＬＣＤドライバの構成の例を示すブロック図である。
【００６５】
本実施例は、実施例３のＬＣＤドライバのラッチ２を、実施例２と同様、上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵと、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬとに分割し、上位ビット側ラッチＬＴ１Ｕ〜ＬＴｍＵへ供給するラッチパルスをラッチパルス制御部３から出力されるＣＰ１〜ＣＰｍとし、下位ビット側ラッチＬＴ１Ｌ〜ＬＴｍＬへ供給するラッチパルスを基本のラッチパルスであるＣＫ１〜ＣＫｍとしたものである。
【００６６】
これにより、本実施例のＬＣＤドライバは、実施例３のＬＣＤドライバの有する効果に、さらに、実施例２のＬＣＤドライバの有する効果を持たせることができる。
【符号の説明】
【００６７】
１  エラー検出部
２  ラッチ
３  ラッチパルス制御部
１１  エラーチェックデータ生成部
１２  比較部
ＡＮ１〜ＡＮｍ  ＡＮＤゲート
ＯＲ１  ＯＲゲート
【図１】
2010243776.tif 000003
【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
2010243776.tif 000011
【図１０】
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【図１１】
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