(57)【要約】【課題】  ＩＩＩ族窒化物半導体により構成された半導体基板において、ダメージが少ないｃ面を露出させる技術を提供する。【解決手段】  半導体装置の製造方法は、ＩＩＩ族窒化物半導体により構成されており、主面がｃ面である半導体基板を準備する工程と、主面をドライエッチングすることにより、主面に溝部を形成する工程と、半導体基板のｃ面に対するエッチングレートが半導体基板のｃ面以外の面に対するエッチングレートよりも低いエッチング液を用いて溝部の内面をウェットエッチングすることにより、エッチング領域内に半導体基板のｃ面を露出させる工程を有する。【選択図】図５
2020188165.tif 000002
【特許請求の範囲】
【請求項１】
半導体装置の製造方法であって、
ＩＩＩ族窒化物半導体により構成されており、主面がｃ面である半導体基板を準備する工程と、
前記主面をドライエッチングすることにより、前記主面に溝部を形成する工程と、
前記半導体基板のｃ面に対するエッチングレートが前記半導体基板のｃ面以外の面に対するエッチングレートよりも低いエッチング液を用いて前記溝部の内面をウェットエッチングすることにより、エッチング領域内に前記半導体基板のｃ面を露出させる工程、
を有する、製造方法。
【請求項２】
前記半導体基板内にソース領域とドレイン領域を形成する工程であって、前記ウェットエッチングにより露出した前記ｃ面が前記ソース領域と前記ドレイン領域の間に位置するように前記ソース領域と前記ドレイン領域を形成する工程と、
前記ソース領域と前記ドレイン領域の間に位置する前記ｃ面に対向する位置に配置されたゲート電極を形成する工程、
をさらに有する、請求項１に記載の製造方法。
【請求項３】
前記ソース領域と前記ドレイン領域を形成する工程では、前記溝部の底面の位置に前記ソース領域と前記ドレイン領域の少なくとも一方を形成する、請求項２に記載の製造方法。
【請求項４】
前記主面に前記溝部を形成する工程では、前記主面に第１溝部と第２溝部を形成し、
前記ソース領域と前記ドレイン領域を形成する工程では、前記第１溝部の底面の位置に前記ソース領域を形成し、前記第２溝部の底面の位置に前記ドレイン領域を形成する、
請求項３に記載の製造方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本明細書に開示の技術は、半導体装置の製造方法に関する。
【背景技術】
【０００２】
特許文献１には、ＩＩＩ族窒化物半導体により構成された半導体基板を有する半導体装置が開示されている。この半導体装置は、半導体基板の上面に設けられた溝部と、溝部の側面を覆うゲート絶縁膜と、ゲート絶縁膜の表面を覆うゲート電極を有している。半導体基板が、ｎ型のソース領域と、ｐ型のボディ領域と、ｎ型のドレイン領域を有している。ソース領域が半導体基板の上面と溝部の側面に露出している。ボディ領域がソース領域の下側で溝部の側面に露出している。ドレイン領域がボディ領域の下側で溝部の側面に露出している。
【０００３】
この半導体装置の製造方法では、まず、ドレイン領域とボディ領域とソース領域が積層された半導体基板を準備する。そして、半導体基板の上面（すなわち、ｃ面）をドライエッチングすることにより、その側面にソース領域、チャネル領域及びドレイン領域が露出する溝部を形成する。このとき、溝部の側面には、ｃ面以外の面（無極性面や半極性面）が露出する。次いで、溝部の側面をウェットエッチングすることにより、ドライエッチングに起因するダメージ層を除去する。その後、ゲート絶縁膜、ゲート電極等を形成することにより、半導体装置が完成する。特許文献１の半導体装置では、ドライエッチングに起因するダメージ層が除去されるので、溝部の側面（すなわち、半導体基板）とゲート絶縁膜の界面準位を低減することができる。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２００８−２０５４１４号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
ＩＩＩ族窒化物半導体では、ｃ面をウェットエッチングすることが難しい。このため、ｃ面にダメージが存在する場合に、ｃ面に形成されたダメージ層をウェットエッチングにより除去することが難しい。このため、従来は、ＩＩＩ族窒化物半導体において表層部のダメージ層を除去する場合にはｃ面以外の面を露出させる必要があり、半導体装置の設計が制限されるという問題があった。本明細書は、ＩＩＩ族窒化物半導体により構成された半導体基板において、ダメージが少ないｃ面を露出させる技術を提供する。
【課題を解決するための手段】
【０００６】
本明細書が開示する半導体装置の製造方法は、ＩＩＩ族窒化物半導体により構成されており、主面がｃ面である半導体基板を準備する工程と、前記主面をドライエッチングすることにより、前記主面に溝部を形成する工程と、前記半導体基板のｃ面に対するエッチングレートが前記半導体基板のｃ面以外の面に対するエッチングレートよりも低いエッチング液を用いて前記溝部の内面をウェットエッチングすることにより、エッチング領域内に前記半導体基板のｃ面を露出させる工程を有する。
【０００７】
上記の製造方法では、まず、ドライエッチングにより半導体基板の主面（ｃ面）に溝部を形成する。これにより、形成された溝部の側面には、ｃ面以外の面が露出する。そして、溝部の内面に対してウェットエッチングを実施する。ウェットエッチングは、ｃ面に対するエッチングレートが、ｃ面以外の面に対するエッチングレートよりも低いエッチング液を用いて実施される。溝部の側面はｃ面以外の面であるので、当該側面はウェットエッチングによりエッチングが進行する。溝部の側面がエッチングされると、溝部の側面と底面の境界部にｃ面が露出する。露出したｃ面ではエッチングが進行し難いので、ｃ面が露出した状態が維持される。このため、溝部の側面のエッチングが進行するほど、ｃ面の露出する範囲が拡大する。したがって、エッチング後の表面にｃ面を露出させることができる。ウェットエッチングでは、エッチング後の表面にダメージが生じ難い。このため、この方法によれば、ダメージが少ないｃ面を露出させることができる。
【図面の簡単な説明】
【０００８】
【図１】半導体装置１０の断面図。
【図２】半導体装置１０の製造工程を説明するための図。
【図３】半導体装置１０の製造工程を説明するための図。
【図４】半導体装置１０の製造工程を説明するための図。
【図５】半導体装置１０の製造工程を説明するための図。
【図６】半導体装置１０の製造工程を説明するための図。
【図７】溝部を形成する領域の一例を説明するための半導体基板１２の平面図。
【図８】溝部を形成する領域の一例を説明するための半導体基板１２の平面図。
【図９】半導体装置１００の断面図。
【発明を実施するための形態】
【０００９】
（実施例１）
図１を参照して、実施例１の半導体装置１０について説明する。半導体装置１０は、半導体基板１２、ソース電極１４、ドレイン電極１６、ゲート電極１８、ゲート絶縁膜２０及び層間絶縁膜２１、２２を備える。本実施例では、半導体装置１０は、ＭＯＳＦＥＴ（Metal-Oxide-Semiconductor Field-Effect Transistor）である。
【００１０】
半導体基板１２は、ＩＩＩ族窒化物半導体により構成されている。ＩＩＩ族窒化物半導体としては、例えば、ＧａＮ（窒化ガリウム）が挙げられる。半導体基板１２は、上面１２ａ及び下面１２ｂを有している。半導体基板１２の上面１２ａは、ｃ面である。半導体基板１２には、ソース領域３０、ボディ領域３２、ドレイン領域３４及びｎ型領域３６が設けられている。
【００１１】
ソース領域３０は、ｎ型である。ソース領域３０は、半導体基板１２の上面１２ａの一部に露出する範囲に設けられている。
【００１２】
ドレイン領域３４は、ｎ型である。ドレイン領域３４は、半導体基板１２の上面１２ａの一部に露出する範囲に設けられている。ドレイン領域３４は、ソース領域３０から間隔を空けて設けられている。
【００１３】
ボディ領域３２は、ｐ型である。ボディ領域３２は、半導体基板１２の上面１２ａに露出する範囲から、ソース領域３０及びドレイン領域３４の下側まで伸びている。ボディ領域３２は、ソース領域３０の周囲、及び、ドレイン領域３４の周囲を囲っている。ボディ領域３２によって、ソース領域３０とドレイン領域３４が分離されている。
【００１４】
ｎ型領域３６は、ボディ領域３２の下側に配置されている。ｎ型領域３６は、半導体基板１２の下面１２ｂに露出している。ｎ型領域３６は、ボディ領域３２によって、ソース領域３０及びドレイン領域３４から分離されている。
【００１５】
半導体基板１２の上面１２ａには、ゲート絶縁膜２０及び層間絶縁膜２１、２２が設けられている。ゲート絶縁膜２０は、ソース領域３０とドレイン領域３４の間の範囲において半導体基板１２の上面１２ａを覆っている。層間絶縁膜２１は、ソース領域３０近傍の範囲（ドレイン領域３４とは反対側の範囲）において、半導体基板１２の上面１２ａを覆っている。層間絶縁膜２２は、ドレイン領域３４の近傍の範囲（ソース領域３０とは反対側の範囲）において、半導体基板１２の上面１２ａを覆っている。ゲート絶縁膜２０及び層間絶縁膜２１、２２は、例えば、二酸化ケイ素（ＳｉＯ２）によって構成されている。
【００１６】
ソース電極１４は、層間絶縁膜２１の上面と半導体基板１２の上面１２ａに跨る範囲に設けられている。ソース電極１４は、ソース領域３０が露出する範囲（すなわち、層間絶縁膜２１とゲート絶縁膜２０の間の範囲）で半導体基板１２の上面１２ａに接している。
【００１７】
ドレイン電極１６は、層間絶縁膜２２の上面と半導体基板１２の上面１２ａに跨る範囲に設けられている。ドレイン電極１６は、ドレイン領域３４が露出する範囲で半導体基板１２の上面１２ａに接している。
【００１８】
ゲート電極１８は、ゲート絶縁膜２０の上面に設けられている。ゲート電極１８は、ソース領域３０とドレイン領域３４の間の範囲で、ボディ領域３２に対してゲート絶縁膜２０を介して対向している。ゲート電極１８は、ゲート絶縁膜２０によって半導体基板１２から絶縁されている。ソース電極１４、ドレイン電極１６及びゲート電極１８は、互いに絶縁されている。ソース電極１４、ドレイン電極１６及びゲート電極１８は、例えば、アルミニウム（Ａｌ）によって構成されている。
【００１９】
次に、半導体装置１０の動作について説明する。半導体装置１０の使用時には、半導体装置１０と負荷（例えば、モータ）と電源が直列に接続される。半導体装置１０と負荷の直列回路に対して、電源電圧が印加される。半導体装置１０のドレイン電極１６側がソース電極１４側よりも高電位となる向きで、電源電圧が印加される。ゲート電極１８にオン電位（ゲート閾値以上の電位）を印加すると、ゲート絶縁膜２０に接する範囲のボディ領域３２にチャネルが形成され、半導体装置１０がオンする。ゲート電極１８にオフ電位（ゲート閾値未満の電位）を印加すると、チャネルが消滅し、半導体装置１０がオフする。
【００２０】
続いて、本実施例の半導体装置１０の製造方法について説明する。まず、図２に示すように、上面がｃ面であり、ｎ型のＧａＮにより構成された基板（ｎ型領域３６）を準備する。そして、ｎ型領域３６の上面に、ｐ型のＧａＮ層４０をエピタキシャル成長により形成する。ＧａＮ層４０は、ｎ型領域３６のｃ面上に形成される。このため、形成されたＧａＮ層４０の上面もｃ面となる。以下では、ｎ型領域３６及びＧａＮ層４０の全体を半導体基板１２という。
【００２１】
次に、図３に示すように、半導体基板１２の上面に、複数の開口部４２ａを有するマスク４２を形成する。各開口部４２ａは、ソース領域３０を形成すべき範囲の上部、及び、ドレイン領域３４を形成すべき範囲の上部に設けられる。そして、マスク４２を介して半導体基板１２をドライエッチングすることによって、半導体基板１２の上面に溝部４４、４６を形成する。溝部４４、４６の深さは、ＧａＮ層４０の厚みよりも小さい。半導体基板１２の上面がｃ面であるので、半導体基板１２の上面と交わる面である溝部４４、４６の側面４４ａ、４６ａにはｃ面以外の面が露出する。この工程では、溝部４４、４６の底面に露出する範囲にドライエッチングに起因するダメージ層６０が形成される。ドライエッチング後に、マスク４２を除去する。
【００２２】
次に、マスク４２を除去した後に、図４に示すように、複数の開口部４８ａを有するマスク４８を、例えばプラズマＣＶＤ（Chemical Vapor Deposition）により形成する。各開口部４８ａは、溝部４４、４６の上部にそれぞれ設けられる。すなわち、各開口部４８ａによって、溝部４４、４６の内面が露出する。マスク４８は、例えば、ＳｉＯ２により構成されている。そして、マスク４８を介して半導体基板１２の上面にｎ型不純物（例えば、Ｓｉ）をイオン注入する。マスク４８が存在する範囲では、マスク４８によってｎ型不純物が遮断される。マスク４８が存在しない範囲（すなわち、開口部４８ａが存在する範囲）では、ｎ型不純物が半導体基板１２に注入される。この工程では、ｎ型不純物が、溝部４４、４６の底面の近傍（すなわち、表層部分）であって、ｎ型領域３６よりも浅い位置に注入されるようにｎ型不純物の照射エネルギーが調整される。ｎ型不純物を半導体基板１２に注入した後、半導体基板１２をアニールして、注入したｎ型不純物を活性化させる。これにより、溝部４４の底面に露出する範囲にソース領域３０となる領域を形成し、溝部４６の底面に露出する範囲にドレイン領域３４となる領域を形成する。ソース領域３０及びドレイン領域３４は、ＧａＮ層４０によってｎ型領域３６から分離される。イオン注入後に、マスク４８を除去する。
【００２３】
次に、図５に示すように、溝部４４、４６の内面をウェットエッチングすることにより、ＧａＮ層４０のｃ面を露出させる。ここでは、ＧａＮ層４０のｃ面に対するエッチングレートが、ＧａＮ層４０のｃ面以外の面に対するエッチングレートよりも低いエッチング液を用いてウェットエッチングを実施する。より詳細には、ＧａＮ層４０のｃ面がほとんどエッチングされないエッチング液を用いる。例えば、エッチング液として、水酸化テトラメチルアンモニウム（ＴＭＡＨ）やリン酸（Ｈ３ＰＯ４）等を用いることができる。上述したように、溝部４４、４６の側面４４ａ、４６ａはｃ面以外の面であるので、当該側面はウェットエッチングによりエッチングが進行する。他方、溝部４４、４６の底面は、ｃ面と略一致するので、ほとんどエッチングされない。溝部４４の側面４４ａがエッチングされると、溝部４４の側面４４ａと底面の境界部にｃ面が露出する。露出したｃ面ではエッチングがほとんど進行しないので、ｃ面が露出した状態が維持される。このため、溝部４４の側面４４ａのエッチングが進行するほど、ｃ面の露出する範囲が拡大する。溝部４６についても同様である。このように、露出したｃ面がＧａＮ層４０の上面全域に広がるまでウェットエッチングを実施する。この工程では、ウェットエッチングによりＧａＮ層４０をエッチングするため、エッチング後のｃ面にダメージが生じ難い。したがって、ウェットエッチング後のＧａＮ層４０の表面（ｃ面）は、溝部４４、４６が存在した範囲（ソース領域３０及びドレイン領域３４が形成された範囲）を除き、ダメージが少ない。なお、ウェットエッチング後に残存するｐ型のＧａＮ層４０がボディ領域３２となる。
【００２４】
次に、図６に示すように、ゲート絶縁膜２０と層間絶縁膜２１、２２をウェットエッチング後のＧａＮ層４０の上面に形成する。例えば、ＧａＮ層４０の上面の略全域を覆う酸化膜を形成した後、酸化膜を選択的にエッチングすることによって、酸化膜をゲート絶縁膜２０と層間絶縁膜２１、２２に分割することができる。ここでは、ゲート絶縁膜２０と層間絶縁膜２１の間にソース領域３０が露出し、ゲート絶縁膜２０と層間絶縁膜２２の間にドレイン領域３４が露出するように、各絶縁膜が形成される。その後、従来公知の方法によりソース電極１４、ドレイン電極１６及びゲート電極１８を形成することにより図１に示す半導体装置１０が完成する。
【００２５】
上述したように、本実施例の製造方法では、まず、ＧａＮ層のｃ面に溝部４４、４６を形成することにより、溝部４４、４６の側面にｃ面以外の面を露出させる。そして、溝部４４、４６の側面をウェットエッチングすることにより、ウェットエッチング後のＧａＮ層４０の表面にｃ面を露出させる。このように、本実施例では、ドライエッチングに起因するダメージ層６０の範囲を小さく抑えつつ、ウェットエッチングによって、ダメージの少ないｃ面を広範囲に露出させることができる。
【００２６】
また、本実施例の製造方法では、ダメージ層６０が存在する領域にソース領域３０及びドレイン領域３４が形成され、ダメージ層６０が存在しない領域に対向する範囲にゲート電極１８が形成される。すなわち、半導体装置１０がオンするときには、チャネルがダメージの少ない領域に形成される。このため、この半導体装置１０は、チャネル抵抗が低い。なお、ソース領域３０及びドレイン領域３４はダメージ層６０を含む領域に形成されるが、半導体装置１０の特性に対する影響はほとんどない。
【００２７】
なお、ｃ面以外の面には、ｍ面、ａ面及びそれ以外の面が存在する。ここで、水酸化テトラメチルアンモニウム（ＴＭＡＨ）やリン酸（Ｈ３ＰＯ４）等をエッチング液として用いる場合には、ウェットエッチングレートは、ａ面＞それ以外の面＞ｍ面の順で小さくなることが知られている。すなわち、ｃ面以外の面では、ｍ面のエッチングレートが最も小さい。このため、ｃ面以外の面に対してウェットエッチングを実施すると、エッチング面にｍ面が露出する。したがって、六方晶構造を有するＧａＮでは、溝の側面をエッチングすると、溝の形状がｍ面を各辺とする六角形の形状となる場合がある。この現象を利用して、ウェットエッチングの効率を向上させることができる。
【００２８】
図７は、半導体基板１２を平面視した図である。図７に示すように、チャネルを形成すべき領域７０を囲むように、半導体基板１２の上面１２ａに正六角形の外周の軌跡である溝部１４４を形成した場合を考える。すなわち、図７では、溝部１４４の内側の領域をウェットエッチングすることにより、ｃ面を露出させる。溝部１４４の角部１４４ａの底面にソース領域が形成され、角部１４４ｂの底面にドレイン領域が形成される。溝部１４４の各辺は、半導体基板１２のｍ面に平行な辺となるように形成される。ウェットエッチングは、ｍ面に対して等方的に進行するため、溝部１４４の内側の領域のエッチングに要する時間は、溝部１４４の対辺の距離Ｌ１をエッチングする時間に等しい。ここで、チャネルが形成される領域におけるダメージが少なければ、他の領域にダメージ層が存在しても半導体装置に対する影響はそれほどない。すなわち、少なくともチャネルを形成すべき領域７０においてウェットエッチングによりｃ面を露出させればよい。そこで、図８に示すように、領域７０の長手方向に平行な対辺の間隔を小さくした溝部２４４を形成した場合を考える。この場合、溝部２４４の内側の領域のエッチングに要する時間は、領域７０の長手方向に平行な対辺の距離Ｌ２をエッチングする時間に等しい。すなわち、溝部２４４の内側の領域をエッチングするために要する時間が、溝部１４４の内側の領域をエッチングするために要する時間よりも短くなる。このように、ドライエッチングにより形成する溝部の対辺の間隔を、チャネルを形成すべき領域７０の幅に近づけることで、ウェットエッチングに要する時間を短縮することができる。
【００２９】
（実施例２）
実施例２の半導体装置１００は、以下に説明する点において、図１の半導体装置１０と異なる。図９に示す半導体装置１００は、ドレイン領域１３４が半導体基板１１２の下面１１２ｂに露出する範囲に設けられており、ドレイン電極１１６が半導体基板１１２の下面１１２ｂに接している。図１に示す半導体装置１０のドレイン領域３４及びドレイン電極１６は、半導体装置１００ではソース領域１３０及びソース電極１１４として機能する。また、半導体装置１００では、半導体装置１０のｎ型領域３６に対応するｎ型領域１３６が、２つのソース領域１３０の間の範囲で半導体基板１１２の上面１１２ａに露出している。すなわち、ボディ領域１３２が、ｎ型領域１３６によって分割されている。半導体装置１００では、ｎ型領域１３６がドリフト領域として機能する。すなわち、半導体装置１００は、縦型のＭＯＳＦＥＴである。
【００３０】
半導体装置１００の製造方法では、実施例１と同様に、溝部を２つのソース領域１３０を形成すべき範囲の上部に形成し（図３参照）、当該溝部の内面をウェットエッチングすることによって、ｃ面を露出させる（図５参照）。そして、ウェットエッチングにより露出したｃ面（ダメージが少ない領域）に対向する範囲にゲート電極１８が形成される。このため、この半導体装置１００においても、半導体装置１００がオンするときに、ダメージの少ない領域にチャネルが形成される。したがって、半導体装置１００は、チャネル抵抗が低い。
【００３１】
上述した各実施例では、ＭＯＳＦＥＴについて説明したが、ＩＧＢＴに本明細書に開示の技術を適用してもよい。ｎ型のドレイン領域１３４に代えて、ｐ型領域を設けることで、ＩＧＢＴの構造を得ることができる。
【００３２】
（参考例）
一般的に、上述したような各半導体装置は、半導体ウェハの内部に複数の半導体装置を形成した後、ダイシングにより半導体ウェハを複数のチップに分割することにより製造される。半導体ウェハをダイシングすると、ダイシングされた面から不要な金属元素がチップの内部に取り込まれ、チップが汚染される場合がある。本明細書に開示の技術は、このような金属汚染を除去する際にも有用である。例えば、半導体ウェハの主面をｃ面とした場合、分割されたチップの側面に対して本明細書に開示のウェットエッチングを実施してもよい。上述したように、本明細書に開示のウェットエッチングでは、主にｃ面以外の面に対するエッチングが進行する。したがって、上面がｃ面により構成されているチップの側面に対してウェットエッチングを実施することにより、上面（ｃ面）をほとんどエッチングすることなく側面をエッチングすることができる。このため、チップの洗浄のみでは取り除くことが困難であったチップ内部に取り込まれた金属元素を除去することができる。
【００３３】
本明細書が開示する技術要素について、以下に列記する。なお、以下の各技術要素は、それぞれ独立して有用なものである。
【００３４】
本明細書が開示する一例の製造方法では、半導体基板内にソース領域とドレイン領域を形成する工程であって、ウェットエッチングにより露出したｃ面がソース領域とドレイン領域の間に位置するようにソース領域とドレイン領域を形成する工程と、ソース領域とドレイン領域の間に位置するｃ面に対向する位置に配置されたゲート電極を形成する工程をさらに有してもよい。
【００３５】
このような構成では、ソース領域とドレイン領域の間の領域が、ダメージの少ない領域となる。この領域に対向するゲート電極を形成することによって、半導体装置をオンしたときに、ダメージの少ない領域にチャネルを形成することができる。このため、チャネル抵抗が低減する。なお、ダメージの比較的多い領域にソース領域やドレイン領域を形成しても、半導体装置の特性にはそれほど影響しない。
【００３６】
本明細書が開示する一例の製造方法では、ソース領域とドレイン領域を形成する工程では、溝部の底面の位置にソース領域とドレイン領域の少なくとも一方を形成してもよい。
【００３７】
本明細書が開示する一例の製造方法では、主面に溝部を形成する工程では、主面に第１溝部と第２溝部を形成してもよく、ソース領域とドレイン領域を形成する工程では、第１溝部の底面の位置にソース領域を形成し、第２溝部の底面の位置にドレイン領域を形成してもよい。
【００３８】
以上、本発明の具体例を詳細に説明したが、これらは例示に過ぎず、特許請求の範囲を限定するものではない。特許請求の範囲に記載の技術には、以上に例示した具体例を様々に変形、変更したものが含まれる。本明細書または図面に説明した技術要素は、単独であるいは各種の組み合わせによって技術的有用性を発揮するものであり、出願時請求項記載の組み合わせに限定されるものではない。また、本明細書または図面に例示した技術は複数目的を同時に達成するものであり、そのうちの一つの目的を達成すること自体で技術的有用性を持つものである。
【符号の説明】
【００３９】
１０：半導体装置、１２：半導体基板、１２ａ：上面、１２ｂ：下面、１４：ソース電極、１６：ドレイン電極、１８：ゲート電極、２０：ゲート絶縁膜、２１、２２：層間絶縁膜、３０：ソース領域、３２：ボディ領域、３４：ドレイン領域、３６：ｎ型領域、４０：ＧａＮ層、４４、４６：溝部、６０：ダメージ層
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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