(57)【要約】【課題】外部から同期制御することが難しいデバイスを効率的に試験可能な試験装置、試験方法を提供する。【解決手段】試験装置２００は、外部からの同期制御が不可能なＤＵＴ１１０を検査対象とする。メインコントローラ２１０は、それ自身が主導権を有する同期制御によってデバイスを検査するアーキテクチャをベースとしている。ＭＩＵ２２０は、メインコントローラ２１０とＤＵＴ１１０の間に介在し、ＤＵＴ１１０との間において、ＤＵＴ１１０が主導権を有する非同期制御を成立させつつ、メインコントローラ２１０との間において、メインコントローラ２１０が主導権を有する制御を成立させる。【選択図】図２
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【特許請求の範囲】
【請求項１】
デバイス側通信回路と、プログラム制御可能なデバイス側プロセッサと、を有する被試験デバイスの試験装置であって、
前記試験装置を統合的に制御するメインコントローラと、
プログラム制御可能なテスター側プロセッサと、前記デバイス側通信回路との間で伝送チャンネルを形成するテスター側通信回路と、を含むインタフェースユニットと、
を備え、
前記デバイス側プロセッサがデバイス用スクリプトを実行することにより、前記被試験デバイスが主導権を有する非同期の試験が行われることを特徴とする試験装置。
【請求項２】
試験に先立って前記試験装置から前記被試験デバイスに、前記デバイス用スクリプトをロード可能であることを特徴とする請求項１に記載の試験装置。
【請求項３】
前記デバイス用スクリプトのロードは、前記デバイス側通信回路と前記テスター側通信回路の間のインタフェースとは別の、有線のインタフェースを介して行われることを特徴とする請求項２に記載の試験装置。
【請求項４】
前記デバイス側通信回路と前記テスター側通信回路はＩ２Ｃ（Inter IC）またはＳＰＩ（Serial Peripheral Interface）に準拠し、マスター、スレーブの関係は入れ替え可能であることを特徴とする請求項１から３のいずれかに記載の試験装置。
【請求項５】
前記インタフェースユニットは、前記伝送チャンネルを介して前記テスター側通信回路が受信したデータにもとづいて前記被試験デバイスの良否を判定し、判定結果が前記メインコントローラに提供されることを特徴とする請求項１から４のいずれかに記載の試験装置。
【請求項６】
前記テスター側プロセッサは、前記デバイス用スクリプトとともに試験のシーケンスを規定するテスター用スクリプトを実行することを特徴とする請求項１から５のいずれかに記載の試験装置。
【請求項７】
外部からの同期制御が不可能な被試験デバイスの試験装置であって、
それ自身が主導権を有する同期制御によって前記被試験デバイスを検査するアーキテクチャをベースとしているメインコントローラと、
前記メインコントローラと前記被試験デバイスの間に介在し、前記被試験デバイスとの間において、前記被試験デバイスが主導権を有する非同期制御を成立させつつ、前記メインコントローラとの間において、前記メインコントローラが主導権を有する制御を成立させるインタフェースユニットと、
を備えることを特徴とする試験装置。
【請求項８】
外部からの同期制御が不可能な被試験デバイスの試験装置に使用されるインタフェースユニットであって、
前記試験装置が主導権を有する同期制御によって前記被試験デバイスを検査するアーキテクチャをベースとしているメインコントローラとともに用いられ、
前記メインコントローラと前記被試験デバイスの間に介在し、前記被試験デバイスとの間において、前記被試験デバイスが主導権を有する非同期制御を成立させつつ、前記メインコントローラとの間において、前記メインコントローラが主導権を有する制御を成立させることを特徴とするインタフェースユニット。
【請求項９】
デバイス側通信回路と、プログラム制御可能なデバイス側プロセッサとを有する被試験デバイスの試験方法であって、
前記被試験デバイスにデバイス用スクリプトをロードするステップと、
前記被試験デバイスにおいて前記デバイス側プロセッサが前記デバイス用スクリプトを実行するステップと、
前記デバイス用スクリプトにもとづいて生成されるデータを、前記デバイス側通信回路が、試験装置に送信するステップと、
前記試験装置が前記データにもとづいて前記被試験デバイスの良否を判定するステップと、
を備えることを特徴とする試験方法。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、試験装置に関する。
【背景技術】
【０００２】
大量生産される半導体デバイスの検査に、半導体試験装置（ＡＴＥ：Automatic Test Equipment、以下、単に試験装置という）が用いられる。試験装置は、被試験デバイス（ＤＵＴ:Device Under Test）に試験信号を与え、被試験デバイスから、試験信号に応じたレスポンスを取得し、得られたレスポンスが期待値と等しいか否かを判定する。
【０００３】
従来におけるＤＵＴの代表例は、外部からの制御下で受動的に動作するメモリである。試験装置はメモリにデータ（テストパターン）を書き込み、続いてメモリからデータを読み出して、読み出したデータが期待値と等しいか否かを判定する。
【０００４】
図１は、従来の試験システム２のアーキテクチャを示す図である。メモリなどのＤＵＴ１０は、試験装置２０からのデータが入力され、また入力された信号にもとづく信号を出力する機能（Ｉ／Ｏ（Input/Output）ブロックという）を有する。またＤＵＴ１０には、同期信号（システムクロック信号）を入力可能であり、Ｉ／Ｏブロックの動作をクロックのサイクル単位で制御可能である。したがって試験装置２０は、クロックのサイクル単位で、ＤＵＴ１０の状態を逐一知ることができ、また制御することができた。これにより、従来の試験システム２では、試験装置２０をマスター、ＤＵＴ１０をスレーブとして、クロックサイクルレベルの同期制御が行われている。
【０００５】
試験装置２０は、大量のメモリを効率よく試験できるように開発されてきた経緯があり、したがって、現状の試験装置２０は、試験装置２０が主導権を有する同期制御のアーキテクチャがベースとなっている。
【発明の概要】
【発明が解決しようとする課題】
【０００６】
近年、ＳｏＰ（System on Chip）やＳｉＰ（System in Package）などの、能動的、自律的に動作するデバイス（以下、複合デバイスともいう）の試験のニーズが高まっている。複合デバイスは、（i）プロセッサを有し、ＯＳ（Operating System）がインストールされた最終製品に近いものや、（ii）オシレータを内蔵し、外部からの同期信号を受け付けないもの、などに分類される。
【０００７】
複合デバイスにおけるデータの入出力のタイミングは、試験装置によってクロックサイクルごとに制御することができず、試験装置と複合デバイスの間は非同期制御となる。したがって、同期制御を前提とした従来のメモリ試験のアーキテクチャをそのまま適用すると、試験効率が低下し、スループットが著しく低下する。
【０００８】
本発明は係る状況においてなされたものであり、そのある態様の例示的な目的のひとつは、外部からクロックサイクルレベルでの同期制御することが難しいデバイスを効率的に試験可能な試験装置、試験方法等の提供にある。
【課題を解決するための手段】
【０００９】
本発明のある態様は、試験装置に関する。試験装置は、デバイス側通信回路と、プログラム制御可能なデバイス側プロセッサと、を有する被試験デバイスを検査対象とする。試験装置は、当該試験装置を統合的に制御するメインコントローラと、プログラム制御可能なテスター側プロセッサと、デバイス側通信回路との間で伝送チャンネルを形成するテスター側通信回路と、を含むインタフェースユニットと、を備える。デバイス側プロセッサがデバイス用スクリプトを実行することにより、被試験デバイスが主導権を有する非同期の試験が行われる。
【００１０】
試験に先立って試験装置から被試験デバイスに、デバイス用スクリプトをロード可能であってもよい。
【００１１】
デバイス用スクリプトのロードは、デバイス側通信回路とテスター側通信回路の間のインタフェースとは別の、有線のインタフェースを介して行われてもよい。
【００１２】
デバイス側通信回路とテスター側通信回路はＩ２Ｃ（Inter IC）またはＳＰＩ（Serial Peripheral Interface）に準拠し、マスター、スレーブの関係は入れ替え可能であってもよい。
【００１３】
インタフェースユニットは、伝送チャンネルを介してテスター側通信回路が受信したデータにもとづいて被試験デバイスの良否を判定し、判定結果がメインコントローラに提供されてもよい。
【００１４】
テスター側プロセッサは、デバイス用スクリプトとともに試験のシーケンスを規定するテスター用スクリプトを実行してもよい。
【００１５】
本発明のある態様は試験装置に関する。試験装置は、外部からの同期制御が不可能な被試験デバイスを検査する。試験装置は、それ自身が主導権を有する同期制御によって被試験デバイスを検査するアーキテクチャをベースとしているメインコントローラと、メインコントローラと被試験デバイスの間に介在し、被試験デバイスとの間において、被試験デバイスが主導権を有する非同期制御を成立させつつ、メインコントローラとの間において、メインコントローラが主導権を有する制御を成立させるインタフェースユニットと、を備える。
【００１６】
なお、以上の構成要素の任意の組み合わせや本発明の構成要素や表現を、方法、装置などの間で相互に置換したものもまた、本発明の態様として有効である。
【発明の効果】
【００１７】
本発明のある態様によれば、外部から同期制御することが難しいデバイスを効率的に試験できる。
【図面の簡単な説明】
【００１８】
【図１】従来の試験システムのアーキテクチャを示す図である。
【図２】実施の形態に係る試験システムのブロック図である。
【図３】実施の形態に係る試験システムのブロック図である。
【図４】ファンクション試験における各要素における命令の実行を説明する図である。
【図５】ファンクション試験に関するシーケンス図である。
【図６】ファンクション試験に関する別のシーケンス図である。
【発明を実施するための形態】
【００１９】
以下、本発明を好適な実施の形態をもとに図面を参照しながら説明する。各図面に示される同一または同等の構成要素、部材、処理には、同一の符号を付するものとし、適宜重複した説明は省略する。また、実施の形態は、発明を限定するものではなく例示であって、実施の形態に記述されるすべての特徴やその組み合わせは、必ずしも発明の本質的なものであるとは限らない。
【００２０】
本明細書において、「部材Ａが、部材Ｂと接続された状態」とは、部材Ａと部材Ｂが物理的に直接的に接続される場合のほか、部材Ａと部材Ｂが、それらの電気的な接続状態に実質的な影響を及ぼさない、あるいはそれらの結合により奏される機能や効果を損なわせない、その他の部材を介して間接的に接続される場合も含む。
【００２１】
同様に、「部材Ｃが、部材Ａと部材Ｂの間に設けられた状態」とは、部材Ａと部材Ｃ、あるいは部材Ｂと部材Ｃが直接的に接続される場合のほか、それらの電気的な接続状態に実質的な影響を及ぼさない、あるいはそれらの結合により奏される機能や効果を損なわせない、その他の部材を介して間接的に接続される場合も含む。
【００２２】
図２は、実施の形態に係る試験システム１００のブロック図である。試験システム１００は、ＤＵＴ１１０と試験装置２００を備える。ＤＵＴ１１０は、ＳｉＰやＳｏＣなどの外部から同期制御することが困難なデバイスである。
【００２３】
試験装置２００は、メインコントローラ２１０およびマルチインタフェースユニット（以下、ＭＩＵ）２２０を備える。メインコントローラ２１０は、それ自身が主導権を有する同期制御によってＤＵＴを検査するアーキテクチャをベースとして構成される基幹プラットフォームである。
【００２４】
ＭＩＵ２２０は、メインコントローラ２１０とＤＵＴ１１０の間に設けられる。ＭＩＵ２２０は、メインコントローラ２１０とＤＵＴ１１０の間に介在し、ＤＵＴ１１０との間において、ＤＵＴ１１０が主導権を有する非同期制御を成立させつつ、メインコントローラ２１０とＭＩＵ２２０の間において、メインコントローラ２１０が主導権を有する制御を成立させる。
【００２５】
一実施例において、メインコントローラ２１０は、メモリ試験にも利用可能な既存のハードウェアすなわちＡＴＥであってもよい。ＭＩＵ２２０は、メインコントローラ（ＡＴＥ）２１０とＤＵＴ１１０の間に設けられた追加のハードウェアと捉えることができる。
【００２６】
図３は、実施の形態に係る試験システム１００のブロック図である。ＤＵＴ１１０は、デバイス側プロセッサ１１２およびデバイス側通信回路１１４を備える。デバイス側プロセッサ１１２は、ＭＰＵ（Micro Processing Unit）やＣＰＵ（Central Processing Unit）などのプログラム制御可能なハードウェアである。複合デバイスの一例であるＩｏＴ（Internet of Things）デバイスには、プロセッサとしてARM社が設計するプロセッサコアが実装される場合が多い。ＤＵＴ１１０は、デバイス側プロセッサ１１２に加えて、オシレータ、メモリを内蔵することができる。
【００２７】
デバイス側通信回路１１４は、外部との間でデータを送受信可能な所定の通信プロトコルに準拠する有線あるいは無線のインタフェースである。たとえばデバイス側通信回路１１４は、Ｉ２Ｃ（Inter IC）インタフェース、ＳＰＩ（Serial Peripheral Interface），ＧＰＩＯ（General Purpose Input/Output）、ＵＡＲＴ（Universal Asynchronous Receiver/Transmitter）などの有線シリアルインタフェースであってもよい。あるいはＨＤＭＩ（登録商標）（High-Definition Multimedia Interface）、ＭＩＰＩ（Mobile Industry Processor Interface）、Ｉ２Ｓ（Inter-IC Sound）などの画像や画像を伝送するマルチメディア用のインタフェースであってもよい。あるいはＢｌｕｅｔｏｏｔｈ（登録商標）、ＷｉＦｉ（登録商標）やＺｉｇＢｅｅ（登録商標）などの無線インタフェースであってもよい。
【００２８】
ＭＩＵ２２０は、テスター側プロセッサ２２２およびテスター側通信回路２２４を備える。テスター側プロセッサ２２２は、ＣＰＵ（Central Processing Unit）やマイクロプロセッサ、ＭＰＵ（Micro Processing Unit）などのプログラム制御可能なハードウェアである。
【００２９】
テスター側通信回路２２４は、デバイス側通信回路１１４と同じ通信プロトコルに準拠しており、テスター側通信回路２２４は、デバイス側通信回路１１４との間で有線あるいは無線の伝送チャンネルＣＨを形成する。
【００３０】
テスター側通信回路２２４は、ＦＰＧＡ（Field Programmable Gate Array）で構成してもよいし、ＡＳＩＣ（Application Specific Integrated Circuit）であってもよい。テスター側通信回路２２４によって、ＤＵＴ１１０における処理のレイテンシが吸収され、メインコントローラ２１０とＭＩＵ２２０の間のシーケンス制御のタイミングは維持される。
【００３１】
ＤＵＴ１１０において、デバイス側プロセッサ１１２がデバイス用スクリプト（以下、ＤＵＴスクリプト）ＳＣＲ１を実行する。スクリプトは複数の命令を含むコードであり、プログラムと同義である。この際、ＭＩＵ２２０において、テスター側プロセッサ２２２は、ＤＵＴスクリプトＳＣＲ＿ＤＵＴとともに試験のシーケンスを規定するＭＩＵスクリプトＳＣＲ＿ＭＩＵを実行する。これにより、デバイス側通信回路１１４のファンクション試験が、ＤＵＴ１１０が主導権を有する非同期制御のもとで行われる。
【００３２】
ＤＵＴスクリプトＳＣＲ＿ＤＵＴは、試験に先立って試験装置２００のメインコントローラ２１０からＤＵＴ１１０にロード可能としてもよい。同様に、ＭＩＵスクリプトＳＣＲ＿ＭＩＵは、メインコントローラ２１０からＭＩＵ２２０にロード可能であってもよい。
【００３３】
メインコントローラ２１０とＭＩＵ２２０の間はバスＢ１で接続される。また、ＭＩＵ２２０とＤＵＴ１１０の間はバスＢ２で接続される。バスＢ１，Ｂ２は、ＵＳＢ（Universal Serial Bus）やイーサネット（登録商標）などであり得る。これらのバスＢ１，Ｂ２は、ファンクション試験の対象である伝送チャンネルＣＨとは独立したインタフェースである。バスＢ１は、メインコントローラ２１０が、ＭＩＵ２２０を制御するために利用され、バスＢ２は、ＭＩＵ２２０がＤＵＴ１１０を制御するために利用される。またこれらのバスＢ１，Ｂ２は、ＤＵＴスクリプトＳＣＲ＿ＤＵＴ、ＭＩＵスクリプトＳＣＲ＿ＭＩＵのロードに利用することができる。
【００３４】
続いてデバイス側通信回路１１４のファンクション試験（接続試験）を説明する。図４は、ファンクション試験における各要素における命令の実行を説明する図である。
【００３５】
図４において、メインプログラムＰＲＯＧにもとづく処理、ＤＵＴスクリプトＳＣＲ＿ＤＵＴにもとづく処理、ＭＩＵスクリプトＳＣＲ＿ＭＩＵにもとづく処理には異なるハッチが付されている。
【００３６】
メインコントローラ２１０は、骨格となるテストプログラムＰＲＯＧを格納する。また、ＤＵＴ１１０およびＭＩＵ２２０が実行するスクリプトＳＣＲ１，ＳＣＲ２も、原始的にはメインコントローラ２１０に格納されている。
【００３７】
メインコントローラ２１０において、メインプロセッサ（テスタープロセッサ）がテストプログラムＰＲＯＧの実行開始すると、ＭＩＵ２２０の初期化が実行される（Ｓ１０）。初期化が完了すると、メインコントローラ２１０とＭＩＵ２２０との間で、バスＢ１によるリンクが確立する（Ｓ１１）。そしてバスＢ１を介して、スクリプトＳＣＲ１，ＳＣＲ２が、ＭＩＵ２２０にロードされる（Ｓ１２）。
【００３８】
ＭＩＵ２２０は、ＭＩＵスクリプトＳＣＲ＿ＭＩＵを実行する。ＭＩＵ２２０は、ＭＩＵスクリプトＳＣＲ＿ＭＩＵにもとづいて、ＤＵＴ１１０の初期化を指示する（Ｓ１３）。これによりＤＵＴ１１０との間のバスＢ２のリンクが確立する（Ｓ１４）。そしてバスＢ２を介して、ＤＵＴスクリプトＳＣＲ＿ＤＵＴがＤＵＴ１１０にロードされる（Ｓ１５）。
【００３９】
ＭＩＵ２２０は、テスター用スクリプトＳＣＲ１にもとづく処理を実行するとともに、ＤＵＴ１１０にＤＵＴスクリプトＳＣＲ＿ＤＵＴの開始指示を与える。ＤＵＴ１１０は、ＭＩＵ２２０からの指示をトリガーとして、ＤＵＴスクリプトＳＣＲ＿ＤＵＴにもとづく処理の実行を開始する。
【００４０】
ＭＩＵ２２０は、テスター側通信回路２２４のセットアップＳ１６を行い、ＤＵＴ１１０では、デバイス側通信回路１１４のセットアップＳ１７が行われる。
【００４１】
ＤＵＴスクリプトＳＣＲ＿ＤＵＴの実行により、デバイス側通信回路１１４の機能がテストされる（ファンクション試験）。このファンクション試験では、ＭＩＵ２２０、ＤＵＴ１１０それぞれにおいて、デバイス側通信回路１１４とテスター側通信回路２２４それぞれを制御する命令が実行され、伝送チャンネルＣＨを介して、ＭＩＵ２２０とＤＵＴ１１０の間で伝送される。
【００４２】
データの送受信が完了すると、ＭＩＵ２２０は、ＭＩＵスクリプトＳＣＲ＿ＭＩＵにもとづいて、最終的に得られたデータを期待値と比較し、良否を判定する（Ｓ２０）。この良否判定の結果は、メインコントローラ２１０に送信される（Ｓ２１）。
【００４３】
ＭＩＵ２２０の制御によりＤＵＴ１１０とＭＩＵ２２０のリンクが切断され（Ｓ２２）、メインコントローラ２１０の制御によりメインコントローラ２１０とＭＩＵ２２０のリンクが切断する（Ｓ２３）。
【００４４】
なお図４において、処理に示す符号Ｓ＃の番号＃は、処理の順序を制限するものではない。
【００４５】
図５は、ファンクション試験に関するシーケンス図である。シーケンス図において、メインコントローラ２１０が実行するテストプログラムＰＲＯＧにもとづく処理は二重線で示す。またＭＩＵ２２０が実行するＭＩＵスクリプトＳＣＲ＿ＭＩＵにもとづく処理は太線で示す。またＤＵＴ１１０が実行するＤＵＴスクリプトＳＣＲ＿ＤＵＴにもとづく処理は破線で示す。
【００４６】
メインコントローラ（ＡＴＥ）２１０が、テストプログラムＰＲＯＧの実行を開始する（Ｓ１００）。メインコントローラ２１０はＭＩＵ２２０に、スクリプト群ＳＣＲ０を送信する（Ｓ１０２）。スクリプト群ＳＣＲ０の送信には、バスＢ１が利用される。このスクリプト群ＳＣＲ０は、ＭＩＵ２２０が実行すべきスクリプトＳＣＲ２に加えて、ＤＵＴ１１０が実行すべきスクリプトＳＣＲ１を含む。またこのスクリプト群ＳＣＲ０は、期待値データを含む。
【００４７】
続いてメインコントローラ２１０からＭＩＵ２２０に、ＭＩＵスクリプトＳＣＲ＿ＭＩＵの実行指示が与えられる（Ｓ１０４）。これを受け、ＭＩＵ２２０のテスター側プロセッサ２２２は、ＭＩＵスクリプトＳＣＲ＿ＭＩＵの実行を開始する（Ｓ１０６）。
【００４８】
ＭＩＵスクリプトＳＣＲ＿ＭＩＵにしたがって、ＭＩＵ２２０のテスター側プロセッサ２２２は、ＤＵＴ１１０の初期化を指示し（Ｓ１０８）、これによりＤＵＴ１１０が初期化される（Ｓ１１１０）。この初期化により、ＭＩＵ２２０とＤＵＴ１１０は、バスＢ２による通信が可能となる。
【００４９】
続いて、ＭＩＵスクリプトＳＣＲ＿ＭＩＵにしたがって、ＭＩＵ２２０はＤＵＴ１１０に対して、ＤＵＴスクリプトＳＣＲ＿ＤＵＴを送信する（Ｓ１１２）。ＤＵＴスクリプトＳＣＲ＿ＤＵＴの送信にはバスＢ２が利用される。
【００５０】
またＭＩＵ２２０のテスター側プロセッサ２２２は、テスター側通信回路２２４をスレーブモードにセットし（Ｓ１１４）、テスター側通信回路２２４を、ＤＵＴ１１０からのＩ２Ｃで規定されるプロトコル信号の待機状態にセットする（Ｓ１１６）。なお、Ｉ２Ｃは、伝送用のクロック信号とシリアルデータが伝送されるが、このクロック信号は、ＤＵＴ１１０のシステムクロックとは無関係であることに留意されたい。
【００５１】
そしてＭＩＵ２２０は、ＤＵＴ１１０のデバイス側プロセッサ１１２に、デバイス用スクリプトＳＣＰＲＴ１の実行を指示する（Ｓ１１８）。ＤＵＴ１１０のデバイス側プロセッサ１１２は、ＤＵＴスクリプトＳＣＲ＿ＤＵＴの実行を開始する（Ｓ１２０）。ここから、試験の主導権がＤＵＴ１１０に渡される。
【００５２】
デバイス側プロセッサ１１２は、ＤＵＴスクリプトＳＣＲ＿ＤＵＴにもとづいて、デバイス側通信回路１１４をマスターモードにセットする（Ｓ１２２）。そして、デバイス側通信回路１１４は、テスター側通信回路２２４に対して、書き込み要求（プロトコル信号）を送信し（Ｓ１２４）、それに続いてシリアルデータを出力する（Ｓ１２６）。このとき出力すべきシリアルデータは、予め規定されている。
【００５３】
書き込みが完了すると、テスター側プロセッサ２２２は、ＭＩＵスクリプトＳＣＲ＿ＭＩＵにしたがって、受信したデータとその期待値の比較を行う（Ｓ１２８）。
【００５４】
そして判定結果が、バスＢ１を介してメインコントローラ２１０に送信される（Ｓ１３０）。そしてメインコントローラ２１０は、判定結果を処理する（Ｓ１３２）。
【００５５】
以上が、通信プロトコルがＩ２Ｃであり、デバイス側通信回路１１４がマスターモード、テスター側通信回路２２４がスレーブモードであるときのファンクション試験である。
【００５６】
ファンクション試験は、マスターとスレーブを入れ替えて行うことができる。図６は、ファンクション試験に関する別のシーケンス図である。図６では、デバイス側通信回路１１４がスレーブモード、テスター側通信回路２２４がマスターモードに設定される。このファンクション試験においてＤＵＴ１１０、ＭＩＵ２２０が実行するスクリプトＳＣＲ１，ＳＣＲ２に含まれる命令は、図５のそれらとは異なることに留意されたい。
【００５７】
Ｓ１００〜Ｓ１１２までは図５と同様である。ＤＵＴ１１０へのＤＵＴスクリプトＳＣＲ＿ＤＵＴの送信（Ｓ１１２）の後、テスター側プロセッサ２２２はテスター側通信回路２２４をマスターモードにセットする（Ｓ１４０）。そしてＤＵＴ１１０に、ＤＵＴスクリプトＳＣＲ＿ＤＵＴの実行を指示する（Ｓ１１８）。これを受けて、デバイス側プロセッサ１１２はＤＵＴスクリプトＳＣＲ＿ＤＵＴの実行を開始する（Ｓ１２０）。
【００５８】
ＤＵＴスクリプトＳＣＲ＿ＤＵＴにしたがい、デバイス側プロセッサ１１２は、デバイス側通信回路１１４をスレーブモードにセットする（Ｓ１４２）。デバイス側通信回路１１４は、テスター側通信回路２２４からのプロトコル信号（リード命令あるいはライト命令）を待機する（Ｓ１４４）。
【００５９】
続いてテスター側通信回路２２４からデバイス側通信回路１１４に、書き込み要求が出力される（Ｓ１４６）。それに続いて、データが転送される（Ｓ１４８）。
【００６０】
続いてテスター側通信回路２２４からデバイス側通信回路１１４に、読み出し要求が出力される（Ｓ１５０）。続いて、テスター側通信回路２２４は、デバイス側通信回路１１４からデータを読み出し、データが転送される（Ｓ１５２）。続いて、テスター側プロセッサ２２２は、読み出したデータと期待値を比較する（Ｓ１２８）。
【００６１】
以上が実施の形態に係る試験システム１００の構成および動作である。
【００６２】
メインコントローラ２１０としてＡＴＥを用いた場合、（i）複合デバイス（ＤＵＴ）が主導権を有する非同期制御モードと、（ii）ＡＴＥが主導権を有する制御モードを切り替え可能なテストシステムを構築可能である。
【００６３】
ＤＵＴ１１０が主導権を有する非同期制御モードにおいて、メインコントローラ２１０とＭＩＵ２２０との間は、非同期制御であってもよいし、同期制御であってもよい。同測効率を高めたい場合には非同期制御で動作させることが好ましく、ＡＴＥ固有のリソースを利用した試験を行う場合には、同期制御で動作させることが好ましい。
【００６４】
上述したように、通信回路のファンクション試験は、非同期制御モードで実行できる。その他、アプリケーションレイヤ試験やシステムコストの検証は、非同期制御モードで試験できる。
【００６５】
本来のＡＴＥによる試験であるパラメータテストは、ＡＴＥ主導の同期制御モードによって実行可能である。そのほか、物理レイヤー試験、ストレス試験、同測試験、テスト時間の試験も、同期制御モードで実行可能である。
【００６６】
実施の形態にもとづき本発明を説明したが、実施の形態は、本発明の原理、応用を示しているにすぎず、実施の形態には、請求の範囲に規定された本発明の思想を逸脱しない範囲において、多くの変形例や配置の変更が認められる。
【００６７】
（変形例１）
本実施の形態では、ＤＵＴ１１０が、単一のデバイス側通信回路１１４を備える場合を説明したが、ＤＵＴ１１０は、プロトコルが異なる複数のデバイス側通信回路１１４を備えることができる。たとえばＤＵＴ１１０は、Ｉ２Ｃ，ＨＤＭＩ、ＷｉＦｉ，Ｂｌｕｅｔｏｏｔｈの４つのプロトコルの通信回路を備えてもよい。この場合、ＭＩＵ２２０には、ＤＵＴ１１０が備える複数のプロトコルに準拠する複数のテスター側通信回路２２４が実装される。
【００６８】
（変形例２）
メインコントローラ２１０は、ＡＴＥではなく、汎用的なコンピュータやワークステーションであってもよい。
【００６９】
実施の形態にもとづき本発明を説明したが、実施の形態は、本発明の原理、応用を示しているにすぎず、実施の形態には、請求の範囲に規定された本発明の思想を逸脱しない範囲において、多くの変形例や配置の変更が認められる。
【符号の説明】
【００７０】
１００  試験システム
１１０  ＤＵＴ
１１２  第１プロセッサ
１１４  デバイス側通信回路
２００  試験装置
２１０  メインコントローラ
２２０  ＭＩＵ
２２２  テスター側プロセッサ
２２４  テスター側通信回路
ＣＨ  伝送チャンネル
ＰＲＧ  テストプログラム
ＳＣＲ＿ＤＵＴ  デバイス用スクリプト
ＳＣＲ＿ＭＩＵ  テスター用スクリプト
【図１】
2020112469.tif 000003
【図２】
2020112469.tif 000004
【図３】
2020112469.tif 000005
【図４】
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【図５】
2020112469.tif 000007
【図６】
2020112469.tif 000008