(57)【要約】【課題】より好適な高抵抗領域を形成する。【解決手段】半導体装置１０の製造方法は、ｐ型の半導体基板１２と、半導体基板１２の表面１６に形成される配線層１４とを備える半導体装置１０にイオン照射して半導体基板１２内にイオン照射前よりも抵抗率の高い高抵抗領域３０を形成することと、イオン照射後に半導体装置１０を２５０℃以上３００℃以下の温度で加熱処理することと、を備える。イオン照射は、半導体基板１２と配線層１４の界面１８から１０μｍ以内の半導体基板１２内の第１深さ位置に向けて、配線層１４の上から第１の水素イオン照射をすることと、界面１８から２０μｍ以上離れた半導体基板１２内の第２深さ位置に向けて、配線層１４の上から第２の水素イオン照射をすることと、を含む。【選択図】図６
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【特許請求の範囲】
【請求項１】
ｐ型の半導体基板と、前記半導体基板の表面に形成される配線層とを備える半導体装置にイオン照射して前記半導体基板内にイオン照射前よりも抵抗率の高い高抵抗領域を形成することと、
前記イオン照射中および前記イオン照射後の少なくとも一方において前記半導体装置を２５０℃以上３００℃以下の温度で加熱処理することと、を備え、
前記イオン照射は、
前記半導体基板と前記配線層の界面から１０μｍ以内の前記半導体基板内の第１深さ位置に向けて、前記配線層の上から第１の水素イオン照射をすることと、
前記界面から２０μｍ以上離れた前記半導体基板内の第２深さ位置に向けて、前記配線層の上から第２の水素イオン照射をすることと、を含むことを特徴とする半導体装置の製造方法。
【請求項２】
前記第１の水素イオン照射は、前記第１深さ位置の水素密度が５×１０１６ｃｍ−３以上となるようになされ、
前記第２の水素イオン照射は、前記第１深さ位置から前記第２深さ位置までの範囲の欠陥密度が８×１０１７ｃｍ−３以上となるようになされることを特徴とする請求項１に記載の半導体装置の製造方法。
【請求項３】
前記第１の水素イオン照射のエネルギーは、２ＭｅＶ以上５ＭｅＶ以下であることを特徴とする請求項１または２に記載の半導体装置の製造方法。
【請求項４】
前記第２の水素イオン照射のエネルギーは、４ＭｅＶ以上であることを特徴とする請求項３に記載の半導体装置の製造方法。
【請求項５】
前記第１の水素イオン照射後であって前記第２の水素イオン照射前に前記半導体装置を３００℃以上４００℃未満の温度でアニールすることをさらに備えることを特徴とする請求項１から４のいずれか一項に記載の半導体装置の製造方法。
【請求項６】
前記半導体基板の前記イオン照射前の抵抗率は１０Ω・ｃｍ以下であり、前記高抵抗領域の抵抗率が１００Ω・ｃｍ以上であることを特徴とする請求項１から５のいずれか一項に記載の半導体装置の製造方法。
【請求項７】
前記第２深さ位置の抵抗率が５００Ω・ｃｍ以上であることを特徴とする請求項６に記載の半導体装置の製造方法。
【請求項８】
ｐ型の半導体基板と、
前記半導体基板の表面に形成される配線層と、
前記半導体基板と前記配線層の界面から１０μｍ以内の前記半導体基板内の第１深さ位置に設けられ、前記半導体基板よりも高抵抗率のｎ型高抵抗領域と、
前記界面から２０μｍ以上離れた前記半導体基板内の第２深さ位置に設けられ、前記半導体基板よりも高抵抗率のｐ型高抵抗領域と、を備えることを特徴とする半導体装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、半導体装置および半導体装置の製造方法に関する。
【背景技術】
【０００２】
近年、ＣＭＯＳ技術が向上し、アナログ回路とデジタル回路を混載させたＳｏＣ（System on a Chip）が様々な用途に用いられている。このような混載チップでは、アナログ回路部分の特性向上のために半導体基板内に高抵抗領域が形成される。例えば、半導体基板の表面上に形成されるインダクタ素子の特性向上のために高抵抗領域が用いられる。インダクタ素子の直下に高抵抗領域を形成することで、インダクタ素子の動作時に半導体基板内で生じる渦電流損失を小さくし、インダクタ素子のＱ値を向上できる。
【０００３】
高抵抗領域の形成方法として、水素（Ｈ）やヘリウム（Ｈｅ）などの軽イオンを半導体基板に照射する方法がある。例えば、ｐ型半導体基板に水素（Ｈ）イオンを照射して熱処理を施すと、基板内に注入された水素が活性化してｎ型キャリア化（ドナー化）する。このとき、ｐ型半導体基板内のｐ型キャリア濃度と、水素のドナー化によるｎ型キャリア濃度とが同程度となるように水素イオンの照射条件を調整することで、半導体基板の中性化による高抵抗率を実現できる（例えば、特許文献１参照）。
【先行技術文献】
【特許文献】
【０００４】
【特許文献１】特開２０１８−９３１８４号公報
【発明の概要】
【発明が解決しようとする課題】
【０００５】
上述のインダクタ素子は、半導体基板上の配線層（酸化物層）に形成されることが一般的である。また、インダクタ素子を備える半導体装置は、プリント基板等に実装するための半田付け工程にて加熱処理が施されることも一般的である。本発明者の知見によれば、酸化物層の上から半導体基板にイオン照射した後に熱処理が施されると、半導体基板と酸化物層の界面近傍に導電層が形成され、インダクタ素子の特性低下につながるおそれがあることが分かっている。熱処理後においても、半導体基板と酸化物層の界面が高抵抗であることが望ましい。
【０００６】
本発明のある態様の例示的な目的のひとつは、より好適な高抵抗領域を形成する技術を提供することにある。
【課題を解決するための手段】
【０００７】
本発明のある態様の半導体装置の製造方法は、ｐ型の半導体基板と、半導体基板の表面に形成される配線層とを備える半導体装置にイオン照射して半導体基板内にイオン照射前よりも抵抗率の高い高抵抗領域を形成することと、イオン照射後に半導体装置を２５０℃以上３００℃以下の温度で加熱処理することと、を備える。イオン照射は、半導体基板と配線層の界面から１０μｍ以内の半導体基板内の第１深さ位置に向けて、配線層の上から第１の水素イオン照射をすることと、界面から２０μｍ以上離れた半導体基板内の第２深さ位置に向けて、配線層の上から第２の水素イオン照射をすることと、を含む。
【０００８】
本発明の別の態様は、半導体装置である。この半導体装置は、ｐ型の半導体基板と、半導体基板の表面に形成される配線層と、半導体基板と配線層の界面から１０μｍ以内の半導体基板内の第１深さ位置に設けられ、半導体基板よりも高抵抗率のｎ型高抵抗領域と、界面から２０μｍ以上離れた半導体基板内の第２深さ位置に設けられ、半導体基板よりも高抵抗率のｐ型高抵抗領域と、を備える。
【０００９】
なお、以上の構成要素の任意の組み合わせや本発明の構成要素や表現を、方法、装置、システムなどの間で相互に置換したものもまた、本発明の態様として有効である。
【発明の効果】
【００１０】
本発明によれば、より好適な高抵抗領域を形成できる。
【図面の簡単な説明】
【００１１】
【図１】図１（ａ）−（ｄ）は、半導体基板と配線層の界面における導電層の形成を模式的に示す図である。
【図２】半導体基板と配線層の界面近傍をｎ型化した場合のエネルギーバンド図である。
【図３】熱処理による水素の活性化率を示すグラフである。
【図４】熱処理によるキャリア濃度変化を模式的に示すグラフである。
【図５】水素イオン照射のドーズ量と水素密度の関係を示すグラフである。
【図６】実施の形態に係る半導体装置の構造を模式的に示す断面図である。
【図７】実施の形態に係る半導体装置の製造方法の流れを示すフローチャートである。
【図８】実施の形態に係る第１イオン照射工程を模式的に示す断面図である。
【図９】実施の形態に係る第２イオン照射工程を模式的に示す断面図である。
【図１０】水素イオン照射のエネルギーと基板内でイオンが到達する深さ分布の半値幅の関係を示すグラフである。
【図１１】実施例に係るイオン照射後の半導体基板内の欠陥密度分布および水素濃度分布を示すグラフである。
【発明を実施するための形態】
【００１２】
本実施の形態を詳細に説明する前に概要を示す。本実施の形態は、低抵抗（例えば１〜１０Ω・ｃｍ）の半導体基板に水素（Ｈ）やヘリウム（Ｈｅ）などの軽イオンを照射することにより、半導体基板内に部分的に抵抗率の高い領域である高抵抗領域（例えば１００Ω・ｃｍ以上）を形成する。半導体基板にイオンを照射すると、イオンの加速エネルギーに応じた深さまでイオンが到達する。その際、到達した領域を含む近傍では格子欠陥が形成され、結晶の規則性（周期性）が乱れた状態となる。このような格子欠陥が多い領域ではキャリア（電子または正孔）が散乱されやすくなり、キャリアの移動が阻害される。その結果、イオン照射により局所的な格子欠陥が生じた領域では、照射前に比べて抵抗率が上昇する。
【００１３】
本実施の形態では、例えば、水素（Ｈ）イオンを１ＭｅＶ以上、１００ＭｅＶ以下の加速エネルギーで照射する。例えば、１価の水素イオン（１Ｈ＋）を４ＭｅＶ、８ＭｅＶ、１７ＭｅＶの加速エネルギーで照射する。このような加速エネルギーのイオンビームを照射する装置として、サイクロトロン方式やバンデグラフ方式の装置が用いられる。このような照射条件を用いることにより、シリコンウェハにおいて半導体基板の表面から深さ１００μｍ以上の位置にまでイオンを到達させることができる。
【００１４】
イオン照射により形成される高抵抗領域の抵抗率は、生成される格子欠陥の密度（欠陥密度）に依存する。本発明者らの知見によれば、欠陥密度が１×１０１７ｃｍ−３以上であれば、１ｋΩ・ｃｍ以上の抵抗率を好適に得られることが分かっている。このような欠陥密度は、照射イオンの加速エネルギーが２ＭｅＶ〜１７ＭｅＶであれば、水素イオンの照射量（ドーズ量）を１×１０１３ｃｍ−２以上にすることで実現できる。
【００１５】
このようにして形成される高抵抗領域は、熱処理を加えることにより抵抗率が低下することが知られている。発明者らの知見によれば、イオン照射後の半導体基板を２００℃以上に加熱することで抵抗率の低下が見られ、３００℃以上または４００℃以上に半導体基板を加熱すると抵抗率が顕著に低下する。これは、熱処理によって格子欠陥が回復して欠陥密度が低下することが原因と考えられる。したがって、イオン照射により高抵抗領域を形成した場合、その後の工程において２００℃以上の熱処理を加えないことが好ましい。
【００１６】
一方で、高抵抗領域をインダクタ素子の直下といった狙い通りの位置に形成するためには、ウェハをダイシングする前、つまり、半導体プロセスにおける後工程より前の段階でイオン照射を実行する必要がある。後工程では、ダイボンディングやワイヤボンディング、樹脂封止といった熱処理がなされ、これらの工程では２５０℃〜３００℃程度の温度に半導体基板が加熱されうる。そのため、後工程での熱処理により高抵抗領域の抵抗率が低下し、所望の抵抗率（例えば、１００Ω・ｃｍ以上または５００Ω・ｃｍ以上）を維持できないおそれがある。
【００１７】
そこで、本発明者は、２５０℃〜３００℃程度の加熱処理後であっても高抵抗領域の抵抗率が維持されるように、イオン照射工程のドーズ量を多めにし、より多くの格子欠陥が形成されるようにする方法を考案した。つまり、加熱処理によって格子欠陥が部分的に回復したとしても、高抵抗を維持できるだけの格子欠陥が残存するようにすることを考えた。本発明者の知見によれば、５×１０１７ｃｍ−３以上の欠陥密度を実現すれば、２５０℃〜３００℃程度の加熱処理後も１００Ω・ｃｍ以上の高抵抗を実現でき、８×１０１７ｃｍ−３以上の欠陥密度を実現すれば、２５０℃〜３００℃程度の加熱処理後も５００Ω・ｃｍ以上の高抵抗を実現できる。
【００１８】
しかしながら、高ドーズ量のイオン照射を実行した後に２５０℃〜３００℃程度の加熱処理をすると、半導体基板と配線層の界面付近に高導電率となる部分（導電層ともいう）が形成され、インダクタ素子の動作時に生じる渦電流損失を十分に低減できないことが分かった。そこで、本実施の形態では、半導体基板と配線層の界面付近の導電層の形成を防ぎ、より適切な高抵抗領域を形成する手法を提案する。
【００１９】
以下、本発明を実施するための形態について詳細に説明する。なお、以下に述べる構成は例示であり、本発明の範囲を何ら限定するものではない。また、図面の説明において同一の要素には同一の符号を付し、重複する説明を適宜省略する。また、以下の説明において参照する各断面図において、半導体基板やその他の層の厚みや大きさは説明の便宜上のものであり、必ずしも実際の寸法や比率を示すものではない。
【００２０】
図１（ａ）−（ｄ）は、半導体基板１２と配線層１４の界面１８における導電層６８の形成を模式的に示す図である。図１（ａ）は、イオン照射前の半導体基板１２と配線層１４の界面１８の近傍の結晶状態を模式的に示す。半導体基板１２は、例えばｐ型のシリコンであり、多数のキャリア（正孔）６２が分布している。配線層１４は、酸化シリコンなどの酸化物で構成される絶縁体層であり、界面１８の近傍に固定電荷（正電荷）６４が存在する。半導体基板１２と配線層１４の界面１８は、半導体と絶縁体の接合により、空乏層６０が形成される。空乏層６０の厚さは、１μｍ以下であり、典型的には数ｎｍ〜数十ｎｍ程度である。
【００２１】
図１（ｂ）は、イオンビームＢの照射後の半導体基板１２と配線層１４の界面１８の近傍の結晶状態を模式的に示す。イオン照射により、半導体基板１２および配線層１４には多数の格子欠陥６６が形成される。図１（ｃ）は、イオン照射後に２５０℃〜３００℃程度の加熱処理中の状態を模式的に示し、熱処理によって格子欠陥６６が部分的に回復する様子を示している。半導体基板１２の内部では、格子欠陥６６の回復により欠陥数が減少し、キャリア（正孔）６２が増加していく。また、配線層１４の内部でも格子欠陥６６の回復により欠陥数が減少し、界面１８の近傍において固定電荷６４の増加や界面準位への正孔６２の捕獲が生じうる。その結果、熱処理後の図１（ｄ）に示されるように、界面１８において半導体基板１２のアクセプタ準位の電子７０が引き寄せられ、界面１８の近傍の電子密度が増加し、界面１８の近傍に導電層６８が形成されうる。導電層６８は、イオン照射前の半導体基板１２（例えば１〜１０Ω・ｃｍ）よりも抵抗率の低い領域である。導電層６８の抵抗率は、例えば１Ω・ｃｍ未満（例えば１０−１Ω・ｃｍ以下または１０−２Ω・ｃｍ以下）である。
【００２２】
図１（ｄ）に示す導電層６８は、半導体基板１２と配線層１４の界面１８の近傍に多数の格子欠陥６６を形成した後に２５０℃〜３００℃程度の熱処理を加えることで生じると考えられる。現在の半導体装置の製造工程において、２５０℃〜３００℃程度の熱処理を加えないようにすることは難しい。そこで、本実施の形態では、半導体基板１２と配線層１４の界面１８の近傍がｐ型半導体ではなく、ｎ型半導体となるようにすることで、熱処理後の界面１８に導電層６８が形成されるのを防ぐようにする。
【００２３】
図２は、半導体基板１２と配線層１４の界面１８の近傍をｎ型化した場合のエネルギーバンド図である。図２は、上述の図１（ｄ）と同様、高抵抗領域を形成するためのイオン照射後に２５０℃〜３００℃程度の熱処理を加えた後の状態を示している。半導体基板１２内の界面１８に隣接する第１領域３２は、ｎ型化した領域（ｎ−領域）であり、電子が多数キャリアとなっている。一方、半導体基板１２内の第１領域３２よりも深い第２領域３４は、ｐ型領域（ｐ＋領域）であり、正孔が多数キャリアとなっている。配線層１４内の界面１８の近傍には正の固定電荷６４が存在するため、界面１８における半導体基板１２のバンドは障壁が高くなるように曲がっている。その結果、熱処理後に配線層１４内の界面１８の近傍の固定電荷６４が増加した状態となっても、界面１８における導電層６８の形成を防止できる。
【００２４】
本実施の形態では、ｐ型半導体基板１２の界面１８の近傍をｎ型化する手法として、水素イオンを利用する。ｐ型基板内に照射された水素イオンは、熱処理によって活性化してｎ型キャリアとなりうる。したがって、イオン照射前の半導体基板１２のｐ型キャリア濃度よりも多くのｎ型キャリア濃度を実現できれば、導電型をｐ型からｎ型に変えることができる。一般に、低抵抗（１〜１０Ω・ｃｍ）のｐ型シリコン基板のｐ型キャリア濃度は、１．０×１０１５ｃｍ−３〜１．０×１０１６ｃｍ−３であることから、これよりも多くのｎ型キャリア濃度が実現されるように水素イオンを照射すればよい。
【００２５】
図３は、熱処理による水素の活性化率を示すグラフであり、温度と活性化率の関係を示している。図示されるように、２００℃〜４００℃の範囲は、水素の活性化率が低く、温度上昇による活性化率の増加も緩やかである。一方、４００℃を超えると、温度上昇による活性化率の増加率が大きくなり、活性化率の値も１０％を超える。したがって、温度上昇による活性化率の増加が緩やかな２００℃〜４００℃の範囲の熱処理を用いることで、後工程における熱処理の温度に個体差が生じる場合であっても、ｎ型キャリア濃度の制御が容易となる。
【００２６】
図４は、熱処理によるキャリア濃度変化を模式的に示すグラフであり、異なる四つの水素密度について、熱処理によりドナー化されるｎ型キャリア濃度の値を模式的に示す。Ａは水素密度が５×１０１６ｃｍ−３（０．５×１０１７ｃｍ−３）であり、Ｂは水素密度が１．０×１０１７ｃｍ−３であり、Ｃは水素密度が１．５×１０１７ｃｍ−３であり、Ｄは水素密度が２．０×１０１７ｃｍ−３である。グラフ中の破線は、半導体基板１２の抵抗率２Ω・ｃｍ、４Ω・ｃｍおよび１０Ω・ｃｍに対応するｐ型キャリア濃度を示している。
【００２７】
例えば、水素イオンの照射後に２５０℃〜３００℃程度の熱処理を加えて水素イオンをドナー化する場合、基板抵抗率が４Ω・ｃｍであれば１．０〜１．５×１０１７ｃｍ−３程度の水素密度でｎ型反転化できることが分かる。同様に基板抵抗率が２Ω・ｃｍであれば２．０×１０１７ｃｍ−３程度の水素密度でｎ型反転化できる。また、基板抵抗率が１０Ω・ｃｍであれば０．５×１０１７ｃｍ−３程度の水素密度でｎ型反転化できる。なお、ｎ型反転化に必要となる条件は、半導体基板１２の抵抗率に応じて水素密度および加熱温度の双方を調整することで適宜設定できる。
【００２８】
図５は、水素イオン照射のドーズ量と水素密度の関係の一例を示すグラフであり、水素イオンの加速エネルギーを２ＭｅＶ，４ＭｅＶ，８ＭｅＶ，１７ＭｅＶとした場合について示す。図示されるように、水素イオンのドーズ量と照射後の水素密度は比例関係にある。また、照射エネルギーが低いほど得られる水素密度は高い。これは、加速エネルギーが低いと水素イオンが注入される深さ方向の範囲が限定され、単位体積あたりの水素注入量が増えるためである。グラフより、０．５〜２．０×１０１７ｃｍ−３の水素密度を実現するためには、２ＭｅＶまたは４ＭｅＶであれば０．５〜２．０×１０１４ｃｍ−２程度、８ＭｅＶであれば１．０〜４．０×１０１４ｃｍ−２程度、１７ＭｅＶであれば３．５×１０１４ｃｍ−２程度以上にすればよい。なお、これらのドーズ量でイオン照射をすれば、５００Ω・ｃｍ以上の高抵抗率の実現に必要な１×１０１７ｃｍ−３以上の欠陥密度を得ることもできる。
【００２９】
以上の考察より、本実施の形態では、ｐ型の半導体基板１２と配線層１４の界面１８の近傍をｎ型化するための第１の水素イオン照射と、半導体基板１２内に厚い高抵抗領域を形成するための第２の水素イオン照射とを組み合わせる手法を提案する。
【００３０】
図６は、実施の形態に係る半導体装置１０の構造を模式的に示す断面図である。半導体装置１０は、システムＬＳＩやシステム・オン・チップといった集積回路（ＩＣ）である。半導体装置１０は、半導体基板１２と、配線層１４とを備える。
【００３１】
本明細書において、半導体基板１２と配線層１４の界面１８に直交する方向を上下方向または深さ方向ということがある。また、半導体基板１２の内部において、界面１８に向かう方向を上方向または上側、界面１８と反対側の裏面２０に向かう方向を下方向または下側ということがある。また、界面１８に平行する方向を横方向または水平方向ということがある。
【００３２】
半導体基板１２は、抵抗率が１０Ω・ｃｍ以下の低抵抗の半導体基板であり、抵抗率が１〜１０Ω・ｃｍ程度の半導体基板である。半導体基板１２は、例えば、チョクラルスキー（ＣＺ）法により作製されたｐ型のシリコン（Ｓｉ）ウェハであり、ｐ型キャリア濃度が１０１５ｃｍ−３〜１０１６ｃｍ−３程度である。ＣＺ法により作製されたウェハは、フローティングゾーン（ＦＺ）法等により作製された高抵抗ウェハと比較して抵抗率が低く、安価である。ある実施例において、半導体基板１２の抵抗率は４Ω・ｃｍであり、ｐ型キャリア濃度が３．４×１０１５ｃｍ−３である。
【００３３】
半導体基板１２の上には配線層１４が設けられる。配線層１４は、多層配線構造を有し、例えば、複数の層間絶縁層と、層間絶縁層内に形成される配線部とを有する。配線層１４の厚さｔ０は、５μｍ〜３０μｍ程度であり、例えば１０μｍ、１５μｍまたは２０μｍ程度である。配線層１４に形成される配線部として、例えば、水平方向に延びる水平配線や、異なる層に形成される水平配線同士を接続するために上下方向に延びるビア配線などが設けられる。また、配線層１４の表面１６上にはインダクタ素子２８が形成される。インダクタ素子２８は、配線層１４の表面１６上でループ状または渦巻状に延びる帯状導電体により形成される。
【００３４】
半導体装置１０は、半導体素子領域２２とインダクタ素子領域２４を有する。半導体素子領域２２には、トランジスタやダイオードなどの半導体素子２６が設けられる。半導体素子領域２２の半導体基板１２内には、半導体素子２６を形成するためのウェル領域、ソース／ドレイン領域、コンタクト領域などの不純物拡散層が設けられる。インダクタ素子領域２４には、配線層１４に形成されるインダクタ素子２８が設けられる。
【００３５】
インダクタ素子２８の直下の半導体基板１２の内部には、高抵抗領域３０が設けられる。高抵抗領域３０は、半導体基板１２のボディ部分３８よりも抵抗率が高い領域である。高抵抗領域３０は、水素（Ｈ）を半導体装置１０に照射することにより形成される。高抵抗領域３０は、界面１８の近傍の第１領域３２と、第１領域３２よりも深い位置の第２領域３４とを有する。
【００３６】
第１領域３２は、界面１８と隣接する領域であり、ｎ型反転化した領域である。第１領域３２は、ｎ型反転化のために高濃度の水素が注入されている領域とも言える。第１領域３２の抵抗率は、１００Ω・ｃｍ以上であり、好ましくは５００Ω・ｃｍまたは１ｋΩ・ｃｍ以上である。したがって、第１領域３２は、導電型がｎ型であり、半導体基板１２のボディ部分３８より高抵抗率の「ｎ型高抵抗領域」である。第１領域３２の厚さｔ１は、できるだけ小さいことが望ましく、１０μｍ以下または５μｍ以下であることが好ましい。第１領域３２の厚さｔ１は、１μｍ〜２μｍ程度であってもよい。
【００３７】
第２領域３４は、第１領域３２と深さ方向に連続する領域であり、ｐ型が維持された領域である。第２領域３４の抵抗率は、１００Ω・ｃｍ以上であり、好ましくは５００Ω・ｃｍ以上または１ｋΩ・ｃｍ以上である。したがって、第２領域３４は、導電型がｐ型であり、半導体基板１２のボディ部分３８より高抵抗率の「ｐ型高抵抗領域」である。第２領域３４の厚さｔ２は、できるだけ大きいことが望ましく、２０μｍ以上、５０μｍ以上または１００μｍ以上であることが好ましい。
【００３８】
つづいて、本実施の形態に係る半導体装置１０の製造方法について述べる。図７は、半導体装置１０の製造方法を模式的に示すフローチャートである。まず、ｐ型の半導体基板１２に半導体素子２６を形成し（Ｓ１０）、半導体基板１２の上に配線層１４を形成し、形成した素子や配線を保護するための保護膜を形成する（Ｓ１４）。Ｓ１０〜Ｓ１４の工程は、半導体プロセスにおいて「前工程」といわれる工程であり、熱酸化、熱拡散、ＣＶＤ、アニールといった４００℃以上の高温処理がなされうる。
【００３９】
次に、半導体基板１２にイオン照射して高抵抗領域３０を形成し（Ｓ１６）、半導体基板１２の裏面研磨がなされる（Ｓ１８）。Ｓ１６およびＳ１８の工程は、いわゆる「中間工程」または「ポストパッシベーションプロセス（ＰＰＰ；Post Passivation Process）」といわれる工程である。
【００４０】
その後、熱処理を含む後工程（Ｓ２０）がなされ、半導体集積回路として完成する。Ｓ２０の後工程では、例えば、ウェハをダイシングして個片化する工程、個片化されたチップを実装基板上に接着するダイボンド工程、実装基板とチップとをワイヤボンドで結線する工程、チップを樹脂で封止する工程などが含まれる。例えば、ダイボンド工程、ワイヤボンド工程および樹脂封止工程では、２００℃〜３００℃程度の熱処理がなされ、ある実施例において熱処理の最高温度は２６０℃程度である。なお、ボンディングや封止工程とは別に半導体装置１０を加熱するアニール処理がなされてもよい。このアニール処理は、高抵抗領域３０を２５０℃以上３００℃以下の所定温度で加熱することにより、高抵抗領域３０の抵抗率を安定化させてもよい。このアニール処理は、１０分以下の比較的短い時間実行すれば十分であり、５分以下、１分以下、または、３０秒以下の時間であってもよい。
【００４１】
つづいて、Ｓ１６のイオン照射による高抵抗領域３０の形成方法について詳述する。図８は、実施の形態に係る第１イオン照射工程を模式的に示す断面図であり、上述の第１領域３２を形成する工程を示す。半導体装置１０の上方には、インダクタ素子領域に対応する部分に開口４２が設けらるマスク４０が配置されている。第１の水素イオン照射では、マスク４０を用いて配線層１４の上から半導体装置１０に向けてイオンビームＢ１を照射する。これにより、インダクタ素子２８の直下の半導体基板１２内に第１領域３２が形成される。
【００４２】
第１の水素イオン照射では、半導体基板１２と配線層１４の界面１８から第１深さｄ１の深さ位置（第１深さ位置ともいう）を狙って高ドーズ量のイオンビームＢ１が照射される。第１深さｄ１は１０μｍ以内であり、例えば５μｍ以下である。第１深さｄ１は、第１領域３２の厚さｔ１よりも小さい。界面１８から少しだけ深い位置を狙って高ドーズ量のイオン照射することで、界面１８の近傍に高濃度の水素イオンを照射することができ、熱処理後にｎ型反転化された第１領域３２を形成できる。
【００４３】
図９は、実施の形態に係る第２イオン照射工程を模式的に示す断面図であり、上述の第２領域３４を形成する工程を示す。第２イオン照射では、第１イオン照射と共通のマスク４０を用いて配線層１４の上からイオンビームＢ２が照射される。第２イオン照射では、界面１８から第２深さｄ２の深さ位置（第２深さ位置ともいう）を狙ってイオンビームＢ２が照射される。第２深さｄ２は、第１深さｄ１よりも大きく、界面１８から２０μｍ以上離れており、例えば３０μｍ以上または５０μｍ以上である。界面１８から離れた深い位置を狙ってイオン照射することで、深さ方向に連続する厚い第２領域３４を形成できる。
【００４４】
第２イオン照射は、第２領域３４の厚みｔ２が大きくなるように、第２深さｄ２の大きさを変化させて複数回実行されてもよい。例えば、界面１８からの第２深さｄ２を５０μｍおよび９０μｍなどに設定することにより、深さ方向に１００μｍ以上にわたって連続する高抵抗領域（第２領域３４）を形成してもよい。第２イオン照射は、第１イオン照射の実行前になされてもよいし、第１イオン照射の実行後になされてもよい。
【００４５】
第１イオン照射は、界面１８の近傍のみに第１領域３２を形成するため、基板内でイオンが到達する深さ方向の分布が相対的に小さいイオンビームを用いることが好ましいかもしれない。一方、第２イオン照射は、深さ方向に連続した厚い第２領域３４を形成するため、基板内でイオンが到達する深さ方向の分布が相対的に大きいイオンビームを用いることが好ましいかもしれない。イオンが到達しうる深さ方向の分布は、例えばイオンビームのイオン種やエネルギーを変化させることで調整可能である。
【００４６】
図１０は、水素イオン照射のエネルギーと基板内でイオンが到達する深さ分布の半値幅の関係を示すグラフである。図示されるように、照射エネルギーが高いほど分布の半値幅が広くなることが分かる。界面１８の近傍のｎ型反転化された第１領域３２の厚さは１０μｍ程度であれば十分であるため、２ＭｅＶ以上５ＭｅＶ以下のエネルギーの水素イオンを用いることで、界面１８の近傍に高濃度の水素イオンを局所的に注入することができる。
【００４７】
図１１は、実施例に係るイオン照射後の半導体基板１２内の欠陥密度分布および水素濃度分布を示すグラフであり、加熱処理前の分布を示している。グラフの深さ位置は、半導体基板１２の表面１６を基準としており、界面１８が１５μｍの深さ位置に存在する。この実施例では、配線層１４の上から水素イオンを複数回照射しており、２０μｍ、７０μｍおよび１１０μｍの３箇所の深さ位置にイオン照射している。イオン照射の深さ位置は、例えば、マスク４０よりも手前に配置されるアブソーバの厚みを変えることで調整できる。２０μｍの深さ位置（界面１８から５μｍの深さ位置）は、第１の水素イオン照射に相当し、７０μｍおよび１１０μｍの深さ位置（界面１８から５５μｍおよび９５μｍの深さ位置）は第２の水素イオン照射に相当する。
【００４８】
図１１の実施例では、４ＭｅＶの水素イオン（１Ｈ＋）を用いるとともに、照射位置の深さに応じてドーズ量を異ならせている。具体的には、２０μｍの深さ位置を２．０×１０１４ｃｍ−２のドーズ量とし、７０μｍの深さ位置を１．０×１０１４ｃｍ−２のドーズ量とし、１１０μｍの深さ位置を２．０×１０１４ｃｍ−２のドーズ量としている。
【００４９】
図１１の実線は、欠陥密度分布を示す。図示されるように、０μｍから１２０μｍの深さ範囲にわたって欠陥密度が１×１０１８ｃｍ−３以上であるため、２５０℃〜３００℃程度の加熱処理後であっても５００Ω・ｃｍ以上の高抵抗を実現できる。図１１の破線は、水素密度を示す。図示されるように、界面１８の近傍において０．５〜３．０×１０１７ｃｍ−３の水素密度を実現することができており、２５０℃〜３００℃程度の熱処理後において界面１８の近傍をｎ反転化させることができる。なお、３００℃〜４００℃程度の熱処理を加えれば、より確実に界面１８の近傍をｎ反転化させることができる。
【００５０】
本実施例では、２０μｍの深さ位置（界面１８から５μｍの深さ位置）を狙った第１の水素イオン照射のドーズ量を大きくすることで、界面１８の深さ位置における水素密度を高め、界面１８の近傍を熱処理後にｎ反転化させることができる。さらに、７０μｍおよび１１０μｍの深さ位置を狙った第２の水素イオン照射により、界面１８から１００μｍ程度の深さ範囲まで２５０℃〜３００℃程度の加熱処理後であっても５００Ω・ｃｍ以上の程度の高抵抗を実現できる。したがって、本実施例によれば、導電層６８の形成が抑制された好ましい高抵抗領域３０を形成できる。
【００５１】
以上、本発明を実施の形態にもとづいて説明した。本発明は上記実施の形態に限定されず、種々の設計変更が可能であり、様々な変形例が可能であること、またそうした変形例も本発明の範囲にあることは、当業者に理解されるところである。
【００５２】
上述の実施の形態では、イオン照射による高抵抗領域の形成（Ｓ１６）の後に２５０℃〜３００℃程度の熱処理（Ｓ２０）を施して水素をドナー化させる場合について示した。変形例においては、イオン照射中に半導体基板１２を２５０℃〜３００℃に加熱してもよい。例えば、半導体基板１２を保持するための保持装置に温度調整機構を設け、半導体基板１２を加熱しながらイオン照射してもよい。また、ビーム照射により半導体基板１２に与えられる熱エネルギーを利用して半導体基板１２を２５０℃〜３００℃程度に加熱してもよい。この場合、半導体基板１２を加熱または冷却しながらイオン照射することで、イオン照射中の基板温度が２５０℃〜３００℃程度に維持されるようにしてもよい。また、イオン照射中（Ｓ１６）での熱処理と、後工程（Ｓ２０）での熱処理が併用されてもよい。つまり、イオン照射中およびイオン照射後の少なくとも一方において半導体基板１２を２５０℃〜３００℃程度の温度で加熱処理されてもよい。
【００５３】
変形例においては、相対的に浅い位置の第１イオン照射後に３００℃〜４００℃程度の熱処理（アニール処理）を実行することで、界面１８の近傍をアニールして第１領域３２に注入される水素イオンの活性化率を高めてもよい。その後、相対的に深い位置の第２イオン照射を実行し、深さ方向に厚い高抵抗領域を形成してもよい。
【００５４】
上述の実施の形態では、インダクタ素子２８の直下に形成する高抵抗領域３０について説明した。本実施の形態は、配線層１４に形成されるアンテナ、伝送線路、キャパシタといった任意の受動素子の直下に形成される高抵抗領域に適用することも可能である。
【符号の説明】
【００５５】
１０…半導体装置、１２…半導体基板、１４…配線層、１６…表面、１８…界面、２０…裏面、３０…高抵抗領域、３２…第１領域、３４…第２領域。
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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