(57)【要約】【課題】スイッチング損失の低減を図ることが可能な電力変換装置を提供する。【解決手段】電力変換装置１００は、直流電圧から三相交流を出力する三相ブリッジ１０３と、直流電圧を分圧する複数のＤＣリンクコンデンサ１０１、１０２と、三相ブリッジの各相の中点と複数のＤＣリンクコンデンサにより形成された分圧電圧点との間に接続された補助回路１０８とを備えている。補助回路１０８は、三相ブリッジ１０３と、インダクタ１０４と、三相ブリッジの上アームに対向する半導体スイッチＳ１と、三相ブリッジの下アームに対向する半導体スイッチＳ２とを備えている。ここで、三相ブリッジの上アームの半導体スイッチＱ１、Ｑ３は、半導体スイッチＳ２がオン状態となり、下アームの半導体スイッチＱ２、Ｑ４、Ｑ６がターンオフした後に、ターンオンする。【選択図】図１
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【特許請求の範囲】
【請求項１】
直流電圧から三相交流を出力する三相ブリッジと、
前記直流電圧を分圧する複数のコンデンサと、
三相ダイオードブリッジと、インダクタと、前記三相ブリッジの上アームに対向する第１補助スイッチと、前記三相ブリッジの下アームに対向する第２補助スイッチとを備え、前記三相ブリッジの各相の中点と前記複数のコンデンサにより形成された分圧電圧の点との間に接続された補助回路と
を備え、
前記上アームのスイッチは、前記第２補助スイッチがオン状態となり、前記下アームのスイッチがターンオフした後に、ターンオンする、電力変換装置。
【請求項２】
請求項１に記載の電力変換装置において、
前記上アームのスイッチおよび前記下アームのスイッチのそれぞれは、半導体スイッチと、前記半導体スイッチの電流経路に対して並列接続された逆並列ダイオードおよびスナバコンデンサを備える、電力変換装置。
【請求項３】
請求項２に記載の電力変換装置において、
前記複数のコンデンサは、前記直流電圧が供給される一対の電圧配線のそれぞれと前記分圧電圧の点との間に接続されたコンデンサを備え、
三相ダイオードブリッジの入力は、前記三相ブリッジの各相の中点に接続され、前記第１補助スイッチと前記第２補助スイッチは、前記三相ダイオードブリッジの出力間に直列接続され、前記インダクタは、前記第１補助スイッチと前記第２補助スイッチとの間の接続点と、前記分圧電圧の点との間に接続されている、電力変換装置。
【請求項４】
直流電圧から三相交流を出力する三相ブリッジと、
前記直流電圧を分圧する複数のコンデンサと、
三相ダイオードブリッジと、前記三相ブリッジの上アームに対向した第１補助スイッチと前記三相ブリッジの下アームに対向した第２補助スイッチとを備えるハーフブリッジと、インダクタとを備え、前記三相ブリッジの各相中点と前記複数のコンデンサの中点との間に接続された補助回路と
を備え、
前記三相ブリッジにおいてターンオフ状態のスイッチは、前記三相ブリッジにおいてターンオン状態のスイッチを備えるアームに対向した前記第１補助スイッチまたは前記第２補助スイッチがオンし、前記三相ブリッジにおいてターンオン状態のスイッチがターンオフした後で、ターンオンする、電力変換装置。
【請求項５】
請求項４に記載の電力変換装置において、
ターンオンした前記第１補助スイッチまたは前記第２補助スイッチは、供給される電流が実質的にゼロになってから、オフする、電力変換装置。
【請求項６】
請求項５に記載の電力変換装置において、
前記第１補助スイッチおよび前記第２補助スイッチがオンするタイミングは、前記三相ブリッジからの出力電流に基づいて設定される、電力変換装置。
【請求項７】
請求項６に記載の電力変換装置において、
前記三相ブリッジからの前記出力電流の極性に応じて、前記三相ブリッジにおいてターンオフさせるスイッチが切り替えられる、電力変換装置。
【請求項８】
請求項４に記載の電力変換装置において、
前記三相ブリッジが備える前記複数のスイッチのうち、ソフトスイッチングの対象とするスイッチは、温度に基づいて選択される、電力変換装置。
【請求項９】
請求項４に記載の電力変換装置において、
前記三相ブリッジから出力される電力に応じて、前記ハーフブリッジを駆動または停止させる、電力変換装置。
【請求項１０】
請求項４に記載の電力変換装置において、
前記電力変換装置は、前記直流電圧が供給される一対の電圧配線を備え、
前記複数のコンデンサは、前記一対の電圧配線のそれぞれと、前記複数のコンデンサの中点との間に接続されたコンデンサを備え、
前記複数のコンデンサの中点は、前記インダクタおよび前記ハーフブリッジを介して、前記三相ブリッジの各相の中点に接続されている、電力変換装置。
【請求項１１】
請求項１０に記載の電力変換装置において、
前記三相ブリッジを構成するスイッチは、半導体スイッチと、前記半導体スイッチの電流経路に対して並列的に接続された逆並列ダイオードおよびスナバコンデンサを備える、電力変換装置。
【請求項１２】
請求項４に記載の電力変換装置において、
前記電力変換装置は、モータ外周に設けられる、電力変換装置。
【発明の詳細な説明】
【技術分野】
【０００１】
本発明は、電力変換装置に関し、例えばモータと一体化が可能な電力変換装置に関する。
【背景技術】
【０００２】
電力変換装置としては、直流電力を三相交流電力へ変換するインバータ装置が知られている。インバータ装置は、モータドライブ、無停電電源装置等に広く利用されており、６個の半導体スイッチを使用した三相ブリッジで構成されたものが一般的に知られている。これらの半導体スイッチを、パルス幅変調（ＰＷＭ）方式等に基づいて生成されたパターンでスイッチングさせることにより、インバータ装置は、任意の電圧および周波数を持った三相交流電圧を出力することができる。これにより、インバータ装置をモータドライブに利用すると、モータの速度を可変制御することが可能となり、設備の省エネ化を実現することが可能となる。
【０００３】
インバータ装置のスイッチング方式としては、ハードスイッチング方式及びソフトスイッチング方式の２種類が知られている。インバータ装置におけるソフトスイッチング方式は、主に共振ＤＣリンク方式と補助共振転流方式に大きく分けられる。共振ＤＣリンク方式では、インバータ装置に補助回路を追加し、三相ブリッジの各半導体スイッチのスイッチング時に、ＤＣリンク電圧をおよそ０Ｖにすることでゼロ電圧スイッチング（以下、ＺＶＳと称する）する。しかし、共振ＤＣリンク方式では、ＤＣリンクの前段に接続される電源とＤＣリンクを遮断するためのスイッチが必要であり、このスイッチには主回路電流が流れるため、導通損失が無視できず全体の損失低減効果が限定的である。
【０００４】
一方の補助共振転流方式では、インバータ装置に補助回路を追加し、この補助回路に流れる電流を三相ブリッジの半導体スイッチの出力容量もしくはスナバコンデンサに転流させることで半導体スイッチの両端電圧をおよそ０Ｖにし、三相ブリッジの半導体スイッチをＺＶＳする。
【０００５】
補助共振転流方式は、例えば特許文献１に記載されている。特許文献１には、三相ブリッジの各相中点と直列接続された２つのＤＣリンクコンデンサの中点との間に、インダクタと双方向スイッチからなる補助回路を接続した構成が示されている。補助回路を構成する双方向スイッチを、三相ブリッジのスイッチングタイミングに基づいて駆動することにより、三相ブリッジの半導体スイッチをソフトスイッチングすることが可能である。
【先行技術文献】
【特許文献】
【０００６】
【特許文献１】特開平８−３４０６７６号公報
【発明の概要】
【発明が解決しようとする課題】
【０００７】
補助共振転流方式では、補助回路に電流を流す時、主回路と並列の電流経路を形成するため、主回路電流が補助回路には流れない。このため、補助共振転流方式は、共振ＤＣリンク方式よりもスイッチング損失は小さい。
【０００８】
しかしながら、補助共振転流方式においても、スイッチング損失の低減が十分であると
は言えず、より一層スイッチング損失を低減する技術が望まれる。
【０００９】
本発明の目的は、スイッチング損失の低減を図ることが可能な電力変換装置を提供することにある。
【００１０】
本発明の前記並びにその他の目的と新規な特徴は、本明細書の記述及び添付図面から明らかになるであろう。
【課題を解決するための手段】
【００１１】
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、次のとおりである。
【００１２】
電力変換装置は、直流電圧から三相交流を出力する三相ブリッジと、直流電圧を分圧する複数のコンデンサと、三相ブリッジの各相の中点と複数のコンデンサにより形成された分圧電圧点との間に接続された補助回路とを備える。補助回路は、三相ダイオードブリッジと、インダクタと、三相ブリッジの上アームに対向する第１補助スイッチと、三相ブリッジの下アームに対向する第２補助スイッチとを備えている。ここで、三相ブリッジの上アームのスイッチは、第２補助スイッチがオン状態となり、下アームのスイッチがターンオフした後に、ターンオンする。
【発明の効果】
【００１３】
本願において開示される発明のうち、代表的なものによって得られる効果を簡単に説明すれば、以下のとおりである。
【００１４】
スイッチング損失の低減を図ることが可能な電力変換装置を提供することができる。スイッチング損失の低減を図ることにより、温度上昇が抑えられ、冷却器を小型化することが可能であるため、さらに電力変換装置の小型化を図ることが可能となる。その結果、電力変換装置とモータとを一体化したとき、装置全体の小型化を図ることも可能となる。
【図面の簡単な説明】
【００１５】
【図１】実施の形態１に係わる電力変換装置の構成を示す回路図である。
【図２】実施の形態１に係わる制御回路が生成するゲート信号の波形図である。
【図３】（Ａ）および（Ｂ）は、実施の形態１に係わる電力変換装置における電流経路を説明するための説明図である。
【図４】（Ａ）および（Ｂ）は、実施の形態１に係わる電力変換装置における電流経路を説明するための説明図である。
【図５】（Ａ）および（Ｂ）は、実施の形態１に係わる電力変換装置における電流経路を説明するための説明図である。
【図６】実施の形態１に係わる電力変換装置における電圧および電流の波形を示す波形図である。
【図７】実施の形態１に係わる制御回路が生成するゲート信号の波形図である。
【図８】実施の形態２に係わる制御回路が生成するゲート信号の波形図である。
【図９】（Ａ）および（Ｂ）は、実施の形態２に係わる電力変換装置における電流経路を説明するための説明図である。
【図１０】（Ａ）および（Ｂ）は、実施の形態２に係わる電力変換装置における電流経路を説明するための説明図である。
【図１１】（Ａ）および（Ｂ）は、実施の形態２に係わる電力変換装置における電流経路を説明するための説明図である。
【図１２】実施の形態３に係わる電力変換装置の動作を示すフローチャート図である。
【図１３】実施の形態３に係わる電力変換装置を説明するための図である。
【図１４】実施の形態４に係わるモータシステムの構成を示すブロック図である。
【発明を実施するための形態】
【００１６】
以下の実施の形態においては便宜上その必要があるときは、複数のセクションまたは実施の形態に分割して説明するが、特に明示した場合を除き、それらは互いに無関係なものではなく、一方は他方の一部または全部の変形例、詳細、補足説明等の関係にある。また、以下の実施の形態において、要素の数等（個数、数値、量、範囲等を含む）に言及する場合、特に明示した場合および原理的に明らかに特定の数に限定される場合等を除き、その特定の数に限定されるものではなく、特定の数以上でも以下でも良い。
【００１７】
さらに、以下の実施の形態において、その構成要素（要素ステップ等も含む）は、特に明示した場合および原理的に明らかに必須であると考えられる場合等を除き、必ずしも必須のものではないことは言うまでもない。同様に、以下の実施の形態において、構成要素等の形状、位置関係等に言及するときは、特に明示した場合および原理的に明らかにそうでないと考えられる場合等を除き、実質的にその形状等に近似または類似するもの等を含むものとする。このことは、上記数値および範囲についても同様である。
【００１８】
以下、本発明の実施の形態を図面に基づいて詳細に説明する。なお、実施の形態を説明するための全図において、同一の部材には原則として同一の符号を付し、その繰り返しの説明は原則として省略する。
【００１９】
（実施の形態１）
図１は、実施の形態１に係わる電力変換装置の構成を示す回路図である。図１において、１００は電力変換装置を示している。電力変換装置１００は、第一ＤＣリンクコンデンサ１０１と、第二ＤＣリンクコンデンサ１０２と、三相ブリッジ１０３と、補助回路１０８と、制御回路１１２とを備えている。第一ＤＣリンクコンデンサ１０１および第二ＤＣリンクコンデンサ１０２は、以下、単にＤＣリンクコンデンサ１０１おとび１０２と称する。
【００２０】
三相ブリッジ１０３は、６個の半導体スイッチＱ１〜Ｑ６で構成されている。図１では、半導体スイッチＱ１、Ｑ３およびＱ５が、三相ブリッジ１０３の上アームのスイッチを構成し、半導体スイッチＱ２、Ｑ４およびＱ６が、三相ブリッジ１０３の下アームのスイッチを構成している。また、半導体スイッチＱ１とＱ２とによってＵ相のレグが構成され、半導体スイッチＱ３とＱ４とによってＶ相のレグが構成され、半導体スイッチＱ５とＱ６とによってＷ相のレグが構成されている。
【００２１】
図１において、ＬＤＶおよびＬＤＧは、図示しない直流電力源から直流電圧が供給される一対の配線を示している。Ｕ相のレグを構成する半導体スイッチＱ１とＱ２の電流経路が、配線ＬＤＶとＬＤＧとの間で直列となるように、半導体スイッチＱ１、Ｑ２は直列接続されており、半導体スイッチＱ１とＱ２の接続部ＢＵＣが、Ｕ相の中点に相当する。Ｖ相のレグを構成する半導体スイッチＱ３、Ｑ４と、Ｗ相のレグを構成する半導体スイッチＱ５、Ｑ６についても、Ｕ相のレグを構成する半導体スイッチＱ１、Ｑ２と同様に、配線ＬＤＶとＬＤＧの間で直列接続されている。半導体スイッチＱ３とＱ４とを接続する接続部ＢＶＣがＶ相の中点に相当し、半導体スイッチＱ５とＱ６とを接続する接続部ＢＷＣがＷ相の中点に相当する。
【００２２】
補助回路１０８は、インダクタ１０４と、ハーフブリッジ１０５と、三相ダイオードブリッジ１０７とを備えている。三相ダイオードブリッジ１０７は、６個のダイオード１０６ｕｐ〜１０６ｗｎを備えている。６個のダイオードのうち、ダイオード１０６ｕｐと１０６ｕｎがＵ相に対向し、ダイオード１０６ｖｐと１０６ｖｎがＶ相に対向し、ダイオード１０６ｗｐと１０６ｗｎがＷ相に対向している。
【００２３】
Ｕ相に対向したダイオード１０６ｕｐと１０６ｕｎを例にして述べると、一対の出力配線ＬＤＣ、ＬＤＡ間にダイオード１０６ｕｐと１０６ｕｎが直列接続されている。ダイオード１０６ｕｐと１０６ｕｎとを接続する接続部ＤＵＣが、三相ダイオードブリッジ１０７のＵ相の中点に相当し、対向する三相ブリッジ１０３のＵ相の中点である接続部ＢＵＣに接続されている。Ｖ相に対向したダイオード１０６ｖｐ、１０６ｖｎと、Ｗ相に対向したダイオード１０６ｗｐ、１０６ｗｎについても、Ｕ相に対向したダイオード１０６ｕｐ、１０６ｕｎと同様に、出力配線ＬＤＣ、ＬＤＡ間に直列接続されている。また、接続部ＤＶＣ、ＤＷＣが、三相ダイオードブリッジ１０７のＶ相、Ｗ相の中点に相当する。
【００２４】
ハーフブリッジ１０５は、出力配線ＬＤＣとＬＤＡとの間で、直列接続された半導体スイッチＳ１と半導体スイッチＳ２とを備えている。半導体スイッチＳ１は、三相ブリッジ１０３の上アームに対向しており、第１補助スイッチと見なすことができる。また、半導体スイッチＳ２は、三相ブリッジ１０３の下アームに対向しており、第２補助スイッチと見なすことができる。半導体スイッチＳ１とＳ２との間の接続部ＨＢＣが、ハーフブリッジ１０５の中点に相当する。
【００２５】
ＤＣリンクコンデンサ１０１と１０２とは、電圧配線ＬＤＶとＬＤＧとの間で、直列接続されており、ＤＣリンクコンデンサ１０１と１０２とによって、電圧配線ＬＤＶ、ＬＤＧに供給される直流電圧を分圧する分圧回路が構成されている。ＤＣリンクコンデンサ１０１と１０２との間の接続部ＤＤＣから、分圧により生成された分圧電圧が出力される。すなわち、接続部ＤＤＣが、分圧電圧が出力される分圧電圧の点あるいはＤＣリンクコンデンサ１０１と１０２により構成された分圧回路の中点に該当する。
【００２６】
補助回路１０８が備えるインダクタ１０４は、接続部ＨＢＣとＤＤＣとの間に接続されている。
【００２７】
実施の形態１においては、三相ブリッジ１０３を構成する半導体スイッチＱ１〜Ｑ６に、スナバコンデンサ１０９ｑ１〜１０９ｑ６と逆並列ダイオード１１１ｄ１〜１１１ｄ６とが並列に設けられている。半導体スイッチＱ１を例にして述べると、半導体スイッチＱ１の電流経路とスナバコンデンサ１０９ｑ１と逆並列ダイオード１１１ｄ１とが並列になるように、スナバコンデンサ１０９ｑ１と逆並列ダイオード１１１ｄ１が、半導体スイッチＱ１に接続されている。スナバコンデンサ１０９ｑ２〜１０９ｑ６と逆並列ダイオード１１１ｄ２〜１１１ｄ６も、同様に、半導体スイッチＱ２〜Ｑ６に接続されている。同様に、半導体スイッチＳ１およびＳ２についても、その電流経路と並列となるように、ダイオードが半導体スイッチＳ１、Ｓ２と接続されている。
【００２８】
電力変換装置１００には、ＤＣリンクコンデンサ１０１、１０２が接続された電圧配線ＬＤＶ、ＬＤＧに、図示しないＤＣリンク部の直流電力源から直流電圧が供給される。電力変換装置１００は、供給された直流電圧を、三相ブリッジ１０３で三相交流電圧に変換し、各相の中点に接続された出力端子１１０ｕ〜１１０ｗに出力する。出力端子１１０ｕ〜１１０ｗには、図示しないモータ等の負荷が接続される。
【００２９】
前記したように、三相ブリッジ１０３の各相中点、すなわち三相ブリッジ１０３の出力は、補助回路１０８の三相ダイオードブリッジ１０７の各相中点と接続され、三相ダイオードブリッジ１０７の出力は、半導体スイッチＳ１、Ｓ２を介してハーフブリッジ１０５の中点に接続されている。ハーフブリッジ１０５の中点には、インダクタ１０４の一方の端子が接続され、インダクタ１０４の他方の端子は、ＤＣリンクコンデンサ１０１、１０２により構成された分圧回路の中点に接続されている。
【００３０】
制御回路１１２は、三相ブリッジ１０３が備える半導体スイッチＱ１〜Ｑ６を駆動するゲート信号ＱＧと、ハーフブリッジ１０５が備える半導体スイッチＳ１およびＳ２を駆動するゲート信号ＳＧとを生成する。
【００３１】
実施の形態１に係わる補助回路１０８は、図１に示すように、２個の半導体スイッチＳ１、Ｓ２と、インダクタ１０４と、６個のダイオード１０６ｕｐ〜１０６ｗｎとによって構成されている。言い換えるならば、追加部品として、２個の半導体スイッチと１個のインダクタと６個のダイオードとを追加することにより、補助回路１０８を構成することが可能である。これらの追加部品のうち、インダクタおよびダイオードは受動素子であるため、インダクタおよびダイオードを制御する制御部は必要とされない。そのため、ダイオード等の受動素子を追加しても、電力変換装置１００が大型化するのを抑制することが可能である。これに対して、特許文献１においては、各相に対して１個のインダクタと２個の半導体スイッチが必要とされ、三相のインバータ装置では、前記したように３個のインダクタと６個の半導体スイッチが必要とされる。さらに特許文献１に記載の技術では、６個の半導体スイッチを制御する制御部も必要とされる。したがって、実施の形態１に係わる電力変換装置１００は、特許文献１に記載のものに比べて、構成が簡素となり、小型化することが可能である。また、電力変換装置１００のコストが上昇するのを抑制することも可能である。
【００３２】
半導体スイッチＱ１〜Ｑ６、Ｓ１およびＳ２は、ＩＧＢＴあるいはＭＯＳＦＥＴ等によって構成することができる。図１では、制御回路１１２が、半導体スイッチＱ１〜Ｑ６を制御するゲート信号ＱＧと、半導体スイッチＳ１、Ｓ２を制御するゲート信号ＳＧを形成する例を示したが、これに限定されるものではない。例えば、ゲート信号ＱＧとゲート信号ＳＧは、別々の制御回路によって形成するようにしてもよい。
【００３３】
なお、図１において、ｎｄおよびｎｓは、ＩＧＢＴあるいはＭＯＳＦＥＴ等の端子を示し、Ｑ１−Ｉは、半導体スイッチＱ１を流れる電流を示している。端子ｎｄは、例えばＭＯＳＦＥＴのドレイン端子を示し、端子ｎｓは、ＭＯＳＦＥＴのソース端子を示す。また、電流Ｑ１−Ｉは、ＭＯＳＦＥＴの電流経路（ドレイン−ソース電流経路）を流れる電流と、逆並列ダイオード１１１ｄ１を流れる電流と、スナバコンデンサ１０９ｑ１を流れる電流の合成電流を示している。図１では、半導体スイッチＱ１についてのみ、端子ｎｄ、ｎｄおよび電流Ｑ１−Ｉが明示されているが、他の半導体スイッチＱ２〜Ｑ６についても、同様である。端子ｎｄ、ｎｓおよび電流Ｑ１−Ｉについては、後で図６を説明する際に用いるので、ここでは説明を省略する。
【００３４】
なお、半導体スイッチと、半導体スイッチの電流経路に対して並列的に接続されたスナバコンデンサおよび逆並列ダイオードとを含めて、単にスイッチと見なしてもよい。
【００３５】
＜半導体スイッチのゲート信号＞
図２は、実施の形態１に係わる制御回路が生成するゲート信号の波形図である。図２において、Ｖｓａｗは、ＰＷＭキャリア信号を示している。図２では、ＰＷＭキャリア信号Ｖｓａｗの電圧は、鋸波状に変化し、ピーク電圧に到達すると、極性が反転して、再び鋸波状に変化する。制御回路１１２は、ＰＷＭキャリア信号Ｖｓａｗと所定の信号とを比較することにより、ゲート信号ＱＧを形成する。
【００３６】
図１に示したゲート信号ＱＧは、半導体スイッチＱ１〜Ｑ６に対応したゲート信号Ｖｇ＿Ｑ１〜Ｖｇ＿Ｑ６を含んでおり、ゲート信号ＳＧは、半導体スイッチＳ１、Ｓ２に対応したゲート信号Ｖｇ＿Ｓ１、Ｖｇ＿Ｓ２を含んでいる。図２において、横軸は時間ｔを示し、縦軸はＰＷＭキャリア信号Ｖｓａｗ、ゲート信号Ｖｇ＿Ｑ１〜Ｖｇ＿Ｑ６、Ｖｇ＿Ｓ２の電圧を示している。
【００３７】
図２には、以下の状態を想定した波形が示されている。本明細書では、図１において、出力端子１１０ｕ、１１０ｖ、１１０ｗを流れる出力電流の方向が、紙面左側から右側の場合を正とし、紙面右側から左側へ出力電流が流れる方向を負としている。図２には、出力端子１１０ｕおよび１１０ｖを流れる出力電流の方向が正で、出力端子１１０ｗを流れる出力電流の方向が負の場合を想定した状態の波形が示されている。また、図２に示した期間は、ＰＷＭキャリア信号Ｖｓａｗの１周期分である。出力端子を流れる出力電流は、三相交流であるため、周期的に変化するが、ＰＷＭキャリア信号Ｖｓａｗの周期は、出力電流の周期に比べて十分に短い。そのため、以下の説明では、出力端子を流れる出力電流の値は、一定であると考える。このような想定の下、半導体スイッチＱ１〜Ｑ６およびＳ１、Ｓ２の動作の推移を説明する。
【００３８】
時刻０から時刻ｔ１までの期間Ｉにおいて、半導体スイッチＱ２、Ｑ４、Ｑ６がターンオンした状態で、他の半導体スイッチＱ１、Ｑ３、Ｑ５がターンオフした状態になっている。すなわち、三相ブリッジ１０３の下アームにおける各相の半導体スイッチがオン状態で、上アームにおける各相の半導体スイッチがオフ状態になっている。
【００３９】
制御回路１１２は、時刻ｔ１において、ゲート信号Ｖｇ＿Ｓ２をハイレベルに変化させることにより、半導体スイッチＳ２をターンオンさせる。時刻ｔ２において、ＰＷＭキャリア信号Ｖｓａｗが、ピーク値に達し、ＰＷＭキャリア信号Ｖｓａｗのリセットタイミングに到達すると、ゲート信号Ｖｇ＿Ｑ２、Ｖｇ＿Ｑ４、Ｖｇ＿Ｑ６がローレベルに変化し、半導体スイッチＱ２、Ｑ４、Ｑ６がターンオフする。そなわち、時刻ｔ１から時刻ｔ２までの期間ＩＩにおいて、制御回路１１２は、補助回路１０８内の半導体スイッチＳ２と下アームの各相の半導体スイッチＱ２、Ｑ４、Ｑ６とをオン状態にする。
【００４０】
時刻ｔ２から時刻ｔ３までの期間ＩＩＩは、上アームにおける半導体スイッチＱ１、Ｑ３、Ｑ５と下アームにおける半導体スイッチＱ２、Ｑ４、Ｑ６が、ともにオフ状態となるデッドタイム期間である。このデッドタイム期間ＩＩＩにおいても、制御回路１１２は、半導体スイッチＳ２がオン状態を維持するように、ハイレベルのゲート信号Ｖｇ＿Ｓ２を生成する。
【００４１】
デッドタイム期間ＩＩＩが終了する時刻ｔ３において、制御回路１１２は上アームの各相における半導体スイッチＱ１、Ｑ３、Ｑ５がターンオンするように、ゲート信号Ｖｇ＿Ｑ１、Ｖｇ＿Ｑ３、Ｖｇ＿Ｑ５をハイレベルに変化させる。半導体スイッチＱ１、Ｑ３、Ｑ５がオン状態となった後、所定の時間経過した時刻ｔ４において、制御回路１１２は、ゲート信号Ｖｇ＿Ｓ２をローレベルに変化させることにより、半導体スイッチＳ２をターンオフさせる。すなわち、補助回路１０８内の半導体スイッチＳ２は、上アームの各相における半導体スイッチＱ１、Ｑ３、Ｑ５がオン状態になった後、時刻ｔ３から時刻ｔ４までの期間ＩＶも、オン状態を維持し、時刻ｔ４のタイミングで、オフ状態となるように、制御される。
【００４２】
図２には示していないが、期間Ｉ〜期間ＩＶの間、制御回路１１２は、ハーフブリッジ１０５を構成する半導体スイッチＳ１をターンオフの状態に維持する。
【００４３】
以上で、期間Ｉ〜期間ＩＶまでの一連のスイッチング動作が終了する。次に、スイッチング動作によって、期間Ｉ〜期間ＩＶの各期間において流れる電流経路を、図を用いて説明する。
【００４４】
＜電流経路の状態＞
図３〜図５は、実施の形態１に係わる電力変換装置における電流経路を説明するための説明図である。図３〜図５を用いて説明する電力変換装置１００の構成は、図１で説明したものと同じであるため、原則として構成の説明は省略する。また、図３〜図５において、矢印付きの破線は、電流の流れる向きと経路を示している。
【００４５】
図２と図３〜図５との対応を説明しておくと、図３（Ａ）および（Ｂ）は、図２に示した期間Ｉおよび期間ＩＩにおける電流経路を示しており、図４（Ａ）および（Ｂ）は、図２に示した期間ＩＩＩにおける電流経路を示している。また、図５（Ａ）および（Ｂ）は、図２に示した期間ＩＶにおける電流経路を示している。
【００４６】
図３（Ａ）において、Ｌｒはインダクタ１０４のインダクタンスを示し、Ｃｒはスナバコンデンサ１０９ｑ１のキャパシタンスを示し、Ｖｄｃは直流電力源から電力変換装置１００に供給される直流電圧（ＤＣリンク電圧）を示している。実施の形態１においては、スナバコンデンサ１０９ｑ１〜１０９ｑ６は、同じ値のキャパシタンスを有している。また、Ｉｕは出力端子１１０ｕを流れる出力電流を示し、Ｉｖは出力端子１１０ｖを流れる出力端子を示し、Ｉｗは出力端子１１０ｗを流れる出力電流を示している。
【００４７】
期間Ｉにおいては、下アームの各相の半導体スイッチＱ２、Ｑ４、Ｑ６の全てがオン状態であるため、図３（Ａ）に示すように、出力電流Ｉｕ、Ｉｖ、Ｉｗは、半導体スイッチＱ２、Ｑ４、Ｑ６間を還流している。
【００４８】
期間Ｉから期間ＩＩに移行する時刻ｔ１において、補助回路１０８内の半導体スイッチＳ２がターンオンする。そのため、期間ＩＩにおいては、ＤＣリンクコンデンサ１０２と、インダクタ１０４と、ダイオード１０６ｕｎ、１０６ｖｎと、半導体スイッチＱ２、Ｑ４と、半導体スイッチＳ２によってループが形成されることになる。この形成されたループを電流が流れ始める。すなわち、図３（Ａ）に示した電流経路に対して前記したループが追加され、２つの電流経路を出力電流Ｉｕ、Ｉｖ、Ｉｗは流れることになる。このとき、電流経路にインダクタ１０４があるため、半導体スイッチＳ2はゼロ電流スイッチング（ＺＣＳ）となる。期間ＩＩにおいては、ダイオード１０６ｗｎは導通しないため、ダイオード１０６ｗｎは電流経路とはならない。これは、還流している出力電流が、半導体スイッチＱ６については、紙面の上側から下側に向かって流れるため、Ｗ相の中点、すなわち図１に示した接続部ＢＷＣの電位が、Ｕ相およびＶ相の中点における電位よりも高くなるためである。これにより、ダイオード１０６ｗｎは逆バイアス状態となり、ダイオード１０６ｗｎはオフ状態となる。
【００４９】
電流経路をより厳密に述べるならば、半導体スイッチＱ２およびＱ４を流れる電流にも順番がある。すなわち、半導体スイッチＱ２、Ｑ４のうち、大きな出力電流に対応する半導体スイッチから順に電流が流れ始める。これは、電流の大きさによってダイオードの順方向電圧降下が異なるからである。
【００５０】
リンク電圧Ｖｄｃは、ＤＣリンクコンデンサ１０１、１０２によって構成された分圧回路によって分圧される。実施の形態１においては、リンクコンデンサ１０１と１０２は、等しいキャパシタンスである。そのため、分圧電圧点ＤＤＣ（図１）における分圧電圧は、ＤＣリンク電圧Ｖｄｃの約１／２となる。これにより、インダクタ１０４には、約１／２のＤＣリンク電圧Ｖｄｃが印加されることになり、インダクタ１０４を流れるインダクタ電流は、直線的に増加することになる。
【００５１】
時刻ｔ２において、インダクタ１０４を流れるインダクタ電流が、半導体スイッチＱ６を流れる出力電流と等しくなると、三相ブリッジ１０３（図１）の下アームを構成する半導体スイッチＱ２、Ｑ４およびＱ６の全てがターンオフする。このとき、半導体スイッチＱ２、Ｑ４およびＱ６の両端間の電圧、すなわち、これらの半導体スイッチのソース端子−ドレイン端子間の電圧は、並列に接続されたスナバコンデンサ１０９ｑ２、１０９ｑ４および１０９ｑ６（図１）によって、遅れて上昇する。そのため、時刻ｔ２において、半導体スイッチＱ２、Ｑ４およびＱ６の両端子の電圧が０Ｖの状態で、電流を遮断することができるため、下アームを構成する半導体スイッチＱ２、Ｑ４およびＱ６のターンオフは、ＺＶＳ動作となる。
【００５２】
なお、図３（Ｂ）において、Ｖｑ１は、半導体スイッチＱ１のソース端子とドレイン端子間の電圧(以下、「端子間電圧」と呼ぶ)を示し、Ｉｑ１は、半導体スイッチＱ１、スナバコンデンサ１０９ｑ１および逆並列ダイオード１１１ｄ１を流れる合成電流を示している。
【００５３】
期間ＩＩＩは、２つの連続した期間ＩＩＩ−１とＩＩＩ−２によって構成されている。図４においては、先の期間ＩＩＩ−１における電流経路が図４（Ａ）に示されており、後の期間ＩＩＩ−２における電流経路が図４（Ｂ）に示されている。
【００５４】
時刻ｔ２において、三相ブリッジ１０３の下アームにおける全ての半導体スイッチがターンオフする。そのため、時刻ｔ２の後の期間ＩＩＩ−１においては、図４（Ａ）に示すように、インダクタ１０４を流れているインダクタ電流は、三相ブリッジ１０３を構成する半導体スイッチに接続されたスナバコンデンサ１０９ｑ１〜１０９ｑ６に転流することになる。この場合、インダクタ１０４は、スナバコンデンサと直列接続されることになるため、ＬＣ直列共振回路が構成されることになり、ＬＣ直列共振が開始することになる。
【００５５】
ＬＣ直列共振が開始することにより、スナバコンデンサ１０９ｑ１〜１０９ｑ６には、図４（Ａ）に矢印付きの破線で示す方向の電流が流れることになる。すなわち、三相ブリッジ１０３の上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５に接続されているスナバコンデンサ１０９ｑ１、１０９ｑ３、１０９ｑ５においては、放電を行う方向（負方向）の電流が流れることになる。これに対して、三相ブリッジ１０３の下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６に接続されているスナバコンデンサ１０９ｑ２、１０９ｑ４、１０９ｑ６には、充電を行う方向（正方向）の電流が流れることになる。
【００５６】
期間ＩＩＩ−２において、上アームのスナバコンデンサ１０９ｑ１、１０９ｑ３、１０９ｑ５の放電が終了する。これにより、上アームの半導体スイッチＱ１、Ｑ３、Ｑ５のそれぞれの端子間電圧は、実質的に０Ｖとなり、上アームの半導体スイッチＱ１、Ｑ３、Ｑ５に接続された逆並列ダイオード１１１ｄ１、１１１ｄ３、１１１ｄ５（図１）に電流が転流する。このとき、すなわち図２に示した時刻ｔ３において、ゲート信号Ｖｇ＿Ｑ１、Ｖｇ＿Ｑ３をハイレベルに変化させることにより、半導体スイッチＱ１、Ｑ３をターンオンさせる。この場合、半導体スイッチＱ１、Ｑ３は、端子間電圧が実質的に０Ｖとなっているため、半導体スイッチＱ１、Ｑ３は、ＺＶＳ動作でターンオンすることになる。なお、このとき、半導体スイッチＱ５については、対応する出力電流Ｉｗの極性が、他相の出力電流Ｉｕ、Ｉｖと異なるため、自動的に電流が転流することになる。
【００５７】
期間ＩＩＩに続く期間ＩＶは、２つの連続する期間ＩＶ−１とＩＶ−２によって構成されている。先の期間ＩＶ−１における電流経路が、図５（Ａ）に示され、後の期間ＩＶ−２における電流経路が、図５（Ｂ）に示されている。
【００５８】
期間ＩＩＩにおける半導体スイッチのスイッチング動作により、期間ＩＶ−１においては、インダクタ１０４に印加される約１／２のＤＣリンク電圧Ｖｄｃの極性が、期間ＩＩのときとは逆極性となる。すなわち、期間ＩＶ−１においても、期間ＩＩのときと同様に、約１／２のＤＣリンク電圧Ｖｄｃが、インダクタ１０４に印加されるが、印加される電圧の極性は、期間ＩＩのときとは異なっている。これにより、期間ＩＶ−１において、インダクタ１０４を流れるインダクタ電流は、増加するのではなく、直線的に減少することになる。
【００５９】
インダクタ１０４を流れるインダクタ電流が減少し、図２に示した時刻ｔ４までに、インダクタ電流は実質的に０Ａになる。インダクタ電流が実質的に０Ａになった後で、図２に示したように、ゲート信号Ｖｇ＿Ｓ２をローレベルに変化させ、ハーフブリッジ１０５（図１）を構成する半導体スイッチＳ２をターンオフさせる。これにより、半導体スイッチＳ２は、その電流経路を流れる電流が、実質的に０Ａのときに、ターンオフすることになり、ゼロ電流スイッチング（ＺＣＳ）することになる。ＺＳＣ動作では、電流経路を流れる電流が実質的に０Ａのときに、半導体スイッチがターンオフまたはターンオンするように動作させる。これにより、ＺＣＳ動作の場合も、ＺＶＳ動作と同様に、ソフトスイッチングを行うことが可能である。
【００６０】
期間ＩＶ−２においては、上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５がターンオン状態となり、下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６がターンオフ状態となる。この期間においては、出力電流Ｉｕ、Ｉｖ、Ｉｗが、上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５を還流する状態となり、一連のスイッチング動作が終了する。
【００６１】
＜スイッチング動作時の電圧、電流波形＞
図６は、実施の形態１に係わる電力変換装置における電圧および電流の波形を示す波形図である。ここでは、図１に示した三相ブリッジ１０３の上アームの半導体スイッチＱ１を、代表例として説明するが、半導体スイッチＱ３についても、動作は半導体スイッチＱ１と同様である。
【００６２】
図６において、符号ｎｄ−ｎｓは、図１に示した端子ｎｄと端子ｎｓ間の端子間電圧を示し、符号Ｑ１−Ｉは、図１に示した半導体スイッチＱ１を流れる電流を示している。図１において説明したように、電流Ｑ１−Ｉは、ＭＯＳＦＥＴの電流経路を流れる電流と、逆並列ダイオードおよびスナバコンデンサを流れる電流の合成電流を示している。
【００６３】
また、符号Ｖｇ＿ＰＡは、三相ブリッジ１０３の上アームを構成する半導体スイッチのゲート信号を示し、符号Ｖｇ＿ＮＡは、三相ブリッジ１０３の下アームを構成する半導体スイッチのゲート信号を示している。すなわち、ゲート信号ＶＧ＿ＰＡは、図２に示したゲート信号Ｖｇ＿Ｑ１、Ｖｇ＿Ｑ３、Ｖｇ＿Ｑ５に相当し、ゲート信号ＶＧ＿ＮＡは、図２に示したゲート信号Ｖｇ＿Ｑ２、Ｖｇ＿Ｑ４、Ｖｇ＿Ｑ６に相当する。
【００６４】
図２で説明したように、時刻ｔ１において、半導体スイッチＳ２がターンオンされる。これにより、インダクタ１０４の他方の端子は、ＤＣリンクコンデンサ１０１と１０２との間の接続部に接続されるとともに、インダクタ１０４の一方の端子は、半導体スイッチＳ２、ダイオード１０６ｕｎ、１０６ｖｎおよび半導体スイッチＱ２、Ｑ４を介して配線ＬＤＧに接続される。その結果、インダクタ１０４の両端子間には、ＤＣリンク電圧Ｖｄｃの約１／２の電圧が印加されることになる。これにより、インダクタ１０４を流れるインダクタ電流１０４Ｉは、図６に示すように、期間ＩＩにおいて、直線的に増加する。
【００６５】
時刻ｔ２において、下アームを構成する半導体スイッチがターンオフすることで、インダクタ電流１０４Ｉが、スナバコンデンサ１０９ｑ１〜１０９ｑ６のそれぞれに転流し、インダクタ１０４とスナバコンデンサ１０９ｑ１〜１０９ｑ６とを含むＬＣ直列共振回路においてＬＣ直列共振の動作が開始する。その結果、インダクタ電流１０４Ｉは、図６に示すように、期間ＩＩＩにおいて、正弦波状に変化する。このとき、図４（Ａ）で説明しように、半導体スイッチＱ１に接続されたスナバコンデンサ１０９ｑ１においては、放電を行う負方向の電流Ｑ１−Ｉが流れ、半導体スイッチＱ１の端子間電圧ｎｄ−ｎｓは減少する。なお、電流Ｑ１−Ｉは、インダクタ１０４とスナバコンデンサ１０９ｑ１によって定まる共振周波数に従って変化し、期間ＩＩＩにおける電流Ｑ１−Ｉは、インダクタ電流１０４Ｉの形状を反転したような波形形状を有することになる。
【００６６】
端子間電圧ｎｄ−ｎｓが減少し、時刻ｔ３において実質的に０Ｖになり、半導体スイッチＱ１に接続されている逆並列ダイオード１１１ｄ１に電流が転流し、ＬＣ直列共振が終了する。その後、上アームを構成する半導体スイッチＱ１、Ｑ３をターンオンさせることによって、半導体スイッチＱ１、Ｑ３は、それぞれの端子間電圧ｎｄ−ｎｓが実質的に０Ｖの状態のときに、ターンオンさせることが可能となる。すなわち、半導体スイッチＱ１、Ｑ２を、ＺＶＳ動作でターンオンさせることが可能である。
【００６７】
時刻ｔ３からｔ４の期間ＩＶにおいては、上アームを構成する半導体スイッチがターンオンしているため、インダクタ１０４の一方の端子は、半導体スイッチＳ２、ダイオード１０６ｕｎ、１０６ｖｎ、１０６ｗｎおよび上アームの半導体スイッチを介して、配線ＬＤＶに接続される。そのため、インダクタ１０４の両端子間には、逆極性のＤＣリンク電圧Ｖｄｃの約１／２の電圧が印加されることになる。これにより、期間ＩＶにおいて、インダクタ１０４を流れるインダクタ電流１０４Ｉは、図６に示すように、直線的に減少し、０Ａになると三相ダイオードブリッジ１０７を構成するダイオードはオフ状態となる。この後で、ハーフブリッジ１０５を構成する半導体スイッチＳ２をターンオフさせる。半導体スイッチＳ２をターンオフさせるとき、インダクタ電流１０４Ｉが、実質的に０Ａとなっているため、半導体スイッチＳ２をＺＣＳ動作でターンオフさせることが可能である。このようにして、図３〜図５で説明した一連のスイッチング動作が実行される。
【００６８】
期間ＩＩＩにおいて、インダクタ電流１０４Ｉをスナバコンデンサに転流させるためには、期間ＩＩにおいてインダクタ１０４に初期電流を流す必要がある。インダクタ１０４に流す初期電流の条件について、ここで説明する。
【００６９】
時刻ｔ２から、インダクタ電流１０４Ｉを各スナバコンデンサに転流させるためには、インダクタ電流１０４Ｉの値が、時刻ｔ２までに出力電流の値以上となるようにする必要がある。このために、例えば出力端子１１０ｗに流れている出力電流Ｉｗの絶対値をｉ＿ｗとすると、式（１）のような条件が成立することが要求される。なお、図６においては、出力電流Ｉｗの絶対値ｉ＿ｗが破線４０１で示されている。
【００７０】
ｉ＿Ｌｒ＝（１/Ｌｒ）×∫Ｖ＿ＤＣｄｔ＝（Ｖ＿ＤＣ/２Ｌｒ）×Ｔ＿ＩＩ≧ｉ＿ｗ      ・・・式（１）
式（１）において、ｉ＿Ｌｒは、インダクタ電流１０４Ｉの値を示し、Ｌｒはインダクタ１０４のインダクタンスを示し、Ｖ＿ＤＣはＤＣリンク電圧Ｖｄｃの電圧値を示し、Ｔ＿ＩＩは期間ＩＩの時間を示す。式（１）を整理すると、期間ＩＩの時間Ｔ＿ＩＩは、式（２）のような条件を満たせば良いことがわかる。
【００７１】
Ｔ＿ＩＩ≧２Ｌｒ×ｉ＿ｗ/Ｖ＿ＤＣ      ・・・式（２）
したがって、半導体スイッチＳ２をターンオンする時刻ｔ１は、出力電流の大きさによって、式（２）を満足するように決定すればよい。言い換えるならば、半導体スイッチＳ２をターンオンする時刻ｔ１は、出力電流の大きさに依存して、変更することが望ましい。
【００７２】
＜電流極性反転＞
次に、図１に示した出力端子１１０ｕ、１１０ｖ、１１０ｗを流れる電流が反転したときを説明する。すなわち、図１では、出力端子１１０ｕ、１１０ｖ、１１０ｗを流れる電流の向きが、“正”、“正”、“負”の場合を説明したが、ここでは、出力端子１１０ｕ、１１０ｖ、１１０ｗを流れる電流の向きが、“負”、“負”、“正”の場合を説明する。
【００７３】
図７は、実施の形態１に係わる制御回路が生成するゲート信号の波形図である。図７には、図２で説明した電流が反転した状態が示されている。また、図７において、符号Ｖｇ＿Ｓ１は、ハーフブリッジ１０５を構成する半導体スイッチＳ１を制御するゲート信号を示している。
【００７４】
実施の形態１においては、３相の出力電流Ｉｕ、Ｉｖ、Ｉｗのうち、同じ方向に流れていた２相の出力電流の方向が反転した場合、ＰＷＭキャリア信号Ｖｓａｗの鋸波の極性が、図７に示すように反転する。すなわち、例えば期間Ｉ〜ＩＩを見た場合、図２では、ＰＷＭキャリア信号Ｖｓａｗの波形は、上昇するように変化するのに対して、図７では、期間Ｉ〜ＩＩに対応する期間Ｉ’〜ＩＩ’のとき、ＰＷＭキャリア信号Ｖｓａｗの波形は、下降するように変化する。
【００７５】
図７において、期間Ｉ’の時刻ｔ１’直前では、制御回路１１２は、ゲート信号Ｖｇ＿Ｑ１、Ｖｇ＿Ｑ３、Ｖｇ＿Ｑ５をハイレベルにしている。これにより、三相ブリッジ１０３の上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５は、期間Ｉ’においてターンオン状態となっている。また、制御回路１１２は、時刻ｔ１’において、ゲート信号Ｖｇ＿Ｓ１をハイレベルに変化させる。これにより、ハーフブリッジ１０５を構成する半導体スイッチＳ１がターンオンし、期間Ｉ’に続く期間ＩＩ’においては、半導体スイッチＱ１、Ｑ３、Ｑ５およびＳ１が、ターンオンした状態となる。
【００７６】
時刻ｔ２’において、ＰＷＭキャリア信号Ｖｓａｗがピークに達し、時刻ｔ２’がＰＷＭキャリア信号Ｖｓａｗのリセットタイミングとなる。このリセットタイミングになると、制御回路１１２は、上アームの半導体スイッチＱ１、Ｑ３、Ｑ５がターンオフするように、対応するゲート信号をローレベルに変化させる。時刻ｔ２’から時刻ｔ３’までの期間ＩＩＩ’、制御回路１１２は、上アームの半導体スイッチおよび下アームの半導体スイッチがターンオフ状態となるように、これらの半導体スイッチに対応するゲート信号をローレベルに維持する。これにより、期間ＩＩＩ’は、デッドタイム期間となる。制御回路１１２は、時刻ｔ２’から時刻ｔ３’までの期間ＩＩＩ’においても、ハーフブリッジ１０５を構成する半導体スイッチＳ１がターンオン状態を維持するように、ゲート信号Ｖｇ＿Ｓ１をハイレベルに維持する。
【００７７】
次に、時刻ｔ３’において、制御回路１１２は、ゲート信号Ｖｇ＿Ｑ２、Ｖｇ＿Ｑ４、Ｖｇ＿Ｑ６をハイレベルに変化させる。これにより、下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６が、時刻ｔ３’でターンオンする。一方、制御回路１１２は、時刻ｔ４’まで、ゲート信号Ｖｇ＿Ｓ１をハイレベルに維持する。その結果、時刻ｔ４’において、半導体スイッチＳ１はターンオフし、半導体スイッチＱ２、Ｑ４、Ｑ６はターンオン状態を維持することになる。
【００７８】
以上の動作は、図２で説明した動作の電流極性を反転させたものであり、動作原理は、図２と同じである。すなわち、半導体スイッチＱ１、Ｑ３、Ｑ５をターンオフさせるときには、これらの半導体スイッチをＺＶＳ動作でターンオフさせることが可能である。また、半導体スイッチＱ２、Ｑ４、Ｑ６をターンオンさせるときには、半導体スイッチＱ２、Ｑ４を、ＺＶＳ動作でターンオンさせることが可能である。さらに、半導体スイッチＳ１は、ＺＣＳ動作でターンオンおよびターンオフを行うことが可能である。
【００７９】
実施の形態１によれば、ターンオンについては、三相ブリッジを構成する半導体スイッチのうち２相の半導体スイッチを、ＺＶＳ動作でターンオンさせることが可能である。また、ターンオフについては、３相の半導体スイッチをＺＶＳ動作でターンオフさせることが可能である。さらに、補助回路を構成する半導体スイッチＳ１、Ｓ２は、ＺＣＳ動作でターンオンおよびターンオフを行うことが可能である。これにより、半導体スイッチのターンオンおよびターンオフに伴うスイッチング損失の低減を図ることが可能となる。また、電力変換装置の回路構成を簡素にすることが可能であるため、電力変換装置の小型化を図ることが可能である。さらに、スイッチング損失の低減を図ることが可能であるため、冷却器の小型化あるいは冷却器の設置を不要とすることが可能であり、電力変換装置の更なる小型化が可能である。また、スイッチング時に生じるノイズを低減することが可能である。
【００８０】
ターンオンに関しては、特定の１相の半導体スイッチは、ソフトスイッチング動作ではなく、ハードスイッチング動作でターンオンを行う。すなわち、それが出力する出力電流の極性が、他の２相の出力電流の極性と異なる半導体スイッチは、ハードスイッチング動作で、ターンオンする。図２および図７の例では、出力電流Ｉｗの極性が、他の出力電流Ｉｕ、Ｉｖと異なっている。この出力電流Ｉｗは、Ｗ相の半導体スイッチＱ６から出力されるため、半導体スイッチＱ６は、ターンオンするとき、ハードスイッチング動作をする。一方、同じＷ相の半導体スイッチＱ５は、対応するゲート信号Ｖｇ＿Ｑ５をハイレベルに変化させなくても、ソフトスイッチング動作でターンオンする。そのため、図２に示したように、時刻ｔ３において、ゲート信号Ｖｇ＿Ｑ５をハイレベルに変化させる必要は無い。しかしながら、ゲート信号Ｖｇ＿Ｑ５をハイレベルにすることにより、半導体スイッチＱ５を構成するＭＯＳＦＥＴの内部インピーダンスの低減を図ることが可能である。そのため、半導体スイッチにＭＯＳＦＥＴを使用する場合には図２に示すように、時刻ｔ３において、ゲート信号Ｖｇ＿Ｑ５もハイレベルに変化させることが望ましい。
【００８１】
図２では、出力電流Ｉｕ、Ｉｖ、Ｉｗの極性が”正”、”正”、”負”の場合を説明した。この場合、三相ブリッジ１０３において、ターンオフする半導体スイッチは、Ｑ２、Ｑ４、Ｑ６であった。これに対して、図７では、出力電流Ｉｕ、Ｉｖ、Ｉｗの極性が、図２の場合に対して反転し、“負”、“負”、“正”の場合を説明したが、この場合には、三相ブリッジ１０３において、ターンオフする半導体スイッチは、Ｑ１、Ｑ３、Ｑ５である。このように、実施の形態１に係わる電力変換装置１００においては、三相ブリッジ１０３からの出力電流の極性に応じて、ＰＷＭキャリア信号Ｖｓａｗのリセットタイミングでターンオフする半導体スイッチが切り替わる。
【００８２】
（実施の形態２）
実施の形態１では、三相ブリッジ１０３を構成する半導体スイッチをターンオンさせるときに、２相分の半導体スイッチを、ソフトスイッチング動作させる構成を示した。これに対して、実施の形態２においては、三相ブリッジ１０３を構成する半導体スイッチをターンオンさせるときに、１相分の半導体スイッチを、ソフトスイッチング動作させる構成が示される。図８は、実施の形態２に係わる制御回路が生成するゲート信号の波形図である。実施の形態２に係わる電力変換装置の構成は、実施の形態１と同じである。そのため、以下の説明において、電力変換装置の構成を述べる場合には、例えば図１を参照する。
【００８３】
図８には、図７と同様に、ＰＷＭキャリア信号Ｖｓａｗ、ゲート信号Ｖｇ＿Ｑ１〜Ｖｇ＿Ｑ６およびゲート信号Ｖｇ＿Ｓ１(電圧)が示されている。図８には、電力変換装置１００からの出力電流の極性が、図１の場合と同様な状態になっているときの各電圧が示されている。すなわち、図８に示されている電圧波形は、出力電流ＩｕおよびＩｖの両方が、“正”で、出力電流Ｉｗが、“負”のときの電圧波形である。
【００８４】
実施の形態１の図２においては、上アームの半導体スイッチＱ１、Ｑ３が、ＺＶＳ動作でターンオンしたが、図８では、下アームの半導体スイッチＱ６が、ＺＶＳ動作でターンオンする。このように、半導体スイッチＱ６をＺＶＳ動作でターンオンさせるための条件および各半導体スイッチの動作を説明する。
【００８５】
図２と図８の相異点として、ＰＷＭキャリア信号Ｖｓａｗである鋸波の極性が反転している。これにより、時刻ｔ２において、ターンオフする三相ブリッジの半導体スイッチを、下アームから上アームに切り替えている。すなわち、図２では、時刻ｔ２において、下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６がターンオフしていたが、図８では、時刻ｔ２において、上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５がターンオフする。
【００８６】
制御回路１１２は、期間Ｉの時刻ｔ１直前では、上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５がターンオン状態となるように、ゲート信号Ｖｇ＿Ｑ１、Ｖｇ＿Ｑ３、Ｖｇ＿Ｑ５によって、これらの半導体スイッチを制御している。また、制御回路１１２は、時刻ｔ１直前までは、他の半導体スイッチＱ２、Ｑ４、Ｑ６およびＳ１がターンオフ状態となるように、これらの半導体スイッチを制御している。すなわち、時刻ｔ１の直前では、三相ブリッジの上アームの各相を構成する半導体スイッチＱ１、Ｑ３、Ｑ５の全てをオン状態とし、下アームの各相を構成する半導体スイッチＱ２、Ｑ４、Ｑ６および半導体スイッチＳ１をオフ状態にしている。
【００８７】
時刻ｔ１において、制御回路１１２は、ハーフブリッジ１０５内の半導体スイッチＳ１をターンオンさせ、時刻ｔ１から時刻ｔ２まの期間ＩＩの間、半導体スイッチＱ１、Ｑ３、Ｑ５およびＳ１をオン状態に維持する。
【００８８】
時刻ｔ２において、ＰＷＭキャリア信号Ｖｓａｗがリセットタイミングに到達すると、制御回路１１２は、半導体スイッチＱ１、Ｑ３、Ｑ５をターンオフさせる。時刻ｔ２から時刻ｔ３までの期間ＩＩＩは、デッドタイム期間である。実施の形態１と同様に、このデッドタイム期間においても、ハーフブリッジ１０５内の半導体スイッチＳ１はオン状態を維持するように、制御回路１１２によって制御されている。
【００８９】
次に時刻ｔ３において、三相ブリッジ１０３の下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６が、ゲート信号Ｖｇ＿Ｑ２、Ｖｇ＿Ｑ４、Ｖｇ＿Ｑ６によってターンオンされる。これにより、半導体スイッチＱ２、Ｑ４、Ｑ６およびＳ１が、期間ＩＶにおいてオン状態に維持される。
【００９０】
さらに、時刻ｔ４において、半導体スイッチＳ１は、制御回路１１２によってターンオフされる。半導体スイッチＱ２、Ｑ４、Ｑ６はオン状態が維持されるように、制御回路１１２によって制御される。
【００９１】
＜電流経路の状態＞
図９〜図１１は、実施の形態２に係わる電力変換装置における電流経路を説明するための説明図である。図９〜図１１を用いて説明する電力変換装置１００の構成は、図１で説明したものと同じであるため、原則として構成の説明は省略する。また、図９〜図１１において、矢印付きの破線は、電流の流れる方向と経路を示している。
【００９２】
図９（Ａ）には、図８に示した期間Ｉのときの電流経路が示され、図９（Ｂ）には、図８に示した期間ＩＩのときの電流経路が示されている。図８に示した期間ＩＩＩは、連続した２つの期間ＩＩＩ−１とＩＩＩ−２に分けられ、期間ＩＩＩ−１のときの電流経路が、図１０（Ａ）に示され、期間ＩＩＩ−２のときの電流経路が、図１０（Ｂ）に示されている。また、図８に示した期間ＩＶも、連続した２つの期間ＩＶ−１とＩＶ−２に分けられ、期間ＩＶ−１のときの電流経路が、図１１（Ａ）に示され、期間ＩＶ−２のときの電流経路が、図１１（Ｂ）に示されている。
【００９３】
期間Ｉの時刻ｔ１直前では、三相ブリッジ１０３の上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５が全てオン状態となっているため、図９（Ａ）において矢印付き破線で示すように、出力電流Ｉｕ、Ｉｖ、Ｉｗは、半導体スイッチＱ１、Ｑ３、Ｑ５間を還流している。時刻ｔ１に到達すると、期間Ｉから期間ＩＩへ移行する。このとき、ハーフブリッジ１０５内の半導体スイッチＳ１がターンオンする。半導体スイッチＳ１がターンオンすることにより、期間ＩＩにおいては、ＤＣリンクコンデンサ１０１、インダクタ１０４、ダイオード１０６ｗｐおよび半導体スイッチＱ５によってループが形成され、このループを電流が流れ始める。この場合、図９（Ｂ）に示すように、期間Ｉで形成された電流経路、すなわち半導体スイッチＱ１、Ｑ３、Ｑ５間を電流が還流する電流経路に、期間ＩＩで形成されたループによる電流経路が追加される。
【００９４】
なお、期間ＩＩにおいて、ダイオード１０６ｕｐおよび１０６ｖｐは導通しない。これは、図３（Ｂ）で説明したダイオード１０６ｗｎと同様に、中点である接続部ＤＵＣ、ＤＶＣの電位が、出力配線ＬＤＣにおける電位に比べて低くなるためである。
【００９５】
半導体スイッチＳ１がオン状態となるため、インダクタ１０４の両端子間には、ＤＣリンク電圧Ｖｄｃの約１／２の電圧が印加されるため、インダクタ１０４を流れるインダクタ電流は、直線的に増加する。このときのインダクタ電流の増加は、図３（Ｂ）のときとは逆極性の電流が増加する。
【００９６】
時刻ｔ２で、インダクタ１０４を流れるインダクタ電流が、半導体スイッチＱ５を流れる電流と等しくなり、その後三相ブリッジ１０３の上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５の全てが、ターンオフされる。半導体スイッチＱ１、Ｑ３、Ｑ５の全てを、ターンオフさせるとき、半導体スイッチＱ１、Ｑ３、Ｑ５の端子に接続された各スナバコンデンサによって、半導体スイッチの端子間電圧ｎｄ−ｎｓ（図１）の上昇が遅れるため、ＺＶＳ動作で、半導体スイッチＱ１、Ｑ３、Ｑ５を、ターンオフさせることが可能である。
【００９７】
上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５がオフ状態となったため、期間ＩＩＩ−１においては、インダクタ１０４に流れていたインダクタ電流が、三相ブリッジ１０３を構成する半導体スイッチに接続されているスナバコンデンサ１０９ｑ１〜１０９ｑ６に転流し、ＬＣ直列共振が開始する。これにより、上アームを構成する半導体スイッチＱ１、Ｑ３、Ｑ５のスナバコンデンサ１０９ｑ１、１０９ｑ３、１０９ｑ５および下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６のスナバコンデンサ１０９ｑ２、１０９ｑ４、１０９ｑ６に、図１０（Ａ）において矢印で示す方向の電流が流れる。すなわち、スナバコンデンサ１０９ｑ１、１０９ｑ３、１０９ｑ５のそれぞれには、スナバコンデンサを充電する方向の電流が流れ、スナバコンデンサ１０９ｑ２、１０９ｑ４、１０９ｑ６のそれぞれには、スナバコンデンサを放電する方向の電流が流れる。
【００９８】
図１０（Ｂ）に示した期間ＩＩＩ−２においては、下アームのスナバコンデンサ１０９ｑ２、１０９ｑ４、１０９ｑ６の放電が終了し、半導体スイッチＱ２、Ｑ４、Ｑ６の両端子ｎｄ、ｎｓの電圧が０Ｖになり、逆並列ダイオード１１１ｄ２、１１１ｄ４、１１１ｄ６に電流が転流する。期間ＩＩＩ−２の時刻ｔ３において、半導体スイッチＱ６をターンオンさせることにより、半導体スイッチＱ６の両端子ｎｄ、ｎｓの電圧が０Ｖの状態のときに、半導体スイッチＱ６をターンオンさせることが可能であり、ＺＶＳ動作でターンオンさせることが可能となる。なお、この時半導体スイッチＱ２、Ｑ４については自動的に電流が転流する。
【００９９】
図１１（Ａ）に示す期間ＩＶ−１では、期間ＩＩＩにおけるスイッチング動作によって、インダクタ１０４の両端子間に、期間ＩＩのときとは逆極性のＤＣリンク電圧Ｖｄｃの約１/２が印加される。そのため、インダクタ１０４を流れるインダクタ電流は直線的に減少する。時刻ｔ４で、インダクタ電流が０Ａになった後、半導体スイッチＳ１をターンオフする。この時、インダクタ電流が０Ａとなっているため、半導体スイッチＳ１は、それを流れる電流が０Ａのときに、ターンオフすることになり、ＺＣＳ動作でターンオフすることが可能となる。
【０１００】
図１１（Ｂ）に示す期間ＩＶ−２では、出力電流Ｉｕ、Ｉｖ、Ｉｗが、下アームを構成する半導体スイッチＱ２、Ｑ４、Ｑ６間を還流するモードとなり、一連のスイッチング動作が終了する。
【０１０１】
実施の形態２は、実施の形態１と異なり、１相の半導体スイッチがＺＶＳ動作でターンオンすることができる。また、ターンオフについては実施の形態１と同様に３相の各半導体スイッチが、ＺＶＳ動作でターンオフすることができる。また、実施の形態１と同様に補助回路１０８の各半導体スイッチはＺＣＳ動作でターンオンおよびターンオフできる。
【０１０２】
このように、実施の形態２に係わる電力変換装置１００においても、ターンオンおよびターンオフをソフトスイッチング動作で行うことが可能であるため、ターンオンおよびターンオフに伴うスイッチング損失を低減し、ノイズの発生を低減することが可能な電力変換装置を、簡素な構成で実現することが可能である。
【０１０３】
実施の形態２においては、出力電流の極性が他相と一致する２相についてはハードスイッチング動作となる。具体的に述べると、図９に示すように、出力電流ＩｕとＩｖの極性は同じで、出力電流Ｉｗの極性は、出力電流Ｉｕ、Ｉｖと異なっている。この２つの出力電流Ｉｕ、Ｉｖを出力する半導体スイッチＱ１およびＱ３が、ハードスイッチング動作でターンオンすることになる。しかしながら、２相に対して極性が異なる出力電流Ｉｗの絶対値は、他相を流れる電流の値よりも大きくなる。そのため、実施の形態２で述べたように動作させることにより、出力電流Ｉｗに対応する半導体スイッチＱ５において、局所的に大きな発熱が発生するのを抑制することが可能であり、熱源を分散することが可能である。
【０１０４】
図１に示した電力変換装置１００を、実施の形態１で説明したように動作させるか、実施の形態２で説明したように動作させるかは、制御回路１１２の動作を変更することにより、決めることが可能である。そのため、例えば電力変換装置１００の周囲温度または／および半導体スイッチの温度が高い場合、実施の形態２で説明した動作が、電力変換装置１００において実行されるように制御回路１１２の動作を変更することで、局所的な発熱を抑制することが可能である。これにより、電力変換装置１００の信頼性の向上を期待することができる。
【０１０５】
実施の形態１においては、三相ブリッジ１０３において、ターンオンの際にソフトスイッチング動作させる半導体スイッチが、２つの半導体スイッチＱ１、Ｑ３である。これに対して、実施の形態２においては、ターンオンの際にソフトスイッチング動作させる半導体スイッチが、１つの半導体スイッチＱ６である。また、前記したように、電力変換装置１００の周囲温度または／および半導体スイッチの温度が高い場合には、実施の形態２を利用することが望ましい。そのため、見方を変えると、ソフトスイッチング動作の対象とする半導体スイッチが、電力変換装置１００の周囲温度または／および半導体スイッチの温度によって決定されると見なすことが可能である。
【０１０６】
（実施の形態３）
図１に示した電力変換装置１００の出力端子１１０ｕ、１１０ｖ、１１０ｗには、図示しないモータ等の負荷が接続される、負荷は変動するため、電力変換装置１００は、負荷変動に応じた出力電流を負荷に供給することになる。
【０１０７】
負荷が、比較的軽い軽負荷時においては、電力変換装置１００から負荷に対して供給する出力電流は小さくて済む。この場合、三相ブリッジ１０３等における半導体スイッチがハードスイッチング動作をしても、スイッチング損失は比較的小さく、スイッチング損失による発熱自体も小さくなる。そのため、スイッチング損失低減の必要性はあまり高くない。
【０１０８】
実施の形態１および２においては、三相ブリッジ１０３を構成する半導体スイッチＱ１〜Ｑ６をスイッチング動作させる前に、補助回路１０８に含まれるインダクタ１０４にエネルギーを蓄積し、蓄積されたエネルギーを利用して、各スナバコンデンサの充放電を行うようにしている。半導体スイッチＱ１〜Ｑ６をスイッチング動作させる前に、各スナバコンデンサの充放電を確実に完了させるために必要な最低限の電流値が存在する。例えば、ごく軽負荷時であれば、各スナバコンデンサを充放電するのに必要な最低限の電流値より、電力変換装置１００から負荷に供給する出力電流が小さくなる場合が考えられる。この場合には、各スナバコンデンサを充放電するのに必要な電流によって、かえって電力変換装置１００のスイッチング損失を増加させる恐れがある。
【０１０９】
実施の形態３においては、軽負荷のとき、補助回路１０８の動作を停止させることが可能な電力変換装置が提供される。すなわち、負荷に応じて、補助回路１０８の動作を制御する電力変換装置が提供される。
【０１１０】
図１２は、実施の形態３に係わる電力変換装置の動作を示すフローチャート図である。実施の形態３に係わる電力変換装置の構成は、図１に示した構成と類似しているので、図１を参照にしながら、本実施の形態に係る電力変換装置１００の動作を説明する。実施の形態３においては、制御回路１１２に予め演算周期と、軽負荷か否かを判定するためのしきい値とが設定される。
【０１１１】
制御回路１１２は、予め設定されている演算周期に基づいて、周期的に、ステップＳＳ０を実行して、演算動作を開始する。ステップＳＳ１においては、現在の負荷電力を算出することにより、負荷電力がモニタされる。例えば、制御回路１１２は、出力電流Ｉｕ、Ｉｖ、Ｉｗと、出力端子１１０ｕ、１１０ｖ、１１０ｗにおける出力電圧を基にして、現在の負荷電力を算出して、負荷電力をモニタする。
【０１１２】
次に、制御回路１１２は、ステップＳＳ２において、算出した負荷電力が、予めしきい値として設定されている所定値以上か否かを判定する。制御回路１１２は、算出した負荷電力が、所定値以上の場合、ステップＳＳ３を実行し、所定値未満の場合、ステップＳＳ４を実行する。
【０１１３】
ステップＳＳ３において、制御回路１１２は、三相ブリッジ１０３においてソフトスイッチング動作が実行されるように、補助回路１０８を駆動する。すなわち、実施の形態１および２において説明したように、制御回路１１２は、半導体スイッチＱ１〜Ｑ６およびＳ１、Ｓ２を制御する。これに対して、ステップＳＳ４において。制御回路１１２は、補助回路１０８の動作を停止させる。例えば、制御回路１１２は、補助回路１０８における半導体スイッチＳ１、Ｓ２が、継続的にオフ状態となるようなゲート信号ＳＧを補助回路１０８に供給し、半導体スイッチＱ１〜Ｑ６をスイッチング動作させるゲート信号ＱＧを三相ブリッジ１０３に供給する。これにより、三相ブリッジ１０３における半導体スイッチは、ハードスイッチング動作でスイッチングすることになる。
【０１１４】
ステップＳＳ３またはＳＳ４において、所定の時間が経過した後、制御回路１１２は、ステップＳＳ５において補助回路１０８の制御を終了する。前記したステップＳＳ０〜ＳＳ５は、制御回路１１２に設定された演算周期で繰り返される。
【０１１５】
図１３は、実施の形態３に係わる電力変換装置を説明するための図である。図１３には、電力変換装置１００の負荷率と補助回路１０８の動作状態との関係が示されている。図１３において、横軸は負荷を表し、縦軸は補助回路１０８の動作状態を表している。ここで負荷率は、現在の負荷電力と電力変換装置１００の定格電力との比（現在の負荷電力／定格電力）である。現在の負荷電力は、前記したように演算により算出し、定格電力は、例えば電力変換装置１００を設計したときの設計値である。勿論、比の母数は、定格電力に限定されず、電力変換装置１００の最大電力等であってもよい。
【０１１６】
制御回路１１２には、しきい値として、所定の負荷率９０１が設定されている。これにより、算出した現在の負荷電力に基づく負荷率が、負荷率９０１以上となる領域では、電力変換装置１００は、補助回路１０８を駆動させるソフトスイッチング動作モード９０２で動作する。これに対して、算出した現在の負荷電力に基づく負荷率が、負荷率９０１未満となる領域では、電力変換装置１００は、補助回路１０８を停止させるハードスイッチング動作モード９０３で動作する。
【０１１７】
これにより、軽負荷時において補助回路１０８が動作することにより電力変換装置１００のスイッチング損失が増加するのを抑制し、電力変換装置１００の低損失化を図ることが可能である。また、負荷電力の変動に応じて、電力変換装置１００の動作モードが、自動的に、ソフトスイッチング動作モード９０２またはハードスイッチング動作モード９０３に切り替わる。そのため、負荷電力の変動に応じて、動的にスイッチング損失の低減を図ることが可能である。
【０１１８】
補助回路１０８において、制御回路１１２が制御する部分は、図１に示したように、ハーフブリッジ１０５である。そのため、負荷電力に応じて、ハーフブリッジ１０５の動作が制御されていると見なすこともできる。
【０１１９】
（実施の形態４）
図１４は、実施の形態４に係わるモータシステムの構成を示すブロック図である。モータシステム１０００は、実施の形態１〜３で説明した電力変換装置１００と、モータ１００１と、三相交流電力源１００２と、整流回路１００３とを備えている。モータ１００１は、電力変換装置１００の出力端子１１０ｕ、１１０ｖ、１１０ｗに接続され、電力変換装置１００の負荷を構成している。
【０１２０】
図１４においては、図１に示した三相ブリッジ１０３と補助回路１０８と制御回路１１２とが、１つの回路ブロック１００４として示され、ＤＣリンクコンデンサ１０１、１０２が、１つのＤＣリンクコンデンサとして示されている。
【０１２１】
配線ＬＤＶ、ＬＤＧは、整流回路１００３に接続されている。三相交流電力源１００２から出力された三相交流電圧は、整流回路１００３によって、直流電圧に変換され、変換により得られた直流電圧は、整流回路１００３から配線ＬＤＶ、ＬＤＧに供給される。実施の形態４においては、前記した直流電力源が、三相交流電源１００２と整流回路１００３とによって構成されている。
【０１２２】
図１４では、モータと電力変換装置１００とが分離しているように描かれているが、実際には、電力変換装置１００は、モータ１００１と一体となるように、モータ１００１外周に設けられる。実施の形態１〜３によれば、電力変換装置１００を簡素な構成にすることが可能であるため、一体化されたモータ装置（モータと電力変換装置を含む）の小型化を図ることが可能である。さらに、実施の形態１〜３によれば、電力変換装置１００におけるスイッチング損失を低減することが可能であるため、スイッチング損失による発熱を低減することが可能であるため、冷却器の小型化あるいは冷却器の設置を不要とすることが可能であり、モータ装置の更なる小型化を図ることが可能である。
【０１２３】
なお、モータ１００１としては、ラジアルギャップ型のモータであっても、アキシャルギャップ型のモータであってもよい。
【０１２４】
以上、本発明者によってなされた発明を実施の形態に基づき具体的に説明したが、本発明は前記実施の形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることはいうまでもない。
【符号の説明】
【０１２５】
１００  電力変換装置
１０１、１０２  ＤＣリンクコンデンサ
１０３  三相ブリッジ
１０４  インダクタ
１０５  ハーフブリッジ
１０６ｕｐ〜１０６ｗｎ  ダイオード
１０７  三相ダイオードブリッジ
１０８  補助回路
１０９ｑ１〜１０９ｑ６  スナバコンデンサ
１１０ｕ、１１０ｖ、１１０ｗ  出力端子
１１１ｄ１〜１１１ｄ６  逆並列ダイオード
１１２  制御回路
Ｉｕ、Ｉｖ、Ｉｗ  出力電流
Ｑ１〜Ｑ６、Ｓ１、Ｓ２  半導体スイッチ
Ｖｇ＿Ｑ１〜Ｖｇ＿Ｑ６、Ｖｇ＿Ｓ１、Ｖｇ＿Ｓ２  ゲート信号
Ｖｓａｗ  ＰＷＭキャリア信号
【図１】
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【図２】
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【図３】
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【図４】
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【図５】
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【図６】
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【図７】
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【図８】
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【図９】
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【図１０】
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【図１１】
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【図１２】
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【図１３】
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【図１４】
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