Circuit neuromorphique (10) propre à mettre en œuvre un réseau de neurones, le circuit neuromorphique (10) comprenant : - des lignes de mot (WL), - des paires de lignes de bits complémentaires (BL, BLb), - des lignes de source (SL), - un ensemble de cellules élémentaires (12) organisées selon une matrice (14) bidimensionnelle comportant des lignes (16) et des colonnes (18), l’ensemble de cellules élémentaires (12) comportant un ensemble de mémorisation (27) regroupant un ensemble de lignes (16) de cellules élémentaires (12), les cellules élémentaires (12) de l’ensemble de mémorisation (27) étant des cellules mémoires (26), les cellules mémoires (26) d’une même ligne (16) étant sélectionnables par une ligne de mot (WL), les cellules mémoires (26) d’une même colonne (18) étant reliées à une paire de lignes de bits complémentaires (BL, BLb) et une ligne de source (SL), chaque cellule mémoire (26) comprenant deux memristors (28, 30) et deux commutateurs (32, 34), chaque memristor (28, 30) étant relié à la même ligne de source (SL) et à un commutateur (32, 34) respectif, chaque memristor (28, 30) mémorisant respectivement un poids ou l’inverse du même poids en présentant respectivement des première et deuxième valeurs de résistances différentes, les commutateurs étant reliés, pour leur activation, à une ligne de mot (WL) et reliés respectivement à une paire de lignes de bits complémentaires (BL, BLb), - un circuit électronique implémentant un neurone (24) présentant une sortie et comportant : - un ensemble de composants logiques (42), chaque composant logique (42) présentant une unité logique (48) comprenant une entrée connectée à une ligne de source (SL) respective, l’unité logique (48) étant propre à effectuer une opération logique présentant un basculement entre une valeur basse et une valeur haute en fonction de la valeur de la ou des entrées de l’unité logique (48), chaque unité logique réalisant une fonction logique de type inverseur ou double inverseur, - une unité de comptage (44), l’unité de comptage (44) étant propre à compter le nombre de valeurs hautes ou basses en sortie des composants logiques (42), l’unité de comptage (44) étant un pont (58, 96), un pont (58, 96) étant un ensemble de mêmes éléments (60, 98) en parallèle et reliés entre eux sur une de leurs bornes à une sortie de l’unité de comptage, chaque élément (60, 98) étant relié à un composant logique (42) respectif et étant une résistance (98) ou un condensateur (60), - une unité de comparaison (46) comportant un comparateur (62) et un générateur de tension de comparaison (64), le comparateur (62) étant propre à comparer la sortie de l’unité de comptage (44) à la tension de comparaison générée par le générateur de tension de comparaison (64) pour émettre en sortie un signal dépendant de la comparaison et correspondant à la sortie du circuit électronique implémentant un neurone (24). Circuit neuromorphique selon la revendication 1, dans lequel chaque memristor (28, 30) comporte un état vierge, l’unité de comptage (44) étant une ligne (16) de cellules élémentaires (12), chaque cellule élémentaire (12) de l’unité de comptage (44) étant une cellule comprenant deux memristors dans l’état vierge (MV1, MV2) et deux commutateurs (T1, T2), chaque memristor dans l’état vierge (28, 30) étant connecté à l’autre memristor dans l’état vierge (MV1, MV2) et à un commutateur (T1, T2) respectif, les commutateurs (T1, T2) étant reliés entre eux. Circuit neuromorphique selon la revendication 1 ou 2, dans lequel chaque unité logique (48) comprend un inverseur formé à partir d’une cellule élémentaire (12) comprenant deux memristors (M1, M2) et deux commutateurs (TR, TT), chaque memristor (M1, M2) étant connecté à l’autre memristor (M1, M2) et à un commutateur (TR, TT) respectif, une piste de court-circuit (P cc ) étant agencée pour court-circuiter les deux memristors (M1, M2), un des commutateurs (T1, T2) étant relié à la masse et à l’entrée de l’unité logique pour sa commande et l’autre commutateur étant relié à un potentiel d’alimentation et monté en diode. Circuit neuromorphique selon la revendication 1 ou 2, dans lequel chaque unité logique (48) comprend un inverseur formé à partir d’une cellule élémentaire (12) comprenant deux memristors (M1, M2) et deux commutateurs (TR, TT), chaque memristor (M1, M2) étant connecté à l’autre memristor (M1, M2) et à un commutateur (TR, TT) respectif, un premier commutateur (TR) étant relié à la masse et à l’entrée de l’unité logique pour sa commande et le deuxième commutateur (TT) étant relié à un potentiel d’alimentation et monté en diode, une piste de court-circuit (P cc ) étant agencée pour court-circuiter le memristor (M1) relié au premier commutateur (TR). Circuit neuromorphique selon l’une quelconque des revendications 1 à 4, comprenant un premier contrôleur (20) permettant de sélectionner les cellules élémentaires d’une ligne qui sont reliées à une même ligne de mots (WL), et comprenant un deuxième contrôleur reliés aux paires de lignes de bit et permettant d’appliquer sur chaque paire de ligne de bits des tensions différentes et symétriques par rapport à une tension milieu, la tension appliquée sur une ligne de bit étant supérieure ou inférieur à celle appliquée sur la ligne de bit complémentaire associée selon la valeur d’un signal d’entrée, chaque signal d’entrée correspondant à une entrée d’une synapse reliée audit neurone. Circuit neuromorphique selon la revendication 5, dans lequel l’ensemble formé par chaque unité logique (48) est réalisé à partir d’au moins une ligne (16 2 , 16 3 ) de cellules élémentaires (12) n’appartenant pas à l’ensemble de mémorisation (27). Circuit neuromorphique selon la revendication 2, dans lequel chaque unité logique correspond à un inverseur (76) formé desdits commutateurs de chaque cellule élémentaire (12) de l’unité de comptage (44) et d’un transistor PMOS (120) dont le drain est relié à une tension d’alimentation (Vdd), la grille est reliée à une ligne de source SL et la source est reliée aux drains desdits commutateurs. Circuit neuromorphique selon l’une quelconque des revendications 1 à 7, dans lequel le générateur de tension de comparaison (64) est un générateur de tension fixe. Circuit neuromorphique selon l’une quelconque des revendications 1 à 8, dans lequel le générateur de tension de comparaison (64) est un deuxième pont (66, 100) présentant les mêmes éléments (68, 102) que l’unité de comptage (44), chaque élément (68, 102) du deuxième pont (66, 100) étant relié à un inverseur (70) connecté à une unité logique (42) respective. Circuit neuromorphique selon la revendication 9, dans lequel les éléments des deux ponts (58, 66) sont des condensateurs (68) présentant la même capacité, le générateur de tension de comparaison (64) et l’unité de comptage (44) comportant un condensateur de décalage (CD), le condensateur de décalage (CD) présentant une capacité égale à la moitié de la capacité d’un condensateur (60, 68) d’un des deux ponts (58, 66). Circuit neuromorphique selon l’une quelconque des revendications 1 à 10, dans lequel l’opération logique effectuée par chaque unité logique (48) est choisie parmi : un ou-exclusif avec une entrée fixée à 0, une inversion, un non-et avec une des deux entrées fixées à 1, un non-ou avec une des deux entrées fixées à 0. Circuit neuromorphique selon l’une quelconque des revendications 1 à 11, dans lequel le circuit neuromorphique comporte des transistors de rappel (82, 84), un des transistors de rappel (82) étant relié à l’ensemble des éléments (60, 98) de l’unité de comptage (44) et les autres transistors de rappel (84) étant reliés à une ligne de source (SL) respective, les transistors de rappel (82, 84) étant propres à effacer les éléments (60, 68, 98, 102). Circuit neuromorphique selon l’une quelconque des revendications 1 à 12, dans lequel le circuit neuromorphique (10) comporte plusieurs ensembles distincts de cellules élémentaires (12) propres à fonctionner en parallèle. Circuit neuromorphique selon la revendication 13, dans lequel les lignes de sources (SL) présentent plusieurs portions, des portions de ces lignes étant spécifiques à un ensemble de cellules élémentaires (12). Circuit neuromorphique selon l’une quelconque des revendications 1 à 14, dans lequel le circuit neuromorphique (10) est un circuit intégré tridimensionnel.