Dispositif (2) comprenant un premier circuit (CORR), un deuxième circuit (NUM) et un troisième circuit (LOOP), dans lequel : le premier circuit (CORR) est configuré pour : - recevoir un premier signal (I1(t)), un deuxième signal (Q1(t)) et un troisième signal (THETA), le troisième signal étant représentatif d'un déphasage ; - générer un quatrième signal (I2(t)) et un cinquième signal (Q2(t)) par application dudit déphasage respectivement au premier signal et au deuxième signal ; et - fournir un sixième signal (sI2) correspondant à un échantillonnage sur un bit du quatrième signal (I2), un septième signal (sQ2) correspondant à un échantillonnage sur un bit du cinquième signal (Q2), un huitième signal (sI2-Q2) correspondant à un échantillonnage sur un bit de la différence entre les quatrième et cinquième signaux, et un neuvième signal (sI2+Q2) correspondant à un échantillonnage sur un bit de la somme entre les quatrième et cinquième signaux, le deuxième circuit (NUM) est configuré pour : - recevoir les sixième, septième, huitième et neuvième signaux ; - déterminer, lors d'une première phase où les premier et deuxième signaux sont représentatifs d'un premier symbole (S1) connu d'une constellation QPSK, un état d'un premier bit (UP/DW) parmi un premier état et un deuxième état à partir des huitième et neuvième signaux (sI2-Q2, sI2+Q2) ; - fournir un signal numérique (LOOP-IN) correspondant à une multiplication du premier bit (UP/DW) par un gain (G) ; et - diminuer périodiquement, pendant ladite première phase, ledit gain (G) jusqu'à une valeur unitaire, et le troisième circuit (LOOP) est configuré pour déterminer le troisième signal (THETA) à partir dudit signal numérique (LOOP-IN). Dispositif selon la revendication 1, dans lequel le deuxième circuit (NUM) comprend un quatrième circuit (ALGO1) configuré pour, lors de la première phase : - mettre le premier bit (UP/DW) au premier état lorsque, sur la constellation QPSK, une position correspondant aux quatrième (I2(t)) et cinquième (Q2(t)) signaux est décalée dans un premier sens par rapport au premier symbole (S1), et - mettre le premier bit (UP/DW) au deuxième état lorsque, sur la constellation QPSK, la position est décalée dans un deuxième sens par rapport au premier symbole. Dispositif selon la revendication 2, dans lequel le quatrième circuit (ALGO1) est configuré pour déterminer le sens du décalage à partir des huitième (sI2-Q2) et neuvième (sI2+Q2) signaux, de préférence uniquement à partir des huitième et neuvième signaux. Dispositif selon la revendication 3, dans lequel le quatrième circuit (ALGO1) est une machine d'états à deux états, configurée pour être cadencée à la fréquence d'échantillonnage de la somme et de la différence des quatrième (I2(t)) et cinquième (Q2(t)) signaux. Dispositif selon l'une quelconque des revendications 1 à 4, dans lequel le troisième circuit (LOOP) comprend un premier filtre numérique (F1), de préférence proportionnel intégrateur, suivi d'un deuxième filtre numérique (F2), de préférence intégrateur, le premier filtre étant configuré pour recevoir ledit signal numérique (IN-LOOP), le deuxième filtre étant configuré pour recevoir un signal de sortie (PHI) du premier filtre et pour fournir le troisième signal (THETA). Dispositif selon la revendication 5, dans lequel les premier et deuxième filtres (F1, F2) sont configurés pour être cadencés à la fréquence d'échantillonnage de la somme et de la différence des quatrième (I2(t)) et cinquième (Q2(t)) signaux. Dispositif selon l'une quelconque des revendication 1 à 6, comprenant en outre un oscillateur (VCO) configuré pour fournir un dixième signal (sFLO) et un onzième signal (sFLO+90) à une première fréquence déterminée par un signal de commande (CTRL-FLO), le onzième signal (sFLO+90) étant déphasé de 90° par rapport au dixième signal (sFLO), et un circuit de commande (CTRL-CFO) configuré pour fournir ledit signal de commande (CTRL-FLO). Dispositif selon l'une quelconque des revendication 7, dans lequel, lors de la première phase de fonctionnement, le circuit de commande (CTRL-CFO) est configuré, au moins lorsque le gain (G) atteint une première fois la valeur unitaire, pour : - déterminer un écart entre la première fréquence et une deuxième fréquence, de préférence à partir d'un signal (PHI) fourni par le troisième circuit (LOOP) ; - comparer (606) l'écart déterminé à un seuil ; - mettre à jour le signal de commande (CTRL-FLO) et commander une réinitialisation du gain (G) à une valeur maximale lorsque ladite comparaison indique que l'écart est supérieur audit seuil ; et - maintenir le signal de commande (CTRL-FLO) à sa valeur courante et commander le maintien du gain (G) à la valeur unitaire lorsque ladite comparaison indique que l'écart est inférieur audit seuil. Dispositif selon la revendication 7 ou 8, comprenant en outre un premier mélangeur de fréquence (MIX1) configuré pour recevoir le dixième signal (sFLO) et un signal radiofréquence modulé en QPSK (RFin) et un deuxième mélangeur de fréquence (MIX2) configuré pour recevoir le onzième signal (sFLO+90) et le signal radiofréquence modulé en QPSK (RFin), le premier mélangeur (MIX1) étant configuré pour fournir le premier signal (I1(t)) et le deuxième mélangeur (MIX2) étant configuré pour fournir le deuxième signal (Q1(t)). Dispositif selon la revendication 9, dans lequel le premier circuit (CORR) est configuré pour échantillonner les quatrième et cinquième signaux, la somme des quatrième et cinquième signaux et la différence des quatrième et cinquième signaux à une fréquence inférieure à une fréquence de données du signal radiofréquence modulé en QPSK (RFin). Dispositif selon l'une quelconque des revendications 1 à 10, dans lequel, lors d'une deuxième phase de fonctionnement, le deuxième circuit (NUM) est configuré pour déterminer l'état du premier bit (UP/DW) sur la base des sixième, septième, huitième et neuvième signaux (sI2, sQ2, SI2+Q2, sI2-Q2). Dispositif selon la revendication 11, dans lequel le deuxième circuit (NUM) comprend un circuit (CTRL-ALGO) configuré pour déterminer un passage de la première phase de fonctionnement à la deuxième phase de fonctionnement. Dispositif selon la revendication 11 ou 12, dans lequel le deuxième circuit (NUM) comprend un cinquième circuit (ALGO2) configuré pour, lors de la deuxième phase : - estimer auquel des quatre symboles (S1, S2, S3, S4) de la constellation correspondent les premier et deuxième signaux (I1(t), Q1(t)) à partir des sixième et septième signaux (sI2, sQ2) ; - mettre le premier bit (UP/DW) au premier état lorsque, sur la constellation, une position correspondant aux quatrième (I2(t)) et cinquième (Q2(t)) signaux est décalée dans un premier sens par rapport au symbole estimé, et - mettre le premier bit (UP/DW) au deuxième état lorsque, sur la constellation, ladite position est décalée dans un deuxième sens par rapport au symbole estimé. Dispositif selon la revendication 13, dans lequel le cinquième circuit (ALGO2) est configuré pour déterminer le sens du décalage à partir des huitième (sI2+Q2) et neuvième (sI2-Q2) signaux. Démodulateur QPSK comprenant un dispositif selon l'une quelconque des revendications 1 à 14.