FR 3104286 A1 20210611 FR 1913764 A 20191204 Procédé d’exécution d’un programme d’ordinateur par un appareil électronique Procédé d’exécution d’un programme d'ordinateur dans lequel : - lorsque qu'un microprocesseur écrit un bloc de N o octets d'une donnée d'un bloc de données en clair enregistré dans une mémoire déchiffrée, un module de sécurisation fait basculer (190) un indicateur de validité associé à ce bloc de N o octets dans un état actif dans lequel il indique que ce bloc d'octets est valide, et - à chaque fois qu'un bloc de N o octets d'une donnée du bloc de données en clair est chargé par le microprocesseur à partir de la mémoire déchiffrée, le module matériel de sécurisation vérifie (176) si l'indicateur de validité associé à ce bloc de N o octets est dans son état actif et, dans l'affirmative, le traitement, par le microprocesseur, de ce bloc de N o octets est autorisé (178), et, dans la négative, le traitement, par le microprocesseur, de ce bloc de N o octets est interdit (180). Fig. 5 Procédé d’exécution d’un programme d’ordinateur par un appareil électronique L’invention concerne un procédé d’exécution d’un programme d’ordinateur par un appareil électronique comportant un microprocesseur, une mémoire déchiffrée, une mémoire chiffrée et un module matériel de sécurisation. L’invention concerne également : - un code binaire apte à être exécuté par un microprocesseur en mettant en œuvre ce procédé, - un module matériel de sécurisation et un compilateur pour la mise en œuvre de ce procédé. Pour des raisons de sécurité, il est connu d’enregistrer les données traitées, lors de l’exécution d’un programme d’ordinateur, sous forme chiffrée dans une mémoire. Par la suite, la mémoire ou partie de mémoire qui contient ces données chiffrées est appelée « mémoire chiffrée ». Dans ce cas, à chaque fois qu’une donnée doit être chargée dans le microprocesseur pour y être traitée, la donnée chiffrée est d’abord transférée de la mémoire chiffrée vers une mémoire déchiffrée. Par la suite, on appelle « mémoire déchiffrée », une mémoire dans laquelle les données sont enregistrées sous forme déchiffrée. Lors de ce transfert, l’intégrité de la donnée à charger est d’abord vérifiée. Seulement si l’intégrité de la donnée est confirmée, alors la donnée est déchiffrée puis enregistrée dans la mémoire déchiffrée. Dans ce contexte, des données sont également transférées, en sens inverse, de la mémoire déchiffrée vers la mémoire chiffrée pour y être enregistrées. Lors de ce transfert, la donnée est chiffrée, puis le code d’authentification permettant de vérifier son intégrité est calculé. Enfin, la donnée chiffrée et son code d’authentification sont enregistrés dans la mémoire chiffrée. Les opérations de vérification de l’intégrité d’une donnée et de déchiffrement de cette donnée sont relativement longues. De même, les opérations de chiffrement et de calcul d’un code d’authentification sont aussi relativement longues. Ainsi, pour accélérer les transferts de données entre la mémoire déchiffrée et la mémoire chiffrée, il a déjà été proposé de faire ces transferts par bloc de plusieurs données, plutôt qu’individuellement pour chaque donnée. Dans ce cas, le bloc de données est enregistré dans la mémoire chiffrée sous la forme d’un bloc de données chiffrées et authentifiées. Un tel bloc de données chiffrées et authentifiées comprend notamment : - un cryptogramme du bloc de données en clair, et - un code d’authentification de ce cryptogramme. Le cryptogramme du bloc de données en clair est obtenu en traitant le bloc de données comme un seul bloc de bits et sans distinguer les données les unes des autres. Ainsi, pour obtenir un cryptogramme, une seule opération de chiffrement est exécutée au lieu d’une opération de chiffrement pour chaque donnée de ce bloc de données. Ceci accélère l’opération de chiffrement des données. En contrepartie, le cryptogramme ne peut être déchiffré qu’en une seule opération de déchiffrement. En particulier, il n’est pas possible de déchiffrer qu’une partie seulement des données sans déchiffrer la totalité du cryptogramme. De façon similaire, le code d’authentification est commun à l’ensemble des données du bloc de données. Il est donc calculé en une seule opération et en traitant le bloc de données comme un seul bloc. Ainsi, on évite de construire un code d’authentification pour chaque donnée de ce bloc de données. Cela accélère aussi la construction du code d’authentification. Lors du transfert d’un bloc de données chiffrées et authentifiées de la mémoire chiffrée vers la mémoire déchiffrée, le microprocesseur vérifie d’abord l’intégrité du cryptogramme transféré à l’aide du code d’authentification contenu dans ce bloc de données chiffrées et authentifiées. Si la vérification échoue, le traitement des données contenues dans ce bloc de données chiffrées et authentifiées est interdit. A l’inverse, si la vérification réussit, le bloc de données chiffrées et authentifiées est alors déchiffré pour obtenir un bloc de données en clair. Puis le bloc de données en clair est enregistré dans la mémoire déchiffrée. Lors du transfert d’un bloc de données de la mémoire déchiffrée vers la mémoire chiffrée, les opérations inverses sont réalisées. En particulier : - le bloc de données en clair est chiffré pour obtenir son cryptogramme, puis - le code d’authentification est calculé, puis - le bloc de données chiffrées et authentifiées est obtenu en regroupant le cryptogramme et le code d’authentification calculé. Le bloc de données chiffrées et authentifiées ainsi obtenu est ensuite enregistré dans la mémoire chiffrée. Par ailleurs, il existe souvent dans les codes binaires des programmes d’ordinateur, des données qui n’ont pas explicitement été initialisée à une valeur prédéterminée lors de la compilation ayant conduit à la génération de ce code binaire. Les valeurs des données non-initialisées sont donc inconnues au moins au début de l'exécution de ce code binaire. Pour éviter leur usage avant qu’elles soient initialisées, lors de l’exécution du code binaire, elles sont souvent regroupées dans une partie de la mémoire principale découpée en blocs de données non-initialisées. Les blocs de données non-initialisées ont la même structure que les blocs de données chiffrées et authentifiées, sauf que le code d’authentification associé au bloc de données non-initialisées est incorrect. Ainsi, si un bloc de données non-initialisées est chargé de la mémoire chiffrée vers la mémoire déchiffrée avant son initialisation, la vérification du code d’authentification échoue et le traitement des données non-initialisées est empêché. Par contre, il est possible d’écrire des données dans le bloc de données non-initialisées pour, notamment, permettre leur initialisation à une valeur connue. Ainsi, si l’instruction exécutée par le microprocesseur est une instruction d’écriture d’une donnée, cette donnée est écrite dans le bloc de données non-initialisées, ce qui permet de l’initialiser à une valeur connue et de l’utiliser pour des traitements ultérieurs. Le fait que le traitement des données non-initialisées soit interdit permet d’empêcher qu’un attaquant puisse provoquer un fonctionnement inattendu du code binaire. En effet, un tel fonctionnement inattendu pourrait, par exemple, laisser fuir des informations confidentielles. Les inventeurs ont cependant découvert qu'il reste encore possible de provoquer un tel fonctionnement inattendu du code binaire. Par exemple, pour cela, un bloc de données non-initialisées est d’abord chargé de la mémoire chiffrée vers la mémoire déchiffrée. Ensuite un nombre limité d’octets de ce bloc de données est initialisé, par écriture, dans ce bloc de données non-initialisées. Ainsi, à ce stade, ce bloc de données contient à la fois des données initialisées et des données non-initialisées. Il est donc partiellement initialisé. Enfin, lorsque le bloc de données partiellement initialisé n’est plus utilisé, il est sauvegardé dans la mémoire chiffrée. Comme expliqué ci-dessus, lors du transfert de la mémoire déchiffrée vers la mémoire chiffrée, le code d’authentification est calculé à partir de l’ensemble des données du bloc de données partiellement initialisé. Par conséquent, le code d'authentification est calculé en prenant en compte aussi bien les données initialisées que les données non-initialisées. Dès lors, suite à cela, on trouve dans la mémoire chiffrée, un bloc de données chiffrées et authentifiées qui contient à la fois des données initialisées et des données non-initialisées. Ultérieurement, lorsque ce bloc de données chiffrées et authentifiées est transféré, une nouvelle fois, de la mémoire chiffrée vers la mémoire déchiffrée, la vérification de l’intégrité de ce bloc de données réussit et les données non-initialisées sont chargées dans la mémoire déchiffrée. Dans ce cas, rien n’empêche le traitement de ces données non-initialisées par le microprocesseur. Par ce biais-là, il est donc possible de provoquer un fonctionnement inattendu du code binaire lors de son exécution. En particulier, pour provoquer le traitement des données non-initialisées par le microprocesseur, un bloc de données chiffrées et authentifiées dont on sait qu’il contient uniquement des données qui seront toutes traitées par le microprocesseur à un moment ou à un autre est remplacé par le bloc de données chiffrées et authentifiées qui contient des données non-initialisées. Dans ce cas, il est certain qu’à un moment ou à un autre, le microprocesseur va charger la donnée non-initialisée puis la traiter, comme s’il s’agissait d’une donnée qui a été correctement initialisée alors que ce n’est pas le cas. L’invention vise donc à renforcer la sécurité d'un tel procédé d’exécution d'un programme d’ordinateur par un appareil électronique comportant un microprocesseur, une mémoire déchiffrée, une mémoire chiffrée et un module matériel de sécurisation. L’invention a donc pour objet un tel procédé d’exécution d’un programme d'ordinateur par un appareil électronique comportant un microprocesseur, une mémoire déchiffrée, une mémoire chiffrée et un module matériel de sécurisation, dans lequel, lors de l'exécution du programme d'ordinateur, le transfert des données entre la mémoire déchiffrée et la mémoire chiffrée se fait par bloc entier de plusieurs données chiffrées et authentifiées, chaque donnée étant composée d'un ou plusieurs blocs de N o octets, où N o est égal au plus petit nombre d'octets qui peut être écrit, indépendamment des autres octets de la donnée, par le microprocesseur lorsqu'il exécute une instruction d'écriture de son jeu d'instructions machines, le procédé comportant à cet effet : a) lors du transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée : - la transformation du bloc de données en clair en un bloc de données chiffrées et authentifiées, cette transformation comportant : le chiffrement du bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, le calcul d'un code d'authentification à partir des données du bloc de données en clair, et le regroupement, dans un même bloc, du cryptogramme obtenu, du code d'authentification calculé et de métadonnées pour obtenir le bloc de données chiffrées et authentifiées, puis - l'enregistrement du bloc de données chiffrées et authentifiées obtenu dans la mémoire chiffrée, b) lors du transfert d'un bloc de données chiffrées et authentifiées de la mémoire chiffrée vers la mémoire déchiffrée : - la vérification de l'intégrité du bloc de données chiffrées et authentifiées à l'aide du code d'authentification contenu dans ce bloc de données chiffrées et authentifiées, - lorsque cette vérification échoue, l'inhibition du traitement, par le microprocesseur, des données de ce bloc de données, et - lorsque cette vérification réussie : le déchiffrement du cryptogramme contenu dans le bloc de données chiffrées et authentifiées pour obtenir le bloc de données en clair, l'enregistrement du bloc de données en clair obtenu dans la mémoire déchiffrée et l'enregistrement des métadonnées du bloc de données chiffrées et authentifiées dans un registre non adressable par le microprocesseur, dans lequel le procédé comporte : - l'incorporation dans les métadonnées de chaque bloc de données et pour chaque bloc de N o octets de chaque donnée de ce bloc de données, d'un indicateur de validité associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc d'octets est valide, et un état inactif dans lequel il indique que ce bloc d'octets est invalide, au moins certains des indicateurs de validité étant initialement dans leur état inactif, - lorsque le microprocesseur écrit un bloc de N o octets d'une donnée du bloc de données en clair enregistrée dans la mémoire déchiffrée, le module de sécurisation fait basculer l'indicateur de validité associé à ce bloc de N o octets dans son état actif, - à chaque fois qu'un bloc de N o octets d'une donnée du bloc de données en clair est chargé par le microprocesseur à partir de la mémoire déchiffrée, le module matériel de sécurisation vérifie si l'indicateur de validité associé à ce bloc de N o octets est dans son état actif et, dans l'affirmative, le traitement, par le microprocesseur, de ce bloc de N o octets est autorisé, et, dans la négative, le traitement, par le microprocesseur, de ce bloc de N o octets est interdit. Les modes de réalisation de ce procédé d’exécution peuvent comporter une ou plusieurs des caractéristiques suivantes : 1) Lors du calcul du code d'authentification, le code d'authentification est également calculé à partir des indicateurs de validité associés à chaque groupe de N o octets de chaque donnée du bloc de données en clair. 2) - lors du chiffrement des données en clair, les données en clair sont chiffrées en utilisant une clé cryptographique et un vecteur d'initialisation, la clé cryptographique utilisée étant la même lors de chaque transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée et le vecteur d'initialisation étant modifié lors de chaque transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée, et - l'incorporation dans les métadonnées du bloc de données chiffrées et authentifiées, du vecteur d'initialisation utilisé pour obtenir le cryptogramme de ce bloc de données, et - lors du déchiffrement des données, le module matériel de sécurisation extrait des métadonnées du bloc de données chiffrées et authentifiées, le vecteur d'initialisation à utiliser pour réaliser ce déchiffrement. 3) Chaque bloc de données chiffrées et authentifiées est enregistré à une adresse @ BDCi égale à @ BDi .T b /T BD , où : - @ BDi est l'adresse physique de début, dans la mémoire déchiffrée, du bloc de données en clair obtenu par déchiffrement du cryptogramme de ce bloc de données chiffrées et authentifiées, - T b est la taille, en nombre d'octets, du bloc de données chiffrées et authentifiées, - T BD est la taille, en nombre d'octets, du bloc de données en clair. 4) - chaque donnée est associée, par une relation biunivoque, à une adresse physique et chaque bloc de données en clair contient seulement les N d données associées, par cette relation biunivoque, a des adresses physiques contenue dans une plage respective et continue de N d adresses physiques consécutives et l'adresse @ BDi de début de ce bloc de données en clair est égale à la plus petite adresse physique de cette plage de N d adresses physiques, - lors de l'exécution du programme d'ordinateur, le microprocesseur exécute une instruction d'accès à au moins un bloc de N o octets d'une première donnée associée à une adresse physique @ Di,j , cette première donnée n'appartenant à aucun des blocs de données en clair actuellement enregistrés dans la mémoire déchiffrée au moment de l'exécution de cette instruction d'accès, - en réponse, le module matériel de sécurisation calcule une adresse @ BDCi égale à E(@ Di,j /T BD ).T b , où - E() est la fonction qui retourne la partie entière du nombre situé entre les parenthèses, et - @ BDCi est l'adresse de début, dans la mémoire chiffrée, du bloc de données chiffrées et authentifiées qui contient la première donnée, puis - le bloc de données chiffrées et authentifiées qui débute à l'adresse @ BDCi calculée est transféré de la mémoire chiffrée vers la mémoire déchiffrée de manière à enregistrer dans la mémoire déchiffrée un nouveau bloc de données en clair qui contient la première donnée, puis - ledit au moins un bloc de N o octets est accédé à partir de la première donnée contenue dans ce nouveau bloc de données en clair. 5) - T b et T BD sont tous les deux des puissances de deux et l'adresse @ BDCi est calculée à l'aide de la première relation suivante @ BDCi = E(@ Di,j /T BD ).T b , ou - (T b -T BD ) et T BD sont tous les deux des puissances de deux et l'adresse @ BDCi est calculée à l'aide de la seconde relation suivante @ BDCi = E(@ Di,j /T BD ).T BD + E(@ Di,j /T BD ).(T b -T BD ), et - chaque division et chaque multiplication des première et seconde relations sont exécutées par des registres à décalage du module matériel de sécurisation. 6) Lorsque la vérification de l'intégrité du code d'authentification d'un bloc de données chiffrées et authentifiées échoue : - un bloc vierge de données en clair est préparé et enregistré dans la mémoire déchiffrée au même emplacement que celui où aurait été enregistré le bloc de données en clair si la vérification de l'intégrité du code d'authentification du bloc de données chiffrées et authentifiées avait réussie, les données de ce bloc vierge étant toutes initialisées à une valeur prédéterminée, et - les indicateurs de validité associés à chacun des blocs de N o octets du bloc vierge sont basculés dans leur état inactif. L’invention a également pour objet un code binaire apte à être exécuté par un microprocesseur en mettant en œuvre le procédé ci-dessus, dans lequel le code binaire comporte des blocs de données chiffrées et authentifiées, chaque bloc de données chiffrées et authentifiées contenant : - un cryptogramme d'un bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, - un code d'authentification calculé à partir des données du bloc de données en clair, - des métadonnées, dans lequel les métadonnées comporte, pour chaque bloc de N o octets de chaque donnée du bloc de données en clair, un indicateur de validité associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc de N o octets est valide, et un état inactif dans lequel il indique que ce bloc de N o octets est invalide. L’invention a également pour objet un module matériel de sécurisation pour la mise en œuvre du procédé ci-dessus, dans lequel le module matériel est configuré pour : a) lors du transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée : - transformer le bloc de données en clair en un bloc de données chiffrées et authentifiées, cette transformation comportant : le chiffrement du bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, le calcul d'un code d'authentification à partir des données du bloc de données en clair, et le regroupement, dans un même bloc, du cryptogramme obtenu, du code d'authentification calculé et de métadonnées pour obtenir le bloc de données chiffrées et authentifiées, puis - l'enregistrement du bloc de données chiffrées et authentifiées obtenu dans la mémoire chiffrée, b) lors du transfert d'un bloc de données chiffrées et authentifiées de la mémoire chiffrée vers la mémoire déchiffrée : - vérifier l'intégrité du bloc de données chiffrées et authentifiées à l'aide du code d'authentification contenu dans ce bloc de données chiffrées et authentifiées, - lorsque cette vérification échoue, inhiber le traitement, par le microprocesseur, des données de ce bloc de données, et - lorsque cette vérification réussie : déchiffrer le cryptogramme contenu dans le bloc de données chiffrées et authentifiées pour obtenir le bloc de données en clair, enregistrer le bloc de données en clair obtenu dans la mémoire déchiffrée et enregistrer les métadonnées du bloc de données chiffrées et authentifiées dans un registre non adressable par le microprocesseur, dans lequel : - lorsque le microprocesseur modifie un bloc de N o octets d'une donnée du bloc de données en clair enregistré dans la mémoire déchiffrée, le module de sécurisation est configuré pour faire basculer l'indicateur de validité associé à ce bloc de N o octets dans son état actif, et - à chaque fois qu'un bloc de N o octets d'une donnée du bloc de données en clair est chargé par le microprocesseur à partir de la mémoire déchiffrée, le module matériel de sécurisation est configuré pour vérifier si l'indicateur de validité associé à ce bloc de N o octets est dans son état actif et, dans l'affirmative, autoriser le traitement, par le microprocesseur, de ce bloc de N o octets, et, dans la négative, interdire le traitement, par le microprocesseur, de ce bloc de N o octets. L’invention a également pour objet un compilateur apte à transformer automatiquement un code source d’un programme d'ordinateur en un code binaire de ce programme d'ordinateur, dans lequel le compilateur est apte à transformer automatiquement le code source en un code binaire tel que décrit ci-dessus, ce compilateur étant configuré à cet effet pour transformer automatiquement des blocs de données en clair en blocs de données chiffrées et authentifiées, pour cela ce compilateur est apte, pour chaque bloc de données en clair, : - à chiffrer le bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, - à calculer un code d'authentification à partir des données du bloc de données en clair, et - à regrouper, dans un même bloc, le cryptogramme obtenu, le code d'authentification calculé et les métadonnées pour obtenir le bloc de données chiffrées et authentifiées, dans lequel le compilateur est également configuré pour incorporer dans les métadonnées de chaque bloc de données et pour chaque bloc de N o octets de chaque donnée de ce bloc de données, un indicateur de validité associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc d'octets est valide, et un état inactif dans lequel il indique que ce bloc d'octets est invalide, au moins certains des indicateurs de validité étant initialement dans leur état inactif. L'invention sera mieux comprise à la lecture de la description qui va suivre, donnée uniquement à titre d'exemple non limitatif et faite en se référant aux dessins sur lesquels : - la figure 1 est une illustration schématique de l'architecture d'un appareil électronique apte à exécuter un code binaire d'un programme d'ordinateur, - la figure 2 est une illustration schématique d'une partie d'une mémoire principale de l'appareil de la figure 1, - la figure 3 est une illustration schématique de la structure d'un bloc de données chiffrées et authentifiées contenu dans la partie de la mémoire de la figure 2, - la figure 4 est un organigramme d'un procédé d'exécution du code binaire par l'appareil de la figure 1, et - la figure 5 est un organigramme d'un procédé détaillant les opérations réalisées lorsque l'instruction exécutée du code binaire est une instruction de chargement ou d'écriture d'une donnée, - la figure 6 est une illustration schématique d'un compilateur apte à générer le code binaire exécuté par l'appareil de la figure 1. Les conventions, notations et définitions utilisées dans cette descriptions sont données dans le chapitre I. Ensuite, un exemple détaillé de mode de réalisation est décrit dans le chapitre II à l'aide des figures. Dans un chapitre III suivant, des variantes de ce mode de réalisation détaillé sont présentées. Enfin, les avantages des différents modes de réalisation sont présentés dans un chapitre IV. Chapitre I : Conventions, notations et définitions : Dans les figures, les mêmes références sont utilisées pour désigner les mêmes éléments. Dans la suite de cette description, les caractéristiques et fonctions bien connues de l’homme du métier ne sont pas décrites en détails. Dans cette description, les définitions suivantes sont adoptées. Un « programme » désigne un ensemble d'une ou de plusieurs fonctions prédéterminées que l'on souhaite faire exécuter par un microprocesseur. Un « code source » est une représentation du programme dans un langage informatique. Le code source n'est pas directement exécutable par un microprocesseur. Le code source est destiné à être transformé par un compilateur en un code binaire directement exécutable par le microprocesseur. Un programme ou un code est dit être « directement exécutable » lorsqu'il est apte à être exécuté par un microprocesseur sans que ce microprocesseur n'ait besoin au préalable de le compiler au moyen d'un compilateur ou de l'interpréter au moyen d'un interpréteur. Une « instruction » désigne une instruction machine exécutable par un microprocesseur. Une telle instruction est constituée : - d'un opcode, ou code d'opération, codant la nature de l'opération à exécuter, et -d'un ou plusieurs opérandes définissant la ou les valeurs des paramètres de cette opération. Le jeu d'instructions machines d'un microprocesseur est formé par l'ensemble des opcodes utilisables pour former des instructions exécutables par le microprocesseur. Le jeu d'instructions machines peut être différent d'un microprocesseur à un autre. Un « code machine » est un ensemble d'instructions machines. Il s'agit typiquement d'un fichier contenant une succession de bits portant la valeur « 0 » ou « 1 », ces bits codant les instructions à exécuter par le microprocesseur. Le code machine est directement exécutable par le microprocesseur, c'est-à-dire sans nécessiter une compilation ou une interprétation préalable. Un « code binaire » est un fichier contenant une succession de bits portant la valeur « 0 » ou « 1 ». Ces bits codent des données et des instructions à exécuter par le microprocesseur. Ainsi, le code binaire comprend au moins un code machine et en plus, généralement, des données numériques traitées par ce code machine. Au niveau du code binaire, une instruction et une donnée correspondent tous les deux à des bits. Toutefois, les instructions et les données ne sont pas traitées de la même façon par un microprocesseur. Par exemple, une instruction est seulement chargée puis exécutée par le microprocesseur lorsque le compteur ordinal pointe sur cette instruction. Une donnée est chargée par le microprocesseur seulement en réponse à l'exécution par ce microprocesseur d'une instruction de chargement de cette donnée. On parle d'exécution d'une fonction pour désigner l'exécution des instructions réalisant cette fonction. Chapitre II : Exemple de mode de réalisation détaillé : La figure 1 représente un appareil électronique 1 comportant un microprocesseur 2, un ensemble 4 de mémoires et un support 6 de stockage de masse. Par exemple, l'appareil 1 est un ordinateur, un smartphone, une tablette électronique ou similaire. Le microprocesseur 2 comporte ici : - une unité arithmétique et logique 10 ; - un ensemble 12 de registres ; - un tampon 14 de données ; - une interface 16 d'entrée/sortie de données, - un chargeur 18 d'instructions comportant un compteur ordinal 26, - une file 22 d'instructions à exécuter, et - un module matériel 28 de sécurisation comportant une mémoire non-volatile sécurisée 29. L'ensemble 4 est configuré pour stocker les instructions et les données d'un code binaire 30 d'un programme devant être exécuté par le microprocesseur 2. L'ensemble 4 est une mémoire à accès aléatoire. Typiquement, l'ensemble 4 est une mémoire volatile. Chaque donnée et chaque instruction est associée à une adresse physique qui est utilisée pour la lire ou l'écrire sans modifier les autres données et instructions. Ainsi, par la suite, on dit que ces données et instructions sont adressables individuellement. A titre d'illustration, dans ce mode de réalisation, les données et les instructions sont chacune codées sur 32 bits et sont donc chacune formée par quatre octets. Par la suite, la taille d'une donnée, en nombre d'octets, est notée T d . Par exemple, l'ensemble 4 comporte : - trois niveaux de mémoires caches, et - une mémoire principale MP. Les mémoires caches permettent d'accélérer le transfert de données entre la mémoire principale MP et le microprocesseur 2. Les trois niveaux de mémoire cache sont appelés habituellement L1, L2 et L3. Sur la figure 1, les symboles "L1", "L2" et "L3" sont utilisés pour désigner, respectivement, les trois mémoires caches L1, L2 et L3. Ici, pour simplifier la figure 1, la mémoire cache L1 est représentée à l'extérieur du microprocesseur 2 alors que, souvent, elle est intégrée à l'intérieur du microprocesseur 2. Ici, on considère qu'une mémoire est réalisée à l'extérieur du microprocesseur lorsqu'elle est réalisée sur un substrat différent de celui utilisé pour réaliser les différents composants du microprocesseur 2. Généralement, les autres mémoires caches sont à l'extérieur du microprocesseur 2. Les mémoires L1 à L3 sont classées par ordre de rapidité de lecture, la mémoire L1 étant la plus rapide. Généralement, la taille des mémoires cache est inversement proportionnelle à leur rapidité. Ainsi, ici, la taille de la mémoire L1 est inférieure à la taille de la mémoire L2 qui est elle-même inférieure à la taille de la mémoire L3. Classiquement, après le chargement du code binaire 30 dans la mémoire MP, la mémoire MP comporte notamment les parties suivantes : - une première partie 42 contenant les instructions à exécuter, - une deuxième partie 44 contenant des données à traiter, - une troisième partie 46 utilisée pour sauvegarder le contexte d'exécution d'une fonction lorsqu'elle appelle une autre fonction appelée "routine", et - une quatrième partie 48 utilisée pour allouer dynamiquement de la mémoire au programme en cours d'exécution afin d'y enregistrer des données. La partie 42 est connue sous le terme de "segment de code" ("code segment" ou "text segment" en anglais). La partie 44 contient typiquement les variables statiques et globales du programme exécuté. La partie 44 est elle-même classiquement divisée en une première et une seconde sections. La première section contient les variables statiques est globales qui ont été initialisées lors de la compilation. Cette première section est connue sous le terme de segment de données et souvent notée ".data". La seconde section comporte les variables statiques et globales qui n'ont pas été initialisées lors de la compilation du code binaire 30. Cette seconde section est également connue sous le terme de "segment bss" et souvent notée ".bss". Généralement, ces deux sections sont contiguës. La partie 46 est connue sous le terme de "pile d'exécution" ("call stack" en anglais). Par conséquent, par la suite, la partie 46 est également appelée "pile 46". Enfin la partie 48 est connue sous le terme de "tas" ("heap" en anglais). Ainsi, par la suite, la partie 48 est également appelée "tas 48". Le code binaire 30 comporte notamment un code machine 32 et un bloc 34 de données nécessaires à l'exécution du code binaire 30. Le code machine 32 et le bloc 34 sont enregistrés dans, respectivement, les parties 42 et 44. L'exécution du code binaire 30 débute par le chargement et le traitement de données du bloc 34. Ici, en particulier, le bloc 34 comporte un cryptogramme ka* obtenu en chiffrant une clé secrète ka à l'aide d'une clé publique pk CPU du microprocesseur 2. L'ensemble 4 de mémoire est raccordé au microprocesseur 2 par un bus de données et un bus d'adresses. Pour simplifier la figure 1, ces deux bus sont représentés par une double flèche 50 et désignés collectivement dans la suite de cette description par le terme "bus 50". L'ensemble 4 est un ensemble de mémoires chiffrées, c'est-à-dire un ensemble dans lequel les données sont enregistrées sous forme chiffrée. Par la suite, la description est faite dans le cas particulier où les données chiffrées sont celles contenues dans la partie 44. Un découpage en blocs de données chiffrées et authentifiées de la partie 44 est représenté sur la figure 2. Dans cette figure et dans la suite de la description, on note "BDC i " un bloc de données chiffrées et authentifiées, enregistré dans la mémoire MP à l'adresse @ BDCi , où l'indice i est un identifiant de ce bloc BDC i . Ici, l'indice i est le numéro d'ordre du bloc de données compté à partir du premier bloc BDC 1 , c'est-à-dire celui situé au début de la partie 44. L'adresse @ BDCi est ici égale à l'adresse à laquelle débute le bloc BDC i . Dans cet exemple, l'indice i varie de 1 à n de sorte que la partie 44 est divisée en n blocs BDC i distincts. Sur la figure 2 et les suivantes, le symbole "..." indique qu'une partie des éléments n'a pas été représentée. Ici, tous les blocs BDC i sont structurellement identiques. Ainsi, seul le bloc BDC i représenté sur la figure 3 est décrit en détail. La taille du bloc BDC i en nombre d'octets est noté T b par la suite. La taille T b est supérieure à huit ou seize et, généralement supérieur ou égale à 32 ou 64 octets. Généralement, la taille T b est inférieure à 1 ko ou 1 Mo. Dans ce premier mode de réalisation, à titre d'illustration la taille T b est égal à trente-deux octets. Le bloc BDC i comporte, dans l'ordre en partant de son adresse @ BDCi de début : - un cryptogramme BD i *, - des métadonnées MD i , et - un code d'authentification MAC i , Le cryptogramme BD i * est obtenu en chiffrant un bloc BD i de N d données D i,j en clair à l'aide de la clé cryptographique ka, où N d est un nombre entier supérieur à un ou deux ou quatre. Ici, N d est égale à quatre. L'indice j est un identifiant de la donnée D i,j qui permet de la distinguer des autres données contenues dans le même bloc BD i . Ici, l'indice j est le numéro d'ordre de la donnée D i,j compté à partir de la première donnée D i,1 du bloc BD i , c'est-à-dire à partir de la donnée D i,1 situé à l'adresse @ BDi . Plus précisément, le cryptogramme BD i * est obtenu à l’aide de la relation suivante : BD i * = f ka (BD i ; iv i ), où : - f ka est une fonction de chiffrement, correspondant à une fonction de déchiffrement f ka -1 , et - iv i est un vecteur d'initialisation également connu sous le nom de "nonce". Les fonctions f ka et f ka -1 sont préprogrammées dans le module 28. Typiquement, la fonction f ka est une fonction de chiffrement symétrique. Le vecteur iv i est un vecteur d'initialisation dont la valeur est modifiée à chaque fois que la fonction f ka est utilisée pour chiffrée un bloc BD i de données en clair. A l'inverse, la clé ka est toujours la même. Dès lors, la clé ka permettant de déchiffrer le cryptogramme BD i * est préenregistrée dans la mémoire 29 afin de permettre au module 28 de déchiffrer chaque cryptogramme BD i *. Dans ce mode de réalisation, chaque bloc BD i contient N d données associées à des adresses physiques respectives et consécutives. Ainsi, chaque bloc BD i correspond donc à une plage continue de N d adresses physiques consécutives. Ces plages d'adresses physiques sont distinctes les unes des autres. En particulier, elles ne se chevauchent pas de sorte qu'une même donnée D i,j ne peut pas être contenue dans plusieurs blocs BD i différents. De plus, ces plages d'adresses sont contiguës les unes aux autres de sorte qu'il n'existe pas, entre un premier bloc BD i et un second bloc BD i+1 contigus, des données qui n'appartiennent ni au bloc BD i ni au bloc BD i+1 . Ainsi, les blocs BD i divisent l'espace mémoire dans lequel sont enregistrées les données en une succession de blocs de données consécutifs. A l'intérieur d'un même bloc BD i , les N d données D i,j sont, par exemple, classées par ordre d'adresses physiques croissantes de sorte que la donnée D i,1 est la première donnée du bloc BD i . Dans ces conditions, l'adresse physique @ BDi de début du bloc BD i est égale à l'adresse physique de la donnée D i,1 . La taille T BD du bloc BD i est égale à N d T d , où T d est la taille d'une donnée D i,j en nombre d'octets. Ici, la taille du cryptogramme BD i * est égale à la taille du bloc BD i . Les métadonnées MD i contiennent ici: - pour chaque donnée D i,j et pour chaque bloc de N o octets de cette donnée D i,j , un indicateur de validité IdV i,p , et - le vecteur iv i utilisé pour obtenir le cryptogramme BD i *. L'indice p est un identifiant de l'indicateur IdV i,p qui permet de le distinguer de tous les autres indicateurs de validité contenus dans les métadonnées MD i . Ici, l'indice p est le numéro d'ordre de l'indicateur IdV i,p compté à partir du premier indicateur IdV i,1 , c'est-à-dire celui situé juste après le cryptogramme BD i *. Ainsi, le nombre d'indicateurs IdV i,p est égal à (T d /N o ).N d . Ici, T d est égal à quatre . Dans cette description, le symbole "." désigne l'opération de multiplication scalaire. Chaque indicateur IdV i,p est déplaçable entre un état actif et un état inactif. Dans l'état actif, l'indicateur IdV i,p indique que le p-ième bloc de N o octets du bloc BD i de données en clair est valide. A l'inverse, dans l'état inactif, l'indicateur IdV i,p indique que le p-ième bloc de N o octets du bloc BD i de données en clair est invalide. A cet effet, chaque indicateur IdV i,p est codé sur un seul bit. Par exemple, les valeurs "0" et "1" de ce bit correspondent, respectivement, aux états inactif et actif. Le rôle de ces indicateurs IdV i,p est détaillé plus loin en référence à la figure 5. Le code MAC i est une étiquette d'intégrité qui permet de vérifier l'intégrité du bloc BD i de données. A cet effet, ici, le code MAC i est un code permettant de vérifier l’intégrité et l’authenticité du cryptogramme BD i *. De plus, dans ce mode de réalisation, le code MAC i permet aussi de vérifier l'intégrité et l'authenticité des indicateurs IdV i,p . Ce code MAC i est communément appelé « code d’authentification de message » et connu sous l’acronyme MAC (« Message Authentification Code »). Un tel code MAC i est obtenu en construisant une empreinte numérique à partir du cryptogramme BD i * et des indicateurs IdV i,p . Cette empreinte numérique comporte normalement moins de bits que le cryptogramme BD i *. Une telle empreinte numérique est plus connue sous le terme anglais de "digest" ou "hash". Cette empreinte numérique est construite à l’aide d’une fonction prédéterminée et d'une clé secrète k' connue seulement de l’auteur du code binaire 30 et du microprocesseur 2. Ici, la clé k’ est préenregistrée dans la mémoire 29 du module 28 de sécurisation. Par exemple, la fonction prédéterminée est une fonction à sens unique telle qu'une fonction de hachage. Dans ce cas, généralement, l'empreinte numérique est le résultat de l'application de cette fonction de hachage à une combinaison, par exemple une concaténation, du cryptogramme BD i *, des indicateurs IdV i,p et de la clé k'. La taille du code MAC i est typiquement supérieure ou égale à 32 bits ou 64 bits. Ici, la taille du code MAC i est égale à huit octets (64 bits). Dans ce mode de réalisation, pour accélérer les transferts de données entre le microprocesseur 2 et l'ensemble 4 de mémoires, les tailles T b et T BD sont toutes les deux des puissances de deux. Pour cela la taille T b est égale à deux fois la taille T BD . Ainsi, dans cet exemple, T b est égale à trente-deux octets. Dans ces conditions, la taille des métadonnées MD i est égale à huit octets. Sur ces huit octets, deux d'entre-eux sont utilisés pour stocker les indicateurs IdV i,p et les deux octets restants sont utilisés pour stocker le vecteur iv i . Enfin, l'adresse physique @ BDCi à laquelle est enregistré le bloc BDC i dans la mémoire MP est définie par la relation (1) suivante : @ BDCi = @ BDi .T b / T BD . Le ratio @ BDi / T BD est ici nécessairement un nombre entier puisque l'adresse @ BDi est égale au cumul des tailles des blocs BD 1 à BD i-1 . Ainsi, les blocs BDC i sont classées dans la mémoire MP dans le même ordre que les blocs BD i , c'est-à-dire par ordre croissant des adresses physiques des données données D i,j qui sont chiffrées dans ce bloc BDC i . De plus, la relation (1) impose que les blocs BDC i sont, dans la mémoire MP, immédiatement consécutifs les uns aux autres et ne se chevauchent pas. Dans cet exemple, le jeu d'instructions machines du microprocesseur 2 comporte notamment une instruction d'écriture et une instruction de chargement. Une instruction d'écriture est une instruction qui, lorsqu'elle est exécutée par l'unité 10, provoque l'écriture d'un ou plusieurs octets dans l'ensemble 4. Ici, le jeu d'instructions machines comporte notamment une instruction d'écriture qui permet d'écrire un bloc de N o octets plus petit que la taille d'une donnée. Autrement dit N o est plus petit que T d . Ainsi, la plus petite granularité avec laquelle il est possible d'écrire dans l'ensemble 4 est inférieure à la taille T d d'une donnée. En particulier, le microprocesseur 2 peut écrire seulement N o octets d'une donnée sans écrire les autres octets de cette mème donnée. Dans cet exemple, N o est égal à un. Une instruction de chargement est une instruction qui, lorsqu'elle est exécutée par l'unité 10, provoque le chargement d'un ou plusieurs octets dans le microprocesseur 2 à partir de l'ensemble 4. Généralement, le bloc d'octets chargé est enregistré dans un registre du microprocesseur comme, par exemple, un des registres de l'ensemble 12. Ici, le jeu d'instructions machines du microprocesseur 2 comporte une instruction de chargement qui permet de charger seulement un bloc de N o octets et donc un bloc plus petit que la taille T d d'une donnée. A titre d'illustration, le microprocesseur 2 est conforme à l'architecture RISC (« Reduced Instructions Set Computer ») et il met en œuvre le jeu d'instructions "RISC-V". Ici, l'unité 10 est une unité arithmétique et logique de N inst bits. Typiquement, N inst est un entier supérieure ou égale à 8, 16, 32 ou 64. Dans cet exemple, N inst est égal à 32. Le chargeur 18 charge dans la file 22 la prochaine instruction à exécuter par l'unité 10 à partir de l'ensemble 4 de mémoires. Plus précisément, le chargeur 18 charge l'instruction sur laquelle pointe le compteur ordinal 26. L'unité 10 est notamment configurée pour exécuter les unes après les autres les instructions chargées dans la file 22. Les instructions chargées dans la file 22 sont généralement systématiquement exécutées dans l'ordre où ces instructions ont été enregistrées dans cette file 22. L'unité 10 est aussi capable d'enregistrer le résultat de ces instructions exécutées dans un ou plusieurs des registres de l'ensemble 12. Dans cette description, on utilisera comme synonymes « exécution par le microprocesseur 2 » et « exécution par l'unité 10 ». Le tampon 14 est utilisé pour accélérer encore plus les transferts de données entre le microprocesseur 2 et l'ensemble 4 de mémoire. Pour cela, les données transférées entre le microprocesseur 2 et l'ensemble 4 sont systématiquement transférées par bloc entier contenant exactement N d données. Plus précisément, lors du chargement d'une donnée à partir de l'ensemble 4, c'est le bloc BDC i qui contient cette donnée qui est transféré, dans sa totalité, au microprocesseur 2 par l'intermédiaire du bus 50. A l'inverse, lorsqu'une donnée doit être écrite dans l'ensemble 4 de mémoires, c'est un bloc BDC i complet, qui contient cette donnée écrite, qui est transféré du microprocesseur 2 vers l'ensemble 4 par l'intermédiaire du bus 50. Ici, le tampon 14 est une mémoire déchiffrée, c'est-à-dire une mémoire dans laquelle les données sont enregistrées en clair. Ce tampon 14 est apte à contenir au moins un bloc BD i de données en clair. Dans ce mode de réalisation, à titre d'illustration, il est apte à contenir un seul bloc de données BD i . Le module 28 est capable d'exécuter automatiquement les différentes opérations décrites en détails en référence au procédé de la figure 5 pour sécuriser l'exécution du programme d'ordinateur. En particulier, il est apte à transformer un bloc BDC i en un bloc BD i de données en clair et vice versa. Le module 28 fonctionne indépendamment et sans utiliser l'unité 10. Ainsi, il est capable de traiter des blocs de données avant et/ou après que ceux-ci soient traités par l'unité 10. A cet effet, il comporte notamment la mémoire non-volatile sécurisée 29. Aucun accès à cette mémoire 29 sans passer par l’intermédiaire du module 28 n'est prévu. Dans ce mode de réalisation, le module 28 est pré-programmé, par exemple lors de sa conception, pour exécuter des opérations telles que les opérations suivantes : - vérifier l'intégrité et l'authenticité d'un bloc BDC i à partir du code MAC i qu'il contient, - calculer un code MAC i , - chiffrer le bloc BD i pour obtenir le cryptogramme BD i *, - déchiffrer le cryptogramme BD i * pour obtenir le bloc BD i de données en clair . La mémoire 29 est utilisée pour stocker les informations secrètes nécessaires à la mise en œuvre du procédé de la figure 5. Ici, elle comporte donc notamment des informations secrètes pré-enregistrées avant le début de l'exécution du code binaire 30. En particulier, elle comporte les informations pré-enregistrées suivantes : - une clé secrète k' utilisée pour le calcul et la vérification des codes MAC i , - un clé privée secrète sk CPU qui permet de déchiffrer les données qui ont été chiffrées à l'aide de la clé publique pk CPU . Dans ce mode de réalisation, la mémoire 29 comporte aussi : - un registre R iv de vecteurs d'initialisation, et - un registre B itV d'indicateurs de validité. Dans cet exemple de réalisation, l'ensemble 12 comporte des registres généraux utilisables pour stocker tout type de données. Un bus d'échange de données 24 relie les différents composants du microprocesseur 2 entre eux. Il est représenté sur la figure 1 pour indiquer que les différents composants du microprocesseur 2 peuvent échanger des données entre eux. Le support 6 est typiquement une mémoire non volatile. Par exemple, il s'agit d'une mémoire du type EEPROM ou Flash. Il contient ici une copie 40 de sauvegarde du code binaire 30. Typiquement, c'est cette copie 40 qui est automatiquement recopiée dans la mémoire 4 pour restaurer le code 30, par exemple, après une coupure de courant ou similaire ou juste avant que débute l'exécution du code 30. La figure 4 représente un procédé d'exécution du code binaire 30 par le microprocesseur 2. Le procédé débute par une étape 150 de génération puis de fourniture du code binaire 30 dans la mémoire MP. La génération du code binaire 30 est typiquement réalisée par un compilateur tel que celui décrit, plus loin, en référence à la figure 6. La fourniture du code binaire 30 consiste ensuite à enregistrer la copie 40 dans le support 6. Puis, par exemple, le microprocesseur 2 recopie la copie 40 à l'intérieur de la mémoire MP pour obtenir le code binaire 30 enregistré dans la mémoire MP. Ainsi, lors de l'étape 150, les bloc BDC i construits lors de la compilation du code source et contenus dans le code binaire 30, sont enregistrés dans la mémoire MP et, généralement, dans la partie 44. Plus précisément, les blocs BDC i qui contiennent les données initialisées par le compilateur sont enregistrés dans le segment de données. Les blocs BDC i qui contiennent les données qui n'ont pas été explicitement initialisées par le compilateur sont enregistrés dans le segment bss. Une donnée est considérée comme initialisée, si le compilateur lui a explicitement affectée une valeur. De plus, à chaque fois que le compilateur construit un bloc BDC i , il bascule dans l'état actif les indicateurs IdV i,p qui sont associés aux blocs de N o octets initialisés. A l'inverse, les indicateurs IdV i,p qui sont associés aux blocs de N o octets qui n'ont pas été explicitement initialisés sont basculés dans leur état inactif. Ainsi, en général, les indicateurs IdV i,p de tous les blocs BDC i enregistrés dans le segment de données sont dans leur état actif. A l'inverse, les indicateurs IdV i,p de tous les blocs BDC i enregistrés dans le segment bss sont dans leur état inactif. Ensuite, lors d'une phase 152, le microprocesseur 2 exécute le code binaire 30 et, en particulier, le code machine 32. Éventuellement, l’exécution du code binaire 30 commence par une étape 154 d’authentification de l’auteur de ce code binaire. Si l'authentification est réussie avec succès, alors le procédé se poursuit par une étape 162. À l’inverse, si l’authentification n’a pas été réussie avec succès, le module 28 considère alors que l’authentification de l’auteur du code binaire 30 a échoué et le procédé se poursuit par une étape 163. Lors de l’étape 163, l’exécution du code binaire 30 est arrêtée. Lors de l’étape 162, le module 28 charge notamment le cryptogramme ka* contenu dans le bloc 34 et le déchiffre à l’aide de la clé sk CPU contenue dans la mémoire 29. À l’issue de l’étape 162, la clé ka est contenue dans la mémoire 29. Ensuite, lors de l’étape 162, le microprocesseur 2 exécute, les unes après les autres, les instructions du code machine 32. Lors ce de cette étape 162, des instructions de chargement et des instructions d'écriture sont exécutées. Par la suite, ces deux types d'instructions sont collectivement désignées par l'expression "instruction d'accès" ou "instruction d'accès à la mémoire". A chaque fois qu'une instruction d'accès à la mémoire est exécutée par le microprocesseur 2, le procédé de la figure 5 est exécuté. Le procédé de sécurisation des données enregistrées dans l'ensemble 4 va maintenant être décrit à l’aide de la figure 5 et dans le cas où la donnée accédée est la donnée D i,j . L’adresse physique associée à la donnée D i,j est notée par la suite @ Di,j. En réponse à l'exécution d'une instruction d'accès à la donnée D i,j , lors d’une étape 170, l’adresse @ Di,j est transmise au module 28. Lors d’une étape 172, le module 28 détermine l’adresse @ BDCi du bloc BDC i qui contient cette donnée D i,j . Pour cela, le module 28 calcule ici l’adresse @ BDCi selon la relation (2) suivante : @ BDCi = E(@ Di,j /T BD ).T b , où : - E(…) est la fonction qui retourne la partie entière du nombre entre parenthèses, et - T BD et T b sont les tailles, en nombre d’octets, respectivement du bloc BD i et du bloc BDC i . La fonction E(...) est connue sous le terme anglais de "floor". Dans la mémoire MP, les blocs BDC i sont immédiatement consécutifs les uns aux autres. De plus, ils sont classés par ordre croissant des adresses physiques des données D i,j qui sont chiffrées dans chacun de ces blocs BDC i . Dès lors, le terme E(@ Di,j /T BD ) donne le numéro d’ordre du bloc BDC i à partir duquel la donnée D i,j peut être chargée. Étant donné que dans ce mode de réalisation, les tailles T BD et T b sont toutes les deux des puissances de deux, la division par la taille T BD et la multiplication par la taille T b peuvent toutes les deux être réalisées par un registre à décalage. Un registre à décalage décale les bits du nombre qu’il contient vers la droite pour réaliser une division et vers la gauche pour réaliser une multiplication. Plus précisément, dans ce mode de réalisation, la taille T BD est égale à 2 4 octets et la taille T b est égale à 2 5 octets. Ici, le module 28 comporte donc un registre matériel à décalage. Dans ces conditions, le module 28 est capable de calculer très rapidement, et typiquement en un cycle d’horloge, l’adresse @ BDCi . Ainsi, ici, pour calculer l’adresse @ BDCi , le module 28 enregistre l’adresse @ Di,j dans son registre à décalage puis décale de quatre bits vers la droite les bits de l’adresse enregistrée dans ce registre pour obtenir le résultat du ratio @ Di,j /T BD. Ensuite le module 28 calcule la partie entière du ratio obtenu puis enregistre cette partie entière dans le registre à décalage. Enfin, le registre à décalage décale de cinq bits vers la gauche les bits de cette partie entière pour obtenir l’adresse @ BDCi . Il est préférable que le calcul de l’adresse @ BDCi soit très rapide, car ce calcul est réalisé à chaque fois qu’une donnée est accédée. Une fois l’adresse @ BDCi déterminée, le module 28 vérifie si l’adresse @ BDCi est égale à une adresse @ BDCc . L'adresse @ BDCc est l'adresse du bloc BDC c à partir duquel le bloc BD c actuellement contenu dans le tampon 14 a été chargé. L'adresse @ BDCc est, par exemple, enregistrée dans la mémoire 29. Dans l’affirmative, cela signifie que le bloc BD i qui contient la donnée D i,j à accéder est déjà enregistré dans le tampon 14. Autrement dit, les blocs BD i et BD c sont les mêmes. Dans ce cas, le procédé se poursuit : - directement par une étape 176 si l’instruction d'accès exécutée est une instruction de chargement, ou - directement par une étape 190 si l’instruction d'accès exécutée est une instruction d’écriture. Lors de l’étape 176, pour chaque octet à charger, le module 28 vérifie si l’indicateur IdV i,p associé à cet octet est dans l’état actif. Pour cela, le module 28 utilise les indicateurs IdV i,p associés à chacun des octets du bloc BD i qui sont enregistrés dans le registre B itV de la mémoire 29. Si l’indicateur IdV i,p associé à cet octet est dans l’état actif, lors d’une étape 178, le traitement de cet octet par le microprocesseur 2 est autorisé. Dans ce cas, il est alors directement chargé à partir du tampon 14 puis, par exemple, transféré dans l’un des registres de l’ensemble 12. Ensuite, l’unité 10 exécute des instructions de traitement des données enregistrées dans les registres de l'ensemble 12. Si l’indicateur IdV i,p associé à cet octet est dans l’état inactif, le traitement, par le microprocesseur 2, de cet octet est interdit. Dans ce cas, le procédé se poursuit par une étape 180 d'inhibition du chargement des octets associés à ces indicateurs IdV i,p dans l’état inactif. Par exemple, lors de l’étape 180, aucun des octets qui auraient dû être chargés par le microprocesseur 2 en réponse à l’exécution de l’instruction de chargement n’est chargé dans un registre de l'ensemble 12. De plus, ici, lors de l’étape 180, le module 28 déclenche le signalement d’une faute d’exécution du code binaire 30. En réponse à un tel signalement, lors d'une étape 182, le microprocesseur 2 met en œuvre une ou plusieurs mesures correctives et/ou une ou plusieurs contre-mesures. A titre d'exemple d'une mesure corrective, lors de l'étape 182, le module 28 initialise à une valeur prédéterminée, par exemple zéro, les octets du bloc BD i qui devaient être chargés alors qu'ils n'avaient pas encore été initialisés. Après cela, le module 28 bascule les indicateurs IdV i,p associés à ces octets initialisés dans leur état actif. De très nombreuses contre-mesures sont possibles. Les contre-mesures mises en œuvre peuvent avoir des degrés de sévérité très différents. Par exemple, les contre-mesures mises en œuvre peuvent aller d'un simple affichage ou une simple mémorisation d'un message d'erreur sans interrompre l'exécution normale du code binaire, jusqu'à une mise hors service définitive du microprocesseur 2. Le microprocesseur 2 est considéré comme étant hors service lorsqu'il est définitivement placé dans un état où il est incapable d'exécuter un quelconque code binaire. Entre ces degrés de sévérité extrêmes, il existe de nombreuses autres contre-mesures possibles telles que : - l'indication par l'intermédiaire d'une interface homme-machine de la détection des fautes, - l'interruption immédiate de l'exécution du code binaire et/ou sa réinitialisation, et - la suppression du code binaire de la mémoire MP et/ou la suppression de la copie 40 de sauvegarde et/ou la suppression des données secrètes. Lors de l’étape 190, le ou les octets à écrire sont directement écrits dans le bloc de données BD i actuellement enregistré dans le tampon 14. Avant d'écrire un octet dans le tampon 14, le module 28 ne procède pas à la vérification de l'état de l'indicateur IdV i,p associé à cet octet. Au contraire, à chaque fois qu’un octet est écrit dans le tampon 14, le module 28 fait basculer systématiquement l’indicateur IdV i,p associé à cet octet dans son état actif. En effet, à partir du moment où le microprocesseur 2 a écrit un octet, la valeur de cet octet est initialisée et sa valeur n’est plus inconnue. Si lors de l’étape 174, l’adresse @ BDCi est différente de l’adresse contenue dans la mémoire 29, cela signifie que le bloc BD c actuellement contenu dans le tampon 14 ne contient pas la donnée D i,j à accéder. Dans ce cas, le procédé se poursuit par une étape 200. Lors de l’étape 200, le module 28 vérifie si le bloc BD c actuellement contenu dans le tampon 14 a été écrit. Typiquement, pour faire cela, le module 28 vérifie l’état d’un indicateur d’écriture. Un tel indicateur d’écriture est connu sous le terme anglais de « bit dirty». L’indicateur d’écriture est basculé vers son état actif à chaque fois qu’un octet est écrit dans une donnée D c,j du tampon 14. L’état actif de cet indicateur d’écriture indique donc que le bloc BD c a été écrit. A chaque fois qu’un nouveau bloc de données en clair est enregistré dans le tampon 14, l’indicateur d’écriture est basculé dans son état inactif. Ainsi, l’état inactif de l’indicateur d’écriture indique que le bloc BD c enregistré dans le tampon 14 n’a pas été écrit. Si l’indicateur d’écriture est dans son état inactif, il n’est pas nécessaire d’enregistrer le bloc de données BD c dans l’ensemble 4. Dans ce cas, le procédé se poursuit directement par une étape 300 de transfert du bloc BDC i qui contient la donnée D i,j chiffrée depuis l’ensemble 4 vers le tampon 14. Dans le cas contraire, le bloc BD c actuellement enregistré dans le tampon 14 doit être sauvegardé dans l’ensemble 4. Dans ce cas, le procédé se poursuit par une étape 400 de transfert du bloc BD c actuellement contenu dans le tampon 14 vers l’ensemble 4. L’étape 300 débute par une opération 302 de chargement du bloc BDC i situé à l’adresse @ BDCi déterminée lors de l’étape 172. De préférence, le bloc BDC i est chargé depuis l’ensemble 4 vers le microprocesseur en utilisant un mode de transfert accéléré de bloc de données sur le bus 50. Un tel mode est par exemple connu sous le terme anglais de « burst mode ». Le bloc BDC i chargé est alors temporairement stocké dans le microprocesseur 2. Par exemple, il est enregistré dans l’ensemble 12 ou dans la mémoire 29 ou dans le tampon 14. Lors de l’opération 304, le module 28 vérifie l'intégrité du bloc BDC i . Ici, il vérifie l’intégrité et l’authenticité du cryptogramme BD i * et des indicateurs IdV i,p à l’aide du code MAC i . Pour cela, le module 28 calcule un code MAC i ' en utilisant le même algorithme que celui mis en œuvre pour construire le code MAC i sauf qu'il utilise le cryptogramme BD i * et les indicateurs IdV i,p chargés lors de l'opération 302. Si le code MAC i ' ainsi construit est identique au code MAC i chargé, alors l’intégrité et l’authenticité du cryptogramme BD i * et des indicateurs IdV i,p est confirmée. Dans ce cas, le module 28 procède, lors d'une opération 306, au déchiffrement du cryptogramme BD i * en utilisant pour cela la clé ka enregistrée dans sa mémoire 29 et le vecteur iv i extrait à partir des métadonnées MD i du bloc BDC i chargé. Après l'opération 306, lors d'une opération 308, le bloc BD i en clair obtenu est enregistré dans le tampon 14 à la place du précédent bloc de données. Les indicateurs IdV i,p contenus dans le bloc BDC i chargé sont enregistrés dans le registre B itV de la mémoire 29. Le vecteur iv i est quant à lui enregistré dans le registre R iv de la mémoire 29. Enfin, l'adresse @ BDCi du bloc BDC i chargé est aussi enregistrée dans la mémoire 29. Dans le cas où la vérification de l'intégrité du bloc BDC i échoue, le module 28 procède à une opération 310 de préparation d'un bloc BD i vierge. Lors de cette opération 310, le module 28 initialise toutes les données du bloc BDi vierge à une valeur prédéterminée. Typiquement, cette valeur prédéterminée est la valeur zéro. Ensuite, ce bloc BDi vierge est enregistré dans le tampon 14. Toujours lors de cette opération 310, le module 28 bascule aussi chacun des indicateurs IdVi,p, contenus dans le registre BitV de la mémoire 29, dans leur état inactif. Il ré-initialise aussi la valeur du vecteur ivi contenue dans le registre Riv. Par exemple, la nouvelle valeur du vecteur ivi contenu dans le registre Riv est générée par tirage aléatoire ou pseudo-aléatoire. Enfin, l'adresse @BDCi du bloc BDCi chargé est aussi enregistrée dans la mémoire 29. Ainsi, dans le cas où la vérification de l'intégrité du bloc BDCi échoue, c'est un bloc BDi vierge qui est enregistré dans le tampon 14. Après l'opération 308 ou 310, le procédé se poursuit par l'étape 176 ou l'étape 190 selon que l'instruction à exécuter est une instruction de chargement ou une instruction d'écriture. L’étape 400 débute par une opération 402 de transformation du bloc BD c en un bloc BDC c . Pour cela, lors d’une sous-opération 404, le module 28 commence par générer un nouveau vecteur iv i . Le nouveau vecteur iv i est par exemple généré à partir de l’ancienne valeur de ce vecteur iv i enregistrée dans le registre R iv . Par exemple, le nouveau vecteur iv i est obtenu en incrémentant cette ancienne valeur d’un pas prédéterminé. Ensuite, lors d’une sous opération 406, le module 28 chiffre le bloc BD c actuellement contenu dans le tampon 14 en utilisant pour cela la clé ka et le nouveau vecteur iv i généré lors de la sous-opération 404. A l’issue de cette opération, le cryptogramme BD c * est obtenu. Lors d’une sous-opération 408, le module 28 calcule le nouveau code MAC c à partir du cryptogramme BD c * obtenu à l’issue de la sous-opération 406 et à partir des indicateurs IdV c,p actuellement contenus dans le registre B itV de la mémoire 29. Enfin, une fois le nouveau code MAC c calculé, à la fin de la sous-opération 408, le module 28 regroupe dans un même bloc de données, le cryptogramme BD c * , les indicateurs IdV c,p du registre B itV , le nouveau vecteur iv c et le nouveau code MAC c afin d’obtenir un nouveau bloc BDC c . Après, lors d’une opération 410, le nouveau bloc BDC c est enregistré dans l’ensemble 4 à l’adresse @ BDCc actuellement contenue dans la mémoire 29. L’étape 400 s’achève alors et le procédé se poursuit par l’étape 300. La figure 6 représente un compilateur 500 apte à générer automatiquement le code binaire 30 à partir d'un code source 502. À cet effet, le compilateur 500 comporte typiquement un microprocesseur 504 programmable et une mémoire 506. La mémoire 506 contient les instructions et les données nécessaires pour, lorsqu'elles sont exécutées par le microprocesseur 504, générer automatiquement le code binaire 30 à partir du code source 502. En particulier, lors de la compilation du code source 502, le microprocesseur 504 génère automatiquement les bloc BDC i qui seront ensuite enregistrés dans la partie 44 de la mémoire MP après chargement de ce code binaire 30 dans cette mémoire MP . Plus précisément, lors de la compilation, le compilateur 500 transforme chaque bloc BD i en clair destiné à être enregistré dans la partie 44 de la mémoire MP en un bloc BDC i de la façon similaire à ce qui a été décrit en référence de l'étape 400. La conception et la réalisation d'un tel compilateur sont à la portée de l'homme du métier à partir des explications données dans cette description. CHAPITRE III : VARIANTES Variantes de l'appareil 1 : D'autres modes de réalisation de l'ensemble 4 sont possibles. Par exemple, l'ensemble 4 peut comporter un plus grand nombre ou un plus petit nombre de mémoire cache. Dans un cas très simplifié, l'ensemble 4 ne comporte pas de mémoire cache et comporte, par exemple, seulement la mémoire principale MP. La mémoire MP peut être une mémoire non volatile. Dans ce cas, il n'est pas nécessaire de copier le code binaire 30 à l'intérieur de cette mémoire avant le lancement de son exécution puisqu'il s'y trouve déjà. Le fait qu'une mémoire de l'ensemble 4 soit intégrée ou non à l'intérieur du microprocesseur 2 peut être librement modifié. Ainsi, en variante, la mémoire cache L1 est située à l'extérieur du microprocesseur 2 et non pas à l'intérieur. De même, dans une autre variante, les mémoires caches L1 et L2 voire L3 sont intégrées à l'intérieur du microprocesseur 2, c'est-à-dire réalisées sur la même puce semi-conductrice que l'unité 10 du microprocesseur 2. En variante, la mémoire MP peut aussi être une mémoire interne intégrée à l'intérieur du microprocesseur 2. Dans ce dernier cas, elle est réalisée sur le même substrat que les autres éléments du microprocesseur 2. Enfin, dans d'autres configurations, la mémoire MP se compose de plusieurs mémoires dont certaines sont des mémoires internes et d'autres des mémoires externes. Il existe des microprocesseurs dont le jeu d’instructions machines permet seulement, au minimum, d’écrire plusieurs octets et non pas un seul octet à la fois. Dans ce cas, N o est supérieur à un. Par exemple, N o est égal à deux. Dans ce cas, l'indicateur IdV i,p n’est pas associé à chaque octet, mais à chaque bloc de deux octets. Dans d’autres modes de réalisation, le nombre N o peut être supérieur à deux et, par exemple, égal à quatre. En variante, les nombres N o et T d sont égaux. Dans ce cas, la plus petite granularité avec laquelle le microprocesseur 2 peut écrire dans la mémoire MP est la donnée D i,j entière. Dans ce cas, chaque donnée D i,j est associée à un seul indicateur IdV i,p . De nombreuses architectures matérielles différentes sont possibles pour réaliser le module 28. En particulier, le module 28 peut être composé par la combinaison de plusieurs blocs matériels du microprocesseur 2 remplissant des fonctions respectives et situés chacun dans une aire différente de la puce du microprocesseur 2. En variante, le tampon 14 est apte à contenir simultanément plusieurs blocs de données en clair. Variantes du code d'authentification : D’autres méthodes de calcul du code d’authentification sont possibles. Par exemple, en variante, le module 28 calcule un premier code d’authentification uniquement à partir du cryptogramme BD i * et un second code d’authentification uniquement à partir des indicateurs IdV i,p . Dans ce cas, le code d’authentification contenu dans le bloc BDC i est le résultat, par exemple, de la concaténation de ce premier et de ce second codes d’authentification. Ensuite, les premier et second codes d’authentification sont utilisés par le module 28 pour vérifier l’intégrité, respectivement, du cryptogramme BD i * et des indicateurs IdV i,p lors de l’opération 304. Dans un autre mode de réalisation, le code MAC i est calculé à partir du cryptogramme BD i * et sans prendre en compte les indicateurs IdV i,p . Dans ce cas, de préférence, les indicateurs IdV i,p sont alors chiffrés de sorte qu’ils n’apparaissent pas en clair dans le bloc BDC i . Par exemple, ils sont chiffrés à l'aide de la fonction f ka . Dans une autre variante, le code MAC i est calculé à partir des données D i,j en clair et non pas à partir du cryptogramme BD i * . Dans ce cas, il faut inverser l’ordre des opérations de vérification de l’intégrité du code d’authentification et de déchiffrement du cryptogramme BD i * . En effet, dans ce cas, les données doivent d’abord être déchiffrées et seulement ensuite, le module 28 est en mesure d’en vérifier l’intégrité. Variantes des métadonnées : En variante les métadonnées MD i comportent d'autres données que les indicateurs IdV i,p et que le vecteur iv i . A l'inverse, dans un mode de réalisation simplifié, les métadonnées MD i ne comporte pas le vecteur iv i . Dans ce dernier cas, le vecteur iv i à utiliser pour déchiffrer le cryptogramme BD i * est alors stocké différemment. Par exemple, un registre associant, à chaque bloc BDC i , le vecteur iv i nécessaire pour déchiffrer le cryptogramme BD i * est enregistré dans la mémoire MP. Les métadonnées peuvent être enregistrées dans le tampon 14 ou dans un registre indépendant du tampon 14 et de la mémoire 29. Dans le cas où les métadonnées MD i sont enregistrées dans le tampon 14, celles-ci sont, de préférence, enregistrées dans une plage d’adresses distincte de la plage d’adresses où sont enregistrées les données D i,j . Typiquement, cette plage d’adresses distincte n’est pas adressable par le microprocesseur de sorte que la présence des métadonnées MD i dans le tampon 14 ne modifie en rien l’adressage des données D i,j . Par contre, les métadonnées MD i sont accessibles par le module 28 pour qu’il puisse mettre en œuvre les différentes étapes décrites dans le chapitre II. En variante, lorsque le nouveau vecteur iv i d’un bloc BDC i est généré sans prendre en compte sa précédente valeur, il n’est pas nécessaire de sauvegarder sa précédente valeur dans le registre R iv après le chargement du bloc BDC i dans le tampon 14. C’est par exemple le cas lorsque, à chaque transfert d’un bloc de données du tampon 14 vers l’ensemble 4, le nouveau vecteur iv i est généré par tirage aléatoire ou pseudo aléatoire. D’autres méthodes de génération d’un nouveau vecteur iv i sont possibles. Par exemple, le nouveau vecteur iv i est pris égal à la précédente valeur du code MAC i . Dans ce cas, à chaque fois qu’un bloc BDC i est transféré de l’ensemble 4 vers le tampon 14, le code MAC i contenu dans ce bloc BDC i est enregistré dans le microprocesseur, par exemple, dans la mémoire 29. Le nouveau vecteur iv i peut aussi être complété par d’autres informations pour obtenir un vecteur d’initialisation complet ivc i puis, lors de l’opération 406 de chiffrement, c’est ce vecteur ivc i qui est utilisé à la place du vecteur iv i . Dans ce cas, le cryptogramme BD i * est le résultat de la fonction f ka (BD i ; ivc i ). L’opération 306 de déchiffrement doit alors être adaptée en conséquence. Autrement dit, le bloc BD i en clair est le résultat de la fonction f ka -1 (BD i * ; ivc i ). Par exemple, le vecteur ivc i est obtenu en combinant le vecteur iv i et l’adresse @ BDCi contenue dans la mémoire 29. Par exemple, le vecteur iv i et l’adresse @ BDCi sont concaténés. Le vecteur ivc i peut aussi être obtenu en combinant le vecteur iv i avec un identifiant du code binaire 30. Dans ce cas, le cryptogramme BD i * obtenu est fonction du code binaire 30 à exécuter. Le vecteur ivc i peut aussi être obtenu en combinant le vecteur iv i , l’adresse @ BDCi et l’identifiant du code binaire 30. Chaque indicateur IdV i,p peut être composé de plusieurs bits et non pas d’un seul bit comme précédemment décrit. Variantes du procédé : En cas de tentative de chargement d’un octet associé à un indicateur IdV i,p dans l’état inactif, de nombreuses autres actions sont possibles que le signalement d’une faute d'exécution. Par exemple, une ou plusieurs des actions appartenant au groupe constitué des actions suivantes sont déclenchées et exécutées : - le signalement d’une faute d'exécution, - l’initialisation de cet octet à une valeur prédéterminée comme, par exemple, à zéro, et - l’exécution d’une contre-mesure. De même, lorsque la vérification de l’intégrité du code MAC i échoue, une ou plusieurs des actions du groupe ci-dessus peuvent être déclenchées et exécutées. En variante, une autre relation que la relation (1) est utilisée pour déterminer l'adresse @ BDCi où est enregistré le bloc BDC i . Dans ce cas, la relation (2) doit être adaptée en conséquence. Par exemple, dans un mode de réalisation particulièrement souple, le module 28 comporte une table de correspondance qui, à chaque adresse @ BDi d’un bloc BD i en clair associe l’adresse @ BDCi du bloc BDC i contenant les données D i,j sous forme chiffrée. Dans un tel cas, le module 28 peut déterminer l’adresse @ BDCi du bloc contenant la donnée D i,j située à l’adresse @ Di,j en mettant en œuvre les étapes suivantes : - Étape 1 : le module 28 calcule l’adresse @ BDi du bloc BD i qui contient la donnée D i,j à l’aide de la relation suivante : @ BDi = E(@ Di,j /T BD ).T BD , puis - Etape 2 : le module 28 recherche dans la table de correspondance l’adresse @ BDCi associée à l’adresse @ BDi calculée. Le fait que les tailles T b et T BD soient toutes les deux des puissances de deux impose que la taille T b est deux fois plus grande que la taille T BD . Ainsi à chaque fois que la taille T BD est augmentée, la taille T b doit aussi être augmentée de façon proportionnelle. Cela revient donc à augmenter l’espace disponible pour stocker les métadonnées MD i et le code MAC i . Or, il n’est pas toujours souhaitable d’augmenter l’espace disponible pour stocker les métadonnées MD i et le code MAC i car cela revient à occuper plus de place en mémoire, sans que cela se traduise nécessairement par une amélioration des performances de l’appareil 1. Ainsi, en variante, la taille T b n’est pas égale à deux fois la taille T BD . Par exemple, la taille T b est plus petite que 2T BD . Dans ce dernier cas, de préférence, les tailles T b et T BD sont alors choisies de manière à ce que le nombre (T b -T BD ) et la taille T BD sont tous les deux des puissances de deux. Dans ce cas, la relation (1) est remplacée par la relation (3) suivante : @ BDCi =@ BDi +@ BDi (T b -T BD )/T BD . La relation (2) est remplacée par la relation (4) suivante : @ BDCi =E(@ Di,j /T BD ).T BD +E(@ Di,j /T BD )(T b -T BD ). Dans les relations (3) et (4), les multiplications et les divisions peuvent toujours être réalisées en utilisant les registres à décalage du module 28 et donc très rapidement. Par contre, par rapport au cas où ce sont les relations (1) et (2) qui sont utilisées, il faut réaliser une opération d’addition en plus pour calculer l’adresse @ BDCi . Par conséquent, cette variante est un peu moins rapide que ce qui a été décrit dans le chapitre II. Par contre, elle présente l’avantage d'autoriser une taille T BD qui est supérieure à la taille (T b -T BD ), c’est-à-dire supérieure à la taille des métadonnées MD i et du code MAC i . Ce qui a été décrit en détail dans le cas particulier de la partie 44 de la mémoire MP, s'applique à tout autre partie de la mémoire MP contenant des données à protéger. Par exemple, cela peut aussi être appliqué à la pile 46 ou au tas 48. Dans l'exemple détaillé de mode de réalisation, le transfert par blocs entiers entre l'ensemble 4 et le microprocesseur 2 est uniquement mis en œuvre pour les données et pas pour les instructions du code machine 30. Dans ce cas, seul le ou les espaces mémoires de l'ensemble 4 réservés pour le stockage de données sont divisés en blocs successifs de données chiffrées et authentifiées. L'espace mémoire réservé pour le stockage des instructions est alors, par exemple, utilisé de façon conventionnelle. Ainsi, dans ce mode de réalisation, les instructions sont transférées une par une vers le microprocesseur 2. De plus, dans ce cas, les instructions ne sont pas nécessairement enregistrée sous forme chiffrée dans l'ensemble 4. Toutefois, ce qui a été décrit ici dans le cas particulier des données peut aussi être appliqué aux instructions du code machine 32. Par la suite, lorsqu'un bloc contient des instructions, il est appelé "bloc d'instructions". Par exemple, comme décrit dans le cas particulier des données, la partie 42 de la mémoire MP qui contient les instructions du code machine est divisée en blocs d'instructions successifs et contigus. Par exemple, dans un premier mode de réalisation, la structure des bloc de données et des blocs d'instructions sont identiques. De plus, les fonctionnements dans le cas des blocs de données et dans le cas des blocs d'instructions sont identiques. A partir de l'enseignement donné ici dans le cas particulier des blocs de données, l'homme du métier est capable de le transposer, sans difficulté, au cas des instructions. Il est donc seulement souligné que, dans le cas des instructions, l'adresse de la prochaine instruction à charger dans le microprocesseur 2 est contenue dans le compteur ordinal 26 et non pas dans une instruction de chargement exécutée par l'unité 10. Il est également souligné que, de préférence, le tampon utilisé pour stocker un bloc d'instructions en clair est un tampon, par exemple structurellement identique au tampon 14, mais distinct du tampon 14 et dédié au stockage d'un bloc d'instruction. Enfin, il faut remarquer que dans le cas des instructions, celles-ci ne sont pas habituellement destinées à être modifiées individuellement par l'exécution d'une instruction d'écriture par le microprocesseur. Ainsi, le problème qui se pose lorsqu'une seule donnée d'un bloc de données est modifiée, ne se rencontre pas dans le cas des instructions. L'intérêt de traiter exactement de la même manière les instructions et les données est donc surtout d'harmoniser ces traitements et, par conséquent, de simplifier la réalisation du module 28 de sécurisation. Autres variantes : Les différents modes de réalisation et les différentes variantes ont jusqu’à présent été décrits dans le cas particulier où la mémoire déchiffrée est le tampon 14 et la mémoire chiffrée est l’ensemble 4 de mémoire, c’est-à-dire la mémoire de rang juste supérieur. Toutefois, l’enseignement donné ici s’applique à toutes mémoires déchiffrée et chiffrée entre lesquelles des données sont transférées par bloc entier de données chiffrées et authentifiées. Par exemple, en variante, la mémoire déchiffrée est la mémoire cache L1 et la mémoire chiffrée est la mémoire cache L2. Dans ce cas, le module de sécurisation est, par exemple, implémenté dans la mémoire cache L1 pour chiffrer et déchiffrer les blocs BDC i qui sont transférés entre ces deux mémoires cache L1 et L2. On notera que dans ce cas, les données sont en clair dans la mémoire cache L1 et sont chiffrées dans la mémoire cache L2. A partir du moment où les données sont chiffrées dans la mémoire cache L2, celles-ci seront nécessairement chiffrées dans les mémoires de rang supérieur. Ce qui est décrit ici peut aussi être appliqué entre les mémoires cache L2 et L3 ou entre la mémoire cache L3 et la mémoire principale MP. Dans le cas où le module de sécurisation est seulement implémenté entre deux niveaux de mémoire supérieure au tampon 14, le tampon 14 peut être supprimé. Chapitre IV : Avantages des modes de réalisation décrits Le fait d’associer à chaque bloc de N o octets un indicateur IdV i,p permet au module 28 de détecter que ce bloc de N o octets est invalide et d’en interdire le traitement par le microprocesseur 2, et cela même si ce bloc de N o octets est situé à l’intérieur d’un bloc BDC i dont l’intégrité a été, au préalable, vérifiée avec succès lors de son transfert de la mémoire chiffrée vers la mémoire déchiffrée. Ainsi, le procédé d’exécution d’un programme d’ordinateur est plus robuste vis-à-vis des attaques qui cherchent à exploiter la présence d ' octets qui n’ont pas encore été initialisés. Le fait de calculer le code MAC i contenu dans le bloc BDC i à partir des indicateurs IdV i,p rend la falsification des valeurs de ces indicateurs très difficile. Cela accroît donc la sécurité du procédé d’exécution. Le fait d’enregistrer le vecteur iv i dans les métadonnées MD i permet simplement d’enregistrer puis de retrouver chaque vecteur iv i nécessaire pour déchiffrer le cryptogramme BD i * . Le fait que le module 28 construise lui-même l’adresse @ BDCi à laquelle doit être enregistré, dans la mémoire chiffrée, le bloc BDC i rend l’ajout des métadonnées MD i et du code MAC i au cryptogramme BD i * transparent pour l'unité 10. En pratique, l'unité 10 fonctionne comme si toutes les données étaient en clair sans avoir à se préoccuper du chiffrement et du déchiffrement ni de la présence des métadonnées MD i dans la mémoire chiffrée. En particulier, les adresses utilisées par le microprocesseur 2 pour charger ou écrire une donnée sont les mêmes que celles qui seraient utilisées dans le cas où les métadonnées MD i et les codes MAC i n’existaient pas. Le fait que le module 28 calcule lui-même l'adresse @ BDCi du bloc BDC i à partir de laquelle peut être chargée une donnée D i,j à accéder rend la présence des métadonnées MD i et du code MAC i transparente pour l'unité 10. En effet, c’est le module 28 qui réalise la conversion d’adresse et non pas l'unité 10. Le fait d’enregistrer dans la mémoire déchiffrée un bloc vierge de données en clair dont chacun des identifiants IdV i,p a été basculé dans son état inactif permet l’utilisation de segment de mémoire dédié au stockage de données non-initialisées, comme par exemple le segment bss, pour y enregistrer de façon sécurisée des données qui sont initialisées seulement en cours de l’exécution du code binaire. Procédé d’exécution d’un programme d'ordinateur par un appareil électronique comportant un microprocesseur, une mémoire déchiffrée, une mémoire chiffrée et un module matériel de sécurisation, dans lequel, lors de l'exécution du programme d'ordinateur, le transfert des données entre la mémoire déchiffrée et la mémoire chiffrée se fait par bloc entier de plusieurs données chiffrées et authentifiées, chaque donnée étant composée d'un ou plusieurs blocs de N o octets, où N o est égal au plus petit nombre d'octets qui peut être écrit, indépendamment des autres octets de la donnée, par le microprocesseur lorsqu'il exécute une instruction d'écriture de son jeu d'instructions machines, le procédé comportant à cet effet : a) lors du transfert (400) d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée : - la transformation (402) du bloc de données en clair en un bloc de données chiffrées et authentifiées, cette transformation comportant : le chiffrement (406) du bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, le calcul (408) d'un code d'authentification à partir des données du bloc de données en clair, et le regroupement, dans un même bloc, du cryptogramme obtenu, du code d'authentification calculé et de métadonnées pour obtenir le bloc de données chiffrées et authentifiées, puis - l'enregistrement (410) du bloc de données chiffrées et authentifiées obtenu dans la mémoire chiffrée, b) lors du transfert (300) d'un bloc de données chiffrées et authentifiées de la mémoire chiffrée vers la mémoire déchiffrée : - la vérification (304) de l'intégrité du bloc de données chiffrées et authentifiées à l'aide du code d'authentification contenu dans ce bloc de données chiffrées et authentifiées, - lorsque cette vérification échoue, l'inhibition du traitement, par le microprocesseur, des données de ce bloc de données, et - lorsque cette vérification réussie : le déchiffrement (306) du cryptogramme contenu dans le bloc de données chiffrées et authentifiées pour obtenir le bloc de données en clair, l'enregistrement (308) du bloc de données en clair obtenu dans la mémoire déchiffrée et l'enregistrement des métadonnées du bloc de données chiffrées et authentifiées dans un registre non adressable par le microprocesseur, caractérisé en ce que le procédé comporte : - l'incorporation (408) dans les métadonnées de chaque bloc de données et pour chaque bloc de N o octets de chaque donnée de ce bloc de données, d'un indicateur de validité associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc d'octets est valide, et un état inactif dans lequel il indique que ce bloc d'octets est invalide, au moins certains des indicateurs de validité étant initialement dans leur état inactif, - lorsque le microprocesseur écrit un bloc de N o octets d'une donnée du bloc de données en clair enregistré dans la mémoire déchiffrée, le module de sécurisation fait basculer (190) l'indicateur de validité associé à ce bloc de N o octets dans son état actif, - à chaque fois qu'un bloc de N o octets d'une donnée du bloc de données en clair est chargé par le microprocesseur à partir de la mémoire déchiffrée, le module matériel de sécurisation vérifie (176) si l'indicateur de validité associé à ce bloc de N o octets est dans son état actif et, dans l'affirmative, le traitement, par le microprocesseur, de ce bloc de N o octets est autorisé (178), et, dans la négative, le traitement, par le microprocesseur, de ce bloc de N o octets est interdit (180). Procédé selon la revendication 1, dans lequel lors du calcul (408) du code d'authentification, le code d'authentification est également calculé à partir des indicateurs de validité associés à chaque groupe de N o octets de chaque donnée du bloc de données en clair. Procédé selon l'une quelconque des revendications précédentes, dans lequel : - lors du chiffrement (406) des données en clair, les données en clair sont chiffrées en utilisant une clé cryptographique et un vecteur d'initialisation, la clé cryptographique utilisée étant la même lors de chaque transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée et le vecteur d'initialisation étant modifié lors de chaque transfert d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée, et - l'incorporation (408) dans les métadonnées du bloc de données chiffrées et authentifiées, du vecteur d'initialisation utilisé pour obtenir le cryptogramme de ce bloc de données, et - lors du déchiffrement des données, le module matériel de sécurisation extrait (306) des métadonnées du bloc de données chiffrées et authentifiées, le vecteur d'initialisation à utiliser pour réaliser ce déchiffrement. Procédé selon l'une quelconque des revendications précédentes, dans lequel chaque bloc de données chiffrées et authentifiées est enregistré (410) à une adresse @ BDCi égale à @ BDi .T b /T BD , où : - @ BDi est l'adresse physique de début, dans la mémoire déchiffrée, du bloc de données en clair obtenu par déchiffrement du cryptogramme de ce bloc de données chiffrées et authentifiées, - T b est la taille, en nombre d'octets, du bloc de données chiffrées et authentifiées, - T BD est la taille, en nombre d'octets, du bloc de données en clair. Procédé selon la revendication 4, dans lequel : - chaque donnée est associée, par une relation biunivoque, à une adresse physique et chaque bloc de données en clair contient seulement les N d données associées, par cette relation biunivoque, a des adresses physiques contenue dans une plage respective et continue de N d adresses physiques consécutives et l'adresse @ BDi de début de ce bloc de données en clair est égale à la plus petite adresse physique de cette plage de N d adresses physiques, - lors de l'exécution du programme d'ordinateur, le microprocesseur exécute une instruction d'accès à au moins un bloc de N o octets d'une première donnée associée à une adresse physique @ Di,j , cette première donnée n'appartenant à aucun des blocs de données en clair actuellement enregistrés dans la mémoire déchiffrée au moment de l'exécution de cette instruction d'accès, - en réponse, le module matériel de sécurisation calcule (172) une adresse @ BDCi égale à E(@ Di,j /T BD ).T b , où - E() est la fonction qui retourne la partie entière du nombre situé entre les parenthèses, et - @ BDCi est l'adresse de début, dans la mémoire chiffrée, du bloc de données chiffrées et authentifiées qui contient la première donnée, puis - le bloc de données chiffrées et authentifiées qui débute à l'adresse @ BDCi calculée est transféré (302) de la mémoire chiffrée vers la mémoire déchiffrée de manière à enregistrer dans la mémoire déchiffrée un nouveau bloc de données en clair qui contient la première donnée, puis - ledit au moins un bloc de N o octets est accédé (178, 190) à partir de la première donnée contenue dans ce nouveau bloc de données en clair. Procédé selon la revendication 5, dans lequel : - T b et T BD sont tous les deux des puissances de deux et l'adresse @ BDCi est calculée (172) à l'aide de la première relation suivante @ BDCi = E(@ Di,j /T BD ).T b , ou - (T b -T BD ) et T BD sont tous les deux des puissances de deux et l'adresse @ BDCi est calculée à l'aide de la seconde relation suivante @ BDCi = E(@ Di,j /T BD ).T BD + E(@ Di,j /T BD ).(T b -T BD ), et - chaque division et chaque multiplication des première et seconde relations sont exécutées par des registres à décalage du module matériel de sécurisation. Procédé selon l'une quelconque des revendications précédentes, dans lequel, lorsque la vérification (304) de l'intégrité du code d'authentification d'un bloc de données chiffrées et authentifiées échoue : - un bloc vierge de données en clair est préparé (310) et enregistré dans la mémoire déchiffrée au même emplacement que celui où aurait été enregistré le bloc de données en clair si la vérification (304) de l'intégrité du code d'authentification du bloc de données chiffrées et authentifiées avait réussie, les données de ce bloc vierge étant toutes initialisées à une valeur prédéterminée, et - les indicateurs de validité associés à chacun des blocs de N o octets du bloc vierge sont basculés dans leur état inactif. Code binaire (30) apte à être exécuté par un microprocesseur en mettant en œuvre un procédé conforme à l'une quelconque des revendications précédentes, dans lequel le code binaire comporte des blocs de données chiffrées et authentifiées, chaque bloc de données chiffrées et authentifiées contenant : - un cryptogramme (BD i *) d'un bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, - un code d'authentification (MAC i ) calculé à partir des données du bloc de données en clair, - des métadonnées (MD i ), caractérisé en ce que les métadonnées (MD i ) comporte, pour chaque bloc de N o octets de chaque donnée du bloc de données en clair, un indicateur de validité (IdV i,p ) associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc de N o octets est valide, et un état inactif dans lequel il indique que ce bloc de N o octets est invalide. Module matériel (28) de sécurisation pour la mise en œuvre d'un procédé conforme à l'une quelconque des revendications 1 à 7, dans lequel le module matériel est configuré pour : a) lors du transfert (400) d'un bloc de données en clair de la mémoire déchiffrée vers la mémoire chiffrée : - transformer le bloc de données en clair en un bloc de données chiffrées et authentifiées, cette transformation comportant : le chiffrement du bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, le calcul d'un code d'authentification à partir des données du bloc de données en clair, et le regroupement, dans un même bloc, du cryptogramme obtenu, du code d'authentification calculé et de métadonnées pour obtenir le bloc de données chiffrées et authentifiées, puis - l'enregistrement du bloc de données chiffrées et authentifiées obtenu dans la mémoire chiffrée, b) lors du transfert d'un bloc de données chiffrées et authentifiées de la mémoire chiffrée vers la mémoire déchiffrée : - vérifier l'intégrité du bloc de données chiffrées et authentifiées à l'aide du code d'authentification contenu dans ce bloc de données chiffrées et authentifiées, - lorsque cette vérification échoue, inhiber le traitement, par le microprocesseur, des données de ce bloc de données, et - lorsque cette vérification réussie : déchiffrer le cryptogramme contenu dans le bloc de données chiffrées et authentifiées pour obtenir le bloc de données en clair, enregistrer le bloc de données en clair obtenu dans la mémoire déchiffrée et enregistrer les métadonnées du bloc de données chiffrées et authentifiées dans un registre non adressable par le microprocesseur, caractérisé en ce que : - lorsque le microprocesseur modifie un bloc de N o octets d'une donnée du bloc de données en clair enregistré dans la mémoire déchiffrée, le module de sécurisation est configuré pour faire basculer l'indicateur de validité associé à ce bloc de N o octets dans son état actif, et - à chaque fois qu'un bloc de N o octets d'une donnée du bloc de données en clair est chargé par le microprocesseur à partir de la mémoire déchiffrée, le module matériel de sécurisation est configuré pour vérifier si l'indicateur de validité associé à ce bloc de N o octets est dans son état actif et, dans l'affirmative, autoriser le traitement, par le microprocesseur, de ce bloc de N o octets, et, dans la négative, interdire le traitement, par le microprocesseur, de ce bloc de N o octets. Compilateur (500) apte à transformer automatiquement un code source d’un programme d'ordinateur en un code binaire de ce programme d'ordinateur, caractérisé en ce que le compilateur est apte à transformer automatiquement le code source en un code binaire conforme à la revendication 8, ce compilateur étant configuré à cet effet pour transformer automatiquement des blocs de données en clair en blocs de données chiffrées et authentifiées, pour cela ce compilateur est apte, pour chaque bloc de données en clair, : - à chiffrer le bloc de données en clair pour obtenir un cryptogramme de ce bloc de données en clair, ce cryptogramme pouvant uniquement être déchiffré dans sa totalité et non pas donnée par donnée, - à calculer un code d'authentification à partir des données du bloc de données en clair, et - à regrouper, dans un même bloc, le cryptogramme obtenu, le code d'authentification calculé et les métadonnées pour obtenir le bloc de données chiffrées et authentifiées, caractérisé en ce que le compilateur (500) est également configuré pour incorporer dans les métadonnées de chaque bloc de données et pour chaque bloc de N o octets de chaque donnée de ce bloc de données, un indicateur de validité associé à ce bloc de N o octets, cet indicateur de validité étant basculable entre : un état actif dans lequel il indique que ce bloc d'octets est valide, et un état inactif dans lequel il indique que ce bloc d'octets est invalide, au moins certains des indicateurs de validité étant initialement dans leur état inactif.