FR 2819954 A1 20020726 FR 0100953 A 20010124 DISPOSITIF DE COMMANDE D'UN CIRCUIT DE GENERATION DE TENSIONS DE REFERENCE. La présente invention concerne un dispositif de commande d'un circuit de génération de tensions de référence. Plus précisément, ce dispositif de commande permet de commuter des tensions de référence en fonction d'un signal de contrôle logique, pour être appliquées notamment comme tensions de polarisation de transistors cascodes dans un translateur de niveau haute tension. Un exemple d'application concerne les circuits intégrés comprenant des mémoires non volatiles électriquement programmables. Ces mémoires utilisent en effet pour leur programmation, une tension de niveau supérieur à la tension d'alimentation logique Vcc du circuit intégré. La valeur nominale de cette haute tension de programmation dépend essentiellement de la technologie considérée. Pour appliquer cette haute tension à un élément du circuit intégré, par exemple pour l'appliquer sur une rangée d'une mémoire, on utilise habituellement un translateur haute tension, appelé encore translateur de niveaux. Ce translateur reçoit en entrées, un signal logique de commande et une entrée haute tension. En fonction du niveau logique Vcc ou 0 du signal logique de commande, qui dans le cas d'une mémoire sera issu d'un signal de commande d'écriture, on obtient en sortie du translateur, soit la masse, soit le niveau de l'entrée haute tension. Ces translateurs sont bien connus de l'homme du métier. Ces translateurs comprennent habituellement un étage intermédiaire, entre l'étage des transistors du haut et l'étage des transistors du bas. Cet étage intermédiaire comprend un ou plusieurs étages cascodes. Il permet de limiter à des niveaux de tension intermédiaires les noeuds internes du translateur, en sorte qu'aucun transistor du translateur ne voit une trop haute tension à ses bornes. Un exemple d'un translateur à étage cascode de ce type, en technologie CMOS, est représenté sur la figure 1. Dans cet exemple, l'étage du haut comprend dans la première branche, un transistor Mos de type P, Ml, et dans la deuxième branche, un transistor Mos de type P, M2. La source de ces transistors est connectée au noeud d'entrée haute tension EHV. L'étage du bas comprend un transistor Mos de type N, M3, et dans la deuxième branche, un transistor Mos de type N, M4. Ces transistors ont leur source connectée à la masse GND. L'étage cascode comprend quatre transistors Mos : deux transistors Mos de type P, M5 et M6, un dans chaque branche, sous chaque transistor du haut et deux transistors Mos de type N, M7 et M8, un dans chaque branche, au-dessus de chaque transistor du bas. Les transistors MOS P M5 et M6 reçoivent la tension de référence VREFP sur leur grille. Les transistors MOS N M7 et M8 reçoivent la tension de référence VREFn sur leur grille. La sortie VOUT du translateur est prise entre les transistors cascodes N et P d'une branche, aux drains des transistors M6 et M8 dans l'exemple. La grille du transistor du bas M3 de la première branche du translateur reçoit un signal logique de commutation noté IN, et la grille du transistor du bas M4 de la deuxième branche du translateur reçoit le signal inverse, noté/IN. Le rôle de l'étage cascode est de limiter à des niveaux intermédiaires les tensions vues par les transistors du translateur. Les transistors cascodes d'un translateur sont habituellement polarisés par les tensions d'alimentation logique Vcc (transistors cascodes Mos N) et GND (transistors cascodes Mos P). Dans d'autres translateurs, ils sont polarisés par des tensions de référence VREFn, VREFp, générées à partir de la haute tension. Dans la demande de brevet français no 99 09970 déposée le 30 juillet 1999, on montre qu'aucun des deux modes de polarisation n'est satisfaisant. En effet, quand le translateur n'est pas utilisé, le noeud haute tension EHV est à un niveau de repos inférieur ou égal à Vcc. La haute tension est appliquée sous forme d'une rampe de tension qui fait passer le noeud de haute tension depuis sa valeur de repos à sa valeur nominale de haute tension, Vpp. Ainsi, le niveau de tension au noeud EHV, est d'abord inférieur ou égal au niveau de la tension d'alimentation logique Vcc puis devient supérieur pour s'établir à sa valeur nominale Vpp. Quel que soit le mode de polarisation des transistors cascodes choisi, cette polarisation est fixe, déterminée. Dans la demande on montre que la polarisation des transistors cascodes a alors une influence sur la plage de fonctionnement du translateur, ou sur le stress des transistors du translateur, liée à la montée en tension sur le noeud de haute tension EHV. Dans la demande précitée, et comme représenté sur la figure 1, un dispositif de commande est prévu, comprenant un circuit REF de référence de tension et un circuit de commande COM, en sorte d'obtenir des références de tension, en fonction du niveau de l'entrée haute tension EHV. Appliqué au translateur haute tension, ce dispositif de commande permet de faire commuter le translateur dans les valeurs basses de l'entrée haute tension (niveau de repos), en commutant comme tensions de polarisation des transistors cascodes, des tensions de référence égales aux tensions d'alimentation logique Vcc et GND. Une fois que les transistors ont commuté, le niveau de l'entrée haute tension peut monter à sa valeur nominale Vpp, sans risques pour les transistors du translateur. Le dispositif de commande commute alors comme tensions de polarisation des transistors cascodes, les tensions de référence VREFn, VREFP, définies par la mise en série de transistors du circuit de référence montés en diode entre le noeud haute tension et la masse. La sortie du translateur suit alors la montée en tension de l'entrée haute tension Eh avec les avantages d'une polarisation des transistors cascodes par les tensions de référence VREFn, REF,. Tant que le noeud EHV reste à sa valeur nominale Vpp, le translateur peut commuter dans un sens ou dans l'autre, avec ces tensions de polarisation. Dès que le noeud EHV retrouve son niveau de repos, Vcc dans l'exemple, ce sont les tensions Vcc et GND qui s'appliquent comme tensions de polarisation. Ainsi, la fenêtre de fonctionnement du translateur est élargie (commutation à basse tension) et ses translateurs ne subissent pas de stress dû au passage du noeud haute tension de sa position de repos, Vcc dans l'exemple, à sa valeur nominale Vpp. Comme détaillé sur la figure 1, selon la demande précitée, le circuit REF comprend ainsi trois transistors Mos de type P M12, M13 et M14, connectés en série entre le noeud N d'entrée haute tension EHV, et la masse GND. Le premier et le troisième transistors M12 et M14 ont chacun leur grille connectée à leur drain. Le deuxième transistor M13 est commandé par un circuit de commande COM. Son drain et sa source fournissent respectivement une première tension de référence VPOLiet une deuxième tension de référence VPOL2. Ce sont les tensions qui sont appliquées dans l'exemple comme tensions de polarisation de grille des transistors cascodes du translateur haute tension. Le circuit de commande COM permet de contrôler la tension de grille, de drain et de source du deuxième transistor M13, selon le niveau d'un signal de contrôle /WR. Le fonctionnement d'un tel dispositif de commande est illustré sur les figures 2 et 3, dans un exemple dans lequel le niveau de repos de l'entrée haute tension EHV est Vcc. Lorsque le signal de contrôle/WR est à un premier niveau logique,"1"dans l'exemple, le transistor M13 est bloqué et son drain et sa source sont respectivement forcés à Vcc et GND par des moyens du circuit de commande COM. On a alors VPOL1 = Vcc et VPOL2 = GND. Lorsque le signal de contrôle/WR est au deuxième niveau logique,"0"dans l'exemple, le drain et la grille du transistor M13 sont connectés ensemble, en sorte qu'il est monté en diode, comme les deux autres transistors du circuit de référence M12 et M14. Ce sont alors ces transistors de référence M12, M13 et M14 du circuit de référence qui établissent les niveaux de tensions sur les noeuds A et B, en fonction du niveau sur l'entrée haute tension EHV. On a alors VPOL1 = VREFn et VPOL2 = REF,. Ainsi, selon le niveau du signal de contrôle logique/WR, on commute des tensions de référence différentes. Dans l'exemple d'application à la polarisation des transistors cascodes d'un translateur haute tension, le premier mode de fonctionnement (/WR à "1") correspond à l'entrée haute tension à son niveau de repos, Vcc, dans l'exemple, et le deuxième mode de fonctionnement (/WR à"0") correspond à l'entrée haute tension montant à sa valeur nominale Vpp. Le circuit de commande COM comprend principalement quatre transistors Mos M15, M16, M17 et M18, comme représenté sur la figure 1. Le transistor Mos de type P M15 est connecté entre la tension d'alimentation logique Vcc et le premier noeud intermédiaire A du circuit de référence REF, connecté à la source du transistor M13. Le transistor Mos de type N M16 est connecté entre le deuxième noeud intermédiaire B du circuit de référence, connecté au drain du transistor M13, et la masse GND. Le transistor Mos de type P M17 est connecté entre la tension d'alimentation logique Vcc et la grille du transistor M13. Le transistor M18 est connecté entre la grille et le drain (noeud B) du deuxième transistor M13. Les transistors M16 et M18 sont commandés sur leur grille par le signal de contrôle logique/WR du circuit de commande et le transistor M15 est commandé par un signal VNP référencé à l'entrée haute tension EHV et issu du signal/WR et de logique inverse. Le transistor M17 est connecté sur sa grille au deuxième noeud intermédiaire B. Le fonctionnement de ce circuit de commande est le suivant : Lorsque le signal/WR est à"l", le transistor M16 est passant et tire le deuxième noeud intermédiaire B à zéro, et par suite la grille du transistor M17. Le transistor M18 lui est bloqué. Aussi, le transistor M17, qui lui est passant, amène la tension Vcc sur la grille du transistor M13, qui est ainsi forcé à l'état bloqué. Le transistor M15 est lui aussi passant, puisque le signal VNP est de logique inverse au signal/WR. Il amène donc la tension Vcc sur le premier noeud intermédiaire A. Comme le transistor M13 est forcé à l'état bloqué par les transistors M16 et M17 du circuit de commande, les noeuds intermédiaires A et B sont confortés dans leurs niveaux respectifs Vcc et GND, quel que soit le niveau de tension sur l'entrée haute tension. Lorsque le signal/WR passe à"0", correspondant à la montée en tension de l'entrée haute tension EHV depuis Vcc jusqu'à sa valeur nominale VPP, les transistors M15 et M16 passent à l'état bloqué, et par suite le transistor M17 passe à l'état bloqué également. Le transistor M18 lui devient passant et connecte activement la grille du transistor M13 au deuxième noeud intermédiaire B, c'est à dire à son drain. Le transistor M13 se retrouve alors connecté en diode comme les autres transistors M12 et M14 du circuit de référence. On retrouve le fonctionnement normal du circuit de référence : les tensions aux noeuds A et B suivent la montée en tension de l'entrée haute tension EHV. Comme le transistor M15 du circuit de commande est connecté entre la tension d'alimentation logique Vcc et le noeud A et que le transistor M12 du circuit de référence est connecté entre l'entrée haute tension EHV et le noeud A, lorsque cette entrée haute tension EHV atteint les valeurs hautes, il faut être certain que le transistor M15 soit bien bloqué, pour ne pas envoyer de la haute tension vers la tension d'alimentation logique Vcc. Pour cette raison, le transistor M15 doit recevoir sur sa grille non pas le niveau haut correspondant à la tension d'alimentation logique Vcc, mais celui issu de l'entrée haute tension EHV. Quand l'entrée haute tension atteint sa valeur nominale Vpp, on retrouve cette valeur Vpp sur la grille du transistor M15. Ceci est obtenu dans l'exemple au moyen d'un circuit inverseur à trois transistors Mos. Un premier transistor Mos de type P, M19, un deuxième transistor Mos de type N, M20 et un troisième transistor Mos de type N M21 sont connectés en série entre le noeud N d'entrée haute tension EHV et la masse GND. Le transistor M21 est commandé sur sa grille par le signal de contrôle/WR. Les transistors M20 et M19 ont leurs grilles reliées ensemble au premier noeud intermédiaire A. Le signal de logique inverse VNP et référencé à EHV par l'inverseur est fourni par le point de connexion série entre les deux transistors M19 et M20. C'est le signal appliqué sur la grille du transistor M15. Le fonctionnement est comme suit : lorsque le signal binaire/WR est à 1, le transistor M21 est passant et tire la source du transistor M20 à la masse. Le noeud A est à Vcc. Comme l'entrée haute tension EHV est à ce moment à son niveau de repos basse-tension (dans l'exemple, à Vcc, confère figures 2 et 3), le transistor M19 est donc bloqué. Le transistor M20 lui est passant. On retrouve donc 0 volt sur la grille du transistor M15 : VNP=O. Les tailles des transistors MOS 19,20 et 21 sont dimensionnées pour que, même si l'entrée haute tension EHV prend une valeur supérieure à Vcc, VNP reste inférieur à Vcc-Vtp, en sorte que le translateur fonctionne même dans les valeurs hautes de l'entrée haute tension (c'est à dire qu'il peut basculer). Lorsque le signal binaire/WR est à"0", et que l'entrée haute tension EHV monte de Vcc à Vpp, le transistor M21 n'est pas passant et met la source du transistor M20 à un potentiel flottant. Le potentiel VNP n'est pas tiré à la masse. Donc le transistor M15 est bloqué. Si l'entrée EHV est à Vpp, Le noeud A est polarisé par le transistor M12 à une tension inférieure à Vpp-Vtp. Le transistor M19 est passant et VNP est tiré à Vpp. La position stable est donnée par VNP = Vpp, M15 bloqué et VREFn inférieur à Vpp-Vfp. Un problème de ce dispositif de commande tient dans cette commande complexe du transistor M15, et qui nécessite trois transistors M19, M20 et M21, pour assurer son blocage sûr ou sa mise en conduction en fonction du signal de contrôle/WR. Un objet de l'invention est de réduire le nombre de transistors du circuit de commande, tout en conservant la fonctionnalité du dispositif de commande, à savoir une source de tensions de référence Dans l'invention, un circuit de commande est proposé par lequel on prévoit notamment que le transistor M12 du circuit de référence n'est plus directement monté en diode, mais commandé par des moyens de commande par lesquels il fonctionne soit en source de courant, soit en diode. Telle que revendiquée l'invention concerne donc un dispositif de commande d'un circuit de génération REF de tensions de référence VPOL1, VPOL2 comprenant un premier transistor Mos de type P M12, connecté entre un noeud N recevant un signal haute tension EHV et un premier noeud intermédiaire A, un deuxième transistor Mos de type P M13 connecté entre le premier noeud intermédiaire A et un deuxième noeud intermédiaire B et un troisième transistor Mos de type P M14 connecté entre le deuxième noeud et la masse, et ayant sa grille connectée à son drain, permet de fournir des tensions de référence VPOLi, VPOL2 sur les noeuds intermédiaires A, B. Ce dispositif comprend des moyens de commande des transistors de référence pour soit, dans un premier mode de fonctionnement, forcer le premier transistor de référence M12 en source de courant, le deuxième transistor de référence M13 à l'état bloqué et courtcircuiter le troisième transistor de référence M14 à la masse, soit, dans un deuxième mode de fonctionnement, connecter chacun desdits transistors en diode, leur grille et leur drain étant reliés, en fonction d'un signal de contrôle logique/WR. D'autres caractéristiques et avantages de l'invention sont détaillés dans la description suivante, faite à titre indicatif et non limitatif de l'invention et en référence aux dessins annexés dans lesquels : - la figure 1 déjà décrite représente un translateur de haute tension à étage cascode et un dispositif de commande à tensions de référence selon un état de la technique ; - la figure 2 montre la forme du signal VOUT obtenue en sortie du translateur de la figure 1 en fonction du signal de commande de commutation IN ; - la figure 3 montre la forme de l'entrée haute tension, du signal de commande du circuit de commande selon le dispositif de commande de la figure 1, ainsi que les courbes correspondantes des tensions de référence obtenues ; - la figure 4 montre un dispositif de commande selon la présente invention ; - la figure 5 montre une variante de ce dispositif ; - la figure 6 montre le schéma équivalent du dispositif de la figure 5 lorsque le signal de contrôle/WR est à"l" ; - la figure 7 montre le schéma équivalent du dispositif de la figure 5 lorsque le signal de contrôle/WR est à"0" ; et - la figure 8 représente schématiquement un circuit intégré comprenant un tel dispositif de commande. La figure 4 représente un dispositif de commande selon l'invention. Ce dispositif de commande permet de fournir en sortie des tensions de référence VPOL1, VPOL2 qui sont fonction d'un signal de commande logique/WR appliqué en entrée dudit dispositif : Soit/WR=0 et (VPOL1, VPOL2) = (Vcc, 0), correspondant à un premier mode de fonctionnement relatif en pratique au cas où l'entrée haute tension EHV est à son niveau de repos Vcc. Soit/WR=O et (VPOL1, VPOL2) = (Vrefn, Vrefp), correspondant à un deuxième mode de fonctionnement. Le deuxième mode de fonctionnement correspond au cas où l'entrée haute tension passe à sa valeur nominale Vpp. Les tensions de référence s'établissent alors par les transistors de référence M12, M13 et M14 montés en diode, et en fonction du niveau de l'entrée haute tension EHV. Les éléments communs à l'état de la technique représenté sur la figure 1 portent les mêmes références sur la figure 4, pour la clarté de l'exposé. Ainsi, le circuit de référence REF comprend t-il trois transistors Mos de type P M12, M13 et M14, connectés en série entre le noeud N, recevant l'entrée haute tension EHV, et la masse GND. La source et le drain du deuxième transistor M13 fournissent respectivement la première tension de référence VPOL1, sur le premier noeud intermédiaire A du circuit de référence REF, et la deuxième tension de référence VPOL2, sur le deuxième noeud intermédiaire B. Ces tensions de référence peuvent par exemple être appliquées comme tensions de polarisation de grille des transistors cascodes d'un translateur haute tension. Dans le circuit de référence selon l'invention, seul le troisième transistor M14 a sa grille connectée à son drain. Les premier et deuxième transistors M12 et M13 sont eux commandés par un circuit de commande COM selon l'invention. Ce circuit de commande comprend des moyens de commande du premier transistor M12 du circuit de référence pour soit le faire fonctionner en source de courant, soit le faire fonctionner en diode. Ces moyens de commande comprennent un premier transistor MOS de type P, M22, connecté entre la grille et le drain du transistor MOS de type P M12, et un deuxième transistor MOS de type N, M23, connecté entre la grille du transistor MOS de type P M12 et la masse GND. Les transistors M22 et M23 ont leurs grilles connectées en commun et commandées par le signal de contrôle/WR. Ainsi, quand ce signal/WR vaut"1", correspondant au premier mode de fonctionnement du dispositif de commande, l'entrée EHV étant à son niveau de repos Vcc, le transistor M22 est bloqué, tandis que le transistor M23 est passant et amène la grille du premier transistor de référence M12 à GND. Ce transistor a alors une conduction franche qui fait monter son drain au niveau EHV de sa source. Comme l'entrée EHV est à son niveau de repos Vcc, on a VPOL1= Vcc. Quand ce signal/WR vaut"0", correspondant au deuxième mode de fonctionnement du dispositif de commande, l'entrée EHV montant à son niveau nominal Vpp, le transistor M23 est bloqué, tandis que le transistor M22 est passant et court-circuite la grille et le drain du premier transistor de référence M12 : il est équivalent à une diode. Les moyens de commande du deuxième transistor de référence M13 comprennent les transistors MOS de type P M17 et M18, connectés en série entre la tension d'alimentation logique Vcc et le drain du deuxième transistor MOS de référence M13. Le transistor M18 est commandé par le signal logique/WR, mais la grille du transistor M17 n'est plus commandée par la source du troisième transistor de référence. Dans le circuit de commande selon l'invention, le transistor M17 a sa grille commandée comme la grille du premier transistor de référence M12. En d'autres termes, leurs grilles sont connectées ensemble. Soit le signal/WR est à"1", et le transistor M17 est franchement passant, par le transistor M23 qui force sa grille à 0. Le transistor M17 amène alors la grille du deuxième transistor de référence M13 à Vcc : le transistor M13 est bloqué. Le transistor M18 est bloqué. Soit le signal/WR est à 0, et le transistor M17 est franchement bloqué. Le transistor M18 est passant et court-circuite la grille et le drain du deuxième transistor de référence M13 à Vcc : le transistor M13 est monté en diode. Enfin, on retrouve le transistor MOS de type N M16, connecté en parallèle sur le troisième transistor de référence M14 et commandé sur sa grille par le signal de commande logique/WR, pour soit tirer le noeud B à la masse GND, ce qui revient à court-circuiter le transistor de référence M14 (/WR à"1"), soit laisser activement ce transistor de référence M14 monté en diode dans le circuit de référence REF. Par le circuit de commande selon l'invention, quand le signal/WR est à"0", on retrouve le fonctionnement normal du circuit de référence, avec ses trois transistors de référence M12, M13 et M14 activement connectés en diode, en série entre l'entrée haute tension et la masse, permettant l'établissement de tensions de référence en fonction du niveau de cette entrée haute tension. Les figures 6 et 7 permettent d'illustrer le fonctionnement du dispositif de commande selon l'invention. Le schéma équivalent du dispositif de commande quand/WR est à"1"est représenté sur la figure 6. L'entrée EHV est à son niveau de repos Vcc. Le deuxième transistor de référence M13 est bloqué tandis que le premier transistor de référence M12 tire le noeud A à EHV=VCC et que le troisième transistor M14 tire le noeud B à GND. Le schéma équivalent du dispositif de commande quand/WR est à"0"est représenté sur la figure 7. L'entrée haute tension monte ou est établie à son niveau nominal Vpp. Les trois transistors de référence M12, M13 et M14 sont montés en diode entre l'entrée haute tension EHV et la masse, amenant le noeud A et le noeud B à des niveaux de référence VREFn et VREFP fonction du niveau de l'entrée haute tension. Sur la figure 5, une variante d'un dispositif de commande est représentée, dans laquelle la grille du transistor M17 est directement commandée par le signal de contrôle/WR, par le biais d'un inverseur Il (pour moi, toujours le même PB pour cette commande de grille). Avec un dispositif de commande selon l'invention, le nombre de transistors est diminué, lié à la simplification du circuit de commande. Le dispositif de commande selon l'invention est particulièrement adapté pour fournir les tensions de polarisation des transistors cascodes d'au moins un translateur haute tension. Il s'applique tout naturellement, mais pas exclusivement au domaine des mémoires non volatiles, pour leur programmation. Un tel exemple d'application est schématiquement représenté sur la figure 8. Le circuit intégré CI représenté comprend ainsi des cellules de mémoire non volatile électriquement programmable MEM, et au moins un translateur haute tension 10 pour appliquer en sortie VOUT une tension de programmation Vpp sur ces cellules. Ce translateur reçoit les tensions de polarisation VPOL1 et VIOL2 de ses transistors cascodes d'un dispositif de commande 30 selon l'invention à source de références de tension, en fonction du signal de contrôle/WR. Le niveau de ces tensions de polarisation fournies par ce dispositif de commande est fonction de ce signal de contrôle/WR. En pratique, ce signal de contrôle est lui-même fonction du niveau de l'entrée haute tension EHV, et dans l'exemple, fourni par un circuit 50 de comparaison à un seuil déterminé du niveau de cette entrée. On notera qu'un même dispositif de commande peut fournir les tensions de polarisation de plusieurs translateurs haute tension. REVENDICATIONS 1. Dispositif de commande d'un circuit de génération (REF) de tensions de référence (VPOL1, VPOL2) comprenant un premier transistor Mos de type P (M12), connecté entre un noeud (N) recevant un signal haute tension (EHV) et un premier noeud intermédiaire (A), un deuxième transistor Mos de type P (M13) connecté entre le premier noeud intermédiaire (A) et un deuxième noeud intermédiaire (B) et un troisième transistor Mos de type P (M14) connecté entre le deuxième noeud et la masse, et ayant sa grille connectée à son drain, une tension de référence (VPOL1, VPOL2) étant obtenue sur l'un ou l'autre desdits noeuds intermédiaires (A, B), caractérisé en ce qu'il comprend des moyens de commande desdits transistors de référence pour soit, dans un premier mode de fonctionnement, forcer le premier transistor de référence (M12) en source de courant, le deuxième transistor de référence (M13) à l'état bloqué et court-circuiter le troisième transistor de référence (M14) à la masse, soit, dans un deuxième mode de fonctionnement, connecter chacun desdits transistors en diode, leur grille et leur drain étant reliés, en fonction d'un signal de contrôle logique (/WR). 2. Dispositif selon la revendication 1, caractérisé en ce que le noeud d'entrée haute tension a une valeur de repos correspondant à la tension d'alimentation logique Vcc, ce noeud haute tension s'établissant à une valeur nominale supérieur Vpp, selon une rampe, et en ce que le premier mode de fonctionnement (/WR à"1") correspond au niveau de repos de ladite entrée haute tension et le deuxième mode de fonctionnement (/WR à "0") correspond à l'établissement à la valeur nominale. 3. Dispositif selon la revendication 1 ou 2, caractérisé en ce que lesdits moyens de commande comprennent un premier transistor Mos de type P (M22) connecté entre la grille et le drain dudit premier transistor de référence (M12) et un deuxième transistor MOS de type N (M23) connecté entre la grille dudit premier transistor de référence et la masse (GND), lesdits transistors des moyens de commande étant commandés sur leur grille par le signal de contrôle logique (/WR). 4. Dispositif de commande selon l'une des revendications précédentes, caractérisé en ce que lesdits moyens de commande comprennent un premier et un deuxième transistor MOS de type P (M17, M18) connectés en série entre la tension d'alimentation logique (Vcc) et le drain dudit deuxième transistor de référence (M13), le premier transistor (M17) desdits moyens de commande ayant sa grille connectée en commun à la grille dudit premier transistor de référence (M12), et le deuxième transistor (M18) desdits moyens de commande ayant sa grille contrôlée par ledit signal de contrôle logique (/WR). 5. Dispositif de commande selon l'une quelconque des revendications précédentes, caractérisé en ce que lesdits moyens de commande comprennent un transistor MOS de type N (M16), connecté en parallèle entre la source et le drain dudit troisième transistor de référence (M14), et dont la grille est contrôlée par ledit signal de contrôle logique (/WR). 6. Circuit intégré comprenant un translateur haute tension à transistors cascodes, caractérisé en ce qu'il comprend un dispositif de commande selon l'une quelconque des revendications 1 à 5 précédentes pour appliquer les tensions de référence comme tensions de polarisation desdits transistors cascode. 7. Circuit intégré comprenant des éléments mémoire non volatile électriquement programmables, caractérisé en ce qu'il comprend au moins un dispositif de commande selon l'une quelconque des revendications 1 à 5 précédentes, appliqué à au moins un translateur de niveau haute tension selon la revendication 6. 8. Circuit intégré selon la revendication 7, caractérisé en ce qu'il comprend un dispositif de commande pour un ou plusieurs translateurs. 9. Circuit intégré selon la revendication 7 ou 8, caractérisé en ce qu'il comprend un détecteur de tension (50) pour fournir le signal de contrôle (/WR) du circuit de commande par comparaison du niveau de l'entrée haute tension (EHV) à un seuil déterminé.