FR 2743658 A1 19970718 FR 9600259 A 19960111 PROCEDE D'ADRESSAGE D'UN ECRAN PLAT UTILISANT UNE PRECHARGE DES PIXELS, CIRCUIT DE COMMANDE PERMETTANT LA MISE EN OEUVRE DU PROCEDE ET SON APPLICATION AUX ECRANS DE GRANDES DIMENSIONS La présente invention concerne un procédé d'adressage d'un écran plat, plus particulièrement un écran à cristaux liquides utilisant une précharge des pixels. La présente invention concerne aussi un circuit de commande des colonnes d'un tel écran permettant la mise en oeuvre du procédé ainsi que l'application du procédé aux écrans de grandes dimensions. Les écrans à cristaux liquides à vision directe ou à projection sont en général composés de lignes (lignes de sélection) et de colonnes (lignes de données) aux intersections desquelles sont situées les électrodes de pixels connectées au travers de transistors à ces lignes. Les grilles de ces transistors forment les lignes de sélection et sont commandées par les circuits de commandes périphériques, généralement appelés "drivers" (en langue anglaise) qui balayent les lignes et rendent passant les transistors de chaque ligne en permettant, par les lignes de données connectées aux autres circuits de commandes périphériques, de charger les électrodes des pixels et modifier les propriétés optiques du cristal liquide compris entre ces électrodes et la contre-électrode (ou électrode de référence) permettant ainsi la formation d'images sur l'écran. La figure 1 représente le schéma électrique équivalent d'un pixel d'écran plat adressé par des circuits de commande lignes et colonnes. L'électrode et la contre-électrode encadrant le cristal liquide forment une capacité 1 dont la charge (constituée le plus souvent par des données vidéo) est transmise par la colonne 2 au travers du transistor 3 commandé par la ligne de sélection 4. La figure 2 quant à elle représente les chronogrammes de fonctionnement de ce pixel, Vs étant le signal adressé par la ligne de sélection d'une rangée de pixels, Vc le signal vidéo échantillonné sur la rangée de pixels sélectionnée et Vp la charge effective d'un de ces pixels. Théoriquement, à la fin d'une impulsion d'échantillonnage, la tension pixel Vp aux bornes du cristal liquide, devrait être égale à la tension colonne Vc, c'est à dire +/- V. Le problème de ce type d'adressage est qu'en pratique, la tension Vp est différente de la tension de charge Vc de la colonne. En effet, chaque transistor 3, lorsqu'il est dans l'état passant, a une résistance Ron qui n'est pas nulle, de sorte que la charge du pixel présente une caractéristique exponentielle (comme cela est représenté sur la figure 2) de constante de temps qui n'est pas nulle puisque égale au produit Ron x C, C étant la valeur de la capacité 1 du pixel. Lorsque le temps de charge est écoulé, L'erreur résiduelle de convergence est égale à Ven+ en trame positive (valeur négative) ou Ven- en trame négative (valeur positive), différentes des valeurs +/-V de la tension de charge Vc. II en résulte une erreur sur la tension RMS qui oriente le cristal liquide de l'ordre de (Ven±Ven-)/2. Or, les spécifications électrooptiques de l'écran imposent une valeur maximale pour cette erreur de l'ordre de 5 à 10 mV pour un effet nématique en hélice à 900. Le produit RC (résistance par capacité) doit donc être typiquement 7 à 8 fois plus faible que le temps d'adressage pour atteindre un taux de convergence compatible avec une application de qualité. II en résulte des limites sur le nombre de lignes adressables ainsi que sur la taille des pixels. Dans ce cas, il faut diminuer R, c'est à dire élargir le transistor. Cela n'est pas réaliste au delà d'un rapport entre largeur et longueur du canal qui excède quelques unités.D'autre part, lorsque l'impulsion Vs appliquée sur la ligne de sélection revient à l'état bas (voir figure 2), le couplage parasite entre la ligne et le pixel devient excessif dans le cas où la largeur du transistor excède une certaine valeur. Une autre solution connue est représentée à la figure 3. Dans ce cas, un écran 5 constitué de pixels 6 est adressé par un circuit de commande ligne 7 et un circuit de commande colonne 8 formé par des échantillonneurs commandés par un registre à décalage. La charge d'un échantillonneur n'est autre que la capacité répartie de la colonne commandée 9. Cette colonne doit être chargée pendant un temps très court, avec les problèmes de convergence cités plus haut aggravés par le fait que le temps de charge n'est plus qu'une fraction du temps où l'on adresse une ligne 9. En effet, pendant ce temps ligne, il faut successivement échantillonner la vidéo sur toutes les colonnes de l'écran. Pour cette raison, la réalisation d'écrans à drivers intégrés a nécessité jusqu'à ce jour l'utilisation de semi-conducteur à haute mobilité, comme le silicium mono ou polycristallin. Pour remédier aux inconvénients ci-dessus et permettre l'utilisation de transistors en couche mince réalisés en silicium, il est proposé notamment dans la demande PCT/FR94/16428, de réaliser une précharge des pixels à une tension inférieure à la tension utile. L'utilisation d'une telle tension présente un certain nombre d'inconvénients. Elle ne résout pas, en particulier, le problème de la convergence La présente invention propose un nouveau procédé d'adressage permettant de remédier aux inconvénients mentionnés cidessus. En conséquence, la présente invention a pour objet un procédé d'adressage d'un écran plat composé de lignes et de colonnes aux intersections desquelles sont situés des pixels, caractérisé en ce que, au début de chaque échantillonnage du signal vidéo à afficher sur l'écran, une tension (Vr) supérieure à la gamme de tension utile (V) est appliquée sur le pixel sélectionné pendant un temps tr, puis la tension utile est échantillonnée pendant un temps ts. De préférence, la tension de précharge (Vr) est choisie telle que Ven + = Ven- où Ven + et Ven- représentent l'erreur résiduelle respectivement en trame positive et en trame négative. Dans ce cas, la tension de précharge est obtenue par les formules suivantes Ven+=(Vr-V+)exp- 7 #(Vg -Vt -V+) et Ven - = (Vr -V-)exp-#(Vg-Vt -V-) où Vg est la tension sur la grille du transistor pendant l'échantillonnage, et Vt sa tension de seuil. La condition Ven + = Ven- s'écrit (Vr -Vt ) = (Vr - V-) exp - ts ( i z r(Vg-Vt-V+9 ou r(Vg-Vt -V-)=Ron(Vg-Vt -V-)xC et donc donc #(V) est de la forme d'où: ts (Vr -V+)=(Vr -V-) #(V±V-) soit:: La présente invention a aussi pour objet un circuit de commande des colonnes d'un écran plat du type comprenant des échantillonneurs commandés par les sorties d'un registre à décalage, caractérisé en ce que chaque échantillonneur est constitué par trois transistors de type MIS montés en parallèle de telle sorte que leur première électrode soit connectée au signal vidéo et leur seconde électrode à la colonne commandée, laquelle grille du premier transistor étant connectée à une des sorties du registre à décalage et les grilles du second et troisième transistors étant connectées à deux horloges choisies de telle sorte que les deux transistors sont activés, I'un pour réaliser la précharge des lignes paires, L'autre des lignes impaires. Selon une autre caractéristique de l'invention, la tension des horloges appliquée sur le deuxième et troisième transistors est choisie de telle sorte que lorsqu'un transistor n'est pas utilisé pour la précharge, il reçoit sur sa grille une tension négative permettant ultérieurement de compenser les couplages capacitifs lorque cette tension reviendra à zéro. De préférence, les trois transistors sont identiques et sont des transistors réalisés en couche mince ou TFT. Cette solution permet de compenser des couplages capacitifs importants car les transistors utilisés pour réaliser des échantillonneurs sont gros. Elle permet de plus de répartir également le "stress" ou fatigue sur les trois transistors qui sont de même taille ce qui augmente la durée de vie des transistors. La présente invention concerne aussi l'application du procédé d'adressage ci-dessus aux écrans de grande taille. La présente invention a donc pour objet un procédé d'adressage d'un écran plat comportant des lignes et des colonnes aux intersections desquelles sont situés des pixels, dans lequel X circuits de commande de lignes sont connectés chacun à Y lignes, caractérisé en ce que, pendant un temps tr, on réalise la précharge des pixels se trouvant sur les lignes reliées au premier circuit de commande lignes, à une tension (Vr) supérieure à la gamme de tension utile (V), puis on échantillonne successivement les Y lignes et on recommence l'opération ci-dessus pour les X-1 circuits de commande restants. La présente invention a encore pour objet un procédé d'adressage d'un écran plat comportant des lignes et des colonnes aux intersections desquelles sont situés des pixels dans lequel X circuits de commande lignes sont connectés chacun à Y lignes, caractérisé en ce qu'on précharge simultanément la première ligne des X circuits de commande lignes à une tension Vr supérieure à la gamme de tension utile (V) et l'on échantillonne ensuite successivement ladite ligne des X circuits de commande lignes et on recommence l'opération ci-dessus pour les Y-l autres lignes de chacun des X circuits de commande ligne. La présente invention sera mieux comprise et des avantages supplémentaires apparaîtront à la lecture de la description qui va suivre illustrée par les figures suivantes: la figure 1, déjà décrite, représente le schéma électrique équivalent d'un pixel d'un écran à cristaux liquides, la figure 2, déjà décrite, représente les chronogrammes du fonctionnement du pixel de la figure 1, la figure 3, déjà décrite, représente une structure connue d'un écran commandé par des circuits de commande lignes et colonnes, la figure 4 illustre un procédé d'adressage d'un écran à cristaux liquides selon la présente invention, la figure 5 représente un mode de réalisation d'un circuit de commande colonne connu mettant en oeuvre le procédé d'adressage selon la présente invention, la figure 6 représente le chronogramme d'un circuit de commande colonne selon la figure 5, la figure 7 représente un mode de réalisation préférentiel d'un circuit de commande colonne mettant en oeuvre le procédé selon la présente invention, la figure 8 représente le chronogramme de fonctionnement du circuit de commande colonne de la figure 7, et la figure 9 représente schématiquement une partie d'un écran plat de grandes dimensions connecté à des circuits de commande lignes et colonnes utilisant le procédé de la présente invention. Comme cela est représenté sur la figure 4, pendant un temps de remise à zéro tr (ou temps de "remet"), on échantillonne sur la charge une tension Vr supérieure à la tension utile et on échantillonne pendant un temps ts la tension utile (comprise entre +V et -V). Puisque l'on cherche à atteindre la tension utile (entre +V et -V) à partir d'une valeur de tension supérieure, L'erreur résiduelle de convergence est toujours de même signe et égale à (Ven±Ven-)/2, ce qui minimise l'erreur sur la tension RMS. Dans le cas où les transistors de pixels sont réalisés en silicium amorphe (a-Si) et ont une tension de seuil de quelques volts, il existe une tension de précharge Vr telle que les erreurs de convergence Ven+ et Ven- pour atteindre les deux extrêmes de la gamme de tension utile (+V,-V) sont égales (Ven + = -Ven-). L'erreur sur la tension RMS est alors nulle. Cette tension Vr peut être obtenue en utilisant la formule ci après Ven+=(Vr-V+)exp- (Vg ts et Ven -=(Vr -V-)exp- r(Vg -Vt -V-) où Vg est la tension sur la grille du transistor pendant l'échantillonnage, et Vt sa tension de seuil. La condition Ven + = Ven- s'écrit 1 i - -V+9 v(Vg -Vt - V-) exp - ts( T(Vg-Vt-V-) r(Vg -Vt ou t(Vg -Vt -V-) = Ron(Vg -Vt -V-)xC et Cte donc r(V) est de la forme V d'où: (s (Vr-V+)=V-)exp-#(V + Y-) soit: La figure 5 représente un exemple de réalisation d'un circuit de commande colonnes d'un écran permettant la mise en oeuvre du procédé selon l'invention. Ce circuit de commande est formé de transistors réalisés en silicium amorphe. Ce circuit de commande 11 est, de préférence, constitué de plusieurs entrées vidéo fonctionnant en parallèle pour réduire d'autant la fréquence de démultiplexage.Dans l'exemple volontairement simplifié de la figure 5, le circuit de commande colonnes comporte cinq entrées vidéo DB1 à DB5 et six entrées de signaux de démultiplexage DW1 à DW6, ce qui permet de charger trente colonnes 12. Chaque colonne 12 est commandée par un seul transistor 13 qui sert successivement à la précharge pour atteindre la tension Vr pendant le temps tr, et à la convergence vers la valeur de tension vidéo qui convient. La figure 6 représente le chronogramme de fonctionnement de l'écran de la figure 5 lors de son utilisation selon le procédé de l'invention. Pendant le temps tr, une tension Vr supérieure à la tension utile est appliquée sur toutes les colonnes via les signaux DW1 à DW6. Ensuite, les entrées DW1 à DW6 sont sélectionnées successivement, comme représenté par DW1 à DW6, pour chaque signal DB1 à DB5, la tension utile est échantillonnée durant ts. La figure 7 représente une réalisation préférentielle d'un circuit de commande de colonnes mettant en oeuvre le présente invention. Dans ce cas, chaque échantillonneur est constitué par trois transistors 16, 17 et 18 qui sont de préférence identiques et montés en parallèle. Comme représenté clairement sur la figure 7, les premières électrodes ou drains des trois transistors 16, 17 et 18 reçoivent le signal vidéo d'entrée 14 tandis que leur seconde électrode ou source charge la colonne 15 à commander. D'autre part, la grille du transistor 16 est connectée en sortie d'un registre à décalage et reçoit un signal de démultiplexage 19 tandis que les grilles 20 et 21 des deux autres transistors 17 et 18 sont connectées à deux horloges qui sont décrites plus en détail ci-apres. L'utilisation des trois transistors permet de compenser les couplages capacitifs qui sont importants avec un seul gros transistor et de répartir le stress sur les transistors, ce qui allonge la durée de vie. La figure 8 représente le chronogramme d'un circuit de commande lignes du type de celui de la figure 7. Les valeurs numériques ne sont données qu'à titre d'exemple. En fait, les signaux d'horloges appliqués sur les transistors 17 et 18 sont tels que l'un des transistors réalise la précharge des lignes impaires tandis que l'autre réalise la précharge des lignes paires. De plus, lorsque l'un des transistors, par exemple le transistor 17, reçoit sur la grille 20 une impulsion de précharge pendant un temps tr, L'autre transistor 18 reçoit sur sa grille 21 une impulsion négative de par exemple -22V jusqu'à la fin du temps lignes, de façon à pouvoir en fin de temps ligne venir compenser le couplage du transistor de convergence grâce à une impulsion positive sur l'électrode de commande 21.La grille du transistor 16 recevra une impulsion de durée Ts de manière à réaliser la convergence. La précharge prend approximativement deux fois plus de temps (2sec) que la convergence (0,9sec), de sorte que le rapport cyclique de fonctionnement des trois transistors est équivalent, ce qui répartit équitablement le stress. Dans le cas d'un écran à très grand nombre de lignes ou à très grand nombre de pixels élémentaires, le transistor est sous-dimensionné pour éviter d'avoir des capacités de couplage trop importantes. Le schéma de base peut être du type de celui de la figure 1. Pour améliorer le fonctionnement d'un tel écran dans lequel, soit le transistor est trop petit pour charger correctement le pixel de façon classique, soit le nombre de lignes est tellement élevé que l'on ne dispose que de très peu de temps pour la charge, on peut aussi utiliser un schéma de fonctionnement avec une précharge du type de la figure 4. Dans ce cas, on travaille de préférence par paquets de lignes. Ainsi, comme représenté sur la figure 9, qui concerne un écran dont le circuit de commande colonnes est identique au circuit de la figure 5 et où les lignes sont groupées par cinq, chaque groupe étant commandé par un registre lignes R1, R2, R3 ... pour des paquets de cinq lignes, on fait tout d'abord une précharge simultanée sur les lignes L1 à L5, puis on échantillonne séquentiellement ces mêmes lignes L1 à L5. Ensuite, on fait une précharge simultanée des lignes L6 à L10, etc. Ce mode de fonctionnement n'est pas compatible avec les circuits de commande habituels (commande de cinq lignes à la fois). II nécessite donc une électronique particulière. On peut aussi si l'écran utilise par exemple cinq circuits de commande lignes, tels que R1, R2, R3 ..., pour six cents lignes, charger simultanément ces cinq circuits de commande, et on utilise la fonction souvent présente de "output entable" pour gérer successivement la précharge simultanée pour cinq lignes, telles que les cinq premières lignes L1, L6, 111 dans le mode de réalisation de la figure 9, commandées par ces cinq circuits R1, R2 ..., puis l'adressage successif de ces cinq lignes. Toutefois, cette solution nécessite une mémoire de trame pour pouvoir stocker et donc reconstituer l'image vidéo. Dans tous les cas, la précharge est réalisée en utilisant une tension Vr supérieure à la tension utile V+/V-. La présente invention s'applique en particulier aux écrans plats à cristaux liquides commandés par une matrice active de transistors (AMLCD) en couches minces, et en général à toute application nécessitant un échantillonneur dont la précision relative est plus importante que la précision absolue. REVENDICATIONS 1. Procédé d'adressage d'un écran plat composé de lignes et de colonnes aux intersections desquelles sont situés des pixels, caractérisé en ce qu'au début de chaque échantillonnage du signal vidéo à afficher sur l'écran une tension (Vr) supérieure à la gamme de tension utile (V) est appliquée sur le pixel sélectionné pendant un temps tr, puis la tension utile est échantillonnée pendant un temps ts. 2. Procédé selon la revendication 1, caractérisé en ce que la tension de précharge (Vr) est choisie telle que Ven + = Ven- où Ven + et Ven- représentent l'erreur résiduelle respectivement en trame positive et en trame négative. 3. Procédé selon la revendication 3, caractérisé en ce que la tension de précharge est obtenue par la formule suivante Ven+=(Vr -V+)exp- (s r(Vg-Vt -V+) (s et Ven - = (Vr -V-)exp- r(Vg -Vt -V-) où Vg est la tension sur la grille du transistor pendant l'échantillonnage, et Vt sa tension de seuil. La condition Ven + = Ven- s'écrit 1 i (Vr -Vt ) =(K - V-) exp - ts( r(Vg -Vt -V-) r(Vg -Vt -V+)) ou r(Vg -Vt V-) Ron(Vg - Vt - V-)xC et donc donc r(V) est de la forme V d'où: (s (Vr-V+)=(Vr-V-)exp r(V±V-) soit: 4.Circuit de commande des colonnes d'un écran plat du type comprenant des échantillonneurs commandés par les sorties d'un registre à décalage permettant la mise en oeuvre du procédé selon l'une quelconque des revendications 1 à 3, caractérisé en ce que chaque échantillonneur est constitué par trois transistors (16, 17, 18) de type MIS montés en parallèle de telle sorte que leur première électrode soit connectée au signal vidéo (14) et leur seconde électrode à la colonne commandée (15), laquelle grille (19) du premier transistor étant connectée à une des sorties du registre à décalage et les grilles (20, 21) du second et troisième transistors étant connectées à deux horloges choisies de telle sorte que les deux transistors sont activés, I'un pour réaliser la précharge des trames paires, L'autre des trames impaires. 5. Circuit selon la revendication 4, caractérisé en ce que la tension des horloges appliquée sur le deuxième et troisième transistors est choisie de telle sorte que lorsqu'un transistor n'est pas utilisé pour la précharge, il reçoit sur sa grille une tension négative permettant de compenser les couplages capacitifs, à la remontée ultérieure de sa tension de grille. 6. Circuit selon l'une quelconque des revendications 4 et 5, caractérisé en ce que les trois transistors sont identiques. 7. Circuit selon l'une quelconque des revendications 4 à 6, caractérisé en ce que les trois transistors sont réalisés en couche mince. 8. Procédé d'adressage d'un écran plat comportant des lignes et des colonnes aux intersections desquelles sont situés des pixels, dans lequel X circuits de commande de lignes sont connectés chacun à Y lignes, caractérisé en ce que, pendant un temps tr, on réalise la précharge des pixels se trouvant sur les lignes reliées au premier circuit de commande lignes, à une tension (Vr) supérieure à la gamme de tension utile (V), puis on échantillonne successivement les Y lignes et on recommence l'opération ci-dessus pour les X-1 circuits de commande restants. 9. Procédé d'adressage d'un écran plat comportant des lignes et des colonnes aux intersections desquelles sont situés des pixels dans lequel X circuits de commande lignes sont connectés chacun à Y lignes, caractérisé en ce qu'on précharge la première ligne de chacun des X circuits de commande lignes à une tension Vr supérieure à la gamme de tension utile (V) et l'on échantillonne successivement ladite ligne des X circuits de commande lignes et on recommence l'opération ciaessus pour les Y-l autres lignes.