FR 2738426 A1 19970307 FR 9510174 A 19950829 La présente invention est relative à un dispositif de traitement numérique d'une information se présentant sous une forme analogique et devant être restituée sous une forme analogique après avoir subi ce traitement numérique. Plus précisément, l'invention concerne un convertisseur destiné à réaliser une conversion de signaux variables, soit dans le sens analogique/numérique, soit dans le sens numérique/analogique, ces signaux devant être utilisés dans des applications dans lesquelles leur conversion ne nécessite pas une précision absolue uniforme sur toute leur plage de variation. Une application dans laquelle des conversions de ce type peuvent être admises est celle de l'aide auditive dont on équipe les malentendants. Ces appareils nécessitent notamment une adaptation du spectre sonore environnant à la physiologie de l'oreille du porteur d'où la présence dans ces appareils de moyens de traitement des signaux reçus avant qu'ils puissent être transmis sur l'oreille par l'intermédiaire d'un transducteur sonore de restitution des sons. Le traitement étant relativement complexe et de façon avantageuse souvent particularisé pour chaque patient, il est souhaitable qu'il soit fait sur des signaux numériques, plutôt qu'analogiques. C'est en effet dans ces conditions qu'il peut être exécuté par des logiciels spécialement adaptés et facilement configurables de cas en cas. Une telle aide auditive doit ainsi pouvoir convertir les signaux utiles dans les deux sens, savoir analogique/numérique et le sens inverse. Or, de nombreuses expériences ont montré que la qualité de la perception auditive peut s'accomoder d'un niveau de bruit allant jusqu'à 25 dB par rapport au signal utile. Par conséquent, il s'avère qu'une précision de conversion relative par rapport au signal utile est suffisante dans cette application particulière. En d'autres termes, on aurait besoin d'une précision au niveau numérique bien inférieure à ce qui est communément admis pour la conversion de signaux sonores analogiques (habituellement 14 bits absolus) dans les installations sonores communément utilisées. Une telle précision relative peut être obtenue en utilisant un convertisseur dit "à trois plages de décision Un convertisseur de ce type dans le sens analogique/numérique est décrit dans un article de Bernard Ginetti et al., paru dans la revue "IEEE Journal of Solid State Circuits", Vol 27, NO 7, Juillet 1992. Dans cet article, on décrit d'abord l'algorithme mis en oeuvre dans un tel convertisseur. Cet algorithme est rappelé ici en se référant à la figure 1 des dessins annexés dans laquelle les notations suivantes sont utilisées: - i = numéro d'itération de l'algorithme; - bi = valeur binaire obtenue à chaque itération; - Vin = tension à convertir; - V: - V = tension intermédiaire de l'algorithme; Z(i - Vr = tension de référence; - Vth = tension de seuil; - n = nombre total d'itération pour une prise d'échantillon. Dans son principe, cet algorithme de conversion cyclique revient au processus suivant. Chaque échantillon VX de la tension d'entrée Vin à convertir est multiplié par deux et le résultat de cette multiplication est comparé à une tension de référence. Si le signal est plus grand que cette tension de référence, le bit de plus grand poids du signal de sortie est porté à "1" et la tension de référence est soustraite de Vu(,,. Sinon, le bit de plus grand poids est porté à "0" et aucune opération arithmétique n'est exécutée. Le reste de la tension, VR2" qui correspond en fait au reste partiel de la division, subit les mêmes opérations au cours de l'itération suivante et la boucle de l'algorithme se répète ainsi jusqu'à obtention du bit de poids le plus faible. En fait, pour obtenir de meilleures performances de la conversion, notamment en matière de fréquence d'horloge et de simplification des composants nécessaires, on ajoute à ce processus, l'établissement d'une troisième valeur de b, en utilisant à chaque itération deux niveaux de comparaison, +Vth et -Vth. Ainsi, si le signal Vx est plus grand que +Vth, le bit de sortie est porté à "1" et la tension de référence est soustraite. Si le signal Vx est plus petit que -Vth, le bit est porté à -1 et la tension Vth est additionnée. Dans les autres cas, le bit est porté à "0" et aucune opération arithmétique n'est effectuée. Dans l'article précité, on se préoccupe avant tout de proposer un circuit de mise en oeuvre de cet algorithme dans le but de réduire la précision minimale requise par la comparaison entre +V et la tension 0 et l'erreur de décalage de boucle. Cette tentative des auteurs de l'article conduit à un circuit dont les performances sont excellentes mais qui dans certaines applications, et notamment celle des appareils auditifs dépassent les exigences requises en matière de précision de la conversion. Sous forme intégrée, un tel circuit est donc trop encombrant et un trop grand consommateur d'énergie pour le but que l'on doit se fixer. L'invention est basée sur la considération que dans certaines applications et notamment dans celle des appareils auditifs, mais aussi certains autres domaines tels que l'"audiométrie" (la technique de mesure de l'audience d'une chaîne de radio ou de télévision) ou encore la téléphonie, on peut admettre, comme déjà indiqué ci-dessus, un rapport signal/bruit relativement important, ce qui permet dans la mise en oeuvre de l'algorithme de la figure 1, d'utiliser un circuit plus simple nécessitant moins de surface d'intégration, présentant une consommation plus faible et étant néanmoins compatible avec les qualités de conversion auxquelles on doit s'attendre dans l'application spécifique envisagée, telle que par exemple l'aide auditive. L'invention a pour but de fournir un convertisseur de signaux qui soit simple, peu encombrant et d'une consommation des plus réduites. L'invention a donc pour objet un convertisseur d'un signal d'entrée en un signal de sortie représentatif dudit signal d'entrée avec une précision relative, ce convertisseur mettant en oeuvre un algorithme de conversion à trois plages de décision impliquant des valeurs numériques ternaires bi, avec bi = 1, 0, ou -1, et comprenant une source de tension de référence, des moyens de calcul pour, au cours de chacune des itérations d'une suite d'itérations successives dudit algorithme, établir une valeur de tension formée de la somme d'une valeur établie sur la base de la tension calculée à l'itération précédente et d'une valeur qui est le produit de la valeur ternaire obtenue au cours de l'itération précédente et de ladite tension de référence, lesdits moyens de calcul comprenant à cet effet une pluralité de capacités commutées coopérant avec des moyens d'amplification délivrant ladite valeur de tension à chacune desdites itérations, ledit convertisseur comprenant également des moyens générateurs pour engendrer à partir des valeurs de tension successives calculées pendant ladite suite d'itérations des échantillons successifs représentant sous forme convertie ledit signal d'entrée, caractérisé en ce que lesdits moyens de calcul sont formés par un montage unilatéral de capacités commutées en combinaison avec un unique amplificateur opérationnel formant lesdits moyens d'amplification, l'une des entrées dudit amplificateur opérationnel étant connectée à un potentiel fixe, et en ce que ladite source de référence est agencée pour fournir une tension de référence unipolaire référencée sur ledit potentiel fixe. Selon un premier mode de réalisation de l'invention, dans lequel lesdits signaux d'entrée sont analogiques et lesdits signaux de sortie sont numériques, lesdits moyens de calcul effectuent au cours de chacune desdites itérations, l'algorithme de la forme VX,=2Vx +biVr dans laquelle VX est la tension obtenue au cours de l'itération i précédente, Vt est la tension à obtenir au cours de l'itération i+1 en cours, bi est la valeur ternaire -1, 0 ou +1 calculée et Vr est la tension de référence, et en ce qu'il comprend également des moyens de comparaison pour comparer le signal de sortie dudit amplificateur opérationnel à une tension de référence bipolaire et un circuit logique de transformation pour transformer la sortie desdits moyens de comparaison en les valeurs ternaires utilisées à chaque itération. Un convertisseur analogique/numérique présentant les caractéristiques énoncées ci-dessus ne nécessite qu'une seule tension de référence unipolaire facile à obtenir, contrairement à un montage dans lequel on aurait besoin d'une tension de référence pour chaque polarité dont les valeurs absolues ne pourraient être établies moyennant un circuit complexe d'appariement. Par ailleurs, du fait que le montage est unilatéral, un seul amplificateur opérationnel suffit pour réaliser les moyens de calcul. Ceci conduit à une simplification appréciable du convertisseur et en réduit considérablement la consommation, propriété qui est très utile dans des appareils portables nécessairement miniaturisés, comme les aides auditives dans lesquelles la place réservée à la source d'énergie est généralement très réduite. Dans l'article précité, on enseigne uniquement la réalisation d'un convertisseur analogique/numérique mettant en oeuvre l'algorithme précité au moyen d'un montage symétrique comprenant plusieurs amplificateurs opérationnels. Cependant, la Demanderesse de la présente demande de brevet a constaté que l'algorithme de conversion à trois plages de décision peut, moyennant une adaptation adéquate, être utilisé avec profit pour opérer une conversion inverse numérique/analogique, dans les mêmes conditions que celles sous lesquelles travaille le convertisseur selon le premier mode de réalisation de l'invention. Ainsi, suivant un second mode de réalisation de l'invention, dans lequel lesdits signaux d'entrée sont numériques et lesdits signaux de sortie sont analogiques, lesdits moyens de calcul effectuent au cours de chacune desdites itérations, l'algorithme de la forme dans laquelle V est la portion de tension intermédiaire calculée au cours de l'itération i précédente, V, est la portion de tension intermédiaire à obtenir pendant l'itération i+1 en cours, bi est la valeur ternaire -1, 0 ou +1 calculée et Vr est la tension de référence, et en ce qu'il comprend également des moyens de maintien pour conserver la tension cumulée obtenue au cours d'un cycle d'itérations précédentes pendant l'exécution d'un cycle d'itérations jusqu'à l'achèvement de celui-ci afin de délivrer les échantillons successifs de la tension analogique à obtenir. Ce convertisseur numérique/analogique présente les mêmes avantages de simplicité et de faible consommation que le convertisseur suivant le premier mode de réalisation. L'invention a également pour objet un dispositif électronique, notamment une aide auditive, comprenant des moyens de traitement numérique de signaux analogiques, devant être restitués sous une forme adaptée et également analogique après ce traitement et en combinaison avec des convertisseurs de signaux tels que définis ci-dessus. D'autres caractéristiques et avantages de l'invention apparaîtront au cours de la description qui va suivre, donnée uniquement à titre d'exemple et faite en se référant aux dessins annexés sur lesquels: - la figure 1 déjà décrite est la représentation d'un algorithme connu utilisé dans le convertisseur analogique/numérique selon l'invention; - la figure 2 est un schéma très simplifié d'une aide auditive comportant deux convertisseurs, un de chaque type, selon l'invention; - la figure 3 est un schéma plus détaillé du convertisseur analogique/numérique selon l'invention; - la figure 4 est un diagramme des temps illustrant le fonctionnement du convertisseur selon la figure 3; - la figure 5 est un graphique illustrant le fonctionnement des comparateurs utilisés dans le convertisseur de la figure 3;; - la figure 6 est un graphique montrant, en fonction de la tension appliquée au convertisseur, l'évolution du rapport signal/bruit par plusieurs courbes obtenues avec des méthodes de conversion différentes; - la figure 7 représente l'organigramme mis en oeuvre par les moyens de calcul du convertisseur numérique/analogique suivant l'invention; - la figure 8 est un schéma simplifié des moyens de calcul du convertisseur numérique/analogique selon l'invention; et - la figure 9 est un diagramme des temps illustrant le fonctionnement du convertisseur selon la figure 8. Sur la figure 2, on a représenté à titre d'exemple d'application avantageux de l'invention un mode de réalisation préféré d'une aide auditive dans laquelle sont utilisés deux convertisseurs. Cette aide auditive comprend un microphone 1 captant l'environnement sonore, un amplificateur 2 à gain fixe recevant les signaux du microphone 1 et transmettant ce signal amplifié vers un filtre passe-bas 3 ayant une fréquence de coupure de 8000 Hz, par exemple. Le signal filtré issu du filtre 3 est appliqué à un convertisseur analogique/numérique 4 conçu selon l'invention et destiné à engendrer, à partir de ce signal, une suite de mots binaires codés selon la valeur des échantillons successifs pris de ce signal analogique. La sortie du convertisseur 4 est appliquée à un processeur de signaux binaires 5 qui est destiné à traiter le spectre sonore représenté par les signaux binaires, notamment pour l'adapter à la physiologie de l'oreille du porteur de l'aide auditive. Le processeur 5 est suivi d'un autre convertisseur 6 numérique/analogique selon l'invention et ce convertisseur est branché à la sortie du processeur 5 pour reconvertir le signal binaire transformé par celui-ci en un signal analogique. Ce signal est rendu audible par un haut-parleur 7 ou tout autre transducteur d'écoute approprié, pour le patient porteur de l'aide auditive. On va maintenant décrire le convertisseur analogique/numérique 4 selon l'invention en se reportant à la figure 3 qui en représente un exemple préféré. Cet exemple est réalisé avantageusement avec des condensateurs dits "capacités commutées" intégrées sur une même puce avec des transistors MOS qui forment des interrupteurs commandés. Ainsi, ce convertisseur comprend des moyens de calcul désignés globalement par la référence MC et comprenant un premier condensateur Cr de référence connecté à une borne 8 du convertisseur 4 sur laquelle est appliquée une tension continue de référence Vr, par exemple la tension d'alimentation du montage, à travers un interrupteur S1. On notera que cette tension Vr est unipolaire et la seule tension utilisée pour le calcul. Le condensateur Cr peut également être connecté sélectivement à la masse à travers un interrupteur S2. L'autre armature du condensateur de référence Cr est reliée à un noeud 9 auquel est relié un condensateur C1. L'armature opposée de ce condensateur C1 est reliée à un noeud 10 qui est connecté à deux interrupteurs S3 et S4. L'interrupteur S4 est connecté à la masse. Le noeud 9 est relié à deux interrupteurs S5 et S6, l'interrupteur S5 étant également connecté à la masse. L'interrupteur S6 est connecté à l'entrée inverseuse d'un amplificateur opérationnel 11, dont l'entrée non inverseuse est reliée à la masse, c'est-à-dire à un potentiel fixe. On remarquera que cet amplificateur est le seul utilisé pour effectuer le calcul par l'algorithme. Un condensateur C2 est branché entre l'entrée inverseuse de cet amplificateur 11 et un noeud 12. La sortie de l'amplificateur 11 est connectée d'une part à l'interrupteur S3 et d'autre part à un interrupteur S7 qui peut relier cette sortie à l'entrée inverseuse. Par ailleurs, le noeud 12 est relié à un interrupteur S8 permettant d'appliquer au condensateur C2 une tension Vin fournie à partir d'une borne 13. Un interrupteur S9 est inséré entre le condensateur C2 et la sortie de l'amplificateur 11. Le noeud 12 est également connecté à un ensemble comparateur désigné globalement par la référence 14. On notera à ce stade, que les moyens de calcul MC sont d'une conception "unilatérale" ce qui, au sens de la présente description, veut dire que tous les composants travaillent avec des polarités situées d'un côté d'une tension de base qui est ici la masse, la polarité étant arbitrairement choisie du côté positif. Il en résulte un circuit très simple qui, au prix d'une imprécision admissible, permet d'obtenir une conversion appropriée pour l'application envisagée. On notera également que ce montage ne comporte qu'un seul amplificateur opérationnel 11. Enfin, la tension de référence Vr est unipolaire (et positive dans le cas représenté). L'ensemble comparateur 14 comprend deux comparateurs 15 et 16 dont les schémas sont identiques à une exception près. Plus précisément, chaque comparateur comprend deux inverseurs (transistors M1 à M4) couplés en croix auxquels sont respectivement raccordés deux transistors de transfert M5 et M6 des signaux à comparer et deux transistors de transfert M7 et M8 des potentiels d'alimentation Wa et Vdd. Les tensions à comparer sont, bien entendu celle du noeud 12 et des tensions respectives de seuil +Vth et -Vth qui, selon une caractéristique importante de l'invention, sont dérivées d'un potentiel unique à savoir celui de la masse. Les transistors de transfert M5 à M8 sont commandés respectivement par le signal d'horloge Ck et l'inverse de ce signal, comme représenté sur la figure 3; ces signaux étant appliqués respectivement sur les bornes 17 et 18 des comparateurs. En observant cette figure, on s'aperçoit que dans les deux circuits, les noeuds 19 et 20 entre leur transistor de transfert M6 et leurs transistors M2 et M4 sont respectivement connectés à des condensateurs C3 et C4, de faible valeur, typiquement de quelques dizaines de femtofarad. Ces condensateurs permettent de modifier légèrement le potentiel sur les noeuds 19 et 20, respectivement dans le sens positif et dans le sens négatif pour former les tensions +Vth et -Vth au moment de l'application de l'impulsion d'horloge Ck ou le complément de cette impulsion sur les bornes respectives 17 et 18. Ce processus est illustré sur la figure 5 pour ce qui concerne le comparateur 15. Il a l'avantage important d'éviter l'utilisation d'un générateur de tensions de seuil en positif et en négatif, le montage étant ainsi moins encombrant et ayant une plus faible consommation. Il est à noter que sur la figure 5, on a représenté par un trait plein la tension du point de jonction 19 (figure 3) au moment où il se produit une transition du signal d'horloge CK, le trait en pointillés représentant l'évolution de la tension sur le noeud 21. Les sorties des deux comparateurs 15 et 16 apparaissent sur des bornes 21 et 22 respectivement à la jonction entre les transistors M1, M3 et M5 et au noeud 20. Ces sorties aboutissent à un circuit de transformation 23 destiné à produire les valeurs de bi à partir des signaux élaborés par les comparateurs 15 et 16 selon la table de vérité suivante:: TABLE DE VERITE valeur borne borne de bi 2122 0 0 0 -1 0 1 +1 1 0 La sortie 24 du circuit 23 est la valeur bi qui est appliquée à un circuit 25 destiné à produire les mots binaires parallèles en complément à deux représentant les échantillons numériques du signal analogique d'entrée à partir du codage dit (RSD, Redundant Signed Digit). Un tel circuit est décrit dans l'article précité. En outre, la sortie 24 permet de commander la position des interrupteurs S1 et S2 au cours de l'exécution des itérations de l'algorithme représenté sur la figure 1. La figure 4 est un chronogramme illustrant le déroulement d'une série d'itérations successives pour obtenir un échantillon de la tension analogique appliquée au convertisseur 4. Chaque train d'impulsions correspond à la commande de l'interrupteur correspondant S1 à S9 de la figure 3. Il est à noter que les trains d'impulsions commandant les interrupteurs S1 et S2 sont représentés en pointillés, car les formes d'onde correspondantes dépendent des valeurs successives du bit ternaire bi obtenues sur la sortie 24. Chaque cycle de fonctionnement commence par une phase d'acquisition PA (figure 4) qui est destiné également à établir le bit de poids fort de la valeur de l'échantillon finalement obtenu. Cette phase d'acquisition se déroule sur deux temps d'horloge (Pai et (pua2. L'interrupteur S7 est encore fermé pendant le temps (Pai pour remettre à zéro l'amplificateur 11. Pendant le même temps, l'interrupteur S8 est fermé ce qui place sur le condensateur C2 la valeur de l'échantillon de tension analogique à convertir. Les interrupteurs S4 et S6 sont également fermés. L'interrupteur S9 est ouvert. Pendant le temps (Pa2, les interrupteurs S3 et S5 sont fermés et les interrupteurs S4 et S6 sont ouverts ce qui copie la charge placée jusqu'ici sur le condensateur C2, sur le condensateur C1. Simultanément, l'un ou l'autre des interrupteurs S1 ou S2 est fermé en fonction du bit de poids fort, les comparateurs 15 et 16 étant amenés à basculer pendant cette phase pour donner ce résultat. La phase suivante constitue la première itération il de l'algorithme qui comme chacune des phases d'itération suivantes se déroule sur deux temps d'horloge. Pendant le premier temps cpl, la charge du condensateur C1 est transférée sur le condensateur C2 par la fermeture des interrupteurs 54 et S6, tandis qu'en fonction de la valeur de bi, l'un ou l'autre des interrupteurs S1 ou S2 est fermé. Ceci applique la tension Vr ou la tension O au condensateur de référence Cr. De ce fait, sur le condensateur C2 apparaît une tension constituée du double de la tension Vx majoré de bi*Vr. Puis, au cours du second temps p2 de cette phase il, la charge du condensateur C2 est recopiée sur le condensateur C1 par la fermeture des interrupteurs S3 et S5 et l'ouverture des interrupteurs S4 et S6. Ce processus se répète pendant toutes les itérations suivantes d'un cycle complet jusqu'à ce que le mot binaire complet représentant l'échantillon analogique soit obtenu. Un autre échantillon va alors être pris et traité de la même façon. La figure 6 montre un graphique illustrant les résultats que l'on peut obtenir grâce à l'invention en matière de rapport signal/bruit. A cet effet, ce rapport a été porté en ordonnées en fonction de l'amplitude d'un signal analogique d'entrée Vx formé par une sinusoïde à 1000 Hz. Le graphique montre trois courbes numérotées de 1 à 3. La courbe 1 correspond à un convertisseur analogique/numérique parfait à 14 bits dans lequel la multiplication par 2 serait parfaitement exacte. La courbe 2 montre le cas d'un convertisseur analogique/numérique selon l'invention dans lequel le facteur multiplicatif est de 1,998, soit une erreur de 0,2%. La courbe 3 correspond à un convertisseur ayant la même marge d'erreur, mais utilisant un algorithme de calcul classique à deux plages de décision. On voit donc que la courbe 2 significative quant à l'invention, suit pratiquement une grande partie de la courbe idéale 1 et s'en écarte dans une plage d'amplitude, avec un décalage qui, par définition, est sans conséquence dans l'application envisagée, comme celle des aides auditives. La figure 7 représente l'algorithme mis en oeuvre dans le convertisseur numérique/analogique 6 de la figure 2. La figure 8 montre un schéma des moyens de calcul MC-A utilisés dans le convertisseur 6. On voit que ce schéma est très semblable à celui des moyens de calcul MC du convertisseur analogique/numérique 4 représenté sur la figure 3. Ces moyens de calcul MC-A comprennent un condensateur de référence CR-A raccordé à deux interrupteurs S10 et S11 connectés respectivement à une borne 26 d'application de la tension de référence Vr et à la masse. Ces interrupteurs sont commandés en fonction de l'état d'un signal numérique ternaire élaboré à partir du signal fourni par le circuit de traitement 5 dans un circuit de transformation 27. Celui-ci fonctionne sur la base d'un système de transformation dit "CSD" (pour "Canonical Signed Digit") connu en soi.Un tel système est décrit dans un ouvrage de J.M. Müller édité dans la Collection Etudes et Recherches en Informatique et intitulé "Arithmétique des ordinateurs: opérateurs et fonctions élémentaires" (Masson, Paris, 1989) Le condensateur Cr-A est également connecté à un condensateur C1-A relié entre deux noeuds 28 et 29. Le noeud 28 est connecté à deux interrupteurs S12 et S13. L'interrupteur S12 est connecté à la sortie d'un amplificateur opérationnel ll-A formant un noeud 30. L'interrupteur S13 est connecté à la masse. Le noeud 29 est connecté à un interrupteur S14 relié à l'entrée inverseuse de l'amplificateur opérationnel ll-A, et également à un interrupteur S15 connecté par ailleurs à la masse. L'entrée inverseuse de l'amplificateur opérationnel ll-A est reliée à un condensateur C2-A connecté par ailleurs au noeud 30. Le noeud 30 est connecté à un circuit de maintien 31 qui peut être déclenché à chaque cycle d'itérations de l'algorithme de calcul au moyen d'un interrupteur S16. Ce circuit fournit sur sa sortie 32 la suite des échantillons de la tension analogique à obtenir. Dans le cas de la figure 8 la conversion commence par le bit de poids le plus faible (voir également la figure 9). A chaque itération, une charge correspondante, proportionnelle à bi*Vr est ajoutée à celle du condensateur C2-A. (bi=-l, O ou +1) et la charge totale est divisée par 2. Chaque itération se déroule sur deux temps d'horloge 1 et 2, comme dans le cas du convertisseur analogique/numérique 4. Pendant le premier temps d'horloge, le condensateur CR-A se charge à la tension Vr sinon à la tension 0, et la charge du condensateur C1-A est portée à zéro. Pendant le temps 92, le condensateur CR-A est chargé à la tension Vr si bi=-1, sinon à la tension 0, et le condensateur C1-A est mis en parallèle avec le condensateur C2-A. Ainsi, à la fin de chaque temps (p2, la tension sur le condensateur C2-A sera: A la fin d'un cycle d'itérations, cette tension totale est conservée dans le circuit de maintien 31 jusqu'à l'arrivé du résultat du cycle d'itérations suivant. A propos des moyens de calcul MC-A que l'on vient de décrire on peut remarquer les mêmes propriétés que celles attachées aux moyens de calcul de la figure 3, savoir une simplicité remarquable. REVENDICATIONS 1. Convertisseur d'un signal d'entrée en un signal de sortie représentatif dudit signal d'entrée avec une précision relative, ce convertisseur mettant en oeuvre un algorithme de conversion à trois plages de décision impliquant des valeurs numériques ternaires bi, avec bi = 1, 0, ou -1, et comprenant une source de tension de référence (Vr), des moyens de calcul (MC;; MC-A) pour, au cours de chacune des itérations d'une suite d'itérations successives dudit algorithme, établir une valeur de tension formée de la somme d'une valeur établie sur la base de la tension calculée à l'itération précédente et d'une valeur qui est le produit de la valeur ternaire obtenue au cours de l'itération précédente et de ladite tension de référence, lesdits moyens de calcul comprenant à cet effet une pluralité de capacités (Cr, C1, C2;Cr-A, C1-A, C2-A) commutées coopérant avec des moyens d'amplification (11; llA) délivrant ladite valeur de tension à chacune desdites itérations, ledit convertisseur comprenant également des moyens générateurs (14; 31) pour engendrer à partir des valeurs de tension successives calculées pendant ladite suite d'itérations des échantillons successifs représentant sous forme convertie ledit signal d'entrée, caractérisé en ce que lesdits moyens de calcul (MC;MC-A) sont formés par un montage unilatéral de capacités commutées (Cr, C1, C2; Cr-A, C1-A, C2-A) en combinaison avec un unique amplificateur opérationnel (11; llA) formant lesdits moyens d'amplification, l'une des entrées (+) dudit amplificateur opérationnel étant connectée à un potentiel fixe, et en ce que ladite source de référence est agencée pour fournir une tension de référence unipolaire (Vr) référencée sur ledit potentiel fixe. 2. Convertisseur suivant la revendication 1, dans lequel lesdits signaux d'entrée sont analogiques et lesdits signaux de sortie sont numériques, caractérisé en ce que lesdits moyens de calcul effectuent au cours de chacune desdites itérations, l'algorithme de la forme Vxs - 2V, +biVr dans laquelle VF est la tension obtenue au cours de l'itération i précédente, Vx,. est la tension à obtenir au cours de l'itération i+l en cours, bi est la valeur ternaire -1, 0 ou +1 calculée et Vr est la tension de référence, et en ce qu'il comprend également des moyens de comparaison pour comparer le signal de sortie dudit amplificateur opérationnel à une tension de référence bipolaire (+Vth, Vth) et un circuit logique de transformation (23) pour transformer la sortie desdits moyens de comparaison (15, 16) en les valeurs ternaires utilisées à chaque itération. 3. Convertisseur suivant la revendication 1, dans lequel lesdits signaux d'entrée sont numériques et lesdits signaux de sortie sont analogiques, caractérisé en ce que lesdits moyens de calcul effectuent au cours de chacune desdites itérations, l'algorithme de la forme dans laquelle V est la portion de tension intermédiaire calculée au cours de l'itération i précédente, Vxl, est la portion de tension intermédiaire à obtenir pendant l'itération i+l en cours, bi est la valeur ternaire -1, O ou +1 calculée et Vr est la tension de référence, et en ce qu'il comprend également des moyens de maintien pour conserver la tension cumulée obtenue au cours d'un cycle d'itérations précédentes pendant l'exécution d'un cycle d'itérations jusqu'à l'achèvement de celui-ci afin de délivrer les échantillons successifs de la tension analogique à obtenir. 4.- Convertisseur suivant l'une quelconque des revendications 1 à 3, caractérisé en ce que l'entrée noninverseuse dudit amplificateur opérationnel (11,;11-A) est connectée à la masse. 5.- Convertisseur suivant l'une quelconque des revendications 1 à 4, à l'exclusion de la revendication 3, caractérisé en ce que lesdits moyens générateurs (14) comprennent deux comparateurs (15, 16) dans chacun desquels l'une des entrées de comparaison est connectée à un condensateur (C3, C4) chargé par un signal de commande (Ck, Ck complément) déclenchant l'opération de comparaison dans le comparateur respectif, ces condensateurs étant par ailleurs reliés à la masse. 6. Dispositif de traitement numérique d'un signal analogique devant être restitué sous une forme analogique, caractérisé en ce qu'il comporte un circuit de traitement numérique (5) à l'entrée duquel est raccordé un convertisseur (4) selon l'une quelconque des revendications 1, 2, 4 et 5 et à la sortie duquel est raccordé un convertisseur selon l'une quelconque des revendications 1, 3 et 4. 7. Dispositif suivant la revendication 6 caractérisé en ce qu'il constitue une aide auditive et en ce que ledit circuit de traitement (5) est destiné à adapter un signal sonore à des propriétés physiologiques d'un patient.