FR 2611400 A1 19880902 FR 8702551 A 19870226 PROCEDE DE TEST D'ELEMENTS POUR UNE MEMOIRE INTEGREE ET DISPOSITIF DE MISE EN OEUVRE DU PROCEDE La présente invention concerne un procédé de test d'éléments pour une mémoire intégrée et un dispositif de mise en oeuvre du procédé. Une mémoire intégrée comporte classiquement des éléments mémoire, et un décodeur d'adresse permettant d'adresser ces éléments. La mémoire peut comporter également un ou plusieurs éléments mémoire de redondance, chaque élément de redondance étant destiné à remplacer un élément défectueux de la mémoire. Pour cela, l'adresse de chaque élément défectueux est mémorisée par une batterie de fusibles dans laquelle on claque certains fusibles, la batterie possédant autant de fusibles que de bit d'adresse à mémoriser. Pour éviter d'avoir à rejeter des mémoires qui présentent des cellules sur des lignes ou sur des colonnes non fonctionnelles, la démarche de lthomme de l'art a donc consisté jusque là à tester les éléments mémoire et à prévoir des éléments de redondance ligne ou colonne pour remplacer ces éléments défectueux de la mémoire. La démarche actuelle de l'homme de l'art consiste à augmenter le nombre d'éléments de redondance pour pouvoir remplacer tous les éléments défectueux de la mémoire afin de réduire le taux de rejet des mémoires. L'homme de l'art se trouve ainsi confronté à deux problèmes. Le premier problème réside dans l'augmentation de la taille des mémoires pour une capacité donnée. Le deuxième problème concerne la diminution du rendement d'une telle augmentation, si on considère que ce rendement s'évalue par le rapport entre le nombre d'éléments redondants pour un nombre d'élément mémoire donné et le taux de déchet des mémoires. En effet, l'augmentation du nombre dtéléments redondants entraîne le plus souvent une augmentation du taux de déchet des mémoires pour lesquelles les éléments mémoires ont été testés et remplacés par des éléments de redondance du fait que la probabilité qu'il y ait des éléments défectueux a également augmenté . L'objet de la présente invention consiste à résoudre ces problèmes en proposant un procédé de test plus complet que ceux proposés dans l'art antérieur. Le but consiste en particulier, étant donné un certain nombre d'éléments de redondance que l'on se fixe pour une mémoire, à augmenter le rendement obtenu de manière à obtenir un taux de déchet inférieur à ce qu'il serait selon l'art antérieur. La présente invention a donc pour objet un procédé de test d'une mémoire intégrée qui consiste à tester les éléments de redondance avant de les substituer ou non à des éléments défectueux de la mémoire. La présente invention a également pour objet de rendre les éléments de redondance testables sans avoir à figer l'état des fusibles qui vont permettre l'aiguillage vers chacun de ces éléments de redondance, de manière à ne substituer un élément de redondance à un élément mémoire défectueux que si cet élément de redondance s'est avéré être fonctionnel lors du test. L'invention a donc pour objet un procédé de test de mémoire intégrée qui comporte un réseau d'éléments mémoire, un décodeur d'adresse de ces éléments, des éléments redondants ainsi qu'au moins une batterie de fusibles permettant de définir par claquage de certains fusibles de chaque batterie une adresse et la sélection ou non d'un élément mémoire défectueux à remplacer par un élément redondant, caractérisé en ce qu'il consiste - à tester les éléments mémoire pour détecter des éléments défectueux - à tester les éléments de redondance pour détecter des éléments de redondance fonctionnels et des éléments de redondance défectueux - à claquer des fusibles d'une batterie en correspondance avec l'adresse d'un élément mémoire défectueux, cette batterie étant reliée à un élément de redondance défini fonctionnel par le test. - à claquer un fusible de sélection d'élément de redondance. La présente invention sera mieux comprise à l'aide de la description détaillée faîte à titre d'exemple non limitatif et en regard des figures annexées qui représentent - la figure 1, un schéma général du dispositif permettant de mettre en oeuvre le procédé selon l'invention ~ - la figure 2, un schéma de réalisation d'une batterie de fusibles et d'un décodeur DR selon la figure 1 - la figure 3, un schéma d'une réalisation particulière d'un élément de mémorisation selon la figure 2 La mémoire intégrée M comporte des éléments mémoires EM et des éléments de redondance RED. Une seule ligne de redondance RED et un seul signal VER qui permet de l'adresser ont été représentés pour simplifier la compréhension. Les éléments mémoire sont, de manière classique, adressables par un décodeur d'adresse DA, qui permet d'écrire ou de lire le contenu de chaque élément mémoire par l'intermédiaire des plots d'entrées-sorties E/S. Le contenu de chaque élément mémoire de redondance qui a été programmé est accessible également par les plots d'entrées-sorties E/S. Le procédé selon l'invention, consiste à tester à l'aide d'un testeur non représenté, mais classique en soi, les éléments mémoire EM et d'enregistrer les adresses des éléments mémoire qui sont défectueux. Lorsque le testeur a enregistré des adresses d'éléments défectueux, il commande la vérification des éléments de redondance. Cette vérification se fait par application d'un signal de vérification VER pour chaque ligne (ou colonne) de redondance à adresser. L'état de chaque éléments de redondance ainsi adressé est connu du testeur. Lorsqu un premier élément redondant adressé par un premier signal VER est fonctionnel, on procède au claquage de la batterie de fusibles BA pour mémoriser l'adresse Ai d'un premier élément mémoire défectueux présenté aux entrées d'adresse de cette batterie qui contient également un fusible de sélection ES pour informer et valider selon son état que l'on se sert ou non de cet élément de redondance pour cette adresse. Les fusibles sont claqués par application d'un signal de commande de claquage F et de la tension claquage VF. Les sorties de la batterie sont appliquées à un décodeur DR qui délivre un seul signal CR dont l'état est 0 ou 1 selon l'adresse présentée et selon que le fusible de sélection ES est claqué ou non. Lorsque le fusible de sélection a été claqué, le signal CR qui est appliqué sur une entrée d'une porte OU exclusif Q permet d'inhiber le décodeur d'adresses DA et d'adresser un élément de redondance particulier, le signal de sortie R de la porte prenant un état O ou 1 susceptible d'inhiber le décodeur DA. Ainsi, on claque des fusibles d'une batterie de manière à ce que l'état des fusibles de la batterie corresponde à une adresse d'un élément défectueux de la mémoire. On relie ensuite cette batterie à un élément de redondance particulier par claquage du fusible de sélection SE qui signale donc que l'on se sert de cet élément et ceci après avoir testé cet élément, de redondance qui a été reconnu fonctionnel par le test. Sur ce schéma général on a envisagé de relier à un élément de redondance une batterie, et ainsi chaque élément de redondance a sa batterie de fusibles. Tout en restant dans l'esprit de l'invention, il est également possible d'associer à chaque batterie plusieurs éléments de redondance, la liaison entre chaque batterie et un élément de redondance n'étant faite qu'après le test et en fonction du résultat de ce test. Sur la figure 2, on a représenté le schéma d'une batterie de fusibles pour la mémorisation d'une adresse Ai et le décodeur DR. La batterie comporte autant d'élément de mémorisation que de bit d'adressage. Ces éléments sont référencés E6 à E15 et correspondent donc aux entrées d'adressage A6-A15 de la mémoire. Un élément de mémorisation ES supplémentaire est prévu pour mémoriser l'information d'utilisation ou non de la redondance, c'est-à-dire pour effectuer ou ne pas effectuer une liaison entre la batterie de fusible à un élément de redondance. Cet élément de redondance reçoit à son entrée d'adresse une tension Vcc. Chaque élément ES, E6 - E 15 comporte une entrée pour recevoir la tension de claquage VF et une entrée pour recevoir la tension de commande de claquage F, ces tensions étant appliquées une fois que l'on s'est assuré que l'élément de redondance est fonctionnel. Le décodeur DR est constitué par un ensemble de transistors TS, T6-T15 qui ont leur grille reliée à une sortie d'un élément de mémorisation et les drains reliés entre eux pour former une seule sortie délivrant le signal CR. Les sources des transistors sont reliées à la masse. Pour claquer les fusibles dans une batterie, c'est-à-dire pour mémoriser une adresse et pour sélectionner un élément de redondance, on applique un niveau bas sur toutes les entrées d'adresse puis on augmente la tension jusqu'a obtenir le claquage VF, de 12 à 13 V généralement, puis on applique la tension de -commande F, de O à 5 V généralement et on adresse successivement chaque élément. On utilise préférentiellement une seule source de tension VF pour toutes les batteries et une source de tension F pour chaque batterie. Les entrées A6-A15 sont destinées à recevoir les signaux correspondant aux bits d'adresse en provenance des plots d'entrées-sorties E/S de la mémoire. Le fusible de sélection reçoit (à la place d'un bit d'adresse) une tension Vcc de 5 V par exemple. Lorsque l'on procède par la suite à une écriture puis à des lectures dans la mémoire, la sortie unique du décodeur DR obtenue à partir des éléments de mémorisation E6-E15, est à 0 (ou à 1) si l'adresse présentée à l'entrée de la batterie a été mémorisée par cette batterie. La sortie de chaque élément El a le même état que l'entrée (0 ou 1) si le bit d'entrée correspond à l'état du fusible. Si c'est le cas et que le fusible de l'élément de sélection a été claqué, l'aiguillage est fait vers l'élément de redondance sélectionné. Sur la figure 3, on a représenté un exemple détaillé de réalisation d'un élément El de mémorisation d'adresse ou de sélection à titre indicatif et nullement limitatif. L'élément Ei de mémorisation comprend un circuit de programmation P qui reçoit le signal ai correspondant à un bit d'adresse Ai, la tension de commande de claquage F du fusible. Le circuit comporte une porte Non-ET, NE, et les transistors T19 à T23 et délivre un signal qui va provoquer un claquage (ou non) du fusible R par conduction (ou non) du transistor Tl9 à Vss. L'élément de mémorisation EI comprend également un circuit de mémorisation ME proprement dit qui reçoit la tension de claquage VF pour claquer le fusible R sur commande du circuit P. Ce circuit ME comporte le fusible R, des transistors T24 à T27, un condensateur C et délivre pendant la lecture de l'état du fusible, un état xi traduisant l'état du fusible. L'élément de mémorisation comporte également un décodeur DEC qui reçoit également le signal ai d'entrée correspondant à un bit d'adresse et le signal lu xi dans l'élément de mémorisation ME. Ce circuit DEC permet de délivrer le signal de sortie Si dont l'état est soit ai si l'état xi du fusible correspond à l'état ai, soit ai (ai inversé) si l'état xi du fusible ne correpond pas à cet état. Le circuit DEC comporte un inverseur I, et les transistors T28 à T30. La sortie de ce circuit est reliée à un transistor Ti (T6, T7.T15) du décodeur d'adresse DR. Cet exemple particulier de circuit a été réalisé en technologie CMOS, les transistors T20, T23, T19, T24, T27, T28, T29 étant des transistors MOS à canal N et les transistors T21, T22, T25, T30 étant des transistors à canal P. REVENDICATIONS 1. Procédé de test d'une mémoire intégrée qui comporte un réseau d'éléments mémoire (EM), un décodeur d'adresse (DA) de ces éléments, des éléments redondants (RED) ainsi qu'au moins une batterie de fusibles (BA) permettant de définir par claquage de certains fusibles de chaque batterie une adresse d'un élément de mémoire défectueux à remplacer par un élément redondant, caractérisé en ce qu'il consiste - à tester les éléments mémoire (EM) pour détecter des éléments défectueux - à tester les éléments de redondance (RED) pour détecter des éléments de redondance fonctionnels et des éléments de redondance défectueux - à claquer des fusibles d'une batterie en correspondance avec l'adresse d'un élément mémoire défectueux, cette batterie étant reliée à un élément de redondance défini fonctionnel par le test - à claquer un fusible de sélection d'élément de redondance. 2. Procédé de test selon la revendication 1, caractérisé en ce qu'il consiste à relier à chaque élément de redondance une batterie respective et à n'utiliser un couple élément de redondance-batterie que si l'élément de redondance a été défini fonctionnel. 3. Procédé de test selon la revendication 1, caractérisé en ce qu'il consiste à associer à chaque batterie plusieurs éléments de redondance, la liaison entre une batterie et un de ces éléments de redondance n'est faite qu'après le test, en fonction du résultat du test. 4. Dispositif de test d'une mémoire intégrée selon l'une quelconque des revendications 1 à 3, caractérisé en ce qu'il comporte - une porte ou exclusif (Q) qui permet d'adresser au moins un élément de redondance de la mémoire, cette porte (Q) recevant pour cela au moins un signal de vérification (VER) pour le test de cet élément - un fusible de sélection dans la batterie (BA) de fusibles qui va permettre ou non en fonction de son état de relier la batterie à cet élément de redondance si cet élément a été détecté fonctionnel lors du test - une batterie (BA) de fusibles qui reçoit une adresse d'un élément défectueux de la mémoire, cette adresse étant mémorisée par claquage de certains fusibles en même temps qutà lieu le claquage du fusible de sélection - un décodeur (DR) qui reçoit tous les signaux de sortie de la batterie (BA) et dont la sortie délivre un signal (CR) qui est susceptible par l'intermédiaire de la porte ou exclusif (Q) d'inhiber le décodeur d'adresse lorsque l'adresse présentée à l'entrée a été enregistrée dans la batterie et que le fusible de sélection a été claqué. - 5. Dispositif selon la revendication 4, caractérisé en ce que la batterie de fusibles comporte un élément de mémorisation (E6-E15) pour chaque bit d'adresse et en ce que la sortie de chaque élément (E6-E15) a le même état O (ou 1) que l'entrée si le bit d'entrée correspond à l'état du fusible.