FR 2779888 A1 19991217 FR 9807721 A 19980616 CIRCUIT DE DÉTECTICN DE VERROUILLAGE D'ITIE BOUCLE DE SYNCIRONISATION D'UN DÉMDDULATEUR QPSK La présente invention concerne un démodulateur dit QPSK ("Quadrature Phase Shift Keying") permettant de transmettre simultanément deux signaux binaires I et Q sur deux porteuses de même fréquence mais en quadrature de phase. La présente invention vise plus particulièrement la détection de la synchronisation d'une horloge interne sur la fréquence de transmission des signaux binaires. Dans un démodulateur QPSK, on cherche, d'une part à reconstruire le couple de signaux binaires tel qu'il a été émis, et d'autre part à extraire les valeurs binaires du couple de signaux reconstruits. La présente invention concerne essentiel- lement l'extraction des valeurs binaires. La figure 1 représente schématiquement la partie d'un démodulateur QPSK classique permettant d'extraire les valeurs binaires. Deux convertisseurs analogique/numérique 10 reçoivent respectivement deux signaux analogiques Ia et Qa correspondant au couple de signaux binaires I et Q après une démodulation gros- sière. Les convertisseurs 10 sont cadencés par une horloge SCK de fréquence supérieure à la vitesse de transmission des valeurs binaires par les signaux I et Q. Les sorties des convertisseurs analogique/numérique 10 sont fournies à un filtre d'interpolation 12 destiné à calculer à partir des couples d'échantillons fournis par les convertisseurs , les valeurs (Is, Qs) correspondant à chaque couple de valeurs binaires transmises. La sélection des échantillons Is et Qs est déterminée par une horloge reconstruite CKR synchronisée sur la transmission des valeurs binaires. En général, les fronts de l'horloge CKR, qui déterminent les échantillons à sélectionner, surviennent entre deux échantillons successifs. La position d'un front de l'horloge CKR entre deux échantillons est indiquée par un coef- ficient k permettant au filtre 12 d'interpoler la valeur de l'échantillon à sélectionner. Cette mesure est nécessaire, notam- ment lorsque la vitesse de transmission des valeurs binaires est proche de la fréquence d'échantillonnage des convertisseurs 10, car la reconstruction de l'horloge CKR dépend des variations d'amplitude des échantillons sélectionnés. L'horloge CKR et le coefficient k sont fournis par un oscillateur à commande numérique 14 qui reçoit une consigne de fréquence d'un circuit de détection d'erreur de synchronisation 16 par l'intermédiaire d'un filtre passe-bas 18. Le circuit de détection d'erreur 16 calcule une valeur d'erreur numérique à partir des valeurs binaires Is et Qs fournies par le filtre d'interpolation 12. Ce circuit de calcul d'erreur 16 peut mettre en oeuvre un parmi de nombreux algorithmes de calcul d'erreur bien connus de la technique. A l'aide de la boucle de synchronisation constituée des éléments 12 à 18, l'horloge CKR est synchronisée sur la transmis- sion des valeurs binaires. Or, ces valeurs binaires sont fournies par une démodulation grossière. Il en résulte que la porteuse n'a pas été totalement supprimée des signaux transmis et que le vecteur de composantes Is et Qs tourne à une fréquence égale à l'erreur de fréquence de la démodulation. Cette erreur est sup- primée par un circuit de correction de rotation qui peut être placé, comme cela est représenté en pointillés, entre le filtre 12 et le circuit de détection d'erreur 16, ou bien plus en aval. Un problème qui se pose dans un tel démodulateur est que la vitesse de transmission des valeurs binaires peut varier dans de grandes proportions, de sorte que la boucle de synchroni- sation est généralement incapable de se resynchroniser après un changement de vitesse de transmission. Pour parvenir à une syn- chronisation, on procède généralement par essais successifs de fréquence et on utilise un détecteur de verrouillage pour indi- quer que la bonne fréquence a été trouvée. Un premier type de détecteur de verrouillage classique utilise le signal d'erreur de synchronisation fourni par le circuit 16 et indique un verrouillage lorsque cette erreur devient inférieure à un seuil. Toutefois, lorsque les conditions de réception sont mauvaises, il s'avère qu'il n'y a pas de dif- férence significative entre un signal d'erreur d'un système verrouillé et celui d'un système non verrouillé. Pour éviter ce problème, un autre type de détecteur de verrouillage utilise un algorithme d'analyse de la stabilité de la fréquence instantanée. Cependant, cette analyse est peu fiable seule et nécessite une confirmation par de nombreux recoupements, ce qui rend cette solution particulièrement complexe et longue à réagir. Un objet de la présente invention est de prévoir une détection de verrouillage qui réagisse rapidement et qui soit fiable même dans des mauvaises conditions de réception. Cet objet est atteint grâce à un procédé de détection de verrouillage d'une boucle de synchronisation d'une horloge interne sur la transmission de couples de valeurs provenant d'une démodulation QPSK. Il comprend les étapes consistant à calculer le module de chaque vecteur ayant comme composantes les deux valeurs de chaque couple; à comparer le module à un seuil infé- rieur au module théorique; et à déterminer la condition de verrouillage en fonction de la proportion des modules trouvés supérieurs ou inférieurs au seuil par rapport au nombre de modules comptabilisés. Selon un mode de réalisation de la présente invention, le procédé comprend les étapes consistant à incrémenter le seuil d'une valeur prédéterminée A si le module est supérieur au seuil; à décrémenter le seuil d'une valeur prédéterminée B supérieure à la valeur A si le module est inférieur au seuil; et à déterminer la condition de verrouillage à partir de la valeur du seuil atteinte pour un nombre prédéterminé de couples de valeurs. Selon un mode de réalisation de la présente invention, une condition de verrouillage est détectée lorsque le seuil est supérieur à une valeur limite constante. Selon un mode de réalisation de la présente invention, une condition de verrouillage est en outre détectée lorsque le seuil est inférieur à la valeur limite et qu'une variation forcée de la fréquence de l'horloge interne provoque un abaissement significatif du seuil. La présente invention prévoit également un circuit de détection de verrouillage d'une boucle de synchronisation d'une horloge interne sur une transmission de couples de valeurs prove- nant d'une démodulation QPSK, comprenant un circuit de calcul du module de chaque vecteur ayant comme composantes les deux valeurs de chaque couple; un registre contenant un seuil; un compara- teur du seuil contenu dans le registre au module fourni par le circuit de calcul; des moyens pour incrémenter le contenu du registre d'une valeur prédéterminée A lorsque le module est supérieur au seuil et décrémenter le contenu du registre d'une valeur prédéterminée B supérieure à la valeur A lorsque le module est inférieur au seuil; et un circuit d'analyse du seuil contenu dans le registre pour déterminer la condition de verrouillage. Selon un mode de réalisation de la présente invention, les valeurs A et B sont choisies de manière que le rapport A/A+B soit égal à la probabilité souhaitée pour que le module soit inférieur au seuil. Ces objets, caractéristiques et avantages, ainsi que d'autres de la présente invention seront exposés en détail dans la description suivante de modes de réalisation particuliers faite à titre non-limitatif en relation avec les figures jointes parmi lesquelles: la figure 1, précédemment décrite, représente schémati- quement une partie d'un démodulateur QPSK classique destinée à régénérer la fréquence de transmission des signaux modulés; la figure 2 représente une constellation de quatre points correspondant aux valeurs théoriques transmissibles par un signal modulé en QPSK, ainsi que des zones d'apparition probable des points dans des conditions réelles; la figure 3 représente des distributions de distances à l'origine des points de la constellation dans le cas d'un système verrouillé et dans le cas d'un système non verrouillé; la figure 4 représente schématiquement un mode de réa- lisation de détecteur de verrouillage selon l'invention; et la figure 5 représente des zones d'équiprobabilité de verrouillage et de non verrouillage en fonction du rapport signal sur bruit de la transmission et d'une distance de référence à l'origine des points de la constellation. La figure 2 représente une constellation de quatre points P1 à P4 illustrant les quatre combinaisons théoriques possibles du couple de valeurs (Is, Qs) fourni par un démodula- teur QPSK du type de la figure 1. Les points Pi à P4 apparaissant dans un système réel s'éloignent d'autant plus des points repré- sentés en figure 2 que le système est perturbé ou loin de la condition de verrouillage. Les points réels ont une probabilité d'apparition maximale dans des zones hachurées en figure 2. La présente invention est basée sur une analyse des positions des points de la constellation d'un système réel. Lorsque le système est verrouillé et que les signaux ont subi une correction de rotation adéquate, les points ont une forte proba- bilité d'apparaître au voisinage des points théoriques, cette probabilité diminuant lorsque le rapport signal sur bruit de la transmission se détériore. En l'absence de correction de rotation, les points ont une probabilité élevée d'apparaître à une distance fixe de l'ori- gine. Lorsque le système n'est pas verrouillé, les points se dispersent de manière qu'ils ont une probabilité relativement élevée d'apparaître à proximité de l'origine de la constellation. La figure 3 représente, en trait plein, un exemple de distribution des distances r à l'origine des points de la cons- tellation pour un système verrouillé et, en pointillés, la même distribution pour un système non verrouillé. La distance 100 correspond à la distance théorique. On remarque ici plus claire- ment que la probabilité d'apparition de points proches de l'origine est significativement plus élevée pour le système non verrouillé. Selon la présente invention, on observe un nombre suf- fisant de points consécutifs et on considère que le système est verrouillé lorsque la proportion de points proches de l'origine est inférieure à un seuil. On pourrait pour cela choisir un seuil fixe. Toutefois, il s'avère que les distributions illustrées en figure 3 changent en fonction du rapport signal sur bruit de la transmission. En particulier, les distributions s'élargissent et s'aplatissent lorsque le bruit augmente, de sorte qu'un seuil convenable pour un rapport signal sur bruit donné ne convient plus pour un autre rapport signal sur bruit. De plus, le rapport signal sur bruit est a priori inconnu. La figure 4 représente schématiquement un mode de réa- lisation de circuit de détection de verrouillage selon l'invention qui évite les inconvénients liés à un rapport signal sur bruit inconnu. Un circuit 20 reçoit le couple de valeurs Is et Qs fournies par le démodulateur (figure 1) et calcule le module r du vecteur ayant pour composantes les valeurs Is et Qs. Ainsi, la valeur r est la distance à l'origine de la constel- lation du point correspondant aux valeurs Is et Qs. Un comparateur 22 compare cette distance r à une distance seuil rth contenue dans un registre 24. Le contenu du registre 24, donc la distance seuil rth, est modifié en fonction du résultat de la comparaison. Plus spécifiquement, lorsque la distance r est supérieure à la distance seuil rth, le contenu du registre 24 est incrémenté d'une valeur A. Dans le cas contraire, il est décré- menté d'une valeur B supérieure à A. Pour cela, un additionneur 26 met à jour le contenu du registre 24 par la somme de ce même contenu et de la sortie d'un multiplexeur 28. Le multiplexeur 28 reçoit la valeur A sur une première entrée et la valeur -B sur une deuxième entrée. Le comparateur 22 commande le multiplexeur 28 pour sélectionner la valeur A ou -B adéquate. Avec cette configuration, après avoir comptabilisé un nombre suffisant de points, le seuil rth s'établit à une valeur telle que la proportion des distances r trouvées en dessous du seuil rth est égale à A/A+B. En d'autres termes, le seuil rth est automatiquement ajusté à une valeur telle que la probabilité d'avoir une distance inférieure au seuil rth soit égale au rap- port A/A+B. Un circuit 30 analyse l'évolution du seuil contenu dans le registre 24 et active un signal de verrouillage LCK lorsque ce seuil correspond à des critères particuliers décrits ci-dessous. La figure 5 représente deux bandes d'équiprobabilité, l'une I correspondant à un système verrouillé et l'autre II correspondant à un système non verrouillé, en fonction du rapport signal sur bruit de la transmission. Chaque bande d'équiprobabi- lité correspond à une probabilité constante déterminée par les incréments A et B et fournit, pour un rapport signal sur bruit donné, la plage dans laquelle doit s'établir le seuil rth. Les dimensions représentées à titre d'exemple à la figure 5 cor- respondent à une probabilité de 1/16 pour que la distance r soit inférieure au seuil rth. On observe dans cette figure 5 qu'il est pratiquement sûr que le système est verrouillé si le seuil rth s'établit à une valeur supérieure à 50. Ainsi, le circuit d'analyse 30 active le signal de verrouillage LCK lorsque le seuil rth devient supérieur à 50. On observe également qu'il est pratiquement sûr que le système est non verrouillé si le seuil rth s'établit à une valeur inférieure à 40. Il subsiste une plage d'incertitude de 40 à 50. En effet, dans cette plage, un même seuil peut correspondre à un état verrouillé avec un faible rapport signal sur bruit et à un état non verrouillé avec un rapport signal sur bruit plus élevé. La figure 5 illustre ceci par deux points de même seuil 45 et dont l'un, P5, est à un rapport signal sur bruit inférieur à 3 dB et l'autre, P6, à un rapport signal sur bruit de l'ordre de 5,6 dB. Dans un tel cas d'ambiguïté, il suffit que le circuit d'ana- lyse 30 force la fréquence de l'oscillateur 14 (figure 1) à une valeur nettement différente de sa valeur courante et relève de nouveau le seuil rth. Si le seuil rth bouge peu, c'est que la condition du système ne change pas. Le système ne pouvait être que non ver- rouillé. Le seuil rth reste dans les limites de la bande II. Il est très peu probable qu'en effectuant un saut de fréquence arbitraire on passe d'une condition non verrouillée à une condi- tion verrouillée et donc que le point P6 passe, après le changement de fréquence, dans la bande I. Si par contre le seuil rth s'abaisse significativement après le changement de fréquence, cela signifie que la condition de fonctionnement du système a changé, à savoir qu'il est passé de l'état verrouillé à l'état non verrouillé. Ceci est illustré à la figure 5 par un point P7 de seuil inférieur à 40. Dans ce cas, le circuit 30 rétablit la fréquence initiale et active le signal de verrouillage LCK. De bons résultats sont obtenus pour un rapport A/A+B compris entre 1/20 et 1/10. Pour des valeurs faibles du rapport, la bande II devient plus croissante, alors que pour des valeurs élevées, la bande I devient moins croissante et plus large. On remarquera que le circuit de calcul 20 peut recevoir les valeurs Is et Qs tout de suite en sortie du filtre d'interpo- lation 12, ou bien après correction de rotation. En effet, l'erreur de rotation n'a aucune influence sur les calculs de distance. Une détection de verrouillage selon l'invention néces- site l'observation d'un nombre de points suffisanmnent élevé, quelques milliers, pour être représentatif de la condition de fonctionnement du système, mais ce nombre de points reste net- tement inférieur à celui que requièrent les solutions classiques, des dizaines de milliers. REVEDICATIONS 1. Procédé de détection de verrouillage d'une boucle de synchronisation d'une horloge interne (CKR) sur la transmission de couples de valeurs (Is, Qs) provenant d'une démodulation QPSK, caractérisé en ce qu'il comprend les étapes suivantes: - calculer le module (r) de chaque vecteur ayant comme composantes les deux valeurs de chaque couple; - comparer le module à un seuil (rth) inférieur au module théorique; et - déterminer la condition de verrouillage en fonction de la proportion des modules trouvés supérieurs ou inférieurs au seuil par rapport au nombre de modules comptabilisés. 2. Procédé de détection de verrouillage selon la reven- dication 1, caractérisé en ce qu'il comprend les étapes sui- vantes: - incrémenter le seuil d'une valeur prédéterminée A si le module est supérieur au seuil; - décrémenter le seuil d'une valeur prédéterminée B su- périeure à la valeur A si le module est inférieur au seuil; et déterminer la condition de verrouillage à partir de la valeur du seuil atteinte pour un nombre prédéterminé de cou- ples de valeurs. 3. Procédé de détection de verrouillage selon la reven- dication 2, caractérisé en ce que les valeurs A et B sont choisies de manière que le rapport A/A+B soit égal à la probabi- lité souhaitée pour que le module soit inférieur à la valeur du seuil atteinte. 4. Procédé de détection de verrouillage selon la reven- dication 2, caractérisé en ce qu'une condition de verrouillage est détectée lorsque le seuil est supérieur à une valeur limite constante. 5. Procédé de détection de verrouillage selon la reven- dication 4, caractérisé en ce qu'une condition de verrouillage est en outre détectée lorsque le seuil est inférieur à la valeur limite et qu'une variation forcée de la fréquence de l'horloge interne provoque un abaissement significatif du seuil. 6. Circuit de détection de verrouillage d'une boucle de synchronisation d'une horloge interne (CKR) sur une transmission de couples de valeurs (Is, Qs) provenant d'une démodulation QPSK, caractérisé en ce qu'il comprend: - un circuit (20) de calcul du module (r) de chaque vecteur ayant comme composantes les deux valeurs (Is, Qs) de chaque couple; - un registre (24) contenant un seuil (rth); - un comparateur (22) du seuil contenu dans le registre au module fourni par le circuit de calcul; - des moyens (26, 28) pour incrémenter le contenu du registre d'une valeur prédéterminée A lorsque le module est supérieur au seuil et décrémenter le contenu du registre d'une valeur prédéterminée B supérieure à la valeur A lorsque le module est inférieur au seuil; et - un circuit (30) d'analyse du seuil contenu dans le registre pour déterminer la condition de verrouillage. 7. Circuit de détection de verrouillage selon la reven- dication 6, caractérisé en ce que les valeurs A et B sont choisies de manière que le rapport A/A+B soit égal à la probabi- lité souhaitée pour que le module soit inférieur au seuil.