FR 2710806 A1 19950407 FR 9311633 A 19930928 Dispositif d'asservissement de fréquence La présente invention concerne de manière générale un dispositif pour asservir une fréquence d'un signal d'horloge local à N fois la fréquence d'un signal d'horloge pilote, N étant un entier prédéterminé. Typiquement, un tel dispositif d'asservissement d'un signal d'horloge local est utilisé lors d'une phase de maintien en fréquence succédant à une phase d'acquisition en fréquence. Une fréquence du signal d'horloge local égale à N fois la fréquence du signal d'horloge pilote est acquise lors de la phase d'acquisition et cette fréquence acquise est maintenue par le dispositif d'asservissement de fréquence. L'invention trouve application notamment dans le domaine des télécommunications pour asservir la fréquence d'un signal d'horloge local d'échantillonnage dans un système de réception à N fois la fréquence d'un signal d'horloge pilote reçu par ce système. La fréquence du signal d'horloge pilote est par exemple la fréquence des trames de données reçues par le système de réception. Dans ce cas, le signal d'horloge local a une fréquence égale à la fréquence des éléments binaires dans chaque trame, N étant alors égal au nombre d'éléments binaires dans une trame. Un tel exemple d'application de l'invention permet de récupérer la fréquence des éléments binaires dans chaque trame à partir de la fréquence de trame, afin d'échantillonner ces éléments binaires et ainsi retrouver les données incluses dans les trames. La figure 1 montre, sous forme de bloc- diagramme, un dispositif d'asservissement de fréquence 1 selon la technique antérieure très connu de l'homme du métier. Le dispositif est une boucle de verrouillage de phase comprenant un comparateur de phase 10, un filtre 11, un oscillateur commandé en tension 12 et un diviseur de fréquence par N 13. Le comparateur 10, le filtre 11 et l'oscillateur 12 sont connectés en cascade selon cet ordre. Une sortie de l'oscillateur 12 est rebouclée sur une première entrée 101 du comparateur de phase 10 à travers le diviseur de fréquence 13. Une seconde entrée 102 du comparateur de phase 10 reçoit un signal d'horloge pilote Sp à une fréquence pilote fp. Le fonctionnement du dispositif d'asservissement de fréquence montré à la figure 1 est le suivant. Le comparateur de phase 10 compare la phase du signal d'horloge pilote Sp avec la phase d'un signal d'horloge d'asservissement Sa produit en sortie du diviseur de fréquence 13, et fournit une tension de commande VC pour commander l'oscillateur 12 à travers le filtre 11. Le signal d'asservissement Sa a une fréquence fa N fois plus petite que la fréquence fl du signal d'horloge local Si en sortie de l'oscillateur 12, et sensiblement égale à la fréquence fp du signal d'horloge pilote Sp. Le dispositif 1 selon la technique antérieure est typiquement utilisé lorsque le rapport de fréquence fl/fp entre la fréquence fl du signal d'horloge local Sl et la fréquence fp du signal d'horloge pilote Sp est inférieur à une valeur sensiblement égale à 104. Il est à noter que, si la fréquence fp du signal d'horloge Sp est très faible, c'est-à- dire la période de ce signal est très élevée, le dispositif 1 ne peut être utilisé en raison des difficultés de réalisation du filtre 11 dont les composants doivent avoir des valeurs élevées pour filtrer le signal de commande VC tout en garantissant une commande précise de l'oscillateur 12. Dans le cas o le rapport de fréquence fl/fp est supérieur à une valeur sensiblement égale à 104, le dispositif 1 ne peut être utilisé. En effet, une augmentation ou diminution infime de la fréquence fl du signal Sl produit par l'oscillateur n'induit qu'une très faible variation de phase du signal d'asservissement Sa compte tenu du rapport des périodes entre les signaux Sa et Sl, et le dispositif manque alors de précision. En pratique, quand le rapport de fréquence fl/fp est élevé, typiquement supérieur à 104, la technique antérieure prévoit deux dispositifs d'asservissement de fréquence 1 et 2 qui sont du type montré à la figure 1 et connectés en cascade. Dans cette réalisation montrée sous forme de bloc-diagramme à la figure 2, chacun des premier et second dispositif d'asservissement de fréquence est une boucle de verrouillage de phase, comprenant un comparateur de phase 10, 20, un filtre 11, 21, un oscillateur commandé en tension 12, 22 et un diviseur de fréquence 13P, 23 agencés de la même manière que dans la figure 1. La sortie de l'oscillateur 12 du premier dispositif d'asservissement 1 est appliquée à une seconde entrée 202 du comparateur de phase 20 du second dispositif d'asservissement 2. Les deux dispositifs d'asservissement de fréquence 1 et 2 connectés en cascade confère un facteur de multiplication de fréquence égal à N = (P x M), correspondant à la multiplication de deux rapports de division de fréquence P et M dans les diviseurs de fréquence 13P et 23. Le second oscillateur 22 produit un signal d'horloge local Sl ayant une fréquence N = (P x M) fois plus élevée que la fréquence fp du signal d'horloge pilote Sp appliqué à la seconde entrée 102 du comparateur de phase 10. Cette réalisation résout le problème énoncé précédemment relatif à un rapport de multiplication trop élevé entre la fréquence fp d'un signal d'horloge pilote Sp reçu et la fréquence fl d'un signal d'horloge local Sl à générer. Cependant, les deux réalisations connues présentent les inconvénients suivants. Pour des applications dans lesquelles le rapport de fréquence entre la fréquence fl du signal d'horloge local Sl et la fréquence fp du signal d'horloge pilote Sp est très élevée, typiquement supérieur à 104, le dispositif 1 ne peut être utilisé. La réalisation de la figure 2 induit le doublement des composants électroniques puisque deux boucles de verrouillage de phase sont utilisées, et donc une augmentation de coût. L'invention vise à remédier aux inconvénients précités en fournissant un dispositif d'asservissement de fréquence, qui est destiné à des réalisations pour lesquelles le rapport des fréquences entre la fréquence du signal d'horloge local et la fréquence du signal d'horloge pilote est élevé, et qui est de moindre coût comparativement à la réalisation connue selon la technique antérieure montrée à la figure 2. A cette fin, un dispositif pour asservir une fréquence locale d'un signal d'horloge local à N fois une fréquence pilote d'un signal d'horloge pilote, N étant un entier prédéterminé, comprenant, sous la forme d'une boucle de verrouillage de phase, des moyens de comparaison de phase ayant des première et seconde entrées et produisant un signal de commande, des moyens de filtrage pour filtrer le signal de commande, des moyens d'oscillation commandés par le signal de commande filtré pour produire ledit signal d'horloge local, et des premiers moyens de division de fréquence par M, M étant un entier prédéterminé inférieur à N, pour diviser ladite fréquence locale en une fréquence intermédiaire d'un premier signal d'asservissement appliqué à la première entrée desdits moyens de comparaison de phase, est caractérisé en ce qu'il comprend des seconds moyens de division de fréquence par M pour diviser ladite fréquence locale en la fréquence intermédiaire d'un second signal d'asservissement appliqué à la seconde entrée desdits moyens de comparaison de phase qui comparent des phases respectives desdits premier et second signaux d'asservissement pour produire ledit signal de commande, lesdits seconds moyens de division de fréquence étant réinitialisés périodiquement à ladite fréquence pilote par le signal pilote. Cette réinitialisation impose une référence de phase au second signal d'asservissement en dépendance de celle du signal d'horloge pilote, et permet ainsi l'asservissement en fréquence du signal d'horloge local sur le signal d'horloge pilote. D'autres caractéristiques et avantages de la présente invention apparaîtront plus clairement à la lecture de la description suivante en référence aux dessins annexés correspondants dans lesquels: - la figure 1, déjà commentée, est un bloc- diagramme d'un dispositif d'asservissement de fréquence selon la technique antérieure; - la figure 2, commentée également, est un bloc- diagramme d'un dispositif d'asservissement de fréquence selon la technique antérieure résultant de la mise en cascade de deux dispositifs d'asservissement de fréquence du type montré à la figure 1; et - la figure 3 est un bloc-diagramme d'un dispositif d'asservissement de fréquence selon l'invention. En référence à la figure 3, un dispositif d'asservissement de fréquence 3 selon l'invention pour asservir la fréquence fl d'un signal d'horloge local Sl à N fois la fréquence fp d'un signal d'horloge pilote Sp comprend un comparateur de phase , un filtre 31, un oscillateur commandé en tension 32, des premier et second diviseurs de fréquence par M 33 et 34, M étant un entier prédéterminé inférieur à N, et un circuit de chargement 35. A titre d'exemple, les fréquences fp et fl sont 41, 66... Hz et 12,288 MHZ et l'entier M est 4096. Le comparateur de phase 30, le filtre 31 et l'oscillateur 32 sont connectés en cascade selon cet ordre. Une sortie de l'oscillateur 32 est reliée à deux entrées respectives des diviseurs de fréquence 33 et 34 réalisés chacun sous la forme d'un compteur. Des sorties des diviseurs 33 et 34 sont rebouclées sur des première et seconde entrées 301 et 302 du comparateur de phase 30. Le second diviseur de fréquence 34 reçoit à une entrée de réinitialisation RZ le signal d'horloge pilote Sp, une "réinitialisation" du diviseur 34 correspondant à une remise à zéro (RZ) du compteur d'impulsions du signal fl formant le diviseur 34. Le circuit de chargement 35 a Q entrées parallèles 350 à 35Q_1 connectées respectivement à Q étages de poids forts du compteur formant le diviseur de fréquence 34, et Q sorties appliquées à Q étages de poids forts du compteur formant le diviseur de fréquence 33. Le fonctionnement du dispositif d'asservissement de fréquence 3 selon l'invention est le suivant. Les deux diviseurs de fréquence 33 et 34 ont pour objet d'établir respectivement des signaux d'horloge d'asservissement S3 et S4 à une fréquence intermédiaire F qui est inférieure à et sous-multiple de la fréquence fl du signal d'horloge local Sl à générer mais qui est supérieure à et multiple de la fréquence fp du signal d'horloge pilote Sp. Le diviseur de fréquence par M 34 est réinitialisé, à la fréquence pilote fp, par des fronts montants du signal d'horloge pilote Sp. En raison de cette réinitialisation périodique, une référence de phase du signal d'horloge d'asservissement S4 est maintenue dans le temps en dépendance du signal Sp, ce qui autorise l'asservissement en fréquence. Si cette réinitialisation n'était pas opérée, un glissement des instants de phase significatifs des signaux S3 et S4 par rapport au signal de réinitialisation Sp se produirait au cours du temps en dépendance du glissement de fréquence permanent du signal d'horloge local S1 produit par l'oscillateur 32 autour de la fréquence (N x fp) et l'asservissement en fréquence ne pourrait être obtenu. Il est à noter que la fréquence F des signaux S3 et S4 doit être multiple de la fréquence pilote fp, à une variation près de la fréquence du signal Si produit par l'oscillateur 32 autour de la fréquence de maintien (Nxfp), pour éviter des sauts de phase périodiques, à la fréquence du signal d'horloge pilote Sp, du signal S4 par rapport au signal S3 en raison de la réinitialisation périodique du diviseur 34 par le signal Sp. Le comparateur de phase 30 compare la phase du signal S3 à la phase du signal S4, qui est constante en moyenne dans le temps grâce à la réinitialisation périodique du diviseur 34 par le signal Sp, et produit en réponse une tension de commande VC commandant l'oscillateur 32 à travers le filtre 31. L'oscillateur 32 produit le signal d'horloge local Sl pour que le signal d'horloge d'asservissement S3 soit asservi en phase au signal S4. Cet asservissement de phase assure, d'une part, que la fréquence locale fl est égale à N fois la fréquence pilote fp, et, d'autre part, que la phase du signal d'horloge local Sl coïncide périodiquement, à la fréquence locale fp, avec la phase du signal pilote Sp à un déphasage près. L'invention telle que décrite ci-dessus fait abstraction du fait que suite à une initialisation générale IG du dispositif d'asservissement 3, c'est- à-dire une mise sous tension de celui-ci, la phase d'un premier front montant du signal d'asservissement S4, dépendant d'un instant de réinitialisation du diviseur de fréquence 34 par le signal d'horloge pilote Sp, peut être très différente (déphasage sensiblement égal à 0 ou v pour un comparateur de phase sous la forme d'une porte OU EXCLUSIF) de la phase d'un premier front montant du signal d'asservissement S3 dépendant de l'instant d'initialisation générale du dispositif. Cela conduit alors à un temps de convergence relativement élevé pour l'asservissement de la fréquence locale fl à N fois la fréquence fp dû aux oscillations de la fréquence du signal Sl autour de la fréquence (N x fp). Le circuit de chargement 35 est destiné à remédier à cet inconvénient. Il comprend un additionneur 350. Les sorties des étages de poids forts du compteur formant le diviseur 34 sont appliquées respectivement à des premières entrées parallèles de l'additionneur 350. Des secondes entrées parallèles de l'additionneur 350 reçoivent un mot binaire prédéterminé WORD d'une mémoire morte câblée. Q sorties parallèles S de l'additionneur 350 sont appliquées respectivement à Q étages de poids forts du compteur formant le diviseur 33. En réponse à la mise sous tension du dispositif 3 par le signal d'initialisation générale IG, les compteurs formant les diviseurs 33 et 34 sont initialisés. Les valeurs binaires mémorisées dans les Q étages de poids forts du compteur formant le diviseur 34 sont appliquées aux premières entrées de l'additionneur 350. L'additionneur 350 additionne ces valeurs binaires au mot prédéterminé WORD et le résultat de cette addition est chargé dans les Q étages de poids forts du compteur formant le diviseur 33. Une initialisation générale IG du dispositif d'asservissement 3 est suivie par un chargement des valeurs mémorisées dans les Q étages binaires de poids forts du compteur formant le diviseur 34, auxquelles sont additionnées le mot WORD, dans les Q étages de poids forts dans le compteur formant le diviseur 33. Ce chargement a pour fonction de produire un déphasage entre les signaux d'asservissement S3 et S4. Ce déphasage est égal au rapport de la différence des valeurs respectives mémorisées dans les étages de poids faibles dans les deux compteurs des diviseurs 33 et 34 sur le nombre d'états de comptage des deux compteurs formant les diviseurs 33 et 34 multiplié par la période 1/F des signaux d'asservissement S3 et S4, de manière à commander l'oscillateur 32 dans sa plage d'acquisition en fréquence en évitant ainsi une oscillation de la fréquence fl produite par l'oscillateur 32 autour de la fréquence (Nxfp). Cette plage d'acquisition en fréquence de l'oscillateur est définie, en terme de phase, par un déphasage périodique entre les signaux S3 et S4 inférieur à un seuil prédéterminé autour d'un déphasage donné entre ces deux signaux correspondant à un maintien de la fréquence courante. Ce déphasage donné est fonction du type de comparateur de phase utilisé. A titre d'exemple, pour un comparateur sous la forme d'une porte OU EXCLUSIF, cette plage d'acquisition correspond à un déphasage entre les signaux S3 et S4 autour de (r/2). Le mot WORD est donc fonction du déphasage entre les signaux S3 et S4 pour lequel l'oscillateur 32 est commandé afin de maintenir la fréquence courante. Il est fonction du type de comparateur de phase utilisé. Suite à cette initialisation générale du dispositif 3, chaque front montant du signal pilote Sp qui est appliqué à l'entrée de réinitialisation RZ du compteur formant le diviseur 34 et à une entrée de chargement LOAD du compteur formant le diviseur 33, garantit la mise à zéro du compteur formant le diviseur 34 et le chargement des étages de poids forts du compteur du diviseur 33 par le mot WORD additionné aux valeurs mémorisées dans les étages de 1l poids forts du compteur 34. En fonctionnement normal ces mise à zéro et chargement des compteurs formant les diviseurs 33 et 34 confirment les valeurs binaires mémorisées dans ces compteurs. Par contre, une absence momentanée de réception du signal pilote Sp induisant une incrémentation à fréquence variable des compteurs 33 et 34 en dépendance de la variation de la fréquence fl autour de la fréquence de maintien (N x fp) est corrigée par un front montant du signal pilote Sp succédant à cette absence momentanée de réception par réinitialisation et chargement des compteurs 33 et 34. L'homme du métier appréciera que contrairement au dispositif de la figure 2, le dispositif d'asservissement 3 selon l'invention n'est pas affecté par un défaut de réception momentané du signal d'horloge pilote Sp. En effet, les deux signaux d'asservissement S3 et S4 continuent d'être produits par les deux diviseurs 33 et 34, et seule une dérive en fréquence du signal d'horloge local Sl se produit alors compte tenu de la perte momentanée de la phase du signal Sp du à ce défaut de réception momentané. Dans le cas du dispositif de la figure 2, un défaut de réception momentané du signal d'horloge pilote entraîne une perte durable du maintien de la fréquence fl à N fois la fréquence fp. REVENDICATIONS 1 - Dispositif (3) pour asservir une fréquence locale (fi) d'un signal d'horloge local (Sl) à N fois une fréquence pilote (fp) d'un signal d'horloge pilote (Sp), N étant un entier prédéterminé, comprenant, sous la forme d'une boucle de verrouillage de phase, des moyens de comparaison de phase (30) ayant des première et seconde entrées (301 o0 et 302) et produisant un signal de commande (VC), des moyens de filtrage (31) pour filtrer le signal de commande (VC), des moyens d'oscillation (32) commandés par le signal de commande filtré pour produire ledit signal d'horloge local (Sl), et des premiers moyens de division de fréquence par M (33), M étant un entier prédéterminé inférieur à N, pour diviser ladite fréquence locale (fl) en une fréquence intermédiaire (F) d'un premier signal d'asservissement (S3) appliqué à la première entrée (301) desdits moyens de comparaison de phase (100), caractérisé en ce qu'il comprend des seconds moyens de division de fréquence par M (34) pour diviser ladite fréquence locale (fl) en la fréquence intermédiaire (F) d'un second signal d'asservissement (S4) appliqué à la seconde entrée (302) desdits moyens de comparaison de phase (30) qui comparent des phases respectives desdits premier et second signaux d'asservissement (S3, S4) pour produire ledit signal de commande (VC), lesdits seconds moyens de division de fréquence (34) étant réinitialisés périodiquement à ladite fréquence pilote (fp) par le signal pilote (Sp). 2 - Dispositif conforme à la revendication 1, caractérisé en ce que lesdits premiers et seconds moyens de division de fréquence (33, 34) comprennent chacun un compteur modulo M, de préférence programmable, incrémenté par ledit signal d'horloge local (Sl). 3 - Dispositif conforme à la revendication 2, caractérisé en ce qu'il comprend des moyens (35) pour charger, en réponse à une initialisation générale du dispositif (3) et périodiquement à ladite fréquence pilote (fp) du signal pilote (Sp), des étages binaires de poids fort dudit compteur dans lesdits premiers moyens de division de fréquence (33) par un mot binaire prédéterminé (WORD) additionné à des valeurs binaires mémorisées respectivement dans des étages binaires de poids forts du compteur inclus dans lesdits seconds moyens de division de fréquence (34).