FR 2685518 A1 19930625 FR 9116046 A 19911223 CIRCUIT D'HORLOGE POUR SYSTEME DE LECTURE D'INFORMATIONS SEQUENTIELLES L'invention concerne un circuit d'horloge pour système de lecture d'informations séquentielles Elle est applicable par exemple à la lecture d'informations enregistrées sur bande magnétique, sur disques magnétiques ou sur disques optiques, notamment dans les périphériques informatiques. Dans un enregistreur numérique, le décodage des informations binaires passe par la régénération du signal de référence temporelle (horloge) qui a servi à l'enregistrement des informations Cette horloge est le plus souvent réalisée par un oscillateur (VCO: voltage controlled oscillator) inséré dans une boucle à verrouillage de phase (PLL: phase locked loop) qui se synchronise sur les transitions du signal de lecture. Dans un enregistreur multipiste, il est possible d'utiliser une seule horloge reconstruite pour l'ensemble des pistes, à condition que la synchronisation entre toutes les pistes inscrites sur la bande soit conservée Ceci suppose que les têtes d'enregistrement et les têtes de lecture soient alignées, et que la bande ne se déforme pas Si ces conditions ne sont pas strictement respectées, les références temporelles des diverses pistes se décalent les unes par rapport aux autres (phénomènes de glissement ou "skew") Il est possible de compenser les défauts de skew s'ils ne sont pas trop importants. Dans les autres cas, et en particulier dans les enregistreurs réalisant une haute densité d'informations selon le sens longitudinal de lecture du média d'enregistrement, et comportant un grand nombre de pistes parallèles, il est impossible de maintenir le skew suffisamment faible pour pouvoir le compenser sur l'ensemble des pistes Il est alors nécessaire de réaliser un circuit de régénération d'horloge indépendant pour chaque piste, ce qui conduit à avoir un grand nombre de circuits. L'invention a pour but de diminuer ce nombre de circuits d'horloge. Selon l'invention la réalisation numérique du régénérateur d'horloge permet, avec un seul ensemble d'opérateurs, de réaliser les opérations nécessaires séquentiellement sur un grand nombre de pistes, conduisant à une simplification importante de l'électronique L'invention tire profit des corrélations qui existent entre les horloges de chacune des pistes. Ce circuit séquentiel selon l'invention permet d'améliorer sensiblement les performances de l'ensemble du système. L'invention a pour objet un circuit d'horloge pour système de lecture d'informations séquentielles pour la lecture de plusieurs séries d'informations enregistrées selon sensiblement une même période, sur plusieurs moyens d'enregistrement et nécessitant pour la lecture une période d'échantillonnage déterminée, caractérisé en ce qu'il comprend: un circuit de calcul de phase recevant les informations lues et calculant la phase de chaque signal à partir de la lecture de deux échantillons successifs d'une 1 o même série d'informations et fournissant un signal de phase calculé, le circuit étant connectable sélectivement à différents moyens d'enregistrement; un circuit de comparaison de phase recevant chaque signal de phase calculé et le comparant à un signal d'oscillateur et fournissant un signal d'erreur; un filtre numérique recevant le signal d'erreur de phase le filtrant et fournissant un signal de contrôle d'oscillateur; un oscillateur numérique dont la fréquence et la phase sont contrôlée par le signal de contrôle d'oscillateur et fournissant un signal d'oscillateur, cet oscillateur numérique comportant un élément mémoire par série d'informations auxquelles est connectable le circuit de calcul de phase. Les différents objets et caractéristiques de l'invention apparaîtront plus clairement dans la description qui va suivre faite à titre d'exemple et dans les figures annexées qui représentent: la figure la, un schéma de principe d'une bande à verrouillage réalisée sous forme analogique; la figure lb, un schéma de principe d'une boucle à verrouillage de phase numérique; la figure 2, un exemple de réalisation détaillé d'un circuit de poursuite de phase tel qu'utilisé dans l'invention; les figures 3, 4 et 6, des exemples de réalisation du circuit de l'invention; la figure 5, une organisation de tête de lecture et d'inscription sur bande d'enregistrement. Le circuit de la figure 2 comporte une entrée de lecture Xk sur laquelle arrivent de façon séquentielle les informations d'une piste enregistrée Par exemple, cette piste enregistrée peut être une piste d'une bande d'enregistrement. Un circuit de calcul CP de la phase du signal reçoit les informations lues et calcule la phase du signal à partir des valeurs de deux échantillons successifs lorsqu'ils sont de signes opposés Pour cela un circuit RI mémorise une information lue et un circuit de calcul CCP calcule la différence de phase entre l'instant de détection d'un signal et l'instant de détection d'un signal suivant. Une boucle à verrouillage de phase comportant un circuit de comparaison de phase COMP compare la phase entre la phase calculée du signal et celle d'un oscillateur numérique VCO. Un filtre numérique FN filtre le signal d'erreur de phase et élabore un signal de contrôle de l'oscillateur. L'oscillateur numérique VCO délivre sur la sortie S un signal dont la fréquence et la phase sont contrôlées par le signal filtré du filtre numérique FN Les circuits OP 1, OP 2, OP 3 sont des opérateurs additionneurs Le rôle du circuit de la figure 2 est d'élaborer, pour chaque nouvel échantillon de signal xk, une estimation de la phase de cet échantillon, la référence de phase étant l'horloge bit (oscillateur VCO), c'est-à-dire les instants théoriques de transition Lorsqu'il y a une transition du signal, le circuit de calcul de phase peut délivrer une valeur mesurée de la phase du signal, et après filtrage, cette nouvelle valeur sert à actualiser l'estimation de phase. L'algorithme proposé pour ajuster l'instant de décision optimal ou pour suivre la phase du signal à démoduler (dans le récepteur) est connu Il est basé sur les équations suivantes: Dico, e + -0 = ( 0,,,o /e) + xaà ec) + 2 ir Tef (C))2,r j A O e) = (bis) 2 ir Te A O (k (d, kie c O ki)2 avec Te: période d'échantillonnage fixe du système. Si l'on normalise la fréquence et la phase, ce système d'équations peut être écrit plus simplement: f I + =f)+ 3 A Ok) La phase future du signal est prédite en fonction de la phase actuelle de l'oscillateur, de sa période d'horloge, et d'une erreur de phase pondérée entre le signal d'entrée et l'oscillateur La correction de l'écart de phase n'est appliquée que lorsqu'une mesure de la phase du signal est disponible; sinon la phase de i O l'oscillateur est maintenue à une période près. Ces équations décrivent le fonctionnement d'une boucle à verrouillage de phase numérique du second ordre constituée par un oscillateur commandé (VCO) fournissant un signal de fréquence f(k) et de phase L Dvco(k) entre le signal du VCO et un signal de référence (noté Fsignal ou FS). ca et 1 P sont des coefficients de pondération ajustant le poids de la dernière mesure effectuée et sont appelés paramètres de boucle Les schémas blocs de boucles à verrouillage de phase analogique et numérique sont présentés en figures la et lb. Sur la figure 2, les différents circuits comportent des circuits à retard Rl, R 2, R 3 qui ont pour temps de retard la période d'échantillonnage D du signal à lire Selon cet exemple de réalisation, le support d'enregistrement étant une bande magnétique, on a un circuit tel que celui de la figure 2 par piste d'enregistrement. La phase du signal est calculée à partir de la valeur de deux échantillons successifs lorsqu'il y a changement de signe entre ces deux échantillons Le calcul est fait à partir d'une ROM selon la technique "loop-up table". Dans un système multipiste, N pistes sont lues simultanément Selon le mode de réalisation et de mise en oeuvre du système de lecture, N échantillons correspondant aux N pistes lues sont disponibles simultanément à chaque instant d'échantillonnage, ou délivrés successivement pendant la durée de la période d'échantillonnage. Le circuit de la figure 2 est applicable à un système multipistes ou plus généralement à un système à N pistes indépendantes Pour cela, on le fera travailler successivement sur les échantillons de données correspondant à chacune des n pistes, dans leur ordre d'arrivée Afin d'effectuer aux instants i+kn l'ensemble des opérations décrites par l'algorithme pour la piste i, on doit présenter à l'entrée des opérateurs, à ces instants, les grandeurs qu'il est nécessaire de conserver en mémoire, soit (xk, eks flk)* La figure 3 représente un exemple de réalisation dans lequel le support d'enregistrement comporte plusieurs pistes d'informations en parallèle. Au lieu de prévoir un circuit d'horloge par piste, on prévoit un circuit d'horloge pour un nombre N de pistes. Dans ce cas, chaque circuit à retard Rl, R 2, R 3 est en fait un ensemble de N circuit à retard (correspondant au nombre N de pistes) En effet, les N pistes sont lues quasi simultanément et il s'agit d'affecter un signal d'horloge à chaque piste Plus précisément, le circuit de calcul de phase CP est connecté sélectivement et successivement par des moyens de commutation non représentés au circuit d'entrée xk. Les circuits à retard constituent des registres à décalage de longueur n, ou des buffers circulaires réalisés à partir de RAM, permettant de conserver les résultats intermédiaires de chacune des N pistes à traiter A l'instant i+kn, les grandeurs O *f,,x,,x'k correspondant à la piste i sont présentes aux entrées des opérateurs, et permettent l'estimation de k+ et fk'+, Un instant plus tard, la piste i+ 1 est traitée Après N coups d'horloge, on traite à nouveau la piste i. La boucle de phase précédemment décrite est du second ordre puisqu'elle estime deux paramètres du signal (fréquence et phase) L'estimation de la fréquence est rendue délicate par la grande précision requise Compte tenu du rapport signal à bruit faible que l'on trouve typiquement dans un enregistreur à haute densité, le coefficient,3 est petit (typiquement 5 10-3), ce qui conduit à des calculs sur 16 ou 24 bits Ceci entraîne également une phase d'accrochage (période transitoire au démarrage du processus) longue et délicate Pour ces raisons, beaucoup de circuits d'horloge utilisés en enregistrement sont simplement des filtres du premier ordre. Si l'on considère que la fréquence du signal est proportionnelle à la vitesse de la bande, et si les têtes sont alignées, alors la fréquence instantanée est sensiblement la même sur chacune des pistes On peut alors améliorer sensiblement l'estimation de la fréquence sur une piste en la remplaçant par la moyenne des estimations faites sur l'ensemble des pistes Ainsi, si l'on moyenne les résultats de n pistes indépendantes, le rapport signal à bruit pourra être amélioré de W/iï. Comme cela est représenté en figure 4, le circuit est modifié de façon qu'un même registre mémoire R 3 est utilisé pour stocker la fréquence de chacune des N pistes, réalisant ainsi une moyenne des N estimations individuelles de la fréquence. Cette solution présente les avantages suivants: la fréquence est estimée avec une plus grande précision, ce qui conduit à une augmentation du gain et/ou de la bande passante de la boucle; la phase d'accrochage est plus rapide, et la tenue en l'absence momentanée de signal sur une piste est améliorée, puisque l'ensemble des pistes contribuent à l'estimation La probabilité que la plupart des pistes soit en défaut est très faible; il est possible de sécuriser le système multipiste en dédiant une piste au contrôle de la vitesse, par l'enregistrement sur cette piste d'un signal à fréquence fixe, ou d'un code à fort contenu d'horloge (par exemple FM ou biphase) qui servira par ailleurs de piste de contrôle (enregistrement de time-code ou d'autres signaux de service); il devient possible d'utiliser des codes sans contrainte de longueur maximale sans transition (maximum run-length codes): par exemple NRZ scramblé, ou d'utiliser des codes à fenêtre temporelle étroite: par exemple les codes Run Limited Length (RLL) de type (d, k) ( 1, x). La figure 5 représente un exemple d'un enregistreur à têtes statiques, o les deux têtes n'ont pas la même géométrie: ici, la tête d'écriture INS a une géométrie "matricielle" c'est-à-dire que les entrefers sont disposés selon m lignes de n têtes, alors que la tête de lecture LEC a tous ses entrefers disposés en ligne On ne peut alors considérer que la fréquence instantanée du signal n'est la même que pour les pistes dont les têtes d'écriture appartiennent à la même ligne verticale On devra donc dans ce cas effectuer m estimations de la fréquence, pour les m groupes de N têtes Ceci est obtenu grâce à un registre à décalage de m états Bien entendu cette méthode est applicable au cas o la tête de lecture a aussi une structure matricielle. La solution décrite ici, consistant à ne mettre en commun les estimations de fréquence des diverses pistes que lorsqu'elles sont proches s'étend aux cas o par suite du grand nombre de pistes et de la haute densité d'enregistrement, on ne peut plus considérer que la fréquence du signal est rigoureusement la même d'un bord à l'autre de la bande Dans ce cas, on séparera les pistes par groupes présentant des caractéristiques voisines, et on utilisera autant de cases mémoires que de groupes à traiter distinctement. Cette structure peut être utilisée dans bon nombre de circuits numériques multicanaux, lorsque des paramètres à estimer sont commun aux diverses voies. La description qui précède n'a été faite qu'à titre d'exemple en application à la lecture d'informations sur bande Cependant, le circuit de 1 o l'invention peut être utilisé dans tout autre type d'applications pour la lecture d'informations séquentielles (numériques notamment). Dans ces types d'applications, il s'agira de préférence d'avoir à lire des informations dont certains paramètres à estimer sont communs aux différentes voies Par ailleurs, les exemples de réalisation ne sont donnés que pour illustrer la description et d'autres variantes peuvent être envisagées sans sortir du cadre de l'invention, notamment dans les figures décrites, on a utilisé des circuits à retard mais on aurait pu utiliser des mémoires. Egalement, pour l'entrée du circuit de calcul de phase CCP, il importe peu que les échantillons de signaux xk proviennent directement (et séquentiellement) du support d'enregistrement ou qu'ils proviennent de mémoires intermédiaires o elles ont été enregistrées simultanément. REVENDICATIONS 1 Circuit d'horloge pour système de lecture d'informations séquentielles pour la lecture de plusieurs séries d'informations enregistrées selon sensiblement une même période, sur plusieurs moyens d'enregistrement et nécessitant pour la lecture une période d'échantillonnage déterminée, caractérisé en ce qu'il comprend: un circuit de calcul de phase recevant les informations lues et calculant la phase de chaque signal à partir de la lecture de deux échantillons successifs d'une même série d'informations et fournissant un signal de phase calculé, le circuit étant connectable sélectivement à différents moyens d'enregistrement; un circuit de comparaison de phase recevant chaque signal de phase calculé et le comparant à un signal d'oscillateur et fournissant un signal d'erreur; un filtre numérique recevant le signal d'erreur de phase le filtrant et fournissant un signal de contrôle d'oscillateur; un oscillateur numérique dont la fréquence et la phase sont contrôlée par le signal de contrôle d'oscillateur et fournissant un signal d'oscillateur, cet oscillateur numérique comportant un élément mémoire par série d'informations auxquelles est connectable le circuit de calcul de phase. 2 Circuit d'horloge selon la revendication 1, caractérisé en ce qu'il comporte des moyens de commutation permettant de connecter sélectivement le circuit de calcul de phase sur les différents moyens d'enregistrement, la période de commutation de ces moyens de commutation étant telle que le temps séparant deux connexions successives du circuit de calcul de phase à un moyen d'enregistrement déterminé est sensiblement égal à un multiple de la période échantillonnage sur la piste. 3 Circuit d'horloge selon la revendication 2, caractérisé en ce que le circuit de calcul de phase comporte un élément mémoire par série d'informations auxquelles est connectable le circuit de calcul de phase. 4 Circuit d'horloge selon la revendication 1, caractérisé en ce que le filtre numérique comporte un élément mémoire de signaux de phase calculé par série d'informations auxquelles est connectable le circuit de calcul de phase. Circuit d'horloge selon la revendication 1, caractérisé en ce qu'il comporte un nombre m de groupes de N séries d'informations, le circuit de calcul de phase comporte m N éléments mémoire, l'oscillateur numérique comporte m n éléments mémoire. 6 Circuit d'horloge selon la revendication 5, caractérisé en ce que le filtre numérique comporte m N éléments mémoire. 7 Circuit d'horloge selon la revendication 5, caractérisé en ce que le filtre numérique comporte m éléments mémoire. 8 Circuit d'horloge selon l'une des revendications 3 ou 5, caractérisé en ce que le filtre numérique comporte un seul élément mémoire. 9 Circuit d'horloge selon l'une quelconque des revendications 1 o précédentes, caractérisé en ce que chaque élément mémoire comporte au moins un circuit à retard. Circuit d'horloge selon la revendication 9, caractérisé en ce que dans le circuit de calcul de phase, dans le filtre numérique, et dans l'oscillateur numérique, la combinaison de plusieurs éléments mémoire est réalisée par la mise en série de plusieurs circuits à retard. 11 Circuit d'horloge selon la revendication 10, caractérisé en ce que chaque circuit à retard détermine un temps de retard correspondant à un temps de commutation séparant la connexion du circuit de calcul de phase à deux moyens d'enregistrement consécutifs. 12 Circuit selon la revendication 11, caractérisé en ce que l'oscillateur numérique (VCO) comporte une boucle à retard dont le temps de retard correspond à la période d'échantillonnage (lecture) du support. 13 Circuit selon la revendication 11, caractérisé en ce que le circuit de calcul de phase comporte un circuit à retard dont le temps de retard correspond à la période d'échantillonnage du support d'enregistrement. 14 Circuit selon la revendication 11, caractérisé en ce que le filtre numérique comporte au moins un circuit à retard dont le temps de retard correspond à la période d'échantillonnage du support. Circuit selon l'une des revendications 12 à 14, caractérisé en ce que le support d'enregistrement comporte plusieurs séries d'un nombre déterminé n d'informations lues en parallèle, et chaque boucle à retard comporte un même nombre N de circuits à retard, la sommes des retards des circuits d'une boucle à retard étant égal à la période d'échantillonnage. 16 Circuit selon l'une des revendications 12 à 14, caractérisé en ce que le support d'enregistrement comporte une série d'un nombre déterminé n d'informations, le filtre numérique comporte un circuit à retard correspondant à la période d'échantillonnage du support d'enregistrement; l'oscillateur (VCO) et le circuit de calcul de phase comportent chacun ledit nombre déterminé N de circuit à retard dont la somme des retards correspond à la période d'échantillonnage du support d'enregistrement. 17 Circuit selon la revendication 15, caractérisé en ce qu'il comporte un seul circuit d'horloge commun aux différentes séries d'informations; le circuit 1 o de calcul de phase et l'oscillateur comportent chacun un nombre de circuits à retards égal au nombre de séries d'informations N multiplié par le nombre d'informations N contenues dans une série, la durée totale du retard de chacun de ces ensembles de circuits à retard étant égal à la période d'échantillonnage des informations à lire; le filtre numérique comporte un nombre de circuits à retard égal au nombre d'informations contenues dans une série. 18 Circuit selon la revendication 1, caractérisé en ce que les différents moyens d'enregistrement sont réalisés sur un même support d'enregistrement. 19 Circuit selon la revendication 18, caractérisé en ce que le support d'enregistrement est une bande magnétique.