FR 2584848 A1 19870116 FR 8610025 A 19860709 La présente invention concerne un circuit détecteur d'erreurs pouvant être utilisé, par exemple, dans un appareil de reproduction ou de lecture de signaux numériques, tel qu'un appareil d'enregistrement et de lecture numériques à bande magnétique d'images ou magnétoscope'numérique. Dans un magnétoscope numérique, o l'enregistrement et la lecture s'effectuent avec utilisation d'un signal vidéo couleur composite, numérisé, une information erronée se produisant lors de la lecture normale peut être détectée au moyen de codes détecteurs ou correcteurs d'erreurs. Dans la pratique, une erreur est corrigée lorsqu'une correction d'erreurs est possible au moyen du code correcteur d'erreurs, tandis qu'une erreur qui ne peut pas être corrigée est interpolée à l'aide de valeurs moyennes ou de manière analogue. Par contre, lors d'une lecture à vitesse variable, la tête rotative effectue un balayage en travers de plusieurs pistes, en raison des changements de la vitesse de la bande magné- tique, de sorte qu'il devient impossible d'obtenir des informations continues. De ce fait, la correction d'erreurs au moyen d'un code correcteur d'erreurs est généralement considérée comme posant des problèmes. On envisage d'employer des codes correcteurs d'erreurs de faible longueur de code, pour que des erreurs puissent également être corrigées pendant la lecture à vitesse variable; cette solution pose cependant le problème que l'information vidéo exacte n'est pas utilisée, bien qu'elle soit en elle-même exacte, puisque la longueur d'entrelacement du code correcteur d'erreurs est courte lorsque le code redondant en tant que code correcteur d'erreurs est inexact. De plus, comme les erreurs augmentent en nombre lors d'une lecture à vitesse variable, il se pose le problème supplémentaire qu'une correction d'erreurs convenable n'est pas possible lorsqu'elle est basée sur le résultat détecté par des codes correcteurs d'erreurs. L'invention vise à procurer un circuit détecteur d'erreurs qui supprime le défaut décrit ci-dessus du circuit clas- sique; qui puisse détecter les erreurs sans l'emploi de codes détecteurs ou correcteurs d'erreurs; qui soit capable de détecter convenablement la position des informations erronées et, enfin, qui soit utilisable lors de la lecture à vitesse variable dans un magnétoscope numérique. Le circuit détecteur d'erreurs selon l'invention, utilisé pour un signal vidéo numérique contenant des bruits aléa- toires, comprend un circuit pour détecter le niveau de signal en dehors de la bande de fréquences du signal vidéo numérique et est conçu pour détecter la position d'une erreur dans le signal vidéo numérique en fonction du signal de sortie du circuit de détection. Le circuit détecteur comprend un premier filtre passe-haut et un premier circuit détecteur de crêtes et il est conçu pour déterminer la position d'une erreur d'après un signal de valeur de crête fourni par le premier circuit détecteur de crêtes. Le circuit détecteur comprend un second filtre passe-haut qui est connecté à la sortie du premier filtre passe- haut, de même qu'un second circuit détecteur de crêtes, et il est conçu pour déterminer la position d'une erreur par la détection de motifs de signaux de valeur de crête fournis par le premier et le second circuit détecteur de crêtes. Les informations erronées peuvent être détectées par la détection d'un composant hors bande d'un signal vidéo. Le composant compris dans la bande passante du signal vidéo est enlevé au moyen d'un filtre éLiminateur de bande et des filtres passe-haut, le composant hors bande du signal vidéo étant délivré à la sortie des filtres passe-haut. La valeur de crête du signal à La sortie du premier filtre passe-haut et la valeur de crête du signal à la sortie du second filtre passe-haut, lequel est connecté à la sortie du premier filtre passe-haut, présentent des motifs spécifiques qui corres- pondent à la position o L'information erronée est générée. En soumettant ces motifs à une détection, on peut déterminer la position o L'information erronée s'est produite. D'autres caractéristiques et avantages de l'invention ressortiront plus clairement de la description qui va suivre de plusieurs modes de réalisation non limitatifs, ainsi que des dessins annexés, sur lesquels: - la figure I montre une table spectrale servant à expliquer un mode de réalisation de l'invention; - la figure 2 est le schéma synoptique d'un circuit détecteur d'erreurs selon un mode de réalisation de l'invention; - la figure 3 est le schéma synoptique d'un filtre éLiminateur de bande utilisé dans un circuit détecteur d'erreurs selon l'invention; - la figure 4 est le schéma synoptique d'un filtre passe-haut utilisé dans un circuit détecteur d'erreurs selon l'invention; - la figure 5 représenteune forme d'onde servant à expliquer un circuit détecteur d'erreurs selon l'invention; - la figure 6 est une représentation schématique servant à expliquer la détection des crêtes dans un circuit détecteur d'erreurs selon l'invention; - les figures 7 A, B et C sont des représentations schématiques servant à expliquer le fonctionnement d'un circuit détecteur d'erreurs selon l'invention; - les figures 8A et 8B représentent les schémas de circuits de valeur absolue, de circuits détecteurs de crêtes et de circuits suppresseurs de bruit utilisés dans un circuit détecteur d'erreurs selon l'invention; - les figures 9A et 9B sont des représentations schématiques pour expliquer le fonctionnement des circuits détecteurs de crêtes des figures 8A et 8B; la figure 10 représente le schéma d'un circuit détecteur de motifs utilisé dans un circuit détecteur d'erreurs selon l'invention; et - les figures 11 A, B et C sont des diagrammes de temps utilisés pour expliquer le fonctionnement du circuit détecteur de motifs représenté sur la figure 10. La description qui va suivre porte sur un mode de réalisation préféré de l'invention. Dans un magnétoscope numérique, avec numérisation d'un signal video couleur composite et enregistrement de ce signal sur une bande magnétique à l'aide d'une tête magnétique rotative, on a prévu un processus de réarrangement. Ce processus provoquant la dispersion d'un paquet d'erreurs à la remise dans L'ordre initial, pendant la reproduction, les informations erronées n'apparaissent pas l'une après l'autre mais sous forme d'erreurs aléatoires d'un échantillon ou de deux échantillons dans l'information numérique reproduite. La fréquence maximale du signal vidéo est limitée, par exemple à 4,2 MHzdans le système NTSC, comme représenté sur la figure 1. Si un signal reproduit contient l'une des erreurs aléa- toires mentionnées ci-dessus, un composant de signal hors de la bande de fréquences du signal vidéo sera contenu dans le signal reproduit. La détection du composant hors bande du signal vidéo permet par conséquent de détecter l'information erronée. Lorsqu'on se reporte maintenant à la figure 2, la borne d'entrée 1 reçoit un signal vidéo couleur composite, numé- rique, de 8 bits par exemple, qui a été lu par une tête magnétique rotative dans un magnétoscope numérique. Ce signal est numérisé à la cadence d'échantillonnage correspondant à quatre fois la fréquence de la sous-porteuse de couleur. A partir de la borne d'entrée 1, il est envoyé à travers un circuit à retard 2 et un sélecteur 3 à une borne de sortie 4 pour le contrôle, de même qu'à un étage suivant. A cet effet, le signal vidéo couleur composite, numérisé, est appliqué, à partir de la borne d'entrée 1, à un filtre éliminateur de bande 5, comprimant le composant de fréquence de sous-porteuse de couleur, à 3,58 MHz par exemple, en commençant par le composant de fréquence de sousporteuse de couleur de grande puissance. Le signal de sortie du filtre éliminateur de bande 5 est appliqué à un filtre passe-haut 6A pour permettre le passage à travers ce filtre du composant hors de la bande du signal vidéo, du composant dépassant 4,2 MHz par exemple, le signal de sortie du filtre passe-haut 6A étant appliqué à un filtre passe- haut 6B, par lequel le composant compris dans la bande passante du signal vidéo est enlevé. Comme filtre éliminateur de bande 5, la figure 3 représente, à titre d'exemple, un filtre numérique qui est constitué de circuits à retard à un échantillon 51, 52, 53 et 54, de circuits additionneurs 55 et 56 et de circuits de multiplication par 1/2 57 et 58, et dont la fonction de transfert H(z) correspond à: H(z) = (1 + 2Z-2 + Z-4) / 4 En tant que filtres passe-haut 6A et 6B, on utilise, par exemple, un filtre numérique comme celui représenté sur la figure 4, comprenant des circuits à retard à un échantillon 61 et 62, des circuits additionneurs 63 et 64 et des circuits de multiplication par 1/2 65 et 66, et dont la fonction de transfert H(z) correspond à: H(z) = (-1 + 2Z-1 - 2) / 4. Comme le signal de sortie du filtre passe-haut 6A est appliqué à l'entrée du filtre passe-haut 6B, ces deux filtres forment ensemble un filtre numérique dont la fonction de trans- fert H(z) possède une caractéristique à pente raide et corres- pondant à: H(z) = (-1 + 2Z-1 - Z-2)(- 1 + 2Z- + Z-2)/16. La sortie du filtre passe-haut 6B délivre seulement le composant hors bande du signal vidéo et l'apparition ou non de ce composant à la sortie du filtre 6B indique si le signal vidéo contient ou non une information erronée. Si le signal vidéo contient une erreur, le filtre passe-haut 6B fournit un signal de sortie. Si le signal vidéo ne contient pas d'erreur, ce filtre ne fournit pas de signal de sortie. Cependant, il est difficile de déterminer la position de l'information erronée d'après le seul signal de sortie du filtre passe-haut 6B. Plus précisément, lorsque la présence d'une infor- mation erronée est détectée, le filtre numérique délivre un signal de sortie comme celui représenté sur la figure 5. Du fait que le filtre possède une caractéristique à pente raide, il y a beaucoup de résonance et des valeurs de crête du signal de sortie du filtre apparaissent en plusieurs positions. De plus, si l'information introduite dans le filtre contient une erreur sur deux ou davantage d'échantillons, les valeurs de crête du signal de sortie du filtre ne correspondent pas toujours aux positions de l'information erronée. Pour déterminer la position de l'information erronée d'après le signal de sortie du filtre, l'invention prévoit un circuit de valeur absolue 7A, un circuit détecteur de crêtes 8A et un circuit suppresseur de bruit 9A pour la sortie du filtre passe- haut 6A, de même qu'un circuit de valeur absolue 78, un circuit détecteur de crêtes 8B et un circuit suppresseur de bruit 9B pour la sortie du filtre passe-haut 6B. Comme la caractéristique du filtre passe-haut 6A est progressive comparativement à la caractéristique de la combinaison des deux filtres passe-haut 6A et 68, il n'y a pas autant de résonance dans le premier. Les signaux de sortie des filtres passe-haut 6A et 68 sont transformés, par les circuits de valeur absolue 7A et 7B, en informations de valeur absolue, comme indiqué sur la figure 6, qui sont fournies aux circuits détecteurs de crêtes 8A et 8B. Dans ces derniers, on obtient des valeurs de crête P1 et P2 des signaux de sortie des filtres passe-haut 6A et 6B, après passage par les circuits de valeur absolue 7A et 7B. Ces signaux de sortie des circuits détecteurs de crêtes 8A et 8B sont appliqués, à travers les circuits suppresseurs de bruit 9A et 9B, à un circuit détecteur de motifs 10. Les circuits suppresseurs de bruit 9A et 9B sont dotés de seuils qui font que ces circuits suppresseurs de bruit éliminent les valeurs de crête P1 et P2 de niveau relativement bas et qui sont pas nécessaires pour la détection des motifs. La position de l'erreur est trouvée dans le circuit détecteur de motifs 10 sur la base des valeurs de crête P1 et P2 qui sont appliquées à ce circuit à travers les circuits suppresseurs de bruit 9A et 9B. Si l'information erronée E porte sur un échan- tillon, les valeurs de crête P1 et P2 correspondent à La position de L'information erronée. Au cas o l'information erronée porte sur deux échantillons, les valeurs de crête P1 fournies par le circuit suppresseur de bruit 9A et les valeurs de crête P2 fournies par le circuit suppresseur de bruit 9B apparaissent sous forme de motifs spécifiques, par exemple comme représenté sur les figures 7A à 7C, en raison de la dispersion de l'information erronée E. Le circuit 10 détecte l'appartenance des motifs des valeurs de crête P1 et P2 qui lui sont fournies par les circuits suppresseurs de bruit 9A et 9B et détermine ainsi les positions des informations erronées. Les impulsions d'erreur EP, voir les figures 7A à 7C, sont produites en concordance avec les positions des informations erronées par le circuit 10 et ces impulsions d'erreur sont fournies à un circuit additionneur 11. Le signal de sortie de ce dernier est appliqué à une borne 12 de sortie d'impulsions d'erreur. Ces impulsions d'erreur EP sont transmises à un circuit correcteur d'erreurs dans - un étage suivant, non représenté. La référence 13 sur la figure 2 désigne un circuit détecteur d'information FF (de fréquence de trame) servant à détecter une information "FF" de nombre hexadécimal. Au cas o il est détecté une information hexadécimale "FF", qui ne pourrait pas être l'information d'échantillonnage du signal vidéo, pendant qu'un signal vidéo couleur, numérique, d'entrée, est fourni depuis la borne d'entrée 1 et à travers le circuit à retard 2 au circuit détecteur FF 13, ce dernier produit une impulsion d'erreur et cette impulsion est appliquée au circuit additionneur 11. La référence 14 désigne un circuit détecteur de suppression du noir. Le signal du filtre étiminateur de bande 5 est appliqué à ce circuit 14 pourêtre comparé avec l'information pour le niveau de suppression. Au cas o le circuit 14 détecte une information au-dessous du niveau de suppression, un signal de détection est appliqué à une borne de sortie 15, d'o ce signal est transmis à un circuit détecteur de suppression du noir (non représenté) et transformé en information de niveau de suppression. Le sélecteur 3 est prévu pour que le composant hors bande du signal vidéo puisse être sorti à des fins de contr8le. Le sélecteur 3 reçoit à son entrée les signaux de sortie du circuit à retard 2 et du filtre passehaut 6B et il transmet sélec-vement l'un ou l'autre à la borne de sortie 4. Les motifs dont il a été question dans ce qui précède dépendent des caractéristiques de filtrage pour supprimer la bande du signal vidéo couleur. Différents autres motifs sont possibles, suivant les caractéristiques de filtrage, en dehors de ceux repré- sentés sur la figure 7. Au cas o le circuit 10 de détection de motifs détecte un motif qui n'est pas préétabli dans ce circuit, il détermine si oui ou non une valeur de crête P2, ayant traversé le circuit sup- presseur de bruit 9B, est présente, par exemple, dans deux échan- tillons avant et après la valeur de crête P1, qui a traversé le circuit suppresseur de bruit 9A; si la valeur de crête P2 y est détectée, le circuit 10 établit que cette information correspond à l'information erronée. La détection de P2 peut être effectuée dans un échantillon avant et un échantillon après la valeur de crête P1, mais on peut également prévoir une commutation, suivant les circonstances. La figure 8A montre le circuit de valeur absolue 7A, recevant l'information délivrée par la sortie du filtre passe-haut 6A. Le circuit 7A produit la valeur absolue de cette information reçue à son entrée. Un circuit à retard 80A reçoit le signal de sortie du circuit de valeur absolue 7A et produit un signal de sortie retardé d'un échantillon et un autre signal de sortie retardé d'un échantillon, qui est inversé par rapport au premier. Ces deux signaux de sortie sont appliqués à un circuit additionneur 81A qui est destiné à produire la différence entre les deux. Le signal de sortie du circuit additionneur 81A est retardé d'un échantillon par un circuit à retard 82A. Un circuit 83A détecteur de flancs positifs délivre un signal de détection lorsque le signal de sortie du circuit à retard 82A est supérieur ou égal à huit. Un additionneur 84A produit un signal de détection négatif lorsque la sortie de l'addi- tionneur 84A produit un signal de report. Un circuit 85A détecteur de flancs négatifs reçoit le signal de sortie du circuit à retard 82A et le signal de sortie de l'additionneur 84A, à travers le circuit à retard 82A. Le circuit 85A produit un signal de détection lorsque le signal de sortie du circuit à retard 82A est inférieur ou égal à moins 8. Un circuit 86A détecteur de zone produit un signal de détection Lorsque le signal de sortie du circuit à retard 82A est compris entre moins sept et sept. Un circuit 87A de réglage du niveau de seuil dyna- mique produit une information de niveau de seuil X et Y, laquelle est réglée à partir d'une borne d'entrée de réglage. L'information de niveau de seuil est appliquée à un circuit comparateur 88A qui compare un bit inférieur du signal de sortie du circuit à retard 82A et un bit inférieur retardé d'une période d'horloge avec l'infor- mation de niveau de seuil. Un circuit Logique 89A de détection de crêtes reçoit le signal de détection de flancs positifs, le signal de détection de flancs négatifs et le signal de détection de zone, ensemble avec des signaux de sortie du circuit comparateur 88A, et produit un signal de point de crête lorsqu'une information de valeur absolue et inférieure est suivie par une information de valeur absolue plus élevée et lorsqu'une information de valeur absolue inférieure consé- cutive, ou une information de valeur absolue inférieure, est suivie par deux informations de valeur absolue plus élevée,limitée par l'information de niveau de seuil, ou lorsque deux informations de valeur absolue plus élevée sont suivies par une information de valeur absolue inférieure, comme représenté sur la figure 9A. Le signal de sortie retardé d'une période d'horloge, du circuit à retard 80A, est appliqué à un circuit 91A de réglage de niveau de seuil. Un signal de sortie de ce circuit 91A est appliqué à un circuit de porte 92A en tant que signal de porte pour faire passer le signal de point de crête à travers le circuit 92A en qualité de signal de sortie indicateur de crête P1. La figure 8B représente Le circuit de valeur absolue 7B, recevant l'information de sortie délivrée par le filtre passe-haut 68. Le circuit de valeur absolue 7B produit la valeur absolue de l'information appliquée à son entrée. Un circuit à retard 80B reçoit Le signal de sortie du circuit de valeur absolue 7B et produit un signal de sortie retardé d'un échantillon et un autre signal de sortie retardé d'un échantillon mais inversé par rapport au premier. Ces deux signaux de sortie du circuit à retard 80B sont appliqués à un circuit additionneur 81B destiné à produire la différence entre les signaux reçus à son entrée. Le signal de sortie du circuit additionneur 81B est retardé d'un échantillon par un circuit à retard 82B. Un circuit 83B détecteur de flancs positifs produit un signal de détection lorsque le signal de sortie du circuit à retard 82B est positif. Un additionneur 84B produit un signal de détection négatif lorsque la sortie de l'additionneur 84A produit un signal de report. Un circuit logique 89B de détection de crêtes reçoit le signal de détection de flanc positif et le signal de détection de flanc négatif, retardé d'une période d'horloge, et produit un signal de point de crête lorsqu'une information de valeur absolue inférieure est suivie par une information de valeur absolue plus élevée et lorsqu'une information de valeur absolue inférieure consécutive, ou une information de valeur absolue inférieure, est suivie par deux informations de valeur absolue plus élevée, ou lorsque deux informations de valeur absolue plus élevée sont suivies par une information de valeur absolue inférieure, comme représenté sur la figure 9B. Le signal de sortie retardé d'une période d'horloge, du circuit à retard 80B, est appliqué à un circuit 91B de réglage de niveau de seuil. Le signal de sortie de ce circuit 91B est fourni à un circuit de porte 92B comme signal de porte pour faire passer le signal de point de crête par le circuit 92B en qualité de signal de sortie indicateur de crête P2. Sur la figure 10, on voit que le signal indicateur de crête P1 est transmis à un registre à décalage 101A et que le signal indicateur de crête P2 est transmis à un registre à déca- lage 101B. Les signaux de sortie QA' QB QD à QG du registre à décalage 101A et les signaux de sortie QA à QF du registre à décalage 101B sont transmis à un circuit Logique 102 qui délivre à sa sortie un signal indicateur d'erreur P. Le circuit logique 102 peut être remplacé par une mémoire morte (ROM). Dans ce cas, les signaux de sortie des registres à décalage 101A et 101B sont transmis à la borne d'adresse de cette mémoire morte en tant que signal d'adresse et le signal indicateur d'erreur P est obtenu sous forme d'une information de -sortie de cette mémoire. Les figures 11 A à C montrent les informations binaires aux points (a) à (p) du circuit logique 102, dans une séquence chronologique, en cas d'apparition des motifs de crête représentés sur les figures 7A, 7B respectivement 7C. Selon l'invention, comme la détection d'erreurs est effectuée par la détection d'un composant hors bande du signal vidéo, une détection d'erreurs convenable est possible même à la lecture à vitesse variable, sans qu'il se pose le problème de l'impossibilité d'effectuer une correction d'erreurs convenable comme cela est le cas pour l'emploi d'un code correcteur d'erreurs. De plus, grâce à l'utilisation des signaux de sortie de deux filtres passe-haut, il est possible de détecter convenablement la position de l'information erronée. REVENDICATIONS 1. Circuit détecteur d'erreurs, caractérisé en ce qu'il comprend: un circuit d'entrée (1, 2) recevant un signal numé- rique, obtenu par conversion d'un signal analogique, le circuit d'entrée possédant un circuit éliminateur (2) pour éliminer un com- posant de signal hors de la bande de fréquences du signal analogique; un premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 8B, 98) qui est connecté au circuit d'entrée (1, 5) et est destiné à détecter un niveau de signal hors de la bande de fréquences du signal numérique appliqué au circuit d'entrée (1, 5); et un deuxième circuit de détection (10) qui est connecté au premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 8B, 9B) et est destiné à détecter la position d'une erreur dans le signal numérique d'après le signal de sortie du premier circuit -de détection (6A, 7A, 8A, 9A, 6B, 7B, 8B, 98). 2. Circuit détecteur d'erreurs selon La revendication 1, dans lequel le premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 88, 9B) contient un premier filtre passe-haut (6A) et un premier circuit détecteur de crêtes (8A) qui est connecté au premier filtre passe-haut (6A) et est destiné à produire un premier signal de valeur de crête, et dans LequeL le deuxième circuit de détection (10) détermine La position de l'erreur d'après Le signal de vaLeur de crête fourni par le premier circuit détecteur de crêtes (8A). 3. Circuit détecteur d'erreurs selon la revendication 2, dans LequeL le premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 88, 9B) contient, en outre, un deuxième filtre passe-haut (6B) connecté au premier filtre passe-haut (6A), de même qu'un deuxième circuit détecteur de crêtes (8B) qui est connecté au premier filtre passe-haut (8B) et est destiné à produire un deuxième signal de valeur de crête, et dans Lequel le deuxième circuit de détec-. tion (10) détermine la position de l'erreur d'après Les premier et deuxième signaux de valeur de crête fournis par Les premier et deuxième circuits détecteurs de crêtes (8A, 8B). 4. Circuit détecteur d'erreurs selon la revendication 2, dans lequel le premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 8B, 9B) contient, en outre, un circuit suppresseur de bruit (9A, 9B) qui est connecté entre le premier circuit détecteur de crêtes (8A) et le deuxième circuit de détection (10). 5. Circuit détecteur d'erreurs selon la revendication 4, dans lequel le circuit suppresseur de bruit (9A, 9B) contient un circuit de réglage (91A, 91B) pour le réglage d'un niveau de seuil et un circuit de porte (92A, 92B) qui est connecté au premier circuit détecteur de crêtes (8A) et est destiné à faire passer ou à empêcher le passage du signal de sortie du premier circuit détecteur de crêtes (8A). 6. Circuit détecteur d'erreurs selon la revendication 3, dans lequel le premier circuit de détection (6A, 7A, 8A, 9A, 6B, 7B, 8B, 9B) contient, en outre, un circuit de valeur absolue (7A, 7B) connecté entre le premier filtre passe-haut (6A) et le premier circuit détecteur de crêtes (8A) d'une part et entre le deuxième filtre passe-haut (8A) et le deuxième circuit détecteur de crêtes (8B) d'autre part. 7. Circuit détecteur d'erreurs selon la revendication 1, dans lequel le circuit d'entrée (1, 2) comporte un-filtre éliminateur de bande (2). 8. Circuit détecteur d'erreurs selon la revendication 1, dans lequel le signal numérique est un signal vidéo composite, numérique.