FR 2561428 A1 19850920 FR 8404067 A 19840316 7j 2561428 PROCEDE D'ENREGISTREMENT DANS UNE MEMOIRE A DISQUES ET SYSTEME DE MEMOIRE A DISQUES La présente invention concerne les mémoires à disques utilisées principalement pour l'enregistrement de données numériques. Plus particulièrement l'invention concerne un procédé permettant la lecture et l'écriture de données numériques dans une pluralité de disques. Elle concerne également un système de mémoire pour la mise en oeuvre du procédé. Un problème qui se pose actuellement dans les systèmes informatiques est la difficulté d'obtenir un grand débit lors dez transferts d'informations vers ou à partir des mémoires de masse faisant partie de ces systèmes. En particulier pour les calculateurs à haute performance, l'élément du système qui limite sa capacité de traitement est en général la mémoire de masse. Le problème a résoudre est alors de concevoir un procédé d'enregistrement et de lecture ainsi qu'un système de mémoire à grande capacité d'informations et autorisant un grand débit vers ou à partir des unités de traitement. L'invention a donc pour objet des moyens permettant de réaliser une telle mémoire a haut d6bit et de capacité suffisante pour stocker l'énorme quantiié d'information nécessaire pour les calculs complexes auxquels est destiné le système informatique. L'invention peut s'appliquer avantageusement à tous les systèmes susceptibles de manipuler de très grandes bases de données, par exemple les systèmes de traitement d'images. Dans l'état actuel de la technique seuls les disques magnétiques fournissent des dispositifs ayant un temps d'accès faible pour un coût par bit minimum. Cependant un grand nombre de disques est nécessaire pour atteindre des capacités compatibles avec la puissance de traitement des unités actuelles. Pour améliorer les performances des mémoires de masse à disques, la tendance actuelle est de -2- tenter d'augmenter la densité d'information ainsi que la vitesse de lecture ou d'écriture sur les disques. Par exemple on développe actuellement des procédés d'enregistrement dit perpendiculaires qui augmentent la densité d'information enregistrée, mais ces dispositifs sont encore à l'état de développement et risquent d'être très coûteux. Il en est de même pour les mémoires à disques optiques. La solution la plus communément adoptée consiste à utiliser un certain nombre d'unités de disques magnétiques conventionnelles sur lequel l'usager répartit ses fichiers de façon astucieuce, chaque fichier étant totalement sur un disque donné. Cependant lorsqu'on utilise des unités de disques conventionnelles les informations qui sont enregistrées sur un disque se présentent toujours comme des mots de plusieurs bits transmis en série. Il en résulte une limitation du débit des informations pouvant transiter entre l'unité de calcul et la mémoire de masse. Pour résoudre le problème de grand débit et de grande capacité l'invention propose un procédé d'écriture et de lecture selon lequel les bits d'un même mot d'information transitent en parallèle et en synchronisme entre les unités de calcul et les différentes unités de disques. Pour atteindre ce résultat l'invention concerne également un système de mémoire comprenant des moyens de commande qui permettent de résoudre les problèmes de mise en oeuvre du procédé. Plus particulièrement l'invention a pour objet un procédé d'écriture et de lecture d'informations numériques dans une mémoire de masse comprenant une pluralité d'unités de disques, chaque unité de disques pouvant contenir un ou plusieurs disques, ladite mémoire de masse étant commandée par au moins un contrôleur de disques, chaque mot - 3 - d'information numérique étant composé de plusieurs bits et associé à une adresse logique caractérisé en ce que, lors de transferts d'informations vers ou à partir des unités de disques, les bits constituant un mot d'information sont transmis simultanément, chaque bit étant affecté à une unité de disques associée au poids dudit bit dans ledit mot pour y être écrit ou lu en synchronisme avec les autres bits du même mot à une adresse physique fonction univoque de l'adresse logique dudit mot d'information, ladite adresse physique définissant, pour chaque unité de disque, l'emplacement effectif o sera écrit ou lu ledit bit, c'est-à-dire définissant le disque de ladite unité, dans le cas o l'unité contient plus d'un disque, le numéro de piste de ce disque et l'emplacement dudit bit sur cette piste. L'invention a également pour objet un système de mémoire comprenant plusieurs unites de disques relié à l'extérieur par un bus de contrôle, un bus de données et un bus d'adresse caractérisé en ce que lesdites unités de disques sont contrôl1es par un contrôleur principal coopérant par l'intermédiaire d'un bus d'adresse, de lignes de données et de lignes de commande avec une pluralité de contrôleurs de disques qui comnandent chacun une unité de disques contenant un ou plusieurs disques et en ce que ledit contrôleur principal comprend des moyens, pour synchroniser un transfert simultané des bits constituant chaque mot d'information à écrire ou a lire dans lesdites unités de disques et des moyens pour commander simultanément en écriture ou en lecture lesdits contrôleurs de disques, chaque contrôleur ainsi validé pouvant traiter pour chaque mot d'information un seul bit dudit mot d'information et transmettre ou recevoir ledit bit par l'intermédiaire d'une ligne de données reliée au contrôleur principal. -4- D'autres caractéristiques et détails de réalisation apparaitront dans les modes de réalisation préférentiels décrits dans la description qui va suivre: La figure 1 montre un système informatique dans lequel peut s'appliquer le procédé et le système de mémoire selon l'invention. La figure 2 représente un schéma d'ensemble du système de mémoire selon l'invention. La figure 3 représente la structure interne d'un contrôleur principal selon un mode de réalisation de l'invention. La figure 4 montre un circuit de détection et de correction d'erreurs faisant parti du contrôleur principal de la figure 3. Les figures 5 à 8 concernent un circuit sélecteur de lignes de données faisant parti du contrôleur principal de la figure 3. La figure 9 décrit une unité de disques du système de la figure 2. La figure 10 représente une matérialisation du système selon l'invention. Les figures Mla à llc montrent comment les bits de données sont traités par le procédé selon l'invention. La figure 1 montre un exemple de système informatique afin de mieux situer l'invention dans son contexte. La figure 1 représente de façon très schématique les éléments essentiels d'un système informatique pouvant utiliser le -- 5-- système de mémoire selon l'invention représentée par la mémoire de masse M3. Celle-ci est reliée aux unités de traitement 1 du système informatique par l'intermédiaire d'une mémoire secondaire M2. Cette memoire secondaire M2 est associée à une unité de commarnde d'entrée/sortie (non représentée) dont le rôle est de piloter les communications d'informations entre la mémoire de masse M3 et la mémoire principale Mlt Les échanges d'informations entre la mémoire de masse M3e la mémoire secondaire M2 et la mémoire principale Ml ainsi que les échanges avec l'unité de calcul C sont réalisés par l'intermédiaire d'un dispos tif de connezion Cxo L unité de calcul C peut etre constituée par unr systeme multiprocesseuro Celle-ci est également associée aux dieérentes unritées peripheériques 13 c1assiques non representéee0 La memoire principale Mi contient normaloement!es programmes et les données des programmes en cours d' exzcution et c'est à elle que s'adresse l'unitée de calcul C pour obtenir ou ranger les instructions et ies données exocutables. La mémoire seccndaire Nr2 &r-t essentiellement de tampon entre la mémoirî de masse M3 et la mémoire principale M1I Cette mlmo.re secondaire M2 est commandée par une unité d e'i.rse/scrtie qui est conçue pour assurer un débit elevé _îr des blocs de on relativement imeortantso La ma- moire de masse i3,,>'jet de la présente invention0 a Dour rze. de conserver les programmes et les dconnées Elle doit avoir une taill suffisante pour couvrir.es besoins de tous les utilisateurs. Cete tailie peut être de l'ordre de I gigamot. Afin d'assurer un temps minimum d'appel et 3- de rangement des données et des programmes il est nécessaire que le débit de la mëmoire de masse M3 vers la mérmoire secondaire M2 soit très important, de l'ordre de cent mégaoctets par seconde par exemple. Nous allons maintenant décrire un procédé d'enregistrement e' de lecdure en relation avec un système de memoi-re permettant d'atteindre cet objectif. - 6 - La figure 2 montre avec plus de détails le systènte de mémoire selon l'invention. L'unité de traitement 1 est du type déjà décrit en relation avec la figure 1. Le système de mémoire M3 comprend essentiellement un contrôleur principal 2 ainsi qu'une pluralité d'unités de disques 3. Le contrôleur principal 2 communique avec l'unité de traitement 1 par l'intermédiaire d'un bus de données D1, d'un bus d'adresses AI et de!ignes de contrôle ou bus de contr6le CI. Le contrôleur principal 2 communique d'autre part avec plusieurs unites de disques 3 par l'intermédiaire des lignes d'un bus de données D2, d'un bus d'adresses A2 et de lignes ou d'un bus de contrôle C2. Comme cela apparaît sur la figure 2 les unités de disques 3 reçoivent toutes la même adresse par l'intermédiaire du bus d'adresse A2. Les lignes de commande et de contro1e appartenant aux bus C2 permettent de transmettre les ordres provenant du contrôleur principal 2 aux différentes unites de disques 3. Inversement ces lignes de contrôle du bus C2 sont également destinées a transmettre les signaux d'état de chacunes des unites de disques 3 vers le contrôleur principal 2. Les signaux de commande provenant du contrôleur principal 2 sont par exemple les ordres d'écriture, de lecture ou de validation. Les signaux de contrôle provenant des unités de disques 3 peuvent fournir des indications sur l'état de fonctionnement des unités de disques 3 correspondantes. Ces signaux seront précisés ultérieurement. Selon une particularité de l'invention, les informations issues de l'unité de traitement 1 et transmises par l'intermédiaire du bus Dl sont des données binaires transmises en parallèle. Le contrôleur principal traite ces données binaires également en parallèle comme nous le verrons ultérieurement. Lors de l'écriture, le contrôleur principal 2 envoit sur le bus D2 des données binaires également en parallèle. Le bus D2 se subdivise ensuite en une pluralité de lignes de données 8 connectées chacunes à une unité de disques 3. Inversement lors de la - 7- lecture d'informations contenues dans les unités de disques 3, des données binaires issues de chaque unité sont transmises par les lignes de données 8 qui sont re- groupées pour former le bus D2 et sont donc transmises en parallèle, vers le contrôleur principal 2. Les unités de disques 3 comprennent essentiellement un contrôleur de disques 4, une interface 5, une unité d'actionnement 6 et un support d'enregistrement. Le contrôleur de disque 4 est munit également d'une mémoire à accès direct 9. Cette mémoire, pouvant servir d'anté-memoire, sert à emmagasiner temporairement des informations transitant entre le support d'enregistrement représenté sous forme de disques 7 et le contrôleur principal 2. Le contrôleur de disques 4 comprend une unité de commande programmée qui gère le transfert des informations vers ou a partir des disques 7. Le contrôleur de disques 4 à également pour rôle la génération de bits de correction d'erreurs dites longitudinales. Inversement lors de la lecture à partir du support d'enregistrement 7 le contrôleur de disque 4 utilise ces bits de correction d'erreurs pour corriger éventuellement des erreurs qui se seraient produites au cours de l'enregistrement ou au cours de la lecture. L'unité d'actionnement 6 est com-Tandée par le contrôleur de disques 4 par l'intermedlaire de l'interface 5 qui a également pour rôle la conversion parallèle-série et serie- parallèle des données binaires transmises ainsi que le codage et décodage des signaux de données Nous pouvons maintenant décrire le procédé d'enregistrement et de lecture exécuté par le système de mémoire selon l'invention. Lorsque 1'unité de traitement! désire inscrire des informations sur les disques, celle-ci transmet tout -8- d'abord un signal de commande d'écriture par le bus de contrôle C1 ainsi que les signaux d'adresse sur le bus d'adresse A1. En fonction de ces signaux le contrôleur principal 2 fournit à son tour les signaux d'adressage sur le bus A2 et les signaux de commande sur les lignes de contrôle C2 aux unités de disques 3 faisant partie du système. Ainsi chaque unité de disques reçoit sur une ligne de contrôle appartenant au bus C2 un ordre d'écriture. Chaque unité de disques 3 reçoit également l'information concernant l'adresse logique de disque qui déterminera l'emplacement o sera enregistrée l'information provenant de l'unité de traitement 1. En général, ces informations d'adresse sont indexées lorsque les informations à enregistrer se présentent sous la forme de blocs d'informations c'est-à-dire sous la forme d'une succession de mots de plusieurs bits en parallèles et transmis par le bus de données D1, les uns après les autres. Dans ce cas l'information d'adresse logique de disque à fournir représentera par exemple l'adresse du premier mot du bloc et la longueur du bloc. En résumé l'unité de traitement 1 fournit ce que nous pouvons appeler une adresse logique. Le contrôleur principal 2 génère éventuellement à partir de cette adresse logique, une adresse, dite "adresse logique de disque " susceptible d'être exploitée par chacune des unités de disques 3. En fonction de cette adresse logique de disque, chaque unité de disques 3 est capable de déterminer l'adresse physique o devront être enregistrées les informations prêtes à être transmises. La détermination de l'adresse physique permet a l'unité d'actionnement d'effectuer le positionnement de la tête de lecture sur la piste correspondant à l'adresse physique déterminée par le contrôleur de disque 4 de l'unité 3. Lorsque la tête est positionnée, le contrôleur de disque 4 envoie un signal au contrôleur principal par une ligne du bus C2 indiquant que l'unité est prête à recevoir les données. Lorsque le - 9- contrôleur principal 2 a reçu une telle information de chacune des unités de disques 3, le système est prêt pour le transfert des informations. Cet état est signalé également à l'unité de traitement 1 et à partir de ce moment le transfert des informations peut être effectué. Le rôle du contrôleur principal est ensuite de contrôler le transfert d'informations entre l'unité de traitement 1 et les différentes unités de disques 3. Pour la mise en oeuvre de l'invention, il est possible d'utiliser différents types de contrôleurs de disques 4 associés à différents types d'interfaces. La suite du procédé dépendra donc en partie du choix du controleur de disques 4. Le contrôleur de disques 4 de l'unité 3, peut comprendre une mémoire 9 d'une capacité égale à un seul secteur. Il est cependant préférable d'utiliser des unités de disques o la mémoire 9 est plus importante. Elle peut avoir la capacité d'une piste complète ou même de plusieurs pistes completes. Selon le cas, le contrôleur principal 2 ordonnera ou autorisera le transfert des informations provenant de l'unité de traitement 1 par blocs d informations d'une capacité maximale égale à un secteur ou a une piste complete ou eventuellement à plu- sieurs pistes completes. Lors de la phase d'écriture proprement dite le contrôleur principal a pour rôle de synchroniser ce transfert en parallèle des bits de chaque mots d'informations appartenant au bloc d'information à enregistrer. Au niveau d'une unité de disques 3, un bloc d'information en cours d'enregistrement apparait comme une succession de bits en série transmis sur la ligne de donrnées 8.'Cette série de bits est enregistrée temporairement dans la mémoire 9 à' des adresses correspondant à l'ordre dans lequel apparaissent les bits transmis sur la ligne 8. Lorsque le transfert du bloc d'informations est terminé ou lorsque.Ia - 10 - capacité maximale de la mémoire est atteinte, chaque contrôleur de disques 4 entamme alors la procédure d'enregistrement physique sur le disque des données enregistrées dans la mémoire 9. Ce transfert s'accompagne de la génération de bits de correction d'erreurs longitudinales, d'une conversion parallèle-série et d'un codage. Finalement des signaux codés sont enregistrés sur une piste ou plusieurs pistes d'un disque 7 de l'unité de disques 3, le numéro de cette piste étant déterminé en fonction de l'adresse physique élaborée par le contrôleur de disques 4 en fonction de l'adresse logique de disque. Lorsque l'unité de traitement 1 envoie un ordre de lecture d'informations, une procédure inverse est exécutée. L'unité de traitement 1 envoie sur son bus d'adresse Al les informations d'adresse du bloc d'information à lire; de même les lignes de commande C1 transmettent les signaux d'ordre de lecture. Le contrôleur principal 2 envoie à son tour l'adresse logique de disque sur le bus d'adresse A2 à chacune des unités de disques 3. Sur le bus de contrôle C2 apparait un signal d'ordre de lecture qui est transmis à chacune des unités de disques 3. Dans le cas o la mémoire 9 à une capacité importante, par exemple de plusieurs pistes, celle-ci peut alors jouer le rôle d'anté-mémoire; cela signifie qu'il est possible que le bloc de données adressé par l'unité de traitement 1 soit déjà inscrit dans la mémoire 9 et dans ce cas l'unité de disques 3 est déjà prête pour la lecture. Le contrôleur de disques 4 envoie alors un signal indiquant que la lecture peut être immédiatement exécutée. Si cela n'est pas le cas, le contrôleur de disque 4 envoie des signaux de commande du positionnement de la tête de lecture sur une piste associée à l'adresse-physique correspondant à l'adresse logique de disque reçue par le bus d'adresse A2. Le contrôleur de disques 4 commande ensuite le transfert - 11 - des informations recherchées et contenues sur la piste ainsi déterminée vers la mémoire 9. Ce transfert s'accompagne alors d'un décodage, d'une conversion série- parallèle et d'une procédure de détection et éventuellement de correction d'erreurs longitudinales. Lorsque l'information recherchée à été complètement enregistrée dans la mémoire 9 chaque contrôleur de disques 4 envoie alors un signal indiquant qu'il est prêt pour le transfert des informations; dès lors le contrôleur principal 2 signale cet état à l'unité de traitement et le transfert des informations peut être effectué. Le contrôleur principal, grâce à des signaux de commandes transmises sur le bus C2 ordonne la lecture de chacune des mémoires 9 appartennant aux différentes unités de disques 3. Ceci provoque la lecture séquentielle dans chacune des mémoires 9 d'une partie ou de toutes les données contenues dans celles-ci. Ces données binaires apparaissent sur les lignes 8 et sont regroupées pour former des mots de plusieurs bits sur le bus de données D2. Une telle architecture permet donc d'obtenir un débit important lors des transferts d'informations. On peut par exemple traiter des mots de 64 bits en parallèle et dans ce cas il faut prévoir 64 unités de disqueso Cependant un problème important peut survenir si l'une des unités de disques est defaillante e c'est pourquoi selon une caractéristique avantageuse de l invention il est prévu un procédé permettant de surmonter une telle éventualité. Pour cela l'invention prévoit un certain nombre d'unités de disques supplementaires. De même, dans le contrôleur principal 2 est prévu un générateur de bits de correction d'erreurs dites transversales commandé par l'unité de commande du contrôleur principal 2. A partir des bits d'informations reçus en parallèle sur le bus de données DI, ce générateur de bits de correction d'erreurs - 12 - peut générer des bits redondants. Ces bits seront ajoutés en parallèle sur le bus de données D2 aux bits issus du bus de données D1. Un certain nombre d'unités de disques seront donc affectés à ces bits de correction d'erreurs. Lors de l'écriture un procédé analogue à celui décrit précedemment est effectué, mais au lieu de transmettre simplement les mêmes bits d'information sur le bus de données D2 que ceux reçus à partir du bus de données D1, des bits supplémentaires seront générés et enregistrés sur les unités de disques supplémentaires. Inversement, lors de la lecture l'ensemble des bits enregistrés sur chacune des unités de disques, y compris les unités supplémentaires, est regroupé sur le bus de données D2. Le contrôleur principal 2 grâce à son unité de correction d'erreurs peut corriger des erreurs qui pourraient s'être produites lors de l'enregistrement ou au cours de la lecture. Dans ce cas, même si une unité de disques est complètement en panne, le contrôleur principal pourra régénérer l'information telle qu'elle avait été transmise lors de l'écriture. Selon une autre caractéristique avantageuse de l'invention la disposition décrite précédemment permet la mise en oeuvre de mesures supplémentaires pour augmenter la fiabilité du système. Ces mesures seront désignées par la suite par "procédé de reconfiguration". La présence de moyens de correction des informations issues d'une unité de disques défaillante peut être exploité davantage et selon cette caractéristique de l'invention, on prévoit des unités de disques de réserve qui peuvent être utilisées pour retranscrire des informations perdues à cause d'une unité de disques défaillante. Si par exemple, les moyens de correction et détection d'erreurs comprennent un simple générateur de bits de parité associés à un détecteur de parité, on peut reconstituer pour chaque mot le bit perdu par une unité défaillante. Il faut bien entendu que l'on - 13 - sache par ailleurs quelle unité est défaillante. Dans ce cas, un simple contrôle de parité permet de reconstituer tous les bits issus de l'unité de disques en panne. Il existe d'autres dispositifs plus évolués permettant la détection et la correction d'erreurs. Ces dispositifs sont par exemple basés sur l'utilisation des codes de HAMMINGO Ils permettent de corriger une erreur ou d'en détecter deux simultanées. Avec de tels détecteurs d'erreurs, la génération d'un syndrome d'erreur permet de détecter o est l'erreur et de la corriger si une seule erreur est présente. Le proc&de de reconfiguration sera donc être effectué comme suit: Lors de la lecture, si le détecteur d'erreurs a déterminé qu'une unité est d&faillante; cet état est pris en compte par l'unité de commande du contrôleur principal 2 et l'unit6 de commande 21 ordonne la procédure de recornfiguratioin. Cette procédure consiste a déclencher une lecture complète de toutes les informations contenues sur tous les disques de toutes les unités. L'ensemble des bits reçus en parallèle sur le bus de données D2, et 2 appartenant aux mêmes mots d'information permet au détecteur d'erreurs de déterminer le disque défaillant et de générer a nouveau le bit correct. Apres cette opération le bit corrigé peut être à son tour envoyé vers une unité de disques de réserve. Cette opération est effectuée sur tous les mots enregistrés dans la mémoire de masse. Ainsi, la totalité des informations affectées a l'unité de disques défaillante est reconstituée et enregistrée à nouveau dans l'unité de disques de réserve. Selon une variante de l'invention, l'unité de disques 3 est munie d'un contrôleur spécialement adapté au système. - 14 - La présence d'une mémoire ou anté-mémoire 9 de capacité d'au moins une piste, permet d'accélérer la procédure d'écriture ou de lecture sur le support d'enregistrement. La mémoire 9 étant une mémoire a accès direct, celle-ci peut être lue a n'importe quelle adresse. On peut mettre à profit cette propriété. Lors de l'écriture par exemple, dès que la tête de lecture ou d'écriture est positionnée sur la piste recherchée correspondant A l'adresse logique de disque fournit par le contrôleur principal 2, la tête fournit un signal indiquant le numéro du premier secteur rencontré par cette tête. Cette information peut être prise en compte par le contrôleur de disques 4 qui détermine alors la première adresse de la mémoire 9 correspondant au début de ce premier secteur rencontré. Le contrôleur de disques 4 peut donc immédiatement déclencher la lecture de la mémoire 9 A partir de cette première adresse et poursuivre la lecture selon un ordre cyclique de façon A vider entièrement la mémoire et retranscrire les informations lues selon le même ordre sur le support d'enregistrement. Inversement lors de la lecture, une fois la tête de lecture positionnée celle-ci peut détecter le premier secteur qu'elle rencontre, en informer le contrôleur de disques. Celui-ci adresse alors la mémoire 9 a partir de l'adresse correspondant au début de ce premier secteur rencontré et déclenche l'ordre d'écriture dans le même ordre cyclique que celui utilisé lors de l'écriture. Selon une autre variante on peut également prévoir que la mémoire 9 est constituée par deux mémoires A double accès et ayant chacune la capacité d'une ou plusieurs pistes. Cette disposition permet de gagner du temps pendant les transferts d'informations lorsque des opérations de lecture ou d'écriture se succèdent. En effet, une des mémoires correspondant A une piste peut être lue ou écrite sous le contrôle du contrôleur principal 2 alors que l'autre mémoire correspondant à une autre piste peut être - 15 - lue ou écrite sous le contrôle du contrôleur de disque 4. La lecture ou l'écriture d'un bloc d'information ayant la dimension d'une piste est ainsi effectuée sans attendre que la totalité des opérations portant sur un bloc précédent soient terminées. Enfin il est également avantageux d'utiliser une unité de disques 3 munie d'un contrôleur 4 dit "intelligent". En plus des fonctions classiques de contrôle de l'unité de disques, de tels contrôleurs intelligents peuvent effectuer, grâce a un matériel et des microprogrammes adaptés, un procédé d'optimisation des pistes mise en mémoire dans la mémoire 9. Ces contrôleurs peuvent par exemple gérer le contenu d'une mémoire 9 ayant la capacité de six pistes complètes et déterminer quelles sont les pistes qui doivent rester en priorité dans la mémoire 9. Cette gestion du contenu de la mémoire 9 est effectuée selon des critères liés à la fréquence d'utilisation de chacune des pistes enu mémoire par le système informatique 1 et au laps de temps qui s'est écoulé depuis la dernière utilisation de chacune de ces pistes. Ces contrôleurs peuvent également effectuer, sans intervention de l'extérieur, une reconfiguration automatique des pistes détectées comme hors d'usage. Dans ce cas un signal représentatif des capacités de reconfiguration de l'unité de disques est disponible et peut être exploité par le controleur principal 2 comme cela sera explique ultérieurement. Cependant l'invention n'est pas limitée àces modes particuliers de réalisation. Comme nous le verrons dans la suite, on peut appliquer les enseignements de l'invention en utilisant des unités de disques 3 classiques à condition de prévoir des circuits d'adaptation au niveau de l'interface de ces unités 3. - 16 - La figure 3 représente de façon plus détaillée la structure interne du contrôleur principal. Le contrôleur principal 2 est constitué par une unité de commande 21, qui peut être un microprocesseur, qui communique avec d'autres éléments du contrôleur par un ensemble de bus B de façon classique. Cet ensemble de bus B est constitué par un bus de donnée, un bus d'adresse, -t un bus de contrôle non représentés séparément. Le c. ntrc dur principal comprend une mémoire de programmes 25 reli de reconfiguration. Ce rôle sera détaillé ultérieurement. Le bus B du contrôleur principal 2 communique avec le bus de contrôle C2 connecté aux unités de disques 3, par l'intermédiaire d'une interface 30. Un dispositif - 17 - d'affichage 33 ainsi qu'un panneau de commande 34 sont prevus pour la maintenance. Ces éléments 33, 34 sont reliés à l'unité de commande 21 via les bus 83 et 84 par 1' irntermediaire de l'interface 32O Un sélecteur 23f reliée au bus B par l'intermédiaire de l'interface 29 et dont la structure sera precisée ultérieurement, a pour rcle de sélectionner les lignes de données qui seront connectées aux diferentes unités de disques 3o Cet element 23 est nécessaire pour le fonctionnement du système lorsque l'on c0 veuit prévoir la possiDilité d'une reconfigurationo En e.. .et0 etant donne qu'il existe un nombre d'unités de disques supérieur à celui qui est nécessaire pour enregistrer les bits d'un mot en parallèle, ce selecteur 23 doit selectionner les lignes utiles0 c'est-a-dire, les lignes qui doivent etre reliées effectivement aux unités de disques qui ne sont pas ou qui ne sont plus de réserveo -3n dispoGtif de detection et de correction d'erreurs 22 est relie a C unité de commande 21 par l'intermédiaire de iinterf ace 2 et du bus B. C' est ce dispositif de ea vcction et correc-;ion d'erreurs 22 qui a pour role0 lors C, #,i r'écrire de g'é;e> les bits de correction d'erreurs. Ces bits de correction d'erreurs seront ajoutés en pra-r'll aux bits de données pour chaque mot d'information recu sur le bus de donnée DI. Inversement ors s.une ilecture, ce dispositif 22 peut deétecter la position d'une erreur eventuelle et corriger l'erreuro Dans un mode de ré-alisation particulier nous verrons ce::rnt ce adétecteur et co-rsecteur d'erreur 22 permet de s0 adtect-er et co rger une erreur, ou a la possibilité de aetecter deux erreurs simultanees sur un meme mot d'informiation. Enfinr., il est prevu un - dispositif de gestion 3S d'interruption 35. Ce dispositif, relié également au bus B, permet de gérer les interruptions occasionnées par des - 18 - états particuliers détectés ou signalés, provenant soit du détecteur et correcteur d'erreurs 22 soit éventuellement d'autres unités du système signalant la nécessité d'une interruption. Le fonctionnement de ce contrôleur principal découle du procédé déjà décrit. En résumé lors de l'écriture, les données provenant du bus de données DI sont traites par le dispositif de détection et correction d'erreurs 22 on sont générés des bits de correction d'erreurs. L'ensemble de ces bits de données et de correction d'erreurs transitent par le sélecteur 23, préselectionné par des signaux de sélection issus de l'interface 29 et transmis par le bus 81. En fonction de ces signaux, le sélecteur est positionne pour aiguiller les bits de données en parallèle apparaissant sur le bus 82 vers chacune des unites de disques en fonctionnement. Les bits de chaque mot d'information sontd comme cela a déjA été expliqué, répartis sur les différentes unités de disques du système par l'intermédiaire des lignes de données 8. Toutes ces operations sont bien entendu surveillées et synchronisées par l'unité de commande 21 qui effectue le décomptage des mots d'information transmis. Lors de la lecture, la procédure inverse est exécutée. Des données en parallèle apparaissant sur le bus de données D2 sont transmises par l'intermédiaire du sélecteur 23 et du bus 82 vers le dispositif de détection et correction d'erreurs 22. Si aucune erreur ne s'est produite ou n'a été détectée par le dispositif 22, les données sont transmises directement sur le bus de données DI. Par contre, si une ou plusieurs erreurs sont détectées, cet état est signalé A l'unité de commande par 1'intermédiaire du dispositif de gestion d'interruption 35. Par l'intermédiaire de l'interface 28, l'unité de commande 21 peut reconnaitre le type de l'erreur et la position de - 19 - l'erreur, c'est-à-dire l'unité de disques 3 qui a provoqué l'erreur. Cet état peut déclencher la procédure de reconfiguration qui sera exécutée par l'unit6 de commande 21 selon une procédure enregistr6e dans la mLmoire de programme 25. L'exécution de ce programme provoque l'adressage séquentiel, piste par piste, de toutes les pistes de tous les disques de toutes les unités. Il ordonne la lecture séquentielle des pistes, la correction des erreurs et la réinscription de chaque bit corrigé sur une unité de réserve. Cette opération est effectuée sous le contrôle de l'unité de commande 21 qui envoit les signaux de lecture et d'écriture aux différentes unités 3 et provoque la modification de l'adresse fournie au sélecteur 23 par le bus de sélection 81. Plus précisémment, l'opération de reconfiguration consiste d'abord A adresser si'mltanaent las unités 3 et donner l'ordre de lecture par 2Lntermédiaire des mémoires 9 de la première piste de chque disque, à g6n&rer pour chaque mot, grâce au code correcteur le bit manquant et son adresse, & adresser la première piste de lunité de disques de rÉserve et donner l'ordre d9'criture, dans la mémoire 9 de cette unite, des _its corrigés. Ensuite le contenu de la mmore 9 est transféré sur le support d'enregistrement de cette unit2. La meme operation s'effectue pour la seconde piste et ainsi de suite, piste par piste, jusqu ' 7puisenent de toutes les pistes des disques de chaque unit-. Nous allons maintenant décrire de façon détaille le procédé d'écriture mis en oeuvre par le système de mémoire en relation avec les figures lia, Ilb, et lic0 Lorsque l'unité de traitement 1 désire enregistrer un bloc de données représentées sur la figure l!a, un signal d ecriture est envoyé par le bus de contrôle CI vers le contrôleur principal 2. Chaque mot de ce bloc d'information apparait comme un ensemble de bits en - 20 - parallèle sur le bus de données Dl. Chaque ligne du bus de données Dl correspond à un poids déterminé du bit de chaque mot d'information. Par exemple, la ligne i correspond aux bits de poids i: Bli, B2i,... Bji,... Bzi. Lorsqu'un mot d'information apparaît à l'entrée du circuit de détection et correction d'erreurs 22, celui-ci est sous la forme de l'ensemble des bits en parallèle Bjl, Bj2,..., Bjl... Bjq. Le circuit de détection et correction d'erreurs génère pour Ce mot un ensemble de bits de correction d'erreur transversales Cjl..., Cjk. L'ensemble de ces bits, bits de correction d'erreurs et bits d'information apparaissent en parallèle à la sortie 82 du circuit de détection et correction d'erreur. La figure llb réprésente, le format d'un mot d'information comprenant ces bits de correction d'erreurs. La même opération s'effectue de façon séquentielle pour chaque mot du bloc. Tous les bits d'un même poids, c'est-à-dire associés à une même ligne de donnée du bus de données D2, seront donc dirigés vers une unité de disques associée à ce poids. La figure lla représente également les successions de bits transmis par les lignes 8 aux unités de disques 3. L'unité de disques i recevra donc en série les bits Bli..., Bji..., Bzi. Le contr8leur 4 de cette unité de disques 3 va ensuite générer pour chaque série de bits ainsi reçue sur sa ligne de données 8 des bits de correction d'erreurs longitudinales Kli..., Kyi, comme représenté à la figure llc. C'est finalement l'ensemble de ces bits qui, après codage, sera enregistrés sur les supports d'enregistrement. Inversement, lors de la lecture, chaque disque délivre, après décodage, une série de bits telle que représentée sur la figure l1c. Après correction d'erreurs longitudinales et suppression des bits de correction d'erreurs, ces bits sont regroupés en parallèle pour former des mots de plusieurs bits en parallèle, tels que - 21 - représentés à la figure 11b, et comprenant les bits d'information et les bits de correction d'erreurs transversales. Le dispositif de détection et correction d'erreurs transversales 22 qui reçoit donc des mots ayant la structure représentée à la figure l!b peut traiter ces bits en vue de détecter la présence d'une erreur et corriger cette erreur. Ainsi les données éventuellement corrlgées seront transmises successivement pour reconstituer le bloc demandé par l'unité de traitement 1. !0 La f1guar 4 montre en dltail les éléments fonctionnels d'un exle de dirpositif de détection et correction d'erreurs transversales 22 basé sur l'utilisation des codes de IMNoG. Une memoire tampon d'entrée 221 sert à i5 stocker teipporairemient des données reçues de l'unité 1 ou avant detze transZrzees vets unite!o De même une oe taipon 222 sert a stocker temporairement des donn&es transmettre vers les unités de disques 3 ou prove'nanlt de ces unites. Lors de _'4criture, les donn&es qui proviennent du bus DI, permettett de r lnrrr!es bits de correction d'erreurs. Cetc oQ-ation e efectuee par le generateur 223o A la sortie d ce gnrateur apparaissent en parallèle les bits d'infoûmation et les bits de correction d'erreurs tran:versales. Lois de La lecture lies bits de données apparaissant sur le bu8 02, steckes temporairement dans la mémoire tampon 222 sont: transmis vers un generateur de syndrome d'erreurs 224. Ce gcnérateur indique, dans le cas o il existe une seule erreur, la position de cette erreur, c'est-à-dire le poids correspondant au bit erronn6. Dans le cas o il y aurait deux erreurs simultanées sur le même mot cet état est signalé par la ligne 351. Dans le cas d'une seule erreur, la position de l'erreur est indiquée à la sortie - 22 - du générateur de syndrome d'erreur 224 sur le bus D3. Cette information permet au correcteur d'erreurs 225 de corriger la donnée erronnée. Cette information est aussi transmise à l'unité de commande 21 du contrôleur principal 2. Le mode de fonctionnement du dispositif 22 est com- mandé par les signaux des lignes C3 du bus 80 issu de l'interface 28. Ces signaux sélectionnent le mode écriture ou lecture et permettent de synchroniser le transfert des mots d'un bloc d'informations sous le contrôle de l'unité de commande 21. Les données apparaissant sur le bus D3, lorsqu'il y a une erreur, seront utilisées par l'unité de commande 21 pour effectuer la reconfiguration du système. Les données du bus D3 représentent le poids du bit défaillant et indiquent par la même occasion quelle est l'unité de disques qui a généré cette erreur. L'unité de commande 21 détermine ainsi quelle unité est défaillante et peut déclencher la procédure de reconfiguration pour retranscrire toutes les informations corrigées en provenance de cette unité défaillante vers une unité de disques de réserve. L'unité de disques de réserve qui sera sélectionnée par l'unité de commande 21 est déterminée en fonction des données contenues dans la mémoire de configuration 24. C'est dans cette mémoire qu'est enregistre l'état de chacune des unités de disques y compris les unités de disques de réserve. Les critères qui permettent de décider à quelle condition il est nécessaire d'effectuer une reconfiguration, peuvent être variables en fonction du degré de fiabilité que l'on exige pour le système. Comme critère de reconfiguration on peut indiquer par exemple la détection d'une erreur longitudinale persistante. Cet état peut être signalé directement par une unité de disques 3 ou par la détection d'erreurs transversales effectuées par le circuit 22. La reconfiguration peut être également envisagée dans le cas o une des unités de disques 3 approche de la saturation - 23 - du nombre de ces pistes de reconfiguration disponibles, si les unites de disques choisies pour le système sont munies de contrôleurs 4 permettant des reconfigurations de pistes. D Il est bien évident que lorsque le système est en cours de reconfiguration, un signal indiquant cet état est transmis a l'unité de traitement par une des lignes de contr8le Cl. Le système de mémoire est ainsi déclaré indisponible. Egalement lorsqu'une ou plusieurs reconfigurations ont été effectuées, l'état des disques qui ont été reconfigurés doit être indiqué. Ceci peut être simplement réalisé par l'actionnement d'un signal lumineux associé aux unités de disques défaillantes. Dans le cas o une ou plusieurs unites de disques ont été recon'igurées des voyants lumineux correspondants du panneau d'affichage 33 sont allumés et le service de maintenance devra remplacer ces unités. Lorsque le remplaceen-t a été effectue l'unité de disques pourra etre a nouveaul utilise par le système à condition que:ette nouvelle situation soit signalée au contrôleur principal par le panneau de commande 34, ce qui provoque une remise a jour de la mémoire de configuration 24. La figure 5 représentG un schéma de principe du sélecteur 23 faisant partie du contrOleur principal 2c Ce sélecteur recoit les données issues du dispositif de deétection et de correction d'erreurs transversales 22 par le bus de données 82. Ce sélecteur 23 est adressé par des signaux de sélection déterminés par l'unité de commande et apparaissant sur le bus 81. En fonction de ces signaux, le sélecteur 23 positionne des commutateurs de lignes autorisant le passage des signaux provenant du bus 82 vers des lignes sélectionnées du bus D2. - 24 - La figure 6 représente de façon plus détaillée le sélecteur 23 de la figure 5. Le sélecteur 23 comprend essentiellement les circuits de décodage et de commutation 36. Des signaux de sélection et de contrôle apparaissent sur le bus 38 et proviennent de l'interface 37. Cette interface 37 peut être simplement un ensemble de registres servant de mémoire tampon pour les signaux provenant du bus 81. L'interface 37 peut également comprendre un convertisseur série-parallèle dans le cas o les signaux de sélection sont transmis en séries. Un tel cas peut se présenter si l'on désire sélectionner un grand nombre d'unités de disques sans toutefois être obligé de prévoir un grand nombre de lignes pour le bus 81. Nous voyons d'autre part que le circuit de décodage et de commutation 36 est relié aux lignes du bus 82, dont le nombre est égal au nombre de bits transmis en parallèle, y compris les bits de correction d'erreurs, et qui proviennent du circuit de détection et correction d'erreurs transversales 22. A la sortie du circuit 36 sont branchées des lignes de sorties dont le nombre est égal au nombre de lignes du bus 82 auquel s'ajoute un nombre de lignes égal au nombre d'unités de disques de réserve. Ces lignes de sortie du circuit 36 constitue le bus D2. Le bus D2 se subdivise ensuite vers chacune des unités de disques du système. L'ensemble de ces unités de disques 3 comprend d'une part les unités de disques 3 que l'on peut qualifier de "normales" 3-1... 3-P et d'autre part les unités de disques de réserve 3-(P+l)... 3-N. Le fonctionnement de ce sélecteur 36 est le suivant: en fonction de l'information de sélection provenant du bus 81 et transmis par l'intermédiaire de l'interface 37 et du bus 38, les commutateurs du sélecteur 36 sont positionnes de sorte que chacune des lignes d'entrées appartenant au bus 82 soit connectée à une et une seule unité de disques 3. L'adressage de ce sélecteur est déterminé par l'unité - 25 - de commande 21 en fonction de la configuration du système gardée en mémoire dans la mémoire de configuration 24. La figure 7 represente un mode de réalisation particulier du selecteur 23. Dans ce mode de realisation les unités de disques de réserve 3-(P--l)o.. 3-N sont particularisées.. La figure 7 représente un exemple o il n'y aurait que trois unitss de disques de reserve. I1 est évident que l'homme de métier peut extrapoler cette disposition pour un nombre quelconcque d' unites de disques de reserve. Selon ce cas particulier, le bus de sélection 81 est composé de trois bus 81-1, 81-2, 81-3, ainsi que de lignes de contr6le. Ces bus 81-1, 81-2, 81-3 sont affectes respectivement aux unites de disques de reserve. Le selecteur 23 comprend également une pluralitée de modules de selection 23-1, 23-2, etc 23-P, dont le nombre est égal au nombre de lignes du bus 82. Chaque module de sélection 23-0. !o, 23-P est connecté d'une part a une unite de disques 3-1... 3-P associee ce module de szlection et d'autre part a chacune des unit-s de disques de réserve 3-(P+l), 3-(P+2), 3-(P+3). La selection s'effectue de façon analogue à celle des circuits de la figure 5 et de la figure 6 a la différence pres que les unités de disques de réserve sont particularisées. Dans ce cas, seules ies unites 3-(P+l), 3-(P+2), 3-(P+3) peuvent servir d'iunit&s de disques de reccnfiguration. Une telle structure 2 pour avantage de limiter le nombre de lignes de slection du bus 81 sans n'ecess iter une conversion s'rie-parallle des informations de s.lection. Comme variante A la méthode de s&lection precdente, on peut ainsi prévoir des modules de sélection munis de ragistres adressables capables de mémoriser des signaux silection issus d'un bus 81 unique. Dans ce cas les signaux- de sélection, sont fournis successivement aux registres des modules de sélection, ce qui re-rmet de - 26 - réduire le nombre de lignes du bus 81, tout en gardant pour le sélecteur 23 une vitesse de commutation acceptable. La figure 8 montre un des modules de sélection 23-M associé à l'unité de disques 3-M. Le bus 81-1 est relié à un décodeur 23-Ml, le bus 81-2 est relié à un autre décodeur 23-M2 et le bus 81-3 est relié au troisième décodeur 23-M3. En fonction des signaux de sélection reçus sur son entrée, l'un des décodeurs 23-Ml, 23-M2, 23-M3, peut fournir a une première sortie un premier signal binaire DMF indiquant que l'unité de disques 3-M est défaillante. Ces signaux DMF1, DMF2, DMF3, issus des décodeurs 23-M1, 23-M2, 23-M3, indiquent pour un état logique déterminé quelle unité 3-M doit être déconnectée. Si l'un quelconque de ces signaux est dans cet état la porte 23-M4 est commandée en ouverture interdisant ainsi le transfert des signaux provenant du bus 82 vers la ligne 8 associée à l'unité de disques 3M. Egalement en fonction des signaux de sélection apparaisant sur les bus 811, 81-2, 81-3, les décodeurs associés délivrent A leur seconde sortie un signal MR1, MR2 ou MR3 dont l'état permet de valider l'une des portes 23-M5, 23-M6, 23-M7. Lorsque l'une de ces portes 23-M5, 23-M6, 23-M7 est validée par le décodeur associé, les signaux issus du bus 82 peuvent être transmis vers l'une des unités de réserve correspondante. Ainsi avec un nombre réduit de lignes de sélection, il est possible d'aiguiller des signaux provenant du bus 82 soit vers l'unité de disque normale connectée A la ligne 8 soit vers l'une des unités de disques de réserve connectées aux lignes RI, R2, ou R3. Il faut cependant noter qu'avec de tels module de sélection les unités de disques normales ne peuvent pas servir d'unité de disques de réserve. Il en résulte que lorsqu'un certain nombre d'unités de disques de réserve ont déjA été utilisés lors de reconfigurations, il est nécessaire que ,61428 - 27 - le service de maintenance prenne des mesures pour effectuer une réécriture de ces disques de réserveff sur des unités de disques normales qui auront remplacé des unités défaillantes. Une telle opération peut être effectuée en agissant sur la console de maintenance 34. L'unité de commande 21 pourra être programmée pour effectuer la lecture systématique des unités de disques de réserve et l'écriture correspondante sur les unités de disques de remplacement. La figure 9 montre comment il est possible de réaliser un système de mémoire selon l'invention en utilisant des unités de disques classiques travaillant sur 8 bits en parallèle. Il convient alors de prévoir un convertisseur série-parallèle servant d' interface entre le contrôleur de disques standard 301 et le contrôleur principal 2O A cet effet, on peut utiliser un registre à décalage bi- directionnel 305 rapide, par ezxemple TTL, de 8 bits. Les données sont transmises en série par l'intermédiaire d'une ligne du bus D2. Ce registre à décalage 305 est commandé par des lignes de contrôle appartenant au bus de contrôle C2 o sont transmis les signaux de commande provenant de "'interface 30 L'interface 30 contient un diviseur de fréquence par huit 311 dont l'entrée est reliee a une horloge du contrôleur principal 2 et dont la sortie valide le transfert des données contenues dans le registre a décalage 305 vers le contrôleur 301. Lorsque 8 bits ont été enregistrées dans le registre à décalage 305, en synchronisme avec les signaux d'horloge du contrôleur principal, le signal de validation fournit par le diviseur 311 autorise le transfert en parallèle des informations du registre à décalage 305 vers le bus de données D4 du contrôleur de disques 301. Si les contrôleurs de disques 4 sont prévus pour la réception directe de signaux d'adresse en parallèle, le - 28 - bus A2 peut être directement connecté au bus d'adresse de ce contrôleur. Par contre un certain nombre de contrôleur de disques classiques reçoivent les signaux d'adresses sur leur bus de données. Un tel contrôleur 301 a été représenté sur la figure 9. Dans ce cas, l'adressage four- nit au contrôleur de disques 301 doit être transmis par l'intermédiaire du bus de données D4 de ce contrôleur et il faut donc prévoir une interface 306 qui reçoit les informations d'adresse par le bus A2 et transmet à l'unité de commande du contrôleur de disques d'une part, des signaux d'adressage par l'intermédiaire du bus de données D4 et d'autre part des signaux de contrôle. Ces signaux de contrôle seront reçus sur le bus de contrôle interne de ce contrôleur de disques. Enfin chaque contrôleur de disques fournit sur des lignes de contrôle du bus C4 des informations indiquant son état de fonctionnement. Ces informations sont par exemple, les signaux de synchronisation indiquant que les mots à lire ou à écrire ont été reçus ou sont prêts à être transmis. C'est éga- lement par ce bus de contrôle C4 que le contrôleur principal enverra les ordres d'écriture ou de lecture à chaque contrôleur de disques. Ces informations proviennent du bus de contrôle C2 dont certaines lignes sont reliées au bus de contrôle C4 du contrôleur de disques 301. C'est aussi par ces lignes de contrôle C4 et C2 que le contrôleur de disque 301 fournit l'indication que la mémoire 9 est pleine, par exemple lors d'une opération de lecture d'une piste de disques. Chaque contrôleur de disques envoit de tels signaux de contrôle et c'est seulement lorsque tous les signaux de contrôle provenant de chacune des unités de disques indiquent que toutes ces unités de disques sont prêtent que le contrôleur principal 2 pourra déclencher l'ordre de transfert soit en lecture, soit en écriture. Pour cela il faut prévoir dans l'interface 30 des portes logiques 312, 313 dont la sortie indiquera que tous les contrôleurs de disques sont prêts - 29 - ou que toutes les rames sont pleines. La sortie de ces portes servira de signaux de synchronisation pour le contrôleur principal. Inversement lorsque le contrôl1eur principal veut faire exécuter un ordre d'écriture, il faut eue celui-ci transmette à chaue contrôleur de disques, en synchronisme, un signal donnant l'ordre d'crire dans les mémoires 4 à l'adresse indiquee par les signaux transmis par te bus A2. La ? ealisaioï- f-.Srce des circuits décrits pr&c&demment eepenra essentielimrent du nombre dunitces de disque0 que on veut commarndcer Ce nombre d unites de disques, consrditi Onnera galSemelr't le choix et l e nombre des in-_-e;rate utilisables d-ns 'e contrôleur principal. Dans l le ca 'ar uerx e o" l 0! -'travaille sur des mots de 54 i. t5 cr paraIlse i aEaui: onCnc pr-voir 72 unietés de disq-ues au -cta!es, pus lee unitzes de disques de reserve. b.en 'un.n %e de corhande 2.1 ne pourra pas adru>eer onr-r. 2 -.,ct.=mnt ' 2 lensemble de ces -20 uncitis; c t le ca '.= particulier si l unit' de coImrraeie 2! st ur mïiJ o ess-eur dont le nombre de tbornes '-;"- z ':m. nei den rfsoudre le problème est e 't.ilise: in-efface ds eontr-'-ure doentrée/sortie p reirazvble27 ^u.' Deombre de ces Contr$!eurs :d entree/zortie programrl ab c e ndra du nombre de dises _ue le.cntr- ?rinc _ doit commander Com'ms exemi e rea-l a'tioîn nous pouvons indiquer les :ment suivXiants v pour u niti de commaurde 21 on peut a1 t..l.s7r un INicToprocesseurRl', 80 85 ou équivalent, pousr lee memoires de donnees 26 il est possible d'utiliser une seoizre vve statique I!TEL 81 55 ou une memoire vive dynamimeu IT[ 271 d64 Commrle memoire de programme 25, on Deut utiliser une mémoire morte INTEL 83 55 ou une memoire morte programmable électriquement INTEL 87 55 La mémoire de configuration 24 nécessite une capacité relativement - 30 - réduite, n nanmoins il convient que cette mamoire ne soit pas volatile. On peut utiliser une mémoire vive statique alimentée séparément par une batterie. Une autre possibilité consiste à utiliser une mémoire morte modifiable àlectriquement ayant les caractéristiques par exemple de la mémoire INTEL 2816 A. Pour réaliser les interfaces 27 A 31, il est pcssible d'utiliser des contrôleurs d'entrée/sorties programmables tel aque le mo- dèle INTEL 8255. Comme circuit de gestion des interruptions 35, on peut utiliser un contrôleur d'interruption programmable!NTEL 8259. Pour 'interface d'affichage 32 un modèle tel que INTEL 8279 convient parfaitement. Enfin le circuit de détection et de correction d'erreurs, qui a éga!ement le rôle de génér teur de bits de correction d'eerreurs, peut etre rialisé à l'aide du circuit INTEL 8206 ou du circuit NATIONAL SEMI CONDUCTOR DP8400. Enfin le sélecteaur 23 peut être réalisé à l'aide de circuits logiques classiques, en particulier les décodeurs 23-Ml, 23-M2, 23-M3, neuvent être réalisés simplement à l'aide de portes logiques et d'inverseurs connectés aux entrées bien chnoisies. Il convient enfin de remarquer que1 l'invention ne se limite pas à l'exemple décrit traitant 64 bits en parallèle et utilisant 72 unités de disques. On peut imaginer un dispositif selon l'inrvention qui ne travaille que sur 8 bits en parallèle. Si l'on veut utiliser un dispositif de détection et de correction d'erreurs du type HAMMING il faudrait dans ce cas prévoir 5 unités de disques affectées aux bits de correction d'erreurs. De plus, une ou plusieurs unités de disques supplémentaires pourront servir d'unité de disques de réserve pour la reconfiguration. Un exemple de réalisation concret a été décrit a la figure 10. L'ensemble des unités de disques 75 a été disposé dans - 31 - une armoire 70. Cette armoire contient toutes les unites de disques 75 y compris les unites de disques de réserve servant à la reconfiguration. Pour indiquer au service de maintenance qu'une ou plusieurs unites de disques sont défaillantes des voyants lumineux 72 ont été prévus sur la face de l'armoire. Si par exemple l'unité de disques 78 est déclarée défaillante par le voyant correspondant, le Service de Maintenance peut simplement extraire l'uni%é défaillante 78 et la remplacer par une unité de secours 76 ou 77 contenue dans une armoire de disques de secours 71. L'armoire 70 contient également le contrtôleur principal 2, un panneau de commande et d'affichage 79 et! alimentation électrique du système 74. - 32 - Revendications de brevet: 1. Procédé d'écriture et de lecture d'informations numériques dans une mémoire de masse comprenant une pluralité d'unités(3) de disques, chaque unité de disques pouvant contenir un ou plusieurs disques(7), ladite mémoire de masse étant commandée par au moins un contrôleur de disques, chaque mot d'information numérique étant composé de plusieurs bits et associé a une adresse logique caractérisé en ce que, lors de transferts d'informations vers ou à partir des unités(3) de disques, les bits constituant un mot d'information sont transmis simultanément, chaque bit étant affecté à une unité de disques associée au poids dudit bit dans ledit mot pour y être écrit ou lu en synchronisme avec les autres bits du même mot à une adresse physique fonction univoque de l'adresse logique dudit mot d'information, ladite adresse physique définissant, pour chaque unité de disque, l'emplacement effectif o sera écrit ou lu ledit bit, c'est-à-dire définissant le disque de ladite unité, dans le cas o l'unité contient plus d'un disque, le numéro de piste de ce disque et l'emplacement dudit bit sur cette piste. 2. Procédé selon la revendication 1 caractérisé en ce que pour chaque mot d'information à écrire, des bits de détection ou de correction d'erreurs dites transversales sont calculées, associés aux bits dudit mot d'information, chaque bit de détection ou de correction d'erreurs transversales étant transmis en synchronisme avec les bits dudit mot vers une unité de disques associée au poids dudit bit pour y être écrit, et en ce que pour chaque information à lire, une opération de détection ou de correction d'erreurs transversales est effectuée à l'aide desdits bits de détection ou de correction d'erreurs transversales avant que les bits de ladite information soit transmis en synchronisme par le bus de données. - 33 - 3. Procédé selon la revendication 2 caractérisé en ce que lors de la détection selon des critères prédétermines, de défauts permanents affectant l'enregistrement dans une ou plusieurs unités de disques, cet état déclenche, si la correction des défauts est possible à l'aide de bits de correction d'erreurs transversales, une procédure de reconfiguration selon laquelle la totalité de i'enregistrement conrtenu dans la ou les unités de disques défaillantes est retranscrite, apres ladite correction d'erreurs transversales, sur une ou plusieurs unités de di.zques de réserve. 4. Procdé sealon l'une des revendications précédentes caractérise en ce que pour ecrire un bloc d'informations, c'est-à-dire une suite de mots d'informations associée à une dresse de bloc et se Presentant à chaque auite de disqcue come une suite de bits associte. la même adresse de bloc, chaoue 1bit de ladite suite destiné a être enregistre dans l'unité de disques correspondante est d'a-lOrd inàcrit une adresse de mémoire fonction univeqe de! adresse de bloc et de la place du bit dans ladite suit. de bits, dans une m&eoire à acecs direct e! te unitA de disques et lorsque ladite suite de at eient..m.n.t inscrite dans ladite meémoire, les inroformations biniaires alors contenues dans ladite meéoair'.ont lues seéuentil!ement et transmises en série no r. e... .str.es sur une piste de l'un des disques de cadi e u-ió ledit disque et ladite piste dudit disque etrt déie'mi... en fonction de ladite adresse de bloc, 0 l ?adresse de mémoire du premier bit transmis étant d'ermineé en fonction du numéro du premier secteur de ladite piste rencontre par la tête d'enregistrement, la lecture séquentielle de ladite mémoire étanteffectuée suivant urne séquence cyclique, et en ce que pour lire un mot d'information associé a une adresse logique donnée, les bits constituant cette information sont lus en synchronisme a partir de l'ensemble des mémoires associées auxdites unités de - 34 - disques à des adresses de mémoires fonction de l'adresse logique immédiatement si l'information est présente dans l'ensemble des mémoires ou, dans le cas contraire, après retranscription dans chaque mémoire de la totalité des informations binaires contenues sur la piste associée à ladite adresse logique, ladite retranscription s'effectuant à partir du premier secteur de ladite piste rencontré par la tête de lecture. 5. Procédé selon la revendication 4 caractérisé en ce que avant d'enregistrer sur une piste de disque la suite d'informations binaires transmise à partir de la mémoire associée à une unit& de disques, des bits de détection et de correction d'erreurs (Kli à K2i) dites longitudinales sont calculés et ajoutés à ladite suite et en ce que avant d'écrire dans la mémoire les informations binaires provenant d'une piste, une opération de détection et éventuellement de correction d'erreurs longitudinales est effectuée. 6. Procédé selon les revendications 3 et 5 caractérisé en ce que le résultat desdites opérations de détection d'erreurs transversales et/ou longitudinales sert à établir ledit critère de défauts permanents affectant l'enregistrement dans au moins une unité de disques si, après une ou plusieurs relectures des pistes, des erreurs transversales et/ou longitudinales sont encore détectées. 7. Système de mémoire comprenant plusieurs unités (3) de disques relié à l'extérieur par un bus de contrôle (Cl), un bus de données (D1) et un bus d'adresse (A1) caractérisé en ce que lesdites unités de disques (3) sont contrôlées par un contrôleur principal (2) coopérant par l'intermédiaire d'un bus d'adresse (A2), de lignes (8) de données formant un bus (D2) et de lignes de commande (C2) avec une pluralité de contrôleurs (4) de disques qui commandent chacun une unité (3) de disques contenant un ou plusieurs disques (7) - 35 - et en ce que ledit contrôleur principal (2) comprend des moyens (21, 25, 23, 29, 30) pour synchroniser un transfert simultané des bits constituant chaque mot d'information à écrire ou à lire dans lesdites unités (3) de disques et des moyens pour commander simultanément en écriture ou en lecture lesdits contrôleurs (4) de disques, chaque contrôleur (4) ainsi validé pouvant traiter pour chaque mot d'information un seul bit dudit mot d'information et transmettre ou recevoir ledit bit par l'intermédiaire d'une ligne (8) de données reliée au contrôleur principal. 8. Système de mémoire selon la revendication précédente caractérisé en ce que ledit contrôleur principal comprend des moyens (21, 25, 26, 31) pour déterminer, à partir d'une adresse logique associée à un mot d'informlation a lire ou à écrire, une adresse logique de disque composée d'un numéro logique de disque, d'un numéro logique de piste et d'une adresse complémentaire, ladite adresse lo- gique de disque étant transmise à chaque contrôleur de disque par ledit bus d'adresse et des moyens pour donner l'ordre de lecture ou d'écriture auxdits contrôleurs, via les lignes de commande (2) et en ce que chaque contrôleur (4) de disques comprend des moyens pour écrire dans l'unité (3) de disques associée, à une adresse physique fonction univoque de l'adresse logique de disque, l'information binaire reçue sur sa ligne (8) de donnée et des moyens pour lire dans ladite unite de disque l'information binaire enregistree à ladite adresse physique et pour transmettre ladite information binaire sur la ligne de donnée (8). 9. Système de mémoire selon la revendication 7 ou 8 caractérisé en ce que le contrôleur principal comprend des moyens (22) pour calculer-pour chaque mot d'information, à partir des bits dudit mot d'information reçus de l'extérieur sur le bus de donnée (D1), des bits de détection ou de correction d'erreurs dites transversales (Cjl à Cjk), destinés à être enregistrés séparément dans - 36 - des unités (3) de disques affectées à ces bits de détection ou correction d'erreur. 10. Système de mémoire selon l'une des revendications 7 à 9 caractérisé en ce que chaque unité (3) de disques comprend une mémoire vive à accès direct (9, 302) destinée à mémoriser une suite de bits provenant de la ligne (8) de donnée avant d'être transmise vers un disque ou servant à mémoriser une suite de bits provenant d'un disque avant d'être transmise vers la ligne (8) de donnée. 11. Système de mémoire selon les revendications 8 et 10 caractérisé en ce que chaque mémoire (9, 302) associée à une unité (3) de disques est adressable soit par le contrôleur principal (2) soit par le contrôleur (4) de disque de ladite unité, l'adressage par le contrôleur principal (3) étant déterminé par ladite adresse complémentaire. 12. Système de mémoire selon l'une des revendications 7 à 11 caractérisé en ce qu'il comprend des unités (3-(P+l) à 3-N) de disques de réserve et une unité de sélection (23) des lignes de données(D2), dudit contrôleur principal (2), permettant une reconfiguration du système en cas de défaillance d'une ou de plusieurs unités (3) de disques. 13. Système de mémoire selon la revendication précédente caractérisé en ce que ladite unité de sélection (23) est constituée par une pluralité de multiplexeurs (23 - 1 à 23 _ p), chacun étant associé A une unité (3-1 à 3-P) de disques normale et relié d'une part A ladite unité (3-1 à 3-P) de disques et d'autre part aux unités (3-(P+l) A 3-N) de disques de réserve, sous la commande du contrôleur principal (2). 14. Système de mémoire selon l'une des revendications 7 à 13 caractérisé en ce que chaque contrôleur (3) de disques comprend une unité de traitement (304) travaillant sur des - 37 - données en parallèle et un convertisseur (305) série- parallèle servant d'interface pour le contr1ôleur principal (2) et comimandé par ce dernier.