FR 2567339 A1 19860110 FR 8410515 A 19840703 GENERATEUR DE SEQUENCES PREDETERMINEES DE SIGNAUX LOGIQUES COMBINES La présente invention concerne un généra- teur de séquences prédéterminées de signaux logiques combinés. Ce générateur permet d'obtenir des séquen- ces prédéterminées de signaux logiques combinés de ni- veau 1 et O obtenus, dans certaines conditions prédé terminées, à des instants successifs de chaque séquen- ce. L'invention s'applique à la simulation de tous les systèmes logiques fonctionnant à partir de la réception de signaux logiques de niveau O ou 1. Ces signaux logiques de niveau O ou 1 appliqués sur les différentes entrées d'un circuit de simulation, cor- respondent par exemple à la simulation de la défail- lance ou de la réparation des composants du cir- cuit simulé. Ce générateur peut aussi s'appliquer à l'étude de la défaillance ou du bon fonctionnement de tout système à plusieurs composants, (mécaniques ou hydrauliques par exemple), en fonction de la défail- lance ou du bon fonctionnement de chacun de ses compo- sants; la défaillance ou le bon fonctionnement des composants du système peuvent intervenir soit simul- tanément, soit séparément. L'étude de la défaillance du système se fait en associant le générateur de l'in- vention avec un simulateur logique dont les composants logiques représentent les composants du système simu- lé; les signaux logiques de niveau O ou 1 sont appli- qués sur les entrées des composants logiques du simu- lateur pour simuler la défaillance ou la répa- ration des composants correspondants du système. Pour chacune des combinaisons des signaux logiques fournis sur les sorties du générateur de l'invention, la ré- ponse du simulateur (niveau logique du signal de sor- tie du simulateur) est analysée, afin de savoir s'il s'agit d'une combinaison de signaux logiques entraî- nant ou non la défaillance du système. La liste des combinaisons de signaux logiques de niveau O ou 1 as- sociée aux réponses du simulateur, permet d'analyser le système simulé, pour des études de fiabilité. On sait que dans les centrales nucléaires, les avions, les ensembles de recherches pétroliè- res,... il est nécessaire d'utiliser des systèmes de commande ou de sécurité présentant une grande fiabili- té, qui pour cette raison, présentent tès souvent des voies redondantes. Ces voies redondantes permettent d'éviter que toute panne de l'un des composants de l'une des voies, empêche le système de déclencher l'action de sécurité ou de commande souhaitée. Ces voies redondantes permettent aussi de faciliter la réparation ou le contrôle d'une ou plusieurs voies sans arrêter l'action de sécurité ou de commande sou- haitée. Différentes méthodes ont été utilisées pour analyser la fiabilité de systèmes de commande ou de sécurité. Malheureusement, ces méthodes utilisent gé- néralement le principe dit "d'arbre de défaillance", qui nécessite l'usage de calculateur de puissance lorsque le système à contrôler est complexe. Ces dif- ficultés sont décrites dans l'article de P.K. ANDOW intitulé "Difficulties in fault tree synthesis for process plant" paru dans la revueIEEE transactions re- liability -vol. R29 - avril 1980 - pages 2 à 9. Les difficultés qui apparaissent dans t'analyse de fiabilité d'un système à partir de l'arbre de défaillance de ce système, peuvent être surmontées grâce à l'utilisation de circuits de simu- lation câblés, représentant ce système. Ces circuits sont décrits, par exemple dans l'article intitulé "Verification of fault tree analysis" publié par "Electric Power Research Institute", dans la revue EPRI-NP1570- volumes 1 et 2 - mai 1981. Ces circuits de simulation permettent d'éviter la conception d'un D arbre de défaillance d'un système; ils sont cependant très limités en performances, puisqu'ils permettent l'étude de fiabilité de systèmes comportant au plus 20 composants. Plus récemment a été développé un générateur de signaux logiques combinés permettant d'étudier la fiabilité de systèmes à partir de circuits de simula- tion. Ce générateur est décrit dans L'article de A. LAVIRON intitulé "ESCAF- failure simulation and re- liability calculation device"- second national relia- bility conference - Birmingham (England)- volume 2- mars 1979- page 6C/4/1- 6C/4/10. Ce générateur de signaux logiques combinés permet d'étudier la fiabili- té de systèmes complexes, par l'intermédiaire de si- mulateurs logiques. Il fournit sur N de ses sorties, toutes les combinaisons possibles de P signaux logi- ques de niveau 1 et de N-P signaux logiques de niveau 0. Ces signaux logiques sont appliques, en fonction des tests recherchés de fiabilité, sur les entrées des composants du circuit de simulation de manière à si- muler soit le bon fonctionnement de chaque composant (niveau logique 1 du signal appliqué sur une entrée du composant), soit la défaillance de chaque composant (niveau logique 0 appliqué sur l'entrée de ce compo- sant). Ces signaux logiques simulant la défaillance ou le bon fonctionnement d'un ou plusieurs composants du -circuit de simulation permettent d'observer sur la sortie de ce circuit, si la défaillance ou le bon fonctionnement d'un ou plusieurs composants du cir- cuit, provoque la défaillance ou Le bon fonctionnement de ce circuit. Le générateur de combinaison précité permet de simuler des systèmes comprenant plus de 40 composants. Toutefois, it ne permet que la simulatio, d'événements (défaillance ou bon fonctionnement ' composants d'un circuit) survenant simultanéme pour des études dans lesquelles l'ordre d'arrivée de! événements n'intervient pas. Ce générateur qui présen- te un progrès évident par rapport aux systèmes de si- mulation utilisant des ordinateurs de puissance (de type GRAY I par exemple) ne permet toutefois pas dE simuler des évènements (défaillance ou bon fonctionne- ment des composants d'un circuit survenant successive- ment. Or il apparaît souvent nécessaire, dans une étude de fiabilité d'un système, de faire intervenir des séquences de défaillance ou de bon fonctionnement, dans lesquelles l'ordre d'arrivée des événements, pré- sente une grande importance pour L'étude de fiabilité. Les techniques de simulation (arbre de défai lance) qui étaient utilisées avec le générateur précité, ne peuvent alors pas être mises en oeuvre. Ces techniques connues nécessitent la construction d'un diagramme de MARKOV, en général très complexe, qui, pour un système comportant de nombreux composants, est impossible à concevoir. La présente invention a pour but de remédier aux inconvénients des dispositifs connus permettant d'étudier la fiabilité de système complexes. Elle per- q t notamment de surmonter les inconvénients concer- nant les limitations de performances, le coût et la complexité des dispositifs connus, et notamment ceux qui utilisent des ordinateurs de puissance. Le généra- teur de l'invention permet d'appliquer aux systèmes étudiés, des événements survenant en séquences. Elle permet également d'améliorer les performances du géné- rateur de combinaisons mentionné plus haut, notamment en rendant possible l'étude de fiabilité de systèmes -. 2567339 -,. X5 -.,À . : . -;. '. - '..DTD: très complexes; ces systèmes sont notamment ceux-qui font intervenir de-s événements séquentiels avec des conditions spéciales validant ou non certains événe- ments à certaines-périodes de la séquence: par exem- pIe, on ne peut -simuter-unefus de démarrage d'un -- moteur qu'au moment ou celui-ci reçoit effectivement un ordre de démarrage. - - = Le générateur séquentiel de l'invention permet d'étudier, grâce à un circuit de, simulation,-La: -10 plupart des systèmes qui nécessitent une étude de fia- bilité. - - L'invention a pour objet un générateur de séquences prédéterminées de signaux logiques combi- nés, caractérisé en ce qu'il comprend: - des moyens séquentiels comprenant un nom- bre R de sorties capables de fournir à chaque instant t. d'une succession d'instants de chaque séquence pré- *1 déterminée de signaux combinés, un nombre qi de si- gnaux de niveau logique 1, fournis sur qi sorties et -20 un nombre R-qi de signaux de niveau logique 0, fournis sur R-qi sorties, la somme des nombres qi étant égale à un nombre prédéterminé p de signaux de niveau logi- que 1, - des moyens reliés aux moyens séquentiels pour les initialiser et pour qu'ils fournissent les signaux de niveaux logiques 1 et 0 aux instants suc- cessifs t. correspondant à la séquence prédéterminée, *1 à partir de la combinaison initiale enregistrée, - des moyens de commande reliés aux moyens séquentiels pour que ceux-ci fournissent aux instants ti sur les R sorties, les qi signaux de niveau logique I et les R-qi signaux de niveau logique O, de- sorte que la somme des nombres q soit égale à p, pour l'en- semble des instants t. de la séquence, les nombres R, q.i et p étant des nombres entiers, *X... .. - -des moyens d'arrêt reLiés aux moyens sé- -quentiels pour arrêter la fourniture de.signaux sur Les R sorties, après une séquence prédéterminée de signaux combinés.- - SeLon une autre caractéristique, Les moyens séquentieLs sont des moyens séquentieLs de muLtiplexa- ge, capables d'enregistrer lesdites combinaisons ini- tiales pour fournir sur R-sorties, les q. signaux de niveau Logique I et les R-qi signaux de- niveau logi- que 0, chaque combinaison initiale comportant p si- gnaux de niveau logique 1, et des signaux de. niveau logique 0. -. - Selon une autre caractéristique, les moyens séquentiels de multiplexage comprennent: 15. - un générateur de signaux logiques combinés présentant N sorties, capable de fournir lesdites com- binaisons initiates, correspondant auxdites séquences prédéterminés, chaque combinaison initiale étant for- mée de p signaux de- niveau logique 1 produits sur p sorties du générateur de signaux combinés et N-p si- gnaux de niveau logique 0 produits sur N-p sorties du générateur de signaux combinés, - des multiplexeurs recevant sur N entrées les p signaux de niveau logique 1 et les N-p signaux de niveau logique 0 correpondant aux combinaisons ini- tiales et fournissant sur R sorties, les qi signaux de niveau logique 1 et les R-qi signaux de niveau logique 0, aux instants successifs ti de chaque séquence, Les moyens d'initialisation étant reliés au générateur de signaux combinés, les moyens de commande étant reliés au générateur de signaux combinés et aux multiple- xeurs.. Selon une autre caractéristique, le nombre des instants successifs t. varie de 1 à m, m étant un *1 nombre entier inférieur-ou égaL à p; q. étant une va- leur entière comprise entre 1 et p. Selon une autre caractéristique, le généra- teur comprend en outre des moyens logiques de contrôle reliés aux R sorties des multiplexeurs et aux moyens de commande, comportant des moyens pour avorter toute séquence pour laquelle, à tout instant ti, deux si- gnaux de sortie parmi les R signaux de sorties des multiplexeurs sont simultanément au niveau logique 1, alors qu'ils ne devraient pas l'être. Selon une autre caractéristique, les moyens de contrôle (C) comportent des moyens pour avorter toute séquence pour laquelle, à tout instant ti, aucun signal de niveau logique 1 n'est fourni sur l'une quelconque de R sorties des multiplexeurs à un instant ti d'une séquence, alors que des signaux de niveau logique 1 sont fournis à un instant t.+k, avec k> 1. Selon une autre caractéristique, les moyens logiques de contrôle comprennent une entrée de comman- de d'invalisation par les moyens de commande, d'une combinaison initiale de signaux logiques présents sur les N sorties du générateur de signaux logiques combi- né s. Selon une autre caractéristique, les moyens logiques de contrôle (C) comprennent en outre une en- trée (EVENEXT) et une entrée (INHIB) de commande de mise au niveau logique 0 des signaux de sortie des multiplexeurs, lorsqu'à un instant t. la séquence de *1 signaux prévue à cet instant sur les sorties des mul- tipleurs, ne doit pas être utilisée. û Selon une autre caractéristique, les moyens de contrôle (C) comprennent des moyens d'enregistre- ment de signaux (VALCOL), qui combinés avec les si- gnaux fournis sur les R sorties des multipleurs (MX1, MXR) permettent d'invalider toute séquence ne correspondant pas à une séquence de signaux souhaitée _-W sur les sorties des multiplexeurs. Les caractéristiques et avantages de L'in- vention ressortiront mieux de la description qui va suivre donnée en référence aux dessins annexes dans lesquels: - La figure 1 représente schématiquement un système dont la fiabilité peut être étudiée grâce au généra- teur de l'invention, - la figure 2 représente schématiquement un circuit de simulation du système de la figure 1, - les figures 3A et 3B représentent schématiquement, un générateur de séquences de signaux Logiques com- binés, conforme à l'invention Le générateur de séquences prédéterminées de signaux logiques conforme à l'invention est plus particulièrement destiné-à l'étude de la défaillance ou du bon fonctionnement d'un circuit logique mais comme on va te voir, il peut permettre, par analogie, grâce à un circuit logique de simulation, l'étude du bon fonctionnement ou de la défaillance de systèmes divers, tels que des circuits hydrauliques par exem- ple. La figure I représente schématiquement un circuit hydraulique dont la fiabilité peut être étu- diée grâce au générateur de L'invention, par l'inter- médiaire d'un circuit de simulation qui sera décrit plus loin en détail. Ce circuit hydraulique permet d'établir par exemple, la circulation d'un fluide en- tre un conduit amont 4 et un conduit aval 5, grâce à trois vannes pneumatiques 1, 2, 3 dont l'ouverture ou la fermeture peut être commandée par la présence ou L'absence d'air comprimé dans les conduits de commande 6, 7, 8. Dans ce circuit, on considère que les vannes constituent les seuls composants qui peuvent être, soit en état de défaillance, soit en état de bon fonc- tionnement. Le circuit hydraulique considéré est dé- faillant si le fluide n'est pas transmis dans le con- duit aval 5. Lorsque seules les vannes I et 2 sont défaillantes, le fluide ne passe plus du conduit amont 4 vers le conduit aval 5; il en est de même lorsque les vannes 1 et 3 sont défaillantes. Dans ces deux cas, le circuit est mis en état de défaillance lorsque les vannes précitées sont défaillantes. Lorsque seules les vannes 1 et 3 sont en bon fonctionnement, le fluide passe d'amont en aval; le circuit reste donc en état de bon fonctionnement lors- que seules les vannes 1 et 3 sont en état de bon fonc- tionnement. La figure 2 représente schématiquement un circuit logique équivalent permettant de simuler le circuit hydraulique de la figure 1. C'est sur des en- trées de certains des composants de ce circuit que sont appliquées, comme on le verra plus loin en dé- tail, les séquences de signaux fournies par le généra- teur de séquences de signaux logiques combinés de l'invention. Ces signaux séquentiels de niveaux logi- ques 0 ou 1, appliqués sur des entrées de certains des composants du circuit de simulation, permettent de simuler électroniquement, soit la défaillance, soit le bon fonctionnement des composants correspondants du système hydraulique. Sur le schéma de la figure 2, les ensembles 10, 11, 12, de circuits logiques permettent de simuler soit la défaillance, soit le bon fonction- nement des vannes 1, 2, 3, de la figure 1. Ces ensem- bles de circuits logiques sont constitués de manière que si un signal de niveau logique 1 est appliqué sur une entrée 13 du circuit de simulation, un signal de niveau logique 1 doit apparaître sur la sortie 14 de ce circuit. Le signal de niveau logique 1 appliqué à l'entrée simule en fait l'arrivée du fluide dans le conduit 4, en amont du système hydraulique de La figu- re 1. Sur la sortie 14 du circuit de simulation, ce signal de niveau logique I permet de déduire que le système simulé est en état de bon fonctionnement et qu'il laisse passer le fluide arrivant à son entrée, quel que soit l'état de défaillance ou de bon fonc- tionnement d'un ou plusieurs des composants du circuit hydraulique simulé. Les ensembles logiques de simulation 10, 11, 12 comprennent respectivement des portes logiques de type "ET" 15, 16, 17. Chacune de ces portes comprend deux entrées. Les entrées 18, 19 des portes 15, 16, reçoivent le signal de niveau logique 1 appliqué sur l'entrée 13 du circuit, pour simuler l'arrivée du fluide dans le conduit 4 du circuit de la figure 1. Les autres entrées 20, 21, des portes 15, 16 sont re- liées respectivement aux sorties 22, 23 de mémoire 24, constituées par des bascules de type D. Les portes , 16 fournissent un signal de niveau logique I sur leur sortie lorsque les bascules D 24, 25 reliées à leurs entrées 20, 21 fournissent un signal de niveau logique 1 sur leurs sorties Q 22, 23. Inversement, ces portes fournissent un signal de niveau logique 0 lors- que les bascules de type D fournissent un signal de niveau logique 0. En fait, le niveau logique 1 du si- gnal fourni par les bascules de type D est représenta- tif du bon fonctionnement de la vanne correspondante du système simulé. Le niveau logique 0 de ce signal est au contraire représentatif de la défaillance ou du mauvais fonctionnement de cette vanne. De la même manière, la porte ET 17, de l'en- semble logique 12 correspondant à la vanne du circuit hydraulique de la figure 1, comprend une entrée 26 qui est reliée à la sortie d'une porte OU 27. Cette porte OU comprend deux entrées qui sont reliées respective- ment aux sorties des portes ET 15, 16. Elle est équi- valente au branchement de L'entrée de la vanne 3 avec les sorties des vannes 1, 2 du circuit hydrauLique. L'autre entrée 28 de la porte ET 17 est reliée à la sortie 29 d'une mémoire 30, -constituée elle aussi par une bascule de type D. Comme précédemment la présence d'un signal de niveau logique I sur La sortie 29 de la bascule 30, exprime le bon fonctionnement de la vanne correspondante 3 du circuit hydraulique simulée Au contraire, la présence d'un signal de niveau logique 0 sur la sortie 29, exprime le mauvais fonctionnement-ou la défaillance de la vanne 3. Un signal de niveau logique 1 est obtenu sur la sortie 22 de la bascule 24 et simule le bon fonc- tionnement de la vanne 1 correspondante, lorsqu'un signal EVEN2 de niveau logique 1, est appliqué sur l'entrée 31 de l'ensemble de simulation 10 en même temps qu'un signal d'horloge CKS est appliqué à la bascule 24; un signal de niveau logique 1 est bien entendu appliqué sur l'entrée 13 du circuit de simula- tion. Un signal de niveau logique 0 est obtenu sur la sortie 22 de la bascule 24 et simule la défaillance de la vanne 1, lorsqu'un signal EVEN1 de niveau logique 1, est appliqué sur l'entrée 32 de l'ensemble 10, en - même temps qu'un signal d'horloge CKS est appliqué à la bascule 24. De la même manière, les ensembles de simula- tion 11, 12, comprennent respectivement des entrées 33, 34 et 35, 36. Des signaux EVEN4, EVEN6, de niveau logique 1 appliques respectivement sur des entrées 33, simulent le bon fonctionnement des composants cor- respondants 2, 3 du circuit hydraulique. Des signaux EVEN3, EVEN5, de niveau logique 1 appliqués respecti- vement sur les entrées 34, 36 simulent la défaillance des composants correspondants 2, 3 du circuit hydrau- tique. Des signaux d'horloge CKS sont respectivement appliqués aux bascules 25 et 30. Dans L'ensemble 10, Le signal EVEN1 de ni- veau Logique 1, simulant la défaillance de La vanne 1, est appliqué à un inverseur 37, dont la sortie est reliée à une entrée d'une porte ET38. Une autre entrée de cette porte est reliée à la sortie 22 de la bascule 24. La sortie de la porte ET38 est reliée à une entrée d'une porte 0U39, qui reçoit sur une autre entrée, le signal EVEN2 de niveau logique I lorsque le bon fonc- tionnement de la vanne I doit être simulé. La sortie de la porte 0U39 est reliée à une entrée d'un multi- plexeur 40. Une autre entrée de ce multiplexeur reçoit à l'initialisation, un signal INIT provenant du géné- rateur de séquences de l'invention, comme on le verra plus loin en détail. La sortie du multiplexeur 40 est reliée à l'entrée D de la bascule 24. Une autre entrée de cette bascule reçoit les signaux d'horloge CKS, provenant du générateur de séquences de signaux Logi- ques combinés de l'invention. De la même manière, l'ensemble de simulation 11 comprend un inverseur 41, une autre porte ET42, une porte 0U43, un multiplexeur 44; l'ensemble de simula- tion 12 comprend lui aussi un inverseur 45, une autre porte ET46, une porte OU47 et un multiplexeur 48. Ces éléments sont reliés de la même façon que dans l'en- semble 10. On voit que dans le circuit de simulation qui vient d'être décrit, le niveau logique du signal sur la sortie 14 de ce circuit dépend du niveau logi- que des signaux séquentiels EVEN1, EVEN2, EVEN3, EVEN6, appliqués sur les entrées correspondantes de * simulation de ce circuit, par le générateur de séquen- ces de l'invention. Le fonctionnement de ce circuit de simulation va maintenant être expliqué de manière plus détaillée. Au début d'une séquence de signaux logiques combinés appliqués sur les entrées 31, 32,... , 36 du circuit de simulation, un signal INIT d'initialisa- tion, de niveau logique 1, fourni par le générateur de l'invention, est appliqué sur les entrées des multip- lexeurs 40, 44, 48. Ce signal de niveau logique I se retrouve sur Les sorties correspondantes des multiple- xeurs et il est appliqué sur les entrées D des bascu- les 24, 25, 30. Toutes ces bascules de type D mémori- sent alors Le niveau logique 1 à la première impulsion d'horloge CKS, fournie en même temps que le signal INIT. Les sorties Q, 22, 23, 29 des bascules 24, 25, fournissent alors respectivement des signaux de niveau logique 1. Le signal apparaissant à la sortie 14 du circuit de simulation présente alors le niveau logique 1. Les entrées 31, 32, 36 du circuit de simu- lation sont reliées, comme on Le verra plus loin en détail, aux sorties du générateur de séquences de l'invention. L'initialisation du circuit de simula- tion ayant été effectuée comme indiqué plus haut, si le générateur de séquence fournit par exemple un si- gnal EVEN3, de niveau logique 1 sur l'entrée 34 du circuit de simulation en même temps qu'une impulsion d'horloge CKS, la bascule 25 correspondant à la vanne 2 du système simulé, fournit sur sa sortie 23 un si- gnal de niveau logique 0, représentant la défaillance de la vanne 2. En appliquant successivement les si- gnaux EVEN1, EVEN2,..., EVEN6 sur les entrées corres- pondantes du circuitde simulation, à des instants suc- cessifs t. déterminés par l'horloge du générateur de l'invention, on simule donc la succession d'événements correspondants (défaillances ou bon fonctionnement) qui peuvent survenir dans le fonctionnement des compo- sants du circuit hydraulique simulé. En observant le niveau logique du signal sur la sortie 14 du circuit ae simutation, et en connaissant la séquence émise à chaque instant ti, il est donc possible de déterminer Les séquences qui conduisent à la défaillance ou au bon fonctionnement du circuit hydraulique simulé. C'est ainsi par exemple que dans le système de la figure 1 la défaillance peut être provoquée à la suite d'une séquence d'événements qui peut être la suivante: - défaillance de la vanne 1, - réparation ou bon fonctionnement de la vanne 1, - défaillance de la vanne 2, - défaillance de la vanne 1. Cette séquence correspond, pour le circuit de simulation, à l'application d'un signal EVEN1 de niveau logique 1 sur l'entrée 32, à l'instant ti, puis à l'application d'un signal EVEN2 de niveau logique 1 sur l'entrée 31 à l'instant t.+l, puis à l'application d'un signal EVEN3 de niveau logique 1 sur l'entrée 34, à l'instant t.+2, puis enfin à l'application d'un si- gnal EVEN1 de niveau logique 1 sur l'entrée 32 à l'instant t.+3. i La défaillance du système peut également être obtenue par la seule défaillance de la vanne 3. Dans ce cas, la séquence est constituée tout simple- ment par l'application d'un signal EVEN5 de niveau lo- gique 1 sur l'entrée 36 du circuit de simulation, à un instant unique t.. i Le circuit de simulation représenté sur cette figure comprend aussi des ensembles logiques 50, 51, 52, identiques, dans lesquels seul l'ensemble lo- gique 50 a été représenté en détail. Ces ensembles logiques sont reliés aux entrées d'une porte 0U53. Cette porte fournit sur sa sortie 54, un signal INVAL COMB, qui est appliqué au générateur de séquences de l'invention, lorsqu'une séquence ne doit pas être prise en compte par suite de la non observation de certains critères. C'est ainsi par exemple que dans le circuit de simulation qui vient d'être décrit, un si- gnal INVAL COMB de niveau logique 1 apparaît sur la sortie 54 de la porte 0U53, lorsqu'un signal de niveau logique 1 est appliquc sur une entrée de défaillance d'un composant (EVEN1, EVEN3 ou EVEN5 par exemple), et que le composant est déjà considéré comme défaillant. De la même manière, le signal INVAL COMB est mis au niveau logique 1, si un signal de niveau 1 est appli- qué sur une entrée (EVEN2, EVEN4 ou EVEN6) alors que le composant correspondant est déjà considéré comme étant en bon fonctionnement, la mémoire d'enregistre- ment de cet état ayant déjà sa sortie au niveau logi- que 1. Le signal INVAL COMB est appliqué sur une en- tree correspondante du générateur de l'invention, com- me on le verra plus loin en détail. L'ensemble logique 50 comprend une porte ET55 dont les entrées sont reliées respectivement à l'entrée de simulation 32 et à la sortie 22 de la bascule 24. La sortie de la porte ET55 est reliée à une entrée de la porte 0U53. Cet ensemble comprend aussi un inverseur 56 dont l'entrée est reliée à la sortie de la bascule 24 et dont la sortie est reliée à une entrée d'une porte ET57. Une autre entrée de la porte ET57 est reliée à l'entréede simulation 32. La sortie de la porte ET57 est reliée à une autre entrée de la porte 0U53. Les ensembles 51 et 52 sont consti- tués de la même façon. On n'a représenté sur la figure que leurs entrées reliées aux circuits 11, 12 corres- pondants, et leurs sorties reliées à des entrées de la porte 0U53. Les figures 3a et 3b représentent schémati- quement un générateur de séquence prédéterminé de si- gnaux logiques combinés, conforme à L'invention. Ce générateur comporte -des moyens séquen- tiels S1 qui présentent un nombre R de sorties EVEN1, EVEN2, EVEN3,..., EVENR; ces moyens sont capables de - fournir à chaque instant t. d'une succession d'-ins- tants et pour chaque séquence prédéterminée de signaux combinés, un nombre qi de signaux de niveau logique 1, fournis sur qi sorties et un nombre R-qi de signaux de niveau Logique 0, fournis sur R-qi sorties. La somme des nombresqi est égale à un nombre prédéterminé p de signaux de niveau logique 1, dans une combinaison ini- tiale enregistrée dans ces moyens séquentiels, comme on le verra plus loin en détail. Cette combinaison initiale correspond à la séquence prédéterminée que L'on cherche à obtenir et comprend p signaux de niveau Logique 1, ainsi que des signaux de niveau logique 0. D'une manière générale, et comme on Le verra plus Loin en détail, le nombre des instants successifs t. varie de 1 à m. m étant un nombre entier inférieur ou égal à p, tandis que qi est une valeur entière comprise entre 1 et p. Le tableau ci-dessous permettra de mieux comprendre sur un exempte particulier, L'obtention d'une séquence prédéterminée sur Les sorties du géné- rateur de séquences de l'invention. t. EVEN1 EVEN2 EVEN3 EVEN4 q. t1 1 0 0 0 q1=1 t2 0 O 1 O q2=1 t3 1 1 1 0 q3=3 Dans ce tableau, on a représenté Les niveaux -logiques 1 ou 0 des signaux fournis sur Les sorties EVEN1, EVEN2, EVEN3, EVEN4, du générateur, aux ins- tants successifs ti Ct1, t2, t3), lorsque i présente Les valeurs sccessives 1, 2, 3. On a également indiqué les valeurs de q1' q2, q3' qui indiquent, pour chaque instant ti, Le nombre de sorties du générateur de sé- quences qui sont à un niveau 1. On remarque que dans la séquence prédétermi- née choisie en exemple, le nombre de signaux logiques de niveau 1, est q1=1 à l'instant tl, q2=1 à l'instant t2 et q3=3 à l'instant t3. La somme q1+q2+q3 des va- leurs qi est égale à 5. La valeur p=5 correspond à un nombre prédéterminé p choisi de signaux logiques de niveau 1; ces p signaux de niveau 1 sont pris dans une combinaison initiale de N signaux comprenant comme on le verra plus loin en détail, N-p signaux de niveau logique O et p signaux logiques de niveau 1 fournis simultanément et non pas en séquence, cette combinai- son initiale de signaux logiques est enregistrée, com- me on le verra plus loin, dans les moyens séquentiels du générateur de l'invention. Ce générateur comprend aussi des moyens CH1, VALCOL, reliés aux moyens séquentiels S1, pour initia- liser ces moyens séquentiels et pour qu'ils fournis- sent les signaux de niveau logique 1 et O aux instants successifs t. correspondant à la séquence prédétermi- *1 née, à partir de la combinaison initiale enregistrée dans les moyens séquentiels. Ces moyens d'initialisa- tion seront décrits plus loin en détail. Le générateur comprend aussi des moyens de commande M1 reliés aux moyens séquentiels S1 pour que ceux-ci fournissent aux instants successifs ti., sur les R sorties EVEN1, EVEN2,...,EVENR, les qi signaux de niveau logique 1 et les R-qi signaux de niveau lo- gique O. La somme des nombres qi, pour l'ensemble des instants t. de la séquence est égale à p et est fixée par la combinaison initiale de signaux appliques aux moyens séquentiels. Il est bien évident que les nom- Z567339 bres R, qi et p mentionnés plus haut, sont des nombres entiers. Enfin, le générateur comprend des moyens d'arrêt A1, reliés aux moyens séquentiels S1, pour arrêter la fourniture de signaux sur les R sorties du générateur de l'invention, après une séquence prédé- terminée de signaux combinés. Les moyens séquentiels S1 comprennent un gé- nérateur PM de signaux logiques combinés présentant N sorties capables de fournir les combinaisons initiales (p signaux de niveau 1 et N-p signaux de niveau O) correspondant aux séquences prédéterminées que l'on souhaite obtenir. Les p sorties de ce générateur sont représentées en QP1...QPn sur la figure. Chaque combi- naison initiale est formée de p signaux de niveau lo- gique 1 produits sur p sorties du générateur et de N-p signaux de niveau logique 0, produits sur N-p sorties de ce générateur. Le générateur PM capable de fournir les combinaisons initiales de signaux, est par exempl.e celui qui est décrit dans la demande de brevet fran- çais n'8101392, déposée le 26 janvier 1981, au nom du même demandeur. Les moyens A1 qui permettent d'arrêter les moyens séquentiels et qui sont reliés à ce généra- teur, sont ceux qui sont décrits en exemple dans cette demande de brevet. Les moyens CH1, reliés au généra- teur et qui permettent d'initialiser les moyens sé- quentiels sont aussi ceux qui sont décrits en exemple dans la demande de brevet précitée. Les moyens CVALCOL qui sont reliés aux moyens CH1, et qui permettent eux aussi d'initialiser les moyens séquentiels seront dé- crits plus loin en détail. Les moyens séquentiels S1 comprennent aussi des multiplexeurs MX1, MX2,..., MXR qui reçoivent si- multanément sur N de leurs entrées, les p signaux de niveau logique 1 et les N-p signaux de niveau logique 0 correspondant aux combinaisons initiales. Ces multi- plexeurs fournissent sur R sorties, les qi signaux de niveau logique 1 et les R-qi signaux de niveau logique 0, en un certain nombre d'instants successifs t. de chaque séquence. Les moyens de commande il sont reliés au générateur PN de signaux combinés et au multiple- xeur MX1... MXR. Le nombre des instants successifs ti varie de I à m, m étant un nombre entier inférieur ou égal à p. En effet, dans une séquence qui comporterait p si- gnaux de niveau logique 1 et pour laquelle un seul signal de niveau logique I serait fourni à chaque instant ti, un nombre p d'instants t. serait nécessai- re pour décrire toute une séquence comprenant p si- gnaux de niveau logique 1. Le générateur de séquences de l'invention comprend aussi des moyens Logiques de contr6le C qui seront décrits plus loin en détail. Ces moyens logi- ques de contrôle sont reliés aux R sorties des muti- pLexeurs ainsi qu'aux moyens de commande M1. Xls per- mettent d'avorter toute séquence pour Laquelle à tout instant ti, deux signaux de sortie parmi les R signaux fournis par les multiplexeurs, sont simultanément au niveau logique 1 alors qu'ils ne devraient pas l'être dans la simulation que l'on désire effectuer. Ces moyens de contrôle permettent aussi d'avorter toute séquence pour laquelle, à tout instant ti, aucun si- gnal de niveau logique I n'est fourni sur -t'une quel- conque des R sorties des multiplexeurs, alors que des signaux de niveau logique I sont fournis à un instant ti+k, avec k>i. La structure de ces moyens de contrôle ainsi que leur fonctionnement seront décrits plus loin en détail. Ces moyens comprennent notamment une entrée INVALCOMB de commande d'invalidation, par l'intermé- diaire des moyens de commande M1, d'une combinaison initiale de signaux Logiques présents sur Les N sor- ties du générateur PM de signaux logiques combinés. Cette entrée peut être retiée à La sortie correspon- dante du circuit de simulation de la figure 1. Les moyens logiques de contrôLe (C) compren- nent aussi des entrées EVENEXT et INHIB, qui, en fonc- tion des besoins de La simulation à effectuer et comme on le verra plus loin en détail, reçoivent des signaux permettant d'arrêter ou non la présentation d'une com- binaison de signaux sur les sorties du générateur sé- quentieL. Ces moyens de contrôle comprennent aussi une entrée VALCOL, reliée à des moyens d'enregistrement de signaux, qui, combinés avec Les signaux fournis par Les muLtipLexeurs, permettent d'invalider toute sé- quence ne correspondant pas à une séquence souhaitée. Cette possibilité sera décrite ultérieurement. Les moyens de commande M1 fournissent au circuit de simulation décrit plus haut, des signaux d'horloge CKS et d'initialisation INIT dans des condi- tions qui seront décrites plus loin. Ces moyens de commande fournissent également au générateur PM un signal COMBINSUIV, lorsqu'une séquence de signaux pré- déterminée a été décrite et que Le générateur PM doit présenter la combinaison initiale suivante, permet- tant de décrire une autre séquence prédéterminée. Ces moyens de commande M1 reçoivent du générateur PM, un signal COMBINOK, lorsqu'une nouvelle combinaison ini- tiale permettant de décrire une séquence prédéterminée est présente sur les sorties QP1,..., QPN du généra- teur PM de combinaisons initiales. La structure et le fonctionnement des moyens essentiels du générateur de l'invention vont mainte- nant être décrits de manière plus détaillée. Les moyens de commande M1 comprennent une horloge H fournissant des impulsions CKH sur l'entrée a-une porte ET60. Lette porte est retiee par une autre entrée à La sortie d'un inverseur 61. L'entree de cet inverseur est reliée à la sortie Q d'une bascule mo- nostable 62, dont le rôle sera décrit plus loin en détail, qui fournit notamment le signal COMBINSUIV appliqué au générateur PM. La sortie de la porte 60 fournit des impulsions d'horloge CKS au circuit de si- mulation décrit plus haut. Cette sortie est aussi re- liée à une entrée d'une porte ET63, dont une autre entrée est reliée à la sortie d'un inverseur 64. La sortie de la porte ET63 est reliée à une entrée d'hor- loge CK d'un compteur CP à trois éléments binaires, pour lui appliquer les impulsions d'horloge CKS. Les bascules du compteur sont désignées par A, B, C. La sortie de la porte ET63 est aussi reliée à une entrée d'horloge CK de la bascule 62, ainsi qu'a une entrée d'horloge CK d'une mémoire MEVEN, constituée par une bascule de type D. Les sorties du compteur CP sont reliées aux multiplexeurs MX1, MX2,..., MXR, pour que ceux-ci présentent sur une ou plusieurs de leurs sor- ties EVEN1, EVEN2,..., EVENR, un ou plusieurs des signaux présents sur leurs entrées QP1,..., QPN. Les sorties du compteur CP sont reliées aux multiplexeurs, par l'intermédiaire de portes 0U65, 66, 67; ces por- tes peuvent également recevoir, sur une autre entrée, le signal d'inhibition INHIB. Les sorties du compteur CP sont aussi reliées aux entrées d'une porte ET68, dont la sortie fournit le signal d'initialisation INIT appliqué au circuit de simulation décrit plus haut. Enfin, la première et la dernière sorties du compteur CP sont reliées aux entrées d'une porte ET69 dont la sortie est reliée à une entrée d'une porte OU70 des moyens de contrôle C. Les moyens de commande M1 com- prennent aussi une bascule monostable 71 dont l'entrée reçoit le signal COMBINOK provenant du générateur PM lorsqu'une combinaison initiale prédéterminée est présente sur les sorties de ce générateur de combinai- sons PM. La sortie de cette bascule monostable four- nit, comme on le verra plus loin en détail, une impul- sion RAZ de remise à zéro du compteur CP et de comman- de de la bascule 62, qui fournit alors le signal COMBINSUIV appliqué au générateur PM pour que celui-ci présente, sur ses sorties une nouvelle combinaison initiale de signaux logiques. La sortie de la porte OU70 des moyens de contrôle C est reliée à l'entrée D de la bascule 62. Les moyens de contr8le C comprennent des registres à décalage VALCOL1, VALCOL2,..., VALCOL R reliés en série et charges à l'initialisation du géné- rateur de séquences de signaux logiques. Ces registres sont chargés sur leursentrées VALCOL, par des signaux provenant des moyens d'initialisation C VALCOL, sous la commande d'impulsions de décalage CLK. Ces regis- tres permettent, comme on le verra plus loin en détail de valider les signaux de sortie des multiplexeurs en fonction de la simulation à effectuer, ou d'invalider certaines séquences qui ne correspondent pas aux sé- quences souhaitées. Chaque registre tel que le regis- tre VALCOL 1 par exemple, comprend une sortie qui est reliée à une entrée d'une porte ET71 dont une autre entrée est reliée à la sortie du multiplexeur MX1 cor- respondant des moyens séquentiels. La sortie de cette porte ET71 est reliée, d'une part à une entrée d'une porte 0U72, et d'autre part à une entrée d'une porte ET73. Une autre entrée de la porte ET72 et une autre entrée de la porte ET73 sont reliées à la sortie d'une porte OU74 semblable, pour le registre VALCOL 2, à la porte 0U72. La sortie de la porte OU73 est reliée à une entrée d'une porte 0U75 dont une autre entrée est reliée à la sortie d'une porte OU76, semblable pour le registre VALCOL 2 à la porte OU75. La sortie de la porte 0U75 est reliée à une entree d'une porte OU?77. Les portes 71, 72, 73, 75 forment un ensemble logique, dont le rôle sera décrit plus loin en détail, cet en- semble reçoit des signaux provenant du multiplexeur MX1, du registre à décalage VALCOL 1 correspondant, ainsi que des signaux provenant de l'ensemble logique précédent, correspondant au registre à décalage VALCOL 2 et au multiplexeur IX2. Le dernier ensemble, non représenté sur la figure, qui correspond à l'avant-dernier multiplexeur MX(R-1) et à l'avant- dernier registre à décalage VALCOL(R-1) reçoit, sur les entrées des portes OU qui correspondent aux portes 0U72, 75, et sur L'entrée de La porte ET correspondant à la porte 73 du premier ensemble, des signaux de ni- veau logique 0, comme indiqué sur La figure. La sortie de la porte OU72 est reliée à une entrée d'une porte OU78. Une autre entrée de La porte 78 peut recevoir, dans des conditions qui seront dé- crites plus loin en détail, le signat EVENEXT. Ce si- gnal peut également être appliqué à une entreé d'une porte ET79, dont la sortie est reliée à une autre en- trée de la porte OU77. Une autre entree de la porte ET79 est reliée à la sortie de la porte 0U72. La sor- tie de la porte ET77 est reliée à une entrée de la porte OU70. La sortie de la porte 0U78 est reliée d'une part à l'entrée D de la bascule MEVEN et, d'au- tre part à une entrée d'une porte ET80. Une autre en- trée de la porte 80 est reliée à la sortie d'un inver- seur 81. L'entrée de cet inverseur est reliée à la sortie Q de la bascule MEVEN. La sortie de la porte ET80 est reliée à une entree de la porte OU7O. Les explications qui suivent vont permettre maintenant de mieux comprendre le fonctionnement du générateur de séquences de signaux logiques combinés, qui vient d'être décrit. Lorsque Le générateur de combinaisons ini- tiales PM a émis une combinaison initiale comprenant p signaux de niveau logique 1 et N-p signaux de niveau logique 0, sur ses N sorties QP1,..., QPN, il émet un signal COMBINOK qui est appLiqué à La bascule monosta- bLe 71. Cette bascule fournit une impulsion qui met au niveau Logique 1 Les trois bascules A, B, C, du comp- teur CP. Il en résulte que la porte ET68 fournit un signal INIT de niveau logique 1 qui est appliqué, comme indiqué plus haut, au circuit de simulation pour l'initialiser. Jusqu'à cet instant, aucun signal EVEN1,... , -EVENR n'est fourni sur les sorties des multiplexeurs MX1,..., MXR. Cette inhibition des sor- ties des multiplexeurs vient du fait que les signaux de sortie du compteur, qui sont appliqués. aux entrées de commande (0, 1, 2... 6, 7) des multiplexeurs, par L'intermédiaire des portes 0U65, 66, 67, sont tous au niveau logique 1. Dans ce cas, c'est l'entrée OV de chaque multiplexeur qui est sélectionnée car l'entrée n 7 du pultiplexeur reçoit un signal de niveau logi- que 0. Lorsque La première impulsion CK de l'horlo- ge H est produite à l'instant to (pour i=O), le front montant de cette impulsion provoque l'initialisation du circuit de simulation car le signal INIT est au niveau logique 1 (les 3 entrées de La porte ET68 étant au niveau logique 1). Pour l'impulsion d'horloge CKS suivante, c'est-à-dire au temps t1 (i=1), Les bascules A, B, C du compteur présentent sur leur sortie, des signaux de niveau Logique 0; ces signaux commandent les multi- plexeurs pour que ceux-ci fournissent sur les sorties EVENl,..., EVENR, des signaux correspondant respecti- vement aux signaux appliques sur les entrées QPS, QP10, QP15,..., QPN de ces multiplexeurs, car l'en- trée n O de chaque multiplexeur, est sélectionnée. IL est évident que tout autre mode de comptage associé à toute autre façon de commander Les multiplexeurs, peut être envisagé. A l'impulsion d'horloge suivante (corres- pondant au temps t2 pour i=2, le signal de sortie de la bascule A du compteur est au niveau logique 1 tan- dis que les signaux de sortie des bascules B et C sont au niveau logique 0. Les multipl'exeurs vont alors fournir sur leurs sorties EVEN1,..., EVENR des si- gnaux correspondant aux signaux appliques sur leurs entrées QP4, QP9, QP14,..., QPN-1, par le générateur PM de combinaisons initiales. Après le temps t5 (l'exemple de réalisation considéré comprenant des multiplexeurs à 5 entrées) la bascule 62 est actionnée par une nouvelle impulsion d'horloge. En effet, au temps t5, les signaux de sor- * tie des bascules A et C du compteur sont au niveau logique 1 et il en résulte que la sortie de la porte ET69 est elle aussi au niveau logique 1. Ce niveau logique est transmis à la bascule 62 par l'intermé- diaire de la porte OU70. Un signal COMBINSUIV de ni- veau logique I apparaît donc à la sortie de la bascule 62. Ce signal est appliqué au générateur de combinai- son PM qui fournit alors, sur ses sorties, la combi- naison initiale suivante; le générateur de séquences va alors fournir une nouvelle séquence prédéterminée de signaux, à partir de cette nouvelle combinaison initiale. Lorsque le générateur PM est prêt à fournir une nouvelle combinaison initiale, un signal COMBINOK est appliqué à la bascule monostable 71; le signal de sortie de la bascule 71 remet à zéro la bascule 62 dont la sortie était à 1 à la fin de la séquence précé- denteo On notera que Lorsqu'à La fin d'une séquen- ce, Le signal de sortie de La bascuLe 62 passe au niveau Logique 1, L'horLoge H est bloquée puisque L'entrée de La porte ET60, qui est reliée à La sortie de L'inverseur 61, est au niveau Logique O. Un exempLe numérique va permettre de mieux comprendre Le fonctionnement séquentiel du générateur de l'invention: on suppose par exempLe que Le généra- teur de combinaison PM fournit la combinaison initiaLe de signaux QP3=1, QP10=1, QP14=1, QP19=1 sur 4 de ses sorties, Les signaux sur Les autres sorties du généra- teur étant au niveau Logique O. A partir de cette com- binaison, le générateur séquentiel va fournir par exempLe, sur les sorties EVEN1, EVEN2, EVEN3, EVEN4, les signaux séquentiels prédéterminés suivants: le signal EVEN1 correspondant au signal QP3 de niveau Lo- gique 1, est fourni au temps t3. Le signal EVEN2 co- respondant au signal QP10 de niveau logique 1 est fourni au temps t1. Le signal EVEN3 correspondant au signal QP14 de niveau logique 1, est fourni au temps t2. Le signal EVEN4 correspondant au signal QP19 de niveau logique 1, est fourni au temps t2. Cet exemple permet de mieux comprend qu'à une combinaison initiale donnée de signaux de niveau logique 1 et de niveau logique O fournis sur les sor- ties QP1,..., QPN du générateur de combinaisons PM, correspond sur les sorties du générateur séquentieL une séquence prédéterminée de signaux, fournis aux instants successifs t.. Les moyens CH1 d'initialisation, sont les mêmes que ceux qui sont décrits dans la demande de brevet n 8101392 précitée; ces moyens sont associés avec les moyens d'initialisation VALCOL qui permet- tent, comme on le verra plus Loin en détail, d'invaLi- der certaines séquences, sur les sorties des multiple- xeurs. Les moyens d'arrêt A1 sont identiques à ceux qui sont décrits dans la demande de brevet n'8101392. On va maintenant décrire les moyens qui per- mettent d'invalider une séquence qui ne correspond pas à une séquence de signaux souhaitée, sur les sorties des multiplexeurs. L'ensemble de registres VALCOLI, VALCOLR permet d'enregistrer autant d'éléments binaires qu'il y a de multiplexeurs. Chaque élâment binaire qui est à 1 dans l'un des registres VALCOL1p VALCOLN permet de valider un signal de sortie EVEN1 ou EVEN2,...,ou EVENR correspondant. La sortie notée 1 EVEN de la porte 0U78 est au niveau Logique 1, s'il existe au moins un signal EVEN1 ou EVEN2...o ou EVENR de niveau Logique 1 en même temps qu'un élément binaire de valeur I dans un registre VALCOL1 ou VALCOL2... ou VALCOLR correspondant. La sortie 2 EVEN de la porte OU77 est au niveau Logique 1, s'il existe au moins deux sorties EVEN1 ou EVEN2... ou EVENR au niveau logique 1 et que des éléments binaires de valeur 1 se trouvent dans deux des registres VALCOLIO..o VALCOLN correspondant aux deux multiplexeurs dont les sorties sont au niveau logique 1. La sortie 2 EVEN de la porte 77 permet d'in- valider une séquence dans laquelle deux sorties du générateur séquentiel sont au niveau logique 1 alors qu'elles ne devraient pas l'être pour la simulation souhaitée. Dans ce cas, la sortie 2EVEN est au niveau logique 1. La séquence en cours est avortée car l'en- trée D de la bascule 62 est alors au niveau 1et que le signal COMBINSUIV sur la sortie de cette bascule, passe au niveau logique 1. Une nouvelle combinaison initiale est alors présentée sur les sorties du géné- rateur PM. Les moyens qui viennent d'être décrits per- é5 mettent d'empêcher l'arrivée simultanée de deux événe- ments (deux niveaux Logiques 1 simultanés sur deux sorties du générateur séquentiel). Dans d'autres cas de simulation, ces moyens peuvent être inhibés de fa- çon au contraire, à permettre comme on le verra plus loin, l'arrivée simultanée de deux événements. Les moyens de contrôLe C comprennent aussi des moyens pour avorter toute séquence dans laquelle, à un instant ti, aucun signal de niveau Logique 1 ne serait fourni sur l'une quelconque des R sorties des multiplexeurs, alors que des signaux de niveau logique 1 sont fournis à l'instant ti+k. En effet, il ne ser- virait à rien de décrire une séquence dans Laquelle une impulsion d'horloge ne procurerait aucun événement sur l'ensemble des sorties du générateur séquentiel (toutes les sorties EVEN1,..., EVENR sont au niveau logique 0). C'est ainsi par exemple, qu'une séquence qui permet d'obtenir le signal INIT à la première im- pulsion d'horloge puis Les signaux EVEN1 et EVEN3 de niveau Logique 1, pour La deuxième et la troisième impulsions d'horloge, est équivalente à la séquence qui permet d'obtenir Le signaL INIT à la première im- pulsion d'horloge puis le signaL EVEN1 (niveau logique 1) à la deuxième impulsion d'horloge, aucun signal à la troisième impulsion d'horloge, et le signal EVEN3 (niveau logique 1) pour La quatrième impulsion d'hor- loge. La deuxième séquence citée en exempte est, équi- valente à la première, mais aucun événement ne se pro- duit à la troisième impulsion d'horloge. Cette séquen- ce présente à la troisième impulsion d'horloge, une perte de temps inutile.- Les moyens qui permettent -30 d'avorter ce type de séquence comprennent essentielle- ment la mémoire MEVEN. Cette mémoire est initialisée à son entrée PR, au niveau logique 1, Lors de l'appari- tion du signal COMBINOK. Dès qu'il y a absence d'évé- nement (signaux de niveau logique 0 sur toutes Les sorties EVEN1,..o, EVENR du générateur séquentiel, pour une impulsion d'horloge, la mémoire MEVEN passe au niveau logique 0. Dans ce cas en effet, le signal de sortie de la porte OU78 est au niveau logique 0. Si après cette absence d'événement intervient la présence d'un événement, le signal lEVEN est au niveau logique 1. L'absence d'événement (signal de sortie de la bas- cule MEVEN, au niveau logique O) est détectée par la porte ET80 qui applique, par l'intermédiaire de la porte OU70, sur t'entrée D de la bascule 62, un signal de niveau logique 1. La sortie Q de cette bascule 62 passe alors au niveau 1, vient bloquer l'horloge H, par l'intermédiaire de l'inverseur 61 et de la porte ET60. La séquence en cours est arrêtée, Le signal COMBINSUIV de niveau logique 1 commande le générateur de combinaison PM pour que celui-ci fournisse une nou- velLe combinaison initiale. Les moyens de contrôle C comprennent une entrée INVALCOMB, de commande d'invalidation d'une combinaison initiale de signaux logiques, présents sur les sorties du générateur PM. Ce signal de niveau lo- gique 1, peut être appliqué au générateur séquentiel, par le circuit de simulation décrit plus haut, lorsque la séquence ne satisfait pas à certains critères pré- déterminés. Le signal INVALCOMB est appliqué à la bascule 62, par l'intermédiaire de la porte OU70. La sortie de cette bascule qui est alors au niveau logi- que 1 bloque l'horloge H et commande le générateur PM pour que celui-ci fournisse sur sa sortie une autre combinaison initiale. L'entrée EVENEXT permet d'arrêter ou non en fonction des besoins de la simulation à effectuer, la présentation d'une combinaison de signaux sur les sor- ties du générateur séquentiel, en relation avec un si- gnal présenté sur l'entrée INHIB.o Les entrées INHIB et EVENEXT sont reliées à des circuits logiques dont les connexions ne seront pas décrites en détail; ces circuits comprennent des bascules D 90, 91, des portes ET 92, 93 et des inverseurs 94, 95. Lorsqu'un signal de niveau logique 1 est ap- pliqué sur l'entrée EVENEXT, il produit d'une part les signaux 1EVEN et éventuellement 2EVEN décrits plus haut et, d'autre part, il bloque la propagation des signaux d'horloge CKH vers le circuit de simulation (signal CKS) et vers le générateur séquentiel (signal CK), par l'intermédiaire des portes 92, 60 et de l'in- verseur 95, la bascule D90 étant initialement au ni- veau logique 0. Simultanément, un signal de niveau 0 ou 1 est appliqué sur l'entrée INHIB selon que la simula- tion en cours nécessite l'application ou non des si- gnaux fournis sur les sorties du générateur séquen- tiel. Le signal INHIB est mémorisé par la bascule D91 à l'impulsion d'horloge CKH suivante (non transmise au circuit de simulation et au générateur séquentiel). Cette même impulsion provoque un passage du niveau lo- gique 0 au niveau logique 1 de la bascule D90, cette bascule provoque alors la réapparition du signal d'horloge CKS du circuit de simulation et du signal d'horloge CK du générateur séquentiel. Cependant le signal CK n'est effectivement validé que si la bascule 91 est restée au niveau logique 0. La porte ET93 per- met la remise à zéro de la bascule 91 à l'impulsion d'horloge suivante car la bascule 90 applique un si- gnal de niveau logique I sur l'inverseur 94 dont la sortie est alors à zéro. Le signal INHIB de niveau logique I n'est utilisé en fait que lorsque le signal 1EVENEXT est lui-même au niveau logique 1. La mémorisation du signal INHIB est néces- saire du fait que le signal INHIB dépend des signaux fournis par le générateur séquentiel et que la présen- ce des signaux délivres pour ce générateur dépend eLle aussi de La présence de ce signal INHIB; cette mémo- risation évite toute osciLLation due à la présence d'un tel reboucLage. REVENDICATIONS 1. Générateur de séquences prédéterminées de signaux logiques combinés, caractérisé en ce qu'il comprend: - des moyens séquentiels (S1) comprenant un nombre R de sorties (EVEN1,..., EVENR) capables de fournir à chaque instant ti d'une succession d'ins- tants de chaque séquence prédéterminée de signaux com- binés, un nombre qi de signaux de niveau logique 1, fournis sur q. sorties et un nombre R-qi de signaux de niveau logique 0, fournis sur R- qi sorties, la somme des nombres q. étant égale à un nombre prédéterminé p de signaux de niveau logique 1, - des moyens (CH1, VALCOL) reliés aux moyens séquentiels (SI) pour les initialiser et pour qu'ils fournissent les signaux de niveaux Logiques 1 et 0 aux instants successifs ti correspondant à la séquence prédéterminée, à partir d'une combinaison initiale en- registrée, - des moyens de commande (M1) reliès aux moyens séquentiels pour que ceux-ci fournissent aux instants ti sur les R sorties, les qi signaux de ni- veau logique 1 et les R-q. signaux de niveau logique 0, de sorte que la somme des nombres qi soit égale à p, pour l'ensemble des instants t. de la séquence, Les nombres R, qi et p étant des nombres entiers, - des moyens d'arrêt (A1) reliés aux moyens séquentiels (S1) pour arrêter la fourniture de signaux sur les R sorties, apres une séquence prédéterminée de signaux combinés. 2. Générateur de séquences de signaux logi- ques combinés, selon la revendication 1, caractérisé en ce que Les moyens séquentiels (Si1) sont des moyens séquentiels de multiplexage, capables d'enregistrer lesdites combinaisons initiales pour fournir sur R sorties, les qi signaux de niveau logique 1 et les R-qi signaux de niveau logique 0, chaque combinaison initiale comportant p signaux logiques de niveau 1, et des signaux de niveau logique 0. 3. Générateur de séquences de signaux logi- ques combinés, seLon la revendication 2, caractérisé en ce que les moyens séquentiels de multiplexage (S1) comprennent: - un générateur (PM) de signaux logiques combinés présentant N sorties (QP1,..., QPN), capable de fournir lesdites combinaisons initiales, corres- pondant auxdites séquences prédétermines, chaque com- binaison initiale étant formée de p signaux de niveau logique 1 produits sur p sorties du générateur de si- gnaux combinés et N-p signaux de niveau logique 0 pro- duits sur N-p sorties du générateur (PM) de signaux combinés, - des multiplexeurs (MX1,... MXR) recevant sur N entrées les p signaux de niveau logique 1 et les N-p signaux de niveau logique 0 correpondant aux com- binaison initiales et fournissant sur R sorties, les qi signaux de niveau logique 1 et les R-qi signaux de niveau logique O, aux instants successifs ti de chaque séquence, les moyens d'initialisation (CH1) étant re- liés au générateur (PM) de signaux combinés, les moyens de commande (M1) étant reliés au générateur (PM) de signaux combinés et aux multiplexeurs. 4. Générateur de séquences de signaux logi- ques combinés, selon la revendication 3, caractérisé en ce que le nombre des instants successifs t. varie de 1 à m, m étant un nombre entier inférieur ou égal à p. q.i étant une valeur entière comprise entre 1 et p. 5. Générateur de séquences de signaux logi- ques combinés, selon la revendication 3, caractérisé en ce qu'il comprend en outre des moyens logiques de contrôle (C) reLiés aux R sorties des muLtiplexeurs et aux moyens de commande, et comportant des moyens pour avorter toute séquence pour laqueLLe, à tout instant ti, deux signaux de sortie parmi les R signaux de sor- ties des multiplexeurs (MX1,..., MXR) sont simultané- ment au niveau logique 1, aLors qu'ils ne devraient pas L'être. 6. Générateur de séquences de signaux logi- ques combinés, seLon La revendication 5, caractérisé en ce que Les moyens de contr8le (C) comprennent en outre des moyens pour avorter toute séquence pour la- quelle, à tout instant ti, aucun signal de niveau Logique 1 n'est fourni sur L'une quelconque de R sor- ties des multiplexeurs à un instant ti d'une séquence, alors que des signaux de niveau logique 1 sont fournis à un instant ti+k, avec k> 1. 7. Générateur de séquences de signaux logi- ques combinés, seLon La revendication 6, caractérisé en ce que les moyens logiques de contrôle comprennent une entrée (INVALCOMB) de commande d'invalidation par les moyens de commande (M1), d'une combinaison initia- le de signaux logiques présents sur les N sorties du générateur (PM) de signaux logiques combinés. 8. Générateur de séquence de signaux logi- ques combinés, selon la revendication 7, caractérisé en ce que les moyens Logiques de contrôle (C) compren- nent en outre une entrée (EVENEXT) et une entrée (INHIB) de commande de mise au niveau Logique O des signaux de sortie des multiplexeurs, Lorsqu'à un ins- tant t. la séquence de signaux prévue à cet instant sur les sorties des multiplexeurs, ne doit pas être utilisée. 9. Générateur de séquences de signaux logi- ques combinés, selon la revendication 1, caractérisé en ce que les moyens de contr@le (C) comprennent des moyens d'enregistrement de signaux (VALCOL), qui com$ binés avec les signaux fournis sur les R sorties des multiplexeurs (MXI,..., MXR), permettent d'invalider toute séquence ne correspondant pas à une séquence de signaux souhaitée sur Les sorties des multiplexeurso