FR 2494869 A1 19820528 FR 8121667 A 19811119 La présente invention concerne une disposition de circuit propre à simuler les unités périphériques reliées à des circuits d'interface d'un module d'entrée-sortie d'un ordinateur électronique. Un ordinateur peut être relié à une pluralité d'unités périphériques, qui peuvent être extrêmement différentes entre elles en ce qui concerne les caractéristiques (vitesse de transmission, transmission série ou parallèle, code employé, etc.). A titre d'exemple, citons les télescripteurs, les lecteurs de fiches, bande perforée ou ruban magnétique, impri- meuses lentes ou rapides, terminaux données, perforateurs de fiches ou bande, etc. Les circuits d'interface d'un ordinateur sont souvent regroupés en unités fonctionnelles, appelées modules, qui comprennent également des circuits de supervision et de gestion du branchement entre circuits d'interface et unités périphé- riques. A chaque type d'unité périphérique, reliable à l'ordi- nateur, correspond un circuit d'interface, qui présente des caractéristiques spécifiques: il s'ensuit que les caractéris- tiques électriques du module d'entrée-sortie d'un même ordina- teur diffèrent également entre elles, étant subordonnées à celles des circuits d'interface qui composent chaque module. Cette non-uniformité peut comporter des problèmes et des frais pour le développement et l'essai des modules d'entrée- sortie, vue que cela peut exiger la présence physique des unités périphériques à relier à chaque module, pour effectuer les essais nécessaires au cours du développement et l'essai dans le cadre de la production. Il est clair que cela peut être très onéreux et compor- ter également des problèmes logistiques considérables. La présente invention vise à pallier lesdits inconvé- nients et consiste dans une disposition de circuit capable de se brancher aux circuits d'interface d'un module, en simulant le comportement électrique des unités périphériques, auxquelles le module est destiné à être relié. Etant microprogrammée, l'inven- tion peut être facilement adaptée aux caractéristiques électri- ques exigées par le module sous essai. Un simulateur d'unités périphériques, suivant l'inven- tion, comprend: - un microprocesseur, - une pluralité de circuits d'interface, dirigés par un circuit de sélection, - un bus données bidirectionnel, qui relie entre eux le micro- processeur et le circuit de sélection, et des unités d'inter- échange propres à gérer le dialogue entre les circuits d'inter- face et le microprocesseur, - un premier bus unidirectionnel, dirigé par une première unité d'interéchange, sur lequel transitent les données provenant du bus données et destinées aux circuits d'interface, - au moins un deuxième bus unidirectionnel, dirigé par une seconde unité d'interéchange, sur lequel transitent les données destinées au bus données et provenant des circuits d'interface. L'invention sera maintenant décrite conformément à un exemple de réalisation, illustré dans les figures annexées dont la figure 1 représente un schéma synoptique de l'inven- tion, la figure 2 montre schématiquement une possible utili- sation de l'invention, pour essayer un module d'entrée-sortie. La figure 1 montre le schéma synoptique d'un exemple de réalisation d'un simulateur d'unités périphériques, selon l'invention. Dans la figure a été indiqué par MT un micro- processeur, qui dirige le bon fonctionnement du simulateur SP; il est relié, au moyen d'un bus bidirectionnel BDB à une unité DEP pour la sélection des circuits d'interface (SINP, SIND), à un premier circuit d'interéchange SOUT, qui dirige le transit des données provenant du bus bidirectionnel BDB et destinés à un circuit d'interface et à, au moins, un second circuit d'interéchange (SIP, SID), qui dirige les données provenant d'un circuit d'interface et destinés au bus bidirectionnel BDB. Dans la figure, on a représenté schématiquement un simultateur d'unités périphériques SP, à même d'être relié à un module comprenant des circuits d'interface (comme celui décrit, par exemple, dans la demande de brevet n0 24283 A/80 du 26/8/1980), propres à s'assurer que deux de ces circuits d'inter- face, adjacents et associés à des unités périphériques destinées à remplir en même temps les mêmes fonctions, évoluent en syn- chronisme (procédure de "link"). A cet effet, les circuits d'interface du simulateur SP sont définis, suivant leur position, "pairs" et "impairs", et le simulateur comprend deux seconds circuits d'interéchange (SIP et SID), auxquels parviennent, par deux bus unidirection- nels distincts(BP et BD), les données provenant des circuits d'interface "pairs" SINP et des circuits "impairs" SIND. Le simulateur SP est donc en mesure de recevoir et de gérer en même temps les données provenant des deux interfaces adjacentes, opérant dans la modalité "link". Les données provenant du bus bidirectionnel BDB, dirigés par le premier circuit d'interéchange SOUT, arrivent à tous les circuits d'interface (SIND, SINP), au moyen d'un autre bus unidirectionnel BC. Si le module ne possède pas des circuits d'interface à même d'opérer dans la modalité "link" dans le simulateur, la distinction en circuits d'interface "pairs" et "impairs" n'a plus raison d'être, et tous les circuits d'interface envoient des données à un seul second circuit d'interéchange, au moyen d'un seul bus unidirectionnel. La désignation de l'interface à sélectionner est envoyée, par le microprocesseur MP et à travers le bus BDB, au circuit DEP, o elle est mémorisée sur le registre de commande RC et, ensuite, envoyée au décodage DEC, qui active un des fils AB des circuits d'interface (SIND, SINP). Pour des raisons de fiabilité, la désignation est envoyée à deux décodeurs DEC, dont les sorties parviennent à un circuit de comparaison CO, qui 2494O369 lorsqu'il relève une différence, émet un signal d'erreur mémo- risé (en même temps que d'autres signaux erreur E, émis par d'autres circuits, qui n'ont pas été reproduits sur la figure pour des raisons dé simplification) sur le registre RS. Les données, envoyées par le microprocesseur MP aux circuits d'interface, par transmission en parallèle sur le bus BDB, arrivent au premier circuit d'interéchange SOUT, o un convertisseur parallèle-série P/S et un circuit générateur de parité GP permettent leur envoi, par le bus BC, en série, -au circuit d'interface (SIND; SINP), activé par le circuit DEP par l'intermédiaire du fil AB correspondant. Les circuits d'interface (SIND, SINP) comprennent des commandes de ligne et des récepteurs de ligne, nécessaires à l'échange des données avec l'interface INT du module auxquels ils sont reliés, les circuits correspondants, pilotés par le circuit DEP, au moyen du fil AB correspondant, et, dans une forme de réalisation possible, des circuits pour le contrôle de la parité, dont le signal erreur peut être l'un des signaux indiqués génériquement par E, mémorisés dans le registre de situation RS du premier (SOUT) ou du second (SIP ou SID) circuit d'inter échange. Les instructions envoyées par le microprocesseur et mémorisées dans les registres de commande C ont-été indiquées, dans la figure par C. Le second circuit d'interéchange (SID ou SIP) reçoit les données du circuit d'interface SIND ou SINP, à travers le bus BD ou BP; après une conversion série-parallèle, effectuée par le convertisseur S/P, le circuit CP effectue le contrôle de la parité: l'erreur éventuelle est mémorisée dans le registre de situation RS, en même temps que les autres signaux erreur (indiqués génériquement par E), émis par les circuits de contrôle ou d'auto-contrôle, dont est équipé le circuit d'interéchange, et qui ont été omis pour des raisons de simpli- fication. Suivant une forme de réalisation possible, illustrée dans la figure, seul le circuit SID est équipé d'un registre de commande RC, sur lequel sont enregistrées également les instruc- tions envoyées par le microprocesseur MP et relatives au circuit 2494$59 SIP; sans sortir du cadre de l'invention, il est toutefois possible d'équiper également le circuit SIP d'un registre de commande RC. En agissant sur les multiplexeurs MPX, le microproces- seur MP peut recevoir, grâce au bus BDB, le contenu du registre de situation RS, ou bien les données provenant des circuits d'interface (SIND ou SINP). Comme il a été dit au départ de cette description, le simulateur des périphériques SP peut être avantageusement utilisé pour l'essai d'un module: la possibilité de contrôler le bon fonctionnement du simulateur de circuits périphériquesSP a donc une importance toute particulière. Les moyens adoptés à cet effet sont ceux que l'on emploie souvent pour ce qui concerne les ordinateurs électro- niques: citons, à titre d'exemple, le doublement du circuit de décodage DEC et le circuit de contrôle CO, présents dans le bloc DEP, la possibilité de transcrire (sur commande du micro- processeur MP) le contenu du registre de commande RC sur le registre de situation RS (si les registres et le bus BDB sont efficients, la parole de commande RC lui revient inchangée, en tant que parole de situation provenant du registre de situation RS), ainsi que la possibilité de relier, dans les circuits d'interface (SIND, SINP), la sortie des commandes de ligne à l'entrée des récepteurs de ligne, en vérifiant ainsi le bon fonctionnement des voies de transmission et des circuits inté- ressés par le flux données. Le microprocesseur MP a, par ailleurs, la possibilité de commander l'introduction d'erreurs même formelles (par exemple, de parité) dans le flux données transmis aux circuits d'interface (SIND, SINP), ainsi que de retarder ou de supprimer l'envoi de signaux de réponse: cela est très important en cours d'essai d'un module d'entrée-sortie, pour vérifier le bon fonctionnement des circuits de contrôle du module. Souvent le processus d'essai est laissé aux soins d'un ordinateur d'essai EP: le simulateur de périphériques SP comprend donc un circuit d'interface spécialisé, ESI, qui permet à l'ordinateur EP d'accéder au bus bidirectionnel BDB. Dans la figure 2 est indiqué, schématiquement, l'emploi 24940$9 d'un simulateur de périphériques SP, pour essayer un module d'entrée-sortie d'un ordinateur électronique EL. Le module à l'essai MOP est introduit dans l'ordina- teur EL, comme les autres modules MO: il est en outre relié, au moyen de n branchements bidirectionnels, en nombre égal à celui des circuits d'interface INT, qui équipent le module MOP, au simulateur de périphériques SP. L'ordinateur d'essai EP dialogue d'un côté, avec le simulateur SP, de l'autre, avec un circuit TCC à même de l) diriger l'échange de données entre un ordinateur extérieur et un circuit de contrôle éloigné CON (qui, à son tour, dialogue avec la CPU et/ou les modules d'entrée-sortie MO d'un ordina- teur EL. Comme circuit TCC, on peut utilement utiliser celui décrit dans la demande de brevet n0 24284 A 80 du 26/8/1980. - REVENDICATIONS - ______________ 1. Disposition de circuit pour simuler les unités périphériques d'un ordinateur électronique, caractérisée par le fait qu'il comprend un microprocesseur (MP), une pluralité de circuits d'interface (SIND, SINP), dirigés par un circuit de sélection (DEP), un bus données (BDB) bidirectionnel, qui relie entre eux le microprocesseur (MP), le circuit de sélec- tion (DEP), et des unités d'interéchange (SOUT, SID, SIP) à même de diriger le dialogue entre les circuits d'interface (SIND, SINP) et le microprocesseur (MP), un premier bus unidi- rectionnel (BC), dirigé par une première unité d'interéchange (SOUT), sur lequel transitent les données provenant du bus données (BDB) et destinées aux circuits d'interface (SIND, SINP), au moins un second bus unidirectionnel (BD, BP), dirigé par une seconde unité d'interéchange (SID, SIP), sur lequel transitent les données destinées au bus données (BDB) et prove- nant des circuits d'interface (SIND, SINP). 2. Disposition de circuit, comme mentionnée à la revendication 1, caractérisée par le fait de pouvoir dialoguer avec un ordinateur électronique (EP), qui accède au bus données (BDB) grâce à un circuit d'interface supplémentaire (ESI). 3. Disposition de circuit, comme indiquée aux revendi- cations 1 ou 2, caractérisée par le fait que les circuits d'interface (SIND), qui occupent physiquement les positions impaires, sont réunis par un second bus (BD), distinct de celui (BP) qui réunit les circuits d'interface (SINP), qui occupent les positions impaires et qui est dirigé par une seconde unité d'interéchange (SID), distincte de celle (SIP) qui dirige l'autre second bus (BP).