FR 2470501 A1 19810529 FR 7929335 A 19791122 La présente invention concerne un équipement d'essai du démodula- teur d'un téléviseur récepteur de télétexte. Plus particulièrement, l'invention concerne un équipement d'essai dans lequel on affiche un diagramme de l'oeil sur l'écran du tube du récepteur de télévision, permettant d'apprécier la qualité du démodulateur du récepteur. Les systèmes de télétexte, lesquels permettent d'afficher sur un écran de récepteur de télévision des pages de textes ou des données graphiques, sont maintenant bien connus. Ainsi, à titre d'exemple, on peut citer, en France, le système appelé "ANTIOPE" ou, au Royaume-Uni le système appelé "CEEFAX",. Dans ces systèmes, les informations à affi- cher se présentent sous forme de paquets de données numériques, qui sont insérés dans la partie active des lignes de télévision. En France le système de télédiffusion de données appelé "DIDON" effectue l'inser- tion et la transmissionde ces paquets de données numériques. Les premières expéreiencese en vraie grandeur, de transmission de télétexte ont monré que les différents maillons de la chaîne de trans- mission, c'est à dire les émetteurs de signaux de télévision, le trajet hertzien et les récepteurs de télévision du réseau public, s'ils étaient bien adaptés pour transmettre des images et le son, peuvent présenter des insuffisances en ce qui concerne la transmission des données numériques, Des remèdes peuvent relativement aisément être apportés aux émetteurs qui sont en relativement petit nombre et qui sont entretenus par un personnel hautement qualifié. Par contre, les téléspectateurs sont en possession de récepteurs de télévision qui diffèrent entre eux par l'âge, la technologie, etc. Or, un service de télétexte doit pouvoir, particulièrement s'il s'agit d'un service pu- blic, être accessible à tous, et, par ailleurs, au cours des expérien- ces mentionnées ci-dessus, on a pu constater que les démodulateurs des récepteurs de télévision constituaient le maillon le plus fragile de la chaine de transmission. En conséquence, un objet de la présente invention consiste à prévoir un équipement d'essai permettant de tester un démodulateur de récepteur de télévision. Pour estimer les performances -du démodulateur vis-à-vis du bruit et des décalages de l'instant d'échantillonnage, on utilise, comme on le fait dans les systèmes de transmission de données classiques, un diagramme représentant sur un intervalle de temps centré autour de l'instant d'échantillonnage, toutes les valeurs que le signal est 2 2470501 susceptible de prendre. La partie centrale de ce diagramme a une forme analogue à celle d'un oeil d'o la dénomination "diagramme de l'oeil". En général, on fait apparaître le diagramme de l'oeil sur un oscillosco- pe. Toutefois, on peut utiliser également l'écran d'un tube à rayons cathodiques d'un récepteur de télévision, comme cela est, par exemple, mentionné dans le rapport technique de M. G. Croll intitulé "CEEFAX: Measurement techniques" paru dans la revue BBC Record, NI 6, 1977, pages 4 à 7, ou la conférence de J.P. Chambers intitulé "Measurement and specification of teletext waveforms", parue dans la revue IBC 76, pages 117 à 121. Un autre obJet de l'invention consiste à prévoir un équipement d'essai de démodulateur de récepteur de télévision pour faire apparai- tre le diagramme de l'oeil, concernant le démodulateur, sur l'écran du tube du meme réecepteur de télévision. Suivant une caractéristique de l'invention, il est prévu un équi- pement d'essai d'un démodulateur d'un téléviseur récepteur de télétexte comprenant un générateu-r de signaux numériques d'essai dont la sortie est reliée à l'entrée HF du téléviseur, et un récepteur dont l'entrée est reliée à la sortie vidéo dudit téléviseur, dans lequel le généra- teur émet des paquets de données pseudoaléatoires *ayant une première fréquence d'éléments binaires, avec deux éléments binaires de durée double à deux instants prédéterminés tl et t2 de chaque paquet et en ce que ledit récepteur comporte un circuit de régénération des données dont le seuil varie ligne par ligne d'une valeur maximale à une valeur minimale, l'horloge d'échantillonnage dudit récepteur ayant une seconde fréquence plus basse que la première dans le rapport (n-2)/n, o n est égal au rapport entier de la première fréquence à la fréquence ligne du téléviseur, des moyens pour assurer la resynchronisation de l'horloge d'échantillonnage au milieu de chaque ligne et un circuit de réception de données pseudo-aléatoires, les erreurs détectées par le circuit de réception de données pseudo-aléatoires étant transmises à l'entrée vidéo du téléviseur. Suivant une autre caractéristique, le générateur comprend des moyens pour engendrer une ligne de référence de données o tous les éléments binaires sont des 1 et en ce que le récepteur comprend des moyens pour détecter ladite ligne de référence et des premiers moyens pour évaluer la valeur maximale du niveau de la ligne de référence, ladite valeur maximale étant utilisée dans un générateur de rampe dont la sortie fixe le seuil dudit circuit de régénération des données. 2470501- Les caractéristiques de l'invention mentionnées ci-dessus, ainsi que d'autres, apparaîtront plus clairement à la lecture de la descrip- tion d'un exemple de réalisation, ladite description étant faite en relation avec les dessins joints, parmi lesquels: la Fig. la est un blocdiagramme de l'équipement d'essai, suivant l'invention, associé à un récepteur de télévision à tester, la Fig. lb est un bloc-diagramme d'un récepteur de télétexte asso- cié à un téléviseur, la Fig. 2 est le bloc-diagramme du générateur de signaux utili- sé dans l'équipement de la Fig. 1, les Figs. 3a à 3e sont des formes d'ondes illustrant le fonction- nement d'un circuit du générateur de la Fig. 2, la Fig. 4 est le blocdiagramme du récepteur de traitement des signaux utilisés dans l'équipement de la Fig. 1, la Fig. 5 est un schéma du récepteur de la Fig. 4, les Figs. 6a à 6e sont des ment du circuit de la Fig. 5, la Fig. 7 est le schéma du récepteur de la Fig. 4, la Fig. 8 est le schéma du rampe du récepteur de la Fig. 4, la Fig. 9 est un diagramme par le générateur de rampe de la détecteur de ligne de référence du formes d'onde illustrant le fonctionne- circuit de régénération de salve du - compteur de lignes et du générateur de montrant Fig. 8, la rampe de tension délivrée la Fig. 10 est le schéma du circuit de marquage de tension moye: ne du récepteur de la Fig. 4, la Fig. 11 est le schéma du circuit de mise en phase initiale d récepteur de la Fig. 4, les Figs. 12a et 12b sont des formes d'onde illustrant le fonc- tionnement du récepteur de la Fig. 4, les Figs. 13a à 13h sont des formes d'ondes illustrant le fonc- tionnement du circuit de la Fig. 11, la Fig. 14 est le schéma du circuit de resynchronisation du récr u e- pteur de la Fig. 4, les Figs. 15a à 15c sont des formes d'onde illustrant le fonction- nement du circuit de la Fig. 14, et la Fig. 16 représente un diagramme de l'oeil affiché dans le cas d'un signal de réception idéal. n- L'équipement d'essai 1 de la Fig. la comprend un générateur de signaux de test 2, un récepteur de traitement de signal de test 3, un modulateur 4 et un oscillateur 5. Une sortie vidéo du générateur 2 est reliée à l'entrée de modulation du modulateur 4 dont l'entrée de porteuse est reliée à la sortie de l'oscillateur 5. La sortie haute-fré- quence du modulateur 4 est reliée à l'entrée HF du récepteur de télévi- sion 6 à tester. La sortie vidéo 7 du démodulateur 8 du récepteur 6 est reliée à l'entrée du récepteur 3. La sortie du récepteur de traite- ment 3 est reliée à l'entrée de vidéo 9 des circuits vidéo 10 du réce- pteur de télévision 6. A la Fig. lb, on a, de plus, montré un récepteur de données de télétexte 11 dont l'entrée 12 peut être reliée à la sortie vidéo 7 du démodulateur 8 et dont la sortie 13 peut être reliée à l'entrée vidéo 9 des circuits vidéol10. A la Fig. 2 le générateur de signaux de test 2 comprend un oscil- lateur à quartz 14 dont la sortie h délivre ce qu'il est convenu d'appe- ler le signal d'horloge, qui est distribué aux autres circuits du géné- rateur 2. Un diviseur programmable 15 a sa sortie reliée à une première entrée d'un comparateur de phase 16 dont la sortie est reliée à l'en- trée de commande d'un oscillateur commandable par la tension 17, dont la sortie est reliée à l'entrée d'un générateur de synchronisation de télévision 18. Le générateur de synchronisation 18 a une première sor- tie reliée, d'une part, à la seconde entrée du comparateur de phase 16 et, d'autre part, à une entrée de signal d'un circuit 19, une seconde sortie reliée, d'une part, à une entrée de commande du circuit 19 et, d'autre part, à l'entrée RAZ d'un circuit formé de deux bascules 20 et 21 en série, et une troisième sortie reliée à l'entrée d'un circuit de réglage de niveau 22 dont la sortie est reliée à l'entrée d'un circuit de mise en forme 23. La sortie du circuit 19 est reliée, d'une part, à l'entrée d'une porte ET 24 dont la sortie est reliée à l'entrée d'un circuit de base de temps 25 et, d'autre part, à l'entrée d'horloge des bascules 20 et 21. La sortie du circuit 23 est reliée à une première entrée d'un amplificateur additionneur 26. A l'entrée D de la bascule , on suppose qu'un "1" est appliqué. La sortie Q2 de la bascule 21 est reliée à la seconde entrée de la porte ET 24. La sortie du circuit 19, la sortie Ql de 20 et la sortie Q2 de 21 sont respectivement re- liées aux entrées d'une porte NON-ET à trois entrées 27 dont la sortie est reliée à une entrée d'une porte OU 28. Une première sortie du cir- cuit de base de temps 25 est reliée à l'entrée d'un générateur de don- 2470501 nées numériques pseudo-aléatoires 29 et une seconde sortie de 25 est reliée à une entrée d'initialisation d'un circuit 30. La sortie du générateur 29 est reliée à une entrée d'une porte OU 31 dont la sortie est reliée à l'entrée de données du circuit 30, auquel le signal d'hor- loge est également appliqué. La sortie du circuit 30 est reliée à la seconde entrée de la porte OU 28 dont la sortie est reliée à un circuit de réglage de niveau de données 32 dont la sortie est reliée à l'entrée d'un circuit de mise en forme 33 dont la sortie est reliée à la seconde entrée de l'amplificateur 26. La sortie de l'amplificateur 26 constitue la sortie du générateur de signaux de test 2. L'oscillateur à quartz 14 délivre le signal d'horloge h à la fréquence Febh c'est à dire la fréquence des éléments binaires. Le diviseur 15 est un diviseur numérique programmable capable de diviser la fréquence du signal reçu de l'oscillateur 14 par le nombre entier n. Le signal de sortie de 15 définit la fréquence de l'oscillateur 17, qui sera la fréquence ligne du signal de télévision engendré par le généra- teur de signaux de test 2. La structure de la boucle de verrouillage de fréquence de l'oscillateur 17 comprenant le comparateur de phase 16, l'oscillateur 17, le générateur 18 et la liaison du générateur 18 à 16 est classique et son fonctionnement est bien connu. Le générateur de synchronisation 18 reçoit de 17 les signaux à la fréquence ligne et en déduit, comme dans un émetteur de télévision, sur ses première et secon- de sorties 18.1 et 18.2 des signaux logiques de synchronisation ligne et trame et sur sa troisième sortie 18.3 un signal de synchronisation mélangé complet conformes au standard du réseau de télédiffusion de données à tester. La seconde sortie 18.2 du générateur 18 est également reliée à une entrée du circuit 19 qui reçoit également les signaux d'horloge de l'oscillateur 14. Le circuit 19 comprend un premier compteur 34. dont l'entrée de comptage est reliée à la première sortie de 18 et l'entrée d'initialisation à la seconde sortie de 18. La sortie du compteur 34 est reliée à une entrée d'une porte ET 35 dont la seconde entrée est reliée à la première sortie 18.1 de 18. La sortie de la porte ET 35 est reliée à l'entrée de validation d'un second compteur 36 comportant une entrée d'horloge et dont la sortie 37 est celle du circuit 19. Le comp- teur 34 qui reçoit les signaux de synchronisation trame et ligne de 18 a sa sortie activée uniquement pour les lignes visibles. Le compteur 36 a sa sortie activée uniquement pendant la durée utile d'une ligne, c'est à dire qu'elle n'est pas activée pendant environ 10,5 microsecon- des au début de la ligne, ainsi qu'après 63,5 microsecondes, ce qui 6 2470501 s'obtient facilement par comptage. La sortie 37 délivre donc des élé- ments binaires "1", pour chaque ligne visible, entre l'instant de début d'un paquet et la fin d'un paquet de durée maximale. Il en résulte que le circuit 19 délivre des "1" pour chaque ligne visible pendant la. durée de la ligne réservée à la transmission des paquets. La bascule 20 est remise à zéro à chaque réception de la synchro- nisation trame. Quand le premier signal d'horloge, qui correspond à l'insertion de la première ligne, provient de 19, comme le montre la Fig. 3a, et est appliqué à 20, sa sortie Q passe à 1, Fig. 3b, l'état de la bascule 21 n'étant pas modifié. La sortie de la porte 27 délivre alors un signal correspondant à celui montré à la Fig. 3d. A la réce- ption du second signal provenant de 19, la bascule 21 change d'état, comme le montre la Fig. 3c. La porte 27 se trouve inhibée pour toutes les lignes suivantes. Par contre, la porte 24 qui était inhibée au cours de la première ligne est ouverte pour les lignes suivantes, comme le montre la Fig. 3e. Le circuit de base de temps 25 comprend un compteur 38 recevant l'horloge h et du circuit 24 une validation pour chaque ligne visible, sauf la première. Pour la clarté de l'exposé, on a figuré le compteur 38 sous la forme d'un registre comportant autant de points de sortie que d'éléments binaires porteurs d'information dans une ligne. Le pre- mier point de-sortie est relié à l'entrée de mise à 1 d'une bascule 39 tandis que le dernier point de sortie est relié à l'entrée de mise à 0 de cette bascule. La sortie 1 de la bascule 39 est reliée, d'une part, à une entrée d'une porte ET 40 à trois entrées et, d'autre part, à la seconde entrée de la porte OU 31. Par ailleurs, deux points de sortie particuliers a et b, dont on verra comment ils sont déterminés dans la suite, sont respectivement reliés aux entrées d'une porte OU 41 dont la sortie est reliée, par l'intermédiaire d'un inverseur 42, à la seconde entrée de la porte ET 40. La troisième entrée de la porte ET 40 reçoit les signaux d'horloge h. La sortie de la porte ET 40 est reliée à l'en- - trée du générateur de données numériques pseudo-aléatoires 29. Le géné- rateur 29 délivre ainsi, pour chaque signal d'horloge passant par la porte ET 40, un élément binaire faisant partie d'une séquence aléatoi- re. Pour les instants élémentaires correspondant aux points de sorties a et b du compteur 38 reliés à la porte OU 41, il délivre le même si- gnal qu'à l'instant précédent. Avant l'instant correspondant au premier point de sortie et après l'instarnt correspondant au dernier point de sortie, la porte OU 31, étant donné son entrée reliée à la sortie Q qui est alors à 0, de la bascule 39, délivre des 0. En fait, dans l'exemple décrit, le générateur 29 fournit une séquence pseudo-aléatoire de 2047 éléments binaires obtenue par la division modulo deux du polynome "1 suivi d'une infinité de zéros" par le polynome xil + x + 1. Cette séquence n'est pas contenue un nombre entier de fois dans une trame et donne une structure animée. On pour- rait figer cette structure en réinitialisant le diviseur au début de chaque trame. Le circuit 30 comprend un registre à décalage 43 ayant une capaci- té de deux octets comportant des entrées de chargement parallèles re- liées alternativement à une source de tension et à la masse, ce qui permet d'y introduire au chargement deux octets ayant chacun la composi- tion suivante: 10101010. L'entrée de chargement initial du registre 43 est reliée au premier point de sortie du compteur 38. Le registre 43, qui reçoit les signaux d'horloge à son entrée de décalage, se vide vers la porte OU 28. A chaque sortie d'un élément binaire de 43, un nouvel élément binaire est écrit en provenance de la sortie de la porte 31, c'est à dire provenant de 29 ou de 39. Les circuits de réglage de niveau 22 et 32, ainsi que les cir- cuits de mise en forme 23 et 33 sont des circuits classiques dans le domaine technique de la télévision et des transmission de données. L'amplificateur 26 est un adaptateur d'impédance. Il résulte de la description ci-dessus que, dans chaque trame, en ce qui concerne la partie visible de l'image, le générateur de si- gnaux de test 2 délivre une première ligne dont la partie utile se compose de "1" provenant du circuit-21, à travers 28, puis une suite de lignes dont la partie utile se compose de deux octets de synchronisa- tion d'éléments binaires, puis d'une séquence d'éléments binaires pseu- do-aléatoire. Comme on l'a dit plus haut, le signal de sortie de 2 sert de signal modulant dans le modulateur 4 qui délivre le signal modulé à l'entrée HF du récepteur de télévision 6 à tester. Dans ce dernier1, le signal est démodulé dans le démodulateur 8, pour âtre appliqué au récepteur 3. Le récepteur de signaux de test 3, Fig. 4, comprend un amplifica- teur vidéo 44 auquel le signal vidéo est appliqué à travers un condensa- teur Cl et dont la sortie est respectivement reliée à l'entrée d'un circuit d'extraction de synchronisation 45, à une armature d'un conden- sateur C2, à l'entrée d'un circuit détecteur 46 et à l'entrée d'un circuit de régénération de salve 47. La seconde armature du condensa- teur C2 est reliée, d'une part, à l'entrée d'un circuit de découpage des données 48 et, d'autre part, à l'entrée d'un circuit de clampage 49, dont la sortie est reliée, d'une part, à l'entrée d'un circuit d'échantillonnage de valeur maximale 50 et, d'autre part, à l'entrée d'un circuit d'échantillonage de valeur moyenne 51. La sortie du cir- cuit d'échantillonnage 50 est reliée à l'entrée d'un circuit générateur de rampe 52 dont la sortie est reliée, d'une part, à l'entrée de com- mande du circuit de découpage 48 et, d'autre part, à l'entrée de com- mande d'un circuit de marquage de valeur moyenne de la salve 53. La sortie du circuit 51 est reliée à l'entrée de signal du circuit 53. Le circuit détecteur 46 comprend deux sorties 54 et 55. La sortie 54 délivre un signal de détection de la ligne de référence et est re- liée, d'une part, à l'entrée de commande du circuit 50 et, d'autre part, à une entrée d'initialisation d'un compteur de lignes 57. La sortie 55 de 46 délivre un signal pour chaque ligne utile, autre que la première, et est reliée à l'entrée d'initialisation d'un circuit de comptage 58. La sortie 55 délivre également un signal de validation et est reliée à l'entrée de commande du circuit de régénération 47.- Le circuit de comptage 58 comprend quatre sorties 59 à 62. La sortie 59 délivre un signal vers l'entrée de commande du circuit d'échantillonnage 51. La sortie 60 délivre un signal de déclenchement et est reliée à une entrée de commande d'un circuit de détection des erreurs 63. Les sorties 61 et-62 délivrent des signaux de commande à des moments différents et sont respectivement reliées aux entrées de commande correspondantes d'un circuit de mise en phase 64. L'entrée de signal du circuit de phasage 64 est reliée à la sor- tie d'un oscillateur stable, par exemple à quartz, 65. Par ailleurs, le circuit 64 a encore une entrée de commande reliée à la sortie du circuit de régénération de salve 47 et une entrée de commande à laquel- le est appliquée un signal à la fréquence ligne FH. La sortie du cir- cuit de phasage 64 est reliée, d'une part, à une entrée d'horloge du circuit 63 et, d'autre part, à l'entrée d'un compteur d'éléments binai- res 66. La sortie du circuit 47 est également reliée à l'entrée de commande du circuit de comptage 58. Le compteur d'éléments binaires 66 comporte trois sorties 67 à 69-. La sortie 67 délivre un signal de validation et est reliée à une entrée de commande du circuit 63 et à une entrée d'initialisation du circuit 53. La sortie 68 délivre un signal indiquant le milieu des lignes et est reliée à un circuit générateur d'un signal de rosynchro- nisation 70. La sortie 69 est reliée à une entrée de signal d'un cir- cuit engendrant le signal de visualisation 71. La sortie du circuit d'extraction de synchronisation 45 est re- liée, d'une part, à une entrée de signal du circuit 71 et, d'autre part, à l'entrée d'un circuit séparateur 72 délivrant, à sa sortie 73 un signal à la fréquence ligne FH. La sortie du circuit de découpage des données 48 est reliée à l'entrée de données du circuit de détection d'erreur 63. La sortie du compteur de lignes 57, qui en pratique comprend un faisceau de fils, est reliée, d'une part, à l'entrée correspondante du circuit générateur de rampe 52 et, d'autre part, aux entrées correspondantes d'une mémoire de marquage 74 dont la sortie est reliée à une entrée de signal du circuit 71. L'amplificateur vidéo 44 constitue l'étage d'entrée délivrant la vidéo sous impédance très faible. Le condensateur Cl à l'entrée de 44 empêche la transmission de la composante continue. Le circuit extrait du signal vidéo la synchronisation complète qui est réinjec- tée dans le circuit de mélange 71 qui peut ainsi délivrer, par 75, un signal vidéo complet pour le tube d'affichage. Par ailleurs, le circuit 72 permet d'obtenir, à partir de la synchro complète, le signal à fréquence ligne FH utilisé dans le circuit de clampage 49 le cir- cuit de phasage 64, le circuit de resynchronisation 70, et le compteur lignes 57. Le circuit 46 sert à détecter la première ligne formée de "1" ainsi que les débuts des paquets. Un exemple de réalisation du circuit 46 est montré à la Fig. 5. Il comprend un comparateur 76, formée d'un amplificateur 77 dont l'entrée - est reliée à la sortie de 44 et l'en- trée + à la masse. La sortie de 77 est reliée à l'entrée d'un circuit monostable 78 dont la sortie Q est reliée, d'une part, à la sortie et, d'autre part, à une entrée d'une porte ET 79 dont la sortie est reliée à la sortie 54. La sortie Q de 78 est reliée à l'entrée d'un circuit monostable 80 dont la sortie Q est reliée à la seconde entrée de la porte 79. Le signal de la Fig. 6a représente le signal provenant de 44 au moment de l'arrivée de la ligne de référence 81, suivie de lignes. utiles 82. Ce signal ne comprend pas de composante continue. La ligne ne comprend que des "1", d'o son amplitude constante. La valeur moyenne du signal de la Fig. 6a est indiquée par Vm. L'entrée + de 77 étant au potentiel de la masse, la sortie de 77 délivre le signal de la Fig. 6b, c'est à dire les parties de signal appliqué au-dessus de la valeur moyenne. La constante de temps du monostable 78 est choisie égale à quelques microsecondes (moins de 10 microsecondes) et, de plus, le monostable 78 est supposé redéclenchable. Il en résulte que la-pre- mière transition de la ligne 81 engendre le créneau 83 dont la durée est égale à la constante de temps de 78, mais que, pour les lignes suivantes, le monostable reste à l'état de travail toute la ligne et même au-delà, comme l'indique le créneau 84. Le front descendant de 83 déclenche le monostable 80 dont la constante de temps est légèrement inférieure à la durée d'une trame, ce qu'indique la courbe 6d. Le si- gnal de sortie de la porte 79 a donc l'allure de la Fig. 6e. La Fig. 7 montre un exemple de réalisation des circuit 47 et 58. Le circuit 47 comporte un comparateur 85 formé d'un amplificateur différentiel 86 dont l'entrée - est reliée à la sortie de 44 par un condensateur C3. En courant continu, l'entrée + est à la masse par une résistance R ainsi que l'entrée -. La sortie de 86 est reliée, par une résistance de liaison r.- à un circuit LC, le point milieu de l'inductance L étant à la masse et les armatures du condensateur C étant respectivement reliées aux entrées - et + d'un amplificateur différentiel 87. Le circuit LC est accordé sur 3,1 MHz pour éliminer les composantes de bruit, soit la modulation parasite de la largeur des créneaux. Les entrées de validation des amplificateurs différen- tiels sont reliées à la sortie 55 de 46. Ainsi, le signal filtré par le circuit LC est redécoupé dans 87 dont la sortie est reliée, d'une part, à travers un circuit 88 monostable fonctionnant sur les transi- tions, à une entrée de signal du circuit de phasage 64 et, d'autre part, dans le circuit 58, à l'entrée d'horloge d'un registre à décalage 89. Le registre à décalage 89 comporte huit étages. Deux sorties du registre 89 sont respectivement reliées aux entrées d'une porte OU exclusif 90 dont la sortie est reliée à l'entrée de commande du circuit d'échantillonnage 51. En pratique, la sortie 59de la porte OU 90 défi- nit un créneau de temps pendant lequel le circuit 51 détermine la va- leur moyenne du signal qui lui est appliqué pendant le même temps. Une autre sortie 60 du registre 89 détermine, en fin de salve, le début de l'analyse des données et, à ce titre, est reliée au circuit 63. Deux autres sorties 61 et 62 de 89 sont reliées au circuit de phasage 64. Par ailleurs, les entrées RAZ et D de 89 sont reliées à la sortie 55. Le circuit de clampage 49 est un circuit classique permettant 24Y050 1 de définir un niveau O volt pour le noir pour les signaux de ligne appliqués aux circuits 50 et 51. Le circuit d'échantillonage 50 se compose, par exemple, d'un échantillonneur bloqueur qui intègre dans un condensateur la tension de crête du signal 81 de la Fig. 6a pendant la durée du créneau 83 qui lui est appliqué à partir de la sortie 54 de 58. Puis ce circuit 50 délivre en permanence une tension égale à celle mise en mémoire dans le conden- sateur, soit la tension- maximale V de la courbe 81.Le circuit 51 -Max comprend un filtre passe-bas suivi d'un échantillonneur bloqueur qui est activé pendant le créneau de temps défini par la sortie 59 de la porte OU 90, Fig. 7. Le compteur de lignes 57, Fig. 8, se compose de deux compteurs binaires à quatre étages 91 et 92 montés en série. Les entrées d'initia- lisation des compteurs sont reliés à une sortie de 70 et sont chargés î5 au maximum au début de chaque trame, soit pour l'ensemble des compteurs à255. Le circuit 57 comprend encore une porte ET 93 dont une entrée reçoit le signal de fréquence ligne FH et dont la sortie est appliquée aux entrées de décomptage de 91 et 92. La sortie de poids fort 94 du compteur 92 est reliée à l'entrée d'un inverseur 95 dont la sortie est reliée à une entrée d'une porte NON-ET 96 dont la seconde entrée, comme la seconde entrée de la porte ET 93, est reliée à la sortie de retenue 97 du compteur 92. Les sorties de compte du compteur 91 et celles du compteur 92, sauf la sortie de poids fort 94, sont reliées en parallè- le, ainsi que la sortie de la porte NON-ET 96, d'une part, aux entrées correspondantes d'une mémoire PROM 98 du circuit 74 et, d'autre part, aux entrées correspondantes de données numériques d'un convertisseur numérique-analogique 99 du générateur de rampe 52. Tant que le contenu des compteurs 91 et 92 est supérieur ou égal à 128, les sorties 94 et 97 sont chacune à "1", donc, étant donné l'in- verseur 95, on a un "1" et un "O" sur les entrées de 96, qui délivre un "1". Quand le contenu des compteurs est inférieur ou égal à 127, la sortie 94 est à "O", donc les deux entrées de 96 sont à "1" et 96 déli- vre un "O". Donc, en ce qui concerne la mémoire 98 et le convertisseur 99, pendant le décomptage, tout se passe comme si leurs entrées de poids forts étaient directement reliées à 94. Quand le contenu des compteurs est nul, à la fin du décomptage, la sortie de retenue 97 passe à "O", donc les entrées de 96 sont maintenant "O" et "1", et 96 délivre un "1", ce qui revient à appliquer la valeur 128 aux entrées de 98 et 99, jusqu'au prochain chargement des compteurs à la trame 12 2470501 suivante. - Le convertisseur numérique-analogique 99 est un convertisseur par exemple du type MC 1408 commercialisé par la société MOTOROLA et a une borne 100 reliée à la masse par une résistance de valeur R3, une borne 101 reliée à la sortie du circuit 50 délivrant la tension V par l'intermédiaire d'une résistance de valeur R3, et une borne 102 reliée, d'une part, à la sortie de 50 par une résistance de valeur R2 et, d'autre part, à l'entrée - d'un amplificateur opérationnel 103, monté en additionneur. L'entrée + de 103 est reliée à la masse par une résistance appropriée et sa sortie est reliée à son entrée - par une résistance de valeur RI. La borne 102 délivre un courant égal à -(axV max/R3), dans lequel le coefficient a est donné par la formule suivante: a = A1/2 + A2/4 + A3/8 +...+ A/256 o A à A désignent les valeurs binaires appliquées aux entrées du même nom du convertisseur 99. Donc a varie par 1/256ème de O à 255/256, soit pratiquement de O à 1. La tension E à la sortie de l'amplificateur 103 est donné par la formule suivante: E = (Rl/R13) a Vma - (Rl'/R2) Vma ( /) max (/)max Dans un exemple de réalisation, on a choisi les valeurs des résis- tances Rl à R3, telles que Rl = 1792 ohms, R2 = 12800 ohms et R3 1400 ohms, ce qui conduit à la variation linéaire de E en fonction de a, montrée à la Fig. 9. Au début du comptage, c'est à dire de la partie visible de la trame, on a: a L 1 d'o E = (114/100) Vmax et à la fin du comptage, c'est à dire à la fin de la partie visible de la trame, on a: a = O d'o E = - (14/100) V max Il apparaît donc que la rampe délivrée par le circuit 52 varie linéairement de 1,14 VMax à - 0,14 V a. Comme on le verra dans la suite, une telle rampe a été choisie pour assurer, au début de l'analy- se des erreurs, un seuil de décision supérieur au niveau maximal des signaux vidéo et, à la fin de l'analyse, un seuil de décision négatif. A la droite de la Fig. 9, on a indiqué, dans une première colon- ne, les valeurs (au coefficient V a /100 près) de E variant, entre O et , de 10 en 10. Dans une deuxième colonne, on a indiqué les valeurs des adressez de la mémoire 98 pour lesquelles celle-ci délivre un si- gnal de marquage vers le circuit 71. Il apparaît clairement que, lors du décomptage des compteurs 91 et 92, chaque fois que le compte de sortie atteint une valeur de la seconde colonne mentionnée ci-dessus, la ligne correspondante se trouve marquée sur l'écran du téléviseur. On notera que les valeurs choisies correspondent à un marquage tous les 10% entre les valeurs O et 100 de la première colonne. La Fig. 10 représente le schéma du circuit de marquage de la ten- sion moyenne V. Le circuit 53 comprend un amplificateur différen- moyen tiel 104 dont une entrée de signal est reliée à la sortie du générateur de rampe 52, dont l'autre entrée de signal est reliée à la sortie du circuit 51 délivrant la valeur Vmoyen' et dont l'entrée de validation est reliée à la sortie F H. La sortie de l'amplificateur 104 est reliée à l'entrée d'une bascule RS 105 dont la seconde entrée est reliée à la sortie Fv* La sortie Q de la bascule 105 est reliée à l'entrée d'hor- loge d'une bascule D 106 dont la sortie Q est reliée au circuit 71 et dont l'entrée d'initialisation P est reliée à la sortie de 67 du comp- teur 66. La Fig. Il représente le circuit de mise en phase initiale 64, ainsi que l'horloge locale de réception 65. Par ailleurs, les Figs. 12a et 12b sont respectivement les diagrammes de temps de l'horloge du signal reçu et de l'horloge d'échantillonnage de réception. L'horlo- loge du signal reçu est, à la phase près, l'horloge de l'oscillateur 14, Fig. 2, et a une fréquence égale à nfH. L'horloge d'échantillonnage de réception a une fréquence définie par la fréquence de l'oscillateur local 65, cette fréquence étant choisie égale à (n-2)f H. Quand on réali- se pratiquement au départ de chaque paquet une mise en phase sur deux impulsions correspondantes des horloges des courbes 12a et 12b, on a ensuite tout au long de la ligne un décalage qui varie linéairement entre les deux horloges. Le but du circuit 64 est de créer un déphasage constant des signaux fournis par l'oscillateur 65 et le circuit de régénération de salve 47, de manière à obtenir cette mise en phase initiale. Dans le récepteur, l'horloge du signal reçu est délivrée par le circuit 47 de régénération de la salve des deux octets de synchroni- sation. Dans le circuit 64, la sortie de l'oscillateur 65 est reliée à une ligne à retard 107 comportant quatre sorties respectivement déca- lées de T/8, o T est la période de l'oscillateur 65. Ces quatre sor- ties sont respectivement reliées aux quatre entrées du registre 108. L'état de ces sorties est mémorisé sur la commande 62, caractéristique de la phase de la salve. L'état du registre décodé par le décodeur 109 adresse un multiplexeur 110 qui sélectionne la phase convenable de 107. *247050 1 On obtient ainsi un préphasage, le signal délivré par le multiplexeur étant un signal dont la phase est voisine de celle de la salve, à moins de T/8 près. La sortie du multiplexeur 110 est reliée, d'une part, à l'entrée d'un inverseur 111 dont la sortie est reliée à l'entrée d'une porte NON-ET 112 dont la sortie est reliée à l'entrée d'une porte NON-ET 113, d'autre part, à la seconde entrée de la porte NON-ET 112 et, enfin, à l'entrée d'horloge d'une bascule D 114. La sortie Q de la bascule 114 est reliée à la seconde entrée de la porte NON-ET 113, son entrée D est reliée à la sortie 62 du compteur 58, son entrée P de mise à 1 reliée à la sortie 61 de 58 et son entrée RAZ reliée à la sortie de 47. La sor- tie de la porte 113 est reliée à la base d'un transistor 115 dont l'émetteur est à la masse et le collecteur relié respectivement à l'ano- de d'une diode 116, à la masse par un condensateur C4, à la sortie d'un générateur de courant 117 et à une entrée de signal d'un comparateur 118. La cathode de 116 est reliée à la masse par un condensateur C5, à l'entrée d'un échantillonneur 119 dont la sortie est reliée à la secon- de entrée du comparateur 118, et, enfin, à un contact d'un interrupteur 120. L'interrupteur 120 est commandé à la fréquence ligne f. La sortie du comparateur 118 est reliée à l'entrée d'un monnosta- ble 121 qui délivre le signal d'horloge de réception 122. La Fig. 13a représente les impulsions obtenues à partir des tran- sitions de la salve à la sortie de 88 et qui sont actives à l'entrée RAZ de 114 à partir de la quatrième impulsion. La Fig. 13b représente les impulsions obtenues sur les fronts montants de l'horloge appliquée à l'entrée d'horloge de 114. En pratique, les impulsions de la Fig. 13b sont fabriquées d'une manière classique par l'inverseur 111 et la porte 112. Elles sont appliquées à la porte 113. La Fig. 13c représente la forme d'onde du signal à la sortie Q de 114. La Fig. 13d représente la forme d'onde du signal à la sortie de la porte 113. La Fig. 13e représente la forme d'onde du signal sur l'anode de 116, c'est à dire la tension de charge du condensateur C4. La Fig. 13f représente la forme d'onde du signal sur la cathode de 116, c'est à dire la tension de charge du condensateur C5. Le temps T qui s'écoule entre le front montant de l'horloge, Fig. 13b, et une transition sur la salve, Fig. 13a, est calculé par la bascu- le D 114. Le créneau obtenu, Fig. 13d, est converti en tension par la charge du condensateur C5 pendant le temps correspondant, ce qui, avant la fin de la salve, conduit à une dent de scie dont la valeur crête VT 1 5 2 4 7 û v5O i1 est directement fonction de la largeur du créneau. Cela est vrai quand le condensateur C4 est chargé à la crête, -a-diode 116 ne conduisant plus. Cette valeur crête est mise en mémoire dans l'échantillonneur bloqueur 119 et va servir ensuite de valeur de référence. En effet, au 16ème élément binaire de la salve, l'entrée P de 114 reçoit un signal de 58, ce qui force la sortie Q à 1, comme le montre la Fig. 13c. Donc le créneau de la Fig. 13d s'élargit et la dent de scie de la Fig. 13e dépasse la valeur VT. Au moment o elle dépasse cettte valeur, le compa- rateur 118 délivre un front ascendant, Fig. 13g, qui est rigoureusement en phase avec le front ascendant des impulsions de la Fig. 13a. Ensuite les-créneaux finals de la Fig. 13c sont répétés, donc également les dernières dents de scie dépassant VT si bien que les instants de bascu- lement du comparateur 118 forment les instants d'échantillonnage. Enfin le circuit monostable 121 reçoit les fronts montants délivrés par 118oet délivrent des impulsions, Fig. 13h, de largeur constante. Bien entendu la mise en phase étant ainsi assurée à la fin de la salve, on a, dans la suite de la ligne, un décalage linéaire progres- sif, comme on l'a mentionné plus haut, étant donné que la fréquence de égale à (n-2)F est inférieure à la fréquence du signal reçu égale'à H nFH' Le circuit de base de temps 66 est constitué par un compteur dont les sorties 67 à 69 correspondent à des comptes prédéterminés. Le circuit de resynchronisation 70, Fig. 14, comprend un compteur 123 dont l'entrée de déclenchement de chargement est reliée à la sortie 54 de 46 et dont l'entrée d'horloge reçoit le signal F. La sortie "max" du compteur 123 est reliée à l'entrée d'horloge d'une bascule D 124 dont l'entrée D est à la masse et l'entrée P reliée à la sortie 68 de la base de temps 68, la sortie 68 indiquant le milieu de ligne. La sortie Q de la bascule 124 est reliée, d'une part, à l'entrée correspon- dante du circuit 63 et, d'autre part, à l'entrée d'horloge d'une bascu- le D 125 dont l'entrée D est à la masse et l'entrée P à la sortie d'un inverseur 126 à l'entrée duquel est appliqué FH. La sortie Q de la bascule 125 est reliée aux entrée de chargement des compteurs 91 et 92, Fig. 8. La Fig. 15a est un diagramme montrant les impulsions de milieu de ligne délivrées par 68. Le diagramme de la Fig. 15b montre les impul- sions à la fréquence ligne F. Le diagramme de la Fig. 15c montre le changement d'état de la sortie du compteur 123 quand il a atteint son maximum. En pratique, le compteur 123 fonctionne en circuit à retard. En effet, dans une image de télévision, il y a 275 lignes visibles, mais, comme la capacité des compteurs 91 et 92 n'est que de 255, on ne peut traiter que 255 lignes. Le retard fourni par le compteur 123 per- met de centrer les 255 lignes traitées dans les 275 lignes visibles. Les fonctions des bascules 124 et 125 sont évidentes. La resynchronisation du circuit 63, qui est un récepteur de don- nées pseudo-aléatoires, ne peut être faite que si l'on introduit 11 élements binaires corrects dans le multiplicateur de ce circuit. Cette situation a le maximum de chance de se produire si le seuil de découpa- ge des données délivré par le circuit 52 est égal à la moitié de V max c'est à dire voisin de V et si l'instant d'échantillonnage est au moyen milieu de l'élément binaire. C'est pourquoi on force la première condi- tion de la fin d'une trame au début de la suivante, comme le montre la Fig. 9, par lasortie 97, Fig. 8. La deuxième condition existe au voisi- nage du milieu d'une ligne de télévision qui est l'instant défini par le circuit de la Fig. 14. Le diagramme de la Fig. 16 permet d'illustrer le fonctionnement de l'appareil de test. Par ailleurs de la description qui précède, il apparaît que le seuil de découpage du signal numérique dans le cir- cuit 48 varie de manière linéaire, suivant la rampe délivrée par 52 et en synchronisme avec le balayage trame du téléviseur. Ce seuil varie entre des valeurs extrêmes qui encadrent le signal numérique reçu. De plus, l'instant d'échantillonnage des données délivrées par 48 varie linéairement en synchronisme avec le balayage ligne du téléviseur, étant donné comme le montrent les Fig. 12a et 12b que la fréquence d'échantillonnage à la réception est légèrement inférieure à la fréquen- ce ds éléments binaires à l'émission, la différence étant de deux pério- des par ligne. Sur le diagramme de la Fig. 16, au temps tO, qui correspond au milieu de ligne délivré par 70, l'instant d'échantillonnage est correct tandis qu'aux temps tl et t2, les instants d'échantillonnage correspon- dent respectivement au début et à la fin d'un élément binaire. A noter qu'aux insstants tl et t2, l'horloge d'émission prend un coup d'avance sur l'horloge de réception. Cependant le nombre d'éléments binaires émis doit rester identique au nombre des éléments binaires traités dans le récepteur, c'est pourquoi, aux mêmes instants tl et t2, 1'élé- ment binaire émis à une durée double, ce qui est obtenu par 41, Fig. 2. A la Fig. 16, dans la zone Zl, qui correspond à la partie de la rampe, Fig. 9, inférieure à 0, tous les éléments binaires échantil- lonnés sont évidemment égaux à 1, ce qui entraîne un taux d'erreur de 50%. Dans la zone Z2, symétriquement, tous les éléments échantillonnés sont égaux à O et le taux d'erreurs est encore égal à 50%. Dans la zone Z3, l'élément binaire à échantillonner sera toujours présent, sauf dans le cas d'une transition montante, et c'est seulement dans ce cas qu'il y aura une erreur. Dans cette zone, les combinaisons O O, 1 1, 1 0 n'entraînent pas d'ereurs et seule la combinaison 01 conduit à échantil- lonner un O à la place du 1. Donc, dans cette zone, le taux d'erreur est de 25%.Il en est de même pour les zones 24 à 26. REVENDICATIONS 1) Equipement d'essai d'un démodulateur d'un téléviseur récepteur de télétexte comprenant un générateur de signaux numériques d'essai dont la sortie est reliée à l'entrée HF du téléviseur, et un récepteur dont l'entrée est reliée à la sortie vidéo dudit téléviseur, caracté- risé en ce que ledit générateur émet des paquets de données pseudoaléatoires ayant une première fréquence d'éléments binaires, avec deux éléments binaires de durée double à deux instants prédéterminés tl et t2 de chaque paquet et en ce que ledit récepteur comporte un circuit de régénération des données dont le seuil varie ligne par ligne d'une valeur maximale à une valeur minimale, l'horloge d'échantillonnage dudit récepteur ayant une seconde fréquence plus basse que la première dans le rapport (n-2)/n, o n est égal au rapport entier de la première fréquence à la fréquence ligne du téléviseur, des moyens pour assurer la resynchronisation de l'horloge d'échantillonnage au milieu de chaque ligne et un circuit de réception de données pseudo-aléatoires, les erreurs détectées par le circuit de réception de données pseudo-aléatoi- res étant transmises à l'entrée vidéo du téléviseur. 2) Equipement d'essai suivant la revendication 1, caractérisé en ce que le générateur comprend des moyens pour engendrer une ligne de référence de données o tous les éléments binaires sont des 1 et en ce que le récepteur comprend des moyens pour détecter ladite ligne de référence et des premiers moyens pour évaluer la valeur maximale du niveau de la ligne de référence, ladite valeur maximale étant utilisée dans un générateur de rampe dont la sortie fixe le seuil dudit circuit de régénération des données.- 3) Equipement d'essai suivant la revendication 1, caractérisé en ce que le récepteur comprend des moyens pour initialement mettre en phase l'horloge d'échantillonnage avec l'horloge des signaux reçus dudit générateur. 4) Equipement suivant la revendication 1 ou 2, caractérisé en ce que ledit générateur de rampe comprend des moyens de commutation fixant avant le début de la rampe et après la fin de celle-ci le niveau du seuil à la moitié de la valeur maximale. ) Equipement suivant la revendication 3 ou 4, caractérisé en ce que les moyens pour initialement mettre en phase ladite horloge d'échan- tillonnage avec le train des signaux d'horloge reçus du générateur com- prennent une horloge locale, des moyens pour engendrer des impulsions de largeurs égales au retard entre chaque signal d'horloge locale et chaque signal d'horloge reçu, des moyens pour charger en parallèle par un générateur de courant constant deux condensateurs ayant respective- ment une armature à la masse et une armature isolée, les armatures isolées étant reliées par une diode, l'armature isolée à laquelle est appliqué directement le courant de charge étant également reliée à une première entrée d'un comparateur, l'armature isolée à laquelle est appliqué le courant de charge à travers la diode étant également reliée à l'entrée d'un échantillonneur bloqueur dont la sortie est reliée à l'autre entrée du comparateur, les moyens engendrant les impulsions étant inhibés après un nombre déterminé de signaux d'horloge reçus, la sortie du comparateur délivrant un signal quand le signal appliqué à sa première entrée dépasse le signal appliqué à sa seconde entrée, le signal de sortie du comparateur étant alors en phase avec le train des signaux reçus. 6) Equipement suivant l'une des revendications 2 à 5, caractérisé en ce que le générateur de rampe est constitué par un compteur numé- rique de lignes dont les sorties sont reliées aux entrées correspondan- tes d'un convertisseur numérique analogique dont une entrée de référen- ce analogique reçoit la valeur maximale du niveau de la ligne de réfé- rence et dont la sortie analogique est reliée à l'entrée d'un amplifica- teur linéaire ayant un gain supérieur à 1 dont la sortie délivre le signal en forme de rampe.