FR 2458904 A1 19810102 FR 7914996 A 19790612 La présente invention concerne une structure intégrée comprenant un montage à transistor, le transistor d'en- trée étant muni de diodes anti-saturation, ainsi que le procédé de fabrication d'une telle structure. Il est connu dans la technique que pour améliorer certaines caractéristiques d'un transistor, notamment pour des transistors de puissance fonctionnant en commutation, il peut être souhaitable d'associer à ce- transistor trois diodes, dites diodes d'anti-saturation, connectées de la façon représentée en figure 1. L'entrée vers la base du transistor NPN Tl se fait par l'intermédiaire de deux diodes en anti- parallèle D2 et D3. Cette entrée est connectée au collecteur du transistor Tl par l'inter- médiaire d'une diode.Dl orientée de la façon représentée dans la figure. Cette prévision de diodes anti-saturation s'applique également, comme cela est connu dans la technique, au cas d'un montage Darlington comme cela est représenté dans la figure 2. On peut voir dans cette figure, outre les éléments déjà décrits en relation avec la figure 1, un transistor T2 dont la base est reliée à l'émetteur du transistor Tl et le collecteur au collec- teur du transistor Tl, cette connexion commune de collecteur servant de sortie collecteur du montage et l'émetteur du transis- tor T2 servant de sortie d'émetteur du montage Darlington. De façon générale, il est également prévu une résistance RI entre les émetteurs des transistors Tl et T2, une résistance R2 entre l'émetteur du transistor Tl et l'entrée 10 du circuit et une diode de sortie D5. En outre, entre collecteur et émetteur, une diode D4, couramment appelée diode de déstockage, est souvent incluse dans un montage Darlington entre l'émetteur et la base du transistor Tl (ou plutôt, dans le cas particulier représenté, l'entrée 10) pour diminuer le temps de stockage du circuit. On connaît dans la technique des circuits incluant les transistors Tl, T2 et les diodes D4 et D5 sous forme intégrée. La présente invention a pour objet de prévoir un circuit intégré monolithique incluant le transistor Tl et l'en- semble de ses diodes d'anti-saturation Dl, D2, D3, cette inté- gration étant compatible avec l'intégration d'un ensemble Darlington comme dans le cas de la figure 2. Dans la pratique, 2 2458904 chacune des diodes DI, D2, D3 et D4 peut en fait être constituée de plusieurs diodes en série. L'invention se base sur une analyse détaillée et comparative entre un transistor muni de ses diodes anti-satura- tion tel que le transistor Tl de la figure 1 et un montage Darlington avec diode de déstockage tel qu'il est-représenté en figure 3. Un montage Darlington est constitué de l'asso- ciation de deux transistors tO et tl, le transistor tl étant un transistor de puissance et le transistor tO un transistor de commande. Ces transistors sont connectés en collecteur commun; la base du transistor tO sert d'entrée au circuit; l'émetteur du transistor tO est connectée à la base du transistor tl; et l'émetteur du transistor tl sert de sortie d'émetteur au montage. En outre, il est généralement prévu pour améliorer la rapidité de commutation de l'ensemble une diode d3 dite diode de déstockage montée de la façon représentée entre émetteur et base du transistor de commande tO. Dans la pratique courante des montages Darlington, le gain du transistor tO est choisi à une valeur nettement supérieure à l'unité étant donné que le gain du transistor d'ensemble est sensiblement égal au produit des deux gains des transistors tO et tl. L'invention se base sur l'appréciation du fait que les schémas des figures 1 et 3 sont strictement équivalents dans le cas o le gain du transistor tO est nettement inférieur à l'unité. Alors, ce transistor tO devient équivalent à l'ensemble des diodes dl et d2 représentées en figure 1. Ainsi, la présente invention prévoit un circuit intégré monolithique équivalent à un transistor associé à trois diodes anti- saturation comprenant deux transistors en montage Darlington et une diode de déstockage, le gain du premier transistor étant inférieur à l'unité. Pour réduire le gain de ce premier transistor et augmenter la rapidité de la diode de déstockage D3, la présente invention prévoit la fabrication normale d'un montage Darlington, tel que représenté en figure 3, avec en cours du processus uneétape de fabrication propre à diminuer un des deux paramètres physiques responsables de la valeur du gain dans une structure transistor. Ces deux paramètres sont la durée de vie des porteurs minoritaires dans la base d'une part, le coefficient d'injection de la jonction émetteur-base d'autre part. 3 2458904 On effectue la diminution de la durée de vie par une diffusion d'or ou une irradiation (aux électrons, aux rayons X et y) dans la zone occupée par le transistor to et la diode d3. On peut procéder à la diminution du coefficient d'injection essentiellement de deux façons: ou bien la base est diffusée avec une très forte concentration en dopant, d'une valeur telle que le rapport de la quantité de dopant utilisé pour l'émetteur sur la quantité de dopant utilisé dans la base n'excède pas un facteur 10; ou bien on remplace la zone d'émetteur N (ou P) par un caisson en silicium polycristallin dopé selon une impureté N (ou P), la nature polycristalline de l'émetteur inhibant d'une façon sensible le mécanisme d'in- jection des porteurs. Le circuit de la figure 3, après avoir subi le traitement de réduction de durée de vie ou du coefficient d'injection, devient équivalent à un transistor Ti équipé de trois diodes anti-saturation. Si l'on souhaite obtenir un montage Darlington dans lequel le premier transistor est équipé de diodes anti-saturation, il conviendra de rajouter derrière le transistor tl un transistor t2 monté par rapport à ce transistor tl en montage Darlington, une diode d4 servant de diode anti-saturation pour ce montage. On obtient alors le schéma représenté en figure 4 dans lequel des éléments équivalents à ceux de la figure 3 sont désignés par de mêmes références al- phanumériques. Un avantage de la présente invention réside dans le fait que l'on fait usage des techniques bien connues pour intégrer des montages Darlington et que l'on modifie ces struc- tures de façon à réduire le gain dans une zone prédéterminée pour obtenir un transistor équipé de diodes anti-saturation. La description de modes de réalisation particuliers de la présente invention effectuée ci-après permettra de montrer la simplicité de fabrication de structures de transistors équipés de diodes anti-saturation selon la présente invention. Ces objets, caractéristiques et avantages ainsi que d'autres de la présente invention seront exposés plus en détail dans la description suivante de modes de réalisation particuliers faite en relation avec les figures jointes parmi lesquelles: - les figures 1 et 2 représentent sous forme symbolique des circuits que vise à réaliser la structure inté- grée selon la présente invention; - les figures 3 et 4 représentent des circuits respectivement équivalents aux circuits des figures 1 et 2 selon la présente invention; - les figures 5A et-5B représentent respectivement une vue de dessus et une vue en coupe schématique d'un transis- tor associé à ses trois diodes anti-saturation selon la présente invention; - les figures 6A et 6B représentent respectivement une vue de dessus et une vue en coupe d'un montage Darlington dans lequel le transistor d'entrée est associé à trois diodes anti-saturation. On notera que, dans les diverses figures, comme cela est classique dans la représentation schématique de dispositifs à semiconducteur, ni les épaisseurs, ni les dimensions relati- ves des diverses couches et surfaces ne sont tracées à l'échelle. Pour une réalisation pratique, l'homme de l'art se référera aux connaissances technologiques usuelles dans le domaine considéré. La figure 5B représente une vue en coupe schématique d'une structure intégrée selon la présente invention mettant en oeuvre le circuit de la figure 3 équivalent au circuit de la figure 1. On reconnait une vue en coupe d'un montage Darlington classique. La borne 10 est la borne d'entrée, la borne il la borne d'émetteur et la borne 12 la borne dé collecteur. Sur la face supérieure d'un substrat de type N, on forme une structure collecteur N/N, soit par épitaxie de la couche N en partant d'un substrat N+, soit par diffusion d'une couche N dans un matériau N (Technologie Triple diffusé). La base de type P est formée soit par épitaxie P soit par diffusion. On effectue ensuite simultanément des diffusions de type N à tra- vers un masque sur la surface supérieure pour former des zones de type N 3, 4, 5 et 6. Si la base a été faite par épitaxie, on peut aussi continuer en faisant croître sur la couche P une troisième couche épitaxiée N dans laquelle on fait les caissons N 3, 4, 5 et 6 par diffusion (Technologie dit du LEC: Low Emitter Concentration). Les zones de type N 3 et 4 correspon- dent à l'émetteur du premier transistor tO (voir figure 3), la zone de type N 5 correspond à la diode anti-saturation d3 et la zone de type N 6 correspond à l'émetteur du transis- tor tl. Dans les figures, les couches hachurées correspondent à des couches de silice ou autres éléments de masquage et de passivation et les couches marquées d'une croix à des métalli- sations. On se référera à la figure pour déterminer schémati- quement les contacts établis par ces couches de métallisation, étant entendu que ceci est de façon générale connu pour la réalisation de montages de type Darlington. Ensuite, selon l'invention, toute la partie supérieure gauche de la structure est traitée pour réduire le gain des structures transistors verticales à l'aplomb des couches N 3, 4 et 5. Divers procédés peuvent être utilisés pour réaliser cette réduction du gain des transistors jusqu'à une valeur inférieure à 1. Si l'on choisit de-diminuer la durée de vie des porteurs, on pourra procéder à une diffusion d'or localisée avant la réalisation des métallisations, ou bien on pourra procéder par irradiation électronique, ou encore aux rayons X ou y. Dans ces derniers cas, le traitement pourra être effectué à travers les métallisations. Dans les deux cas, il conviendra de masquer avant le traitement, la partie supérieure de la structure correspondant à la zone d'émetteur 6 pour mainte- nir le gain du transistor ti. Si l'on choisit de diminuer le coefficient d'injection, il faut surdoper la base du transistor tO et ceci peut se faire avant, pendant ou après la diffusion de la base commune des transistors tO et tl selon les caracté- ristiques physiques de cette base et la nature des dopants utilisés. Dans le cas o l'on se refuse à surdoper localement la zone de base tout en voulant diminuer le coefficient d'injec- tion, on peut faire un dépôt localisé de silicium polycristallin dopé à l'emplacement de l'émetteur du transistor tO et de la diode de déstockage. Tous les procédés énumérés (diffusion d'or localisée, irradiation localisée,surdopage de la base, émetteur polycristallin dopé) qui réalisent localement des structures transistor à gain inférieur à 1 sont connus dans la technique et ne seront pas décrits en détail ici. La vue de dessus de la figure 5A ne constitue qu'un exemple de réalisation de la présente invention. On pourra se référer aux diverses structures Darlington connues et les traiter selon l'invention pour diminuer le gain du transistor d'entrée ou transistor de commande. La zone 8 dans l'émetteur 6 du transistor tl correspond à une réserve propre à former une diode analogue à la diode d5 de la figure 4. La figure 6B représente une vue en coupe d'une structure intégrée selon la présente invention équivalente à un montage Darlington dans lequel le transistor d'entrée est associé à des diodes anti-saturation. Seule la partie supérieu- re du substrat 1 a-été représentée. Dans cette figure, on a utilisé de mêmes références pour désigner des zones et couches analogues à celles déjà représentées en figure 5B. On retrouve notamment les zones 3, 4, 5 et 6. On peut en outre voir une zone de type N 20 correspondant à la diode de déstockage du transistor t2 (voir figure 4) et une zone 21 de type N corres- pondant à l'émetteur du transistor t2 et connectée à la borne d'émetteur 11. Les diffusions 3 et 4 qui apparaissent comme deux diffusions distinctes en figure 6B sont en fait une seule et même diffusion reliée par une zone continue comme on peut le voir en figure 6A. Dans la figure 6A, les zones diffusées de type N sont représentées par des contours en traits pleins. La référence 3-4 désigne le contour de diffusion dont les vues en coupe correspondent aux zones 3 et 4. Une zone interne 22 n'est pas diffusée. Les contours des métallisations désignées par des références 30 à 35 sont indiqués par des traits en pointillés. Les métallisations 33, 34 et 35 recouvrant les zones 22, 5 et 20 sont en fait solidaires et passent au-dessus des autres métallisations sousjacentes par l'intermédiaire d'une couche d'oxyde d'isolement. En outre, bien qu'ils ne soient pas représentés sur la figure 6A, les affleurements de jonction sont protégés par des couches d'oxyde pour éviter la mise en court-circuit des jonctions. Il est clair qu'en figure 6B, plu- sieurs métallisations apparaissant comme distinctes sont en fait une seule et même métallisation et sont désignées par de mêmes références numériques. La présente invention n'est pas limitée aux modes de réalisation explicitement décrits mais en englobe les diver- ses variantes et généralisations tombant dans le domaine des revendications ci-après. REVENDICATIONS 1. Circuit intégré monolithique équivalent à un transistor associé à trois diodes anti-saturation, caractérisé en ce qu'il comprend deux transistors en montage Darlington et une diode de déstockage, le gain du premier transistor étant inférieur à l'unité. 2. Circuit intégré selon la revendication 1, carac- térisé en ce que la zone correspondant au premier transistor et à la diode de déstockage est soumise à une diffusion d'or. 3. Circuit intégré selon la revendication 1, caractérisé en ce que la zone correspondant au premier transis- tor et à la diode de déstockage est soumise à une irradiation du type électrons, rayons x, rayons gamma. 4. Circuit intégré selon la revendication 1, carac- térisé en ce que la zone de base correspondant au premier transistor et à la sortie de la diode de stockage comprend un surdopage sur toute son épaisseur. 5. Circuit intégré selon la revendication 1, caractérisé en ce que la zone d'émetteur correspondant au pre- mnier transistor et à l'entrée de la diode de déstockage est constitué d'un matériau polycristallin dopé. 6. Circuit intégré selon l'une quelconque des revendications 1 à 5, caractérisé en ce qu'il comprend en outre un troisième transistor associé au deuxième selon un montage Darlington. 7. Circuit selon la revendication 6, caractérisé en ce qu'il comprend en outre une diode de déstockage associée au troisième transistor, cette diode étant soumise au traitement défini dans l'une des revendications 2 à 5. 8. Procédé de fabrication d'un circuit intégré équivalent à un transistor et à ses trois diodes anti-saturation, caractérisé en ce qu'il comprend les étapes suivantes - fabriquer de façon connue un circuit Darlington monolithique avec une diode de déstockage; - réduire, soit la durée de la vie des porteurs minoritaires, soit le coefficient d'injection dans les zones du premier transistor et de la diode de déstockage. 9. Procédé selon la revendication 8, caractérisé en ce que la réduction de durée de vie est obtenue par diffusion d'or. 9 2458904 10. Procédé selon la revendication 8, caractérisé en ce que la réduction de durée de vie est obtenue par irradia- tion. 11. Procédé selon la revendication 8, caractérisé en ce que la réduction du coefficient d'injection est obtenue par un surdopage localisé de la base. 12. Procédé selon la revendication 8, caractérisé en ce que la réduction du coefficient d'injection est obtenue par réalisation d'un émetteur en silicium polycristallin dopé.