Brevet FR3089657A1 — publié le 20200612

Description Titre de l'invention : Dispositif tel qu'un objet connecté pourvu de moyens pour contrôler l'exécution d'un programme exécuté par le dispositif Domaine technique 100011 La présente invention concerne un dispositif comprenant une circuit électronique adapté pour exécuter un programme susceptible d'être corrompu par des attaques. 100021 La présente invention trouve notamment application dans le domaine des objets connectés. Technique antérieure [0003] Un circuit électronique non sécurisé exécutant un programme est typiquement sensible à plusieurs vecteurs d'attaques, que ce soit via des attaques hardware ou software. [0004] Il est difficile de mettre en oeuvre des moyens génériques de sécurisation d'un circuit électronique exécutant un programme microcontrôleur ou d'un microprocesseur sans que ce circuit électronique ne nécessite soit la modification du programme soit la modification du matériel. Dans les deux cas, les modifications à apporter représentent un coût substantiel à cause du savoir-faire ou du matériel nécessaire. Exposé de l'invention [0005] Un but de l'invention décrit est de contrôler si un circuit électronique non sécurisé subit une attaque altérant son fonctionnement, sans que l'implémentation de ce contrôle n'engendre un surcout de fabrication du circuit électronique à contrôler. [0006] Un autre but de l'invention est de faire en sorte que ce contrôle puisse être mis en oeuvre facilement pour une grande variété de circuits électroniques existants. [0007] Il est donc proposé, selon un premier aspect de l'invention, un dispositif tel qu'un objet connecté comprenant un premier circuit électronique comprenant : - une première unité de traitement configurée pour exécuter un programme, - une première mémoire configurée pour mémoriser des données du programme ou manipulées par le programme au cours de son exécution, - un port de debug dédié au contrôle de l'exécution du programme depuis l'extérieur du premier circuit, le dispositif comprenant en outre un deuxième circuit électronique connecté au port de debug, le deuxième circuit électronique comprenant : - une deuxième mémoire mémorisant des données de référence relatives au programme, - une deuxième unité de traitement configurée pour mettre en oeuvre les étapes 2 suivantes de manière automatique et autonome via le port de debug : contrôler l'intégrité des données mémorisées par la première mémoire et/ou la conformité de l'exécution du programme par la première unité de traitement à une exécution de référence, à l'aide des données de référence. [0008] Un port de dcbug est d'habitude utilisé pour détecter, reproduire et analyser des bugs présents dans un programme exécuté par un circuit électronique au cours de son développement. L'utilisation conventionnelle d'un port de debug est la suivante : un dévcloppeur surveille et contrôle manuellement l'exécution d'un programme huggé d'un circuit depuis une station de travail au moyen d'un programme de débogage, ou dehugger et d'un tel port de dcbug. Le débogage ainsi réalisé par le développeur est une tache empirique qui dépend essentiellement de ses connaissances générales en informatique, sa connaissance du code source du programme contrôlé, de son expérience passée en matière de débogage et de son intuition. Dans le dispositif selon le premier aspect de l'invention, le port de debug est astucieusement détourné de son utilisation habituelle pour mettre en oeuvre un contrôle d'intégrité totalement automatique et autonome (par « automatique et autonome », on entend : sans intervention humaine). En se fondant sur les données de référence mémorisées par le deuxième circuit électronique, ce contrôle d'intégrité permet de détecter si l'exécution est conforme à des règles préétablies ou non, auquel cas il est possible que le premier circuit électronique ait été attaqué. [0009] De plus, comme la plupart des circuits électroniques existants équipés d'une unité de traitement (notamment microcontrôleurs ou processeurs) disposent d'un tel port de debug, l'invention est applicable à une grande variété de circuits. [0010] Par ailleurs, comme le contrôle d'intégrité est commandé depuis l'extérieur du premier circuit électronique, en l'occurrence par le deuxième circuit électronique, il n'est pas nécessaire de modifier le premier circuit électronique en profondeur. [0011] Le dispositif selon le premier aspect de l'invention peut également comprendre les caractéristiques énoncées dans les revendications dépendantes. [0012] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent par ailleurs une commande de suspension du programme, l'étape de contrôle d'intégrité et/ou de conformité étant mise en oeuvre pendant que le programme est suspendu. [0013] De préférence, 1 commande de suspension comprend le placement d'un point d'arrêt en un endroit prédéterminé du programme, de sorte à suspendre le programme à l'endroit prédéterminé, ou le placement d'un point d'observation sur une variable du programme, de sorte à suspendre le programme lorsque la variable est modifiée. [0014] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent une étape consistant à vérifier si une 3 condition indépendante de la manière dont le programme s'exécute est remplie, par exemple vérifier si un délai de durée prédéterminée s'est écoulé depuis un précédent démarrage du programme, une précédente reprise du programme ou une précédente mise sous tension du dispositif, l'étape de commande de suspension étant mise en oeuvre lorsque la condition est remplie. [0015] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent la commande d'une reprise du programme par la première unité de traitement lorsqu'aucune compromission du programme ou des données manipulées par le programme n'est révélée lors de l'étape de contrôle, et/ ou arrêter définitivement le programme lorsqu'une compromission du programme ou des données manipulées par le programme est révélée lors de l'étape de contrôle. [0016] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent la génération d'un rapport indiquant si une compromission du programme ou des données manipulées par le programme a été révélée lors de l'étape de contrôle. [0017] De préférence, le dispositif comprend une interface de communication avec l'extérieur du dispositif configurée pour transmettre le rapport généré à un serveur à distance du dispositif [0018] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent la commande la transmission du rapport au serveur via l'interface de communication pendant que le programme est suspendu. [0019] De préférence, l'interface de communication est configurée pour transmettre le rapport au serveur sans que le rapport ne passe par le premier circuit électronique. En variante, l'interface de communication fait partie du premier circuit électronique. [0020] De préférence, les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement comprennent la commande d'une écriture, via le port de debug, du rapport dans un zone d'échange allouée dans la première mémoire, de sorte que le rapport soit par la suite relayé au serveur via l'interface de communication. [0021] Le premier circuit électronique peut comprendre un deuxième port distinct du port de debug, et les étapes mises en oeuvre de manière automatique et autonome par la deuxième unité de traitement peuvent comprendre la commande d'une transmission du rapport à l'interface de communication via le deuxième port, de sorte que le message d'erreur soit par la suite relayé au serveur via l'interface de communication. [0022] De préférence, les données de référence indiquent une séquence d'évènements survenant dans un ordre prédéterminé au cours de l'exécution de référence du programme, et dans lequel le contrôle de conformité de l'exécution du programme à une exécution de référence comprend une comparaison entre l'ordre prédéterminé et un ordre dans lequel surviennent les évènements au cours de l'exécution du programme par la première unité de traitement. [0023] Il est également proposé, selon un deuxième aspect de l'invention, un procédé mis en oeuvre dans un dispositif tel qu'un objet connecté, le dispositif comprenant : - un premier circuit électronique comprenant une première unité de traitement configure° pour exécuter un programme, une première mémoire configure° pour mémoriser des données du programme ou manipulées par le programme au cours de son exécution, et un port de &bug dédié au contrôle de l'exécution du programme depuis l'extérieur du premier circuit, - un deuxième circuit électronique connecté au port de debug et comprenant une deuxième mémoire mémorisant des données de référence relatives au programme, le procédé comprenant les étapes suivantes mises en oeuvre par une deuxième unité de traitement du deuxième circuit électronique, de manière automatique et autonome via le port de debug : contrôler l'intégrité des données mémorisées par la première mémoire et/ou la conformité de l'exécution du programme par la première unité de traitement à une exécution de référence, à l'aide des données de référence. [0024] Il est également proposé un produit programme d'ordinateur comprenant des ins- tructions de code de programme pour l'exécution des étapes du procédé selon le deuxième aspect de l'invention, lorsque ce procédé est exécuté par une unité de traitement. Brève description des dessins [0025] D'autres caractéristiques, buts et avantages de l'invention ressortiront de la des- cription qui suit, qui est purement illustrative et non limitative, et qui doit être lue en regard des dessins annexés. [0026] [fig.1] [0027] [fig.] [0028] [fig.3] [0029] Les figures 1 à 3 illustrent de façon schématique des dispositifs selon trois modes de réalisation différents de l'invention. [0030] [fig.4] [0031] La figure 4 est un organigramme d'étape d'un procédé susceptible d'être mis en oeuvre par l'un des dispositifs représentés sur les figures 1 à 3. [0032] Sur l'ensemble des figures, les éléments similaires portent des références identiques. Description des modes de réalisation 100331 En référence à la figure 1, un dispositif 1 comprend un premier circuit électronique 2 et un deuxième circuit électronique 4, distinct du premier circuit électronique 2. 100341 Le premier circuit électronique 2 comprend une première unité de traitement 6, une première mémoire 8 et un port de dehug 10. [0035] La première unité de traitement 6 est configurée pour exécuter un programme d'ordinateur, que l'on appellera dans la suite « programme cible ». La première unité de traitement 6 comprend typiquement un ou plusieurs processeurs. [0036] La première mémoire 8 est configurée pour mémoriser des données du programme cible ou manipulées par le programme cible au cours de son exécution. La première mémoire 8 comprend typiquement au moins une unité de mémoire non-volatile (flash, EEPROM, NVM, etc.) configurée pour stocker le programme cible et des données de manière persistante, et au moins une unité de mémoire volatile (RAM, registres, etc.), configure° pour mémoriser des instructions de programme à exécuter ou des données manipulées temporairement par le programme cours de son exécution. [0037] Le port de debug 10 est dédié au contrôle de l'exécution du programme cible depuis l'extérieur du premier circuit électronique 2. Le port de debug 10 constitue une interface de communication entre le programme cible et l'extérieur du premier circuit électronique 2. [0038] Le port de debug 10 par exemple un port TAP ou JTAG défini par l'un des spéci- fications JTAG connues (par exemple IEEE 1149.1 ou TEEE 1149.9), ou bien un port de type SWD. [0039] Le premier circuit électronique 2 peut être : un FPGA, un ASTC, etc. [0040] Le deuxième circuit électronique 4 comprend un port 16, une deuxième unité de traitement 12 et une deuxième mémoire 14. [0041] Le port 16 est connecté directement au port de debug 10 du premier circuit élec- tronique 2. [0042] La deuxième unité de traitement 12 est configurée pour exécuter un programme dit programme de contrôle ». Le programme de contrôle a pour fonction de contrôler l'intégrité de données mémorisées dans la première mémoire 8 au cours de l'exécution du programme cible (en particulier, des portions du programme cible lui-même, des données manipulées par le programme cible au cours de son exécution), ou bien des données de contexte d'exécution, telles que le « program counter » ou les registres de l'unité de traitement, ainsi que vérifier le déroulement du programme de la deuxième unité de traitement 6 (via une chaine valide de points d'arrêt atteints). [0043] Le programme de contrôle comprend notamment (mais pas seulement) des ins- tructions adaptées pour mettre en oeuvre des fonctionnalités que l'on trouve dans un debugger classique, comme par exemple le placement de points d'arrêts dans le programme cible. [0044] La deuxième mémoire 14 est configurée pour mémoriser des données de référence relatives au programme cible (des exemples de telles données de référence sont donnés dans la suite). [0045] La deuxième mémoire 14 comprend typiquement au moins une unité de mémoire 6 non-volatile (flash, EEPROM, NVM, etc.) configurée pour stocker le programme de contrôle et/ou les données de référence de manière persistante, et au moins une unité de mémoire volatile (RAM, registres, etc.), configurée pour mémoriser des instructions du programme de contrôle à exécuter ou des données manipulées temporairement par le programme de contrôle au cours de son exécution. [0046] Le premier circuit électronique 2 peut être : un FPGA, un ASTC, etc. [0047] De préférence, le deuxième circuit électronique 4 est davantage sécurisé contre des attaques extérieures que ne l'est le premier circuit électronique 2. Dans certains domaines, le terme « élément sécurisé » (abrégé en SE) est utilisé pour désigner un circuit disposant d'un niveau de sécurité élevé, et le terme de « microcontrôleur » (abrégé en MCU) est utilisé pour désigner un circuit disposant d'un niveau de sécurité comparativement plus faible. Le premier circuit électronique 2 peut donc être considéré comme un SE et le deuxième circuit électronique 4 peut être considéré comme un MCU. [0048] Le dispositif 1 est par exemple un objet connecté, ou bien lui-même un circuit élec- tronique tel qu'un système sur puce (SoC). [0049] Le dispositif 1 comprend par ailleurs une interface de communication 18 avec un serveur distant 3, typiquement une interface de communication radio sans fil (Wi-Fi, NFC, Bluetooth, 3/4/5G, etc.) ou bien filaire (de manière directe, par exemple via Ethernet, ou de manière indirecte au moyen d'un bus PC contrôlant un émetteur radio agissant comme un relai entre l'interface 18 et le serveur 3). [0050] Lorsque le dispositif 1 est un objet connecté, le serveur 3 distant est apte à com- muniquer avec un réseau d'objets connectés auquel le dispositif 1 est susceptible d'adhérer. Le serveur 3 a notamment pour fonction de collecter des informations communiques par différents objets connectés tel que l'objet 1. [0051] Comme on le verra dans la suite, le deuxième circuit électronique 4 et le serveur 3 peuvent échanger des informations, en passant par des chemins différents. [0052] Dans le premier mode de réalisation illustré en figure 1, l'interface de commu- nication 18 fait partie du deuxième circuit électronique 4, et le premier circuit électronique ne comprend pas nécessairement d'interface de communication directe avec l'extérieur du dispositif 1 (bien que cela soit possible). Ceci a l'avantage d'éviter au deuxième circuit électronique d'être « à la merci » du premier circuit électronique 2 pour pouvoir communiquer vers l'extérieur : dans le cas où le premier circuit électronique 2 ne fait pas les actions nécessaires pour relayer des messages venant du deuxième circuit électronique 4, ce dernier ne peut pas communiquer avec l'extérieur. [0053] On a illustré en figure 2 un deuxième mode de réalisation du dispositif 1, dans lequel l'interface de communication 18 fait partie du premier circuit électronique 2. Ceci a l'avantage d'éviter un surcout, des contraintes ou des limitations inutiles dans un 7 dispositif 1 dont le premier circuit électronique 2 dispose de matériel de communication avec l'extérieur. [0054] Toutefois, il demeure que le deuxième circuit électronique 4 a besoin de com- muniquer avec le serveur 3, situé à l'extérieur du dispositif 1. A cette fin, le premier circuit électronique 2 comprend un port 20 distinct du port de debug 10, et le deuxième circuit électronique 4 comprend un port 22 relié au port 20 par une liaison indépendante de la liaison qui relie le port 16 au port de debug 10. Le port 20 est relié à la première unité de traitement 6. La liaison entre les ports 20 et 22 est par exemple un bus 12C. [0055] Dans ce deuxième mode de réalisation, le programme exécuté sur la première unité de traitement 6 s'assure de recevoir (ou transmettre) des données venant du premier circuit électronique 2 vers le (ou venant du) serveur 3 grâce à sa capacité de communication vers l'extérieur assurée par l'interface de communication 18. Dans le cas présent, le succès de la communication entre le deuxième circuit électronique 4 et le serveur 3 est donc assuré par la coopération du programme exécuté sur le premier circuit électronique 2. [0056] Cette configuration peut être particulièrement adaptée, mais non limitée, aux cas où le deuxième circuit électronique 4 fournit au premier circuit électronique 2 des fonctions annexes, auquel cas ce dernier peut alors faire des requêtes au premier, qui se comporte alors comme un composant esclave classique sur un bus de communication embarqué (comme présenté avant, par exemple PC). [0057] Est illustré en figure 3 un troisième mode de réalisation, dans lequel l'interface de communication 18 fait partie du premier circuit électronique 2, tout comme dans le deuxième mode de réalisation. Toutefois, à la différence du deuxième mode de réalisation illustré en figure 2, le deuxième circuit électronique communique avec le serveur 3 par le biais du port de debug 10, et non par le biais d'un port supplémentaire. Ceci permet de simplifier l'architecture du dispositif 1 par rapport au deuxième mode de réalisation. Le port de debug 10 sert en effet non seulement à gérer des communications entre les circuits 2 et 4 (au sein du dispositif 1) mais également à gérer des communications entre le deuxième circuit électronique 4 et le serveur 3. [0058] Le dispositif 1 est configuré comme suit dans une phase préliminaire de confi- guration. [0059] Le code du programme cible est compilé, de sorte à produire un exécutable destiné à être exécuté sur le premier circuit électronique 2. [0060] Après compilation, des données d'intégrité sont calculées sur des segments prédé- terminés du code du programme cible. [0061] Une liste d'adresses du programme cible sont déterminées dans le but d'y placer des points d'arrêts. 8 [0062] Le code du programme cible est chargé dans la première mémoire 8, de sorte à pouvoir ensuite être exécuté par la première unité de traitement 6. [0063] Par ailleurs, la liste d'adresses déterminée et les données d'intégrité sont mémorisées dans la deuxième mémoire 14 en tant que données de référence. Chaque adresse est associée dans la mémoire avec au moins une donnée d'intégrité. [0064] Le code du programme de contrôle est chargé dans la deuxième mémoire 14, de sorte à pouvoir être exécuté par la première unité de traitement 12. [0065] La phase préliminaire de configuration du dispositif 1 est alors terminée. [0066] En référence à la figure 3, les étapes suivantes sont mises en oeuvre au cours d'une phase ultérieure d'utilisation du dispositif 1, une fois celui-ci mis sous tension. [0067] La deuxième unité de traitement 12 commande une suspension du programme cible exécuté par la première unité de traitement 6 (étape 100). [0068] Différentes politiques de suspension du programme cible peuvent être mises en oeuvre, prises seules ou en combinaison. [0069] La deuxième unité de traitement 12 peut par exemple placer des points d'arrêts définis par les données de référence (au sens où les données de référence pointent vers des endroits précis du code du programme en lesquels l'exécution du programme sera suspendue). Ce placement de points d'arrêts est typiquement mis en oeuvre lors d'une mise sous tension du premier circuit électronique 2 (ou plus généralement du dispositif 1), via une commande appropriée émise par le premier circuit électronique 2 transitant par le port de debug 10, avant que le programme cible ne démarre ou bien très peu de temps après son démarrage par la première unité de traitement 6. [0070] L'exécution du programme est suspendue à chaque fois que le pointeur d'exécution atteint l'une des adresses où a été placé un point d'arrêt. [0071] Un avantage d'une suspension au moyen de points d'arrêts est de pouvoir cibler de manière déterministe des parties critiques du programme cible les plus susceptibles d'être corrompues par des attaques, ou cibler des zones ayant peu d'impact sur les opérations ne devant pas être interrompues (pour une meilleure stabilité du système). [0072] La deuxième unité de traitement 12 peut également commander la suspension en placement des points d'observations au niveau de variables du programme cible. Dans ce cas, une suspension survient lorsque la variable est modifiée. [0073] Additionnellement, le circuit 4 peut vérifier de manière répétée (selon une période fixe ou aléatoire par exemple) que les points d'arrêts ou d'observations placés sont toujours présents. [0074] La deuxième unité de traitement 12 peut également suspendre le programme cible lorsqu'une condition indépendante de la manière dont le programme s'exécute est remplie. [0075] La condition est par exemple une condition temporelle : la deuxième unité de 9 traitement déclenche la suspension une fois qu'un délai de durée prédéterminée s'est écoulé depuis le démarrage ou une précédente reprise du programme cible. À cet effet, la deuxième unité de traitement 12 dispose d'un compteur de temps qui est réinitialisé au démarrage ou à chaque reprise du programme cible. [0076] Certaines attaques peuvent avoir pour conséquence que le pointeur d'exécution ne passe plus jamais par les adresses où ont été placés des points d'arrêts, ou ne modifie plus les variables où ont été placés des points d'observation, ce qui est préjudiciable. L'avantage d'une suspension déclenchée sur respect d'une condition indépendante de la manière dont le programme s'exécute est par conséquent de pouvoir garantir qu'il y aura une suspension, quels que soient les endroits du programme cible où passe le pointeur d'exécution de la première unité de traitement 6 et quelles que soient les variables que le programme cible modifie. Cet avantage est en particulier obtenu lors de l'utilisation d'une condition temporelle de déclenchement de la suspension. [0077] Pendant que le programme cible est suspendu, la deuxième unité de traitement 12 met en oeuvre un contrôle d'intégrité du programme ou de données manipulées par ce dernier et/ou un contrôle de la conformité de l'exécution du programme par la première unité de traitement 6 à une exécution de référence. Pour opérer de tels contrôles la deuxième unité de traitement 12 accède en lecture à la deuxième mémoire 14 en se fondant sur les données de référence qui sont mémorisées dans la deuxième mémoire 14 (étape 102). [0078] L'étape de contrôle 102 couvre tout traitement mettant en oeuvre des vérifications de cohérence de l'exécution et d'intégrité du programme et/ou de ses données de manière à détecter des altérations de ce même programme ou des anomalies d'exécution pouvant être la conséquence d'évènements aléatoires, mais aussi pouvant avoir été générées par un attaquant (dépassement de tampon par exemple). [0079] Un premier type de contrôle susceptible d'être mis en oeuvre au cours de l'étape 102 porte sur l'intégrité du programme ou de données manipulées par ce dernier. [0080] Typiquement, lorsque le programme cible est suspendu, la deuxième unité de traitement 12 vérifie si une donnée à contrôler présente dans la première mémoire 8 et une donnée d'intégrité faisant partie des données de référence mémorisées dans la deuxième mémoire 14 sont cohérentes. La deuxième unité de traitement 12 peut par exemple comparer la donnée d'intégrité et la donnée à contrôler, auquel cas les deux données sont considérées cohérentes lorsqu'elles sont de valeurs identiques. [0081] Toutefois, la vérification de cohérence entre une donnée d'intégrité et une donnée à contrôler peut être plus complexe qu'une simple comparaison. L'une des données en entrée de la vérification de cohérence peut par exemple subir une transformation, et le résultat de cette transformation peut être comparé avec l'autre donnée. Les deux données en entrée de la vérification de cohérence peuvent également subir des trans- formations respectives, les résultats de ces deux transformations être ensuite comparés. [0082] La vérification de cohérence peut être répétée pour plusieurs données de référence (lorsque plusieurs données d'intégrité ont été associées à la même adresse, par exemple). [0083] Par exemple, une donnée de premier circuit électronique 2 à contrôler au cours de de l'étape contrôle d'intégrité est une variable globale. [0084] Le contrôle d'intégrité 102 produit deux résultats possibles : un résultat positif, en cas de cohérence entre les données d'intégrité et à contrôler, et un résultat négatif dans le cas contraire (incohérence entre les données). Ce résultat négatif révèle une compromission du programme cible ou de données manipulées par le programme cible. [0085] Un deuxième type de contrôle susceptible d'être mis en oeuvre au cours de l'étape 102 porte la question de savoir si le programme s'exécute d'une manière conforme à un schéma préétabli. [0086] Les données de références renseignent alors sur une exécution de référence du programme. L'exécution de référence du programme est une exécution du programme dans le cas où celui-ci n'a fait l'objet d'aucune modification ou altération par une attaque survenant suite à son installation dans le dispositif 1. [0087] Au cours de l'étape 102, la deuxième unité de traitement 12 utilise les données de référence pour déterminer si l'exécution du programme par la première unité de traitement 6 est conforme à cette exécution de référence. [0088] Ce contrôle de conformité produit deux résultats possibles : un résultat positif, en cas de conformité entre l'exécution du programme et l'exécution de référence, et un résultat négatif dans le cas contraire (incohérence entre les exécutions). Ce résultat négatif révèle également une compromission du programme cible ou de données manipulées par le programme cible. [0089] Une façon de mettre en oeuvre un tel contrôle de conformité est de référencer dans les données de référence une séquence d'évènements censés survenir dans un certain ordre, ou plus généralement un graphe orienté d'évènements. Par exemple, ces évènements sont des passages d'un pointeur d'exécution par différents endroits du programme dans un ordre prédéfini. Prenons le cas par exemple de trois instructions de code A, B, C du programme. A est une instruction de code du programme exécutée à son démarrage, B est une instruction de code du programme se trouvant au début d'une fonction censée être exécutée après A, et C est une instruction de code du programme se trouvant à la tin de cette même fonction. Dans le cas où le programme ne subit aucune modification ou altération, le pointeur d'exécution de la première unité de traitement 6 est censé passer par les instructions A, puis B. puis C. Par contre, si ces trois instructions sont exécutées dans un ordre différent, par exemple B, puis A, puis C, ceci est révélateur d'une altération du programme survenue après son installation 11 initiale. [0090] Aussi, la deuxième unité de traitement 12 détecte l'ordre dans lequel les évènements référencés dans les données de référence surviennent au cours de l'exécution du programme par la première unité de traitement 6. [0091] La deuxième unité de traitement compare ensuite l'ordre prédéfini dans les données de référence (A puis B puis C dans l'exemple présenté ci-dessus), et l'ordre qu'elle a détecté. [0092] Si les deux ordres comparés correspondent, le résultat du contrôle de conformité est positif. Sinon, ce résultat est négatif [0093] Bien entendu, les deux types de contrôle précités (intégrité de données / conformité d'exécution du programme) peuvent être combinés au cours de l'étape 102. Dans ce cas, on considère que le résultat général du contrôle mis en oeuvre au cours de l'étape 102 est positif seulement si tous les types de contrôles sous-jacents mis en oeuvre au cours de cette étape 102 aboutissent à des résultats positifs. [0094] Le résultat du contrôle effectué au cours de l'étape 102 est vérifié (étape 104). [0095] Lorsque le résultat du contrôle est positif, la deuxième unité de traitement 12 commande une reprise du programme cible (étape 106), en émettant une commande appropriée via le port de dcbug 10. [0096] Lorsque le résultat du contrôle est négatif, la deuxième unité de traitement 12 peut commander un arrêt complet du programme cible (étape 108), ce qui implique, à la différence d'une simple suspension, une libération de données allouées dans la première mémoire 8 au cours de l'exécution du programme cible. [0097] Par ailleurs, la deuxième unité de traitement 12 génère un rapport indiquant le résultat du contrôle 102 effectué. Ce résultat peut par exemple se présenter sous la forme d'une information binaire (OK ou en-eur), ou bien présenter une forme plus détaillée (renseignant sur le type de contrôle effectué, etc.). [0098] Le rapport généré est transmis au serveur 3 distant (étape 112), via un canal sécurisé établi entre l'interface de communication 18 du dispositif 1 et le serveur 3. [0099] Le canal sécurisé est typiquement établi avec à la suite d'une authentification entre le dispositif 1 et le serveur 3 faisant intervenir au moins une clé secrète. Par exemple, cette authentification est une authentification mutuelle entre le dispositif 1 et le serveur 3, et/ou utilise un mécanisme cryptographique à base de clé publique/clé privée. Les clés utilisées peuvent être stockées dans la mémoire 14 de manière protégée contre des attaques. [0100] Le rapport généré peut être transmis en réponse à un résultat négatif du contrôle 102 effectué. Toutefois, il convient de garder à l'esprit qu'il est également avantageux de transmettre ce rapport également dans le cas d'un résultat positif du contrôle 102 effectué. 12 [0101] L'étape 112 de transmission du rapport au serveur 3 peut être mise en oeuvre de dif- férentes manières. [0102] Dans le premier mode de réalisation du dispositif 1 illustré en figure 1, le rapport ne transite pas par le premier circuit électronique 2 car l'interface de communication 18 fait partie du deuxième circuit électronique 4. Le rapport est simplement émis par cette interface de communication 18 sur commande de la deuxième unité de traitement 12. [0103] Dans les modes de réalisation du dispositif 1 illustrés en figure 2 et 3, le rapport transite par le premier circuit électronique 2 avant de parvenir au serveur 3. [0104] Dans le deuxième mode de réalisation illustré en figure 2, la deuxième unité de traitement 12 commande une écriture, via les port supplémentaires 22 et 20, du rapport dans une zone d'échange préalablement allouée dans le premier circuit électronique 2, typiquement dans la première mémoire 8. Par exemple, la première unité de traitement 6 peut accéder périodiquement en lecture à la zone d'échange, et le rapport être transmis par le premier circuit électronique 2 en réponse à une telle lecture dans la zone d'échange. En variante, la transmission du rapport n'est déclenchée que sur réception, via l'interface de communication 18, d'une requête émise par le serveur 3 distant. [0105] Dans le troisième mode de réalisation du dispositif 1 illustré en figure 3, le rapport transite par le premier circuit électronique 2 avant de parvenir au serveur 3, mais d'une manière différente du deuxième mode de réalisation. Une requête émise par le serveur 3 est relayée par le premier circuit électronique 2 au deuxième circuit, via le port de debug 10. Sur réception de cette requête, le deuxième circuit se charge s'y répondre en envoyant au serveur 3 le rapport. Le rapport peut ne pas passer par la première unité de traitement 6 ou la première mémoire 8. Cette zone d'échange peut être interne à l'interface de communication 18 et indépendante de la mémoire 8. [0106] L'envoi du rapport au serveur peut être mis en oeuvre en réponse à la réception par le deuxième circuit 4 d'un message provenant du serveur 3 demandant un rapport. [0107] Par exemple, le circuit 2 reçoit un tel message du serveur 3 via l'interface de commu- nication 18. Ce message est stocké soit automatiquement grâce l'architecture du circuit 2 dans la mémoire 8 (par exemple DMA), soit via le programme exécuté sur l'unité de traitement 6 (sans DMA). Une fois ce message stocké, l'unité de traitement 6 fait une série de post-traitement pour en extraire les données utiles, et les formate de manière à pouvoir les envoyer au deuxième circuit 4, et l'unité de traitement 6 exécutera une partie de son programme qui contrôle l'interface de communication 10 pour envoyer ce message formaté, soit automatiquement, soit périodiquement, soit lors de réception d'une requête sur l'interface de communication 10 envoyée via l'interface de communication 16 par l'unité de traitement 12 (requête d'inten-uption de l'interface de communication 10). 13 [0108] De préférence, la transmission du rapport est mise en oeuvre pendant que le programme cible est dans un état suspendu. Ceci présente l'avantage d'éviter que le premier circuit électronique 2 dans un état corrompu ne tente d'empêcher la transmission de ce message ou d'en altérer le contenu de sorte à faire croire au serveur 1 qu'aucune compromission n'a été détectée par le deuxième circuit électronique 4. [0109] On distingue deux cas de figures, qui dépendent des capacités matérielles de l'interface de communication 18 lors d'une suspension du programme cible. [0110] Dans un premier cas, l'interface de communication 18 est fonctionnelle même lorsque le programme cible a été suspendu. [0111] Dans un deuxième cas, la suspension du programme cible entraîne également une suspension de l'interface de communication 18 ; autrement dit, il est alors nécessaire reprendre l'exécution du programme cible pour que l'interface de communication 18 également fonctionner. Ceci peut être causé par deux raisons : [0112] - Une raison matérielle pure, comme par exemple lorsque la suspension via le port de &bug 10 entraîne un arrêt d'alimentation en horloge de l'interface de communication 18 Une raison de performance : passer par le port de dcbug 10 pour écrire directement dans l'interface de communication 18 n'est pas assez performant pour assurer une communication stable et fiable. [0113] Dans ce deuxième cas, il peut être prévu ce qui suit dans un mode de réalisation non limitatif dans lequel le port 20 est un bus PC. [0114] - La deuxième unité de traitement 12 suspend la première unité de traitement 6 via un point d'arrêt placé au moment où la première unité 6 va s'endormir à la fin d'un cycle : à ce moment-là, la première unité de traitement 6 a fini ses opérations critiques et de communication avec l'extérieur via l'interface de communication 18. La deuxième unité de traitement 12 formate ses messages à envoyer vers l'extérieur indépendamment de la première unité de traitement 6. La deuxième unité de traitement 12 sauvegarde le contenu des registres de configuration d'un périphérique PC de la première unité de traitement 6, par exemple dans la deuxième mémoire 14. La deuxième unité de traitement 12 écrit dans les registres de configuration du périphérique PC de la première unité de traitement 6 pour préparer la communication vers l'extérieur du dispositif 1. La deuxième unité de traitement 12 écrit progressivement dans le registre du buffer d'émission du périphérique 12C pour transmettre les données formatées vers l'extérieur. Le SE restaure le contenu des registres de configuration du périphérique 12C 14 du MCU. Le SE rend la main au MCU, qui peut alors réellement partir dans sa période endormie. [0115] Dans le second cas, il est possible d'ajouter du code dans le premier circuit élec- tronique 2 qui est dédié à cette manipulation faite par la première unité de traitement 6. Par exemple : [0116] - Une zone libre est déterminée dans la première mémoire 8. Pendant que le programme cible est suspendu, la deuxième unité de traitement 12 écrit dans la zone libre une boucle d'attente de type boucle infinie, cette boucle pouvant éventuellement assister la communication faite par la deuxième unité de traitement 12. Cette boucle peut lire en mémoire (zone échange) une liste de bytes et les envoyer automatiquement dans le bufferl, C.La deuxième unité de traitement 12 force un changement de « program countcr » et sauvegarde le contexte d'exécution de la première unité de traitement 6 de façon à sauter sur la nouvelle boucle d'attente. La deuxième unité de traitement 12 commande les écritures voulues dans le registre de communication de l'interface de communication 18, soit via le port de dcbug 10 (Boucle infinie vide), soit via la boucle d'attente écrite (boucle infinie avec assistance de communication). Une fois la communication finie, la deuxième unité de traitement 12 restaure le contexte et rend la main au programme cible. [0117] Lorsque le serveur 3 reçoit un rapport contenant un message d'erreur, le serveur 3 peut par exemple commander un arrêt à distance du premier circuit électronique 2 si un tel arrêt n'a pas déjà été mis en oeuvre de manière autonome par la deuxième unité de traitement 12 au cours de l'étape 108. Alternativement, ou à titre complémentaire, le serveur 3 révoque le dispositif 1, c'est à dire lui interdit l'accès à certains services (par exemple des services d'un réseau d'objets connectés auquel le serveur 3 appartient). [0118] Les étapes qui précèdent sont répétées à chaque fois qu'une nouvelle suspension du programme cible se produit. [0119] Dans ce qui précède, il a été présenté des modes de réalisation dans lesquels le contrôle de l'étape 102 est mis en oeuvre pendant que le programme est suspendu. Cette suspension a pour avantage de simplifier grandement la mise en oeuvre du contrôle effectué. Cependant, il convient de noter qu'une telle suspension n'est pas obligatoire, bien qu'avantageuse. En effet, il peut être envisagé que la deuxième unité de traitement 12 injecte via le port de debug 10 des instructions de code spéciales ayant vocation à déclencher, au cours de leur exécution par la première unité de traitement 6, l'envoi vers le deuxième circuit 4 de données à contrôler au cours de l'étape de contrôle 102. L'exécution du code injecté et l'envoi des données qui sont vérifiées peuvent tout à fait être effectuées sans suspension du programme. 16 [Revendication 1] [Revendication 2] [Revendication 3] [Revendication 4]