Brevet FR2983664A1 — publié le 20130607

CONVERTISSEUR ANALOGIQUE-NUMERIQUE ET CIRCUIT NEUROMORPHIQUE UTILISANT UN TEL CONVERTISSEUR L'invention concerne d'une part un nouveau type de convertisseur analogique-numérique et d'autre part un circuit électronique à architecture neuromorphique utilisant un tel convertisseur. Le convertisseur analogique-numérique est tout spécialement conçu pour une utilisation dans le contexte d'un circuit neuromorphique mais il peut avoir également d'autres utilisations. Il va être décrit dans ce contexte pour lequel il a été conçu. Les circuits neuromorphiques sont des réseaux de multiples cellules, configurés de manière à imiter un peu le comportement des réseaux de neurones biologiques. Les réseaux de neurones biologiques comportent des neurones élémentaires qui reçoivent et émettent de l'information, et des synapses qui connectent ces neurones à d'autres neurones. Par analogie, les circuits neuromorphiques comprennent en général un réseau matriciel de cellules élémentaires de traitement qu'on appellera neurones, identifiés chacun par une adresse respective dans la mémoire, et une mémoire matricielle d'autant de mémoires élémentaires qu'il y a de neurones ; chaque mémoire élémentaire est associée à un neurone et peut donc être identifiée par l'adresse unique de ce neurone ; elle contient des adresses d'autres neurones qui doivent recevoir une information en provenance du neurone correspondant à cette mémoire élémentaire. On considère dans ce qui suit les neurones dits "à décharge". Ces neurones reçoivent des signaux d'entrée en provenance d'autres neurones ; ils les traitent sous forme généralement analogique et produisent un résultat. Le résultat peut être l'émission d'un signal d'évènement, par exemple une impulsion à un moment donné. C'est cette impulsion, dite de "décharge du neurone", qui sert à aller chercher dans la mémoire élémentaire associée au neurone non seulement les adresses d'autres neurones (neurones-cible ou neurones de destination), mais aussi des poids associés à chacune de ces adresses. Les poids associés signifient qu'un neurone va influencer un ou plusieurs autres neurones de manière pondérée et non de manière indifférenciée. Les adresses des neurones influencés par un neurone sont appelées adresses post-synaptiques ; les poids associés sont appelés poids synaptiques. Par exemple, un neurone élémentaire analogique peut être constitué sous forme d'un intégrateur temporel à fuite ; son potentiel interne représente la somme algébriques de plusieurs potentiels appliqués au fil du temps à ses entrées par d'autres neurones, cette somme étant affectée par des courants de fuite ; lorsque le potentiel interne atteint un certain seuil, le neurone signale cet évènement en émettant un signal d'évènement qui est une impulsion de très courte durée, souvent appelé "spike". Le potentiel revient alors à un état de repos, en attente de nouvelles entrées. Le signal d'évènement, ou spike, est utilisé, avec l'adresse du neurone qui l'a émis, pour extraire le contenu de la mémoire élémentaire associée à cette adresse ; ce contenu est constitué par une ou plusieurs adresses post-synaptiques et leurs poids synaptiques associés. Ces adresses et poids sont reçus par un circuit de traitement qui élabore des signaux d'entrée pondérés et qui les transmet en tant que signaux d'entrée aux neurones correspondant aux adresses post-synaptiques. Dans la technique antérieure telle qu'illustrée sur la figure 1, le signal d'évènement issu de la décharge d'un neurone de la matrice de neurones RN est appliqué à un encodeur d'adresse ENC qui détermine l'adresse du neurone qui a généré l'évènement et qui envoie cette adresse sur un bus dit présynaptique Bpre-syn- Le bus pré-synaptique est un bus d'adresse pour la mémoire. Ce bus est géré par un contrôleur CTRL qui applique cette adresse à la mémoire MEM et qui recueille de la mémoire une ou plusieurs adresses post-synaptiques et les poids associés à chacune de celles-ci. Le contrôleur émet successivement les différentes adresses post-synaptiques sur un bus d'adresses post-synaptiques Bpost-syn qui applique ces adresses à un décodeur d'adresses DEC associé à la matrice de neurones RN. En même temps, le contrôleur envoie les poids synaptiques à un convertisseur numérique analogique DAC qui établit des niveaux analogiques en fonction de chaque poids synaptique. Un niveau de signal analogique correspondant à un poids synaptique déterminé est donc appliqué à chacun des neurones post-synaptiques identifiés par le contenu de la mémoire élémentaire qui a été activée par le signal d'évènement. Le neurone peut être schématisé comme sur la figure 2 par un noeud capacitif ND, de capacité Cnd. Ce noeud est connecté à l'entrée d'un comparateur à seuil CMP. L'entrée du neurone est constituée par une borne E reliée au noeud ND ; c'est une entrée en courant et le courant d'entrée sert 5 à charger (ou décharger) la capacité. Par exemple, une impulsion de courant de largeur temporelle déterminée, positive ou négative, d'amplitude représentant un poids synaptique est appliquée à l'entrée E chaque fois que le neurone est désigné par un autre neurone. Par ailleurs, le noeud capacitif peut présenter des fuites de sorte que la capacité du noeud se décharge 1 0 progressivement si de nouvelles impulsions de charge n'arrivent pas sur l'entrée E. Lorsque la tension aux bornes de la capacité augmente suffisamment pour atteindre le seuil du comparateur, celui-ci émet une impulsion brève qui est le signal d'évènement ou spike du neurone. La figure 3 représente un neurone post-synaptique qui a été 15 désigné par le bus post-synaptique et qui peut alors recevoir du convertisseur numérique-analogique DAC un signal analogique dont l'amplitude représente un poids synaptique. Ce signal est une impulsion brève de courant. Le poids synaptique Pds est contenu sous forme numérique dans la mémoire MEM, à l'adresse du neurone (pré-synaptique) 20 qui a émis un spike à destination du neurone post-synaptique considéré ici. Le convertisseur numérique-analogique convertit ce poids numérique en une valeur de courant analogique émis pendant une impulsion de durée prédéfinie. De nombreuses réalisations de convertisseurs numérique- 25 analogique existent mais il est important de réaliser le convertisseur sous une forme particulièrement simple. L'invention a pour but de proposer un convertisseur numérique-analogique de construction simple et peu encombrante, utilisable tout particulièrement dans cette application de circuit neuromorphique. 30 L'invention repose sur le fait que les technologies de fabrication industrielle de circuits intégrés entraînent une dispersion non désirée, mais mise à profit ici, des caractéristiques individuelles des éléments du circuit intégré, et notamment des transistors. Ainsi, des transistors qui ont tous les mêmes caractéristiques géométriques nominales devraient tous fournir le 35 même courant pour la même tension grille-source, mais fournissent en réalité des courants très différents les uns des autres. Cette dispersion est d'autant plus importante que les transistors sont plus petits ; or la technologie tend à évoluer vers des transistors de plus en plus petits, pour pouvoir maximiser le nombre de transistors sur une surface de circuit intégré donnée. La dispersion est particulièrement sensible pour des transistors de dimensions longueur par largeur inférieures à 40x100 nm2, et encore plus pour 20x50 nm2. Le convertisseur numérique-analogique selon l'invention comporte: - un ensemble de plusieurs transistors de caractéristiques géométriques nominales identiques mais de caractéristiques courant-tension dispersées telles que lorsqu'on applique une tension grille-source constante aux différents transistors il circule dans le transistor un courant variable en fonction de la dispersion, - une table numérique de correspondance ayant une entrée numérique pour recevoir un mot à convertir et une sortie de sélection pour sélectionner parmi l'ensemble de transistors, en fonction du mot à convertir, un transistor ou un groupe de transistors fournissant un courant de valeur désirée représentant ce mot sous forme analogique, - une sortie en courant fournissant le courant délivré par le transistor ou le groupe de transistors sélectionnés, recevant tous une tension grille-source nominale, - et des moyens pour charger dans la table numérique de correspondance à une adresse déterminée une donnée déterminant la sélection du transistor ou du groupe de transistors, en fonction de caractéristiques courant-tension réelles mesurées des différents transistors de l'ensemble, pour établir une correspondance entre des mots à convertir et des valeurs de courant obtenues par la sélection des transistors. De préférence, la tension grille-source appliquée aux transistors 30 est une tension inférieure à la tension Vt de seuil de mise en conduction des transistors. De préférence, la sortie de sélection de la table de correspondance comprend plusieurs conducteurs de sortie connectés chacun au drain d'un transistor respectif, les sources des transistors étant 35 toutes reliées à la sortie du convertisseur, de sorte que la sortie du convertisseur fournit la somme des courants traversant ceux des transistors qui sont sélectionnés par la table, les autres transistors ne fournissant pas de courant. Les conducteurs de sortie de la table peuvent avoir deux états qui sont un premier état en haute impédance dans lequel les drains des transistors ne reçoivent pas de tension d'alimentation et ne peuvent donc pas être parcourus par un courant, et un deuxième état dans lequel les drains des transistors reçoivent une alimentation et peuvent donc fournir un courant. L'invention concerne également l'application principale pour laquelle ce convertisseur a été conçu, à savoir un circuit neuromorphique comprenant - un réseau de neurones identifiés chacun par une adresse de neurone dans le réseau, chaque neurone pouvant recevoir et traiter au 15 moins un signal d'entrée puis émettre plus tard sur une sortie du neurone un signal représentant un évènement qui se produit à l'intérieur du neurone, - une mémoire programmable adressable par l'adresse d'un neurone ayant émis un signal d'évènement représentant un résultat de l'activité du neurone, la mémoire contenant à cette adresse une donnée 20 numérique comprenant une ou plusieurs adresses de neurones post-synaptiques et un poids post-synaptique respectif associé à chaque adresse post-synaptique, - des moyens pour extraire de la mémoire la donnée relative à un neurone, après que ce neurone ait émis un signal d'évènement 25 représentant un résultat de l'activité du neurone, - un convertisseur numérique-analogique pour appliquer à l'entrée d'un neurone post-synaptique identifié par une adresse contenue dans la donnée une impulsion de courant dont l'amplitude représente le poids post-synaptique associé à cette adresse dans la donnée, 30 caractérisé en ce que le convertisseur numérique-analogique comprend - au moins un ensemble de plusieurs transistors de caractéristiques géométriques nominales identiques mais de caractéristiques courant-tension dispersées telles que lorsqu'on applique une tension grille source constante aux différents transistors il circule dans le transistor un courant variable en fonction de la dispersion, - une table numérique de correspondance ayant une entrée numérique et une sortie de sélection pour sélectionner en fonction de l'entrée 5 numérique un transistor ou un groupe de transistors parmi l'ensemble, - une sortie en courant fournissant le courant délivré par le transistor ou le groupe de transistors sélectionnés, recevant tous une tension grille-source nominale, - et des moyens pour charger dans la table numérique de 10 correspondance des données déterminées déterminant la sélection de transistors, en fonction de caractéristiques courant-tension réelles mesurées des différents transistors de l'ensemble. Dans une première réalisation, le convertisseur est commun à 15 tous les neurones ; l'ensemble de transistors qui effectue la conversion en courant est commun à tous les neurones. La mémoire programmable envoie une adresse de neurone post-synaptique pour sélectionner ce neurone et elle envoie à la table de correspondance un mot numérique représentant le poids synaptique associé à ce neurone. La sortie en courant du 20 convertisseur est appliquée au neurone post-synaptique désigné par la mémoire. Les neurones post-synaptiques sont activés successivement s'il y en a plusieurs, le convertisseur ne pouvant convertir qu'un poids synaptique à la fois. Dans une autre réalisation, un convertisseur individuel est placé 25 en amont de chaque neurone de sorte qu'il y a un ensemble de m transistors associé à chaque neurone et placé en amont du noeud capacitif du neurone ; s'il y a N neurones, il y a donc N ensembles de m transistors ; la table de correspondance est constituée par la mémoire programmable elle-même qui reçoit une adresse de neurone pré-synaptique ; cette adresse désigne au 30 moins un neurone post-synaptique et désigne donc un ensemble de m transistors associé à ce neurone. Mais la table désigne non seulement cet ensemble mais plus précisément un transistor ou un groupe de transistors de l'ensemble ; en pratique, la table de correspondance adresse donc directement un transistor ou un groupe de transistors parmi mxN transistors. 35 Le poids synaptique est inscrit dans la table non pas sous une forme de valeur numérique mais directement sous forme d'un code de sélection des transistors d'un ensemble. Avec cette structure, on peut appliquer simultanément à plusieurs neurones post-synaptiques les impulsions de courant ayant des amplitudes désirées. D'une manière générale, la structure de circuit selon l'invention permet d'améliorer les performances en termes de consommation de puissance et de surface du circuit intégré. D'autres caractéristiques et avantages de l'invention apparaîtront 1 0 à la lecture de la description détaillée qui suit et qui est faite en référence aux dessins annexés dans lesquels : - la figure 1 déjà décrite représente la structure d'un réseau neuronal de l'art antérieur ; - la figure 2 déjà décrite représente un schéma simplifié de 15 neurone ; - la figure 3 déjà décrite représente le neurone auquel est appliqué un courant représentant un poids post-synaptique issu d'une mémoire ; - la figure 4 représente un exemple de courbes dispersées de transistors de caractéristiques géométriques en principe identiques ; 20 - la figure 5 représente le schéma de principe du convertisseur numérique-analogique selon l'invention ; - la figure 6 représente un premier mode de réalisation d'un circuit neuromorphique utilisant un convertisseur selon l'invention ; - la figure 7 représente un deuxième mode de réalisation d'un 25 circuit neuromorphique utilisant un convertisseur selon l'invention. Sur la figure 4, on a représenté à titre d'exemple un ensemble de caractéristiques courant-tension de transistors ayant tous les mêmes dimensions nominales et la même technologie de fabrication. Il s'agit de très 30 petits transistors dont la longueur de canal est de 10 nanomètres. Huit courbes de valeurs de transconductance sont représentées, correspondant à des transistors nominalement identiques. En abscisse on a porté la tension grille-source Vg en échelle linéaire en volts et en ordonnée la valeur du courant drain-source Ids en 35 échelle logarithmique. La tension drain-source est de 1 volt, mais le principe reste le même pour une tension de polarisation plus faible. On observe une très grande dispersion des courbes, notamment pour une tension Vg sous le seuil de conduction Vt du transistor, ici un seuil d'environ 0 volt mais le seuil pourrait être supérieur ou inférieur à O. La dispersion augmente lorsque la tension grille-source s'écarte plus du seuil. Si on se place par exemple à une tension grille-source de -1,6 volts pour un seuil de 0 volt, les courants générés par ces huit transistors varient entre environ 10-9 et 10-5 ampères. Ces courbes ont été relevées pour des transistors de longueur effective de canal 10 nanomètres destinées à des circuits intégrés de très haute densité. La forte variabilité des courants de fuite peut être due à une présence variable de dopants indésirables dans le centre du canal, le centre du canal étant très proche des sources et drains dopés du transistor lorsque le transistor est de très petite taille et lorsque le dopant du canal est de même nature que celui des source et drain. Elle peut être due aussi aux fluctuations locales de différents paramètres géométriques tels que l'épaisseur de l'oxyde de grille, la rugosité des gravures, etc. La variabilité peut être due également à d'autres facteurs : permittivité de l'oxyde de grille, taille des grains métalliques, granularité du dopage. La figure 5 représente le principe du convertisseur numérique- analogique à sortie en courant selon l'invention. Il comprend un circuit de sélection LUT qui est une table numérique de correspondance (en anglais : "look-up-table") recevant comme entrée un mot numérique "DATA" de p bits à convertir, ici par exemple un mot de 3 bits, et fournissant sur ses sorties un code numérique servant à sélectionner un ou plusieurs transistors d'un ensemble de m transistors. La table de correspondance LUT comprend donc m sorties fournissant un signal logique haut ou bas selon la valeur des bits du mot appliqué à l'entrée. Par exemple, le niveau haut sur la sortie signifie la sélection d'un transistor et le niveau bas signifie l'absence de sélection. Dans l'exemple le plus simple, la table comporte m=2P sorties et elle établit un niveau logique haut sur une sortie et une seule en fonction du mot d'entrée, les autres sorties étant au niveau bas. Mais dans d'autres exemples la table possède m sorties, m différent de 2P, et peut placer une ou plusieurs sorties au niveau logique haut. Dans l'exemple représenté sur la figure 5, on a supposé que l'ensemble de transistors comprend m=8 transistors T1 à T8 qui ont tous les mêmes caractéristiques physiques nominales (mêmes longueurs, largeurs, profondeurs et concentrations en dopants). Chaque sortie est appliquée au drain d'un transistor respectif pour lui appliquer une tension d'alimentation si le transistor est sélectionné mais pas de tension d'alimentation s'il n'est pas sélectionné. Les sources des transistors sont toutes reliées à une sortie commune S du convertisseur. Cette sortie constitue une sortie en courant. Les grilles de tous les transistors sont portées à un potentiel nominal 1 0 commun Vg, de préférence comme on l'a dit un potentiel au-dessous du seuil de conduction Vt du transistor ; un courant qu'on peut appeler courant de fuite passe alors dans le transistor à la condition toutefois qu'il soit sélectionné par la table de correspondance. La sortie S délivre un courant de fuite global ; ce courant est la somme des courants de fuite des 15 transistors qui reçoivent une tension d'alimentation (niveau logique haut fourni par la table de correspondance) sur leur drain ; les autres transistors ne fournissent pas de courant de fuite. En raison du fait que les transistors, bien qu'identiques en théorie, ont des courants de fuite différents mais stables dans le temps, on remplit la 20 table de correspondance avec des données qui font correspondre à chaque mot d'entrée un courant de sortie représentant une valeur analogique du mot d'entrée. Le remplissage de la table est fait à partir de mesures effectuées sur le circuit. On recherche à partir de ces mesures les courants ou sommes de courants de transistors qui représentent le mieux les valeurs analogiques 25 désirées pour chaque valeur de mot numérique à l'entrée du convertisseur. On remplit la table en conséquence pour que l'application d'un mot numérique à l'entrée entraîne la sélection d'un transistor ou d'un groupe de transistors dont la somme des courants de fuite représente la valeur analogique désirée pour représenter ce mot numérique. Statistiquement, la 30 grande variabilité des caractéristiques des transistors permet de trouver une sélection aboutissant à une valeur suffisamment proche de la valeur désirée. Pour mesurer les courants de fuite des différents transistors, le plus simple est d'évaluer les courants fournis par toutes les combinaisons possibles de 1 à m transistors, puis de sélectionner une série de 2P valeurs 35 qui représentent au mieux une valeur analogique acceptable pour un mot d'entrée donné. On charge dans la table à chacune des 2P adresses de la table un mot qui représente la combinaison de transistors à activer pour obtenir de la meilleure manière possible cette valeur. Une manière de mesurer le courant de fuite d'un transistor consiste à relier la source du transistor à une capacité (analogue au neurone de la figure 2) reliée à un comparateur à seuil, à appliquer des impulsions successives de tension au drain de ce transistor (dont la grille est à la tension nominale Vg), et à compter le nombre N d'impulsions de largeur constante dt qui aboutissent au basculement du comparateur à seuil. Ce nombre est d'autant plus faible que le courant de fuite du transistor est plus grand. La durée des impulsions sera choisie brève pour une mesure fine du courant de fuite. Si la mesure est faite par un neurone ou un pseudo-neurone de capacité Cnd et de tension de seuil Vth, la valeur du courant de fuite d'un transistor donné relié à ce neurone sera donnée par la formule I = Cnd.Vth/N.dt, en supposant qu'on néglige dans cette mesure le courant de fuite naturel du neurone lui-même. En utilisation, après avoir chargé la table de correspondance en fonction des mesures faites, on applique un mot à convertir à l'entrée du convertisseur, c'est-à-dire à l'entrée de la table de correspondance, et on 20 utilise le courant analogique sur la sortie S. Selon l'invention, une application principale de ce convertisseur est l'incorporation du convertisseur à un circuit neuromorphique tel que celui de la figure 1. 25 La figure 6 représente une première variante de réalisation dans laquelle il y a un seul convertisseur numérique-analogique pour l'ensemble des neurones du circuit. On a représenté trois neurones sous la même forme que celui de la figure 2, à savoir avec un noeud capacitif ND et un comparateur à seuil CMP. Un neurone post-synaptique désigné par le bus 30 post-synaptique peut être sélectionné par un signal SEL issu du décodeur DEC de la figure 1. Ce neurone reçoit alors le courant de sortie du convertisseur numérique-analogique DAC de la figure 5 ; le convertisseur a reçu en même temps le poids synaptique Pds fourni par le bus post-synaptique et le courant fourni au neurone est un courant analogique 35 représentant ce poids. La figure 7 représente une autre variante dans laquelle il y a une structure de convertisseur numérique-analogique associée à chaque neurone et non pas une structure de convertisseur globale pour tous les neurones. La table de correspondance LUT du convertisseur se confond alors avec la mémoire MEM de la figure 1, et cette table désigne à la fois un neurone post-synaptique, donc un ensemble de m transistors associé à ce neurone, et le ou les transistors à sélectionner dans cet ensemble de m transistors. Sur la figure 7 on a supposé que m = 4. La table de correspondance est donc une table numérique qui fait correspondre une adresse pre-synaptique Adr-pre (l'adresse du neurone qui a émis un évènement) avec une sélection d'un ou plusieurs transistors parmi m transistors. Le poids synaptique représenté par cette sélection est inscrit dans la table sous une forme numérique qui est directement un code de sélection des transistors. Si le neurone pré-synaptique fait appel à plusieurs neurones post-synaptiques, la table de correspondance fait correspondre à une adresse pré-synaptique plusieurs groupes de transistors correspondant à des neurones post-synaptiques différents. L'impulsion de courant peut-être appliquée simultanément à tous les neurones post-synaptique, alors que dans la réalisation de la figure 6 une impulsion de courant ne peut être appliquée par un convertisseur qu'à un neurone post-synaptique à la fois. Sur la figure 7, on a représenté à titre d'exemple des interrupteurs entre chaque ensemble de transistors et le neurone associé, la fermeture simultanée de tous les interrupteurs permettant l'application d'une impulsion de courant de durée dt à ceux des neurones qui sont sélectionnés et avec une amplitude respective selon les transistors sélectionnés pour chacun d'eux. REVENDICATIONS1. Convertisseur numérique-analogique caractérisé en ce qu'il comporte : - un ensemble de plusieurs transistors (T1 -T8) de caractéristiques géométriques nominales identiques mais de caractéristiques courant-tension dispersées telles que lorsqu'on applique une tension grille- source constante aux différents transistors il circule dans le transistor un courant variable en fonction de la dispersion, - une table numérique de correspondance ayant une entrée numérique pour recevoir un mot à convertir et une sortie de sélection pour sélectionner parmi l'ensemble de transistors, en fonction du mot à convertir, un transistor ou un groupe de transistors fournissant un courant de valeur désirée représentant ce mot sous forme analogique, - une sortie en courant fournissant le courant délivré par le transistor ou le groupe de transistors sélectionnés, recevant tous une tension grille-source nominale (Vg), - et des moyens pour charger dans la table numérique de correspondance à une adresse déterminée une donnée déterminant la sélection du transistor ou du groupe de transistors, en fonction de caractéristiques tension-courant réelles mesurées des différents transistors de l'ensemble, pour établir une correspondance entre des mots à convertir et des valeurs de courant obtenues par la sélection des transistors. 2. Convertisseur numérique-analogique selon la revendication 1, caractérisé en ce que la tension grille-source appliquée aux transistors est une tension inférieures à un seuil Vt de mise en conduction du transistor. 3. Convertisseur numérique-analogique selon l'une des revendications 1 et 2, caractérisé en ce que la sortie de sélection de la table de correspondance comprend plusieurs conducteurs de sortie connectés chacun au drain d'un transistor respectif, les sources des transistors étant toutes reliées à la sortie du convertisseur, de sorte que la sortie du convertisseur fournit la somme des courants traversant ceux des transistorsqui sont sélectionnés par la table, les autres transistors ne fournissant pas de courant. 4. Convertisseur selon la revendication 3, caractérisé en ce que les conducteurs de sortie de la table ont deux états qui sont un premier état en haute impédance dans lequel les drains des transistors ne reçoivent pas de tension d'alimentation, et un deuxième état dans lequel les drains des transistors reçoivent une alimentation et peuvent donc fournir un courant. 5. Circuit neuromorphique comprenant - un réseau de neurones (RN) identifiés chacun par une adresse de neurone dans le réseau, chaque neurone pouvant recevoir et traiter au moins un signal d'entrée puis émettre plus tard sur une sortie du neurone un signal représentant un évènement qui se produit à l'intérieur du neurone, - une mémoire programmable (MEM) adressable par l'adresse d'un neurone ayant émis un signal d'évènement représentant un résultat de l'activité du neurone, la mémoire contenant à cette adresse une donnée numérique comprenant une ou plusieurs adresses de neurones post- synaptiques et un poids post-synaptique respectif associé à chaque adresse post-synaptique, - des moyens (CTRL) pour extraire de la mémoire la donnée relative à un neurone, après que ce neurone ait émis un signal d'évènement représentant un résultat de l'activité du neurone, - un convertisseur numérique-analogique (DAC) pour appliquer à l'entrée d'un neurone post-synaptique identifié par une adresse contenue dans la donnée une impulsion de courant dont l'amplitude représente le poids post-synaptique associé à cette adresse dans la donnée, caractérisé en ce que le convertisseur numérique-analogique 30 comprend - au moins un ensemble de plusieurs transistors (T1-T8) de caractéristiques géométriques nominales identiques mais de caractéristiques courant-tension dispersées telles que lorsqu'on applique une tension grille-source constante aux différents transistors il circule dans le transistor un 35 courant variable en fonction de la dispersion,- une table numérique de correspondance (LUT) ayant une entrée numérique et une sortie de sélection pour sélectionner en fonction de l'entrée numérique un transistor ou un groupe de transistors parmi l'ensemble, - une sortie en courant (S) fournissant le courant délivré par le transistor ou le groupe de transistors sélectionnés, recevant tous une tension grille-source nominale (Vg), - et des moyens pour charger dans la table numérique de correspondance des données déterminées déterminant la sélection de 1 0 transistors, en fonction de caractéristiques courant-tension réelles mesurées des différents transistors de l'ensemble. 6. Circuit neuromorphique selon la revendication 5, caractérisé en ce que le convertisseur numérique-analogique est commun à tous les 15 neurones, l'ensemble de transistors qui effectue la conversion en courant étant commun à tous les neurones. 7. Circuit neuromorphique selon la revendication 5, caractérisé en ce qu'il comporte un ensemble de m transistors associé à chaque 20 neurone et placé en amont du noeud capacitif du neurone, et en ce que la table de correspondance est constituée par la mémoire programmable (MEM) qui reçoit une adresse de neurone pré-synaptique et qui sélectionne au moins un ensemble de m transistors et, dans cet ensemble, un transistor ou un groupe de transistors, pour appliquer à un neurone associé un courant 25 correspondant au transistor ou au groupe de transistors sélectionné.