Brevet FR2960720A1 — publié le 20111202

Procédé de protection d'un circuit logique contre des radiations externes et dispositif électronique associé. L'invention concerne la robustesse de composants électroniques tels que des circuits intégrés, et plus particulièrement la robustesse des circuits intégrés dans un environnement radiatif.. L'impact d'une particule sur un transistor ou proche d'un transistor peut engendrer un courant parasite dans un circuit intégré, suivant le pouvoir ionisant de cette particule (par exemple caractérisé par son LET : Linear Energy Transfer). En effet, la quantité de charge engendrée par une particule correspond à celle mise en oeuvre pendant le changement d'état d'un noeud logique commandé par un transistor. La conséquence de cet impact peut être le changement d'état, ou de niveaux, des signaux logiques, et par conséquent entraîner des erreurs en sortie du circuit. Afin de palier aux erreurs engendrées par de tels phénomènes, il est habituel de dupliquer les signaux en dupliquant les circuits générateurs de tels signaux. Une telle redondance permet de réduire la probabilité d'obtenir un signal erroné en sortie. En effet, la probabilité que tous les signaux dupliqués issus d'un même signal soient tous modifiés à la fois, c'est-à-dire que tous les circuits générant ces signaux subissent simultanément une perturbation radiative, est bien plus faible que la probabilité qu'un signal non dupliqué soit perturbé par une radiation externe. De cette manière, une analyse des signaux dupliqués en sortie permet de retrouver la valeur non perturbée de manière plus sûre. Certains secteurs d'activités, comme l'aérospatial ou le secteur médical, ont besoin d'une robustesse de composant permettant une fiabilité de réponse proche de 100%, cette caractéristique primant sur les autres facteurs. Il est connu, notamment par les documents US 6 703 858 ou US 5 570 313, d'utiliser des composants électriques nommés « éléments C » pour résoudre ces perturbations. Comme illustré sur la figure 1, ces éléments C comportent par exemple un empilement de quatre transistors, deux transistors PMOS 11 et 12, et deux transistors NMOS 13 et 14, couplés en séries. Le signal de sortie d'un bloc logique Ao est couplé en entrée du premier transistor PMOS 11 et du premier transistor NMOS 13, et un second signal de sortie du bloc logique A1, correspondant à une duplication du premier signal Ao, est couplé en entrée du second transistor PMOS 12 et du second transistor NMOS 14. La sortie S est prise entre le second transistor PMOS 12 et le premier transistor NMOS 13. Ces éléments C sont de très bons filtres contre les erreurs induites par les radiations. En effet, si une perturbation intervient sur un seul des deux blocs, les deux signaux seront de valeurs contraires, bloquant ainsi tout signal de sortie. En effet, si les signaux issus des blocs Ao et Al sont différents, aucun signal de sortie ne sera émis. Cependant, ces éléments C possèdent un courant de sortie faible donc un temps de réponse long pour une surface donnée. D'autres secteurs d'activités n'ont pas besoin d'une telle fiabilité, mais nécessitent en revanche des critères de rapidité de réponse, d'occupation de surface et de puissance plus optimaux. Selon un mode de réalisation et un mode de mise en oeuvre, il est proposé une architecture de protection visant à améliorer les caractéristiques de vitesse de réponse et de puissance tout en conservant une même surface d'occupation. Selon un aspect, il est proposé un procédé de protection d'un circuit électronique, par exemple un bloc logique contre les radiations externes, ledit circuit électronique comprenant au moins une sortie. Selon une caractéristique générale de cet aspect, on effectue au moins une duplication du circuit électronique, la duplication étant une duplication au moins fonctionnelle du circuit électronique, et on peut relier respectivement les sorties des circuits électroniques à des entrées homologues d'éléments combinatoires ou séquentiels au moins fonctionnellement identiques, et on relie ensemble les sorties homologues de tous les éléments combinatoires ou séquentiels. Ainsi, le principe de protection offert ici est totalement différent de celui de l'art antérieur. En effet, le fait que les sorties homologues des éléments combinatoires ou séquentiels soient reliés ensemble va conduire en cas de perturbation sur l'un des circuits dupliqués à un court-circuit temporaire en sortie (au lieu d'une absence d'émission d'un signal en sortie dans l'art antérieur). Par ailleurs, comme expliqué ci-après, une duplication fonctionnelle permet de résoudre le problème de la vitesse de réponse, même si une duplication structurelle, conduisant à des circuits structurellement identiques, comme par exemple des blocs logiques structurellement identiques, est préférable en terme de consommation. De même, il n'est pas nécessaire que les éléments combinatoires ou séquentiels soient structurellement identiques, pour autant qu'ils soient au moins fonctionnellement identiques. Avantageusement, on peut relier respectivement des circuits électroniques supplémentaires à des entrées supplémentaires des éléments combinatoires. Ainsi, par exemple, si les éléments combinatoires comprennent deux entrées, il est possible de protéger un premier circuit et un second circuit distincts en dupliquant chacun d'eux. Le premier circuit et ses duplicata seront, par exemple, couplés aux premières entrées des éléments combinatoires, et le second circuit et ses duplicata seront, par exemple, couplés aux secondes entrées des éléments combinatoires. La combinaison des signaux de sortie des deux circuits sera alors délivrée en sortie des éléments combinatoires. Selon un autre aspect, il est proposé un dispositif électronique permettant la protection d'un circuit électronique contre les radiations externes. Selon une caractéristique générale, le dispositif électronique comprend N circuits électroniques au moins fonctionnellement identiques comportant chacun au moins une sortie et N éléments combinatoires ou séquentiels au moins fonctionnellement identiques possédant au moins une entrée, avec N>1, les sorties des circuits électroniques étant respectivement reliées à des entrées homologues des éléments combinatoires ou séquentiels, et les sorties homologues des éléments combinatoires ou séquentiels étant respectivement reliées ensemble. De préférence, les circuits électroniques sont structurellement identiques. En effet, dans le cas où ils ne sont pas structurellement identiques mais fonctionnellement identiques il est possible qu'il y ait un retard temporel entre les signaux de sorties qui augmentera la consommation d'énergie, diminuant par conséquent les performances du dispositif électronique. Mais, le dispositif électronique fonctionne tout de même avec des circuits électroniques fonctionnellement identiques. Les éléments combinatoires ou séquentiels peuvent comporter une ou plusieurs sorties. Ainsi, par exemple, dans le cas d'un élément combinatoire formé, par exemple, d'un additionneur complet, ou « full adder », comprenant une première sortie pour la somme et une seconde sortie pour la retenue, il est prévu, d'une part, de coupler ensemble les premières sorties des additionneurs complets utilisés, et, d'autre part, de coupler ensemble les secondes sorties des additionneurs complets. De préférence, le nombre N d'éléments combinatoires ou séquentiels et de circuits électroniques est au moins égal au nombre deux. En multipliant les duplicata de circuits électroniques et, par correspondance, les éléments combinatoires ou séquentiels, le rapport de force en courant est modifié. En effet, la multiplication des circuits et des éléments permet de diluer l'impact de l'erreur due à la perturbation radiative. Dans un cas où le circuit électronique et l'élément combinatoire sont tripliqués, par exemple, si la perturbation radiative est contenue sur un seul des circuits électroniques, il n'y aura qu'un seul signal qui sera erroné, et deux signaux qui seront correctes. Le court-circuit qui sera alors engendré s'estompera plus rapidement que dans un cas d'une duplication, et l'amplitude de la perturbation sera moins importante. En modifiant ainsi le rapport de force en courant grâce à la multiplication des circuits électroniques, et des éléments combinatoires en correspondance, les caractéristiques de protection du dispositif électronique sont encore améliorées. Avantageusement, le dispositif peut comprendre au plus N circuits électroniques supplémentaires au moins fonctionnellement identiques. Les éléments combinatoires ou séquentiels peuvent comprendre une entrée supplémentaire, et les sorties des circuits électroniques supplémentaires peuvent respectivement être reliées à des entrées supplémentaires des éléments combinatoires. Les éléments combinatoires peuvent comprendre des inverseurs CMOS. Les transistors PMOS et NMOS d'un élément combinatoire ou séquentiel peuvent préférentiellement avoir des canaux présentant des caractéristiques dimensionnelles sensiblement identiques. Ceci présente l'avantage d'équilibrer les retards entre les éléments dupliqués et de minimiser le temps pendant lequel les éléments en parallèle sur une même sortie donnent lieu à un court-circuit transitoire. Les éléments combinatoires peuvent aussi comprendre des portes logiques CMOS telles que des portes NAND. Il est également possible d'utiliser des éléments séquentiels tels que des bascules, ou « latch », en lieu et place et des éléments combinatoires. D'autres avantages et caractéristiques de l'invention apparaîtront à l'examen de la description détaillée de modes de réalisation, nullement limitatifs, et des dessins annexés sur lesquels : La figure 1, déjà citée, représente un dispositif de protection selon l'art antérieur ; - La figure 2 représente un dispositif électronique selon un premier mode de réalisation ; - La figure 3 représente un dispositif électronique selon un second mode de réalisation ; La figure 4 représente un dispositif électronique selon un troisième mode de réalisation ; La figure 5 représente un dispositif électronique selon un quatrième mode de réalisation ; La figure 6 représente un dispositif électronique selon un cinquième mode de réalisation ; Dans la description détaillée qui suit, les circuits électroniques à protéger sont des blocs logiques. Cela étant l'invention n'est pas limitée à ce type de circuit électronique mais s'applique à tout type de circuit électronique délivrant en sortie un ou plusieurs signaux que l'on souhaite protéger contre des radiations externes, comme par exemple un capteur. La figure 2 illustre de manière schématique un dispositif électronique selon un premier mode de réalisation de l'invention. Dans ce premier mode de réalisation, le dispositif électronique comprend un bloc logique Ao et un bloc logique Al que l'on cherche à protéger d'un environnement radiatif, le bloc logique Al étant une duplication du bloc logique Ao. Le dispositif électronique comprend également deux éléments combinatoires 21 et 22 identiques, tels qu'un inverseur. Le premier inverseur 21 comprend un transistor PMOS 211 couplé en série avec un transistor NMOS 212 entre une borne d'alimentation 210 et la masse. De même, le second inverseur 22 comprend un transistor PMOS 221 couplé en série avec un transistor NMOS 222 entre une borne d'alimentation 220 et la masse. Les blocs logiques Ao et Al sont respectivement couplés en entrée des deux inverseurs. Les sorties des inverseurs sont couplées ensemble et constituent la sortie S du dispositif électronique. Lorsque les signaux issus des blocs logiques Ao et At diffèrent à l'entrée des éléments combinatoires 21 et 22, par exemple à cause d'une perturbation d'un des blocs par une radiation externe, la sortie S sera en court-circuit, délivrant une tension indéterminée. Cependant, en comparaison avec un « élément C », un dispositif électronique selon ce premier mode de réalisation de l'invention permet de diviser par quatre le courant de sortie donc le temps de réponse du circuit, pour une surface donnée, tout en offrant une protection aux radiations externes. En effet, le court-circuit produit lors d'une perturbation d'un des blocs logiques ne dure qu'un temps très court, de l'ordre de la nanoseconde, durée d'évacuation des charges parasites produites par la particule ionisante dans un des deux blocs logiques A0 ou Al, si aucune perturbation ne se produit à nouveau (faible probabilité), le dispositif électronique délivre de nouveau en sortie la valeur du signal souhaitée. Sur la figure 3 est illustré de manière schématique un dispositif électronique selon un deuxième mode de réalisation de l'invention. Ce second mode de réalisation diffère du premier mode de réalisation illustré sur la figure 2 en ce que le bloc logique à protéger a été tripliqué de manière à avoir une premier bloc logique A0, un second bloc logique A1, et un troisième bloc logique A2, et en ce qu'il comprend trois inverseurs 21, 22 et 23 comprenant chacun un transistor PMOS couplé en série avec un transistor NMOS entre un potentiel et la masse. Les trois blocs Ao, Al et A2 sont respectivement couplés chacun à l'entrée d'un inverseur 23, 22 et 21. Un tel dispositif permet d'augmenter la protection d'un bloc logique en modifiant le rapport de force en courant. En effet, la multiplication des blocs logiques et des inverseurs permet de diluer d'autant plus l'impact de l'erreur due à la perturbation radiative. Dans l'exemple illustré sur cette figure 3, si la perturbation radiative est contenue sur un seul des blocs logiques tripliqués, par exemple le bloc logique A0, il n'y aura qu'un seul signal erroné pour deux signaux corrects, qui seront délivrés à l'ensemble composé par les inverseurs. Le court-circuit résultant en sortie S des inverseurs sera de moindre amplitude que dans un cas de simple duplication comme par exemple sur la figure 2. En modifiant ainsi le rapport de force en courant grâce à la multiplication des blocs logiques, et des éléments combinatoires en correspondance, les caractéristiques de protection du dispositif électronique sont encore améliorées. La figure 4 présente schématiquement un troisième mode de réalisation d'un dispositif électronique selon l'invention. Dans ce troisième mode de réalisation, le dispositif électronique comprend un bloc logique Ao qu'on cherche à protéger d'un environnement radiatif. Le bloc logique Ao est dupliqué en un bloc logique dupliqué Al. Le dispositif électronique comprend également un premier élément combinatoire 41 constitué d'une porte logique NOR comprenant un premier transistor PMOS 411 couplé en série avec un deuxième transistor PMOS 412 couplé lui-même en série avec un premier transistor NMOS 413 couplé à la masse, le premier transistor NMOS 413 étant couplé en parallèle avec un second transistor NMOS 414. Le dispositif électronique comprend un second élément combinatoire 42 fonctionnant comme une porte logique NOR. Le second élément combinatoire 42 comprend un premier transistor PMOS 421 couplé en série avec un deuxième transistor PMOS 422 couplé lui-même en série avec un transistor NMOS 423 couplé à la masse, le transistor NMOS 423 étant couplé en parallèle avec le second transistor NMOS 414 du premier élément combinatoire 41. Cet ensemble de transistors permet un fonctionnement du second élément combinatoire comme une porte logique NOR. Par conséquent, ici l'élément combinatoire 42 n'est pas structurellement identique à l'élément combinatoire 41 mais seulement fonctionnellement identique. Le bloc logique dupliqué Al est couplé à une première entrée du premier élément combinatoire 41, cette première entrée étant couplée à la grille du second transistor PMOS 412 et à la grille du second transistor NMOS 414 de ce premier élément combinatoire 41. Le bloc logique Ao est couplé à une première entrée du second élément combinatoire 42, cette première entrée étant couplée à la grille du second transistor PMOS 422 et à la grille du premier transistor NMOS 423 de ce second élément combinatoire 42. Un signal Enable distinct du premier bloc logique Ao est couplé à une seconde entrée du premier élément combinatoire 41, cette seconde entrée étant couplée à la grille du premier transistor PMOS 411 et à la grille du premier transistor NMOS 413, ainsi qu'à une seconde entrée du second élément combinatoire 42, cette seconde entrée étant couplée à la grille du premier transistor PMOS 421 du second élément combinatoire 42. Ce signal Enable ainsi couplé aux secondes entrées des éléments combinatoires 41 et 42 permet d'activer les éléments combinatoires ou de les bloquer, inhibant alors le fonctionnement du dispositif électronique. Enfin, les sorties des éléments combinatoires sont couplées ensemble formant une sortie S commune. Sur la figure 5 est représentée un quatrième mode de réalisation d'un dispositif électronique selon l'invention. Dans ce quatrième mode de réalisation, le dispositif électronique comprend, comme précédemment sur la figure 4, un bloc logique Ao qu'on cherche à protéger des radiations externes et qu'on a dupliqué en un bloc logique dupliqué Al. I1 comprend également un signal supplémentaire Eno qu'on cherche également à protéger des radiations externes et qu'on a dupliqué en un signal supplémentaire dupliqué En1. Ce signal supplémentaire peut, par exemple, correspondre à un circuit d'activation Enable du dispositif électronique pour lequel une protection a été prévue contre les radiations externes. Le dispositif électronique comprend également deux éléments combinatoires identiques 51 et 52 qui sont chacun constitués d'une porte logique NOR. Ce mode de réalisation permet de protéger deux blocs logiques dont les signaux logiques sont combinés in fine. Le premier élément combinatoire 51 comprend un premier transistor PMOS 511 couplé en série avec un deuxième transistor PMOS 512 couplé en série avec un premier transistor NMOS 513 couplé à la masse, le premier transistor NMOS 513 étant couplé en parallèle avec un second transistor NMOS 514. Le second élément combinatoire 52 est constitué de manière identique un premier et un deuxième transistors PMOS 521 et 522 et un premier et un second transistors NMOS 523 et 524. Le bloc logique dupliqué Al est couplé à une première entrée du premier élément combinatoire 51, cette première entrée étant couplée à la grille du second transistor PMOS 512 et à la grille du second transistor NMOS 514 de ce premier élément combinatoire 51. Le bloc logique Ao est couplé à une première entrée du second élément combinatoire 52, cette première entrée étant couplée à la grille du second transistor PMOS 522 et à la grille du premier transistor NMOS 523 de ce second élément combinatoire 52. Le signal supplémentaire Eno est couplé à une seconde entrée du premier élément combinatoire 51, cette seconde entrée étant couplée à la grille du premier transistor PMOS 511 et à la grille du premier transistor NMOS 513. Le signal supplémentaire dupliqué Enl est couplé à une seconde entrée du second élément combinatoire 52, cette seconde entrée étant couplée à la grille du premier transistor PMOS 521 du second élément combinatoire et à la grille du second transistor NMOS 524 du second élément combinatoire 52. Enfin, les sorties des deux éléments combinatoires 51 et 52 sont couplées ensemble formant une sortie S commune. Sur la figure 6, est illustré un dispositif électronique selon un cinquième mode de réalisation de l'invention. Comme dans le mode de réalisation précédent illustré sur la figure 5, il est prévu un bloc logique Ao et un signal Eno tout deux dupliqués en un bloc logique dupliqué Al et un signal supplémentaire dupliqué Eni. Dans ce cinquième mode de réalisation, les deux éléments combinatoires 61 et 62 sont cette fois-ci des portes logiques NAND (au lieu des portes logiques NOR) comprenant chacune deux entrées et une sortie. Le premier élément combinatoire 61 comprend un premier transistor PMOS 611 couplé en parallèle avec un second transistor PMOS 612, ce montage en parallèle étant couplé en série avec un premier transistor NMOS 613 et un second transistor NMOS 614. De la même manière, le second élément combinatoire 62 comprend deux transistors PMOS 621 et 622 et deux transistors NMOS 623 et 624. Le bloc logique Ao est couplé à une première entrée du premier élément combinatoire 61, cette première entrée étant couplée à la grille du premier transistor PMOS 611 et à la grille du premier transistor NMOS 613 de ce premier élément combinatoire 61. Le bloc logique dupliqué AI est couplé à une première entrée du second élément combinatoire 62, cette première entrée étant couplée à la grille du premier transistor PMOS 621 et à la grille du premier transistor NMOS 623 de ce second élément combinatoire 62. Le signal supplémentaire Eno est couplé à une seconde entrée du premier élément combinatoire 61, cette seconde entrée étant couplée à la grille du premier second PMOS 612 et à la grille du second transistor NMOS 614. Le signal supplémentaire dupliqué En1 est couplé à une seconde entrée du second élément combinatoire 62, cette seconde entrée étant couplée à la grille du second transistor PMOS 622 et à la grille du second transistor NMOS 624 du second élément combinatoire 62. Enfin, les sorties des deux éléments combinatoires 61 et 62 sont couplées ensemble formant une sortie S commune. Dans les différents modes de réalisation, il est parfaitement possible de dupliquer les blocs logiques plus d'une fois afin d'augmenter la protection du bloc logique. Dans ce cas les éléments combinatoires permettant la protection doivent également se trouver en un nombre plus important, ce nombre devant correspondre au nombre de circuits identiques pour un bloc logique donné. REVENDICATIONS1. Procédé de protection d'un circuit électronique (Ao) contre des radiations externes, ledit circuit électronique (Ao) comportant au moins une sortie, caractérisé en ce qu'on effectue au moins une duplication (A1) du circuit électronique (Ao), la duplication étant une duplication au moins fonctionnelle du circuit électronique (Ao), et on relie respectivement les sorties des circuits électroniques (Ao, A1) à des entrées homologues d'éléments combinatoires ou séquentiels (21, 22) au moins fonctionnellement identiques, et on relie ensemble les sorties (S) homologues de tous les éléments combinatoires ou séquentiels (21, 22). 2. Procédé de protection selon la revendication 1, dans lequel on relie respectivement des circuits électroniques supplémentaires à des entrées supplémentaires des éléments combinatoires. 3. Dispositif électronique, caractérisé en ce qu'il comprend N circuits électroniques (Ao) au moins fonctionnellement identiques comportant chacun au moins une sortie et N éléments combinatoires ou séquentiels (21, 22) au moins fonctionnellement identiques possédant au moins une entrée, avec N>1, les sorties des circuits électroniques étant respectivement reliées à des entrées homologues des éléments combinatoires ou séquentiels (Ao), et les sorties (S) homologues des éléments combinatoires ou séquentiels (21, 22) étant respectivement reliées ensemble. 4. Dispositif électronique selon la revendication 3, dans lequel le nombre N est au moins égal au nombre trois. 5. Dispositif de protection selon l'une des revendications 3 ou 4, dans lequel les éléments combinatoires ou séquentiels (21, 22) comprennent des transistors PMOS et NMOS dont les canaux présentent des caractéristiques dimensionnelles sensiblement identiques. 6. Dispositif de protection selon l'une quelconque des revendications 3 à 5, caractérisé en ce qu'il comprend au plus Ncircuits électroniques supplémentaires au moins fonctionnellement identiques, en ce que les éléments combinatoires ou séquentiels comprennent une entrée supplémentaire, et en ce que les sorties des circuits électroniques supplémentaires sont respectivement reliées à des entrées supplémentaires homologues des éléments combinatoires ou séquentiels. 7. Dispositif électronique selon l'une quelconque des revendications 3 à 6, dans lequel les éléments combinatoires comportent des portes logiques CMOS. 8. Dispositif de protection selon l'une quelconque des revendications 3 à 7, dans lequel les éléments comportent des inverseurs CMOS.