Brevet FR2950721A1 — publié le 20110401

PROCEDE D'EXECUTION D'UN ALGORITHME DE PROTECTION D'UN DISPOSITIF ELECTRONIQUE PAR MASQUAGE AFFINE ET DISPOSITIF ASSOCIE La présente invention concerne un procédé d'exécution d'un algorithme de protection de données secrètes dans un dispositif électronique tel qu'une carte à puce ou un composant cryptographique. Les données secrètes à protéger sont, par exemple, des variables intervenant dans des opérations réalisées par un algorithme de chiffrement de données. L'invention a également pour objet un dispositif implémentant un tel procédé de protection de données secrètes. Les opérations exécutées par un dispositif cryptographique engendrent des variations de grandeurs physiques. Ces variations sont différentes en fonction des données traitées, qui peuvent être mesurées par un attaquant, par exemple par le biais d'une mesure de la consommation électrique du dispositif ou de son rayonnement électromagnétique. Un attaquant peut exploiter ces mesures pour obtenir une information sur les données secrètes manipulées au sein du dispositif. Pour se prémunir d'un tel attaquant, le concepteur du dispositif doit adapter les opérations effectuées de sorte que les variations mesurables qu'elles engendrent soient indépendantes des données secrètes. Une technique connue de l'Homme du métier permettant d'attaquer un dispositif afin de dévoiler les données secrètes qu'il contient est l'attaque dite par canaux auxiliaires. Cette attaque consiste à mesurer la consommation du dispositif et à exploiter cette mesure afin d'en déduire l'information qu'il contient. Afin de se prémunir contre de telles attaques, une méthode de protection connue consiste à combiner toutes les variables x sensibles de l'algorithme implémenté par le dispositif avec une donnée aléatoire r. De cette façon, toute variable intermédiaire manipulée par le dispositif peut s'écrire comme une fonction de x et r, mr(x). Une des contraintes de cette solution réside dans le fait de s'assurer que x peut être retrouvé à partir de mr(x) et ce à n'importe quelle étape de l'algorithme considéré. Pour ce faire, toutes les opérations effectuées sur la variable x doivent être adaptées pour prendre en compte la technique de masquage mr. Concernant les algorithmes de chiffrement de données de type chiffrement par blocs, les données sensibles x manipulées par ce type d'algorithme sont masquées en utilisant la fonction suivante mr(x) = x + r, où r est une variable aléatoire et le signe '+' fait référence à l'opération ou exclusif connu sous l'abréviation XOR. Cette technique, connue de l'art antérieur, est simple à mettre en oeuvre car toutes les opérations linéaires ou affines exécutées par l'algorithme à protéger peuvent être adaptées de façon immédiate. De plus cette technique est efficace contre des attaques par canaux auxiliaires du premier ordre, c'est-à-dire qui n'utilisent qu'un seul point de mesure, par exemple de la consommation du dispositif. Un des problèmes principaux de la solution de l'art antérieur par masquage avec une fonction du type mr(x) = x + r est qu'elle résiste mal aux attaques par canaux auxiliaires d'ordres supérieurs, c'est-à-dire utilisant plusieurs points de mesures au lieu d'un point unique. En effet l'information associée à deux points sur les mesures correspondant au traitement des variables xi + r et x2 + r est fortement corrélée à xi + X2 ce qui a pour conséquence une faible résistance aux attaques plus évoluées dites d'ordre k où k est un entier strictement supérieur à 1. Ce problème peut cependant être résolu en étendant la solution initiale à un nombre k d'aléas de façon à utiliser un masquage du type mr(x) = x + ri + r2 + ... + rk où les variables r1, r2, ..., rk sont manipulées séparément. Cette solution, pose toujours le problème d'une attaque exploitant un nombre de points de mesures quelconque, de plus elle engendre un surcout d'implémentation qui est inacceptable en pratique lorsque k est grand. Par ailleurs, il n'existe pas de solution connue pour mettre en oeuvre une telle solution lorsque k est supérieur ou égal à trois. Aucune solution de l'art antérieur ne permet de résister aux attaques connues à tout ordre k supérieur strictement à 1 et ce pour un surcout de complexité acceptable. Afin de remédier aux limitations de l'état de l'art, la présente invention propose une solution consistant à masquer toute variable intermédiaire x manipulée par des opérations réalisées au sein du dispositif dont on souhaite protéger le contenu en utilisant des applications affines du type m(x) = Rx r, où R est une matrice inversible binaire. Les opérations réalisées par le dispositif sont adaptées en exploitant les propriétés mathématiques de l'application affine. Cette solution permet, à moindre cout, de résister aux attaques connues d'ordre strictement supérieur à un car les méthodes connues pour inférer les données secrètes en exploitant l'information associée à au moins deux points de mesures correspondant au traitement de données intermédiaires échouent lorsque ces données sont masquées par une application affine contrairement à la solution de l'art antérieur. L'invention concerne tout dispositif capable de mettre en oeuvre des algorithmes cryptographiques ou des algorithmes comprenant des données secrètes dont on souhaite protéger l'accès contre une personne mal intentionnée. L'invention s'applique en particulier, mais pas exclusivement à un ordinateur, un terminal mobile, une carte à puce. L'invention s'applique également à tout type d'algorithme cryptographique, notamment un algorithme à clé publique ou clé privée, A cet effet, l'invention a pour objet un procédé d'exécution comportant une étape de protection par masquage affine d'un dispositif électronique, ledit dispositif réalisant des opérations sur des variables secrètes x, lesdites variables x étant des vecteurs binaires de taille donnée N non nulle, ledit procédé étant caractérisé en ce que lesdites variables x sont remplacées, à l'aide d'une opération dite de masquage affine, par la fonction affine suivante m(x) R.x + r, où R est une matrice binaire inversible aléatoire à N lignes et N colonnes et r est un vecteur binaire aléatoire de taille N. Dans une variante de réalisation de l'invention, ladite opération de masquage affine d'une variable secrète x est réalisée par l'intermédiaire des étapes suivantes o générer, pour tout vecteur z binaire de taille N, la table T telle que T[z]=Rz+r, o remplacer ladite variable secrète x par T[x]. Dans une variante de réalisation de l'invention, ledit dispositif électronique réalise au moins une opération linéaire sur un ensemble de variables secrètes z1, ...,zm produisant le résultat z=A1z1+A2z2+...+Amzm où les variables AI, A2... Am sont des matrices qui commutent chacune avec la matrice R et son inverse R"', et l'opération de masquage affine dudit résultat z est effectuée à l'aide des étapes suivantes o appliquer la dite opération de masquage affine sur l'ensemble desdites variables z1, ...zm afin de produire l'ensemble des variables masquées z,, , zm , o déterminer à partir dudit vecteur aléatoire r et d'un deuxième vecteur binaire aléatoire r', un troisième vecteur aléatoire r = r +(A, +•••+)r, o déterminer le résultat z de l'opération de masquage affine appliquée au résultat z de la dite opération linéaire à l'aide des étapes de calcul suivantes : z = A, zi + r Pour i variant de 2 à m z + A 2950721 z + r + r Dans une variante de réalisation de l'invention, ledit dispositif électronique réalise au moins une opération linéaire sur un ensemble de 5 variables secrètes zi, ...,zm de taille N produisant le résultat z=A1z1+A2z2+...+Amzm où les variables AI, A2... Am sont des matrices qui ne commutent pas avec la matrice R ni avec son inverse R"', et l'opération de masquage affine dudit résultat z est effectuée à l'aide des étapes suivantes : o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, ~o la table TR, telle que TR[x]=Rx, o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, la table TR', telle que TR-'[x]=R"' x, o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, les tables Ai telles que Ai [ x ] = TR [ AITR _, [xi] , pour i variant 15 de 1 à m, o appliquer la dite opération de masquage affine sur l'ensemble desdites variables z1, ...zm afin de produire l'ensemble des variables masquées Z1,•••,zm , o calculer à partir dudit vecteur aléatoire r et d'un deuxième vecteur n }ù' 20 binaire aléatoire r' le vecteur binaire r -Ç[r]+. ...i..f[!m[r] o déterminer le résultat z de l'opération de masquage affine appliquée au résultat z de la dite opération linéaire à l'aide des étapes de calcul suivantes A, [z,] + r 25 Pour i variant de 2 à m z = z + AI[z.] z = + r + r ' Dans une variante de réalisation de l'invention, ledit dispositif électronique réalise au moins une opération non linéaire S sur au moins une variable secrète y produisant le résultat y'= S(y) et que l'opération de masquage affine dudit résultat y' est effectuée à l'aide des étapes suivantes : o appliquer la dite opération de masquage affine sur la variable secrète y afin de produire le résultat y = R • y + r , o déterminer une opération adaptée S' de l'opération non linéaire S à l'aide de la relation suivante : S' (•) = R • S(R-' • (• + r))+ r , déterminer le résultat y' de l'opération de masquage affine appliquée au résultat y' de ladite opération non linéaire à l'aide de la relation suivante : y ' = S Dans une variante de réalisation de l'invention, ledit dispositif électronique réalise un algorithme cryptographique. L'invention a également pour objet un dispositif électronique réalisant des opérations sur des variables secrètes x caractérisé en ce qu'il met en oeuvre des moyens pour protéger lesdites variables x à l'aide des étapes du procédé de protection par masquage affine décrit ci-dessus. Dans une variante de réalisation de l'invention, ledit dispositif est une carte à microcircuit. D'autres caractéristiques apparaîtront à la lecture de la description 25 détaillée donnée à titre d'exemple et non limitative qui suit faite en regard de dessins annexés qui représentent La figure la, un diagramme schématisant le procédé selon l'invention de masquage affine appliqué à une transformation linéaire, dans le cas où 20 les matrices AI, ..., Am, coefficients de la transformation linéaire, commutent avec les matrices R et R"1, La figure lb, un diagramme schématisant le procédé selon l'invention de masquage affine appliqué à une transformation linéaire, dans le cas où les matrices AI, ..., Am, coefficients de la transformation linéaire, ne commutent pas avec les matrices R et R"', La figure 2, un synoptique d'un premier exemple de dispositif selon l'invention, La figure 3, un synoptique d'un second exemple de dispositif selon ~o l'invention, La figure 4, un schéma d'une carte à microcircuit mettant en oeuvre le procédé selon l'invention. La présente invention consiste, dans le but de résoudre les limitations 15 de l'art antérieur présentées précédemment, à proposer une technique de masquage de données sensibles par l'intermédiaire de fonctions affines. Le procédé selon l'invention concerne notamment l'exécution d'un algorithme de masquage de données dans le but de protéger des données sensibles. La fonction de masquage utilisée dans ce cas pour protéger une variable x est: 20 m(x)=R.x r,(1) x est une variable sensible, par exemple manipulée par un algorithme de chiffrement implémenté par un dispositif cryptographique, cette variable est représentée par un vecteur binaire à N composantes, N > O. R est une matrice aléatoire, binaire c'est-à-dire qu'elle ne contient que des 0 25 ou des 1, et inversible de taille NxN, r est un vecteur aléatoire également binaire de taille N, e est l'opération « ou exclusif » Le procédé selon l'invention consiste, notamment, à remplacer une variable x par m(x) afin de la rendre moins vulnérable à une attaque. Cette opération 30 est appelée opération de masquage, et dans le cadre de l'invention, il s'agit de masquage affine. La mise en oeuvre de ce procédé peut se faire, notamment mais non limitativement, de deux façons différentes. Dans un premier mode de réalisation, la fonction de masquage affine m(x) est réalisée par l'intermédiaire d'une table de correspondance T[x] dans laquelle est stocké l'ensemble des valeurs de m(x) = R.x C-0 r pour toutes les valeurs de la variable x possibles. Pour un vecteur x comprenant N bits, il y a donc 2" valeurs possibles. La génération de la table de correspondance T[x] comprend donc les étapes suivantes : - un tirage aléatoire du vecteur binaire r de taille N, un tirage aléatoire d'une matrice binaire inversible R de taille NxN, - le calcul de m(x) = R.x @ r pour toutes les valeurs possibles de x. La mise en oeuvre du masquage affine selon l'invention consiste ensuite, pour une variable sensible x donnée manipulée par le dispositif à protéger, à extraire la valeur m(x) correspondante dans la table T[x]. Dans un second mode de réalisation, la fonction de masquage affine m(x) peut être générée directement lorsqu'on souhaite protéger la variable sensible x. A cet effet, la matrice binaire inversible R et le vecteur binaire r sont générés aléatoirement pour chaque variable x à l'instant où cette variable est utilisée dans l'algorithme de chiffrement. La variable x manipulée par l'algorithme implémenté peut être l'objet d'opérations linéaires ou non linéaires. Le procédé selon l'invention consiste également à adapter ces opérations afin de masquer leur résultat sans engendrer de calculs trop complexes. La figure la schématise les étapes mises en oeuvre lors du masquage d'une combinaison linéaire de variables masquées dans le cas où les matrices AI, ..., Am commutent avec les matrices R et R"I. En considérant le cas général de l'opération linéaire définie par la relation suivante z=+A2z2+•••+z,, (2) où z~,...zm sont des variables sensibles de taille N et z1,•••,zm representent leurs versions masquées à l'aide du procédé de masquage affine selon l'invention qui s'écrivent à l'aide de la relation z; = R.z; + r . Les matrices Al,..., Am sont des matrices binaires inversibles à N lignes et N colonnes. Dans le cas particulier où les variables AI, ..., Am, z1, zm peuvent être vues comme des éléments du corps de Galois fini GF(2") de cardinal égal à 2". La variable R est obtenue en tirant aléatoirement un élément matriciel inversible de GF(2"). La variable r est obtenue en tirant aléatoirement un élément vectoriel de GF(2"). La table T est générée en tabulant les valeurs de l'application x ù* m(x) = Rx+r pour tous les vecteurs x appartenant à GF(2"). Dans ce cas les matrices AI, ..., Am commutent avec les matrices R et R-1. On rappelle que la matrice A; commute avec la matrice R si A;R=RA;. La variable z peut alors être masquée en exécutant les étapes de calcul suivantes. Dans une première étape 111, un aléa r' est généré par tirage aléatoire d'un vecteur dans le corps fini GF(2") et la variable r" est calculée à partir de r' et de l'aléa r utilisé pour masquer les variables sensibles zi,...zm selon la relation suivante Y' =Y' +(A1 +...+Am)r (3) Dans une deuxième étape 112, le résultat du masquage Z est initialisé : r (4)25 Dans une troisième étape 113 itérative la variable masquée Z est mise à jour en effectuant le calcul suivant pour i variant de 2 à m : = z + A z l (5) Dans une dernière étape 114, la variable z résultat du masquage affine de la combinaison linéaire de m autres variables est délivré : z = z + r + r (6) ~o La figure 1 b schématise les étapes mises en oeuvre lors du masquage d'une combinaison linéaire de variables masquées dans le cas où les matrices AI, ..., Am ne commutent pas avec les matrices R et R-1. Lorsque les matrices A1,..,Am ne commutent pas avec les matrices R et R'1, 15 il faut générer en même temps que la table T les tables TR et TR_1 des applications respectivement x --4 Rx et x ù* R-'x. La génération des tables TR et TR_1 est réalisée pour un coût marginal en temps d'exécution en parallèle de la génération de la table T. Dans ce cas la variable z peut être masquée en exécutant les étapes de 20 calcul suivantes. Dans une étape initiale 120 réalisée une seule fois au démarrage du procédé, les tables A1,•••, Am sont calculées à partir de TR et TR..1 selon la relation vérifiant : Ai[x] = TR [AiTR_, [xi] (7) 25 pour tout 1 i ≤ m. Dans une première étape 121, un aléa r' est généré à partir du corps fini GF(2") et la variable r" est calculée à partir de r', des tables A1,•.., Am , et5 de l'aléa r utilisé pour masquer les variables sensibles z1,...zm selon la relation suivante : r =(AA[r]+..+ [r])+r' (8) Dans une deuxième étape 122, le résultat du masquage Z est initialisé selon la relation suivante: Dans une troisième étape 123 itérative la variable masquée Z est mise à jour en effectuant le calcul suivant pour i variant de 2 à m z = z + A~[zi] (10) ~o Dans une dernière étape 124, la variable z résultat 104 du masquage affine de la combinaison linéaire de m autres variables est délivré z = z + r + r'(11) Ainsi, le procédé selon l'invention permet une exécution optimisée du 15 masquage affine d'opérations linéaires. Le masquage affine du résultat de transformations non linéaires, qui peuvent également être implémentées par un algorithme de chiffrement, sont traitées par le procédé de masquage selon l'invention de la façon suivante. 20 Si S est une opération non linéaire qui relie la variable y à la variable y' selon la relation suivante y'= S(y) (12) y étant une variable sensible et y sa version masquée à l'aide du procédé de masquage affine selon l'invention qui s'écrit à l'aide de la relation 25 y=R.y+r. On cherche alors à calculer la version masquée y' de y'. Dans une première étape, une version adaptée S' de l'opération linéaire S est calculée, définie par la relation suivante : S'(•)=R•S(R-' .(•+r))+r (13) Dans une deuxième étape, le résultat de l'opération ÿ est délivré en 5 appliquant l'opération S' à la variable masquée y : S'(Y)(14) La génération de la matrice aléatoire inversible R utilisée par le procédé de masquage affine selon l'invention doit être efficace d'un point de 10 vue de la complexité des calculs mis en oeuvre afin de ne pas engendrer de surcout important pour l'implémentation. De plus la matrice R doit répondre à un critère de sécurité, le nombre de matrices R générées aléatoirement doit être suffisamment important afin d'empêcher toute attaque ayant pour but de retrouver le schéma de masquage. 15 La figure 2 schématise un exemple de dispositif 201 selon l'invention protégé par une ou plusieurs opérations de masquage affine selon l'invention. Ce dispositif réalise, par exemple, un algorithme de chiffrement. Un message 210 est reçu en entrée du dispositif 201. Ce message subit une 20 première opération de masquage affine 211 afin de le rendre ininterprétable. Le message 210 masqué selon l'invention subit ensuite une série d'opérations linéaires 212 et d'opérations non linéaires 213 qui sont propres aux traitements nativement implémentés sur ledit dispositif 201 mais qui sont adaptées selon l'invention afin de délivrer à leur sortie un message masqué 25 compatible du procédé selon l'invention. En parallèle, une clé 216, par exemple une clé de chiffrement, est reçue par le dispositif 201 et subit également une opération 217 de masquage affine selon l'invention. Les variables internes manipulées par le dispositif 201 sont ainsi protégées d'une éventuelle attaque par canaux auxiliaires. Le message 210 masqué puis manipulé par les opérations linéaires et non linéaires exécutées sur le dispositif 201 est ensuite démasqué 214 par une opération inverse de celle consistant à remplacer une variable sensible par sa version masquée, puis le message chiffré 215 est délivré en sortie. La figure 3 représente, schématiquement, un dispositif de traitement de données 340 dans lequel la présente invention est mise en oeuvre. Ce dispositif 340 comprend un microprocesseur 310, auquel est associée d'une part une mémoire vive 360, par exemple au moyen d'un bus 370, et d'autre ~o part une mémoire non volatile 320 (par exemple du type EEPROM), par exemple à travers un bus 50. Le dispositif de traitement de données 340, et précisément le microprocesseur 310 qu'il incorpore, peuvent échanger des données avec des dispositifs extérieurs au moyen d'une interface de communication 330. 15 On a schématiquement représenté sur la figure 3 la transmission d'une donnée d'entrée X reçue d'un dispositif extérieur (non représenté) et transmise de l'interface de communication 330 au microprocesseur 310. De manière similaire, on a représenté la transmission d'une donnée de sortie S du microprocesseur 310 vers l'interface de communication 330 à destination 20 d'un dispositif extérieur. Cette donnée de sortie Y est issue d'un traitement de données par le microprocesseur 310, généralement sur la donnée d'entrée X à l'aide d'une donnée secrète 380 interne au système, par exemple une clé privée. Bien que, pour l'illustration, les données d'entrée et les données de 25 sortie figurent sur deux flèches différentes, les moyens physiques qui permettent la communication entre le microprocesseur 310 et l'interface 330 pourront être réalisés par des moyens uniques, par exemple un port de communication série ou un bus. Le microprocesseur 310 est apte à exécuter un logiciel (ou 30 programme d'ordinateur) qui permet au dispositif de traitement de données 340 d'exécuter un procédé conforme à l'invention dont des exemples sont donnés en regard des figures la et 1 b. Le logiciel est composé d'une série d'instructions de commande du microprocesseur 310 qui sont par exemple stockées dans la mémoire 320. En variante, l'ensemble microprocesseur 310 - mémoire non-volatile 320 - mémoire vive 360 peut être remplacé par un circuit à application spécifique qui comprend alors des moyens de mise en oeuvre des différentes étapes du procédé de traitement de données. La figure 4 représente une carte à microcircuit qui constitue un ~o exemple de dispositif de traitement de données conforme à l'invention tel que représenté à la figure 3. L'interface de communication 330 est dans ce cas réalisée au moyen des contacts de la carte à microcircuit. La carte à microcircuit incorpore un microprocesseur 310, une mémoire vive 360 et une mémoire non volatile 320 comme cela est représenté sur la figure 3. 15 Cette carte à microcircuit est par exemple conforme à la norme ISO 7816 et munie d'un microcontrôleur sécurisé qui regroupe le microprocesseur (ou CPU) 320 et la mémoire vive 360. En variante, le dispositif de traitement de données peut être une clef USB, un document ou un support d'informations papier comportant dans 20 l'une de ses feuilles un microcircuit associé à des moyens de communication sans contact. II s'agit de manière préférée d'une entité électronique portable ou de poche. Le procédé selon l'invention a notamment pour avantage d'être peu 25 complexe à mettre en oeuvre tout en restant compatible des opérations linéaires et non linéaires effectuées sur les variables sensibles protégées selon l'invention. L'invention a également pour avantage d'offrir des résultats significativement meilleurs que les solutions connues de l'état de l'art pour 30 des attaques connues par canaux auxiliaires d'ordre supérieur à 2. En effet, la solution de l'art antérieur consistant à utiliser un masquage à base d'opérations « XOR » ne résiste pas à des attaques par canaux auxiliaires du second ordre. Cela est du au fait que pour toute variable sensible x, un attaquant peut trouver deux variables intermédiaires vl et v2 telles que x= vl v2 et la consommation C(x) associée à la variable x peut être prédite à partir de IC(vi) - C(v2)I. Par contre, une telle prédiction n'est plus possible si les variables vl et v2 sont masquées à l'aide d'un procédé de masquage affine selon l'invention. En effet, la corrélation de C(x) avec IC(vi) - C(v2)I décroit rapidement avec la taille n du vecteur x comme cela est illustré à la table 1.2. Le même type de conclusion peut être obtenu lorsqu'on cherche à prédire C(x) à partir de C(v1) x C(v2) tel que cela est indiqué dans la table 1.2. Soit xi et x2 deux variables aléatoires uniformément distribuées dans l'espace {0,1}'. La table 1.1 compare les corrélations entre x= xi ^$, X2 et les variables xi et x2 masquées par une méthode de masquage de type « XOR ». Les métriques utilisées pour effectuer une analyse des performances de cette méthode sont les suivantes : Cor (I HW ()fi (+) r) û HW (x2 C) r)lfl HW (x)) (10) et Cor (1HW (xl r).HW (x2 e r)lfl; HW (x)) (11) HW(x) représente le poids de Hamming du vecteur x. n Co e/i(x, er)ùHT/f(x2 er fi; HW(x)) Cot(IHW(x1 HTT(x)) r).HW(x2 er)fl, [3=1 (3=2 (3=3 [3=1 (3=2 13=3 1 1 1 1 -0,578007 -0,579426 -0,579963 2 0,532322 0,579113 0,568336 -0,315755 -0,366913 -0,368015 3 0,411518 0,452034 0,438087 -0,217523 -0,284781 -0,293768 4 0,351401 0,381051 0,368472 -0,169834 -0,233549 -0,249807 0,304950 0,333761 0,324023 -0,137339 -0,198963 -0,217753 6 0,279849 0,302910 0,291607 -0,117385 -0,173757 -0,197643 7 0,258828 0,276712 0,268064 -0,101258 -0,151014 -0,179686 $ 0,236417 0,261128 0,249791 -0,087109 -0,136167 -0,164959 Table 1.1 5 La table 2.1 présente les mêmes résultats mais cette fois appliqués au procédé de masquage affine selon l'invention, les métriques utilisées sont les suivantes : CoîHW(Rxl Or) -HW(Rx2 C-Dr)lfl; HW(x)) (12) et Cor(' HW(Rx, O r).HW(Rx2 r)I ; HW(x)) (13) n Co ~ H Or -H Gr ~ Co ~ HW ©r HW C+. r HI~(x)) W~ ) ~~ ; HW(x)) (~ ) .(moi )I~ R=1 R=2 R=3 R=1 R=2 R=3 1 1 1 1 -0,574882 -0,573609 -0,579249 2 0,535827 0,386256 0,285722 -0,209768 -0,270511 -0,316286 3 0,298929 0,191070 0,136149 -0,090795 -0,137604 -0,164889 4 0,162631 0,103208 0,070132 -0,043678 -0,067954 -0,080933 5 0,091369 0,051445 0,034176 -0,021675 -0,035601 -0,040952 6 0,053028 0,030678 0,025059 -0,009192 -0,017957 -0,019982 7 0,030603 0,014429 0,010588 -0,006485 -0,006548 -0,011328 8 0,011109 0,006532 0,004693 -0,002205 -0,002554 -0,006627 Table 2.2 Les tables 1.1 et 1.2 montrent que les métriques considérées décroissent fortement lorsque n augmente dans le cas du procédé de masquage affine selon l'invention. Les métriques définies à l'aide des relations 10,11,12 et 13 utilisent le poids de Hamming d'une variable x car il est connu d'approximer la consommation électrique liée à la variable x avec le poids de Hamming de cette même variable x. Ces résultats indiquent que l'information associée à deux (ou d'avantage) points sur les mesures correspondant au traitement de données intermédiaires de la forme Rx1+r et Rx2+r est beaucoup plus faiblement ~o corrélée à x1+x2 que dans la solution de l'art antérieur présentée. L'invention permet donc de résister à des attaques connues d'ordre strictement supérieur à 1. REVENDICATIONS1. Procédé d'exécution comportant une étape de protection par masquage affine d'un dispositif électronique, ledit dispositif réalisant des opérations sur des variables secrètes x, lesdites variables x étant des vecteurs binaires de taille donnée N non nulle, ledit procédé étant caractérisé en ce que lesdites variables x sont remplacées, à l'aide d'une opération dite de masquage affine, par la fonction affine suivante : m(x) = R.x + r, où R est une matrice binaire inversible aléatoire à N lignes et N colonnes et r est un vecteur binaire aléatoire de taille N. 2. Procédé selon la revendication 1 caractérisé en ce que ladite opération de masquage affine d'une variable secrète x est réalisée par l'intermédiaire des étapes suivantes : o générer, pour tout vecteur z binaire de taille N, la table T telle que T[z]=Rz+r, o remplacer ladite variable secrète x par T[x]. variables masquées z,,•••,z,,, 2950721 3. Procédé selon l'une des revendications 1 ou 2 caractérisé en ce que ledit dispositif électronique réalise au moins une opération linéaire sur un ensemble de variables secrètes z1, ...,zm produisant le résultat z=Ajzi+A2z2+...+Amzm où les variables AI, A2... Am sont des matrices qui commutent chacune avec la matrice R et son inverse R-1, et que l'opération de masquage affine dudit résultat z est effectuée à l'aide des étapes suivantes o appliquer la dite opération de masquage affine sur l'ensemble desdites variables z1, ...zm afin de produire l'ensemble des o déterminer à partir dudit vecteur aléatoire r et d'un deuxième vecteur binaire aléatoire r', un troisième vecteur aléatoire r" = r' +(A, +..+Am)r, o déterminer le résultat z de l'opération de masquage affine appliquée au résultat z de la dite opération linéaire à l'aide des étapes de calcul suivantes : A,z, + r Pour i variant de 2 à m z + Az, z = z + r + r 4. Procédé selon l'une des revendications 1 ou 2 caractérisé en ce que ledit dispositif électronique réalise au moins une opération linéaire sur un ensemble de variables secrètes zi, ...,zm de taille N produisant le résultat z=A1z1+A2z2+...+Amzm où les variables AI, A2... Am sont des matrices qui ne commutent pas avec la matrice R ni avec son inverse R"', et que l'opération de masquage affine dudit résultat z est effectuée à l'aide des étapes suivantes : o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, 20 la table TR, telle que TR[x]=R.x, o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, la table TR-1, telle que TR-1[x]=R"' x, o déterminer, pour l'ensemble desdits vecteurs binaires x de taille N, les tables Ai telles que Ai [xi = TR [ AiTR _1 [ x ]] , pour i variant 25 de1àm, o appliquer la dite opération de masquage affine sur l'ensemble desdites variables zi, ...zm afin de produire l'ensemble des variables masquées o calculer à partir dudit vecteur aléatoire r et d'un deuxième vecteur binaire aléatoire r' le vecteur binaire rä =(.4[r]+• +Am[Y']»Y'', o déterminer le résultat z de l'opération de masquage affine appliquée au résultat z de la dite opération linéaire à l'aide des 5 étapes de calcul suivantes : Al [z1] + r'' Pour i variant de 2 à m z = z + A z = z + r + r 5. Procédé selon l'une des revendications 1 ou 2 caractérisé en ce que ledit dispositif électronique réalise au moins une opération non linéaire S sur au moins une variable secrète y produisant le résultat y'= S(y) et que l'opération de masquage affine dudit résultat y' est effectuée à 15 l'aide des étapes suivantes : o appliquer la dite opération de masquage affine sur la variable secrète y afin de produire le résultat y = R. y + r , o déterminer une opération adaptée S' de l'opération non linéaire S à l'aide de la relation suivante : S' (•) = R S(R-` • (• + r)}+ r , 20 o déterminer le résultat y' de l'opération de masquage affine appliquée au résultat y' de ladite opération non linéaire à l'aide de la relation suivante : y ' = S «y 6. Procédé selon l'une des revendications 1 à 5 caractérisé en ce que 25 ledit dispositif électronique réalise un algorithme cryptographique. 105 7. Dispositif électronique réalisant des opérations sur des variables secrètes x caractérisé en ce qu'il met en oeuvre des moyens pour protéger lesdites variables x à l'aide des étapes du procédé de protection par masquage affine selon l'une des revendications 1 à 6. 8. Dispositif électronique selon la revendication 7 caractérisé en ce que ledit dispositif est une carte à microcircuit.