Brevet FR2954552A1 — publié le 20110624

,13L,...j R - CAS ALONGA & JOSSE Paris - Munich - Alicante - GrenobleCONSEILS EN PROPRIÉTÉ INDUSTRIELLE EUROPEAN PATENT AND TRADEMARK ATTORNEYS 8, avenue Percier ù F 75008 PARIS Tél. : 33 (0)1 45 61 94 64 Fax : 33 (0)1 45 63 94 21 e-mail : paris@casalonga.com DEMANDE DE BREVET B09-4015FR ù FZ/EVH 09-RO-287 Société par Actions Simplifiée dite : STMICROELECTRONICS (ROUSSET) SAS Procédé d'identification d'un circuit intégré et circuit intégré correspondant Invention de : Pascal FORNARA Mathieu LISART Procédé d'identification d'un circuit intégré et circuit intégré correspondant L'invention concerne les circuits intégrés, et plus particulièrement leur identification, en particulier mais non limitativement pour permettre leur traçabilité. Selon un mode de mise en oeuvre et de réalisation, il est proposé un procédé d'identification d'un circuit intégré permettant une identification aisée, non invasive, c'est-à-dire ne détruisant pas le circuit intégré, et permettant de retrouver un code d'identification logé de façon confidentielle dans le circuit intégré. Selon un mode de mise en oeuvre et de réalisation, le code d'identification est basé sur des lignes métalliques classiques, par exemple réalisées dans la partie d'interconnexion du circuit intégré, et l'identification comporte la détection de traces électromagnétiques provoquées par des variations de courants circulant le long de ces lignes métalliques ou par des variations de tensions générées sur ces lignes métalliques, les caractéristiques de ces variations de courants ou de tensions étant déterminées par des données stockées de façon secrète ou à tout le moins de façon difficilement détectable, lors de la personnalisation électrique du circuit intégré, dans un moyen de stockage, par exemple un moyen de stockage du type non volatil et électriquement programmable et effaçable (par exemple des points-mémoires EEPROM). Selon un aspect, il est ainsi proposé un procédé d'identification d'un circuit intégré comprenant une production d'un champ électromagnétique par un réseau électriquement conducteur réalisé au sein du circuit intégré et parcouru par des courants électriques transitoires ou soumis à des tensions transitoires (ou variations de tensions) dont les caractéristiques dépendent de la valeur d'un mot numérique, formant un code d'identification du circuit intégré, et stocké de façon secrète dans une mémoire non volatile, et une analyse du champ électromagnétique produit de façon à retrouver ou non ledit code d'identification. Le stockage de façon secrète ou à tout le moins difficilement détectable dans une mémoire non volatile peut être obtenu par exemple par un stockage dans une mémoire morte protégée ou bien une mémoire du type EEPROM ou bien une mémoire du type FLASH. Selon une variante, le réseau électriquement conducteur comporte au moins une paire de moyens électriquement conducteurs, par exemple au moins une paire de lignes métalliques, associée à un bit du mot numérique ; les caractéristiques des courants transitoires comportent le sens de circulation du courant transitoire dans un moyen électriquement conducteur ; on fait alors circuler dans les deux moyens électriquement conducteurs de ladite paire deux courants transitoires de même sens ou de sens opposé en fonction de la valeur du bit, et on analyse le champ magnétique produit au dessus de chacun des moyens électriquement conducteurs et entre les deux moyens électriquement conducteurs. Cette analyse permet de déterminer si la valeur logique du bit est égale à 1 ou à O. En général, le réseau électriquement conducteur comporte plusieurs paires de moyens électriquement conducteurs mutuellement espacées d'une distance supérieure à la surface d'analyse d'un moyen d'analyse de champ magnétique par exemple une sonde équipée d'une boucle formant antenne accordée avec l'antenne formée par les paires de moyens électriquement conducteurs. En pratique, cette distance est bien supérieure au diamètre de la boucle de la sonde magnétique. Chaque paire est associée à un bit du mot numérique et on fait circuler dans les deux moyens électriquement conducteurs de chaque paire deux courants transitoires de sens opposés ou de même sens en fonction de la valeur du bit associé à ladite paire, et on analyse le champ magnétique produit au dessus de chacun des moyens électriquement conducteurs et entre les deux moyens électriquement conducteurs de chaque paire, avec ledit moyen d'analyse. Selon une autre variante, le réseau électriquement conducteur comporte au moins un moyen électriquement conducteur, par exemple une ligne métallique, associé à un bit du mot numérique, les caractéristiques des tensions transitoires comportant une génération ou une absence de génération d'une tension transitoire ou variation de tension dans un moyen électriquement conducteur ; on génère alors ou non dans le moyen électriquement conducteur une variation de tension en fonction de la valeur du bit, et on détecte la présence éventuelle d'un champ électrique produit au dessus du moyen électriquement conducteur. Cette présence du champ électrique peut être détectée par couplage capacitif entre la ligne métallique et la sonde d'analyse. Là encore, selon un mode de mise en oeuvre de cette variante, le réseau électriquement conducteur comporte généralement plusieurs moyens électriquement conducteurs mutuellement espacés d'une distance supérieure à la surface d'analyse d'un moyen d'analyse du champ électrique, chaque moyen électriquement conducteur étant associé à un bit du mot numérique, et on génère ou non dans chaque moyen électriquement conducteur une variation de tension en fonction de la valeur du bit qui lui est associé et on détecte la présence éventuelle d'un champ électrique produit au dessus de chaque moyen électriquement conducteur. La mémoire non volatile peut être une mémoire morte du type électriquement programmable et effaçable. Selon un autre aspect, il est proposé un circuit intégré, comprenant un moyen de stockage non volatil configuré pour stocker de façon secrète un mot numérique dont la valeur forme un code d'identification du circuit intégré, des moyens de contrôle configurés pour recevoir le mot numérique et pour générer des courants électriques transitoires ou des tensions transitoires dont les caractéristiques dépendent de la valeur du mot numérique, et un réseau électriquement conducteur configuré pour être parcouru par lesdits courants électriques transitoires ou recevoir lesdites tensions transitoires de façon à générer un champ électromagnétique. Selon un mode de réalisation, le réseau électriquement conducteur comporte au moins une paire de moyens électriquement conducteurs associée à un bit du mot numérique, les moyens de contrôle étant configurés pour définir le sens de circulation du courant transitoire dans un moyen électriquement conducteur en fonction de la valeur dudit bit. Selon un mode de réalisation, le réseau électriquement conducteur comporte plusieurs paires de moyens électriquement conducteurs mutuellement espacées d'une distance supérieure à la surface d'analyse d'un moyen d'analyse de champ magnétique, chaque paire étant associée à un bit du mot numérique, les moyens de contrôle étant configurés pour faire circuler dans les deux moyens électriquement conducteurs de chaque paire deux courants transitoires de même sens ou de sens opposé en fonction de la valeur du bit associé à ladite paire. Selon un mode de réalisation, les deux moyens électriquement conducteurs de chaque paire comporte respectivement deux lignes électriquement conductrices parallèles. En variante, le réseau électriquement conducteur comporte au moins un moyen électriquement conducteur associé à un bit du mot numérique, les moyens de contrôle étant configurés pour générer ou non une tension transitoire ou variation de tension dans un moyen électriquement conducteur en fonction de la valeur du bit. Selon un mode de réalisation, le réseau électriquement conducteur comporte plusieurs moyens électriquement conducteurs mutuellement espacés d'une distance supérieure à la surface d'analyse d'un moyen d'analyse de champ électrique, chaque moyen électriquement conducteur étant associé à un bit du mot numérique, les moyens de contrôle étant configurés pour générer ou non dans chaque moyen électriquement conducteur une variation de tension en fonction de la valeur du bit qui lui est associé. Selon un mode de réalisation, chaque moyen électriquement conducteur est une ligne électriquement conductrice. Selon un mode de réalisation, le moyen de stockage non volatil comprend une mémoire du type adressable par le contenu comportant par bit stocké deux points-mémoires du type EEPROM connectés par deux inverseurs montés tête-bêche. Selon un mode de réalisation, les moyens de contrôle comportent au moins un multiplexeur dont la sortie est connectée à au moins une extrémité d'au moins un moyen électriquement conducteur, commandé par la valeur du bit associé à ce moyen électriquement conducteur, et possédant une première entrée destinée à recevoir un signal de tension comportant au moins un créneau de tension. D'autres avantages et caractéristiques de l'invention apparaîtront à l'examen de la description détaillée de modes de mise en oeuvre et de réalisation, nullement limitatifs, et des dessins annexés, sur lesquels : - la figure 1 illustre de façon schématique un mode de réalisation d'un circuit intégré selon l'invention, - la figure 2 illustre plus en détail une partie du circuit intégré de la figure 2, - les figures 3 à 5 illustrent une première variante de l'invention, - les figures 6 à 8 illustrent schématiquement des modes de réalisation d'un moyen de stockage non volatil et de moyens de contrôle d'un circuit intégré selon l'invention, - la figure 9 illustre schématiquement un mode de réalisation d'un banc de mesure selon l'invention, et - les figures 10 et 11 illustrent schématiquement une autre variante de l'invention. Sur la figure 1, la référence CI désigne un circuit intégré comportant par exemple des blocs logiques LG1, LG2 étant bien entendu que la fonctionnalité de ces blocs n'est pas limitative, ceux-ci pouvant être également remplacés par des blocs de microcontrôleurs par exemple. Outre ces éléments classiques de circuit intégré, le circuit intégré CI comporte un moyen de mémoire non volatile NVM qui peut être par exemple une mémoire morte protégée ou bien une mémoire du type Flash ou encore une mémoire du type non volatile électriquement programmable et effaçable et bien connue de l'homme du métier sous la dénomination anglosaxonne de « mémoire EEPROM ». Ce moyen de mémoire non volatile NVM est destiné à contenir de façon secrète ou à tout le moins difficilement détectable un mot numérique dont les valeurs de bits définissent un code d'identification du circuit intégré. Ce code d'identification est par exemple stocké dans la mémoire NVM lors de la personnalisation électrique du circuit intégré. Le circuit intégré comporte également un réseau électriquement conducteur REC comportant, dans cet exemple, des paires de moyens électriquement conducteurs tels que des lignes métalliques. Des moyens de contrôle MCTL, dont on verra plus en détail la structure ci-après, sont destinés à générer des courants électriques transitoires (ou variations de courants) dans le réseau électriquement conducteur REC dont les caractéristiques dépendent de la valeur du mot numérique, et donc du code d'identification, stocké dans le moyen de mémoire NVM. Comme on le verra plus en détail ci-après, les courants électriques transitoires sont produits notamment à partir de signaux de tension en créneaux fournis sur des bornes d'entrée IPD, telles que des bornes d'entrée de test, connectées au réseau électriquement conducteur REC. Ces courants électriques transitoires vont générer un champ électromagnétique dont les caractéristiques sont reliées aux caractéristiques des courants transitoires et par conséquent au code d'identification. L'analyse de ce champ électromagnétique va permettre l'identification ou la non identification du circuit intégré CI. Comme illustré sur la figure 2, le réseau électriquement conducteur REC peut être réalisé au dessus du substrat SB dans la partie d'interconnexion PINT du circuit intégré, communément désigné par l'homme du métier sous la dénomination anglosaxonne de « BEOL » (Back-End-Of-Lines), par exemple sur un niveau de métallisation Mn relativement élevé du circuit intégré. Dans l'exemple décrit ici, les moyens électriquement conducteurs composant le réseau REC sont formés de lignes métalliques parallèles, par exemple en cuivre, LM, à réaliser de façon classique et connue en soi. Ces lignes ou pistes métalliques sont classiquement mutuellement séparées par un diélectrique et sont également électriquement isolées des niveaux de métallisation adjacents par un diélectrique. Bien que ce réseau électriquement conducteur REC puisse être disposé à n'importe quel endroit du circuit intégré, il est préférable de le disposer dans un endroit qui ne se situe pas à la verticale des blocs logiques, de façon à éviter notamment toute interférence potentielle. Une première variante de l'invention prévoit d'utiliser (figure 3 notamment) une sonde magnétique SDH comportant une boucle dont le diamètre ou surface d'analyse, est supérieur à l'espacement dl entre les deux lignes métalliques LMG1 et LMD1 d'une paire, pour détecter et déterminer l'intensité du champ magnétique créé par la circulation des courants transitoires dans les deux lignes métalliques. Typiquement, l'espacement dl est par exemple de l'ordre de 10 microns tandis que le diamètre de la boucle de la sonde magnétique SDH est de l'ordre de 50 microns. La configuration illustrée sur la figure 3 est celle dans laquelle, en réponse à des signaux de tension impulsionnels, les courants transitoires circulent en sens inverse dans les deux lignes LMG1 et LMD1. La circulation de ces courants transitoires crée un champ électromagnétique dont on a représenté sur la partie droite de la figure 3 les lignes de champ de la composante magnétique de ce champ. Puisque les deux courants transitoires circulent en sens inverses, on voit que l'intensité du champ magnétique présente un pic PCU entre les deux lignes métalliques. Ce pic PCU est supérieur à un seuil S prédéterminé. Le fait que l'intensité du champ magnétique dépasse le seuil S est alors représentatif par exemple de la valeur logique 1 du bit du code d'identification associé à cette paire de lignes métalliques. Le champ magnétique créé par la paire de lignes formant antenne dépend de l'intensité du courant transitoire circulant dans cette antenne et décroît avec la distance par rapport à l'antenne. Par ailleurs, la boucle de la sonde SDH forme également une antenne qui, en fonction de sa dimension va être accordée sur l'antenne formée par les deux lignes métalliques à une certaine fréquence. En général, cette fréquence pourra être par exemple comprise entre 10 kHz et 135 kHz conduisant à une détection du type « champ proche » (near field) par couplage inductif avec une portée de l'ordre de quelques dizaines de centimètres. A titre indicatif, le courant circulant dans les lignes métalliques peut être de l'ordre du milliampère. Bien qu'en général il soit suffisant de prévoir pour chaque moyen électriquement conducteur de la paire, une seule ligne métallique, il peut être particulièrement avantageux, de façon en particulier à augmenter l'intensité du champ magnétique, de prévoir que chaque moyen électriquement conducteur de ladite paire comporte non pas une ligne métallique mais plusieurs lignes métalliques de préférence parallèles LMGl-LMG10 ou LMDl-LMD10. Dans ce cas, toutes les lignes métalliques LMGl-LMG10 du même moyen électriquement conducteur sont parcourues par un courant transitoire de même sens. Sur la figure 4, on a illustré la configuration dans laquelle les deux lignes métalliques LMG1 et LMD1 de la paire de lignes métalliques sont parcourues par un courant transitoire de même sens. Dans ce cas, comme illustré sur la partie droite de la figure 4, l'intensité du champ magnétique présente deux pics PC1 et PC2 au- delà du seuil S. Ces deux pics PC1 et PC2 sont séparés par un creux CRX se situant en deçà du seuil S et situé approximativement entre les deux lignes métalliques LMG1 et LMD1. La détection d'un creux entre deux pics permet ainsi de repérer une telle configuration qui est par exemple représentative de la valeur logique « 0 » du bit associé à ladite paire de lignes métalliques. La figure 5 illustre le cas où le réseau électriquement conducteur comporte plusieurs paires de lignes métalliques Pl-P5. Dans cet exemple, le code d'identification CDI stocké dans le moyen de mémoire non volatil NVM comporte cinq bits dont les valeurs sont illustrées sur la figure 5. Ces valeurs déterminent donc les sens des courants dans les différentes lignes métalliques. Par ailleurs, deux paires de lignes adjacentes Pi et Pi+1 sont espacées d'une distance supérieure à la surface d'analyse de la sonde magnétique, cet espacement d2 étant par exemple de l'ordre de la centaine de microns. Pour procéder à l'identification du circuit intégré, on alimente le réseau REC avec des signaux de test, typiquement des transitions de tension, et on déplace la sonde magnétique au dessus du réseau électriquement conducteur REC et on analyse le champ magnétique. Et, si l'on retrouve des caractéristiques du champ magnétique (pics et creux) correspondant à la valeur du mot numérique 1 0 1 1 0 stocké en mémoire, le circuit intégré sera considéré comme ayant été identifié. La figure 6 illustre un exemple de réalisation d'un moyen de mémoire non volatile NVM du type adressable par le contenu « Content Adressable Memory » (« CAM » selon un acronyme anglosaxon bien connu de l'homme du métier). Plus précisément, la mémoire NVM du type adressable par le contenu comporte, par bit stocké, deux points-mémoires du type EEPROM connectés par deux inverseurs INV1 et INV2 montés tête- bêche. Chaque point-mémoire EEPROM comporte un transistor à grille flottante TGF1, TGF2 dont les sources S1 et S2 sont reliées à la masse. Lorsqu'au moment de la personnalisation électrique du circuit intégré, le point-mémoire de gauche de la cellule de la figure 6 est programmé tandis que le point-mémoire de droite de cette cellule est effacé, on considère que la cellule stocke par exemple un « 1 » logique. En effet, après une précharge du noeud BL avec la tension d'alimentation Vdd puis relâchement de la précharge, le transistor TGF1 sera passant tandis que le transistor TGF12 sera bloqué, conduisant à la délivrance d'un « 1 » à la sortie OUTCAM. Par contre, si les deux points-mémoires ont été effacés lors du stockage du code d'identification, cela correspond au stockage d'un « 0 » logique. En effet, après une précharge du noeud BL avec la tension d'alimentation Vdd puis relâchement de la précharge, un « 0 » logique sera délivré. Une telle structure présente l'avantage de délivrer le contenu de la mémoire pour autant qu'une tension soit disponible, et ce même si le reste du circuit intégré est totalement endommagé. La figure 7 illustre un exemple de moyens de contrôle MCTL permettant de générer les courants dans un sens ou dans l'autre dans les deux lignes LMG et LMD d'une paire de lignes métalliques. Plus précisément, dans cet exemple non limitatif, l'une des lignes métalliques de la paire, par exemple la ligne LMD, est connectée entre les sorties de deux multiplexeurs MUX1 et MUX2. L'entrée de commande de chaque multiplexeur est connectée à la sortie OUTCAM de la cellule-mémoire associée à cette paire de lignes métalliques. La première entrée du multiplexeur MUX1 est susceptible de recevoir le signal de test SIN qui, comme illustré sur la figure 8, est un signal de tension 0-5 volts par exemple, en forme de créneau. La deuxième entrée E2 du multiplexeur MUX2 est également susceptible de recevoir ce signal SIN. Les entrées E2 et El des multiplexeurs MUX1 et MUX2 sont par ailleurs reliés à la masse. L'autre ligne métallique, par exemple la ligne LMG, est susceptible de recevoir à une de ses extrémités le signal SIN et a son autre extrémité reliée à la masse. Ainsi, dans le cas où les deux multiplexeurs MUX1 et MUX2 sont placés sur leur première entrée El, les deux lignes LMD et LMG sont parcourues par des courants transitoires de même sens. Par contre, lorsque les deux multiplexeurs MUX1 et MUX2 sont placés sur leur entrée E2, les deux lignes métalliques sont parcourues par des courants transitoires de sens opposés. La détection et l'analyse du champ magnétique sont effectuées au cours de fenêtres d'analyse FA englobant chaque transition montante du signal SIN. En variante il serait possible de supprimer le multiplexeur MUX2 et de laisser l'extrémité de la ligne LMD en l'air. Par ailleurs la deuxième entrée E2 du multiplexeur MUX1 serait reliée à la borne IPD par l'intermédiaire d'un inverseur. Dans ce cas, si le multiplexeur MUX1 est placé sur son entrée El, la transition positive de SIN pendant la fenêtre d'analyse FA charge la ligne LMD qui est à la fois résistive et capacitive et provoque la circulation d'un courant transitoire de la gauche vers la droite. Bien entendu l'intensité du courant est la plus forte au voisinage de la sortie du multiplexeur produisant un champ magnétique plus intense dans cette zone. Si le multiplexeur MUX1 est placé sur son entrée E2, la transition négative de l'opposé du signal SIN pendant la fenêtre d'analyse FA décharge la ligne LMD et provoque la circulation d'un courant transitoire de la droite vers la gauche. Dans cette variante ce qui vient d'être décrit pour la ligne LMD est valable pour chaque ligne. Cette variante présente l'avantage d'offrir une consommation électrique moindre. En pratique, comme illustré sur la figure 9, le banc de mesure BM comporte une table TB sur laquelle peut se déplacer la sonde SD, elle-même reliée à un appareil de mesure APM, par exemple un oscilloscope. Plusieurs possibilités sont offertes. I1 est possible, puisque l'on connaît l'emplacement du réseau électriquement conducteur REC dans le circuit intégré, de positionner la sonde SD au dessus du réseau électriquement conducteur et de la déplacer au dessus des paires de lignes en effectuant dans chaque fenêtre d'analyse FA la mesure du champ magnétique. En variante, il serait possible d'effectuer sur un produit fabriqué et personnalisé une cartographie du champ magnétique comportant en particulier la partie relative au code d'identification, et d'effectuer à nouveau un balayage complet de la surface du circuit intégré lors d'une procédure d'identification, de façon à obtenir une nouvelle cartographie. La comparaison des deux cartographies, incluant la comparaison dans la zone relative au code d'identification, permettant alors l'identification ou non du circuit intégré. La figure 10 illustre une autre variante possible de l'invention. Dans cet exemple, le réseau électriquement conducteur comporte plusieurs lignes métalliques LM1, LM2, LM3 mutuellement espacées d'une distance d3. Dans cette variante, on génère ou non une variation de tension ou tension transitoire dans une ligne métallique en fonction de la valeur du bit associé à cette ligne métallique. Ainsi, par exemple, pour une valeur logique de bit égale à « 1 », on génèrera une variation de tension dans la ligne métallique tandis que l'on n'en génèrera pas si la valeur du bit est égale à « 0 ». On détecte alors la présence du champ électrique généré en utilisant une sonde SDE qui va détecter un couplage capacitif ou non en fonction de la présence variation de tension dans la ligne métallique. Là encore, la distance d3, par exemple quelques centaines de micromètres, est choisie bien supérieure à la surface d'analyse de la sonde SDE. Des moyens de contrôle MCTL adaptés à cette variante sont illustrés sur la figure 1 l à titre d'exemple non limitatif. Plus précisément, un multiplexeur MUX est connecté à une extrémité de chaque ligne métallique, l'autre extrémité de cette ligne métallique étant connectée à la masse. L'entrée de commande du multiplexeur est connectée à la sortie OUTCAM de la cellule-mémoire stockant le bit associé à cette ligne métallique. La première entrée El du multiplexeur MUX est destinée à recevoir le signal d'entrée SIN tandis que la deuxième entrée E2 est reliée à la masse. Selon la valeur du bit logique, le multiplexeur est commuté sur sa première entrée ou sur sa deuxième entrée, permettant de générer ou non une variation de tension dans la ligne métallique. Là encore, en variante il serait possible de laisser en l'air 5 l'extrémité droite de la ligne LM de façon à réduire la consommation électrique. REVENDICATIONS1. Procédé d'identification d'un circuit intégré, comprenant une production d'un champ électromagnétique par un réseau électriquement conducteur (REC) réalisé au sein du circuit intégré (CI) et parcouru par des courants électriques transitoires ou soumis à des tensions transitoires dont les caractéristiques dépendent de la valeur d'un mot numérique formant un code d'identification (CDI) du circuit intégré et stocké de façon secrète dans une mémoire non volatile (NVM), et une analyse du champ électromagnétique produit de façon à retrouver ou non ledit code d'identification (CDI). 2. Procédé selon la revendication 1, dans lequel le réseau électriquement conducteur (REC) comporte au moins une paire (Pl) de moyens électriquement conducteurs (LMD1, LMG1) associée à un bit du mot numérique, les caractéristiques des courants transitoires comportant le sens de circulation du courant transitoire dans un moyen électriquement conducteur, et on fait circuler dans les deux moyens électriquement conducteurs (LMD1, LMG1) deux courants transitoires de même sens ou de sens opposé en fonction de la valeur du bit, et on analyse le champ magnétique produit au dessus de chacun des moyens électriquement conducteurs et entre les deux moyens électriquement conducteurs. 3. Procédé selon la revendication 2, dans lequel le réseau électriquement conducteur comporte plusieurs paires (Pl-P5) de moyens électriquement conducteurs mutuellement espacées d'une distance (d2) supérieure à la surface d'analyse d'un moyen d'analyse de champ magnétique, chaque paire (P1-P5) étant associée à un bit du mot numérique, et on fait circuler dans les deux moyens électriquement conducteurs de chaque paire deux courants transitoires de même sens ou de sens opposé en fonction de la valeur du bit associé à ladite paire, et on analyse le champ magnétique produit au dessus de chacun des moyens électriquement conducteurs et entre les deuxmoyens électriquement conducteur de chaque paire, avec ledit moyen d'analyse (SDH). 4. Procédé selon la revendication 2 ou 3, dans lequel les deux moyens électriquement conducteurs de chaque paire comporte respectivement deux lignes électriquement conductrices parallèles (LMD, LMG). 5. Procédé selon la revendication 2 ou 3, dans lequel chaque moyen électriquement conducteur comporte au moins deux lignes électriquement conductrices parallèles (LMD1, LMD10), et on fait circuler dans toutes les lignes (LMD1, LMD10) d'un moyen électriquement conducteur des courants transitoires dans le même sens. 6. Procédé selon la revendication 1, dans lequel le réseau électriquement conducteur (REC) comporte au moins un moyen électriquement conducteur (LM1) associé à un bit du mot numérique, les caractéristiques des tensions transitoires comportant une génération ou une absence de génération d'une variation de tension dans un moyen électriquement conducteur, et on génère ou non dans le moyen électriquement conducteur une variation de tension en fonction de la valeur du bit, et on détecte la présence éventuelle d'un champ électrique produit au dessus du moyen électriquement conducteur. 7. Procédé selon la revendication 6, dans lequel le réseau électriquement conducteur (REC) comporte plusieurs moyens électriquement conducteurs (LM1-LM3) mutuellement espacés d'une distance (d3) supérieure à la surface d'analyse d'un moyen d'analyse de champ électrique (SDE), chaque moyen électriquement conducteur étant associé à un bit du mot numérique, et on génère ou non dans chaque moyen électriquement conducteur une variation de tension en fonction de la valeur du bit qui lui est associé, et on détecte la présence éventuelle d'un champ électrique produit au dessus de chaque moyen électriquement conducteur. 8. Procédé selon la revendication 6 ou 7, dans lequel chaque moyen électriquement conducteur (LM1-LM3) est une ligne électriquement conductrice. 9. Procédé selon l'une des revendications précédentes, dans lequel la mémoire non volatile (NVM) est une mémoire morte de type électriquement programmable et effaçable. 10. Circuit intégré, comprenant un moyen de stockage (NVM) non volatil configuré pour stocker de façon secrète un mot numérique dont la valeur forme un code d'identification (CDI) du circuit intégré, des moyens de contrôle (CTML) configurés pour recevoir le mot numérique et pour générer des courants électriques transitoires ou des tensions transitoires dont les caractéristiques dépendent de la valeur du mot numérique, et un réseau électriquement conducteur (REC) configuré pour être parcouru par lesdits courants électriques transitoires ou recevoir lesdites tensions transitoires de façon à générer un champ électromagnétique. 11. Circuit intégré selon la revendication 10, dans lequel le réseau électriquement conducteur (REC) comporte au moins une paire de moyens électriquement conducteurs (LMD1, LMG1) associée à un bit du mot numérique, les moyens de contrôle (MCTL) étant configurés pour définir le sens de circulation du courant transitoire dans un moyen électriquement conducteur en fonction de la valeur dudit bit. 12. Circuit selon la revendication 11, dans lequel le réseau électriquement conducteur comporte plusieurs paires (Pl-P5) de moyens électriquement conducteurs mutuellement espacées d'une distance supérieure à la surface d'analyse d'un moyen d'analyse de champ magnétique, chaque paire étant associée à un bit du mot numérique, les moyens de contrôle (MCTL) étant configurés pour faire circuler dans les deux moyens électriquement conducteurs de chaque paire deux courants transitoires de même sens ou de sens opposé en fonction de la valeur du bit associé à ladite paire. 13. Circuit selon la revendication 10 ou 1l, dans lequel les deux moyens électriquement conducteurs de chaque paire comporte respectivement deux lignes électriquement conductrices parallèles (LMD1, LMG1). 14. Circuit selon la revendication 10 ou 11, dans lequel chaque moyen électriquement conducteur comporte au moins deux lignes électriquement conductrices parallèles (LMD1, LMD10), et les moyens de contrôle (MCTL) sont configurés pour faire circuler dans toutes les lignes d'un moyen électriquement conducteur des courants transitoires dans le même sens. 15. Circuit selon la revendication 10, dans lequel le réseau électriquement conducteur (REC) comporte au moins un moyen électriquement conducteur (LM1-LM3) associé à un bit du mot numérique, les moyens de contrôle (MCTL) étant configurés pour générer ou non une variation de tension dans un moyen électriquement conducteur en fonction de la valeur du bit. 16. Circuit selon la revendication 15, dans lequel le réseau électriquement conducteur (REC) comporte plusieurs moyens électriquement conducteurs (LM1-LM3) mutuellement espacés d'une distance (d3) supérieure à la surface d'analyse d'un moyen d'analyse de champ électrique, chaque moyen électriquement conducteur étant associé à un bit du mot numérique, les moyens de contrôle étant configurés pour générer ou non dans chaque moyen électriquement conducteur une variation de tension en fonction de la valeur du bit qui lui est associé. 17. Circuit selon la revendication 15 ou 16, dans lequel chaque moyen électriquement conducteur est une ligne électriquement conductrice. 18. Circuit selon l'une des revendications 10 à 17, dans lequel le réseau électriquement conducteur (REC) est incorporé dans au moins un niveau de métallisation (Mn) de la partie d'interconnexion du circuit intégré. 19. Circuit selon l'une des revendications 10 à 18, dans lequel le moyen de stockage non volatil (NVM) comprend une mémoire morte de type électriquement programmable et effaçable. 20. Circuit selon l'une des revendications 10 à 18, dans lequel le moyen de stockage non volatil (NVM) comprend une mémoire du type adressable par le contenu comportant, par bit stocké,deux points-mémoires du type EEPROM connectés par deux inverseurs montés tête-bêche. 21. Circuit selon l'une des revendications 10 à 20, dans lequel les moyens de contrôle (MCTL) comportent au moins un multiplexeur dont la sortie est connectée à au moins une extrémité d'au moins un moyen électriquement conducteur, commandé par la valeur du bit associé à ce moyen électriquement conducteur, et possédant une première entrée destinée à recevoir un signal de tension (SIN) comportant au moins un créneau de tension.