Brevet FR2946480A1 — publié le 20101210

RECEPTEUR EQUIPE D'UN DECODEUR DE VITERBI A TREILLIS Le domaine de l'invention est celui de la réception d'un signal numérique codé selon un codage de Viterbi ; il s'agit plus particulièrement du décodage de ce signal reçu, selon un décodage de Viterbi à treillis. Très utilisé dans le domaine des communications de données, le codage des données transmises permet d'améliorer grandement la résistance aux erreurs de transmissions numériques en rajoutant des symboles de redondance astucieusement calculés. Ces symboles de redondance permettent au récepteur de détecter et de corriger des erreurs sans qu'il soit nécessaire de demander à l'émetteur de retransmettre les données. C'est particulièrement intéressant lorsque les retransmissions sont coûteuses voire impossibles, comme par exemple dans le domaine des transmissions radio et plus spécifiquement lorsque ces transmissions sont bruitées comme c'est le cas pour les transmissions par satellites. Il existe plusieurs types de codages correcteurs d'erreurs parmi lesquels le codage par blocs et le codage convolutif ainsi désigné car fondé sur la convolution des données d'entrée avec les réponses impulsionnelles du codeur. Le codage de Viterbi est un codage convolutif. Les bits à émettre sont introduits dans un registre à décalage de longueur le-1 pour être codés comme illustré figure 1, le étant désignée longueur de contrainte. On parle aussi de registre à le-1 étages. Un codeur est défini par des polynômes et il comprend K registres de mémoire, K étant le nombre de lignes à retard (constituant le registre à décalage) nécessaires pour implémenter les polynômes. On a le=K. Un codeur de Viterbi dont l'implémentation est représentée figure 2 est défini par les deux polynômes G1(x), G2(x) suivants : G1(x) = x6+x5+x4+x3+1 G2(x) = x6+x4+x3+x2+1 Un codeur convolutif est souvent considéré comme une machine à états finis. Chaque état correspond à une valeur du registre du codeur. A partir d'un bit d'entrée (1 ou 0), en fonction de l'état du registre d'entrée du codeur, on obtient (par décalage des bits du registre d'entrée puis en prenant le bit d'entrée pour le bit manquant), deux états autorisés en sortie du codeur, soit deux transitions possibles, les autres étant interdites. Et ainsi de suite. Ces transitions d'état sont représentées par des arcs sur un diagramme désigné treillis. Les états du codeur sont représentés par les noeuds du treillis. On a représenté figure 3 un exemple de maille élémentaire d'un treillis pour le = 3. Une maille élémentaire aussi désignée treillis élémentaire illustre pour tous les états de départ les transitions (ou arcs) autorisées entre un état de départ et un état d'arrivée. Les traits pleins correspondent à l'émission d'un � 1 �, les traits en pointillé correspondent à l'émission d'un � 0 � ; cette convention est conservée par la suite. Un treillis permet aussi de représenter le codage : ceci est obtenu en étiquetant les arcs du treillis en fonction de ce codage. On a représenté figure 5 un exemple de treillis correspondant à un codage dont l'implémentation est représentée figure 4 et qui est défini par les polynômes : G1(x) = x2+x+1 G2(x) = x2+1 Les étiquettes sur les arcs de la maille représentent la paire de symboles (G1, G2) émis en sortie du codeur ils ont été obtenus de la façon suivante, G1 et G2 étant calculés modulo 2 : partant de l'état 00, en introduisant le bit 1, on obtient G1(1) = 1 et G2(1) = 1 partant de l'état 00, en introduisant le bit 0, on obtient G1(0) = 0 et G2(0) = 0 partant de l'état 01, en introduisant le bit 1, on obtient G1(1) = 0 et G2(1) = 0 partant de l'état 01, en introduisant le bit 0, on obtient G1(0) = 1 et G2(0) = 1 partant de l'état 10, en introduisant le bit 1, on obtient G1(1) = 0 et G2(1) = 1 partant de l'état 10, en introduisant le bit 0, on obtient G1(0) = 1 et G2(0) = 0 partant de l'état 11, en introduisant le bit 1, on obtient G1(1) = 1 et G2(1) = 0 partant de l'état 11, en introduisant le bit 0, on obtient G1 (0) = 0 et G2(0) = 1. Partant d'une ligne à retard initialisée à � 0 �, on émet la séquence 1001 : le chemin représenté figure 6 se traduit par l'émission de la séquence de symboles, 11 10 11 11 générés par le codage de l'exemple précédent. Chaque chemin du treillis correspond à une séquence valide de bits codés ; et inversement, n'importe quelle séquence valide peut être représentée par un chemin. Côté réception, les données doivent donc être décodées. Lorsqu'une erreur survient générée par exemple par le canal de transmission (on reçoit 11 00 11 11 au lieu de 11 10 11 11), le récepteur recevra un symbole correspondant à une transition interdite, qui n'est pas sur un chemin possible. La tâche du décodeur est alors de trouver un chemin qui soit le plus proche possible du chemin de la séquence de bits envoyés. Si le codeur est d'implémentation relativement triviale, le décodeur (implanté dans le récepteur) nécessite plus de calculs. Le décodeur Viterbi utilise traditionnellement l'algorithme du treillis qui permet une détection optimale en terme de performance et de charge de calcul des symboles d'erreur. De nombreuses implémentations matérielles ou logicielles de ce décodeur proposant ou non un paramétrage manuel sont disponibles. Les données reçues par le récepteur sont en général des données analogiques bruitées. Par exemple le bit 1 émis devient 0,8 à la réception. Un codage peut alors être introduit à la réception, pour prendre en considération le fait que certaines données reçues sont plus certaines que d'autres : selon ce codage dit à décision pondérée ou � sort decision � en anglais, chaque donnée reçue est codée sur n bits (on a en général n=3 qui correspond à une pondération variant entre 0 et 7). On parle alors de décodeur de Viterbi à décision pondérée. Un codage à décision ferme ou binaire, ou � hard decision � en anglais désigne un codage sans cette pondération c'est-à-dire pondérée avec 0 bit (n=1) : il s'agit finalement d'un cas particulier de codage à décision pondérée. L'utilisation du mécanisme de � sort decision � permet d'améliorer les performances de diminution du taux d'erreur binaire (TEB). Les différentes implémentations de cet algorithme permettent soit de privilégier la rapidité de l'algorithme (adaptée à un débit élevé de données) en parallélisant les ressources, soit au contraire d'optimiser l'utilisation des ressources (taille de silicium pour implémentation matérielle, taux de charge pour implémentation logicielle), au détriment du débit. Dans le cas des récepteurs GNSS le débit reste faible (quelques centaines de Hertz au maximum) et on s'intéresse donc à une optimisation des ressources. L'invention propose une implémentation matérielle particulière d'un décodeur de Viterbi à décision pondérée et à treillis, optimisant les ressources matérielles nécessaires ; cette implémentation est notamment adaptée au besoin GNSS. Elle est rendue possible par la mise en oeuvre d'un procédé de décodage spécifique ; l'invention a également pour objet, ce procédé. Plus précisément, l'invention a pour objet un récepteur d'un signal numérique équipé d'un décodeur Viterbi à treillis à N états, et à décision pondérée, le signal reçu comportant une suite de symboles. Il est principalement caractérisé en ce qu'il comprend un circuit logique programmable qui comporte : - une mémoire source A et une mémoire destination B comprenant chacune N lignes et M+L colonnes respectivement attribuées à m champs fixes de description du treillis, et à L champs variables, un opérateur apte à calculer les champs variables d'une mémoire en fonction des champs fixes de ladite mémoire, des symboles reçus et des champs variables de l'autre mémoire et à inverser le rôle des mémoires source et destination. Selon une caractéristique de l'invention, le treillis étant établi à partir d'un treillis élémentaire comportant N états de départ et N états d'arrivée, chaque état de départ étant relié à deux états d'arrivés par des arcs étiquetés, les champs fixes comportent deux champs d'adresse de destination, un par état d'arrivée et deux champs d'étiquettes des arcs correspondants ; les champs variables comportent un champ de distance cumulée en fonction des étiquettes du treillis élémentaire et des symboles reçus, et un champ de séquence des S derniers bits décodés. Selon une autre caractéristique de l'invention, N étant égal à 210, le étant la longueur de contrainte du codeur, les adresses de destination sont définies sur le bits. De préférence, M=4 et L=2 ou 3. La décision pondérée étant codée sur n bits, les étiquettes sont alors définies sur n bits. Selon une caractéristique de l'invention, les champs variables comportent en outre un champ indiquant pour chaque ligne de la mémoire si la distance cumulée a déjà été calculée pour le symbole reçu. Ce champ indicateur est par exemple défini sur un bit. Ce récepteur est typiquement un récepteur GNSS. L'invention a aussi pour objet un procédé de réception d'un signal numérique au moyen d'un récepteur tel que précédemment décrit, comportant une étape de décodage qui comprend une étape de traitement de chaque symbole reçu qui comporte pour chaque ligne de la mémoire source les sous-étapes suivantes pour chacune des deux adresses de cette ligne : Calcul de la distance entre le symbole reçu et l'étiquette du champ étiquette associé à cette adresse, - Calcul de la distance cumulée de la mémoire destination à cette adresse à partir de ladite distance et de la distance cumulée de ladite ligne de la mémoire source, cette distance dite dernière distance étant associée à une séquence décodée, caractérisé en ce que cette étape de traitement de symboles comprend en outre la sous-étape suivante : si une distance cumulée dite distance cumulée précédente a déjà été calculée à cette adresse, choix pour cette adresse de la plus petite distance cumulée entre cette distance cumulée précédente et la dernière distance cumulée, et mise à jour de la séquence décodée par la séquence associée à la distance cumulée choisie. Selon une caractéristique de l'invention, à la fin de l'étape de traitement du symbole reçu, le rôle des mémoires source et destination est inversé. A la fin de l'étape de traitement du symbole reçu, la distance cumulée de chaque ligne de la mémoire destination est avantageusement normalisée pour éviter un débordement du champ distance cumulée. Cette normalisation consiste par exemple à soustraire à toutes les distances cumulée la plus petite distance cumulée. Selon une caractéristique de l'invention, la valeur de l'indicateur du champ indicateur s'inverse lorsque la distance cumulée a déjà été calculée et à la fin de l'étape de traitement du symbole reçu, cet indicateur est réinitialisé pour chaque ligne de la mémoire. Ce procédé permet de définir une partie de l'architecture d'un circuit logique programmable (ASIC ou FPGA) dédiée au décodage des messages émis par les satellites d'un système de positionnement GNSS (Galileo, EGNOS, GPS, etc.). Pour réduire le taux d'erreur de bits dû à la transmission, ces messages sont codés au niveau du satellite suivant l'algorithme de Viterbi. Le déport du décodage à l'intérieur d'une puce de traitement de signal existant permet de libérer des ressources software dans les processeurs de traitement des récepteurs GNSS. Ce procédé permet ainsi d'optimiser la taille et donc le volume et 10 la consommation du composant ce qui peut se faire dans la mesure où l'on est peu contraint par la problématique du débit de données GNSS. D'autres caractéristiques et avantages de l'invention apparaîtront à la lecture de la description détaillée qui suit, faite à titre d'exemple non 15 limitatif et en référence aux dessins annexés dans lesquels : la figure 1 déjà décrite représente schématiquement un registre à décalage à K-1 étages, la figure 2 déjà décrite représente schématiquement l'implémentation d'un codeur Viterbi, 20 la figure 3 déjà décrite représente schématiquement une maille élémentaire d'un treillis pour K = 3, la figure 4 déjà décrite représente schématiquement l'implémentation d'un exemple de codeur, la figure 5 déjà décrite représente schématiquement le treillis 25 élémentaire (ou maille élémentaire) du codeur de la figure 4, la figure 6 déjà décrite représente schématiquement le chemin pour une séquence émise égale à 1001 à partir du treillis de la figure 4, les figures 7a à 7c représentent schématiquement un exemple de construction selon l'invention, du treillis associé au décodage selon la maille 30 élémentaire de la figure 5, de la séquence de symboles reçus 11 00 11 11, les figures 8a à 8c représentent schématiquement l'initialisation des mémoires A et B (fig 8a), leur mise à jour induite par la réception de la première paire de symboles (11) de l'exemple considéré (fig 8b, 8c), selon l'invention, les figures 9a à 9c représentent schématiquement, la mise à jour des mémoires A et B induite par la réception de la 2è paire de symboles (00) de l'exemple considéré, selon l'invention, les figures 10a à 10f représentent schématiquement, la mise à 5 jour des mémoires A et B induite par la réception de la 3è paire de symboles (11) de l'exemple considéré, selon l'invention, les figures 11a à 11f représentent schématiquement, la mise à jour des mémoires A et B induite par la réception de la 4è paire de symboles (11) de l'exemple considéré, selon l'invention, 10 la figure 12 représente schématiquement l'implémentation selon l'invention du procédé de décodage présenté. D'une figure à l'autre, les mêmes éléments sont repérés par les mêmes références. 15 On va tout d'abord dérouler le procédé de décodage Viterbi sur lequel est basée l'implémentation matérielle du décodeur selon l'invention. Ce déroulement décrit en relation avec les figures 7a à 7c, est réalisé sur le même exemple que précédemment : la séquence reçue à décoder est 11 00 11 11. Les symboles sont reçus par paires. 20 Le premier symbole reçu est la paire 11. Sachant qu'on part de l'état 00 (état d'initialisation avec i=0), les deux états possibles suivants sont 00 ou 10. En reportant sur chaque arc les étiquettes des arcs du treillis élémentaire, on a pour la colonne i=1: une distance (indiquée entre parenthèses à côté des étiquettes) égale 25 à 2 en comparant la séquence reçue 11 à 00, une distance cumulée (indiquée entre parenthèses sur chaque noeud) aussi égale à 2, le bit décodé correspondant (souligné à côté de chaque noeud) étant 0, une distance de 0 en comparant la séquence reçue 11 à 11, une distance cumulée aussi égale à 0, le bit correspondant étant 1. 30 Le deuxième symbole reçu est la paire 00. En partant d'un des deux états possibles à savoir l'état 00, on a pour la colonne i=2: une distance égale à 0 en comparant la séquence reçue 00 à 00, une distance cumulée qui reste égale à 2, le bit correspondant étant 0, la séquence de bits décodés (soulignée à côté de chaque noeud) étant 00, une distance de 2 en comparant la séquence 00 à 11, une distance cumulée égale à 4, le bit correspondant étant 1, la séquence de bits 5 décodés étant 01. En partant de l'autre état possible à savoir l'état 10, on a toujours pour i=2 - une distance égale à 1 en comparant la séquence 00 à 01, une distance cumulée égale à 1, le bit correspondant étant 1, la séquence 1 o de bits décodés étant 11, une distance de 1 en comparant la séquence 00 à 10, une distance cumulée égale à 1, le bit correspondant étant 0, la séquence de bits décodés étant 10. Le troisième symbole reçu est la paire 11. En partant d'un des 15 quatre états possibles à savoir l'état 00, on a pour la colonne i=3: une distance égale à 2 en comparant la séquence reçue 11 à 00, une distance cumulée égale à 4, le bit correspondant étant 0, la séquence de bits décodés étant 000, une distance de 0 en comparant la séquence 11 à 11, une distance 20 cumulée égale à 2, le bit correspondant étant 1, la séquence de bits décodés étant 001. En partant d'un autre état possible à savoir l'état 01, on a pour la colonne i=3: - une distance égale à 0 en comparant la séquence 11 à 11, une 25 distance cumulée égale à 1, le bit correspondant étant 0, la séquence de bits décodés étant 100, une distance de 2 en comparant la séquence 11 à 00, une distance cumulée égale à 3, le bit correspondant étant 1, la séquence de bits décodés étant 101. 30 En partant d'un autre état possible à savoir l'état 10, on a pour la colonne i=3: une distance égale à 1 en comparant la séquence 11 à 01, une distance cumulée égale à 5, le bit correspondant étant 1, la séquence de bits décodés étant 011, une distance de 1 en comparant la séquence 11 à 10, une distance cumulée égale à 5, le bit correspondant étant 0, la séquence de bits décodés étant 010. En partant du quatrième autre état possible 11, on a pour la colonne i=3: une distance égale à 1 en comparant la séquence 11 à 10, une distance cumulée égale à 2, le bit correspondant étant 1, la séquence de bits décodés étant 111, une distance de 1 en comparant la séquence 11 à 01, une distance cumulée égale à 2, le bit correspondant étant 0, la séquence de bits décodés étant 110. A partir de cette quatrième colonne de noeuds (i=3), chaque état est atteint par deux chemins. Par exemple l'état 00 peut être atteint à partir : - du chemin dont les états sont 00, 00, 00, 00, avec une distance cumulée égale à 4, la séquence décodée étant 000, ou - du chemin dont les états sont 00, 10, 01, 00 avec une distance cumulée égale à 1, la séquence décodée étant 100. On ne conserve que le chemin dont la distance cumulée est la plus petite (en fait inférieure ou égale mais selon une alternative on pourrait choisir la distance strictement inférieure); et la distance cumulée attribuée à cet état est alors cette plus petite distance. De la sorte on ne conserve pour cette colonne i=3, pour : - l'état 00, que la séquence 100 associée à la distance cumulée 1 (au lieu de 000 associée à la distance cumulée 4), l'état 01, que la séquence 110 associée à la distance cumulée 2 (au lieu de 010 associée à la distance cumulée 5), l'état 10, que la séquence 001 associée à la distance cumulée 2 (au lieu de 101 associée à la distance cumulée 3), l'état 11, que la séquence 111 associée à la distance cumulée 2 (au lieu de 011 associée à la distance cumulée 5). Le procédé est ensuite déroulé entre les colonnes i=3 et i=4 et décrit en relation avec les figures 7b, 7c. On ne conserve pour : l'état 00, que la séquence 1100 associée à la distance cumulée 2 (au lieu de 1000 associée à la distance cumulée 3), l'état 01, que la séquence 1110 associée à la distance cumulée 3, l'état 10, que la séquence 1001 associée à la distance cumulée 1 (au lieu de 1101 associée à la distance cumulée 4), l'état 11, que la séquence 0011 associée à la distance cumulée 3. On peut alors retrouver la séquence initialement émise en partant de l'état ayant la plus petite distance cumulée, soit 1 dans notre exemple avec la séquence décodée 1001 (qui a été entourée figure 7c), qui est bien l'inverse de la séquence initialement émise : le décodeur a donc retrouvé la bonne séquence malgré l'erreur qui s'était introduite sur les symboles reçus. Le décodeur Viterbi considéré ici est conçu pour une implémentation matérielle sur un circuit logique programmable de type ASIC ou FPGA, qui permet d'optimiser les ressources matérielles utilisées (RAM, nombre de bascules...). A la réception, comme on vient de le voir sur notre exemple, on génère un treillis à partir de la maille élémentaire en inscrivant : sur les arcs, la distance entre les symboles reçus et les étiquettes associés à l'arc, sur chaque noeud, la distance cumulée depuis le début. L'état de décodage peut être représenté à tout moment par la dernière colonne du treillis avec les 2K-1 chemins survivants. Ce procédé est implémenté de la manière suivante. Le décodeur selon l'invention comprend deux mémoires qui ont la même organisation, l'une étant désignée mémoire source, l'autre mémoire destination et un opérateur qui travaille en bascule sur ces deux mémoires. La taille de ces mémoires est dimensionnée d'après la longueur de contrainte le (correspondant à la � mémoire � du décodeur) : elles comptent 21c mots ou lignes. Chaque mot doit contenir les champs suivants : Adresse destination1 définie sur le bits, Adresse destination2 définie sur le bits, Distance adressel (ou métriquel) définie sur n bits, Distance adresse2 (ou métrique2) définie sur n bits, Distance cumulée (ou Distance totale) définie sur m bits, avec n Le traitement est réalisé au moyen de l'implémentation 35 représentée figure 12 qui comprend une mémoire source A 10, une mémoire destination B 20, interchangeables et un opérateur 30 relié à ces mémoires. Selon un mode d'exploitation privilégié, cette implémentation ne comprend que ces 2 mémoires 10, 20 et cet opérateur 30. De manière classique les symboles reçus proviennent d'une 5 mémoire de symboles 40, les bits décodés sont stockés dans une mémoire de bits décodés 50. Le traitement consiste à analyser l'ensemble des symboles reçus de la mémoire 40 en temps réel ou en temps différé et, pour chaque symbole à parcourir la mémoire source de la ligne 0 jusqu'à la ligne 21'1 comme 10 illustré figures 8a à 8c. Pour chaque adresse de la mémoire source 10 (représentant un état possible de l'encodeur), sont disponibles deux adresses de la mémoire destination 20 représentant les deux états suivants possibles et les étiquettes associées à ces transitions. 15 Dans la mémoire destination, l'opérateur 30 met à jour : la distance cumulée en fonction des étiquettes des arcs de la maille élémentaire et des symboles reçus associés aux transitions, le chemin parcouru aussi désignée séquence décodée, qui est constitué de la concaténation des symboles correspondants à 20 l'ensemble des transitions parcourues depuis le début du décodage : il s'agit d'une séquence de bits décodés (une paire de symboles décodés permettant de trouver le bit émis). Ce chemin est rempli par le haut, en décalant les bits décodés déjà présents vers les poids faibles. Un multiplexeur permet de choisir à partir de quelle position de 25 cette séquence les bits décodés seront évacués vers la sortie, c'est-à-dire vers la mémoire � résultat � c'est-à-dire la mémoire des bits décodés 50. Cette position correspond à la profondeur du chemin inverse aussi désignée profondeur de � traceback �. L'indicateur d'état (ou Flag) dont la valeur s'inverse à chaque nouveau 30 symbole et qui a pour rôle de signifier que cette ligne de la mémoire de destination a été mise à jour. Cela est utile car chaque destination est traitée deux fois et on ne doit pas écrire un chemin moins bon que le chemin éventuellement déjà présent dans cette case. Ceci permet de � couper la branche � la moins bonne des deux. Cette fonction peut être assurée par un autre moyen non codé dans la mémoire mais qui serait un état interne à l'opérateur. Une fois épuisées les lignes (ou mots) de la mémoire source 10, l'opérateur 30 évacue le bit calculé vers la mémoire de bits décodés 50, recadre les distances cumulées pour éviter un débordement du champ � distance cumulée �, réinitialise les indicateurs, inverse le rôle des mémoires et passe à la paire de symboles suivante jusqu'à concurrence du nombre de symboles indiqués par une unité de contrôle et d'initialisation 60 ou bien tant que des symboles arrivent en temps réel. Selon une variante privilégiée de l'invention, après avoir traité un nouveau symbole, l'opérateur 30 détermine la distance minimale parmi toutes celles trouvées en traitant un symbole et la soustrait à toutes les distances calculées, ceci de façon à éviter que les distances débordent. On � rabote � en quelque sorte la distance cumulée. Lors du lancement du procédé de décodage, l'opérateur 30 est initialisé sur ordre de l'unité de contrôle et d'initialisation 60, à l'aide des paramètres suivants : nombre de symboles à traiter (pour un traitement par bloc) ou choix du mode temps réel, type de traitement (premier bloc, bloc intermédiaire ou dernier bloc). Les mémoires 10, 20 sont initialisées par l'unité de contrôle et d'initialisation 60 avec les étiquettes des arcs associées à chaque noeud du treillis, dérivées de la maille élémentaire, c'est-à-dire des valeurs des polynômes G1 et G2 à utiliser. Plus précisément, les champs suivants de chacune des 2 mémoires sont initialisés de la façon suivante : Adresse destination1 (ou adresse 1) : par les valeurs dérivées des polynômes G1 et G2 Adresse destination2 (ou adresse 2): par les valeurs dérivées des polynômes G1 et G2 Distance addl (ou métrique 1): par les étiquettes associées aux arcs du treillis Distance add2 (ou métrique 2) : par les étiquettes associées aux arcs du treillis Distance cumulée : à 0 Séquence décodée : à 0 Indicateur d'état (ou � flag �) : à 0 Ceci est illustré figure 8a dans laquelle les lignes correspondant 5 aux adresses de la mémoire sont numérotées suivant la convention numérique de 0 à 3, 0 étant associé à l'état 00, 1 à l'état 01, 2 à l'état 10 et 3 à l'état 11. On illustre en relation avec les figures 8b à 8c, le déroulement du procédé sur ces deux mémoires en l'appliquant à notre exemple. On utilise 10 comme distance, la distance de Hamming qui est égale au nombre de bits différents (soit 0, 1 ou 2 pour un état à 2 bits) et qui s'applique à un décodeur à décision ferme (� hard decision �). Le traitement du premier symbole reçu est le plus simple car l'état 15 de départ étant connu, il limite les hypothèses. On considère tout d'abord la réception du premier symbole, soit la paire 11. � Réception du 1 er symbole 11 ; traitement de la ligne 0 � : Dans ce cadre-là on traite d'abord les deux adresses de la ligne 20 0 (figure 8b) : étapes 1 à 5 pour l'adresse 1, étapes 6 à 11 pour l'adresse 2. 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 0 de la mémoire source: 2. Distance totale (B,adressel (A,0)) = Distance totale (A,0) + abs{symbole reçu-metriqueI (A,0)} 25 Soit: Distance totale (B4O)) = 0 + abs({ 1;1}-{0;0}) =2 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B4O)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à 30 jour : Flag(B4O)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (6,0)) = 2 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B4O)=Symboles(A,0) décalé à gauche+k (k=0 pour adressel car il s'agit du bit 0,k=1 pour adresse2 35 car il s'agit du bit 1, convention que l'on conservera pour la suite). 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 0 de la mémoire source: 7. Distance totale (B,adresse2(A,0)) = Distance totale (A,0) + abs{symbole reçu-metrique2(A,0)} Soit: Distance totale (B,2)) = 0 + abs({ 1;1}-{1 ;1}) =0 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B,2)=0 : pas encore écrite: 10.On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(B,2)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (B,2)) = 0. 11.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,2)=Symboles(A,0) décalé à gauche +k. Comme il s'agit du premier symbole reçu et que l'état initial du décodeur est 0 (par hypothèse) on ne traite pas les lignes suivantes (on part d'un état unique connu). L'étape suivante est : � Fin de traitement du 1 er symbole reçu 11 � (figure 8c). 1. On normalise les distances de manière à éviter un débordement : on retire à toutes les distances de la mémoire destination la valeur de la distance la plus faible (0). 2. On inverse le rôle des mémoires source et destination. 3. On remet à 0 tous les flags. On considère alors le traitement du deuxième symbole reçu soit la paire 00. Dans ce cadre-là on traite d'abord la ligne 0 puis la ligne 2. � Réception du 2è symbole 00 ; traitement de la ligne 0 � : On traite pour la ligne 0 ses deux adresses (figure 9a) : étapes 1 à 5 pour l'adresse 1, étapes 6 à 11 pour l'adresse 2. 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 0 de la mémoire source: 2. Distance totale (A,adressel (B4O)) = Distance totale (B4O) + abs{symbole reçu-metriquel(B4O)} Soit: Distance totale (A,0)) = 2+ abs({ 0;0}-{0;0}) =2 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,0)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(A,0)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,0)) = 2 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,0)=Symboles(B4O) décalé 1 o à gauche +k. 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 0 de la mémoire source: 7. Distance totale (A,adresse2(B4O)) = Distance totale (B4O) + 15 abs{symbole reçu-metrique2(B4O)} Soit: Distance totale (A,2)) = 2 + abs({ 0;0}-{1;1}) =4 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,2)=0 : pas encore écrite: 20 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(A,2)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,2)) =4. 10.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,2)=Symboles(B4O) décalé 25 à gauche +k. On traite pour la ligne 2 ses deux adresses (figure 9b) : étapes 1 à 5 pour l'adresse 1, étapes 6 à 11 pour l'adresse 2. � Réception du 2è symbole 00 ; traitement de la ligne 2 � : 30 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 2 de la mémoire source: 2. Distance totale (A,adressel(B,2)) = Distance totale (B,2) + abs{symbole reçu-metriquel (B,2)) Soit: Distance totale (A,1)) = 0+ abs({ 0;0}-{1;0}) =1 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,1)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à 5 jour : Flag(A,1)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,1)) =1. 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,1)=Symboles(B,2) décalé à gauche +k. 10 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 2 de la mémoire source: 7. Distance totale (A,adresse2(B,2)) = Distance totale (B,2) + abs{symbole reçu-metrique2(B,2)} 15 Soit: Distance totale (A,3)) = 0 + abs({ 0;0}-{0;1}) =1 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,3)=0 : pas encore écrite: 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à 20 jour : Flag(A,3)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,3)) = 1 10.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,3)=Symboles(B,2) décalé à gauche +k. 25 Comme il s'agit du deuxième symbole reçu et que l'état initial du décodeur était 0 (par hypothèse) on ne traite pas les 2 autres lignes qui ne sont pas des hypothèses valides. � Fin de traitement du 2è symbole 00 � (figure 9c). 30 1. On normalise les distances de manière à éviter un débordement : on retire à toutes les distances de la mémoire destination la valeur de la distance la plus faible (1). 2. On inverse le rôle des mémoires source et destination. 3. On remet à 0 tous les flags. 35 On considère alors le traitement du troisième symbole reçu soit la paire 11. Dans ce cadre-là on traite successivement les quatre lignes. � Réception du 3è symbole 11 ; traitement de la ligne 0 � : (figure 10a): 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 0 de la mémoire source: 2. Distance totale (B,adressel (A,0)) = Distance totale (A,0) + abs{symbole reçu-metriquel(A,O)} Soit: Distance totale (B4O)) = 1+ abs({ 1;1}-{0;0}) =3 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B4O)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(B4O)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (B4O)) =3. 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B4O)=Symboles(A,O) décalé à gauche +k. 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 0 de la mémoire source: 7. Distance totale (B,adresse2(A,0)) = Distance totale (A,O) + abs{symbole reçu-metrique2(A,O)} Soit: Distance totale (B,2)) = 1 + abs({ 1;1}-{1;1}) =1 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B4O)=0 : pas encore écrite: 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(B4O)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (B,2)) = 1. 10.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,2)=Symboles(A,0) décalé à gauche +k. � Réception du 3è symbole 11 ; traitement de la ligne 1 � : (figure 10b) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 1 de la mémoire source: 2. Distance totale (B,adressel(A,1)) = Distance totale (Al) + abs{symbole reçu-metriquel (A,1)} Soit: Distance totale (B4O)) = 0+ abs({ 1;1}-{1;1}) =0 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B4O)=1 : déjà écrite. La distance calculée (0) est inférieure à la distance stockée (3) donc on met à jour cette dernière : Distance totale (B4O)) = 0. 4. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B4O)=Symboles(A,1) décalé à gauche +k . 5. On calcule la distance totale correspondant à l'adresse 2 de la ligne 1 de la mémoire source: 6. Distance totale (B,adresse2(A,1)) = Distance totale (Al) + abs{symbole reçu-metrique2(A,1)} Soit: Distance totale (B,2)) = 0 + abs({ 1;1}-{0;0}) =2 7. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B,2)=1 : déjà écrite : La distance calculée (2) est supérieure à la distance stockée (1) donc on ne met pas à jour cette dernière. • On ne met pas à jour la séquence des bits décodés de la mémoire 25 destination. � Réception du 3è symbole 11 ; traitement de la ligne 2 � : (figure 10c) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 2 de la mémoire source: 30 2. Distance totale (B,adressel(A,2)) = Distance totale (A,2) + abs{symbole reçu-metriquel (A,2)} Soit: Distance totale (B,1)) = 3+ abs({ 1;1}-{1;0}) =4 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle 35 Flag(B,1)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(B,1)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (B,1)) =4. 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,1)=Symboles(A,2) décalé à gauche +k. 6. On met à jour la distance totale correspondant à l'adresse 2 de la ligne 2 de la mémoire source: 7. Distance totale (B,adresse2(A,2)) = Distance totale (A,2) + abs{symbole reçu-metrique2(A,2)} Soit: Distance totale (B,3)) = 3 + abs({ 1;1}-{0;1}) =4 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B,3)=0 : pas encore écrite. 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(B,3)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (B,3)) =4. 10.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,3)=Symboles(A,2) décalé à gauche +k. � Réception du 3è symbole 11 ; traitement de la ligne 3 � : (figure 10d) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 3 de la mémoire source: 2. Distance totale (B,adressel (A,3)) = Distance totale (A,3) + abs{symbole reçu-metriquel (A,3)} Soit: Distance totale (B,1)) = 0+ abs({ 1;1}-{0;1}) =1 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(B,1)=1 : déjà écrite. La distance calculée (1) est inférieure à la distance stockée (4) donc on met à jour cette dernière: Distance totale (B,1)) = 1. 4. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,1)=Symboles(A,3) décalé à gauche +k. 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 3 de la mémoire source: 7. Distance totale (B,adresse2(A,3)) = Distance totale (A,3) + abs{symbole reçu-metrique2(A,3)} Soit: Distance totale (B,3)) = 0 + abs({ 1;11-0 ;01) =1 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle. Flag(B,3)=1 déjà écrite. La distance calculée (1) est inférieure à la distance stockée (4) donc on met à jour cette dernière: Distance totale (B,3)) = 1. 9. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(B,3)=Symboles(A,3) décalé à gauche +k. � Fin du traitement du 3è symbole 11 � (figure 10e): 1. Ayant atteint la profondeur de traceback (3 bits) on sort vers la mémoire de bits décodés, le bit correspondant à la ligne de la mémoire de destination ayant la distance totale la plus faible ; ici il s'agit de la ligne 0 (distance 1) et le bit le plus vieux (1). II correspond au premier bit effectivement émis par l'émetteur. 2. On normalise les distances de manière à éviter un débordement : on retire à toutes les distances de la mémoire destination la valeur de la distance la plus faible (ici 0). 3. On inverse le rôle des mémoires source et destination. 4. On remet à 0 tous les flags. On considère alors le traitement du quatrième symbole reçu soit la paire 11. Dans ce cadre-là on traite successivement les quatre lignes. � Réception du 4è symbole 11 ; traitement de la ligne 0 � : (figure 11a): 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 0 de la mémoire source: 2. Distance totale (A,adressel (B4O)) = Distance totale (B4O) + abs{symbole reçu-metriquel (B4O)} Soit: Distance totale (A,0)) = 0+ abs({ 1;1}-{0;0}) =2 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,0)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(A,0)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,0)) =2. 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,0)=Symboles(B4O) décalé à gauche +k. 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 0 15 de la mémoire source: 7. Distance totale (A,adresse2(B4O)) = Distance totale (B4O) + abs{symbole reçu-metrique2(B4O)} Soit: Distance totale (A,2)) = 0 + abs({ 1;1)-0 Il) =0 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination 20 pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,0)=0 : pas encore écrite: 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(A,0)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,2)) = 0. 25 10.On met à jour la séquence des bits décodés avec la valeur correspondante: Symboles(A,2)=Symboles(B4O) décalé à gauche +k. � Réception du 4è symbole 11 ; traitement de la ligne 1 � : (figure 11 b) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 1 30 de la mémoire source: 2. Distance totale (A,adressel (B,1)) = Distance totale (B,1) + abs{symbole reçu-metriquel (B,1)} Soit: Distance totale (A,0)) = 1+ abs({ 1;1)-0 ;1}) =1 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination 35 pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,0)=1 : déjà écrite. La distance calculée (1) est inférieure à la distance stockée (2) donc on met à jour cette dernière : Distance totale (A,0)) = 1. 4. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,O)=Symboles(B,1) décalé à gauche +k. 5. On calcule la distance totale correspondant à l'adresse 2 de la ligne 1 de la mémoire source: 10 6. Distance totale (A,adresse2(B,1)) = Distance totale (B,1) + abs{symbole reçu-metrique2(B,1)} Soit: Distance totale (A,2)) = 1 + abs({ 1;1}-{0;0}) =3 7. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle 15 Flag(A,2)=1 : déjà écrite : La distance calculée (3) est supérieure à la distance stockée (0) donc on ne met pas à jour cette dernière. • On ne met pas à jour la séquence des bits décodés de la mémoire destination. 20 � Réception du 4è symbole 11 ; traitement de la ligne 2 � : (figure 11 c) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 2 de la mémoire source: 2. Distance totale (A,adressel (B,2)) = Distance totale (B,2) + abs{symbole reçu-metriquel (B,2)} 25 Soit: Distance totale (A,1)) = 1+ abs({ 1;1}-{1;0}) =2 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,1)=0 : pas encore écrite: 4. On change la valeur du flag pour dire que l'adresse a déjà été mise à 30 jour : Flag(A,1)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,1)) =2. 5. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,1)=Symboles(B,2) décalé à gauche +k. 35 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 2 de la mémoire source: 7. Distance totale (A,adresse2(B,2)) = Distance totale (B,2) + abs{symbole reçu-metrique2(B,2)} Soit: Distance totale (A,3)) 1 + abs({ 1;1}-{0;1)) =2 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,3)=0 : pas encore écrite 9. On change la valeur du flag pour dire que l'adresse a déjà été mise à jour : Flag(A,3)=1. On met à jour la distance totale dans la mémoire destination : Distance totale (A,3)) =2. 10.On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,3)=Symboles(B,2) décalé à gauche +k. � Réception du 4è symbole 11 ; traitement de la ligne 3 � : (figure 11d) : 1. On calcule la distance totale correspondant à l'adresse 1 de la ligne 3 de la mémoire source: 2. Distance totale (A,adressel(B,3)) = Distance totale (B,3) + abs{symbole reçu-metriquel (B,3)} Soit: Distance totale (A,1)) = 1+ abs({ 1;1)-{0;1}) =2 3. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,1)=1 : déjà écrite. La distance calculée (2) est inférieure 25 (ou égale) à la distance stockée (2) donc on met à jour cette dernière: Distance totale (A,1)) =2. 4. On met à jour la séquence des bits décodés de la mémoire destination avec la valeur correspondante: Symboles(A,1)=Symboles(B,3) décalé à gauche +k . 30 6. On calcule la distance totale correspondant à l'adresse 2 de la ligne 3 de la mémoire source: 7. Distance totale (A,adresse2(B,3)) = Distance totale (B,3) + abs{symbole reçu-metrique2(B,3)} 35 Soit: Distance totale (A,3)) = 1 + abs({ 1;1}-{1 ;0)) =2 8. On vérifie la valeur du flag à l'adresse de la mémoire de destination pour s'assurer qu'elle n'a pas déjà été écrite durant ce cycle Flag(A,3)=1 déjà écrite. La distance calculée (2) est inférieure (ou égale) à la distance stockée (2) donc on met à jour cette dernière: 5 Distance totale (A,3)) =2. 9. On met à jour la séquence des bits décodés avec la valeur correspondante: Symboles(A,3)=Symboles(B,3) décalé à gauche +k. � Fin de traitement du 4è symbole 11 � : 10 1. Ayant atteint la profondeur de traceback (3 bits) on sort vers la mémoire de bits décodés, le bit correspondant à la ligne de la mémoire de destination ayant la distance totale la plus faible. Ici il s'agit de la ligne 2 (distance 0) et le bit le plus vieux (0). Il correspond au second bit effectivement émis par l'émetteur. On retrouve dans 15 cette branche la suite des autres bits émis (0 0 1). 2 On normalise les distances de manière à éviter un débordement : on retire à toutes les distances la valeur de la distance la plus faible (ici 0) 3. On inverse le rôle des mémoires source et destination. 4. On remet à 0 tous les flags (figure 11 e). 20 On présente à présent le processus générique de traitement mis en oeuvre par l'opérateur. Initialisation des mémoires ; Pour chaque symbole reçu: 25 Pour chaque ligne (i) de la matrice source: Pour chacun des deux champs adresse (j=1 ou2) Calculer la nouvelle distance totale par la formule: Nouvelle Distance = Distance totale (source,i) + abs{symbole reçu-métriquej(source,i)} 30 Vérifier la valeur de Flag(destination,adressej(source,i)). Si cette valeur vaut 0 alors mettre à jour la distance totale de la ligne de la mémoire destination Distance totale(destination,adressej(source,i)) = 35 Nouvelle Distance Changer la valeur du flag pour dire que l'adresse a déjà été mise à jour Mettre à jour la séquence des bits décodés avec la valeur correspondante: Symboles(destination, ad ressej(source,i)) )= (Symboles(source, i ) �1)+0 Si cette valeur vaut 1 alors Si Distance totale(destination,adressel(source,i)) A la fin du traitement d'un symbole: Mettre à 0 tous les flags Remettre à l'échelle les distance calculées Sortir le bit arrivé au bout du traceback correspondant à la ligne avec la plus faible distance Inverser mémoire source et mémoire destination. S'il s'agit d'un traitement par blocs, le traitement d'un premier bloc dit bloc d'initialisation dont les symboles sont connus a priori, initialise la mémoire destination 50. Le traitement d'un bloc intermédiaire tient compte des distances calculées lors du traitement du bloc précédent. Le traitement 10 20 25 30 Mettre à jour la séquence des bits décodés Symboles(destination, adressej(source,i)) d'un bloc final utilise la présence des � tait � bits (6 zéros en fin de message) pour supprimer certains chemins à la fin du traitement. La profondeur de traceback peut être paramétrée jusqu'à une limite égale à la longueur S du champ � Séquence décodée � dans la 5 mémoire destination 20. Cette implémentation originale du décodeur Viterbi adapté aux signaux GNSS permet de limiter les ressources matérielles à deux mémoires 10 et 20 ainsi qu'un opérateur 30. ~o Cette solution permet l'embarquement de ce type de décodeur sur les récepteurs aéronautiques directement dans l'ASIC ou le FPGA dédié au traitement du signal. REVENDICATIONS1. Récepteur d'un signal numérique équipé d'un décodeur Viterbi à treillis à N états, et à décision pondérée, le signal reçu comportant une suite de symboles, caractérisé en ce qu'il comprend un circuit logique programmable qui comporte : une mémoire source A (10) et une mémoire destination B (20) comprenant chacune N lignes et M+L colonnes respectivement attribuées à m champs fixes de description du treillis, et à L champs variables, un opérateur (30) apte à calculer les champs variables d'une mémoire en fonction des champs fixes de ladite mémoire, des symboles reçus et des champs variables de l'autre mémoire et apte à inverser le rôle des mémoires source (10) et destination (20). 2. Récepteur selon la revendication précédente, caractérisé en ce que le treillis étant établi à partir d'un treillis élémentaire comportant N états de départ et N états d'arrivée, chaque état de départ étant relié à deux états d'arrivées par des arcs étiquetés, les champs fixes comportent deux champs d'adresse de destination, un par état d'arrivée et deux champs d'étiquettes des arcs correspondants. 3. Récepteur selon la revendication précédente, caractérisé en ce que N étant égal à 21c, le étant la longueur de contrainte du codeur, les adresses de destination sont définies sur le bits. 4. Récepteur selon l'une des revendications précédentes, caractérisé en ce que M=4 et L=2 ou 3. 5. Récepteur selon l'une des revendications précédentes prise en combinaison avec la revendication 2, caractérisé en ce que la décision pondérée étant codée sur n bits, les étiquettes sont définies sur n bits. 6. Récepteur selon l'une des revendications précédentes, caractérisé en ce que le treillis étant établi à partir d'un treillis élémentaire comportant N états de départ et N états d'arrivée, chaque état de départ étant relié à deux états d'arrivées par des arcs étiquetés, les champs variables comportent un champ de distance cumulée en fonction des étiquettes de la maille élémentaire et des symboles reçus, et un champ de séquence des S derniers bits décodés. 7. Récepteur selon la revendication précédente prise en combinaison avec la revendication 5, caractérisé en ce que la distance cumulée est définie sur m bits avec n 8. Récepteur selon l'une des revendications 6 ou 7, caractérisé en ce que les champs variables comportent un champ indiquant pour chaque ligne de la mémoire si la distance cumulée a déjà été calculée pour le symbole reçu. 9. Récepteur selon la revendication précédente, caractérisé en ce que 20 le champ indicateur est défini sur un bit. 10. Récepteur selon l'une des revendications précédentes, caractérisé en ce qu'il s'agit d'un récepteur GNSS. 25 11. Procédé de réception d'un signal numérique au moyen d'un récepteur selon l'une des revendications précédentes prise en combinaison avec la revendication 6, comportant une étape de décodage qui comprend une étape de traitement de chaque symbole reçu qui comporte pour chaque ligne de la mémoire source (10) les sous- 30 étapes suivantes pour chacune des deux adresses de cette ligne : - calcul par l'opérateur (30) de la distance entre le symbole reçu et l'étiquette du champ étiquette associé à cette adresse, - calcul par l'opérateur (30) de la distance cumulée de la mémoire destination (20) à cette adresse à partir de ladite distance et de la 35 distance cumulée de ladite ligne de la mémoire source, cettedistance cumulée dite dernière distance cumulée étant associée à une séquence décodée, - si une distance cumulée dite distance cumulée précédente a déjà été calculée à cette adresse, choix par l'opérateur (30) pour cette adresse de la plus petite distance cumulée entre cette distance cumulée précédente et la dernière distance cumulée, et mise à jour de la séquence décodée par la séquence associée à la distance cumulée choisie. 12. Procédé de réception d'un signal numérique selon la revendication précédente, caractérisé en ce qu'à la fin de l'étape de traitement du symbole reçu, le rôle des mémoires source (10) et destination (20) est inversé par l'opérateur (30). 13. Procédé de réception d'un signal numérique selon l'une des revendications 11 à 12, caractérisé en ce qu'à la fin de l'étape de traitement du symbole reçu, la distance cumulée de chaque ligne de la mémoire destination est normalisée pour éviter un débordement du champ distance cumulée. 14. Procédé de réception d'un signal numérique selon la revendication précédente, caractérisé en ce qu'on soustrait à toutes les distances cumulée la plus petite distance cumulée. 15. Procédé de réception d'un signal numérique selon l'une des revendications 11 à 14 prise en combinaison avec la revendication 8, caractérisé en ce que la valeur de l'indicateur du champ indicateur s'inverse lorsque la distance cumulée a déjà été calculée et en ce qu'à la fin de l'étape de traitement d'un symbole reçu, cet indicateur est réinitialisé pour chaque ligne de la mémoire.