Brevet FR2857798A1 — publié le 20050121

AMPLIFICATEUR DE TENSION A FAIBLE CONSOMMATION DOMAINE TECHNIQUE ET ART ANTERIEUR L'invention concerne un amplificateur de tension à faible consommation. L'amplificateur de tension à faible consommation selon l'invention peut être utilisé dans tout domaine de l'Electronique. Selon une application 10 particulièrement avantageuse, l'amplificateur de tension à faible consommation selon l'invention est un amplificateur tension/tension de détecteur de photons X ou gamma. Le schéma de principe d'un détecteur de 15 photons X ou gamma fonctionnant en comptage de photons est représenté en figure 1. Le détecteur comprend un détecteur élémentaire 1, polarisé par une tension Vpol, qui transforme chaque photon détecté en une impulsion de courant, un amplificateur charge/tension A qui 20 intègre le courant délivré par le détecteur élémentaire pendant la durée de l'impulsion et transforme la charge obtenue en une tension, un amplificateur tension/tension 5 qui amplifie le signal délivré par l'amplificateur charge/tension et limite la bande 25 passante de ce signal afin de réduire le bruit du détecteur, un comparateur 6 qui compare la tension délivrée par l'amplificateur 5 avec une tension de seuil Vth et un compteur 7. L'amplificateur A est généralement constitué d'un amplificateur opérationnel 2 dont l'entrée inverseuse (-) est reliée au détecteur élémentaire 1 et dont l'entrée non inverseuse (+) e.st reliée à la masse du circuit, une résistance 3 et un condensateur 4 étant montés en parallèle entre l'entrée inverseuse (-) et la sortie de l'amplificateur opérationnel 2. De façon générale, les performances demandées à l'amplificateur tension/tension 5 sont les suivantes: - être capable de traiter des flux d'impulsions 10 rapides (par exemple, plusieurs millions d'impulsions par seconde) ; - être faible bruit; - consommer peu; - avoir une impédance d'entrée élevée (de façon à 15 pouvoir être attaqué par l'amplificateur charge/tension situé en amont dont l'impédance de sortie est élevée) ; être réalisable en circuit intégré afin d'être peu encombrant; - s'adapter au niveau de la tension de repos de l'amplificateur charge/tension situé en amont, qui peut ne pas être bien établi du fait de variations du courant de repos du détecteur élémentaire ou de dispersions technologiques. La figure 2 représente un amplificateur tension/tension 5 de l'art connu. L'amplificateur comprend un transistor MOS T (MOS pour Metal Oxide Semiconductor ), un premier condensateur de capacité Ca ayant une première armature reliée à la grille du 30 transistor T, un deuxième condensateur de capacité Cb monté entre la grille et le drain du transistor T, une résistance r montée en parallèle du deuxième condensateur de capacité Cb et un générateur de courant i monté entre une tension d'alimentation Vdd et le drain du transistor T dont la source est reliée à la 5 masse. L'entrée E de l'amplificateur est constituée par la deuxième armature du premier condensateur de capacité Ca et la sortie S de l'amplificateur par le drain du transistor T. Le gain nominal G de l'amplificateur s'écrit alors: G = - Ca/Cb La résistance r permet, d'une part, de stabiliser le potentiel sur la grille du transistor T, et, d'autre part, de régler la fréquence de coupure basse du circuit. Un tel amplificateur présente plusieurs limitations. En particulier, la contre-réaction (r, Cb) conduit la grille du transistor T à apparaître, en alternatif, comme une masse virtuelle pour l'étage situé en amont. La recherche d'un gain élevé, et donc 20 d'une valeur de capacité Ca élevée, conduit alors à charger l'étage situé en amont et, partant, à faire consommer ce dernier de façon importante. La consommation globale de l'amplificateur peut alors devenir importante et atteindre plusieurs dizaines, 25 voire plusieurs centaines, de microwatts. L'amplificateur selon invention ne présente pas cet inconvénient. EXPOSE DE L'INVENTION En effet, l'invention concerne un amplificateur de 30 tension comprenant un premier transistor à effet de champ ayant une grille, un drain et une source, la borne d'entrée et la borne sortie de l'amplificateur étant formées respectivement par la grille et par le drain du premier transistor à effet de champ, caractérisé en ce qu'il comprend: - un premier générateur de courant qui charge le drain du premier transistor; - un deuxième générateur de courant qui charge la source du premier transistor, la valeur du courant délivré par le deuxième générateur de 10 courant étant sensiblement égale à la valeur du courant délivré par le premier générateur de courant; - un premier condensateur ayant une première borne reliée au drain du premier transistor et une 15 deuxième borne reliée à une première tension de référence; et - un deuxième condensateur ayant une première borne reliée à la source du premier transistor et une deuxième borne reliée à une deuxième tension de 20 référence. Les première et deuxième tensions de référence peuvent être une même tension, par exemple, la tension de référence du circuit (masse). Selon une caractéristique supplémentaire de 25 l'invention, l'amplificateur comprend un circuit d'asservissement de la tension de sortie qu'il délivre. Selon encore une caractéristique supplémentaire de l'invention, le circuit d'asservissement est constitué d'une résistance 30 connectée entre le drain du premier transistor et une tension fixe. Selon encore une caractéristique supplémentaire de l'invention, le circuit d'asservissement est constitué d'un circuit de lecture dont l'entrée reçoit la tension de sortie de 5 l'amplificateur et dont la sortie délivre un signal de commande de la grille d'un transistor qui constitue le premier ou le second générateur de courant. Selon encore une caractéristique supplémentaire de l'invention, l'amplificateur comprend 10 un filtre passe-bas placé en sortie du circuit de lecture pour filtrer le signal de commande délivré par le circuit de lecture. Selon encore une caractéristique supplémentaire de l'invention, le circuit de lecture 15 est un suiveur de tension. Selon encore une caractéristique supplémentaire de l'invention, le circuit de lecture est un amplificateur différentiel à deux entrées, la tension de sortie de l'amplificateur étant appliquée 20 sur une première entrée de l'amplificateur différentiel et une tension de référence étant appliquée sur la deuxième entrée de l'amplificateur différentiel. Selon encore une caractéristique supplémentaire de l'invention, le circuit de lecture 25 est un amplificateur qui amplifie les variations de la tension de sortie de l'amplificateur par rapport à une tension de référence déterminée à partir d'une tension de réglage. Selon encore une caractéristique supplémentaire de l'invention, le circuit d'asservissement est constitué d'un transistor MOS - l monté en grille commune et dont la source est connectée à la sortie de l'amplificateur. Selon encore une caractéristique supplémentaire de l'invention, l'amplificateur comprend 5 un transistor à effet de champ supplémentaire de type opposé au premier transistor à effet de champ, la grille et le drain du transistor à effet de champ supplémentaire étant respectivement reliés à la grille et au drain du premier transistor à effet de champ, la 10 source du transistor à effet de champ supplémentaire étant reliée au premier générateur de courant et à une première borne d'un condensateur supplémentaire dont la deuxième borne est reliée à une tension fixe. Selon encore une caractéristique supplémentaire de l'invention, l'amplificateur comprend un transistor à effet de champ supplémentaire de type opposé au premier transistor à effet de champ, le drain du transistor supplémentaire étant relié au drain du premier transistor à effet de champ, la grille du 20 transistor supplémentaire étant reliée à une tension différente de la tension appliquée sur la grille du premier transistor à effet de champ, la source du transitor à effet de champ supplémentaire étant reliée au premier générateur de courant et à une première 25 borne d'un condensateur supplémentaire dont la deuxième borne est reliée à une tension fixe. Selon encore une caractéristique supplémentaire de l'invention, l'amplificateur comprend un circuit de décalage de tension pour former la 30 tension appliquée sur la grille du transistor supplémentaire à partir de la tension appliquée sur la grille du premier transistor à effet de champ. Selon encore une caractéristique supplémentaire de l'invention, le circuit de décalage de tension est une source de tension extérieure. Selon encore une caractéristique supplémentaire de l'invention, le circuit de décalage de tension est une diode polarisée en direct. Selon encore une caractéristique supplémentaire de l'invention, l'amplificateur est réalisé en technologie MOS. L'invention concerne également un détecteur de photons X ou gamma comprenant un amplificateur charge/tension et un amplificateur tension/tension qui 15 amplifie la tension délivrée par l'amplificateur charge/tension, caractérisé en ce que l'amplificateur tension/tension est un amplificateur selon l'invention. BREVE DESCRIPTION DES FIGURES D'autres caractéristiques et avantages de 20 l'invention apparaîtront à la lecture de modes de réalisation préférentiels de l'invention faits en référence aux figures jointes parmi lesquelles: - la figure 1 représente un schéma de principe de détecteur de photons X ou gamma selon l'art 25 connu; - la figure 2 représente un schéma électrique d'amplificateur tension/tension de détecteur de photons X ou gamma selon l'art connu; - la figure 3 représente un schéma électrique 30 d'amplificateur tension/tension selon l'invention; - les figures 4A, 4B, 5A et 5B représentent différentes variantes d'un premier perfectionnement d'amplificateur tension/tension selon l'invention; - la figure 6 représente un deuxième perfectionnement d'amplificateur tension/tension selon l'invention; - la figure 7 représente une première variante du 10 deuxième perfectionnement représenté en figure 6; - la figure 8 représente une deuxième variante du deuxième perfectionnement représenté en figure 6; - la figure 9 représente un exemple de réalisation d'amplificateur tension/tension selon l'invention. Sur toutes les figures, les mêmes références désignent les mêmes éléments. 20 DESCRIPTION DETAILLEE DE MODES DE MISES EN EUVRE DE L'INVENTION La figure 3 représente un schéma électrique d'un amplificateur tension/tension selon l'invention. L'amplificateur tension/tension comprend un transistor MOS Ml, un premier générateur de courant Il, un premier condensateur de capacité Cl, un deuxième générateur de courant I0 et un deuxième condensateur de capacité CO. Le montage est décrit, à titre d'exemple, 30 avec un transistor MOS de type N. L'homme de l'art peut transposer ce montage sans effort avec un transistor MOS de type P. L'amplificateur est alimenté entre une tension de polarisation Vdd et une tension de 5 référence, par exemple la masse. La borne d'entrée E et la borne de sortie S de l'amplificateur sont respectivement la grille et le drain du transistor Mi. Le drain du transistor est relié à une première borne du premier générateur de courant Il dont 10 la deuxième borne est reliée à la tension d'alimentation Vdd. Le premier condensateur de capacité Cl a une première borne reliée au drain du transistor Ml et une deuxième borne reliée à la masse. La source du transistor Ml est reliée à une première borne du 15 deuxième générateur de courant I0 dont la deuxième borne est reliée à la masse. Le deuxième condensateur de capacité CO est monté en parallèle du deuxième générateur de courant I0. Le fontionnement de l'amplificateur va 20 maintenant être décrit. Au départ, le transistor Ml ne conduit pas. Le générateur de courant I0 injecte des électrons sur la source du transistor Ml, lesquels électrons sont stockés dans le condensateur de capacité CO, entraînant 25 la chute du potentiel de source VA, jusqu'à ce que le transistor Ml se mette à conduire. Le potentiel de source VA se stabilise lorsque le courant qui parcourt le transistor Ml devient égal à I0. Tant que le transistor M1 ne conduit pas, la tension de sortie VS 30 de l'amplificateur est égale à la tension d'alimentation Vdd. A partir du moment où le transistor Ml conduit le courant I0, si les courants Il et I0 sont sensiblement égaux, la borne de sortie S reçoit une somme de courants nulle et la tension de sortie VS peut a priori se stabiliser à une valeur quelconque entre 5 VE-VT et Vdd, où VE est la tension d'entrée de l'amplificateur et VT la tension de seuil du transistor Mi. Supposons la tension de sortie VS égale à une tension de repos VS0. Si l'étage en amont de 10 l'amplificateur module la tension d'entrée VE d'une quantité AVE positive, alors le transistor Ml conduit temporairement davantage et le potentiel VA croît jusqu'à ce que le courant qui parcourt le transistor Ml se stabilise de nouveau à la valeur I0. Il vient 15 alors: VA = VE-VT + AVE. La charge Q01 transmise par le transistor Ml, de la source vers le drain du transistor M1, pendant la durée Atl du phénomène transitoire décrit 20 ci-dessus s'écrit alors: Q01 = -I0 x Atl - CO x AVE Pendant cette même durée Atl, la charge Q1 délivrée par le générateur de courant Il sur la borne de sortie S s'écrit: Q1 = Il x Atl, soit Q1 _ I0 x Atl La variation de charge AQ1 sur la borne de sortie S s'écrit alors: AQ1 _ - CO x AVE, ce qui génère une variation de tension telle que: AVS - (C0/Cl) x AVE. Pendant la durée du transitoire où apparaît la tension AVE, l'amplificateur présente ainsi un gain négatif égal à - (C0/C1). Un échelon d'entrée est alors transformé en un échelon de sortie. Lorsque la tension VE revient à son état de repos, et donc varie d'une quantité AVE négative, le transistor Ml conduit temporairement moins. La tension VA diminue jusqu'à ce que le courant qui parcourt le 10 transistor se stabilise de nouveau à la valeur I0. La tension VA s'écrit alors: VA _ VE - VT. La charge Q02 transmise par le transistor Ml, de la source vers le drain, pendant la durée At2 de 15 ce phénomène transitoire s'écrit alors: Q02 = I0 x At2 + CO x AVE Pendant ce même temps At2, la charge Q2 délivrée par le générateur de courant I0 sur la borne de sortie S s'écrit: Q2 = Il x At2, soit Q2 - I0 x At2 La variation de charge AQ2 sur la borne S s'écrit donc: AQ2 _ CO x AVE ce qui génère une variation de tension AVs telle que: AVS _ (CO /C1) x AVE Cette variation étant l'opposé de la variation précédente, la tension de sortie VS revient à sa valeur de repos. L'amplificateur de tension proposé selon l'invention est un amplificateur de tension de gain négatif -(C0/C1). Les principaux avantages d'un tel circuit peuvent être énumérés comme suit: - l'étage situé en amont de l'amplificateur ne voit comme charge que la faible capacité de grille du transistor Ml, - si la valeur de repos de la tension d'entrée VE varie, cela change le point d'équilibre de la 10 source du transistor M1 (VA VE - VT) et, partant, cela change l'excursion de tension possible pour la tension de sortie VS (de VA à Vdd), alors que cela ne change ni la valeur de repos de la tension de sortie VS, ni le gain du 15 montage. La tension VS disponible en sortie de l'amplificateur est délivrée sous haute impédance. Cela nécessite donc que l'étage aval soit lui-même un étage à haute impédance. Ceci est facilement réalisable à 20 l'aide de circuits intégrés, en particulier de circuits intégrés MOS pour lesquels l'impédance d'entrée de l'étage aval peut être purement capacitive et élevée du fait de la faible taille des transistors (faible capacité de grille). Il faut également noter qu'à la 25 capacité de sortie Cl s'ajoute la capacité parasite de liaison entre l'amplificateur et l'étage aval. Là encore, des circuits intégrés permettent de minimiser les capacités parasites. Il est souhaitable de réaliser une égalité 30 des courants IO et Il de façon aussi précise que possible, afin que la tension VS puisse se stabiliser entre la tension VE - VT et la tension Vdd. Du fait des dispersions technologiques, une égalité quasi-parfaite entre I0 et Il ne peut généralement pas être obtenue par simple dimensionnement des composants qui 5 constituent le circuit. L'égalité quasi-parfaite entre I0 et Il est alors obtenue à l'aide d'un dispositif d'asservissement. Les figures 4A, 4B, 5A et 5B représentent différentes variantes d'un premier perfectionnement de 10 l'invention selon lequel l'amplificateur comprend un dispositif d'asservissement. La figure 4A représente une première variante de ce premier perfectionnement. Selon cette première variante, l'amplificateur comprend tous les éléments déjà décrits en référence à la figure 3 avec, en plus, une résistance Rl. La résistance Rl a une première borne connectée au drain du transistor Ml et une deuxième borne connectée à la tension Vdd. Selon d'autres modes 20 de réalisation, la deuxième borne de la résistance R1 peut être connectée à une tension fixe différente de la tension Vdd, comme par exemple la masse. L'ensemble constitué par la source de courant Il et la résistance Ri est alors une source de 25 courant non parfaite, de valeur nominale Il, avec une résistance de sortie Rl. Par construction, le courant Il est ici choisi de valeur inférieure à I0. La tension VS se stabilise lorsque la relation suivante est réalisée: Vdd - VS= Rl x (I0 -Il), soit VS = Vdd Rl x (I0 - Il) Dans le cas où la deuxième borne de la résistance Ri est connectée à la masse, par construction le courant Il est alors choisi supérieur au courant IO. Le courant circulant dans la résistance 5 Ri est alors égal à I1-I0 et les équations qui expriment la tension VS sont modifiées en conséquence. Le circuit selon la première variante du premier perfectionnement de l'invention ne passe pas les variations très basse fréquence de la tension 10 d'entrée VE. La tension de sortie revient alors vers son point d'équilibre avec la constante de temps RlCl. Ceci est avantageux, car il est généralement demandé à un amplificateur de tension de circuit de détection de rayons X ou gamma d'être passe- bande (fonction 15 shaper ). Si la fréquence de coupure basse est définie par la constante de temps RIC1, la fréquence de coupure haute est, quant à elle, définie par la vitesse de transfert des charges du condensateur de capacité CO 20 vers le condensateur de capacité Cl, c'est-à-dire par la constante de temps (1/gm) x CO, où gm est la transconductance du transistor M1, elle-même définie par le choix du courant I0. L'amplificateur à asservissement représenté 25 en figure 4A régule le courant qui circule dans la résistance Rl de façon que la somme du courant Il et du courant qui parcourt la résistance Rl soit égale à I0. La figure 4B représente une deuxième variante du premier perfectionnement de l'invention. Selon cette deuxième variante, l'amplificateur comprend tous les éléments déjà décrits en référence à la figure 3 avec, en plus, un transistor MOS TM monté en grille commune et dont la source est connectée à la sortie de l'amplificateur. La grille du transistor TM est alors connectée à une tension fixe VG telle que: VG = VS - VTmos, où VTmos est la tension de seuil du transistor TM et VS la tension de sortie de l'amplificateur. Le transistor TM, fonctionnant en régime saturé, 10 présente alors un comportement fortement non linéaire en fonction de la tension VS. Un tel montage est particulièrement bien adapté lorsque le signal d'entrée de l'amplificateur est formé d'impulsions. Le transistor TM peut être de type N ou de type P. 15 Dans le cas où le transistor TM est de type N (figure 4B), son drain est connecté à la tension Vdd et son substrat est à la masse. Le courant Il est alors inférieur au courant I0 et le montage est adapté à la présence d'impulsions négatives en entrée de 20 l'amplificateur. Dans le cas où le transistor TM est de type P (non représenté sur les figures), son drain est connecté à la masse et son substrat est connecté à la tension Vdd. Dans ce cas, le courant Il est supérieur 25 au courant I0 et le montage est adapté à la présence d'impulsions positives en entrée de l'amplificateur. Deux autres variantes d'amplificateur à asservissement selon le premier perfectionnement de l'invention sont représentées aux figures 5A et 5B. 30 Seul le circuit représenté en figure 5A sera décrit, le circuit représenté en figure 5B se déduisant à l'évidence du circuit représenté en figure 5A. Selon le deuxième exemple d'amplificateur tension/tension à asservissement selon l'invention, l'amplificateur comprend tous les éléments déjà décrits 5 en référence à la figure 3 avec, en plus, un circuit de lecture As et un filtre passe-bas constitué d'une résistance R2 en série avec un condensateur de capacité C2. Le générateur de courant Il est ici réalisé 10 par un transistor M2a de type P dont le drain, la source et la grille sont reliés, respectivement, au drain du transistor Ml, à la tension d'alimentation Vdd et au point intermédiaire entre R2 et C2. L'entrée du circuit As est reliée aux drains des transistors Ml et 15 M2a (i.e. la sortie S de l'amplificateur). Une première borne du filtre constitué par la résistance R2 en série avec le condensateur de capacité C2 est reliée à la sortie du circuit de lecture As, la deuxième borne du filtre, ou point intermédiaire, étant reliée à la 20 grille du transistor M2a. La tension de sortie VS est lue par le circuit de lecture As qui reproduit les variations de tension VS avec un gain positif pas nécessairement constant, et avec une tension d'offset pas 25 nécessairement nulle. La sortie du circuit de lecture As est filtrée en basse fréquence par le circuit (R2, C2). La tension filtrée est appliquée à la grille du transistor M2a. La valeur de repos de la tension VS est 30 celle qui produit sur la grille du transistor M2a, via le circuit de lecture As, une tension telle que le courant Il qui parcourt le transistor M2a soit égal au courant I0. Le circuit de lecture As peut être réalisé de différentes manières. Ainsi, le circuit As peut-il 5 être un suiveur de tension de gain sensiblement égal à l'unité. Le circuit As peut également être un amplificateur différentiel à deux entrées, la tension VS étant appliquée sur une première entrée et une tension de référence étant appliquée sur la deuxième 10 entrée. Dans ce dernier cas, la tension de sortie VS se stabilise à une valeur sensiblement égale à la tension de référence. Un troisième exemple est celui où le circuit As amplifie les variations de la tension VS par rapport à une tension de référence déterminée à partir 15 d'une tension de réglage, comme cela apparaîtra, à titre d'exemple, à la figure 9. Afin d'assurer la stabilité du montage, le circuit de lecture As est conçu pour introduire un faible déphasage. L'amplificateur selon les deux 20 variantes décrites aux figures 5A et 5B ne passe pas le continu. La fréquence de coupure basse est définie par la constante de temps R2C2. La fréquence de coupure haute est définie, comme précédemment, par (1/gm) x CO. Selon le schéma de la figure 5A, le 25 générateur de courant I0 est maître et le générateur de courant Il est asservi. La figure 5B représente la variante selon laquelle le générateur de courant Il est maitre et le générateur de courant I0, réalisé à l'aide d'un transistor M2b, est asservi. La figure 6 représente un deuxième perfectionnement de l'amplificateur tension/tension selon l'invention. Selon ce deuxième perfectionnement, l'amplificateur comprend des moyens pour accroître le gain de l'amplificateur. L'amplificateur tension/tension selon le 5 deuxième perfectionnement de l'invention comprend tous les éléments déjà décrits en référence à la figure 3 avec, en plus, un transistor M3 et un condensateur de capacité C01. Le transistor M3 est un transistor MOS de type P monté en série entre le transistor Ml et le 10 générateur de courant Il, le drain, la source et la grille du transistor M3 étant reliés, respectivement, au drain du transistor Ml, au générateur de courant Il et à l'entrée E de l'amplificateur. L'entrée E de l'amplificateur est donc reliée aux grilles des 15 transistors Ml et M3. Le condensateur de capacité C01 a une première borne reliée à la source du transistor M3 et une deuxième borne reliée à la masse du circuit. De même que précédemment, l'égalité précise entre les courants I0 et Il peut être assurée par un 20 dispositif d'asservissement, lequel n'est pas représenté sur la figure 6 afin de ne pas alourdir le dessin. Le dispositif d'asservissement est alors réalisé, par exemple, par l'un quelconque des dispositifs d'asservissement décrits précédemment (cf. 25 figures 4A-5B). Les transistors Ml et M3 sont en régime saturé. Il s'en suit que: VS > VE - VT(Ml), et VS Lorsque la tension d'entrée VE croît, le courant qui parcourt le transistor Ml croît et le courant qui parcourt le transistor M3 diminue. A la fin d'un transitoire de tension d'entrée AVE, il vient: AVS = (C0/Cl+C01/Cl) x AVE Avantageusement, le gain de l'amplificateur est donc accru. Si, par exemple, les capacités CO et C01 sont sensiblement égales, le gain est doublé alors que la consommation demeure inchangée. Une autre variante du perfectionnement de l'invention est représentée en figure 7. Cette autre variante s'applique préférentiellement au cas où l'étage amont délivre simultanément une tension de sortie sous la forme de deux tensions de repos 20 différentes. Dans le cas où l'étage amont ne délivre qu'une seule tension de sortie, il est clair, pour l'homme de l'art, qu'une duplication de tension peut se réaliser à l'aide d'un étage intermédiaire, par exemple en utilisant la chute de tension qui apparaît aux 25 bornes d'une diode polarisée en direct. Le schéma de la figure 7 illustre, de façon symbolique, la duplication de la tension de sortie de l'étage amont sous la forme d'une tension de décalage Vdec appliquée entre la grille du transistor M3 et la grille du transistor Ml. 30 La tension VE est ainsi appliquée sur la grille du transistor Ml et la tension VE + Vdec sur la grille du transistor M3. Dans le cas où la tension Vdec est négative, la valeur minimale nécessaire de la tension d'alimentation Vdd est réduite et il est possible, en 5 conséquence, de réduire la puissance dissipée (mais alors l'excursion de la tension VS se trouve également réduite) . A l'inverse, dans le cas où la tension Vdec est positive, la valeur minimale de la tension d'alimentation Vdd est augmentée et il est possible, en 10 conséquence, d'augmenter l'excursion de la tension VS (mais alors la puissance dissipée se trouve également augmentée). La figure 8 représente une variante du perfectionnement représenté en figure 6. En plus des éléments représentés en figure 6, le circuit de la figure 8 comprend un montage cascode constitué de deux transistors MK1 et MK2, respectivement de type P et N, montés en série entre les transistors M3 etMI. La source du transistor MK1 20 est reliée au drain du transistor M3 et la source du transistor MK2 est reliée au drain du transistor Mi. Les drains des transistors Mkl et MK2 sont reliés entre eux et constituent la sortie de l'amplificateur de tension. Les tensions VK1 et VK2 respectivement 25 appliquées sur la grille du transistor MK1 et sur la grille du transistor MK2 sont ajustées pour assurer la polarisation en mode cascode. Un avantage du circuit représenté en figure 8 est de réduire les capacités Miller du montage et, en conséquence, de réduire la 30 charge vue par l'étage situé en amont. Le circuit représenté en figure 8 comprend, à titre d'exemple, un montage cascode à deux transistors. L'invention concerne également des circuits dont le montage cascode ne comprend, par exemple, qu'un seul transistor. La figure 9 représente un circuit électrique en technologie MOS illustrant un exemple de réalisation d'amplificateur selon l'invention. Le circuit électrique de la figure 9 correspond à un amplificateur dont le schéma de principe est celui de 10 la figure 7 et qui comprend un dispositif d'asservissement tel que représenté en figure 5B. Il s'en suit que le circuit électique illustré en figure 9 comprend les générateurs de courant Il et I0, les transistors Ml et M3, les condensateurs de capacités 15 respectives CO, Cl, C01, C2, l'amplificateur de lecture As et la résistance R2, tous ces composants étant réalisés à l'aide de transistors MOS. Le circuit représenté en figure 9 comprend également un circuit de polarisation P de la grille du transistor qui constitue 20 le générateur de courant Il. Le circuit de polarisation P est alimenté par une tension Vddimage qui est également la tension d'alimentation de l'amplificateur de lecture As. L'amplificateur de lecture As est conforme au troisième exemple d'amplificateur de 25 lecture mentionné précédemment et, en conséquence, amplifie les variations de la tension de sortie VS par rapport à une tension de référence déterminée à partir d'une tension de réglage Vr. Le circuit électrique représenté en figure 30 9 est conçu pour amplifier, avec un gain négatif, des impulsions de tension positives qui sont appliquées sur l'entrée E par rapport à un niveau de repos de la tension d'entrée. Le montage est polarisé entre une tension Vdd et la masse. REVENDICATIONS 1. Amplificateur de tension comprenant un 5 premier transistor à effet de champ (M1) ayant une grille, un drain et une source, la borne d'entrée et la borne sortie de l'amplificateur étant formées respectivement par la grille et par le drain du premier transistor à effet de champ, caractérisé en ce qu'il 10 comprend: - un premier générateur de courant (Il) qui charge le drain du premier transistor (Ml) ; - un deuxième générateur de courant (I0) qui charge la source du premier transistor (Ml), la valeur 15 du courant délivré par le deuxième générateur de courant (I0) étant sensiblement égale à la valeur du courant délivré par le premier générateur de courant (Il) ; - un premier condensateur (Cl) ayant une première 20 borne reliée au drain du premier transistor (Ml) et une deuxième borne reliée à une première tension de référence; et - un deuxième condensateur (CO) ayant une première borne reliée à la source du premier transistor 25 (M1) et une deuxième borne reliée à une deuxième tension de référence. 2. Amplificateur selon la revendication 1, caractérisé en ce qu'il comprend un circuit 30 d'asservissement de la tension de sortie qu'il délivre. 3. Amplificateur selon la revendication 2, caractérisé en ce que le circuit d'asservissement est constitué d'une résistance (Ri) connectée entre le drain du premier transistor (Ml) et une tension fixe. 4. Amplificateur selon la revendication 2, caractérisé en ce que le circuit d'asservissement est constitué d'un circuit de lecture (As) dont l'entrée reçoit la tension de sortie (VS) de l'amplificateur et 10 dont la sortie délivre un signal de commande de la grille d'un transistor (M2a, M2b) qui constitue le premier ou le second générateur de courant. 5. Amplificateur selon la revendication 4, 15 caractérisé en ce qu'il comprend un filtre passe-bas (R2, C2) placé en sortie du circuit de lecture pour filtrer le signal de commande délivré par le circuit de lecture (As). 6. Amplificateur selon la revendication 4 ou 5, caractérisé en ce que le circuit de lecture (As) est un suiveur de tension. 7. Amplificateur selon la revendication 4 25 ou 5, caractérisé en ce que le circuit de lecture (As) est un amplificateur différentiel à deux entrées, la tension de sortie de l'amplificateur étant appliquée sur une première entrée de l'amplificateur différentiel et une tension de référence étant appliquée sur la 30 deuxième entrée de l'amplificateur différentiel. 8. Amplificateur selon la revendication 4 ou 5, caractérisé en ce que le circuit de lecture (As) est un amplificateur qui amplifie les variations de la tension de sortie (VS) de l'amplificateur par rapport à une tension de référence déterminée à partir d'une tension de réglage (Vr). 9. Amplificateur selon la revendication 2, caractérisé en ce que le circuit d'asservissement est 10 constitué d'un transistor MOS monté en grille commune (TM) et dont la source est connectée à la sortie de l'amplificateur. 10. Amplificateur selon l'une quelconque 15 des revendications précédentes, caractérisé en ce qu'il comprend un transistor à effet de champ supplémentaire (M3) de type opposé au premier transistor à effet de champ (Ml), la grille et le drain du transistor à effet de champ supplémentaire (M3) étant respectivement 20 reliés à la grille et au drain du premier transistor à effet de champ (Ml), la source du transitor à effet de champ supplémentaire étant reliée au premier générateur de courant (Il) et à une première borne d'un condensateur supplémentaire (C01) dont la deuxième 25 borne est reliée à une tension fixe. 11. Amplificateur selon l'une quelconque des revendications précédentes, caractérisé en ce qu'il comprend un transistor à effet de champ supplémentaire 30 (M3) de type opposé au premier transistor à effet de champ (MI), le drain du transistor supplémentaire (M3) étant relié au drain du premier transistor à effet de champ (Ml), la grille du transistor supplémentaire (M3) étant reliée à une tension différente de la tension appliquée sur la grille du premier transistor à effet 5 de champ (Ml), la source du transitor à effet de champ supplémentaire étant reliée au premier générateur de courant (Il) et à une première borne d'un condensateur supplémentaire (C01) dont la deuxième borne est reliée à une tension fixe. 12. Amplificateur selon la revendication 11, caractérisé en ce qu'il comprend un circuit de décalage de tension pour former la tension appliquée sur la grille du transistor supplémentaire (M3) à 15 partir de la tension appliquée sur la grille du premier transistor à effet de champ (Ml). 13. Amplificateur selon la revendication 12, caractérisé en ce que le circuit de décalage de 20 tension est une source de tension extérieure. 14. Amplificateur selon la revendication 12, caractérisé en ce que le circuit de décalage de tension est une diode polarisée en direct. 25 15. Amplificateur selon l'une quelconque des revendications précédentes, caractérisé en ce qu'il est réalisé en technologie MOS. 16. Détecteur de photons X ou gamma comprenant un amplificateur charge/tension et un amplificateur tension/tension qui amplifie la tension délivrée par l'amplificateur charge/tension, caractérisé en ce que l'amplificateur tension/tension est un amplificateur selon l'une quelconque des revendications 1 à 15.