Brevet FR2814282A1 — publié le 20020322

La présente invention concerne le domaine des circuits intégrés et plus particulièrement les dispositifs électriques tels que des transistors MOS à grille. Des dispositifs à semi-conducteurs sous la forme de circuits intégrés sont largement répandus dans la plupart des dispositifs électroniques. Par exemple, des ordinateurs, des téléphones cellulaires et d'autres dispositifs analogues comprennent de manière typique un ou plusieurs circuits intégrés (CI). De plus, de nombreux types de CI typiques sont basés sur la technologie à semiconducteurs en oxyde de métal (MOS), dans laquelle chaque transistor comprend des régions de source et des régions de drain dopées dans un substrat semi-conducteur, avec un région de puits ou de puits entre le drain et la source. Une configuration particulière du transistor à effet de champ (FET) MOS qui est couramment utilisée pour des applications électriques intenses, est celle que l'on appelle MOSFET à tranche (s). Dans cette configuration, une couche semi-conductrice est formée sur un substrat et dopée pour former une région de puits sur une surface de la couche semi-conductrice opposée au substrat. Des tranches sont taillées dans la région de puits, habituellement vers le bas, vers la couche semi-conductrice, de manière à définir plusieurs parties de corps ou colonnes qui s'étendent vers l'extérieur à partir de la couche semi-conductrice. Un dispositif MOS à grille est formé dans les tranches, qui comprend une couche d'oxyde adjacente à la tranche et à une partie correspondante de la couche semiconductrice, et qui comprend une couche conductrice (par exemple du polysilicone) adjacente à la couche d'oxyde. Des régions de source sont dopées sur les surfaces des colonnes et le substrat et la couche semi-conductrice définissent une région de drain. Des régions de puits s'étendent entre les régions de source et la région de drain. Alors que la configuration des MOSFET les rend particulièrement appropriés à la gestion de grandes quantités de courant, un inconvénient des dispositifs MOSFET typiques réside dans le fait qu'un champ électrique intense a tendance à se former dans le fond de la tranche, par exemple près de la jonction entre la couche d'oxyde sur la grille et la couche semi-conductrice. Ce champ peut entraîner une rupture de la couche d'oxyde due à l'injection d'un porteur chargé, que l'on appelle couramment le vieillissement du à un porteur chargé. Le brevet américain N 6, 804, 264 de Darwish et autres, intitulé"Trench MOSFET Having Improved Breakdown and On-Resistance Characteristics" ("MOSFET à tranche (s) pourvu de caractéristiques de résistance accrues à la panne"), constitue une tentative menée dans l'art antérieur pour solutionner ce problème. Le brevet présente un MOSFET à tranche (s) comprenant une couche épitaxiale de type P qui recouvre un substrat N+. Une région de drain de type N est implantée dans le fond de la tranche, dans la couche épitaxiale, et il est diffusé de manière à s'étendre à partir du fond de la tranche jusqu'au substrat. De cette façon, une jonction est créée entre la région de drain et la couche épitaxiale et elle s'étend à partir de la tranche jusqu'au substrat. Cependant, cette structure peut présenter un inconvénient en raison du fait que le dopant utilisé pour former les régions de drain doit s'étendre bien au-delà du fond de la tranche pour atteindre le substrat. En d'autres termes, il peut être difficile de fournir les énergies et les dosages d'implantation requis pour former lesdites régions de drain en raison de la diffusion du porteur inhérente au processus d'implantation. La diffusion du porteur peut avoir pour conséquence que les parois de la tranche soient implantées avec un dopant dont la polarité est incorrecte ce qui, à son tour, peut abaisser de façon irrégulière le seuil du dispositif et entraîner des effets de réduction de la conductivité du puits. Au vu de l'arrière-plan qui précède, la présente invention a donc pour objectif de fournir un dispositif à circuit intégré qui soit moins susceptible d'être soumis au vieillissement par porteur chargé. Outre cet objectif, selon la présente invention, d'autres objectifs, caractéristiques et avantages peuvent être atteints grâce à un dispositif à circuit intégré comprenant une couche semi-conductrice d'un premier type de conductivité, une pluralité de colonnes semi-conductrices espacées les unes par rapport aux autres, qui s'étendent vers l'extérieur à partir de ladite couche semiconductrice et qui définissent des tranches entre elles, une structure de grille respective dans chaque tranche, et au moins une région de puits profond d'un second type de conductivité et positionnée de manière à s'étendre dans ladite couche semi-conductrice entre une paire adjacente de colonnes semi- conductrices correspondantes, et sous le fond d'au moins une tranche, définissant de la sorte au moins une structure de grille inactive. Chaque colonne semiconductrice peut être d'un second type de conductivité opposé au premier type de conductivité. Ladite au moins une région de puits profond peut être positionnée de telle sorte qu'au moins une tranche ne comprenne pas de région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active. Ladite au moins une région de puits profond réduit de façon considérable la formation d'un champ électrique intense dans le fond des structures de grille actives et réduit par là-même l'injection de porteur chargé dans les couches d'oxyde de la grille. Le dispositif peut comprendre une pluralité de régions de puits profond disposées de manière à définir des structures de grille actives et inactives alternées. Chaque colonne semi-conductrice comprend une partie supérieure du premier type de conductivité, et au moins une structure de grille inactive peut être connectée à la partie supérieure de chaque colonne semi-conductrice. Au moins une structure de grille inactive et au moins un structure de grille active peuvent être connectées ensemble. Chaque structure de grille peut comprendre une couche d'oxyde sur la grille, adjacente à la tranche, ainsi qu'une couche conductrice, telle qu'une couche de polysilicone, adjacente à la couche d'oxyde. En outre, un substrat semi-conducteur peut être incorporé de manière adjacente à la couche semiconductrice, sur un côté de celle-ci, opposé aux colonnes semi-conductrices. Le substrat semi-conducteur peut comprendre du silicium et peut même être plus fortement dopé que la couche semi-conductrice. Le substrat semi-conducteur peut être du premier type de conductivité, de manière à définir par-là même un transistor à effet de champ à semi-conducteur à oxyde métallique, ou d'un second type de conductivité, de manière à définir par-là même un transistor bipolaire isolé à grille, par exemple. Le premier type de conductivité peut correspondre au type N et le second type de conductivité peut correspondre au type P par exemple. Un procédé de fabrication d'un dispositif à circuit intégré selon la présente invention comprenant les étapes suivantes qui consistent à : (i) former une pluralité de colonnes semi-conductrices espacées les unes par rapport aux autres, adjacentes à une couche semi-conductrice d'un premier type de conductivité, qui s'étendent vers l'extérieur à partir de la couche semi-conductrice et qui définissent des tranches entre elles ; (ii) former une structure de grille respective dans chaque tranche ; et (iii) former au moins une région de puits profond du second type de conductivité, qui s'étend dans la couche semi-conductrice entre une paire adjacente de colonnes semi-conductrices correspondantes et sous le fond d'au moins une tranche, de manière à définir par-là même au moins une structure de grille inactive. Ladite au moins une région de puits profond peut être positionnée de telle sorte qu'au moins une tranche ne comprenne pas de région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active. En outre, chaque colonne semi-conductrice peut être d'un second type de conductivité opposé au premier type de conductivité. La figure 1 est une vue en coupe d'un dispositif MOSFET selon la présente invention comprenant une région de puits profond. La figure 2 est une vue en coupe d'un dispositif MOS à grille de l'art antérieur similaire, illustrant la formation d'un champ électrique intense dans le fond d'une tranche. La figure 3 est une vue en coupe d'un dispositif MOS à grille similaire selon la présente invention comprenant une région de puits profond étendue. Les figures 4 à 7 sont des vues en coupe schématiques illustrant la formation de la région de puits profond selon la présente invention. La figure 8 est une vue en coupe d'un dispositif IGBT selon un autre mode de réalisation de la présente invention. La présente invention va maintenant être décrite plus en détails, en faisant référence aux dessins annexés qui représentent des modes de réalisation préférés de l'invention. Cette invention peut toutefois être réalisée sous bien d'autres modes différents et ne doit pas être considérée comme se limitant aux modes de réalisation décrits dans le présent document. Ces modes de réalisation sont plutôt fournis afin de constituer une documentation aussi exhaustive et complète que possible afin de faire parfaitement comprendre le champ d'application de l'invention aux professionnels du métier. Tout au long de ce document, les mêmes numéros de référence se rapportent toujours aux mêmes éléments et les numéros de référence utilisés sur le premier mode de réalisation sont repris pour indiquer les éléments similaires dans les autres modes de réalisation. Sur les dessins, les dimensions des couches et des régions sont exagérées pour faciliter la compréhension. Si l'on se réfère maintenant au diagramme schématique principal de la figure 1, un dispositif MOSFET 20 selon un mode de réalisation de la présente invention est tout d'abord décrit. Le dispositif 20 est un dispositif à puits N qui comprend un substrat semi-conducteur de type N 21, une couche semiconductrice de type N 22 et des colonnes semi-conductrices espacées les unes par rapport aux autres, qui s'étendent vers l'extérieur à partir de la couche semiconductrice et définissent des tranches 24 entre elles. Les tranches 24 sont visibles sur les figures 5 à 7. Le substrat semi-conducteur 21 est adjacent à une couche de drain en métal 55, et la couche semi-conductrice 22, le substrat semiconducteur 21 et la couche de drain en métal 55 forment une région de drain 30. Le substrat semi-conducteur 21 est de préférence plus fortement dopé que la couche semi-conductrice 22. Par exemple, le substrat semi-conducteur 21 peut avoir une concentration de dopant de 5 x 1018 environ à 4 x 1013 cm-3 environ et une résistance de 0,002 à 0,01 Q. cm environ, alors que la couche semiconductrice 22 peut avoir une concentration de dopant de 5 x 1014 environ à 8 x 1016 cm environ et une résistance de 0,1 à 10 Q. cm environ. Le substrat semiconducteur 21 et la couche semi-conductrice 22 peuvent être tous les deux en silicium par exemple, et la couche semi-conductrice peut augmenter de manière épitaxiale. Chaque colonne semi-conductrice 23 comprend une partie de corps 25 (qui est de type P pour un dispositif à puits N) dopée dans la couche semi- conductrice 22, comme décrit plus en détails ci-dessous, ainsi qu'une partie supérieure comprenant une région de source 26 et une partie de contact de corps 27. Les parties de corps 25 peuvent avoir une concentration de dopant de 1 x 1016 environ à 1 x 1018 cm-3 environ par exemple. La région de source 26 est de type N pour un dispositif à puits N et elle est, de préférence, plus fortement dopée que la couche semi-conductrice 22. Par exemple, la région de source peut avoir une concentration de dopant de 1 x 1018 environ à 1 x 102 cm environ. La partie de contact de corps 27 est de type P pour un dispositif à puits N et elle est, de préférence, plus fortement dopée que la partie de corps 25 par exemple avec une concentration de dopant de 1 x 1018 environ à 1 x 1020 cm-3 environ par exemple. Une structure MOS respective à grille 57 est formée dans chaque tranche 24 et comprend une couche d'oxyde sur la grille 28 adjacente à la tranche, et une couche conductrice 29 adjacente à la couche d'oxyde sur la grille. La couche conductrice 29 peut être constituée d'un polysilicone par exemple qui est de type N pour le dispositif à puits N 20 et peut avoir une concentration de dopant de 1 x 1018 environ à 1 x 1021 cm-3 environ par exemple. Une couche de source en métal 50 peut être formée par-dessus les structures de grille, les régions de source 26 et les parties de contact de corps 27. Le dispositif 20 comprend également des régions de puits profond 35 qui sont du type P pour un dispositif à puits N. Chaque région de puits profond 35 est positionnée de manière à s'étendre dans la couche semi-conductrice 21 entre une paire adjacente de colonnes semi-conductrices 23 et sous le fond d'une tranche correspondante 24 de manière à définir par-là même une structure de grille inactive 57b. Les régions de puits profond 35 sont également espacées de telle sorte qu'au moins une tranche ne comprenne pas une région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active 57a. La région de puits profond 35 a de préférence une concentration de dopant comparable à celle de la partie de corps 25 indiquée ci-dessus (c'est à dire de 1 x 1016 environ à 1 x 1018 cm-3 environ). En outre, les parties de contact de corps 27 sont adjacentes aux structures de grille inactives 57b et les régions de source 26 sont adjacentes aux structures de grille actives 57a. Les structures de grille inactives 57b peuvent être, soit connectées aux régions de source 26 par un connecteur 56, comme représenté sur la figure 1, soit connectées ensemble avec les structures de grille actives 57a par un connecteur 56, comme représenté sur l'autre mode de réalisation de la figure 8, qui va être étudié en détails ci-dessous. Dans un cas comme dans l'autre, les caractéristiques de résistance accrues à la panne dont le dispositif 20 est pourvu selon la présente invention (qui vont être étudiées en détails ci-dessous) ne sont pas perdues puisque, durant une phase de blocage, les couches conductrices 29a ont le même potentiel que les régions de source 26. Même dans ce cas, dans certaines applications, il peut être souhaitable de connecter les structures de grille inactives 57b à la région de source 26 dans la mesure où aucune augmentation de la tension d'entrée ou entre le puits et la grille du dispositif ne se produit sensiblement, comme cela peut être apprécié par les hommes de métier. Pour une meilleure compréhension des avantages de la présente invention, on va maintenant comparer le dispositif MOS à grille et à tranche 40 similaire de l'art antérieur représenté sur la figure 2, au dispositif MOS à grille et à tranche 20 similaire de la présente invention représenté sur la figure 3. Le dispositif de l'art antérieur 40 comprend des structures de grille comprenant une couche d'oxyde 48 et une couche conductrice 49 formées à l'intérieur de tranches respectives dans la couche semi-conductrice 42 et une partie de corps adjacente 45. La partie de corps adjacente 45 est pourvue d'une région de source 46 formée dans une partie supérieure de celle-ci. On peut voir que la jonction 41 entre la partie de corps 45 et la couche semi-conductrice 42 ne s'étend pas au-dessous des tranches. Comme les hommes de métier sont à même de l'apprécier, un champ électrique intense 47 peut se former dans le fond des tranches à l'endroit où les couches d'oxyde de la grille 48 rencontrent la couche semi-conductrice 42, lorsqu'une tension de blocage est appliquée au dispositif 40. Ce champ électrique intense 47 entraîne une injection d'un porteur chargé qui peut rompre la couche d'oxyde 48 qui, à son tour, perd de ses performances et peut, en fin de course, entraîner une détérioration irrémédiable de la couche d'oxyde. Selon la présente invention, la région de puits profond 35 représentée sur la figure 3 réduit la formation d'un champ électrique intense dans le fond des tranches qui ont les structures de grille actives 57a. C'est à dire que la région de puits profond 35 forme une jonction 56 entre la région de puits profond et la couche semi-conductrice 22. La région de puits profond 35 protège le fond de la couche d'oxyde sur la grille 28a et entraîne une baisse du potentiel de la couche des deux côtés de la jonction 56. La réduction du champ électrique réduit en conséquence l'injection d'un porteur chargé au niveau des couches d'oxyde de la grille 28a et minimise par-là même la rupture consécutive au vieillissement du à un porteur chargé. En outre, les caractéristiques de résistance accrues à la panne sont également réalisées. Par conséquent, la couche semi-conductrice 22 peut être plus fortement dopée que dans les dispositifs de l'art antérieur. Ceci procure une résistance considérablement inférieure au courant qui circule à travers la région de drain 30, ce qui, à son tour, réduit la résistance de passage sans tension du dispositif et améliore l'efficacité du dispositif, comme les hommes de métier sont à même de l'apprécier. Les régions de puits profond 35 peuvent être espacées les unes par rapport aux autres de manière à définir des structures de grille actives et inactives alternées, comme représenté sur la figure 1. Bien entendu, les régions de puits profond 35 peuvent aussi être espacées les unes par rapport aux autres de manière à définir toutes les troisièmes, quatrièmes, etc. structures de grille (ou même des structures de grille intermédiaires) comme des structures de grille inactives 57b, comme les hommes de métier sont à même de l'apprécier. Si l'on se réfère maintenant aux figures 4 à 7, un procédé de fabrication d'un dispositif à circuit intégré comprenant des régions de puits profond 35 selon la présente invention, va maintenant être décrit. La couche semi-conductrice 22 est augmentée de manière épitaxiale, par exemple, de façon adjacente au substrat semi-conducteur 21, comme représenté sur la figure 4. Une partie supérieure de la couche semi-conductrice 22 est alors dopée avec un dopant de type P (par implantation, par exemple), tel que du bore par exemple, pour former une région de puits P 37 à cet endroit. L'implant dopant de type P peut être compris entre 1 x 1012 environ et 5 x 1014 cm-2 environ par exemple. Un masque 37 peut alors être déposé sur une surface supérieure de la région de puits P 37, comme représenté sur la figure 5, de telle sorte que les tranches 24 puissent être taillées. Les tranches 24 définissent les parties de corps 25 dans la région de puits P 37 qui s'étendent vers l'extérieur à partir de la couche semi-conductrice 22. Une couche d'oxyde sacrificielle (non représentée) peut alors être formée en option dans les tranches 24. Un masque de puits profond 39 peut alors être déposé par-dessus les tranches 24 dans lesquelles les structures de grille actives sont formées de telle sorte qu'un implant de puits profond puisse être réalisé dans les tranches restantes, comme représenté sur la figure 6. L'implant de puits profond peut être identique à l'implant utilisé pour former la région de puits P 37 par exemple. Les masques 38,39 et la couche d'oxyde sacrificielle (le cas échéant) peuvent alors être déposés, comme représenté sur la figure 7. Lorsque de la chaleur est appliquée durant la formation des couches d'oxyde de la grille 28, les implants de puits profonds dans le fond des tranches 24 se diffusent dans la couche semiconductrice 22 pour s'étendre entre les paires adjacentes de parties de corps correspondantes 25 pour former les régions de puits profond 35. On appréciera que les étapes décrites ci-dessus puissent être accomplies en utilisant des procédés conventionnels connus des hommes de métier ; elles ne seront donc pas décrites plus en détails ici. En outre, les structures de grille actives et inactives du dispositif MOS, les régions de source 26, les parties de contact de corps 27, et les couches en métal 50 et 55 peuvent également être formées en utilisant des procédés conventionnels connus des hommes de métier. Comme spécifié ci-dessus, les structures de grille inactives 57b peuvent être, soit connectées aux régions de source 26, soit connectées aux structures de grille actives 57a durant la formation susmentionnée. Bien que le mode de réalisation ci-dessus illustre un dispositif à puits N, les hommes de métier apprécieront que d'autres configurations, telles que des dispositifs à puits P, puissent également être réalisées selon la présente invention. En outre, l'invention peut être utilisée avec des dispositifs autres que le mode de réalisation décrit ci-dessus, tels que des transistors bipolaires isolés à grille (des IGBT) ou des thyristors à commande MOS (MCT) par exemple. Un dispositif IGBT 20'pourvu d'un substrat P+ 21'est représenté sur la figure 8. Les autres éléments représentés sur la figure 8 sont similaires à ceux qui ont été étudiés ci-dessus en faisant référence à la figure 1 et ne seront donc pas étudiés plus en détails ici. De plus, les concentrations de dopant indiquées ci-dessus pour les différentes couches et régions selon la présente invention sont fournies à titre d'exemple uniquement, et les hommes de métier comprendront que des concentrations différentes de dopant peuvent être utilisées sans sortir du cadre de la présente invention. De nombreuses modifications et d'autres modes de réalisation de l'invention viendront à l'esprit des hommes de métier, qui peuvent prendre en compte les caractéristiques décrites ci-dessus en association avec les dessins annexés. Par conséquent, on comprendra aisément que l'invention ne se limite pas aux modes de réalisation spécifiques proposés ici, et que d'autres modifications et d'autres modes de réalisation sont prévus pour être inclus dans le champ d'application des revendications annexées. Revendications 1.-Dispositif à circuit intégré comprenant : une couche semi-conductrice (22 ; 22') d'un premier type de conductivité ; une pluralité de colonnes semi-conductrices (23 ; 23') espacées les unes par rapport aux autres, qui s'étendent vers l'extérieur à partir de ladite couche semi-conductrice et qui définissent des tranches (24) entre elles, chaque colonne semi-conductrice étant d'un second type de conductivité, opposé au premier type de conductivité ; une structure de grille respective (57) dans chaque tranche ; et au moins une région de puits profond (35 ; 35'), du second type de conductivité, et positionnée de manière à s'étendre dans ladite couche semiconductrice entre une paire adjacente de colonnes semi-conductrices correspondantes et sous le fond d'au moins une tranche de manière à définir par-là même au moins une structure de grille inactive (57b ; 57b'), ladite au moins une région de puits profond étant positionnée de telle sorte qu'au moins une tranche ne comprenne pas une région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active (57a ; 57a'). 2. -Dispositif selon la revendication 1, dans lequel ladite au moins une région de puits profond (35 ; 35') comprend une pluralité de régions de puits profond disposées de manière à définir des structures de grille actives et inactives alternées. 3. -Dispositif selon la revendication 1, dans lequel ladite au moins une région de puits profond (35 ; 35') a une concentration de dopant comprise entre 1 x1016 environ et 1 x 1018 cm-3 environ. 4.-Dispositif selon la revendication 1, dans lequel chaque colonne semi-conductrice (23 ; 23') comprend une partie supérieure du premier type de conductivité. 5. -Dispositif selon la revendication 1, dans lequel ladite au moins une structure de grille inactive (57 ; 57') est connectée à la partie supérieure de chaque colonne semi-conductrice (23 ; 23'). 6. -Dispositif selon la revendication 1, dans lequel ladite au moins une structure de grille inactive (57b ; 57b') et ladite au moins une structure de grille active (57a ; 57a') sont connectées ensemble. 7. -Dispositif selon la revendication 1, dans lequel chaque structure de grille (57) comprend une couche d'oxyde (28) sur la grille, adjacente à ladite tranche (24), et une couche conductrice (29) adjacente à ladite couche d'oxyde (28) sur la grille. 8. -Dispositif selon la revendication 7, dans lequel ladite couche conductrice (29) contient du polysilicone. 9. -Dispositif selon la revendication 1, comprenant en outre un substrat semi-conducteur (21 ; 21') adjacent à ladite couche semiconductrice (22 ; 22') sur un côté de celle-ci opposé aux dites colonnes semi-conductrices (23 ; 23'). 10. -Dispositif selon la revendication 9, dans lequel ledit substrat semi-conducteur (21 ; 21') contient du silicium. 11.-Dispositif selon la revendication 9, dans lequel ledit substrat semi-conducteur (21 ; 21') est plus fortement dopé que ladite couche semiconductrice (22 ; 22'). 12.-Dispositif selon la revendication 9, dans lequel ledit substrat semi-conducteur (21 ; 21') est du premier type de conductivité, de manière 1 à définir par-là même un transistor à effet de champ à semi-conducteur à oxyde métallique. 13. -Dispositif selon la revendication 9, dans lequel ledit substrat semi-conducteur (21 ; 21') est du second type de conductivité, de manière à définir par-là même un transistor bipolaire isolé à grille. 14. -Dispositif selon la revendication 1, dans lequel le premier type de conductivité correspond au type N et le second type de conductivité correspond au type P. 15. -Dispositif à circuit intégré MOS à grille comprenant : un substrat semi-conducteur (21 ; 21') ; une couche semi-conductrice (22 ; 22') d'un premier type de conductivité sur ledit substrat semi-conducteur ; une pluralité de colonnes semi-conductrices (23 ; 23') espacées les unes par rapport aux autres, qui s'étendent vers l'extérieur à partir de ladite couche semi-conductrice, et définissent des tranches (24) entre elles, chaque colonne semi-conductrice (23 ; 23') étant d'un second type de conductivité opposé au premier type de conductivité ; une structure de grille MOS (57) respective dans chaque tranche comprenant une couche d'oxyde (28) sur la grille, adjacente à ladite tranche et une couche conductrice (29) adjacente à ladite couche d'oxyde sur la grille ; une pluralité de régions de puits profond (35 ; 35') du second type de conductivité, chaque région de puits profond étant disposée de manière à s'étendre dans ladite couche semi-conductrice (22 ; 22') entre une paire adjacente de colonnes semi-conductrices et sous le fond d'une tranche correspondante de manière à définir par-là même une structure de grille inactive (57b ; 57b'), lesdites régions de puits profond étant espacées les unes par rapport aux autres de manière à définir des structures de grille actives (57a ; 57a') entre elles. 16. -Dispositif selon la revendication 15, dans lequel chaque région de puits profond (35 ; 35') a une concentration de 1 x 1016 environ à 1 x 1018 cm 3 environ. 17. -Dispositif selon la revendication 15, dans lequel ladite pluralité de régions de puits profond (35 ; 35') sont espacées les unes par rapport aux autres de manière à définir des structures de grille actives et inactives alternées. 18. -Dispositif selon la revendication 15, dans lequel chaque colonne semi-conductrice (23 ; 23') comprend une partie supérieure du premier type de conductivité. 19. -Dispositif selon la revendication 18, dans lequel ladite au moins une structure de grille inactive (57b ; 57b') est connectée à la partie supérieure de chaque colonne semi-conductrice (23 ; 23'). 20. -Dispositif selon la revendication 15, dans lequel ladite structure de grille inactive (57b ; 57b') et ladite structure de grille active (57a ; 57a') sont connectées ensemble. 21. -Dispositif selon la revendication 15, dans lequel ladite couche conductrice (29) contient du polysilicone. 22. -Dispositif selon la revendication 15, dans lequel ledit substrat semi-conducteur (21 ; 21') contient du silicium. 23.-Dispositif selon la revendication 15, dans lequel ledit substrat semi-conducteur (21 ; 21') est du premier type de conductivité, de manière à définir par-là même un transistor à effet de champ à semi-conducteur à oxyde métallique. 24. -Dispositif selon la revendication 23, dans lequel ledit substrat semi-conducteur (21 ; 21') est du second type de conductivité, de manière à définir par-là même un transistor bipolaire isolé à grille. 25. -Dispositif selon la revendication 15, dans lequel ledit substrat semi-conducteur (21 ; 21') est plus fortement dopé que ladite couche semiconductrice (22 ; 22'). 26. -Dispositif selon la revendication 15, dans lequel le premier type de conductivité correspond au type N et le second type de conductivité correspond au type P. 27. -Procédé de fabrication d'un dispositif à circuit intégré comprenant les étapes suivantes qui consistent à : former une pluralité de colonnes semi-conductrices (23 ; 23') espacées les unes par rapport aux autres, adjacentes à une couche semi-conductrice (22 ; 22') d'un premier type de conductivité, qui s'étendent vers l'extérieur à partir de ladite couche semi-conductrice (22 ; 22') et définissent des tranches (24) entre elles, chaque colonne semi-conductrice (23 ; 23') étant d'un second type de conductivité opposé au premier type de conductivité ; former une structure de grille (57) respective dans chaque tranche ; et former au moins une région de puits profond (35 ; 35') du second type de conductivité, qui s'étende dans ladite couche semi-conductrice entre une paire adjacente de colonnes semi-conductrices correspondantes et sous le fond d'au moins une tranche de manière à définir par-là même au moins une structure de grille inactive (57b ; 57b'), ladite au moins une région de puits profond étant positionnée de telle sorte qu'au moins une tranche ne comprenne pas une région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active (57a ; 57a'). 28. -Procédé selon la revendication 27, dans lequel la formation de ladite au moins une région de puits profond (35 ; 35') comprend l'implantation d'un dopant dans le fond de ladite au moins une tranche (24), et la diffusion du dopant de manière à former ladite au moins une région de puits profond. 29. -Procédé selon la revendication 28, comprenant en outre la formation d'un masque (39) adjacent à ladite au moins une tranche (24), définissant ladite au moins une structure de grille active (57a ; 57a') avant d'implanter et d'enlever le masque après diffusion. 30. -Procédé selon la revendication 28, dans lequel l'implantation comprend l'implantation d'un dopant tel que du bore. 31. -Procédé selon la revendication 28, dans lequel l'implantation comprend l'implantation du dopant dans une fourchette comprise entre 1 x 1012 environ et 1 x 10 cm environ. 32. -Procédé selon la revendication 27, dans lequel la formation de ladite au moins une région de puits profond (35 ; 35') comprend la formation d'une pluralité de régions de puits profond disposées de manière à définir des structures de grille actives et inactives alternées. 33. -Procédé selon la revendication 27, dans lequel la formation d'une pluralité de colonnes semi-conductrices (23 ; 23') comprend les étapes suivantes qui consistent à : doper une surface d'une couche semi-conductrice (22 ; 22') avec un dopant du premier type de conductivité de manière à définir une région de puits ; tailler la pluralité de tranches (24) dans la région de puits de manière à former par-là même la pluralité de colonnes semi-conductrices. 34. -Procédé selon la revendication 27, dans lequel la formation de la structure de grille (57) comprend la connexion de ladite au moins une structure de grille inactive (57b ; 57b') à la partie supérieure de chaque colonne semi-conductrice (23 ; 23'). 35. -Procédé selon la revendication 27, dans lequel la formation des structures de grille (57) comprend la connexion de ladite au moins une structure de grille inactive (57b ; 57b') à ladite au moins une structure de grille active (57a ; 57a'). 36. -Procédé selon la revendication 27, dans lequel la formation des structures de grille (57) comprend la formation d'un couche d'oxyde (28) sur la grille, adjacente à chaque tranche (24), et la formation d'une couche conductrice (29) adjacente à chaque couche d'oxyde sur la grille. 37. -Procédé selon la revendication 36, dans lequel la formation de la couche conductrice (29) comprend la formation d'un couche conductrice en polysilicone. 38. -Procédé selon la revendication 27, comprenant en outre la formation de la couche semi-conductrice (22 ; 22') adjacente à un substrat semi-conducteur (21 ; 21') du premier type de conductivité de manière à définir par-là même un transistor à effet de champ à semi-conducteur à oxyde métallique. 39.-Procédé selon la revendication 27, comprenant en outre la formation de la couche semi-conductrice (22 ; 22') adjacente à un substrat semi-conducteur (21 ; 21') du second type de conductivité, de manière à définir par-là même un transistor bipolaire isolé à grille. 40. -Procédé selon la revendication 38, dans lequel la formation de la couche semi-conductrice (22 ; 22') comprend l'augmentation de manière épitaxiale de la couche de silicium. 41. -Procédé selon la revendication 27, dans lequel le premier type de conductivité correspond au type N et le second type de conductivité correspond au type P. 42. -Procédé de fabrication d'un dispositif à circuit intégré MOS à grille comprenant les étapes suivantes qui consistent à : former une couche semi-conductrice (22 ; 22') d'un premier type de conductivité adjacente à un substrat semi-conducteur (21 ; 21') ; former une pluralité de colonnes semi-conductrices (23 ; 23') espacées les unes par rapport aux autres, adjacentes à un côté de la couche semiconductrice (22 ; 22') opposé au substrat semi-conducteur, qui s'étendent vers l'extérieur à partir de ladite couche semi-conductrice et définissent des tranches (24) entre elles, chaque colonne semi-conductrice (23 ; 23') étant d'un second type de conductivité opposé au premier type de conductivité ; former une structure MOS respective à grille (57) dans chaque tranche comprenant une couche d'oxyde (28) sur la grille, adjacente à chaque tranche, et une couche conductrice (29) adjacente à chaque couche d'oxyde sur la grille ; et former au moins une région de puits profond (35 ; 35') du second type de conductivité, qui s'étende dans ladite couche semi-conductrice entre une paire adjacente de colonnes semi-conductrices correspondantes et sous le fond d'au moins une tranche de manière à définir par-là même au moins une structure de grille inactive, ladite au moins une région de puits profond étant positionnée de telle sorte qu'au moins une tranche ne comprenne pas une région de puits profond en dessous d'elle, de manière à définir au moins une structure de grille active (57a ; 57a'). 43. -Procédé selon la revendication 42, dans lequel la formation de ladite au moins une région de puits profond (35 ; 35') comprend l'implantation d'un dopant dans le fond de ladite au moins une tranche (24), et la diffusion du dopant de manière à former ladite au moins une région de puits profond. 44. -Procédé selon la revendication 43, comprenant en outre la formation d'un masque (39) adjacent à ladite au moins une tranche, définissant ladite au moins une structure de grille active (57a ; 57a') avant d'implanter et d'enlever le masque après diffusion. 45. -Procédé selon la revendication 43, dans lequel l'implantation comprend l'implantation d'un dopant tel que du bore. 46. -Procédé selon la revendication 43, dans lequel l'implantation comprend l'implantation du dopant dans une fourchette comprise entre 1 x 1012 environ et 1 x 10"cm'environ. 47. -Procédé selon la revendication 42, dans lequel la formation de ladite au moins une région de puits profond (35 ; 35') comprend la formation d'une pluralité de régions de puits profond disposées de manière à définir des structures de grille actives et inactives alternées. 48. -Procédé selon la revendication 42, dans lequel la formation de la pluralité de colonnes semi-conductrices (23 ; 23') comprend les étapes suivantes qui consistent à : doper une surface de la couche semi-conductrice (22 ; 22') avec un dopant du second type de conductivité de manière à définir une région de puits ; tailler la pluralité de tranches (24) dans la région de puits de manière à former par-là même la pluralité de colonnes semi-conductrices. 49. -Procédé selon la revendication 42, dans lequel la formation des structures de grille (57) comprend la connexion de ladite au moins une structure de grille inactive (57b ; 57b') à la partie supérieure de chaque colonne semi-conductrice (23 ; 23'). 50. -Procédé selon la revendication 42, dans lequel la formation des structures de grille (57) comprend la connexion de ladite au moins une structure de grille inactive (57b ; 57b') à ladite au moins une structure de grille active (57a ; 57a'). 51. -Procédé selon la revendication 42, dans lequel la formation de la couche conductrice (29) comprend la formation d'un couche conductrice en polysilicone. 52. -Procédé selon la revendication 42, dans lequel le substrat semi- conducteur (21 ; 21') comprend du silicium, et dans lequel la formation de la couche semi-conductrice (22 ; 22') comprend l'augmentation de manière épitaxiale d'une couche de silicium sur le substrat en silicium. 53. -Procédé selon la revendication 42, dans lequel le substrat semi- conducteur (21 ; 21') est du premier type de conductivité, de manière à définir par-là même un transistor à effet de champ à semi-conducteur à oxyde métallique. 54.-Procédé selon la revendication 42, dans lequel le substrat semiconducteur (21 ; 21') est du second type de conductivité, de manière à définir par-là même un transistor bipolaire isolé à grille. 55. -Procédé selon la revendication 42, dans lequel le premier type de conductivité correspond au type N et le second type de conductivité correspond au type P.