Brevet FR2750817A1 — publié le 19980109

Générateur d'impulsions électroniques programmables en durée et en fréquence. L'invention concerne un générateur d'impulsions électroniques programmables en durée et en fréquence. Dans le monde industriel actuel, de nombreuses applications nécessitent la mise en oeuvre d'opérations de mesure de temps absolus ou relatifs et de génération d'impulsions électroniques à des instants précis. Ces opérations ou fonctions sont habituellement réalisées par des compteurs, des décompteurs, des générateurs de signaux ou impulsions électroniques modulées en largeur, désignés par PWM en référence au vocable anglo-saxon Pulse Width Modulation ou des synthétiseurs de fréquences. Tous les dispositifs précités comportent une horloge, ou un compteur, ainsi que des circuits électroniques capables d'engendrer des actions d'état dépendantes du temps ou d'événements extérieurs. Ces dispositifs peuvent être utilisés dans des secteurs d'activité très variés et permettent d'engendrer, soit des impulsions électroniques de fréquence ou de rapport cyclique variable, soit, par intégration, des tensions analogiques variables. A titre d'exemple d'application, on indique que le domaine de la construction automobile utilise des PWM pour la mise en oeuvre de systèmes d'antiblocage de freinage, ABS, de l'affichage de la vitesse, des modules gradateurs de l'intensité d'éclairage, des commandes de moteurs électri- ques, tels que les moteurs pas-à-pas, et de la télécommande en fréquence. De même, dans le secteur des télécommunications, les dispositifs PWM peuvent être utilisés pour la synchronisa- tion de systèmes en temps réel, la création d'impulsions électroniques de numérotation (DTMF) ou de sonneries. Enfin, dans le domaine de l'industrie de production, les dispositifs PWM sont utilisés pour le positionnement des servomoteurs de télécommande, la commande des moteurs et des gradateurs d'éclairage par exemple. Les synthétiseurs de fréquences peuvent servir à la création des sons, à la modulation des signaux transmis sur fils ou fibre optique. D'une manière générale, les dispositifs PWM connus de l'état de la technique présentent plusieurs sorties, chacune de ces sorties étant le siège d'une commutation individuelle, génératrice d'une impulsion, lorsqu'une base de temps, telle qu'un compteur, atteint en coïncidence la valeur affectée à la sortie considérée. Chaque sortie revient ensuite à son état de commutation complémenté lorsque le compteur atteint sa valeur de comptage périodique finale, désignée par valeur de modulo. Un tel mode opéra- toire réduit considérablement la flexibilité de ces disposi- tifs, notamment lorsqu'il est nécessaire, soit d'engendrer des impulsions multiples, trains d'impulsions, soit lorsque les commandes déphasées doivent être engendrées, le dépha- sage devant, dans un tel cas, être supérieur à l'intervalle de temps compris entre la commutation en coïncidence avec la valeur affectée et la valeur de modulo. A titre d'exemple de ce type de dispositifs, tels que représentés en figure la, ceux-ci comprennent une base de temps, commune à tous les générateurs ou sorties PWM, laquelle est incrémentée à chaque front d'une impulsion d'horloge système. Lorsque le contenu du compteur/base de temps est égal à 0, toutes les sorties PWM passent dans un premier état, alors que lorsque le contenu du compteur/base de temps est égal à la valeur affectée à un générateur ou sortie PWM, cette sortie commute à un deuxième état, complémenté du premier état. Ce processus est effectué par l'intermédiaire d'un comparateur qui commute la sortie lorsque les deux valeurs sont égales. Lorsque la valeur de comptage du compteur atteint sa valeur de modulo, toutes les sorties PWM sont commutées au premier état, et ainsi de suite. Un chronogramme des signaux correspondants est représenté en figure lb. Une amélioration aux dispositifs du type de ceux représentés en figure la consiste, ainsi que représenté en figure lc, à utiliser un compteur/base de temps dont la valeur de modulo est plus grande et à comparer le contenu d'un registre de mémorisation de la valeur d'affectation codée sur n bits du dispositif PWM avec les [n-2,...,0] bits de poids faibles du compteur et le contenu d'un autre registre d'un autre dispositif PWM avec les n-1 bits de poids fort. En raison du fait que la base de temps réalisée par les n-l bits de poids faible est deux fois plus rapide que celle réalisée par les n bits, les périodes des sorties PWM correspondantes diffèrent dans un rapport 2. Ce mode opératoire apporte une amélioration par rapport à celui représenté en figures la et lb, la vitesse de comparaison étant, au plus, doublée, mais limite tout de même la flexibilité souhaitée car l'une des sorties est bloquée sur une période T alors que l'autre sortie reste bloquée sur une période T/2. Enfin, certains dispositifs, plus sophistiqués, permettent de choisir, soit une sortie PWM sur T et l'autre sortie sur T/2, comme dans le cas des figures lc, ld, soit les deux sur T, ou encore les deux sur T/2. Toutefois, ces dispositifs restent tout de même soumis à la contrainte temporelle T ou T/2. Une solution pourrait, le cas échéant, consister à retenir d'autres périodes, sous-multiples de T, mais les limitations de principe demeurent. Une autre solution pourrait également consister à implanter un compteur/base de temps par sortie PWM. Toutefois, les solutions précitées sont difficilement envisageables dans le cas o l'on étend le nombre de sorties PWM, en particulier dans l'optique d'une réalisation sous forme de circuit intégré, en raison du surcoût en silicium engendré par la multiplication des circuits auxiliaires tels que compteur/base de temps et multiplexeur, laquelle rend quasiment inaccessible l'implantation de ces dispositifs. La présente invention a pour objet de remédier aux inconvénients précités par la mise en oeuvre d'un générateur PWM, lequel, bien que n'utilisant qu'un seul compteur/base de temps, permet toutefois d'engendrer des impulsions électroniques de largeur et de fréquence programmables. Un autre objet de la présente invention est en outre la mise en oeuvre d'un tel générateur PWM d'impulsions électroniques programmables en largeur et en fréquence sur une pluralité de sorties distinctes, ce qui permet de conférer à un tel générateur une très grande flexibilité d'utilisation. Un autre objet de la présente invention est égale- ment la mise en oeuvre d'un générateur PWM dans lequel la période d'un train d'impulsions émis est supérieure ou égale à celle du signal d'horloge de référence, horloge système. Un autre objet de la présente invention est enfin la mise en oeuvre d'un générateur PWM sous forme de circuit intégré, en technologie CMOS, dans lequel le coût en silicium est rendu minimum, en l'absence de multiplication des circuits auxiliaires. Le générateur d'impulsions électroniques programma- bles en durée et en fréquence, objet de la présente inven- tion, comprend m sorties S3, j E [0,m-l], programmables distinctes. Il est remarquable en ce qu'il comporte au moins un circuit d'initialisation-base de temps piloté par un signal d'hor- loge de référence et par un signal d'initialisation/compa- raison, ce circuit délivrant au moins m valeurs d'initiali- sation codées sur n bits pour la valeur vraie du signal d'initialisation, chaque bit desdites valeurs d'initialisa- tion étant désigné par CAMij, i E [0,n-l], respectivement une valeur de comptage périodique codée sur n bits, pour la valeur vraie du signal de comparaison, chaque bit de la valeur de comptage étant désigné par BLi. Un module de décodage d'adresse reçoit une pluralité de valeurs d'adresse X E [O,m-l] et délivre sur des lignes de mot un bit d'a- dresse de commande en écriture WLij, WL2j. Une matrice de comparaison de bits comportant n x m cellules de comparaison arrangées en m lignes et n colonnes est prévue. Chaque cellule de comparaison Cij comporte une cellule mémoire RAM et une cellule mémoire CAM, cellule mémoire adressable par le contenu, ces cellules mémoire étant adressables en écriture sur les lignes de mot par un bit d'adresse de commande en écriture WLlj et WL21 et recevant chacune pour mémorisation le bit de rang i BLi de la valeur de comptage. Chaque cellule de comparaison d'adresse i,j permet, d'une part, de mémoriser le bit correspondant CAMij de la valeur d'initialisation pour la valeur vraie du signal d'initiali- sation, et, d'autre part, de délivrer une valeur CAMiJ BLi, valeur complémentée du produit OU exclusif de ce bit CAMij de la valeur d'initialisation et du bit BLi de la valeur de comptage BLi. Chaque cellule mémoire RAM d'adresse i,j délivre une valeur de bit de masquage mémorisée pour la valeur vraie du signal d'initialisation, désignée par Mij, et chaque cellule mémoire CAM et RAM de même adresse i,j sont couplées par un couplage logique de type OU, chaque cellule de comparaison Cij délivrant une valeur résultante HITij = (CAMij e BLi) + Mij. Toutes les cellules de comparaison Cij d'une même ligne de rang j sont couplées par une fonction logique de type OU à la sortie correspondante Sj, ce qui permet d'effectuer une comparaison entre un mot de n bits stocké dans les cellules mémoire CAM de chaque ligne de rang j pour la valeur vraie du signal d'initialisation avec la valeur de comptage délivrée par le circuit d'initialisation-base de temps piloté pour la valeur vraie du signal de comparaison et d'engendrer ainsi sur chaque sortie Sj une impulsion programmée vérifiant la relation: n- 1 n-i HIT = HITij = [(CAMij e BLi) + Mi] i =0 i=0 selon un signal périodique dont la période est une période harmonique de la période de la valeur de comptage périodi- que. Le générateur d'impulsions électroniques programma- bles, objet de la présente invention, peut être utilisé dans tous les domaines de l'industrie précédemment mentionnés dans la description. Il sera mieux compris à la lecture de la description ci-après et à l'observation des dessins dans lesquels, outre les figures la à ld relatives à l'art antérieur, - la figure 2a représente, sous forme de blocs fonctionnels, un schéma général du générateur d'impulsions électroniques programmables en durée et en fréquence, objet de la présente invention; - la figure 2b représente un chronogramme des signaux mis en oeuvre pour la réalisation du mode opératoire du générateur d'impulsions électroniques, objet de la présente invention, selon une phase d'initialisation suivie d'une phase de comparaison; - la figure 2c représente, de manière détaillée, un mode de réalisation avantageux d'une cellule de comparaison de bits, constituée par une cellule mémoire RAM et une cellule mémoire CAM adressable par le contenu, un ensemble de cellules de comparaison de bits organisé en matrice permettant la mise en oeuvre du générateur d'impulsions électroniques programmables représenté en figure 2a; - la figure 2d représente un chronogramme des signaux mis en oeuvre au niveau d'une cellule de comparaison Cij, constituée par une cellule mémoire RAM et une cellule mémoire adressable par le contenu, cellule mémoire CAM; - la figure 2e représente, à titre d'exemple non limitatif, un chronogramme d'impulsions électroniques programmées obtenues à partir d'un compteur-décompteur à 25 pour différentes valeurs d'initialisation d'une ligne de cellules de comparaison, en particulier de cellules mémoire CAM; - la figure 3a représente une variante de réalisa- tion du générateur d'impulsions électroniques programmables en durée et en fréquence représenté en figure 2a, dans lequel l'une ou moins des lignes de cellules de comparaison a été dédoublée en une première et une deuxième ligne élémentaire de cellules de comparaison, afin de permettre la superposition de trains d'impulsions électroniques distincts engendrés par chaque ligne élémentaire de cellules de comparaison; - la figure 3b donne, à titre d'exemple non limita- tif, un chronogramme des trains d'impulsions électroniques distincts engendrés par chaque bloc élémentaire de cellules de comparaison, et de leur combinaison suite à leur superpo- sition, pour obtenir un train d'impulsions électroniques résultant. Une description plus détaillée d'un générateur d'impulsions électroniques programmables en durée et en fréquence, conforme à l'objet de la présente invention, sera maintenant donnée en liaison avec les figures 2a, 2b et 2c. Le générateur d'impulsions électriques programmables en durée et en fréquence, objet de la présente invention, tel que représenté en figure 2a, comprend m sorties program- mables distinctes, notées Sj, j E [0,m-l]. Par sorties programmables distinctes, on indique que chaque sortie Sj est susceptible d'engendrer périodiquement une forme d'onde distincte des formes d'ondes engendrées par les autres sorties. Chaque sortie Sj est connectée à un port délivrant les formes d'ondes précitées, noté PWMj. Conformément à un aspect particulièrement remarqua- ble du générateur d'impulsions, objet de la présente invention, celui-ci comprend, ainsi que représenté en figure 2a, au moins un circuit d'initialisation-base de temps, piloté par un signal d'horloge, noté CLK, ce signal d'hor- loge constituant un signal d'horloge de référence délivré par exemple par le système d'exploitation d'une unité informatique. Le circuit d'initialisation-base de temps 1 est en outre piloté par un signal d'initialisation/comparaison, noté I/C, le signal I/C ayant pour objet essentiellement de commander le circuit d'initialisation-base de temps selon une phase dite d'initialisation du générateur d'impulsions électroniques programmables, suivie d'une phase de comparai- son, c'est-à-dire d'une phase au cours de laquelle les formes d'ondes programmées sont engendrées par les sorties Sj précédemment mentionnées, ainsi qu'il sera décrit ultérieurement dans la description. Compte tenu du mode opératoire précité, on comprend que le signal d'initialisation/comparaison I/C peut être constitué par un simple signal logique binaire, pour lequel le phase d'initialisation est validée pour la valeur vraie de ce signal binaire, la phase de comparaison étant alors inhibée, alors qu'au contraire, cette phase de comparaison est validée pour la valeur complémentée de la valeur vraie de ce signal binaire, et réciproquement. Par convention, on indique que le signal d'initiali- sation/comparaison I/C correspond ainsi à un signal d'ini- tialisation présentant une valeur vraie et un signal dit de comparaison présentant également une valeur vraie. Les deux signaux, signal d'initialisation et signal de comparaison, présentent alors une valeur vraie pour les valeurs complé- mentées du signal logique précédemment cité. Conformément à un aspect particulier du générateur d'impulsions, objet de la présente invention, on indique que le circuit d'initialisation base de temps 1 délivre au moins m valeurs d'initialisation codées sur n bits, pour la valeur vraie du signal d'initialisation, chaque bit de ces valeurs d'initialisation étant désigné par CAMij, avec i E [0,n-l]. En outre, en fonction du type de marquage utilisé, des valeurs correspondantes d'initialisation sont mémorisées au niveau des cellules RAM correspondantes. Ainsi, pour une comparaison stricte, une valeur zéro est mémorisée dans la cellule RAM d'adresse i,j alors que pour un marquage effectif du bit d'adresse i,j correspondante une valeur 1 est mémorisée dans cette même cellule RAM au cours de cette initialisation. Le circuit d'initialisation-base de temps 1 délivre respectivement une valeur de comptage périodique, codée sur n bits pour la valeur vraie du signal de comparai- son, chaque bit de la valeur de comptage étant désigné par BLi. Dans ce but, ainsi que représenté également sur la figure 2a, le circuit d'initialisation-base de temps piloté 1 comporte, dans un mode de réalisation préférentiel, un compteur-décompteur 10 recevant le signal d'horloge CLK, ce signal d'horloge délivrant la valeur de comptage périodique codée sur n bits de 0 à n-1. Le compteur-décompteur 10 joue en quelque sorte le rôle d'une base de temps dans la mesure o ce compteur-décompteur recevant le signal d'horloge, délivre la valeur de comptage précitée modulo n avec une remise à zéro systématique dès que la valeur de modulo est atteinte. Le fonctionnement du compteur- décompteur 10 est de type tout-à-fait classique et il n'est pas nécessaire de décrire ce fonctionnement de manière plus détaillée. En outre, le circuit d'initialisation-base de temps 1 comporte un circuit multiplexeur 11 recevant m valeurs d'initialisation codées sur n bits, chaque bit étant dénoté CAMij. Ces valeurs d'initialisation comportent également les valeurs de bit mémorisées au niveau des cellules RAM correspondantes, et sont des valeurs programmées, spécifi- ques, ainsi qu'il sera décrit ultérieurement dans la description. Le circuit multiplexeur 11 reçoit également la succession des valeurs de comptage codées sur n bits délivrées par le compteur-décompteur 10, et il délivre les valeurs de bit correspondantes en fonction de l'état du signal d'initialisation/comparaison I/C, ainsi qu'il sera décrit ci-après dans la description. Enfin, le circuit d'initialisation-base de temps piloté 1 comporte une pluralité 12 de n circuits amplifica- teurs-inverseurs. Chaque amplificateur-inverseur, noté 12o à 12n1, engendre une valeur de bit BL0, BLi à BLn1 lorsque le signal d'initialisation/comparaison I/C correspond à la valeur vraie du signal de comparaison ou les bits de rang correspondant, notés par analogie BLi, i E [O,n-1], des m valeurs d'initialisation lorsque le signal d'initialisa- tion/comparaison I/C correspond au contraire à la valeur vraie du signal d'initialisation. Chaque amplificateur- inverseur 12i délivre cette valeur de bit BLi ainsi que la valeur complémentée de cette valeur de bit, notée BLBi. Ainsi, le circuit d'initialisation-base de temps 1 délivre au moins les m valeurs d'initialisation codées sur n bits pour la valeur vraie du signal d'initialisation, respectivement une valeur de comptage périodique codée également sur n bits pour la valeur vraie du signal de comparaison, chaque bit de la valeur de comptage étant désigné par BLi, ainsi que bien entendu les valeurs complé- mentées BLBi de ces valeurs de bit. Ainsi que représenté en outre en figure 2a, le générateur d'impulsions électroniques, objet de la présente invention, comprend un module de décodage 2, module décodeur d'adresse, recevant une pluralité de valeurs d'adresse X E [O,m-1], ce module de décodage 2 délivrant sur des lignes de mots un bit d'adresse de commande en écriture, noté WL1j, WL2j. Le module décodeur d'adresse peut être réalisé à titre d'exemple non limitatif par une table de consultation recevant en entrée les valeurs d'adresse X et délivrant un bit d'adresse de commande en écriture sur les lignes de mots précitées. Enfin, le générateur d'impulsions, objet de la présente invention, comprend une matrice de comparaison de bits, portant la référence 3, cette matrice comportant n x m cellules de comparaison arrangées en m lignes et n colonnes, ainsi que représenté en figure 2a. Chaque cellule de comparaison est notée Cij et comporte une cellule mémoire RAM et une cellule mémoire adressable par le contenu, dite cellule mémoire CAM. Les cellules mémoire RAM et cellules mémoire CAM sont adressables en écriture sur les lignes de mots par un bit d'adresse de commande en écriture, WL1j et WL2j respecti- vement, précédemment mentionnés dans la description. Chaque cellule de comparaison Cij reçoit pour mémorisation le bit de rang i BLi de la valeur de comptage et chaque cellule de comparaison d'adresse ij permet, d'une part, de mémoriser, le bit correspondant CAMi3 de la valeur d'initialisation pour la valeur vraie du signal d'initialisation, et, d'autre part, de délivrer une valeur correspondant à la valeur complémentée du produit OU exclusif de ce bit CAMij de la valeur d'initialisation et du bit BLi de la valeur de comptage, cette valeur étant notée CAMij BLi. En outre, chaque cellule mémoire RAM d'adresse i,j délivre une valeur de bit de masquage, notée Mij, cette valeur de masquage étant mémorisée pour la valeur vraie du signal d'initialisation. Chaque cellule mémoire CAM et cellule mémoire RAM de même adresse i,j, constitutives donc de la cellule de comparaison Cij correspondante, sont couplées par une fonction logique de type OU pour former la cellule de comparaison Cij correspondante. Chaque cellule de comparaison Cij délivre ainsi une valeur résultante, notée: HITit = (CAMij BLi) + Mij (1) Enfin, ainsi qu'on l'observera sur la figure 2a, toutes les cellules de comparaison Cij d'une même ligne de rang j sont couplées par une fonction logique de type OU à la sortie correspondante Su. Le générateur d'impulsions électroniques programmables en durée et en fréquence, objet de la présente invention, permet ainsi, grâce à l'architec- ture représentée en figure 2a, d'effectuer une comparaison entre un mot de n bits, valeur d'initialisation stockée dans les cellules mémoire CAM de chaque ligne de rang j pour la valeur vraie du signal d'initialisation, avec la valeur de comptage délivrée par le circuit d'initialisation-base de temps piloté 1 pour la valeur vraie du signal de comparai- son, et d'engendrer ainsi sur chaque sortie Sj une impulsion programmée vérifiant la relation: n-1 n-1 HITj = HITITij = (CAMij ( BLi) + Mij] (2) J.0 i=0 selon un signal périodique dont la période est une période harmonique de la période de la valeur de comptage périodique du compteur décompteur 10. D'une manière générale, on indique que le mode opératoire du générateur d'impulsions électroniques program- mables en durée et en fréquence, objet de la présente invention, peut être schématisé selon les étapes ci-après: - une étape de chargement des valeurs initiales à comparer, c'est-à-dire des m valeurs initiales dans les cellules mémoire CAM d'adresse i,j, et, - une étape de chargement des valeurs de masquage Mij en cellules mémoire RAM d'adresse i,j correspondantes, ces valeurs permettant en fait de forcer la comparaison à la valeur vraie quel que soit le résultat de la comparaison entre la valeur chargée dans une cellule mémoire CAM d'adresse i,j et la valeur du bit de rang i correspondant BLi transitant à un instant donné par la période d'horloge et délivré par le compteur-décompteur 10 pour valeur de comptage à cet instant. On indique qu'il n'y a pas d'ordre spécifique de chargement à respecter, le chargement des cellules mémoire CAM d'adresse i,j et celui des cellules mémoire RAM d'a- dresse i,j correspondantes pouvant être effectués indiffé- remment l'un après l'autre. Le mode opératoire du générateur d'impulsions électroniques programmables, objet de la présente invention, tel que représenté en figure 2a, est illustré en référence à la figure 2b, ainsi que mentionné précédemment, pour l'étape ou phase d'initialisation en fonctionnement apério- dique, respectivement pour l'étape ou phase de comptage ou comparaison en fonctionnement périodique. Une description plus détaillée de chaque cellule mémoire RAM et mémoire CAM constitutive d'une cellule de comparaison Cij sera maintenant donnée en liaison avec la figure 2c. Ainsi que représenté sur la figure précitée, on indique que chaque cellule mémoire RAM comprend au moins un premier et deuxième transistor de type MOS, notés T1 et T2, dont l'électrode de grille est connectée en parallèle à la ligne de mot WLj. L'électrode de source du premier transis- tor T1 et l'électrode de drain du deuxième transistor T2 reçoit la valeur de bit BLi de la valeur de comptage, respectivement la valeur de bit complémentée BLBi de cette valeur de comptage. L'électrode de drain du transistor T1 et l'électrode de source du transistor T2 sont reliées par l'intermédiaire de deux inverseurs connectés en tête-bêche, le point commun entre les deux inverseurs précités et l'électrode de source du deuxième transistor MOS T2 déli- vrant la valeur mémorisée ou valeur de masquage Mij. De même que représenté sur la figure 2c, chaque cellule mémoire CAM comprend au moins un premier et un deuxième transistor MOS, notés T3, T4, dont l'électrode de grille est connectée en parallèle à la ligne de mot WL2z et dont l'électrode de source, respectivement de drain, reçoit la valeur de bit BLi, respectivement la valeur de bit complémentée BLBi, de la valeur de comptage délivrée par le compteur-décompteur 10. L'électrode de drain, respectivement de source, des premier et deuxième transistors T3, T4, est reliée par l'intermédiaire de deux inverseurs connectés en tête-bêche de façon semblable à la structure de la mémoire RAM précédemment décrite en liaison avec la figure 2c. En outre, un troisième, T5, et un quatrième transis- tor MOS, T6, sont connectés en cascade par l'intermédiaire d'un point commun entre leur électrode de drain et électrode de source. L'électrode de source du troisième transistor MOS T5 reçoit la valeur de bit BLi et l'électrode de drain du quatrième transistor MOS T6 reçoit la valeur de bit complé- mentée BLBi de la valeur de comptage délivrée par le compteur-décompteur 10. Les électrodes de grille du troi- sième T5 et du quatrième T6 transistor MOS sont connectées à l'électrode de source du deuxième T4, respectivement à l'électrode de drain du premier T3 transistor MOS. Enfin, un cinquième transistor MOS, T7, est prévu, l'électrode de source de ce cinquième transistor étant connectée à la tension de référence, tension de masse à O volt du dispositif par exemple, alors que l'électrode de grille du cinquième transistor T7 est connectée au point commun du troisième et du quatrième transistor MOS T5, T6. L'électrode de drain du cinquième transistor MOS T7 délivre la valeur complémentée du produit OU exclusif entre les valeurs mémorisées par la cellule mémoire CAM, valeurs mémorisées CAMi, et BLi. Enfin, ainsi que représenté en figure 2c, le couplage de type OU entre cellules mémoire CAM et RAM de même adresse i,j est réalisé par l'intermédiaire d'un transistor MOS T8, transistor de couplage dont l'électrode de source est reliée à l'électrode de drain du cinquième transistor MOS T7 et revoit la valeur complémentée du produit OU exclusif entre les valeurs mémorisées CAMij et BLi. L'électrode de grille du transistor T8 de couplage est connectée au point commun entre le deuxième transistor MOS T2 et les inverseurs tête-bêche de la cellule mémoire RAM de même adresse i,j. L'électrode de drain du transistor de couplage T8 délivre la valeur résultante selon la relation (1) mentionnée précédemment dans la description. Enfin, on indique que le couplage par une fonction logique de type OU detoutes les cellules de comparaison Cij d'une même ligne de rang j est effectué par exemple par l'interconnexion en parallèle de toutes les électrodes de drain des transistors MOS T8 de couplage à une ligne de sortie connectée à la sortie Sj de rang j correspondant. Le fonctionnement de chaque cellule RAM et CAM d'adresse i,j est le suivant: Lorsque la ligne de mot WL1î est portée au niveau haut, pour commande en écriture, les transistors MOS T1 et T2, de type N par exemple, sont rendus conducteurs. Si, à titre d'exemple, au même instant, on suppose qu'un signal de niveau haut est appliqué sur la ligne de bit BLi et qu'en conséquence un niveau bas est appliqué sur la ligne de bit du bit de valeur complimenté BLBi, le potentiel de la ligne de bit à la valeur BLi est appliqué au noeud N1 des inver- seurs en tête-bêche L1 de la cellule RAM, ces inverseurs en tête-bêche constituant en fait un circuit de verrouillage ou "latch" en vocable anglo-saxon, par l'intermédiaire du transistor T1, tandis que le potentiel correspondant à la valeur complémentée BLB, est appliqué au noeud N2 du circuit de verrouillage L1 par l'intermédiaire du transistor T2. Dans ces conditions, on considère que le circuit de verrouillage Lt a stocké une valeur au niveau 1. Cette valeur correspond à la valeur de masquage Mij de l'adresse i,j correspondante. Dans les mêmes conditions, lorsque la ligne de mot WL1; est portée au niveau haut alors que la ligne de bit pour la valeur BLi est au niveau bas, la valeur complémentée BLBi étant par contre portée au niveau haut, on considère que le circuit de verrouillage L1 a au contraire stocké un niveau bas, dit niveau 0. Par suite, lorsque le circuit de verrouillage L1 est réputé avoir stocké une valeur 1, on comprend que le noeud N1 est au potentiel haut et que le noeud N2 est au potentiel bas, et réciproquement, le circuit de verrouillage L1 est réputé avoir stocké une valeur 0, ou valeur basse, lorsque le noeud N1 est au potentiel bas et le noeud N2 au potentiel haut. En ce qui concerne le fonctionnement de chaque cellule mémoire CAM, celui-ci peut être illustré de la façon ci-après. Chaque cellule CAM comprend en fait la même struc- ture que la cellule RAM de même adresse, à l'exception des transistors T5, T6 et T7. Le fonctionnement en mode stockage de chaque cellule mémoire CAM est donc identique à celui de chaque cellule mémoire RAM lorsque la ligne de mot WL2j de commande en écriture est portée au potentiel haut, la valeur de bit BLi de la valeur de comptage étant portée au poten- tiel haut ou bas et la valeur complémentée BLBi correspon- dante à la valeur complémentée correspondante. En supposant, à titre d'exemple illustratif, que le circuit de verrouillage L2 de la cellule mémoire CAM ait préalablement mémorisé une valeur 1, lorsqu'on applique un niveau bas BLi et en conséquence un niveau haut BLBi, le transistor T5 de type NMOS reste bloqué, tandis que le transistor T6 de même type devient conducteur, appliquant ainsi un potentiel de niveau haut sur la grille du transis- tor T7 de type NMOS, le noeud N8 représenté sur la figure 2c étant ainsi porté à un potentiel bas. De même si, à titre d'exemple, on suppose que le circuit de verrouillage L2 de la cellule mémoire CAM a préalablement stocké une valeur 0, potentiel bas, et que l'on applique une valeur de bit correspondant à un potentiel haut BLi et donc une valeur de bit complémentée BLBi corres- pondant à un potentiel bas, la grille du transistor Ts de type NMOS est portée à un niveau haut, rendant ce transistor conducteur, et le noeud N8 de la figure 2c est porté à un potentiel bas par l'intermédiaire du transistor T7 qui est conducteur. Les autres cas correspondent successivement à: - circuit de verrouillage L2 de la cellule mémoire CAM à la valeur 1, BLi au niveau haut, BLBi niveau bas; - circuit de verrouillage de la cellule mémoire CAM à la valeur 0, BLi au niveau bas, BLBi au niveau haut. Le noeud N8 reste à un niveau haut si, par exemple, il a été placé à un tel niveau par un élément de précharge représenté sur la figure 2a pour chaque cellule mémoire CAM correspondante. Le fonctionnement de l'ensemble est représenté par le tableau 1 ci-après, la valeur BLBi désignant toujours la valeur complémentée de BLi. Tableau 1 CAMij BLi N8 0 0 1 0 1 0 1 0 0 1 1 1 Ce mode opératoire permet de réaliser une fonction identité NON/OU exclusif au noeud N8 de chaque cellule de comparaison Cij vérifiant la relation logique: N8 = CAMij ( BLi. (3) La commande de la grille de chaque transistor T8 par la cellule RAM correspondante permet alors d'obtenir la relation logique (2) précédemment mentionnée dans la description. Le chronogramme de la valeur résultante à partir d'un signal de précharge délivré à chaque cellule de mémoire RAM et CAM par un circuit de précharge de type classique, tel que représenté en figure 2a, est donné en figure 2d pour la cellule de comparaison Cij. Les circuits d précharge ne sont pas décrits en raison de leur type classique connu de l'homme de l'art. La multiplication sur une ligne pour n bits consti- tutifs des valeurs de comptage, par exemple pour n = 16, permet d'effectuer une comparaison entre un mot de 16 bits stocké dans les cellules mémoire CAM de la ligne considéré et un mot d'un nombre correspondant, n = 16 par exemple, de bits correspondant à la valeur de comptage, c'est-à-dire aux valeurs BLi et BLBi précédemment mentionnées dans la descrip- tion, l'état de repos étant matérialisé par BLi = BLBi, tous les résultats de comparaison délivrés par les cellules de comparaison d'une même ligne étant reliés par la liaison logique OU précédemment mentionnée dans la description. Dans ces conditions, la sortie Sj correspondante, pour la ligne de rang j considérée, vérifie la relation (3) précédemment mentionnée dans la description. Dans cette relation, lorsque tous les bits de masquage Mî1 sont stockés inactifs, la relation précédente est à la valeur vraie si et seulement si toutes les compa- raisons sont identiques, ce qui implique CAMij = BLi. Si, au contraire, tous les bits de masquage Mij sont stockés actifs, la relation précédente est à la valeur vraie quel que soit le contenu du mot correspondant à la valeur de comptage, c'est-à-dire aux valeurs correspondantes des bits BLi et valeur complémentée BLBi. Ainsi, lorsque le mot à comparer, c'est-à-dire la valeur de comptage instantanée délivrée par le compteur- décompteur 10 diffère de un ou plusieurs bits par rapport au mot stocké sur une même ligne de rang j de cellule mémoire CAM, la relation précédente est à la valeur vraie lorsque les valeurs de masquage correspondantes sont à la valeur active. Un exemple de valeur vraie des comparaisons déli- vrées par chaque cellule de comparaison Cij est donné dans le tableau 2 ci-après: Tableau 2 CAMj1 1 O O 1 0 0 1 1O 0 0 1 O 1 1 1 BLi 1 0 0 0 1 0 1 1 1 0 0 1 1 0 11011 Mij O 0 1 1 1 1 0 0 1 1 0O O Bien entendu, une pluralité de mots de comparaison, c'est-à-dire les m valeurs initiales, peut ainsi être prévue, chaque mot étant mémorisé au niveau d'une ligne de cellules mémoire de type CAM, le générateur d'impulsions électroniques programmables en durée et en fréquence, objet de la présente invention, présentant alors la configuration en matrice de cellules de comparaison telle que représentée en figure 2a. On comprend ainsi que le générateur d'impulsions électroniques, objet de la présente invention, permet de programmer, chaque ligne de rang j de cellules de comparai- son Cij, de façon à faire varier le nombre et la largeur des impulsions dans une période donnée par la période de récurrence du compteur-décompteur 10, selon le mode opéra- toire qui sera explicité ci-après dans la description. A l'aide de la structure représentée en figure 2a, on peut ainsi réaliser un générateur d'impulsions électroni- ques programmables en durée et en fréquence à m sorties, chaque sortie Sj pouvant en fait être considérée comme un générateur distinct PWMj. A chaque front du signal d'horloge CLK délivré par l'horloge système par exemple, le compteur-décompteur 10 du circuit d'initialisation-base de temps piloté 1 est incré- menté et l'on effectue ainsi une comparaison entre la sortie du compteurdécompteur, c'est-à-dire la valeur instantanée de comptage et le contenu de la matrice de points, c'est-à- dire chaque ligne de cellules mémoire CAM et cellules mémoire RAM. La période des impulsions délivrées est le modulo du compteur, c'est-àdire une période harmonique de la période de la valeur de comptage périodique. On comprend bien entendu qu'en fonction des valeurs programmées, notamment des bits de masquage Mij et des valeurs d'initialisation, la période des impulsions peut être, soit égale à la période de comptage du compteur-décompteur, soit au contraire une période harmonique de ce dernier, ainsi qu'il sera décrit ci-après. Les différentes formes d'ondes à durée variable et à impulsions multiples seront décrites en liaison avec la figure 2e dans un exemple non limitatif de mise en oeuvre utilisant un compteur-décompteur de valeur 25 pour une valeur préchargée, c'est-à-dire une valeur d'initialisation correspondant à une ligne de rang j par exemple, cette valeur préchargée étant arbitrairement prise égale à la valeur 10010. Sur la figure 2e, on a représenté, d'une part, les états du compteurdécompteur 10, c'est-à-dire la valeur de comptage et finalement la valeur des bits de poids 20 à 24, ainsi que les valeurs correspondantes contenues dans une * ligne de rang j de cellules mémoire CAM correspondantes. En liaison avec la figure 2e, on indique que pour la valeur d'initialisation 10010 chargée en mémoire CAM, lorsque la valeur de comptage par le compteur-décompteur atteint cette valeur, c'est-à-dire lors de la comparaison ou identité stricte représentée en figure 2e entre la valeur de comptage et la valeur d'initialisation, on obtient une impulsion unique par période de comptage du compteur- décompteur dont la durée est égale à un cycle d'horloge CLK. Si au contraire on masque le bit de poids faible, bit de poids 2 , la valeur M0j étant portée à la valeur X, la valeur X désignant ici indifféremment la valeur O ou 1, la relation (2) précédente est vraie deux fois consécutives, ce qui permet d'engendrer une impulsion dont la durée est égale à deux cycles d'horloge, ainsi que représenté sur la forme d'ondes 1 de la figure 2e. Si, en outre, on masque le bit de poids 21, la valeur d'initialisation étant portée à la valeur 100XX, la relation (2) devient vraie quatre fois consécutivement, ainsi que représenté au point 2 de la figure 2e, et ainsi de suite. On peut ainsi faire varier la durée d'une impulsion par puissance de deux fois la durée de la période ou du cycle d'horloge système dans l'intervalle d'une période de comptage du compteurdécompteur en masquant consécutivement les bits de poids faible vers les bits de poids fort. La durée D de l'impulsion engendrée vérifie ainsi la relation: D = 2k+1 (4) o k représente le poids du bit de rang le plus élevé des bits masques. Les formes d'ondes correspondantes sont données aux positions 1 et 2 de la figure 2e. En ce qui concerne la programmation par impulsions multiples, celle-ci peut être obtenue en démasquant le bit de poids le plus faible, bit de poids 2 pour l'obtention d'une comparaison stricte entre la valeur correspondante mémorisée en mémoire CAM et la valeur BLi, et qu'en outre, on masque un bit parmi les n-l bits restants. L'on engendre alors deux impulsions dont la durée est égale à une durée de cycle d'horloge système CLK. La distance, exprimée en nombre de périodes d'hor- loge CLK entre ces deux impulsions, est fonction du poids du bit masqué. Ainsi, le nombre d'impulsions obtenu est une puissance de 2 du nombre de bits masqués, alors que la distance entre les impulsions est donnée par la relation: d = 2P(5) o p représente le poids du bit masqué. Les formes d'ondes représentées aux points 3, 4, 5 et 6 de la figure 2e permettent de vérifier le résultat précédemment indiqué. Le générateur d'impulsions électroniques programma- bles en durée et en fréquence, objet de la présente inven- tion, permet bien entendu de programmer toutes formes d'ondes avec une récurrence, c'est-à-dire une distance entre impulsions fonction du rang du bit masqué et un nombre d'impulsions fonction du nombre de bits masqués. Ainsi, si l'on considère une suite 2r, 2' et 2t o r, s et t représentent le rang des bits masqués, un motif périodique tel que représenté en positions 7 et 8 de la figure 2e peut être obtenu avec les paramètres ci-après: - distance d1 = 2r, o r représente le rang du bit de poids le plus fort des bits masqués; - distance d2 = 2s, o s représente le rang du bit de poids le plus faible des bits masqués; - d1 représente la distance entre motifs constitués par deux impulsions élémentaires, alors que d2 représente la distance entre impulsions élémentaires constitutives d'un motif; - le nombre de motifs constitués par des impulsions élémentaires est donné par N = 2t o t représente le nombre de bits masqués. Dans le cadre de la figure 2e, on indique que les formes d'ondes représentées aux positions 1 et 2 ne sont en fait qu'un cas particulier dans lequel la distance d1 est égale à 1, soit, pour r = 0, alors que la distance d2 est égale au nombre, soit 2s = 2t. En ce qui concerne les formes d'ondes représentées aux positions 3, 4, 5 et 6, celles-ci constituent un cas particulier pour lequel r = s. Le mode de réalisation du circuit générateur d'impulsions électroniques programmables en durée et en fréquence, objet de la présente invention, précédemment décrit en liaison notamment avec les figures 2a et suivan- tes, apparaît particulièrement intéressant dans la mesure o celui-ci permet d'engendrer des trains d'impulsions consti- tués de motifs à impulsions multiples, ce qui permet d'augmenter considérablement la flexibilité d'utilisation de ce type de générateur par rapport aux systèmes décrits dans l'art antérieur. Toutefois, on notera que dans le mode de réalisation précité, les distances et le nombre d'impulsions sont des puissances entières de 2. Une telle limitation ne permet pas un réglage aussi fin que la période ou cycle d'horloge système, ce qui, dans certains cas, peut constituer un inconvénient. Afin de remédier à l'inconvénient précité, un mode de réalisation préférentiel du générateur d'impulsions électroniques programmables en durée et en fréquence, objet de la présente invention, sera décrit en liaison avec les figures 3a et 3b. Selon le mode de réalisation précité représenté en figure 3a, chaque ligne de cellules de comparaison de rang j est dédoublée en une première et une deuxième ligne élémentaire de cellules de comparaison, chaque cellule de comparaison portant la référence Coij, respectivement CIj, le premier indice 0 ou 1 désignant l'indice de dédoublement de chaque cellule de comparaison pour former la première et la deuxième ligne élémentaire de cellules de comparaison. On comprend, ainsi que représenté sur la figure 3a, que les cellules de comparaison sont alignées pour former la première et la deuxième ligne élémentaire, chaque ligne élémentaire étant interconnectée à une sortie correspondante S0,, respectivement Sj, le premier indice désignant l'indice de dédoublement. Selon un aspect particulièrement avantageux du générateur d'impulsions électroniques programmables, objet de la présente invention, tel que représenté dans le mode de réalisation de la figure 3a, chaque ligne élémentaire de cellules de comparaison, c'est-à-dire les lignes désignées par Sj et S1j, sont programmables indépendamment et complé- mentairement l'une de l'autre, de façon à délivrer des motifs de trains d'impulsions complémentaires. Par lignes élémentaires de cellules de comparaison programmables indépendamment et complémentairement l'une de l'autre, on entend que chaque ligne élémentaire de cellule peut être programmée indépendamment, c'est-à-dire compte non tenu de la programmation de l'autre ligne élémentaire de cellules de comparaison. Le caractère complémentaire de la programmation réside dans le fait que la programmation à l'identique de l'une et l'autre des lignes élémentaires de cellules n'offre pas d'intérêt effectif et que, conformément à l'objet de la présente invention, il est avantageux de programmer l'une et l'autre des lignes élémentaires de cellules de comparaison S0j et S1, de manière que les motifs engendrés soient distincts, afin de permettre la superposi- tion de ces motifs pour créer un motif ou train d'impulsions spécifique, beaucoup plus fin, ainsi qu'il sera décrit ci- après dans la description. Ainsi qu'on l'observera en figure 3a, on indique que le générateur comporte en outre, pour chaque couple de première et deuxième ligne élémentaire S0o et Se tel que représenté en figure 3a, un circuit logique de type OU interconnecté aux première et deuxième sorties élémentaires S., et Sj, ce circuit logique de type OU délivrant un signal de superposition des motifs ou de train d'impulsions complémentaires programmés sur chaque ligne élémentaire de cellule de comparaison. Le circuit logique de type OU, portant la référence 43 sur la figure 3a, permet ainsi d'assurer la superposition des motifs de train d'impulsions complémentaires programmés sur les lignes élémentaires S0j et S,,. Toutefois, ainsi que représenté également sur la figure 3a, le circuit logique de type OU 4j peut être suivi d'un circuit référencé 5;, de type bistable par exemple, recevant le signal de superposition et délivrant un signal résultant dont la résolution temporelle est égale à celle de la période du signal d'horloge de référence. Le mode de réalisation décrit en figure 3a permet en fait de régler les impulsions ou les trains d'impulsions à la durée souhaitée avec une précision correspondant à la durée de la période ou cycle de l'horloge système CLK. Sur la figure 3b, on a représenté à titre d'exemple non limitatif les chronogrammes d'impulsions obtenues lors de la mise en oeuvre d'un générateur d'impulsions électroni- ques programmables en durée et en fréquence dans lequel une ligne de rang j de cellules de comparaison est constituée par deux lignes élémentaires, une première ligne élémentaire étant programmée de façon à délivrer un signal représenté par HIToj pour une valeur initiale comportant 5 bits, le bit de poids le plus fort étant masqué à la valeur X, les deux bits suivants étant à la valeur 0, et les deux derniers bits à la valeur 1, alors que la deuxième ligne élémentaire est programmée de façon à délivrer un signal HIT11 pour une valeur initiale codée sur 5 bits dont le bit de poids le plus fort est égal à la valeur 1 et les quatre autres bits successifs égaux à la valeur 0. On comprend que dans ce cas, les signaux HIT0j et HIT1j sont appliqués à l'entrée de la porte OU référencée 4j, ce qui permet de piloter le circuit bascule 5] de façon à délivrer le signal résultant PWMj tel que représenté en figure 3b, constitué par une série d'impulsions de durée 3T o T représente le cycle d'horloge système CLK séparées par 13 périodes ou cycles d'horloge T. On indique bien entendu que le principe d'impulsions multiples peut être appliqué de manière à obtenir, par le biais d'une bascule ou, le cas échéant, en l'absence de bascule 5j, des formes d'ondes de récurrence souhaitée. On a ainsi décrit un générateur d'impulsions électroniques programmables en durée et en fréquence particulièrement performant dans la mesure o, grâce à une mise en oeuvre particulièrement souple de chaque ligne de cellules de comparaison, il est possible d'obtenir, sur chacune de celles-ci, une pluralité d'impulsions configurées en trains d'impulsions ou motifs dont la résolution tempo- relle est au plus égale à celle de la période ou cycle du signal d'horloge système CLK. Ce type de générateur d'impulsions électroniques apparait particulièrement satisfaisant dans la mesure o il est possible d'envisager des applications très variées telles que générateurs de signaux périodiques de périodes diverses de phénomènes physiologiques, tels que pulsations cardiaques ou autres, ou, par exemple, générateurs d'impul- sions électroniques programmables en durée et en fréquence sous forme de circuits dédiés destinés à la reconnaissance de signature fréquentielle de sources d'émission. REVENDICATIONS 1. Générateur d'impulsions électroniques programma- bles en durée et en fréquence comprenant m sorties program- mables distinctes, Sj, j E [O,m-1], caractérisé en ce qu'il comporte au moins: - un circuit d'initialisation-base de temps piloté par un signal d'horloge de référence et par un signal d'initialisation/comparaison, ledit circuit d'initialisa- tion-base de temps délivrant au moins m valeurs d'initiali- sation codées sur n bits pour la valeur vraie du signal d'initialisation, chaque bit desdites valeurs d'initialisa- tion étant désigné par CAMij, i E [O0,n-l], respectivement une valeur de comptage périodique codée sur n bits, pour la valeur vraie du signal de comparaison, chaque bit de la valeur de comptage étant désigné par BLi; des moyens de décodage recevant une pluralité de valeurs d'adresse X E [0,m-l] et délivrant sur des lignes de mot un bit d'adresse de commande en écriture WL1j, WL2j; - une matrice de comparaison de bits comportant n x m cellules de comparaison arrangées en m lignes et n colonnes, chaque cellule de comparaison Cij comportant une cellule mémoire RAM et une cellule mémoire CAM, cellule mémoire adressable par le contenu, lesdites cellules mémoire étant adressables en écriture sur lesdites lignes de mot par un bit d'adresse de commande en écriture WL11 et WL21 respec- tivement, et recevant chacune pour mémorisation le bit de rang i BLi de ladite valeur de comptage, chaque cellule de comparaison d'adresse i,j permettant, d'une part, de mémoriser ledit bit correspondant CAMi. de la valeur d'ini- tialisation pour la valeur vraie du signal d'initialisation, et, d'autre part, de délivrer pour la valeur vraie du signal de comparaison une valeur CAMij e BLi, valeur complémentée du produit OU exclusif de ce bit CAMij de la valeur d'initia- lisation et du bit BLi de ladite valeur de comptage, chaque cellule mémoire RAM d'adresse i,j délivrant une valeur de bit de masquage mémorisée pour la valeur vraie du signal d'initialisation, désignée par Mij, et chaque cellule mémoire CAM et RAM de même adresse i,j étant couplées par un couplage logique de type OU pour former ladite cellule de comparaison Cij et chaque cellule de comparaison délivrant une valeur résultante HITij = (CAMij e BLi) + Mij, toutes les cellules de comparaison Ci; d'une même ligne de rang j étant couplées par une fonction logique de type OU à la sortie correspondante Si, ce qui permet d'effectuer une comparaison entre un mot de n bits valeur d'initialisation stocké dans les cellules mémoire CAM de chaque ligne de rang j pour la valeur vraie du signal d'initialisation avec la valeur de comptage délivrée par le circuit d'initialisation- base de temps piloté pour la valeur vraie du signal de comparaison et d'engendrer ainsi sur chaque sortie Sj une impulsion programmée vérifiant la relation: n-1 n-i HIT1= HITij = [(CAMij ( BLi) + Mij] i =0 i=0 i selon un signal périodique dont la période est une période harmonique de la période de la valeur de comptage périodi- que. 2. Générateur selon la revendication 1, caractérisé en ce que ledit circuit d'initialisation-base de temps piloté comporte: - un compteur-décompteur recevant ledit signal d'horloge et délivrant ladite valeur de comptage périodique codée sur n bits; - un circuit multiplexeur recevant, d'une part, lesdites m valeurs d'initialisation codées sur n bits CAMij, et, d'autre part, la valeur de comptage codée sur n bits BLi, délivrée par le compteur-décompteur, ledit circuit multiplexeur délivrant les valeurs de bit correspondantes; - une pluralité de n circuits amplificateurs inverseurs, recevant chacun une valeur de bit et délivrant cette valeur de bit et la valeur complémentée de cette valeur de bit BLBi. 3. Générateur selon l'une des revendications 1 ou 2, caractérisé en ce que chaque cellule mémoire de type RAM comprend au moins un premier et un deuxième transistor MOS (T1, T2) dont l'électrode de grille est connectée en paral- lèle à ladite ligne de mot WL1, et dont l'électrode de source, respectivement de drain, reçoit la valeur de bit BLi, respectivement la valeur de bit complémentée BLBi, et dont l'électrode de drain, respectivement de source, est reliée par l'intermédiaire de deux inverseurs connectés en tête-bêche, le point commun entre les deux inverseurs et l'électrode de source du deuxième transistor MOS délivrant la valeur mémorisée Mij. 4. Générateur selon l'une des revendications 1 à 3, caractérisé en ce que ladite cellule mémoire CAM comprend au moins: - un premier et un deuxième transistor MOS (T3, T4) dont l'électrode de grille est connectée en parallèle à ladite ligne de mot WL2j et dont l'électrode de source, respectivement de drain, reçoit la valeur de bit BLi, respectivement la valeur de bit complémentée BLB1, et dont l'électrode de drain, respectivement de source, est reliée par l'intermédiaire de deux inverseurs connectés en tête- bêche; - un troisième et un quatrième transistor MOS (T5, T6) connectés en cascade par l'intermédiaire d'un point commun entre leur électrode de drain et électrode de source, l'électrode de source du troisième transistor MOS (T5) recevant la valeur de bit BLi et l'électrode de drain du quatrième transistor MOS (T6) recevant la valeur de bit complémentée BLBi, les électrodes de grille du troisième (T5) et du quatrième (T6) transistor MOS étant connectées à l'électrode de source du deuxième (T4), respectivement de drain du premier (T3) transistor MOS; - un cinquième transistor MOS (T7) dont l'électrode de source est connectée à la tension de référence et l'électrode de grille est connectée audit point commun du troisième et du quatrième transistor MOS (T5, T6), l'élec- trode de drain dudit cinquième transistor MOS (T7) délivrant ladite valeur complémentée du produit OU exclusif entre lesdites valeurs mémorisées CAMij et BLi. 5. Générateur selon les revendications 1, 3 et 4, caractérisé en ce que le couplage de type OU entre cellules mémoire CAM et RAM de même adresse i,j est réalisé par l'intermédiaire d'un transistor MOS (T8) de couplage dont l'électrode de source reliée à l'électrode de drain dudit cinquième transistor MOS (T7) reçoit ladite valeur complé- mentée du produit OU exclusif entre les valeurs mémorisées CAM.j et BLi, dont l'électrode de grille est connectée au point commun entre le deuxième transistor MOS (T2) et les inverseurs tête-bêche de la cellule mémoire RAM de même adresse i,j, et dont l'électrode de drain délivre ladite valeur résultante HITij = (CAMij BLi) + Mij. 6. Générateur selon les revendications 1, 3, 4 et 5, caractérisé en ce que le couplage par une fonction logique de type OU de toutes les cellules de comparaison Cij d'une même ligne de rang j est effectué par l'interconnexion en parallèle de toutes les électrodes de drain des transistors MOS (T8) de couplage à une ligne de sortie connectée à la sortie Sj de rang j correspondant. 7. Générateur selon l'une des revendications 1 à 6, caractérisé en ce que chaque ligne de cellules de comparai- son de rang j est dédoublée en une première et une deuxième ligne élémentaire de cellules de comparaison, chaque ligne élémentaire de cellules de comparaison étant programmable indépendamment et complémentairement l'une de l'autre, de façon à délivrer des motifs de trains d'impulsion complémen- taires, et interconnectées chacune à une première et une deuxième sortie élémentaire respectivement, ledit générateur comportant en outre, pour chaque couple de première et deuxième ligne élémentaire de cellules de comparaison: - un circuit logique de type OU interconnecté auxdites première et deuxième sorties élémentaires et délivrant un signal superposition desdits motifs de trains d'impulsion complémentaires; - un circuit de type bistable recevant ledit signal superposition et délivrant un signal résultant, dont la résolution temporelle est égale à celle de la période du signal d'horloge de référence.