Brevet FR2688628A1 — publié le 19930917

ASSEMBLAGE TRIDIMENSIONNEL DE COMPOSANTS ELECTRONIQUES PAR MICROFILS ET GALETTES DE SOUDURE ET PROCEDE DE REALISATION DE CET ASSEMBLAGE DESCRIPTION L'invention a pour objet un assemblage de composants électroniques à semi-conducteurs miniaturisés, faisant intervenir des interconnexions tridimensionnelles, ainsi que son procédé de réalisation. Ces composants électroniques peuvent être des puces de circuits intégrés ainsi que des substrats d'interconnexion équipés d'une ou plusieurs couches de conducteurs électriques. L'invention trouve une application dans les domaines de la microélectronique, de l'informatique, de l'optoélectronique et du traitement de signal. On cherche de plus en plus à miniaturiser les systèmes électroniques ou informatiques utilisant des circuits intégrés. Or, l'un des facteurs limitatifs de la taille de ces systèmes est aujourd'hui l'assemblage des puces et des circuits intégrés ainsi que leur interconnexion. Dans le but de réaliser des circuits complexes denses, plusieurs approches ont été réalisées. La première approche a été de supprimer les bottiers électroniques autour des puces et d'hybrider directement Les puces avec des billes de soudure sur des substrats multicouches réalisant les interconnexions entre Les puces. Cette première technique dite "flip-chip" conduit à l'hybridation de centaines de puces sur des substrats céramiques (technique "multi-chip module"). Elle est décrite par exemple dans le brevet IBM US-A-4 202 007 et dans le document FR-A-2 611 986 (Thomson Semiconducteurs). Cette technique permet d'occuper une surface d'interconnexion au minimum égale à la somme totale des surfaces des puces hybridées, puisqu'elles se trouvent toutes dans un même plan. Une deuxième technique dite "tridimensionnelle" permet de ramener les interconnexions dans un volume réduit par rapport à celui de la première technique. Cette seconde technique consiste à coller les puces les unes sur les autres et à réaliser une technologie sur la tranche du bloc ainsi obtenu de manière à interconnecter les puces entre elles par leur tranche. Cette deuxième technique est relativement complexe et coûteuse à mettre en oeuvre, ce qui fait qu'elle n'est pas utilisée actuellement en fabrication. Elle est en particulier décrite dans la publication IEEE transactions on CHMT, Dec. 90, vol. 13, n04, pp. 814-821 de C. Val et T. Lemoine, "3-D Interconnection for ultra-dense multichip". Par ailleurs, en vue de réduire La longueur des fils de liaison entre les circuits intégrés ou les puces et donc de limiter les capacités de lignes d'interconnexion qui sont des facteurs limitatifs des vitesses de commutation des assembLages actuels, on a envisagé de recouvrir l'emplacement de réception des puces, dans un bottier céramique multicouche, de nombreux plots conducteurs isolés les uns des autres pouvant servir de relais de soudure pour des fils de Liaison plus courts. Cet assemblage est notamment décrit dans le document FR-A-2 647 962. Cette dernière technique utilise des bottiers électroniques autour des puces et ne conduit donc pas à une miniaturisation suffisante de l'assemblage. La présente invention a justement pour objet un assemblage tridimensionnel de composants électroniques par microfilms et galettes de soudure ainsi que le procédé de réalisation de cet assemblage permettant de remédier aux différents inconvénients mentionnés ci-dessus. Ces composants électroniques peuvent être des puces d'un ou plusieurs circuits intégrés ou des substrats d'interconnexion. L'invention permet en particulier la réalisation d'un assemblage de puces de circuits intégrés dans un volume réduit, sur une surface largement inférieure à celle utilisée dans la première technique citée ci-dessus. Elle permet également la réalisation séparément d'un substrat d'interconnexion testable complexe multicouche, destiné à relier des puces entre elles, ce que ne permet pas la deuxième technique exposée où Les interconnexions sont réalisées après assemblage des puces. Elle permet en outre de réduire les longueurs des lignes d'interconnexions entre les puces et de limiter ainsi les capacités de ces lignes d'interconnexions. De façon plus précise, l'invention a pour objet un assemblage de composants électroniques comportant : A) - au moines un premier composant électronique muni sur une de ses faces d'au moins un premier plot de contact électrique équipé d'un microfil conducteur, orienté perpendiculairement à ladite face, 8) - au moins un second composant électronique muni sur une de ses faces d'au moins un second plot de contact électrique, les premier et second composants électroniques étant perpendiculaires, au contact L'un de l'autre et positionnés de façon que le microfil soit en regard du second plot de contact électrique, le microfil étant connecté au second plot conducteur, via un élément de soudure. Selon l'invention, L'assemblage comporte un ou plusieurs premiers composants électroniques comportant chacun un ou plusieurs premiers plots conducteurs pourvus chacun d'un microfil, destinés à être connectés. De même, l'assemblage comporte un ou plusieurs seconds composants électroniques comportant chacun un ou plusieurs seconds plots conducteurs. Dans cet assemblage, les premiers et seconds composants électroniques sont disposés à 900 l'un de l'autre, limitant ainsi la surface occupée par cet assemblage. En particulier, L'élément de soudure de l'assemblage se présente sous la forme d'une sphère. Les microfils peuvent présenter la forme d'un cylindre à base circulaire, la forme d'un parallélépipède à base carrée ou toute autre forme. Avantageusement, les microfilms ont une hauteur de 20 à 200um pour un diamètre ou largeur allant de 10 à 50m. Lorsque l'un des premier et second composants électroniques comporte n premiers plots conducteurs situés avantageusement sur un seul côté d'une même face du composant sur laquelle ils sont montés, avec n entier > 2, l'autre composant comporte n seconds plots disposés sur une même rangée et connectés respectivement aux n premiers plots. En vue d'une miniaturisation optimum, le centre du ou des seconds plots conducteurs du second composant électronique est situé à une distance d d'un bord de ladite face du second composant telle que d H représentant la hauteur de L'élément de soudure. Lorsque L'assemblage comporte deux seconds composants électroniques ou plus, équipés chacun de plusieurs seconds plots conducteurs, ces seconds composants électroniques sont orientés parallèlement entre eux et perpendiculairement à un premier composant électronique, ce dernier comportant au moins deux séries de premiers plots conducteurs équipés de microfils, disposés selon deux droites parallèles et connectés respectivement aux seconds plots des deux seconds composants électroniques. Dans ce cas particulier, le premier composant électronique est un substrat d'interconnexion par exemple en céramique du type multicouche et les seconds composants électroniques sont des puces de circuits intégrés. Ainsi, en disposant Les seconds composants électroniques sur leur tranche, on obtient une miniaturisation optimum de l'assemblage. Il est aussi possible, selon l'invention, que le premier composant électronique consiste en une puce de circuit intégré. Dans ce cas, le second composant électronique peut alors être un substrat d'interconnexion, du type multicouche. Dans ce cas, l'assemblage comporte au moins deux premiers composants électroniques parallèles entre eux et connectés perpendiculairement à un second composant électronique. L'invention a encore pour objet un procédé permettant la réalisation de l'assemblage décrit précédemment. Aussi, l'invention se rapporte encore à un procédé d'assemblage d'au moins un premier composant électronique muni sur une de ses faces d'au moins un premier plot de contact électrique et d'au moins un second composant électronique muni sur une de ses faces d'au moins un second plot de contact électrique destiné à être connecté au premier plot, comportant les étapes suivantes : a) - réalisation d'un microfil conducteur sur le premier plot de contact, oriente perpendiculairement à ladite face du premier composant ; b) - réalisation d'un élément de soudure sur le second plot de contact, cet élément étant constitué d'un matériau conducteur dont le point de fusion est inférieur à celui du premier et second plots et à celui du microfil, ce matériau étant apte à mouiller le second plot et le microfil c) - positionnement des premier et second composants électroniques perpendiculairement entre eux et au contact l'un de l'autre par la tranche, de façon que le microfil soit en regard de l'élément de soudure ; d) - chauffage de l'ensemble pour fondre ltélément de soudure et assurer la fixation du microfil sur l'élément de soudure, e) - refroidissement de l'ensemble à une température inférieure à la température de fusion de l'élément de soudure. Jusqu'à ce jour, les fils destinés à la connexion des puces de circuits intégrés entre elles étaient des fils rapportés qu'on soudait sur des plots conducteurs. Or, conformément à l'invention, les microfilms conducteurs sont réalisés par mi crolithographie. Ces microfils peuvent être réalisés soit par la technique "lift-off" (dépôt d'une couche photosensible, formation d'ouvertures dans cette couche en regard des premiers plots de contact, dépôt sur l'ensemble de la structure d'un matériau conducteur puis élimination de la résine). De façon avantageuse, l'étape a) consiste à déposer sur le premier composant une couche continue conductrice métallique puis une couche de résine photosensible, à former dans cette couche de résine au moins une ouverture en regard du premier plot de contact à connecter, à déposer électrolytiquement du métal dans ladite ouverture, à éliminer la résine puis la couche continue métallique présente entre les microfilms. De façon avantageuse, l'étape b) consiste à former sur chaque second plot conducteur une galette plate en matériau de soudure conducteur dont la surface est supérieure à celle du second plot. Dans l'étape (d) lorsque ces galettes sont chauffées au-dessus du point de fusion du matériau de soudure les constituant, Les forces de tension superficielle en modifient La forme et elles se mettent sous la forme d'une sphère dont la hauteur est supérieure à celle de la galette avant sa fusion. Suivant l'étape (e) et si cela est nécessaire, l'ensemble obtenu peut être rigidifié par un enrobage tel qu'un matériau isolant de protection utilisé classiquement lors de la mise en bottier de circuits électroniques. L'invention a aussi pour objet la fabrication des circuits intégrés permettant la mise en oeuvre du procédé conforme à L'invention. Ainsi, l'invention a encore pour objet un circuit intégré comportant sur l'une de ses faces plusieurs premiers plots de contact électrique devant être connectés à des seconds plots de contact électrique d'un autre circuit intégré, caractérisé en ce que les premiers plots de contact comportent chacun un microfil conducteur orienté perpendiculairement à ladite face, réalisé par microlithographie. L'invention a encore pour objet un circuit intégré comportant sur une de ses faces plusieurs seconds plots de contact électrique devant être connectés à des premiers pLots de contact électrique d'un autre circuit intégré, caractérisé en ce que les seconds plots de contact comportent chacun une galette de soudure dont le point de fusion est inférieur à celui des seconds plots, la galette ayant une surface supérieure à celle de chaque second plot. D'autres caractéristiques et avantages de l'invention ressortiront mieux de la description qui va suivre, donnée à titre illustratif et non limitatif, en référence aux figures annexées dans lesquelles - la figure 1 montre un substrat d'interconnexion destiné à être assemblé selon l'invention, comportant une série de microfils. - la figure 2 montre, de façon plus détaillée, un microfil du substrat de la figure 1, - la figure 3 montre un circuit intégré destiné à être assemblé sur le substrat d'interconnexion de la figure 1, ce circuit intégré comportant les éléments de soudure destinés à être soudés au microfil ; - La figure 4 montre le détail d'un élément de soudure du circuit intégré de la figure 3, avant sa soudure ; - la figure 5 montre le détail d'un élément de soudure du circuit intégré de la figure 3, après sa fusion - la figure 6 montre l'assemblage réalisé d'une série de circuits intégrés sur un substrat d'interconnexion, conformément à l'invention ; - la figure 7 montre le détail de l'assemblage, d'un microfil et d'une galette de soudure, avant la fonte de celle-ci ; - la figure 8 montre le détail d'une interconnexion à microfil réalisée selon l'invention ; - les figures 9 et 10 montrent l'assemblage de puces de circuit intégré sur un substrat d'interconnexion, conformément à l'invention, respectivement avant et après la fusion de l'élément de soudure ; - la figure 11 représente schématiquement L'enrobage par un matériau de protection de l'assemblage de la figure 6. La figure 1 montre une partie d'un substrat d'interconnexion multicouche 1, fabriqué conformément à l'art antérieur. Ce substrat est constitué d'un substrat isolant 2 en céramique (Al O . Six . etc.) ou en matière plastique rigide (polyméthacrylate de méthyle par exemple) comportant une ou plusieurs couches telles que 3 et 4 de lignes électriquement conductrices. Les lignes 3 sont logées dans le substrat et les lignes 4 sont formées en surface du substrat. Ces lignes conductrices peuvent être reliées électriquement entre elles ou être isolées selon leur besoin et contituent un réseau d'interconnexion. Un tel substrat est notamment celui décrit dans le brevet d'IBM USA-4 202 007. Les sorties électriques de ce substrat multicouche 1 aboutissent à des plots de contact électrique 5 ou 6. Les plots de contact 5 formés sur l'ensemble de la surface la de grande dimension du substrat 1 sont destinés à la liaison des lignes conductrices 3 et 4 du substrat multicouche et à la connexion d'un point particulier d'un circuit intégré à un point particulier d'un autre circuit intégré. Les plots de contact 5 sont formés sur des ouvertures 9 pratiquées dans le matériau isolant 2 du substrat. Ils sont disposés selon des rangées parallèles entre elles sur la surface la. Les sorties électriques 6 sont destinées à une sortie ou à une entrée d'un signal extérieur au substrat 1. Elles sont situées à la périphérie de la surface la du substrat. Conformément à l'invention, le substrat 1 comporte sur ses plots de contact électrique 5, destinés à la liaison de lignes conductrices 3 ou 4 du substrat d'interconnexion, des microfils verticaux 7 dont un exemplaire est représenté de façon pLus détaillée sur la figure 2. Le microfil 7 représenté sur la figure 2 a la forme d'un cylindre à base circulaire, mais bien entendu d'autres formes peuvent être envisagées. Chaque microfil 7 est constitué d'un matériau électriquement conducteur, par exemple en nickel, en cuivre, en argent, etc. Il présente une hauteur L qui peut atteindre de 20 à 200um pour un diamètre I de 10 à 50pu. Ceci permet des connexions à un pas faible. Typiquement, pour un diamètre de 10pu, on obtient un pas de 15pu. Chaque microfil 7 est formé selon les techniques de microlithographie sur les plots conducteurs 5, par exemple par croissance électroLytique d'un métal dans des ouvertures pratiquées dans une résine photosensible déposée sur une couche conductrice continue métallique, elle-même déposée à la surface la du substrat, puis élimination de La résine et de la couche conductrice métallique se trouvant en dehors du microfil. Les ouvertures dans la résine sont réalisées par photolithographie (insolation à travers un masque mécanique fixant l'emplacement des ouvertures, puis révélation). Le substrat d'interconnexion 1 de la figure 1 est destiné à recevoir un ou plusieurs circuits intégrés tels que représentés sur la figure 3. Ces circuits portent la référence générale 10. Ils sont réalisés de façon connue et comportent sur l'une de leurs faces de grande dimension 12 des plots de contact électrique 13 destinés à leur interconnexion (voir figure 6). Le nombre de plots de contact électrique 13 de chaque circuit intégré est par exemple égal à celui des plots de contact 5 d'une même rangée. Conformément à l'invention, ces plots de contact électrique 13 sont tous disposés sur un même bord de la face 12 du circuit intégré (ici le bord inférieur 14). Ces plots de contact 13 ont leur centre disposé approximativement selon une droite A parallèle au bord 14 de La face 12. La distance séparant la droite A du bord 14 est notée d. Conformément à l'art antérieur, les plots de contact électrique 13 sont formés dans une couche supérieure d'isolant électrique. Conformément à l'invention, chaque plot conducteur 13 est destiné à être connecté à un plot conducteur 5, via les microfils 7 et des éléments de soudure, représentés de façon plus détaillée sur les figures 4 et 5, respectivement avant et après leur fusion. Les éléments de soudure sont constitués d'un matériau conducteur électrique dont le point de fusion est inférieur à celui des microfils 7 ainsi qu'à celui des contacts électriques 13 et 5 à interconnecter. Ces éléments de soudure sont déposés par une technique dite "lift off" sur les plots 13. Ils présentent La forme d'une galette 15a avant leur fusion (voir figure 4) dont la surface est supérieure à celle du plot de contact éLectrique 13. En pratique, h vaut de 4 à 50um pour des plots de contact 13 de 0,1 à 5ym d'épaisseur (e). Les éléments de soudure sont en particulier réalisés en étain, en un alliage d'or et d'étain, en alliage d'étain-plomb ou tout autre matériau classique de soudure et les plots de contact électrique 5 et 13 sont réalisés en or, nickel, platine ou cuivre. Lorsque les galettes 15a de soudure sont chauffées au-dessus du point de fusion du métal les constituant, les forces de tension superficielle en modifient la forme et elles se mettent, comme représenté sur la figure 5, sous la forme d'une sphéroide 15b de hauteur H supérieur à fl. Typiquement H varie de 10 à 200pu. Conformément à l'invention, la distance d entre le centre des plots de contact 13 et le bord inférieur 14 du circuit intégré sur lequel les plots sont implantés, satisfait à la relation d Le substrat d'interconnexion 1 équipé de ses microfils 7 et des circuits intégrés 10a, 10b, 10c équipés de leurs éléments de soudure 15a, sous forme de galettes, et réalisés comme sur la figure 3, peuvent alors être connectés, comme représenté sur la figure 6. Le substrat d'interconnexion 1 est disposé horizontalement dans un appareil équipé de moyens de chauffage teLs qu'un four. Les circuits intégrés, respectivement 10a, lOb,..., 10c sont disposés verticalement sur les sites de réception 16a, 16b et 16c du substrat d'interconnexion 1 ; ces sites de réception sont équipés chacun d'une rangée de plots de contact 5 muni de leurs microfils 7. Ainsi, les différents circuits intégrés îOa- 10c sont disposés parallèlement entre eux, leurs faces 12 équipées des plots de contact 13 à connecter étant situées en regard de la face de circuit intégré contigue, dépourvue des plots de contact. Les circuits intégrés 10a-10c sont positionés de façon à reposer sur leur tranche et les galettes 15a sont en regard des microfils 7, comme représenté de façon plus détaillée sur la figure 7. Le positionnement des circuits intégrés 10a à 10c sur les sites 16a-16c du substrat 1 est réalisé avec une précision telle que la surface des éléments de soudure 15a en forme de galettes (c'est-à-dire avant soudure) se trouve à une distance D des microfils 7 inférieure ou égale à H-h. Cette distance D peut être par exemple de 20fm maximum pour des galettes de soudure 15a 2 d'épaisseur h de 12,um et d'une surface de 1200 (soit 30mx40m). L'ensemble ainsi réalisé est chauffé à une température supérieure à celle du point de fusion des galettes 15a en atmosphère inerte (azote par exemple) ou en atmosphère réductrice (hydrogène par exemple). Les galettes 15a prennent alors la forme d'un sphéroide 15b, comme représenté de façon plus détaillée sur la figure 8 ; ces derniers viennent au contact des microfils 7 et se soudent à ceux-ci. La température de l'ensemble est ramenée à une température inférieure à la température de fusion du métal de soudure et en particulier à la température ambiante. Chaque sphéroide 15b de soudure étant alors connecté à un microfil 7, il s'ensuit que chaque plot de contact 5 est relié à un plot de contact 13 et par conséquent que les lignes conductrices 3 et 4 du substrat 1 se trouvent connectées avec les éléments de circuit des circuits 10a-10c, par l'intermédiaire du substrat multicouche 1. L'assemblage final est celui représenté sur la figure 6. Sur les figures 9 et 10, on a représenté une variante de réalisation de l'assemblage de circuits intégrés et du procédé d'assemblage, conformes à l'invention. Dans cette variante, le substrat d'interconnexion 1 équipé de ses lignes d'interconnexion (3 par exemple) et de ses plots de contact 5 est destiné à être connecté à des puces de circuit intégré 17 équipées de plots de contact 13. Dans ce mode de réalisation, les plots de contact 5 du substrat 1 sont recouverts de l'élément de soudure et les plots de contact 13 des puces de circuit intégré 17 sont équipés de microfils 7. La figure 9 représente l'assemblage avant fusion des galettes 15a de soudure et la figure 10 représente l'assemblage après fusion des éléments de soudure, ces derniers ayant alors la forme de sphéro;des 15b. Dans ce mode de réalisation, les microfils 7 de chaque puce sont disposés au bord inférieur 14 de la puce correspondante ; plus précisément, le bord inférieur des microfils 7 est situé dans le même plan que le bord inférieur 14 des puces à assembler. Ceci peut être réalisé en découpant les microfils de chaque puce en même temps que la puce correspondante. Avant la soudure, les puces 17 sont inclinées par rapport à la surface la du substrat, les microfils 7 reposant sur les galettes 15a de soudure. Durant la soudure, les forces de tension superficielle ramènent les puces 17 à assembler perpendiculairement au substrat d'interconnexion 1 (voir figure 10) et au contact de celui-ci. Si cela s'avère nécessaire, l'assemblage obtenu peut être rigidifié par un enrobage tel que celui classiquement réalisé pour la mise en bottier de circuit électronique. Cet enrobage est en particulier représenté sur la figure 11. Il permet une rigidification mécanique de l'assemblage. Dans le mode représenté, il est constitué d'un matériau isolant électrique 18 par exemple en colle époxy déposée aux pieds des puces 10a-10c assemblées sur le substrat 1. Il est toutefois possible de disposer cet assemblage, comme représenté en pointillé sur la figure 11, de façon à ce qu'il recouvre toute La partie en regard de deux puces successives. REVENDICATIONS 1. Assemblage de composants électroniques comportant : A) - au moins un premier (1, 17) composant électronique muni sur une de ses faces (la, 17a) d'au moins un premier plot (5, 13) de contact électrique équipé d'un microfil (7) conducteur, orienté perpendiculairement à ladite face, B) - au moins un second composant électronique (10, 10a, 10b, 10c, 1) muni sur une de ses faces (12, la) d'au moins un second plot (13, 5) de contact électrique, les premier et second composants électroniques étant perpendiculaires, au contact l'un de l'autre et positionnés de façon que le microfil soit en regard du second plot de contact électrique, le microfil étant connecté au second plot conducteur, via un élément de soudure (15b). 2. Assemblage selon la revendication 1, caractérisé en ce que L'élément de soudure se présente sous la forme d'une sphère (15b). 3. Assemblage selon la revendication 1 ou 2, caractérisé en ce que le microfil (7) a une hauteur de 20 à 200um et un diamètre ou largeur allant de 10 à 50Hm. 4. Assemblage selon l'une quelconque des revendications 1 à 3, caractérisé en ce que l'un des premier et second composants électroniques (10, 17) comporte n premiers plots (13) situés sur un seul côté (14) de la même face du composant électronique avec n entier > 2, et en ce que l'autre composant électronique (1) comporte n seconds plots (5) disposés sur une même rangée et connectés respectivement aux n premiers plots. 5. Assemblage selon l'une quelconque des revendications 1 à 4, caractérisé en ce que le centre du ou des seconds plots conducteurs (13) est situé à une distance d d'un bord (14) de ladite face du second composant électronique (10) telle que d 6. Assemblage selon l'une quelconque des revendications 1 à 4, caractérisé en ce que le bord inférieur du ou des microfils est situé dans le même plan que le bord inférieur (14) de la face du premier composant électronique (17). 7. Assemblage selon l'une quelconque des revendications 1 à 6, caractérisé en ce qu'il comprend au moins deux seconds composants électroniques (10a, 10b, 10c) comportant plusieurs seconds plots conducteurs, ces seconds composants électroniques étant orientés parallèlement entre eux et un premier composant électronique (1) comportant au moins deux séries de premiers plots conducteurs équipés de microfils, disposés selon deux droites parallèles et connectés respectivement aux seconds plots des deux seconds composants électroniques. 8. Assemblage selon l'une quelconque des revendications 1 à 7, caractérisé en ce que le premier composant électronique est un substrat d'interconnexion (1) et Le ou les seconds composants électroniques sont des puces de circuits intégrés (10a, 10b, 10c). 9. Assemblage selon l'une quelconque des revendications 1 à 8, caractérisé en ce que le ou les seconds composants électroniques (10a, lOb, 10c) reposent sur leur tranche sur le premier composant électronique (1). 10. Assemblage selon l'une quelconque des revendications 1 à 4, caractérisé en ce que le premier composant électronique (17) est une puce de circuit intégré et le second composant électronique (1) est un substrat d'interconnexion. 11. Assemblage selon la revendication 10, caractérisé en ce qu'il comprend au moins deux premiers composants électroniques (17) connectés à un second composant électronique (1). 12. Assemblage selon l'une quelconque des revendications 1 à 11, caractérisé en ce qu'un matériau isolant (18) d'enrobage est prévu. 13. Procédé d'assemblage d'au moins un premier composant électronique (1, 17) muni sur une de ses faces (la, 17a) d'au moins un premier plot de contact électrique et d'au moins un second composant électronique (10, 10a, 10b, 10c, 1) muni sur une de ses faces (12, la) d'au moins un second plot (13, 5) de contact électrique destiné à être connecté au premier plot de contact, comportant les étapes suivantes a) - réalisation d'un microfil (7) conducteur sur Le premier plot de contact, orienté perpendicuLai- rement à ladite face du premier composant ; b) - réalisation d'un élément de soudure (15a) sur Le second plot de contact, cet élément étant constitué d'un matériau conducteur dont le point de fusion est inférieur à celui du premier et second plots et à celui du microfil, ce matériau étant apte à mouiller le second plot et Le microfil ; c) - positionnement des premier et second composants électroniques perpendiculairement entre eux et au contact l'un de l'autre par la tranche, de façon que le microfil (7) soit en regard de l'élément de soudure (18a) d) - chauffage de L'ensemble pour fondre l'élément de soudure (15b) et assurer la fixation du microfil sur l'élément de soudure, e) - refroidissement de l'ensemble à une température inférieure à la température de fusion de l'élément de soudure. 14. Procédé selon la revendication 13, caractérisé en ce que l'étape a) est réalisée par mi crolithographie. 15. Procédé selon la revendication 13 ou 14, caractérisé en ce que l'étape a) consiste à déposer sur le premier composant une couche continue conductrice métallique puis une couche de résine photosensible, à former dans cette couche de résine au moins une ouverture en regard du premier plot de contact, à déposer électrolytiquement du métal dans ladite ouverture, à éliminer la résine puis la couche continue conductrice en dehors du microfil ainsi formé. 16. Procédé selon l'une quelconque des revendications 13 à 15, caractérisé en ce que l'étape b) consiste à former sur le second plot une galette (15a) plate en matériau de soudure conducteur dont la surface est supérieure à celle du second plot. 17. Procédé selon l'une quelconque des revendications 13 à 16, caractérisé en ce que l'on enrobe l'assemblage (18) obtenu par un matériau isolant de protection approprié. 18. Circuit intégré comportant sur une de ses faces (la) plusieurs premiers plots (5) de contact électrique, destiné à être assemblé par le procédé selon l'une quelconque des revendications 13 à 17, caractérisé en ce que les premiers plots de contact comportent chacun un microfil conducteur (7) orienté perpendiculairement à ladite face, réalisé par mi crolithographi e. 19. Circuit intégré comportant sur une de ses faces (12) plusieurs seconds plots (13) de contact électrique, destiné à être assemblé par Le procédé selon l'une quelconque des revendications 13 à 17, caractérisé en ce que les seconds plots de contact comportent chacun une galette de soudure (1 Sa) dont le point de fusion est inférieur à celui des seconds plots, la galette ayant une surface supérieure à celle de chaque second plot.