Brevet FR2657978A1 — publié le 19910809

"Procédé de stockage en mémoire pour le traitement d'images, et dispositif pour la mise en oeuvre du procédé' La présente invention concerne un procédé pour gérer le stoc- kage dans une mémoire d'un système de traitement d'images dans lequel les images sont traitées par blocs, chacun desdits blocs étant carré ou rectangulaire et contenant plusieurs pixels dans chaque direction hori- zontale et verticale, la description des pixels à l'intérieur d'un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne. Elle concerne aussi un dispositif pour calculer l'adresse d'un pixel dans une mémoire o sont rangées les descriptions des pixels d'une image traitée par blocs, chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V exprimées en nombre de pixels sont des puissances entières de deux, la description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne. Pour les algorithmes de compression d'images à bas débit d'in- formations, le traitement temporel tient une place importante, nécessi- tant une capacité de mémorisation importante En outre, pour ce type d'algorithmes, le nombre de pixels à traiter par unité de temps est fixe, ceci afin d'une part de ne pas dégrader les performances des algo- rithmes et d'autre part de fixer une limite à la complexité des systèmes de codage et de décodage Une conséquence directe est que le nombre de pixels à coder dans une image et par conséquent le nombre de mots mémoi- re nécessaire à son stockage est borné. Dans certaines applications de compression d'images o il est souhaitable d'admettre un format d'images (facteur de forme) variable, apparait le besoin de trouver une adéquation entre le format variable des images et la taille fixe de la mémoire destinée à recevoir des ima- ges lors du processus de décodage Un tel cas se présente dans une application multi-média comme le Disque Compact Interactif ("CDI"), o le format des images est variable. Un des points critiques pour la réalisation de décodeurs d'images comprimées sur la base de blocs se situe au niveau de la grande quantité nécessaire d'accès à la mémoire Les mémoires habituellement utilisées pour des raisons de coût et d'intégration sont des mémoires dynamiques caractérisées par un accès en deux temps consistant à fournir dans un premier temps l'adresse 'rangée' puis après un délai, fixé selon la mémoire utilisée, à fournir dans un second temps l'adresse 'colonne", et enfin accéder à l'information après un autre délai L'accès peut être plus rapide quand les informations à lire sont situées sur la même rangée soit à des adresses "colonne" consécutives, en utilisant un mode dit "nibble', soit à des adresses quelconques en utilisant un mode dit Nstatic column" Dans les deux cas, l'accès à la première information correspond aux deux temps décrits plus haut, mais l'accès aux informa- tions suivantes ne prend plus que le second temps. La présente invention tire notamment profit de l'existence du mode d'accès nstatic column' dans les mémoires utilisées. Une approche couramment utilisée dans l'art antérieur consistait à utiliser un adressage dit "bit map" qui consiste à plaquer dans la mémoire le tableau à deux dimensions représentant l'image Une telle approche trouve sa limite lorsque le format des images à mémoriser est variable En effet, en mode "bit map" si le format horizontal et le format vertical sont susceptibles de varier, il faut disposer d'une mémoire plus importante que celle contenant juste le nombre de pixels à afficher L'inconvénient qui en résulte est encore aggravé par le fait qu'il est nécessaire à un instant donné de mémoriser plusieurs images. Un autre inconvénient réside dans le mauvais rendement de l'utilisation de la place mémoire lorsque le nombre de pixels par lignes ou le nombre de lignes par image n'est pas un multiple ou un sous-multiple du nombre de colonnes ou du nombre de rangées des boîtiers mémoire. L'invention prend tout son intérêt lorsque le format d'image est variable Elle permet d'utiliser la capacité mémoire strictement nécessaire pour stocker une image, et ceci quel que soit le facteur de forme de celle-ci L'invention permet en outre d'accéder plus rapidement à des blocs dans l'image. tidée de base de l'invention s'appuie sur le fait que les algorithmes de compression d'images sont basés sur des blocs dont les dimensions horizontales et verticales sont des sous-multiples des dimensions de l'image Ainsi selon l'invention, les contenus (pixels) des différents blocs sont placés l'un à la suite de l'autre dans la mémoire. La mémoire étant organisée en rangées et en colonnes, on y place les contenus des différents blocs en incrémentant l'adresse colonne jusqu'à sa valeur limite, après quoi on ramène cette adresse à zéro et on incrémente l'adresse rangée, et ainsi de suite. Les blocs ayant des dimensions horizontale et verticale exprimées en nombre de pixels qui sont des puissances entières de deux, on calcule l'adresse mémoire du début d'un bloc contenant un pixel donné, à partir des coordonnées x, y de ce pixel dans l'image, au moyen d'opérations "division entière" et "modulo' avec comme dividende l'une desdites coordonnées x ou y et comme diviseur la susdite dimension respectivement horizontale ou verticale, ces opérations étant réalisées sur ces valeurs représentées par des mots binaires au moyen de dichotomies qui fournissent en tant que résultat d'une division entière les bits dont le rang est supérieur à la susdite puissance de deux, et en tant que résultat d'une opération modulo les bits dont le rang est inférieur ou égal à cette même puissance de deux. Un dispositif muni d'une mémoire pour stocker une image traitée par blocs, chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V exprimées en nombre de pixels sont des puissances entières de deux, respectivement m et p, et la description des pixels contenus dans un bloc étant faite en considé- rant les pixels les uns après les autres ligne par ligne dans ce bloc, est remarquable en ce que, les descriptions complètes de chacun des dif- férents blocs étant placées l'une à la suite de l'autre dans la mémoire qui est organisée en rangées et en colonnes, il comporte des moyens pour calculer le numéro d'un bloc dans la mémoire à partir des coordonnées x, y d'un pixel de ce bloc, qui sont constitués de deux opérateurs maté- riels qui à partir des mots binaires représentant les valeurs de x et de y en extraient les bits de poids supérieur à respectivement m et p, d'un multiplieur auquel sont fournis en tant que multiplicandes, d'une part le nombre de blocs par ligne d'image, et d'autre part le mot binaire fait des bits extraits par l'un des susdits opérateurs dans le mot binaire représentant y (bits qui représentent la coordonnée verticale dans l'image du bloc contenant le pixel), et d'un additionneur aux deux entrées duquel sont fournis, d'une part le résultat issu du susdit mul- tiplieur, et d'autre part le mot binaire constitué par les bits extraits par l'autre des susdits opérateurs dans le mot binaire représentant x (bits qui représentent la coordonnée horizontale dans l'image du bloc contenant le pixel). Si l'on désire pouvoir modifier à la demande le format d'image, ce dispositif comporte avantageusement aussi un opérateur maté- riel extrayant de la valeur de la dimension horizontale d'une image les bits de poids supérieur à m, de façon à fournir pour chaque format le nombre de blocs par ligne d'image. En outre, le dispositif comporte avantageusement des moyens pour calculer l'adresse relative d'un pixel dans un bloc à partir de son adresse x, y dans l'image, qui sont constitués de deux opérateurs extrayant respectivement dans les mots binaires représentant la valeur de x et de y, les m et p bits de plus faible poids, les deux groupes de blocs extraits étant fournis à un opérateur qui décale de m bits vers la gauche le groupe de bits extrait de y par l'un des susdits opérateurs, et le concatène avec le groupe de bits extrait de x par l'autre susdit opérateur, ces opérateurs étant matériels. Le dispositif comporte en outre avantageusement des moyens pour calculer les adresses rangée et colonne d'un pixel dans la mémoire à partir du numéro du bloc qui contient ce pixel et de l'adresse relati- ve du pixel dans le bloc, qui sont constitués d'un opérateur séparant dans le mot binaire représentant le numéro du bloc les "e" bits de plus faible poids, o New est un entier tel que deux puissance "e" est égal au nombre de blocs par rangée de mémoire, ces 'e' bits étant amenés à un élément de concaténation o ils sont décalés vers la gauche et concaté- nés avec les bits représentant l'adresse relative du pixel dans le bloc, pour fournir la composante de l'adresse recherchée dans-la direction horizontale, c'est-à-dire le numéro de colonne de mémoire, les autres bits (de poids supérieur à "e") fournissant la composante de l'adresse recherchée dans la direction verticale, c'est-à-dire le numéro de rangée de mémoire. L'image traitée par blocs est donc organisée en un réseau de blocs régulièrement disposés (comme un damier) Néanmoins, lorsqu'une méthode de compensation de mouvement, connue en soi, est utilisée, le décodage d'images comprimées impose d'accéder non seulement aux données d'un bloc correspondant exactement à un bloc H*V du réseau de blocs d'une image, mais aussi à un bloc décalé horizontalement et/ou vertica- lement par rapport à un bloc du réseau et par conséquent appartenant à quatre blocs différents du réseau A cet effet, pour calculer l'adresse en mémoire des pixels contenus dans un bloc de l'image qui est décalé par rapport à un bloc du susdit réseau, le calcul étant fait à partir de l'adresse de ce bloc (A) du réseau, dit bloc de référence, et du décala- ge du bloc décalé par rapport à ce bloc de référence, en connaissant le nombre de blocs contenus horizontalement dans l'image, le dispositif comporte un ensemble constitué: -de premiers moyens pour, à partir du décalage du bloc décalé, calculer de combien le bloc est décalé horizontalement et verticalement par rap- port au bloc de référence et pour calculer sa position relative par rap- port au bloc du réseau qui contient son point de départ, horizontalement et verticalement, -de seconds moyens pour calculer à partir du décalage du bloc décalé, de l'adresse du bloc de référence, et du nombre de blocs par image en horizontal, le numéro, dans l'image, du bloc qui contient le point de départ du bloc décalé, -de troisièmes moyens pour générer les deux composantes de l'adresse relative du pixel à l'intérieur du bloc dont le numéro est donné par les moyens précédents, -de quatrièmes moyens pour décaler vers la gauche les bits de la compo- sante verticale de l'adresse relative du pixel et les concaténer avec les bits de la composante horizontale de cette adresse relative, pour fournir une adresse 'linéaire' relative dans le bloc de la mémoire (on entend par %adresse linéaire" le fait qu'elle est calculée en numérotant consécutivement tous les pixels d'un bloc à partir du début), -de cinquièmes moyens constitués d'un opérateur séparant dans le mot binaire indiquant le numéro du bloc les "el bits de plus faible poids, o 'e" est un entier tel que deux puissance Ze" est égal au nombre de blocs par rangée de mémoire, ces "e* bits étant amenés à un élément de concaténation o ils sont décalés vers la gauche et concaténés avec les bits issus des moyens précédents pour fournir la composante de l'adresse recherchée dans la direction horizontale (numéro de colonne de mémoire), les autres bits dudit mot binaire fournissant la composante de l'adresse recherchée dans la direction verticale (numéro de rangée de mémoire). Les susdits premiers moyens peuvent avantageusement être consti- tués d'un opérateur séparant les m bits de plus faible poids dans le mot binaire exprimant la valeur dans la direction horizontale du décalage du bloc décalé par rapport au bloc de référence, et d'un opérateur sépa- rant les p bits de plus faible poids dans le mot binaire exprimant la valeur dans la direction verticale du décalage du bloc décalé par rap- port au bloc de référence. Les susdits seconds moyens peuvent avantageusement être cons- titués d'un premier additionneur faisant la somme de la valeur de l'adresse du bloc de référence dans la direction verticale et de la valeur du décalage du bloc décalé dans la direction verticale, d'un mul- tiplieur pour multiplier le résultat délivré par ce premier additionneur avec la valeur du nombre de blocs par image dans la direction horizonta- le, d'un deuxième additionneur faisant la somme de la valeur de l'adres- se du bloc de référence dans la direction horizontale et de la valeur du décalage du bloc décalé dans la direction horizontale, et d'un troisième additionneur faisant la somme de la valeur délivrée par le deuxième additionneur et de la valeur délivrée par le multiplieur. Les susdits troisièmes moyens peuvent avantageusement être constitués par un premier groupe d'éléments comprenant un multiplexeur pour délivrer une valeur choisie entre, soit zéro, soit la valeur de la position relative, dans la direction horizontale, du bloc décalé par rapport au bloc du réseau qui continet son point de départ, et d'un compteur qui peut être initialisé avec la valeur délivrée par le multi- plexeur et qui au rythme d'une horloge délivre la composante horizontale de l'adresse relative du pixel, et par un deuxième groupe constitué de façon identique et qui traite les éléments correspondants dans la direc- tion verticale. Les troisièmes moyens peuvent en outre contenir un groupe d'éléments comprenant un circuit arithmétique délivrant le complément à deux du mot binaire exprimant la valeur de la position relative, dans la direction horizontale, du bloc décalé par rapport au bloc du réseau qui contient son point de départ, un multiplexeur pour délivrer une valeur choisie entre, soit zéro, soit le susdit complément à deux, et un comp- teur qui peut être initialisé avec la valeur délivrée par le multiple- xeur et qui au rythme d'une horloge délivre la composante horizontale de l'adresse relative du pixel, et un autre groupe d'éléments constitué de façon identique et qui traite les éléments correspondants dans la direction verticale. La description qui va suivre, en regard des dessins annexés décrivant des exemples non limitatifs fera bien comprendre comment l'in- vention peut être réalisée. La figure 1 illustre un inconvénient du procédé dit "bit map'. La figure 2 illustre le mode de description par blocs dans une image. La figure 3 illustre le rangement de la description des blocs en mémoire. La figure 4 est un schéma du dispositif pour calculer les adresses. La figure 5 illustre la position dans une image d'un bloc compensé en mouvement. La figure 6 illustre les positions occupées dans la mémoi- re par le bloc E de la figure 5. La figure 7 illustre un dispositif pour calculer les adresses en mémoire des pixels d'un bloc compensé en mouvement. Les figures 8 à Il illustrent plus en détail différents modules du dispositif de la figure 7. La figure 12 est un diagramme du temps pour les opérations réalisées par le dispositif GENADR des figures 7 et 8. Les figures 13 et 14 illustrent une réalisation simplifiée du dispositif de la figure 7 pour le cas d'un bloc non compensé en mou- vement. Sur la figure 1, le cadre 24 représente une mémoire orga- nisée en rangées R et en colonnes C Lorsqu'une organisation "bit map" est employée, la rangée de mémoire doit être assez longue pour contenir la largeur de l'image 25 qui y est plaquée Mais si l'on désire que le format d'image puisse être changé et que par exemple une image 26 moins large mais plus haute puisse aussi être utilisée, le nombre de rangées de la mémoire doit être suffisant pour contenir l'image 26 En outre comme le nombre de pixels par ligne ou le nombre de lignes par image n'est pas un multiple ou un sous-multiple du nombre de colonnes ou du nombre de rangées des boîtiers mémoire, la dimension de la mémoire est encore un peu plus grande que celle correspondant à la largeur de l'ima- ge 25 par la hauteur de l'image 26 La mémoire peut contenir une image symbolisée par le cadre 24 alors qu'elle aura seulement à contenir une des images 25 ou 26 Si par exemple le format horizontal et le format vertical sont susceptibles de varier dans des rapports 1/2, 1, ou 2, il faut disposer d'une mémoire quatre fois plus importante que celle contenant juste le nombre de pixels à afficher. Le traitement d'une image par blocs est illustré sur la figure 2, o sont représentés deux blocs avec leur dimensions horizontale H et verticale V qui sont ici toutes deux égales à 8 L'ordre dans lequel les descriptions des pixels sont traitées et rangées dans la mémoire est indiqué par des flèches Les graduations indiquent les coordonnées des pixels dans l'image selon x et selon y La figure représente les deux premiers blocs en haut et à gauche d'une image et suggère quelques autres blocs en les représentant partiellement: une image est ainsi constituée d'un réseau de blocs régulièrement disposés comme un damier. Une mémoire organisée avec une dimension "horizontale" MEMDIMH de 512 colonnes et une dimension "verticale" MEMDIMV de 512 rangées est schématisée sur la figure 3, o sont indiquées les positions dans les- quelles sont rangées les descriptions des blocs La notion d'horizontale ou de verticale est bien entendu une commodité de langage qui n'a rien à voir avec la disposition physique des éléments de mémoire, il ne s'agit en fait que des deux dimensions d'une matrice Les blocs référencés BLOCO et BLOC 1, par exemple, correspondent respectivement à la position en mémoire de la description du contenu du premier et du second bloc en haut et à gauche d'une image, qui sont représentés sur la figure 2. La représentation de la figure 3 correspond au cas o une ran- gée de la mémoire contient un nombre entier de blocs (ici huit blocs de O à 7) et o le nombre de rangées de mémoire (ici cinq cent douze rangées: de O à 511) multiplié par le nombre de blocs par rangée est égal au nombre total (entier) de blocs. Dans un cas non idéal, il suffirait, si à un moment donné la place restante dans une rangée de la mémoire n'est pas suffisante pour la description complète d'un bloc, de reporter le début de la descrip- tion de ce bloc à la rangée suivante Néanmoins, pour des commodités de description ultérieure, on supposera que la dimension horizontale MEMDIME de la mémoire est un multiple de H*V, et on nommera k l'entier égal à MEMDIMH / (H*V) Cette hypothèse est tout à fait réaliste car en pratique MEMDIMH, H, V sont toujours des puissances de deux. Pour éviter toute ambiguïté, en l'absence d'autre précision, on parlera d'une "position" lorsqu'il s'agit de position dans une image, FEV 90 et d'une 'adresse' lorsqu'il s'agit de position dans une mémoire. L'image à mémoriser possède les dimensions horizontales et verticales IMADIMH et IMADIMV, avec IMADIMH multiple de H et IMADIMV multiple de V On suppose bien entendu que la mémoire est suffisamment grande pour mémoriser tous les pixels de l'image c'est-à-dire: MEMDIMH*MEMDIMV > IMADIMH*IMADIMV. On posera: 2 puissance m est égal à H 2 puissance p est égal à V "div" devra être compris comme l'opérateur de division entière "mod" devra être compris comme l'opérateur modulo. Puisque le mode d'adressage est à base de blocs H par V, on détermine dans un premier temps le numéro du bloc H*V dans l'image à partir des coordonnées du pixel x, y dans l'image Pour cela on calcule les coor- données horizontales et verticales du premier élément du bloc H*V dans l'image, ADBLOCH et ADBLOCV: ADBLOCH = x div H ( 1) ADBLOCV = y div V ( 2) On en déduit le numéro de bloc dans l'image NUMBLOC, compté en une suite continue à partir du premier bloc en haut à gauche (figure 3): NUMBLOC = (IMADIMH div H) * ADBLOCV + ADBLOCH ( 3) A partir des coordonnées de chaque pixel, on détermine les adresses relatives ADRELH, ADRELV du pixel à l'intérieur du bloc: ADRELH = x mod H ( 4) ADRELV = y mod V ( 5) ADREL = ADRELV * H + ADRELH ( 6) Le calcul de l'adresse d'un bloc de l'image, BLOCH et BLOCV dans un adressage décrit selon l'invention s'effectue à partir de son numéro de bloc, NUMBLOC: BLOCH = (NUMBLOC mod k) * (H*V) ( 7) BLOCV = (NUMBLOC div k) ( 8) On dispose de tous les éléments pour calculer l'adresse ADRX de la ran- gée de mémoire et l'adresse ADRY de la colonne de mémoire, pour un pixel d'une image: ADRX = BLOCH + ADREL ( 9) ADRY = BLOCV ( 10) Le mode de réalisation du calcul de ADRX et ADRY à partir des calculs développés précédemment, en partant des coordonnées x, y, du pixel dans l'image, va être décrit maintenant en référence à la figure 4. On posera: 2 puissance a est égal à IMADIMH 2 puissance b est égal à IMADIMV 2 puissance alpha est égal à MEMDIMH 2 puissance beta est égal à MEMDIMV 2 puissance e est égal à k avec la condition de possibilité de stockage de l'image alpha + beta > a + b Pour l'exemple présenté on a choisi des blocs de 8 par 8 pixels mais la méthode s'applique à d'autres valeurs de H et V. Les valeurs choisies pour H, V et k sont des puissances entiè- res de 2 Dans ce cas les opérateurs div et mod peuvent être réalisés de manière simple: il suffit de séparer un champ de bits en deux champs de bits notés MSB et LSB, qui fournissent respectivement les valeurs résul- tant des opérations div et mod (le point de séparation des bits dépend de la valeur du diviseur H, V ou k) Cette dichotomie est réalisée par les modules marqués 'OP' sur la figure 4 (et sur les figures 9 et 13). Le module w CONC' crée un champ de bits à partir de la concaténation de deux champs de bits MSB et LSB Les autres modules: '+' (additioneur) et n*" (multiplieur) sont connus de l'homme du métier. Sauf mention contraire, les modules opérateurs OP réalisent une division entière par 8, c'est-à-dire que la séparation s'effectue entre le troisième et le quatrième bit. A partir des coordonnées x et y du pixel à traiter, amenées sur des connexions 13 et 14 munies respectivement de a fils et b fils, les modules OP respectivement 11 et 12 fournissent les valeurs ADBLOCH, ADRELH, ADBLOCV, ADRELV, selon les formules ( 1) ( 2) ( 4) ( 5) indiquées plus haut, sur des connexions munies respectivement de a-m fils, m fils, b-p fils et p fils. A partir des valeurs ADRELV et ADRELH, le module CONC 23 déca- le les bits de ADRELV de m positions ce qui revient à multiplier par H, et les concatène avec les bits de ADRELH pour réaliser la formule ( 6) indiquée plus haut, et fournit ainsi ADREL sur une connexion munie de p+m fils. A partir des valeurs IMADIMH et IMADIMV sur des connexions 15 FEV 90 et 16 munies respectivement de a et de b fils, le module OP 18, qui utilise comme diviseur V, fournit sur une connexion munie de b-p fils une valeur NBLOCV qui représente le nombre de blocs verticalement dans l'image, et le module OP 17, qui utilise comme diviseur H, fournit sur une connexion munie de a-m fils la valeur NBLOCH qui est égale à IMADIMH div H de la formule ( 3), c'est-à-dire le nombre de blocs hori- zontalement dans l'image Pour réaliser la formule ( 3), cette valeur est multipliée par ADBLOCV dans le multiplieur 19 et le résultat de la mul- tiplication est ajouté au terme ADBLOCH par un additionneur 20 qui four- nit ainsi NUMBLOC. La valeur NUMBLOC est reprise par un module OP 21 dont le divi- seur est k, et qui fournit donc BLOCV = ADRY selon les formules ( 8) et ( 10), et NUMBLOC mod k (on a: 2 e = k, donc le module OP sépare les el bits de poids le plus faible) Dans le module CONC 22, les bits de cette dernière valeur sont décalés de m+p positions, ce qui revient à multiplier par H*V pour réaliser la formule ( 7), et concaténés avec ADREL, ce qui réalise la formule ( 9) et fournit ADRX. Ce qu'on a appelé de façon générale 'description d'un pixel' peut concerner la luminance aussi bien que la chrominance. Le schéma décrit ci-dessus illustre la démarche permettant le traitement matériel des formules Lorsque les circuits d'affichage du système (qui ne font pas partie de l'invention) génèrent les coordonnées x, y du pixel à afficher dans l'image, le dispositif d'adressage décrit ci-dessus calcule les adresses ADRX et ADRY du pixel en mémoire et peut donc être utilisé pour l'affichage de l'image. Lorsqu'une méthode de compensation de mouvement est utilisée, dans laquelle le décodage d'images comprimées impose d'accéder à un bloc décalé horizontalement et/ou verticalement par rapport au réseau (c'est- à-dire par rapport à un bloc du réseau) et par conséquent pouvant appar- tenir à au plus quatre blocs différents de ce réseau, un autre agence- ment est utilisé, qui sera décrit plus loin en référence aux figures 7 à 12 C'est le cas par exemple du bloc E de la figure 5, dont les pixels appartiennent aux quatre blocs A, B, C, D De plus, le dispositif d'affichage doit pouvoir accéder à un ensemble de pixels constituant une ligne (ou un segment de ligne) d'une image. Avant de procéder à l'affichage, le dispositif de décodage doit lire les pixels de l'image sous la forme 'luminance + différences de FEV 90 couleur" (Y, U, V) pour générer des pixels définis par leur trois cou- leurs fondamentales (Rl Gl B) D'autre part pour des raisons de place on ne stocke de manière intermédiaire qu'une portion de ligne vidéo à l'in- térieur du dispositif de décodage Le dispositif d'adressage par bloc permet de disposer sur une même rangée mémoire de MEMDIMH / V pixels appartenant à une même ligne vidéo et par conséquent accessibles dans une même salve Si l'on utilise une mémoire tampon d'une taille égale à MEMDIMH / Vl on atteint les performances optimales de communication entre la mémoire de stockage et le dispositif de décodage. On appelle "accès en rafale" une opération consistant en la séquence suivante: -envoi à la mémoire d'une adresse "rangée" et du signal URAS" (sélec- tion d'adresse rangée) correspondant, -envoi à la mémoire d'une adresse "colonne' et du signal "CAS" (sélec- tion d'adresse colonne) correspondant, -envoi à la mémoire d'une suite d'adresses "colonne" pour tous les pixels auxquels on désire accéder et qui sont situés sur la même rangée. Dans un dispositif d'adressage "bit map", l'accès à un bloc H*V se faitpar V accès en rafale de H pixels Dans un dispositif o les images sont adressées par bloc, l'accès à un bloc de taille H*V se fait en un seul accès en rafale de H*V pixels dans le cas o le bloc auquel on accède se situe exactement sur une frontière de bloc et se fait au plus en quatre accès en rafale si le bloc se situe à cheval sur plu- sieurs blocs. Par exemple, pour accéder au bloc E de la figure 5, qui repré- sente la disposition physique du bloc dans une image, on prend l'adresse de début du bloc A à laquelle on ajoute successivement les adresses relatives dans ce bloc A: 46, 47, 54, 55, 62, 63, puis on prend l'a- dresse de début du bloc B avec successivement les adresses relatives dans le bloc B: 40 à 45, 48 à 53, 56 à 61, et ainsi de suite avec les blocs C et D. La figure 6 montre la même séquence, mais cette fois du point de vue des positions en mémoire: on y retrouve les blocs A, B, C, D et les positions relatives des pixels dans chaque bloc, mentionnées au paragraphe précédent. Si l'on traite des blocs dont la dimension V est strictement supérieure à 4, le dispositif d'adressage selon l'invention permet FEV 90 d'accéder à un bloc de taille H*V compensé en mouvement d'une manière plus rapide qu'avec un adressage "bit map", et pour les accès à un bloc correspondant exactement à un bloc mémoire, l'accès est plus rapide quelles que soient les valeurs de H et de V. Les dispositifs décrits ciaprès correspondent à la mise en oeuvre du procédé d'adressage lié au type d'accès particulier de la mémoire La spécificité de l'accès (par rangée, par bloc,) entraîne l'usage de dispositifs particuliers, adaptés au calcul d'adresse à réaliser. Pour le traitement de blocs compensés en mouvement, on utilise un dispositif d'adressage qui est destiné à générer les adresses des pixels appartenant à un bloc dont l'adresse de départ est égale à l'adresse d'un bloc mémoire déplacé horizontalement de DX et verticale- ment de DY comme celui représenté par la figure 5 o E est le bloc com- pensé en mouvement par rapport au bloc A avec DX=+ 6 et DY=+ 5 Ce dispo- sitif est décrit en référence à la figure 7 Il reçoit en entrée NBLOCH et NBLOCV, c'est-à-dire le nombres de blocs H*V en horizontal et en ver- tical calculés par les modules 17 et 18 du circuit de la figure 4, ainsi que les déplacements ou décalages horizontaux DX et verticaux DY du bloc compensé en mouvement Il engendre les adresses rangée ADRX et colonne ADRY du pixel en mémoire ainsi que les adresses rangée BUFADRH et colonne BUFADRV du même pixel dans une mémoire tampon destinée à rece- voir le bloc compensé en mouvement. A partir d'un signal de synchronisation de bloc CBLK, le dis- positif CNTRBLK qui est représenté plus en détail à la figure 8 compte dans les compteurs CNTR 27 et 28 le numéro du bloc courant Ce numéro est comparé en horizontal et en vertical, dans des comparateurs 29 et , respectivement avec les valeurs NBLOCH et NBLOCV Le comparateur 29 remet à zéro le compteur 27 à chaque fin de ligne d'image et incrémente en même temps le compteur 28 d'une unité Le comparateur 30 délivre un signal FINIMA qui indique que le dernier bloc de l'image vient d'être traité Le dispositif CNTRBLK génère l'adresse de début du bloc courant ADBLOCH, ADBLOCV, comme le fait le dispositif de la figure 4, mais ici à partir du signal de synchronisation de blocs, et non pas à partir d'une adresse x, y de pixel. Le dispositif OFCAL qui est chargé de calculer le décalage ou FEV 90 "offset" du bloc OFBLKX, OFBLKY et le décalage ou "offset" du pixel OFPELX, OFPELY à ajouter aux adresses bloc et pixel du bloc courant du fait de la compensation de mouvement, est représenté par la figure 9 Il est constitué d'un bloc OP 31 séparant les m bits de plus faible poids dans le mot binaire exprimant la valeur dans la direction horizontale DX du décalage du bloc décalé par rapport au bloc de référence, et d'un bloc OP 32 séparant les p bits de plus faible poids dans le mot binaire exprimant la valeur DY dans la direction verticale du décalage du bloc décalé par rapport au bloc de référence Les bits de plus faible poids fournissent les valeurs OFPELX et OFPELY Il faut noter que les décala- ges DX et DY sont fournis par un dispositif de détermination des mouve- ments qui est indépendant du présent dispositif (et ne fait pas partie de la présente invention), et que les décalages qu'il fournit peuvent dépasser huit pixels, si bien que le bloc déplacé peut avoir son point de départ en dehors du bloc de référence (autrement dit "g m" n'est pas nul). Pour reconstituer le bloc E (figure 5) il faut accéder aux pixels situés dans les blocs A, B, C et D Pour ce faire, deux bits appelés addx et addy servent à désigner dans lequel des quatre carrés A, B, C, D on est en train de travailler Ces bits addx et addy sont déter- minés à partir des valeurs de décalage OFPELX et OFPELY, et d'un signal de synchronisation CK qui indique le changement de bloc au cours du par- cours de A vers B puis C et D Un circuit très simple à cet effet (fi- gure 7) est constitué d'un compteur 37 qui compte les signaux CK Ce compteur compte de zéro à trois puis repart à zéro Le chiffre de comp- tage sort donc sur deux bits En sortie du compteur 37, le bit de plus petit poids est relatif à addx, et le bit de plus fort poids est relatif à addy Ainsi, pendant l'accès au bloc A, addx et addy ont une valeur nulle; pendant l'accès au bloc B, addx a une valeur de 1 et addy une valeur nulle; pendant l'accès au bloc C, addx a une valeur nulle, addy une valeur de 1; enfin pendant l'accès au bloc D, addx et addy ont une valeur de 1 Pour prendre en compte le cas o (dans l'une ou l'autre direction) le décalage serait exactement égal à un nombre entier de blocs, les bits de l'un des mots binaires OFPELX ou OFPELY étant alors tous égaux à zéro, ces valeurs OFPELX et OFPELY sont amenés en parallèle aux entrées (il y a autant d'entrées que de bits par mot) d'une porte OU respectivement 38, 39 dont la sortie est amenée à une entrée de commande FEV 90 * d'une porte ET respectivement 40, 41, et les bits addx et addy doivent traverser respectivement la porte 40 ou la porte 41 pour être validés. Les bits addx et addy sont enfin ajoutés par les modules "+" (figure 9) aux valeurs de sortie (bits de rang le plus élevé) des modu- les respectivement 31 et 32, pour fournir OFBLKX et OFBLKY. Le dispositif NUMBLK qui est représenté plus en détail par la figure 10 est constitué d'un premier additionneur 33 faisant la somme de la valeur de l'adresse du bloc de référence dans la direction verticale (ADBLOCV) et de la valeur du décalage du bloc décalé dans la direction verticale (OFBLKY), d'un multiplieur 34 pour multiplier le résultat délivré par ce premier additionneur avec la valeur du nombre de blocs par image dans la direction horizontale (NBLOCH), d'un deuxième addi- tionneur 35 faisant la somme de la valeur de l'adresse du bloc de réfé- rence dans la direction horizontale (ADBLOCH) et de la valeur du décala- ge du bloc décalé dans la direction horizontale (OFBLKX), et d'un troi- sième additionneur 36 faisant la somme de la valeur délivrée par le deu- xième additionneur et de la valeur délivrée par le multiplieur. Le dispositif GENADR qui est représenté plus en détail par la figure 11 est chargé de générer l'adresse relative des pixels, à l'inté- rieur du bloc compensé en mouvement Il convient de se référer en même temps aux figures 5 et 6 dont l'exemple sera utilisé pour expliquer la séquence d'adresses que doit générer le dispositif GENADR pour chaque bloc mémoire auquel appartient le bloc d'image décalé Un dispositif de contrôle non représenté qui ne fait pas partie de l'invention et qui peut être facilement imaginé par l'homme du métier est chargé d'engen- drer les signaux de contrôle de la partie opérative: les signaux CPELX, CPELY, CPELH, CPELV, sont des signaux d'horloge pour l'incrémentation des compteurs CNTR respectivement A, B, C, D, les signaux LOADX, LOADY, LOADH, LOADV, sont des signaux de chargement d'une valeur initiale pour les compteurs CNTR respectivement A, B, C, D, et les signaux SELDEPX, SELDEPY, SELDEPH, SELDEPV,sont des signaux d'information pour commander le choix de la variable transmise par des multiplexeurs MUX, variable qui est soit zéro, soit respectivement OFPELX, OFPELY, le complément à deux de OFPELX, le complément à deux de OFPELY. On veut d'abord accéder aux pixels 46, 47, 54, 55, 62, 63 situés tous sur une même rangée de la mémoire dans le bloc A Pour cela on charge le compteur A CNTR avec la valeur OFPELX en agissant sur les FEV 90 signaux SELDEPX et LOADX, de même en agissant sur les signaux SELDEPY et LOADY on charge le compteur B CNTR avec la valeur OFPELY De la même façon avec les signaux SELDEPH, SELDEPV, LOADH et LOADV on charge les compteurs C CNTR et D CNTR avec zéro indiqué par"O" sur la figure A chaque nouveau pixel auquel on accède dans la mémoire, on incrémente les compteurs A CNTR et C CNTR Lorsque la valeur de comptage du compteur A CNTR atteint H, OVERFX est mis à 1 ce qui entraîne l'incrémentation des compteurs B CNTR et D CNTR, et le chargement du compteur A CNTR avec OFPELX et du compteur C CNTR avec zéro et l'on recommence à incrémenter A CNTR et C CNTR, le cycle se poursuivant jusqu'à ce que le comptage dans B CNTR atteigne V ce qui met OVERFY à 1 A cet instant tous les pixels auxquels on voulait accéder dans le bloc A ont été atteints et rangés dans une mémoire tampon temporaire à des adresses qui sont four- nies par les compteurs C CNTR et D CNTR. On passe alors à l'accès aux pixels du bloc B Pour cela on charge d'abord le compteur A CNTR avec zéro en agissant sur les fils de commande SELDEPX et LOADX, on charge les compteurs B CNTR et D CNTR com- me pour l'accès au bloc A, on charge le compteur C CNTR avec le complé- ment à 2 de OFPELX en agissant sur les fils de commande SELDEPH et LOADH, et un processus répétitif semblable à celui décrit pour accéder au bloc A prend place jusqu'à ce que la valeur de comptage du compteur B CNTR soit supérieure ou égale à V On passe alors à l'accès aux pixels du bloc C en chargeant les compteurs C CNTR et B CNTR avec zéro, le compteur A CNTR avec OFPELX et le compteur D CNTR avec le complément à 2 de OFPELY et un processus répétitif intervient à nouveau, jusqu'à ce que la valeur de comptage du compteur D CNTR soit cette fois supérieure ou égale à V On accède enfin aux pixels du bloc D en chargeant les comp- teurs A CNTR et B CNTR avec zéro, les compteurs A CNTR et C CNTR avec respectivement les compléments à deux de OFPELX et OFPELY, en agissant toujours sur les mêmes fils de commande, et un processus répétitif intervient à nouveau, jusqu'à ce que la valeur de comptage du compteur D CNTR soit supérieure ou égale à V, ce qui termine l'accès au bloc de pixels recherché. Le fonctionnement des compteurs C et D est semblable, et n'a pas besoin d'être décrit spécifiquement: il suffit de remplacer les signaux référencés X ou Y ci-dessus par les mêmes référencés H ou V, et de noter que les valeurs initiales à charger dans les compteurs sont les compléments à deux, engendrés par des modules référencés 2/COMPL, des valeurs OFPELX et OFPELY Ces compteurs fournissent les valeurs BUFADRH et BUFADRV qui sont les adresses relatives du pixel à l'intérieur du bloc décalé, et permettent d'adresser une mémoire tampon utilisée pour le traitement d'un bloc. Le fonctionnement du dispositif GENADR est illustré par la figure 12 o sont représentés les signaux de contrôle relatifs au dispo- sitif GENADR et correspondant à l'exemple illustré en figures 5 et 6 Le signal CPELX est l'horloge dont une période correspond au temps de trai- tement d'un pixel; la ligne MUXX indique l'action du multiplexeur: sa sortie est positionnée à OFPELX (= + 6) pendant les six périodes corres- pondant aux six pixels 46, 47, 54, 55, 62, 63 du bloc A, puis elle est positionnée sur zéro pour les autres blocs B et D et sur la position OFPELX pour le bloc C; le signal LOADX commande le chargement dans le compteur A CNTR de ce qui sort du multiplexeur, avant le pixel 46 du bloc A, avant le pixel 54 du bloc A, avant le pixel 62 du bloc A, avant le pixel 40 du bloc B, etc; le signal AVERFX est déclenché quand la valeur de comptage du compteur A CNTR atteint huit (=H) c'est-à-dire après deux temps puisqu'il était initialisé à six: enfin la ligne ADRELH indique le résultat, à savoir l'adresse relative du pixel dans son bloc de référence, pour les pixels 46, 47, 54, 55, 62, 63 du bloc A, puis les pixels 40 à 46, 48 du bloc B Les lignes suivantes concernant l'adresse relative en vertical s'expliquent de la même façon à ceci près que l'horloge CPELY y est déclenchée en correspondance avec le signal LOADX Par exemple lorsqu'on passe, dans le bloc B, du pixel 45 au pixel 48, il faut charger la valeur " 48 " dans A CNTR et en même temps incré- menter B CNTR. Le dispositif BLKADREL qui forme l'adresse relative du pixel à partir de ses coordonnées horizontales et verticales dans le bloc, et le dispositif MEMADR qui est chargé de former l'adresse de chaque pixel à partir du numéro de bloc et de l'adresse relative du pixel dans le bloc, sont les mêmes que ceux indiqués figure 4 sous les mêmes références. Lorsque le décalage est nul, le dispositif précédemment décrit peut être sensiblement simplifié du fait que l'on génère des adresses de pixels toujours situés à l'intérieur d'un même bloc mémoire On utilise alors le dispositif d'adressage représenté par la figure 13 qui possède FEV 90 une structure similaire à celle du dispositif décrit ci-dessus pour le calcul des adresses d'un bloc compensé en mouvement Les modules CNTRBLK, NUMBLK, MEMADR, OP sont identiques à ceux déja décrits sous les mêmes références Le module ADRBLK est représenté plus en détail à la figure 14 Il est constitué par un décompteur qui décompte sous l'action d'une horloge CPEL et est initialisé par la valeur H*V sous l'action d'une commande LOAD La valeur de comptage qu'il fournit est ADREL et il indique qu'il est arrivé à sa capacité maximale par un signal OVERF. FEV 90 REVENDICATIONS: 1 Procédé pour gérer le stockage dans une mémoire d'un système de traitement d'images dans lequel les images sont traitées par blocs, cha- cun desdits blocs étant carré ou rectangulaire et contenant plusieurs pixels dans chaque direction horizontale et verticale, la description des pixels à l'intérieur d'un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne, caractérisé en ce que les con- tenus des différents blocs sont placées l'un à la suite de l'autre dans la mémoire. 2 Procédé selon la revendication 1, dans lequel on utilise une mémoire organisée en rangées et en colonnes, caractérisé en ce qu'on y place les contenus des différents blocs en incrémentant l'adresse colon- ne jusqu'à sa valeur limite, après quoi on ramène cette adresse à zéro et on incrémente l'adresse rangée, et ainsi de suite. 3 Procédé selon la revendication 1, dans lequel on utilise des blocs dont les dimensions horizontale et verticale exprimées en nombre de pixels sont des puissances entières de deux, caractérisé en ce qu'on calcule l'adresse mémoire du début d'un bloc contenant un pixel donné, à partir des coordonnées x, y de ce pixel dans l'image, au moyen d'opéra- tions "division entière' et "modulo" avec comme dividende l'une desdites coordonnées x ou y et comme diviseur la susdite dimension respectivement horizontale ou verticale, ces opérations étant réalisées sur ces valeurs représentées par des mots binaires au moyen de dichotomies qui fournissent en tant que résultat d'une division entière les bits dont le rang est supérieur à la susdite puissance de deux, et en tant que résultat d'une opération modulo les bits dont le rang est inférieur ou égal à cette même puissance de deux. 4 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V exprimées en nombre de pixels sont des puissances entières de deux, respectivement m et p, la descrip- tion des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractéri- sé en ce que, les descriptions complètes de chacun des différents blocs étant placées l'une à la suite de l'autre dans la mémoire qui est orga- nisée en rangées et en colonnes, il comporte des moyens pour calculer le numéro d'un bloc dans la mémoire à partir des coordonnées x, y d'un pixel de ce bloc, qui sont constitués de deux opérateurs matériels qui à partir des mots binaires représentant les valeurs de x et de y en extraient les bits de poids supérieur à respectivement m et p, d'un mul- tiplieur auquel sont fournis en tant que multiplicandes, d'une part le nombre de blocs par ligne d'image, et d'autre part le mot binaire fait des bits extraits par l'un des susdits opérateurs dans le mot binaire représentant y (bits qui représentent la coordonnée verticale dans l'image du bloc contenant le pixel), et d'un additionneur auquel sont fournis pour y être additionnés, d'une part le résultat issu du susdit multiplieur, et d'autre part le mot binaire constitué par les bits - extraits par l'autre des susdits opérateurs dans le mot binaire repré- sentant x (bits qui représentent la coordonnée horizontale dans l'image du bloc contenant le pixel). Dispositif selon la revendication 4, avec lequel on désire pou- voir modifier à la demande le format d'image, caractérisé en ce qu'il comporte un opérateur matériel extrayant dans le mot binaire représen- tant la valeur de la dimension horizontale d'une image les bits de poids supérieur à m, de façon à fournir pour chaque format le nombre de blocs par ligne d'image. 6 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V sont des puissances entières de deux, respectivement m et p, la description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, les descriptions complètes de chacun des différents blocs étant placées l'une à la suite de l'autre dans la mémoire qui est organisée en rangées et en colonnes, et l'accès à la mémoire étant organisé sur la base de l'adresse de début d'un bloc, il comporte des moyens pour calculer l'adresse relative d'un pixel dans un bloc à partir de son adresse x, y dans l'image, qui sont constitués de deux opérateurs extrayant respectivement à partir des mots binaires représentant la valeur de x et de y, les m et p bits de plus faible poids, les deux groupes de blocs extraits étant fournis à un opé- rateur qui décale de m bits vers la gauche le groupe de bits extrait de y par l'un des susdits opérateurs, et le concatène avec le groupe de bits extrait de x par l'autre susdit opérateur, ces opérateurs étant matériels. 7 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V sont des puissances entières de deux, la description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, les descriptions complètes de chacun des différents blocs étant placées l'une à la suite de l'autre dans la mémoire qui est organisée en rangées et en colonnes, et l'accès à la mémoire étant organisé sur la base de l'adresse de début d'un bloc, il comporte des moyens pour calculer les adresses rangée et colonne d'un pixel dans la mémoire à partir du numéro du bloc qui contient ce pixel et de l'adresse relative du pixel dans le bloc, qui sont constitués d'un opérateur séparant dans le mot binaire représentant le numéro du bloc les "e" bits de plus faible poids, o Ne' est un entier tel que deux puissance 'e" est égal au nombre de blocs par rangée de mémoire, ces "e" bits étant amenés à un élément de concaténation o ils sont décalés vers la gauche et concaténés avec les bits représentant l'adresse relative du pixel dans le bloc, pour fournir la composante de l'adresse recherchée dans la direction horizontale, c'est-à-dire le numéro de colonne de mémoire, les autres bits (de poids supérieur à "e") fournissant la com- posante de l'adresse recherchée dans la direction verticale, c'est-à- dire le numéro de rangée de mémoire. 8 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, l'image étant donc faite d'un réseau de blocs et chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V sont des puissances entières de deux, la, description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, pour calculer l'adresse en mémoire des pixels contenus dans un bloc de l'image qui est décalé par rapport à un bloc du susdit réseau, le calcul étant fait à partir de l'adresse de ce bloc du réseau, dit bloc de référence, et du décalage du bloc décalé par rapport à ce bloc de référence, en connaissant le nombre de blocs contenus horizontalement dans l'image, il comporte un ensemble constitué: -de moyens pour, à partir du décalage du bloc décalé, calculer de com- bien le bloc est décalé horizontalement et verticalement par rapport au bloc de référence, et pour calculer sa position relative par rapport FEV 90 au bloc du réseau qui contient son point de départ, horizontalement et verticalement, -de moyens pour calculer à partir du décalage du bloc décalé, de l'adresse du bloc de référence, et du nombre de blocs par image en hori- zontal, le numéro, dans l'image, du bloc qui contient le point de départ du bloc décalé, -de moyens pour générer les deux composantes de l'adresse relative du pixel à l'intérieur du bloc dont le numéro est donné par les moyens pré- cédents, -de moyens pour décaler vers la gauche les bits de la composante verti- cale de l'adresse relative du pixel et les concaténer avec les bits de la composante horizontale de cette adresse relative, pour fournir une adresse "linéaire' relative dans le bloc de la mémoire, -de moyens constitués d'un opérateur séparant dans le mot binaire représentant le numéro du bloc les "e' bits de plus faible poids, o ne" est un entier tel que deux puissance "e" est égal au nombre de blocs par rangée de mémoire, ces "e" bits étant amenés à un élément de concaténa- tion o ils sont décalés vers la gauche et concaténés avec les bits issus des moyens précédents pour fournir la composante de l'adresse recherchée dans la direction horizontale (numéro de colonne de mémoire), les autres bits dudit mot binaire fournissant la composante de l'adresse recherchée dans la direction verticale (numéro de rangée de mémoire). 9 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, l'image étant donc faite d'un réseau de blocs et chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V sont des puissances entières de deux respectivement m et p, la description des pixels contenus dans un bloc étant faite en consi- dérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, pour le traitement d'un bloc de l'image qui est décalé par rapport au susdit réseau, il comporte des moyens qui sont constitués d'un bloc séparant les m bits de plus faible poids dans le mot binaire exprimant la valeur dans la direction horizontale du décala- ge du bloc décalé par rapport au bloc de référence, et d'un bloc sépa- rant les p bits de plus faible poids dans le mot binaire exprimant la valeur dans la direction verticale du décalage du bloc décalé par rap- port au bloc de référence. Dispositif muni d'une mémoire pour stocker une image traitée par blocs, l'image étant donc faite d'un réseau de blocs et chacun desdits blocs étant un carré ou un rectangle dont les dimensions horizontale H et verticale V sont des puissances entières de deux, la description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, pour le traitement d'un bloc de l'image qui est décalé par rapport au susdit réseau, il comporte des moyens qui sont constitués d'un pre- mier additionneur faisant la somme de la valeur de l'adresse du bloc de référence dans la direction verticale et de la valeur du décalage du bloc décalé dans la direction verticale, d'un multiplieur pour multi- plier le résultat délivré par ce premier additionneur avec la valeur du nombre de blocs par image dans la direction horizontale, d'un deuxième additionneur faisant la somme de la valeur de l'adresse du bloc de réfé- rence dans la direction horizontale et de la valeur du décalage du bloc décalé dans la direction horizontale, et d'un troisième additionneur faisant la somme de la valeur délivrée par le deuxième additionneur et de la valeur délivrée par le multiplieur. 11 Dispositif muni d'une mémoire pour stocker une image traitée par blocs, l'image étant donc faite d'un réseau de blocs et chacun des- dits blocs étant un carré ou un rectangle dont les dimensions horizonta- le H et verticale V sont des puissances entières de deux, la description des pixels contenus dans un bloc étant faite en considérant les pixels les uns après les autres ligne par ligne dans ce bloc, caractérisé en ce que, pour le traitement d'un bloc de l'image qui est décalé par rapport au susdit réseau, il comporte des moyens qui sont constitués par un pre- mier groupe d'éléments comprenant un multiplexeur pour délivrer une valeur choisie entre, soit zéro, soit la valeur de la position relative, dans la direction horizontale, du bloc décalé par rapport au bloc du réseau qui contient son point de départ, et d'un compteur qui peut être initialisé avec la valeur délivrée par le multiplexeur et qui au rythme d'une horloge délivre la composante horizontale de l'adresse relative du pixel, et par un deuxième groupe constitué de façon identique et qui traite les éléments correspondants dans la direction verticale. 12 Dispositif selon la revendication 11, caractérisé en ce qu'il contient en outre un groupe d'éléments comprenant un circuit arithméti- que délivrant le complément à deux du mot binaire exprimant la valeur de la position relative, dans la direction horizontale, du bloc décalé FEV 90 par rapport au bloc du réseau qui contient son point de départ, un mul- tiplexeur pour délivrer une valeur choisie entre, soit zéro, soit le susdit complément à deux, et un compteur qui peut être initialisé avec la valeur délivrée par le multiplexeur et qui au rythme d'une horloge délivre la composante horizontale de l'adresse relative du pixel, et un autre groupe d'éléments constitué de façon identique et qui traite les éléments correspondants dans la direction verticale. FEV 90